SU1569992A1 - Coder - Google Patents

Coder Download PDF

Info

Publication number
SU1569992A1
SU1569992A1 SU884358978A SU4358978A SU1569992A1 SU 1569992 A1 SU1569992 A1 SU 1569992A1 SU 884358978 A SU884358978 A SU 884358978A SU 4358978 A SU4358978 A SU 4358978A SU 1569992 A1 SU1569992 A1 SU 1569992A1
Authority
SU
USSR - Soviet Union
Prior art keywords
input
inputs
elements
block
decoder
Prior art date
Application number
SU884358978A
Other languages
Russian (ru)
Inventor
Анатолий Алексеевич Самусев
Александр Антонович Шостак
Original Assignee
Предприятие П/Я М-5339
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Предприятие П/Я М-5339 filed Critical Предприятие П/Я М-5339
Priority to SU884358978A priority Critical patent/SU1569992A1/en
Application granted granted Critical
Publication of SU1569992A1 publication Critical patent/SU1569992A1/en

Links

Landscapes

  • Compression, Expansion, Code Conversion, And Decoders (AREA)

Abstract

Изобретение относитс  к вычислительной технике и может быть использовано дл  построени  шифраторов кода нормализации. Изобретение позвол ет при конструировании шифраторов сократить количество логических элементов,  вл ющихс  их составными част ми, при этом функциональные возможности шифраторов остаютс  неизменными. Шифратор содержит блок 1 шифрации пр мого кода, первый и второй дешифраторы 2 и 5 границы нулей, элемент И 3 и блок 4 шифрации инверсного кода. Дешифраторы 2 и 5 границы нулей содержат по четыре элемента И-НЕ 11 - 14. Блок 1 шифрации пр мого кода содержит три элемента И-НЕ 15 - 17. Блок 4 шифрации инверсного кода содержит два элемента И-НЕ 18 и 19. 3 з.п. ф-лы, 1 ил.The invention relates to computing and can be used to construct the encoders of the normalization code. The invention allows for the design of encoders to reduce the number of logical elements that are their constituent parts, while the functionality of the encoders remain unchanged. The encoder contains a block of 1 encryption of the direct code, the first and second decoders 2 and 5 of the boundary of zeros, the element And 3 and block 4 of the encryption of the inverse code. Decoders 2 and 5, the zeros of the boundaries contain four AND-NOT 11-14 elements each. The direct code encryption unit 1 contains three AND-15 elements 17. The encryption unit 4 of the inverse code contains two AND-NOT elements 18 and 19. 3 .P. f-ly, 1 ill.

Description

10ten

СПSP

О со се се гоAbout this and that

i Изобретение относитс  к вычислительной технике и может быть использовано дл  построени  шифраторов кода Йормализации.i The invention relates to computing and can be used to build the encoders of the Jormalization code.

Целью изобретени   вл етс  упрощение шифратораThe aim of the invention is to simplify the encoder.

На чертеже представлена функциональна  схема шифратора.The drawing shows the functional scheme of the encoder.

Ыифратор содержит блок шифрации пр мого кода, первый дешифратор 2 (границы нулей, элемент ИЗ, блок 4 цифрации инверсного кода, второй де- ишфратор 5 границы нулей. На схеме обозначены старший 6 и младший 7 информационные входы, вход 8 блокировки , первый 9 и второй ТО выходы шифратора .The encoder contains a direct code encryption block, the first decoder 2 (zero boundaries, the IZ element, the inverse code digit block 4, the second decoder 5 bounds of zeros. The diagram denotes the high 6 and low 7 information inputs, block 8 input, the first 9 and the second MOT encoder outputs.

Дешифраторы 2 и 5 границы нулей Содержат первый-четвертый элементы И-НЕ.11-14„ Блок 1 шифрации пр мого кода содержит первый-третий элементы Й-НЕ 15-17„ Блок 4 шифрации инверсного кода содержит первый-второй эле- енты И-НЕ 18 и 19.Decoders 2 and 5 zeros of boundaries Contain the first to fourth elements of AND-NE.11-14 "Block 1 of the encryption of the direct code contains the first to third elements of X-NE 15-17" Block 4 of the encryption of the inverse code contains the first to second elements of AND - NOT 18 and 19.

Дешифраторы 2 и 5 предназначены дл  формировани  признака нул  на Своих вторых выходах или фиксации последнего (крайнего справа) нул  в i-руппе нулей, установленных в край- лих левых разр дах информационного зхода дешифраторов 2 и 5, т.е на 1-м (,1,0„„) разр де выхода дешифратора 2(5) формируетс  логический 10, если на всех разр дах информационного входа дешифратора 2(5), начина  с крайнего левого и конча  i-м, установлены логические 1, кодирую- Йще нули.Decoders 2 and 5 are designed to form a sign of zero on their second outputs or to fix the last (rightmost) zero in the i-roll of zeros set in the extreme left bits of the information output of the decoders 2 and 5, i.e., on the 1st ( , 1,0 „„) the decrypter 2 output output (5) forms a logical 10, if at all bits of the information input of the decoder 2 (5), starting from the leftmost and ending i, logical 1 is set, encoding zeros .

Блок 1 предназначен дл  шифрации пр мого кода количества нулей слева, установленных на информационном вход дешифратора 2, и дл  транзитной передачи с инвертированием кода с выхода блока 4„Block 1 is designed to encrypt the forward code of the number of zeros on the left, set to the information input of the decoder 2, and for transit transmission with inverting the code from the output of the block 4 "

Блок 4 предназначен дл  шифрации инверсного (обратного) кода количества нулей слева, установленных на информационном входе дешифратора 5, бе учета крайнего правого разр даUnit 4 is designed to encrypt the inverse (reverse) code of the number of zeros on the left, installed on the information input of the decoder 5, without taking into account the rightmost bit

Ыифратор функционирует следующим образом.The encoder functions as follows.

В исходном состо нии на входах 6 1 устанавливаетс  анализируемый двоичный код. На выходе 9 формируетс  код признака равенства кода на входа 6 и 7 нулю (логическа  1, если на Входах 6 и 7 установлен единичный ко 1 или логический О, если хот  быIn the initial state, the analyzed binary code is set at the inputs 6-1. At output 9, the code of the sign of the equality of the code at input 6 and 7 is zero (logical 1, if Inputs 6 and 7 is set to 1 to 1 or logical O, if at least

00

5five

на одном разр де входов 6 и 7 установлен логический О). В данном случае ноль в каждом разр де входов 6 и 1 кодируетс  логической 1.one of the inputs of the 6 and 7 is set to logical O). In this case, zero in each bit of inputs 6 and 1 is encoded logical 1.

Если на входе 8 установлен код блокировки - логический О, то на выходе 10 устанавливаетс  единичный код Если на входе 8 установлена логическа  1, то на выходе 10 формируетс  код количества нулей слева на разр дах входов 6 и 7 без учета кода на крайнем правом разр де входа 7.If a blocking code, logical O, is set at input 8, then a single code is set at output 10 If logical 1 is set at input 8, then a code for the number of zeros on the left of the bits of inputs 6 and 7 is formed at output 10 without considering the code at the right-most bit. input 7.

Функционирование шифратора может быть по снено двум  примерами0The operation of the encoder can be explained by two examples.

На входе 8 установлена логическа  1, а на входах 6 и 7 установлен код 1110ХХХХ и 1111110Х.Logic 1 is installed at input 8, and code 1110ХХХХ and 1111110Х is installed at inputs 6 and 7.

При коде 111QXXXX на выходе 10 формируетс  код 011, т.е. равный 3, что соответствует количеству логических 1 слева до первого логического О в коде на входах 6 и 7 При коде 111111ОХ на выходе 10 . формируетс  код 110, т.е равныйWith the code 111QXXXX, the output 10 forms a code 011, i.e. equal to 3, which corresponds to the number of logical 1 on the left to the first logical O in the code at inputs 6 and 7 With the code 111111ОХ at output 10. code 110 is generated, i.e. equal

Ид (IId (I

о .about .

00

5five

ОABOUT

5five

00

5five

Claims (4)

Формула изобретени Invention Formula 1 . Ыифратор, содержащий блок шифрации пр мого кода и первый дешифратор границы нулей, первые выходы которого соединены с соответствующими первыми входами блока шифрации пр мого кода, второй вход блока шифрации пр мого кода  вл етс  входом блокировки шифратора отличающийс  тем, что, с целью упрощени  шифратора, в него введены элемент И, блок шифрации инверсного кода и второй дешифратор границы нулей, первые выходы которого соединены с соответствующими первыми входами блока шифрации инверсного кода, выходы которого соединены с соответствующими тре тьими входами блока шифрации пр мого кода, второй выход первого дешифратора границы нулей соединен с вторым входом блока шифрации инверсного код и с первым входом элемента И, второй выход второго дешифратора границы нулей соединен с вторым входом элемента И, выход которого  вл етс  первым выходом шифратора, входы первого и второго дешифраторов границы нулей  вл ютс  соответственно старшим и младшим информационными входами шифратора, выходы блока шифрации пр мого кода  вл ютс  вторым выходом шифратора.one . The encoder contains the direct code encryption unit and the first zero boundary decoder, the first outputs of which are connected to the corresponding first inputs of the direct code encryption unit, the second input of the direct code encryption unit is different, in order to simplify the encoder, An element I, an encryption block of the inverse code and a second decoder of the zero boundary are entered into it, the first outputs of which are connected to the corresponding first inputs of the encryption block of the inverse code whose outputs are connected according The third inputs of the forward code encryption block, the second output of the first zero boundary decoder are connected to the second input of the inverse code encryption block and the first input of the And element, the second output of the second zero boundary decoder is connected to the second input of the And element, the output of which is the first output the encoder, the inputs of the first and second decoders of the zero boundary are respectively the high and low information inputs of the encoder, the outputs of the direct code encryption unit are the second output of the encoder. 2. иифратор поп. 1, отличающийс  тем, что дешифратор границы нулей выполнен на элементах И-НЕ, первый вход первого элемента И-НЕ объединен с первыми входами второго, третьего и четвертого элементов И-НЕ и  вл етс  первым входом дешифратора, второй вход второго элемента И-НЕ объединен с вторыми входами третьего и четвертого элементов И-НЕ и  вл етс  вторым входом дешифратора, третий вход третьего элемента И-НЕобъединен с третьим входом четвертого элемента И-НЕ и  вл етс  третьим входом дешиф- ратора, четвертый вход четвертого элемента И-НЕ  вл етс  четвертым входом дешифратора, инверсный выход четвертого элемента И-НЕ соединен с вторым входом первого элемента И-НЕ, с третьим входом второго элемента И-НЕ и с четвертым входом третьего элемента h-HE, инверсный выход которого соединен с третьим входом первого элемента И-НЕ и с четвертым входом,второго элемента И-НЕ, инверсный выход которого соединен с четвертым входом первого элемента И-НЕ, инверсные выходы первого - четвертого элементов И-НЕ  вл ютс  соответствующими первыми вы- ходами дешифратора, пр мой выход чет2. the performer pop. 1, characterized in that the zeroth border decoder is made on AND-NES elements, the first input of the first NAND element is combined with the first inputs of the second, third and fourth AND-NES elements and is the first input of the decoder, the second input of the second AND-NEA element combined with the second inputs of the third and fourth AND-NOT elements and is the second input of the decoder, the third input of the third AND-NOT connected to the third input of the fourth AND-NOT element and is the third input of the decoder, the fourth input of the fourth AND-NOT element is fourth the input of the decoder, the inverse output of the fourth element AND-NOT connected to the second input of the first element AND-NOT, the third input of the second AND-NOT element and the fourth input of the third h-HE element, the inverse output of which is connected to the third input of the first element AND- NOT and with the fourth input, the second NAND element, the inverse output of which is connected to the fourth input of the first NAND element, the inverse outputs of the first to the fourth AND AND elements are the corresponding first decoder outputs, the forward output 00 5 о 5 o 00 5five вертого элемента И-НЕ  вл етс  вторым выходом дешифратора.AND-NOT is the second output of the decoder. 3. Шифратор по п. 1, отличающийс  тем, что блок шифрации пр мого кода выполнен на элементах И-НЕ, выходы которых  вл ютс  выходами блока, первые входы первого, второго и третьего элементов И-НЕ и объединенные вторые входы первого и второго элементов И-НЕ  вл ютс  соответствующими первыми входами блока второй вход третьего элемента И-НЕ объединен с третьими входами первого и второго элементов И-НЕ и  вл етс , вторым входом блока, четвертые входы первого и второго элементов И-НЕ  вл ютс  соответствующими третьими вхо-- дами блока.3. The encoder according to claim 1, characterized in that the direct code encryption unit is executed on the NAND elements whose outputs are the outputs of the block, the first inputs of the first, second and third elements of NAND and the combined second inputs of the first and second elements AND-NOT are the corresponding first inputs of the block, the second input of the third AND-NO element is combined with the third inputs of the first and second AND-NOT elements and is the second input of the block, the fourth inputs of the first and second AND-NOT elements are the corresponding third inputs. - dami block. 4. Шифратор по п. отличающийс  тем, что блок шифрации инверсного кода выполнен на элементах И-НЕ, выходы которых  вл ютс  выходами блока, первые входы первого и второго элементов И-НЕ  вл ютс  соответствующими первыми входами блока, второй вход первого элемента И-НЕ объединен с вторым входом второго элемента И-НЕ и  вл етс  вторым входом блока .4. The encrypter according to claim. Characterized in that the inverse code encryption unit is executed on the AND-NOT elements whose outputs are the outputs of the block, the first inputs of the first and second AND-NOT elements are the corresponding first inputs of the block, the second input of the first AND element Is NOT combined with the second input of the second NAND element and is the second input of the block.
SU884358978A 1988-01-05 1988-01-05 Coder SU1569992A1 (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
SU884358978A SU1569992A1 (en) 1988-01-05 1988-01-05 Coder

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
SU884358978A SU1569992A1 (en) 1988-01-05 1988-01-05 Coder

Publications (1)

Publication Number Publication Date
SU1569992A1 true SU1569992A1 (en) 1990-06-07

Family

ID=21347832

Family Applications (1)

Application Number Title Priority Date Filing Date
SU884358978A SU1569992A1 (en) 1988-01-05 1988-01-05 Coder

Country Status (1)

Country Link
SU (1) SU1569992A1 (en)

Similar Documents

Publication Publication Date Title
US4807172A (en) Variable shift-count bidirectional shift control circuit
Bose On unordered codes
JPH0428180B2 (en)
JPS63102510A (en) Composite circuit constituting exclusive or gate and/or exclusive nor gate
US5129066A (en) Bit mask generator circuit using multiple logic units for generating a bit mask sequence
SU1569992A1 (en) Coder
JPS6370320A (en) Digital circuit for generating digital sine and cosine function value simultaneously
JPH0374418B2 (en)
US5729725A (en) Mask data generator and bit field operation circuit
JPH0578104B2 (en)
RU2023345C1 (en) Encoder
SU1571591A1 (en) Device for shaping even signals
JPH0427754B2 (en)
SU1753598A1 (en) Code former for track circuit
SU839059A1 (en) Logical redundancy device
SU432487A1 (en) CONVERTER BINDING-DECIMAL CODE TO UNITARY CODE
SU561958A1 (en) Binary-decimal encoder
SU981994A1 (en) Device for adding numbers by modulus
RU2037268C1 (en) Binary-coded-decimal-code-8-4-2-1-to-code-5-4-2-1 converter
SU945988A1 (en) Device for majority decoding of binary codes
AU611005B2 (en) Bidirectional shifting circuit for data processors
SU1751758A1 (en) Priority encoder
SU1767700A1 (en) Binary-to-nonposition fibonacci code converter
SU1211719A1 (en) Device for selecting minimum number of n numbers
SU404079A1 (en) DEVICE FOR ENCRYPTION AND DECODING OF BINARY CODES