RU2613932C9 - Маломощный радиочастотный приемник, преобразующий радиочастотный сигнал в цифровую форму - Google Patents

Маломощный радиочастотный приемник, преобразующий радиочастотный сигнал в цифровую форму Download PDF

Info

Publication number
RU2613932C9
RU2613932C9 RU2012139204A RU2012139204A RU2613932C9 RU 2613932 C9 RU2613932 C9 RU 2613932C9 RU 2012139204 A RU2012139204 A RU 2012139204A RU 2012139204 A RU2012139204 A RU 2012139204A RU 2613932 C9 RU2613932 C9 RU 2613932C9
Authority
RU
Russia
Prior art keywords
frequency
signal
processing unit
digital
receiver
Prior art date
Application number
RU2012139204A
Other languages
English (en)
Other versions
RU2613932C2 (ru
RU2012139204A (ru
Inventor
Ен-Чэн КУАНЬ
Чживэй СЮЙ
Original Assignee
Зе Боинг Компани
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Зе Боинг Компани filed Critical Зе Боинг Компани
Publication of RU2012139204A publication Critical patent/RU2012139204A/ru
Application granted granted Critical
Publication of RU2613932C2 publication Critical patent/RU2613932C2/ru
Publication of RU2613932C9 publication Critical patent/RU2613932C9/ru

Links

Images

Classifications

    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04B—TRANSMISSION
    • H04B1/00—Details of transmission systems, not covered by a single one of groups H04B3/00 - H04B13/00; Details of transmission systems not characterised by the medium used for transmission
    • H04B1/0003—Software-defined radio [SDR] systems, i.e. systems wherein components typically implemented in hardware, e.g. filters or modulators/demodulators, are implented using software, e.g. by involving an AD or DA conversion stage such that at least part of the signal processing is performed in the digital domain
    • H04B1/0007—Software-defined radio [SDR] systems, i.e. systems wherein components typically implemented in hardware, e.g. filters or modulators/demodulators, are implented using software, e.g. by involving an AD or DA conversion stage such that at least part of the signal processing is performed in the digital domain wherein the AD/DA conversion occurs at radiofrequency or intermediate frequency stage
    • H04B1/0021—Decimation, i.e. data rate reduction techniques

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Circuits Of Receivers In General (AREA)
  • Digital Transmission Methods That Use Modulated Carrier Waves (AREA)

Abstract

Изобретение относится к системам связи, в частности к приемнику, преобразующему радиочастотный сигнал в цифровую форму, и предназначено для уменьшения соотношения сигнал-шум приемника. Приемник, преобразующий радиочастотный сигнал в цифровую форму, содержит модулятор, дискретизирующий сигнал на первой частоте. Приемник содержит по меньшей мере один обрабатывающий блок. Обрабатывающий блок содержит множество цифровых полосовых фильтров, разделяющих сигнал и восстанавливающих сигнал на частоте, меньшей первой частоты. Обрабатывающий блок содержит цифровой понижающий преобразователь, регулирующий частотный сдвиг или центрирующий сигнал на частоте, меньшей первой частоты. Приемник содержит по меньшей мере одно буферное управляющее устройство для управления частотой, соединенное с соседними обрабатывающими блоками при размещении в приемнике по меньшей мере двух обрабатывающих блоков. 3 н. и 11 з.п. ф-лы, 9 ил.

Description

Область техники
Примеры реализации настоящего изобретения в целом относятся к системам связи и, в частности, к маломощному радиочастотному приемнику, преобразующему радиочастотный сигнал в цифровую форму, который может выполнять произвольную полосовую фильтрацию в радиочастотной (RF) области и может преобразовать с понижением частоты отфильтрованные радиочастотные (RF) сигналы в цифровой области.
Радиоприемник может преобразовывать сигналы от радиоантенны в форму, в которой их можно использовать. Конструкции для преобразования сигналов, полученных от антенны, могут содержать малошумящий усилитель (LNA), понижающие преобразователи частоты, управляемый напряжением генератор (VCO), низкочастотные фильтры (LPF), синтезирующую систему, опорный генератор, аналого-цифровые преобразователи (ADC) и цифровой сигнальный процессор (DSP), который может содержать модулятор. Создание этих встроенных в приемник узлов радиочастотных блоков и схем с аналоговой полосой пропускания и комбинированными сигналами может потребовать значительных конструкторских усилий и затрат. Кроме того, использование нецифровых схем может поднять вопрос ограниченности запаса по напряжению (амплитуде), возникающей по мере развития технологий и уменьшения питающего напряжения.
В одной из конструкций, выполненной для упрощения и смягчения остроты указанного вопроса ограниченности по напряжению путем удаления большей части схем с радиочастотными и аналоговыми полосами пропускания, входные сигналы от антенны могут быть усилены посредством малошумящего усилителя (LNA) и непосредственно дискретизированы посредством аналого-цифрового преобразователя (ADC). Большая часть обработки аналогового сигнала может быть перемещена в цифровой сигнальный процессор (DSP). Данная конструкция может вводить жесткие требования к аналого-цифровым преобразователям (ADC). Частота дискретизации аналого-цифрового преобразователя (ADC) может представлять собой частоту Найквиста несущей радиочастоты, которая может быть выше, чем ширина полосы частот сигнала. Это может привести к увеличению сложности конструкции и энергопотребления синхронизатора дискретизации для аналого-цифрового преобразователя (ADC). Даже при условии принятия стратегии дискретизации, в полосу пропускания может попасть дополнительный шум, что может уменьшить соотношение сигнал-шум (SNR) приемника.
Таким образом, было бы целесообразно создать систему и способ, решающий описанные выше проблемы.
РАСКРЫТИЕ ИЗОБРЕТЕНИЯ
Радиочастотный приемник, преобразующий радиочастотный сигнал в цифровую форму, содержит модулятор, дискретизирующий сигнал на первой частоте. Приемник содержит по меньшей мере один обрабатывающий блок. Обрабатывающий блок содержит множество цифровых полосовых фильтров, разделяющих сигнал и восстанавливающих сигнал на частоте, меньшей первой частоты. Обрабатывающий блок содержит цифровой понижающий преобразователь, регулирующий частотный сдвиг или центрирующий сигнал на частоте, меньшей первой частоты. Приемник содержит по меньшей мере одно буферное управляющее устройство для управления частотой, соединенное с соседними обрабатывающими блоками при размещении в приемнике по меньшей мере двух обрабатывающих блоков.
Многочастотный повышающий преобразователь содержит цифровой повышающий преобразователь, выполненный с возможностью приема сигнала. Множество цифровых полосовых фильтров соединено с цифровым повышающим преобразователем, выполненным с возможностью разделения сигнала. Цифровой маршрутизатор соединен с множеством полосовых фильтров для объединения сигнала. Цифро-аналоговый преобразователь присоединен к цифровому маршрутизатору для преобразования сигнала в аналоговый сигнал.
Способ уменьшения энергопотребления с использованием радиочастотного приемника включает прием сигнала; фильтрацию сигнала; дискретизацию сигнала на первой частоте; и выполнение по меньшей мере в одном обрабатывающем блоке разделения сигнала на субполосы на частоте обработки, меньшей первой частоты, восстановление сигнала из субполос на частоте обработки и корректирование частотного сдвига или центрирование сигнала на частоте обработки.
Особенности, функции и преимущества могут быть обеспечены независимо друг от друга в различных примерах реализации настоящего изобретения или могут быть объединены в других примерах реализации.
КРАТКОЕ ОПИСАНИЕ ЧЕРТЕЖЕЙ
Примеры реализации настоящего изобретения будут более понятны из подробного описания и прилагаемых чертежей.
На фиг.1 показана блок-схема обобщенной конструкции приемника с однородным процессом обработки.
На фиг.2 показан график процесса преобразования сигнала от несущей частоты к полосе пропускания через множество стадий, каждая из которых выполнена посредством обрабатывающего блока.
На фиг.3 показана блок-схема конкретного варианта приемника.
На фиг.4 показана блок-схема эквивалентного варианта реализации приемника.
На фиг.5 показан график результатов моделирования для конкретного варианта приемника.
На фиг.6 показана схема процесса работы приемника.
На фиг.7 показана блок-схема высокочастотного звукового генератора.
На фиг.8 показана схема процесса работы высокочастотного звукового генератора.
На фиг.9 показан график результатов моделирования для высокочастотного звукового генератора.
ОСУЩЕСТВЛЕНИЕ ИЗОБРЕТЕНИЯ
Согласно фиг.1 может быть показана блок-схема обобщенной конструкции приемника 100 с однородным процессом обработки. Приемник 100 может иметь маломощную конструкцию с цифровым преобразованием радиочастотного сигнала. Приемник 100 может быть описан далее в отношении мобильной платформы. Приемник 100 может быть размещен в смартфоне, мобильном телефоне или аналогичном устройстве, которое обрабатывает входящие радиочастотные сообщения. Кроме того, приемник 100 может быть использован в программно-определяемых радиосистемах (SDR), интеллектуальных радиосистемах, автомобильных средствах связи, мультимедийных системах для транспортных средств и т.п.
Приемник 100 может выполнять процесс полосовой фильтрации, дискретизацию, понижающее преобразование и прореживание при низком уровне сложности и энергоэффективным образом. В отличие от существующих подходов, которые могут содержать несколько конструктивных блоков для совокупности радиочастотной, аналоговой и цифровой областей и могут функционировать на очень высоких синхронизирующих частотах в цифровых схемах, приемник 100 может использовать сочетание многодиапазонной цифровой обработки сигнала (MDSP) и полосовой сигма-дельта аналого-цифровой преобразователь с непрерывным преобразованием (BP-CT-ΔΣ-ADC) для выполнения вышеописанных процессов в обтекаемом и прозрачном приспособлении, функционирующем на синхронизирующей частоте необходимой ширины полосы частот сигнала. Это может обеспечивать уменьшение времени ожидания от входных сигналов до выходных данных, уменьшение количества необходимых конструктивных блоков и уменьшение энергопотребления по сравнению с конструкциями уровня техники. Кроме того, конструкция может устранить жесткие требования к аналого-цифровым преобразователям (ADC). Приемник 100 может содержать конструктивные блоки, которые представляют собой аналоговые схемы или цифровые схемы, уменьшающие радиочастотные схемы, обеспечивающие устойчивость приемника 100 к изменению параметров процесса в современных технологиях сверхбольших интегральных схем (VLSI).
Приемник 100 может выполнять произвольную полосовую фильтрацию (BPF) в радиочастотной (RF) области. В примере реализации по фиг.1 приемник 100 может преобразовывать с понижением частоты отфильтрованные радиочастотные (RF) сигналы в цифровой области. Приемник 100 может применять методологию разработки схем с комбинированными сигналами и обрабатывать сигналы на частоте Найквиста. Приемник 100 может обеспечивать значительные преимущества, состоящие в низком энергопотреблении и небольшой сложности конструкции. Приемник 100 может быть основан на технологии многодиапазонной цифровой обработки сигнала (MDSP) и технологии полосового сигма-дельта аналого-цифрового преобразователя 104 с непрерывным преобразованием (BP-CT-ΔΣ-ADC).
Вместо обработки сигналов на частоте, которая кратна несущей частоте, приемник 100 может работать с сигналами на частоте, которая охватывает ширину полосы частот сигнала. Это уменьшение в частоте обработки может сохранить производительность системы обработки данных и уменьшить общее энергопотребление. Кроме того, маломощный радиочастотный приемник 100, преобразующий радиочастотный сигнал в цифровую форму, может содержать конструктивные блоки, которые могут быть запрограммированы и отрегулированы на необходимую входную частотную область и частоту выходных данных через программируемые модули. Часть многодиапазонной цифровой обработки сигнала (MDSP) приемника 100 может быть переконфигурирована для ее преобразования в многочастотный повышающий преобразователь, который может функционировать в качестве звукового генератора для калибровки в начале работы приемника 100.
В примере реализации по фиг.1 входные радиочастотные (RF) сигналы могут быть введены через антенну (не показано). Антенна может принимать радиоволны и преобразовывать их в электрической схеме. Антенна может быть соединена с усилителем 102. Усилитель 102 может представлять собой малошумящий усилитель (LNA) 102 и может увеличивать мощность сигнала, принимаемого посредством антенны приемника 100.
Малошумящий усилитель (LNA) 102 может быть присоединен к модулятору 104. Модулятор 104 может принимать сигнал от усилителя 102. В примере реализации по фиг.1 модулятор 104 может представлять собой полосовой сигма-дельта аналого-цифровой преобразователь 104А с непрерывным преобразованием (BP-CT-ΔΣ-ADC) и может обрабатывать сигнал путем его фильтрации и дискретизации. Путем перевода сигнала в цифровую область полосовой сигма-дельта аналого-цифровой преобразователь 104А с непрерывным преобразованием (BP-CT-ΔΣ-ADC) может обеспечивать помехозащищенность, надежность и универсальность и может привнести потенциальные улучшения в технические характеристики, энергопотребление и уменьшение затрат. Полосовой сигма-дельта аналого-цифровой преобразователь 104А с непрерывным преобразованием (BP-CT-ΔΣ-ADC) может обеспечивать возможность высокоскоростной работы при одновременном сохранении низкого энергопотребления и площади кристалла. Отсчеты отфильтрованного сигнала, показанные в качестве Xk(n), могут быть созданы на выходе полосового сигма-дельта аналого-цифрового преобразователя 104А с непрерывным преобразованием (BP-CT-ΔΣ-ADC) на частоте Fin_k. Выходной сигнал может обеспечивать высокую степень программируемости и может представлять собой идеальный сигнал для многостандартных радиочастотных приемников 100.
Полосовой сигма-дельта аналого-цифровой преобразователь 104А с непрерывным преобразованием (BP-CT-ΔΣ-ADC) может преобразовывать с понижением частоты входной сигнал, принятый малошумящим усилителем (LNA) 102 в полосе пропускания. Модулятор 104 может подходить для выполнения аналого-цифрового преобразования (ADC) в полосе пропускания на основании узкополосных сигналов. Отфильтрованный сигнал может быть оцифрован частью модулятора 104 с непрерывной дельта-сигма модуляцией (CT-AI). Полосовой сигма-дельта аналого-цифровой преобразователь 104А с непрерывным преобразованием (BP-CT-ΔΣ-ADC) может комбинировать входной сигнал и оцифровывать его, что может потребовать усиления посредством малошумящего усилителя (LNA) 102. Полосовой сигма-дельта аналого-цифровой преобразователь 104А с непрерывным преобразованием (BP-CT-ΔΣ-ADC) может обеспечить использование целого числа синусоидальных импульсов для обратной связи. Основная функция обратной связи может представлять собой по существу полосу пропускания. Это может значительно улучшить технические характеристики модулятора 104 при наличии флуктуации времени задержки и паразитной модуляции длительности импульса. Кроме того, частота дискретизации модулятора 104 может быть меньше несущей частоты, на которую настроен модулятор 104.
Модулятор 104 может быть присоединен к цифровому многофазному фильтру (DPF) 106 согласно примеру реализации по фиг.1. Цифровой многофазный фильтр (DPF) 106 может принимать выходной сигнал полосового сигма-дельта аналого-цифрового преобразователя 104А с непрерывным преобразованием (ВР-СТ-ΔΣ-ADC), показанный как Xk(n). Цифровой многофазный фильтр (DPF) 106 может реализовать многодиапазонную цифровую обработку сигнала (MDSP), что обеспечивает преобразование сигнала с понижением частоты и его прореживание. Фильтр 106 может разделять входной сигнал Xk(n) на некоторое количество равноотстоящих субполос 120, которые субдискретизированы посредством коэффициента М таким образом, что они могут быть дискретизированы в необходимых пределах.
Субполосы 120 могут представлять собой матрицу полосовых фильтров 120 с конечной импульсной характеристикой (FLF), которые разделяют входной сигнал, Xk(n), на множество компонент и каждый из которых фильтрует первоначальный сигнал с различными фильтрационными коэффициентами. Например, фильтрационный коэффициент может составлять Hn(zej(θk+…). Согласно фиг.1 первый фильтрационный коэффициент может составлять H0(zej(θk+…). Цифровой многофазный фильтр (DPF) 106 может восстановить сигнал через объединитель 122 из субполос 120 на частоте Fout_k. Частота Fout_k может быть дифференцирована от частоты Fin_k и может представлять собой частоту, меньшую частоты Fin_k.
Каждый из полосовых фильтров 120 цифрового многофазного фильтра (DPF) 106 может работать на частоте Fout_k. Частота Fout_k может быть больше, чем необходимая ширина полосы пропускания сигнала. Частота Fout_k обычно может быть намного меньше, чем частота Fin_k и может быть выбрана таким образом, что частота Fin_k кратна частоте Fout_k. Количество фильтров 120 с конечной импульсной характеристикой (FLF), обозначенное через М, может быть задано в качестве отношения частоты Fin_k к частоте Fout_k. В цифровом многофазном фильтре (DPF) 106 всего может быть выполнено М субфильтров 120 с конечной импульсной характеристикой (FLF), каждый из которых функционирует на частоте Fout_k. Выходные сигналы Xk(n) полосового сигма-дельта аналого-цифрового преобразователя 104А с непрерывным преобразованием (BP-CT-ΔΣ-ADC) мультиплексированы по времени в каждой субполосе 120, как обозначено пунктирными линиями, показывающими разделение сигнала.
На фиг.2 показан график процесса преобразования сигнала от несущей частоты к полосе пропускания через множество этапов (сверху вниз), каждый из которых выполнен посредством обрабатывающего блока (PU) 110. Конечные импульсные характеристики (FIR) могут быть использованы цифровым многофазным фильтром (DPF) 106 для получения отсчетов из входного сигнала Xk(n). Выходные сигналы от фильтров 120 с конечной импульсной характеристикой (FLF) 120 могут быть затем объединены в объединителе 122 на частоте Fout_k.
В примере реализации по фиг.1 цифровой многофазный фильтр (DPF) 106 может быть присоединен к цифровому понижающему преобразователю (DDC) 108, причем они оба могут работать на частоте Fout_k. Цифровой понижающий преобразователь (DDC) 108 может преобразовывать выходной сигнал цифрового многофазного фильтра (DPF) 106 в оцифрованный действующий сигнал, центрированный на промежуточной частоте (IF), или полосовой комплексный сигнал, центрированный на нулевой частоте. Цифровой понижающий преобразователь (DDC) 108 приемника 100 может затем обеспечить выходной сигнал yk(nMk) на частоте Fout_k.
Приемник 100 может быть размещен в устройстве или может составлять часть единой конструкции с обрабатывающим блоком (PU) 110, в которой множество цифровых многофазных фильтров (DPF) 106 и цифровых понижающих преобразователей (DDC) 108 могут быть размещены последовательно с усилителем 102 и модулятором 104. В одном из показанных примеров реализации полосовой сигма-дельта аналого-цифровой преобразователь 104А с непрерывным преобразованием (BP-CT-ΔΣ-ADC) может быть присоединен к первому обрабатывающему блоку (PU) 110, а именно к PU1, и по существу ко многим другим обрабатывающим блокам (PU) 110. Каждый обрабатывающий блок (PU) 110 может обрабатывать сигнал. Буферное запоминающее устройство 112 для преобразования частоты (RCB) может быть соединено между обрабатывающими блоками (PU) 110 в приемнике 100. Буферные запоминающие устройства 112 для преобразования частоты (RCB) могут быть использованы для обработки сигнала на одной частоте дискретизации и преобразовывания его в новую частоту дискретизации. Количество обрабатывающих блоков (PU) 110 и буферных запоминающих устройств 112 для преобразования частоты (RCB) может быть отрегулировано. Цифровой выходной сигнал может быть получен путем объединения обрабатывающих блоков (PU) 110 и буферных запоминающих устройств 112 для преобразования частоты (RCB).
Согласно фиг. 1 приемник 100 может содержать по меньшей мере один обрабатывающий блок (PU) 110. Каждый обрабатывающий блок (PU) 110 может содержать множество цифровых полосовых фильтров 120 в цифровом многофазном фильтре (DPF) 106. Множество цифровых полосовых фильтров 120 может разделить сигнал, поступающий на частоте Fin_k, и может восстановить сигнал на частоте Fout_k, которая меньше частоты входного сигнала Fin_k. Частоты Fin_k и Fout_k могут быть различны для каждого обрабатывающего блока (PU) 110. Цифровые понижающие преобразователи (DDC) 108 в обрабатывающих блоках (PU) 110 могут регулировать частотный сдвиг или могут центрировать сигнал на частоте, меньшей частоты входного сигнала Fout_k. По меньшей мере одно буферное запоминающее устройство 112 для преобразования частоты (RCB) может быть присоединено к соседним обрабатывающим блокам (PU) 110 при размещении в приемнике 100 по меньшей мере двух обрабатывающих блоков (PU) 110.
Приемник 100 может содержать управляющее устройство 140. Управляющее устройство 140 может быть встроено в приемник 100 при условии работы по меньшей мере двух обрабатывающих блоков (PU) 110. Согласно фиг. 1, управляющее устройство 140 может быть присоединено к каждому из обрабатывающих блоков (PU) 110 и буферных запоминающих устройств 112 для преобразования частоты (RCB) в приемнике 100. Это соединение может обеспечивать возможность конфигурирования обрабатывающих блоков (PU) 110 и буферных запоминающих устройств 112 для преобразования частоты (RCB). При конфигурировании могут быть отрегулированы частоты, на которых происходит обработка сигнала.
Управляющее устройство 140 может быть запрограммировано в программном обеспечении, аппаратном обеспечении или их сочетании. В программной реализации код может быть реализован на нетранзисторном машиночитаемом носителе. Нетранзисторный машиночитаемый носитель управляющего устройства 140 может содержать, без ограничения, энергозависимую память, неэнергозависимую память, магнитные и оптические запоминающие устройства или другие носители, которые выполнены с возможностью хранения кода и/или данных и которые известны или будут разработаны в уровне техники. Код может быть считан и выполнен посредством компьютерной системы, выполняющей способы и процессы, реализованные в качестве структур данных и кода, сохраненных в нетранзисторном машиночитаемом носителе. Кроме того, способы и процессы для управляющего устройства 140 могут быть включены в аппаратные модули. Эти аппаратные модули могут включать чипы со специализированными интегральными схемами (ASIC), логические матрицы с программированием в условиях эксплуатации (FPGA) и другие программируемые логические устройства, известные в уровне техники или разработанные в дальнейшем.
Управляющее устройство 140 может конфигурировать каждый обрабатывающий блок (PU) 110 путем регулирования цифровых полосовых фильтров 120 и цифровых понижающих преобразователей (DDC) 108. В одном из примеров реализации обрабатывающие блоки (PU) 110 и буферные запоминающие устройства 112 для преобразования частоты (RCB) могут быть конфигурированы другим способом, например аппаратным. Управляющее устройство 140 может обходить цифровой понижающий преобразователь (DDC) 108 в обрабатывающем блоке (PU) 110 путем регулирования входной частоты в качестве частоты, кратной частоте обработки текущего обрабатывающего блока (PU) 110, и регулирования несущей частоты в качестве частоты, кратной частоте обработки текущего обрабатывающего блока (PU) 110, при соединении текущего обрабатывающего блока (PU) 110 с модулятором 104. В альтернативном варианте управляющее устройство 140 может регулировать частоту обработки предыдущего обрабатывающего блока (PU) 110 в качестве частоты, кратной частоте обработки текущего обрабатывающего блока (PU) 110, и может регулировать промежуточную частоту в качестве частоты, кратной частоте обработки текущего обрабатывающего блока (PU) 110.
Полученный сигнал может быть разделен в каждом обрабатывающем блоке (PU) 110 путем мультиплексирования по времени. При соединении обрабатывающего блока (PU) 110 с модулятором 104 дискретизированный сигнал от модулятора 104 может быть обеспечен в каждой субполосе 120 цифрового многофазного фильтра (DPF) 106. В альтернативном варианте выходные сигналы предыдущего обрабатывающего блока (PU) 110 могут быть мультиплексированы по времени в субполосах 120 цифрового многофазного фильтра (DPF) 106 текущего обрабатывающего блока (PU) 110.
При использовании множества обрабатывающих блоков (PU) 110 в приемнике 100 всего может функционировать М субфильтров 120 с конечной импульсной характеристикой на частоте Fout_k, меньшей входной частоты Fin_k. М может представлять собой отношение первой частоты к частоте обработки текущего обрабатывающего блока (PU) 110 при размещении обрабатывающего блока (PU) 110 после модулятора 104. При отсутствии соединения обрабатывающего блока (PU) 110 с модулятором 104, например, PU2110, PUk 110 или PUN 110, М может представлять собой отношение частоты обработки предыдущего обрабатывающего блока (PU) 110 к частоте обработки текущего обрабатывающего блока (PU) 110.
Согласно приведенному выше описанию модулятор 104 может обрабатывать сигнал на первой частоте. Первая частота может быть больше несущей частоты. Обрабатывающие блоки (PU) 110, содержащие множество цифровых полосовых фильтров 120 и цифровых понижающих преобразователей (DDC) 108, могут обрабатывать сигнал на частоте большей или равной частоте Найквиста в полосе пропускания сигнала. Обычно эта частота может быть меньше несущей частоты.
Цифровые понижающие преобразователи (DDC) 108 в каждом обрабатывающем блоке (PU) 110 могут функционировать и создавать выходные сигналы на частоте, идентичной частоте М субфильтров 120 с конечной импульсной характеристикой в идентичном обрабатывающем блоке (PU) 110. В одном из примеров реализации цифровой понижающий преобразователь (DDC) 108 в каждом обрабатывающем блоке (PU) 110 может центрировать сигнал на нулевой частоте, если обрабатывающий блок последним создает выходные сигналы. В альтернативном варианте цифровые понижающие преобразователи (DDC) 108 могут корректировать частотный сдвиг до необходимой промежуточной частоты. Первая частота может быть больше несущей частоты. Частота обработки каждого обрабатывающего блока (PU) 110 может охватывать полосу пропускания сигнала и может быть меньше несущей частоты.
Согласно фиг.3 может быть описана блок-схема отдельного варианта приемника 100. Приемник 100 может работать с одним обрабатывающим блоком (PU) 110. Радиочастотный (RF) сигнал может быть принят посредством антенны (не показана). Малошумящий усилитель (LNA) 102 может быть присоединен к антенне. Малошумящий усилитель (LNA) 102 может улучшить сигнал, принятый от антенны. Модулятор 104 может быть присоединен к малошумящему усилителю (LNA) 102. Полосовой сигма-дельта аналого-цифровой преобразователь 104А с непрерывным преобразованием (BP-CT-ΔΣ-ADC) может обрабатывать сигнал от малошумящего усилителя (LNA) 102 путем его фильтрации и дискретизации. Сигнал может быть обработан на первой частоте FS. Частота FS может быть кратна несущей частоте.
Сигнал после его обработки модулятором 104 может быть передан на цифровой многофазный фильтр (DPF) 106. Выходной сигнал модулятора 104 может составлять х(n). В примере реализации по фиг.3 сигнал может быть обработан посредством фильтров 120 с конечной импульсной характеристикой (FLF). Фильтры 120 с конечной импульсной характеристикой (FLF) могут обеспечивать субполосы, причем каждый из этих фильтров фильтрует первоначальный сигнал с различными фильтрационными коэффициентами. Например, фильтрационный коэффициент может составлять Hn(zej(θk+…). Согласно фиг.3 первый фильтрационный коэффициент может составлять H0(zej(θk+…). В данном примере реализации субполосы 120 могут быть представлены для 64 дискретных компонент. Например, каждая субполоса 120 может дискретизировать при коэффициенте, составляющем 64, для предельной дискретизации. Сигнал может быть восстановлен из шестидесяти четырех субполос 120 на второй частоте FOUT посредством объединителя 122. Количество субполос 120, составляющее шестьдесят четыре, может быть эквивалентно или пропорционально отношению первой частоты FS ко второй частоте FOUT. Восстановленный сигнал может быть передан на цифровой понижающий преобразователь (DDC) 108 и выдан в качестве выходного сигнала y(nM,k). Частота FS может быть кратна несущей частоте, а частота FOUT может охватывать полосу пропускания сигнала.
Вся работа цифрового многофазного фильтра (DPF) 106 может быть эквивалентна сочетанию цифрового полосового фильтра (DBF) 402 и цифрового прореживателя 404 (DDEC) с шагом прореживания М-1, показанных в примере реализации по фиг.4. Согласно чертежу сигнал может быть принят от антенны посредством малошумящего усилителя (LNA) 102. Полосовой сигма-дельта аналого-цифровой преобразователь 104А с непрерывным преобразованием (BP-CT-ΔΣ-ADC) может оцифровывать сигнал и подавать его на цифровой полосовой фильтр (DBF) 402 в обрабатывающем блоке (PU) 110. Сигнал х(n) может быть выдан на частоте FS согласно приведенному выше описанию.
Цифровой полосовой фильтр (DBF) 402 может выполнять операции для фильтрации сигнала в заданной полосе пропускания. К цифровому полосовому фильтру (DBF) 402 может быть присоединен цифровой прореживатель (DDEC) 404. Цифровой прореживатель (DDEC) 404 может уменьшать количество отсчетов в дискретном сигнале, принимаемом от цифрового полосового фильтра (DBF) 402. Цифровой прореживатель (DDEC) 404 может довести сигнал, принятый от цифрового полосового фильтра (DBF) 402 до полосы пропускания. Уменьшение может быть пропорционально М, которое было задано в качестве отношения частоты FS к частоте FOUT. Цифровой понижающий преобразователь (DDC) 108, присоединенный к цифровому прореживателю (DDEC) 404, может затем преобразовывать сигнал с понижением частоты на частоте FOUT. Цифровой понижающий преобразователь (DDC) 108 может затем обеспечить выходной сигнал y(nM,k). Сочетание цифрового полосового фильтра (DBF) 402 и цифрового прореживателя (DDEC) 404 может быть эквивалентно цифровому многофазному фильтру (DPF) 106. Цифровой полосовой фильтр (DBF) 402 и цифровой прореживатель (DDEC) 404 могут функционировать на частоте FS. Несмотря на то, что оба этих устройства функционируют на более высокой частоте FS, цифровой многофазный фильтр (DPF) 106 по фиг.3, функционирующий на частоте FOUT, потребляет меньше энергии, чем сочетание цифрового полосового фильтра (DBF) 402 и цифрового прореживателя (DDEC) 404 по фиг.4.
Фильтрационные коэффициенты для каждой субполосы или фильтра 120 с конечной импульсной характеристикой (FLF) могут быть представлять собой мультиплексированные по времени значения соответствующих коэффициентов цифрового полосового фильтра (DBF) 402. В одном из примеров реализации коэффициенты цифрового полосового фильтра (DBF) 402 могут представлять собой перевернутые или преобразованные версии коэффициентов фильтра нижних частот (DLF). Фильтр нижних частот (DLF) может иметь фильтровую ширину полосы пропускания, идентичную цифровому полосовому фильтру (DBF) 402, однако он обрабатывает преобразованные с понижением частоты отсчеты в полосе пропускания. Угол поворота может составлять θk+Δθ, причем θk равно 2π×k×FS/М, а Δθ может составлять разницу между несущей частотой (FC) и θk.
На фиг.5 показан график результатов моделирования для приемника 100. На графике показано объединение процессов полосового сигма-дельта аналого-цифрового преобразователя 104А с непрерывным преобразованием (BP-CT-ΔΣ-ADC) и цифрового многофазного фильтра (DPF) 106.
Согласно фиг.6 может быть описана диаграмма процесса работы приемника 100. Начало процессов для приемника 100 может происходить в блоке 600. В блоке 602 антенна приемника 100 может принимать радиочастотный сигнал. Радиочастотный (FR) сигнал может быть усилен посредством малошумящего усилителя (LNA) 102 в блоке 604. Сигнал может быть отфильтрован в блоке 606. Сигнал может быть дискретизирован в блоке 608. Фильтрация и дискретизация сигнала могут быть выполнены посредством полосового сигма-дельта аналого-цифрового преобразователя 104А с непрерывным преобразованием (BP-CT-ΔΣ-ADC).
В блоке 610 сигнал может быть мультиплексирован по времени в цифровом многофазном фильтре. Цифровой многофазный фильтр (DPF) 106 может разделить оцифрованный сигнал, принятый от модулятора 104, на субполосы 120. Сигнал может быть создан из этих субполос 120 через объединитель 122 цифрового многофазного фильтра (DPF) 106. Восстановленный сигнал может быть преобразован с понижением частоты в блоке 612. Выходной сигнал цифрового понижающего преобразователя (DDC) 108 может быть затем дополнительно обработан или использован путем применений на устройстве. Процессы могут быть завершены в блоке 614.
Согласно фиг.7 может быть описан высокочастотный звуковой генератор 700. Сигнальные пути приемника 100, описанного ранее, могут быть переконфигурированы для обеспечения генератора 700. Высокочастотный звуковой генератор 700 может содержать цифровой повышающий преобразователь (DUC) 702, цифровой многофазный фильтр (DPF) 106 и цифровой маршрутизатор (DR) 704. Дополнительный цифро-аналоговый преобразователь (AUX DAC) 706 может быть присоединен к генератору 700 через цифровой маршрутизатор (DR) 704. Цифровой сигнал, x(nM,k) может быть передан на цифровой повышающий преобразователь (DUC) 702. Сигнал может быть комбинирован с комплексным сигналом посредством цифрового повышающего преобразователя (DUC) 702 и передан на цифровой многофазный фильтр (DPF) 106 на частоте Fin.
В примере реализации по фиг.7 сигнальные пути для цифрового многофазного фильтра (DPF) 106 и цифрового понижающего преобразователя (DDC) 108 приемника 100 могут быть просто переконфигурированы в противоположном направлении таким образом, что весь приемник 100 может быть преобразован в высокочастотный звуковой генератор 700 посредством цифро-аналогового преобразователя (DAC). Каждая субполоса 120 цифрового многофазного фильтра (DPF) 106 может брать часть входного сигнала. Субполосы 120 могут быть присоединены к цифровому маршрутизатору (DR) 704. Цифровой маршрутизатор (DR) 704 может мультиплексировать выходной сигнал субполос в единичный сигнал. Дополнительный цифро-аналоговый преобразователь (AUX DAC) 706 может быть присоединен к цифровому маршрутизатору (DR 704). Дополнительный цифро-аналоговый преобразователь (AUX DAC) 706 может брать сигнал и преобразовывать его в аналоговую форму. Сигнал может быть передан на передатчик. Передатчик может преобразовывать электрические сигналы в радиочастотные сообщения. Частота Fin меньше высокочастотной звуковой частоты, что может уменьшить энергопотребление.
На фиг.8 показан график результатов моделирования для высокочастотного звукового генератора 700. Выходные сигналы этого звукового генератора 700 могут выполнять функцию испытательных сигналов, подаваемых на входы малошумящего усилителя (LNA) 102 или полосового сигма-дельта аналого-цифрового преобразователя 104 с непрерывным преобразованием (BP-CT-ΔΣ-ADC) для выполнения калибровки в начале работы приемника 100.
Согласно фиг.9 может быть описана диаграмма процесса работы высокочастотного звукового генератора 700. Начало процессов генератора 700 может происходить в блоке 900. В блоке 902 цифровой повышающий преобразователь (DUC) 702 генератора 700 может принимать цифровой сигнал. В блоке 904 цифровой повышающий преобразователь (DUC) 702 может надлежащим образом форматировать оцифрованный сигнал путем его преобразования с повышением частоты. Сигнал может быть мультиплексирован по времени посредством цифрового многофазного фильтра (DPF) 106 в блоке 906. Цифровой многофазный фильтр (DPF) 106 может быть видоизменен для генератора 700 и может разделять сигнал на частоте Fin.
В блоке 908 сигнал может быть перенаправлен в цифровой форме через цифровой маршрутизатор (DR) 704 в цифровом многофазном фильтре. Восстановление сигнала на частоте большей Fin может быть использовано цифровым маршрутизатором (DR) 704. Вследствие более низких скоростей обработки на первоначальных стадиях обработки может быть обеспечено сохранение энергии. В блоке 910 сигнал может быть преобразован в аналоговый сигнал посредством дополнительного цифро-аналогового преобразователя (AUX DAC) 706. Завершение процессов может происходить в блоке 912.
Согласно чертежам и приведенному выше описанию раскрыт радиочастотный приемник 100, преобразующий радиочастотный сигнал в цифровую форму, содержащий модулятор 104, дискретизирующий сигнал на первой частоте; по меньшей мере один обрабатывающий блок 110, содержащий множество цифровых полосовых фильтров 120, разделяющих сигнал и восстанавливающих сигнал на частоте, меньшей первой частоты; цифровой понижающий преобразователь 108, регулирующий частотный сдвиг или центрирующий сигнал на частоте, меньшей первой частоты; и по меньшей мере одно буферное управляющее устройство для управления частотой, соединенный с соседними обрабатывающими блоками 110 при размещении по меньшей мере двух обрабатывающих блоков 110 в приемнике 100.
В одном из вариантов радиочастотный приемник 100 с цифровым преобразованием сигнала содержит управляющее устройство 140, конфигурирующее соединения по меньшей мере между одним обрабатывающим блоком 110 и по меньшей мере одним буферным управляющим устройством для управления частотой при размещении по меньшей мере двух обрабатывающих блока 110 в приемнике 100. Еще в одном варианте радиочастотный приемник 100, преобразующий радиочастотный сигнал в цифровую форму, содержит усилитель 102 для приема и усиления сигнала до его приема модулятором 104. Еще в одном варианте модулятор 104 представляет собой полосовой сигма-дельта аналого-цифровой преобразователь с непрерывным преобразованием. Еще в одном варианте множество цифровых полосовых фильтров 120 в каждом обрабатывающем блоке 110 выполнены в виде цифрового многофазного фильтра 106.
В одном из альтернативных вариантов множество цифровых полосовых фильтров 120 в каждом обрабатывающем блоке 110 содержит всего М субфильтров с конечной импульсной характеристикой, каждый из которых функционирует на частоте, меньшей первой частоты, причем М представляет собой отношение первой частоты к частоте обработки текущего обрабатывающего блока 110 при размещении текущего обрабатывающего блока 110 после модулятора 104 или М представляет собой отношение частоты обработки предыдущего обрабатывающего блока 110 к частоте обработки текущего обрабатывающего блока 110. Еще в одном варианте входные сигналы на М субфильтров с конечной импульсной характеристик в каждом обрабатывающем блоке 110 поданы путем мультиплексирования по времени выходных сигналов модулятора 104 при размещении текущего обрабатывающего блока 110 после модулятора 104 или мультиплексирования по времени выходных сигналов обрабатывающего блока 110.
Еще в одном варианте, в котором модулятор 104 обрабатывает сигнал на первой частоте, которая больше несущей частоты, множество цифровых полосовых фильтров 120 и цифровые понижающие преобразователи 108 в каждом обрабатывающем блоке 110 обрабатывают сигнал на частоте, которая больше или равна частоте Найквиста в полосе пропускания сигнала, однако меньше несущей частоты. Еще в одном варианте цифровой преобразователь 108 с понижением частоты в каждом обрабатывающем блоке 110 функционирует и создает выходные сигналы для обрабатывающего блока 110 на частоте, идентичной частоте М субфильтров с конечной импульсной характеристикой в идентичном обрабатывающем блоке 110. В одном из примеров цифровой преобразователь 108 с понижением частоты в каждом обрабатывающем блоке 110 центрирует сигнал на нулевой частоте при условии, что обрабатывающий блок 110 последним создает окончательные выходные сигналы, в противном случае он корректирует частотный сдвиг до необходимой промежуточной частоты. Еще в одном варианте, в котором первая частота больше несущей частоты, частота обработки каждого обрабатывающего блока 110 охватывает полосу пропускания сигнала и меньше несущей частоты.
В одном из вариантов раскрыт многочастотный повышающий преобразователь, содержащий цифровой повышающий преобразователь 702 для приема сигнала, множество цифровых полосовых фильтров 120, соединенных с цифровым повышающим преобразователем 702 для разделения сигнала; цифровой маршрутизатор, соединенный с множеством цифровых полосовых фильтров120 для объединения сигнала; и цифро-аналоговый преобразователь 706, присоединенный к цифровому маршрутизатору для преобразования сигнала в аналоговый сигнал. В одном из вариантов сигнал подан в качестве тестирующего сигнала на малошумящий усилитель 102 или модулятор 104 в радиочастотном приемнике 100 с цифровой обработкой сигнала для выполнения калибровки. Еще в одном варианте многочастотный повышающий преобразователь содержит радиочастотный приемник 100 с цифровой обработкой сигнала. В одном из вариантов цифровой повышающий преобразователь 702 и множество цифровых полосовых фильтров 120 повторно использованы в качестве обрабатывающего блока 110 в радиочастотном приемнике 100, преобразующем радиочастотный сигнал в цифровую форму. В одном из альтернативных вариантов радиочастотный приемник 100 содержит модулятор 104, дискретизирующий сигнал на первой частоте; множество обрабатывающих блоков 110, каждый из которых содержит: множество цифровых полосовых фильтров 120, разделяющих сигнал и восстанавливающих сигнал на частоте, меньшей первой частоты; цифровой понижающий преобразователь 108, регулирующий частотный сдвиг или центрирующий сигнал; по меньшей мере одно буферное управляющее устройство для управления частотой, соединенное с соседними обрабатывающими блоками 110; и управляющее устройство 140, конфигурирующее соединения между каждым обрабатывающим блоком 110 и буферным управляющим устройством для управления частотой.
В одном из вариантов раскрыт способ для уменьшения энергопотребления на приемнике 100, включающий: прием сигнала; фильтрацию сигнала; дискретизацию сигнала на первой частоте; по меньшей мере в одном обрабатывающем блоке 110: разделение сигнала на субполосы 120 на частоте обработки, меньшей первой частоты; восстановление сигнала из субполос 120 на частоте обработки; и корректирование частотного сдвига или центрирование сигнала на частоте обработки.
В одном из вариантов способ включает обход цифрового понижающего преобразователя 108 в обрабатывающем блоке 110 путем регулирования первой частоты в качестве частоты, кратной частоте обработки текущего обрабатывающего блока 110, и регулирования несущей частоты в качестве частоты, кратной частоте обработки текущего обрабатывающего блока 110 при соединении текущего обрабатывающего блока 110 с модулятором 104 или регулирования частоты обработки предыдущего обрабатывающего блока 110 в качестве частоты, кратной частоте обработки текущего обрабатывающего блока 110, и регулирования промежуточной частоты в качестве частоты, кратной частоте обработки текущего обрабатывающего блока 110.
В одном из вариантов разделение сигнала включает временное мультиплексирование дискретизированного сигнала в каждой субполосе 120 при соединении текущего обрабатывающего блока 110 с модулятором 104 или временное мультиплексирование выходных сигналов предыдущего обрабатывающего блока 110 в каждой субполосе 120 в текущем обрабатывающем блоке 110. Еще в одном варианте способ может включать конфигурирование каждого обрабатывающего блока 110 путем регулирования множества цифровых полосовых фильтров 120 и цифрового понижающего преобразователя 108 в обрабатывающем блоке 110 посредством управляющего устройства 140 или обход множества цифровых полосовых фильтров 120 и цифрового преобразователя 108 с понижением частоты в обрабатывающем блоке 110 посредством управляющего устройства 140.
Несмотря на то, что примеры реализации настоящего изобретения были в терминах различных конкретных примеров реализации, специалисту в области техники будет понятно, что примеры реализации настоящего изобретения могут быть реализованы с изменениями в рамках сущности и объема формулы изобретения.

Claims (28)

1. Приемник (100), преобразующий радиочастотный сигнал в цифровую форму и содержащий:
модулятор (104), дискретизирующий сигнал на первой частоте;
по меньшей мере два обрабатывающих блока (110), каждый из которых содержит:
множество цифровых полосовых фильтров (120), разделяющих сигнал и восстанавливающих его на частоте, меньшей первой частоты;
цифровой понижающий преобразователь (108), регулирующий частотный сдвиг или центрирующий сигнал на частоте, меньшей первой частоты; и
по меньшей мере одно буферное управляющее устройство для управления частотой, соединенное с соседними обрабатывающими блоками (110).
2. Приемник (100) по п. 1, содержащий управляющее устройство (140), конфигурирующее соединения по меньшей мере между одним обрабатывающим блоком (110) и по меньшей мере одним буферным управляющим устройством для управления частотой.
3. Приемник (100) по п. 1 или 2, дополнительно содержащий усилитель (102) для приема и усиления сигнала до приема сигнала модулятором (104).
4. Приемник (100) по п. 1 или 2, в котором модулятор (104) представляет собой полосовой дельта-сигма аналого-цифровой преобразователь с непрерывным преобразованием.
5. Приемник (100) по п. 1 или 2, в котором множество цифровых полосовых фильтров (120) в каждом обрабатывающем блоке (110) выполнены в виде цифрового многофазного фильтра (106).
6. Приемник (100) по п. 1 или 2, в котором множество цифровых полосовых фильтров (120) в каждом обрабатывающем блоке (110) всего содержит М субфильтров с характеристиками конечной длительности, каждый из которых функционирует на частоте, меньшей первой частоты,
причем значение М представляет собой отношение первой частоты к частоте обработки текущего обрабатывающего блока (110) при размещении текущего обрабатывающего блока (110) рядом с модулятором (104) или отношение частоты обработки предыдущего обрабатывающего блока (110) к частоте обработки текущего обрабатывающего блока (110).
7. Приемник (100) по п. 6, в котором входные сигналы на М субфильтров с характеристиками конечной длительности в каждом обрабатывающем блоке (110) поданы путем мультиплексирования по времени выходных сигналов модулятора (104) при размещении текущего обрабатывающего блока (110) рядом с модулятором (104) или мультиплексирования по времени выходных сигналов предыдущего обрабатывающего блока (110).
8. Приемник (100) по любому из пп. 1-2, 7, в котором модулятор (104) выполнен с возможностью обработки сигнала на первой частоте, которая больше несущей частоты, а множество цифровых полосовых фильтров (120) и цифровые понижающие преобразователи в каждом обрабатывающем блоке (110) выполнены с возможностью обработки сигнала на частоте, большей или равной частоте Найквиста в полосе пропускания сигнала, но меньшей несущей частоты.
9. Приемник по любому из пп. 1-2, 7, в котором цифровой преобразователь с понижением частоты в каждом обрабатывающем блоке (110) выполнен с возможностью функционирования и создания выходных сигналов для обрабатывающего блока (110) на частоте, идентичной частоте М субфильтров с характеристиками конечной длительности в идентичном обрабатывающем блоке (110).
10. Приемник по любому из пп. 1-2, 7, в котором цифровой преобразователь (108) с понижением частоты в каждом обрабатывающем блоке (110) центрирует сигнал на нулевой частоте при условии, что обрабатывающий блок (110) последним создает окончательные выходные сигналы, или корректирует частотный сдвиг до необходимой промежуточной частоты.
11. Способ уменьшения энергопотребления на приемнике (100), преобразующем радиочастотный сигнал в цифровую форму, включающий:
прием сигнала;
фильтрацию сигнала;
дискретизацию сигнала на первой частоте;
выполнение по меньшей мере в одном обрабатывающем блоке (110):
разделения сигнала на субполосы (120) на частоте обработки, меньшей первой частоты;
восстановления сигнала из субполос (120) на частоте обработки; и
корректирования частотного сдвига или центрирования сигнала на частоте обработки,
причем способ дополнительно включает конфигурирование каждого обрабатывающего блока (110) путем регулирования множества цифровых полосовых фильтров (120) и цифрового понижающего преобразователя (108) в обрабатывающем блоке (110) посредством управляющего устройства (140) или обхода множества цифровых полосовых фильтров (120) и цифрового преобразователя (108) с понижением частоты в обрабатывающем блоке (110) посредством управляющего устройства (140).
12. Способ по п. 11, включающий обход цифрового понижающего преобразователя (108) в обрабатывающем блоке (110) путем регулирования первой частоты в качестве частоты, кратной частоте обработки текущего обрабатывающего блока (110), и регулирования несущей частоты в качестве частоты, кратной частоте обработки текущего обрабатывающего блока (110), при соединении текущего обрабатывающего блока (110) с модулятором (104) или путем регулирования частоты обработки предыдущего обрабатывающего блока (110) в качестве частоты, кратной частоте обработки текущего обрабатывающего блока (110), и регулирования промежуточной частоты в качестве частоты, кратной частоте обработки текущего обрабатывающего блока (110).
13. Способ по п. 11, в котором разделение сигнала включает временное мультиплексирование дискретизированного сигнала в каждой субполосе (120) при соединении текущего обрабатывающего блока (110) с модулятором (104) или временное мультиплексирование выходных сигналов предыдущего обрабатывающего блока (110) в каждой субполосе (120) в текущем обрабатывающем блоке (110).
14. Система для уменьшения энергопотребления, содержащая приемник по любому из пп. 1-10 и/или выполненная с возможностью выполнения способа по любому из пп. 11-13.
RU2012139204A 2011-09-15 2012-09-13 Маломощный радиочастотный приемник, преобразующий радиочастотный сигнал в цифровую форму RU2613932C9 (ru)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
US13/233,938 US8625726B2 (en) 2011-09-15 2011-09-15 Low power radio frequency to digital receiver
US13/233938 2011-09-15

Publications (3)

Publication Number Publication Date
RU2012139204A RU2012139204A (ru) 2014-03-20
RU2613932C2 RU2613932C2 (ru) 2017-03-22
RU2613932C9 true RU2613932C9 (ru) 2017-07-25

Family

ID=47177739

Family Applications (1)

Application Number Title Priority Date Filing Date
RU2012139204A RU2613932C9 (ru) 2011-09-15 2012-09-13 Маломощный радиочастотный приемник, преобразующий радиочастотный сигнал в цифровую форму

Country Status (5)

Country Link
US (1) US8625726B2 (ru)
EP (1) EP2571174B1 (ru)
JP (1) JP6033012B2 (ru)
CN (1) CN103051347B (ru)
RU (1) RU2613932C9 (ru)

Families Citing this family (92)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US10917163B2 (en) 2014-08-15 2021-02-09 SEAKR Engineering, Inc. Integrated mixed-signal RF transceiver with ADC, DAC, and DSP and high-bandwidth coherent recombination
EP2744102B1 (en) * 2012-12-17 2018-07-04 Nxp B.V. Digital down converter circuit
US9270390B2 (en) * 2014-03-28 2016-02-23 Olympus Corporation Frequency and phase offset compensation of modulated signals with symbol timing recovery
US10320432B2 (en) * 2014-06-19 2019-06-11 Teko Telecom S.R.L. Appliance for receiving radio frequency signals, usable in particular for the management of uplink signals
EP3866423A1 (en) 2014-08-15 2021-08-18 Seakr Engineering, Inc. Integrated mixed-signal asic with adc, dac, and dsp
US11269455B1 (en) 2020-10-23 2022-03-08 Sigmasense, Llc. Enhanced mutual capacitance touch screen display with noise compensation and methods for use therewith
US11907484B2 (en) 2015-06-22 2024-02-20 Sigmasense, Llc. Function and orientation identification for input/output (I/O) operative touch sensor device (TSD)
US10664098B2 (en) 2015-06-22 2020-05-26 Sigmasense, Llc. Channel driver circuit
US11397492B2 (en) 2015-06-22 2022-07-26 Sigmasense, Llc. Enhanced mutual capacitance touch screen display with shape detection and methods for use therewith
KR101909515B1 (ko) 2015-06-22 2018-10-18 시그마센스, 엘엘씨. 개선된 성능을 위해 동시적인 기능들을 사용하는 다중 터치 센서 및 정전기 펜 디지타이징 시스템
JP6551915B2 (ja) 2015-07-06 2019-07-31 シグマセンス，エルエルシー 内圧、傾き及び回転についてのペンシステム
US10213134B2 (en) 2016-08-18 2019-02-26 Timothy W. Markison Wireless in-shoe physical activity monitoring implementation
US10838530B2 (en) 2017-09-15 2020-11-17 Sigmasense, Llc. Touchscreen display with concurrent touch and display operations
US11003205B2 (en) 2019-02-04 2021-05-11 Sigmasense, Llc. Receive analog to digital circuit of a low voltage drive circuit data communication system
US11635396B2 (en) 2018-08-27 2023-04-25 Sigmasense, Llc. Sensing device with drive sense circuit and particle sensor and methods for use therewith
US10554215B1 (en) 2019-03-26 2020-02-04 Sigmasense, Llc. Analog to digital conversion circuit with very narrow bandpass digital filtering
US10895867B2 (en) 2018-08-27 2021-01-19 Sigmasense, Llc. Analog world interfacing for automated systems
US11822358B2 (en) 2018-08-27 2023-11-21 Sigmasense, Llc. Drive-sense circuit to determine effects of different electrical characteristics on load
US11644860B2 (en) 2018-08-27 2023-05-09 Sigmasense, Llc. Configuring a programmable drive sense unit
US11550426B2 (en) 2018-08-27 2023-01-10 Sigmasense, Llc. Sensor monitoring system
US11099032B2 (en) 2018-08-27 2021-08-24 Sigmasense, Llc. Drive sense circuit with drive-sense line
US11513543B2 (en) 2018-08-27 2022-11-29 Sigmasense, Llc. Impedance detect drive sense circuit
US12007421B2 (en) 2018-08-27 2024-06-11 Sigmasense, Llc. Load sensing circuit employing sink and sense configuration
US11429226B2 (en) 2018-08-27 2022-08-30 Sigmasense, Llc. Analog-digital drive sense circuit
US11914812B2 (en) 2018-08-27 2024-02-27 Sigmasense, Llc. Current reference operative drive-sense circuit (DSC)
US10862504B2 (en) * 2018-08-29 2020-12-08 Mediatek Singapore Pte. Ltd. Radio frequency bandpass delta-sigma analog-to-digital converters and related methods
US10845985B2 (en) 2018-09-14 2020-11-24 Sigmasense, Llc. Identification in touch systems
US10908718B2 (en) 2018-09-14 2021-02-02 Sigmasense, Llc. Large touch screen display with integrated electrodes
US11899867B2 (en) 2018-09-14 2024-02-13 Sigmasense, Llc. Touch screen display with touchless gestures and methods for use therewith
US11789555B2 (en) 2018-09-14 2023-10-17 Sigmasense, Llc. Touch sense control circuit with noise suppression
US11875005B2 (en) 2018-09-14 2024-01-16 Sigmasense, Llc. Touch screen display with touchless indications and methods for use therewith
US11372510B2 (en) 2018-11-02 2022-06-28 Sigmasense, Llc. Multi-conductor touch system
US10935585B2 (en) 2018-11-19 2021-03-02 Sigmasense, Llc. Drive sense circuit with transient suppression
US10852857B2 (en) 2018-11-19 2020-12-01 Sigmasense, Llc. Frequency diverse e-pen for touch sensor and e-pen systems
US10996728B2 (en) 2019-01-04 2021-05-04 Sigmasense, Llc. Power supply signal conditioning system based on drive-sense circuit (DSC) processing
US10831690B2 (en) 2019-01-14 2020-11-10 Sigmasense, Llc. Channel allocation among low voltage drive circuits
US10733133B1 (en) 2019-01-14 2020-08-04 Sigmasense, Llc. Low voltage drive circuit with range limits and methods for use therewith
US10684977B1 (en) 2019-01-14 2020-06-16 Sigmasense, Llc. Low voltage drive circuit with bus isolation and methods for use therewith
US10884967B2 (en) 2019-01-14 2021-01-05 Sigmasense, Llc. Low voltage drive circuit with variable frequency characteristics and methods for use therewith
US10831226B2 (en) 2019-01-14 2020-11-10 Sigmasense, Llc Low voltage drive circuit with variable oscillating frequencies and methods for use therewith
US11327917B2 (en) 2019-01-14 2022-05-10 Sigmasense, Llc. Low voltage drive circuit and communication system
US10826747B2 (en) 2019-01-14 2020-11-03 Sigmasense, Llc. Low voltage drive circuit with digital to digital conversion and methods for use therewith
US10915483B2 (en) 2019-01-14 2021-02-09 Sigmasense, Llc. Low voltage drive circuit with variable oscillating characteristics and methods for use therewith
US11061082B2 (en) 2019-03-18 2021-07-13 Sigmasense, Llc. Single line hall effect sensor drive and sense
US10671034B1 (en) 2019-03-18 2020-06-02 Sigmasense, Llc. Motor drive input adaptation with in-line drive-sense circuit
US12046214B2 (en) 2019-03-22 2024-07-23 Sigmasense, Llc. Display controller with row enable based on drive settle detection
US11029782B2 (en) 2019-05-03 2021-06-08 Sigmasense, Llc. Light emitting diode (LED) touch display circuit
US10756578B1 (en) 2019-05-31 2020-08-25 Sigmasense, Llc. Wireless power transfer with in-line sensing and control
US11131714B2 (en) 2019-05-31 2021-09-28 Sigmasense, Llc. Battery monitoring and characterization during charging
US11056930B2 (en) 2019-05-31 2021-07-06 Sigmasense, Llc. Wireless power transfer and communications
US11216133B2 (en) 2019-06-10 2022-01-04 Sigmasense, Llc. Device for use with a touch screen
US11221709B2 (en) 2019-06-10 2022-01-11 Sigmasense, Llc. Electronic writing apparatus with ring-back and other functionalities
US11054920B2 (en) 2019-06-10 2021-07-06 Sigmasense, Llc. Pen for use with a touch screen
US11126297B2 (en) 2019-06-10 2021-09-21 Sigmasense, Llc. Electronic pen with ring-back and other functionalities
US11029769B2 (en) 2019-06-10 2021-06-08 Sigmasense, Llc. Pen for use with a touch screen
US11555687B2 (en) 2019-08-08 2023-01-17 Sigmasense, Llc. Capacitive imaging glove
US10976837B2 (en) 2019-08-20 2021-04-13 Sigmasense, Llc. User input passive device for use with an interactive display device
US11017845B2 (en) 2019-09-11 2021-05-25 Sigmasense, Llc. RAM cell processing circuit for concurrency of refresh and read
US10908641B1 (en) 2019-10-09 2021-02-02 Sigmasense, Llc. Display generated data transmission from user device to touchscreen via user
US11221980B2 (en) 2019-10-31 2022-01-11 Sigmasense, Llc. Low voltage drive circuit operable to convey data via a bus
US11190205B2 (en) 2019-11-08 2021-11-30 Sigmasense, Llc. Single-ended direct interface dual DAC feedback photo-diode sensor
US11133811B2 (en) 2019-11-08 2021-09-28 Sigmasense, Llc. High resolution analog to digital converter (ADC) with improved bandwidth
US10862492B1 (en) 2019-11-08 2020-12-08 Sigmasense, Llc. Current operative analog to digital converter (ADC)
US11709189B2 (en) 2019-11-08 2023-07-25 Sigmasense, Llc. Two-element high accuracy impedance sensing circuit with increased signal to noise ratio (SNR)
US11935397B2 (en) 2019-12-30 2024-03-19 Sigmasense, Llc. Organic and inorganic test system
US11216109B2 (en) * 2020-01-07 2022-01-04 Sigmasense, Llc. Drive-sense control for extended sensor panels
US11221704B2 (en) 2020-02-05 2022-01-11 Sigmasense, Llc. Screen-to-screen communication via touch sense elements
US11079888B1 (en) 2020-02-18 2021-08-03 Sigmasense, Llc. Sensitivity region of interest processing (ROIP) for input/output (I/O) operative touch sensor device (TSD)
US11144160B1 (en) 2020-03-30 2021-10-12 Sigmasense, Llc. Three-dimensional data reduction method and system
US11182038B2 (en) 2020-04-08 2021-11-23 Sigmasense, Llc. Encoded data pattern touchscreen sensing system
US11340995B2 (en) 2020-05-21 2022-05-24 Sigmasense, Llc. Integrated circuit with programmable input/output module
US11439812B2 (en) 2020-06-03 2022-09-13 Sigmasense, Llc. Array operative to perform distributed/patterned sensing and/or stimulation across patient bodily section
US11504535B2 (en) 2020-06-03 2022-11-22 Sigmasense, Llc. Pacemaker operative to deliver impulses of pace signal and sense cardiac response via single conductor of pacemaker lead
CN113839724B (zh) * 2020-06-08 2024-01-26 杭州海康威视数字技术股份有限公司 频谱侦测装置
US11304002B2 (en) 2020-08-12 2022-04-12 Sigmasense, Llc. Single transducer audio in/out device
US11539375B2 (en) * 2020-10-21 2022-12-27 The Boeing Company System and method for direct signal down-conversion and decimation
US11374587B1 (en) 2021-02-25 2022-06-28 Sigmasense, Llc. Batteryless wireless sensor system
US20220342513A1 (en) * 2021-04-23 2022-10-27 Sigmasense, Llc. Processing z-direction pressure indication of a passive pen
US11575850B2 (en) 2021-05-28 2023-02-07 Sigmasense, Llc. Imaging device with drive-sense circuit(s) and methods for use therewith
US11575851B2 (en) 2021-05-28 2023-02-07 Sigmasense, Llc. Handheld communication device with drive-sense circuit based imaging array and methods for use therewith
US11977123B2 (en) 2021-06-01 2024-05-07 Sigmasense, Llc. Sensing voltage using micro-watt sensor
US11679678B2 (en) 2021-06-28 2023-06-20 Sigmasense, Llc. Vehicle system for detecting and visually conveying vehicle button interaction
US11733818B2 (en) 2021-07-19 2023-08-22 Sigmasense, Llc. Identifying capacitively coupled devices
US11556298B1 (en) 2021-07-30 2023-01-17 Sigmasense, Llc Generation and communication of user notation data via an interactive display device
US11592874B1 (en) 2021-08-04 2023-02-28 Sigmasense, Llc. Touch sensing in a flexible/foldable touch screen display
US11797139B2 (en) 2021-09-21 2023-10-24 Sigmasense, Llc. Fingerprint scanning device incorporating drive-sense circuitry
US11435864B1 (en) 2021-09-28 2022-09-06 Sigmasense, Llc. Differential touch screen display
US11709563B2 (en) 2021-10-26 2023-07-25 Sigmasense, Llc. Touch-based device with interlaced electrode grids
US11740752B1 (en) 2022-07-13 2023-08-29 Sigmasense, Llc. Device with signal generator
EP4311113A1 (en) * 2022-07-21 2024-01-24 Rohde & Schwarz GmbH & Co. KG Radio frequency receiver and operation method thereof
US20240039551A1 (en) * 2022-07-31 2024-02-01 Texas Instruments Incorporated Non-pll, 1-wire, asynchronous oversampling of delta-sigma adc bitstream
US12050740B2 (en) 2022-11-29 2024-07-30 Sigmasense, Llc. Passive device with compressible pressure assembly for Z-direction capacitance detection

Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20040190660A1 (en) * 2003-03-31 2004-09-30 Morris Bradley John Digital receiver and method
US20040192229A1 (en) * 2003-03-31 2004-09-30 Morris Bradley John Digital transmitter and method
US20060222116A1 (en) * 2005-03-31 2006-10-05 Freescale Semiconductor, Inc. AGC with integrated wideband interferer detection
RU2292658C2 (ru) * 2001-12-05 2007-01-27 Мацусита Электрик Индастриал Ко., Лтд. Цифровой многочастотный приемопередатчик
US20080159453A1 (en) * 2001-05-15 2008-07-03 Smith Francis J Radio receiver

Family Cites Families (20)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5555534A (en) * 1994-08-05 1996-09-10 Acuson Corporation Method and apparatus for doppler receive beamformer system
US5757867A (en) * 1995-03-30 1998-05-26 The United States Of America As Represented By The Secretary Of The Navy Digital mixing to baseband decimation filter
US5621345A (en) 1995-04-07 1997-04-15 Analog Devices, Inc. In-phase and quadrature sampling circuit
US5952947A (en) * 1997-09-09 1999-09-14 Raytheon Company Flexible and programmable delta-sigma analog signal converter
US6218972B1 (en) 1997-09-11 2001-04-17 Rockwell Science Center, Inc. Tunable bandpass sigma-delta digital receiver
US6243430B1 (en) * 1998-01-09 2001-06-05 Qualcomm Incorporated Noise cancellation circuit in a quadrature downconverter
US6459743B1 (en) 1998-08-07 2002-10-01 Telefonaktiebolaget Lm Ericsson (Publ) Digital reception with radio frequency sampling
US6215430B1 (en) 1999-04-24 2001-04-10 Motorola, Inc. Method and apparatus for processing a digital signal for analog transmission
EP1192723A1 (en) * 1999-05-07 2002-04-03 Morphics Technology, Inc. Programmable digital intermediate frequency transceiver
DE19948899A1 (de) * 1999-10-11 2001-04-19 Infineon Technologies Ag Verfahren und Schaltungsanordnung zur digitalen Frequenzkorrektur eines Signals
US6429797B1 (en) 2001-07-05 2002-08-06 International Business Machines Corporation Decimation filter for a bandpass delta-sigma ADC
US6577258B2 (en) 2001-10-01 2003-06-10 Nokia Corporation Adaptive sigma-delta data converter for mobile terminals
US6621366B1 (en) * 2001-12-07 2003-09-16 Analog Devices, Inc. Parallel-process digital modulator structures and methods
US6639526B1 (en) 2002-03-21 2003-10-28 Linear Technology Corporation Circuits and methods for a variable oversample ratio delta-sigma analog-to-digital converter
GB0214621D0 (en) * 2002-06-25 2002-08-07 Koninkl Philips Electronics Nv Signal receiver
WO2006023726A1 (en) * 2004-08-19 2006-03-02 Intrinsix Corporation Hybrid heterodyne transmitters and receivers
US20080291974A1 (en) * 2005-03-30 2008-11-27 Nxp B.V. Signal Transmitter for Wideband Wireless Communication
JP2009060175A (ja) * 2007-08-29 2009-03-19 Fujitsu Ltd 受信装置、受信回路および受信回路制御方法
CN101378263B (zh) * 2007-08-31 2012-07-04 京信通信系统（中国）有限公司 基于数字中频的多载波数字接收机及多载波数字接收方法
US7692570B2 (en) * 2008-01-16 2010-04-06 Lockheed Martin Corporation Direct RF complex analog to digital converter

Patent Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20080159453A1 (en) * 2001-05-15 2008-07-03 Smith Francis J Radio receiver
RU2292658C2 (ru) * 2001-12-05 2007-01-27 Мацусита Электрик Индастриал Ко., Лтд. Цифровой многочастотный приемопередатчик
US20040190660A1 (en) * 2003-03-31 2004-09-30 Morris Bradley John Digital receiver and method
US20040192229A1 (en) * 2003-03-31 2004-09-30 Morris Bradley John Digital transmitter and method
US20060222116A1 (en) * 2005-03-31 2006-10-05 Freescale Semiconductor, Inc. AGC with integrated wideband interferer detection

Also Published As

Publication number Publication date
EP2571174A2 (en) 2013-03-20
RU2613932C2 (ru) 2017-03-22
US20130070875A1 (en) 2013-03-21
EP2571174A3 (en) 2014-07-09
EP2571174B1 (en) 2017-11-08
JP6033012B2 (ja) 2016-11-30
RU2012139204A (ru) 2014-03-20
CN103051347A (zh) 2013-04-17
US8625726B2 (en) 2014-01-07
JP2013081162A (ja) 2013-05-02
CN103051347B (zh) 2016-09-07

Similar Documents

Publication Publication Date Title
RU2613932C9 (ru) Маломощный радиочастотный приемник, преобразующий радиочастотный сигнал в цифровую форму
US7436910B2 (en) Direct bandpass sampling receivers with analog interpolation filters and related methods
EP2680448B1 (en) Discrete digital receiver
US9209844B2 (en) Subsampling receiver using interstage off-chip RF band pass filter
JP2002374181A (ja) サブサンプリング無線周波受信機アーキテクチャ
US20120163434A1 (en) Digital receiver for mobile communication and operating method
US10122551B2 (en) Methods and systems for programmable digital down-conversion
US20150326244A1 (en) Systems and methods related to digital-to-analog conversion in radio-frequency applications
WO2000069085A9 (en) Programmable digital intermediate frequency transceiver
US9001932B2 (en) Method and apparatus for extracting the quadrature component of a complex signal from the in-phase component after baseband digitizing using a complex transform
US7953184B2 (en) Direct sampling type wireless receiver and method using the same
KR100957321B1 (ko) 소프트웨어 무선기 및 이를 이용한 신호처리 방법
KR20130082422A (ko) 블록간 고주파 오프칩 대역 필터를 이용한 서브샘플링 수신기
Han A flexible and compact digital front-end design for wideband software radio receivers
WO2014049384A1 (en) Method for digitizing an analogue signal for further demodulation in a radio receiving device
KR101696324B1 (ko) 대역통과 샘플링 수신기
GB2516152A (en) Mixed mode time interleaved digital-to-analog converter for radio-frequency applications
Efstathiou Base station transceiver trends for 3G and beyond wireless systems
Lahouli et al. Phase mismatch study and correction of a parallel FBD ΣΔ ADC for SDR receiver
Singh et al. Design of programmable digital down converter for WiMAX Charanjit Singh1, Dr. Manjeet Singh Patterh1 and Dr. Sanjay Sharma2
Müller et al. A Software Defined Multistandard Tuner Platform for Automotive Applications
Marković et al. Multi-GHz Radio DSP

Legal Events

Date Code Title Description
TH4A Reissue of patent specification