RU163275U1 - INTEGRAL DIFFERENTIAL SLOW-MOUNTING AMPLIFIER WITH EXTENDED DYNAMIC RANGE - Google Patents
INTEGRAL DIFFERENTIAL SLOW-MOUNTING AMPLIFIER WITH EXTENDED DYNAMIC RANGE Download PDFInfo
- Publication number
- RU163275U1 RU163275U1 RU2016104442/08U RU2016104442U RU163275U1 RU 163275 U1 RU163275 U1 RU 163275U1 RU 2016104442/08 U RU2016104442/08 U RU 2016104442/08U RU 2016104442 U RU2016104442 U RU 2016104442U RU 163275 U1 RU163275 U1 RU 163275U1
- Authority
- RU
- Russia
- Prior art keywords
- resistor
- transistor
- terminal
- nominal value
- collector
- Prior art date
Links
Images
Abstract
Интегральный дифференциальный малошумящий усилитель с расширенным динамическим диапазоном, содержащий первый, второй, третий и четвертый транзисторы и первый и второй источники тока, отличающийся тем, что введены третий источник тока и первый, второй, третий, четвертый, пятый, шестой, седьмой и восьмой резисторы, при этом первые клеммы первого, второго и третьего источников тока соединены с шиной заземления, вторая клемма первого источника тока соединена с базой четвертого транзистора, с первой клеммой источника входного сигнала и через второй резистор соединена с эмиттером второго транзистора, вторая клемма третьего источника тока соединена с базой третьего транзистора, со второй клеммой источника входного сигнала и через первый резистор соединена с эмиттером первого транзистора, вторая клемма второго источника тока соединена через четвертый резистор с базой второго транзистора и с эмиттером четвертого транзистора, а через третий резистор соединена с базой первого транзистора и с эмиттером третьего транзистора, коллектор второго транзистора через восьмой резистор соединен с коллектором третьего транзистора и с первой клеммой пятого резистора, коллектор первого транзистора через шестой резистор соединен с коллектором четвертого транзистора и с первой клеммой седьмого резистора, вторая клемма которого соединена со второй клеммой пятого резистора, причем, номинал первого резистора выбирают равным номиналу второго резистора, номинал третьего резистора выбирают равным номиналу четвертого резистора, номинал пятого резистора выбирают равным номиналу седьмого резистора, номинал шестого резистора выбирают равнAn integrated differential low-noise amplifier with an extended dynamic range containing the first, second, third and fourth transistors and the first and second current sources, characterized in that the third current source and the first, second, third, fourth, fifth, sixth, seventh and eighth resistors are introduced while the first terminals of the first, second and third current sources are connected to the ground bus, the second terminal of the first current source is connected to the base of the fourth transistor, to the first terminal of the input signal source and through the second resistor is connected to the emitter of the second transistor, the second terminal of the third current source is connected to the base of the third transistor, to the second terminal of the input signal source and through the first resistor is connected to the emitter of the first transistor, the second terminal of the second current source is connected through the fourth resistor to the base of the second transistor and the emitter of the fourth transistor, and through the third resistor connected to the base of the first transistor and the emitter of the third transistor, the collector of the second transistor through the eighth resistor connected to the collector of the third transistor and to the first terminal of the fifth resistor, the collector of the first transistor through the sixth resistor is connected to the collector of the fourth transistor and to the first terminal of the seventh resistor, the second terminal of which is connected to the second terminal of the fifth resistor, and the nominal value of the first resistor is chosen equal to the nominal value of the second resistor the nominal value of the third resistor is chosen equal to the nominal value of the fourth resistor, the nominal value of the fifth resistor is chosen equal to the nominal value of the seventh resistor, the nominal value of the sixth resistor ybirayut equally
Description
Полезная модель относится к электронике и может быть использована для создания интегральных дифференциальных малошумящих усилителей с расширенным динамическим диапазоном.The utility model relates to electronics and can be used to create integrated differential low-noise amplifiers with an extended dynamic range.
Известен усилитель [RU 2193273, С2, H03F 3/26, H03F 3/45, 10.06.2002], содержащий первую входную дифференциальную пару на транзисторах Т5 и Т6 первого типа проводимости, базы которых подключены к входным клеммам (+) и (-), а их эмиттеры соединены между собой и с одним концом источника стабильного тока ИСТ-1, второй конец которого подключен к источнику отрицательного напряжения Еn -, отражатель тока ОТ-1 на транзисторе Т2 и диоде D1 и отражатель тока ОТ-2 на транзисторе Т4 и диоде D3, при этом анод диода D1 и эмиттер транзистора Т2 через резисторы R1 и R2 соответственно соединены с шиной источника положительного напряжения Еn +, а база транзистора Т2 соединена с катодом диода D1 и с анодом диода D3, коллектор транзистора Т2 соединен с эмиттером транзистора Т4 и с коллектором транзистора Т6, а коллектор транзистора Т4 соединен со входом буферного каскада и с коллектором транзистора Т12, вторую входную дифференциальную пару на транзисторах Т7 и Т8 второго типа проводимости, базы которых соединены соответственно с базами транзисторов Т5 и Т6, а их эмиттеры соединены между собой и с одним концом источника стабильного тока ИСТ-2, второй конец которого подключен к источнику положительного напряжения Еn +, отражатель тока ОТ-3 на транзисторе Т10 и диоде D9, отражатель тока ОТ-4 на транзисторе Т12 и диоде D11, два управляемых источника тока подпитки In1 и In2, первый источник тока подпитки In1 образован транзистором Т17 и резистором R5, причем, катод диода D9 и эмиттер транзистора Т10 через резисторы R3 и R4 соответственно соединены с шиной источника отрицательного питания Еn - база транзистора Т10 соединена с анодом диода D9 и с катодом диода D11, коллектор транзистора Т10 соединен с эмиттером транзистора Т12 и с коллектором транзистора Т8, база транзистора Т17 соединена с катодом диода D1, а эмиттер транзистора Т17 соединен через резистор R5 с источником положительного напряжения Еn +, коллектор транзистора Т17 соединен с эмиттером транзистора Т4 и с одним концом ускоряющего конденсатора Су1, второй конец которого соединен с коллектором транзистора Т4, база которого подключена к коллектору транзистора Т5 и к катоду диода D3, второй источник подпитки In2 образован транзисторами Т18 и резистором R6, причем, база транзистора Т18 соединена с анодом диода D9, а эмиттер транзистора Т18 соединен через резистор R6 с источником отрицательного напряжения Еn -, коллектор транзистора Т18 соединен с эмиттером транзистора Т12 и с одним концом ускоряющего конденсатора Су2, второй конец которого соединен с коллектором транзистора Т12, база которого подключена к коллектору транзистора Т7 и к аноду диода Dl 1.The known amplifier [RU 2193273, C2, H03F 3/26, H03F 3/45, 06/10/2002] containing the first input differential pair on transistors T5 and T6 of the first type of conductivity, the bases of which are connected to the input terminals (+) and (-) and their emitters are interconnected and with one end of the IST-1 stable current source, the second end of which is connected to a negative voltage source E n - , the current reflector OT-1 on transistor T2 and diode D1, and the current reflector OT-2 on transistor T4 and diode D3, while the anode of diode D1 and the emitter of transistor T2 through resistors R1 and R2, respectively, are connected us to the bus source of positive voltage E n +, while the base of transistor T2 is connected to the cathode of D1 diode and the anode of the diode D3, the collector of transistor T2 is connected to the T4 transistor emitter and collector of transistor T6 and T4 the transistor collector is connected to the input of the buffer stage and the collector of transistor T12, the second input differential pair on transistors T7 and T8 of the second type of conductivity, the bases of which are connected respectively to the bases of transistors T5 and T6, and their emitters are connected to each other and to one end of a stable current source IST-2, the second end of which is connected to a positive voltage source E n + , current reflector OT-3 on transistor T10 and diode D9, current reflector OT-4 on transistor T12 and diode D11, two controllable recharge current sources I n1 and I n2 , the first source feeding current I n1 is formed by transistor T17 and the resistor R5, wherein, cathode of the diode D9 and the emitter of T10 transistor through resistors R3 and R4 respectively connected to a bus source of negative power E n - base of transistor T10 is connected to the anode of the diode D9 and diode cathode D11, collector of transistor T10 is connected the emitter of the transistor T12 and the collector of transistor T8, the base of transistor T17 is connected to the cathode of D1 diode, and T17 transistor whose emitter is connected through R5 resistor to a source of positive voltage E n +, collector of the transistor T17 is connected to the T4 emitter of the transistor and to one end of the accelerating capacitor C y1 , the second end of which is connected to the collector of transistor T4, the base of which is connected to the collector of transistor T5 and to the cathode of diode D3, the second feed source I n2 is formed by transistors T18 and resistor R6, and the base of transistor T18 with connected to the anode of the diode D9, and the emitter of the transistor T18 is connected through a resistor R6 to a negative voltage source E n - , the collector of the transistor T18 is connected to the emitter of the transistor T12 and to one end of the accelerating capacitor C y2 , the second end of which is connected to the collector of the transistor T12, the base of which connected to the collector of the transistor T7 and to the anode of the
Недостатком этого технического решения является относительно высокий уровень нелинейных искажений.The disadvantage of this technical solution is the relatively high level of non-linear distortion.
Известен также интегральный усилитель [RU 2072624, C1, H03F 1/32, 27.01.1997], содержащий каскад предварительного усиления и каскад оконечного усиления, коллектор транзистора которого через последовательно соединенные нагрузочный резистор и резистор фильтра нижних частот подключен к шине питания, а через резистор отрицательной обратной связи к базе этого транзистора и к коллектору транзистора каскада предварительного усиления, эмиттер которого и эмиттер транзистора каскада оконечного усиления нагружены на цепи отрицательной обратной связи по току и стабилизации режима по постоянному току, база транзистора каскада предварительного усиления через первый резистор базового смещения подключена к выходу фильтра нижних частот, второй резистор базового смещения, первый вывод которого подключен к общей шине, элемент управления на транзисторе, коллектор которого соединен с базой транзистора каскада предварительного усиления, эмиттер с вторым выводом второго резистора базового смещения, а также резистивный делитель напряжения, включенный между выходом фильтра нижних частот и общей шиной и выполненный на первом и втором резисторах, при этом Rэ/Rэкв 0,005°С 0,05, где Rэ второй резистор базового смещения, Rэкв R1R2/R1+R2, R1 и R2 первый и второй резисторы резистивного делителя напряжения.An integral amplifier is also known [RU 2072624, C1,
Недостатком этого технического решения является относительно высокий уровень нелинейных искажений.The disadvantage of this technical solution is the relatively high level of non-linear distortion.
Наиболее близким по технической сущности к предложенному является усилитель [RU 2436224, C1, H03F 1/34, H03F 1/26, 10.12.2011], состоящий из входной цепи сдвига уровня, вход которой соединен с неинвертирующим входом усилителя, первый выход соединен с базой первого n-p-n транзистора, а второй выход - с базой первого p-n-p транзистора и с первым выводом первого источника тока, второй вывод которого соединен с шиной отрицательного питания и с зажимом питания первого токового зеркала, вход которого соединен с коллектором первого p-n-p транзистора, эмиттер которого подключен к инвертирующему входу усилителя и к эмиттеру первого n-p-n транзистора, коллектор которого соединен со входом второго токового зеркала, зажим питания которого подключен к шине положительного питания усилителя и к первому выводу второго источника тока, второй вывод которого соединен с базой первого n-p-n транзистора, первый выход первого токового зеркала соединен с первым выходом второго токового зеркала и с первым входом выходного буфера, выход которого соединен с выходом усилителя, второй вход подключен к второму выходу первого токового зеркала, а третий вход - ко второму выходу второго токового зеркала, второй n-p-n транзистор, база которого подключена к базе первого n-p-n транзистора, второй p-n-p транзистор, база которого подключена к базе первого p-n-p транзистора, а эмиттер соединен с эмиттером второго n-p-n транзистора, третье токовое зеркало, зажим питания, которого соединен с шиной отрицательного питания, а первый вход - с коллектором второго p-n-p транзистора, дополнительный буфер, первый вход которого соединен с первым выходом третьего токового зеркала, а второй вход подключен ко второму выходу третьего токового зеркала, четвертое токовое зеркало, зажим питания которого подключен к шине положительного питания, вход соединен с коллектором второго n-p-n транзистора, первый выход подключен к первому выходу третьего токового зеркала, а второй выход соединен с третьим входом дополнительного буфера, третий и четвертый n-p-n транзисторы соответственно, эмиттеры которых соединены между собой и подключены к третьему выходу третьего токового зеркала, а базы соединены между собой и с выходом дополнительного буфера, коллектор третьего n-p-n транзистора подключен к входу управления четвертого токового зеркала, а коллектор четвертого n-p-n транзистора подключен к входу управления второго токового зеркала, пятый и шестой n-p-n транзисторы, коллекторы которых соединены между собой и с шиной положительного питания, базы соединены между собой и с выходом выходного буфера, а эмиттеры соединены между собой и подключены к третьему выходу третьего токового зеркала, третий и четвертый p-n-p транзисторы, базы которых соединены между собой и с выходом дополнительного буфера, эмиттеры соединены между собой и подключены к третьему выходу четвертого токового зеркала, коллектор третьего p-n-p транзистора соединен со входом управления третьего токового зеркала, а коллектор четвертого p-n-p транзистора - со входом управления первого токового зеркала, пятый и шестой p-n-p транзисторы, эмиттеры которых соединены между собой и с третьим выходом четвертого токового зеркала, базы соединены между собой и подключены к выходу выходного буфера, а коллекторы соединены между собой и с шиной отрицательного питания.The closest in technical essence to the proposed one is an amplifier [RU 2436224, C 1 ,
Недостатком наиболее близкого технического решения является относительно низкая стабильность коэффициента передачи усилителя.The disadvantage of the closest technical solution is the relatively low stability of the gain of the amplifier.
Задачей, которая решается в предложенном техническом решении, является создание усилителя с повышенной стабильностью коэффициента передачи, способного работать на высоких частотах, обеспечивать малый уровень нелинейные искажения с одновременным подавлением шумов основных транзисторов и пониженную чувствительность к отклонениям технологического процесса изготовления микросхемы.The problem that is solved in the proposed technical solution is to create an amplifier with increased stability of the transmission coefficient, capable of operating at high frequencies, to provide a low level of non-linear distortion while suppressing the noise of the main transistors and reduced sensitivity to deviations of the technological process of manufacturing the chip.
Требуемый технический результат заключается в повышении стабильности коэффициента передачи усилителя.The required technical result is to increase the stability of the gain of the amplifier.
Поставленная задача решается, а требуемый технический результат достигается тем, что в устройство, содержащее первый, второй, третий и четвертый транзисторы и первый, второй и третий источники тока, согласно полезной модели, введены первый, второй, третий, четвертый, пятый, шестой, седьмой и восьмой резисторы, при этом, первые клеммы первого, второго и третьего источников тока соединены с шиной заземления, вторая клемма первого источника тока соединена с базой четвертого транзистора, с первой клеммой источника входного сигнала и через второй резистор соединена с эмиттером второго транзистора, вторая клемма третьего источника тока соединена с базой третьего транзистора, со второй клеммой источника входного сигнала и через первый резистор соединена с эмиттером первого транзистора, вторая клемма второго источника тока соединена через четвертый резистор с базой второго транзистора и с эмиттером четвертого транзистора, а через третий резистор соединена с базой первого транзистора и с эмиттером третьего транзистора, коллектор второго транзистора через восьмой резистор соединен с коллектором третьего транзистора и с первой клеммой пятого резистора, коллектор первого транзистора через шестой резистор соединен с коллектором четвертого транзистора и с первой клеммой седьмого резистора, вторая клемма которого соединена со второй клеммой пятого резистора, причем, номинал первого резистора выбирают равным номиналу второго резистора, номинал третьего резистора выбирают равным номиналу четвертого резистора, номинал пятого резистора выбирают равным номиналу седьмого резистора, номинал шестого резистора выбирают равным номиналу восьмого резистора, а проводимости второго, четвертого, седьмого и восьмого резисторов выбирают из соотношенияThe problem is solved, and the required technical result is achieved by the fact that in the device containing the first, second, third and fourth transistors and the first, second and third current sources, according to the utility model, the first, second, third, fourth, fifth, sixth, the seventh and eighth resistors, while the first terminals of the first, second and third current sources are connected to the ground bus, the second terminal of the first current source is connected to the base of the fourth transistor, with the first terminal of the input signal source and through the first resistor is connected to the emitter of the second transistor, the second terminal of the third current source is connected to the base of the third transistor, to the second terminal of the input signal source and through the first resistor is connected to the emitter of the first transistor, the second terminal of the second current source is connected through the fourth resistor to the base of the second transistor and the emitter of the fourth transistor, and through the third resistor is connected to the base of the first transistor and with the emitter of the third transistor, the collector of the second transistor is connected through the eighth resistor inen with the collector of the third transistor and with the first terminal of the fifth resistor, the collector of the first transistor through the sixth resistor is connected to the collector of the fourth transistor and with the first terminal of the seventh resistor, the second terminal of which is connected to the second terminal of the fifth resistor, and the nominal value of the first resistor is chosen equal to the nominal value of the second resistor the nominal value of the third resistor is chosen equal to the nominal value of the fourth resistor, the nominal value of the fifth resistor is chosen equal to the nominal value of the seventh resistor, the nominal value of the sixth resistor is selected equal to the nominal value of the eighth resistor, and the conductivity of the second, fourth, seventh and eighth resistors is selected from the ratio
где: gOC=1/[R6+(RИСТ/2)], g8 - проводимость четвертого резистора, g11 - проводимость седьмого резистора, g12 - проводимость восьмого резистора, S02 - крутизна выходной характеристики в рабочей точке второго транзистора, R6 - сопротивление второго резистора, Rист - выходное сопротивлений источника сигнала.where: g OC = 1 / [R 6 + (R IST / 2)], g 8 is the conductivity of the fourth resistor, g 11 is the conductivity of the seventh resistor, g 12 is the conductivity of the eighth resistor, S 02 is the steepness of the output characteristic at the operating point of the second transistor, R 6 is the resistance of the second resistor, R Ist is the output resistance of the signal source.
На чертеже представлена электрическая схема предложенного интегрального дифференциального усилителя с расширенным динамическим диапазоном совместно с источником сигнала, характеризующимся выходным сопротивлением Rист и уровне сигнала Uист.сигн.The drawing shows an electrical diagram of the proposed integrated differential amplifier with an extended dynamic range in conjunction with a signal source, characterized by an output impedance R Ist and a signal level U Ist.sign .
Интегральный дифференциальный усилитель с расширенным динамическим диапазоном содержит первый 1, второй 2, третий 3 и четвертый 4 транзисторы, первый 5, второй 6, третий 7, четвертый 8, пятый 9, шестой 10, седьмой 11 и восьмой 12 резисторы, а также первый 13, второй 14 и третий 15 источники тока.An integrated differential amplifier with an extended dynamic range contains the first 1, second 2, third 3 and fourth 4 transistors, the first 5, second 6, third 7, fourth 8, fifth 9, sixth 10, seventh 11 and eighth 12 resistors, as well as the first 13 , second 14 and third 15 current sources.
В интегральном дифференциальном усилителе с расширенным динамическим диапазоном первые клеммы первого 13, второго 14 и третьего 15 источников тока соединены с шиной 16 заземления, вторая клемма первого источника 13 тока соединена с базой четвертого транзистора 4, с первой клеммой источника входного сигнала и через второй резистор 6 соединена с эмиттером второго транзистора 2.In an integrated differential amplifier with an extended dynamic range, the first terminals of the first 13, second 14 and third 15 current sources are connected to the
Кроме того, в интегральном дифференциальном усилителе с расширенным динамическим диапазоном вторая клемма третьего источника 15 тока соединена с базой третьего транзистора 3, со второй клеммой источника входного сигнала и через первый резистор 5 соединена с эмиттером первого транзистора 1, вторая клемма второго источника 14 тока соединена через четвертый резистор 8 с базой второго транзистора 2 и с эмиттером четвертого транзистора 4, а через третий резистор 7 соединена с базой первого транзистора 1 и с эмиттером третьего транзистора 3.In addition, in an integrated differential amplifier with an extended dynamic range, the second terminal of the third
Дополнительно в интегральном дифференциальном усилителе с расширенным динамическим диапазоном коллектор второго транзистора 2 через восьмой резистор 12 соединен с коллектором третьего транзистора 3 и с первой клеммой пятого резистора 9, коллектор первого транзистора 1 через шестой резистор 10 соединен с коллектором четвертого транзистора 4 и с первой клеммой седьмого резистора 11, вторая клемма которого соединена со второй клеммой пятого резистора 9, причем, номинал первого резистора выбирают равным номиналу второго резистора, номинал третьего резистора 7 выбирают равным номиналу четвертого резистора 8, номинал пятого резистора 9 выбирают равным номиналу седьмого резистора 11, номинал шестого резистора 10 выбирают равным номиналу восьмого резистора 12, а проводимости второго 6, четвертого 8, седьмого 11 и восьмого 12 резисторов выбирают из соотношенияAdditionally, in an integrated differential amplifier with an extended dynamic range, the collector of the
, ,
где gOC=1/[R2+(RИСТ/2)], g4=1/R4, g6.1=1/R7 g6.2=1/R8, S02 - крутизна выходной характеристики в рабочей точке второго транзистора, R2, R4, R7, R8 - значения сопротивлений второго, четвертого, седьмого и восьмого резисторов, соответственно, Rист - входное сопротивление источника сигнала.where g OC = 1 / [R 2 + (R IST / 2)], g 4 = 1 / R 4 , g 6.1 = 1 / R 7 g 6.2 = 1 / R 8 , S 02 is the steepness of the output characteristic at the operating point the second transistor, R 2 , R 4 , R 7 , R 8 are the values of the resistances of the second, fourth, seventh and eighth resistors, respectively, R East is the input resistance of the signal source.
Для упрощения в схеме интегрального дифференциального усилителя с расширенным динамическим диапазоном не указаны цепи установки рабочей точки и не показаны развязывающие емкости поскольку в диапазоне средних частот, в котором, преимущественно, работает усилитель, их можно считать короткозамкнутыми. Представленная схема реализована на базе биполярных транзисторов, но возможна реализация и на МОП структурах.To simplify the scheme of an integrated differential amplifier with an extended dynamic range, the operating point installation circuits are not indicated and decoupling capacities are not shown, since they can be considered short-circuited in the medium frequency range, in which the amplifier mainly works. The presented circuit is implemented on the basis of bipolar transistors, but it is possible to implement it on MOS structures.
Интегральный дифференциальный усилитель с расширенным динамическим диапазоном работает следующим образом.Integrated differential amplifier with extended dynamic range works as follows.
Входной сигнал от источника Uист.сигн с выходным сопротивлением Rист поступает на вход каскада усиления, состоящего из третьего 3 и четвертого 4 транзисторов, третьего 7, четвертого 8, пятого 9 и седьмого 11 резисторов и второго источника 14 тока. Переменный входной дифференциальный сигнал, поступающий на базы третьего 3 и четвертого 4 транзисторов, возбуждает в последних переменные токи коллекторов и эмиттеров, которые, кроме полезного сигнала, содержат в себе шумы и нелинейные искажения этих транзисторов. Протекая через пятый 9 и седьмой 11 резисторы дифференциальные коллекторные токи преобразуются в переменное напряжение. Токи третьего 3 и четвертого 4 эмиттеров также преобразуются в переменное дифференциальное напряжение при протекании через третий 7 и четвертый 8 резисторы. Это переменное напряжение используется для подавления нелинейных искажений и частично шумов третьего 3 и четвертого 4 транзисторов. Напряжение, снимаемое с третьего 7 и четвертого 8 резисторов, поступает на входы первого сумматора, образованного первым 1 и вторым 2 транзисторами и первым 5 и вторым 6 резисторами. Дифференциальный сигнал, содержащий нелинейные искажения и шумы, поступает на базы первого 1 и второго 2 транзисторов. На второй дифференциальный вход этого сумматора (первый 5 и второй 6 резисторы) подается входной сигнал. Компоненты полезного сигнала, действующие на двух входах сумматора, находятся в фазе. Последнее означает, что компоненты полезного сигнала будут вычитаться и выходные коллекторные токи первого и второго транзисторов будут содержать, практически, только компоненты нелинейных искажений и шумов третьего 3 и четвертого 4 транзисторов. Выделенные нелинейные искажения и шумы третьего 3 и четвертого 4 транзисторов затем усиливаются с помощью каскада усиления ошибки, образованного первым 1 и вторым 2 транзисторами и первым 5, вторым 6, пятым 9, шестым 10, седьмым 11 и восьмым 12 резисторами. Четверка коллекторных сопротивлений в составе пятого 9, шестого 10, седьмого 11 и восьмого 12 резисторами выполняют функцию выходного сумматора. На его выходах будет сформирована разность двух сигналов: сигнала каскада усиления, состоящего из третьего 3 и четвертого 4 транзисторов, третьего 7, четвертого 8, пятого 9 и седьмого 11 резисторов и второго источника 14 тока, и каскада усиления ошибки, образованного первым 1 и вторым 2 транзисторами и первым 5, вторым 6, пятым 9, шестым 10, седьмым 11 и восьмым 12 резисторами. Коэффициент усиления каскада усиления ошибки, а также отношение сопротивлений пар резисторов пятого 9 и восьмого 12 и шестого 10 и седьмого 11 выбирается так, чтобы величины компонентов нелинейных искажений и шумов третьего 3 и четвертого 4 транзисторов, передающиеся по двум путям, были одинаковыми. Токи первого источника 13 и третьего источника 15 выбираются из соображения обеспечения согласования по мощности с источником сигналов, а именно, активная часть последовательного соединения сопротивления первого 5 резистора (второго 6 резистора) и выходного сопротивления эмиттера первого транзистора 1 (второго транзистора 2) должны быть равны половине выходного сопротивления источника сигнала. Тогда компенсация нелинейных искажений и частично шумов третьего 3 и четвертого 4 транзисторов при равенстве площади третьего транзистора 4 площади четвертого транзистора 4 и площади перового транзистора 1 площади второго транзистора 2, а также при соблюдении условий, что номинал первого резистора 5 выбирают равным номиналу второго 6 резистора, номинал третьего резистора 7 выбирают равным номиналу четвертого резистора 8, номинал пятого резистора 9 выбирают равным номиналу седьмого резистора 11, номинал шестого резистора 10 выбирают равным номиналу восьмого резистора 12, будет наблюдаться, если проводимости второго 6, четвертого 8, седьмого 11 и восьмого 12 резисторов будут выбираться из соотношенияInput signal U from the source ist.sign with output impedance R ist fed to the input gain stage, consisting of three third and
, ,
где gOC=1/[R2+(RИСТ/2)], g4=1/R4, g6.1=1/R7 g6.2=1/R8, S02 - крутизна в рабочей точке второго транзистора, R2, R4, R7, R8 - значения сопротивлений второго, четвертого, седьмого и восьмого резисторов, соответственно, Rист - входное сопротивление источника сигнала.where g OC = 1 / [R 2 + (R IST / 2)], g 4 = 1 / R 4 , g 6.1 = 1 / R 7 g 6.2 = 1 / R 8 , S 02 is the slope at the operating point of the second transistor , R 2, R 4, R 7, R 8 - resistance value of the second, fourth, seventh and eighth resistors, respectively, R ist - the input impedance of the signal source.
Таким образом, благодаря усовершенствованию известного устройства достигается требуемый технический результат, заключающийся в повышении стабильности коэффициента передачи, обусловленное снижением уровня нелинейных искажений с одновременным подавлением шумов транзисторов и снижением чувствительности усилителя к отклонениям технологического процесса изготовления микросхемы.Thus, due to the improvement of the known device, the required technical result is achieved, which consists in increasing the stability of the transmission coefficient due to a decrease in the level of nonlinear distortions while suppressing the noise of transistors and reducing the sensitivity of the amplifier to deviations of the technological process of manufacturing the microcircuit.
Claims (1)
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
RU2016104442/08U RU163275U1 (en) | 2016-02-10 | 2016-02-10 | INTEGRAL DIFFERENTIAL SLOW-MOUNTING AMPLIFIER WITH EXTENDED DYNAMIC RANGE |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
RU2016104442/08U RU163275U1 (en) | 2016-02-10 | 2016-02-10 | INTEGRAL DIFFERENTIAL SLOW-MOUNTING AMPLIFIER WITH EXTENDED DYNAMIC RANGE |
Publications (1)
Publication Number | Publication Date |
---|---|
RU163275U1 true RU163275U1 (en) | 2016-07-10 |
Family
ID=56370478
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
RU2016104442/08U RU163275U1 (en) | 2016-02-10 | 2016-02-10 | INTEGRAL DIFFERENTIAL SLOW-MOUNTING AMPLIFIER WITH EXTENDED DYNAMIC RANGE |
Country Status (1)
Country | Link |
---|---|
RU (1) | RU163275U1 (en) |
-
2016
- 2016-02-10 RU RU2016104442/08U patent/RU163275U1/en not_active IP Right Cessation
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US10326416B2 (en) | Amplifier | |
JP2012235376A (en) | Electronic circuit and light-receiving circuit | |
US3497824A (en) | Differential amplifier | |
US8310307B2 (en) | Amplifying circuit | |
GB2133596A (en) | Voltage adder circuit | |
JPH0143485B2 (en) | ||
JPS6014523B2 (en) | cascode amplifier circuit | |
CN113992156A (en) | Low-input bias current amplifier | |
RU163275U1 (en) | INTEGRAL DIFFERENTIAL SLOW-MOUNTING AMPLIFIER WITH EXTENDED DYNAMIC RANGE | |
EP1345320A2 (en) | Amplifier and tuner | |
CN114400978B (en) | Offset compensation structure suitable for large dynamic range logarithmic amplifier | |
RU164172U1 (en) | INTEGRAL AMPLIFIER WITH ADVANCED DYNAMIC RANGE | |
JP5333520B2 (en) | Amplifier circuit | |
CN109428555B (en) | Bootstrap application arrangement and application in a unity gain follower | |
CN113169711B (en) | Audio amplifier with integrated filter | |
JP5810935B2 (en) | Switching amplifier | |
CN109075754B (en) | Single-end instrument folding grid-cathode amplifier | |
JP5007937B2 (en) | Attenuator | |
JP6673645B2 (en) | Differential amplifier | |
JP5302356B2 (en) | Differential transimpedance amplifier | |
JP2665072B2 (en) | Amplifier circuit | |
JPS5840370B2 (en) | Zoufuku Cairo | |
JPH10247831A (en) | Amplifier circuit | |
US3439285A (en) | Stabilized direct-coupled amplifier | |
JP5445515B2 (en) | Amplifier circuit |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
MM1K | Utility model has become invalid (non-payment of fees) |
Effective date: 20170211 |