PL175091B1 - Method of protecting a mos power transistor - Google Patents
Method of protecting a mos power transistorInfo
- Publication number
- PL175091B1 PL175091B1 PL94306440A PL30644094A PL175091B1 PL 175091 B1 PL175091 B1 PL 175091B1 PL 94306440 A PL94306440 A PL 94306440A PL 30644094 A PL30644094 A PL 30644094A PL 175091 B1 PL175091 B1 PL 175091B1
- Authority
- PL
- Poland
- Prior art keywords
- gate
- control
- transistor
- voltage
- circuit
- Prior art date
Links
Landscapes
- Electronic Switches (AREA)
Abstract
Sposób zabezpieczenia pracy tranzystora mocy typu MOS, polegający na wprowadzeniu go w stan przewodzeniaza pomocąsygnałunapięcia sterującego, odpowiednio dodatniego względem jego źródła dla tranzystorów z kanałem typun, a ujemnego dla tranzystora z kanałem typu p, podawanego na jego bramkę przy pomocy układu sterującego i układów kontrolujących, znamienny tym, że układ sterujący (A) wysyła impuls sterujący do układu logicznego (B) badającego napięcie zasilania, gdy badane napięcie osiągnie żądaną wartość układ (B) przekazuje napięcie do układu wejściowego (C) zasilającego bramkę (G) tranzystora mocy MOS, przy czym opornik (R) zawartymiędzybramką(G) a wyjściemukładu, podaje masę przez obciążenie, w przypadku awaryjnegojej braku, a układ pomiarowy (D) mierzy prąd drenu, płynący przez tranzystor MOS, gdy prąd przekroczy dopuszczalną wartość układ (D) włącza tyrystor (T) który zwiera sygnał sterujący bramką (G) do masyThe way of securing the operation of the power transistor MOS type, which consists in putting it into the state of conduction using a control voltage signal, correspondingly positive to its source for typun channel transistors and negative for the transistor with a p-channel fed to its gate by means of the steering system and controlling systems, characterized in that the control system (A) it sends a control pulse to the tester logic (B) supply voltage when tested voltage reaches the required value, the circuit (B) transfers voltage to the input circuit (C) feeding the gate (G) the power MOS transistor, with the resistor (R) between the gate (G) and the exit of the system, he gives mass by load, in the event of an emergency lack, and the measuring system (D) measures the drain current, flowing through the MOS transistor when the current exceeds system (D) turns on thyristor (T) permissible value which connects the gate control signal (G) to ground
Description
Przedmiotem wynalazku jest sposób zabezpieczenia pracy tranzystora mocy typu MOS, pracującego jako przekaźnik elektroniczny.The subject of the invention is a method of securing the operation of a MOS type power transistor, operating as an electronic relay.
Znany sposób zabezpieczenia pracy tranzystora mocy MOS polega na tym, że za pomocą układu sterowania podaje się na jego bramkę napięcie sterujące, odpowiednio dodatnie względemjego źródła, dla tranzystorów z kanałem typu n i ujemne dla tranzystorów z kanałem typu p. Równocześnie zapomocączłonu czasowego układu sterowania, w określonych odstępach czasu, wysyła się za pośrednictwem układu kontroli napięcia, impulsy kontrolujące wartości napięcia między źródłem i drenem sterowanego tranzystora mocy MOS. W przypadku odchyleń od wartości nominalnej, napięcie jest stabilizowane przez człon kontrolno-ograniczający, po czym kontroluje się dodatkowo napięcie dren-źródło tranzystora mocy MOS za pomocą układu kontroli napięcia członu sterującego, a gdy jego wartośćjest wyższa od progu ustalonego przez układ sterujący, wówczas sygnał napięcia sterującego, podawanego na bramkę tranzystora MOS, zostaje zablokowany.A known method of securing the operation of a power MOS transistor consists in the fact that, by means of the control system, the control voltage is applied to its gate, correspondingly positive in relation to its source, for transistors with a ni-type channel, negative for transistors with a p-channel. at certain intervals, pulses are sent via the voltage control circuit to control the voltage values between the source and the drain of the controlled power MOS transistor. In the case of deviations from the nominal value, the voltage is stabilized by the control-limiting element, then the drain-source voltage of the MOS transistor is additionally controlled by the control unit voltage control system, and when its value is higher than the threshold set by the control system, then the signal the control voltage supplied to the gate of the MOS transistor is blocked.
Sposób według wynalazku polega na tym, że układ sterujący wysyła impuls sterujący do układu logicznego, badającego napięcie zasilania, gdy badane napięcie osiągnie żądaną wartość, układ logiczny przekazuje impuls napięciowy do układu wejściowego, zasilającego bramkę tranzystora mocy MOS. Opornik który jest zawarty między bramką tranzystora MOS a wyjściem układu, podaje masę przez obciążenie tranzystora MOS w przypadku awaryjnego jej braku. Układ pomiarowy mierzy prąd drenu płynący przez tranzystor mocy MOS, gdy prąd przekracza dopuszczalną wartość układ pomiarowy włącza tyrystor, który zwiera sygnał sterujący bramką tranzystora MOS, do masy.The method according to the invention consists in that the control circuit sends a control pulse to the logic circuit examining the supply voltage, when the tested voltage reaches the desired value, the logic circuit transmits the voltage pulse to the input circuit that powers the gate of the MOS power transistor. The resistor, which is included between the gate of the MOS transistor and the output of the system, gives the mass through the load of the MOS transistor in the event of its failure. The measuring system measures the drain current flowing through the MOS transistor, when the current exceeds the allowable value, the measuring system turns on the thyristor, which connects the signal controlling the MOS transistor's gate to ground.
Zaletą rozwiązania według wynalazku jest możliwość zabezpieczenia tranzystora mocy MOS przed uszkodzeniem, z powodu nadmiernej wartości prądu płynącego przez tranzystor oraz z powodu awaryjnego braku masy w układzie zasilania.The advantage of the solution according to the invention is the ability to protect the power MOS transistor against damage due to excessive current flowing through the transistor and due to an emergency lack of mass in the power supply system.
Przedmiot wynalazku został uwidoczniony na rysunku w przykładzie wykonania.The subject of the invention has been shown in the drawing in an exemplary embodiment.
Sposób według wynalazku polega na tym, że układ sterujący A wysyła impuls sterujący do układu logicznego B, badającego napięcie zasilania układu zasilającego Z. Gdy napięcie zasilania osiągnie niezbędną wartość, układ logiczny B przekazuje napięcie zasilania do układu wej175 091 ściowego C, zasilającego bramkę tranzystora mocy MOS. Gdy w układzie logicznym B zabraknie awaryjnie masy, wtedy poprzez obciążenie podaje masę opornik R, umieszczony między bramką tranzystora MOS a wyjściem układu, chroniąc tranzystor mocy MOS przed zniszczeniem. Następnym zabezpieczeniem umieszczonym w układzie pracy tranzystora mocy MOS jest układ pomiarowy D, mierzący prąd drenu płynący przez tranzystor MOS, gdy prąd przekracza dopuszczalną wartość, układ pomiarowy D włącza tyrystor T, który zwiera sygnał sterujący bramką tranzystora do masy.The method according to the invention consists in that the control circuit A sends a control pulse to the logic B, which tests the supply voltage of the supply circuit Z. When the supply voltage reaches the necessary value, the logic B transfers the supply voltage to the input circuit C, which supplies the gate of the power transistor. MOS. When there is an emergency ground in the logic system B, then the R resistor, placed between the gate of the MOS transistor and the output of the circuit, gives the mass through the load, protecting the MOS power transistor against damage. The next protection placed in the MOS transistor operation system is the measuring system D, measuring the drain current flowing through the MOS transistor, when the current exceeds the permissible value, the measuring system D turns on the thyristor T, which short-circuits the signal controlling the transistor's gate to ground.
175 091 uktad175 091 sect
Departament Wydawnictw UP RP. Nakład 90 egz. Cena 2,00 złPublishing Department of the UP RP. Circulation of 90 copies. Price PLN 2.00
Claims (1)
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
PL94306440A PL175091B1 (en) | 1994-12-21 | 1994-12-21 | Method of protecting a mos power transistor |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
PL94306440A PL175091B1 (en) | 1994-12-21 | 1994-12-21 | Method of protecting a mos power transistor |
Publications (2)
Publication Number | Publication Date |
---|---|
PL306440A1 PL306440A1 (en) | 1996-06-24 |
PL175091B1 true PL175091B1 (en) | 1998-10-30 |
Family
ID=20063980
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
PL94306440A PL175091B1 (en) | 1994-12-21 | 1994-12-21 | Method of protecting a mos power transistor |
Country Status (1)
Country | Link |
---|---|
PL (1) | PL175091B1 (en) |
-
1994
- 1994-12-21 PL PL94306440A patent/PL175091B1/en unknown
Also Published As
Publication number | Publication date |
---|---|
PL306440A1 (en) | 1996-06-24 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US10038436B2 (en) | Masking vd to vref after miller plateau and gate charge | |
US5519557A (en) | Power supply polarity reversal protection circuit | |
US7256605B2 (en) | Diagnostic circuit and method therefor | |
DE102007031494B4 (en) | Power supply controller | |
DE102010048520B4 (en) | Electronic control device | |
KR960701514A (en) | OUTPUT DRIVER | |
DE102010000875A1 (en) | Junction temperature determining method for e.g. insulated-gate bipolar transistor in three-phase power converter arrangement, involves supplying current to be fed so that total current flowing in transistor corresponds to test current | |
DE20005927U1 (en) | Safety barrier to limit current and voltage | |
JP3121821B2 (en) | Load short-circuit detection circuit device | |
US20090180231A1 (en) | Overcurrent protection circuit and voltage regulator incorporating same | |
JP2570523B2 (en) | Current detection circuit | |
US5333105A (en) | Transient voltage protector | |
DE102018105916A1 (en) | Gate potential control apparatus | |
DE602004003382T2 (en) | UNDERGROUND SENSOR ARRANGEMENT AND METHOD | |
PL175091B1 (en) | Method of protecting a mos power transistor | |
DE10349092B4 (en) | Integrated circuit arrangement for recognizing and outputting control signals | |
DE102019113053A1 (en) | Circuit, method and system for voltage monitoring | |
US6255887B1 (en) | Variable transconductance current mirror circuit | |
KR19990083515A (en) | CMOS Output Buffer Protection Circuit | |
JPS5755428A (en) | Protection circuit | |
JP4424095B2 (en) | Level shift circuit | |
US11563430B2 (en) | Transistor diagnostic circuit | |
DE10243571B4 (en) | Circuit arrangement for short circuiting a MOSFET switch | |
JP2792477B2 (en) | Power supply switching circuit and semiconductor integrated circuit including the power supply switching circuit | |
CN112653438B (en) | Analog switch multiplexer system and related method |