KR970049307A - 팬 디지타이징 시스템의 전력 절약 제어 회로 - Google Patents
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Abstract
본 발명은 펜 디지타이징 시스템(Pen Digitizing System)에 있어서,패널(Panel)상의 접촉이 일정 시간 동안 없는 경우 불필요한 전류 소비를 방지하기 위한 전력 절약 제어 회로(Powersave Control Circuit)에 관한 것으로,시스템 클럭을 입력으로 카운팅하여 244Hz의 클럭을 출력하는 카운팅부,및 패널상의 접촉 여부를 나타내는 팁 신호가 패널 상의 접촉이 없는 상태를 나타내는 경우 상기 카운팅부로 부터 출력되는 클럭을 입력으로 일정 시간 동안 카운팅하여 전류 소비를 제어하기 위한 파워 슬립 신호를 출력하는 파워 슬립 신호 출력부를 포함하여 구성된다.따라서 본 발명은 간단한 하드웨어적인 회로를 통해 불필요한 전류의 소비를 막을 수 있으며,회로의 클리어 기능을 반복 수행할 수 있는 효과가 있다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명에 의한 펜 디지타이징 시스템의 전력 절약 제어 회로의 구성도.
Claims (5)
- 시스템 클럭을 입력으로 카운팅하여 244Hz의 클럭(Q1)을 출력하는 카운팅부(20),및 패널상의 접촉 여부를 나타내는 팁 신호(TIP)가 패널 상의 접촉이 없는 상태를 나타내는 경우 상기 카운팅부(20)로 부터 출력되는 클럭(Q1)을 입력으로 일정 시간 동안 카운팅하여 전류 소비를 제어하기 위한 파워 슬립 신호(PSL)를 출력하는 파워 슬립 신호 출력부(30)를 포함하여 구성되는 것을 특징으로 하는 펜 디지타이징 시스템의 전력 절약 제어 회로.
- 제1항에 있어서,상기 시스템 클럭(CLK)은 2MHz의 주파수를 갖는 것을 특징으로 하는 펜 디지타이징시스템의 전력 절약 제어 회로.
- 제2항에 잇어서,상기 카운팅부(20)는 외부로 부터 입력되는 클리어 신호(CLE)에 따라 클리어되고 상기 시스템 클럭(CLK)을 입력으로 카운팅하는 12단 카운터(21),및 상기 클리어 신호(CLE)에 따라 클리어되고 상기 12단 카운터(22)의 출력을 입력으로 카운팅하여 244Hz의 클럭(Q1)을 출력하는 4단 카운터(22)를 포함하여 구성되는 것을 특징으로 하는 펜 디지타이징 시스템의 전력 절약 제어 회로.
- 제1항에 있어서,상기 파워 슬립 신호 출력부(30)는 상기 팁신호(TIP)에 따라 상기 카운팅부(20)로 부터 출력되는 클럭(Q1)을 반전시켜 출력하는 인버터(31),상기 팁신호(TIP)에 따라 클리어되고 상기 인버터(31)의 출력을 입력으로 일정 시간 동안 카운팅하는 12단 카운터(32), 및 상기 팁 신호(TIP)와 12단 카운터(32)의 출력을 논리곱하여 파워 슬립신호(PSL)를 출력하는 앤드 게이트(33)를 포함하여 구성되는 것을 특징으로 하는 펜 디지타이징 시스템의 전력 절약 제어 회로.
- 제4항에 있어서,상기 12단 카운터(32)는 상기 팁신호(TIP)에 따라 클리어되고 상기 인버터(31)의 출력을 입력으로 8초 동안 카운팅하는 것을 특징으로 하는 펜 디지타이징 시스템의 전력 절약 제어 회로.※ 참고사항: 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (14)
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Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
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1995
- 1995-12-26 KR KR1019950056423A patent/KR970049307A/ko not_active Application Discontinuation
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
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