KR960028474A - 계층부호화를 위한 피티에스 벡터양자화 부호기 - Google Patents
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Abstract
본 발명은 계층부호화를 위한 PTS VQ 엔코더에 관한 것으로, 영상데이타를 읽어와 입력벡터(Vin)를 형성하는 램억세스부(10)와; 상기 부호책(5)으로부터 부호벡터를 미리 읽어와 좌측 부호벡터(VL)와 우측 부호벡터(VR)를 출력하고, 결과신호에 따라 선택된 가지(branch)의 노드를 중심으로 다시 우측 부호벡터와 좌측 부호벡터를 읽어오고, 제1계층의 끝 노드에 도달하면 제1계층종료 플래그(1st END FLAG)를 발생하고, 단자 노드(terminal node)에 도달 하면 완료신호(complete)를 발생하는 프리패치부(30); 상기 입력벡터(Vin)를 프리 패치된 좌측 부호벡터(VL) 및 우측 부호벡터(VR)와 왜곡치를 계산하여 왜곡치가 적은 쪽의 가지를 선택하도록 상기 결과신호를 출력하는 계산부(20); 및 상기 계산부(20)의 결과신호에 따라 해당 부호벡터의 인덱스 코드를 생성하여 제1계층종료 플래그에 따라 제1계층 인덱스코드를 출력하고, 상기 완료신호(complete)에 따라 제2계층 인덱스코드를 출력하는 코드발생부(40)를 구비하여 PTS VQ에 의해 계층부호화한다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 따른 계층부호화를 위한 PTSVQ 엔코더를 도시한 블럭도.
Claims (3)
- 프레임 메모리에 저장된 영상 데이타를 읽어와 제1계층과 제2계층으로 계층화된 PTS VQ에 따른 부호책(codebook:5)으로부터 상기 부호벡터를 읽어와 제1계층 인덱스코드 및 제2계층 인덱스코드를 발생하는 PTS VQ 엔코더에 있어서, 영상데이타를 읽어와 입력벡터(Vin)를 형성하는 램억세스부(10)와; 상기 부호책(5)으로부터 부호벡터를 미리 읽어와 좌측 부호벡터(VL)와 우측 부호벡터(VR)를 출력하고, 결과신호에 따라 선택된 가지(branch)의 노드를 중심으로 다시 우측 부호벡터와 좌측 부호벡터를 읽어오고, 제1계층의 끝 노드에 도달하면 제1계층종료 플래그(1st END FLAG)를 발생하고, 단자 노드(terminal node)에 도달하면 완료신호(complete)를 발생하는 프리패치부(30); 상기 입력벡터(Vin)를 프리 패치된 좌측 부호벡터(VL) 및 우측 부호 벡터(VR)와 왜곡치를 계산하여 왜곡치가 적은 쪽의 가지를 선택하도록 상기 결과신호를 출력하는 계산부(20); 및 상기 계산부(20)의 결과신호에 따라 해당 부호벡터의 인덱스 코드를 생성하여 제1계층종료 플래그에 따라 제1계층 인덱스코드를 출력하고, 상기 완료신호(complete)에 따라 제2계층 인덱스코드를 출력하는 코드 발생부(40)를 구비한 것을 특징으로 하는 계층부호화를 위한 피티에스벡터양자화 부호기.
- 제1도에 있어서, 상기 프리패치부(30)는 바이너리 트리 구조로 제1계층과 제2계층으로 구분되어 부호벡터가 저장된 저장된 부호책 램(5)을 억세스하여 현재 노드로부터 좌측 노드의 좌측 부호벡터와 우측 부호벡터 및 각각의 제1계층종료 플래그를 읽어오고, 현재 노드로부터 우측 노드의 좌측 부호벡터와 우측 부호벡터 및 각각의 제1계층종료 플래그를 읽어오는 램리드부(31)와; 램리드부(31)가 읽어온 우측 노드의 우측 부호벡터를 저장하는 RR레지스터(32); 램리드부(31)가 읽어온 우측노드의 좌측부호벡터를 저장하는 RL레지스터(33); 우측노드의 제1계층종료 플래그를 저장하는 레지스터(34); 램리드부(31)가 읽어온 좌측노드의 우측 부호 벡터를 저장하는 LR레지스터(35); 램리드부(31)가 읽어온 좌측 노드의 좌측 부호벡터를 저장하는 LL레지스터(36); 좌측노드의 제1계층종료신호(1st END FLAG)를 저장하는 레지스터(37); 계산부(20)의 결과 신호(COMPUTE)에 따라 상기 RR레지스터(32), RL레지스터(33) 및 제1종료신호레지스터(34) 혹은 LR레지스터(35), LL레지스터(36) 및 제1종료신호 레지스터(37)를 선택하는 멀티플랙서(38)를 구비한 것을 특징으로 하는 계층부호화를 위한 피티에스 벡터양자화 부호기.
- 제1항에 있어서, 상기 코드발생부(40)의 세부 블럭도로서, 제1계층 인덱스코드 발생부(40B)와; 제2계층 인덱스코드발생부(40A); 및 제1계층 종료신호(1st END FLAG)를 입력하여 벡터코드가 제1계층에 속하면, 상기 제1계층 인덱스코드발생부(40B)로 계산부(20)의 출력을 연결하고, 제1계층에 속하지 않으면 계산부(20)의 출력을 상기 제2계층의 인덱스코드발생부(40A)로 연결하는 디멀티플랙서(DMUX)로 구성되는 것을 특징으로 하는 계층부호화를 위한 피이에스 벡터양자화 부호기.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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---|---|---|---|
KR1019940038209A KR0169661B1 (ko) | 1994-12-28 | 1994-12-28 | 계층부호화를 위한 피티에스 벡터양자화 부호기 |
Applications Claiming Priority (1)
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KR1019940038209A KR0169661B1 (ko) | 1994-12-28 | 1994-12-28 | 계층부호화를 위한 피티에스 벡터양자화 부호기 |
Publications (2)
Publication Number | Publication Date |
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KR960028474A true KR960028474A (ko) | 1996-07-22 |
KR0169661B1 KR0169661B1 (ko) | 1999-03-20 |
Family
ID=19404466
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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KR1019940038209A KR0169661B1 (ko) | 1994-12-28 | 1994-12-28 | 계층부호화를 위한 피티에스 벡터양자화 부호기 |
Country Status (1)
Country | Link |
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KR (1) | KR0169661B1 (ko) |
-
1994
- 1994-12-28 KR KR1019940038209A patent/KR0169661B1/ko not_active IP Right Cessation
Also Published As
Publication number | Publication date |
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KR0169661B1 (ko) | 1999-03-20 |
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