KR960027811A - Isdn 단말기용 채널간 정보지연 동기 회로 - Google Patents
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- H04—ELECTRIC COMMUNICATION TECHNIQUE
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- H04L7/00—Arrangements for synchronising receiver with transmitter
- H04L7/0008—Synchronisation information channels, e.g. clock distribution lines
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- H04Q11/04—Selecting arrangements for multiplex systems for time-division multiplexing
- H04Q11/0428—Integrated services digital network, i.e. systems for transmission of different types of digitised signals, e.g. speech, data, telecentral, television signals
Abstract
본 발명은 종합 정보 통신망(Integrated Services Digital Network)에 관한 것으로, 특히 채널간의 전송매체로 인해 발생되는 시간 지연에 따라 송/수신되는 사용자정보신호가 불일치하는 것을 방지하기 위한 ISDN 단말기용 채널간 정보지연 동기회로에 관한 것이다.
본 발명은 ISDN 단말기를 구성시 다중화/역다중화부 통하여 입력되는 프레임 구조의 서비스 채널정보를 통해 각 B채널에 실린 정보의 지연 상태를 파악한 후 그 차이값 만큼 먼저 들어오는 채널의 정보를 저장하였다가 나중에 들어오는 채널의 정보와 동기를 맞추어서 출력하도록 구성되어 있는 채널지연 동기회로를 제공하는데 그 특징이 있다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 발명의 회로를 적용한 ISDN A/V 단말기의 전체 구성도, 제5A도는 본 발명의 채널지연 제어부(13)의 블럭도, 제5B도는 본 발명의 채널지연 회로부(13)의 회로도.
Claims (6)
- 망(network)과 연결된 ISDN용 플러그(1)를 통한 전송신호는 신호 송수신을 위한 트랜스(2)와 드라이버/리시버(3) 그리고 프로토콜 처리를 위한 계층처리부(4)를 거쳐 각각의 다중화/역다중화부(6),(7)에 입력되도록 한 ISDN A/V단말기에 있어서, 상기 계층처리부(4)와 각각의 다중화/역다중화부(6),(7) 사이에 채널지연 동기회로부(5)를 구성하여 마이크로프로세서(12)가 상기 채널지연 동기회로부(5)와 상기 각 다중화/역중화부(6),(7)를 제어하여 음성코덱부(8)와 영상코덱부(9)에 각 채널을 통해 들어온 신호를 분배하도록 구성됨을 특징으로 하는 ISDN 단말기용 채널간 정보지연 동기 회로.
- 제1항에 있어서, 상기 채널지연 동기회로부(5)는 측정된 지연차이값을 이용해 카운터를 선택하는 카운터 선택부(21)와, 실제로 다운카운터 및 레치작용을 하는 카운터 및 레치부(22)와, 다운카운팅되는 과정을 측정하여 측정된 카운터값에 따라 지연된 만큼 동기를 맞출 수 있는 신호를 발생하는 카운터 측정부(23)로 이루어진 채널지연 제어부(13)와; 먼저 들어온 정보를 저장하였다가 나중에 들어오는 정보와 동기를 맞추어 출력할 수 있도록 한 정보저장 및 출력부(44)로 구성됨을 특징으로 하는 ISDN 단말기용 채널간 정보지연 동기 회로.
- 제2항에 있어서, 상기 카운터 선택부(21)는 상기 마이크로 프로세서부(12)로부터 지연값을 다운카운트할 수 있도록 하는 오아게이트(24),(25),(26)와 D플립플롭(35), 노아게이트(31), 디코더(34)로 구성됨을 특징으로 하는 ISDN 단말기용 채널간 정보지연 동기 회로.
- 제2항에 있어서, 상기 카운터 및 레치부(22)는 상기 마이크로 프로세서부(12)로부터 지연값을 받아 다운 카운트하는 카운터(36),(37),(38)와 다운카운트되는 과정의 값을 래치하는 래치(39),(40),(41)로 구성됨을 특징으로 하는 ISDN 단말기용 채널간 정보지연 동기 회로.
- 제2항에 있어서, 상기 카운터 측정부(23)는 상기 카운터 및 래치부(22)로부터 마지막 다운카운트되어 나온 값과 그 값을 래치하여 얻은 값을 이용하여 정보저장 및 출력부(44)에 제어신호를 출력하도록 하는 오아게이트(27),(42),(43)와, 앤드게이트(29),(30),(32)와, 인버터게이트(33)로 구성됨을 특징으로 하는 ISDN 단말기용 채널간 정보지연 동기 회로.
- 제2항에 있어서, 상기 정보저장 및 출력부(44)는 상기 카운터 측정부(23)로부터 나온 신호를 이용하여 정보 저장을 선택하는 오아게이트(19), X-오아게이트(20), 먹스(17),(18)와, 상기 지연값에 따라 정보를 저장하도록 하는 SIPO레지스터(14), FIFO버퍼(15), SISO/PISO레지스터(16)로 구성됨을 특징으로 하는 ISDN 단말기용 채널간 정보지연 동기 회로.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019940040594A KR100210647B1 (ko) | 1994-12-31 | 1994-12-31 | Isdn 단말기용 채널간 정보지연 동기 회로 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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KR1019940040594A KR100210647B1 (ko) | 1994-12-31 | 1994-12-31 | Isdn 단말기용 채널간 정보지연 동기 회로 |
Publications (2)
Publication Number | Publication Date |
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KR960027811A true KR960027811A (ko) | 1996-07-22 |
KR100210647B1 KR100210647B1 (ko) | 1999-07-15 |
Family
ID=19406230
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019940040594A KR100210647B1 (ko) | 1994-12-31 | 1994-12-31 | Isdn 단말기용 채널간 정보지연 동기 회로 |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR100210647B1 (ko) |
-
1994
- 1994-12-31 KR KR1019940040594A patent/KR100210647B1/ko not_active IP Right Cessation
Also Published As
Publication number | Publication date |
---|---|
KR100210647B1 (ko) | 1999-07-15 |
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