KR960011722A - 다중프로세서 시스템에서의 캐쉬간 직접 데이타 전송 지원 제어 장치 - Google Patents

다중프로세서 시스템에서의 캐쉬간 직접 데이타 전송 지원 제어 장치 Download PDF

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KR960011722A
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양승택
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Abstract

본 발명은 공유 캐쉬 메모리를 사용하는 다중프로세서 시스템에서 발생하는 이러한 문제들을 개선하기 위한 것으로, 캐쉬간 직접 데이타전송(cache-to-cache data transfer)을 DRAM은 한번도 읽거나 쓰기를 행하지 않고, 단지 한번의 버스 사용으로 이루어지도록 한다.
캐쉬에서 캐쉬로 데이타를 직접 전송하는 방법을 사용하면, 메모리 데이타 복사본을 여러개의 프로세서 전용의 캐쉬에 분산하여 두었을 경우 발생하는 데이타 불일치 문제를 좀 더 간략화시켜 쉽게 해결할 수가 있고, 캐쉬 데이타의 메모리 되쓰기로 인한 공통버스의 빈번한 사용에 따라서 발생되는 버스 병목 현상을 감소시키고, 또한, 캐쉬에서 메모리로, 또 메모리에서 캐쉬로 데이타를 이중 전송하는 동안 발생할 수 있는 데이타의 에러를 줄여 준다.

Description

다중프로세서 시스템에서의 캐쉬간 직접 데이타 전송 지원 제어장치
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제4도는 본 발명의 상세 구성도.

Claims (1)

  1. 적어도 두개 이상의 프로세서들이 펜디드 프로토콜 버스상에 연결되어 있는 다중프로세서 시스템에 있어서, 상기 프로세서들 각각에 연결되어 캐쉬간 직접 데이터 전송을 수행하는 캐쉬간 전송 모듈(C2CM)들을 포함하고, 상기 캐쉬간 전송 모듈들 각각은 캐쉬간 직접 데이타 전송에 필요한 소정의 제어 신호들을 생성하여 캐쉬간 전송을 제어하는 캐쉬간 제어기(10)와, 데이타 전송형태를 만들거나 검사하는 전송 형태 제어기(30)와, 상기 펜디드 프로토콜 버스에서 구동되는 신호를 저장하거나 구동하는 버스 수신 및 구동기(50)와, 프로세서와 캐쉬 메모리에서 구동되는 어드레스와 데이타나 상기 버스 수신 및 구동기(50)를 통한 상기 펜디드 프로토콜 버스상에서 구동된 데이타를 저장하거나 데이타와 어드레스의 패리티를 검사하는 버퍼 및 패리티 체커(20)와, 상기 펜디드 프로토콜 버스에서 구동되는 DI와 SI를 비교하여 그 결과를 캐쉬간 제어기(10)로 보내는 ID 비교기(40)를 포함하는 것을 특징으로 하는 펜디드 프로토콜 버스상에서의 캐쉬간 직접 데이타 전송 지원 제어 장치.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019940023878A 1994-09-22 1994-09-22 다중프로세서 시스템에서의 캐쉬간 직접 데이타 전송 지원 제어장치 KR960012355B1 (ko)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100348808B1 (ko) * 1996-04-24 2003-01-29 엘지전자주식회사 메모리간의 데이타 전송장치

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* Cited by examiner, † Cited by third party
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KR100348808B1 (ko) * 1996-04-24 2003-01-29 엘지전자주식회사 메모리간의 데이타 전송장치

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