KR950005148Y1 - Solenoid disorder-inspecting apparatus for automobile a. b. s. - Google Patents

Solenoid disorder-inspecting apparatus for automobile a. b. s. Download PDF

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Abstract

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Description

자동차용 ABS의 솔레노이드밸브 고장검출장치Solenoid Valve Fault Detection Device of Automotive ABS

제 1 도는 본 고안 ABS 솔레노이드밸브의 고장검출장치의 회로도.1 is a circuit diagram of the fault detection device of the ABS solenoid valve of the present invention.

제 2 도는 본 고안 ABS의 솔레노이드밸브의 고장검출장치로부터 출력되는 논리표.2 is a logic table outputted from the fault detection device of the solenoid valve of the present invention ABS.

제 3a-c 도는 ABS의 솔레노이드밸브가 정상, 밸브라인 개방, 밸브코일 단락 상태에 따른 각부의 출력파형도.3a-c is an output waveform diagram of each part according to the solenoid valve of ABS is normal, valve line open, valve coil short circuit condition.

* 도면의 주요부분에 대한 부호의 설명* Explanation of symbols for main parts of the drawings

가 : 제어기 나 : 솔레노이드밸브구동부A: Controller B: Solenoid valve driving part

다 : 논리회로 라 : 연산출력부C) logic circuit d) computation output

FET : 전계효과트랜지스터 SV : 솔레노이드밸브FET: Field effect transistor SV: Solenoid valve

본 고안은 자동차용 ABS의 솔레노이드밸브 고장검출장치에 관한 것으로, 특히 브레이크 제동시에 동작하는 솔레노이드 밸브와, 밸브 라인 및 밸브 코일의 이상 유무 상태를 검출 할수 있도록 한 자동차용 ABS의 솔레노이드밸브 고장검출장치에 관한 것이다.The present invention relates to a solenoid valve fault detection device of ABS for automobiles, and more particularly, to a solenoid valve fault detection device of ABS for automobiles capable of detecting abnormality of solenoid valves operated during brake braking and valve lines and valve coils. It is about.

일반적으로 자동차용 ABS의 솔레노이드밸브는 자동차 주행중에 브레이크를 밟았을때, 차량의 속도에 따른 솔레노이드밸브가 온 오프 작동하면서 서서히 정지 작동을 하도록 하는 브레이크 장치 인바, 상기와 같이 작동하는 ABS의 솔레노이드 밸브의 라인 또는 코일에 이상이 생겼을경우, 정상적인 브레이크 동작이 이루어지지 않게 되어 특히 주행중인 경우 사고를 유발시키게 되는 문제점을 가지게 되었다.In general, the solenoid valve of the ABS for a vehicle is a brake device that allows the solenoid valve according to the speed of the vehicle to be gradually stopped while the brake is pressed while driving the vehicle. The insole of the solenoid valve of the ABS operated as described above When an error occurs in the line or the coil, the normal brake operation is not made, especially when driving, there is a problem that causes an accident.

따라서 본 고안의 목적은 자동차 주행중에 브레이크를 밟았을경우 작동되는 ABS의 솔레노이드밸브의 이상 유무를 검출 함으로써, 상기 솔레노이드밸브의 라인 및 코일의 이상으로 인하여 발생되는 사고를 미연에 방지할수 있도록 하는데 있으며, 상기의 목적을 실현하기 위하여 본 고안은 브레이크 작동시 제어신호를 출력하는 제어기와, 상기 제어기로 부터 입력되는 신호에 따라 솔레노이드 들을 구동하는 솔레노이드 밸브 구동부와, 상기 솔레노이드밸브구동부에서 출력되는 신호를 논리 연산하는 논리회로부와, 상기 논리회로부에서 출력되는 신호를 연산하여 상기 제어부 출력하는 연산출력부로 구성한다.Therefore, the object of the present invention is to detect the abnormality of the solenoid valve of ABS that is operated when the brake is pressed while driving the vehicle, to prevent the accident caused by the abnormality of the solenoid valve line and coil, In order to achieve the above object, the present invention provides a controller for outputting a control signal during brake operation, a solenoid valve driver for driving solenoids according to a signal input from the controller, and a logic operation for a signal output from the solenoid valve driver. And a logic output unit configured to calculate a signal output from the logic circuit unit and output the control unit.

이하 첨부된 도면에 의거 본 고안을 상세히 설명하면 다음과 같다.Hereinafter, the present invention will be described in detail with reference to the accompanying drawings.

제 1 도는 본 고안 ABS의 솔레노이드밸브 고장검출장치의 회로도로서, 브레이크 작동시 제어신호를 출력하는 제어기(가)와, 상기 제어기(가)로 부터 입력되는 신호에 따라 온 오프하면서, 솔레노이드(SV)의 신호에 따라 동작하는 솔레노이드(SV), 전계효과트랜지스터(FET)로 구성되는 솔레노이드밸브구동부(나)와, 상기 솔레노이즈밸브구동부(나)에서 동작되어 출력되는 신호를 논리 연산하여 연산된 신호를 출력하는 논리회로(다)와, 상기 논리회로(다)의 게이트에서 출력되는 각각의 신호를 논리연산하여 상기 제어기(가)에 출력되는 연산출력부(라)로 구성 된다.1 is a circuit diagram of a solenoid valve fault detection device of the present invention ABS, the controller for outputting a control signal during brake operation, and the solenoid (SV) while on and off in accordance with the signal input from the controller (A) The solenoid valve driver (B) consisting of a solenoid (SV) and a field effect transistor (FET) operating in accordance with the signal of the signal and the signal operated by the solenoid valve driver (B) and the output signal is calculated Logic circuit (C) for outputting, and an arithmetic output unit (D) output to the controller (A) by performing a logical operation on each signal output from the gate of the logic circuit (C).

제 2 도는 본 고안 ABS의 솔레노이드밸브의 고장검출장치로부터 출력되는 논리표, 제 3a-c 도는 ABS의 솔레노이드밸브가 정상, 밸브라인 개방, 밸브코일 단락 상태에 따른 각부의 출력파형도이다.2 is a logic table output from the fault detection device of the solenoid valve of the present invention ABS, and 3a-c is an output waveform diagram of each part according to the normal, valve line open, valve coil short circuit condition of the ABS solenoid valve.

상기와 같이 구성하여서 된 본 고안의 작용효과를 설명하면 다음과 같다.Referring to the operation and effect of the subject innovation made up as described above are as follows.

먼저 자동차가 주행중인 상태에서 브레이크를 밟게 되면, 제어기(가)에서는 제 3a 도에 도시한 바와 같은 파형을 출력시키게 되고 이 출력된 파형은 솔레노이드밸브구동부(나)에 입력되게 된다.First, when the brake is applied while the vehicle is running, the controller outputs a waveform as shown in FIG. 3A, and the output waveform is input to the solenoid valve driving unit (B).

그러므로, 상기 솔레노이드밸브구동부(나)에 입력되는 신호는 전계효과트랜지스터(FET)의 게이트단자에 입력되게 되는데 상기 전계효과트랜지스터(FET)의 입력되는 신호가 하이신호일 경우 이 하이신호에 의하여 산기 전계효과트랜지스터(FET)는 도통상태가 되므로 상기 솔레노이드(SV)는 온상태가 되어 상기 솔레노이드밸브(SV)에는 전류가 흐르게 되므로 상기 전계효과트랜지스터(FET)의 드레인 출력단자에서는 제 3a 도의 (b)에 도시한 바와 같은 반전된 로우신호를 출력하게 되고, 상기 전계효과트랜지스터(FET)의 게이트단자에 로우신호가 입력되게 되게 되면 상기 솔레노이드밸브(SV)는 오프 상태가 되므로 그의 드레인 출력단자에서는 반전된 하이신호를 출력하게 된다.Therefore, the signal input to the solenoid valve driver (b) is input to the gate terminal of the field effect transistor (FET). When the signal input of the field effect transistor (FET) is a high signal, the diffuser field effect is generated by this high signal. Since the transistor FET is in a conductive state, the solenoid SV is turned on so that a current flows in the solenoid valve SV. Thus, the drain output terminal of the field effect transistor FET is shown in FIG. 3A (b). When the inverted low signal is output, and when the low signal is inputted to the gate terminal of the field effect transistor (FET), the solenoid valve SV is turned off, and thus its inverted high signal is inverted. Will print

이와같이 상기 솔레노이드밸브구동부(나)에서 반전되어 출력되는 신호는 논리회로(다)각각의 게이트 일측단자에 입력됨과 아울러, 논리회로(다)각각의 게이트 타측단자에는 상기 제어기(가)로 부터 출력되는 신호가 입력되게 된다. 그러므로 상기 논리회로(다)의 각각의 게이트단자에서는 상기 솔레노이드밸브구동부(나)에서 출력되는 신호가 상기 제어기(가)에서 출력되는 신호와를 논리연산하여 제 3c,d 도에 도시한 바와같이 각각의 파형을 출력시켜 연산출력부(라)에 입력시키게 된다.In this way, the signal inverted and output from the solenoid valve driver (b) is inputted to one terminal of each gate of the logic circuit (c), and outputted from the controller (a) to the other terminal of the gate of the logic circuit (c). The signal is input. Therefore, at each gate terminal of the logic circuit (C), the signal output from the solenoid valve driver (B) is logically calculated from the signal output from the controller (A), as shown in FIGS. 3C and 3, respectively. The waveform is outputted to the calculation output unit d.

따라서 상기 연산출력부(라)에서는 상기 논리회로(다)에서 입력되는 신호를 논리연산하여 제 3e 도에 도시한 바와같은 파형의 하이신호를 상기 제어기(가)로 출력시키게 됨으로써 제 2 도에 도시한 바와같은 논리표에 의해 상기 솔레노이드밸브(SV)가 정상임을 검출하게 되는 것이다.Therefore, the arithmetic output section D outputs a high signal of a waveform as shown in FIG. 3E to the controller A by performing a logic operation on the signal input from the logic circuit C. As shown in FIG. It is to detect that the solenoid valve (SV) is normal by a logic table as described above.

한편 상기 솔레노이드밸브(SV)라인이 오픈 되어 있는 상태에서 브레이크를 밟게 되면 상기 제어기(가)에서는 제 3b 도의 (a)에 도시한 바와같은 파형을 출력하게 되고, 상기와 같이 출력되는 파형은 이 출력된 파형은 솔레노이드밸브구동부(나)에 입력되게 된다.On the other hand, if the brake is applied while the solenoid valve (SV) line is open, the controller outputs a waveform as shown in (a) of FIG. 3B, and the output waveform is output as described above. The waveform is input to the solenoid valve driver (b).

그러므로, 상기 솔레노이드밸브구동부(나)에 입력되는 신호는 전계효과트랜지스터(FET)의 게이트단자에 입력되게 되는데 상기 전계효과트랜지스터(FET)의 입력되는 신호가 하이신호일 경우 이 하이신호에 의하여 상기 솔레노이드밸브(SV)라인이 오픈상태가 되므로 상기 전계효과트랜지스터(FET)의 드레인 출력단자에서는 제 3b 도의 (b)에 도시한 바와같은 로우신호를 출력하게 되고, 상기 전계효과트랜지스터(FET)의 게이트단자에 로우신호가 입력된다 할지라도 출력상태는 동일하다.Therefore, the signal input to the solenoid valve driver (b) is input to the gate terminal of the field effect transistor (FET). If the signal input of the field effect transistor (FET) is a high signal, the solenoid valve is operated by this high signal. Since the (SV) line is in an open state, the drain output terminal of the field effect transistor (FET) outputs a low signal as shown in (b) of FIG. 3B, and to the gate terminal of the field effect transistor (FET). Even if a low signal is input, the output state is the same.

이와같이 상기 솔레노이드밸브구동부(나)에서 출력되는 신호는 논리회로(다) 각각의 게이트 일측단자에 입력됨과 아울러, 논리회로(다)각각의 게이트 타측단자에는 상기 제어기(가)로 부터 출력되는 신호가 입력되게 된다. 그러므로 상기 논리회로(다)의 각각의 게이트단자에서는 상기 솔레노이드밸브구동부(나)에서 출력되는 신호와 상기 제어기(가)에서 출력되는 신호와를 논리연산하여 제 3 도(b)의 (c)(d)에 도시한 바와 같은 각각의 파형을 출력시켜 연산출력부(라)에 입력시키게 된다.In this way, the signal output from the solenoid valve driver (b) is input to one terminal of each gate of the logic circuit (c), and the signal output from the controller (a) is input to the other terminal of each gate of the logic circuit (c). Will be entered. Therefore, at each gate terminal of the logic circuit (C), a logic operation is performed on the signal output from the solenoid valve driver (b) and the signal output from the controller (c) (c) of FIG. Each waveform as shown in d) is outputted and inputted to the arithmetic output unit d.

따라서 상기 연산출력부(라)에서는 상기 논리회로(다)에서 입력되는 신호를 논리연산하여 제 3b 도의 (e)에 도시한 바와같은 하이 로우신호 파형을 상기 제어기(가)로 출력시키게 됨으로써 제 2 도에 도시한 바와같은 논리표에 의해 상기 솔레노이드밸브(SV)라인이 오픈되어 있음을 검출하게 되는 것이다.Accordingly, the arithmetic output unit D performs a logic operation on a signal input from the logic circuit C to output a high low signal waveform to the controller A as shown in FIG. The solenoid valve SV line is opened by the logic table shown in FIG.

한편 상기 솔레노이드밸브(SV) 코일이 단락되었을 경우, 브레이크를 밟게 되면 상기 제어기(가)에서는 제 3c 도의 (a)에 도시한 바와같은 파형을 출력하게 되고, 상기와 같이 출력되는 파형은 이 출력된 파형은 솔레노이드밸브구동부(나)에 입력되게 된다.On the other hand, when the solenoid valve (SV) coil is short-circuited, when the brake is applied, the controller outputs a waveform as shown in (a) of FIG. 3C, and the output waveform is output as described above. The waveform is input to the solenoid valve driver (b).

그러므로, 상기 솔레노이드밸브구동부(나)에 입력되는 신호는 전계효과트랜지스터(FET)의 게이트단자에 입력되게 되는데 상기 전계효과트랜지스터(FET)의 입력되는 신호가 하이신호일 경우 이 하이신호에 의하여 상기 전계효과트랜지스터(FET)는 도통상태가 되므로 상기 솔레노이드(SV)는 온상태가 되지만 상기 솔레노이드밸브(SV)코일이 단락상태가 되어 있음으로 상기 전계효과트랜지스터(FET)의 드레인 출력단자에서 제 3b 도의 (b)에 도시한 바와 같은 하이신호를 출력하게 되고, 상기 전계효과 트랜지스터(FET)의 게이트단자에 로우신호가 입력된다 할지라도 출력상태는 동일하다.Therefore, the signal input to the solenoid valve driver (b) is input to the gate terminal of the field effect transistor (FET). When the signal of the field effect transistor (FET) is a high signal, the field effect is generated by this high signal. Since the transistor FET is in a conductive state, the solenoid SV is in an on state, but the solenoid valve SV coil is in a short circuit state, and thus, the drain output terminal of the field effect transistor FET is connected to the drain output terminal of FIG. A high signal as shown in Fig. 2) is output and the output state is the same even if a low signal is input to the gate terminal of the field effect transistor (FET).

이와같이 상기 솔레노이드밸브구동부(나)에서 출력되는 신호는 논리회로(다) 각각의 게이트 일측단자에 입력됨과 아울러, 논리회로(다)각각의 게이트 타측단자에는 상기 제어기(가)로 부터 출력되는 신호가 입력되게 된다. 그러므로 상기 논리회로(다)의 각각의 게이트단자에서는 상기 솔레노이드밸브구동부(나)에서 출력되는 신호와 상기 제어기(가)에서 출력되는 신호와를 논리연산하여 제 3c 도의 (c)(d)에 도시한 바와같은 각각의 파형을 출력시켜 연산출력부(라)에 입력시키게 된다.In this way, the signal output from the solenoid valve driver (b) is input to one terminal of each gate of the logic circuit (c), and the signal output from the controller (a) is input to the other terminal of each gate of the logic circuit (c). Will be entered. Therefore, at each gate terminal of the logic circuit (c), a logic operation is performed on the signal output from the solenoid valve driver (b) and the signal output from the controller (a), and the result is shown in FIG. 3 (c) (d). Each waveform as described above is output and inputted to the calculation output unit d.

따라서 상기 연산출력부(라)에서는 상기 논리회로(다)에서 입력되는 신호를 논리연산하여 제 3c 도의 (e)에 도시한 바와같은 하이 로우신호 파형을 상기 제어기(가)로 출력시키게 됨으로써 제 2 도에 도시한 바와같은 논리표에 의해 상기 솔레노이드밸브(SV)코일이 단락되어 있음을 검출하게 되는 것이다.Accordingly, the arithmetic output unit D performs a logic operation on the signal input from the logic circuit C to output a high low signal waveform as shown in FIG. The solenoid valve SV is short-circuited by the logic table shown in FIG.

이상에서 설명한 바와같이 본 고안은 자동차용 ABS에서 브레이크 제동시에 동작하는 솔레노이드 밸브에 고장검출장치를 부가하여 브레이크 작동시, 솔레노이드 밸브 라인 및 밸브 코일의 이상 유무 상태를 검출 할수 있도록 함으로써, 주행중에 솔레노이드밸브의 고장으로 인하여 야기 될수 있는 사고를 미연에 방지 할수 있는 효과를 제공하게 되는 것이다.As described above, the present invention adds a fault detection device to a solenoid valve that operates during brake braking in the ABS of a vehicle so that an abnormal state of the solenoid valve line and the valve coil can be detected during brake operation, thereby driving the solenoid valve while driving. It will provide the effect to prevent the accident that can be caused by the failure of the system.

Claims (1)

자동차용 ABS의 솔레노이드밸브 고장검출장치에 있어서, 브레이크 작동시 제어신호를 출력하는 제어기(가)와, 상기 제어기(가)로 부터 입력되는 신호에 따라 온 오프하면서, 솔레노이드(SV)를 구동하는 솔레노이드(SV), 전계효과트랜지스터(FET)로 구성되는 솔레노이드밸브구동부(나)와, 상기 솔레노이드밸브구동부(나)에서 검출되어 출력되는 신호를 논리 연산하여 연산된 신호를 출력하는 논리회로(다)와, 상기 논리회로(다)의 게이트에서 출력되는 각각의 신호를 논리연산하여 상기 제어기(가)에 출력하는 연산출력부(라)로 구성하여서 된 것을 특징으로 하는 자동차용 ABS의 솔레노이드밸브 고장검출장치.In the ABS solenoid valve fault detection device for a vehicle, a controller for outputting a control signal during brake operation and a solenoid for driving a solenoid (SV) while turning on and off in accordance with a signal input from the controller (A). (SV), a solenoid valve driver (B) consisting of a field effect transistor (FET), and a logic circuit for outputting the calculated signal by performing a logic operation on the signal detected and output from the solenoid valve driver (B); Solvent valve fault detection device for ABS for automobiles, characterized in that it consists of a logic output unit (D) for outputting to the controller (A) by logical operation of each signal output from the gate of the logic circuit (C) .
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