KR940001554A - 디지탈 gmsk 변조회로 - Google Patents

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KR940001554A
KR940001554A KR1019920011534A KR920011534A KR940001554A KR 940001554 A KR940001554 A KR 940001554A KR 1019920011534 A KR1019920011534 A KR 1019920011534A KR 920011534 A KR920011534 A KR 920011534A KR 940001554 A KR940001554 A KR 940001554A
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최장진
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정용문
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    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L27/00Modulated-carrier systems
    • H04L27/18Phase-modulated carrier systems, i.e. using phase-shift keying
    • H04L27/20Modulator circuits; Transmitter circuits
    • H04L27/2003Modulator circuits; Transmitter circuits for continuous phase modulation
    • H04L27/2007Modulator circuits; Transmitter circuits for continuous phase modulation in which the phase change within each symbol period is constrained
    • H04L27/2017Modulator circuits; Transmitter circuits for continuous phase modulation in which the phase change within each symbol period is constrained in which the phase changes are non-linear, e.g. generalized and Gaussian minimum shift keying, tamed frequency modulation

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  • Engineering & Computer Science (AREA)
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Abstract

GMSK변조회로에서 아나로그 소자를 사용하여 아나로그 신호처리에 의해 GMSK변조를 할시 아나로그 여파기 회로로는 가우시안 여파기를 정확히 구현할 수 없음에 따른 오차로 인하여 데이타 전송의 비트 에러율이 높아지며 아나로그 소자를 사용함으로써 소자값의 오차, 경년 열화, 온도 변화로 인하여 특성을 저하되는 것을 개선한다.
이를 위하여 입력되는 데이타를 유한 임펄스 응답으로 디지탈 가우시안 여파하고 여파된 데이타와 미리 설정된 중심주파수 데이타를 가산한다.
상기 가산된 위상데이타 값에 따라 제어되는 주파수의 변조 데이타를 발생한후 발생된 변조 데이타를 아나로그 신호를 변환하여 변조신호로서 출력한다.
따라서 아나로그 소자를 사용하지 않으므로 단일 IC화가 가능하며 정확한 변조신호를 얻을 수 있고 부품의 수가 적어지며 생산 공정을 간단하게 할 수 있게 된다.

Description

디지탈 GMSK 변조회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제 2 도는 본 발명에 따른 디지탈 GMSK 변조회로의 블럭구성도.
제 3 도는 본 발명에 따른 제 2 도의 가우시안 여파기(10)의 상세 블럭구성도.
제 4 도는 본 발명에 따른 제 2 도의 NCO(30)의 상세 블럭구성도.

Claims (6)

  1. 디지탈 GMSK 변조회로에 있어서, 직렬로 입력되는 데이타를 유한 임펄스 응답으로서 디지탈 가우시안 여파기수단과, 상기 여파된 데이타와 미리 설정된 중심주파수 데이타를 가산하여 위상데이타로서 출력하는 가산수단과, 상기 위상데이타값에 따라 제어되는 주파수의 변조데이타를 발생하는 수치제어 발신수단과, 상기 발생된 변조 데이타를 아나로그신호로 변환하는 디지탈/아나로그 변환수단으로서 구성하는 것을 특징으로 하는 디지탈 GMSK 변조회로.
  2. 제 1 항에 있어서, 상기 가우시안 여파기수단이 상기 직렬로 입력되는 데이타를 데이타동기 클럭신호에 동기하여 미리 설정된 비트수만큼 쉬프트시켜 병렬데이타를 출력하는 쉬프트수단과, 적어도 상기 데이타동기 클럭신호보다 높은 주파수를 가지는 샘플링 클럭신호를 미리 설정된 단계로 분주하여 분주된 각 단계의 데이타값을 병렬로 출력하는 분주수단과, 가우시안 여파의 특성에 따른 다수의 여파데이타를 저장하고 있으며 상기 쉬프트수단의 병렬데이타를 상위 어드레스로 입력하고 상기 분주수단의 병렬데이타를 하위 어드레스로 입력하여 어드레스에 대응하는 여파데이타를 출력하는 메모리수단으로 구성하는 것을 특징으로 하는 디지탈 GMSK 변조회로.
  3. 제 1 항에 있어서, 상기 수치제어 발신수단이 상기 가산수단의 위상데이타를 계속하여 적분하는 적분수단과, 정현함수값에 따른 다수의 정현파데이타를 저장하고 있으며 상기 적분된 데이타를 어드레스로 입력하여 어드레스에 대응하는 정현파데이타를 변조데이타로서 출력하는 정현파데이타 발생수단으로 구성하는 것을 특징으로 하는 디지탈 GMSK 변조회로.
  4. 디지탈 GMSK 변조회로에 있어서, 입력되는 데이타를 데이타동기 클럭신호에 동기하여 미리 설정된 비트수만큼 쉬프트시켜 병렬데이타를 출력하는 쉬프트수단과, 적어도 상기 데이타동기 클럭신호보다 높은 주파수를 가지는 샘플링 클럭신호를 미리 설정된 단계로 분주하여 분주된 각 단계의 데이타값을 병렬로 출력하는 분주수단과, 가우시안 여파의 특성에 따른 다수의 여파데이타를 저장하고 있으며 상기 쉬프트수단의 병렬데이타를 상위 어드레스로 입력하고 상기 분주수단의 병렬데이타를 하위 어드레스로 입력하여 입력 어드레스에 대응하는 여파데이타를 출력하는 메모리수단과, 상기 여파데이타와 미리 설정된 중심주파수 데이타를 가산하여 위상데이타로서 출력하는 가산수단과, 상기 가산수단의 위상데이타를 계속하여 적분하는 적분수단과, 정현함수값에 따른 다수의 정현파데이타를 저장하고 있으며 상기 적분된 데이타를 어드레스로 입력하여 입력 어드레스에 대응하는 정현파데이타를 변조데이타로서 출력하는 정현파데이타 발생수단과, 상기 발생된 변조데이타를 아나로그신호로 변환하는 디지탈/아나로그 변환수단으로 구성하는 것을 특징으로 하는 디지탈 GMSK 변조회로.
  5. 디지탈 GMSK 변조회로에 있어서, 직렬로 입력되는 데이타를 유한 임펄스 응답으로서 디지탈 가우시안 여파하는 가우시안 여파기수단과, 상기 가우시안 여파된 데이타를 계속하여 적분하는 적분수단과, 중심 주파수값을 포함하는 정현함수값에 따른 다수의 정현파데이타를 저장하고 있으며 상기 적분된 데이타를 어드레스로 입력하여 입력 어드레스에 대응하는 정현파데이타를 변조데이타로서 출력하는 정현파데이타 발생수단과, 상기 발생된 변조데이타를 아나로그신호로 변환하는 디지탈/아나로그 변환수단으로 구성하는 것을 특징으로 하는 디지탈 GMSK 변조회로.
  6. 제 5 항에 있어서, 상기 가우시안 여파기수단이 상기 직렬로 입력되는 데이타를 데이타동기 클럭신호에 동기하여 미리 설정된 비트수만큼 쉬프트시켜 병렬데이타를 출력하는 쉬프트수단과, 적어도 상기 데이타동기 클럭신호보다 높은 주파수를 가지는 샘플링 클럭신호를 미리 설정된 단계로 분주하여 분주된 각 단계의 데이타값을 병렬로 출력하는 분주수단과, 가우시안 여파의 특성에 따른 다수의 여파데이타를 저장하고 있으며 상기 쉬프트수단의 병렬데이타를 상위 어드레스로 입력하고 상기 분주수단의 병렬데이타를 하위 어드레스로 입력하여 어드레스에 대응하는 여파데이타를 출력하는 메모리수단으로 구성하는 것을 특징으로 하는 디지탈 GMSK 변조회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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