KR920002861B1 - Lpc 음성합성장치 및 그 방법 - Google Patents
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Abstract
내용 없음.
Description
제1도는 본 발명에 따른 LPC 음성합성장치의 회로도
제2도는 및 제3도는 본 발명에 따른 제1도의 동작 흐름도.
*도면의 주요부분에 대한 부호의 설명
10 : 컴퓨터 20 : DSP
30 : 버퍼 40 : 디코더
50 : 인터럽트발생부 60 : 제1 제어신호발생부
70 : 제2제어신호발생부 80 : 데이터 변환부
90 : 음성신호 출력부
본 발명은 음성압성장치 및 그 방법에 관한 것으로, 특히 LPC(Linear Predictive Coding)음성합성장치 및 그 방법에 관한 것이다.
통상적으로 음성합성장치(speech Sysnthesis System)라함은 사람이 의미있는 말로 들을 수 있는 음향적인 파형을 직접 사람이 발생하거나 또는 단순한 녹음 재생에 의하지 않고 하드웨어 또는 소프트웨어로 인공적으로 음성을 발생시키는 것을 칭하고 있다.
이러한 합성장치를 제어하는 방식에서 선형 예측 분석(Linear Predictive Coding)등의 기술을 이용하여 음성 파형으로부터 특징 파라메터(Parameter)를 컴퓨터(Computer)로 추출하고, 이 파라메터로 합성장치를 제어하는 분석 합성과, 규칙에 따라 만들어 낸 파리메터를 사용하는 규칙에 의한 합성등이 있다.
음성파형을 단어나 문장의 단위로 축적하여 놓고 이들의 조합으로 재생함으로써 합성음성을 얻는 녹음 편집방식에서는 선형 예측분석(LPC)등의 기술을 이용하여 음성파형을 파라메터로 변환한 다음 이 파라메터를 축적하여 놓는 파라메터 편집합성 방식에 따라 음성의 정보압축이 이루어진다.
상기와 같이 LPC방식을 사용하는 종래의 음성합성장치는 합성 필터의 파라메터(Parameter)를 피치 피리어드(Pitch Period), 게인(Gain), 예측계수, 유무성음 판별 프레그등으로 구성하여 왔다. 그러나 상기의 피치 피리어드, 게인, 유무성음 판별 플레그 등으로 LPC 음성합성장치를 구성하는 방법은 합성의 음질이 만족스럽지 못한 문제가 있었다.
그 이유로는 아나로그 음성신호에서 피치 피리어드의 추출이나 게인추출이 매우 어렵고 유무성음의 판별이 아직까지는 정확하게 구현되지 않았기 때문이다.
상기 LPC방법 이외에도 ADPCM(Adaptive Differential PCM)방식의 음성합성장치가 있다 상기와 같은 ADPCM 아날로그 음성신호 전체를 코딩(Coding)하여 양질의 음성합성신호를 얻을 수 있으나 많은 메모리용량이 필요로 하는 문제가 있어왔다.
따라서 본 발명의 목적은 음성신호의 에너지(Energy)분포를 나타내는 레지뉴신호(Residue Signal)에서 절대값이 가장 큰것만을 데이터화한 것을 음성합성하는 음성합성장치 및 그 방법을 제공함에 있다.
이하 본 발명을 첨부한 도면을 참조하여 상세히 설명한다.
제1도는 본 발명에 따른 음성합성장치의 회로도로서, 소정의 인터럽트가 입력시에 음성합성에 필요한 파라메터 데이터와 소정 어드레스 및 제어신호를 출력하는 컴퓨터(10)와, 내장된 소정 프로그램에 의해 입출력되는 제어신호를 분석하고 그 결과에 따라 파라메터 데이터를 입력하여 합성용 데이터를 생성출력하거나 파라메터를 입력하기 위한 제어신호를 발생하는 디지털 신호처리부(Digital Signal Processor : 이하 DSP라 함)(20)와, 상기 컴퓨터(10)로부터의 음성합성 파라메터 데이터를 소정 제어신호에 의해 상기 DSP(20)의 데어터 단자로 버퍼링하는 버퍼(30)와, 상기 컴퓨터(10)의 데이터 스트로브(Data Strabe : DS)에 의해 액티브되어지며, 액티브시 상기 컴퓨터(10)의 하위 3비트 어드레스를 디코딩하여 상기 버퍼(30)을 인에이블함과 동시에 상기 DSP(20)의 라이트 가능신호를 발생하는 디코더(40)와, 저항(R), 캐패시터(C), 모노스테이블(31)로 구성되어 상기 DSP(20)가 파라메터를 입력하기 위한 제어신호 발생시 인터럽트 신호를 발생하여 상기 컴퓨터(10)에 입력시키는 인터럽트 발생부(50)와, 저항(R1)(R2), 캐패시터(C1)(C2), 듀얼 모노스테이블(61)로 구성되어 소정주기의 샘플링 클럭(VOCLK)에 제1트리거되어 일정주기를 가지는 인터럽트신호를 발생하여 상기 DSP(20)로 제공하고 상기 어드레스 디코더(40)의 라이트 가능신호에 의해 제2트리거되어 상기 버퍼(30)의 출력을 내부 메모리 영역에 세이브할 수 있는 라이트 제어신호를 상기 DSP(20)에 공급하는 제1제어신호 발생부(60)와, 저항(R3)(R4), 캐패시터(C3)(C4), 듀얼 모노스테이블(71)로 구성되며, 상기 DSP(20)의 데이터 리궤스트(DRQ)에 의해 트리거되어 상기 DSP(20)에 데이터 응답신호(DACK) 및 리이드신호(
)을 제공하는 제2제어신호발생부(70)와, 상기 DSP(20)의 리이드신호 제어신호에 의해 출력하는 음성합성데이터를 상기 리이드신호(RD)의 반전신호에 의해 래치하여 출력하는 래치(81)와, 상기 래치(81)의 출력 데이터를 D/A변환 출력하는 데이터 변환부(80)와, 저항(R6), 연산증폭기(91), 캐패시터(C6)(C7), 필터(92), 스피커(93)으로 구성되어 상기 D/A 변환부(80)의 출력을 소정 증폭하고 스므싱필터링하여 음성신호를 가청음으로 출력하는 음성신호 출력부(90)로 구성된다.
상기 구성중 DSP는 일본국 NEC사의 7720DSP이다. 그리고 상기 제1도의 구성중 컴퓨터(10)내에는 음성합성을 하고저하는 음성이 A/D 변환기(도시하지 않았음)를 통해 디지털 변환된 디지털 음성데이터가 저장되어 있으며, 상기 디지털 음성데이터는 음성합성하고저하는 음성전체에 대한 데이터이다.
상기 컴퓨터(10)는 상기 저장된 디지털 음성 데이터에서 LPC기법을 이용하여 음성에너지 분포를 분석하여 가장 특정적인 파라메터 즉 절대값이 가장 큰 파라메터를 추출한다. 이때 파라메터의 추출은 컴퓨터(10)내에 있는 파라메터 추출 프로그램에 의해 이루어진다.
상기와 간이 추출된 최종의 파라메터는 음성에너지가 가장 큰 순간과 그 크기를 나타내는 것을 시간축(X)과 크기축(Y)으로 나타낼 수 있는 위치와 크기만을 갖는 펄스값으로 나타낸다.
본 발명에 따른 컴퓨터(10)는 인터럽트가 발생시 마다 상기와 같이 추출된 특정 파라메터 데이터를 출력한다.
제2도는 본 발명의 다른 음성합성 방법의 메인 흐름도로서, 추기 음성합성 파라메터를 입력하고 하나의 데이터를 합성하는 제1단계와, 상기 제1단계 수행 완료후 인터럽트 신호를 검출하며, 인터럽트신호 검출시 인터럽트에 대한 서어브스를 실행하고 하나의 프레임을 모두 합성하였는지를 검색하는 제2단계와, 상기 제2단계에서 하나의 프레임을 모두 합성하였을다고 판단시 프레임을 증가시키고 하나의 프레임을 합성치 못하였을 때 상기 제2단계를 반복수행하는 제3단계와, 상기 제3단계에서 프레임을 증가시에 모든 프레임의 합성이 끝났는지를 검색하여 미종료시 하나의 데이터를 합성하여 상기 제2단계를 반복수행하고 종료시에 모든 행위를 종료하는 제4단계로 이루어진다.
제3도는 제2도 제2단계의 인터럽트 서어비스 루틴의 상세흐름도로서, 인터럽트시에 합성된 데이터를 출력하고 입력되는 파라메터 데이터로 데이터를 합성하는 제1단계와, 차기 프레임에 대한 파라메터 데이터를 수신할 준비가 되었는가를 검색하여 미준비시에 다음 프레임의 파라메티 수신 준비상태로 하여 리턴하는 제2단계와, 상기 제2단계에서 차기 프레임에 대한 데이터 수신준비가 되었다고 판단시 차기 프레임에 대한 피라메터 데이터 입력이 종료하였는가를 검색하여 미종료시에 1바이트의 파라메터 데이터를 입력하고 리턴하는 제3단계와, 제3단계 수행후 중복 데이터의 합성여부를 검색하여 합성시 바로 리턴하는 아날시에 중복 데이터에 대한 1개의 샘플을 합성하여 내부 메모리에 저장하고 리턴하는 제4과정으로 이루어진다.
우선 상기 제1도의 동작을 제2도와 제3도를 참조하여 설명하기에 앞서 컴퓨터(10)으로부터 출력 되는 데이터의 상태를 살펴본다.
샘플링 되어질 음성신호는 3.4KHZ(가청신호대역)의 로우 패스필터로 필터링 되어진후 8KHZ의 클럭으로서 샘플링되어진다. 상기 8KHZ의 신호로 샘플링되어진 샘플 음성신호는 8비트 아나로그 디지털 변환기에서 디지털 데이터로 변환된다. 또 8KHZ로 샘플된 음성신호 240샘플 약 30msec를 하나의 프레임으로 정의하였고 200샘플(Sample)씩 이동하면서 차기의 프레임을 설명하였다. 이때 상기의 이동에 의해 40샘플씩 겹치는 것은 프레임사이의 경계값을 보완하기 위함이다. 상기 프레임은 반사계수 10바이트, 파라메터인 펄스위치 12바이트, 파라메터인 펄스크기 12바이트 총 34바이트로 되어 있다.
상기 컴퓨터(10)는 인터럽트 리궤스트단(
)로 인터럽트 요구신호가 입력시마다 1바이트의 전술한 바와같이 추출된 위치와 크기의 펄스 퍼러메터 데이터를 출력하게 된다.
지금 상기 제1도의 회로에 전원전압이 공급되면, DSP(20)는 단자(P1)으로 (2a)과정에서 ＂하이＂상태의 제어신호를 출력하여 컴퓨터(10)로부터 합성에 필요로하는 파라메터 데이터를 입력한다.
상기와 같이 DSP(20)의 단자(P1)포트에서 ＂하이＂상태의 제어신호가 출력되면 모노스테이블(31)이 트리거되어 외부저항(R)과 캐패시터(C)의 시정수에 의한 ＂로우＂펄스가 상기 모노스테이블(3)의 단자(
)로부터 출력되어 컴퓨터(10)의 인터럽트 리궤스트단(
)로 입력된다.
이때 인터럽트 요구를 받은 컴퓨터(10)는 인터럽트 서어비스에 의해 전술한 바와 같이 추출한 샘플음성의 파라메터 데이터(데이터는 펄스열로 표시될 수 있음) 위치와 크기를 갖는 펄스를 버퍼(30)로 출력함과 동시에 데이터 스트로브(
)와 하위 3비트 어드레스 (A0-A2)를 ＂L,L,L＂로 하여 출력한다.
상기 컴퓨터(10)로부터 출력되는 어드레스(A0-A2)는 디코더(40)에서 디코딩되어 출력단자(Y0)에서 ＂로우＂신호가 출력된다.
따라서 상기 디코더(40)의 출력단자(Yo)로부터 ＂로우＂로 출력되는 신호를 인에이블단자(
)로 입력하는 버퍼(30)가 인에이블되어 컴퓨터(10)로부터 출력되는 파라메터 데이터를 DSP(20)의 데이터단자(D0-D7)에 입력시키게 되며, 제1제어신호발생부(60)의 듀얼 모노스테이블(61)중 상기 디코더(30)의 출력단자(Yo)의 신호를 트리거단자(2A)로 입력하는 제2모노스테이블이 트리거되어진다.
그러므로 상기 듀얼 모노스테이블(61)중의 제2모노스테이블의 출력단자(
)에서는 외부저항(R2)와 패캐시터(C2)에 의한 시정수 동안 액티브 ＂로우＂의 신호가 DSP(20)의 라이트(Write)단자(
)로 출력된다.
따라서 상기 DSP(20)는 제2도(2a)과정을 수행함으로서 버퍼(30)를 통해 컴퓨터(10)로부터의 파라메터 데이터를 읽어들이어 내부 메모리에 저장하게 한다. 이후 상기 DSP(20)는 (2b)과정에서 읽어 내부 메모리에 저장한 파라메터 데이터를 이용하여 내부 소프트웨어의 합성 필터에서 한 개의 샘플을 합성시키고 이를 메모리 영역에 세이브한다.
상기 (2b)과정을 수행한 DSP(20)는 (2c)과정에서 인터럽트단자(INT)로 인터럽트 신호가 입력되는가를 검색한다. 상기 DSP(20)의 인터럽트단자(INT)로 입력되는 인터럽트 신호는 듀얼 모노스테이블(61)의 제1모노스테이블의 출력단(1Q)로부터 일정주기마다 출력되는 신호이다.
상기 듀얼 모노스테이블(61)의 제1모노스테이블은 트리거(1A)로 입력되는 음성 샘플링 클럭 VOSCLK(8KHZ)에 의해 트리거되며, 상기 음성샘플링 클럭 VOSCLK에 의해 8KHZ마다 트리거 되어 출력단자(1Q)로부터는 저항(1R), 캐패시터(C1)의 시정수 설정에 의한 인터럽트 신호가 주기적으로 발생되게 되어 있다.
이때 상기 음성 샘플링 클럭 VOSCLK의 주기는 125μsec정도이고, 인터럽트 액티브 시간은 약 85μsec정도이며 이는 상기 음성 샘플링 클럭 VOSCLK에 의해 듀얼 모노스테이블(61)내 제1모노스테이블의 출력단자(1Q)에서 주기적으로 발생된다.
따라서 상기 동작에 의해 인터럽트가 발생되며, DSP(20)는 상기 (2c)과정에서 인터럽트가 발생하였다고 판단하고 (2d)과정에서 인터럽트 루틴으로 점프하여 인터럽트 서어비스를 수행한다.
상기 제2d과정에서 수행되는 인터럽트 서어비스 루틴은 제3도와 같다.
인터럽트가 발생되면, DSP(20)는 제3도 (3a)과정에서 데이터 요구신호(DRQ)를 액티브＂하이＂로 출력하여 전술한 제2도 (2b)과정에서 합성한 데이터를 출력한다. 이때 상기의 과정은 하기와 같이 된다.
상기 DSP(20)의 데이터 요구단자(DRQ)에서 ＂하이＂신호가 출력되면 이는 듀얼 모노스테이블(71)내 제1모노스테이블의 제1트리거단자(1B)에 입력됨으로서, 외부 저항(R3), 캐패시터(C3)의 시정수에 의한 액티브 ＂하이＂신호가 제1모노스테이블의 출력단자(1Q)로부터 출력되어 제2트리거단자(2B)에 입력된다.
따라서 듀얼 모노스테이블(71)중 또다른 내장 모노스테이블인 제2모노스테이블 트리거됨으로 외부저항(R4)와 캐패시터(C4)의 시정수에 의한 펄스가 출력단자(
)에서 출력된다.
이때 상기 듀얼 모노스테이블(71)내부에 있는 제1모노스테이블 출력단자(1Q)와 제2모노스테이블의 출력(
)에서 각각 출력되는 주기는(1Q)의 출력이
출력의 1/2주기를 갖는다. 그러므로 DSP(20)에서 데이터 요구신호(DRQ)을 출력하게되면, 상기 제2제어신호 발생부(70)의 모노스테이블(71)동작에 의해서 ＂로우＂의 데이터 응답신호(
)와 리이드신호(
)가 제공된다.
상기 리이드신호(
)는 인버터(74)에 의해 반전되어 래치(81)의 래치 인에이블신호(
)로 제공된다.
상기 듀얼 모노스테이블(71)로부터 데이터 응답(DACK)와 리이드신호(
)을 입력한 DSP(20)는 내부 메모리에 저장된 1바이트의 합성 데이터를 읽어 래치(81)에 입력시킨다.
따라서 래치(81)는 DSP(20)의 출력데이터를 상기 듀얼 모노스테이블(71)의 제2모노스테이블단자(
)로부터 출력되는 래치 인에이블신호(
)로써 래치하고, 이를 아우트 인에이블(Out Enable :
)에 의해 D/A 변환기(82)에 입력시킨다.
상기 DSP(20)에서 합성된 1바이트의 데이터를 래치(81)를 통해 입력한 D/A 변환기(82)는 이를 아나로그신호로 변환하여 연산증폭기(91)에 입력시킨다. 그러므로 상기 D/A 변환기에서 아나로그 변환된 신호는 상기 연산증폭기(91)에서 소정 증폭되고, 결합 캐패시터(C6)를 통해 필터(92)에 입력됨으로서 스므싱필터링되어 스피커(93)로 가청음으로 출력된다.
한편 상기 제3도(3a)과정의 인터럽트 서어비스를 수행한 DSP(20)는 읽어들인 파라메터 데이터를 (3b)과정에서 소프트웨어적 합성필터를 이용하여 샘플을 합성하고 내부 메모리에 저장한다.
이후 DSP(20)는 (3c)과정에서 다음 프레임에 대한 파라메터 데이터를 수신할 준비가 완료되었는지를 검사한다.
상기 (3c)검색과정에서 다음 프레임에 대한 파라메터 데이터를 수신할 준비가 되지않았다면, DSP(20)는 (3d)과정에서 다음 프레임에 대한 파라메터를 수신 준비한 후 메인 루틴으로 리턴하고, 준비완료시에는 다음 프레임에 대한 파라메터 입력이 종료하였는지 (3e)과정에서 검색한다.
상기 (3e)과정에서 다음 프레임의 파라메터 데이터 입력이 완료되었다면, DSP(20)는 (3g)과정에서 중복 데이터 합성여부를 검색하며, 다음 프레임 파라메터가 입력 종료되지 않았다면 (3f)과정에서 다음 프레임에 대한 파라메터 1바이트를 입력하고 리턴한다.
또 상기 (3g)과정에서 중복데이터가 합성이 되지 않았다면 (3h)과정에서 중복 데이터에 대한 1개 샘플을 합성후 내부 메모리에 저장하고 리턴한다.
상기 제3도와 같은 인터럽트 서어비스가 수행되고 나면, DSP(20)는 제2도 (2e)과정에서 하나의 프레임 합성이 종료하였는지를 검색한다.
하나의 프레임 합성이 종료되지 않았을 때에는 전술한 제(2c)과정부터 반복수행하여 하나의 프레임 합성을 완료하게 된다. 하나의 프레임 합성이 완료되었다면 DSP(20)는 (2f)과정에서 프레임을 증가시킨다.
(2f)과정에서 프레임을 증가시킨 DSP(20)는 (2g)과정에서 모든 프레임 합성이 종료하였는가를 검색하며, 모든 프레임의 음성합성이 미종료시 (2h)과정에서 하나의 데이터를 합성하고 전술한 (2c)과정부터 반복수행함으로서 음성합성음이 데이터 변환부(80) 및 음성신호 출력부(90)를 통해 출력하게 된다.
상술한 바와 같이 본 발명은 음성에너지가 가장 큰 위치와 크기만을 갖는 펄스 형태의 새로운 파라메터를 이용하여 LPC방법으로 음성 데이터를 합성함으로 양호한 음질을 재생할 수 있는 음성합성장치를 제공할 수 있는 이점이 있다.
Claims (3)
- 음성합성될 디지털 음성 데이터의 음성 에너지 분포를 분석하여 상기 음성에너지의 절대값이 가장 큰 위치와 크기만을 갖는 펄스 파라메터 데이터를 저장하고 있으며, 소정의 인터럽트가 입력시에 음성합성에 필요한 펄스 파라메터 데이터와 소정 어드레스 및 제어신호를 출력하는 컴퓨터(10)를 구비한 LPC 음성합성 장치에 있어서, 내장된 소정 프로그램에 의해 입출력되는 제어신호를 분석하고 그 결과에 따라 상기 펄스 파라메터 데이터를 입력하여 음성합성 출력함과 동시에 상기 펄스 파라메터를 입력하기 위한 제어신호를 발생하는 디지털 신호처리부(20)와, 상기 컴퓨터(10)로부터의 펄스 파라메터 데이터를 소정 제어신호에 의해 상기 디지털 신호처리부(20)의 데이터 단자로 버퍼링하는 버퍼(30)와, 상기 컴퓨터(10)의 데이터 스토로브에 의해 액티브되어지며 액티브시 상기 컴퓨터(10)로부터 출력되는 어드레스를 디코딩하여 상기 버퍼(30)을 인에이블함과 동시에 상기 디지털 신호처리부(20)의 라이트 가능신호를 발생하는 디코더(40)와, 저항(R), 캐패시터(C), 모노스테이블(31)로 구성되어 상기 디지털 신호처리부(20)가 파라메터를 입력하기 위한 제어신호를 발생시 이에 응답하여 인터럽트 신호를 상기 컴퓨터(10)에 입력시키는 인터럽트 발생부(50)와, 저항(R1),(R2), 캐패시터(C1),(C2), 듀얼 모노스테이블(61)로 구성되어 소정주기의 샘플링 클럭에 제1트리거되어 일정주기를 가지는 인터럽트신호를 발생하여 상기 디지털 신호처리부(20)로 제공하고, 상기 어드레스 디디코더(40)의 라이트 가능신호에 의해 제2트리거되어 상기 버퍼(30)의 출력을 내부 메모리 영역에 세이브할 수 있는 라이트 제어신호를 상기 디지털 신호처리부(20)에 공급하는 제1제어신호 발생부(60)와, 저항(R3),(R4), 캐패시터(C3),(C4), 듀얼 모노스테이블(71)로 구성되며, 상기 디지털 신호처리부(20)의 데이터 요구신호(DRQ)에 의해 트리거되어 상기 디지털 신호처리부(20)에 데이터 응답신호 및 리이드신호를 제공하는 제2제어신호발생부(70)와, 상기 제2제어신호발생부(70)의 리이드신호에 응답하여 상기 디지털 신호처리부(20)로부터 출력되는 음성합성데이터를 상기 리이드신호의 반전신호에 의해 래치하고, 상기 래치된 음성합성데이터를 아나로그신호로 변환 출력하는 데이터 변환부(80)와, 저항(R6), 연산증폭기(91), 캐패시터(C6),(C7), 필터(92), 스피커(93)으로 구성되어 상기 데이터변환부(80)의 출력을 소정 증폭하고 스므싱필터링하여 음성신호를 가청음으로 출력하는 음성신호 출력부(90)로 구성됨을 특징으로 하는 LPC 음성합성장치.
- 음성합성될 디지털 음성 데이터의 음성 에너지 분포를 분석하여 상기 음성에너지의 절대값이 가장 큰위치와 크기만을 갖는 펄스 파라메터 데이터를 저장하고 있으며, 소정의 인터럽트가 입력시에 음성합성에 필요한 펄스 파라메터 데이터와 소정 어드레스 및 제어신호를 출력하는 컴퓨터(10)와, 내장된 소정 프로그램에 의해 입출력되는 제어신호를 분석하고 그 결과에 따라 상기 펄스 파라메터 데이터를 입력하여 음성합성 출력함과 동시에 상기 펄스 파라메터를 입력하기 위한 제어신호를 발생하는 디지털 신호처리부(20)를 구비한 LPC 음성합성방법에 있어서, 초기 음성합성 펄스 파라메터를 입력하고 하나의 데이터를 합성하는 제1단계와, 상기 1단계수행 완료후 인터럽트 신호를 검출하며, 인터럽트신호 검출시 인터럽트에 대한 서어비스 실행하고, 하나의 프레임을 모두 합성하였는지를 검색하는 제2단계와, 상기 제2단계에서 하나의 프레임을 모두 합성하였다고 판단시 프레임을 증가시키고, 하나의 프레임을 합성치 못하였다고 판단시 상기 제2단계를 반복수행하는 제3단계와, 상기 제3단계에서 프레임을 증가시에 모든 프레임의 합성이 끝났는지를 검색하여 미종료시 하나의 데이터를 합성하여 상기 제2단계를 반복수행하고 종료시에 모든 행위를 종료하는 제4단계로 이루어짐을 특징으로 하는 방법.
- 제2항에 있어서, 제2단계의 인터럽트 루틴은 인터럽트 발생시에 합성된 데이터를 출력하고 입력되는 파라메터 데이터로 데이터를 합성하는 제1단계와, 차기 프레임에 대한 파라메터 데이터를 수신할 준비가 되었는가를 검색하여 미준비시에 다음 프레임의 파라메터 수신 준비상태로 하여 리턴하는 제2단계와, 상기 제2단계에서 차기 프레임에 대한 데이터 수신준비가 되었다고 판단시 차기 프레임에 대한 파라메터 데이터 입력이 종료하였는가를 검색하여 미종료시에 1바이트의 펄스 파라메터 데이터를 입력하고 리턴하는 제3단계와, 제3단계 수행후 중복 데이터의 합성여부를 검색하는 합성시 바로 리턴하는 아닐시에 중복 데이터에 대한 1개의 샘플을 합성하여 내부 메모리에 저장하고 리턴하는 제4과정으로 이루어짐을 특징으로 하는 방법.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019880013228A KR920002861B1 (ko) | 1988-10-11 | 1988-10-11 | Lpc 음성합성장치 및 그 방법 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019880013228A KR920002861B1 (ko) | 1988-10-11 | 1988-10-11 | Lpc 음성합성장치 및 그 방법 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| KR900006911A KR900006911A (ko) | 1990-05-09 |
| KR920002861B1 true KR920002861B1 (ko) | 1992-04-06 |
Family
ID=19278388
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| KR1019880013228A KR920002861B1 (ko) | 1988-10-11 | 1988-10-11 | Lpc 음성합성장치 및 그 방법 |
Country Status (1)
| Country | Link |
|---|---|
| KR (1) | KR920002861B1 (ko) |
-
1988
- 1988-10-11 KR KR1019880013228A patent/KR920002861B1/ko not_active IP Right Cessation
Also Published As
| Publication number | Publication date |
|---|---|
| KR900006911A (ko) | 1990-05-09 |
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