KR910005128A - 중앙처리장치의 오동작 방지회로 및 방법 - Google Patents
중앙처리장치의 오동작 방지회로 및 방법 Download PDFInfo
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명에 따른 회로도.
제3도는 본 발명에 따른 동작 파형도.
Claims (2)
- 중앙처리장치의 오동작 방지회로에 있어서, 국선, 시스템, 밧데리, 혹은 AC/DC어뎁터 기능을 포함하고 있으면서 일정 전압을 출력하여 MPU(13)로 공급하는 전원회로(21)와, 상기 전원회로(21)의 출력전압을 검출하는 전압감지회로(22)와, 상기 전압감지회로(22)의 출력을 받아 상기 CPU(13)의 리세트 신호를 발생하는 리세트회로(23)로 구성됨을 특징으로 하는 회로.
- 중앙처리장치의 오동작 방지 방법에 있어서, 저전압의 상태를 검출하는 제1과정과, 상기 제1과정의 저전압 검출시 정지모드로 설정하는 제2과정과, 상기 제2과정의 정지모드 실행후 리세트신호의 입력을 체크하는 제3과정과, 상기 제1과정에서 저전압이 감지 되지 않았거나 상기 제3과정에서 리세트신호 입력시 동작 모드로 지정하는 제4과정으로 이루어짐을 특징으로 하는 방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019890011780A KR910005128A (ko) | 1989-08-18 | 1989-08-18 | 중앙처리장치의 오동작 방지회로 및 방법 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019890011780A KR910005128A (ko) | 1989-08-18 | 1989-08-18 | 중앙처리장치의 오동작 방지회로 및 방법 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| KR910005128A true KR910005128A (ko) | 1991-03-30 |
Family
ID=68084253
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| KR1019890011780A KR910005128A (ko) | 1989-08-18 | 1989-08-18 | 중앙처리장치의 오동작 방지회로 및 방법 |
Country Status (1)
| Country | Link |
|---|---|
| KR (1) | KR910005128A (ko) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR19990068816A (ko) * | 1999-06-24 | 1999-09-06 | 서인원 | 씨피유의리세트방법 |
-
1989
- 1989-08-18 KR KR1019890011780A patent/KR910005128A/ko not_active Application Discontinuation
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR19990068816A (ko) * | 1999-06-24 | 1999-09-06 | 서인원 | 씨피유의리세트방법 |
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