KR900003644Y1 - Automatic control apparatus for discharge lamps - Google Patents

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Abstract

내용 없음.No content.

Description

테레비젼의 수평 발진회로TV's horizontal oscillation circuit

제1도는 종래의 수평 발진회로를 나타낸 블록도.1 is a block diagram showing a conventional horizontal oscillation circuit.

제2도는 본 고안의 실시 회로도.2 is an implementation circuit diagram of the present invention.

제3a, b도는 본 고안의 동작을 설명하기 위한 전압 파형도.3a and b are voltage waveform diagrams for explaining the operation of the present invention.

* 도면의 주요부분에 대한 부호의 설명* Explanation of symbols for main parts of the drawings

31, 37 : 제 1 및 제 2 시정수회로부 32, 36 : 제 1 및 제 2 차동 증폭부31, 37: first and second time constant circuit section 32, 36: first and second differential amplifier section

33, 39 : 제 1 및 제 2 스위칭부 34, 38 : 제 1 및 제 2 파형정형부33, 39: first and second switching unit 34, 38: first and second waveform shaping unit

35 : 전압변환부 C1, C2:콘덴서35: voltage converter C 1 , C 2 : capacitor

R1-R12: 저항 Q1-Q13: 트랜지스터R 1 -R 12 : Resistor Q 1 -Q 13 : Transistor

본 고안은 테레비젼의 수평 발진회로에 있어서, 특히 이상발진현상을 방지할 수 있도록한 회로에 대한 것이다.The present invention relates to a circuit that can prevent abnormal oscillation phenomenon in the horizontal oscillation circuit of TV.

테레비젼 수상기에서는 수신 방송신호에 걸린 영상을 수상관에 걸상시키기 위하여 수상기내부의 소정의 발진회로의 주파수를 제어하여 상기의 방송신호에 대한 동기를 얻고 있다.In a television receiver, the frequency of a predetermined oscillator circuit in the receiver is controlled to obtain an image caught on a received broadcast signal on the receiving tube, thereby obtaining synchronization with the broadcast signal.

즉 수평발진회로나 수직발진회로 수신되는 방송신호에 대하여 동기를 갖을 필요가 있는 회로로서, 자동주파수제어(AFC:Automatic Frequency Control)회로를 이용하여 수신방송에 동기시키고 있다.That is, a circuit which needs to be synchronized with a broadcast signal received in a horizontal oscillation circuit or a vertical oscillation circuit, is synchronized with the reception broadcast using an automatic frequency control (AFC) circuit.

제1도는 이와 같은 AFC회로에 의해 동기를 얻는 방식인, 종래의 수평발진회로의 블록도로서, 동기 회로(1)에서는 입력된 복합영상신호에서 동기신호(S1)를 분리하여 위상검파 및 제어회로인 AFC 회로(2)로 공급한다. 이 AFC회로에서는 동기분리회로(1)로부터 입력된 동기신호(S1)와 플라이백트랜스(5)로부터 공급되는 플라이백펄스(S2)를 적분하여 얻은 톱니파신호를 위상검파함으로써, 이 위상검파전압을 수평발진회로(3)로 공급하여 수평발진회로(3)의 발진주파수를 제어하게되며, 이렇게 수평발진회로(3)에서 발진된 출력신호는 수평발진회로(4)에 공급되어 플라이백트랜스(5)의 1차측권선(L1)을 구동시키게된다.FIG. 1 is a block diagram of a conventional horizontal oscillation circuit that obtains synchronization by such an AFC circuit. In the synchronization circuit 1, phase detection and control are performed by separating the synchronization signal S 1 from an input composite video signal. It supplies to the AFC circuit 2 which is a circuit. In this AFC circuit, phase detection is performed by phase-detecting a sawtooth signal obtained by integrating the synchronization signal S 1 input from the synchronization separation circuit 1 and the flyback pulse S 2 supplied from the flyback transformer 5. The oscillation frequency of the horizontal oscillation circuit 3 is controlled by supplying a voltage to the horizontal oscillation circuit 3, and the output signal oscillated in the horizontal oscillation circuit 3 is supplied to the horizontal oscillation circuit 4, thereby providing a flyback transformer. The primary winding L 1 of (5) is driven.

이때 이 플라이백펄스(5)의 2차권선(L2)은 자동비임조정(ABL)회로와 고압다이오드(DHV)에 연결되며, 그 3차권선(L3)에서 전술한 플라이백펄스(S2)를 얻도록 되어있다.At this time, the secondary winding L 2 of the flyback pulse 5 is connected to the automatic beam adjustment (ABL) circuit and the high voltage diode (D HV ), and the flyback pulse ( 3 ) described above in the tertiary winding (L 3 ). S 2 ) is obtained.

따라서 이와 같은 수평발진회로(3)는 AFC전압에 의해 그 발진주파수가 제어됨으로써 수신방송신호에 동기된 발진주파수를 출력하게 되는데, 만약수신방송신호가 없는 경우에는 수평발진 회로(3)는 이 회로의 정수로 결정되는 주파수에 의해 자력발진하게 된다.Accordingly, the horizontal oscillation circuit 3 outputs an oscillation frequency synchronized with the reception broadcast signal by controlling the oscillation frequency by the AFC voltage. If there is no reception broadcast signal, the horizontal oscillation circuit 3 performs this circuit. The oscillation is caused by the frequency determined by the integer of.

그러나 이 경우, 고압회로나 수평출력회로(4)등에서는 이 자력발진 주파수에 동기된 스위칭 스플리어스(switching splius)(즉, 플라이백 트랜스(5)에 연결된 고압다이오드(DHV)나 댐핑 다이오등의 스위칭동작시 발생됨)가 누설되기 쉽고, 이에 의해 이 스위칭플리어스가 안테나나 중간주파증폭회로의 전단에 날아들어와 상동기신호로서 발생된 후 동기분리회로(1)에서 동기신호로서 분리되는 것으로서, 결국 상기의 스위칭 스플리어스가 안테나나 중간주파증폭회로의 전단에 날아들면 동기신호에 근사한 주파수가 발생하게 되고, 더더욱이 스위칭 스플리어스에 의한 동기 주파수가 중간주파증폭회로의 입렵부에 설계되어 있는 필터(saw filter)등을 통과하면서 위상지연이 발생하여 위상의 의사동기신호로서 검파분리된다.However, in this case, in the high voltage circuit or the horizontal output circuit 4, for example, a switching splius (i.e., a high voltage diode (D HV ) or a damping diode connected to the flyback transformer 5) synchronized with the magnetic oscillation frequency Is generated during the switching operation, etc.), whereby the switching pliers fly into the front end of the antenna or the intermediate frequency amplification circuit and are generated as homologous signals and then separated as a synchronous signal in the synchronous separation circuit (1). As a result, when the switching splits fly to the front end of the antenna or the intermediate frequency amplifier circuit, a frequency close to the synchronization signal is generated. Furthermore, the synchronization frequency due to the switching split is designed to be placed at the entrance of the intermediate frequency amplifier circuit. Phase delay occurs while passing through a saw filter, etc., and is detected and separated as a pseudo synchronous signal of phase.

따라서 이 지상의사동기 신호가 AFC회로(2)에 입력되면 수평발진회로(3)의 발진주파수를 보다 낮은쪽으로 되도록 제어하게 됨으로써, 수평발진회로(3)의 발진주파수는 순식간에 극단적인 저주파수로 이동하여 플라이백트랜스(5)등에서 이상전압이 발생하거나 또는 고압보호회로에 오동작이 발생하는 폐단이 있었다.Therefore, when the ground motor signal is input to the AFC circuit 2, the oscillation frequency of the horizontal oscillation circuit 3 is controlled to be lower, so that the oscillation frequency of the horizontal oscillation circuit 3 moves to an extremely low frequency in an instant. As a result, an abnormal voltage is generated in the flyback transformer 5, or a malfunction occurs in the high voltage protection circuit.

본 고안의 목적은 이와 같은 수평발진회로의 이상발진현상을 해결하기 위하여 소정의 발진주파수를 갖는 제1발진회로에 이 제1발진회로의 발진주파수보다 일정 레벨이 낮은 발진주파수를 갖는 제2발진회로를 설치하여 정상시에는 제1발진회로에 의해 발진이 이루어지고 이상(異常)발진시에는 제1발진회로의 발진주파수가 제2발진회로의 발진주파수보다 더 낮아지지 않도록 하여, 극단적인 발진주파수의 낮아짐으로 인한 플라이백트랜스의 이상전압발생이나 고압회로부의 오동작을 방지할 수 있도록 안출한 것으로서, 이하 본 고안의 구성 및 작용효과를 첨부도면에 의해 상세히 설명한다.An object of the present invention is to solve the abnormal oscillation phenomenon of the horizontal oscillation circuit, the second oscillation circuit having a predetermined oscillation frequency lower than the oscillation frequency of the first oscillation circuit in the first oscillation circuit having a predetermined oscillation frequency When the oscillation is performed by the first oscillation circuit in normal operation and the oscillation frequency of the first oscillation circuit is not lower than the oscillation frequency of the second oscillation circuit during abnormal oscillation, the extreme oscillation frequency is lowered. It is designed to prevent the abnormal voltage generation or malfunction of the high-voltage circuit portion due to the flyback transformer, the configuration and operation effects of the present invention will be described in detail by the accompanying drawings.

Vcc전압 및 AFC전압이 입력되는 저항(R7)(R8) 및 콘덴서(C1)로 된 제1시정수회로부(31)의 출력단을 트랜지스터(Q1)(Q2) 및 저항(R1)(R2)으로된 제1차동증폭부(32)의 반전입력단에 연결함과 동시에 저항(R3)(R4) 및 트랜지스터(Q7)로 된 제1스위칭부(33)에 연결하고, 이 제1차동증폭부(32)의 출력단을 트랜지스터(Q3)(Q6)로 된 제1파형정형부(34)의 입력단에 연결하며, 이 제1파형정형부(34)의 제1출력단(a)을 통상의 수평출력회로(4)에 연결하고, 그 제2출력단(b)을 상기의 제1스위칭부(33)의 입력단과 저항(R5)(R6) 및 트랜지스터(Q8)로 된 전압변화부(35)의 입력단에 공접시킴과 동시에 저항(R9)을 통해 접지시키며, 이 전압변환부(35)의 출력단을 상기의 제1차동증폭부(32)의 비반전입력단에 연결하여 제1발진회로를 구성하고, 상기의 제1차동 증폭부(32)에 그 에미터가 공접된 트랜지스터(Q12)로 된 제2차동증폭부(36)의 입력단을 저항(R10)(R11) 및 트래지스터(Q13)로 된 제2스위칭부(39)에 연결함과 동시에 상기의 제1시정수회로부(31)보다 큰 시정수를 갖는 저항(R12) 및 콘덴서(C2)로 된 제2시정수회로부(37)의 출력단에 연결하고, 이제2차동증폭부(36)의 출력단을 트랜지스터(Q9-Q11)로 된 제2파형정형부(38)의 입력단에 연결하며, 이제2파형정형부(38)의 출력단과 상기의 제2스위칭부(39)의 입력단을 상기의 제1파형정형부(34)의 제2출력단(b)에 공접시켜 제2발진회로를 구성한 것이다.The output terminals of the first time constant circuit part 31 including the resistors R 7 (R 8 ) and the capacitor C 1 to which the Vcc voltage and the AFC voltage are input are connected to the transistors Q 1 (Q 2 ) and the resistors R 1. ) (R 2), the first connected to the differential amplifier section (the first switching unit (33 a to connect the inverting input terminal, and at the same time the resistance (R 3) (R 4) and a transistor (Q 7) of the 32)) in the The output terminal of the first differential amplifier 32 is connected to the input terminal of the first waveform shaping section 34 of the transistors Q 3 and Q 6 , and the first waveform shaping section 34 is connected to the input terminal of the first waveform shaping section 34. The output terminal (a) is connected to a normal horizontal output circuit (4), and the second output terminal (b) is connected to the input terminal of the first switching unit 33, the resistors R 5 (R 6 ), and the transistor Q. 8 ) is grounded to the input terminal of the voltage changing section 35 and grounded through a resistor R 9 , and the output terminal of the voltage converting section 35 is non-inverted by the first differential amplifier 32. A first oscillation circuit is formed by connecting to an input terminal, and the first differential amplifier 32 Connects the input terminal of the second differential amplifier 36 of the transistor Q 12 to the common gate to the second switching unit 39 of resistor R 10 (R 11 ) and transistor Q 13 . At the same time as the output terminal of the second time constant circuit portion 37 consisting of a resistor R 12 and a capacitor C 2 having a larger time constant than the first time constant circuit portion 31, and The output terminal of 36 is connected to the input terminal of the second waveform shaping section 38 of the transistors Q 9 -Q 11 , and the output terminal of the second waveform shaping section 38 and the second switching section 39 above. A second oscillation circuit is constructed by coupling the input terminal of the terminal to the second output terminal b of the first waveform shaping section 34.

미설명 부호중 I0는 전류원, 2는 AFC 회로이다.In the description, I 0 is a current source and 2 is an AFC circuit.

이와 같이 구성된 본 고안의 회로동작상태는 다음과 같다.The circuit operation state of the present invention configured as described above is as follows.

먼저, 수신방송의 입력이 있는 정상상태의 경우 제1시정수회로(31)내의 콘덴서(C1)는 AFC회로(2)로 부터의 AFC전압이 인가되는 저항(R8) 및 Vcc전압이 인가되는 저항(R7)과의 시정수조합에 의해 서서히 충전되면서 이 충전전압이 제1차동증폭부(32)내의 트랜지스터(Q2)의 베이스에 공급된다.First, in the steady state with the reception broadcast input, the capacitor C 1 in the first time constant circuit 31 is supplied with the resistor R 8 and the Vcc voltage to which the AFC voltage from the AFC circuit 2 is applied. The charging voltage is supplied to the base of the transistor Q 2 in the first differential amplifier 32 while gradually charging by the time constant combination with the resistor R 7 .

이 충전전압이 제1차동증폭부(32)내의 트랜지스터(Q1)의 베이스전압에 도달하면 트랜지스터(Q2)가 도통되고, 이에 의해 제1파형정형부(34)내의 각 트랜지스터(Q3-Q6)가 도통되기 때문에 제1파형정형부(34)의 제1출력단(a) 및 제2출력단(b)로 발진주파수가 출력되는데, 이에 의해 트랜지스터(Q5)의 콜렉터에 연결된 저항(R9)을 통해 전류가 흐르게 되어 이 저항(R9)의 양단에 제어전압이 발생하게 됨으로써 제1 및 제2스위칭부(33)(39)와 전압변화부(35)내의 각 트랜지스터(Q7)(Q13)(Q8)가 모두 도통된다.This charging voltage is the base voltage of the transistor Q 1 in the first differential amplifier 32. When it reaches, the transistor Q 2 is turned on, so that each transistor Q 3 -Q 6 in the first waveform shape section 34 is turned on, so that the first output terminal a of the first waveform shape section 34 is connected. And the oscillation frequency is output to the second output terminal (b), whereby a current flows through the resistor (R 9 ) connected to the collector of the transistor (Q 5 ) to generate a control voltage across the resistor (R 9 ). As a result, the first and second switching units 33 and 39 and the transistors Q 7 and Q 13 and Q 8 in the voltage changing unit 35 are both turned on.

따라서 콘덴서(C1)에 충전된 전하는 제1스위칭부(33)내의 저항(R3) 및 트랜지스터(Q7)를 통해 방전하게 되며, 이와 동시에 전압변환부(35)내의 트랜지스터(Q8)의 도통에 의해 제1차동증폭부(32)내의 저항(R2)에 저항(R6)이 병렬접속됨으로써 트랜지스터(Q1)의 베이스전압이 낮아지게 된다.Thus, the charge charged in the capacitor C 1 is discharged through the resistor R 3 and the transistor Q 7 in the first switching unit 33, and at the same time, the charge of the transistor Q 8 in the voltage conversion unit 35 is discharged. By conduction, the resistor R 6 is connected in parallel to the resistor R 2 in the first differential amplifier 32 so that the base voltage of the transistor Q 1 is lowered.

즉, 이 트랜지스터(Q1)의 베이스전압은 전압의 값으로 결정되고, 이때 콘덴서(C1)가 방전하면서 트랜지스터(Q2)의 베이스전압이 트랜지스터의 베이스전압(VL)에 도달하면 트랜지스터(Q2)가 도통된다.That is, the base voltage of this transistor Q 1 is the voltage It is determined to a value, wherein the capacitor (C 1) when the discharge, while the base voltage of the transistor (Q 2) reaches the base voltage (V L) of the transistor, the transistor (Q 2) is conductive.

이 결과 제1파형정형부(34)내의 트랜지스터(Q3-Q6)는 모두 '오프'되고, 저항(R9)의 양단에는 제어전압이 발생하지 않게 되므로 각 트랜지스터(Q7)(Q13)(Q8)역시 모두 '오프'되어 콘덴서(C1)는 다시 충전을 게시하게 된다.As a result, all of the transistors Q 3 -Q 6 in the first waveform shaping section 34 are 'off', and control voltages are not generated at both ends of the resistor R 9 , so that each transistor Q 7 (Q 13 ). (Q 8 ) Also all are 'off' so the capacitor (C 1 ) will post a charge again.

한편, 제2시정수회로부(37)내의 콘덴서(C2)역시 상기의 트랜지스터(Q7)(Q13)의 동일한 '온.오프'동작에 의해 제1시정수회로부(31)와 동일한 타이밍으로 충반전되나, 전술한 바와 같이 방송신호가 수신되는 정상상태에서 A점에는 AFC회로(2)로 부터 수신방송신호 주파수에 동기시키기 위한 AFC전압이 공급되어 중접되기 때문에 제3도(가)에서 보는 바와같이 A점의 신호파형전압이 B점의 신호파형전압보다 높고, 또한 제2시정수회로부(37)의 시정수가 제1시정수회로부(31)보다 약간 크게 설정되어 있기 때문에 제2차동증폭부(36)내의 트랜지스터(Q12)는 계속 '오프'상태로 유지됨으로써 제2발진회로는 제1발진회로의 발진주파수에 아무런 영향을 미치지 못하게 된다.On the other hand, the capacitor C 2 in the second time constant circuit portion 37 is also at the same timing as the first time constant circuit portion 31 by the same 'on / off' operation of the transistors Q 7 and Q 13 . In the normal state in which the broadcast signal is received as described above, the point A is supplied with an AFC voltage for synchronizing with the frequency of the received broadcast signal from the AFC circuit 2 and is overlapped. As described above, since the signal waveform voltage at point A is higher than the signal waveform voltage at point B, and the time constant of the second time constant circuit portion 37 is set slightly larger than the first time constant circuit portion 31, the second differential amplifier portion 36, transistors in the (Q 12) of the second oscillator circuit being maintained in "off" state is let no effect on the oscillation frequency of the first oscillator circuit.

둘째, 수신방송의 입력이 없고 전술한 바와 같이 발진회로의 발진주파수와 극단적으로 제하된 이상발진 상태의 경우 이때는 AFC회로(2)로부터 공급되는 AFC 전압이 낮아지게 되고, 제3도 (나)에서 보는 바와 같이 B점 신호 파형 전압이 A점의 신호파형 전압보다 더욱 빨리 트랜지스터(Q1)의 베이스전압(VH)에 도달하게 되므로 제1차동증폭부(32)내의 트랜지스터(Q2)는 '오프'되고 제2차동증폭부(36)내의 트랜지스터(Q12)가 도통된다.Secondly, in the case of no oscillation frequency and the oscillation frequency of the oscillation circuit and the abnormal oscillation state which are extremely lowered as described above, the AFC voltage supplied from the AFC circuit 2 is lowered. transistor (Q 2) in the watch so that the point B signal waveform voltage is more quickly reached the base voltage (V H) of the transistor (Q 1) than the signal wave voltage of the point a as a first differential amplifying section 32 ''Off' and transistor Q 12 in second differential amplifier 36 is turned on.

따라서 제2파형정형부(38)의 출력단인 트랜지스터(Q11)의 콜렉터를 통해 흐르는 전류에 의해 저항(R9)의 양단에 제어전압이 발생하게 됨으로써 각 트랜지스터(Q7)(Q13)(Q8)가 도통된다.Accordingly, the control voltage is generated at both ends of the resistor R 9 by the current flowing through the collector of the transistor Q 11 , which is the output terminal of the second waveform shaping portion 38, thereby providing a transistor Q 7 (Q 13 ) ( Q 8 ) is conducted.

따라서 이 경우에 있어서는 제1발진회로의 발진출력은 제2시정수회로부(37)내의 저항(R12) 및 콘덴서(C2)의 시정수에 의해 설정되는 제2발진회로의 발진주파수에 의해 규제되기 때문에 제2발진회로의 발진주파수를 제1발진회로의 정상적인 발진주파수보다 조금 낮게 설정해 주면 제1발진회로의 발진주파수는 제2발진 회로의 발진주파수 이하로 낮아지지 않게 됨으로써 종래와 같은 극단적인 이상발진을 방지할 수 있는 것이다.In this case, therefore, the oscillation output of the first oscillation circuit is set by the oscillation frequency of the second oscillation circuit set by the time constants of the resistor R 1 2 and the capacitor C 2 in the second time constant circuit portion 37. Since the oscillation frequency of the second oscillation circuit is set slightly lower than the normal oscillation frequency of the first oscillation circuit because it is regulated, the oscillation frequency of the first oscillation circuit does not become lower than the oscillation frequency of the second oscillation circuit, thereby making the extreme Abnormal rash can be prevented.

이상과 같은 본 고안은 방송신호간 수신되지 않는 경우 수평발진 회로의 발진주파수가 극단적으로 낮아지는 이상발진을 방지할 수 있어 이에 따른 플라이백트랜스의 이상전압발생이나 고압보호회로등의 오동작을 제거시킬 수 있는 유용한 고안이다.The present invention as described above can prevent abnormal oscillation when the oscillation frequency of the horizontal oscillation circuit is extremely low when it is not received between broadcast signals, thereby eliminating abnormal voltage generation or malfunction of the high voltage protection circuit. It is a useful design.

Claims (1)

Vcc 전압 및 AFC 전압이 입력되는 저항(R7)(R8) 및 콘덴서(C1)로 된 제1시정수회로부(31)의 출력단을 트랜지스터(Q1)(Q2) 및 저항(R1)(R2)으로 된 제1차동증폭부(32)의 반전입력단에 연결함과 동시에 저항(R3)(R4) 및 트랜지스터(Q7)로 된 제1스위칭부(33)에 연결하고, 이 제1차동증폭부(32)의 출력단은 트랜지스터(Q3-Q6)로 된 제1파형정형부(34)의 입력단에 연결하며, 이 제1파형정형부(34)의 제1출력단(a)을 통상의 수평출력 회로(4)에 연결하고, 그 제2출력단(b)을 상기의 제1스위칭부(33)의 입력단과 저항(R5)(R6) 및 트랜지스터(Q8)로된 전압변환부(35)의 입력단에 공접시킴과 동시에 저항(R9)을 통해 접지시키며, 이 전압변환부(35)의 출력단을 상기의 제1차동증폭부(32)의 비반전입력단에 연결하여 제1발진회로를 구성하고, 상기의 제1차동증폭부(32)에 그 에미터가 공접된 트랜지스터(Q12)로 된 제2차동증폭부(36)의 입력단을 저항(R10)(R11) 및 트랜지스터(Q13)로 된 제2스위칭부(39)에 연결함과 동시에 상기의 제1시정수회로부(31)보다 큰 시정수를 갖는 저항(R12) 및 콘덴서(C2)로 된 제2시정수회로부(37)의 출력단에 연결하고, 이 제2차동증폭부(36)의 출력단을 트랜지스터(Q9-Q11)로 된 제2파형 정형부(38)의 입력단에 연결하며, 이 제2파형정형부(38)의 출력단과 당기의 제2스위칭부(39)의 입력단을 상기의 제1파형정형부(34)의 제2출력단(b)에 공접시켜 제2발진회로를 구성함을 특징으로 하는 테레비젼의 수평발진회로.The output terminals of the first time constant circuit part 31 including the resistors R 7 (R 8 ) and the capacitor C 1 to which the Vcc voltage and the AFC voltage are input are connected to the transistors Q 1 (Q 2 ) and the resistors R 1. ) (R 2), the first connected to the differential amplifier section (the first switching unit (33 a to connect the inverting input terminal, and at the same time the resistance (R 3) (R 4) and a transistor (Q 7) of the 32)) in the The output terminal of the first differential amplifier 32 is connected to the input terminal of the first waveform shaping unit 34 of transistors Q 3 -Q 6 , and the first output stage of the first waveform shaping unit 34. (a) is connected to a normal horizontal output circuit (4), and its second output terminal (b) is connected to the input terminal of the first switching unit 33, resistors R 5 (R 6 ) and transistors Q 8 And grounded through the resistor (R 9 ) at the same time as the input terminal of the voltage conversion unit (35), and the output terminal of the voltage conversion unit (35) is the non-inverting input terminal of the first differential amplifier (32). A first oscillation circuit connected to the first differential amplifier 32, Emitter is connected to the input terminal of the second differential amplifier unit 36 to the gongjeop the transistor (Q 12) to the resistor (R 10) (R 11) and a transistor (Q 13), a second switching unit 39 to the box and At the same time, the second differential amplifier unit is connected to the output terminal of the second time constant circuit unit 37 having a resistor R 12 and a capacitor C 2 having a larger time constant than the first time constant circuit unit 31. An output terminal of (36) is connected to an input terminal of the second waveform shaping section 38 of the transistors Q 9 -Q 11 , and the output terminal of the second waveform shaping section 38 and the second switching section 39 of the current pull are 39. TV's horizontal oscillation circuit comprising a second oscillation circuit by making a second oscillation circuit in common with the second output terminal (b) of the first waveform shaping portion (34).
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