KR890000182Y1 - Loop current hipass circuit - Google Patents
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Abstract
내용 없음.No content.
Description
제1도는 종래의 전화국선 장치에 있어서 직류루우프 전류 바이패스 회로도.1 is a DC loop current bypass circuit diagram of a conventional telephone line apparatus.
제2도는 모오스 전계효과 트랜지스터와 제너다이오드를 사용한 전화국선 루우프 전류 바이패스회로와 종래 회로의 특성곡선 비교도.2 is a characteristic curve comparison of a telephone line loop current bypass circuit using a MOS field effect transistor and a zener diode and a conventional circuit.
제3도는 본 고안에 따른 일실시예의 구체회로도.Figure 3 is a specific circuit diagram of one embodiment according to the present invention.
* 도면의 주요부분에 대한 부호의 설명* Explanation of symbols for main parts of the drawings
1 : 브리지 다이오드를 사용한 브리지 정류기1: bridge rectifier using bridge diode
Q₂: 인한스멘트형 모오스 전계효과 트랜지스터Q₂: Due to the moment-type MOS field effect transistor
R₄,R: 저항 ZD :제너다이오드R₄, R : Resistance ZD: Zener Diode
C₃,C₄,C: 캐패시터 T : 트랜스C₃, C₄, C Capacitor T
본 고안은 전화국선 접속장치에 있어서, 직류 루우프 전류 바이패스회로에 관한 것으로 특히 인한스멘드형 모오스 전계효과 트랜지스터와 제너다이와드를 사용하여 전화국측에서 공급되는 직류루우프 전류와 음성전류의 중첩신호로부터 음성전류와 직류루우프전류를 분리하기 위한 직류루우프 전류 바이패스 회로에 관한 것이다.The present invention relates to a DC loop current bypass circuit in a telephone line connection device. A direct current loop current bypass circuit for separating a current from a direct current loop current.
종래에는 사설교환기등의 전화국선 접속장치에 있어서 사설교환기와 전화국선간의 절연 목적 및 직류루우프 전류와 음성신호전류를 분리하기 위한 직류루우프 전류 바이패스 회로로써 제1도에 도시된 바와같이 저항(R₁)(R₂)(R₃)와 모오스 전계효과 트랜지스터(Q₁)와 캐패시터(C₁)(C₂)로 구성된 직류루우프 전류 바이패스회로가 사용되어 왔었다.Conventionally, in a telephone line connection device such as a private exchange, a resistance of R ₁ as shown in FIG. DC loop current bypass circuits consisting of (R₂) (R₃), Morse field effect transistor (Q₁) and capacitor (C₁) (C₂) have been used.
그러나 제1도와 같은 회로에 있어서는 모오스 전계효과 트랜지스터의 게이트 소오스간의 전압 VGS가 저항 R₁과 R₂로 저항분압으로 되여있기 때문에 드레인-소오스간의 전압 VGS가 증가함에 따라서 게이트 소오스간의 전압 VGS비례적으로 증가하게 된다.However, the first In Mohs since the voltage V GS between the gate the source of the field effect transistor doeyeo a resistance divided by resistors R₁ and R₂ drain assist in the same circuit, the voltage thus between the gate the source as the source voltage V GS increases between V GS proportionally To increase.
따라서 직류루우프 전류 IL이 큰 영역에서는 음성전류의 손실이 다소 커지며 정전류 특성을 향상시키기 위하여 상기 모오스 전계효과 트랜지스터의 소오스단자에 접속된 저항R₃(소오스8항)을 증가시킬 경우 고주파 발진이 발생되므로 소오스 저항 R₃의 값에 제한을 받게 되는 결점이 있었다.Therefore, in the region where the DC loop current I L is large, the loss of the negative current is rather large, and high frequency oscillation occurs when the resistance R₃ (source 8 term) connected to the source terminal of the MOS field effect transistor is increased to improve the constant current characteristics. There was a drawback that the value of the source resistance R₃ was limited.
따라서 본 고안의 목적은 직류루우프 전류 IL이 큰 영역에서도 음성전류의 손실이 매우 적으며 정전류 특성을 향상시키기 위하여 소오스 저항R₃을 증가하여도 고주파 발진을 하지 않는 회로를 제공함에 있다.Therefore, an object of the present invention is to provide a circuit that does not generate high frequency oscillation even when the source resistance R₃ is increased to improve the constant current characteristics, even though the loss of the negative current is very small even in the region where the DC loop current I L is large.
이하 본 고안은 첨부된 도면을 참도하여 상세히 설명한다.Hereinafter, the present invention will be described in detail with reference to the accompanying drawings.
제2도는 인한스멘트형 모오스 전계효과 트랜지스터를 사용한 종래의 직류루우프 전류 바이패스회로의 특성과 본 고안에 따른 회로의 정전류 특성을 비교한 것으로써 종래의 회로의 경우는 (a)의 곡선과 같이 직류루우프 전류 IL이 큰 영역에서는 정전류 특성이 다소 떨어짐을 알 수 있다.2 is a comparison of the characteristics of a conventional DC loop current bypass circuit using a moment-type MOS field effect transistor with the constant current characteristics of the circuit according to the present invention. It can be seen that the constant current characteristic is somewhat deteriorated in the region where the DC loop current I L is large.
또한 (b)의 곡선은 본 고안 회로의 특성 곡선으로서 직류루우프 전류 IL이 높은 영역에서도 우수한 정전류 특성을 나타낸 것을 알 수 있다.In addition, it can be seen that the curve of (b) shows excellent constant current characteristics even in a region where the DC loop current I L is high as a characteristic curve of the inventive design.
제3도는 본 고안에 따른 상술한 원리를 구체화한 회로도로써 도면중 R₄,R는 저항, C₃,C₄,C5는 캐패시터, Q₂는 인한스멘트형 모오스 전계효과 트랜지스터, ZD는 제너다이오드, T는 트랜스퍼머이다.3 is a circuit diagram embodying the above-described principle according to the present invention. Is the resistance, C₃, C₄, C 5 is the capacitor, Q₂ is the cemented MOS field effect transistor, ZD is the zener diode, T is the transformer.
전화국선(L₁)(L₂)로부터 입력되는 직류루우프 전류(IL)가 브리지 정류기(1)에 입력되어 극성이 정렬토록 하고 브리지 정류기(1)의 양의 출력단자에서 출력하는 양의 전압(+)이 모오스 전계효과 트랜지스터(Q₂)의 드레인측과 저항(R₄)와 제너다이오드(ZD)의 캐소우드측에 입력하도록 한다.DC loop current (I L ) input from telephone line (L₂) (L₂) is input to bridge rectifier (1) so that polarity is aligned and positive voltage (+) output from positive output terminal of bridge rectifier (1) ) Is input to the drain side of the MOS field effect transistor Q2 and to the cathode side of the resistor R 와 and zener diode ZD.
또한 브리지 정류기(1)의 음의 출력단자에서 출력하는 음의전압(-)이 제너다이오드(ZD)의 애노우드측과 상기 모오스 전계효과 트랜지스터(Q₂)의 소오스단자에접속되어 있는 소오스 저항 R에 입력토록 한다.In addition, a source resistor R connected to the anode side of the zener diode ZD and the source terminal of the MOS field effect transistor Q2 is connected to a negative voltage (−) output from the negative output terminal of the bridge rectifier 1. To be entered.
또 한편 상기 저항 R₄과 제너다이오드(ZD)에 의한 분압전압이 모오스 전계효과 트랜지스터(Q₂)의 게이트에 입력되도록 한다. 그리고 상기 모오스 전계효과 트랜지스터(Q₂)의 게이트에는 교류음성 전류를 바이패스시키는 캐패시터(C₄)로를 접속하며, 캐패시스터(C3)로 교류 음성신호가 트랜스퍼머(T)일차측으로 결합되도록 접속하고 모오스 전계효과 트랜지스터(Q₂)의 게이트와 드레인간에는 고주파 발진을 방지할 수 있는 고주파 발진 방지용 캐패시터(C5)를 접속한다.On the other hand, the divided voltage by the resistor R 'and zener diode ZD is input to the gate of the MOS field effect transistor Q2. A capacitor C 접속 for bypassing the AC negative current is connected to the gate of the MOS field effect transistor Q₂, and an AC audio signal is coupled to the primary side of the transformer T by the capacitor C 3 . A high frequency oscillation preventing capacitor C 5 capable of preventing high frequency oscillation is connected between the gate and the drain of the MOS field effect transistor Q 2.
지금 모오스 전계효과 트랜지스터(Q₂)의 드레인 소오스간의 전압을VDS,드레인 전류를 ID, 상기 드레인 전류 ID, 상기 드레인 전류 ID에 의해서 소오스 저항 R에 발생된 전압강하분을 VRS라 하면 정류회로(1)의 출력단자 양(+)과 음(-)간의 단자 전압 V₁은 하기의 식과 같게 된다.Now the voltage between the drain source of the MOS field effect transistor Q₂ is V DS , the drain current I D , the drain current I D , the drain current I D If the voltage drop generated by V RS is V RS , the terminal voltage V 간의 between the positive and negative output terminals of the rectifier circuit 1 is expressed by the following equation.
V₁=VDS+IDR5..................(1)V₁ = V DS + I D R 5. ................. (1)
상기 (1)식에서 소오스 저항 R에 의한 전압강하를 VRS라 하면 하기의 식과 같이 된다.The source resistance R in the formula (1) Assuming that the voltage drop by V RS is as follows.
VR5 =ID ·R5......................(2)V R5 = I DR 5 ... (2)
또한 모오스 트랜지스터(Q₂)의 게이트전압 VGS는 제너다이오드(ZD)에 걸린 전압에서 상기 소오스저항 R5의 전압강하 VR5를 뺀것과 같으므로 제너다이오드(ZD)의 직류 저항을 RZD라 하면 하기의 식과 같이 쓸 수 있다.In addition, since the gate voltage V GS of the MOS transistor Q₂ is equal to the voltage applied to the zener diode ZD minus the voltage drop V R5 of the source resistor R 5 , the DC resistance of the zener diode ZD is represented by R ZD . Can be written as
따라서 정류회로(1)의 출력단자 전압 V₁에는 직류루우프 전류에 교류음성 신호가 중첩되여 있으므로 식(3)에서 나타낸 바와같이 게이트-소오스간의 전압 VGS에도 교류음성 신호가 실려 모오스 전계효과 트랜지스터(Q₂)의 게이트에 입력될 수 있으므로 캐패시터(C₄)를 사용하여 상기 음성교류 신호성분을 바이패스 시킬 수 있다.Therefore, since the AC terminal signal is superimposed on the DC loop current at the output terminal voltage V 의 of the rectifier circuit 1, as shown in Equation (3), the AC voice signal is also loaded on the voltage V GS between the gate and the source. Since it can be input to the gate of the), it is possible to bypass the voice exchange signal component using a capacitor (C₄).
그러므로 캐패시터(C₄)를 연결하면 게이트 소오스간의 전압 VGS에 실려있는 교류음성신호는 캐패시터(C₄)를 통해 바이패스 됨으로 모오스 전계효과 트랜지스터(Q₂)의 게이트에는 일정한 직류전압만이 입력된다.Therefore, when the capacitor (C₄) is connected, the AC voice signal contained in the voltage V GS between the gate sources is bypassed through the capacitor (C₄), so that only a constant DC voltage is input to the gate of the MOS field effect transistor (Q₂).
따라서 드레인 소오스간의 전류 IDS는 일정하게 된다. 또한 직류루우프 전류 IL의 증가에 따라TJ 드레인 전류 ID도 증가하며 상기 드레인 전류 ID의 흐름에 의해서 소오스저항(R5)의 전압강화분도 증가한다.Therefore, the current I DS between the drain sources becomes constant. In addition, as the DC loop current I L increases, the TJ drain current I D also increases, and the voltage increase of the source resistance R 5 increases with the flow of the drain current I D.
따라서 식(3)에서 알 수 있는 바와같이 게이트 소오스간의 전압 VGS는 드레인전류 ID의 증가에 따라서 상기 게이트 소오스간의 전압 VGS는 감소하게 되며 드레인전류 ID의 증가를 억제할 수 있다.Therefore, the voltage V GS between the source and the gate, as can be seen in formula (3) with the increase of the drain current I D, and decreases the voltage V GS between the gate sources is possible to suppress the increase of the drain current I D.
또 한편 캐패시터(C5)가 없을 경우 회로의 정전류 특성을 향상시키기 위하여 소오스저항 R5를 증가시키면 모오스 전계효과 트랜지스터(Q₂)의 게이트와 소오스간의 궤환으로 인하여 고주파 발진이 일어나므로 캐패시터(C5)를 상기 모오스 전계효과 트랜지스터(Q₂)의 게이트 단자와 소오스단자간에 접속하여 상기 모오스 전계효과 트랜지스터(Q₂)의 게이트와 소오스간의 궤환을 방지함으로써 고주파 발진을 없어지게 할 수 있다.On the other hand a capacitor (C 5) the increase in the source resistor R 5 in order to improve the constant current characteristics of the circuit if not because of the feedback between the gate and the source of the Mohs field effect transistor (Q₂) is a high-frequency oscillation up, because capacitor (C 5) Is connected between the gate terminal and the source terminal of the MOS field effect transistor Q2, thereby preventing high frequency oscillation by preventing feedback between the gate and the source of the MOS field effect transistor Q2.
따라서 상기 고주파 발진방지용 캐패시터(C5)를 접속함으로써 회로의 정전류 특성을 향상시키기 위하여 소오스저항 R5을 큰 값으로 취할 수 있게 할 수 있다.Therefore, by connecting the high frequency oscillation preventing capacitor C 5 , the source resistance R 5 can be set to a large value in order to improve the constant current characteristic of the circuit.
모오스 전계효과 트랜지스터(Q₂)의 게이트 단자에 입력되는 전압은 브리지 정류기(1)의 출력단자 전압 V₁(드레인 소오스간의 전압 VDS)이 저항 R₄와 제너다이오드(ZD)에 의해서 분압되어 입력하게 되는데 단순히 저항 분압일 경우 드레인 소오스간의 전압 VDS에 따라서 게이트 소오스간의 전압 VGS가 비례적으로 증가하게 되여 직류루우프 전류 IL이 클 경우 회로의 정전류 특성이 저하되어 음성전류의 손실이 있었다.The voltage inputted to the gate terminal of the MOS field effect transistor Q₂ is inputted by dividing the output terminal voltage V₁ (voltage of the drain source V DS ) of the bridge rectifier 1 by the resistor R₄ and the zener diode (ZD). In the case of the resistance partial voltage, the voltage V GS between the gate sources increases proportionally according to the voltage V DS between the drain sources. When the DC loop current I L is large, the constant current characteristics of the circuit deteriorate and there is a loss of the voice current.
그러나 일반적으로 제너다이오드의 특성은 제너전압에 가까워질수록 제너다이오드의 직류저항이 낮아지는 특성이 있으므로 이 특성을 이용하여 브리지 정류기(1)의 출력단자 전압 V₁(드레인 소오스간의 전압 VDS)을 저항 R₄와 제너다이오드(ZD)의 직류저항 RZD로 분압한 분압전압을 모오스 전계효과 트랜지스터(Q₂)의 게이트에 입력할 경우, 루우프 전류 IL이 증가하여 드레인 소오스간의 전압 VDS(브리지 정류기(1) 출력단자 전압 V₁)이 증가하더라도 제너다이오드(ZD)의 직류저항 RZD가 상대적으로 낮아지므로 저항 R₄과의 전압분압비가 줄어들게 되여 상기 모오스 전계효과 트랜지스터(Q₂)의 게이트단자에 입력하게 될 수 있다.However, in general, the zener diode has a characteristic of decreasing the direct current resistance of the zener diode as it approaches the zener voltage. Therefore, the output terminal voltage V₁ (voltage V DS between the drain sources) of the bridge rectifier 1 is used by using this characteristic. When the divided voltage divided by the DC resistance R ZD of R ₄ and zener diode (ZD) is input to the gate of the MOS field effect transistor (Q₂), the loop current I L increases to increase the voltage V DS between the drain source (bridge rectifier (1) ) Even if the output terminal voltage V₁) increases, the DC resistance R ZD of the zener diode ZD is relatively low, and thus the voltage division ratio with the resistor R₄ decreases, which may be input to the gate terminal of the MOS field effect transistor Q₂. .
따라서 직류루우프 전류 IL이 높은 영역에서도 우수한 정전류 특성이 될 수 있다.Therefore, excellent constant current characteristics can be obtained even in a region where the DC loop current I L is high.
상술한 바와같이 본 고안은 모오스 전계효과 트랜지스터의 게이트의 입력전압을 제너다이오드의 직류 저항 특성을 이용하여 분압한 전압을 입력하여 직류루우프 전류 IL이 높은 영역에서도 드레인전류 ID를 제어함으로써 교류에 대한 임피던스도 종래의 회로에 비하여 극히 높아질 수 있다.As described above, the present invention inputs a voltage obtained by dividing the input voltage of the gate of the Morse field effect transistor using the DC resistance characteristic of the Zener diode to control the drain current I D even in a region where the DC loop current I L is high. Impedances can also be extremely high compared to conventional circuits.
한편 정전류특성을 향상시키기 위하여 소오스저항을 증가시킴에 따라 고주파 발진이 발생하여 왔으나 캐패시터(C5)를 모오스 전계효과 트랜지스터(Q₂)의 게이트단자와 소오스단자간에 접속하여 고주파 발진을 방지함으로써 소스저항을 높은 값으로 취할수 있다.On the other hand, high frequency oscillation has occurred as the source resistance is increased to improve the constant current characteristics, but the source resistor is prevented by connecting the capacitor (C 5 ) between the gate terminal and the source terminal of the MOS field effect transistor (Q₂) to prevent high frequency oscillation. Can be taken at a high value.
따라서 루우프 전류의 긴 전 여역에서 안정된 정전류특성를 가지게 되어 루우프 전류에 중첩된 음성전류의 대부분을 캐패시터(C₃)을 통하여 트랜스퍼머로 분리할 수 있게된다.Therefore, it has a stable constant current characteristic in the long region of the loop current, so that most of the negative current superimposed on the loop current can be separated by a transformer through the capacitor C₃.
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Priority Applications (1)
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KR2019850017069U KR890000182Y1 (en) | 1985-12-18 | 1985-12-18 | Loop current hipass circuit |
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KR2019850017069U KR890000182Y1 (en) | 1985-12-18 | 1985-12-18 | Loop current hipass circuit |
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KR870011516U KR870011516U (en) | 1987-07-18 |
KR890000182Y1 true KR890000182Y1 (en) | 1989-03-06 |
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- 1985-12-18 KR KR2019850017069U patent/KR890000182Y1/en not_active IP Right Cessation
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