KR880004462A - 디지탈 비디오 신호 처리 회로 - Google Patents

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KR880004462A
KR880004462A KR870010183A KR870010183A KR880004462A KR 880004462 A KR880004462 A KR 880004462A KR 870010183 A KR870010183 A KR 870010183A KR 870010183 A KR870010183 A KR 870010183A KR 880004462 A KR880004462 A KR 880004462A
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KR870010183A
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히데또시 오자끼
Original Assignee
이노우에 도시야
니뽕 빅터 가부시끼 가이샤
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    • G11INFORMATION STORAGE
    • G11BINFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
    • G11B20/00Signal processing not specific to the method of recording or reproducing; Circuits therefor
    • G11B20/10Digital recording or reproducing
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04NPICTORIAL COMMUNICATION, e.g. TELEVISION
    • H04N5/00Details of television systems
    • H04N5/14Picture signal circuitry for video frequency region
    • H04N5/20Circuitry for controlling amplitude response
    • H04N5/205Circuitry for controlling amplitude response for correcting amplitude versus frequency characteristic
    • H04N5/208Circuitry for controlling amplitude response for correcting amplitude versus frequency characteristic for compensating for attenuation of high frequency components, e.g. crispening, aperture distortion correction

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  • Signal Processing (AREA)
  • Multimedia (AREA)
  • Picture Signal Circuits (AREA)

Abstract

내용 없음

Description

디지탈 비디오 신호 처리 회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도 및 제2도는 각각 본 발명 회로의 제1실시예의 블럭계통도 및 그 신호 파형도.
제3도는 노이즈 억압회로의 구체적인 블럭계통도.

Claims (12)

  1. 입력 디지탈 비디오 신호를 소정 지연 시간지연시키며 또한 이 입력 디지탈 비디오 신호의 고역을 강조시킨 제1의 신호와, 입력 디지탈 비디오 신호를 상기 소정시간 지연시키며 또한 이 입력 디지탈 비디오 신호의 고역 성분을 인출한 제2의 신호와, 입력 디지탈 비디오 신호를 상기 소정 지연 시간의 2배의 지연시간 지연시킨 제3의 신호를 얻는 지연수단과, 상기 입력 디지탈 비디오 신호 데이타와 상기 제3의 신호 데이타를 레벨비교하여 레벨의 큰쪽의 신호 데이타를 선택하여 인출하는 한편, 레벨의 적은쪽의 신호 데이타를 선택하여 인출하는 선택 수단과, 이 선택 수단에 의해 선택된 이 레벨의 큰쪽의 신호 데이타를 리미터 레벨로서 상기 제1의 신호 데이타를 리미트하는 제1의 리미터와, 상기 선택 수단에 의해 선택된 상기 레벨의 적은쪽의 신호 데이타를 리미터 레벨로서 이 제1의 리미터의 출력신호 데이타를 리미트하는 제2의 리미터와, 상기 제2의 신호의 노이즈 억압을 하는 노이즈 억압 수단과, 이 노이즈 억압 수단의 출력과 이 제2의 리미터의 출력을 가산하는 가산 수단으로 되는 것을 특징으로 하는 디지탈 비디오 신호 처리 회로.
  2. 제1항에 있어서, 지연 수단은, 제1의 신호를 얻는 고역 강조필터와, 제2의 신호를 얻는 고역 필터를 제3의 신호를 얻는 지연 회로에서 공용하는 것을 특징으로 하는 디지탈 비디오 신호 처리 회로.
  3. 제1항에 있어서, 지연 수단은, 제1의 신호를 얻는 고역 강조필터와 제2의 신호를 얻는 고역필터와의 지연회로와, 제3의 신호를 얻는 지연회로를 별도로 구성하는 것을 특징으로 하는 디지탈 비디오 신호 처리 회로.
  4. 입력 디지탈 비디오 신호를 소정 지연 시간 지연시키며 또한 이 입력 디지탈 비디오 신호의 고역을 강조시킨 제1의 신호와, 입력 디지탈 비디오 신호를 상기 소정 시간 지연시키며 또한 이 입력 디지탈 비디오 신호의 고역 성분을 인출한 제2의 신호와, 입력 디지탈 비디오 신호를 이 소정 지연시간의 2배의 지연시간 만큼 지연시킨 제3의 신호를 얻는 지연수단과, 상기 입력 디지탈 비디오 신호 데이타와 상기 제3의 신호 데이타를 레벨 비교하여 레벨의 큰쪽의 신호 데이타를 선택하여 인출하는 한편, 레벨의 적은쪽의 신호 데이타를 선택하여 인출하는 선택수단과, 이 선택 수단에 의해 선택된 이 레벨의 적은쪽의 신호 데이타를 리미터 레벨로서 상기 제1의 신호 데이타를 리미트하는 제1의 리미터와, 상기 선택수단에 의해 선택된 상기 레벨의 큰쪽의 신호 데이타를 리미터 레벨로서 이 제1의 리미터의 출력 신호 데이타를 리미트하는 제2의 리미터와, 상기 제2의 신호의 노이즈 억압을 하는 노이즈 억압 수단과, 이 노이즈 억압수단의 출력과 이 제2의 리미터의 출력을 가산하는 가산수단에 의하는 것을 특징으로 하는 디지탈 비디오 신호 처리 회로.
  5. 제4항에 있어서, 지연 수단은, 이 제1의 신호를 얻는 고역 강조필터와, 제2의 신호를 얻는 고역 필터를 제3의 신호를 얻는 지연 회로에서 공용하는 것을 특징으로 하는 디지탈 비디오 신호 처리 회로.
  6. 제4항에 있어서, 지연수단은, 제1의 신호를 얻는 고역 강조필터와 제2의 신호를 얻는 고역 필터와의 지연회로와, 제3의 신호를 얻는 지연회로를 각 별도로 구성되는 것을 특징으로 하는 디지탈 비디오 신호 처리 회로.
  7. 입력 디지탈 비디오 신호를 소정의 지연 시간 지연시켜서 또한 이 입력 디지탈 비디오 신호의 고역을 강조시킨 제1의 신호와, 입력 디지탈 비디오 신호를 이 소정의 지연 시간의 2배의 지연 시간 지연시킨 제2의 신호를 얻는 지연 수단과, 상기 입력 디지탈 비디오 신호 데이타와 상기 제2의 신호 데이타를 레벨 비교하여 레벨의 큰쪽의 신호 데이타를 선택하여 인출하는 한편, 레벨이 적은쪽의 신호 데이타를 선택하여 인출하는 선택 수단과,이 선택 수단에 의해 선택된 이 레벨의 큰쪽의 신호 데이타를 리미터 레벨로서 상기 제1의 신호 데이타를 리미트하는 제1의 리미터와, 상기 선택수단에 의해 선택된 상기 레벨의 적은쪽의 신호 데이타를 리미터 레벨로서 이 제1의 리미터의 출력 신호 테이타를 리미트하는 제2의 리미터로 구성되는 것을 특징으로 하는 디지탈 비디오 신호 처리 회로.
  8. 제7항에 있어서, 지연 수단은, 제1의 신호를 얻는 고역 강조 필터와 제2의 신호를 얻는 지연회로로 별도로 구성이 되는 것을 특징으로 하는 디지탈 비디오 신호 처리회로.
  9. 제7항에 있어서, 지연 수단은, 제1의 신호를 얻는 고역 강조 필터부와 제2의 신호를 얻는 지연 회로부를 공용하여 구성되는 것을 특징으로 하는 디지탈 비디오 신호 처리 회로.
  10. 입력 디지탈 비디오 신호를 소정의 지연시간 만큼 지연시켜서 또한 이 입력 디지탈 비디오 신호의 고역을 강조시킨 제1의 신호와, 입력 디지탈 비디오신호를 소정의 지연시간의 2배의 지연시간 만큼 지연시킨 제2의 신호를 얻는 지연 수단과, 상기 입력 디지탈 비디오 신호 데이타와 상기 제2의 신호 데이타를 레벨 비교하여 레벨이 큰쪽의 신호 데이타를 선택하여 인출하는 한편, 레벨의 적은쪽의 신호 데이타를 선택하여 인출하는 선택 수단과, 이 선택 수단에 의해 선택된 이 레벨의 적은쪽의 신호 데이타를 리미터 레벨로서 상기 제1의 신호 데이타를 리미트하는 제1의 리미터와, 상기 선택 수단에 의해 선택된 상기 레벨의 큰쪽의 신호 테이타를 리미터 레벨로서 이 제1의 리미터의 출력 신호 데이타를 리미트하는 제2의 리미터로 되는 것을 특징으로 하는 디지탈 신호 처리 회로.
  11. 제10항에 있어서, 지연 수단은, 제1의 신호를 얻는 고역 강조 필터와 제2의 신호를 얻는 지연회로에서 별도로 구성되는 것을 특징으로 하는 디지탈 비디오 신호 처리 회로.
  12. 제10항에 있어서, 지연 수단은, 제1의 신호를 얻는 고역 강조 필터부와 제2의 신호를 얻는 지연 회로부를 공용하여 구성되는 것을 특징으로 하는 디지탈 비디오 신호 처리회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019870010183A 1986-09-16 1987-09-15 디지탈 비디오 신호처리 회로 KR910008922B1 (ko)

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JP217839 1983-11-21
JP61217840A JPS6373775A (ja) 1986-09-16 1986-09-16 デジタルビデオ信号処理回路
JP217840 1986-09-16
JP61217839A JPS6373774A (ja) 1986-09-16 1986-09-16 デジタルビデオ信号処理回路

Publications (2)

Publication Number Publication Date
KR880004462A true KR880004462A (ko) 1988-06-04
KR910008922B1 KR910008922B1 (ko) 1991-10-24

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ID=26522234

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KR1019870010183A KR910008922B1 (ko) 1986-09-16 1987-09-15 디지탈 비디오 신호처리 회로

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DE3786623D1 (de) 1993-08-26
EP0260913B1 (en) 1993-07-21
EP0260913A2 (en) 1988-03-23
US4853783A (en) 1989-08-01
EP0260913A3 (en) 1989-09-27
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