KR20230149319A

KR20230149319A - 프리미티브들의 배치들의 지오메트리 프로세싱을 위한 스케일러블 프리미티브 레이트 아키텍처

Info

Publication number: KR20230149319A
Application number: KR1020237033923A
Authority: KR
Inventors: 비쉬와나트 샤시칸트 니캄; 칼리안 쿠마르 비라바바틀라; 수밤 차테르지; 시바 사티아나라야나 콜라; 아비셰크 랄; 앤드류 에반 그루버
Original assignee: 퀄컴 인코포레이티드
Priority date: 2021-04-13
Filing date: 2022-03-15
Publication date: 2023-10-26
Also published as: TW202240528A; US11615504B2; BR112023020444A2; CN117136375A; WO2022220979A1; US20220327654A1; EP4323968A1

Abstract

본 개시는 장치, 예를 들어 GPU 를 포함하는 그래픽스 프로세싱을 위한 방법들 및 디바이스들에 관한 것이다. 장치는 복수의 프리미티브들 각각에 대한 복수의 인덱스들을 수신할 수도 있다. 장치는 또한 복수의 프리미티브 배치들 각각의 사이즈를 결정할 수도 있으며, 복수의 프리미티브 배치들 각각은 복수의 프리미티브들 중 적어도 하나의 프리미티브를 포함한다. 부가적으로, 장치는 복수의 프리미티브 배치들 각각의 결정된 사이즈에 기초하여, 복수의 프리미티브들을 복수의 프리미티브 배치들로 분할할 수도 있다. 장치는 또한, 복수의 프리미티브 배치들의 각각을 복수의 지오메트리 슬라이스들의 각각에 분배할 수도 있고, 복수의 지오메트리 슬라이스들의 각각은 복수의 프리미티브들 중 하나 이상의 프리미티브들을 포함한다.

Description

프리미티브들의 배치들의 지오메트리 프로세싱을 위한 스케일러블 프리미티브 레이트 아키텍처

관련 출원에 대한 상호-참조

본 출원은 명칭이 "METHODS AND APPARATUS FOR SCALABLE PRIMITIVE RATE ARCHITECTURE FOR GEOMETRY PROCESSING" 이고 2021 년 4 월 13 일 출원된 미국 특허출원 제 17/229,697 호의 이익을 주장하며, 이는 그 전부가 본 명세서에 참조로 명백히 포함된다.

기술분야

본 개시는 일반적으로 프로세싱 시스템들에 관한 것으로, 특히 그래픽스 프로세싱을 위한 하나 이상의 기법들에 관한 것이다.

컴퓨팅 디바이스는 종종 시각적 콘텐츠를 렌더링 및 디스플레이하기 위해 (예를 들어, 그래픽스 프로세싱 유닛 (graphics processing unit; GPU), 중앙 프로세싱 유닛 (central processing unit; CPU), 디스플레이 프로세서 등을 활용하여) 그래픽스 및/또는 디스플레이 프로세싱을 수행한다. 이러한 컴퓨팅 디바이스는 예를 들어, 컴퓨터 워크스테이션, 모바일 폰, 예컨대 스마트폰, 임베디드 시스템, 개인용 컴퓨터, 태블릿 컴퓨터 및 비디오 게임 콘솔을 포함할 수도 있다. GPU들은 함께 동작하여 그래픽스 프로세싱 커맨드들을 실행하고 프레임을 출력하는, 하나 이상의 프로세싱 스테이지들을 포함하는 그래픽스 프로세싱 파이프라인을 실행하도록 구성된다. 중앙 프로세싱 유닛 (CPU) 은 하나 이상의 그래픽스 프로세싱 커맨드들을 GPU 에 발행함으로써 GPU 의 동작을 제어할 수도 있다. 현대의 CPU들은 통상적으로 다중 애플리케이션들을 동시에 실행할 수 있으며, 그 각각은 실행 동안 GPU 를 활용해야 할 수도 있다. 디스플레이 프로세서는 CPU 로부터 수신된 디지털 정보를 아날로그 값들로 변환하도록 구성되고, 시각적 콘텐츠를 디스플레이하기 위해 디스플레이 패널에 커맨드들을 발행할 수도 있다. 디스플레이 상에 시각적 프리젠테이션을 위한 콘텐츠를 제공하는 디바이스는 GPU 및/또는 디스플레이 프로세서를 활용할 수도 있다.

디바이스의 GPU 는 그래픽스 프로세싱 파이프라인에서 프로세스들을 수행하도록 구성될 수도 있다. 또한, 디스플레이 프로세서 또는 디스플레이 프로세싱 유닛 (display processing unit; DPU) 은 디스플레이 프로세싱의 프로세스들을 수행하도록 구성될 수도 있다. 그러나, 무선 통신 및 더 작은 핸드헬드 디바이스들의 출현으로, 개선된 그래픽스 또는 디스플레이 프로세싱에 대한 증가된 필요성을 발전시켰다.

다음은 그러한 양태들의 기본적인 이해를 제공하기 위하여 하나 이상의 양태들의 간략한 개요를 제시한다. 이 개요는 모든 고려되는 양태들의 광범위한 개관은 아니고, 모든 양태들의 핵심적인 또는 중요한 엘리먼트들을 특정하지도 임의의 또는 모든 양태들의 범위를 기술하지도 않도록 의도된다. 그 유일한 목적은 이후에 제시되는 보다 상세한 설명에 대한 도입부로서 간략화된 형태로 하나 이상의 양태들의 일부 개념들을 제시하는 것이다.

본 개시의 일 양태에서, 방법, 컴퓨터 판독가능 매체, 및 장치가 제공된다. 장치는 그래픽스 프로세싱 유닛 (CPU) 또는 그래픽스 프로세싱을 수행할 수 있는 임의의 장치일 수도 있다. 장치는 복수의 프리미티브들 각각의 가시성을 결정할 수도 있고, 여기서 복수의 프리미티브들 각각에 대한 복수의 인덱스들은 복수의 프리미티브들 각각의 가시성에 기초하여 수신된다. 장치는 또한 복수의 프리미티브들 각각에 대한 복수의 인덱스들을 수신할 수도 있다. 장치는 또한 복수의 프리미티브들 각각에 대한 복수의 인덱스들을 페치할 수도 있다. 부가적으로, 장치는 복수의 프리미티브 배치들 각각의 사이즈를 결정할 수도 있으며, 복수의 프리미티브 배치들 각각은 복수의 프리미티브들 중 적어도 하나의 프리미티브를 포함한다. 장치는 또한 복수의 프리미티브 배치들 각각의 결정된 사이즈에 기초하여, 복수의 프리미티브들을 복수의 프리미티브 배치들로 분할할 수도 있다. 장치는 또한, 복수의 프리미티브 배치들의 각각을 복수의 지오메트리 슬라이스들의 각각에 분배할 수도 있고, 복수의 지오메트리 슬라이스들의 각각은 복수의 프리미티브들 중 하나 이상의 프리미티브들을 포함한다. 추가로, 장치는 하나 이상의 프리미티브들을 포함하는 복수의 지오메트리 슬라이스들 각각을 프로세싱할 수도 있다. 장치는 또한 하나 이상의 프리미티브들을 포함하는 복수의 지오메트리 슬라이스들 각각을 셰이딩할 수도 있다. 또한, 장치는 복수의 지오메트리 슬라이스들 중 적어도 하나가 슬라이스 순서에서 업데이트된 포지션에 대응하도록, 복수의 지오메트리 슬라이스들의 슬라이스 순서를 재배열할 수도 있다. 장치는 또한 복수의 지오메트리 슬라이스들의 슬라이스 순서에 기초하여 복수의 프리미티브들 각각을 래스터화할 수도 있다.

본 개시의 하나 이상의 예들의 상세들은 첨부 도면들 및 하기의 설명에서 기술된다. 다른 특징들, 목적들 및 이점들은 설명 및 도면들, 및 청구항들로부터 명확해질 것이다.

도 1 은 본 개시의 하나 이상의 기법들에 따른 예시의 콘텐츠 생성 시스템을 도시하는 블록 다이어그램이다.
도 2 는 본 개시의 하나 이상의 기법들에 따른 예시의 GPU 를 도시한다.
도 3 은 본 개시의 하나 이상의 기법들에 따른 예시의 이미지 또는 표면을 도시한다.
도 4 는 본 개시의 하나 이상의 기법들에 따른 GPU 에서의 예시의 지오메트리 파이프라인을 도시하는 다이어그램이다.
도 5 는 본 개시의 하나 이상의 기법들에 따른 예시의 프리미티브 배치 분배 프로세스를 도시하는 다이어그램이다.
도 6 은 본 개시의 하나 이상의 기법들에 따른 GPU 에서의 예시의 지오메트리 파이프라인을 도시하는 다이어그램이다.
도 7a 는 본 개시의 하나 이상의 기법들에 따른 GPU 에서의 예시의 지오메트리 파이프라인을 도시하는 다이어그램이다.
도 7b 는 본 개시의 하나 이상의 기법들에 따른 GPU 에서의 예시의 지오메트리 파이프라인을 도시하는 다이어그램이다.
도 8 은 본 개시의 하나 이상의 기법들에 따른 테셀레이션의 예시의 방법의 플로우챠트이다.
도 9 는 본 개시의 하나 이상의 기법들에 따른 프리미티브들의 패치의 예시의 테셀레이션 프로세스를 도시하는 다이어그램이다.
도 10 은 본 개시의 하나 이상의 기법들에 따른 지오메트리 파이프라인에서의 예시의 지오메트리 셰이더 프로세싱을 도시하는 다이어그램이다.
도 11 은 본 개시의 하나 이상의 기법들에 따른 GPU 파이프라인, GPU 컴포넌트, 및 메모리/디스플레이 사이의 예시의 통신들을 도시하는 통신 플로우 다이어그램이다.
도 12 는 본 개시의 하나 이상의 기법들에 따른 예시의 그래픽스 프로세싱의 방법의 플로우챠트이다.

스케일러블 지오메트리 프로세싱 하드웨어를 설계할 때 직면될 수도 있는 많은 쟁점들이 있다. 예를 들어, 지오메트리 파이프라인의 중간에서 드로우콜(drawcall)(즉, 작업 유닛) 의 가변 사이즈 및 적응적 워크로드 확장은 스케일러블 지오메트리 프로세싱 하드웨어를 설계할 때 발생할 수도 있는 일부 쟁점들이다. 상이한 드로우콜들에 걸친 워크로드들은 달라질 수도 있으서, 각각의 드로우콜을 지오메트리 슬라이스에 연결하면 불균일한 데이터 다운스트림을 생성할 수도 있다. 스케일러블 지오메트리 프로세싱 하드웨어를 설계할 때 직면될 수도 있는 다른 쟁점은 다중 지오메트리 슬라이스들에 걸친 가시성 핸들링 (예를 들어, 타일링된 렌더링) 이다. 본 명세서에 나타낸 바와 같이, 타일-기반 렌더링에서, 스크린은 다중 빈들로 분할되고, 비닝 패스는 빈당 가시성 스트림 (즉, 빈에서 가시적인 것으로서 식별될 수도 있는 프리미티브들) 을 생성하는데 사용된다. 프리미티브들의 상이한 가시성들 때문에, 각각의 빈-렌더링 패스에서의 워크로드 패턴은 비닝 패스와 상당히 다를 수도 있다. 워크로드 분배 스킴은 (증폭을 포함하는) 균일한 워크로드가 (가시성에서의 잠재적인 디스패리티를 설명할 때에도) 각각의 지오메트리 슬라이스에 분배되는 것을 보장할 수도 있다. 스케일러블 지오메트리 프로세싱 하드웨어를 설계할 때 직면될 수도 있는 다른 쟁점은 프리미티브 재시작 인덱스 또는 컷 인덱스를 지원하기 위한 애플리케이션 프로그램 인터페이스 (API) 사양이다. 일부 경우들에서, API (예를 들어, OpenGL 또는 DirectX) 는 프리미티브 재시작을 지원하기 위해 하드웨어를 활용할 수도 있다. 또한, 프리미티브 재시작은 애플리케이션 개발자들이 드로우콜 중간에 현재 메시를 정지하고 임의적인 인덱스로부터 새로운 메시를 재시작할 수 있도록 한다. 이는 스케일링블 지오메트리 프로세싱 하드웨어를 설계하는데 있어서 과제를 생성할 수 있는데, 이는 작업 분배 로직이 새로운 메시가 시작하는 임의적인 위치를 인식할 수도 있기 때문이다. 본 개시의 양태들은 독립적으로 작동하는 하드웨어 모듈들에 걸쳐 GPU 워크로드를 균등하게 분배할 수도 있다. 본 개시의 양태들은 또한 상이하게 사이징된 드로우콜들 및/또는 적응적 워크로드 확장들을 위한 스케일러블 지오메트리 프로세싱 하드웨어를 제공할 수도 있다. 또한, 본 개시의 양태들은 다중 지오메트리 슬라이스들에 걸쳐 가시성 핸들링 또는 타일 렌더링을 위한 스케일러블 지오메트리 프로세싱 하드웨어를 제공할 수도 있다. 본 개시의 양태들은 또한 프리미티브 재시작을 지원하기 위해 스케일러블 지오메트리 프로세싱 하드웨어를 제공할 수도 있다.

이하, 시스템들, 장치들, 컴퓨터 프로그램 제품들, 및 방법들의 다양한 양태들이 첨부 도면들을 참조하여 더 충분히 설명된다. 하지만, 본 개시는 많은 상이한 형태들로 실시될 수도 있고 본 개시 전체에 걸쳐 제시된 임의의 특정 구조 또는 기능에 제한되는 것으로 해석되지 않아야 한다. 오히려, 이들 양태들은 본 개시가 철저하고 완전하게 되고, 본 개시의 범위를 당업자에게 충분히 전달하게 되도록 제공된다. 본 명세서에서의 교시들에 기초하여, 당업자는, 본 개시의 다른 양태들과 독립적으로 구현되든 또는 이와 결합되든, 본 명세서에 개시된 시스템들, 장치들, 컴퓨터 프로그램 제품들, 및 방법들의 임의의 양태를 커버하도록 의도됨을 알아야 한다. 예를 들어, 본 명세서에 제시된 임의의 수의 양태를 이용하여 장치가 구현될 수도 있거나 방법이 실시될 수도 있다. 또한, 본 개시의 범위는 본 명세서에 제시된 본 개시의 다양한 양태들 이외에 또는 이에 부가하여 다른 구조, 기능성, 또는 구조 및 기능성을 이용하여 실시되는 그러한 장치 또는 방법을 커버하도록 의도된다. 본 명세서에 개시된 임의의 양태는 청구항의 하나 이상의 엘리먼트들에 의해 구체화될 수도 있다.

다양한 양태들이 본 명세서에서 설명되지만, 이들 양태들의 많은 변형들 및 치환들은 본 개시의 범위에 포함된다. 본 개시의 양태들의 일부 잠재적 이익들 및 이점들이 언급되지만, 본 개시의 범위는 특정 이익들, 사용들, 또는 목적들에 제한되도록 의도되지 않는다. 오히려, 본 개시의 양태들은 상이한 무선 기술들, 시스템 구성들, 네트워크들, 및 송신 프로토콜들에 광범위하게 적용가능한 것으로 의도되고, 이들 중 일부는 도면들 및 다음의 설명에서 예시에 의해 설명된다. 상세한 설명 및 도면들은 본 개시를 제한하는 것이 아니라 예시할 뿐이며, 본 개시의 범위는 첨부된 청구항들 및 그 등가물들에 의해 정의된다.

다양한 장치들 및 방법들을 참조하여 여러 양태들이 제시된다. 이들 장치들 및 방법들은 다양한 블록들, 컴포넌트들, 회로들, 프로세스들, 알고리즘들 등 ("엘리먼트들" 로서 총칭됨) 에 의해 다음의 상세한 설명에서 설명되고 첨부 도면들에서 예시된다. 이들 엘리먼트들은 전자 하드웨어, 컴퓨터 소프트웨어, 또는 이들의 임의의 조합을 이용하여 구현될 수도 있다. 그러한 엘리먼트들이 하드웨어 또는 소프트웨어로 구현될지 여부는 전체 시스템에 부과된 특정 애플리케이션 및 설계 제약들에 의존한다.

예시로, 엘리먼트, 또는 엘리먼트의 임의의 부분, 또는 엘리먼트들의 임의의 조합은 (프로세싱 유닛들로서 또한 지칭될 수 있는) 하나 이상의 프로세서를 포함하는 "프로세싱 시스템" 으로서 구현될 수도 있다. 프로세서들의 예는 마이크로프로세서, 마이크로제어기, 그래픽스 프로세싱 유닛 (GPU), 범용 GPU (GPGPU), 중앙 프로세싱 유닛 (CPU), 애플리케이션 프로세서, 디지털 신호 프로세서 (DSP), RISC (reduced instruction set computing) 프로세서, 시스템 온 칩 (System on Chip; SOC), 베이스대역 프로세서, 주문형 집적 회로 (ASIC), 필드 프로그램가능 게이트 어레이 (FPGA), 프로그램가능 로직 디바이스 (PLD), 상태 머신, 게이트형 로직, 이산 하드웨어 회로, 및 본 개시 전체에 걸쳐 설명된 다양한 기능성을 수행하도록 구성된 다른 적합한 하드웨어를 포함한다. 프로세싱 시스템에서 하나 이상의 프로세서들은 소프트웨어를 실행할 수도 있다. 소프트웨어는 소프트웨어, 펌웨어, 미들웨어, 마이크로코드, 하드웨어 디스크립션 언어로 지칭되든 다른 것으로 지칭되든, 명령들, 명령 세트, 코드, 코드 세그먼트, 프로그램 코드, 프로그램, 서브프로그램, 소프트웨어 컴포넌트, 애플리케이션, 소프트웨어 애플리케이션, 소프트웨어 패키지, 루틴, 서브루틴, 오브젝트, 실행물(executable), 실행의 스레드, 프로시저, 함수(function) 등을 의미하는 것으로 폭넓게 해석될 수 있다. 용어 애플리케이션은 소프트웨어를 지칭할 수도 있다. 본 명세서에 설명된 바와 같이, 하나 이상의 기법들은 하나 이상의 기능들을 수행하도록 구성되는 애플리케이션, 즉 소프트웨어를 지칭할 수도 있다. 이러한 예들에서, 애플리케이션은 메모리, 예를 들어 프로세서의 온-칩 메모리, 시스템 메모리, 또는 임의의 다른 메모리 상에 저장될 수도 있다. 프로세서와 같은 본 명세서에 설명된 하드웨어는 애플리케이션을 실행하도록 구성될 수도 있다. 예를 들어, 애플리케이션은 하드웨어에 의해 실행될 때, 하드웨어로 하여금 본 명세서에 설명된 하나 이상의 기법들을 수행하게 하는 코드를 포함하는 것으로 설명될 수도 있다. 예로서, 하드웨어는 메모리로부터 코드에 액세스하고 메모리로부터 액세스된 코드를 실행하여 본 명세서에 설명된 하나 이상의 기법들을 수행할 수도 있다. 일부 예들에서, 컴포넌트들은 본 개시에서 식별된다. 그러한 예들에서, 컴포넌트들은 하드웨어, 소프트웨어, 또는 이들의 조합일 수도 있다. 컴포넌트들은 별도의 컴포넌트들 또는 단일 컴포넌트의 서브-컴포넌트들일 수도 있다.

이에 따라, 본 명세서에 설명된 하나 이상의 예들에서, 설명된 기능들은 하드웨어, 소프트웨어, 또는 이들의 임의의 조합으로 구현될 수도 있다. 소프트웨어로 구현되는 경우, 기능들은 컴퓨터 판독가능 매체 상에 하나 이상의 명령들 또는 코드로서 저장되거나 또는 인코딩될 수도 있다. 컴퓨터 판독가능 매체는 컴퓨터 저장 매체를 포함한다. 저장 매체들은 컴퓨터에 의해 액세스될 수 있는 임의의 가용 매체들일 수도 있다. 한정이 아닌 예시로, 이러한 컴퓨터 판독가능 매체는 랜덤 액세스 메모리 (random-access memory; RAM), 판독 전용 메모리 (read-only memory; ROM), 전기적 소거가능 프로그램가능 ROM (electrically erasable programmable ROM; EEPROM), 광학 디스크 저장, 자기 디스크 저장, 다른 자기 저장 디바이스들, 전술한 타입의 컴퓨터 판독가능 매체들의 조합들, 또는 컴퓨터에 의해 액세스될 수 있는 명령들 또는 데이터 구조들 형태로 컴퓨터 실행가능 코드를 저장하는데 사용될 수 있는 임의의 다른 매체를 포함할 수 있다.

일반적으로, 본 개시는 단일 디바이스 또는 다중 디바이스들에서 그래픽스 프로세싱 파이프라인을 갖고, 그래픽 콘텐츠의 렌더링을 개선하며, 및/또는 프로세싱 유닛, 즉 GPU 와 같은, 본 명세서에 설명된 하나 이상의 기법들을 수행하도록 구성된 임의의 프로세싱 유닛의 부하를 감소시키기 위한 기법들을 설명한다. 예를 들어, 본 개시는 그래픽스 프로세싱을 활용하는 임의의 디바이스에서 그래픽스 프로세싱을 위한 기법들을 설명한다. 다른 예시의 이익들이 본 개시 전체에 걸쳐 설명된다.

본 명세서에 사용된 바와 같이, 용어 "콘텐츠" 의 인스턴스들은 "그래픽 콘텐츠", "이미지" 를 지칭할 수도 있으며, 그 역 또한 마찬가지이다. 이것은 용어들이 형용사, 명사 또는 다른 품사들로서 사용되고 있는지에 관계없이 사실이다. 일부 예들에서, 본 명세서에 사용된 바와 같이, 용어 "그래픽 콘텐츠" 는 그래픽스 프로세싱 파이프라인의 하나 이상의 프로세스들에 의해 생성된 콘텐츠를 지칭할 수도 있다. 일부 예들에서, 본 명세서에 사용된 바와 같이, 용어 "그래픽 콘텐츠" 는 그래픽스 프로세싱을 수행하도록 구성된 프로세싱 유닛에 의해 생성된 콘텐츠를 지칭할 수도 있다. 일부 예들에서, 본 명세서에 사용된 바와 같이, 용어 "그래픽 콘텐츠" 는 그래픽스 프로세싱 유닛에 의해 생성된 콘텐츠를 지칭할 수도 있다.

일부 예들에서, 본 명세서에 사용된 바와 같이, 용어 "디스플레이 콘텐츠" 는 디스플레잉 프로세싱을 수행하도록 구성된 프로세싱 유닛에 의해 생성된 콘텐츠를 지칭할 수도 있다. 일부 예들에서, 본 명세서에 사용된 바와 같이, 용어 "디스플레이 콘텐츠" 는 디스플레이 프로세싱 유닛에 의해 생성된 콘텐츠를 지칭할 수도 있다. 그래픽 콘텐츠는 디스플레이 콘텐츠가 되도록 프로세싱될 수도 있다. 예를 들어, 그래픽스 프로세싱 유닛은 프레임과 같은 그래픽 콘텐츠를 버퍼 (프레임버퍼로서 지칭될 수도 있음) 에 출력할 수도 있다. 디스플레이 프로세싱 유닛은 버퍼로부터 하나 이상의 프레임들과 같은 그래픽 콘텐츠를 판독하고, 그 상에서 하나 이상의 디스플레이 프로세싱 기법들을 수행하여 디스플레이 콘텐츠를 생성할 수도 있다. 예를 들어, 디스플레이 프로세싱 유닛은 프레임을 생성하기 위해 하나 이상의 렌더링된 계층들에 대해 합성을 수행하도록 구성될 수도 있다. 다른 예로서, 디스플레이 프로세싱 유닛은 2 이상의 계층을 단일 프레임으로 함께 구성, 블렌딩 또는 다르게는 조합하도록 구성될 수도 있다. 디스플레이 프로세싱 유닛은 프레임에 대한 스케일링, 예를 들어, 업스케일링 또는 다운스케일링을 수행하도록 구성될 수도 있다. 일부 예들에서, 프레임은 계층을 지칭할 수도 있다. 다른 예들에서, 프레임은 프레임을 형성하기 위해 이미 함께 블렌딩된 2 이상의 계층들을 지칭할 수도 있으며, 즉 프레임은 2 이상의 계층들을 포함하고, 2 이상의 계층들을 포함하는 프레임은 후속하여 블렌딩될 수도 있다.

도 1 은 본 개시의 하나 이상의 기법들을 구현하도록 구성된 예시의 콘텐츠 생성 시스템 (100) 을 도시하는 블록 다이어그램이다. 콘텐츠 생성 시스템 (100) 은 디바이스 (104) 를 포함한다. 디바이스 (104) 는 본 명세서에 설명된 다양한 기능들을 수행하기 위한 하나 이상의 컴포넌트들 또는 회로들을 포함할 수도 있다. 일부 예들에서, 디바이스 (104) 의 하나 이상의 컴포넌트들은 SOC 의 컴포넌트들일 수도 있다. 디바이스 (104) 는 본 개시의 하나 이상의 기법들을 수행하도록 구성된 하나 이상의 컴포넌트들을 포함할 수도 있다. 나타낸 예에서, 디바이스 (104) 는 프로세싱 유닛 (120), 콘텐츠 인코더/디코더 (122) 및 시스템 메모리 (124) 를 포함할 수도 있다. 일부 양태들에서, 디바이스 (104) 는 다수의 선택적 컴포넌트들, 예를 들어 통신 인터페이스 (126), 트랜시버 (132), 수신기 (128), 송신기 (130), 디스플레이 프로세서 (127), 및 하나 이상의 디스플레이들 (131) 을 포함할 수 있다. 디스플레이 (131) 에 대한 언급은 하나 이상의 디스플레이들 (131) 을 지칭할 수도 있다. 예를 들어, 디스플레이 (131) 는 단일 디스플레이 또는 다중 디스플레이들을 포함할 수도 있다. 디스플레이 (131) 는 제 1 디스플레이 및 제 2 디스플레이를 포함할 수도 있다. 제 1 디스플레이는 좌안 디스플레이이고, 제 2 디스플레이는 우안 디스플레이일 수도 있다. 일부 예들에서, 제 1 및 제 2 디스플레이는 그 상의 제시를 위해 상이한 프레임들을 수신할 수 있다. 일부 예들에서, 제 1 및 제 2 디스플레이는 그 상의 제시를 위한 동일한 프레임들을 수신할 수도 있다. 추가 예들에서, 그래픽스 프로세싱의 결과들이 디스플레이 상에 디스플레이 되지 않을 수도 있으며, 예를 들어 제 1 및 제 2 디스플레이는 그 상의 제시를 위한 임의의 프레임들을 수신하지 않을 수도 있다. 대신, 프레임들 또는 그래픽스 프로세싱 결과들이 다른 디바이스로 전송될 수도 있다. 일부 양태들에서, 이는 분할-렌더링으로 지칭될 수 있다.

프로세싱 유닛 (120) 은 내부 메모리 (121) 를 포함할 수도 있다. 프로세싱 유닛 (120) 은 그래픽스 프로세싱 파이프라인 (107) 에서와 같은, 그래픽스 프로세싱을 수행하도록 구성될 수도 있다. 콘텐츠 인코더/디코더 (122) 는 내부 메모리 (123) 를 포함할 수도 있다. 일부 예들에서, 디바이스 (104) 는 디스플레이 프로세서 (127) 와 같은 디스플레이 프로세서를 포함하여, 하나 이상의 디스플레이들 (131) 에 의한 제시 전에 프로세싱 유닛 (120) 에 의해 생성된 하나 이상의 프레임들에 대해 하나 이상의 디스플레이 프로세싱 기법들을 수행할 수도 있다. 디스플레이 프로세서 (127) 는 디스플레이 프로세싱을 수행하도록 구성될 수도 있다. 예를 들어, 디스플레이 프로세서 (127) 는 프로세싱 유닛 (120) 에 의해 생성된 하나 이상의 프레임들에 대해 하나 이상의 디스플레이 프로세싱 기법들을 수행하도록 구성될 수도 있다. 하나 이상의 디스플레이들 (131) 은 디스플레이 프로세서 (127) 에 의해 프로세싱된 프레임들을 디스플레이하거나 그렇지 않으면 제시하도록 구성될 수도 있다. 일부 예들에서, 하나 이상의 디스플레이들 (131) 은 다음 중 하나 이상을 포함할 수도 있다: 액정 디스플레이 (LCD), 플라즈마 디스플레이, 유기 발광 다이오드 (OLED) 디스플레이, 프로젝션 디스플레이 디바이스, 증강 현실 디스플레이 디바이스, 가상 현실 디스플레이 디바이스, 헤드-장착형 디스플레이 또는 임의의 다른 타입의 디스플레이 디바이스.

시스템 메모리 (124) 와 같은, 프로세싱 유닛 (120) 및 콘텐츠 인코더/디코더 (122) 외부의 메모리는, 프로세싱 유닛 (120) 및 콘텐츠 인코더/디코더 (122) 에 액세스가능할 수도 있다. 예를 들어, 프로세싱 유닛 (120) 및 콘텐츠 인코더/디코더 (122) 는 시스템 메모리 (124) 와 같은, 외부 메모리로부터 판독 및/또는 외부 메모리에 기입하도록 구성될 수도 있다. 프로세싱 유닛 (120) 및 콘텐츠 인코더/디코더 (122) 는 버스를 통해 시스템 메모리 (124) 에 통신 가능하게 커플링될 수도 있다. 일부 예들에서, 프로세싱 유닛 (120) 및 콘텐츠 인코더/디코더 (122) 는 버스 또는 상이한 연결을 통해 서로 통신가능하게 커플링될 수도 있다.

콘텐츠 인코더/디코더 (122) 는 시스템 메모리 (124) 및/또는 통신 인터페이스 (126) 와 같은, 임의의 소스로부터 그래픽 콘텐츠를 수신하도록 구성될 수도 있다. 시스템 메모리 (124) 는 수신된 인코딩 또는 디코딩된 그래픽 콘텐츠를 저장하도록 구성될 수도 있다. 콘텐츠 인코더/디코더 (122) 는 예를 들어, 시스템 메모리 (124) 및/또는 통신 인터페이스 (126) 로부터, 인코딩된 픽셀 데이터의 형태로, 인코딩 또는 디코딩된 그래픽 콘텐츠를 수신하도록 구성될 수도 있다. 콘텐츠 인코더/디코더 (122) 는 임의의 그래픽 콘텐츠를 인코딩 또는 디코딩하도록 구성될 수도 있다.

내부 메모리 (121) 또는 시스템 메모리 (124) 는 하나 이상의 휘발성 또는 비휘발성 메모리들 또는 저장 디바이스들을 포함할 수도 있다. 일부 예들에서, 내부 메모리 (121) 또는 시스템 메모리 (124) 는 RAM, SRAM, DRAM, 소거가능 프로그램가능 ROM (EPROM), 전기적 소거가능 프로그램가능 ROM (EEPROM), 플래시 메모리, 자기 데이터 매체들 또는 광학 저장 매체들, 또는 임의의 다른 타입의 메모리를 포함할 수도 있다.

내부 메모리 (121) 또는 시스템 메모리 (124) 는 일부 예들에 따른 비일시적 저장 매체일 수도 있다. 용어 "비일시적" 은 저장 매체가 캐리어 파 또는 전파된 신호로 구현되지 않음을 나타낼 수도 있다. 그러나, 용어 "비일시적" 은 내부 메모리 (121) 또는 시스템 메모리 (124) 가 이동가능하지 않거나 그 콘텐츠가 정적임을 의미하는 것으로 해석되지 않아야 한다. 일 예로서, 시스템 메모리 (124) 는 디바이스 (104) 로부터 제거되고 다른 디바이스로 이동될 수도 있다. 다른 예로서, 시스템 메모리 (124) 는 디바이스 (104) 로부터 탈착가능하지 않을 수도 있다.

프로세싱 유닛 (120) 은 중앙 프로세싱 유닛 (CPU), 그래픽스 프로세싱 유닛 (GPU), 범용 GPU (GPGPU), 또는 그래픽스 프로세싱를 수행하도록 구성될 수도 있는 임의의 다른 프로세싱 유닛일 수도 있다. 일부 예들에서, 프로세싱 유닛 (120) 은 디바이스 (104) 의 마더보드에 통합될 수도 있다. 일부 예들에서, 프로세싱 유닛 (120) 은 디바이스 (104) 의 마더보드에서의 포트에 설치되는 그래픽스 카드 상에 존재할 수도 있거나 또는 다르게는 디바이스 (104) 와 상호동작하도록 구성된 주변 디바이스 내에 통합될 수도 있다. 프로세싱 유닛 (120) 은 하나 이상의 마이크로프로세서, GPU, 주문형 집적회로 (ASIC), 필드 프로그램가능 게이트 어레이 (FPGA), 산술 로직 유닛 (ALU), 디지털 신호 프로세서 (DSP), 이산 로직, 소프트웨어, 하드웨어, 펌웨어, 다른 등가의 집적된 또는 이산 로직 회로부, 또는 이들의 임의의 조합들을 포함할 수도 있다. 기법들이 부분적으로 소프트웨어로 구현되는 경우, 프로세싱 유닛 (120) 은 적합한, 비일시적 컴퓨터 판독가능 저장 매체, 예를 들어 내부 메모리 (121) 에 소프트웨어를 위한 명령들을 저장할 수도 있고, 본 개시의 기법들을 수행하기 위해 하나 이상의 프로세서들을 사용하여 하드웨어에서 명령들을 실행할 수도 있다. 하드웨어, 소프트웨어, 하드웨어와 소프트웨어의 조합 등을 포함하여 전술한 것 중 임의의 것은 하나 이상의 프로세서들로 간주될 수도 있다.

콘텐츠 인코더/디코더 (122) 는 콘텐츠 디코딩을 수행하도록 구성된 임의의 프로세싱 유닛일 수도 있다. 일부 예들에서, 콘텐츠 인코더/디코더 (122) 는 디바이스 (104) 의 마더보드에 통합될 수도 있다. 콘텐츠 인코더/디코더 (122) 는 하나 이상의 마이크로프로세서, GPU, 주문형 집적회로 (ASIC), 필드 프로그램가능 게이트 어레이 (FPGA), 산술 로직 유닛 (ALU), 디지털 신호 프로세서 (DSP), 비디오 프로세서, 이산 로직, 소프트웨어, 하드웨어, 펌웨어, 다른 등가의 집적된 또는 또는 이산 로직 회로부, 또는 이들의 임의의 조합들을 포함할 수도 있다. 기법들이 부분적으로 소프트웨어로 구현되는 경우, 콘텐츠 인코더/디코더 (122) 는 적합한, 비일시적 컴퓨터 판독가능 저장 매체, 예를 들어 내부 메모리 (123) 에 소프트웨어를 위한 명령들을 저장할 수도 있고, 본 개시의 기법들을 수행하기 위해 하나 이상의 프로세서들을 사용하여 하드웨어에서 명령들을 실행할 수도 있다. 하드웨어, 소프트웨어, 하드웨어와 소프트웨어의 조합 등을 포함하여 전술한 것 중 임의의 것은 하나 이상의 프로세서들로 간주될 수도 있다.

일부 양태들에서, 콘텐츠 생성 시스템 (100) 은 선택적인 통신 인터페이스 (126) 를 포함할 수 있다. 통신 인터페이스 (126) 는 수신기 (128) 및 송신기 (130) 를 포함할 수도 있다. 수신기 (128) 는 디바이스 (104) 와 관련하여 본 명세서에 설명된 임의의 수신 기능을 수행하도록 구성될 수도 있다. 부가적으로, 수신기 (128) 는 다른 디바이스로부터, 정보, 예를 들어 눈 또는 헤드 포지션 정보, 렌더링 커맨드들, 또는 위치 정보를 수신하도록 구성될 수도 있다. 송신기 (130) 는 디바이스 (104) 와 관련하여 본 명세서에 설명된 임의의 송신 기능을 수행하도록 구성될 수도 있다. 예를 들어, 송신기 (130) 는 콘텐츠에 대한 요청을 포함할 수도 있는 정보를 다른 디바이스로 송신하도록 구성될 수도 있다. 수신기 (128) 및 송신기 (130) 는 트랜시버 (132) 내로 조합될 수도 있다. 이러한 예들에서, 트랜시버 (132) 는 디바이스 (104) 와 관련하여 본 명세서에 설명된 임의의 수신 기능 및/또는 송신 기능을 수행하도록 구성될 수도 있다.

다시 도 1을 참조하면, 소정의 양태들에서, 프로세싱 유닛 (120) 은 복수의 프리미티브들 각각의 가시성을 결정하도록 구성된 결정 컴포넌트 (198) 를 포함할 수 있으며, 여기서 복수의 프리미티브들 각각에 대한 복수의 인덱스들은 복수의 프리미티브들 각각의 가시성에 기초하여 수신된다. 결정 컴포넌트 (198) 는 또한 복수의 프리미티브들 각각에 대한 복수의 인덱스들을 수신하도록 구성될 수도 있다. 결정 컴포넌트 (198) 는 또한 복수의 프리미티브들 각각에 대한 복수의 인덱스들을 페치하도록 구성될 수도 있다. 결정 컴포넌트 (198) 는 또한 복수의 프리미티브 배치들 각각의 사이즈를 결정하도록 구성될 수도 있으며, 복수의 프리미티브 배치들 각각은 복수의 프리미티브들 중 적어도 하나의 프리미티브를 포함한다. 결정 컴포넌트 (198) 는 또한 복수의 프리미티브 배치들 각각의 결정된 사이즈에 기초하여, 복수의 프리미티브들을 복수의 프리미티브 배치들로 분할하도록 구성될 수도 있다. 결정 컴포넌트 (198) 는 또한, 복수의 프리미티브 배치들의 각각을 복수의 지오메트리 슬라이스들의 각각에 분배하도록 구성될 수도 있고, 복수의 지오메트리 슬라이스들의 각각은 복수의 프리미티브들 중 하나 이상의 프리미티브들을 포함한다. 결정 컴포넌트 (198) 는 또한 하나 이상의 프리미티브들을 포함하는 복수의 지오메트리 슬라이스들 각각을 프로세싱하도록 구성될 수도 있다. 결정 컴포넌트 (198) 는 또한 하나 이상의 프리미티브들을 포함하는 복수의 지오메트리 슬라이스들 각각을 셰이딩하도록 구성될 수도 있다. 결정 컴포넌트 (198) 는 또한 복수의 지오메트리 슬라이스들 중 적어도 하나가 슬라이스 순서에서 업데이트된 포지션에 대응하도록, 복수의 지오메트리 슬라이스들의 슬라이스 순서를 재배열하도록 구성될 수도 있다. 결정 컴포넌트 (198) 는 또한 복수의 지오메트리 슬라이스들의 슬라이스 순서에 기초하여 복수의 프리미티브들 각각을 래스터화하도록 구성될 수도 있다. 다음의 설명은 그래픽스 프로세싱에 초점을 맞출 수도 있지만, 본 명세서에 설명된 개념들은 다른 유사한 프로세싱 기법들에 적용가능할 수도 있다.

본 명세서에 설명된 바와 같이, 디바이스 (104) 와 같은 디바이스는 본 명세서에 설명된 하나 이상의 기법들을 수행하도록 구성된 임의의 디바이스, 장치 또는 시스템을 지칭할 수도 있다. 예를 들어, 디바이스는 서버, 기지국, 사용자 장비, 클라이언트 디바이스, 스테이션, 액세스 포인트, 컴퓨터, 예를 들어 개인용 컴퓨터, 데스크탑 컴퓨터, 랩탑 컴퓨터, 태블릿 컴퓨터, 컴퓨터 워크스테이션 또는 메인프레임 컴퓨터, 엔드 제품, 장치, 폰, 스마트 폰, 서버, 비디오 게임 플랫폼 또는 콘솔, 핸드헬드 디바이스, 예를 들어 휴대용 비디오 게임 디바이스 또는 개인용 디지털 보조기 (PDA), 웨어러블 컴퓨팅 디바이스, 예를 들어 스마트 워치, 증강 현실 디바이스 또는 가상 현실 디바이스, 비-웨어러블 디바이스, 디스플레이 또는 디스플레이 디바이스, 텔레비전, 텔레비전 셋탑 박스, 중간 네트워크 디바이스 , 디지털 미디어 플레이어, 비디오 스트리밍 디바이스, 콘텐츠 스트리밍 디바이스, 차량내 컴퓨터, 임의의 모바일 디바이스, 그래픽 콘텐츠를 생성하도록 구성된 임의의 디바이스, 또는 본 명세서에 설명된 하나 이상의 기법들을 수행하도록 구성된 임의의 디바이스일 수도 있다. 본 명세서의 프로세스는 특정 컴포넌트 (예를 들어 GPU) 에 의해 수행되는 것으로 설명될 수도 있지만, 추가 실시형태들에서는, 개시된 실시형태들과 일치하는 다른 컴포넌트들 (예를 들어 CPU) 를 사용하여 수행될 수 있다.

GPU들은 GPU 파이프라인에서 다중 타입들의 데이터 또는 데이터 패킷들을 프로세싱할 수 있다. 예를 들어, 일부 양태들에서, GPU 는 두 가지 타입의 데이터 또는 데이터 패킷들, 예를 들어, 컨텍스트 레지스터 패킷들 및 드로우 콜 데이터를 프로세싱할 수 있다. 컨텍스트 레지스터 패킷은 그래픽스 컨텍스트가 어떻게 프로세싱될지를 조절할 수 있는, 글로벌 상태 정보의 세트, 예를 들어, 글로벌 레지스터, 셰이딩 프로그램, 또는 상수 데이터에 관한 정보일 수 있다. 예를 들어, 컨텍스트 레지스터 패킷들은 컬러 포맷에 관한 정보를 포함할 수 있다. 컨텍스트 레지스터 패킷들의 일부 양태들에서, 어느 워크로드가 컨텍스트 레지스터에 속하는지를 표시하는 비트가 있을 수 있다. 또한, 동시에 및/또는 병렬로 실행되는 다중의 기능들 또는 프로그래밍이 있을 수 있다. 예를 들어, 기능들 또는 프로그래밍은 소정의 동작, 예를 들어, 컬러 모드 또는 컬러 포맷을 설명할 수 있다. 따라서, 컨텍스트 레지스터는 GPU 의 다중의 상태들을 정의할 수 있다.

컨텍스트 상태들은 개별 프로세싱 유닛이 어떻게 기능하는지, 예를 들어, 버텍스 페처 (VFD), 버텍스 셰이더 (VS), 셰이더 프로세서, 또는 지오메트리 프로세서 , 및/또는 프로세싱 유닛이 어떤 모드에서 기능하는지를 결정하기 위해 활용될 수 있다. 그렇게 하기 위해, GPU들은 컨텍스트 레지스터들 및 프로그래밍 데이터를 사용할 수 있다. 일부 양태들에서, GPU 는 모드 또는 상태의 콘텍스트 레지스터 정의에 기초하여 파이프라인에서, 워크로드, 예를 들어, 버텍스 또는 픽셀 워크로드를 생성할 수 있다. 소정의 프로세싱 유닛들, 예를 들어, VFD 는 이러한 상태들을 사용하여 소정의 기능들, 예를 들어, 버텍스가 어떻게 어셈블링되는지를 결정할 수 있다. 이들 모드들 또는 상태들이 변경될 수 있기 때문에, GPU들은 대응하는 콘텍스트를 변경할 필요가 있을 수도 있다. 또한, 모드 또는 상태에 대응하는 워크로드는 변화하는 모드 또는 상태를 따를 수도 있다.

도 2 는 본 개시의 하나 이상의 기법들에 따른 예시의 GPU (200) 를 도시한다. 도 2 에 나타낸 바와 같이, GPU (200) 는 커맨드 프로세서 (CP)(210), 드로우 콜 패킷들 (212), VFD (220), VS (222), 버텍스 캐시 (VPC)(224), 삼각형 셋업 엔진 (TSE)(226), 래스터라이저 (RAS)(228), Z 프로세스 엔진 (ZPE)(230), 픽셀 보간기 (PI)(232), 프래그먼트 셰이더 (FS)(234), 렌더 백엔드 (RB)(236), 레벨 2 (L2) 캐시 (UCHE)(238), 및 시스템 메모리 (240) 를 포함한다. 도 2 는 GPU (200) 가 프로세싱 유닛들 (220-238) 을 포함하는 것을 디스플레이하지만, GPU (200) 는 다수의 부가 프로세싱 유닛들을 포함할 수 있다.　 부가적으로, 프로세싱 유닛들 (220-238) 은 단지 예시일 뿐이며, 프로세싱 유닛들의 임의의 조합 또는 순서가 본 개시에 따른 GPU들에 의해 사용될 수 있다. GPU (200) 는 또한 커맨드 버퍼 (250), 컨텍스트 레지스터 패킷들 (260), 및 컨텍스트 상태들 (261) 을 포함한다.

도 2 에 나타낸 바와 같이, GPU 는 커맨드 버퍼를 컨텍스트 레지스터 패킷들, 예를 들어, 컨텍스트 레지스터 패킷들 (260), 및/또는 드로우 콜 데이터 패킷들, 예를 들어, 드로우 콜 패킷들 (212) 로 파싱하기 위해 CP, 예를 들어, CP (210), 또는 하드웨어 가속기를 활용할 수 있다. 그 후 CP (210) 는 GPU 에서의 프로세싱 유닛들 또는 블록들에 대한 별도의 경로들을 통해 컨텍스트 레지스터 패킷들 (260) 또는 드로우 콜 데이터 패킷들 (212) 을 전송할 수 있다. 또한, 커맨드 버퍼 (250) 는 컨텍스트 레지스터들 및 드로우 콜들의 상이한 상태들을 교번할 수 있다. 예를 들어, 커맨드 버퍼는 다음의 방식으로 구조화될 수 있다: 컨텍스트 N 의 컨텍스트 레지스터, 컨텍스트 N 의 드로우 콜(들), 컨텍스트 N+1 의 컨텍스트 레지스터, 및 컨텍스트 N+1 의 드로우 콜(들).

GPU 는 다양한 상이한 방식들로 이미지들을 렌더링할 수 있다. 일부 경우들에서, GPU들은 렌더링 및/또는 타일 렌더링을 사용하여 이미지를 렌더링할 수 있다. 타일 렌더링 GPU들에서, 이미지는 상이한 섹션들 또는 타일들로 분할되거나 분리될 수 있다. 이미지의 분할 후에, 각각의 섹션 또는 타일은 별도로 렌더링될 수 있다. 타일 렌더링 GPU들은 컴퓨터 그래픽스 이미지들을 그리드 포맷으로 분할할 수 있어서, 그리드의 각각의 부분, 즉 타일이 별도로 렌더링된다. 일부 양태들에서, 비닝 패스 동안, 이미지는 상이한 빈들 또는 타일들로 분할될 수 있다. 일부 양태들에서, 비닝 패스 동안, 가시적 프리미티브들 또는 드로우 콜들이 식별될 수 있는 가시성 스트림이 구축될 수 있다. 타일 렌더링과는 대조적으로, 직접 렌더링은 프레임을 더 작은 빈 또는 타일로 분할하지 않는다. 오히려, 직접 렌더링에서는, 전체 프레임이 한 번에 렌더링된다. 부가적으로, 일부 타입들의 GPU들은 타일 렌더링 및 직접 렌더링 양자 모두를 허용할 수 있다.

일부 양태들에서, GPU들은 상이한 빈들 또는 타일들에 드로잉 또는 렌더링 프로세스를 적용할 수 있다. 예를 들어, GPU 는 하나의 빈으로 렌더링할 수 있고, 빈 내의 프리미티브들 또는 픽셀들에 대한 모든 드로잉들을 수행할 수 있다. 빈으로 렌더링하는 프로세스 동안, 렌더 타겟들은 GMEM 에 위치될 수 있다.　 일부 경우들에서, 하나의 빈으로 렌더링한 후에, 렌더 타겟들의 콘텐츠는 시스템 메모리로 이동될 수 있고, GMEM 은 다음 빈을 렌더링하기 위해 해제될 수 있다.　 부가적으로, GPU 는 다른 빈으로 렌더링할 수 있고, 그 빈에서의 프리미티브들 또는 픽셀들에 대한 드로우들을 수행할 수 있다. 따라서, 일부 양태들에서, 하나의 표면에서의 모든 드로우들을 커버하는 작은 수의 빈들, 예를 들어, 4개의 빈이 있을 수도 있다. 또한, GPU들은 하나의 빈에서의 모든 드로우들을 통해 순환할 수 있지만, 가시적인 드로우 콜들, 즉 가시적인 지오메트리를 포함하는 드로우 콜들에 대한 드로우들을 수행할 수 있다. 일부 양태들에서, 가시성 스트림은 이미지 또는 장면에서 각각의 프리미티브의 가시성 정보를 결정하기 위해, 예를 들어, 비닝 패스(binning pass)에서 생성될 수 있다. 예를 들어, 이러한 가시성 스트림은 소정의 프리미티브가 가시적인지 여부를 식별할 수 있다. 일부 양태들에서, 이 정보는 예를 들어, 렌더링 패스에서, 가시적이지 않은 프리미티브들을 제거하는데 사용될 수 있다. 또한, 가시적인 것으로 식별되는 프리미티브들 중 적어도 일부는 렌더링 패스에서 렌더링될 수 있다.

타일 렌더링의 일부 양태들에서, 다중의 프로세싱 페이즈들 또는 패스들이 있을 수 있다. 예를 들어, 렌더링은 2개의 패스, 예를 들어, 가시성 또는 빈-가시성 패스 및 렌더링 또는 빈-렌더링 패스로 수행될 수 있다. 가시성 패스 동안, GPU 는 렌더링 워크로드를 입력하고, 프리미티브들 또는 삼각형들의 포지션들을 기록하고, 그 후 어느 프리미티브들 또는 삼각형들이 어느 빈 또는 영역에 속하는지를 결정할 수 있다. 가시성 패스의 일부 양태들에서, GPU들은 또한 가시성 스트림에서 각각의 프리미티브 또는 삼각형의 가시성을 식별하거나 마킹할 수 있다. 렌더링 패스 동안, GPU 는 가시성 스트림을 입력하고 한 번에 하나의 빈 또는 영역을 프로세싱할 수 있다. 일부 양태들에서, 가시성 스트림은 어느 프리미티브들, 또는 프리미티브들의 버텍스들이 가시적인지 또는 가시적이지 않은지를 결정하기 위해 분석될 수 있다. 이와 같이, 가시적인 프리미티브들, 또는 프리미티브들의 버텍스들이 프로세싱될 수도 있다. 그렇게 함으로써, GPU들은 가시적이지 않은 프리미티브들 또는 삼각형들을 프로세싱 또는 렌더링하는 불필요한 워크로드를 감소시킬 수 있다.

일부 양태들에서, 가시성 패스 동안, 소정 타입들의 프리미티브 지오메트리, 예를 들어, 포지션-전용 지오메트리가 프로세싱될 수도 있다. 부가적으로, 프리미티브들 또는 삼각형들의 포지션 또는 위치에 의존하여, 프리미티브들은 상이한 빈들 또는 영역들로 소팅될 수도 있다. 일부 경우들에서, 프리미티브들 또는 삼각형들을 상이한 빈들로 소팅하는 것은 이들 프리미티브들 또는 삼각형들에 대한 가시성 정보를 결정함으로써 수행될 수도 있다. 예를 들어, GPU들은 각각의 빈 또는 영역에서, 예를 들어, 시스템 메모리에서 각각의 프리미티브의 가시성 정보를 결정 또는 기입할 수도 있다. 이러한 가시성 정보는 가시성 스트림을 결정하거나 생성하는데 사용될 수 있다. 렌더링 패스에서, 각각의 빈에서의 프리미티브들은 별도로 렌더링될 수 있다. 이러한 경우들에서, 가시성 스트림은 그 빈에 대해 가시적이지 않은 프리미티브들을 드롭하는데 사용되는 메모리로부터 페치될 수 있다.

GPU들 또는 GPU 아키텍처들의 일부 양태들은 렌더링을 위한 다수의 상이한 옵션들, 예를 들어, 소프트웨어 렌더링 및 하드웨어 렌더링을 제공할 수 있다. 소프트웨어 렌더링에서, 드라이버 또는 CPU 는 각각의 뷰를 한 번 프로세싱함으로써 전체 프레임 지오메트리를 복제할 수 있다. 또한, 일부 상이한 상태들은 뷰에 의존하여 변경될 수도 있다. 이와 같이, 소프트웨어 렌더링에서, 소프트웨어는 이미지에서의 각각의 뷰포인트에 대해 렌더링하기 위해 활용될 수도 있는 일부 상태들을 변경함으로써 전체 워크로드를 복제할 수 있다. 소정의 양태들에서, GPU들이 이미지에서 각각의 뷰포인트에 대해 동일한 워크로드를 여러 번 제출하고 있을 수도 있기 때문에, 증가된 양의 오버헤드가 있을 수도 있다. 하드웨어 렌더링에서, 하드웨어 또는 GPU 는 이미지에서의 각각의 뷰포인트에 대한 지오메트리를 복제하거나 프로세싱하는 것을 담당할 수도 있다. 따라서, 하드웨어는 이미지에서의 각각의 뷰포인트에 대한 프리미티브들 또는 삼각형들의 복제 또는 프로세싱을 관리할 수 있다.

도 3 은 다중 빈들로 분할된 다중 프리미티브들을 포함하는, 이미지 또는 표면 (300) 을 도시한다. 도 3 에 나타낸 바와 같이, 이미지 또는 표면 (300) 은 프리미티브들 (321, 322, 323, 및 324) 을 포함하는 영역 (302) 을 포함한다. 프리미티브들 (321, 322, 323 및 324) 은 상이한 빈들, 예를 들어 빈들 (310, 311, 312, 313, 314 및 315) 로 분할되거나 배치된다. 도 3 은 프리미티브들 (321-324) 에 대한 다중 뷰포인트들을 사용하는 타일 렌더링의 예를 도시한다. 예를 들어, 프리미티브들 (321-324) 은 제 1 뷰포인트 (350) 및 제 2 뷰포인트 (351) 에 있다. 이와 같이, 영역 (302) 을 포함하는 이미지 또는 표면 (300) 을 프로세싱 또는 렌더링하는 GPU 는 다중 뷰포인트들 또는 멀티-뷰 렌더링을 활용할 수 있다.

본 명세서에 표시된 바와 같이, GPU들 또는 그래픽스 프로세서 유닛들은 전력 소비를 감소시키거나 메모리 대역폭을 절약하기 위해 타일 렌더링 아키텍처를 사용할 수 있다. 위에서 추가로 언급된 바와 같이, 이러한 렌더링 방법은 장면을 다중 빈들로 분할할 수 있을 뿐만 아니라, 각각의 빈에서 가시적인 삼각형들을 식별하는 가시성 패스를 포함할 수 있다. 따라서, 타일 렌더링에서, 전체 스크린은 다중 빈들 또는 타일들로 분할될 수 있다. 장면은 그 후 여러 번, 예를 들어, 각각의 빈에 대해 한 번 이상 렌더링될 수 있다.

그래픽 렌더링의 양태들에서, 일부 그래픽스 애플리케이션들은 단일 타겟, 즉 렌더 타겟으로 한 번 이상 렌더링할 수도 있다. 예를 들어, 그래픽스 렌더링에서, 시스템 메모리 상의 프레임 버퍼는 여러 번 업데이트될 수도 있다. 프레임 버퍼는 GPU 에 대한 디스플레이 데이터를 저장하는 것을 돕기 위해, 예를 들어, 비트맵 또는 스토리지를 포함하는 메모리 또는 랜덤 액세스 메모리 (RAM) 의 부분일 수 있다. 프레임 버퍼는 또한 데이터의 완전한 프레임을 포함하는 메모리 버퍼일 수 있다. 또한, 프레임 버퍼는 논리 버퍼일 수 있다. 일부 양태들에서, 프레임 버퍼를 업데이트하는 것은 빈 또는 타일 렌더링에서 수행될 수 있으며, 여기서, 위에 논의된 바와 같이, 표면은 다중 빈들 또는 타일들로 분할되고, 그 후 각각의 빈 또는 타일이 개별적으로 렌더링될 수 있다. 또한, 타일 렌더링에서, 프레임 버퍼는 다중 빈들 또는 타일들로 파티셔닝될 수 있다.

그래픽스 프로세싱의 일부 양태들에서, GPU 하드웨어는 다중 섹션들, 예를 들어 지오메트리 프로세싱을 위한 하드웨어 및 픽셀 프로세싱을 위한 하드웨어로 분할될 수도 있다. 다양한 마켓 세그먼트들에 걸쳐 상이한 쓰루풋들을 충족하기 위해 스케일러블 GPU 하드웨어가 바람직할 수도 있다. 또한, 일부 양태들에서, 픽셀 프로세싱을 위한 스케일러블 하드웨어는 다양한 방식들로 설계될 수도 있다. 예를 들어, 스크린은 상이한 부분들로 분할될 수 있고, 다중 픽셀 프로세싱 하드웨어 모듈들 (즉, 슬라이스들) 은 스크린의 상이한 부분들에서 독립적으로 작동할 수도 있다. 픽셀 슬라이스들의 수를 변경함으로써, 상이한 티어들에 대해 스케일러블 쓰루풋이 달성될 수도 있다. 그러나, 스케일러블 지오메트리 프로세싱 하드웨어를 설계하는 것은 독립적으로 작동하는 하드웨어 모듈들 (즉, 지오메트리 슬라이스들) 에 걸쳐 워크로드를 균등하게 분배하는 고유한 과제를 갖는다.

스케일러블 지오메트리 프로세싱 하드웨어를 설계할 때 직면될 수도 있는 많은 쟁점들이 있다. 예를 들어, 지오메트리 파이프라인의 중간에서 드로우콜(drawcall)(즉, 작업 유닛) 의 가변 사이즈 및 적응적 워크로드 확장은 스케일러블 지오메트리 프로세싱 하드웨어를 설계할 때 발생할 수도 있는 일부 쟁점들이다. 상이한 드로우콜들에 걸친 워크로드들은 달라질 수도 있으서, 각각의 드로우콜을 지오메트리 슬라이스에 연결하면 불균일한 데이터 다운스트림을 생성할 수도 있다. 이와 별도로, 애플리케이션 프로그램 인터페이스 (API) 는 지오메트리 파이프라인이 상이한 특징들, 예를 들어, 테셀레이션, 지오메트리 셰이딩, 및/또는 삼각형 컬링을 통해 적응적 워크로드 확장/감소를 지원할 수도 있음을 특정할 수도 있다.

도 4 는 GPU 에서의 예시의 지오메트리 파이프라인을 도시하는 다이어그램 (400) 이다. 도 4 에 도시된 바와 같이, 다이어그램 (400) 은 드로우콜 디스패치 (410), 인덱스 페치 (412), 가시성 핸들링 단계 (414), 프리-버텍스 셰이더 인덱스 캐시 (416), 캐시 누락된 인덱스의 속성 페치 (418), 버텍스 셰이더 (420), 헐 셰이더 (422), 테셀레이터 (424), 프리-도메인 셰이더 인덱스 캐시 (426), 도메인 셰이더 (428), 프리미티브 어셈블리 (430), 지오메트리 셰이더 (432), 및 삼각형 셋업 래스터화 (434) 를 포함한다. 도 4 에 나타낸 바와 같이, 인덱스 페치 (412) 후에, 각각의 프리미티브는 다중 프리미티브들을 생성하도록 확장될 수도 있으며, 여기서 증폭 팩터는 런-타임 동안 결정될 수도 있다. 이와 같이, 증폭 팩터를 고려하지 않으면서 상이한 모듈들에 프리미티브들을 전송하는 것은 다운스트림 파이프라인에서 동일하지 않은 워크로드를 생성할 수도 있다. 따라서, 이는 최적의 쓰루풋의 달성을 방지할 수도 있다.

스케일러블 지오메트리 프로세싱 하드웨어를 설계할 때 직면될 수도 있는 다른 쟁점은 다중 지오메트리 슬라이스들에 걸친 가시성 핸들링 (예를 들어, 타일링된 렌더링) 이다. 위에 나타낸 바와 같이, 타일-기반 렌더링에서, 스크린은 다중 빈들로 분할되고, 비닝 패스는 빈당 가시성 스트림 (즉, 빈에서 가시적인 것으로서 식별될 수도 있는 프리미티브들) 을 생성하는데 사용된다. 또한, 가시성 스트림은 전체 스크린을 렌더링하기 위해 다중 빈-렌더링 패스들 (예를 들어, 프로세싱으로부터 가시적이지 않은 프리미티브들을 드롭함) 에서 사용될 수도 있다. 프리미티브들의 상이한 가시성들 때문에, 각각의 빈-렌더링 패스에서의 워크로드 패턴은 비닝 패스와 상당히 다를 수도 있다. 워크로드 분배 스킴은 (증폭을 포함하는) 균일한 워크로드가 (가시성에서의 잠재적인 디스패리티를 설명할 때에도) 각각의 지오메트리 슬라이스에 분배되는 것을 보장할 필요가 있을 수도 있다.

스케일러블 지오메트리 프로세싱 하드웨어를 설계할 때 직면될 수도 있는 다른 쟁점은 프리미티브 재시작 인덱스 또는 컷 인덱스를 지원하기 위한 API 사양이다. 일부 경우들에서, API (예를 들어, OpenGL 또는 DirectX) 는 프리미티브 재시작을 지원하기 위해 하드웨어를 활용할 수도 있다. 또한, 프리미티브 재시작은 애플리케이션 개발자들이 드로우콜 중간에 현재 메시를 정지하고 임의적인 인덱스로부터 새로운 메시를 재시작할 수 있도록 한다. 이는 스케일러블 지오메트리 프로세싱 하드웨어를 설계하는데 있어서 과제를 생성할 수 있는데, 이는 작업 분배 로직이 새로운 메시가 시작하는 임의적인 위치를 인식할 필요가 있을 수도 있기 때문이다.

상기에 기초하여, 독립적으로 작동하는 하드웨어 모듈들에 걸쳐 GPU 워크로드를 균등하게 분배하는 것이 유리할 수도 있다. 상이하게 사이징된 드로우콜들 및/또는 적응적 워크로드 확장들을 위한 스케일러블 지오메트리 프로세싱 하드웨어를 제공하는 것이 또한 유리할 수도 있다. 또한, 다중 지오메트리 슬라이스들에 걸쳐 가시성 핸들링 또는 타일 렌더링을 위한 스케일러블 지오메트리 프로세싱 하드웨어를 제공하는 것이 유리할 수도 있다. 프리미티브 재시작을 지원하기 위해 스케일러블 지오메트리 프로세싱 하드웨어를 제공하는 것이 또한 유리할 수도 있다.

본 개시의 양태들은 독립적으로 작동하는 하드웨어 모듈들에 걸쳐 GPU 워크로드를 균등하게 분배할 수도 있다. 본 개시의 양태들은 또한 상이하게 사이징된 드로우콜들 및/또는 적응적 워크로드 확장들을 위한 스케일러블 지오메트리 프로세싱 하드웨어를 제공할 수도 있다. 또한, 본 개시의 양태들은 다중 지오메트리 슬라이스들에 걸쳐 가시성 핸들링 또는 타일 렌더링을 위한 스케일러블 지오메트리 프로세싱 하드웨어를 제공할 수도 있다. 본 개시의 양태들은 또한 프리미티브 재시작을 지원하기 위해 스케일러블 지오메트리 프로세싱 하드웨어를 제공할 수도 있다.

본 명세서에 나타낸 바와 같이, 본 개시의 양태들은 가변적으로 사이징된 드로우콜들 및/또는 적응적 워크로드 확장들을 허용하는 지오메트리 파이프라인들을 포함할 수도 있다. 이들 지오메트리 파이프라인들은 다수의 상이한 특징들, 예컨대 중앙집중식 인덱스 페치, 인덱스 분배 이전의 가시성 핸들링, 및/또는 다수의 지오메트리 슬라이스들, 예를 들어, N 지오메트리 슬라이스들에 대한 인덱스 분배를 포함할 수도 있다. 일부 경우들에서, 이는 독립적인 셰이더 동작 또는 다수의 지오메트리 슬라이스들, 예를 들어, N 지오메트리 슬라이스들에 걸친 프리미티브들의 재정렬, 및/또는 삼각형 셋업 엔진 또는 래스터라이저 유닛으로의 송신을 포함할 수도 있다.

본 개시의 양태들에서의 지오메트리 아키텍처에서, 인덱스 페치는 중앙집중화될 수도 있다. 또한, 인덱스들은 드로우콜에서 프리미티브 타입에 기초하여 페치될 수도 있다. 일부 양태들에서, 순차적 인덱스 페치는 소정 양의 지오메트리 슬라이스들, 예를 들어, N 지오메트리 슬라이스들의 워크로드 사양을 지원하도록 쉽게 스케일링가능할 수도 있다. 이와 같이, 본 개시의 양태들은 가시성 체크 후에 워크로드 분배를 가능하게 할 수도 있는 중앙집중식 인덱스 페치 및 분배 아키텍처를 포함할 수도 있다. 그렇게 함으로써, 이는 다수의 가시성 프리미티브들을 포함하는 워크로드의 공정한 분배를 생성할 수도 있다. 이는 프리미티브들의 가시성이 워크로드에서 불균형을 생성할 수도 있는 분배된 인덱스 페치 아키텍처들에 비해 본 개시에 대한 장점이다.

본 개시의 양태들은 또한 다수의 지오메트리 슬라이스들, 예를 들어, N 지오메트리 슬라이스들에 대한 인덱스 분배를 허용할 수도 있다. 일부 경우들에서, 코어 지오메트리 파이프라인 (예를 들어, 프리-버텍스 셰이더 인덱스 캐시, 테셀레이터, 프리-도메인 셰이더 인덱스 캐시, 또는 프리미티브 어셈블리) 은 소정 쓰루풋, 예를 들어 N 프리미티브들/clk 의 쓰루풋을 달성하기 위해, 소정 양의 시간들, N 시간들로 인스턴스화될 수도 있다. 또한, 중앙집중식 인덱스 분배기는 로드 밸런싱된 방식으로 다중 슬라이스들에 워크로드를 분배할 수도 있다. 여기서, 로드 밸런스는 각각의 지오메트리 슬라이스에서 액티브 프리미티브 배치들을 추적할 수도 있는 중앙집중식 인덱스 분배기에 의해 달성될 수도 있다. 또한, 쓰르풋 변환을 지원하기 위해, 각각의 슬라이스에 쓰루풋 변환 버퍼가 부착될 수도 있다.

도 5 는 본 개시의 하나 이상의 기법들에 따른 예시의 프리미티브 배치 분배 프로세스를 도시하는 다이어그램 (500) 이다. 보다 구체적으로, 도 5 의 다이어그램 (500) 은 다중 지오메트리 슬라이스들에 대한 예시의 프리미티브 배치 분배를 도시한다. 다이어그램 (500) 은 복수의 프리미티브들 (예를 들어, p1, p2, pN-1, pN, pN+1, pN+2, p2N, p2N+1, p2N+2, p3N 등), 인덱스 분배기 (520), 다중 배치들, 예를 들어, 배치 (530), 배치 (531), 배치 (532) 에서의 다수의 프리미티브들, 및 다중 지오메트리 슬라이스들, 예를 들어, 슬라이스 (540), 슬라이스 (541), 슬라이스 (542) 를 포함하는 프리미티브 워크로드 (510) 를 포함한다. 예를 들어, 인덱스 분배기 (520) 는 프리미티브 워크로드 (510) 를 다중 지오메트리 슬라이스들, 예를 들어, 슬라이스 (540), 슬라이스 (541), 슬라이스 (542) 에 순서대로 분배할 수도 있다. 도 5 는 분배가 로드 밸런싱된 방식일 수도 있음을 나타낸다.

도 5 에 나타낸 바와 같이, 본 개시의 양태들은 프리미티브들의 독립적인 배치들을 생성하고, 이들 배치들을 상이한 지오메트리 슬라이스들에 전송할 수도 있다. 배치 사이즈는 예컨대, 드로우콜에 존재하는 워크로드의 타입에 기초하여 각각의 드로우콜에 대해 달라질 수도 있다. 또한, 각각의 배치는 시작 표시 및 종료 표시를 가질 수도 있다. 시작 표시는 지오메트리 슬라이스에서 프레시 배치를 시작하기 위한 정보 (즉, 소정 변수들의 초기 값들) 를 반송할 수도 있다. 종료 표시는 다음 배치가 전송될 위치에 관한 정보를 반송할 수도 있다. 배치들은 배치 정보의 종료에 기초하여 파이프라인을 따라 아래로 재정렬될 수도 있다.

본 개시의 일부 양태들에서, 적응적 워크로드 확장 경우들 (예를 들어, 지오메트리 셰이더 및 테셀레이션) 에 대해, 제안된 분배 알고리즘은 워크로드들이 균등하게 분배되는 것을 보장하는데 효율적일 수도 있다. 멀티-패스 테셀레이션 솔루션으로의 일부 테셀레이션 워크로드들에서, 제 1 패스 알고리즘은 입력/출력 제어 포인트들에 의존하여 배치 사이즈를 조정함으로써 헐 셰이더 워크로드가 지오메트리 슬라이스들 중에서 균등하게 분배되는 것을 보장할 수도 있다. 제 2 패스 알고리즘은 패치당 증폭을 결정할 수도 있고 패치를 동일한 슬라이스 또는 다중 슬라이스들에 분배할 수도 있다. 각각의 슬라이스는 중앙집중식 분배기에 의해 표시된 바와 같이 패치의 별도의 부분들 상에서 독립적으로 작동할 수도 있다. 또한, 본 개시의 양태들은 크로스바 포스트-테셀레이션 스테이지를 필요로 하지 않을 수도 있다. 부가적으로, 지오메트리 셰이더 경우들에 대해, 본 개시의 일부 알고리즘들은 프리미티브 분배 동안 워크로드 확장을 고려할 수도 있다. 또한, 이러한 알고리즘들은 입력 프리미티브 배치 사이즈를 적응적으로 변경할 수도 있다.

도 6 은 본 개시의 하나 이상의 기법들에 따른 GPU 에서의 예시의 지오메트리 파이프라인을 도시하는 다이어그램 (600) 이다. 도 6 에 나타낸 바와 같이, 다이어그램 (600) 은 드로우콜 디스패치 (610), 중앙집중식 인덱스 페치 (612), 가시성 핸들링 단계 (614), 인덱스 분배기 (616), 쓰루풋 변환 버퍼 (620), 프리-버텍스 셰이더 인덱스 캐시 (622), 캐시 누락된 인덱스의 속성 페치 (624), 버텍스 셰이더 (626), 프리미티브 어셈블리 (628), 지오메트리 셰이더 (629), 프리미티브 재정렬 단계 (640), 및 삼각형 셋업 래스터화 (650) 를 포함한다. 다이어그램 (600) 은 또한 다수의 지오메트리 슬라이스들, 예를 들어, 슬라이스 (630), 슬라이스 (631), 및 슬라이스 (630+N) 를 포함한다.

구체적으로, 다이어그램 (600) 은 버텍스 셰이더 (VS) 모드 또는 지오메트리 셰이더 (GS) 모드에 대한 지오메트리 파이프라인을 포함한다. 예를 들어, 다이어그램 (600) 은 버텍스 셰이더 인에이블된 워크로드 (즉, 일대일 매핑된 변환) 를 포함한다. 도 6 에 나타낸 바와 같이, VS 인에이블된 워크로드에 대해, 배치 사이즈는 성능과 영역 사이의 트레이드-오프일 수도 있다. 예를 들어, 더 작은 배치 사이즈는 전반적인 캐시 적중률의 감소를 초래할 수도 있다. 그러나, 더 큰 배치 사이즈는 또한 더 큰 재정렬 버퍼 및/또는 쓰루풋 변환 버퍼를 필요로 할 수도 있다.

도 7a 및 도 7b 는 본 개시의 하나 이상의 기법들에 따른 GPU 에서의 예시의 지오메트리 파이프라인을 각각 도시하는 다이어그램들 (700 및 750) 이다. 도 7a 에 나타낸 바와 같이, 다이어그램 (700) 은 드로우콜 디스패치 (710), 중앙집중식 인덱스 페치 (712), 가시성 핸들링 단계 (714), 인덱스 분배기 (716), 속성 페치 (720), 버텍스 셰이더 (722), 헐 셰이더 (724), 및 시스템 메모리 (740) 를 포함한다. 다이어그램 (700) 은 또한 다중 지오메트리 슬라이스들, 예를 들어 슬라이스 (730), 슬라이스 (731), 및 슬라이스 (730+N) 을 포함한다. 도 7b 에 나타낸 바와 같이, 다이어그램 (750) 은 드로우콜 디스패치 (710), 중앙집중식 인덱스 페치 (712), 인덱스 분배기 (716), 시스템 메모리 (740), 테셀레이션 프로세싱 단계 (760), 테셀레이터 (770), 프리-도메인 셰이더 인덱스 캐시 (772), 도메인 셰이더 (774), 프리미티브 어셈블리 (776), 프리미티브 재정렬 단계 (790), 및 삼각형 셋업 래스터화 (792) 를 포함한다. 다이어그램 (750) 은 또한 다수의 지오메트리 슬라이스들, 예를 들어, 슬라이스 (780), 슬라이스 (781), 및 슬라이스 (780+N) 를 포함한다.

다이어그램들 (700 및 750) 은 버텍스 셰이더 (VS)-헐 셰이더 (HS)(VS-HS) 모드 또는 도메인 셰이더 (DS) 모드에 대한 지오메트리 파이프라인을 디스플레이한다. 도 7a 의 다이어그램 (700) 은 지오메트리 파이프라인의 제 1 패스 (패스 1) 에 대응하고, 도 7b 의 다이어그램 (750) 은 지오메트리 파이프라인의 제 2 패스 (패스 2) 에 대응한다. 도 7a 및 도 7b 에 나타낸 바와 같이, 병합된 셰이더에서, 동일한 셰이더 하드웨어가 순차적 방식으로 VS-HS 및 DS 워크로드들을 프로세싱하는데 사용될 수도 있다. 도 7a 에 나타낸 바와 같이, 제 1 패치들은 버텍스 셰이더 다음 헐 셰이더에서 프로세싱될 수 있고 (즉, 패스 1), 다수의 팩터들, 예를 들어, 패치 상수 팩터들, 출력 제어 포인트 (OCP) 팩터들, 또는 테셀레이션 팩터들이 메모리에 기입될 수도 있다. 도 7b 에 나타낸 바와 같이, 패스 2 에서, 테셀레이션 팩터들이 페치되고, 테셀레이터 블록 (예를 들어, 특정된 고정 하드웨어 알고리즘) 에 피드되어 프리미티브들을 생성할 수도 있다. 다음으로, 프리미티브들은 캐시-체크되고 도메인 셰이더 (DS) 에 전송될 수도 있다.

도 7a 및 도 7b 에 나타낸 바와 같이, 중앙집중식 배치 분배는 패스 1 (예를 들어, VS-HS 모드) 에 대한 패치 레벨 입도 및 패스 2 (예를 들어, DS 모드) 에 대한 프리미티브 레벨 입도로 별도로 수행될 수도 있다. HS 워크로드에 대해, 배치 사이즈는 패치들 마다의 제어 포인트들의 수 및 웨이브 사이즈 (즉, 셰이더 워크로드의 입도) 를 입력/출력하도록 정렬될 수도 있다. DS 워크로드에 대해, 배치 사이즈는 성능과 영역 사이의 트레이드-오프일 수도 있다. 예를 들어, 각각의 지오메트리 슬라이스는 독립적으로 테셀레이션 프로세스를 수행할 수 있다.

일부 양태들에서, 균일하지 않은 워크로드의 분배를 핸들링하기 위해, 패치의 테셀레이션 팩터들이 페치될 수도 있고 패치 당 서브-프리미티브들의 총 수가 계산될 수도 있다. 패치 (즉, 테셀레이션 팩터들) 는 예컨대, 증폭으로부터 생성될 배치들의 수에 기초하여, 슬라이스 당 하나의 배치로 다중 지오메트리 슬라이스들에 전송될 수도 있다. 테셀레이션 팩터들과 함께, 다중 파라미터들은, 예를 들어, 프리미티브 오프셋 파라미터 및 연속적인 프리미티브들의 스팬에 대한 파라미터가 각각의 지오메트리 슬라이스에 전송될 수도 있다. 프리미티브 오프셋 파라미터는 패치 내부의 테셀레이팅된 서브-프리미티브의 시작 지점을 표시할 수도 있다. 일부 경우들에서, 동일한 패치는, 예컨대 상이한 오프셋 값들로, 동일한 지오메트리 슬라이스에 한번 보다 많이 전송될 수도 있다. 또한, 프리미티브 인덱스 기반 테셀레이터는, 예를 들어, 패치에 대한 인커밍 프리미티브 오프셋에 기초하여, 임의의 출력 프리미티브를 생성하기 위해 모든 일반 프로세싱 클러스터 (GPC) 슬라이스에서 사용될 수도 있다.

도 8 은 본 개시의 하나 이상의 기법들에 따른 예시의 테셀레이션의 방법의 플로우챠트 (800) 이다. 도 8 에 나타낸 바와 같이, 다이어그램 (800) 은 단계들 (810, 820, 830, 840, 850, 및 860) 을 포함한다. 단계 (810) 에서, 본 개시의 양태들은 테셀레이션 프로세스에 입력을 제공할 수도 있다. 단계 (820) 에서, 본 개시의 양태들은 패치의 상대적 프리미티브 식별자들 (ID들) 을 생성할 수도 있다. 단계 (830) 에서, 본 개시의 양태들은 패치에서의 고유한 미리정의된 영역의 상대적 프리미티브 ID들을 매핑할 수도 있다. 단계 (840) 에서, 본 개시의 양태들은 프리미티브의 상대적 인덱스들을 계산할 수도 있다. 단계 (850) 에서, 본 개시의 양태들은 프리미티브의 각각의 인덱스의 글로벌 인덱스를 계산할 수도 있다. 단계 (860) 에서, 본 개시의 양태들은 최종 인덱스들을 계산하기 위해 API 특정된 함수를 사용할 수도 있다.

도 9 는 본 개시의 하나 이상의 기법들에 따른 프리미티브들의 패치의 예시의 테셀레이션 프로세스를 도시하는 다이어그램 (900) 이다. 도 9 에 나타낸 바와 같이, 다이어그램 (900) 은 테셀레이션 프로세스를 위한 출력 프리미티브들을 갖는 쿼드 패치를 포함한다. 다이어그램 (900) 은 다수의 패치 섹션들, 예를 들어, 상단 섹션 (910), 좌측 섹션 (911), 우측 섹션 (912), 하단 섹션 (913), 상단 좌측 섹션 (914), 상단 우측 섹션 (915), 하단 좌측 섹션 (916), 하단 우측 섹션 (917), 및 중간 섹션 (918) 을 포함한다. 도 9 에 나타낸 바와 같이, 다이어그램 (900) 에서 쿼드 패치에 대해 식별되는 총 9개의 고유 영역들이 있다. 영역 당 프리미티브들의 총 수는 입력 파라미터들에 의존할 수도 있다. 또한, 웍크(walk) 패턴에 의존하여, 영역들은 연속적으로, 즉, 차례로 선정될 수도 있다. 제안된 알고리즘은 임의의 타입의 테셀레이션 보행 패턴에 대해 사용될 수도 있다.

일부 경우들에서, 본 개시의 양태들은 패치에서의 고유 영역에 상대적 프리미티브 ID 를 매핑할 수도 있다. 예를 들어, 이는 다음 코드로 표현될 수도 있다:

일부 양태들에서, 영역 프리미티브 인덱스 (region_prim_idx) 가 계산되면, 최종 인덱스들은 기존 솔루션을 사용하여 계산될 수도 있다. 프리미티브 배치들이 셰이더에서 프로세싱되면, 이들은 각각의 배치의 종료에 첨부된 정보에 기초하여 재정렬되고, 추가 프로세싱을 위해 다운스트림으로 전송될 수도 있다. 본 개시의 양태들은 또한 지오메트리 셰이더 (즉, 균일한 증폭된 변환) 인에이블된 워크로드를 포함할 수도 있다. 예를 들어, 증폭을 고려하여, 각각의 프리미티브는 시작 인덱스를 표시할 수도 있는, 적절한 오프셋 포인트로 지오메트리 슬라이스들을 분리하기 위해 전송될 수도 있다. 헐 셰이더와 유사하게, 지오메트리 셰이더에 대해, 배치 사이즈는 지오메트리 셰이더 증폭 및 웨이브 사이즈 (즉, 셰이더 워크로드의 입도) 에 정렬될 수도 있다.

도 10 은 본 개시의 하나 이상의 기법들에 따른 지오메트리 파이프라인에서의 예시의 지오메트리 셰이더 프로세싱을 도시하는 다이어그램 (1000) 이다. 도 10 에 나타낸 바와 같이, 다이어그램 (1000) 은 다중 웨이브들, 예를 들어, 웨이브 [n] 및 웨이브 [n+1], 및 다중 지오메트리 슬라이스들, 예를 들어 지오메트리 슬라이스 [m] 및 지오메트리 슬라이스 [m+1] 을 포함한다. 다이어그램 (1000) 은 또한 다중 프리미티브들, 예를 들어, 프리미티브 (1010), 프리미티브 (1011), 프리미티브 (1012) 및 프리미티브 (1013) 를 포함한다. 도 10 에 나타낸 바와 같이, 웨이브들 각각은, 예를 들어, 웨이브 [n] 및 웨이브 [n+1] 은 상이한 지오메트리 슬라이스, 예를 들어, 지오메트리 슬라이스 [m] 및 지오메트리 슬라이스 [m+1] 에 전송되고, 병렬로 프로세싱될 수도 있다. 일부 양태들에서, 스케일러블 지오메트리 파이프라인 없이, 소정의 프리미티브들은 다중 웨이브들에 걸쳐 스트레칭될 수도 있으며, 이는 연속적으로 프로세싱된다. 또한, 지오메트리 셰이더 프로세싱의 시작 포지션을 표시하기 위해, 각각의 웨이브에 대한 각각의 프리미티브로 추가 오프셋 정보가 전송될 수도 있다.

본 개시의 양태들은 지오메트리 셰이더 프리미티브들에 대한 상이한 분배 로직을 포함할 수도 있다. 예를 들어, 지오메트리 셰이더 프리미티브들에 대한 일부 분배 로직은 다음의 코드에 의해 표현될 수도 있다:

본 개시의 양태들은 또한 다중 지오메트리 슬라이스들에 걸쳐 가시성 핸들링 (예를 들어, 타일 렌더링) 을 포함할 수도 있다. 일부 경우들에서, 중앙 인덱스 페치는 인덱스가 지오메트리 슬라이스들에 분배되기 전에 가시성 스트림 기반 프리미티브 드롭핑 (즉, 빈 렌더링 패스) 을 지원할 수도 있다. 따라서, 가시적인 프리미티브들은 유효한 워크로드로서 간주될 수도 있고, 정상적인 실행을 위한 워크로드 분배 스킴에 적합할 수도 있다.

부가적으로, 본 개시의 양태들은 프리미티브 재시작을 지원할 수도 있다. 중앙 인덱스 페치에서, 모든 페치된 인덱스들은 재시작 인덱스의 존재에 대해 체크될 수도 있다. 발견되는 경우, 후속 프리미티브들은 드로우콜의 종료까지 동일한 지오메트리 슬라이스에 전송될 수 있고, 프리미티브 프로세싱은 단일 슬라이스 출력으로 스케일 다운될 수도 있다. 이는 재시작 인덱스 핸들링의 오버헤드가 제거되는 것을 보장할 수도 있다. 본 개시의 양태들에서, 중앙집중식 인덱스 페치 및 분배는 API 힌트 없이 및/또는 임의의 리던던트 인덱스 페치들 없이 재시작 인덱스 경우들을 동적으로 핸들링하는 것을 허용할 수도 있다.

본 명세서에 나타낸 바와 같이, 본 개시의 양태들은 다수의 이익들 및 이점들을 포함할 수도 있다. 예를 들어, 본 개시의 제안된 스케일러블 지오메트리 파이프라인 아키텍처로, 다중 지오메트리 슬라이스들을 프로세싱 (즉, 다중 프리미티브들/clk 를 지원) 하기 위한 성능 이점이 있을 수도 있다. 예를 들어, 본 개시의 양태들은 다중 지오메트리 슬라이스들을 프로세싱할 때, 소정의 성능 이득, 예를 들어, 2.61% 이득, 2.80% 이득, 또는 8.50% 이득을 경험할 수도 있다.

도 11 은 본 개시의 하나 이상의 기법들에 따른 그래픽스 프로세싱의 통신 플로우 다이어그램 (1100) 이다. 도 11 에 나타낸 바와 같이, 다이어그램 (1100) 은 본 개시의 하나 이상의 기법들에 따른, GPU 파이프라인 (1102), GPU 컴포넌트 (1104), 메모리 또는 디스플레이 (1106) 사이의 예시의 통신들을 포함한다.

1110 에서, GPU 파이프라인 (1102) 은 복수의 프리미티브들 각각의 가시성을 결정할 수도 있고, 여기서 복수의 프리미티브들 각각에 대한 복수의 인덱스들은 복수의 프리미티브들 각각의 가시성에 기초하여 수신된다.

1120 에서, GPU 파이프라인 (1102) 은 복수의 프리미티브들 각각에 대한 복수의 인덱스들, 예를 들어, 인덱스들 (1122) 을 수신할 수도 있다. 장치는 또한 복수의 프리미티브들 각각에 대한 복수의 인덱스들, 예를 들어 인덱스들 (1122) 을 페치할 수도 있다. 예를 들어, 복수의 프리미티브들 각각에 대한 복수의 인덱스들, 예를 들어, 인덱스들 (1122) 을 수신하는 것은 복수의 프리미티브들 각각에 대한 복수의 인덱스들을 페치하는 것을 포함할 수도 있다. 일부 경우들에서, 복수의 인덱스들 각각은 프리미티브 재시작 인덱스와 연관될 수도 있다. 또한, 복수의 지오메트리 슬라이스들 각각에 대한 복수의 프리미티브 배치들 각각의 분배는 복수의 인덱스들 각각과 연관된 프리미티브 재시작 인덱스에 기초할 수도 있다.

1130 에서, GPU 파이프라인 (1102) 은 복수의 프리미티브 배치들 각각의 사이즈를 결정할 수도 있으며, 복수의 프리미티브 배치들 각각은 복수의 프리미티브들 중 적어도 하나의 프리미티브를 포함한다. 일부 양태들에서, 복수의 프리미티브 배치들 각각의 사이즈는 적어도 하나의 드로우콜의 사이즈, 적어도 하나의 작업 아이템의 사이즈, 또는 복수의 프리미티브들 중 적어도 하나의 프리미티브의 사이즈에 대한 조정 중 적어도 하나에 기초하여 결정될 수도 있다. 또한, 복수의 프리미티브 배치들 각각의 사이즈는 하나 이상의 테셀레이션 팩터들, 적어도 하나의 프리미티브 오프셋, 또는 하나 이상의 연속적인 프리미티브들의 스팬(span) 중 적어도 하나를 포함하는 하나 이상의 파라미터들에 기초할 수도 있다. 또한, 복수의 프리미티브 배치들 각각은 시작 표시 및 종료 표시를 포함할 수도 있으며, 시작 표시는 프리미티브 배치의 시작에 대응하고 종료 표시는 프리미티브 배치의 종료에 대응한다.

1140 에서, GPU 파이프라인 (1102) 은 복수의 프리미티브 배치들 각각의 결정된 사이즈에 기초하여, 복수의 프리미티브들을 복수의 프리미티브 배치들로 분할할 수도 있다.

1150 에서, GPU 파이프라인 (1102) 은 복수의 프리미티브 배치들 각각을 복수의 지오메트리 슬라이스들 각각에 분배할 수도 있고, 복수의 지오메트리 슬라이스들 각각은 복수의 프리미티브들 중 하나 이상의 프리미티브들을 포함한다.

1160 에서, GPU 파이프라인 (1102) 은 하나 이상의 프리미티브들을 포함하는 복수의 지오메트리 슬라이스들 각각을 프로세싱할 수도 있다. 장치는 또한 하나 이상의 프리미티브들을 포함하는 복수의 지오메트리 슬라이스들 각각을 셰이딩할 수도 있다. 예를 들어, 복수의 지오메트리 슬라이스들 각각을 프로세싱하는 것은 하나 이상의 프리미티브들을 포함하는 복수의 지오메트리 슬라이스들 각각을 셰이딩하는 것을 포함할 수도 있다. 일부 경우들에서, 복수의 지오메트리 슬라이스들 각각은 버텍스 셰이더, 지오메트리 셰이더, 도메인 셰이더, 또는 테셀레이터 중 적어도 하나에 의해 프로세싱될 수도 있다. 테셀레이터는 복수의 지오메트리 슬라이스 각각에 대한 지오메트리를 프로세싱하도록 구성될 수도 있다. 또한, 테셀레이터는 프리미티브 인덱스 기반 테셀레이터일 수도 있다.

일부 양태들에서, 복수의 지오메트리 슬라이스들은 슬라이스 순서로 배열될 수도 있고, 여기서 복수의 지오메트리 슬라이스들 각각은 슬라이스 순서에서의 포지션에 대응할 수도 있다. 1170 에서, GPU 파이프라인 (1102) 은 복수의 지오메트리 슬라이스들 중 적어도 하나가 슬라이스 순서에서 업데이트된 포지션에 대응하도록, 복수의 지오메트리 슬라이스들의 슬라이스 순서를 재배열할 수도 있다.

1180 에서, GPU 파이프라인 (1102) 은 복수의 지오메트리 슬라이스들의 슬라이스 순서에 기초하여, 복수의 프리미티브들, 예를 들어 프리미티브들 (1182) 각각을 래스터화할 수도 있다. 복수의 프리미티브들, 예를 들어 프리미티브들 (1182) 각각을 래스터화한 후, 프리미티브들은 GPU 의 다른 컴포넌트, 예를 들어 메모리 (1106), 또는 디스플레이, 예를 들어 디스플레이 (1106) 로 송신될 수도 있다. 예를 들어, 래스터화된 복수의 프리미티브들, 예를 들어 프리미티브들 (1182) 각각은 그래픽스 프로세싱 유닛 (GPU) 에 의해 렌더링될 수도 있다.

도 12 는 본 개시의 하나 이상의 기법들에 따른 예시의 그래픽스 프로세싱의 방법의 플로우챠트 (1200) 이다. 방법은 그래픽스 프로세싱을 위한 장치, GPU 또는 다른 그래픽스 프로세서, GPU 파이프라인, 무선 통신 디바이스, 및/또는 도 1 내지 도 11 의 예들과 관련하여 사용된 바와 같은 그래픽스 프로세싱을 수행할 수 있는 임의의 장치와 같은 장치에 의해 수행될 수도 있다.

1202 에서, 장치는 도 1 내지 도 11 의 예들과 관련하여 설명된 바와 같이, 복수의 프리미티브들 각각의 가시성을 결정할 수도 있고, 여기서 복수의 프리미티브들 각각에 대한 복수의 인덱스들은 복수의 프리미티브들 각각의 가시성에 기초하여 수신된다. 예를 들어, GPU 파이프라인 (1102) 은 복수의 프리미티브들 각각의 가시성을 결정할 수도 있고, 여기서 복수의 프리미티브들 각각에 대한 복수의 인덱스들은 복수의 프리미티브들 각각의 가시성에 기초하여 수신된다. 또한, 프로세싱 유닛 (120) 은 1202 을 수행할 수도 있다.

1204 에서, 장치는 도 1 내지 도 11 의 예들과 관련하여 설명된 바와 같이, 복수의 프리미티브들 각각에 대한 복수의 인덱스들을 수신할 수도 있다. 예를 들어, GPU 파이프라인 (1102) 은 복수의 프리미티브들 각각에 대한 복수의 인덱스들을 수신할 수도 있다. 또한, 프로세싱 유닛 (120) 은 1204 을 수행할 수도 있다. 장치는 또한 복수의 프리미티브들 각각에 대한 복수의 인덱스들을 페치할 수도 있다. 예를 들어, 복수의 프리미티브들 각각에 대한 복수의 인덱스들을 수신하는 것은 복수의 프리미티브들 각각에 대한 복수의 인덱스들을 페치하는 것을 포함할 수도 있다. 일부 경우들에서, 복수의 인덱스들 각각은 프리미티브 재시작 인덱스와 연관될 수도 있다. 또한, 복수의 지오메트리 슬라이스들 각각에 대한 복수의 프리미티브 배치들 각각의 분배는 복수의 인덱스들 각각과 연관된 프리미티브 재시작 인덱스에 기초할 수도 있다.

1206 에서, 장치는 도 1 내지 도 11 의 예들과 관련하여 설명된 바와 같이, 복수의 프리미티브 배치들 각각의 사이즈를 결정할 수도 있고, 복수의 프리미티브 배치들 각각은 복수의 프리미티브들 중 적어도 하나의 프리미티브를 포함한다. 예를 들어, GPU 파이프라인 (1102) 은 복수의 프리미티브 배치들 각각의 사이즈를 결정할 수도 있으며, 복수의 프리미티브 배치들 각각은 복수의 프리미티브들 중 적어도 하나의 프리미티브를 포함한다. 또한, 프로세싱 유닛 (120) 은 1206 을 수행할 수도 있다.

일부 양태들에서, 복수의 프리미티브 배치들 각각의 사이즈는 적어도 하나의 드로우콜의 사이즈, 적어도 하나의 작업 아이템의 사이즈, 또는 복수의 프리미티브들 중 적어도 하나의 프리미티브의 사이즈에 대한 조정 중 적어도 하나에 기초하여 결정될 수도 있다. 또한, 복수의 프리미티브 배치들 각각의 사이즈는 하나 이상의 테셀레이션 팩터들, 적어도 하나의 프리미티브 오프셋, 또는 하나 이상의 연속적인 프리미티브들의 스팬 중 적어도 하나를 포함하는 하나 이상의 파라미터들에 기초할 수도 있다. 또한, 복수의 프리미티브 배치들 각각은 시작 표시 및 종료 표시를 포함할 수도 있으며, 시작 표시는 프리미티브 배치의 시작에 대응하고 종료 표시는 프리미티브 배치의 종료에 대응한다.

1208 에서, 장치는, 도 1 내지 도 11 의 예들과 관련하여 설명된 바와 같이, 복수의 프리미티브 배치들 각각의 결정된 사이즈에 기초하여, 복수의 프리미티브들을 복수의 프리미티브 배치들로 분할할 수도 있다. 예를 들어, GPU 파이프라인 (1102) 은 복수의 프리미티브 배치들 각각의 결정된 사이즈에 기초하여, 복수의 프리미티브들을 복수의 프리미티브 배치들로 분할할 수도 있다. 또한, 프로세싱 유닛 (120) 은 1208 을 수행할 수도 있다.

1210 에서, 장치는 도 1 내지 도 11 의 예들과 관련하여 설명된 바와 같이, 복수의 지오메트리 슬라이스들 각각에 복수의 프리미티브 배치들 각각을 분배할 수도 있고, 복수의 지오메트리 슬라이스들 각각은 복수의 프리미티브들 중 하나 이상의 프리미티브들을 포함한다. 예를 들어, GPU 파이프라인 (1102) 은 복수의 프리미티브 배치들 각각을 복수의 지오메트리 슬라이스들 각각에 분배할 수도 있고, 복수의 지오메트리 슬라이스들 각각은 복수의 프리미티브들 중 하나 이상의 프리미티브들을 포함한다. 또한, 프로세싱 유닛 (120) 은 1210 을 수행할 수도 있다.

1212 에서, 장치는 도 1 내지 도 11 의 예들과 관련하여 설명된 바와 같이, 하나 이상의 프리미티브들을 포함하는 복수의 지오메트리 슬라이스들 각각을 프로세싱할 수도 있다. 예를 들어, GPU 파이프라인 (1102) 은 하나 이상의 프리미티브들을 포함하는 복수의 지오메트리 슬라이스들 각각을 프로세싱할 수도 있다. 또한, 프로세싱 유닛 (120) 은 1212 를 수행할 수도 있다. 장치는 또한 하나 이상의 프리미티브들을 포함하는 복수의 지오메트리 슬라이스들 각각을 셰이딩할 수도 있다. 예를 들어, 복수의 지오메트리 슬라이스들 각각을 프로세싱하는 것은 하나 이상의 프리미티브들을 포함하는 복수의 지오메트리 슬라이스들 각각을 셰이딩하는 것을 포함할 수도 있다. 일부 경우들에서, 복수의 지오메트리 슬라이스들 각각은 버텍스 셰이더, 지오메트리 셰이더, 도메인 셰이더, 또는 테셀레이터 중 적어도 하나에 의해 프로세싱될 수도 있다. 테셀레이터는 복수의 지오메트리 슬라이스 각각에 대한 지오메트리를 프로세싱하도록 구성될 수도 있다. 또한, 테셀레이터는 프리미티브 인덱스 기반 테셀레이터일 수도 있다.

일부 양태들에서, 복수의 지오메트리 슬라이스들은 슬라이스 순서로 배열될 수도 있고, 여기서 복수의 지오메트리 슬라이스들 각각은 슬라이스 순서에서의 포지션에 대응할 수도 있다. 1214 에서, 장치는 도 1 내지 도 11 의 예들과 관련하여 설명된 바와 같이, 복수의 지오메트리 슬라이스들 중 적어도 하나가 슬라이스 순서에서의 업데이트된 포지션에 대응하도록, 복수의 지오메트리 슬라이스들의 슬라이스 순서를 재배열할 수도 있다 . 예를 들어, GPU 파이프라인 (1102) 은 복수의 지오메트리 슬라이스들 중 적어도 하나가 슬라이스 순서에서 업데이트된 포지션에 대응하도록, 복수의 지오메트리 슬라이스들의 슬라이스 순서를 재배열할 수도 있다. 또한, 프로세싱 유닛 (120) 은 1214 를 수행할 수도 있다.

1216 에서, 장치는 도 1 내지 도 11 의 예들과 관련하여 설명된 바와 같이, 복수의 지오메트리 슬라이스들의 슬라이스 순서에 기초하여 복수의 프리미티브들 각각을 래스터화할 수도 있다. 예를 들어, GPU 파이프라인 (1102) 은 복수의 지오메트리 슬라이스들의 슬라이스 순서에 기초하여 복수의 프리미티브들 각각을 래스터화할 수도 있다. 또한, 프로세싱 유닛 (120) 은 1216 를 수행할 수도 있다. 복수의 프리미티브들 각각을 래스터화한 후, 프리미티브들은 GPU 의 다른 컴포넌트 또는 디스플레이로 송신될 수도 있다. 예를 들어, 래스터화된 복수의 프리미티브들 각각은 그래픽스 프로세싱 유닛 (GPU) 에 의해 렌더링될 수도 있다.

구성들에서, 그래픽스 프로세싱을 위한 방법 또는 장치가 제공된다. 장치는 GPU, 그래픽스 프로세서, 또는 그래픽스 프로세싱을 수행할 수도 있는 일부 다른 프로세서일 수도 있다. 양태들에서, 장치는 디바이스 (104) 내의 프로세싱 유닛 (120) 일 수도 있거나, 또는 디바이스 (104) 또는 다른 디바이스 내의 일부 다른 하드웨어일 수도 있다. 장치, 예를 들어, 프로세싱 유닛 (120) 은, 예를 들어, 복수의 프리미티브들 각각에 대한 복수의 인덱스들을 수신하는 수단; 복수의 프리미티브 배치들 각각의 사이즈를 결정하는 수단으로서, 복수의 프리미티브 배치들 각각은 복수의 프리미티브들 중 적어도 하나의 프리미티브를 포함하는, 상기 복수의 프리미티브 배치들 각각의 사이즈를 결정하는 수단; 복수의 프리미티브 배치들 각각의 결정된 사이즈에 기초하여, 복수의 프리미티브들을 복수의 프리미티브 배치들로 분할하는 수단; 복수의 프리미티브 배치들 각각을 복수의 지오메트리 슬라이스들 각각에 분배하는 수단으로서, 복수의 지오메트리 슬라이스들 각각은 복수의 프리미티브들 중 하나 이상의 프리미티브들을 포함하는, 상기 복수의 프리미티브 배치들 각각을 분배하는 수단; 복수의 프리미티브들 각각의 가시성을 결정하는 수단으로서, 복수의 프리미티브들 각각에 대한 복수의 인덱스들을 복수의 프리미티브들 각각의 가시성에 기초하여 수신되는, 상기 가시성을 결정하는 수단; 복수의 프리미티브들의 각각에 대한 복수의 인덱스들을 페치하는 수단; 복수의 프리미티브들 각각에 대한 복수의 인덱스들을 페치하는 수단; 하나 이상의 프리미티브들을 포함하는 복수의 지오메트리 슬라이스들 각각을 프로세싱하는 수단; 하나 이상의 프리미티브들을 포함하는 복수의 지오메트리 슬라이스들 각각을 셰이딩하는 수단; 복수의 지오메트리 슬라이스들 중 적어도 하나가 슬라이스 순서에서의 업데이트된 포지션에 대응하도록, 복수의 지오메트리 슬라이스들의 슬라이스 순서를 재배열하는 수단; 및 복수의 지오메트리 슬라이스들의 슬라이스 순서에 기초하여 복수의 프리미티브들의 각각을 래스터화하는 수단을 포함할 수도 있다.

본 명세서에 설명된 청구물은 하나 이상의 이익 또는 이점을 실현하도록 구현될 수 있다. 예를 들어, 설명된 그래픽스 프로세싱 기법들은 GPU, 그래픽스 프로세서, 또는 본 명세서에 설명된 스케일러블 프리미티브 아키텍처를 구현하기 위해 그래픽스 프로세싱을 수행할 수 있는 일부 다른 프로세서에 의해 사용될 수 있다. 이는 또한 다른 그래픽스 프로세싱 기법들과 비교하여 낮은 비용으로 달성될 수 있다. 더욱이, 본 명세서의 그래픽스 프로세싱 기법들은 데이터 프로세싱 또는 실행을 개선하거나 속도를 높일 수 있다. 또한, 본 명세서의 그래픽스 프로세싱 기법들은 리소스 또는 데이터 활용 및/또는 리소스 효율성을 개선할 수 있다. 부가적으로, 본 개시의 양태들은 메모리 대역폭을 개선하고 및/또는 GPU 에서의 성능 오버헤드를 감소시키기 위해 스케일러블 프리미티브 레이트 아키텍처를 활용할 수 있다.

개시된 프로세스들/플로우차트들에 있어서의 블록들의 특정 순서 또는 계위는 예시적인 접근법들의 예시임이 이해된다. 설계 선호도들에 기초하여, 프로세스들/플로우차트들에 있어서의 블록들의 특정 순서 또는 계위가 재배열될 수도 있음이 이해된다. 추가로, 일부 블록들은 결합되거나 생략될 수도 있다. 첨부한 방법 청구항들은 다양한 블록들의 엘리먼트들을 샘플 순서로 제시하며, 제시된 특정 순서 또는 계위로 한정되도록 의도되지 않는다.

상기 설명은 당업자로 하여금 본 명세서에서 설명된 다양한 양태들을 실시할 수 있게 하도록 제공된다. 이 양태들에 대한 다양한 수정들은 당해 분야의 당업자들에게 용이하게 명백할 것이고, 본원에서 정의된 일반적인 원리들은 다른 양태들에 적용될 수도 있다. 따라서, 청구항들은 본 명세서에서 설명된 양태들로 한정되도록 의도되지 않지만, 청구항들의 언어와 부합하는 충분한 범위를 부여받아야 하며, 여기서, 단수로의 엘리먼트들에 대한 언급은 구체적으로 그렇게 언급되지 않는한, "하나 및 단지 하나만" 을 의미하도록 의도되지 않고 오히려 "하나 이상" 을 의미하도록 의도된다. 단어 "예시적인" 은 본 명세서에서 "예, 실례, 또는 예시의 역할을 하는 것" 을 의미하도록 사용된다.　 "예시적인" 것으로서 본 명세서에서 설명된 임의의 양태는 다른 양태들에 비해 반드시 선호되거나 유리한 것으로서 해석될 필요는 없다.

달리 구체적으로 언급되지 않는 한, 용어 "일부" 는 하나 이상을 지칭하고, 용어 "또는" 은 문맥이 달리 지시하지 않는 경우 "및/또는"으 로 해석될 수도 있다. "A, B, 또는 C 중 적어도 하나", "A, B, 또는 C 중 하나 이상", "A, B, 및 C 중 적어도 하나", "A, B, 및 C 중 하나 이상", 및 "A, B, C 또는 이들의 임의의 조합" 과 같은 조합들은 A, B, 및/또는 C 의 임의의 조합을 포함하고, A 의 배수들, B 의 배수들, 또는 C 의 배수들을 포함할 수도 있다. 구체적으로, "A, B, 또는 C 중 적어도 하나", "A, B, 또는 C 중 하나 이상", "A, B, 및 C 중 적어도 하나", "A, B, 및 C 중 하나 이상", 및 "A, B, C 또는 이들의 임의의 조합" 과 같은 조합들은 A만, B만, C만, A 및 B, A 및 C, B 및 C, 또는 A 와 B 와 C 일 수도 있으며 여기서, 임의의 그러한 조합들은 A, B, 또는 C 의 하나 이상의 멤버 또는 멤버들을 포함할 수도 있다. 당업자에게 알려지거나 나중에 알려지게 될 본 개시 전반에 걸쳐 설명된 다양한 양태들의 엘리먼트들에 대한 모든 구조적 및 기능적 균등물들은 본 명세서에 참조로 명백히 통합되며 청구항들에 의해 포괄되도록 의도된다. 또한, 본원에 개시된 어느 것도 그러한 개시가 명시적으로 청구항들에 인용되는지 여부에 관계없이 공중에 전용되는 것으로 의도되지 않는다. "모듈", "메커니즘", "엘리먼트", "디바이스"등의 단어는 "수단" 이라는 단어의 대체물이 아닐 수도 있다. 이와 같이, 어떠한 청구항 엘리먼트도, 그 엘리먼트가 문구 "~하기 위한 수단" 을 사용하여 명백하게 인용되지 않는 한 수단 플러스 기능으로서 해석되지 않아야 한다.

하나 이상의 예들에서, 본 명세서에 설명된 기능들은 하드웨어, 소프트웨어, 펌웨어, 또는 이들의 임의의 조합에서 구현될 수도 있다. 예를 들어, 용어 "프로세싱 유닛"이 본 개시 전체에 걸쳐 사용되었지만, 그러한 프로세싱 유닛은 하드웨어, 소프트웨어, 펌웨어, 또는 이들의 임의의 조합으로 구현될 수도 있다. 본 명세서에 설명된 임의의 기능, 프로세싱 유닛, 본 명세서에 설명된 기법 또는 다른 모듈이 소프트웨어로 구현되는 경우, 기능, 프로세싱 유닛, 본 명세서에 설명된 기법 또는 다른 모듈은 컴퓨터 판독가능 매체 상에 하나 이상의 명령들 또는 코드로서 저장되거나 이를 통해 전송될 수도 있다.

본 개시에 따라, 용어 "또는" 은 문맥이 달리 지시하지 않는 경우 "및/또는" 으로 해석될 수도 있다. 또한, "하나 이상" 또는 "적어도 하나" 등과 같은 구절들이 본 명세서에 개시된 일부 특징에 대해 사용되었을 수도 있지만, 이러한 언어가 사용되지 않은 특징들은 문맥이 달리 지시하지 않는 경우 암시되는 그러한 의미를 갖는 것으로 해석될 수도 있다.

하나 이상의 예들에서, 본 명세서에 설명된 기능들은 하드웨어, 소프트웨어, 펌웨어, 또는 이들의 임의의 조합에서 구현될 수도 있다. 예를 들어, 용어 "프로세싱 유닛"이 본 개시 전체에 걸쳐 사용되었지만, 그러한 프로세싱 유닛은 하드웨어, 소프트웨어, 펌웨어, 또는 이들의 임의의 조합으로 구현될 수도 있다. 본 명세서에 설명된 임의의 기능, 프로세싱 유닛, 본 명세서에 설명된 기법 또는 다른 모듈이 소프트웨어로 구현되는 경우, 기능, 프로세싱 유닛, 본 명세서에 설명된 기법 또는 다른 모듈은 컴퓨터 판독가능 매체 상에 하나 이상의 명령들 또는 코드로서 저장되거나 이를 통해 전송될 수도 있다. 컴퓨터 판독가능 매체들은 일 장소로부터 다른 장소로의 컴퓨터 프로그램의 전송을 용이하게 하는 임의의 매체를 포함하는 통신 매체들 또는 컴퓨터 데이터 저장 매체들을 포함할 수도 있다.　　이러한 방식으로, 컴퓨터 판독가능 매체는 일반적으로 (1) 비일시적인 유형의 컴퓨터 판독가능 저장 매체 또는 (2) 신호 또는 캐리어 파와 같은 통신 매체에 대응할 수도 있다. 데이터 저장 매체들은 본 개시에서 설명된 기법들의 구현을 위한 명령들, 코드 및/또는 데이터 구조들을 취출하기 위해 하나 이상의 컴퓨터들 또는 하나 이상의 프로세서들에 의해 액세스될 수 있는 임의의 가용 매체들일 수도 있다.　 제한이 아닌 예시로, 이러한 컴퓨터 판독가능 매체들은 RAM, ROM, EEPROM, CD-ROM 또는 다른 광 디스크 저장, 자기 디스크 저장 또는 다른 자기 저장 디바이스들을 포함할 수 있다.　 본 명세서에서 사용된 바와 같은 디스크 (disk) 및 디스크 (disc) 는 컴팩트 디스크 (CD), 레이저 디스크, 광학 디스크, 디지털 다기능 디스크 (DVD), 플로피 디스크 및 블루레이 디스크를 포함하며, 여기서, 디스크 (disk) 는 통상적으로 데이터를 자기적으로 재생하지만 디스크 (disc) 는 레이저를 이용하여 데이터를 광학적으로 재생한다. 상기의 조합들이 또한, 컴퓨터 판독가능 매체들의 범위 내에 포함되어야 한다. 컴퓨터 프로그램 제품은 컴퓨터 판독가능 매체를 포함할 수도 있다.

코드는 하나 이상의 프로세서, 예컨대 하나 이상의 디지털 신호 프로세서 (DSP), 범용 마이크로프로세서, 주문형 집적 회로 (ASIC), 산술 로직 유닛 (ALU), 필드 프로그램가능 로직 어레이 (FPGA), 또는 다른 등가의 집적 또는 이산 로직 회로부에 의해 실행될 수도 있다. 따라서, 본 명세서에 사용된 용어 "프로세서" 는 전술한 구조 중 임의의 것 또는 본 명세서에 설명된 기법들의 구현에 적합한 임의의 다른 구조를 지칭할 수도 있다. 또한, 그 기법들은 하나 이상의 회로들 또는 로직 엘리먼트들에서 완전히 구현될 수 있다.

본 개시의 기법들은 무선 핸드셋, 집적 회로 (IC) 또는 IC들의 세트 (예를 들어, 칩 세트) 를 포함하여, 광범위하게 다양한 디바이스들 또는 장치들에서 구현될 수도 있다. 다양한 컴포넌트들, 모듈들 또는 유닛들이, 개시된 기술들을 수행하도록 구성된 디바이스들의 기능적인 양태들을 강조하기 위하여 본 개시에 설명되었지만, 상이한 하드웨어 유닛들에 의한 실현을 반드시 필요로 하는 것은 아니다. 오히려, 상술한 바와 같이, 다양한 유닛들이 임의의 하드웨어 유닛에 결합될 수도 있거나, 또는 적합한 소프트웨어 및/또는 펌웨어와 함께, 상술한 하나 이상의 프로세서를 포함하는 상호동작 하드웨어 유닛들의 집합에 의해 제공될 수도 있다. 따라서, 본 명세서에 사용된 용어 "프로세서" 는 전술한 구조 중 임의의 것 또는 본 명세서에 설명된 기법들의 구현에 적합한 임의의 다른 구조를 지칭할 수도 있다. 또한, 그 기법들은 하나 이상의 회로들 또는 로직 엘리먼트들에서 완전히 구현될 수도 있다.

다음의 양태들은 예시적일 뿐이며 본 명세서에 설명된 다른 양태들 또는 교시들과 제한 없이 조합될 수도 있다.

양태 1 은 그래픽스 프로세싱의 방법이다. 방법은, 복수의 프리미티브들 각각에 대한 복수의 인덱스들을 수신하는 단계; 복수의 프리미티브 배치(batch)들 각각의 사이즈를 결정하는 단계로서, 복수의 프리미티브 배치들 각각은 복수의 프리미티브들 중 적어도 하나의 프리미티브를 포함하는, 상기 사이즈를 결정하는 단계; 복수의 프리미티브 배치들 각각의 결정된 사이즈에 기초하여, 복수의 프리미티브들을 복수의 프리미티브 배치들로 분할하는 단계; 및 복수의 프리미티브 배치들 각각을 복수의 지오메트리 슬라이스들 각각에 분배하는 단계로서, 복수의 지오메트리 슬라이스들 각각은 복수의 프리미티브들 중 하나 이상의 프리미티브들을 포함하는, 상기 복수의 프리미티브 배치들 각각을 분배하는 단계를 포함한다.

양태 2 는 양태 1 의 방법이며, 복수의 프리미티브들 각각의 가시성을 결정하는 단계를 더 포함하고, 복수의 프리미티브들 각각에 대한 복수의 인덱스들은 복수의 프리미티브들 각각의 가시성에 기초하여 수신된다.

양태 3 은 양태들 1 및 2 중 임의의 것의 방법이며, 여기서 복수의 프리미티브들 각각에 대한 복수의 인덱스들을 수신하는 단계는, 복수의 프리미티브들 각각에 대한 상기 복수의 인덱스들을 페치하는 단계를 포함한다.

양태 4 는 양태들 1 내지 3 중 임의의 것의 방법이며, 여기서 복수의 인덱스들 각각은 프리미티브 재시작 인덱스와 연관된다.

양태 5 는 양태들 1 내지 4 중 임의의 것의 방법이며, 여기서 복수의 지오메트리 슬라이스들 각각에 대한 복수의 프리미티브 배치들 각각의 분배는 복수의 인덱스들 각각과 연관된 프리미티브 재시작 인덱스에 기초한다.

양태 6 은 양태들 1 내지 5 중 임의의 것의 방법이며, 하나 이상의 프리미티브들을 포함하는 복수의 지오메트리 슬라이스들 각각을 프로세싱하는 단계를 더 포함한다.

양태 7 은 양태들 1 내지 6 중 임의의 것의 방법이며, 여기서 복수의 지오메트리 슬라이스들 각각을 프로세싱하는 단계는, 하나 이상의 프리미티브들을 포함하는 상기 복수의 지오메트리 슬라이스들 각각을 셰이딩하는 단계를 포함한다.

양태 8 은 양태들 1 내지 7 중 임의의 것의 방법이며, 여기서 복수의 지오메트리 슬라이스들 각각은 버텍스 셰이더, 지오메트리 셰이더, 도메인 셰이더, 또는 테셀레이터 중 적어도 하나에 의해 프로세싱된다.

양태 9 는 양태들 1 내지 8 중 임의의 것의 방법이며, 여기서 테셀레이터는 복수의 지오메트리 슬라이스들 각각에 대한 지오메트리를 프로세싱하도록 구성된다.

양태 10 은 양태들 1 내지 9 중 임의의 것의 방법이며, 여기서 테셀레이터는 프리미티브 인덱스 기반 테셀레이터이다.

양태 11 은 양태들 1 내지 10 중 임의의 것의 방법이며, 여기서 복수의 지오메트리 슬라이스들은 슬라이스 순서로 배열되고, 복수의 지오메트리 슬라이스들 각각은 슬라이스 순서에서의 포지션에 대응한다.

양태 12 는 양태들 1 내지 11 중 임의의 것의 방법이며, 복수의 지오메트리 슬라이스들 중 적어도 하나가 상기 슬라이스 순서에서 업데이트된 포지션에 대응하도록, 상기 복수의 지오메트리 슬라이스들의 상기 슬라이스 순서를 재배열하는 단계를 더 포함한다.

양태 13 은 양태들 1 내지 12 중 임의의 것의 방법이며, 복수의 지오메트리 슬라이스들의 슬라이스 순서에 기초하여 복수의 프리미티브들 각각을 래스터화하는 단계를 더 포함한다.

양태 14 는 양태들 1 내지 13 중 임의의 것의 방법이며, 여기서 래스터화된 복수의 프리미티브들 각각은 그래픽스 프로세싱 유닛 (GPU) 에 의해 렌더링된다.

양태 15 는 양태들 1 내지 14 중 임의의 것의 방법이며, 여기서 복수의 프리미티브 배치들 각각의 사이즈는 적어도 하나의 드로우콜의 사이즈, 적어도 하나의 작업 아이템의 사이즈, 또는 상기 복수의 프리미티브들 중 적어도 하나의 프리미티브의 사이즈에 대한 조정 중 적어도 하나에 기초하여 결정된다.

양태 16 은 양태들 1 내지 15 중 임의의 것의 방법이며, 여기서 복수의 프리미티브 배치들 각각의 사이즈는 하나 이상의 테셀레이션 팩터들, 적어도 하나의 프리미티브 오프셋, 또는 하나 이상의 연속적인 프리미티브들의 스팬(span) 중 적어도 하나를 포함하는 하나 이상의 파라미터들에 기초한다.

양태 17 은 양태들 1 내지 16 중 임의의 것의 방법이며, 여기서 복수의 프리미티브 배치들 각각은 시작 표시 및 종료 표시를 포함하고, 시작 표시는 프리미티브 배치의 시작에 대응하고 종료 표시는 상기 프리미티브 배치의 종료에 대응한다.

양태 18 은 메모리에 커플링되고 양태들 1 내지 17 중 임의의 것에서와 같은 방법을 구현하도록 구성된 적어도 하나의 프로세서를 포함하는 그래픽스 프로세싱을 위한 장치이다.

양태 19 는 양태들 1 내지 17 중 임의의 것에서와 같은 방법을 구현하기 위한 수단을 포함하는 그래픽스 프로세싱을 위한 장치이다.

양태 20 은 컴퓨터 실행가능 코드를 저장하는 비일시적 컴퓨터 판독가능 매체이며, 코드는 적어도 하나의 프로세서에 의해 실행될 때 적어도 하나의 프로세서로 하여금 양태들 1 내지 17 중 임의의 것에서와 같은 방법을 구현하게 한다.

Claims

그래픽스 프로세싱의 방법으로서,
복수의 프리미티브들 각각에 대한 복수의 인덱스들을 수신하는 단계;
복수의 프리미티브 배치(batch)들 각각의 사이즈를 결정하는 단계로서, 상기 복수의 프리미티브 배치들 각각은 상기 복수의 프리미티브들 중 적어도 하나의 프리미티브를 포함하는, 상기 사이즈를 결정하는 단계;
상기 복수의 프리미티브 배치들 각각의 결정된 사이즈에 기초하여, 상기 복수의 프리미티브들을 상기 복수의 프리미티브 배치들로 분할하는 단계; 및
상기 복수의 프리미티브 배치들 각각을 복수의 지오메트리 슬라이스들 각각에 분배하는 단계로서, 상기 복수의 지오메트리 슬라이스들 각각은 상기 복수의 프리미티브들 중 하나 이상의 프리미티브들을 포함하는, 상기 복수의 프리미티브 배치들 각각을 분배하는 단계를 포함하는, 그래픽스 프로세싱의 방법.
제 1 항에 있어서,
상기 복수의 프리미티브들 각각의 가시성을 결정하는 단계를 더 포함하고, 상기 복수의 프리미티브들 각각에 대한 상기 복수의 인덱스들은 상기 복수의 프리미티브들 각각의 가시성에 기초하여 수신되는, 그래픽스 프로세싱의 방법.
제 1 항에 있어서,
복수의 프리미티브들 각각에 대한 상기 복수의 인덱스들을 수신하는 단계는,
상기 복수의 프리미티브들 각각에 대한 상기 복수의 인덱스들을 페치하는 단계를 포함하는, 그래픽스 프로세싱의 방법.
제 1 항에 있어서,
상기 복수의 인덱스들 각각은 프리미티브 재시작 인덱스와 연관되는, 그래픽스 프로세싱의 방법.
제 4 항에 있어서,
상기 복수의 지오메트리 슬라이스들 각각에 대한 상기 복수의 프리미티브 배치들 각각의 분배는 상기 복수의 인덱스들 각각과 연관된 상기 프리미티브 재시작 인덱스에 기초하는, 그래픽스 프로세싱의 방법.
제 1 항에 있어서,
상기 하나 이상의 프리미티브들을 포함하는 상기 복수의 지오메트리 슬라이스들 각각을 프로세싱하는 단계를 더 포함하는, 그래픽스 프로세싱의 방법.
제 6 항에 있어서,
상기 복수의 지오메트리 슬라이스들 각각을 프로세싱하는 단계는,
상기 하나 이상의 프리미티브들을 포함하는 상기 복수의 지오메트리 슬라이스들 각각을 셰이딩하는 단계를 포함하는, 그래픽스 프로세싱의 방법.
제 6 항에 있어서,
상기 복수의 지오메트리 슬라이스들 각각은 버텍스 셰이더, 지오메트리 셰이더, 도메인 셰이더, 또는 테셀레이터 중 적어도 하나에 의해 프로세싱되는, 그래픽스 프로세싱의 방법.
제 8 항에 있어서,
상기 테셀레이터는 상기 복수의 지오메트리 슬라이스들 각각에 대한 지오메트리를 프로세싱하도록 구성되는, 그래픽스 프로세싱의 방법.
제 8 항에 있어서,
상기 테셀레이터는 프리미티브 인덱스 기반 테셀레이터인, 그래픽스 프로세싱의 방법.
제 1 항에 있어서,
상기 복수의 지오메트리 슬라이스들은 슬라이스 순서로 배열되고, 상기 복수의 지오메트리 슬라이스들 각각은 상기 슬라이스 순서에서의 포지션에 대응하는, 그래픽스 프로세싱의 방법.
제 11 항에 있어서,
상기 복수의 지오메트리 슬라이스들 중 적어도 하나가 상기 슬라이스 순서에서 업데이트된 포지션에 대응하도록, 상기 복수의 지오메트리 슬라이스들의 상기 슬라이스 순서를 재배열하는 단계를 더 포함하는, 그래픽스 프로세싱의 방법.
제 11 항에 있어서,
상기 복수의 지오메트리 슬라이스들의 상기 슬라이스 순서에 기초하여 상기 복수의 프리미티브들 각각을 래스터화하는 단계를 포함하는, 그래픽스 프로세싱의 방법.
제 13 항에 있어서,
래스터화된 상기 복수의 프리미티브들 각각은 그래픽스 프로세싱 유닛 (GPU) 에 의해 렌더링되는, 그래픽스 프로세싱의 방법.
제 1 항에 있어서,
상기 복수의 프리미티브 배치들 각각의 사이즈는 적어도 하나의 드로우콜의 사이즈, 적어도 하나의 작업 아이템의 사이즈, 또는 상기 복수의 프리미티브들 중 적어도 하나의 프리미티브의 사이즈에 대한 조정 중 적어도 하나에 기초하여 결정되는, 그래픽스 프로세싱의 방법.
제 1 항에 있어서,
상기 복수의 프리미티브 배치들 각각의 사이즈는 하나 이상의 테셀레이션 팩터들, 적어도 하나의 프리미티브 오프셋, 또는 하나 이상의 연속적인 프리미티브들의 스팬(span) 중 적어도 하나를 포함하는 하나 이상의 파라미터들에 기초하는, 그래픽스 프로세싱의 방법.
제 1 항에 있어서,
상기 복수의 프리미티브 배치들 각각은 시작 표시 및 종료 표시를 포함하고, 상기 시작 표시는 프리미티브 배치의 시작에 대응하고 상기 종료 표시는 상기 프리미티브 배치의 종료에 대응하는, 그래픽스 프로세싱의 방법.
그래픽스 프로세싱을 위한 장치로서,
메모리; 및
상기 메모리에 커플링된 적어도 하나의 프로세서를 포함하고, 상기 적어도 하나의 프로세서는,
복수의 프리미티브들 각각에 대한 복수의 인덱스들을 수신하고;
상기 복수의 프리미티브 배치(batch)들 각각의 사이즈를 결정하는 것으로서, 상기 복수의 프리미티브 배치들 각각은 상기 복수의 프리미티브들 중 적어도 하나의 프리미티브를 포함하는, 상기 사이즈를 결정하고;
상기 복수의 프리미티브 배치들 각각의 결정된 사이즈에 기초하여, 상기 복수의 프리미티브들을 상기 복수의 프리미티브 배치들로 분할하며; 그리고
상기 복수의 프리미티브 배치들 각각을 복수의 지오메트리 슬라이스들 각각에 분배하는 것으로서, 상기 복수의 지오메트리 슬라이스들 각각은 상기 복수의 프리미티브들 중 하나 이상의 프리미티브들을 포함하는, 상기 복수의 프리미티브 배치들 각각을 분배하도록 구성되는, 그래픽스 프로세싱을 위한 장치.
제 18 항에 있어서,
상기 적어도 하나의 프로세서는 추가로,
상기 복수의 프리미티브들 각각의 가시성을 결정하도록 구성되고, 상기 복수의 프리미티브들 각각에 대한 상기 복수의 인덱스들은 상기 복수의 프리미티브들 각각의 가시성에 기초하여 수신되는, 그래픽스 프로세싱을 위한 장치.
제 18 항에 있어서,
상기 복수의 프리미티브들 각각에 대한 상기 복수의 인덱스들을 수신하는 것은, 상기 적어도 하나의 프로세서가 추가로,
상기 복수의 프리미티브들 각각에 대한 상기 복수의 인덱스들을 페치하도록 구성되는 것을 포함하는, 그래픽스 프로세싱을 위한 장치.
제 18 항에 있어서,
상기 복수의 인덱스들 각각은 프리미티브 재시작 인덱스와 연관되는, 그래픽스 프로세싱을 위한 장치.
제 21 항에 있어서,
상기 복수의 지오메트리 슬라이스들 각각에 대한 상기 복수의 프리미티브 배치들 각각의 분배는 상기 복수의 인덱스들 각각과 연관된 상기 프리미티브 재시작 인덱스에 기초하는, 그래픽스 프로세싱을 위한 장치.
제 18 항에 있어서,
상기 적어도 하나의 프로세서는 추가로,
상기 하나 이상의 프리미티브들을 포함하는 상기 복수의 지오메트리 슬라이스들 각각을 프로세싱하도록 구성되는, 그래픽스 프로세싱을 위한 장치.
제 23 항에 있어서,
상기 복수의 지오메트리 슬라이스들 각각을 프로세싱하는 것은, 상기 적어도 하나의 프로세서가 추가로
상기 하나 이상의 프리미티브들을 포함하는 상기 복수의 지오메트리 슬라이스들 각각을 셰이딩하도록 구성되는 것을 포함하는, 그래픽스 프로세싱을 위한 장치.
제 23 항에 있어서,
상기 복수의 지오메트리 슬라이스들 각각은 버텍스 셰이더, 지오메트리 셰이더, 도메인 셰이더, 또는 테셀레이터 중 적어도 하나에 의해 프로세싱되는, 그래픽스 프로세싱을 위한 장치.
제 25 항에 있어서,
상기 테셀레이터는 상기 복수의 지오메트리 슬라이스들 각각에 대한 지오메트리를 프로세싱하도록 구성되는, 그래픽스 프로세싱을 위한 장치.
제 25 항에 있어서,
상기 테셀레이터는 프리미티브 인덱스 기반 테셀레이터인, 그래픽스 프로세싱을 위한 장치.
제 18 항에 있어서,
상기 복수의 지오메트리 슬라이스들은 슬라이스 순서로 배열되고, 상기 복수의 지오메트리 슬라이스들 각각은 상기 슬라이스 순서에서의 포지션에 대응하는, 그래픽스 프로세싱을 위한 장치.
제 28 항에 있어서,
상기 적어도 하나의 프로세서는 추가로,
상기 복수의 지오메트리 슬라이스들 중 적어도 하나가 상기 슬라이스 순서에서 업데이트된 포지션에 대응하도록, 상기 복수의 지오메트리 슬라이스들의 상기 슬라이스 순서를 재배열하도록 구성되는, 그래픽스 프로세싱을 위한 장치.
제 28 항에 있어서,
상기 적어도 하나의 프로세서는 추가로,
상기 복수의 지오메트리 슬라이스들의 상기 슬라이스 순서에 기초하여 상기 복수의 프리미티브들 각각을 래스터화하도록 구성되는, 그래픽스 프로세싱을 위한 장치.
제 30 항에 있어서,
래스터화된 상기 복수의 프리미티브들 각각은 그래픽스 프로세싱 유닛 (GPU) 에 의해 렌더링되는, 그래픽스 프로세싱을 위한 장치.
제 18 항에 있어서,
상기 복수의 프리미티브 배치들 각각의 사이즈는 적어도 하나의 드로우콜의 사이즈, 적어도 하나의 작업 아이템의 사이즈, 또는 상기 복수의 프리미티브들 중 적어도 하나의 프리미티브의 사이즈에 대한 조정 중 적어도 하나에 기초하여 결정되는, 그래픽스 프로세싱을 위한 장치.
제 18 항에 있어서,
상기 복수의 프리미티브 배치들 각각의 사이즈는 하나 이상의 테셀레이션 팩터들, 적어도 하나의 프리미티브 오프셋, 또는 하나 이상의 연속적인 프리미티브들의 스팬(span) 중 적어도 하나를 포함하는 하나 이상의 파라미터들에 기초하는, 그래픽스 프로세싱을 위한 장치.
제 18 항에 있어서,
상기 복수의 프리미티브 배치들 각각은 시작 표시 및 종료 표시를 포함하고, 상기 시작 표시는 프리미티브 배치의 시작에 대응하고 상기 종료 표시는 상기 프리미티브 배치의 종료에 대응하는, 그래픽스 프로세싱을 위한 장치.
그래픽스 프로세싱을 위한 장치로서,
복수의 프리미티브들 각각에 대한 복수의 인덱스들을 수신하는 수단;
복수의 프리미티브 배치(batch)들 각각의 사이즈를 결정하는 수단으로서, 상기 복수의 프리미티브 배치들 각각은 상기 복수의 프리미티브들 중 적어도 하나의 프리미티브를 포함하는, 상기 사이즈를 결정하는 수단;
상기 복수의 프리미티브 배치들 각각의 결정된 상기 사이즈에 기초하여, 상기 복수의 프리미티브들을 상기 복수의 프리미티브 배치들로 분할하는 수단; 및
상기 복수의 프리미티브 배치들 각각을 복수의 지오메트리 슬라이스들 각각에 분배하는 수단으로서, 상기 복수의 지오메트리 슬라이스들 각각은 상기 복수의 프리미티브들 중 하나 이상의 프리미티브들을 포함하는, 상기 복수의 프리미티브 배치들 각각을 분배하는 수단을 포함하는, 그래픽스 프로세싱을 위한 장치.
그래픽스 프로세싱을 위한 컴퓨터 실행가능 코드를 저장하는 컴퓨터 판독가능 저장 매체로서,
상기 코드는 프로세서에 의해 실행될 때 상기 프로세서로 하여금:
복수의 프리미티브들 각각에 대한 복수의 인덱스들을 수신하게 하고;
상기 복수의 프리미티브 배치(batch)들 각각의 사이즈를 결정하게 하는 것으로서, 상기 복수의 프리미티브 배치들 각각은 상기 복수의 프리미티브들 중 적어도 하나의 프리미티브를 포함하는, 상기 사이즈를 결정하게 하고;
상기 복수의 프리미티브 배치들 각각의 결정된 사이즈에 기초하여, 상기 복수의 프리미티브들을 상기 복수의 프리미티브 배치들로 분할하게 하며; 그리고
상기 복수의 프리미티브 배치들 각각을 복수의 지오메트리 슬라이스들 각각에 분배하게 하는 것으로서, 상기 복수의 지오메트리 슬라이스들 각각은 상기 복수의 프리미티브들 중 하나 이상의 프리미티브들을 포함하는, 상기 복수의 프리미티브 배치들 각각을 분배하게 하는, 컴퓨터 판독가능 저장 매체.