KR20230024848A - Plastic package shell for isolator based on capacitor parallel connection and isolator - Google Patents
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Abstract
Description
본 발명은 마이크로파 부품 기술분야에 관한 것으로, 특히 커패시터 병렬 연결 기반의 아이솔레이터용 플라스틱 패키지 쉘 및 상기 플라스틱 패키지 쉘로 조성된 아이솔레이터에 관한 것이다.The present invention relates to the field of microwave component technology, and more particularly, to a plastic package shell for an isolator based on capacitor parallel connection and an isolator composed of the plastic package shell.
현재 5G 통신 Sub6GHz 주파수 대역 범위는 450MHz ~ 6GHz로, 저주파 통신 분야(통신에 비해 mm파는 고주파로 지칭됨)에 속한다. 저주파 통신은 이의 전파 거리가 멀고 침투 기능이 강하여 각 국의 통신 운영업체의 관심을 받고 있으며, 중국 광전 및 차이나모바일은 700MHz의 주파수 대역 배치를 가속화하였고, 터키의 통신 운영업체 TurkTelekom은 5G 통신에서 N71 주파수 대역(617MHz ~ 698MHz)의 적용을 탐색하였으며, 저주파의 통신 기지국 기기는 시스템에서 소형화 특징을 갖는 집중 파라미터 아이솔레이터/아이솔레이터에 대한 요구가 더 시급하다.Currently, the 5G communication Sub6GHz frequency band ranges from 450MHz to 6GHz, which belongs to the field of low-frequency communication (compared to telecommunication, mm waves are referred to as high frequencies). Low-frequency communication has attracted the attention of telecommunication operators in various countries due to its long propagation distance and strong penetration capability. China Optoelectronics and China Mobile have accelerated the deployment of the 700 MHz frequency band, and Turkey's telecom operator TurkTelekom has launched N71 in 5G telecommunications. The application of the frequency band (617MHz ~ 698MHz) was explored, and the low-frequency communication base station device has a more urgent need for a lumped parameter isolator / isolator with miniaturization characteristics in the system.
현재, 종래의 저주파 집중 파라미터 비가역 자성 소자, 즉 아이솔레이터의 구조는 도 1에 도시된 바와 같고, 주요하게 상부 금속 쉘(1), 스트론튬 일정 자석(2), 중심 도체 모듈(3), 단층 칩 커패시터(4), 무선주파수 저항(5), 플라스틱 패키지 쉘(6) 및 하부 금속 쉘(7)을 포함하되; 여기서 상부 금속 쉘(1) 및 하부 금속 쉘(7)는 모두 철제 금속 쉘로, 소자에 폐쇄 자기 회로를 제공하고; 스트론튬 일정 자석(2)은 소자에 외부 일정 자기장을 제공하며; 중심 도체 모듈(3)은 회로의 비가역 접합으로, 에너지 순환 역할을 하고; 단층 칩 커패시터(4)와 중심 도체 모듈(3)은 LC 회로를 구성하며; 무선주파수 저항(5)은 50옴의 정합 부하를 제공하고; 플라스틱 패키지 쉘(6)은 신호 전송을 위해 전송 경로를 제공하며 동시에 내부 소자(단층 칩 커패시터(4) 및 무선주파수 저항(5)을 포함함)가 용접 장착되는 캐리어로 사용된다.At present, the structure of a conventional low-frequency lumped parameter irreversible magnetic element, that is, an isolator, is as shown in Fig. 1, mainly comprising an upper metal shell (1), a strontium constant magnet (2), a central conductor module (3), and a single-layer chip capacitor. (4), including a radio frequency resistor (5), a plastic package shell (6) and a lower metal shell (7); Here, the
상기 종래의 저주파 집중 파라미터 아이솔레이터의 구조에서, 이의 플라스틱 패키지 쉘(6)의 구체적인 구조는 도 2에 도시된 바와 같고, 주요하게 핀 금속 부분(61), 캐리어 금속 부분(62) 및 플라스틱 부분(63)을 포함하며; 여기서 핀 금속 부분(61)은 2개의 단독 핀(신호 전송 제공)이고, 캐리어 금속 부분(62)은 접지 및 소자 용접 장착 캐리어 위치를 제공하며, 플라스틱 부분(63)은 2개의 금속 부분의 조합(즉 핀 금속 부분(61) 및 캐리어 금속 부분(62))으로, 캐리어를 제공하여 내부 소자를 보호하는데 장벽을 제공한다.In the structure of the above conventional low frequency concentrated parameter isolator, the specific structure of its
상기 종래의 플라스틱 패키지 쉘 커패시터 장착 위치는 도 3에 도시된 바와 같고, 도면에서 2.2mm*1mm의 사이즈 및 3.3mm*1mm의 사이즈 위치는 커패시터 장착 위치이고, 커패시터의 최대 제조 사이즈는 2.05mm*0.95mm이다.The conventional plastic package shell capacitor mounting position is as shown in Figure 3, the size position of 2.2mm * 1mm and 3.3mm * 1mm in the drawing is the capacitor mounting position, and the maximum manufacturing size of the capacitor is 2.05mm * 0.95 mm.
상기 종래의 플라스틱 패키지 쉘은 주로 하기와 같은 문제가 존재한다.The conventional plastic package shell mainly has the following problems.
저주파 집중 파라미터 비가역 자성 소자는 주파수가 감소함에 따라 커패시터 값이 증가되도록 설계되었고, 현재 커패시터의 세라믹 재료는 140의 유전 상수에만 달할 수 있으며; 758MHz ~ 803MHz의 집중 파라미터 아이솔레이터/아이솔레이터의 경우, 현재 설계된 플라스틱 패키지 쉘 최대 커패시터 장착 사이즈는 2.1mm*1mm로, 커패시터 두께는 약 0.1mm ~ 0.13mm이어야만 17PF ~ 22PF의 커패시터의 커패시턴스 값의 설계 요구를 충족시킬 수 있다. 높은 유전 상수의 세라믹 재료에 대한 연구 개발의 어려움으로 인해, 커패시터의 제조 두께가 0.16mm 이하이면 커패시터로 제조된 용량이 매우 이산적이며 대량으로 공급할 수 없어 현재 저주파 집중 파라미터 아이솔레이터/서큘레이터의 대량 생산이 구현될 수 없게 된다. 상기 종래의 커패시터 및 플라스틱 패키지 쉘 설계를 계속하여 사용하면, 후속의 통신에 사용되는 600MHz ~ 700MHz의 집중 파라미터 서큘레이터/아이솔레이터 설계에 큰 어려움을 초래할 것이다.The low-frequency concentration parameter irreversible magnetic element is designed so that the capacitor value increases as the frequency decreases, and the ceramic material of the current capacitor can only reach a dielectric constant of 140; For 758MHz ~ 803MHz lumped parameter isolator / isolator, the currently designed plastic package shell maximum capacitor mounting size is 2.1mm * 1mm, and the capacitor thickness must be about 0.1mm ~ 0.13mm to meet the design requirements of the capacitance value of the capacitor of 17PF ~ 22PF. can satisfy Due to the difficulty of research and development of high dielectric constant ceramic materials, when the manufacturing thickness of the capacitor is less than 0.16mm, the capacitance produced by the capacitor is very discrete and cannot be supplied in large quantities. Currently, mass production of low-frequency focused parameter isolators / circulators this cannot be implemented. Continuing to use the above conventional capacitor and plastic package shell design will cause great difficulties in designing a lumped parameter circulator/isolator of 600 MHz to 700 MHz used for subsequent communication.
본 발명의 목적은 커패시터 병렬 연결 기반의 아이솔레이터용 플라스틱 패키지 쉘을 제공하여, 플라스틱 패키지 쉘 사이즈 및 커패시터 장착 사이즈가 모두 고정된 경우, 더 낮은 주파수 대역의 아이솔레이터 설계를 구현하는 것이며 상기 발명은 저주파 대역의 서큘레이터 설계에 적용될 수 있다.An object of the present invention is to provide a plastic package shell for an isolator based on parallel connection of capacitors, to implement a lower frequency isolator design when both the plastic package shell size and the capacitor mounting size are fixed. It can be applied to circulator design.
상기 목적을 구현하기 위해, 본 발명에서 사용한 기술적 해결수단은 다음과 같다. 커패시터 병렬 연결 기반의 아이솔레이터용 플라스틱 패키지 쉘은 핀 금속 부분, 캐리어 금속 부분 및 플라스틱 부분을 포함하고, 상기 캐리어 금속 부분에는 동일한 형상과 크기의 제1 커패시터 접지 핀, 제2 커패시터 접지 핀 및 제3 커패시터 접지 핀이 설치되며, 중간 접지판이 더 설치되되, 여기서 상기 제1 커패시터 접지 핀과 중간 접지판은 좌우로 대향되게 설치되고, 상기 제2 커패시터 접지 핀과 제3 커패시터 접지 핀은 좌우로 대향되게 설치되며, 상기 제1 커패시터 접지 핀, 제2 커패시터 접지 핀 및 제3 커패시터 접지 핀은 모두 내부로 구부러져 상층 칩 커패시터 및 하층 칩 커패시터를 수용하는 수용 캐비티를 형성하고, 상기 수용 캐비티의 바닥부와 중간 접지판의 상부 표면은 동일한 높이에 있다.In order to achieve the above object, the technical solutions used in the present invention are as follows. A plastic package shell for an isolator based on parallel connection of capacitors includes a pin metal part, a carrier metal part and a plastic part, wherein the carrier metal part has a first capacitor ground pin, a second capacitor ground pin and a third capacitor having the same shape and size. A ground pin is installed, and an intermediate ground plate is further installed, wherein the first capacitor ground pin and the intermediate ground plate are installed to face left and right, and the second capacitor ground pin and the third capacitor ground pin are installed to face left and right. The first capacitor ground pin, the second capacitor ground pin, and the third capacitor ground pin are all bent inward to form an accommodating cavity accommodating the upper chip capacitor and the lower chip capacitor, and the bottom of the accommodating cavity and the middle ground. The upper surfaces of the plates are at the same level.
바람직한 기술적 해결수단으로서, 상기 핀 금속 부분 및 캐리어 금속 부분은 인청동 재료로 스탬핑 및 성형되고 니켈 은으로 전기도금된다. 또한 C5191 인청동이 바람직하고 0.13mm의 두께가 바람직하다. 칩 커패시터가 단단히 용접되도록 확보할 수 있다. 당업자는, 본 발명이 다른 등급의 다른 이미 알려진 플라스틱 패키지 쉘 금속 부분을 제조하는 재료를 사용하여 구현될 수도 있음을 이해할 수 있을 것이다.As a preferred technical solution, the pin metal part and the carrier metal part are stamped and formed from phosphor bronze material and electroplated with nickel silver. Also preferred is C5191 phosphor bronze and a thickness of 0.13 mm is preferred. It can be ensured that the chip capacitors are welded tightly. One of ordinary skill in the art will understand that the present invention may be implemented using other grades of materials from which other previously known plastic package shell metal parts are made.
바람직한 기술적 해결수단으로서, 상기 플라스틱 부분은 LCP 플라스틱으로 사출 성형되고, 더 바람직한 LCP 플라스틱의 등급은 E130i이고, 상기 등급의 플라스틱은 유동성이 좋고 성형 후 강도가 비교적 높다. 당업자는, 본 발명이 다른 등급의 다른 이미 알려진 플라스틱 패키지 쉘 플라스틱 부분을 제조하는 재료를 사용하여 구현될 수도 있음을 이해할 수 있을 것이다.As a preferred technical solution, the plastic part is injection molded by LCP plastic, a more preferred grade of LCP plastic is E130i, and the plastic of this grade has good fluidity and relatively high strength after molding. A person skilled in the art will understand that the present invention may be implemented using other grades of materials from which other previously known plastic package shell plastic parts are made.
바람직한 기술적 해결수단으로서, 상기 제1 커패시터 접지 핀, 제2 커패시터 접지 핀 및 제3 커패시터 접지 핀의 상부 폭은 상층 칩 커패시터의 폭보다 짧고, 더 바람직하게는 0.1mm 짧으며, 상기 설계 하에 상층 칩 커패시터는 용접 시 솔더 단락을 쉽게 일으키기 않는다.As a preferred technical solution, the upper width of the first capacitor ground pin, the second capacitor ground pin and the third capacitor ground pin is shorter than the width of the upper chip capacitor, more preferably 0.1 mm shorter, and under the design, the upper chip capacitor width is shorter. Capacitors do not easily cause solder shorts when welding.
바람직한 기술적 해결수단으로서, 상기 제1 커패시터 접지 핀, 제2 커패시터 접지 핀 및 제3 커패시터 접지 핀의 상부 굽힘 위치 폭은 0.3mm ~ 0.4mm이다.As a preferred technical solution, the upper bending position width of the first capacitor ground pin, the second capacitor ground pin and the third capacitor ground pin is 0.3 mm to 0.4 mm.
본 발명의 다른 목적은, 상기 플라스틱 패키지 쉘로 제조된 아이솔레이터를 제공하는 것이며, 기술적 해결수단은, 내림차순으로 조립된 상부 금속 쉘, 스트론튬 일정 자석, 상층 칩 커패시터, 중심 도체 모듈, 하층 칩 커패시터, 무선주파수 저항, 플라스틱 패키지 쉘 및 하부 금속 쉘을 포함하되; 여기서 상기 플라스틱 패키지 쉘은 핀 금속 부분, 캐리어 금속 부분 및 플라스틱 부분을 포함하고, 상기 캐리어 금속 부분에는 동일한 형상과 크기의 제1 커패시터 접지 핀, 제2 커패시터 접지 핀 및 제3 커패시터 접지 핀이 설치되며, 상기 제1 커패시터 접지 핀, 제2 커패시터 접지 핀 및 제3 커패시터 접지 핀은 모두 내부로 구부러져 수용 캐비티를 형성하고, 상기 상층 칩 커패시터와 하층 칩 커패시터는 상기 수용 캐비티 내에서 상하로 병렬 연결된다.Another object of the present invention is to provide an isolator made of the plastic package shell, and the technical solutions include an upper metal shell assembled in descending order, a strontium constant magnet, an upper chip capacitor, a central conductor module, a lower chip capacitor, and a radio frequency including a resistor, a plastic package shell and a lower metal shell; Here, the plastic package shell includes a pin metal part, a carrier metal part, and a plastic part, and a first capacitor ground pin, a second capacitor ground pin, and a third capacitor ground pin having the same shape and size are installed on the carrier metal part, , the first capacitor ground pin, the second capacitor ground pin, and the third capacitor ground pin are all inwardly bent to form an accommodating cavity, and the upper chip capacitor and the lower chip capacitor are vertically connected in parallel in the accommodating cavity.
종래의 기술에 비해, 본 발명의 장점은 다음과 같으며, 즉 본 발명은 종래의 플라스틱 패키지 쉘 설계에 비해, 포트 커패시터 용량을 향상시킬 수 있으며 내부 소자의 국가 생산화를 구현하여 600MHz ~ 700MHz의 집중 파라미터 아이솔레이터/서큘레이터를 제조할 수 있고, 단일 커패시터의 사이즈를 감소시키고 단일 커패시터의 두께를 증가시킬 수도 있으며; 커패시터의 제조에 유리하고 저주파 소자 제조의 재료 비용을 감소시킨다.Compared with the prior art, the advantages of the present invention are as follows, that is, compared to the conventional plastic package shell design, the present invention can improve the capacitance of the port and realize national production of internal elements, so that 600 MHz to 700 MHz It is possible to manufacture lumped parameter isolators/circulators, reduce the size of a single capacitor and increase the thickness of a single capacitor; It is advantageous for the manufacture of capacitors and reduces the material cost of manufacturing low-frequency devices.
도 1은 종래의 저주파 집중 파라미터 아이솔레이터의 분해 구조도이다.
도 2는 도 1 중 플라스틱 패키지 쉘의 구조 모식도이다.
도 3은 도 2 중 종래의 플라스틱 패키지 쉘의 커패시터 장착 위치 모식도이다.
도 4는 본 발명의 실시예의 저주파 집중 파라미터 아이솔레이터의 분해 구조도이다.
도 5는 도 1 중 플라스틱 패키지 쉘의 구조 모식도이다.
도 6은 본 발명의 아이솔레이터 상하 커패시터 병렬 연결 경로 모식도이다.
도 7은 본 발명의 아이솔레이터용 플라스틱 패키지 쉘 생산 및 유입 재료의 모식도이다.
도 8은 본 발명의 아이솔레이터의 입출력 포트의 정상파 시뮬레이션 곡선이다.
도 9는 본 발명의 아이솔레이터의 삽입 손실의 시뮬레이션 곡선이다.
도 10은 본 발명의 아이솔레이터의 아이솔레이션 시뮬레이션 곡선이다. 1 is an exploded structural diagram of a conventional low frequency concentrated parameter isolator.
FIG. 2 is a structural schematic diagram of a plastic package shell in FIG. 1 .
FIG. 3 is a schematic view of a capacitor mounting position of a conventional plastic package shell in FIG. 2 .
4 is an exploded structural diagram of a low frequency concentration parameter isolator in an embodiment of the present invention.
5 is a structural schematic diagram of a plastic package shell in FIG. 1 .
6 is a schematic diagram of a parallel connection path of upper and lower capacitors of the isolator of the present invention.
7 is a schematic diagram of the plastic package shell production and input materials for the isolator of the present invention.
8 is a standing wave simulation curve of an input/output port of the isolator of the present invention.
9 is a simulation curve of the insertion loss of the isolator of the present invention.
10 is an isolation simulation curve of the isolator of the present invention.
이하에서는 첨부 도면을 참고하여 본 발명에 대해 추가로 설명한다.Hereinafter, the present invention will be further described with reference to the accompanying drawings.
실시예 1Example 1
도 4를 참조하면, 저주파 집중 파라미터 아이솔레이터는 내림차순으로 조립된 상부 금속 쉘(1), 스트론튬 일정 자석(2), 상층 칩 커패시터(8), 중심 도체 모듈(3), 하층 칩 커패시터(9), 무선주파수 저항(5), 플라스틱 패키지 쉘(6) 및 하부 금속 쉘(7)을 포함하되; Referring to FIG. 4, the low frequency concentration parameter isolator is assembled in descending order: an upper metal shell (1), a strontium constant magnet (2), an upper chip capacitor (8), a central conductor module (3), a lower chip capacitor (9), including a radio frequency resistor (5), a plastic package shell (6) and a lower metal shell (7);
여기서, 상기 플라스틱 패키지 쉘(6)의 구조는 도 5 및 도 6에 도시된 바와 같고, 2개의 핀 금속 부분(61)(각각 출력 포트 신호 전송 핀(61a) 및 입력 포트 신호 전송 핀(61b)임), 캐리어 금속 부분(62) 및 플라스틱 부분(63)을 포함하며, 상기 캐리어 금속 부분(62)에는 동일한 형상과 크기의 제1 커패시터 접지 핀(62a), 제2 커패시터 접지 핀(62b) 및 제3 커패시터 접지 핀(62c)이 설치되고, 중간 접지판(62d)이 더 설치되되, 여기서 상기 제1 커패시터 접지 핀(62a)과 중간 접지판(62d)은 좌우로 대향되게 설치되며, 상기 제2 커패시터 접지 핀(62b)과 제3 커패시터 접지 핀(62c)은 좌우로 대향되게 설치되고, 상기 제1 커패시터 접지 핀(62a), 제2 커패시터 접지 핀(62b) 및 제3 커패시터 접지 핀(62c)은 모두 내부로 구부러져 수용 캐비티(62e)를 형성하며, 상기 상층 칩 커패시터(8)와 하층 칩 커패시터(9)는 상기 수용 캐비티(62e) 내에서 상하로 병렬 연결되고, 여기서 상층 칩 커패시터(8)와 하층 칩 커패시터(9) 사이에는 중심 도체 전송 와이어(10)가 설치된다.Here, the structure of the
본 실시예에서, 플라스틱 패키지 쉘(6)의 금속 부분, 즉 핀 금속 부분(61)과 캐리어 금속 부분(62)은 모두 0.13mm 두께의 C5191 인청동 재료로 스탬핑 및 성형되고 니켈 은으로 전기도금되어 칩 커패시터가 단단히 용접되도록 확보한다.In this embodiment, the metal parts of the
본 실시예에서, 상기 플라스틱 패키지 쉘(6)의 플라스틱 부분(63)은 E130i의 LCP 플라스틱으로 사출 성형되고, 상기 등급의 플라스틱은 유동성이 좋으며 성형 후 강도가 비교적 높다.In this embodiment, the
본 실시예에서, 상기 플라스틱 패키지 쉘(6)의 설계된 제1 커패시터 접지 핀(62a), 제2 커패시터 접지 핀(62b) 및 제3 커패시터 접지 핀(62c)의 상부 폭은 상층 칩 커패시터(8)의 폭보다 0.1mm 짧고, 이와 같이 상기 설계 하에 상층 칩 커패시터(8)는 용접 시 솔더 단락을 쉽게 일으키기 않는다.In this embodiment, the upper width of the designed first
도 7을 참조하면, 상기 플라스틱 패키지 쉘(6)의 상부의 3개의 커패시터 접지 핀(즉 제1 커패시터 접지 핀(62a), 제2 커패시터 접지 핀(62b) 및 제3 커패시터 접지 핀(62c))은 재료 유입 시 플라스틱 부분(63) 측벽과 평행하고 위를 향하며 스탬핑 및 성형 시 상부 커패시터 접지 핀의 후반 굽힘 부분에 대해 펀칭 및 벤딩 홈(62f) 처리를 수행하고, 펀칭 홈은 60°의 삼각홈으로 설계되어 굽힙 위치 폭을 0.3 ~ 0.4mm로 보장하여 후속의 조립 성형이 용이해지도록 한다.Referring to FIG. 7 , the three capacitor ground pins (ie, the first
본 실시예의 설계를 사용하면, 상기 설계된 플라스틱 패키지 쉘의 포트 커패시터 용량은 종래의 플라스틱 패키지 쉘 설계의 극한 용량 16 ~ 21PF에서 20 ~ 32PF의 극한 용량으로 증가되고, 커패시터의 사이즈는 종래 설계의 2.15mm*0.95mm에서 1.5mm*0.95mm ~ 2.0mm*0.95mm로 감소되며, 단일 커패시터의 두께는 종래 설계의 0.12mm ~ 0.15mm에서 0.17mm ~ 0.25mm로 증가됨으로써, 커패시터 제조가 유리해지고 저주파 소자 제조의 커패시터 재료 비용은 종래 설계의 18위안 ~ 20위안에서 8위안 ~ 12위안으로 감소될 수 있다.Using the design of this embodiment, the capacitance of the pot capacitor of the designed plastic package shell is increased from the limiting capacity of 16 to 21PF of the conventional design of the plastic package shell to the limiting capacity of 20 to 32PF, and the size of the capacitor is 2.15 mm of the conventional design. *0.95mm is reduced from 1.5mm*0.95mm to 2.0mm*0.95mm, and the thickness of a single capacitor is increased from 0.12mm to 0.15mm in the conventional design to 0.17mm to 0.25mm, making capacitor manufacturing advantageous and low-frequency device manufacturing The capacitor material cost of can be reduced from 18 yuan to 20 yuan in the conventional design to 8 yuan to 12 yuan.
본 실시예에서, 600MHz ~ 700MHz 주파수 대역 범위에서 N71 주파수 대역 중의 617MHz ~ 652MHz에 대해 아이솔레이터를 설계하였으며, 시뮬레이션 계산에 의한 전기 성능 곡선 결과는 도 8 내지 도 10을 참조한다.In this embodiment, the isolator was designed for 617 MHz to 652 MHz in the N71 frequency band in the 600 MHz to 700 MHz frequency band range, and the electrical performance curve results by simulation calculation are shown in FIGS. 8 to 10.
도면으로부터 알 수 있듯이, 상기 제품의 시뮬레이션 설계는 1.4 이하의 정상파 비율에 달할 수 있고, 삽입 손실은 0.6dB 이하이며, 아이솔레이션은 15dB 이하이다. 공정 경험에 따르면, 상기 제품은 최종 -40℃ ~ 125℃에서 정상파 비율<1.8, 삽입 손실<1.1dB, 아이솔레이션>10dB를 구현하여 상기 주파수 대역의 아이솔레이터에 대한 사용자의 지표 요구를 충족시킬 수 있다.As can be seen from the figure, the simulation design of the product can reach a standing wave ratio of less than 1.4, an insertion loss of less than 0.6dB, and an isolation of less than 15dB. According to process experience, the product achieves standing wave ratio<1.8, insertion loss<1.1dB, and isolation>10dB at the final -40℃~125℃, which can meet the user's index requirements for the isolator in the frequency band.
617MHz ~ 652MHz 아이솔레이터의 3개의 포트의 시뮬레이션 설계된 커패시터 커패시턴스 값은 22.83PF, 21.72PF, 25.26PF이고, 공정 경험 및 시뮬레이션 모델과 실제 조립의 커패시턴스 값의 차이에 따르면, 최종 상기 유형의 아이솔레이터에 필요한 3개의 포트 커패시터의 실제 커패시턴스 값은 24PF ~ 25PF, 23PF ~ 24PF, 27PF ~ 28PF이다.The simulation designed capacitor capacitance values of the three ports of the 617MHz ~ 652MHz isolator are 22.83PF, 21.72PF, and 25.26PF, and according to the process experience and the difference between the simulation model and the actual assembly capacitance value, the final three The actual capacitance values of the port capacitors are 24PF to 25PF, 23PF to 24PF, and 27PF to 28PF.
본 발명의 플라스틱 패키지 쉘 설계와 국내 칩 커패시터 제조 능력에 따라 하기와 같은 두께 및 커패시턴스 값의 커패시터를 선택하여 상기 유형의 아이솔레이터에 적응시킬 수 있다.According to the plastic package shell design of the present invention and the domestic chip capacitor manufacturing capability, capacitors with the following thickness and capacitance values can be selected to adapt to this type of isolator.
24PF ~ 25PF의 커패시턴스 값은 사이즈가 L*W*T=2mm*0.91mm*0.17mm이고 커패시턴스 값이 13.25PF이며, 사이즈가 L*W*T=1.8mm*0.9mm*0.18mm이고 커패시턴스 값이 11.1PF인 2개의 커패시터로 구성될 것을 요구하고;For the capacitance value of 24PF to 25PF, the size is L*W*T=2mm*0.91mm*0.17mm and the capacitance value is 13.25PF, and the size is L*W*T=1.8mm*0.9mm*0.18mm and the capacitance value is Requires to consist of two capacitors of 11.1 PF;
23PF ~ 24PF의 커패시턴스 값은 사이즈가 L*W*T=2mm*0.91mm*0.17mm이고 커패시턴스 값이 13.25PF이며, 사이즈가 L*W*T=1.8mm*0.9mm*0.19mm이고 커패시턴스 값이 10.5PF인 2개의 커패시터로 구성될 것을 요구하며;For the capacitance value of 23PF to 24PF, the size is L*W*T=2mm*0.91mm*0.17mm and the capacitance value is 13.25PF, and the size is L*W*T=1.8mm*0.9mm*0.19mm and the capacitance value is Requires to consist of two capacitors of 10.5 PF;
27PF ~ 28PF의 커패시턴스 값은 사이즈가 L*W*T=3mm*0.9mm*0.25mm이고 커패시턴스 값이 13.4PF이며, 사이즈가 L*W*T=2.5mm*0.9mm*0.2mm이고 커패시턴스 값이 13.9PF인 2개의 커패시터로 구성될 것을 요구한다.For the capacitance value of 27PF to 28PF, the size is L*W*T=3mm*0.9mm*0.25mm and the capacitance value is 13.4PF, and the size is L*W*T=2.5mm*0.9mm*0.2mm and the capacitance value is It requires that it consist of two capacitors of 13.9PF.
실시예 2Example 2
본 실시예에서, 제2 커패시터 접지 핀(62b) 및 제3 커패시터 접지 핀(62c)의 상부 폭은 상층 칩 커패시터(8)의 폭보다 0.3mm 짧고, 나머지는 실시예 1과 동일하다.In this embodiment, the upper width of the second
이상 서술은 본 발명의 비교적 바람직한 실시예일 뿐 본 발명을 한정하지 않으며, 본 발명의 정신과 원칙 이내에서 이루어진 임의의 수정, 등가 교체 및 개선은 모두 본 발명의 보호 범위 이내에 포함되어야 한다.The above descriptions are only relatively preferred embodiments of the present invention, but do not limit the present invention, and any modifications, equivalent replacements and improvements made within the spirit and principles of the present invention should all fall within the protection scope of the present invention.
1: 상부 금속 쉘
2: 스트론튬 일정 자석
3: 중심 도체 모듈
4: 단층 칩 커패시터
5: 무선주파수 저항
6: 플라스틱 패키지 쉘
61: 핀 금속 부분
61a: 출력 포트 신호 전송 핀
61b: 입력 포트 신호 전송 핀
62: 캐리어 금속 부분
62a: 제1 커패시터 접지 핀
62b: 제2 커패시터 접지 핀
62c: 제3 커패시터 접지 핀
62d: 중간 접지판
62e: 수용 캐비티
62f: 펀칭 및 벤딩 홈
63: 플라스틱 부분
7: 하부 금속 쉘
8: 상층 칩 커패시터
9: 하층 칩 커패시터
10: 중심 도체 전송 와이어1: upper metal shell
2: strontium constant magnet
3: Center conductor module
4: single layer chip capacitor
5: radiofrequency resistance
6: plastic package shell
61: pin metal part
61a: output port signal transmission pin
61b: input port signal transmission pin
62: carrier metal part
62a: first capacitor ground pin
62b: second capacitor ground pin
62c: third capacitor ground pin
62d: middle ground plate
62e: receiving cavity
62f: punching and bending groove
63: plastic part
7: lower metal shell
8: upper layer chip capacitor
9: lower layer chip capacitor
10: center conductor transmission wire
Claims (8)
핀 금속 부분(61), 캐리어 금속 부분(62) 및 플라스틱 부분(63)을 포함하고,
상기 캐리어 금속 부분(62)에는 동일한 형상과 크기의 제1 커패시터 접지 핀(62a), 제2 커패시터 접지 핀(62b) 및 제3 커패시터 접지 핀(62c)이 설치되며, 중간 접지판(62d)이 더 설치되되, 상기 제1 커패시터 접지 핀(62a)과 중간 접지판(62d)은 좌우로 대향되게 설치되고, 상기 제2 커패시터 접지 핀(62b)과 제3 커패시터 접지 핀(62c)은 좌우로 대향되게 설치되며, 상기 제1 커패시터 접지 핀(62a), 제2 커패시터 접지 핀(62b) 및 제3 커패시터 접지 핀(62c)은 모두 내부로 구부러져 상층 칩 커패시터(8) 및 하층 칩 커패시터(9)를 수용하는 수용 캐비티(62e)를 형성하고, 상기 수용 캐비티(62e)의 바닥부는 중간 접지판(62d)의 상부 표면과 같은 높이에 있는 것을 특징으로 하는 커패시터 병렬 연결 기반의 아이솔레이터용 플라스틱 패키지 쉘.In the plastic package shell for isolators based on parallel connection of capacitors,
comprising a pin metal part 61, a carrier metal part 62 and a plastic part 63;
A first capacitor ground pin 62a, a second capacitor ground pin 62b, and a third capacitor ground pin 62c having the same shape and size are installed on the carrier metal part 62, and an intermediate ground plate 62d is Further, the first capacitor ground pin 62a and the intermediate ground plate 62d are installed to face left and right, and the second capacitor ground pin 62b and the third capacitor ground pin 62c are left and right to face each other. The first capacitor ground pin 62a, the second capacitor ground pin 62b, and the third capacitor ground pin 62c are all bent inward to form an upper chip capacitor 8 and a lower chip capacitor 9. A plastic package shell for an isolator based on capacitor parallel connection, characterized in that an accommodating cavity 62e is formed, and the bottom of the accommodating cavity 62e is at the same level as the upper surface of the intermediate ground plate 62d.
상기 핀 금속 부분(61) 및 캐리어 금속 부분(62)은 인청동 재료로 스탬핑 및 성형되고 니켈 은으로 전기도금되는 것을 특징으로 하는 커패시터 병렬 연결 기반의 아이솔레이터용 플라스틱 패키지 쉘.According to claim 1,
The plastic package shell for an isolator based on capacitor parallel connection, characterized in that the pin metal part (61) and the carrier metal part (62) are stamped and molded with phosphor bronze material and electroplated with nickel silver.
상기 인청동 재료는 C5191 인청동 재료인 것을 특징으로 하는 커패시터 병렬 연결 기반의 아이솔레이터용 플라스틱 패키지 쉘.According to claim 2,
The phosphor bronze material is a plastic package shell for a capacitor parallel connection-based isolator, characterized in that the C5191 phosphor bronze material.
상기 플라스틱 부분(63)은 LCP 플라스틱으로 사출 성형되는 것을 특징으로 하는 커패시터 병렬 연결 기반의 아이솔레이터용 플라스틱 패키지 쉘.According to claim 1,
The plastic part (63) is a plastic package shell for an isolator based on capacitor parallel connection, characterized in that the plastic part (63) is injection molded with LCP plastic.
상기 LCP 플라스틱 등급은 E130i인 것을 특징으로 하는 커패시터 병렬 연결 기반의 아이솔레이터용 플라스틱 패키지 쉘.According to claim 4,
The plastic package shell for the capacitor parallel connection-based isolator, characterized in that the LCP plastic grade is E130i.
상기 제1 커패시터 접지 핀(62a), 제2 커패시터 접지 핀(62b) 및 제3 커패시터 접지 핀(62c)의 상부 폭은 상층 칩 커패시터(8)의 폭보다 짧은 것을 특징으로 하는 커패시터 병렬 연결 기반의 아이솔레이터용 플라스틱 패키지 쉘.According to claim 1,
The upper width of the first capacitor ground pin 62a, the second capacitor ground pin 62b, and the third capacitor ground pin 62c is shorter than the width of the upper chip capacitor 8. Plastic package shell for isolators.
상기 제1 커패시터 접지 핀(62a), 제2 커패시터 접지 핀(62b) 및 제3 커패시터 접지 핀(62c)의 상부 굽힘 위치 폭은 0.3mm ~ 0.4mm인 것을 특징으로 하는 커패시터 병렬 연결 기반의 아이솔레이터용 플라스틱 패키지 쉘.According to claim 1,
The first capacitor ground pin (62a), the second capacitor ground pin (62b), and the upper bending position width of the third capacitor ground pin (62c) are 0.3 mm to 0.4 mm for an isolator based on capacitor parallel connection, characterized in that plastic package shell.
내림차순으로 조립된 상부 금속 쉘(1), 스트론튬 일정 자석(2), 상층 칩 커패시터(8), 중심 도체 모듈(3), 하층 칩 커패시터(9), 무선주파수 저항(5), 플라스틱 패키지 쉘(6) 및 하부 금속 쉘(7)을 포함하되; 상기 플라스틱 패키지 쉘(6)은 핀 금속 부분(61), 캐리어 금속 부분(62) 및 플라스틱 부분(63)을 포함하고, 상기 캐리어 금속 부분(62)에는 동일한 형상과 크기의 제1 커패시터 접지 핀(62a), 제2 커패시터 접지 핀(62b) 및 제3 커패시터 접지 핀(62c)이 설치되며, 상기 제1 커패시터 접지 핀(62a), 제2 커패시터 접지 핀(62b) 및 제3 커패시터 접지 핀(62c)은 모두 내부로 구부러져 수용 캐비티(62e)를 형성하고, 상기 상층 칩 커패시터(8)와 하층 칩 커패시터(9)는 상기 수용 캐비티(62e) 내에서 상하로 병렬 연결되는 것을 특징으로 하는 아이솔레이터.In the isolator made of the plastic package shell according to any one of claims 1 to 7,
Upper metal shell (1) assembled in descending order, strontium constant magnet (2), upper chip capacitor (8), center conductor module (3), lower chip capacitor (9), radio frequency resistor (5), plastic package shell ( 6) and a lower metal shell 7; The plastic package shell 6 includes a pin metal part 61, a carrier metal part 62 and a plastic part 63, and the carrier metal part 62 includes a first capacitor ground pin having the same shape and size ( 62a), a second capacitor ground pin 62b, and a third capacitor ground pin 62c are installed, and the first capacitor ground pin 62a, the second capacitor ground pin 62b, and the third capacitor ground pin 62c are installed. ) are all bent inward to form an accommodating cavity 62e, and the upper chip capacitor 8 and the lower chip capacitor 9 are vertically connected in parallel in the accommodating cavity 62e.
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