KR20220152999A - 통신 방법 및 장치 - Google Patents

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KR20220152999A
KR20220152999A KR1020227027326A KR20227027326A KR20220152999A KR 20220152999 A KR20220152999 A KR 20220152999A KR 1020227027326 A KR1020227027326 A KR 1020227027326A KR 20227027326 A KR20227027326 A KR 20227027326A KR 20220152999 A KR20220152999 A KR 20220152999A
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화위 저우
전강 판
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스프레드트럼 커뮤니케이션즈 (상하이) 컴퍼니 리미티드
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Abstract

본 출원의 실시예는 통신 방법 및 장치를 제공하며, 사용자 기기에 적용되고, 상기 방법은, 페이징 지시 물리적 다운링크 제어 채널(PDCCH)을 센싱하는 단계; 페이징 지시 PDCCH가 검출되면, 페이징 지시 정보를 획득하고, 페이징 지시 정보를 기초로, 페이징 PDCCH의 센싱 필요 여부를 결정하는 단계를 포함한다. 사용자 기기가 페이징 PDCCH를 센싱하는 횟수 또는 페이징 메시지를 수신하는 횟수를 줄여, 사용자 기기의 전력을 절약한다.

Description

통신 방법 및 장치
본 출원의 실시예는 컴퓨터 분야에 관한 것으로서, 특히 통신 방법 및 장치에 관한 것이다.
현재, 사용자 기기(User Equipment, UE, 단말이라고도 함)가 아이들 상태(RRC IDLE, RRC IDLE state, Idle state, Idle mode)일 때, 기지국으로부터 송신되는 페이징 메시지를 수신할 수 있도록, UE는 특정 센싱 기회(Paging Occasion, PO)에 기지국이 빔 스위핑을 사용하여 송신한 페이징 물리적 다운링크 제어 채널(Physical Downlink Control Channel, PDCCH)을 센싱하여야 한다. 5G 시스템에서, 페이징 PDCCH는 타입 2-PDCCH 공통 검색 공간 세트(Type2-PDCCH common search space set, Type2-PDCCH CSS set)에서 설정한 PDCCH일 수 있다. 일반적으로, Type2-PDCCH CSS set는 예컨대 페이징 검색 공간(paging Search Space)과 같은 상위 계층 파라미터에 의해 구성되며, P-RNTI에 의해 CRC 스크램블링이 수행된다.
종래기술에서, 페이징 기회는 일 세트의 UE에 대한 것이므로, 페이징 기회 내의 물리적 다운링크 공유 채널(Physical Downlink Share Chanel, PDSCH)에 적재된 페이징 메시지(paging message)는 특정 UE에 대한 것이 아니며, 해당 UE는 여전히 페이징 PDCCH의 센싱 및 페이징 메시지의 수신 등의 전체 과정을 수행하지만, 그 어느 페이징 메시지도 상기 UE에 필요한 것이 아니므로(일반적으로 이러한 경우는 거짓 경보 또는 false alert라고 함), 이러한 경우, 상기 UE는 불필요한 수신에 전력을 소모하게 되어, 해당 UE의 전력 소모가 보다 커진다.
또한, 5G 시스템에서, UE는 센싱 기회에서 기지국이 빔 스위핑(복수의 빔 포함)을 사용하여 UE로 송신한 페이징 PDCCH를 센싱하여야 한다. UE는 빔에 대한 검출 또는 측정을 통해, 하나 또는 복수의 빔에서 페이징 PDCCH를 센싱할 것을 선택한다. UE가 복수의 빔에서 페이징 PDCCH를 센싱할 것을 선택할 때, UE의 전력 소모가 더욱 커진다.
본 출원의 실시예는 통신 방법 및 장치를 제공하며, 사용자 기기가 페이징 PDCCH를 센싱하는 횟수 또는 페이징 메시지를 수신하는 횟수를 줄여, 사용자 기기의 전력을 절약한다.
제1 측면에 따르면, 본 출원의 실시예는 사용자 기기에 적용되는 통신 방법을 제공하며, 상기 방법은,
페이징 지시 PDCCH를 센싱하는 단계;
페이징 지시 PDCCH가 검출되면, 페이징 지시 정보를 획득하는 단계;
페이징 지시 정보를 기초로, 페이징 PDCCH의 센싱 필요 여부를 결정하는 단계;를 포함한다.
일 가능한 설계에서, 상기 페이징 지시 PDCCH를 센싱하는 단계는,
페이징 지시 PDCCH 센싱 기회에서, 상기 페이징 지시 PDCCH를 센싱하는 단계를 포함하고;
여기서, 제1 시점 이전에 있으며, 제1 시점과의 사이의 오프셋이 제1 기설정 시간길이인 것; 또는, 제1 시점 이후에 있으며, 제1 시점과의 사이의 오프셋이 제1 기설정 시간길이인 것; 제1 시점은 동기 신호 블록, 또는 정보 상태 정보 기준 신호, 또는 추종 기준 신호의 시작 시점 또는 종료 시점이다.
다른 가능한 설계에서, 페이징 지시 정보를 획득하는 단계는,
페이징 지시 PDCCH에 대응되는 다운링크 제어 정보(DCI) 또는 다운링크 제어 정보(DCI) 포맷 중의 타겟 비트로부터 페이징 지시 정보를 획득하는 단계를 포함한다.
다른 가능한 설계에서, 타겟 비트는 DCI 또는 DCI 포맷 중의 보류 비트이다.
다른 가능한 설계에서, 타겟 비트는 재정의 DCI 또는 DCI 포맷에 이미 정의된 도메인 중의 비트이다.
다른 가능한 설계에서, 페이징 지시 정보를 획득하는 단계는,
페이징 지시 PDCCH에 의해 스케줄링되는 물리적 다운링크 공유 채널(PDSCH)로부터 페이징 지시 정보를 획득하는 단계를 포함한다.
다른 가능한 설계에서, 페이징 지시 정보는 비트맵이고, 비트맵은 적어도 상기 사용자 기기에 대응되는 사용자 기기 서브 세트에 대응되는 비트를 포함한다.
다른 가능한 설계에서, 페이징 지시 정보는 사용자 기기 서브 세트의 번호 또는 인덱스이다.
다른 가능한 설계에서, 페이징 지시 정보를 기초로, 페이징 PDCCH의 센싱 필요 여부를 결정하는 단계는,
비트가 1이면, 페이징 PDCCH의 센싱이 필요한 것으로 결정하는 단계;
비트가 0이면, 페이징 PDCCH의 센싱이 불필요한 것으로 결정하는 단계;를 포함한다.
다른 가능한 설계에서, 페이징 지시 정보를 기초로, 페이징 PDCCH의 센싱 필요 여부를 결정하는 단계는,
비트가 0이면, 페이징 PDCCH의 센싱이 필요한 것으로 결정하는 단계;
비트가 1이면, 페이징 PDCCH의 센싱이 불필요한 것으로 결정하는 단계;를 포함한다.
다른 가능한 설계에서, 상기 페이징 지시 PDCCH를 센싱하는 단계는,
페이징 지시 PDCCH 센싱 기회에서, 상기 페이징 지시 PDCCH를 센싱하는 단계를 포함하고;
여기서, 상기 페이징 지시 PDCCH 센싱 기회는, 제2 시점 이전에 있으며, 상기 제2 시점과의 사이의 오프셋이 제2 기설정 시간길이인 것; 상기 제2 시점이 페이징 기회의 시작 시점 또는 종료 시점이거나, 또는 페이징 기회에 대응되는 페이징 PDCCH 센싱 기회의 시작 시점 또는 종료 시점인 것; 중 어느 하나의 조건을 만족한다.
다른 가능한 설계에서, 페이징 지시 정보를 획득하는 단계는,
페이징 지시 PDCCH에 대응되는 DCI 또는 DCI 포맷 중의 타겟 비트로부터 페이징 지시 정보를 획득하는 단계를 포함한다.
다른 가능한 설계에서, 타겟 비트는 DCI 또는 DCI 포맷 중의 보류 비트이다.
다른 가능한 설계에서, 타겟 비트는 재정의 DCI 또는 DCI 포맷에 이미 정의된 도메인 중의 비트이다.
다른 가능한 설계에서, 페이징 지시 PDCCH를 센싱하여 페이징 지시 정보를 획득하는 단계는,
페이징 지시 PDCCH에 의해 스케줄링되는 PDSCH로부터 페이징 지시 정보를 획득하는 단계를 포함한다.
다른 가능한 설계에서, 페이징 지시 정보는 비트맵이고, 비트맵은 적어도 상기 사용자 기기에 대응되는 사용자 기기 서브 세트에 대응되는 비트를 포함한다.
다른 가능한 설계에서, 페이징 지시 정보는 사용자 기기 서브 세트의 번호 또는 인덱스이다.
다른 가능한 설계에서, 페이징 지시 정보를 기초로, 페이징 PDCCH의 센싱 필요 여부를 결정하는 단계는,
비트가 1이면, 페이징 PDCCH의 센싱이 필요한 것으로 결정하는 단계;
비트가 0이면, 페이징 PDCCH의 센싱이 불필요한 것으로 결정하는 단계;를 포함한다.
다른 가능한 설계에서, 페이징 지시 정보를 기초로, 페이징 PDCCH의 센싱 필요 여부를 결정하는 단계는,
비트가 0이면, 페이징 PDCCH의 센싱이 필요한 것으로 결정하는 단계;
비트가 1이면, 페이징 PDCCH의 센싱이 불필요한 것으로 결정하는 단계;를 포함한다.
제2 측면에 따르면, 본 출원의 실시예는 사용자 기기에 적용되는 통신 방법을 제공하며, 상기 방법은,
페이징 PDCCH를 센싱하는 단계;
페이징 PDCCH가 검출되면, 페이징 지시 정보를 획득하는 단계;
페이징 지시 정보를 기초로, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신 필요 여부를 결정하는 단계;를 포함한다.
일 가능한 설계에서, 페이징 지시 정보를 획득하는 단계는,
페이징 PDCCH에 대응되는 다운링크 제어 정보(DCI) 또는 다운링크 제어 정보(DCI) 포맷 중의 타겟 비트로부터 페이징 지시 정보를 획득하는 단계를 포함한다.
다른 가능한 설계에서, 타겟 비트는 DCI 또는 DCI 포맷 중의 보류 비트이다.
다른 가능한 설계에서, 페이징 지시 정보는 비트맵이고, 비트맵은 적어도 상기 사용자 기기에 대응되는 사용자 기기 서브 세트에 대응되는 비트를 포함한다.
다른 가능한 설계에서, 페이징 지시 정보는 사용자 기기 서브 세트의 번호 또는 인덱스이다.
다른 가능한 설계에서, 페이징 지시 정보를 기초로, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신 필요 여부를 결정하는 단계는,
비트가 1이면, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신이 필요한 것으로 결정하는 단계;
비트가 0이면, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신이 불필요한 것으로 결정하는 단계;를 포함한다.
다른 가능한 설계에서, 페이징 지시 정보를 기초로, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신 필요 여부를 결정하는 단계는,
비트가 1이면, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신이 필요한 것으로 결정하는 단계;
비트가 0이면, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신이 불필요한 것으로 결정하는 단계;를 포함한다.
제3 측면에 따르면, 본 출원의 실시예는 사용자 기기에 적용되는 통신 장치를 제공하며, 센싱 모듈, 획득 모듈과 결정 모듈을 포함하며, 여기서,
센싱 모듈은 페이징 지시 물리적 다운링크 제어 채널(PDCCH)을 센싱하고;
획득 모듈은 페이징 지시 PDCCH가 검출되면, 페이징 지시 정보를 획득하고;
결정 모듈은 페이징 지시 정보를 기초로, 페이징 PDCCH의 센싱 필요 여부를 결정한다.
일 가능한 설계에서, 센싱 모듈은 구체적으로,
페이징 지시 PDCCH 센싱 기회에서, 상기 페이징 지시 PDCCH를 센싱하고;
여기서, 페이징 지시 PDCCH 센싱 기회는, 제1 시점 이전에 있으며, 제1 시점과의 사이의 오프셋이 기설정 시간길이인 것; 또는, 제1 시점 이후에 있으며, 제1 시점과의 사이의 오프셋이 기설정 시간길이이며, 제1 시점은 동기 신호 블록, 또는 채널 상태 정보 기준 신호, 또는 추종 기준 신호의 시작 시점 또는 종료 시점인 것; 중 어느 하나의 조건을 만족한다.
다른 가능한 설계에서, 획득 모듈은 구체적으로,
페이징 지시 PDCCH에 대응되는 다운링크 제어 정보(DCI) 또는 다운링크 제어 정보(DCI) 포맷 중의 타겟 비트로부터 페이징 지시 정보를 획득한다.
다른 가능한 설계에서, 타겟 비트는 DCI 또는 DCI 포맷 중의 보류 비트이다.
다른 가능한 설계에서, 타겟 비트는 재정의 DCI 또는 DCI 포맷에 이미 정의된 도메인 중의 비트이다.
다른 가능한 설계에서, 획득 모듈은 구체적으로,
페이징 지시 PDCCH에 의해 스케줄링되는 물리적 다운링크 공유 채널(PDSCH)로부터 페이징 지시 정보를 획득한다.
다른 가능한 설계에서, 페이징 지시 정보는 비트맵이고, 비트맵은 적어도 상기 사용자 기기에 대응되는 사용자 기기 서브 세트에 대응되는 비트를 포함한다.
다른 가능한 설계에서, 페이징 지시 정보는 사용자 기기 서브 세트의 번호 또는 인덱스이다.
다른 가능한 설계에서, 결정 모듈은 구체적으로,
비트가 1이면, 페이징 PDCCH의 센싱이 필요한 것으로 결정하고;
비트가 0이면, 페이징 PDCCH의 센싱이 불필요한 것으로 결정한다.
다른 가능한 설계에서, 결정 모듈은 구체적으로,
비트가 0이면, 페이징 PDCCH의 센싱이 필요한 것으로 결정하고;
비트가 1이면, 페이징 PDCCH의 센싱이 불필요한 것으로 결정한다.
일 가능한 설계에서, 센싱 모듈은 구체적으로,
페이징 지시 PDCCH 센싱 기회에서, 상기 페이징 지시 PDCCH를 센싱하고;
여기서, 페이징 지시 PDCCH 센싱 기회는, 페이징 지시 PDCCH 센싱 기회는, 제2 시점 이전에 있으며, 제2 시점과의 사이의 오프셋이 제2 기설정 시간길이인 것; 제2 시점이 페이징 기회의 시작 시점 또는 종료 시점이거나, 또는 페이징 기회에 대응되는 페이징 PDCCH 센싱 기회의 시작 시점 또는 종료 시점인 것; 중 어느 하나의 조건을 만족한다 중 어느 하나의 조건을 만족한다.
일 가능한 설계에서, 획득 모듈은 구체적으로,
페이징 지시 PDCCH에 대응되는 DCI 또는 DCI 포맷 중의 타겟 비트로부터 페이징 지시 정보를 획득한다.
다른 가능한 설계에서, 타겟 비트는 DCI 또는 DCI 포맷 중의 보류 비트이다.
다른 가능한 설계에서, 타겟 비트는 재정의 DCI 또는 DCI 포맷에 이미 정의된 도메인 중의 비트이다.
다른 가능한 설계에서, 획득 모듈은 구체적으로,
페이징 지시 PDCCH에 의해 스케줄링되는 PDSCH로부터 페이징 지시 정보를 획득한다.
다른 가능한 설계에서, 페이징 지시 정보는 비트맵이고, 비트맵은 적어도 상기 사용자 기기에 대응되는 사용자 기기 서브 세트에 대응되는 비트를 포함한다.
다른 가능한 설계에서, 페이징 지시 정보는 사용자 기기 서브 세트의 번호 또는 인덱스이다.
다른 가능한 설계에서, 결정 모듈은 구체적으로,
비트가 1이면, 페이징 PDCCH의 센싱이 필요한 것으로 결정하고;
비트가 0이면, 페이징 PDCCH의 센싱이 불필요한 것으로 결정한다.
다른 가능한 설계에서, 결정 모듈은 구체적으로,
비트가 0이면, 페이징 PDCCH의 센싱이 필요한 것으로 결정;
비트가 1이면, 페이징 PDCCH의 센싱이 불필요한 것으로 결정한다.
제4 측면에 따르면, 본 출원의 실시예는 사용자 기기에 적용되는 통신 장치를 제공하며, 센싱 모듈, 획득 모듈과 결정 모듈을 포함하고, 여기서,
센싱 모듈은 페이징 물리적 다운링크 제어 채널(PDCCH)을 센싱하고;
획득 모듈은 페이징 PDCCH가 검출되면, 페이징 지시 정보를 획득하고;
결정 모듈은 페이징 지시 정보를 기초로, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신 필요 여부를 결정한다.
일 가능한 설계에서, 획득 모듈은 구체적으로,
페이징 PDCCH에 대응되는 다운링크 제어 정보(DCI) 또는 다운링크 제어 정보(DCI) 포맷 중의 타겟 비트로부터 페이징 지시 정보를 획득한다.
다른 가능한 설계에서, 타겟 비트는 DCI 또는 DCI 포맷 중의 보류 비트이다.
다른 가능한 설계에서, 페이징 지시 정보는 비트맵이고, 비트맵은 적어도 상기 사용자 기기에 대응되는 사용자 기기 서브 세트에 대응되는 비트를 포함한다.
다른 가능한 설계에서, 페이징 지시 정보는 사용자 기기 서브 세트의 번호 또는 인덱스이다.
다른 가능한 설계에서, 결정 모듈은 구체적으로,
비트가 1이면, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신이 필요한 것으로 결정하고;
비트가 0이면, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신이 불필요한 것으로 결정한다.
다른 가능한 설계에서, 결정 모듈은 구체적으로,
비트가 1이면, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신이 필요한 것으로 결정하고;
비트가 0이면, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신이 불필요한 것으로 결정한다.
제5 측면에 따르면, 본 출원의 실시예는 통신 장치를 제공하며, 프로세서와 메모리를 포함하고;
메모리에 컴퓨터 실행 명령이 저장되고;
프로세서가 메모리에 저장된 컴퓨터 실행 명령을 실행하여, 프로세서가 상술한 제1 측면 중 어느 하나에 따른 통신 방법을 수행하도록 한다.
제6 측면에 따르면, 본 출원의 실시예는 통신 장치를 제공하며, 프로세서와 메모리를 포함하고;
메모리에 컴퓨터 실행 명령이 저장되고;
프로세서는 메모리에 저장된 컴퓨터 실행 명령을 실행하여, 프로세서가 상술한 제2 측면 중 어느 하나에 따른 통신 방법을 수행하도록 한다.
제7 측면에 따르면, 본 출원의 실시예는 컴퓨터 판독 가능 저장매체를 제공하며, 컴퓨터 판독 가능 저장매체에 컴퓨터 실행 명령이 저장되어 있고, 프로세서가 컴퓨터 실행 명령을 실행할 때, 제1 측면 중 어느 하나에 따른 통신 방법을 구현한다.
제8 측면에 따르면, 본 출원의 실시예는 컴퓨터 판독 가능 저장매체를 제공하며, 컴퓨터 판독 가능 저장매체에 컴퓨터 실행 명령이 저장되어 있고, 프로세서가 컴퓨터 실행 명령을 실행할 때, 제2 측면 중 어느 하나에 따른 통신 방법을 구현한다.
본 출원에서 제공하는 통신 방법 및 장치에서, 상기 방법은 페이징 지시 물리적 다운링크 제어 채널(PDCCH) 또는 페이징 물리적 다운링크 제어 채널(PDCCH)을 센싱하여 페이징 지시 정보를 획득하는 단계; 페이징 지시 PDCCH 또는 페이징 PDCCH가 검출되면, 페이징 지시 정보를 획득하는 단계; 페이징 지시 정보를 기초로, 페이징 PDCCH의 센싱 또는 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신 필요 여부를 결정하는 단계를 포함한다. 상술한 방법에서, 페이징 지시 정보를 기초로, 페이징 PDCCH의 센싱 필요 여부 또는 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지 수신 여부를 결정함으로써, 페이징 PDCCH를 센싱하는 횟수 또는 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지를 수신하는 횟수를 줄여, 사용자 기기의 전력을 절약한다.
본 출원의 실시예 또는 종래기술에 따른 기술방안을 더욱 명확하게 설명하기 위하여, 아래에서는 실시예 또는 종래기술을 설명하기 위해 필요한 첨부 도면을 간략하게 소개한다. 아래에서 설명되는 첨부 도면은 단지 본 출원의 일부 실시예일 뿐, 본 분야에서 통상의 지식을 가진 자가 창조적인 노력을 들이지 않고도 이러한 첨부 도면을 기초로 기타 첨부 도면을 얻어낼 수 있음은 자명하다.
도 1은 본 출원에서 제공하는 통신 방법의 응용 시나리오를 나타내는 도면이다.
도 2는 본 출원의 실시예에 따른 통신 방법을 나타내는 흐름도이다.
도 3은 본 출원의 실시예에 따른 다른 통신 방법을 나타내는 흐름도이다.
도 4는 본 출원의 실시예에 따른 통신 장치를 나타내는 구성도이다.
도 5는 본 출원의 실시예에 따른 다른 통신 장치를 나타내는 구성도이다.
도 6은 본 출원의 실시예에 따른 통신기기의 하드웨어 구성도이다.
도 7은 본 출원의 실시예에 따른 다른 통신기기의 하드웨어 구성도이다.
본 출원의 실시예의 목적, 기술방안 및 이점이 더욱 명확하도록, 아래에서는 본 출원의 실시예에 따른 첨부 도면을 결합하여, 본 출원의 실시예에 따른 기술방안을 명확하고 충분하게 설명한다. 물론, 기재되는 실시예는 단지 본 출원의 부분 실시예일 뿐, 전부의 실시예는 아니다. 본 출원의 실시예의 기초 상에서, 본 분야에서 통상의 지식을 가진 자가 창조적인 노력을 들이지 않고 획득한 모든 기타 실시예들은 전부 본 출원의 보호범위에 속한다.
본 출원에 따른 기술방안은 제5 세대 모바일 통신 기술(the 5th generation mobile communication technology, 5G) 시스템에 적용될 수 있고, 롱 템 에볼루션(long term evolution, LTE) 시스템에 적용될 수도 있고, 범용 모바일 통신 시스템(universal mobile telecommunications system, UMTS) 지상파 무선 액세스 네트워크(UMTS terrestrial radio access network, UTRAN) 시스템, 또는 글로벌 모바일 통신 시스템(global system for mobile communication, GSM)/증강형 데이터 레이트 GSM 진화(enhanced data rate for GSM evolution, EDGE) 시스템의 무선 접속 네트워크(GSM EDGE radio access network, GERAN) 아키텍처에 적용될 수도 있다. 예를 들어, 5G 시스템중의 차량 대 사물(vehicle to X, V2X) 시스템, 기기 대 기기(device to device, D2D) 시스템, 기계형 통신(machine type communication, MTC) 시스템 등에 적용될 수도 있다.
본 출원에 따른 기술방안은 예를 들어 5G 시스템의 진화형 통신 시스템 등과 같은 기타 통신 시스템에도 적용될 수 있으며, 본 출원은 이에 대해 한정하지 않는다.
도 1은 본 출원에서 제공하는 통신 방법의 응용 시나리오를 나타내는 도면이다. 도 1에 도시된 바와 같이, 통신 시스템은 기지국(101)과 사용자 기기(102)를 포함한다. 여기서, 사용자 기기(102)는 기지국(101)에 의해 커버되는 서비스 셀 중의 사용자 기기이다.
선택적으로, 사용자 기기(102)는 모바일 폰(또는 "셀룰러" 폰이라도 함) 또는 모바일 단말을 구비하는 컴퓨터일 수 있으며, 예를 들어, 휴대식, 포켓식, 핸드헬드식, 컴퓨터 내장 또는 차량용 모바일 장치 등일 수 있다. 한편, 사용자 기기(102)는 모바일 스테이션(mobile station, MS), 단말(terminal), 단말기(terminal equipment)라고도 할 수 있다. 본 출원에서, 예시적으로 사용자 기기(102)의 수량을 4로 하여 통신 방법의 응용 시나리오에 대해 설명하며, 여기서는 사용자 기기(102)의 구체적인 유형과 수량에 대해 제한하지 않는다.
실제 응용에서, 기지국(101)은 사용자 기기(102)로 페이징 지시(Paging Indication, PI) 물리적 다운링크 제어 채널(Physical Downlink Control Channel, PDCCH) 또는 페이징(Paging) PDCCH를 송신하고, 사용자 기기(102)는 페이징 지시 PDCCH 또는 페이징 PDCCH를 센싱하여 페이징 지시 정보를 획득하고, 페이징 지시 PDCCH 또는 페이징 PDCCH가 검출되면, 페이징 지시 정보를 획득하고, 만약 페이징 지시 정보를 기초로 페이징 PDCCH의 센싱 또는 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신이 필요한 것으로 결정되면, 페이징 PDCCH를 센싱하거나 또는 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지를 수신하여, 기지국(101)으로부터 사용자 기기(102)로 송신되는 페이징 메시지를 획득한다. 상술한 과정에서, 만약 페이징 지시 정보를 기초로 페이징 PDCCH의 센싱 또는 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신이 필요한 것으로 결정되면, 페이징 PDCCH를 센싱하거나 또는 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지를 수신하여, 사용자 기기의 페이징 PDCCH 센싱 횟수 또는 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신 횟수를 줄임으로써, 사용자 기기의 전력을 절약한다.
아래에서는 구체적인 실시예를 통해 본 출원의 기술방안에 대해 상세하게 설명한다. 아래 몇 개의 구체적인 실시예는 서로 조합될 수 있으며, 동일하거나 유사한 개념 또는 과정은 일부 실시예에서 반복되는 설명이 생략될 수 있다.
도 2는 본 출원의 실시예에 따른 통신 방법을 나타내는 흐름도이다. 도 2에 도시된 바와 같이, 상기 통신 방법은 단계(S201 ~ S203)를 포함한다.
S201: 페이징 지시 물리적 다운링크 제어 채널(PDCCH)을 센싱한다.
선택적으로, 본 출원의 실시예의 수행 주체는 사용자 기기일 수 있고, 사용자 기기에 설치된 통신 장치일 수도 있다.
선택적으로, 상기 통신 장치가 소프트웨어 및/또는 하드웨어의 조합으로 구현될 수 있다.
예를 들어, 통신 장치가 소프트웨어를 통해 구현될 때, 통신 장치는 칩 중 저장 영역에 저장된 한 섹션의 코드일 수 있고, 칩의 프로세서는 상기 코드를 실행할 때, 본 출원의 방법 실시예 중의 단계를 구현한다.
예를 들어, 통신 장치가 하드웨어를 통해 구현될 때, 통신 장치는 예를 들어 칩 또는 칩 모듈 등일 수 있고, 통신 장치 중의 각각의 모듈은 상술한 칩, 칩 모듈 등의 하드웨어 모듈을 포함할 수 있다. 통신 장치가 동작할 때, 본 출원의 방법 실시예 중의 단계를 수행할 수 있다.
예를 들어, 통신 장치가 하드웨어의 조합으로 구현될 때, 통신 장치의 각각의 모듈은 칩, 칩 모듈 등의 하드웨어, 및 칩에 저장된 일 섹션의 코드를 포함한다. 상술한 칩, 칩 모듈이 동작할 때, 상술한 코드를 실행하여, 본 출원의 방법 실시예 중의 단계를 구현한다.
여기서, 페이징 지시 PDCCH는 일 유형의 PDCCH일 수 있고, 페이징 PDCCH도 일유형의 PDCCH일 수 있다. 페이징 지시 PDCCH는 페이징 PDCCH와 다를 수 있다.
일반적으로, PDCCH 센싱은 PDCCH 블라인드 테스트라고도 한다. 사용자 기기는 시간 주파수 위치에서 PDCCH를 센싱하거나 블라인드 테스트하지만, 기지국이 상기 시간 주파수 위치에서 꼭 PDCCH를 송신한 것은 아니므로, 사용자 기기는 CRC 검증을 거쳐야만 기지국이 상기 시간 주파수 위치에서 PDCCH를 송신하였는지 여부를 판단할 수 있다. 일반 PDCCH의 CRC 검증 성공은 사용자 기기가 PDCCH를 검출하였다고 하거나, 사용자 기기가 PDCCH를 성공적으로 검출하였다고 하거나, 사용자 기기가 PDCCH의 검출에 성공하였다고 한다.
특별히 설명하여야 할 점은, 페이징 지시 PDCCH의 순환 중복 검증(Cyclic Redundancy Check, CRC)은 새로운 무선 네트워크 임시 식별자(Radio Network Tempory Identity, RNTI)를 사용하여 스크램블링할 수 있다. 일반적으로, 사용자 기기는 CRC에 대해 특정 유형의 RNTI 디스크램블을 수행하여, 특정 유형의 PDCCH가 성공적으로 검출되었는지 여부를 결정할 수 있다. 예를 들어, 만약 페이징 PDCCH가 P-RNTI(페이징-RNTI)에 대응되면, 사용자 기기는 CRC에 대해 P-RNTI 디스크램블을 수행하여 페이징 PDCCH가 성공적으로 검출되었는지 여부를 결정할 수 있다. 만약 페이징 지시 PDCCH가 PI-RNTI(페이징 지시-RNTI) 스크램블링에 대응되면, 사용자 기기는 CRC에 대해 PI-RNTI 디스크램블을 수행하여, 페이징 지시 PDCCH가 성공적으로 검출되었는지 여부를 결정할 수 있다.
일 가능한 설계에서, 페이징 지시 PDCCH를 센싱하는 단계는,
페이징 지시 PDCCH 센싱 기회에서, 상기 페이징 지시 PDCCH를 센싱하는 단계를 포함하고;
여기서, 페이징 지시 PDCCH 센싱 기회는,
제1 시점 이전에 있으며, 제1 시점과의 사이의 오프셋이 제1 기설정 시간길이인 것; 또는,
제1 시점 이후에 있으며, 제1 시점과의 사이의 오프셋이 제1 기설정 시간길이인 것; 중 어느 하나의 조건을 만족하고,
여기서, 제1 시점은 동기 신호 블록(SS/PBCH block, SSB), 채널 상태 정보 기준 신호(Channel State Information Reference Signal, CSI-RS) 또는 추종 기준 신호(Tracking Reference Signal, TRS)의 시작 시점 또는 종료 시점이다. 구체적으로, 제1 시점은 센싱 기회(Paging Occasion, PO) 또는 센싱 기회 내의 첫번째 페이징 PDCCH 센싱 기회와 가장 가까운 동기 신호 블록, 채널 상태 정보 기준 신호 또는 추종 기준 신호(Tracking Reference Signal, TRS)의 시작 시점 또는 종료 시점이다. 또는, 제1 시점은 센싱 기회 또는 센싱 기회 내의 첫번째 페이징 PDCCH 센싱 기회 이전에 있으며, 센싱 기회 또는 센싱 기회 내의 첫번째 페이징 PDCCH 센싱 기회와 가장 가까운 동기 신호 블록, 채널 상태 정보 기준 신호 또는 추종 기준 신호의 시작 시점 또는 종료 시점이다. 또는, 제1 시점은 센싱 기회 또는 센싱 기회 내의 첫번째 페이징 PDCCH 센싱 기회 이후에 있으며, 센싱 기회 또는 센싱 기회 내의 첫번째 페이징 PDCCH 센싱 기회와 가장 가까운 동기 신호 블록, 채널 상태 정보 기준 신호 또는 추종 기준 신호의 시작 시점 또는 종료 시점이다. 선택적으로, 제1 시점은 페이징 프레임(Paging Frame, PF)과 가장 가까운 동기 신호 블록, 채널 상태 정보 기준 신호 또는 추종 기준 신호(Tracking Reference Signal, TRS)의 시작 시점 또는 종료 시점이다. 또는, 제1 시점은 페이징 프레임 이전에 있으며, 페이징 프레임과 가장 가까운 동기 신호 블록, 채널 상태 정보 기준 신호 또는 추종 기준 신호의 시작 시점 또는 종료 시점이다. 또는, 제1 시점은 페이징 프레임 이후에 있으며, 페이징 프레임과 가장 가까운 동기 신호 블록, 채널 상태 정보 기준 신호 또는 추종 기준 신호의 시작 시점 또는 종료 시점이다. 상기 동기 신호 블록의 시작 시점 또는 종료 시점은 동기 신호 블록이 있는 하프 프레임(Half Frame) 또는 프레임(Frame)의 시작 시점 또는 종료 시점이다.
상술한 시점은 심볼, 슬롯 등일 수 있다. 구체적으로, 본 출원에서는 상술한 시점의 구체적인 값에 대해 한정하지 않는다. 상술한 제1 기설정 시간길이는 1ms, 2ms, 하나의 슬롯, 두 개의 슬롯 등일 수 있다. 구체적으로, 본 출원에서는 제1 기설정 시간길이의 구체적인 값에 대해 한정하지 않는다. 실제 응용에서, 제1 기설정 시간길이는 본 출원에서 제공하는 통신 방법을 실시하는 통신 시스템 중의 상위 계층 파라미터에서 제공할 수 있고, 또는 사용자 기기가 기타 상위 계층 파라미터를 통해 도출할 수도 있다. 제1 기설정 시간길이는 고정된 시간길이일 수도 있다.
본 출원에서, 동기 신호 블록, 채널 상태 정보 기준 신호와 추종 기준 신호는 주기적 신호이다. 여기서, 하나의 동기 신호 블록은 프라이머리 동기 신호(Primary Synchronization Signal, PSS), 세컨더리 동기 신호(Secondary Synchronization Signal, SSS) 및 물리적 브로드캐스트 채널(Physical Broadcast Channel, PBCH)로 구성된다. 각각의 동기 신호 블록은 하나의 사전에 결정된 시간 도메인 위치를 갖는다. 상기 시간 도메인 위치는 후보 동기 신호 블록이라고도 지칭될 수 있다. 복수의 동기 신호 블록은 하나의 동기 신호 버스트(SS-burst)를 이룬다. 복수의 동기 신호 버스트는 하나의 동기 신호 버스트 세트(SS-burst-set)를 이룬다. Lmax개의 동기 신호 블록의 시간 도메인 위치는 하나의 5ms 윈도우 내에서는 고정되며, 여기서, Lmax는 1보다 크거나 같은 정수이다. Lmax개의 동기 신호 블록의 시간 도메인 위치 인덱스는 연속적으로 배열되며, 예를 들어 시간 도메인 위치 인덱스는 0으로부터 Lmax-1까지이다. 따라서 하나의 동기 신호 블록은 해당 5ms 윈도우 내에서의 송신 시점이 고정되어 있으며, 인덱스도 고정되어 있다. 일반적으로, 기지국은 동기 신호 블록을 송신할 때 빔 스위핑(beam sweeping) 방식을 사용하며, 즉 기지국은 서로 다른 빔을 통해 서로 다른 시간 도메인 위치에서 동기 신호 블록을 송신하며, 대응되게, 사용자 기기는 서로 다른 빔을 측정하고, 어느 빔에서 수신되는 신호가 가장 강한지를 감지할 수 있다.
종래기술에서, 페이징 기회는 일 세트의 사용자 기기 페이징 PDCCH를 센싱하는 시간 간격(time interval) 또는 시간 윈도우(time window)를 나타내고, 기지국이 일 페이징 기회 내에서 페이징하는 것은 하나의 사용자 기기일 수 있지만, 기타 사용자 기기는 여전히 페이징 PDCCH가 검출되며(페이징 PDCCH가 검출되며 순환 중복 검증이 검증 통과되거나, 또는 페이징 PDCCH가 성공적으로 검출되었다고 하거나, 또는 페이징 PDCCH의 검출에 성공하였다고 함), 나아가 페이징 PDCCH에 의해 스케줄링되는 PDSCH에 적재된 페이징 메시지를 디코딩하지만, 페이징 메시지 내에는 이러한 기타 사용자 기기가 포함되지 않고, 이러한 기타 사용자 기기는 전력을 그냥 낭비하게 된다. 하지만 본 출원에서, 페이징 지시 PDCCH는 페이징 기회 이전에, 추후 페이징 기회 내에 실제로 페이징되는 사용자 기기 서브 세트를 지시할 수 있다. 다시 말하면, 하나의 페이징 기회에 대응되는 사용자 기기 세트는 추가적으로 사용자 기기 서브 세트로 나뉠 수 있으며, 페이징 지시 PDCCH는 사용자 기기 서브 세트가 페이징되는지 여부를 지시한다. 이러한 경우, 사용자 기기가 불필요한 페이징 PDCCH를 센싱할 가능성을 줄이고, 사용자 기기의 전력 절약에 유리하다.
설명하여야 할 점은, 하나의 페이징 기회에 대응되는 사용자 기기 세트로부터 나뉘어진 하나의 서브 세트의 경우, 하나의 사용자 기기 서브 세트로 지칭할 수 있다. 일반적으로, 하나의 페이징 기회에 대응되거나 또는 하나의 사용자 기기 그룹 내의 하나의 사용자 기기는 모두 기지국에 의해 하나의 사용자 기기 서브 세트가 설정된다. 기지국은 상위 계층 파라미터(상위 계층 시그널링)를 통해 상기 사용자 기기에 대해 하나의 사용자 기기 서브 세트를 할당한다. 상기 사용자 기기 서브 세트는 하나의 비트맵 내의 하나의 비트로 표시되거나, 또는 하나의 번호(number) 또는 인덱스(index)로 표시될 수 있다.
다른 측면에 따르면, 일부 사용자 기기의 페이징 기회 또는 페이징 PDCCH(일반적으로 페이징 기회 내에 있음) 센싱 기회는 상술한 주기 신호(동기 신호 블록, 채널 상태 정보 기준 신호 또는 추종 기준 신호)와의 시간 간격이 보다 길므로, 페이징 지시 PDCCH(일반적으로 페이징 기회 또는 페이징 PDCCH 이전에 있음) 센싱 기회와 상술한 주기 신호의 시간 간격이 보다 길며, 이러한 경우, 이러한 사용자 기기는 페이징 지시 PDCCH 센싱 기회가 도래할 때 적시에 페이징 지시 PDCCH를 센싱할 수 있도록 주기 신호를 통해 채널 추종을 수행한 후 일부 모듈의 온을 유지하여야 한다. 상술한 종래기술에서 사용자 기기는 주기 신호를 통해 채널 추종을 수행한 후 일부 모듈의 온을 유지하여, 사용자 기기가 진정으로 슬립에 진입할 수 없도록 하고, 페이징 지시 PDCCH 센싱 기회가 도래할 때까지 대기하여, 페이징 지시 PDCCH를 센싱하여야 하므로, 사용자 기기의 전력 소모가 보다 크다. 따라서, 본 출원에서, 페이징 지시 PDCCH 센싱 기회가 제1 시점 이전에 있으며, 제1 시점과의 사이의 오프셋이 제1 기설정 시간길이이거나, 제1 시점 이후에 있으며, 제1 시점과의 사이의 오프셋이 제1 기설정 시간길이이므로, 사용자 기기가 제1 기설정 시간길이 동안 일부 모듈의 온을 유지하기만 하면 되므로, 사용자 기기의 전력을 절약한다. 다시 말하면, 사용자 기기는 상술한 주기 신호를 검출 또는 측정하는 시간 내에, 페이징 지시 PDCCH의 센싱도 함께 수행한다. 일반적으로, 만약 사용자 기기는 페이징 지시 PDCCH가 검출되고, 페이징 지시로부터 자신이 페이징 PDCCH를 센싱할 필요가 없음을 발견하면, 사용자 기기는 진정으로 슬립할 수 있으며, 그렇지 않으면, 사용자 기기는 페이징 PDCCH를 센싱하도록 계속하여 일부 모듈의 온을 유지하여야 한다.
일 가능한 설계에서, 페이징 지시 PDCCH를 센싱하는 단계는,
페이징 지시 PDCCH 센싱 기회에서, 페이징 지시 PDCCH를 센싱하는 단계를 포함하며;
여기서, 페이징 지시 PDCCH 센싱 기회는, 제2 시점 이전에 있으며, 제2 시점과의 사이의 오프셋이 제2 기설정 시간길이인 것; 제2 시점이 페이징 기회의 시작 시점 또는 종료 시점이거나, 또는 페이징 기회에 대응되는 페이징 PDCCH 센싱 기회의 시작 시점 또는 종료 시점이거나, 또는 페이징 기회에 대응되는 첫번째 페이징 PDCCH 센싱 기회의 시작 시점 또는 종료 시점인 것; 중 어느 하나의 조건을 만족한다.
상술한 시점은 심볼, 슬롯 등일 수 있다. 구체적으로, 본 출원에서는 상술한 시점의 구체적인 값에 대해 한정하지 않는다. 상술한 제2 기설정 시간길이는 1ms, 2ms, 하나의 슬롯, 두 개의 슬롯 등일 수 있다. 구체적으로, 본 출원에서는 제2 기설정 시간길이의 구체적인 값에 대해 한정하지 않는다. 실제 응용에서, 제2 기설정 시간길이는 본 출원에서 제공하는 통신 방법을 실시하는 통신 시스템 중의 상위 계층 파라미터에서 제공할 수 있고, 또는 사용자 기기가 기타 상위 계층 파라미터를 통해 도출할 수도 있다. 제2 기설정 시간길이는 고정된 시간길이일 수도 있다.
종래기술에서, 페이징 기회는 일 세트의 사용자 기기 페이징 PDCCH를 센싱하는 시간 간격 또는 시간 윈도우를 나타내고, 기지국이 일 페이징 기회 내에서 페이징하는 것은 하나의 사용자 기기일 수 있지만, 기타 사용자 기기는 여전히 페이징 PDCCH가 검출되며(페이징 PDCCH가 검출되며 순환 중복 검증이 검증 통과되거나, 또는 페이징 PDCCH가 성공적으로 검출되었다고 하거나, 또는 페이징 PDCCH의 검출에 성공하였다고 함), 나아가 페이징 PDCCH에 의해 스케줄링되는 PDSCH에 적재된 페이징 메시지를 디코딩하지만, 페이징 메시지 내에는 이러한 기타 사용자 기기가 포함되지 않고, 이러한 기타 사용자 기기는 전력을 그냥 낭비하게 된다. 하지만, 본 출원에서, 페이징 지시 PDCCH는 페이징 기회 이전에, 추후 페이징 기회 내에 실제로 페이징되는 사용자 기기 서브 세트를 지시할 수 있다. 다시 말하면, 하나의 페이징 기회에 대응되는 사용자 기기는 추가적으로 사용자 기기 서브 세트로 나뉠 수 있으며, 페이징 지시 PDCCH는 사용자 기기 서브 세트가 페이징되는지 여부를 지시한다. 이러한 경우, 사용자 기기가 불필요한 페이징 PDCCH를 센싱할 가능성을 줄이고, 사용자 기기의 전력 절약에 유리하다.
설명하여야 할 점은, 하나의 페이징 기회에 대응되는 사용자 기기 세트로부터 나뉘어진 하나의 서브 세트의 경우, 하나의 사용자 기기 서브 세트로 지칭할 수 있다. 일반적으로, 하나의 페이징 기회에 대응되거나 또는 하나의 사용자 기기 그룹 내의 하나의 사용자 기기는 모두 기지국에 의해 하나의 사용자 기기 서브 세트가 설정된다. 기지국은 상위 계층 파라미터(상위 계층 시그널링)를 통해 상기 사용자 기기에 대해 하나의 사용자 기기 서브 세트를 할당한다. 상기 사용자 기기 서브 세트는 하나의 비트맵(bitmap) 내의 하나의 비트로 표시되거나, 또는 하나의 번호(number) 또는 인덱스(index)로 표시될 수 있다.
다른 측면에 따르면, 페이징 지시 PDCCH가 페이징 기회 또는 페이징 기회에 대응되는 페이징 PDCCH와 보다 가까울 때, 페이징 지시 PDCCH와 페이징 PDCCH 사이의 거리를 줄이고(사용자 기기가 페이징 지시 PDCCH를 검출하고, 페이징 지시로부터 자신이 페이징 PDCCH를 센싱하여야 하는 것을 발견하였다고 가정), 사용자 기기는 집중된 한 동안의 시간 내에 웨이크업되어 페이징 지시 PDCCH와 페이징 PDCCH의 센싱을 수행하기만 하면 되며, 사용자 기기는 오래 동안 일부 모듈의 온을 유지할 필요가 없으므로, 사용자 기기의 전력을 절약한다.
S202: 페이징 지시 PDCCH가 검출되면, 페이징 지시 정보를 획득한다.
설명하여야 할 점은, 페이징 지시 PDCCH는 기지국으로부터 송신되는 페이징 지시 PDCCH이고, 상기 페이징 지시 PDCCH는 페이징 지시 정보를 포함하고, 상기 페이징 지시 정보는 사용자 기기가 페이징 PDCCH를 센싱할 필요가 있는지 여부를 지시한다.
일반적으로, 페이징 지시 PDCCH가 검출되었다 함은 페이징 지시 PDCCH가 검출되며 CRC 검증 실패를 나타내거나, 또는 페이징 지시 PDCCH가 성공적으로 검출되었다고 하거나, 또는 페이징 지시 PDCCH의 검출에 성공하였다고 한다.
다른 측면에 따르면, 페이징 지시 PDCCH이 검출되지 않으면(페이징 지시 PDCCH가 검출되었지만 CRC 검증 실패, 또는 페이징 지시 PDCCH가 성공적으로 검출되지 않았다고 하거나, 또는 페이징 지시 PDCCH의 검출에 실패하였다고 한다), 페이징 PDCCH의 센싱이 불필요 또는 필요한 것으로 결정한다. 일반적으로, 상위 계층 파라미터로부터 필요 또는 불필요를 선택할 수 있으며, 예를 들어 시스템 정보 내의 파라미터 또는 설정으로부터 획득한다.
종래기술과 달리, 종래기술에서, 페이징 기회는 일 세트의 사용자 기기에 대한 것이므로, 사용자 기기에 의해 센싱된 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지가 상기 사용자 기기를 포함하지 않으면, 사용자 기기가 불필요한 페이징 PDCCH를 센싱하게 되므로, 사용자 기기의 전력 소모가 보다 크다. 본 출원에서, 페이징 지시 정보를 기초로 페이징 PDCCH의 센싱이 필요한 것으로 결정될 때, 페이징 PDCCH의 센싱 가능성을 줄이고, 페이징 PDCCH에 대한 사용자 기기의 센싱 횟수를 줄여, 사용자 기기의 전력을 절약한다.
일 가능한 설계에서, 페이징 지시 정보를 획득하는 단계는, 페이징 지시 PDCCH에 대응되는 다운링크 제어 정보(DCI) 또는 다운링크 제어 정보(DCI) 포맷 중의 타겟 비트로부터 상기 페이징 지시 정보를 획득하는 단계를 포함한다.
다른 가능한 설계에서, 페이징 지시 정보를 획득하는 단계는, 페이징 지시 PDCCH에 의해 스케줄링되는 물리적 다운링크 공유 채널(PDSCH)로부터 페이징 지시 정보를 획득하는 단계를 포함한다.
선택적으로, 타겟 비트는 DCI 또는 DCI 포맷 중의 보류 비트일 수 있다.
선택적으로, 타겟 비트는 또한 재정의 DCI 또는 DCI 포맷에 이미 정의된 도메인 중의 비트일 수도 있다.
일 가능한 설계에서, 페이징 지시 정보는 비트맵일 수 있고, 비트맵은 적어도 사용자 기기에 대응되는 사용자 기기 서브 세트에 대응되는 비트를 포함한다.
다른 가능한 설계에서, 페이징 지시 정보는 사용자 기기 서브 세트의 번호 또는 인덱스이다.
S203: 페이징 지시 정보를 기초로, 페이징 PDCCH의 센싱 필요 여부를 결정한다.
선택적으로, 페이징 지시 정보가 비트맵일 때, 비트맵은 적어도 사용자 기기에 대응되는 사용자 기기 서브 세트에 대응되는 비트를 포함하고, 상기 사용자 기기가 대응되는 또는 위치하는 사용자 기기 서브 세트에 대응되는 비트를 기초로, 페이징 PDCCH의 센싱 필요 여부를 결정할 수 있다.
예를 들어, 상기 비트가 1이면, 상기 페이징 PDCCH의 센싱이 필요한 것으로 결정하고; 만약 상기 비트가 0이면, 상기 페이징 PDCCH의 센싱이 불필요한 것으로 결정한다.
예를 들어, 만약 상기 비트가 0이면, 상기 페이징 PDCCH의 센싱이 필요한 것으로 결정하고; 상기 비트가 1이면, 상기 페이징 PDCCH의 센싱이 불필요한 것으로 결정한다.
일반적으로, 상기 비트맵은 각각의 사용자 기기 서브 세트에 대응되는 비트를 포함할 수 있다. 상기 사용자 기기가 대응되는 또는 위치하는 사용자 기기 서브 세트가 상기 비트맵 내의 어느 하나의 비트와 대응되는지는, 기지국이 상위 계층 파라미터(시그널링)를 통해 상기 사용자 기기에 알린 것이다. 예를 들어, 상기 비트맵이 010이고, 세 개의 비트가 왼쪽으로부터 오른쪽으로 각각 세 개의 사용자 기기 서브 세트에 대한 것이며, 상기 사용자 기기가 대응되는 또는 위치하는 사용자 기기 서브 세트는 좌측으로부터 우측으로 두번째 서브 세트이면, 대응되는 비트는 1이다.
선택적으로, 페이징 지시 정보가 사용자 기기 서브 세트의 번호 또는 인덱스일 때, 사용자 기기가 대응되는 또는 위치하는 사용자 기기 서브 세트의 번호 또는 인덱스가 페이징 지시 정보 내의 사용자 기기 서브 세트의 번호 또는 인덱스와 동일한지 여부를 기초로, 페이징 PDCCH의 센싱 필요 여부를 결정할 수 있다.
일반적으로, 사용자 기기 서브 세트의 번호 또는 인덱스는 타겟 사용자 기기 서브 세트의 번호 또는 인덱스라고도 할 수 있으며, 즉 지시하는 또는 페이징하는 또는 웨이크업하는 사용자 기기 서브 세트의 번호 또는 인덱스라고도 한다. 예를 들어 페이징 지시 정보의 이진수가 011이고, 최저 비트가 우측에 있으면, 번호 또는 인덱스의 10진수 값은 3으로서, 지시하는 또는 페이징하는 또는 웨이크업하는 사용자 기기 서브 세트가 세번째 사용자 기기 서브 세트임을 나타낸다.
S203에서, 사용자 기기 서브 세트를 도입하였으므로, 페이징 PDCCH 센싱 가능성을 줄이고, 사용자 기기의 전력을 절약할 수 있다.
종래기술과 달리, 종래기술에서, 페이징 기회는 일 세트의 사용자 기기에 대한 것이므로, 사용자 기기에 의해 센싱된 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지가 상기 사용자 기기를 포함하지 않으면, 사용자 기기가 불필요한 페이징 PDCCH를 센싱하게 되므로, 사용자 기기의 전력 소모가 보다 크다. 본 출원에서, 페이징 지시 정보를 기초로 페이징 PDCCH의 센싱 필요 여부를 결정할 때, 페이징 PDCCH의 센싱 가능성을 줄이고, 페이징 PDCCH에 대한 사용자 기기의 센싱 횟수를 줄여, 사용자 기기의 전력을 절약한다.
본 출원에서 제공하는 통신 방법은, 페이징 지시 PDCCH 센싱 기회에서, 페이징 지시 PDCCH를 센싱하는 단계; 페이징 지시 PDCCH가 검출되면, 페이징 지시 정보를 획득하고, 페이징 지시 정보를 기초로, 페이징 PDCCH의 센싱 필요 여부를 결정하는 단계를 포함한다. 상술한 방법에서, 페이징 지시 정보를 기초로, 페이징 PDCCH의 센싱 필요 여부를 결정하여, 사용자 기기의 페이징 PDCCH의 센싱 가능성을 줄이고, 사용자 기기의 전력을 절약한다.
상술한 실시예의 기초 상에서, 아래에서는 도 3을 참조하여 본 출원에 따른 다른 통신 방법에 대해 상세하게 설명한다. 구체적으로, 도 3의 실시예를 참조할 수 있다.
도 3은 본 출원의 실시예에 따른 다른 통신 방법을 나타내는 흐름도이다. 도 3에 도시된 바와 같이, 상기 통신 방법은 단계(S301 ~ S303)를 포함한다.
S301: 페이징 물리적 다운링크 제어 채널(PDCCH)을 센싱한다.
일반적으로, 페이징 PDCCH는 페이징 메시지(PDSCH에 적재됨)를 스케줄링하기 위한 것이다.
S302: 페이징 PDCCH가 검출되면, 페이징 지시 정보를 획득한다.
선택적으로, 페이징 PDCCH에 대응되는 다운링크 제어 정보(DCI) 또는 다운링크 제어 정보(DCI) 포맷 중의 타겟 비트로부터 페이징 지시 정보를 획득한다. 여기서, 타겟 비트는 DCI 또는 DCI 포맷 중의 보류 비트이다.
선택적으로, 페이징 PDCCH에 대응되는 DCI 또는 DCI 포맷 중의 타겟 비트수는 6이다.
선택적으로, 페이징 지시 정보는 비트맵이고, 비트맵은 적어도 사용자 기기에 대응되는 사용자 기기 서브 세트에 대응되는 비트를 포함한다.
선택적으로, 페이징 지시 정보는 또한 적어도 사용자 기기에 대응되는 사용자 기기 서브 세트의 번호 또는 인덱스를 포함할 수 있다.
일반적으로, 페이징 PDCCH가 검출되었다고 함은 페이징 PDCCH가 검출되며 CRC검증 실패를 나타내거나, 또는 페이징 PDCCH가 성공적으로 검출되었다고 하거나, 또는 페이징 PDCCH의 검출에 성공하였다고 한다.
S303: 페이징 지시 정보를 기초로, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신 필요 여부를 결정한다.
선택적으로, 만약 페이징 지시 정보가 비트맵이면, 비트맵에 포함되는 사용자 기기에 대응되는 사용자 기기 서브 세트에 대응되는 비트를 기초로, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신 필요 여부를 결정할 수 있다.
예를 들어: 비트가 1이면, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신이 필요한 것으로 결정하고; 비트가 0이면, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신이 불필요한 것으로 결정한다.
예를 들어: 비트가 0이면, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신이 불필요한 것으로 결정하고; 비트가 1이면, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신이 필요한 것으로 결정한다.
일반적으로, 상기 비트맵은 각각의 사용자 기기 서브 세트에 대응되는 비트를 포함할 수 있다. 상기 사용자 기기가 대응되는 또는 위치하는 사용자 기기 서브 세트가 상기 비트맵 내의 어느 하나의 비트와 대응되는지는, 기지국이 상위 계층 파라미터(시그널링)를 통해 상기 사용자 기기에 알린 것이다. 예를 들어, 상기 비트맵이 010이고, 세 개의 비트가 왼쪽으로부터 오른쪽으로 각각 세 개의 사용자 기기 서브 세트에 대한 것이며, 상기 사용자 기기가 대응되는 또는 위치하는 사용자 기기 서브 세트는 좌측으로부터 우측으로 두번째 서브 세트이면, 대응되는 비트는 1이다.
선택적으로, 만약 페이징 지시 정보가 적어도 사용자 기기에 대응되는 사용자 기기 서브 세트의 번호 또는 인덱스를 포함하면, 사용자 기기가 위치한 사용자 기기 서브 세트의 번호 또는 인덱스가 페이징 지시 정보 내의 사용자 기기가 위치한 사용자 기기 서브 세트의 번호 또는 인덱스와 동일한지 여부에 따라, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신 필요 여부를 결정할 수 있다. 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신 필요 여부를 결정한다.
예를 들어, 사용자 기기가 위치한 사용자 기기 서브 세트의 번호(또는 인덱스)가 페이징 지시 정보 내의 상기 사용자 기기가 위치한 사용자 기기 서브 세트의 번호(또는 인덱스)와 동일하면, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신이 필요한 것으로 결정하고; 만약 사용자 기기가 위치한 사용자 기기 서브 세트의 번호(또는 인덱스)가 페이징 지시 정보 내의 상기 사용자 기기가 위치한 사용자 기기 서브 세트의 번호(또는 인덱스)와 다르면, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신이 불필요한 것으로 결정한다.
일반적으로, 사용자 기기 서브 세트의 번호 또는 인덱스는 타겟 사용자 기기 서브 세트의 번호 또는 인덱스라고도 할 수 있으며, 즉 지시하는 또는 페이징하는 또는 웨이크업하는 사용자 기기 서브 세트의 번호 또는 인덱스라고도 한다. 예를 들어 페이징 지시 정보의 이진수가 011이고, 최저 비트가 우측에 있으면, 번호 또는 인덱스의 10진수 값은 3으로서, 지시하는 또는 페이징하는 또는 웨이크업하는 사용자 기기 서브 세트가 세번째 사용자 기기 서브 세트임을 나타낸다.
본 출원에서 제공하는 통신 방법은, 페이징 PDCCH를 센싱하는 단계; 페이징 PDCCH가 검출되면, 페이징 지시 정보를 획득하는 단계; 페이징 지시 정보를 기초로, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신 필요 여부를 결정하는 단계를 포함한다. 상술한 과정에서, 페이징 지시 정보를 기초로, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신 필요 여부를 결정하여, 사용자 기기가 기지국으로부터 자신에 송신되는 페이징 메시지를 정확하게 수신하도록 확보하면서도, 사용자 기기가 자신과 무관한 페이징 메시지를 수신하는 것을 방지하여, 사용자 기기의 전력을 절약한다.
또한, 본 출원의 실시예에서, 페이징 PDCCH에 대응되는 DCI 또는 DCI 포맷 중의 타겟 비트로부터 페이징 지시 정보를 획득하고; 페이징 지시 정보가 비트맵일 때, 비트맵은 각각의 사용자 기기 서브 세트에 대응되는 비트를 포함하고; 만약 사용자 기기가 위치한 사용자 기기 서브 세트에 대응되는 비트가 1(또는 0)이면, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신이 필요한 것으로 결정하고; 만약 사용자 기기가 위치한 사용자 기기 서브 세트에 대응되는 비트가 0(또는 1)이면, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신이 불필요한 것으로 결정하고; 페이징 지시 정보가 사용자 기기가 위치한 사용자 기기 서브 세트의 번호 또는 인덱스일 때, 사용자 기기가 위치한 사용자 기기 서브 세트의 번호 또는 인덱스가 수신된 사용자 기기 서브 세트의 번호 또는 인덱스와 동일한지 여부를 결정하고; 만약 그러하면, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신이 필요한 것으로 결정하고; 만약 아니면, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신이 불필요한 것으로 결정한다.
상술한 방법에서, 사용자 기기 서브 세트를 도입함으로써, 사용자 기기가 기지국으로부터 자신에 송신되는 페이징 메시지를 정확하게 수신하도록 확보하면서도, 사용자 기기가 자신과 무관한 페이징 메시지를 수신하는 것을 방지하여, 사용자 기기의 전력을 절약한다.
도 4는 본 출원의 실시예에 따른 통신 장치를 나타내는 구조도이다. 통신 장치(10)는 사용자 기기에 설치되고, 통신 장치(10)는 센싱 모듈(11), 획득 모듈(12) 및 결정 모듈(13)을 포함한다.
센싱 모듈(11)은 페이징 지시 물리적 다운링크 제어 채널(PDCCH)을 센싱하고;
획득 모듈(12)은 페이징 지시 PDCCH가 검출되면, 페이징 지시 정보를 획득하고;
결정 모듈(13)은 페이징 지시 정보를 기초로, 페이징 PDCCH의 센싱 필요 여부를 결정한다.
본 출원의 실시예에서 제공하는 통신 장치(10)는 상술한 방법 중 도 2 및 도 3의 실시예에 따른 기술방안을 수행할 수 있으며, 그 구현 원리 및 유리한 효과가 동일하므로, 여기서는 반복되는 설명을 생략한다.
일 가능한 설계에서, 센싱 모듈(11)은 구체적으로,
페이징 지시 PDCCH 센싱 기회에서, 상기 페이징 지시 PDCCH를 센싱하고;
여기서, 페이징 지시 PDCCH 센싱 기회는 제1 시점 이전에 있으며, 제1 시점과의 사이의 오프셋이 제1 기설정 시간길이인 것; 또는, 제1 시점 이후에 있으며, 제1 시점과의 사이의 오프셋이 제1 기설정 시간길이인 것; 중 어느 하나의 조건을 만족하고;
여기서, 제1 시점은 동기 신호 블록, 또는 채널 상태 정보 기준 신호, 또는 추종 기준 신호의 시작 시점 또는 종료 시점이다.
일 가능한 설계에서, 획득 모듈(12)은 구체적으로,
페이징 지시 PDCCH에 대응되는 다운링크 제어 정보(DCI) 또는 다운링크 제어 정보(DCI) 포맷 중의 타겟 비트로부터 페이징 지시 정보를 획득한다.
일 가능한 설계에서, 타겟 비트는 DCI 또는 DCI 포맷 중의 보류 비트이다.
일 가능한 설계에서, 타겟 비트는 재정의 DCI 또는 DCI 포맷에 이미 정의된 도메인 중의 비트이다.
일 가능한 설계에서, 획득 모듈(12)은 구체적으로,
페이징 지시 PDCCH에 의해 스케줄링되는 페이징 메시지로부터 페이징 지시 정보를 획득한다.
일 가능한 설계에서, 페이징 지시 정보는 비트맵이고, 비트맵은 적어도 상기 사용자 기기에 대응되는 사용자 기기 서브 세트에 대응되는 비트를 포함한다.
일 가능한 설계에서, 페이징 지시 정보는 사용자 기기 서브 세트의 번호 또는 인덱스이다.
일 가능한 설계에서, 결정 모듈(13)은 구체적으로,
비트가 1이면, 페이징 PDCCH의 센싱이 필요한 것으로 결정하고;
비트가 0이면, 페이징 PDCCH의 센싱이 불필요한 것으로 결정한다.
일 가능한 설계에서, 결정 모듈(13)은 구체적으로,
비트가 0이면, 페이징 PDCCH의 센싱이 필요한 것으로 결정하고;
비트가 1이면, 페이징 PDCCH의 센싱이 불필요한 것으로 결정한다.
다른 가능한 설계에서, 센싱 모듈(11)은 구체적으로,
페이징 지시 PDCCH 센싱 기회에서, 페이징 지시 PDCCH를 센싱하고;
여기서, 페이징 지시 PDCCH 센싱 기회는, 페이징 지시 PDCCH 센싱 기회는, 제2 시점 이전에 있으며, 제2 시점과의 사이의 오프셋이 제2 기설정 시간길이인 것; 제2 시점이 페이징 기회의 시작 시점 또는 종료 시점이거나, 또는 페이징 기회에 대응되는 페이징 PDCCH 센싱 기회의 시작 시점 또는 종료 시점인 것; 중 어느 하나의 조건을 만족한다 중 어느 하나의 조건을 만족한다.
일 가능한 설계에서, 획득 모듈(12)은 구체적으로,
페이징 지시 PDCCH에 대응되는 DCI 또는 DCI 포맷 중의 타겟 비트로부터 페이징 지시 정보를 획득한다.
다른 가능한 설계에서, 타겟 비트는 DCI 또는 DCI 포맷 중의 보류 비트이다.
다른 가능한 설계에서, 타겟 비트는 재정의 DCI 또는 DCI 포맷에 이미 정의된 도메인 중의 비트이다.
다른 가능한 설계에서, 획득 모듈(12)은 구체적으로,
페이징 지시 PDCCH에 의해 스케줄링되는 PDSCH로부터 페이징 지시 정보를 획득한다.
다른 가능한 설계에서, 페이징 지시 정보는 비트맵이고, 비트맵은 적어도 상기 사용자 기기에 대응되는 사용자 기기 서브 세트에 대응되는 비트를 포함한다.
다른 가능한 설계에서, 페이징 지시 정보는 사용자 기기 서브 세트의 번호 또는 인덱스이다.
다른 가능한 설계에서, 결정 모듈(13)은 구체적으로,
비트가 1이면, 페이징 PDCCH의 센싱이 필요한 것으로 결정하고;
비트가 0이면, 페이징 PDCCH의 센싱이 불필요한 것으로 결정한다.
다른 가능한 설계에서, 결정 모듈(13)은 구체적으로,
비트가 0이면, 페이징 PDCCH의 센싱이 필요한 것으로 결정하고;
비트가 1이면, 페이징 PDCCH의 센싱이 불필요한 것으로 결정한다.
본 출원의 실시예에서 제공하는 통신 장치(10)는 상술한 방법 중 도 2의 실시예에 따른 기술방안을 수행할 수 있으며, 그 구현 원리 및 유리한 효과는 유사하므로, 여기서는 반복되는 설명을 생략한다.
도 5는 본 출원의 실시예에 따른 다른 통신 장치를 나타내는 구조도이다. 상기 통신 장치(20)는 사용자 기기에 적용되며, 센싱 모듈(21), 획득 모듈(22) 및 결정 모듈(23)을 포함한다.
센싱 모듈(21)은 페이징 물리적 다운링크 제어 채널(PDCCH)을 센싱하고;
획득 모듈(22)은 페이징 PDCCH가 검출되면, 페이징 지시 정보를 획득하고;
결정 모듈(23)은 페이징 지시 정보를 기초로, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신 필요 여부를 결정한다.
본 출원의 실시예에서 제공하는 통신 장치(20)는 상술한 방법 중 도 3의 실시예에 따른 기술방안을 수행할 수 있으며, 그 구현 원리 및 유리한 효과는 유사하므로, 여기서는 반복되는 설명을 생략한다.
일 가능한 설계에서, 획득 모듈(22)은 구체적으로,
페이징 PDCCH에 대응되는 DCI 또는 DCI 포맷 중의 타겟 비트로부터 페이징 지시 정보를 획득한다.
일 가능한 설계에서, 타겟 비트는 DCI 또는 DCI 포맷 중의 보류 비트이다.
일 가능한 설계에서, 페이징 지시 정보는 비트맵이고, 비트맵은 적어도 상기 사용자 기기에 대응되는 사용자 기기 서브 세트에 대응되는 비트를 포함한다.
일 가능한 설계에서, 페이징 지시 정보는 사용자 기기 서브 세트의 번호 또는 인덱스이다.
일 가능한 설계에서, 결정 모듈(23)은 구체적으로,
비트가 1이면, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신이 필요한 것으로 결정하고;
비트가 0이면, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신이 불필요한 것으로 결정한다.
일 가능한 설계에서, 결정 모듈(23)은 구체적으로,
비트가 0이면, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신이 필요한 것으로 결정하고;
비트가 1이면, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신이 불필요한 것으로 결정한다.
본 출원의 실시예에서 제공하는 통신 장치(20)는 상술한 도 4의 실시예에 따른 기술방안을 수행할 수 있으며, 그 구현 원리 및 유리한 효과는 유사하므로, 여기서는 반복되는 설명을 생략한다.
도 6은 본 출원의 실시예에 따른 통신 기기의 하드웨어 구성도이다. 도 6에 도시된 바와 같이, 상기 통신 기기(30)는 프로세서(31)와 메모리(32)를 포함하고,
여기서, 프로세서(31)와 메모리(32)는 버스(33)를 통해 연결된다.
구체적인 구현 과정에서, 프로세서(31)는 메모리(32)에 저장된 컴퓨터 실행 명령을 실행하여, 프로세서(31)가 상술한 도 2와 도 3의 실시예에 따른 통신 방법을 수행하도록 한다.
프로세서(31)의 구체적인 구현 과정은 상술한 방법 실시예를 참조할 수 있으며, 그 구현 원리와 기술효과는 유사하므로, 본 실시예는 여기서 반복되는 설명을 생략한다.
도 7은 본 출원의 실시예에 따른 다른 통신 기기의 하드웨어 구성도이다.도 7에 도시된 바와 같이, 상기 통신 기기(40)는 프로세서(41) 및 메모리(42)를 포함하고,
여기서, 프로세서(41)와 메모리(42)는 버스(43)를 통해 연결된다.
구체적인 구현 과정에서, 프로세서(41)는 메모리(42)에 저장된 컴퓨터 실행 명령을 실행하여, 프로세서(41)가 상술한 도 4와 도 5의 실시예에 따른 통신 방법을 수행하도록 한다.
프로세서(41)의 구체적인 구현 과정은 상술한 방법 실시예를 참조할 수 있으며, 그 구현 원리와 기술효과는 유사하므로, 본 실시예는 여기서 반복되는 설명을 생략한다.
상술한 도 6 및 도 7에 도시된 실시예에서, 통신 기기는 사용자 기기일 수 있고, 통신 기기는 통신 장치를 포함하는 하드웨어 기기일 수 있으며, 상술한 프로세서는 중앙 처리 유닛(영어: Central Processing Unit, 약칭: CPU)일 수 있고, 기타 범용 프로세서, 디지털 신호 프로세서(영어: Digital Signal Processor, 약칭: DSP), 전용 집적 회로(영어: Application Specific Integrated Circuit, 약칭: ASIC) 등일 수도 있다는 점을 이해하여야 한다. 범용 프로세서는 마이크로 프로세일 수 있거나 임의의 일반적인 프로세서 등일 수도 있다. 발명에 개시된 방법의 단계를 결합하여 직접 하드웨어 프로세서로 수행 완성하거나, 프로세서 중의 하드웨어 및 소프트웨어 모듈의 조합으로 수행 완성하도록 구현될 수 있다.
메모리는 고속 RAM 메모리를 포함할 수 있고, 비휘발성 저장(NVM), 예를 들어 자기 디스크 메모리를 더 포함할 수도 있다.
버스는 산업 표준 스스템 구조(Industry Standard Architecture, ISA) 버스, 주변기기 상호 연결(Peripheral Component, PCI) 버스 또는 확장 산업 표준 시스템 구조(Extended Industry Standard Architecture, EISA) 버스 등일 수 있다. 버스는 어드레스 버스, 데이터 버스, 제어 버스 등으로 나뉠 수 있다. 표시의 편의성을 위하여, 본 출원의 도면에서 하나 또는 일종의 버스만 존재하는 것을 한정하는 것은 아니다.
본 출원은 컴퓨터 판독 가능 저장매체를 더 제공하며, 컴퓨터 판독 가능 저장매체에 컴퓨터 실행 명령이 저장되어 있고, 프로세서가 컴퓨터 실행 명령을 실행할 때, 상술한 도 2 내지 도 3의 실시예에 따른 기술방안을 구현한다.
본 출원은 컴퓨터 판독 가능 저장매체를 더 제공하며, 컴퓨터 판독 가능 저장매체에 컴퓨터 실행 명령이 저장되어 있고, 프로세서가 컴퓨터 실행 명령을 실행할 때, 상술한 도 4 내지 도 5의 실시예에 따른 기술방안을 구현한다.
상술한 컴퓨터 판독 가능 저장매체는, 상술한 판독 가능 저장매체는 임의의 유형의 휘발성 또는 비휘발성 저장 장치 또는 이들의 조합으로 구현될 수 있고, 예를 들어 정적 랜덤 액세스 메모리(SRAM), 전기적 소거 가능 프로그래머블 판독 전용 메모리(EEPROM), 소거 가능 프로그래머블 판독 전용 메모리(EPROM), 프로그래머블 판독 전용 메모리(PROM), 판독 전용 메모리(ROM), 자기 메모리, 플래쉬 메모리, 자기 디스크 또는 광 디스크가 있다. 판독 가능 저장매체는 범용 또는 전용 컴퓨터가 액세스할 수 있는 임의의 사용 가능 매체일 수 있다.
일 예시적인 판독 가능 저장매체가 프로세서에 커플링되며, 이에 따라 프로세서가 상기 판독 가능 저장매체로부터 정보를 판독할 수 있고, 상기 판독 가능 저장매체로 정보를 기록할 수 있도록 한다. 물론, 저장매체는 프로세서의 구성 부분일 수도 있다. 프로세서와 판독 가능 저장매체는 전용 집적 회로(Application Specific Integrated Circuits, ASIC로 약칭)에 위치될 수 있다. 물론, 프로세서와 저장매체는 별도의 모듈로서 기기에 존재할 수 있다.
유닛의 분할은 논리적 기능 분할일 뿐, 실제적으로 구현할 때 다른 분할 방식이 있을 수 있는 바, 예를 들어 복수의 유닛 또는 모듈은 결합되거나 다른 하나의 시스템에 집적될 수 있고, 또는 일부 특징은 생략하거나 수행하지 않을 수도 있다. 한편, 표시되거나 논의되는 서로 사이의 커플링 또는 직접적 커플링 또는 통신 연결은 일부 인터페이스, 장치 또는 유닛을 통한 간접 커플링 또는 통신 연결일 수 있고, 전기적, 기계적 또는 기타 형태일 수 있다.
분리 부품으로서 설명되는 유닛은 물리적으로 분리된 것이거나 물리적으로 분리되지 않은 것일 수 있고, 유닛으로서 표시되는 부재는 물리적 유닛이거나 물리적 유닛이 아닐 수 도 있는 바, 즉 한 곳에 구비될 수 있고, 복수의 네트워크 유닛에 분포될 수도 있다. 실제 수요에 따라 그 중 일부 또는 모든 유닛을 선택하여 본 실시예에 따른 방안의 목적을 구현할 수 있다.
한편, 본 출원의 각 실시예 중 각 기능 유닛은 하나의 처리 유닛에 집적될 수 있고, 각 유닛이 단독으로 물리적으로 존재할 수도 있으며, 둘 또는 둘 이상의 모듈이 하나의 유닛에 집적될 수도 있다.
기능이 만약 소프트웨어 기능 유닛의 형태로 구현되고 독립적인 제품으로서 판매되거나 사용될 경우, 하나의 컴퓨터 판독 가능 저장매체에 저장될 수 있다. 이러한 이해에 기반하여, 본 출원의 기술방안은 본질적으로 또는 종래기술에 대해 기여하는 부분 또는 해당 기술방안의 일부분은 소프트웨어 제품의 형태로 구현될 수 있고, 해당 컴퓨터 소프트웨어 제품은 하나의 저장매체에 저장되는 바, 몇몇 명령을 포함하여 하나의 컴퓨터 기기(개인 컴퓨터, 서버 또는 네트워크 기기 등일 수 있다)가 본 출원의 각 실시예에 따른 방법의 모든 또는 부분 단계를 수행하도록 한다. 상술한 저장매체는 USB 메모리, 모바일 하드디스크, 읽기 전용 메모리(ROM, Read-Only Memory), 랜덤 액세스 메모리(RAM, Random Access Memory), 자기 디스크 또는 시디롬 등의 프로그램 코드를 저장할 수 있는 다양한 매체를 포함한다.
본 분야의 일반 기술자라면, 상기 각 방법의 실시예를 구현하는 모든 또는 부분 단계는 프로그램 명령과 관련된 하드웨어를 통해 완성할 수 있다는 것을 이해할 수 있다. 상술한 프로그램은 하나의 컴퓨터 판독 가능 저장매체에 저장될 수 있다. 상기 프로그램이 실행될 때, 상기 각 방법 실시예를 포함하는 단계를 수행하고; 상술한 저장매체는 ROM, RAM, 자기 디스크 또는 광 디스크 등의 프로그램 코드를 저장할 수 있는 다양한 매체를 포함한다.
마지막으로, 상술한 각 실시예는 본 출원의 기술방안을 설명하기 위한 것일 뿐, 이에 대해 한정하는 것은 아니다. 비록 상술한 각 실시예를 참조하여 본 출원에 대해 상세하게 설명하였지만, 본 분야의 당업자라면 여전히 상술한 각 실시예에서 기재한 기술방안에 대해 수정을 가하거나, 그 중 부분 또는 모든 기술특징에 대해 동등한 치환을 가할 수 있으며,이러한 수정 또는 치환에 의해 관련 기술방안의 본질이 본 출원의 각 실시예의 기술방안의 범위를 벗어나는 것은 아니다.

Claims (32)

  1. 사용자 기기에 적용되는 통신 방법에 있어서,
    페이징 지시 물리적 다운링크 제어 채널PDCCH을 센싱하는 단계;
    상기 페이징 지시 PDCCH가 검출되면, 페이징 지시 정보를 획득하는 단계;
    상기 페이징 지시 정보를 기초로, 페이징 PDCCH의 센싱 필요 여부를 결정하는 단계;를 포함하는 것을 특징으로 하는 통신 방법.
  2. 제1항에 있어서, 상기 페이징 지시 PDCCH를 센싱하는 단계는,
    페이징 지시 PDCCH 센싱 기회에서, 상기 페이징 지시 PDCCH를 센싱하는 단계를 포함하고;
    여기서, 페이징 지시 PDCCH 센싱 기회는, 제1 시점 이전에 있으며, 상기 제1 시점과의 사이의 오프셋이 제1 기설정 시간길이인 것; 또는, 제1 시점 이후에 있으며, 상기 제1 시점과의 사이의 오프셋이 제1 기설정 시간길이인 것; 중 어느 하나의 조건을 만족하고, 상기 제1 시점은 동기 신호 블록, 또는 정보 상태 정보 기준 신호, 또는 추종 기준 신호의 시작 시점 또는 종료 시점인 것을 특징으로 하는 방법.
  3. 제1항에 있어서, 상기 페이징 지시 정보를 획득하는 단계는,
    상기 페이징 지시 PDCCH에 대응되는 다운링크 제어 정보DCI 또는 다운링크 제어 정보DCI 포맷 중의 타겟 비트로부터 상기 페이징 지시 정보를 획득하는 단계를 포함하는 것을 특징으로 하는 방법.
  4. 제3항에 있어서,
    상기 타겟 비트는 상기 DCI 또는 DCI 포맷 중의 보류 비트인 것을 특징으로 하는 방법.
  5. 제3항에 있어서,
    상기 타겟 비트는 재정의 상기 DCI 또는 DCI 포맷에 이미 정의된 도메인 중의 비트인 것을 특징으로 하는 방법.
  6. 제1항 내지 제5항 중 어느 한 항에 있어서, 상기 페이징 지시 정보를 획득하는 단계는,
    상기 페이징 지시 PDCCH에 의해 스케줄링되는 물리적 다운링크 공유 채널(PDSCH)로부터 상기 페이징 지시 정보를 획득하는 단계를 포함하는 것을 특징으로 하는 방법.
  7. 제3항 내지 제6항 중 어느 한 항에 있어서,
    상기 페이징 지시 정보는 비트맵이고, 상기 비트맵은 적어도 상기 사용자 기기에 대응되는 사용자 기기 서브 세트에 대응되는 비트를 포함하는 것을 특징으로 하는 방법.
  8. 제3항 내지 제6항 중 어느 한 항에 있어서,
    상기 페이징 지시 정보는 사용자 기기 서브 세트의 번호 또는 인덱스인 것을 특징으로 하는 방법.
  9. 제7항에 있어서,
    상기 페이징 지시 정보를 기초로, 페이징 PDCCH의 센싱 필요 여부를 결정하는 단계는,
    상기 비트가 1이면, 상기 페이징 PDCCH의 센싱이 필요한 것으로 결정하는 단계;
    상기 비트가 0이면, 상기 페이징 PDCCH의 센싱이 불필요한 것으로 결정하는 단계;를 포함하는 것을 특징으로 하는 방법.
  10. 제7항에 있어서, 상기 페이징 지시 정보를 기초로, 상기 페이징 PDCCH의 센싱이 필요한지 여부를 결정하는 단계는,
    상기 비트가 0이면, 상기 페이징 PDCCH의 센싱이 필요한 것으로 결정하고;
    상기 비트가 1이면, 상기 페이징 PDCCH의 센싱이 불필요한 것으로 결정하는 단계;를 포함하는 것을 특징으로 하는 방법.
  11. 제1항에 있어서, 상기 페이징 지시 PDCCH를 센싱하는 단계는,
    페이징 지시 PDCCH 센싱 기회에서, 상기 페이징 지시 PDCCH를 센싱하는 단계를 포함하고;
    여기서, 상기 페이징 지시 PDCCH 센싱 기회는, 제2 시점 이전에 있으며, 상기 제2 시점과의 사이의 오프셋이 제2 기설정 시간길이인 것; 상기 제2 시점이 페이징 기회의 시작 시점 또는 종료 시점이거나, 또는 페이징 기회에 대응되는 페이징 PDCCH 센싱 기회의 시작 시점 또는 종료 시점인 것; 중 어느 하나의 조건을 만족하는 것을 특징으로 하는 방법.
  12. 제11항에 있어서, 상기 페이징 지시 정보를 획득하는 단계는,
    상기 페이징 지시 PDCCH에 대응되는 DCI 또는 DCI 포맷 중의 타겟 비트로부터 상기 페이징 지시 정보를 획득하는 단계를 포함하는 것을 특징으로 하는 방법.
  13. 제12항에 있어서,
    상기 타겟 비트는 상기 DCI 또는 DCI 포맷 중의 보류 비트인 것을 특징으로 하는 방법.
  14. 제12항에 있어서,
    상기 타겟 비트는 재정의 상기 DCI 또는 DCI 포맷에 이미 정의된 도메인 중의 비트인 것을 특징으로 하는 방법.
  15. 제12항에 있어서, 상기 페이징 지시 정보를 획득하는 단계는,
    상기 페이징 지시 PDCCH에 의해 스케줄링되는 PDSCH로부터 상기 페이징 지시 정보를 획득하는 단계를 포함하는 것을 특징으로 하는 방법.
  16. 제11항 내지 제15항 중 어느 한 항에 있어서,
    상기 페이징 지시 정보는 비트맵이고, 상기 비트맵은 적어도 상기 사용자 기기에 대응되는 사용자 기기 서브 세트에 대응되는 비트를 포함하는 것을 특징으로 하는 방법.
  17. 제11항 내지 제15항 중 어느 한 항에 있어서,
    상기 페이징 지시 정보는 사용자 기기 서브 세트의 번호 또는 인덱스인 것을 특징으로 하는 방법.
  18. 제16항에 있어서, 상기 페이징 지시 정보를 기초로, 상기 페이징 PDCCH의 센싱이 필요한지 여부를 결정하는 단계는,
    상기 비트가 1이면, 상기 페이징 PDCCH의 센싱이 필요한 것으로 결정하는 단계;
    상기 비트가 0이면, 상기 페이징 PDCCH의 센싱이 불필요한 것으로 결정하는 단계;를 포함하는 것을 특징으로 하는 방법.
  19. 제16항에 있어서, 상기 페이징 지시 정보를 기초로, 상기 페이징 PDCCH의 센싱이 필요한지 여부를 결정하는 단계는,
    상기 비트가 0이면, 상기 페이징 PDCCH의 센싱이 필요한 것으로 결정하는 단계;
    상기 비트가 1이면, 상기 페이징 PDCCH의 센싱이 불필요한 것으로 결정하는 단계;를 포함하는 것을 특징으로 하는 방법.
  20. 사용자 기기에 적용되는 통신 방법에 있어서,
    페이징 물리적 다운링크 제어 채널PDCCH을 센싱하는 단계;
    페이징 PDCCH가 검출되면, 페이징 지시 정보를 획득하는 단계;
    상기 페이징 지시 정보를 기초로, 상기 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신 필요 여부를 결정하는 단계를 포함하는 것을 특징으로 하는 통신 방법.
  21. 제20항에 있어서, 상기 페이징 지시 정보를 획득하는 단계는,
    상기 페이징 PDCCH에 대응되는 다운링크 제어 정보DCI 또는 다운링크 제어 정보DCI 포맷 중의 타겟 비트로부터 상기 페이징 지시 정보를 획득하는 단계를 포함하는 것을 특징으로 하는 방법.
  22. 제21항에 있어서,
    상기 타겟 비트는 상기 DCI 또는 DCI 포맷 중의 보류 비트인 것을 특징으로 하는 방법.
  23. 제21항 또는 제22항에 있어서,
    상기 페이징 지시 정보는 비트맵이고, 상기 비트맵은 적어도 상기 사용자 기기에 대응되는 사용자 기기 서브 세트에 대응되는 비트를 포함하는 것을 특징으로 하는 방법.
  24. 제21항 또는 제22항에 있어서,
    상기 페이징 지시 정보는 사용자 기기 서브 세트의 번호 또는 인덱스인 것을 특징으로 하는 방법.
  25. 제23항에 있어서, 상기 페이징 지시 정보를 기초로, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신 필요 여부를 결정하는 단계는,
    상기 비트가 1이면, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신이 필요한 것으로 결정하는 단계;
    상기 비트가 0이면, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신이 불필요한 것으로 결정하는 단계;를 포함하는 것을 특징으로 하는 방법.
  26. 제23항에 있어서, 상기 페이징 지시 정보를 기초로, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신 필요 여부를 결정하는 단계는,
    상기 비트가 1이면, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신이 필요한 것으로 결정하는 단계;
    상기 비트가 0이면, 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신이 불필요한 것으로 결정하는 단계;를 포함하는 것을 특징으로 하는 방법.
  27. 사용자 기기에 적용되는 통신 장치에 있어서,
    센싱 모듈, 획득 모듈과 결정 모듈을 포함하고, 여기서,
    상기 센싱 모듈은 페이징 지시 물리적 다운링크 제어 채널PDCCH을 센싱하고;
    상기 획득 모듈은 상기 페이징 지시 PDCCH가 검출되면, 페이징 지시 정보를 획득하고;
    상기 결정 모듈은 상기 페이징 지시 정보를 기초로, 페이징 PDCCH의 센싱 필요 여부를 결정하는 것을 특징으로 하는 통신 장치.
  28. 사용자 기기에 적용되는 통신 장치에 있어서,
    센싱 모듈, 획득 모듈과 결정 모듈을 포함하고, 여기서,
    상기 센싱 모듈은 페이징 물리적 다운링크 제어 채널(PDCCH)을 센싱하고;
    상기 획득 모듈은 페이징 PDCCH가 검출되면, 페이징 지시 정보를 획득하고;
    상기 결정 모듈은 상기 페이징 지시 정보를 기초로, 상기 페이징 PDCCH에 의해 스케줄링되는 페이징 메시지의 수신 필요 여부를 결정하는 것을 특징으로 하는 통신 장치.
  29. 프로세서와 메모리를 포함하고;
    상기 메모리는 컴퓨터 실행 명령을 저장하고;
    상기 프로세서는 상기 메모리에 저장된 컴퓨터 실행 명령을 실행하여, 상기 프로세서가 제1항 내지 19 중 어느 한 항에 따른 통신 방법을 수행하도록 하는 것을 특징으로 하는 통신 장치.
  30. 프로세서와 메모리를 포함하고;
    상기 메모리는 컴퓨터 실행 명령을 저장하고;
    상기 프로세서는 상기 메모리에 저장된 컴퓨터 실행 명령을 실행하여, 상기 프로세서가 제20항 내지 제26항 중 어느 한 항에 따른 통신 방법을 수행하도록 하는 것을 특징으로 하는 통신 장치.
  31. 컴퓨터 판독 가능 저장매체에 있어서,
    상기 컴퓨터 판독 가능 저장매체에 컴퓨터 실행 명령이 저장되어 있고, 프로세서가 상기 컴퓨터 실행 명령을 실행할 때, 제1항 내지 19 중 어느 한 항에 따른 통신 방법을 구현하는 것을 특징으로 하는 컴퓨터 판독 가능 저장매체.
  32. 컴퓨터 판독 가능 저장매체에 있어서,
    상기 컴퓨터 판독 가능 저장매체에 컴퓨터 실행 명령이 저장되어 있고, 프로세서가 상기 컴퓨터 실행 명령을 실행할 때, 제20항 내지 제26항 중 어느 한 항에 따른 통신 방법을 구현하는 것을 특징으로 하는 컴퓨터 판독 가능 저장매체.
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