KR20210157950A - 표시 장치 및 그 구동 방법 - Google Patents

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Abstract

본 발명의 표시 장치는, 입력 계조들에 보상 계조들을 합산하여 출력 계조들을 제공하는 계조 변환부; 상기 출력 계조들에 대응하는 데이터 전압들을 제공하는 데이터 구동부; 및 상기 데이터 전압들을 수신하는 화소들을 포함하는 화소부를 포함하고, 상기 계조 변환부는: 상기 입력 계조들을 전압 도메인의 변환 계조들로 변환하는 전압 도메인 변환부; 및 상기 변환 계조들에 기초하여 상기 보상 계조들을 산출하는 보상 계조 산출부를 포함한다.

Description

표시 장치 및 그 구동 방법{DISPLAY DEVICE AND DRIVING METHOD THEREOF}
본 발명은 표시 장치 및 그 구동 방법에 관한 것이다.
정보화 기술이 발달함에 따라 사용자와 정보간의 연결매체인 표시 장치의 중요성이 부각되고 있다. 이에 부응하여 액정 표시 장치(Liquid Crystal Display Device), 유기 발광 표시 장치(Organic Light Emitting Display Device), 플라즈마 표시 장치(Plasma Display Device) 등과 같은 표시 장치의 사용이 증가하고 있다.
표시 장치의 데이터 구동부는 화소들에 데이터 전압들을 공급하고, 화소들은 데이터 전압들에 기초한 휘도로 발광함으로써 영상을 표시할 수 있다. 이때, 화소들은 화소들의 개수보다 작은 개수의 데이터 라인들을 공유하고, 시분할 방식으로 데이터 전압들을 수신할 수 있다.
이때 각 화소의 데이터 전압은 데이터 라인을 공유하는 인접한 화소의 데이터 전압에 영향을 받을 수 있다. 이를 해결하기 위해서 인접한 화소들의 계조들을 비교하여 보상 계조를 산출하는 방식이 제안된 바 있다.
하지만, 이렇게 산출된 보상 계조들은 비선형적(non-linear)이기에, 표시 장치의 구조/구동 방법에 따라 필요한 다양한 게인들(gains)을 적용하기 어렵다는 문제가 있다.
해결하고자 하는 기술적 과제는, 전압 도메인에서 선형적인(linear) 보상 값들을 산출함으로써, 표시 장치의 구조/구동 방법에 따라 필요한 다양한 게인들을 쉽게 적용할 수 있는 표시 장치 및 그 구동 방법을 제공하는 데 있다.
본 발명의 한 실시예에 따른 표시 장치는, 입력 계조들에 보상 계조들을 합산하여 출력 계조들을 제공하는 계조 변환부; 상기 출력 계조들에 대응하는 데이터 전압들을 제공하는 데이터 구동부; 및 상기 데이터 전압들을 수신하는 화소들을 포함하는 화소부를 포함하고, 상기 계조 변환부는: 상기 입력 계조들을 전압 도메인의 변환 계조들로 변환하는 전압 도메인 변환부; 및 상기 변환 계조들에 기초하여 상기 보상 계조들을 산출하는 보상 계조 산출부를 포함한다.
상기 계조 변환부는 1 개 이전 화소행에 해당하는 이전 변환 계조들을 출력하는 메모리를 더 포함할 수 있다.
상기 화소들 각각은 상기 화소들 각각을 기준으로 제1 방향에 위치한 데이터 라인에 연결될 수 있다.
상기 계조 변환부는 2 개 이전 화소행에 해당하는 이전 변환 계조들을 출력하는 메모리를 더 포함할 수 있다.
상기 화소들은 제1 화소들 및 제2 화소들을 포함하고, 상기 제1 화소들 각각은 상기 제1 화소들 각각을 기준으로 제1 방향에 위치한 데이터 라인에 연결되고, 상기 제2 화소들 각각은 상기 제2 화소들 각각을 기준으로 제2 방향에 위치한 데이터 라인에 연결될 수 있다.
상기 표시 장치는, 데이터 출력 라인들을 통해서 상기 데이터 구동부와 연결되고, 데이터 라인들을 통해서 상기 화소들과 연결된 데이터 분배부를 더 포함하고, 상기 데이터 출력 라인들의 개수는 상기 데이터 라인들의 개수보다 작을 수 있다.
상기 보상 계조 산출부는 상기 이전 변환 계조들 중 일부 및 상기 변환 계조들 중 일부에 대응하는 보상 값들을 기록한 룩업 테이블을 포함하고, 상기 보상 계조 산출부는, 상기 화소들 중 일부에 대해서, 상기 보상 값을 보간하여 제1 보간 값들(first interpolated values)을 산출할 수 있다.
상기 보상 계조 산출부는, 상기 화소들 중 다른 일부에 대해서, 상기 제1 보간 값들을 보간하여 제2 보간 값들을 산출할 수 있다.
상기 보상 계조 산출부는 상기 제2 보간 값들을 계조 도메인으로 변환하여 상기 보상 계조들로써 제공할 수 있다.
상기 계조 변환부는 최대 휘도에 기초하여 최대 휘도 게인을 제공하는 최대 휘도 게인 제공부를 더 포함하고, 상기 보상 계조 산출부는 상기 최대 휘도 게인에 따라 상기 제2 보간 값들을 스케일링하고, 스케일링된 제2 보간 값들을 계조 도메인으로 변환하여 상기 보상 계조들로써 제공할 수 있다.
상기 최대 휘도 게인 제공부는 상기 최대 휘도가 증가할수록 상기 최대 휘도 게인을 증가시킬 수 있다.
상기 계조 변환부는 상기 제1 화소들에 대한 연결 게인들을 제공하는 연결 게인 제공부를 더 포함하고, 상기 보상 계조 산출부는 상기 연결 게인들에 따라 상기 제2 보간 값들을 스케일링하고, 스케일링된 상기 제2 보간 값들을 계조 도메인으로 변환하여 상기 보상 계조들로써 제공할 수 있다.
상기 연결 게인 제공부는 상기 제2 화소들에 대한 연결 게인들을 제공하지 않을 수 있다.
상기 계조 변환부는 상기 화소들의 위치에 기초하여 영역 게인들을 제공하는 영역 게인 제공부를 더 포함하고, 상기 보상 계조 산출부는 상기 영역 게인들에 따라 상기 제2 보간 값들을 스케일링하고, 스케일링된 상기 제2 보간 값들을 계조 도메인으로 변환하여 상기 보상 계조들로써 제공할 수 있다.
상기 화소부는 제1 영역, 제2 영역, 및 제3 영역으로 구획되고, 상기 제1 영역은 화소들을 제1 밀도로 포함하고, 상기 제2 영역 및 상기 제3 영역은 화소들을 상기 제1 밀도보다 높은 제2 밀도로 포함하고, 상기 제2 영역의 화소들은 상기 제1 영역의 화소들과 동일한 데이터 라인들에 연결되고, 상기 영역 게인 제공부는 상기 제1 영역의 화소들에 대해서 제1 영역 게인을 제공하고, 상기 제2 영역의 화소들에 대해서 제2 영역 게인을 제공할 수 있다.
본 발명의 한 실시예에 따른 표시 장치의 구동 방법은, 입력 계조들을 전압 도메인의 변환 계조들로 변환하는 단계; 상기 변환 계조들에 기초하여 보상 계조들을 산출하는 단계; 상기 입력 계조들에 상기 보상 계조들을 합산하여 출력 계조들을 제공하는 단계; 및 상기 출력 계조들에 대응하는 데이터 전압들을 화소들로 제공하는 단계를 포함할 수 있다.
상기 구동 방법은, 2 개 이전 화소행에 해당하는 이전 변환 계조들 중 일부 및 상기 변환 계조들 중 일부에 대응하는 보상 값들을 기록한 룩업 테이블을 참조하고, 상기 화소들 중 일부에 대해서, 상기 보상 값들을 보간하여 제1 보간 값들을 산출하는 단계를 더 포함할 수 있다.
상기 구동 방법은, 상기 화소들 중 다른 일부에 대해서, 상기 제1 보간 값들을 보간하여 제2 보간 값들을 산출하는 단계를 더 포함할 수 있다.
상기 구동 방법은, 상기 제2 보간 값들을 상기 보상 계조들로 제공하는 단계를 더 포함할 수 있다.
상기 구동 방법은, 최대 휘도가 증가할수록 증가하는 최대 휘도 게인에 따라 상기 제2 보간 값들을 스케일링하고, 스케일링된 상기 제2 보간 값들을 계조 도메인으로 변환하여 상기 보상 계조들로써 제공하는 단계를 더 포함할 수 있다.
본 발명에 따른 표시 장치 및 그 구동 방법은, 전압 도메인에서 선형적인(linear) 보상 값들을 산출함으로써, 표시 장치의 구조/구동 방법에 따라 필요한 다양한 게인들을 쉽게 적용할 수 있다.
도 1은 본 발명의 한 실시예에 따른 표시 장치를 설명하기 위한 도면이다.
도 2는 본 발명의 한 실시예에 따른 화소를 설명하기 위한 도면이다.
도 3 및 도 4는 본 발명의 한 실시예에 따른 화소부 및 데이터 분배부를 설명하기 위한 도면이다.
도 5는 본 발명의 한 실시예에 따른 계조 변환부를 설명하기 위한 도면이다.
도 6은 본 발명의 한 실시예에 따른 전압 도메인 변환부를 설명하기 위한 도면이다.
도 7 및 도 8은 본 발명의 한 실시예에 따른 보상 계조 산출부를 설명하기 위한 도면이다.
도 9 및 도 10은 본 발명의 한 실시예에 따른 최대 휘도 게인 제공부를 설명하기 위한 도면이다.
도 11 및 도 12는 본 발명의 한 실시예에 따른 연결 게인 제공부를 설명하기 위한 도면이다.
도 13 및 도 14는 본 발명의 한 실시예에 따른 영역 게인 제공부를 설명하기 위한 도면이다.
도 15는 본 발명의 다른 실시예에 따른 계조 변환부를 설명하기 위한 도면이다.
도 16은 본 발명의 다른 실시예에 따른 표시 장치를 설명하기 위한 도면이다.
도 17은 본 발명의 다른 실시예에 따른 화소부를 설명하기 위한 도면이다.
이하, 첨부한 도면을 참고로 하여 본 발명의 여러 실시 예들에 대하여 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 상세히 설명한다. 본 발명은 여러 가지 상이한 형태로 구현될 수 있으며 여기에서 설명하는 실시 예들에 한정되지 않는다.
본 발명을 명확하게 설명하기 위해서 설명과 관계없는 부분은 생략하였으며, 명세서 전체를 통하여 동일 또는 유사한 구성요소에 대해서는 동일한 참조 부호를 붙이도록 한다. 따라서 앞서 설명한 참조 부호는 다른 도면에서도 사용할 수 있다.
또한, 도면에서 나타난 각 구성의 크기 및 두께는 설명의 편의를 위해 임의로 나타내었으므로, 본 발명이 반드시 도시된 바에 한정되지 않는다. 도면에서 여러 층 및 영역을 명확하게 표현하기 위하여 두께를 과장되게 나타낼 수 있다.
도 1은 본 발명의 한 실시예에 따른 표시 장치를 설명하기 위한 도면이다.
도 1을 참조하면, 본 발명의 한 실시예에 따른 표시 장치(10)는 타이밍 제어부(11), 데이터 구동부(12), 주사 구동부(13), 화소부(14), 계조 변환부(15), 및 데이터 분배부(16)를 포함할 수 있다.
타이밍 제어부(11)는 외부 프로세서로부터 각각의 프레임(또는 입력 이미지)에 대한 입력 계조들 및 제어 신호들을 수신할 수 있다. 타이밍 제어부(11)는 프레임 표시를 위하여 데이터 구동부(12), 주사 구동부(13) 등에 각각의 사양에 적합한 제어 신호들을 제공할 수 있다.
계조 변환부(15)는 입력 계조들에 보상 계조들을 합산하여 출력 계조들을 제공할 수 있다. 타이밍 제어부(11)는 이러한 출력 계조들을 데이터 구동부(12)로 제공할 수 있다. 계조 변환부(15)는 타이밍 제어부(11) 또는 데이터 구동부(12)와 일체의 IC(integrated chip)로 구성되거나, 별도의 독립적인 IC로 구성될 수 있다. 한편 계조 변환부(15)는 타이밍 제어부(11) 또는 데이터 구동부(12)에서 소프트웨어로 구현될 수도 있다.
데이터 구동부(12)는 출력 계조들에 대응하는 데이터 전압들을 제공할 수 있다. 예를 들어, 데이터 구동부(12)는 출력 계조들 및 제어 신호들을 이용하여 데이터 출력 라인들(DO1, DO2, ..., DOr)로 제공할 데이터 전압들을 생성할 수 있다. 예를 들어, 데이터 구동부(12)는 클록 신호를 이용하여 출력 계조들을 샘플링하고, 출력 계조들에 대응하는 데이터 전압들을 화소행 단위로 데이터 출력 라인들(DO1~DOr)에 인가할 수 있다. 화소행은 하나의 주사 라인에 연결된 화소들의 그룹을 의미할 수 있다. r은 0보다 큰 정수일 수 있다.
데이터 분배부(16)는 데이터 출력 라인들(DO1~DOr)을 통해서 데이터 구동부(12)와 연결되고, 데이터 라인들(DL1, DL2, DL3, ..., DLn)을 통해서 화소들과 연결될 수 있다. n은 r보다 큰 정수일 수 있다. 데이터 분배부(16)는 일종의 디멀티플렉서(demultiplexer)일 수 있다. 데이터 분배부(16)는 데이터 출력 라인들(DO1~DOr)을 데이터 라인들(DL1~DLn)과 선택적으로 연결시킬 수 있다. 데이터 라인들(DL1~DLn)은 연결된 데이터 출력 라인들(DO1~DOr)로부터 데이터 전압들을 수신할 수 있다.
주사 구동부(13)는 타이밍 제어부(11)로부터 클록 신호, 주사 시작 신호 등을 수신하여, 주사 라인들(SL1, SL2, SL3, ..., SLm)에 제공할 주사 신호들을 생성할 수 있다. m은 0보다 큰 정수일 수 있다.
주사 구동부(13)는 주사 라인들(SL1~SLm)에 턴-온 레벨의 펄스를 갖는 주사 신호들을 순차적으로 공급할 수 있다. 주사 구동부(13)는 시프트 레지스터(shift register) 형태로 구성될 수 있고, 복수의 주사 스테이지들을 포함할 수 있다. 주사 구동부(13)는 클록 신호의 제어에 따라 턴-온 레벨의 펄스 형태인 주사 시작 신호를 다음 주사 스테이지로 순차적으로 전달하는 방식으로 주사 신호들을 생성할 수 있다.
화소부(14)는 데이터 전압들을 수신하는 화소들을 포함한다. 각각의 화소(PXij)는 대응하는 데이터 라인 및 주사 라인에 연결될 수 있다. i 및 j는 0보다 큰 정수일 수 있다. 화소(PXij)는 스캔 트랜지스터가 i 번째 주사 라인 및 j 번째 데이터 라인과 연결된 화소를 의미할 수 있다. 화소들은 제1 전원 라인(ELVDDL) 및 제2 전원 라인(ELVSSL)에 공통적으로 연결될 수 있다(도 2 참조).
도 2는 본 발명의 한 실시예에 따른 화소를 설명하기 위한 도면이다.
도 2를 참조하면, 화소(PXij)는 제1 색상의 광을 방출하는 화소일 수 있다. 제2 색상 또는 제3 색상의 광을 방출하는 화소들은 발광 다이오드(LD)를 제외하고 화소(PXij)와 실질적으로 동일한 구성들을 포함하므로, 중복된 설명은 생략한다.
예를 들어, 제1 색상은 적색, 녹색, 및 청색 중 한가지 색상일 수 있고, 제2 색상은 적색, 녹색, 및 청색 중 제1 색상이 아닌 한가지 색상일 수 있고, 제3 색상은 적색, 녹색, 및 청색 중 제1 색상 및 제2 색상이 아닌 나머지 색상일 수 있다. 또한, 제1 내지 제3 색상들로 적색, 녹색, 및 청색 대신 마젠타(magenta), 시안(cyan), 및 옐로우(yellow)가 사용될 수도 있다.
화소(PXij)는 복수의 트랜지스터들(T1, T2), 스토리지 커패시터(Cst1), 및 발광 다이오드(LD)를 포함할 수 있다.
본 실시예에서 트랜지스터들은 P형 트랜지스터, 예를 들어 PMOS로 도시되었지만, 당업자라면 N형 트랜지스터, 예를 들어 NMOS로 동일한 기능을 하는 화소 회로를 구성할 수 있을 것이다.
트랜지스터(T2)는 게이트 전극이 주사 라인(SLi)에 연결되고, 제1 전극이 데이터 라인(DLj)에 연결되고, 제2 전극이 트랜지스터(T1)의 게이트 전극에 연결된다. 트랜지스터(T2)는 스캔 트랜지스터로 명명될 수 있다.
트랜지스터(T1)는 게이트 전극이 트랜지스터(T2)의 제2 전극에 연결되고, 제1 전극이 제1 전원 라인(ELVDDL)에 연결되고, 제2 전극이 발광 다이오드(LD)의 애노드에 연결된다. 트랜지스터(T1)는 구동 트랜지스터로 명명될 수 있다.
스토리지 커패시터(Cst1)는 트랜지스터(T1)의 제1 전극과 게이트 전극을 연결한다.
발광 다이오드(LD)는 애노드가 트랜지스터(T1)의 제2 전극에 연결되고, 캐소드가 제2 전원 라인(ELVSSL)에 연결된다. 발광 다이오드(LD)는 제1 색상에 해당하는 파장의 광을 방출하는 소자일 수 있다. 발광 다이오드(LD)는 유기 발광 다이오드(organic light emitting diode)로 구성되거나, 마이크로 LED(micro light emitting diode), 양자점 발광 다이오드(quantum dot light emitting diode) 등과 같은 무기 발광 다이오드(inorganic light emitting diode)로 구성될 수 있다. 또한, 발광 다이오드(LD)는 유기물과 무기물이 복합적으로 구성된 발광 소자일 수도 있다. 본 실시예에서는 하나의 발광 다이오드(LD)만 도시되었지만, 복수의 서브 발광 다이오드들이 직렬, 병렬, 또는 직병렬 연결됨으로써 발광 다이오드(LD)를 대체할 수도 있다.
트랜지스터(T2)의 게이트 전극에 주사 라인(SLi)을 통해서 턴-온 레벨(로우 레벨)의 주사 신호가 공급되면, 트랜지스터(T2)는 데이터 라인(DLj)과 스토리지 커패시터(Cst1)의 제1 전극을 연결시킨다. 따라서, 스토리지 커패시터(Cst1)에는 데이터 라인(DLj)을 통해 인가된 데이터 전압과 제1 전원 전압(ELVDD)의 차이에 따른 전압이 기입된다.
트랜지스터(T1)는 스토리지 커패시터(Cst1)에 기입된 전압에 따라 결정된 구동 전류를 제1 전원 라인(ELVDDL)으로부터 제2 전원 라인(ELVSSL)으로 흐르게 한다. 발광 다이오드(LD)는 구동 전류량에 따른 휘도로 발광하게 된다. 화소들의 발광 다이오드들은 공통의 제1 전원 라인(ELVDDL) 및 제2 전원 라인(ELVSSL) 사이에 연결될 수 있다.
도 3 및 도 4는 본 발명의 한 실시예에 따른 화소부 및 데이터 분배부를 설명하기 위한 도면이다.
도 3을 참조하면, 데이터 분배부(16)는 제1 트랜지스터들(MA1, MA2, MA3, MA4, MA5, MA6, MA7, MA8) 및 제2 트랜지스터들(MB1, MB2, MB3, MB4, MB5, MB6, MB7, MB8)을 포함할 수 있다. 제1 트랜지스터들(MA1~MA8)의 게이트 전극들은 제1 제어 라인(CLA)에 연결되고, 제1 전극들은 데이터 출력 라인들(DO1~DO8)에 연결되고, 제2 전극들은 제1 데이터 라인들(DL2, DL3, DL6, DL7, DL10, D11, DL14, DL15)에 연결될 수 있다. 제2 트랜지스터들(MB1~MB8)의 게이트 전극들은 제2 제어 라인(CLB)에 연결되고, 제1 전극들은 데이터 출력 라인들(DO1~DO8)에 연결되고, 제2 전극들은 제2 데이터 라인들(DL1, DL4, DL5, DL8, DL9, DL12, DL13, DL16)에 연결될 수 있다. 제1 트랜지스터들(MA1~MA8)의 개수와 제2 트랜지스터들(MB1~MB8)의 개수는 동일할 수 있다. 또한, 제1 데이터 라인들(DL2~DL15) 및 제2 데이터 라인들(DL1~DL16)의 개수는 동일할 수 있다. 데이터 분배부(16)는 입력 대 출력의 비율이 1:2인 디멀티플렉서일 수 있다.
제1 트랜지스터들(MA1~MA8)의 턴-온 기간과 제2 트랜지스터들(MB1~MB8)의 턴-온 기간은 서로 중첩되지 않을 수 있다. 타이밍 제어부(11)는 제1 트랜지스터들(MA1~MA8) 및 제2 트랜지스터들(MB1~MB8)이 교번적으로 턴-온되도록 제1 및 제2 제어 라인들(CLA, CLB)로 턴-온 레벨의 제어 신호들을 제공할 수 있다(도 4 참조).
예를 들어, 화소부(14)는 펜타일(pentile) 구조로 배열된 화소들(PX12, PX13, PX16, PX17, PX110, PX111, PX114, PX115, PX21, PX24, PX25, PX28, PX29, PX212, PX213, PX216, PX32, PX33, PX36, PX37, PX310, PX311, PX314, PX315, PX41, PX44, PX45, PX48, PX49, PX412, PX413, PX416)을 포함할 수 있다.
제1 주사 라인(SL1) 및 제3 주사 라인(SL3)에 연결된 화소들(PX12~PX115, PX32~PX315)은 제1 데이터 라인들(DL2~DL15)과 연결될 수 있다. 제2 주사 라인(SL2) 및 제4 주사 라인(SL4)에 연결된 화소들(PX21~PX216, PX41~PX416)은 제2 데이터 라인들(DL1~DL16)과 연결될 수 있다. 본 실시예에서는 홀수 번째의 화소행들은 제1 데이터 라인들(DL2~DL15)과 연결되고, 짝수 번째의 화소행들은 제2 데이터 라인들(DL1~DL16)과 연결된다. 다른 실시예에서는 짝수 번째의 화소행들은 제1 데이터 라인들(DL2~DL15)과 연결되고, 홀수 번째의 화소행들은 제2 데이터 라인들(DL1~DL16)과 연결될 수도 있다.
홀수 번째 화소행들에서 화소들은 주사 라인의 연장 방향을 따라서 적색(예를 들어, 화소(PX12)), 녹색(예를 들어, 화소(PX13)), 청색(예를 들어, 화소(PX16)), 및 녹색(예를 들어, 화소(PX17))이 순차적으로 반복되도록 구성될 수 있다. 주사 라인의 연장 방향은 제1 방향(DR1) 또는 제2 방향(DR2)일 수 있다. 이때, 짝수 번째 화소행들에서 화소들은 주사 라인의 연장 방향을 따라서 청색(예를 들어, 화소(PX21)), 녹색(예를 들어, 화소(PX24)), 적색(예를 들어, 화소(PX25)), 및 녹색(예를 들어, 화소(PX28))이 순차적으로 반복되도록 구성될 수 있다. 전술한 바와 같이 홀수 및 짝수는 서로 바뀔 수 있다.
각각의 데이터 라인에는 동일한 색상의 화소들이 연결될 수 있다. 예를 들어, 데이터 라인(DL1)에는 청색의 화소들(PX21, PX41)이 연결될 수 있다. 데이터 라인(DL2)에는 적색의 화소들(PX12, PX32)이 연결될 수 있다. 데이터 라인(DL3)에는 녹색의 화소들(PX13, PX33)이 연결될 수 있다. 데이터 라인들(DL1~DL16)의 연장 방향은 제3 방향(DR3)일 수 있다. 제3 방향(DR3)은 제1 방향(DR1) 또는 제2 방향(DR2)과 직교할 수 있다.
화소들(PX12~PX416)은 제1 화소들(PX13, PX17, PX111, PX115, PX21, PX25, PX29, PX213, PX33, PX37, PX311, PX315, PX41, PX45, PX49, PX413) 및 제2 화소들(PX12, PX16, PX110, PX114, PX24, PX28, PX212, PX216, PX32, PX36, PX310, PX314, PX44, PX48, PX412, PX416)을 포함할 수 있다. 제1 화소들(PX13~PX413) 각각은 제1 화소들(PX13~PX413) 각각을 기준으로 제1 방향(DR1)에 위치한 데이터 라인에 연결될 수 있다. 제2 화소들(PX12~PX416) 각각은 제2 화소들(PX12~PX416) 각각을 기준으로 제2 방향(DR2)에 위치한 데이터 라인에 연결될 수 있다. 제1 방향(DR1) 및 제2 방향(DR2)은 서로 반대일 수 있다.
화소부(14)의 화소들이 행렬 형태로 배치될 때, 제1 화소들(PX13~PX413) 및 제2 화소들(PX12~PX416)은 행 방향(제1 방향(DR1) 또는 제2 방향(DR2)) 및 열 방향(제3 방향(DR3))에서 서로 교번하여 배치될 수 있다.
도 4를 참조하면, 주사 구동부(13)는 주사 라인들(SL1, SL2, SL3, SL4)에 턴-온 레벨의 주사 신호들을 순차적으로 공급할 수 있다. 주사 라인(SL1)에 턴-온 레벨의 주사 신호가 공급될 때, 데이터 라인(DL2)에는 화소(PX12)에 대한 데이터 전압(DV12)이 공급될 수 있다. 주사 라인(SL2)에 턴-온 레벨의 주사 신호가 공급될 때, 데이터 라인(DL1)에는 화소(PX21)에 대한 데이터 전압(DV21)이 공급될 수 있다. 주사 라인(SL3)에 턴-온 레벨의 주사 신호가 공급될 때, 데이터 라인(DL2)에는 화소(PX32)에 대한 데이터 전압(DV32)이 공급될 수 있다. 주사 라인(SL4)에 턴-온 레벨의 주사 신호가 공급될 때, 데이터 라인(DL1)에는 화소(PX41)에 대한 데이터 전압(DV41)이 공급될 수 있다.
화소부(14)가 고해상도가 됨에 따라, 각 화소에 데이터 전압을 기입할 수 있는 기간이 감소하는 추세이다. 이에 따라, 목표한 데이터 전압이 화소에 충분히 기입되지 못하는 경우가 발생할 수 있다. 예를 들어, 데이터 전압(DV32)이 데이터 전압(DV12)보다 큰 경우를 가정한다. 이러한 경우, 데이터 전압(DV32)과 데이터 전압(DV12)의 차이가 클수록 데이터 전압(DV32)을 크게 줌으로써, 목표한 데이터 전압(DV32)이 화소(PX32)에 기입되도록 보상할 수 있다. 예를 들어, 데이터 전압(DV41)이 데이터 전압(DV21)보다 작은 경우를 가정한다. 이러한 경우, 데이터 전압(DV41)과 데이터 전압(DV21)의 차이가 클수록 데이터 전압(DV41)을 작게 줌으로써, 목표한 데이터 전압(DV41)이 화소(PX41)에 기입되도록 보상할 수 있다. 이러한 보상은 후술하는 계조 변환부(15)가 입력 계조들(GVi)을 출력 계조들(GVo)로 변환함으로써 수행될 수 있다.
도 5는 본 발명의 한 실시예에 따른 계조 변환부를 설명하기 위한 도면이다. 도 6은 본 발명의 한 실시예에 따른 전압 도메인 변환부를 설명하기 위한 도면이다. 도 7 및 도 8은 본 발명의 한 실시예에 따른 보상 계조 산출부를 설명하기 위한 도면이다.
도 5를 참조하면, 본 발명의 한 실시예에 따른 계조 변환부(15a)는 전압 도메인 변환부(151), 메모리(152), 보상 계조 산출부(153), 및 출력 계조 산출부(154)를 포함할 수 있다.
전압 도메인 변환부(151)는 입력 계조들(GVi)을 전압 도메인(voltage domain)의 변환 계조들(VVi)로 변환할 수 있다. 도 6을 참조하면, 가로축이 입력 계조들(GVi)이고 세로축이 변환 계조들(VVi)인 그래프들이 도시된다. 전압 도메인 변환은 색상들(적색, 녹색, 청색) 마다 독립적으로 이루어질 수 있다. 전압 도메인 변환부(151)는 도 6의 그래프들 중 적어도 일부를 매핑 데이터(mapping data)로 포함할 수 있다. 전압 도메인 변환부(151)는 이러한 매핑 데이터를 이용하여 입력 계조들(GVi)을 전압 도메인(voltage domain)의 변환 계조들(VVi)로 변환할 수 있다.
도 6의 그래프들을 참조하면, 입력 계조들(GVi)이 높을수록 변환 계조들(VVi)이 낮을 수 있다. 이러한 경우는 도 2와 같이 화소(PXij)의 구동 트랜지스터인 트랜지스터(T1)가 P 형으로 구성된 경우에 해당할 수 있다. 만약, 화소(PXij)의 구동 트랜지스터가 N 형으로 구성된 경우, 입력 계조들(GVi)이 높을수록 변환 계조들(VVi)이 높을 수도 있다. 도 6의 그래프들의 기울기는 표시 장치(10)에 적용된 감마 곡선의 감마 값에 기초할 수 있다.
메모리(152)는 이전 화소행에 해당하는 이전 변환 계조들(VVpre)을 출력할 수 있다. 화소부(14)의 구조가 도 3과 같은 경우, 메모리(152)는 2 개 이전 화소행에 해당하는 이전 변환 계조들(VVpre)을 출력할 수 있다. 다만, 화소부(14)의 구조가 후술하는 도 17과 같은 경우, 메모리(152)는 1 개 이전 화소행에 해당하는 이전 변환 계조들(VVpre)을 출력할 수 있다.
보상 계조 산출부(153)는 변환 계조들(VVi)에 기초하여 보상 계조들(GC)을 산출할 수 있다. 보상 계조 산출부(153)는 변환 계조들(VVi)을 이전 변환 계조들(VVpre)과 비교하여 보상 계조들(GC)을 산출할 수 있다.
도 7을 참조하면, 보상 계조 산출부(153)는 이전 변환 계조들(VVpre) 중 일부 및 변환 계조들(VVi) 중 일부에 대응하는 보상 값들(f00, f01, f10, f11, ...)을 기록한 룩업 테이블(LUT)을 포함할 수 있다. 룩업 테이블(LUT)은 색상 별로 구비될 수 있다. 예를 들어, 보상 계조 산출부(153)는 적색 화소들에 대한 룩업 테이블, 녹색 화소들에 대한 룩업 테이블, 및 청색 화소들에 대한 룩업 테이블을 포함할 수 있다.
보상 계조 산출부(153)는, 화소들 중 일부에 대해서, 보상 값들(f00, f01, f10, f11, ...)을 보간하여 제1 보간 값들(first interpolated values)을 산출할 수 있다. 이때, 이중 선형 보간법(bi-linear interpolation)이 사용될 수 있다.
예를 들어, 룩업 테이블(LUT)이 이전 변환 계조들(VVpre) 중 0, 8, 40, 168, 255 계조들 및 변환 계조들(VVi) 중 0, 8, 40, 168, 255 계조들에 대응하는 보상 값들(f00, f01, f10, f11, ...)을 포함한다고 가정한다. 이때, 이전 변환 계조(VVpre)가 2 계조이고, 변환 계조(VVi)가 208 계조인 경우를 가정한다. 이때, p는 2-0=2이고, q는 208-168=40일 수 있다. 이때, 목표하는 제1 보간 값(fpq)를 구하기 위한 예시적인 수학식 1은 다음과 같다.
[수학식 1]
Figure pat00001
여기서, LPP는 p의 최대 값이고, LPQ는 q의 최대 값일 수 있다. 본 예시에서, LPP는 8-0=8이고, LPQ는 255-168=87일 수 있다.
도 8을 참조하면, 화소부(14)의 경계 영역들(R1, R2, R3, R4)의 대표 화소들에 대해서 제1 보간 값들(f1, f2, f3, f4, ...)이 산출되었음을 가정한다. 각각의 경계 영역들(R1, R2, R3, R4)에 속하는 다른 화소들은 대표 화소들에 대해 산출된 제1 보간 값들(f1, f2, f3, f4, ...)을 동일하게 적용받을 수 있다. 이는 충분히 좁은 영역에서의 계조들은 실질적으로 동일함을 전제 조건으로 할 수 있다. 예시적인 수학식 2는 다음과 같다.
[수학식 2]
Figure pat00002
이때, x 및 y는 각각 제2 방향(DR2) 및 제3 방향(DR3)에서의 계산 대상 화소의 좌표일 수 있다. x1, x2, y1, y2는 경계 영역들(R1, R2, R3, R4)과 중간 영역들(R5, R6, R7, R8, R9)의 경계 좌표를 구성할 수 있다. fpq(R1)은 경계 영역(R1)의 대표 화소의 제1 보간 값이고, fpq(R2)은 경계 영역(R2)의 대표 화소의 제1 보간 값이고, fpq(R3)은 경계 영역(R3)의 대표 화소의 제1 보간 값이고, fpq(R4)은 경계 영역(R4)의 대표 화소의 제1 보간 값이다. fxy는 계산 대상 화소의 제2 보간 값이다.
보상 계조 산출부(153)는, 화소들 중 다른 일부에 대해서, 제1 보간 값들(f1, f2, f3, f4, ...)을 보간하여 제2 보간 값들을 산출할 수 있다. 예를 들어, 보상 계조 산출부(153)는 경계 영역들(R1, R2, R3, R4)의 중간 영역들(R5, R6, R7, R8, R9)에 대해서, 제1 보간 값들(f1, f2, f3, f4, ...)을 보간하여 제2 보간 값들을 산출할 수 있다. 예시적인 수학식 3은 다음과 같다.
[수학식 3]
Figure pat00003
보상 계조 산출부(153)는 제2 보간 값들(fxy)을 계조 도메인으로 변환하여 보상 계조들(GC)로써 제공할 수 있다.
출력 계조 산출부(154)는 입력 계조들(GVi)에 보상 계조들(GC)을 합산하여 출력 계조들(GVo)을 제공할 수 있다.
본 실시예에 따른 계조 변환부(15a)는 전압 도메인에서 선형적인 보상 값들(f00, f01, f10, f11, ...)을 산출함으로써 계조/위치에 대한 선형 인터폴레이션이 이용가능하고, 이에 따라 메모리 및 연산 비용이 감소한다는 장점이 있다.
도 9 및 도 10은 본 발명의 한 실시예에 따른 최대 휘도 게인 제공부를 설명하기 위한 도면이다.
도 9를 참조하면, 본 발명의 한 실시예에 따른 계조 변환부(15b)는, 계조 변환부(15a)를 기준으로, 최대 휘도 게인 제공부(155)를 더 포함할 수 있다.
최대 휘도 게인 제공부(155)는 최대 휘도(DBV)에 기초하여 최대 휘도 게인(Gdbv)을 제공할 수 있다. 최대 휘도(DBV)는 최대 계조(예를 들어, 255 계조)에 대응하여 화소들에서 방출되는 광의 휘도 값일 수 있다. 예를 들어, 하나의 도트(dot)를 이루는 적색 화소가 255 계조에 대응하여 발광하고, 녹색 화소가 255 계조에 대응하여 발광하고, 청색 화소가 255 계조에 대응하여 발광함으로써 생성되는 백색 광의 휘도 값일 수 있다. 휘도 값의 단위는 니트(Nits)일 수 있다. 따라서, 화소부(14)는 부분적으로(공간적으로) 어둡거나 밝은 영상 프레임을 표시할 수 있지만, 영상 프레임의 최대 밝기는 최대 휘도(DBV)로 제한되게 된다. 이러한 최대 휘도(DBV)는 표시 장치(10)에 대한 사용자의 조작에 의해 수동적으로 설정되거나, 조도 센서 등과 연계된 알고리즘에 의해 자동적으로 설정될 수 있다. 계조가 동일하더라도, 최대 휘도(DBV)가 달라지면, 계조에 대응하는 데이터 전압이 달라지게 되므로, 화소의 발광 휘도도 달라지게 된다.
최대 휘도 게인 제공부(155)는 최대 휘도(DBV)가 증가할수록 최대 휘도 게인(Gdbv)을 증가시킬 수 있다. 도 10을 참조하면, 예를 들어, 최대 휘도(DBV)가 4 Nits일 때 최대 휘도 게인(Gdbv)은 0으로 설정될 수 있다. 예를 들어, 최대 휘도(DBV)가 1200 Nits일 때 최대 휘도 게인(Gdbv)은 1.99로 설정될 수 있다.
보상 계조 산출부(153)는 최대 휘도 게인(Gdbv)에 따라 제2 보간 값들(fxy)을 스케일링(scaling)할 수 있다. 예를 들어, 보상 계조 산출부(153)는 제2 보간 값들(fxy)에 최대 휘도 게인(Gdbv)을 곱함으로써 스케일링할 수 있다. 보상 계조 산출부(153)는 스케일링된 제2 보간 값들(fxy)을 계조 도메인으로 변환하여 보상 계조들(GC)로써 제공할 수 있다.
본 실시예에 의하면, 전압 도메인에서 선형적인 보상 값들을 산출함으로써, 최대 휘도 게인(Gdbv)의 단순 곱 연산이 가능해지므로, 메모리 및 연산 비용이 감소한다는 장점이 있다.
도 11 및 도 12는 본 발명의 한 실시예에 따른 연결 게인 제공부를 설명하기 위한 도면이다.
도 11을 참조하면, 본 발명의 한 실시예에 따른 계조 변환부(15c)는, 계조 변환부(15a)를 기준으로, 연결 게인 제공부(156)를 더 포함할 수 있다.
연결 게인 제공부(156)는 제1 화소들에 대한 연결 게인들(Gr, Gg, Gb)을 제공할 수 있다. 한 실시예에서, 연결 게인 제공부(156)는 제2 화소들에 대한 연결 게인들을 제공하지 않을 수 있다. 다른 실시예에서, 연결 게인 제공부(156)는 제2 화소들에 대한 연결 게인들을 제공하되, 제1 화소들에 대한 연결 게인들(Gr, Gg, Gb)과 다른 연결 게인들을 제공할 수 있다. 연결 게인 제공부(156)는 화소들이 제1 화소들 및 제2 화소들 중 어디에 속하는 지 확인하기 위해서 연결 정보(CNI)를 수신할 수 있다.
도 12를 참조하면, 도 3을 참조하여 설명한 바와 같이, 제1 화소들(PX13, PX17, PX111, PX115, PX21, PX25, PX29, PX213, PX33, PX37, PX311, PX315, PX41, PX45, PX49, PX413) 각각은 제1 화소들(PX13~PX413) 각각을 기준으로 제1 방향(DR1)에 위치한 데이터 라인에 연결될 수 있다. 제2 화소들(PX12, PX16, PX110, PX114, PX24, PX28, PX212, PX216, PX32, PX36, PX310, PX314, PX44, PX48, PX412, PX416) 각각은 제2 화소들(PX12~PX416) 각각을 기준으로 제2 방향(DR2)에 위치한 데이터 라인에 연결될 수 있다. 제1 방향(DR1) 및 제2 방향(DR2)은 서로 반대일 수 있다.
화소부(14)의 모든 화소들은 동일한 화소 회로 구조를 가질 수 있다. 이때, 화소 회로의 좌측(예를 들어, 제1 방향(DR1))에 연결되는 데이터 라인과 화소 회로의 우측(예를 들어, 제2 방향(DR2)에 연결되는 데이터 라인은 기생 커패시턴스가 서로 다를 수 있다. 따라서, 본 실시예에 따르면, 데이터 라인들 및 화소들의 배치에 따른 연결 게인들(Gr, Gg, Gb)을 제공함으로써, 화소부(14)의 구조에 대한 보상을 수행할 수 있다. 연결 게인들(Gr, Gg, Gb)은 각 색상마다 달리 제공될 수 있다.
보상 계조 산출부(153)는 연결 게인들(Gr, Gg, Gb)에 따라 제2 보간 값들(fxy)을 스케일링할 수 있다. 예를 들어, 보상 계조 산출부(153)는 제2 보간 값들(fxy)에 연결 게인들(Gr, Gg, Gb)을 곱함으로써 스케일링할 수 있다. 보상 계조 산출부(153)는 스케일링된 제2 보간 값들(fxy)을 계조 도메인으로 변환하여 보상 계조들(GC)로써 제공할 수 있다.
본 실시예에 의하면, 전압 도메인에서 선형적인 보상 값들을 산출함으로써, 연결 게인들(Gr, Gg, Gb)의 단순 곱 연산이 가능해지므로, 메모리 및 연산 비용이 감소한다는 장점이 있다.
도 13 및 도 14는 본 발명의 한 실시예에 따른 영역 게인 제공부를 설명하기 위한 도면이다.
도 13을 참조하면, 본 발명의 한 실시예에 따른 계조 변환부(15d)는, 계조 변환부(15a)를 기준으로, 영역 게인 제공부(157)을 더 포함할 수 있다.
도 13을 참조하면, 영역 게인 제공부(157)는 화소들의 위치에 기초하여 영역 게인들(GAR1, GAR2)을 제공할 수 있다.
도 14를 참조하면, 화소부(14)는 제1 영역(AR1), 제2 영역(AR2), 및 제3 영역(AR3)으로 구획될 수 있다. 제4 영역(AR4)은 제3 영역(AR3)과 동일하게 취급될 수 있으므로, 중복된 설명은 생략한다. 또한, 화소부(14)의 도 3의 영역 또한 제3 영역(AR3)과 동일하게 취급될 수 있으므로, 중복된 설명은 생략한다.
제1 영역(AR1)은 화소들을 제1 밀도로 포함할 수 있다. 제2 영역(AR2) 및 제3 영역(AR3)은 화소들을 제1 밀도보다 높은 제2 밀도로 포함할 수 있다. 즉, 제2 영역(AR2) 및 제3 영역(AR3)의 단위 영역 당 화소들의 개수는 제1 영역(AR1)의 단위 영역 당 화소들의 개수보다 클 수 있다.
예를 들어, 제1 영역(AR1)은 화소들이 존재하지 않아 빛이 투과할 수 있는 투과 영역들을 포함할 수 있다. 이러한 투과 영역들에 평면 상 중첩되도록 이미지 센서, 카메라, 지문 센서, 근접 센서 등의 다양한 장치들이 배치될 수 있다.
제2 영역(AR2)의 화소들(PX421, PX424, PX425, PX428)은 제1 영역(AR1)의 화소들(PX221, PX224, PX225, PX228)과 동일한 데이터 라인들(DL21, DL24, DL25, DL28)에 연결될 수 있다. 따라서, 제2 영역(AR2)의 데이터 라인들(DL21~DL28) 각각에 연결된 화소들의 개수는 제3 영역(AR3)의 데이터 라인들(DL17~DL20) 각각에 연결된 화소들의 개수보다 작다. 따라서, 제2 영역(AR2)의 데이터 라인들(DL21~DL28) 각각의 로드(load)는 제3 영역(AR3)의 데이터 라인들(DL17~DL20) 각각의 로드보다 작다. 이에 따라, 제2 영역(AR2)의 화소들(PX421~PX428)에 대해서 로드 보상을 위한 제2 영역 게인(GAR2)이 필요하다.
동일한 이유로, 제1 영역(AR1)의 데이터 라인들(DL21~DL28) 각각의 로드는 제3 영역(AR3)의 데이터 라인들(DL17~DL20) 각각의 로드보다 작고, 제1 영역(AR1)의 로드 보상을 위한 제1 영역 게인(GAR1)이 필요하다. 다만, 제1 영역(AR1)은 화소의 밀도가 상대적으로 작으므로, 동일한 데이터 전압에 대해서 더 낮은 휘도로 발광하게 된다. 이에 따라, 제1 영역 게인(GAR1)에는 휘도 보상이 더 적용되어야 하므로, 제1 영역 게인(GAR1)과 제2 영역 게인(GAR2)은 서로 다를 수 있다. 다만, 영역 게인들(GAR1, GAR2)의 상대적인 크기 등은 표시 장치(10)의 규격(specification)에 따라서 달라질 수 있다. 제3 영역(AR3)은 별도의 영역 게인이 불필요할 수 있다.
따라서, 영역 게인 제공부(157)는 제1 영역(AR1)의 화소들에 대해서 제1 영역 게인(GAR1)을 제공하고, 제2 영역(AR2)의 화소들에 대해서 제2 영역 게인(GAR2)을 제공할 수 있다. 영역 게인 제공부(157)는 화소들이 제1 영역(AR1), 제2 영역(AR2), 및 제3 영역(AR3) 중 어디에 속하는 지 확인하기 위해서 영역 정보(ARI)를 수신할 수 있다.
보상 계조 산출부(153)는 영역 게인들(GAR1, GAR2)에 따라 제2 보간 값들(fxy)을 스케일링할 수 있다. 예를 들어, 보상 계조 산출부(153)는 제2 보간 값들(fxy)에 영역 게인들(GAR1, GAR2)을 곱함으로써 스케일링할 수 있다. 보상 계조 산출부(153)는 스케일링된 제2 보간 값들(fxy)을 계조 도메인으로 변환하여 보상 계조들(GC)로써 제공할 수 있다.
본 실시예에 의하면, 전압 도메인에서 선형적인 보상 값들을 산출함으로써, 영역 게인들(GAR1, GAR2)의 단순 곱 연산이 가능해지므로, 메모리 및 연산 비용이 감소한다는 장점이 있다.
도 15는 본 발명의 다른 실시예에 따른 계조 변환부를 설명하기 위한 도면이다.
도 15를 참조하면, 본 발명의 한 실시예에 따른 계조 변환부(15e)는, 계조 변환부(15a)를 기준으로, 최대 휘도 게인 제공부(155), 연결 게인 제공부(156), 및 영역 게인 제공부(157)를 더 포함할 수 있다. 최대 휘도 게인 제공부(155), 연결 게인 제공부(156), 및 영역 게인 제공부(157)에 대해서는 전술한 바와 같으므로, 중복된 설명은 생략한다.
보상 계조 산출부(153)는 최대 휘도 게인(Gdbv), 연결 게인들(Gr, Gg, Gb), 및 영역 게인들(GAR1, GAR2)에 따라 제2 보간 값들(fxy)을 스케일링할 수 있다. 예를 들어, 보상 계조 산출부(153)는 제2 보간 값들(fxy)에 최대 휘도 게인(Gdbv), 연결 게인들(Gr, Gg, Gb), 및 영역 게인들(GAR1, GAR2)을 곱함으로써 스케일링할 수 있다. 보상 계조 산출부(153)는 스케일링된 제2 보간 값들(fxy)을 계조 도메인으로 변환하여 보상 계조들(GC)로써 제공할 수 있다.
본 실시예에 의하면, 전압 도메인에서 선형적인 보상 값들을 산출함으로써, 최대 휘도 게인(Gdbv), 연결 게인들(Gr, Gg, Gb), 및 영역 게인들(GAR1, GAR2)의 단순 곱 연산이 가능해지므로, 메모리 및 연산 비용이 감소한다는 장점이 있다.
도 16은 본 발명의 다른 실시예에 따른 표시 장치를 설명하기 위한 도면이다. 도 17은 본 발명의 다른 실시예에 따른 화소부를 설명하기 위한 도면이다.
도 16을 참조하면, 본 발명의 다른 실시예에 따른 표시 장치(10')는 데이터 분배부(16)를 포함하지 않는 점에서 표시 장치(10)와 차이가 있다. 또한, 화소부(14')의 구조가 화소부(14)와 차이가 있다.
도 17을 참조하면, 화소들(PX11~PX48) 각각은 화소들(PX11~PX48) 각각을 기준으로 제1 방향(DR1)에 위치한 데이터 라인에 연결된다. 이에 따라, 연결 정보(CNI)가 불필요하므로, 계조 변환부(15)는 연결 게인 제공부(156)를 포함하지 않을 수 있다. 계조 변환부(15)는 최대 휘도 게인 제공부(155) 및 영역 게인 제공부(157)를 실시예에 따라 선택적으로 포함할 수 있다.
전술한 바와 같이, 도 17의 경우, 메모리(152)는 1 개 이전 화소행에 해당하는 이전 변환 계조들(VVpre)을 출력할 수 있다.
지금까지 참조한 도면과 기재된 발명의 상세한 설명은 단지 본 발명의 예시적인 것으로서, 이는 단지 본 발명을 설명하기 위한 목적에서 사용된 것이지 의미 한정이나 특허청구범위에 기재된 본 발명의 범위를 제한하기 위하여 사용된 것은 아니다. 그러므로 본 기술 분야의 통상의 지식을 가진 자라면 이로부터 다양한 변형 및 균등한 타 실시 예가 가능하다는 점을 이해할 것이다. 따라서, 본 발명의 진정한 기술적 보호 범위는 첨부된 특허청구범위의 기술적 사상에 의해 정해져야 할 것이다.
15a: 계조 변환부
151: 전압 도메인 변환부
152: 메모리
153: 보상 계조 산출부
154: 출력 계조 산출부

Claims (20)

  1. 입력 계조들에 보상 계조들을 합산하여 출력 계조들을 제공하는 계조 변환부;
    상기 출력 계조들에 대응하는 데이터 전압들을 제공하는 데이터 구동부; 및
    상기 데이터 전압들을 수신하는 화소들을 포함하는 화소부를 포함하고,
    상기 계조 변환부는:
    상기 입력 계조들을 전압 도메인의 변환 계조들로 변환하는 전압 도메인 변환부; 및
    상기 변환 계조들에 기초하여 상기 보상 계조들을 산출하는 보상 계조 산출부를 포함하는,
    표시 장치.
  2. 제1 항에 있어서,
    상기 계조 변환부는 1 개 이전 화소행에 해당하는 이전 변환 계조들을 출력하는 메모리를 더 포함하는,
    표시 장치.
  3. 제2 항에 있어서,
    상기 화소들 각각은 상기 화소들 각각을 기준으로 제1 방향에 위치한 데이터 라인에 연결된,
    표시 장치.
  4. 제1 항에 있어서,
    상기 계조 변환부는 2 개 이전 화소행에 해당하는 이전 변환 계조들을 출력하는 메모리를 더 포함하는,
    표시 장치.
  5. 제4 항에 있어서,
    상기 화소들은 제1 화소들 및 제2 화소들을 포함하고,
    상기 제1 화소들 각각은 상기 제1 화소들 각각을 기준으로 제1 방향에 위치한 데이터 라인에 연결되고,
    상기 제2 화소들 각각은 상기 제2 화소들 각각을 기준으로 제2 방향에 위치한 데이터 라인에 연결된,
    표시 장치.
  6. 제5 항에 있어서,
    데이터 출력 라인들을 통해서 상기 데이터 구동부와 연결되고, 데이터 라인들을 통해서 상기 화소들과 연결된 데이터 분배부를 더 포함하고,
    상기 데이터 출력 라인들의 개수는 상기 데이터 라인들의 개수보다 작은,
    표시 장치.
  7. 제5 항에 있어서,
    상기 보상 계조 산출부는 상기 이전 변환 계조들 중 일부 및 상기 변환 계조들 중 일부에 대응하는 보상 값들을 기록한 룩업 테이블을 포함하고,
    상기 보상 계조 산출부는, 상기 화소들 중 일부에 대해서, 상기 보상 값을 보간하여 제1 보간 값들(first interpolated values)을 산출하는,
    표시 장치.
  8. 제7 항에 있어서,
    상기 보상 계조 산출부는, 상기 화소들 중 다른 일부에 대해서, 상기 제1 보간 값들을 보간하여 제2 보간 값들을 산출하는,
    표시 장치.
  9. 제8 항에 있어서,
    상기 보상 계조 산출부는 상기 제2 보간 값들을 계조 도메인으로 변환하여 상기 보상 계조들로써 제공하는,
    표시 장치.
  10. 제8 항에 있어서,
    상기 계조 변환부는 최대 휘도에 기초하여 최대 휘도 게인을 제공하는 최대 휘도 게인 제공부를 더 포함하고,
    상기 보상 계조 산출부는 상기 최대 휘도 게인에 따라 상기 제2 보간 값들을 스케일링하고, 스케일링된 제2 보간 값들을 계조 도메인으로 변환하여 상기 보상 계조들로써 제공하는,
    표시 장치.
  11. 제10 항에 있어서,
    상기 최대 휘도 게인 제공부는 상기 최대 휘도가 증가할수록 상기 최대 휘도 게인을 증가시키는,
    표시 장치.
  12. 제8 항에 있어서,
    상기 계조 변환부는 상기 제1 화소들에 대한 연결 게인들을 제공하는 연결 게인 제공부를 더 포함하고,
    상기 보상 계조 산출부는 상기 연결 게인들에 따라 상기 제2 보간 값들을 스케일링하고, 스케일링된 상기 제2 보간 값들을 계조 도메인으로 변환하여 상기 보상 계조들로써 제공하는,
    표시 장치.
  13. 제12 항에 있어서,
    상기 연결 게인 제공부는 상기 제2 화소들에 대한 연결 게인들을 제공하지 않는,
    표시 장치.
  14. 제8 항에 있어서,
    상기 계조 변환부는 상기 화소들의 위치에 기초하여 영역 게인들을 제공하는 영역 게인 제공부를 더 포함하고,
    상기 보상 계조 산출부는 상기 영역 게인들에 따라 상기 제2 보간 값들을 스케일링하고, 스케일링된 상기 제2 보간 값들을 계조 도메인으로 변환하여 상기 보상 계조들로써 제공하는,
    표시 장치.
  15. 제14 항에 있어서,
    상기 화소부는 제1 영역, 제2 영역, 및 제3 영역으로 구획되고,
    상기 제1 영역은 화소들을 제1 밀도로 포함하고,
    상기 제2 영역 및 상기 제3 영역은 화소들을 상기 제1 밀도보다 높은 제2 밀도로 포함하고,
    상기 제2 영역의 화소들은 상기 제1 영역의 화소들과 동일한 데이터 라인들에 연결되고,
    상기 영역 게인 제공부는 상기 제1 영역의 화소들에 대해서 제1 영역 게인을 제공하고, 상기 제2 영역의 화소들에 대해서 제2 영역 게인을 제공하는,
    표시 장치.
  16. 입력 계조들을 전압 도메인의 변환 계조들로 변환하는 단계;
    상기 변환 계조들에 기초하여 보상 계조들을 산출하는 단계;
    상기 입력 계조들에 상기 보상 계조들을 합산하여 출력 계조들을 제공하는 단계; 및
    상기 출력 계조들에 대응하는 데이터 전압들을 화소들로 제공하는 단계를 포함하는,
    표시 장치의 구동 방법.
  17. 제16 항에 있어서,
    2 개 이전 화소행에 해당하는 이전 변환 계조들 중 일부 및 상기 변환 계조들 중 일부에 대응하는 보상 값들을 기록한 룩업 테이블을 참조하고, 상기 화소들 중 일부에 대해서, 상기 보상 값들을 보간하여 제1 보간 값들을 산출하는 단계를 더 포함하는,
    표시 장치의 구동 방법.
  18. 제17 항에 있어서,
    상기 화소들 중 다른 일부에 대해서, 상기 제1 보간 값들을 보간하여 제2 보간 값들을 산출하는 단계를 더 포함하는,
    표시 장치의 구동 방법.
  19. 제18 항에 있어서,
    상기 제2 보간 값들을 상기 보상 계조들로 제공하는 단계를 더 포함하는,
    표시 장치의 구동 방법.
  20. 제18 항에 있어서,
    최대 휘도가 증가할수록 증가하는 최대 휘도 게인에 따라 상기 제2 보간 값들을 스케일링하고, 스케일링된 상기 제2 보간 값들을 계조 도메인으로 변환하여 상기 보상 계조들로써 제공하는 단계를 더 포함하는,
    표시 장치의 구동 방법.
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