KR20200055632A - Wafer stage, semiconductor manufacturing device, and wafer stage manufacturing method - Google Patents
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Abstract
Description
본 발명은 반도체 웨이퍼를 탑재하는 웨이퍼 스테이지, 및 이것을 이용한 반도체 제조 장치, 웨이퍼 스테이지의 제조 방법에 관한 것이다.The present invention relates to a wafer stage on which a semiconductor wafer is mounted, a semiconductor manufacturing apparatus using the same, and a method for manufacturing a wafer stage.
예를 들면, 반도체 제조 장치를 이용하여 반도체 웨이퍼에 가공을 실행하는 반도체 웨이퍼 제조 공정에 있어서, 반도체 소자의 미세화나 애스펙트비의 증가에 의해서, 예를 들면 에칭을 실행할 때의 온도 의존성이 커지고 있다. 즉, 반도체 웨이퍼의 온도 제어의 마진이 좁아지고, 극히 고정밀도의 온도 제어가 필요하게 되고 있다.For example, in a semiconductor wafer manufacturing process in which processing is performed on a semiconductor wafer using a semiconductor manufacturing apparatus, the temperature dependence when performing etching, for example, is increased by miniaturization of semiconductor elements or an increase in aspect ratio. That is, the margin of temperature control of the semiconductor wafer is narrowed, and extremely high-precision temperature control is required.
종래의 반도체 제조 장치, 예를 들면 에칭 장치에서는 에칭 공정에 있어서 반도체 웨이퍼를 지지하는 정전 척을 갖는 웨이퍼 스테이지는 반도체 웨이퍼의 온도 제어를 실행하기 위해, 가열, 냉각을 실행하는 가열 냉각 수단이 마련되어 있다. 종래, 이러한 웨이퍼 스테이지의 가열 냉각 수단으로서, 가열에는 저항 가열 방식의 가열기, 냉각에는 냉매 유로에 냉매를 흘리는 열교환기를 각각 이용해서 온도 제어를 실행하고 있었다(예를 들면, 특허문헌 1 참조).In a conventional semiconductor manufacturing apparatus, for example, an etching apparatus, a wafer stage having an electrostatic chuck for supporting a semiconductor wafer in an etching process is provided with heating and cooling means for heating and cooling in order to perform temperature control of the semiconductor wafer. . Conventionally, as a heating and cooling means for such a wafer stage, temperature control was performed using a heater of a resistance heating method for heating and a heat exchanger that flows a refrigerant through a refrigerant passage for cooling (see, for example, Patent Document 1).
그러나, 이러한 저항 가열 방식의 가열 및 열 교환 방식의 냉각은 반도체 웨이퍼 전체를 일률적으로 가열, 냉각하는 것은 용이하지만, 반도체 웨이퍼의 임의의 영역만을 가열, 냉각하는 것은 곤란하다. 예를 들면, 반도체 웨이퍼에 플라즈마 에칭을 실행할 때에는 플라즈마도 가스의 흐름도 균일하지는 않기 때문에, 반도체 웨이퍼의 면내의 온도가 불균일하게 되기 쉽지만, 저항 가열 방식의 가열 및 열 교환 방식의 냉각에서는 웨이퍼 스테이지를 세분화된 영역마다 온도 제어를 실행하여, 반도체 웨이퍼의 면내 전체를 균일한 온도로 유지하는 것은 곤란하였다. 또, 반도체 웨이퍼의 온도 변화에 추종한 응답 속도도 느리고, 고정밀도로 온도 제어를 실행하는 것이 곤란하였다.However, the heating of the resistance heating method and the cooling of the heat exchange method are easy to uniformly heat and cool the entire semiconductor wafer, but it is difficult to heat and cool only an arbitrary region of the semiconductor wafer. For example, when plasma etching is performed on a semiconductor wafer, since the plasma and gas flow are not uniform, the temperature inside the semiconductor wafer is likely to be non-uniform, but the wafer stage is subdivided in resistance heating and heat exchange cooling. It was difficult to perform temperature control for each area to keep the entire in-plane semiconductor wafer at a uniform temperature. Moreover, the response speed following the temperature change of a semiconductor wafer was also slow, and it was difficult to perform temperature control with high precision.
이 때문에, 예를 들면, 웨이퍼 스테이지의 가열 냉각 수단으로서, 정전 척의 하부에 다수의 펠티에 소자를 배열하고, 개개의 펠티에 소자(열전 소자)를 독립적으로 동작시키는 것에 의해서, 웨이퍼 스테이지를 세분화된 영역마다 온도 제어하는 방법도 알려져 있다(예를 들면, 특허문헌 2 참조).For this reason, for example, as a means for heating and cooling the wafer stage, a plurality of Peltier elements are arranged under the electrostatic chuck, and individual Peltier elements (thermoelectric elements) are operated independently, whereby the wafer stage is divided into subdivided regions. A method of controlling the temperature is also known (for example, see Patent Document 2).
이러한 웨이퍼 스테이지를 반도체 제조 장치에 설치할 때에는 일반적으로, 가열 냉각 수단의 상부에 형성되는 상부 지지판을 경계로 하여, 반도체 웨이퍼를 탑재하는 정전 척측을 진공, 다른쪽의 측을 대기압으로 하기 위해, 상부 지지판이 적어도 1기압 정도의 압력차에 견딜 수 있는 강도를 가질 필요가 있다. 또, 온도 응답성을 높이기 위해, 상부 지지판 및 정전 척의 열 용량을 작게 할 필요가 있다. 또, 정전 척에 의한 반도체 웨이퍼의 흡착을 확실히 실행하기 위해, 상부 지지판과 정전 척의 열 팽창율이 다른 것에 기인한 만곡의 발생을 저감할 필요도 있다.When such a wafer stage is installed in a semiconductor manufacturing apparatus, an upper support plate is generally used in order to vacuum the electrostatic chuck side on which the semiconductor wafer is mounted, and the other side to atmospheric pressure, with the upper support plate formed on the upper portion of the heating and cooling means as a boundary. It is necessary to have a strength capable of withstanding the pressure difference of at least about 1 atmosphere. In addition, it is necessary to reduce the heat capacity of the upper support plate and the electrostatic chuck in order to increase the temperature responsiveness. In addition, in order to reliably perform the adsorption of the semiconductor wafer by the electrostatic chuck, it is also necessary to reduce the occurrence of curvature caused by different thermal expansion coefficients of the upper support plate and the electrostatic chuck.
그러나, 종래의 웨이퍼 스테이지는 진공 환경과 대기압 환경의 압력차에 견딜 수 있는 충분한 강도와, 열 용량의 최소화에 의한 온도 응답성의 향상과, 열 팽창에 의한 정전 척의 만곡 방지를 모두 만족시키는 것이 곤란하다는 과제가 있었다.However, it is difficult for the conventional wafer stage to satisfy both the strength sufficient to withstand the pressure difference between the vacuum environment and the atmospheric pressure environment, the improvement of the temperature response by minimizing the heat capacity, and the prevention of the curvature of the electrostatic chuck due to thermal expansion. There was a task.
본 발명은 전술한 사정을 감안해서 이루어진 것으로서, 압력 차에 견딜 수 있는 충분한 강도와, 온도 응답성의 향상과, 열 팽창에 의한 정전 척의 만곡 방지를 병립할 수 있는 웨이퍼 스테이지, 및 이것을 구비한 반도체 제조 장치, 웨이퍼 스테이지의 제조 방법을 제공하는 것을 목적으로 한다.The present invention has been made in view of the above-described circumstances, and a wafer stage capable of combining sufficient strength to withstand a pressure difference, improved temperature responsiveness, and prevention of curvature of an electrostatic chuck due to thermal expansion, and semiconductor manufacturing having the same It is an object to provide a method for manufacturing an apparatus and a wafer stage.
상기의 과제를 해결하기 위해, 본 발명의 웨이퍼 스테이지는 반도체 웨이퍼를 지지하는 웨이퍼 스테이지로서, 상기 반도체 웨이퍼가 일면에 탑재되는 정전 척판과, 상기 정전 척판의 타면에 접합된 상부 지지판과, 상기 상부 지지판에 중첩해서 배치된 하부 지지판과, 상기 상부 지지판 및 상기 하부 지지판의 사이에 배치된 가열 냉각 수단을 적어도 갖고, 상기 정전 척판은 세라믹스를 포함하는 재료로 이루어지고, 상기 상부 지지판은 알루미늄 또는 알루미늄 합금과 상기 세라믹스 또는 카본의 복합 재료로 이루어지고, 상기 정전 척판과 상기 상부 지지판은 상온 고체 접합에 의해서 직접 접합되어 있는 것을 특징으로 한다.In order to solve the above problems, the wafer stage of the present invention is a wafer stage for supporting a semiconductor wafer, wherein the semiconductor wafer is mounted on one surface, an electrostatic chuck plate, an upper support plate bonded to the other surface of the electrostatic chuck plate, and the upper support plate At least a lower support plate disposed in overlap, and has at least a heating and cooling means disposed between the upper support plate and the lower support plate, the electrostatic chuck is made of a material containing ceramics, the upper support plate is made of aluminum or aluminum alloy It is made of a composite material of the ceramics or carbon, characterized in that the electrostatic chuck plate and the upper support plate are directly bonded by normal temperature solid bonding.
본 발명의 1실시형태의 웨이퍼 스테이지에 의하면, 상부 지지판을 알루미늄 또는 알루미늄 합금과 세라믹스 또는 카본의 복합재료로 구성하는 것에 의해서, 예를 들면 대기압 환경과 진공 환경의 압력 차에 견딜 수 있는 충분한 강도를 확보할 수 있다.According to the wafer stage of one embodiment of the present invention, by constructing the upper support plate with a composite material of aluminum or aluminum alloy and ceramics or carbon, for example, sufficient strength to withstand a pressure difference between an atmospheric pressure environment and a vacuum environment is obtained. Can be secured.
그리고, 정전 척판과 상부 지지판을 상온 고체 접합에 의해서 직접 접합하는 것에 의해서, 접착제를 개재시켜 접합한 경우에 비해, 정전 척판과 상부 지지판의 사이의 열전도성을 높이고, 온도 응답성을 향상시킬 수 있다. 또, 직접 접합하는 것에 의해서, 정전 척판과 상부 지지판의 접합 강도가 향상하고, 열 팽창에 의한 정전 척의 만곡을 방지하고, 반도체 웨이퍼를 확실하게 흡착할 수 있다.And, by directly bonding the electrostatic chuck plate and the upper support plate by room temperature solid bonding, the thermal conductivity between the electrostatic chuck plate and the upper support plate can be increased and the temperature response can be improved compared to the case of bonding through an adhesive. . In addition, by directly bonding, the bonding strength between the electrostatic chuck plate and the upper support plate is improved, the curvature of the electrostatic chuck due to thermal expansion can be prevented, and the semiconductor wafer can be reliably adsorbed.
본 발명에서는 상기 세라믹스는 SiC, Al2O3, AlN 중의 적어도 하나를 포함할 수 있다.In the present invention, the ceramics may include at least one of SiC, Al 2 O 3 , AlN.
본 발명에서는 상기 상부 지지판은 기공율이 1% 이하일 수 있다.In the present invention, the upper support plate may have a porosity of 1% or less.
본 발명에서는 상기 상부 지지판은 상기 정전 척판에 대한 열 팽창 계수의 차가 ±5% 이내로 되는 재료에 의해서 형성될 수 있다.In the present invention, the upper support plate may be formed of a material having a difference in coefficient of thermal expansion with respect to the electrostatic chuck plate within ± 5%.
본 발명에서는 상기 가열 냉각 수단은 펠티에 소자일 수 있다.In the present invention, the heating and cooling means may be a Peltier element.
본 발명에서는 상기 펠티에 소자는 복수 형성되고, 각각의 펠티에 소자는 독립적으로 제어될 수 있다.In the present invention, the plurality of Peltier elements are formed, and each Peltier element can be controlled independently.
본 발명에서는 상기 펠티에 소자는 상기 하부 지지판의 일면의 면적의 45% 이상을 차지하도록 배열 형성될 수 있다.In the present invention, the Peltier element may be arranged to occupy 45% or more of the area of one surface of the lower support plate.
본 발명에서는 상기 펠티에 소자는 상기 정전 척판의 일면에 있어서 30℃ 내지 80℃의 가열 속도를 1℃/초 이상, 냉각 속도를 0.6℃/초 이상으로 되는 것을 이용할 수 있다.In the present invention, the Peltier element may be used to have a heating rate of 30 ° C to 80 ° C on one surface of the electrostatic chuck plate at 1 ° C / sec or more and a cooling rate of 0.6 ° C / sec or more.
본 발명에서는 상기 펠티에 소자와 상기 상부 지지판의 사이에는 탄성을 갖는 열전도성 시트가 더 마련될 수 있다.In the present invention, a thermally conductive sheet having elasticity may be further provided between the Peltier element and the upper support plate.
본 발명에서는 상기 열전도성 시트는 열전도율이 1w/mK 이상일 수 있다.In the present invention, the thermally conductive sheet may have a thermal conductivity of 1w / mK or more.
본 발명에서는 상기 열전도성 시트는 하중이 가해지지 않는 상태에서의 두께가 0.3㎜이상, 1.0㎜ 이하의 범위일 수 있다.In the present invention, the thermally conductive sheet may have a thickness of 0.3 mm or more and 1.0 mm or less in a state in which no load is applied.
본 발명에서는 상기 열전도성 시트는 경도가 아스카(Asker) C20 이하일 수 있다.In the present invention, the thermally conductive sheet may have a hardness of Asker C20 or less.
본 발명에서는 상기 하부 지지판의 내부에는 냉매를 흘리기 위한 냉매 유로가 형성될 수 있다.In the present invention, a coolant flow path for flowing coolant may be formed inside the lower support plate.
본 발명에서는 상기 하부 지지판은 영율이 120MPa 이상의 재료에 의해서 형성될 수 있다.In the present invention, the lower support plate may be formed of a material having a Young's modulus of 120 MPa or more.
본 발명에서는 상기 하부 지지판은 Ti 또는 Ti 합금, 카본, Si, SiC, Al2O3, BN, ZrO2 중의 적어도 어느 하나를 포함할 수 있다.In the present invention, the lower support plate may include at least one of Ti or Ti alloy, carbon, Si, SiC, Al 2 O 3 , BN, and ZrO 2 .
본 발명에서는 상기 상부 지지판의 상기 가열 냉각 수단에 대향하는 타면으로부터, 상기 정전 척판의 일면까지의 열용량의 합계값은 단위면적당 3.0J/K 이하일 수 있다.In the present invention, the total value of the heat capacity from the other surface of the upper support plate facing the heating and cooling means to one surface of the electrostatic chuck plate may be 3.0 J / K or less per unit area.
본 발명에서는 상기 상부 지지판과 상기 하부 지지판은 나사에 의해서 체결될 수 있다.In the present invention, the upper support plate and the lower support plate can be fastened by screws.
본 발명에서는 상기 나사의 주위에는 상기 상부 지지판과 상기 하부 지지판의 간격을 일정하게 유지하는 스페이서가 더 형성될 수 있다.In the present invention, a spacer that maintains a constant distance between the upper support plate and the lower support plate may be further formed around the screw.
본 발명에서는 상기 나사에는 풀어짐 방지 부재가 더 형성될 수 있다.In the present invention, the screw may be further provided with an anti-loosening member.
본 발명의 반도체 제조 장치는 상기 각 항에 기재된 웨이퍼 스테이지와, 상기 반도체 웨이퍼를 가공하는 가공 수단을 구비한 것을 특징으로 한다.The semiconductor manufacturing apparatus of the present invention is characterized by comprising the wafer stage according to each of the above paragraphs and processing means for processing the semiconductor wafer.
본 발명의 웨이퍼 스테이지의 제조 방법은 상기 각 항에 기재된 웨이퍼 스테이지의 제조 방법으로서, 상기 정전 척판과 상기 상부 지지판의 사이에 중간막을 배치하여, 상온 고체 접합에 의해서 직접 접합하는 공정을 갖는 것을 특징으로 한다.The manufacturing method of the wafer stage of the present invention is a manufacturing method of the wafer stage according to each of the above items, characterized in that it has a step of arranging an intermediate film between the electrostatic chuck plate and the upper support plate, and directly bonding them by normal temperature solid bonding. do.
본 발명에서는 상기 중간막은 Al, Ti, Ni, Au, Ag, Cu, In, Sn, Si, SiO2 중의 적어도 1종류를 포함할 수 있다.In the present invention, the interlayer film may include at least one of Al, Ti, Ni, Au, Ag, Cu, In, Sn, Si, and SiO 2 .
본 발명에서는 상기 중간막은 적어도 2층 이상일 수 있다.In the present invention, the interlayer may be at least two or more layers.
본 발명에서는 상기 상부 지지판은 알루미늄 또는 알루미늄 합금과 상기 세라믹스 또는 카본을 가압 함침법 또는 진공 함침법에 의해서 일체화시켜 형성할 수도 있다.In the present invention, the upper support plate may be formed by integrating aluminum or an aluminum alloy with the ceramics or carbon by a pressure impregnation method or a vacuum impregnation method.
본 발명에 따르면, 압력 차에 견딜 수 있는 충분한 강도와, 온도 응답성의 향상과, 열 팽창에 의한 정전 척의 만곡 방지를 병립할 수 있는 웨이퍼 스테이지, 및 이것을 구비한 반도체 제조 장치, 웨이퍼 스테이지의 제조 방법을 제공하는 것이 가능하게 된다.Advantageous Effects of Invention According to the present invention, a wafer stage capable of combining sufficient strength to withstand a pressure difference, an improvement in temperature responsiveness, and prevention of curvature of an electrostatic chuck due to thermal expansion, and a semiconductor manufacturing apparatus and a method for manufacturing a wafer stage having the same It becomes possible to provide.
도 1은 본 발명의 1실시 형태의 웨이퍼 스테이지를 나타내는 단면도이다.
도 2는 본 발명의 1실시 형태의 웨이퍼 스테이지를 나타내는 분해 사시도이다.
도 3은 본 발명의 실시예의 결과를 나타내는 그래프이다.
도 4는 본 발명의 실시예의 결과를 나타내는 그래프이다.1 is a cross-sectional view showing a wafer stage according to an embodiment of the present invention.
2 is an exploded perspective view showing a wafer stage according to one embodiment of the present invention.
3 is a graph showing the results of an embodiment of the present invention.
4 is a graph showing the results of Examples of the present invention.
이하, 도면을 참조하여, 본 발명의 1실시형태의 웨이퍼 스테이지, 및 이것을 구비한 반도체 제조 장치, 웨이퍼 스테이지의 제조 방법에 대해 설명한다. 또한, 이하에 나타내는 실시형태는 발명의 취지를 더욱 잘 이해시키기 위해 구체적으로 설명하는 것이며, 특히 지정이 없는 한, 본 발명을 한정하는 것은 아니다. 또, 이하의 설명에서 이용하는 도면은 본 발명의 특징을 알기 쉽게 하기 위해, 편의상, 주요부로 되는 부분을 확대해서 나타내고 있는 경우가 있으며, 각 구성요소의 치수 비율 등이 실제와 동일하다고는 할 수 없다.Hereinafter, a wafer stage of one embodiment of the present invention, a semiconductor manufacturing apparatus provided with the same, and a method of manufacturing a wafer stage will be described with reference to the drawings. In addition, the embodiment shown below is specifically demonstrated in order to understand the gist of the invention better, and unless otherwise specified, this invention is not limited. In addition, the drawings used in the following description may, for convenience, be enlarged to show a portion that becomes a main part for convenience of understanding, and the dimensional ratio of each component may not be the same as actual. .
도 1은 본 발명의 1실시형태의 웨이퍼 스테이지를 나타내는 단면도이다. 또, 도 2는 본 발명의 1실시형태의 웨이퍼 스테이지를 나타내는 분해 사시도이다. 1 is a cross-sectional view showing a wafer stage according to an embodiment of the present invention. 2 is an exploded perspective view showing a wafer stage according to one embodiment of the present invention.
본 실시형태의 웨이퍼 스테이지(10)는 위부터 적층된 순으로, 정전 척판(11), 상부 지지판(12), 가열 냉각 수단의 일예인 펠티에 소자(13), 및 하부 지지판(14)을 구비하고 있다. 또, 각각의 펠티에 소자(13)와 상부 지지판(12)의 사이에는 또한 열전도성 시트(15)가 배치되어 있는 것이 바람직하다.The
정전 척판(11)은 반도체 장치에 설치된 웨이퍼 스테이지(10)의 사용시에 있어서, 일면(11a)에 반도체 웨이퍼 W, 예를 들면 실리콘 웨이퍼가 탑재된다. 정전 척판(11)은 세라믹스를 포함하는 재료, 예를 들면 SiC, Al2O3(알루미나), AlN 중의 적어도 하나를 포함하는 재료로 구성되어 있다.In the use of the
본 실시형태에서는 정전 척판(11)은 알루미나와 SiC의 복합재료로 구성되어 있다. 정전 척판(11)은 JR(존슨 라벡)력형 정전 척, 또는 쿨롱력형 정전 척의 어느 것이어도 좋다. 정전 척판(11)의 두께 방향의 내부에는 정전 흡착력을 발생시키는 내부 전극(도시 생략)이 형성되어 있고, 이 내부 전극에 대해, JR력형 정전 척에 있어서는 ±100~500V 정도, 쿨롱력형 정전 척에 있어서는 ±1000~8000V 정도의 전압을 인가한다.In this embodiment, the
또, 정전 척판(11)에는 열전도성 가스 유로(21)가 형성되어 있다. 이 열전도성 가스 유로(21)는 정전 척판(11)의 일면(11a)에 열전도성 가스, 예를 들면 열전도율이 높은 헬륨(0.1442W/mk(0℃))을 공급하는 것에 의해서, 정전 척판(11)의 일면(11a)에 탑재된 반도체 웨이퍼 W와 정전 척판(11)의 일면(11a)의 사이에서, 펠티에 소자(13)로부터의 열을 효율적으로 전열시킬 수 있다.In addition, a heat conductive
상부 지지판(12)은 웨이퍼 스테이지(10)가 반도체 장치에 설치되었을 때에, 반도체 장치의 진공 챔버내의 진공 환경과, 진공 챔버외의 대기압 환경의 경계 부분에 마련되고, 일면(12a)측이 진공 환경, 타면(12b)측이 대기압 환경으로 된다. 이 때문에, 상부 지지판(12)은 적어도 1기압 정도 압력차에 대한 내압성을 갖는 재료 및 두께를 갖는다.The
상부 지지판(12)은 알루미늄(Al) 또는 알루미늄 합금과, 세라믹스 또는 카본으로 이루어지는 복합재료로 구성되어 있다. 세라믹스로서는 예를 들면, SiC, Al2O3(알루미나), AlN 중의 적어도 하나를 포함하는 재료를 들 수 있다.The
상부 지지판(12)은 정전 척판(11)에 대해, 열 팽창율이 ±5 이내가 되는 바와 같은 조성이 선택된다. 본 실시형태에서는 상부 지지판(12)은 Al(29%)-SiC(71%)의 복합재(MMC)로 구성되어 있다. 이러한 조성의 MMC는 Al의 열전도율과 전기 저항을 거의 유지하면서, 정전 척판(11)의 구성 재료, 예를 들면 알루미나와 SiC의 복합재료의 열 팽창 계수에 근사한 값으로 되어 있다. 따라서, 서로 접합된 상부 지지판(12)과 정전 척판(11)의 사이에서 열 팽창 차에 의한 만곡이나 박리를 방지할 수 있다.The
이와 같은 상부 지지판(12)을 구성하는 MMC는 SiC 다공체에 Al를 가압에 의해서 함침시키는 가압 함침법이나, 진공 중에서 SiC 다공체에 Al을 함침시키는 진공 함침법에 의해서 제작된다. 이것에 의해 얻어지는 상부 지지판(12)을 구성하는 MMC는 기공율이 예를 들면 1%이하이고, 가열에 의해서 공극으로부터 가스가 팽창하는 일이 없다.The MMC constituting the
이와 같은 상부 지지판(12)의 일면(12a)과, 정전 척판(11)의 타면(11b)은 상온 고체 접합에 의해서 직접 접합되어 있다. 상부 지지판(12)과 정전 척판(11)을 상온 고체 접합할 때에는 상부 지지판(12)과 정전 척판(11)의 사이에 중간막(도시 생략)을 배치하여, 상온하에서 상부 지지판(12)과 정전 척판(11)을 서로 가압하고, 중간막의 성분을 확산시켜 직접 접합을 실행한다.One
이러한 상온 고체 접합을 실행할 때에 이용하는 중간막은 자기 활성화 에너지가 작고 상호 확산하기 쉬운 금속, 또는 표면 평탄성을 유지하기 쉬운 비정질 세라믹스(SiO2, SiN)를 이용하여, 예를 들면 SiC의 입자가 크기 때문에 표면의 평활성을 높이는 것에 한계가 있는 정전 척판(11)의 타면(11b)과, 상부 지지판(12)의 일면(12a)의 표면 평활성을 높여, 강고한 상온 고체 접합을 촉진시킨다.The interlayer film used when performing such solid-state solid bonding uses a metal having low self-activation energy and easy diffusion, or amorphous ceramics (SiO 2 , SiN) easy to maintain surface flatness. The surface smoothness of the
이러한 상온 고체 접합에 이용하는 중간막으로서는 예를 들면, Al, Ti, Ni, Au, Ag, Cu, In, Sn 중의 적어도 1종류를 포함하는 금속막, 또는 SiO2, SiN과 같은 비정질 세라믹스가 바람직하다. 본 실시형태에서는 상부 지지판(12)과 정전 척판(11)의 상온 고체 접합시에, 상부 지지판(12)의 일면(12a)에 Al을 10㎛의 두께로 성막하여 경면을 얻은 후, 상온, 또한 진공중 환경하에서 200kN의 가압력을 2시간 연속해서 가하고, 상부 지지판(12)과 정전 척판(11)을 상온 고체 접합하였다.As the intermediate film used for such normal temperature solid bonding, for example, a metal film containing at least one of Al, Ti, Ni, Au, Ag, Cu, In, and Sn, or amorphous ceramics such as SiO 2 and SiN is preferable. In this embodiment, at the time of solid-state solid bonding of the
또한, 상온 고체 접합시의 전처리로서, 정전 척판(11)의 타면(11b)을 경면 연마하고, 또 상부 지지판(12)의 일면(12a)에 형성한 Al막은 환원 분위기에서 산화막을 제거하는 것이 바람직하다. 중간막으로서는 상기 막 이외에도, 상부 지지판(12)의 성분에 알루미나를 혼합한 소위 경사 재료로 이루어지는 중간막을 이용하는 것도 바람직하다.In addition, as a pretreatment at room temperature solid bonding, the
또한, 이러한 중간막으로서, 서로 다른 막을 2층 이상 중첩해서 이용할 수도 있다. 복수의 중간막을 중첩해서 이용함으로써, 상부 지지판(12)의 타면(12b)과, 정전 척판(11)의 일면(11a)의 각각을 평활화시키기 위해 최적의 재질의 중간막을 선택할 수 있다.Moreover, as such an interlayer film, two or more layers of different films can also be used. By overlapping and using a plurality of interlayer films, an interlayer film of an optimal material can be selected to smooth each of the
펠티에 소자(가열 냉각 수단)(13)는 전기 에너지를 열에너지로 변환하는 열전 변환 소자이며, 열전 변환 재료의 양단에 전극 등을 형성하여 전극간에서 전위차를 발생시키면, 열전 변환 재료의 양단에 온도차가 발생한다. 이러한 펠티에 소자(13)는 서로 반도체형이 동일한 열전 변환 재료끼리를 접속한 유니레그형 펠티에 소자와, 서로 다른 반도체형, 즉 n형 열전 변환 재료와 p형 열전 변환 재료를 교대로 접속한 π(파이)형 펠티에 소자가 있지만, 본 실시형태에서는 효율적으로 열전 변환을 실행할 수 있는 π형의 펠티에 소자(13)를 이용하고 있다.The Peltier element (heating cooling means) 13 is a thermoelectric conversion element that converts electrical energy into thermal energy. When an electrode or the like is formed on both ends of the thermoelectric conversion material to generate a potential difference between the electrodes, the temperature difference between both ends of the thermoelectric conversion material Occurs. The
본 실시형태에서는 복수의 펠티에 소자(13)가 상부 지지판(12)과 하부 지지판(14)의 사이에 소정의 간격을 두고 배열되어 있다. 본 실시형태에서는 직경 300㎜의 반도체 웨이퍼 W를 탑재 가능한 직경의 웨이퍼 스테이지(10)에 대해 150~160개 정도의 펠티에 소자(13)가 배열되어 있다. 예를 들면, 펠티에 소자(13)는 하부 지지판(14)의 일면(14a)의 면적의 45%이상을 차지하도록 배열 형성되어 있으면 좋다.In the present embodiment, a plurality of
개개의 펠티에 소자(13)는 예를 들면, 정전 척판(11)의 일면(11a)에 있어서, 30℃ 내지 80℃의 가열 속도가 1℃/초 이상, 냉각 속도가 0.6℃/초 이상으로 되는 것을 이용하는 것이 바람직하다. 이러한 특성의 펠티에 소자(13)를 이용하는 것에 의해서, 정전 척판(11)에 탑재한 반도체 웨이퍼 W를, 타임 래그를 억제하여 빠른 응답 속도로 온도 제어할 수 있다.The
각각의 펠티에 소자(13)는 서미스터를 내장하고 있으며, 150~160개 정도의 펠티에 소자(13)가 개개에 독립적으로 제어되어 있다. 이것에 의해, 정전 척판(11)에 탑재한 반도체 웨이퍼 W가 직경 300㎜와 같은 대구경이어도, 작은 영역, 예를 들면 20㎜×20㎜ 정도의 영역마다 정확하게 가열, 냉각을 실행할 수 있고, 반도체 웨이퍼 W 전체를 온도의 구배가 없는 균일한 온도로 유지하는 것이 가능하게 된다. 혹은 의도적으로 국소적으로 온도를 변화시킬 수 있다.Each
또한, 본 실시형태에서는 가열 냉각 수단으로서 펠티에 소자(13)를 예시했지만, 가열 냉각 수단은 펠티에 소자(13)에 한정되는 것은 아니다. 예를 들면, 냉매 유로를 구비한 하부 지지판의 상부에 박막 히터를 다수 배치하여, 정전 척판의 일면의 가열은 이 박막 히터에서 실행하고, 냉각은 박막 히터를 오프로 함으로써 냉매로 냉각된 하부 지지판에 열을 방출하는 바와 같은 구성이어도 좋다.In this embodiment, the
펠티에 소자(13)와 상부 지지판(12)의 사이에는 열전도성 시트(15)가 배치되어 있는 것이 바람직하다. 열전도성 시트(15)는 예를 들면 유연성이 있고, 열전도율이 1w/mK 이상의 시트재, 예를 들면 실리콘 시트(실리콘에 탄소를 첨가하여 열전도성을 개선한 시트재로서, 탄소의 첨가량으로 열전도성은 향상하지만, 실리콘이 갖는 유연성은 없어져 무뎌져 가는 것에 의해 탄소의 농도를 최적화한 시트)로 이루어지는 시트재를 이용할 수 있다. 또, 열전도성 시트(15)는 경도가 아스카 C20 이하이고, 하중이 가해지지 않는 상태에서의 두께가 0.3㎜이상, 1.0㎜이하의 범위인 것이 바람직하다.It is preferable that a thermally
열전도성 시트(15)는 후술하는 나사(23)에 의한 상부 지지판(12)과 하부 지지판(14)의 체결에 의해서, 펠티에 소자(13)와 상부 지지판(12)의 사이에서 두께 방향으로 눌러 찌부러져 협지된다. 이러한 열전도성 시트(15)에 의해서, 펠티에 소자(13)와 상부 지지판(12)의 사이의 접촉 열 저항을 저감하고, 상부 지지판(12)의 열 변형, 열 팽창에 의한 변위를 흡수하여 안정하게 펠티에 소자(13)와 반도체 웨이퍼 W의 사이에서 열전도할 수 있다.The thermally
하부 지지판(14)은 일면(14a)측에서 펠티에 소자(13)와 접하고, 상부 지지판(12)과의 사이에서 펠티에 소자(13)를 협지한다. 하부 지지판(14)은 영율이 120MPa이상의 재료에 의해서 형성되는 것이 바람직하다. 영율이 120MPa이상의 재료를 이용하는 것에 의해서 하부 지지판(14)의 강성이 높아지고, 대기와 진공의 압력 차에 의해 하부 지지판(14)이 만곡되는 것을 방지할 수 있다.The
이러한 하부 지지판(14)의 구성 재료로서는 예를 들면 Ti 또는 Ti 합금, 카본, Si, SiC, Al2O3, BN, ZrO2 중의 적어도 어느 하나를 포함하는 재료를 들 수 있다. 본 실시형태에서는 하부 지지판(14)은 Al(29%)-SiC(71%)의 복합재(MMC)로 구성되어 있다. Al로서는 예를 들면 A6061재를 이용하고 있다.Examples of the constituent material of the
이러한 조성의 하부 지지판(14)을 구성하는 MMC는 SiC 다공체에 Al을 가압에 의해서 함침시키는 가압 함침법이나, 진공 중에서 SiC 다공체에 Al을 함침시키는 진공 함침법에 의해서 제작된다. 이것에 의해 얻어지는 하부 지지판(14)을 구성하는 MMC는 기공율이 예를 들면 1%이하이고, 가열에 의해서 공극으로부터 가스가 팽창하여 방출되는 일이 없다.The MMC constituting the
하부 지지판(14)의 내부에는 냉매를 흘리기 위한 냉매 유로(22)가 형성되어 있다. 이러한 냉매 유로(22)를 형성하기 위해, 하부 지지판(14)을 두께 방향으로 2분할 가능한 형태로 하는 것이 바람직하다. 이것에 의해, 하부 지지판(14)을 이루는 한쪽의 부재에 복수의 홈을 형성하고, 이 한쪽의 부재에 대해, 판형상의 다른쪽의 부재를 접합함으로써, 내부에 냉매 유로(22)가 형성된 하부 지지판(14)을 얻을 수 있다.A
냉매 유로(22)에는 냉매, 예를 들면 프레온 등의 유기 냉매, 물 등을 흘릴 수 있다. 이러한 냉매는 외부에 마련한 방열기(도시 생략)에 의해서 방열하여 순환시키면 좋다. 하부 지지판(14)의 내부에 냉매 유로(22)를 형성하여 냉매를 흘리는 것에 의해서, 예를 들면 펠티에 소자(13)에 의해서 반도체 웨이퍼 W를 냉각할 때에, 하부 지지판(14)측에 생긴 열을 신속히 흡수하고, 펠티에 소자(13)가 과열하는 것을 방지하고, 효율적으로 펠티에 소자(13)에 의한 반도체 웨이퍼 W의 냉각을 실행할 수 있다.A refrigerant, for example, an organic refrigerant such as freon, water, etc., can flow through the
상부 지지판(12)과 하부 지지판(14)의 사이는 나사(23)에 의해서 체결된다. 나사(23)는 하부 지지판(14)에 형성한 나사 구멍(24)을 관통하고, 상부 지지판(12)의 타면(12b)측에서 두께 방향으로 연장하는 내부 나사(25)에 나사맞춤된다. 이것에 의해, 상부 지지판(12)과 하부 지지판(14)의 사이에 배열된 복수의 펠티에 소자(13)가 협지된다.The
상부 지지판(12)과 하부 지지판(14)의 사이는 인가되는 RF 전류에 의한 이상 방전을 방지하기 위해 대기압(1기압)으로 되어 있지만, 이러한 상부 지지판(12)과 하부 지지판(14)의 사이의 대기압 환경과, 상부 지지판(12)보다 정전 척판(11)측의 진공 환경의 사이의 내압 확보를 위해, 상부 지지판(12)과 하부 지지판(14)의 사이는 본 실시형태에서는 30~40개의 나사에 의해서 균등한 간격으로 체결되어 있다.Between the
또, 나사(23)의 주위에는 상부 지지판(12)과 하부 지지판(14)의 간격을 일정하게 유지하는 스페이서(26)가 더 형성되어 있는 것이 바람직하다. 이러한 스페이서(26)에 의해서, 복수의 나사(23)끼리의 체결압에 차가 있어도, 상부 지지판(12)과 하부 지지판(14)의 간격을 일정하게 유지하고, 복수의 펠티에 소자(13)에 의한 열전도성에 편차가 생기는 것을 방지할 수 있다.Further, it is preferable that a
또한, 개개의 나사(23)에는 풀어짐 방지 부재(도시 생략)가 형성되어 있는 것도 바람직하다. 이러한 풀어짐 방지 부재를 마련함으로써, 경시 변화로 나사(23)가 풀어지고, 상부 지지판(12)과 하부 지지판(14)의 체결압이 불균일하게 되어 복수의 펠티에 소자(13)에 의한 열전도성에 편차가 생기는 것을 방지할 수 있다.In addition, it is also preferable that each
이상과 같은 구성의 웨이퍼 스테이지(10)의 상부 지지판(12)의 펠티에 소자(13)에 대향하는 타면(12b)으로부터, 정전 척판(11)의 일면(11a)까지의 열용량의 합계값은 단위면적당 3.0J/K이하가 되도록 구성된다. 열용량의 합계값을 단위면적당 3.0J/K이하로 유지하는 것에 의해, 펠티에 소자(13)의 열을 정전 척판(11)의 일면(11a)을 향해 높은 응답 속도로 전파시키는 것이 가능하게 되고, 반도체 웨이퍼 W의 온도 변화에 추종하여 고정밀도로 온도 제어를 실행하는 것이 가능하게 된다.The total value of the heat capacity from the
이상과 같은 구성의 본 발명의 1실시형태의 웨이퍼 스테이지(10)에 의하면, 상부 지지판(12)을 알루미늄 또는 알루미늄 합금과 세라믹스 또는 카본의 복합재료로 구성하는 것에 의해서, 예를 들면 대기압 환경과 진공 환경의 압력 차에 견딜 수 있는 충분한 강도를 확보할 수 있다.According to the
그리고, 정전 척판(11)과 상부 지지판(12)을 상온 고체 접합에 의해서 직접 접합하는 것에 의해서, 접착제를 개재시켜 접합한 경우에 비해, 정전 척판(11)과 상부 지지판(12)의 사이의 열전도성을 높이고, 온도 응답성을 향상시킬 수 있다. 또, 직접 접합하는 것에 의해서, 정전 척판(11)과 상부 지지판(12)의 접합 강도가 향상하고, 열 팽창에 의한 정전 척의 만곡을 방지하고, 반도체 웨이퍼 W를 확실하게 흡착할 수 있다.Then, by directly bonding the
이상과 같은 웨이퍼 스테이지(10)에 탑재된 반도체 웨이퍼 W를 가공하는 가공 수단을 구비한 반도체 제조 장치로서, 예를 들면 에칭 장치, 화학 기상 성장 장치, 스퍼터링 장치를 들 수 있다. 이들 반도체 제조 장치에 웨이퍼 스테이지(10)를 적용하는 것에 의해서, 압력차에 견딜 수 있는 충분한 강도와, 온도 응답성의 향상과, 열 팽창에 의한 정전 척의 만곡 방지를 병립할 수 있는 웨이퍼 스테이지를 구비한 반도체 제조 장치를 실현할 수 있다. 또한, 에칭 장치나 CVD 장치와 같이 부식성 가스를 이용하는 경우에는 스테이지 측면에 알루미나, 산화이트륨과 같은 내식 성막의 표면 코팅을 실행하는 것도 바람직하다.As a semiconductor manufacturing apparatus provided with the processing means for processing the semiconductor wafer W mounted on the
이상, 본 발명의 실시형태를 설명했지만, 이들 실시형태는 예로서 제시한 것이며, 발명의 범위를 한정하는 것은 의도하고 있지 않다. 이들 실시형태는 그 밖의 각종 형태로 실시되는 것이 가능하며, 발명의 요지를 이탈하지 않는 범위에서, 각종 생략, 치환, 변경을 실행할 수 있다. 이들 실시형태나 그 변형은 발명의 범위나 요지에 포함되는 것과 마찬가지로, 특허청구의 범위에 기재된 발명과 그 균등의 범위에 포함되는 것이다.As mentioned above, although embodiment of this invention was described, these embodiment is shown as an example and it is not intended to limit the scope of the invention. These embodiments can be implemented in various other forms, and various omissions, substitutions, and changes can be made without departing from the spirit of the invention. These embodiments and modifications thereof are included in the scope of the invention and equivalents thereof as described in the claims and the scope of the invention.
[실시예][Example]
웨이퍼 스테이지의 온도의 승강온 속도를 검증하였다. 승강온 속도는 펠티에 소자의 구동 능력과 상부 지지판 및 정전 척판의 열전도율 및 열 용량에 의존한다. 그래서 상부 지지판을 SUS304에서 두께 6㎜(시료 1), MMC에서 두께 1㎜(시료 2), 3㎜(시료 3), 6㎜(시료 4)의 4종류의 샘플을 작성하여 승강온 속도를 측정하였다. 하부 지지판의 온도는 50℃로 고정시켜 정전 척판의 일면의 온도가 30℃에서 80℃의 사이의 변화 속도를 측정한 결과를 도 3에 나타낸다.The rate of temperature rise and fall of the wafer stage was verified. The rate of temperature rise and fall depends on the driving capability of the Peltier element and the thermal conductivity and heat capacity of the upper support plate and the electrostatic chuck plate. So, the upper support plate was made of 4 types of samples in SUS304: 6 mm thick (sample 1),
펠티에 소자는 72시리즈(주식회사 페로텍(Ferrotec Corporation)제)를 이용하고, 구동 전력의 최대값은 1소자당 4.3V, 3A이다. 프로세스상 1℃/sec이상의 냉각 속도가 필요하므로, 단위면적당 상부 지지판과 정전 척판의 열 용량의 합계가 6.0J/k이하가 요구된다. 도 4에 승강온의 실측값(시료 1, 시료 4)의 예를 나타낸다. 도 4에 나타내는 결과로부터, MMC에서 두께 3㎜로 정전 척판에 알루미나 두께 1㎜의 것을 고체 확산 접합으로 형성하면, 원하는 특성을 갖는 웨이퍼 스테이지를 형성하는 것이 가능하다.The Peltier element uses 72 series (manufactured by Ferrotec Corporation), and the maximum value of the driving power is 4.3V per element, 3A. Since the process requires a cooling rate of 1 ° C / sec or higher, the total heat capacity of the upper support plate and the electrostatic chuck plate per unit area is required to be 6.0 J / k or less. Fig. 4 shows an example of the measured values of the temperature rise (
10; 웨이퍼 스테이지
11; 정전 척판
12; 상부 지지판
13; 펠티에 소자
14; 하부 지지판
15; 열전도성 시트10;
12;
14;
Claims (10)
상기 반도체 웨이퍼가 일면에 탑재되는 정전 척판과, 상기 정전 척판의 타면에 접합된 상부 지지판과, 상기 상부 지지판에 중첩해서 배치된 하부 지지판과, 상기 상부 지지판 및 상기 하부 지지판의 사이에 배치된 가열 냉각 수단을 적어도 갖고,
상기 정전 척판은 세라믹스를 포함하는 재료로 이루어지고,
상기 상부 지지판은 알루미늄 또는 알루미늄 합금과 상기 세라믹스 또는 카본의 복합재료로 이루어지고,
상기 정전 척판과 상기 상부 지지판은 상온 고체 접합에 의해서 직접 접합되어 있는 것을 특징으로 하는 웨이퍼 스테이지.A wafer stage supporting a semiconductor wafer,
An electrostatic chuck plate in which the semiconductor wafer is mounted on one surface, an upper support plate bonded to the other surface of the electrostatic chuck plate, a lower support plate disposed overlapping the upper support plate, and heating and cooling arranged between the upper support plate and the lower support plate At least have the means,
The electrostatic chuck is made of a material containing ceramics,
The upper support plate is made of a composite material of aluminum or aluminum alloy and the ceramics or carbon,
Wafer stage, characterized in that the electrostatic chuck plate and the upper support plate are directly bonded by normal temperature solid bonding.
상기 세라믹스는 SiC, Al2O3, AlN 중의 적어도 하나를 포함하는 것을 특징으로 하는 웨이퍼 스테이지.According to claim 1,
The ceramics is a wafer stage, characterized in that it comprises at least one of SiC, Al 2 O 3 , AlN.
상기 상부 지지판은 기공율이 1%이하인 것을 특징으로 하는 웨이퍼 스테이지.According to claim 1,
The upper support plate is a wafer stage, characterized in that the porosity is 1% or less.
상기 상부 지지판은 상기 정전 척판에 대한 열 팽창 계수의 차가 ±5%이내가 되는 재료에 의해서 형성한 것을 특징으로 하는 웨이퍼 스테이지.According to claim 1,
The upper support plate is a wafer stage, characterized in that formed by a material that is within ± 5% of the difference in thermal expansion coefficient for the electrostatic chuck.
상기 가열 냉각 수단은 펠티에 소자인 것을 특징으로 하는 웨이퍼 스테이지.According to claim 1,
The heating and cooling means is a wafer stage, characterized in that the Peltier element.
상기 펠티에 소자는 복수 형성되고, 각각의 펠티에 소자는 독립적으로 제어되는 것을 특징으로 하는 웨이퍼 스테이지.The method of claim 5,
A plurality of Peltier elements are formed, and each Peltier element is independently controlled wafer stage.
상기 펠티에 소자는 상기 하부 지지판의 일면의 면적의 45%이상을 차지하도록 배열 형성되어 있는 것을 특징으로 하는 웨이퍼 스테이지.The method of claim 5,
The Peltier element is a wafer stage, characterized in that it is arranged to occupy more than 45% of the area of one surface of the lower support plate.
상기 펠티에 소자는 상기 정전 척판의 일면에 있어서 30℃ 내지 80℃의 가열 속도를 1℃/초 이상, 냉각 속도를 0.6℃/초 이상으로 되는 것을 이용하는 것을 특징으로 하는 웨이퍼 스테이지.The method of claim 5,
The Peltier element is a wafer stage characterized in that the heating rate of 30 ° C to 80 ° C on one surface of the electrostatic chuck is set to 1 ° C / sec or more and the cooling rate to 0.6 ° C / sec or more.
상기 펠티에 소자와 상기 상부 지지판의 사이에는 탄성을 갖는 열전도성 시트가 더 마련되어 있는 것을 특징으로 하는 웨이퍼 스테이지.The method of claim 5,
A wafer stage characterized in that a thermally conductive sheet having elasticity is further provided between the Peltier element and the upper support plate.
상기 열전도성 시트는 열전도율이 1w/mK이상인 것을 특징으로 하는 웨이퍼 스테이지.The method of claim 9,
The thermally conductive sheet is a wafer stage, characterized in that the thermal conductivity is 1w / mK or more.
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