KR20180111119A - 튜너블 인덕터 회로 - Google Patents

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KR20180111119A
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Abstract

본 발명의 일 실시 예에 따른 튜너블 인덕터 회로는, 제1 단자에 접속된 일단 및 타단을 갖는 제1 공통 전송라인; 상기 제1 공통 전송라인의 타단에 접속된 일단 및 타단을 갖는 제1 비공통 전송라인; 상기 제1 공통 전송라인의 타단과 상기 제1 비공통 전송라인의 타단중 하나를 제1 공통 노드에 연결하는 제1 스위치 회로; 상기 제1 공통 노드에 접속된 일단 및 타단을 갖는 제2 공통 전송라인; 상기 제2 공통 전송라인의 타단에 접속된 일단 및 타단을 갖는 제2 비공통 전송라인; 및 상기 제2 공통 전송라인의 타단과 상기 제2 비공통 전송라인의 타단중 하나를 제2 단자에 연결하는 제2 스위치 회로; 를 포함한다.

Description

튜너블 인덕터 회로{TUNABLE INDUCTOR CIRCUIT}
본 발명은 튜너블 인덕터 회로에 관한 것이다.
일반적으로, 차세대 무선통신 시스템의 광대역화, 멀티미디어화, 지능화 등의 추세에 따라 RF 전력 증폭기의 광대역화, 선형성 향상, 지능화에 대한 요구가 증가하고 있다.
이에 따라 EER(Energy Efficiency Ratio), 디지털 전치왜곡(Digital Predistortion), 도허티 전력증폭기, 스위치 모드 전력 증폭기 등의 설계기법 및 GaN, CMOS 전력 증폭기 등에 대한 개발이 진행되고 있다.
또한, 점차 높은 데이타 전송 속도(data rate)의 통신기술이 요구됨에 따라, RF 프론트-엔드(Front-end)에서는 광대역을 커버할 수 있는 파워 증폭기(power amplifier)의 설계가 필요하다.
이러한 파워 증폭기에서, 광대역 구현을 위해서는 사용 주파수에 따라 최적화된 임피던스로 매칭을 구현하는 것이 중요하며, 이에 따라 집적회로 내에 임피던스를 가변할 수 있는 회로 구현이 필요하다.
기존 임피던스 가변 회로중에는, 온칩으로 커패시턴스를 가변하는 회로는 있으나, 인덕턴스를 가변할 수 있는 회로를 온칩으로 구현하기는 어려움이 있다.
한국 공개특허 제2013-0060756호 공보
본 발명의 일 실시 예는, 인덕턴스 가변 회로를 온칩으로 구현함으로써, 외부 제어 신호를 이용하여 인덕턴스를 제어할 수 있는 튜너블 인덕터 회로를 제안한다.
본 발명의 일 실시 예에 의해, 제1 단자에 접속된 일단 및 타단을 갖는 제1 공통 전송라인; 상기 제1 공통 전송라인의 타단에 접속된 일단 및 타단을 갖는 제1 비공통 전송라인; 상기 제1 공통 전송라인의 타단과 상기 제1 비공통 전송라인의 타단중 하나를 제1 공통 노드에 연결하는 제1 스위치 회로; 상기 제1 공통 노드에 접속된 일단 및 타단을 갖는 제2 공통 전송라인; 상기 제2 공통 전송라인의 타단에 접속된 일단 및 타단을 갖는 제2 비공통 전송라인; 및 상기 제2 공통 전송라인의 타단과 상기 제2 비공통 전송라인의 타단중 하나를 제2 단자에 연결하는 제2 스위치 회로; 를 포함하는 튜너블 인덕터 회로가 제안된다.
또한, 본 발명의 다른 일 실시 예에 의해, 공통 신호 경로에 포함되는 복수의 제1, 제2 내지 제n 공통 전송라인; 우회 신호 경로에 포함되는 복수의 제1, 제2 내지 제n 비공통 전송라인; 및 복수의 제1, 제2 내지 제n 스위치 회로;를 포함하고, 상기 제1 공통 전송라인은 제1 단자에 접속된 일단 및 타단을 포함하고, 상기 제1 비공통 전송라인은 상기 제1 공통 전송라인의 타단에 접속된 일단 및 타단을 포함하고, 상기 제1 스위치 회로는 상기 제1 공통 전송라인의 타단과 상기 제1 비공통 전송라인의 타단중 하나를 상기 공통 신호 경로에 포함된 제1 공통 노드에 연결하고, 상기 제2 공통 전송라인은 상기 제1 공통 노드에 접속된 일단 및 타단을 포함하고, 상기 제2 비공통 전송라인은 상기 제2 공통 전송라인의 타단에 접속된 일단 및 타단을 포함하고, 상기 제2 스위치 회로는 상기 제2 공통 전송라인의 타단과 상기 제2 비공통 전송라인의 타단중 하나를 상기 공통 신호 경로에 포함된 제2 공통 노드에 연결하고, 상기 제n 공통 전송라인은 상기 제n-1 공통 노드에 접속된 일단 및 타단을 포함하고, 상기 제n 비공통 전송라인은 상기 제n 공통 전송라인의 타단에 접속된 일단 및 타단을 포함하고, 상기 제n 스위치 회로는 상기 제n 공통 전송라인의 타단과 상기 제n 비공통 전송라인의 타단중 하나를 상기 공통 신호 경로에 포함된 제2 단자에 연결하는 튜너블 인덕터 회로가 제안된다.
본 발명의 일 실시 예에 의하면, 온칩으로 인덕턴스 가변 회로를 구현함에 따라, 소형 제작이 가능하고, 전송라인(transmission line)의 전기적인 길이(electrical length)를 외부 제어 신호를 이용하여 가변할 수 있는 있다.
도 1은 본 발명의 일 실시 예에 따른 튜너블 인덕터 회로의 일 예시도이다.
도 2는 본 발명의 일 실시 예에 따른 튜너블 인덕터 회로의 다른 일 예시도이다.
도 3은 본 발명의 일 실시 예에 따른 제1,제2 스위치 회로의 일 예시도이다.
도 4는 본 발명의 일 실시 예에 따른 제1,제2 내지 제n 스위치 회로의 일 예시도이다.
도 5는 본 발명의 일 실시 예에 따른 튜너블 인덕터 회로의 일 적용 예시도이다.
도 6은 본 발명의 일 실시 예에 따른 튜너블 인덕터 회로의 다른 일 적용 예시도이다.
도 7은 도 5의 일 적용 예에 따른 제1 주파수에 대한 임피던스 챠트이다.
도 8은 도 5의 일 적용 예에 따른 제2 주파수에 대한 임피던스 챠트이다.
이하에서는, 본 발명은 설명되는 실시 예에 한정되지 않으며, 본 발명의 정신 및 범위를 벗어나지 않으면서 다양하게 변경될 수 있음이 이해되어야 한다.
또한, 본 발명의 각 실시 예에 있어서, 하나의 예로써 설명되는 구조, 형상 및 수치는 본 발명의 기술적 사항의 이해를 돕기 위한 예에 불과하므로, 이에 한정되는 것이 아니라 본 발명의 정신 및 범위를 벗어나지 않으면서 다양하게 변경될 수 있음이 이해되어야 한다. 본 발명의 실시 예들은 서로 조합되어 여러 가지 새로운 실시 예가 이루어질 수 있다.
그리고, 본 발명에 참조된 도면에서 본 발명의 전반적인 내용에 비추어 실질적으로 동일한 구성과 기능을 가진 구성요소들은 동일한 부호를 사용할 것이다.
이하에서는, 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자가 본 발명을 용이하게 실시할 수 있도록 하기 위해서, 본 발명의 실시 예를 첨부한 도면을 참조하여 상세히 설명한다.
도 1은 본 발명의 일 실시 예에 따른 튜너블 인덕터 회로의 일 예시도이다.
도 1을 참조하면, 본 발명의 일 실시 예에 따른 튜너블 인덕터 회로는, 제1 공통 전송라인(CTL-1), 제1 비공통 전송라인(UTL-1), 제1 스위치 회로(SW-1), 제2 공통 전송라인(CTL-2), 제2 비공통 전송라인(UTL-2) 및 제2 스위치 회로(SW-2)를 포함할 수 있다.
상기 제1 공통 전송라인(CTL-1)은, 제1 단자(T1)에 접속된 일단과, 상기 제1 비공통 전송라인(UTL-1)의 일단에 접속된 타단을 포함할 수 있다. 상기 제1 비공통 전송라인(UTL-1)은 상기 제1 공통 전송라인(CTL-1)의 타단에 접속된 일단과, 상기 제1 스위치 회로(SW-1)에 접속된 타단을 포함할 수 있다. 상기 제1 스위치 회로(SW-1)는, 상기 제1 공통 전송라인(CTL-1)의 타단과 상기 제1 비공통 전송라인(UTL-1)의 타단중 하나를 제1 공통 노드(N1)에 연결할 수 있다.
이에 따라, 상기 제1 스위치 회로(SW-1)가 제1 공통 노드(N1)를 상기 제1 공통 전송라인(CTL-1)의 타단에 연결하면, 전송라인으로 제1 공통 전송라인(CTL-1)이 선택된다. 이와 달리, 상기 제1 스위치 회로(SW-1)가 제1 공통 노드(N1)를 상기 제1 비공통 전송라인(UTL-1)의 타단에 연결하면, 전송라인으로 제1 공통 전송라인(CTL-1) 및 제1 비공통 전송라인(UTL-1)이 선택된다.
즉, 상기 제1 스위치 회로(SW-1)의 스위칭 동작에 따라 전송라인의 전기적인 길이가 조절될 수 있다.
또한, 상기 제2 공통 전송라인(CTL-2)은, 상기 제1 공통 노드(N1)에 접속된 일단 및 상기 제2 비공통 전송라인(UTL-2)의 일단에 접속된 타단을 포함할 수 있다. 상기 제2 비공통 전송라인(UTL-2)은, 상기 제2 공통 전송라인(CTL-2)의 타단에 접속된 일단 및 상기 제2 스위치 회로(SW-2)에 접속된 타단을 포함할 수 있다. 상기 제2 스위치 회로(SW-2)는, 상기 제2 공통 전송라인(CTL-2)의 타단과 상기 제2 비공통 전송라인(UTL-2)의 타단중 하나를 제2 단자(T1)에 연결할 수 있다.
이에 따라, 상기 제2 스위치 회로(SW-2)가 제2 단자(T2)를 상기 제2 공통 전송라인(CTL-2)의 타단에 연결하면, 전송라인으로 제2 공통 전송라인(CTL-2)이 선택된다. 이와 달리, 상기 제2 스위치 회로(SW-2)가 제2 단자(T2)를 상기 제2 비공통 전송라인(UTL-2)의 타단에 연결하면, 전송라인으로 제2 공통 전송라인(CTL-2) 및 제2 비공통 전송라인(UTL-2)이 선택된다.
즉, 상기 제2 스위치 회로(SW-2)의 스위칭 동작에 따라 전송라인의 전기적인 길이가 조절될 수 있다.
일 예로, 상기 제1 공통 전송라인(CTL-1)은 상기 제2 비공통 전송라인(UTL-2)의 전송 길이와 다른 전송 길이를 포함할 수 있다.
본 발명의 각 도면에서는, 동일한 부호 및 동일한 기능의 구성요소에 대해서는 가능한 불필요한 중복 설명은 생략될 수 있고, 각 도면에서는 가능한 차이점에 대한 사항을 설명한다.
도 2는 본 발명의 일 실시 예에 따른 튜너블 인덕터 회로의 다른 일 예시도이다.
도 2를 참조하면, 본 발명의 일 실시 예에 따른 튜너블 인덕터 회로는, 공통 신호 경로에 포함되는 복수의 제1, 제2 내지 제n 공통 전송라인(CTL-1~CTL-n)과, 우회 신호 경로에 포함되는 복수의 제1, 제2 내지 제n 비공통 전송라인(UTL-1~UTL-n)과, 복수의 제1, 제2 내지 제n 스위치 회로(SW-1~SW-n)를 포함할 수 있다.
상기 제1 및 제2 공통 전송라인(CTL-1, CTL-2)과, 제1 및 제2 비공통 전송라인(UTL-1, UTL-2)과, 제1 및 제2 스위치 회로(SW-1, SW-2) 각각에 대한 동작은 도 1을 참조한 설명과 동일하므로 생략한다.
도 2를 참조하면, 상기 제n 공통 전송라인(CTL-n, 여기서, n은 3 이상의 자연수)은 상기 제n-1 공통 노드(Nn-1)에 접속된 일단과, 상기 제n 비공통 전송라인(UTL-n)의 일단에 접속된 타단을 포함할 수 있다. 상기 제n 비공통 전송라인(UTL-n)은 상기 제n 공통 전송라인(CTL-n)의 타단에 접속된 일단과, 상기 제n 스위치 회로(SW-n)에 접속된 타단을 포함할 수 있다. 그리고, 상기 제n 스위치 회로(SW-n)는 상기 제n 공통 전송라인(CTL-n)의 타단과 상기 제n 비공통 전송라인(UTL-n)의 타단중 하나를 상기 공통 신호 경로에 포함된 제2 단자(T2)에 연결할 수 있다.
이에 따라, 상기 제n 스위치 회로(SW-n)가 제2 단자(T2)를 상기 제n 공통 전송라인(CTL-n)의 타단에 연결하면, 전송라인으로 제n 공통 전송라인(CTL-n)이 선택된다. 이와 달리, 상기 제n 스위치 회로(SW-n)가 제2 단자(T2)를 상기 제n 비공통 전송라인(UTL-n)의 타단에 연결하면, 전송라인으로 제n 공통 전송라인(CTL-n) 및 제n 비공통 전송라인(UTL-n)이 선택된다.
즉, 상기 제n 스위치 회로(SW-n)의 스위칭 동작에 따라 전송라인의 전기적인 길이가 조절될 수 있다.
일 예로, 상기 제1 내지 제n 공통 전송라인(CTL-1~CTL-n)은 서로 다른 전송 길이를 포함할 수 있다.
도 3은 본 발명의 일 실시 예에 따른 제1,제2 스위치 회로의 일 예시도이고, 도 4는 본 발명의 일 실시 예에 따른 제1,제2 내지 제n 스위치 회로의 일 예시도이다.
도 3 및 도 4를 참조하면, 상기 제1 스위치 회로(SW-1)는 제1 스위치 소자(SW-11)와 제2 스위치 소자(SW-12)를 포함할 수 있다.
상기 제1 스위치 회로(SW-1)의 제1 스위치 소자(SW-11)는, 상기 제1 공통 전송라인(CTL-1)의 타단과 상기 제1 공통 노드(N1) 사이에 접속될 수 있다.
상기 제1 스위치 회로(SW-1)의 제2 스위치 소자(SW-12)는, 상기 제1 비공통 전송라인(UTL-1)의 타단과 상기 제1 공통 노드(N1) 사이에 접속될 수 있다.
일 예로, 상기 제1 스위치 회로(SW-1)의 제1 및 제2 스위치 소자(SW-11,SW-12) 각각은 바이폴라 접합 트랜지스터(BJT)가 될 수 있다. 이 경우, 상기 제1 스위치 회로(SW-1)의 제1 및 제2 스위치 소자(SW-11,SW-12)는, 서로 반대 위상을 갖는 두 제어신호(Vb-11,Vb-12)에 따라 상보적으로 스위칭 동작하여, 상기 제1 공통 전송라인(CTL-1)의 타단과 상기 제1 비공통 전송라인(UTL-1)의 타단중 하나를 제1 공통 노드(N1)에 연결할 수 있다.
또한, 상기 제2 스위치 회로(SW-2)는 제1 스위치 소자(SW-21)와 제2 스위치 소자(SW-22)를 포함할 수 있다.
상기 제2 스위치 회로(SW-2)의 제1 스위치 소자(SW-21)는 상기 제2 공통 전송라인(CTL-2)의 타단과 상기 제2 단자(T2) 사이에 접속될 수 있다.
상기 제2 스위치 회로(SW-2)의 제2 스위치 소자(SW-22)는, 상기 제2 비공통 전송라인(UTL-2)의 타단과 상기 제2 단자(T2) 사이에 접속될 수 있다.
일 에로, 상기 제2 스위치 회로(SW-2)의 제1 및 제2 스위치 소자(SW-21,SW-22) 각각은 바이폴라 접합 트랜지스터(BJT)가 될 수 있다. 이 경우, 상기 제2 스위치 회로(SW-2)의 제1 및 제2 스위치 소자(SW-21,SW-22)는, 서로 반대 위상을 갖는 두 제어신호(Vb-21,Vb-22)에 따라 상보적으로 스위칭 동작하여, 상기 제2 공통 전송라인(CTL-2)의 타단과 상기 제2 비공통 전송라인(UTL-2)의 타단중 하나를 제2 단자(T2)에 연결할 수 있다.
도 4를 참조하면, 상기 제n 스위치 회로(SW-n)는 제1 스위치 소자(SW-n1) 및 제2 스위치 소자(SW-n2)를 포함할 수 있다.
상기 제1 스위치 소자(SW-n1)는 상기 제n 공통 전송라인(CTL-n)의 타단과 상기 제2 단자(T2) 사이에 접속될 수 있다.
상기 제2 스위치 소자(SW-n2)는 상기 제n 비공통 전송라인(UTL-n)의 타단과 상기 제2 단자(T2) 사이에 접속될 수 있다.
일 에로, 상기 제n 스위치 회로(SW-n)의 제1 및 제2 스위치 소자(SW-n1,SW-n2) 각각은 바이폴라 접합 트랜지스터(BJT)가 될 수 있다. 이 경우, 상기 제n 스위치 회로(SW-n)의 제1 및 제2 스위치 소자(SW-n1,SW-n2)는, 서로 반대 위상을 갖는 두 제어신호(Vb-n1,Vb-n2)에 따라 상보적으로 스위칭 동작하여, 상기 제n 공통 전송라인(CTL-n)의 타단과 상기 제n 비공통 전송라인(UTL-n)의 타단중 하나를 제2 단자(T2)에 연결할 수 있다.
전술한 바와 같은 본 발명의 일 실시 에에 따른 튜너블 인덕터 회로는, 매칭 회로 및 필터에 적용될 수 있으며, 이에 대해서는 도 5 및 도 6을 참조하여 설명한다.
도 5는 본 발명의 일 실시 예에 따른 튜너블 인덕터 회로의 일 적용 예시도이다.
도 5를 참조하면, 구동 증폭기(10), 파워 증폭기(20), 입력 매칭부(M1), 단간 매칭부(M2) 및 출력 매칭부(M3)를 포함하는 파워 증폭 회로에서, 본 발명의 일 실시 예에 따른 튜너블 인덕터 회로는 단간 매칭부(M2)에 적용될 수 있다.
도 6은 본 발명의 일 실시 예에 따른 튜너블 인덕터 회로의 다른 일 적용 예시도이다.
도 6을 참조하면, 구동 증폭기(10), 파워 증폭기(20), 입력 매칭부(M1), 단간 매칭부(M2) 및 출력 매칭부(M3)를 포함하는 파워 증폭 회로에서, 본 발명의 일 실시 예에 따른 튜너블 인덕터 회로는 출력단에 접속된 필터(30)에 적용될 수 있다.
본 발명의 일 실시 예에 따른 튜너블 인덕터 회로는 도 5 및 도 6에 도시된 예에 한정되지 않고, 인덕턴스 가변이 필요한 회로에는 적용될 수 있다.
도 7은 도 5의 일 적용 예에 따른 제1 주파수에 대한 임피던스 챠트이고, 도 8은 도 5의 일 적용 예에 따른 제2 주파수에 대한 임피던스 챠트이다.
도 7의 M59 및 M61은 제1 주파수(예, 760MHz)에서의 도 5의 구동 증폭기(10)의 출력 임피던스 및 파워 증폭기(20)의 입력 임피던스이고, 도 8의 M59 및 M61은 제2 주파수(예, 860MHz)에서의 도 5의 구동 증폭기(10)의 출력 임피던스 및 파워 증폭기(20)의 입력 임피던스이다.
도 7 및 도 8의 스미스 챠트는 제1 주파수(760MHz)와 제2 주파수(860 MHz)의 두 개 의 주파수에서 인덕턴스를 가변하면서 두 주파수간 임피던스 미스매칭(impedance mismatch)을 최적화 할 수 있도록 시뮬레이션 결과를 보이고 있다.
도 7의 스미스 챠트(Smith chart)에서 궤적 P11은 제1 주파수(760MHz)에서 단간 매칭부에서 구동 증폭기 출력 방향으로 바라보는 임피던스를 의미하고, 궤적 P12는 제1 주파수(760MHz)에서 단간 매칭부에서 파워 증폭기(20)의 입력 방향으로 바라보는 임피던스를 의미한다.
도 8의 스미스 챠트(Smith chart)에서 궤적 P21은 제2 주파수(860MHz)에서 단간 매칭부에서 구동 증폭기 출력 방향으로 바라보는 임피던스를 의미하고, 궤적 P12는 제2 주파수(860MHz)에서 단간 매칭부에서 파워 증폭기(20)의 입력 방향으로 바라보는 임피던스를 의미한다.
도 7 및 도 8의 시뮬레이션 결과를 참조하면, 두 주파수의 파워 증폭기의 입력 임피던스(PA input impedance) 각각은 1.54-j13.2[Ω], 1.28-j11.7[Ω]이고, 구동 증폭기의 출력 임피던스(DA output impedance) 각각은 4.2+j12.0[Ω], 4.8+j14.4[Ω]이라는 점을 참조하면 매칭의 편차가 작음을 알 수 있다.
이에 따르면, 본 발명의 일 실시 예에 따른 튜너블 인덕터 회로를 이용하면, 주파수가 달라지는 경우에 대응하여 인덕턴스를 적절히 조절할 수 있음을 일 수 있다.
전술한 바에 따르면, 제1 내지 제n 스위치 회로를 이용하여 전송라인의 전기적인 길이를 다양하게 조절할 수 있고, 이에 따라 매칭 회로에 각 주파수 별로 최적의 인덕턴스 값을 각각 제공할 수 있으므로, 이에 따르면, 광대역에 걸쳐 최적화 하는데 큰 유용함을 제공할 수 있다.
CTL-1~CTL-n: 제1, 제2 내지 제n 공통 전송라인
UTL-1~UTL-n: 제1, 제2 내지 제n 비공통 전송라인
SW-1~SW-n: 제1, 제2 내지 제n 스위치 회로
SW-11,SW-21,SW-n1: 제1 스위치 소자
SW-12,SW-22,SW-n2: 제2 스위치 소자

Claims (9)

  1. 제1 단자에 접속된 일단 및 타단을 갖는 제1 공통 전송라인;
    상기 제1 공통 전송라인의 타단에 접속된 일단 및 타단을 갖는 제1 비공통 전송라인;
    상기 제1 공통 전송라인의 타단과 상기 제1 비공통 전송라인의 타단중 하나를 제1 공통 노드에 연결하는 제1 스위치 회로;
    상기 제1 공통 노드에 접속된 일단 및 타단을 갖는 제2 공통 전송라인;
    상기 제2 공통 전송라인의 타단에 접속된 일단 및 타단을 갖는 제2 비공통 전송라인; 및
    상기 제2 공통 전송라인의 타단과 상기 제2 비공통 전송라인의 타단중 하나를 제2 단자에 연결하는 제2 스위치 회로;
    를 포함하는 튜너블 인덕터 회로.
  2. 제1항에 있어서, 상기 제1 스위치 회로는
    상기 제1 공통 전송라인의 타단과 상기 제1 공통 노드 사이에 접속된 제1 스위치 소자; 및
    상기 제1 비공통 전송라인의 타단과 상기 제1 공통 노드 사이에 접속된 제2 스위치 소자;
    를 포함하는 튜너블 인덕터 회로.
  3. 제1항에 있어서, 상기 제2 스위치 회로는
    상기 제2 공통 전송라인의 타단과 상기 제2 단자 사이에 접속된 제1 스위치 소자; 및
    상기 제2 비공통 전송라인의 타단과 상기 제2 단자 사이에 접속된 제2 스위치 소자;
    를 포함하는 튜너블 인덕터 회로.
  4. 제1항에 있어서, 상기 제1 공통 전송라인은
    상기 제2 비공통 전송라인의 전송 길이와 다른 전송 길이를 갖는 튜너블 인덕터 회로.
  5. 공통 신호 경로에 포함되는 복수의 제1, 제2 내지 제n 공통 전송라인;
    우회 신호 경로에 포함되는 복수의 제1, 제2 내지 제n 비공통 전송라인; 및
    복수의 제1, 제2 내지 제n 스위치 회로;를 포함하고,
    상기 제1 공통 전송라인은 제1 단자에 접속된 일단 및 타단을 포함하고, 상기 제1 비공통 전송라인은 상기 제1 공통 전송라인의 타단에 접속된 일단 및 타단을 포함하고, 상기 제1 스위치 회로는 상기 제1 공통 전송라인의 타단과 상기 제1 비공통 전송라인의 타단중 하나를 상기 공통 신호 경로에 포함된 제1 공통 노드에 연결하고,
    상기 제2 공통 전송라인은 상기 제1 공통 노드에 접속된 일단 및 타단을 포함하고, 상기 제2 비공통 전송라인은 상기 제2 공통 전송라인의 타단에 접속된 일단 및 타단을 포함하고, 상기 제2 스위치 회로는 상기 제2 공통 전송라인의 타단과 상기 제2 비공통 전송라인의 타단중 하나를 상기 공통 신호 경로에 포함된 제2 공통 노드에 연결하고,
    상기 제n 공통 전송라인은 상기 제n-1 공통 노드에 접속된 일단 및 타단을 포함하고, 상기 제n 비공통 전송라인은 상기 제n 공통 전송라인의 타단에 접속된 일단 및 타단을 포함하고, 상기 제n 스위치 회로는 상기 제n 공통 전송라인의 타단과 상기 제n 비공통 전송라인의 타단중 하나를 상기 공통 신호 경로에 포함된 제2 단자에 연결하는
    튜너블 인덕터 회로.
  6. 제5항에 있어서, 상기 제1 스위치 회로는
    상기 제1 공통 전송라인의 타단과 상기 제1 공통 노드 사이에 접속된 제1 스위치 소자; 및
    상기 제1 비공통 전송라인의 타단과 상기 제1 공통 노드 사이에 접속된 제2 스위치 소자;
    를 포함하는 튜너블 인덕터 회로.
  7. 제5항에 있어서, 상기 제2 스위치 회로는
    상기 제2 공통 전송라인의 타단과 상기 제2 단자 사이에 접속된 제1 스위치 소자; 및
    상기 제2 비공통 전송라인의 타단과 상기 제2 단자 사이에 접속된 제2 스위치 소자;
    를 포함하는 튜너블 인덕터 회로.
  8. 제5항에 있어서, 상기 제n 스위치 회로는
    상기 제n 공통 전송라인의 타단과 상기 제2 단자 사이에 접속된 제1 스위치 소자; 및
    상기 제n 비공통 전송라인의 타단과 상기 제2 단자 사이에 접속된 제2 스위치 소자;
    를 포함하는 튜너블 인덕터 회로.
  9. 제5항에 있어서, 상기 제1 내지 제n 공통 전송라인은
    서로 다른 전송 길이를 갖는 튜너블 인덕터 회로.


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