KR20180003374U - Chip package circuit board module - Google Patents

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Abstract

칩 패키지 회로 기판 모듈은 회로 기판 및 오리지널 칩을 포함한다. 회로 기판은 제 1 패드 및 제 1 패드 옆에 배치되어 제 1 패드로부터 떨어져 있는 제 2 패드를 포함한다. 오리지널 칩은 제 1 패드 및 제 2 패드에 연결된다. 오리지널 칩의 폭은 W1이고, 제 1 패드의 전체 폭은 P1이고, 제 2 패드의 전체 폭은 P2이고, 제 1 패드의 전체 폭(P1)은 오리지널 칩의 폭(W1)의 2배보다 크고, 제 2 패드의 전체 폭(P2)은 오리지널 칩의 폭(W1)의 2배보다 크다. The chip package circuit board module includes a circuit board and an original chip. The circuit board includes a first pad and a second pad disposed next to the first pad and remote from the first pad. The original chip is connected to the first pad and the second pad. The total width P1 of the first pad is larger than twice the width W1 of the original chip, and the width of the first pad is W1, the total width of the first pad is P1, the total width of the second pad is P2, , The overall width P2 of the second pad is larger than twice the width W1 of the original chip.

Description

칩 패키지 회로 기판 모듈{CHIP PACKAGE CIRCUIT BOARD MODULE}[0001] CHIP PACKAGE CIRCUIT BOARD MODULE [0002]

본 고안은 회로 기판 모듈에 관한 것이고, 특히 칩 패키지 회로 기판 모듈에 관한 것이다. The present invention relates to circuit board modules, and more particularly to chip package circuit board modules.

일반적으로, 발광 다이오드(LED) 칩의 회로 기판 모듈은 회로 기판 상에 LED 칩을 패키징하는 것이다. 그러나, LED 칩이 손상되고, 패키지가 파손되고, 또는 다른 이유로 LED 칩이 발광할 수 없는 경우, LED 칩을 분해하여 회로 기판 상의 패드를 세정해야 하며, 때때로는 재솔더링할 필요가 있으며, 이 때 새로운 LED 칩이 패키징된다. Generally, a circuit board module of a light emitting diode (LED) chip is to package an LED chip on a circuit board. However, if the LED chip is damaged, the package is broken, or for some other reason the LED chip can not emit light, the LED chip must be disassembled to clean the pad on the circuit board, sometimes requiring re-soldering, A new LED chip is packaged.

그러나, 상술한 재작업 공정은, LED 칩이 박리될 때 회로 기판의 표면 상의 구리선이 함께 박리될 가능성이 있는 문제; 고온 환경 하에서 회로 기판이 예상치 못한 팽창 또는 수축을 일으켜 이것이 회로 기판을 손상시킬 수 있어 회로 기판의 신뢰성을 저하시키지만, LED 칩을 박리하는 공정 시에 고온이 가해질 가능성이 있는 문제; LED 칩이 박리될 때, 회로 기판 상의 패드가 손상될 수 있고, 동일 위치에 패키징된 새로운 LED 칩이 수율 저하의 문제를 가질 수 있다는 문제에 직면할 수 있다. However, the reworking process described above has a problem that the copper wire on the surface of the circuit board may peel off together when the LED chip is peeled off; Unexpected expansion or contraction of the circuit board under a high temperature environment may cause damage to the circuit board, thereby lowering the reliability of the circuit board. However, there is a possibility that a high temperature may be applied in the process of peeling the LED chip; When the LED chip is peeled off, the pad on the circuit board may be damaged, and a new LED chip packaged in the same position may face a problem of yield reduction.

본 고안은 대체 칩이 회로 기판 상에 신속하고 용이하게 구성되어서 높은 수율을 달성하도록 적응된 칩 패키지 회로 기판 모듈에 관한 것이다. The present invention relates to a chip package circuit board module adapted to quickly and easily configure a replacement chip on a circuit board to achieve a high yield.

본 고안은 회로 기판 및 오리지널 칩을 포함하는 칩 패키지 회로 기판 모듈을 제공한다. 회로 기판은 제 1 패드 및 제 2 패드를 포함한다. 제 2 패드는 제 1 패드 옆에 배치되어 제 1 패드로부터 떨어져 있다. 오리지널 칩은 제 1 패드 및 제 2 패드에 연결된다. 오리지널 칩의 폭은 W1이고, 제 1 패드의 전체 폭은 P1이고, 제 2 패드의 전체 폭은 P2이다. 제 1 패드의 전체 폭(P1)은 오리지널 칩의 폭(W1)의 2배보다 크고, 제 2 패드의 전체 폭(P2)은 오리지널 칩의 폭(W1)의 2배보다 크다. The present invention provides a chip package circuit board module comprising a circuit board and an original chip. The circuit board includes a first pad and a second pad. The second pad is disposed next to the first pad and away from the first pad. The original chip is connected to the first pad and the second pad. The width of the original chip is W1, the overall width of the first pad is P1, and the overall width of the second pad is P2. The overall width P1 of the first pad is greater than twice the width W1 of the original chip and the overall width P2 of the second pad is greater than twice the width W1 of the original chip.

본 고안의 일실시형태에 있어서, 제 1 패드의 전체 폭(P1) 및 제 2 패드의 전체 폭(P2)은 각각 오리지널 칩의 폭(W1)의 2.1~2.5배이다. In one embodiment of the present invention, the total width P1 of the first pad and the total width P2 of the second pad are 2.1 to 2.5 times the width W1 of the original chip, respectively.

본 고안의 일실시형태에 있어서, 칩 패키지 회로 기판 모듈은 제 1 패드와 제 2 패드에 오리지널 칩과 평행하게 연결된 N개의 대체 칩을 더 포함하고, 여기서 N≥1이고, 각각의 대체 칩의 폭을 W2, 오리지널 칩과 최근방 대체 칩 사이의 간격을 D라고 하면, P1≥W1+N(W2+D)이고, P2≥W1+N(W2+D)이다. In one embodiment of the present invention, the chip package circuit board module further comprises N replacement chips connected to the first pad and the second pad in parallel with the original chip, wherein N > = 1, (W2 + D) and P2 > = W1 + N (W2 + D), where D is the distance between the original chip and the latest replacement chip.

본 고안의 일실시형태에 있어서, 오리리질 칩과 최근방 대체 칩 사이의 간격(D)은 오리지널 칩의 폭(W1)의 0.1~0.5배이다. In one embodiment of the present invention, the distance D between the orientation chip and the last die replacement chip is 0.1 to 0.5 times the width W1 of the original chip.

본 고안의 일실시형태에 있어서, 제 1 패드는 서로 연결된 복수의 제 1 분기부를 포함하고, 제 2 패드는 서로 연결된 복수의 제 2 분기부를 포함하고, 오리지널 칩이 제 1 패드에 연결된 위치는 제 1 분기부 중 하나이고, 오리지널 칩이 제 2 패드에 연결된 위치는 제 2 분기부 중 하나이고, 제 1 패드의 전체 폭(P1)은 제 1 분기부의 폭의 총합이며, 제 2 패드의 전체 폭(P2)은 제 2 분기부의 폭의 총합이다. In one embodiment of the present invention, the first pad includes a plurality of first branch portions connected to each other, the second pad includes a plurality of second branch portions connected to each other, and a position where the original chip is connected to the first pad, Wherein the first chip is one of the first branch portions and the original chip is connected to the second pad is one of the second branch portions, the entire width (P1) of the first pad is the sum of the widths of the first branch portions, (P2) is the sum of the widths of the second branch portions.

본 고안의 일실시형태에 있어서, 칩 패키지 회로 기판 모듈은 제 1 분기부 중 다른 하나 및 제 2 분기부 중 다른 하나에 연결된 대체 칩을 더 포함한다. In an embodiment of the present invention, the chip package circuit module further comprises a replacement chip coupled to the other of the first branch and to the other of the second branch.

본 고안의 일실시형태에 있어서, 제 2 패드는 서로 연결된 복수의 제 2 분기부를 포함하고, 오리지널 칩이 제 2 패드에 연결된 위치는 제 2 분기부 중 하나이며, 제 2 패드의 전체 폭(P2)은 제 2 분기부의 폭의 총합이다. In one embodiment of the present invention, the second pad comprises a plurality of second branches connected to each other, the location where the original chip is connected to the second pad is one of the second branches, and the overall width of the second pad, P2 ) Is the sum of the widths of the second branch portions.

본 고안의 일실시형태에 있어서, 칩 패키지 회로 기판 모듈은 제 1 패드 및 제 2 분기부 중 다른 하나에 연결된 대체 칩을 더 포함한다. In one embodiment of the present invention, the chip package circuit module further comprises a replacement chip coupled to the other of the first pad and the second branch.

상기 설명에 따르면, 본 고안의 칩 패키지 회로 기판 모듈에 있어서, 회로 기판의 제 1 패드의 전체 폭(P1)을 오리지널 칩의 폭(W1)의 2배보다 크게 설계하고, 제 2 패드의 전체 폭(P2)을 오리지널 칩의 폭(W1)의 2배보다 크게 설계함으로써, 오리지널 칩이 작동할 수 없을 때, 대체 칩을 오리지널 칩 바로 옆에 구성하여 제 1 패드와 제 2 패드를 연결할 수 있다. 즉, 제 1 패드와 제 2 패드는 각각 대체 칩을 연결시키기 위한 폭을 유지한다. 이렇게 해서, 재작업 시에 오리지널 칩을 분해할 필요가 필요가 없어 재작업의 작업 절차가 효과적으로 간단화된다. According to the above description, in the chip package circuit board module of the present invention, the entire width P1 of the first pad of the circuit board is designed to be larger than twice the width W1 of the original chip, (P2) is designed to be larger than twice the width (W1) of the original chip, when the original chip can not be operated, the replacement chip can be arranged next to the original chip to connect the first pad and the second pad. That is, the first pad and the second pad maintain a width for connecting the replacement chip, respectively. In this way, there is no need to disassemble the original chip during rework, and the rework work procedure is effectively simplified.

본 고안의 상술한 또한 그 외 특징 및 이점을 이해할 수 있게 하기 위해 도면을 수반하는 몇몇 예시적인 실시형태가 이하에 상세히 설명된다. BRIEF DESCRIPTION OF THE DRAWINGS Some illustrative embodiments involving the drawings are described in detail below in order to provide a better understanding of the above and other features and advantages of the present invention.

첨부 도면은 본 고안의 추가적인 이해를 제공하기 위해 포함되며, 본 명세서에 통합되어 본 명세서의 일부를 구성한다. 도면은 본 고안의 실시형태를 도시하고, 설명과 함께 본 고안의 원리를 설명한다.
도 1은 본 고안의 일실시형태에 따른 칩 패키지 회로 기판 모듈의 개략도이다.
도 2는 본 고안의 다른 실시형태에 따른 칩 패키지 회로 기판 모듈의 개략도이다.
도 3은 본 고안의 다른 실시형태에 따른 칩 패키지 회로 기판 모듈의 개략도이다.
도 4는 본 고안의 다른 실시형태에 따른 칩 패키지 회로 기판 모듈의 개략도이다.
The accompanying drawings are included to provide a further understanding of the invention and are incorporated in and constitute a part of this specification. The drawings illustrate embodiments of the present invention, together with the description, together with the principles of the present invention.
1 is a schematic diagram of a chip package circuit board module according to an embodiment of the present invention;
2 is a schematic view of a chip package circuit board module according to another embodiment of the present invention;
3 is a schematic view of a chip package circuit board module according to another embodiment of the present invention;
4 is a schematic view of a chip package circuit board module according to another embodiment of the present invention.

도 1은 본 고안의 일실시형태에 따른 칩 패키지 회로 기판 모듈의 개략도이다. 도 1을 참조하면, 본 실시형태의 칩 패키지 회로 기판 모듈(100)은 회로 기판(110) 및 복수의 오리지널 칩(120)을 포함한다. 회로 기판(110)은 복수의 제 1 패드(112) 및 복수의 제 2 패드(115)를 포함한다. 본 실시형태에 있어서, 오리지널 칩(120)은 예를 들면, 발광 다이오드(LED) 칩이지만, 오리지널 칩(120)의 형태는 이것에 한정되지 않는다. 또한, 본 실시형태에 있어서, 오리지널 칩(120), 제 1 패드(112) 및 제 2 패드(115)의 수는 예를 들면, 각각 3개이지만, 오리지널 칩(120), 제 1 패드(112) 및 제 2 패드(115)의 수는 이것에 한정되지 않는다. 도 1에 따르면, 제 1 패드(112)는 연결부(111)를 통해 연결되지만, 다른 실시형태에 있어서 제 1 패드(112)는 실제 필요에 따라 서로 떨어져 있을 수도 있다. 1 is a schematic diagram of a chip package circuit board module according to an embodiment of the present invention; Referring to FIG. 1, a chip package circuit board module 100 according to the present embodiment includes a circuit board 110 and a plurality of original chips 120. The circuit board 110 includes a plurality of first pads 112 and a plurality of second pads 115. In the present embodiment, the original chip 120 is, for example, a light emitting diode (LED) chip, but the form of the original chip 120 is not limited to this. In this embodiment, the number of the original chip 120, the first pad 112, and the second pad 115 are three, for example. However, the number of the original chip 120, the first pad 112 And the number of the second pads 115 are not limited to this. According to FIG. 1, the first pads 112 are connected through the connecting portion 111, but in other embodiments, the first pads 112 may be spaced apart from each other as needed.

제 2 패드(115)는 각각 제 1 패드(112) 옆에 배치되어 제 1 패드(112)로부터 떨어져 있다. 도 1에 나타내어진 바와 같이, 각각의 오리지널 칩(120)은 상응하는 제 1 패드(112) 및 상응하는 제 2 패드(115)에 연결되고, 여기서 오리지널 칩(120)의 폭은 W1이고, 제 1 패드(112)의 폭은 P1이고, 제 2 패드(115)의 폭은 P2이다. 도 1에 따르면, 제 1 패드(112)의 폭(P1)이 오리지널 칩(120)의 폭(W1)의 2배보다 크고, 제 2 패드(115)의 폭(P2)이 오리지널 칩(120)의 폭(W1)의 2배보다 큰 것이 알려져 있다. The second pads 115 are disposed next to the first pads 112 and away from the first pads 112, respectively. As shown in Figure 1, each original chip 120 is connected to a corresponding first pad 112 and a corresponding second pad 115, wherein the width of the original chip 120 is W1, The width of one pad 112 is P1 and the width of the second pad 115 is P2. 1, the width P1 of the first pad 112 is larger than twice the width W1 of the original chip 120, and the width P2 of the second pad 115 is larger than the width W1 of the original chip 120, Is larger than twice the width W1 of the electrode terminal portion.

어떤 상태에서, 오리지널 칩(120)이 작동할 수 없다면, 칩 패키지 회로 기판 모듈(100)을 보수할 필요가 있다. 본 실시형태에 있에서, 제 1 패드(112) 및 제 2 패드(115)는 각각 대체 칩(130)을 연결시키기 위한 폭을 유지한다. 따라서, 메인터넌스 시에 오리지널 칩(120)이 분해될 필요없이 보수원이 제 1 패드(112)와 제 2 패드(115)를 연결시키기 위한 오리지널 칩(120) 바로 옆에 대체 칩(130)을 배치하여 재작업의 작업 절차를 효과적으로 간단화할 수 있다.In some situations, if the original chip 120 can not operate, then the chip package circuit module 100 needs to be repaired. In this embodiment, the first pad 112 and the second pad 115 maintain a width for connecting the replacement chip 130, respectively. Therefore, the replacement chip 130 is disposed immediately beside the original chip 120 for connecting the first pad 112 and the second pad 115 to each other without requiring the original chip 120 to be disassembled at the time of maintenance So that the work procedure of the reworking can be effectively simplified.

본 실시형태에 있어서, 칩 패키지 회로 기판 모듈(100)은 제 1 패드(112)와 제 2 패드(115)에 오리지널 칩(120)과 평행하게 연결되는 대체 칩(130)을 포함해도 좋다. 도 1에 있어서, 제 1 패드(112), 제 2 패드(115) 및 오리지널 칩(120)의 폭 관계를 개략적으로 나타내기 위해서, 오리지널 칩(120)은 실선으로 나타내어지고, 대체 칩(130)은 점선으로 나타내어진다. 따라서, 도 1에 있어서, 대체 칩(130)의 수는 오리지널 칩(120)의 수와 동일할 수 있다. 즉, 오리지널 칩(120)을 전기적으로 연결하는데 사용되는 각각의 제 1 패드(112) 및 각각의 제 2 패드(115)는 대체 칩(130)을 연결시키기 위한 위치를 유지한다. The chip package circuit board module 100 may include a replacement chip 130 connected to the first pad 112 and the second pad 115 in parallel with the original chip 120. In this case, 1, the original chip 120 is shown by a solid line in order to schematically show the width relationship between the first pad 112, the second pad 115, and the original chip 120, Is represented by a dotted line. Therefore, in FIG. 1, the number of replacement chips 130 may be equal to the number of original chips 120. That is, each of the first pads 112 and each second pad 115 used for electrically connecting the original chip 120 maintains a position for connecting the replacement chip 130.

또한, 향후에 대체 칩(130)을 연결시키기 위한 제 1 패드(112) 및 제 2 패드(115)에 의해 유지된 위치는 1개보다 많을 수 있다. 예를 들면, 향후에 대체 칩(130)을 연결시키기 위한 제 1 패드(112) 및 제 2 패드(115)에 의해 유지된 위치는 2개 이상일 수 있다. 제 1 패드(112)의 폭(P1) 및 제 2 패드(115)의 폭(P2)은 제 1 패드(112) 및 제 2 패드(115)에 연결될 대체 칩(130)의 수에 따라 조정될 수 있다. In addition, there may be more than one position held by the first pad 112 and the second pad 115 for connecting the alternative chip 130 in the future. For example, there may be two or more positions held by the first pad 112 and the second pad 115 for connecting the replacement chip 130 in the future. The width P1 of the first pad 112 and the width P2 of the second pad 115 may be adjusted according to the number of the replacement chips 130 to be connected to the first pad 112 and the second pad 115 have.

제 1 패드(112) 및 제 2 패드(115)에 연결될 대체 칩(130)의 수를 N이라고 하면, 여기서 N≥1이고, 각각의 대체 칩(130)의 폭은 W2이다. 작동을 용이하게 하고 2개의 칩의 마찰을 방지하기 위해 모든 2개의 인접한 칩 사이에 칩 삽입 간격이 유지되어야 하며, 오리지널 칩(120)과 최근방 대체 칩(130) 사이의 간격을 D라고 가정하면, P1≥W1+N(W2+D)이고, P2≥W1+N(W2+D)이다. 즉, 제 1 패드(112)의 폭(P1)은 오리지널 칩(120)의 폭(W1)에, 향후에 연결될 수 있는 대체 칩(130)의 폭(W2)과 2개의 인접한 칩 사이의 간격(D)을 합한 것의 N배를 더한 것보다 크거나 같다. 마찬가지로, 제 2 패드(115)의 폭(P2)은 오리지널 칩(120)의 폭(W1)에, 향후에 연결될 수 있는 대체 칩(130)의 폭(W2)과 2개의 인접한 칩 사이의 간격(D)을 합한 것의 N배를 더한 것보다 크거나 같다. Assuming that the number of replacement chips 130 to be connected to the first pad 112 and the second pad 115 is N, N > = 1, and the width of each of the replacement chips 130 is W2. Assuming that the chip insertion interval should be maintained between all two adjacent chips to facilitate operation and prevent friction between the two chips and that the spacing between the original chip 120 and the recent replacement chip 130 is D , P1? W1 + N (W2 + D) and P2? W1 + N (W2 + D). That is, the width P1 of the first pad 112 corresponds to the width W1 of the original chip 120, the width W2 of the replacement chip 130 that can be connected in the future, D) plus N times the sum. The width P2 of the second pad 115 corresponds to the width W1 of the original chip 120 and the width W2 of the replacement chip 130 that can be connected in the future and the interval W2 between the two adjacent chips D) plus N times the sum.

본 실시형태에 있어서, 오리지널 칩(120)과 최근방 대체 칩(130) 사이의 간격(D)은 오리지널 칩의 폭(W1) 또는 대체 칩(130)의 폭(W2)의 0.1~0.5배이다. 따라서, 하나의 대체 칩(130)만을 연결시키기에 적합한 제 1 패드(112)의 폭(P1) 및 제 2 패드(115)의 폭(P2)에 관하여, 제 1 패드(112)의 폭(P1) 및 제 2 패드(115)의 폭(P2)은 각각 오리지널 칩(120)의 폭(W1)의 2.1~2.5배이다. 물론, 설계자는 실제 필요에 따라 간격(D)의 크기 및 회로 기판(110) 상의 공간적 구성을 조정해도 좋고, 간격(D)의 크기는 이것에 한정되지 않는다. The distance D between the original chip 120 and the recent replacement chip 130 is 0.1 to 0.5 times the width W1 of the original chip or the width W2 of the replacement chip 130 . The width P1 of the first pad 112 and the width P2 of the second pad 115 that are suitable for connecting only one replacement chip 130 and the width P1 of the first pad 112 And the width P2 of the second pad 115 are 2.1 to 2.5 times the width W1 of the original chip 120, respectively. Of course, the designer may adjust the size of the space D and the spatial configuration on the circuit board 110 according to actual needs, and the size of the space D is not limited to this.

도 1에 있어서, 회로 기판(110)은 각각 상부, 하부 및 중간부에 위치되는 제 1 패드(112)와 제 2 패드(115)의 3개의 세트를 갖지만, 상이한 세트의 제 1 패드(112)의 폭이 동일하고, 상이한 세트의 제 2 패드(115)의 폭이 동일하며, 다른 실시형태에 있어서는 상이한 세트의 제 1 패드(112)의 폭이 다를 수도 있고, 상이한 세트의 제 2 패드(115)의 폭이 다를 수도 있다는 것을 주의해야 한다. 1, the circuit board 110 has three sets of first pad 112 and second pad 115 located at the top, bottom and middle, respectively, but with a different set of first pads 112, The widths of the different sets of second pads 115 are the same and in other embodiments the widths of the different sets of first pads 112 may be different and the different sets of second pads 115 ) May vary in width.

다른 패턴의 칩 패키지 회로 기판 모듈은 이하에 설명되고, 이하의 실시형태에 있어서 상술한 실시형태와 동일하거나 유사한 구성요소는 동일 참조번호로 나타내어지고, 그 상세는 생략하여 상이한 실시형태 간의 차이점만이 기재된다. The chip package circuit board module of another pattern will be described below, and in the following embodiments, the same or similar components as those of the above-described embodiment are denoted by the same reference numerals, and the details thereof are omitted and only differences between the different embodiments .

도 2는 본 고안의 다른 실시형태에 따른 칩 패키지 회로 기판 모듈의 개략도이다. 도 2를 참조하면, 도 2의 칩 패키지 회로 기판 모듈(100a)과 도 1의 칩 패키지 회로 기판 모듈(100) 사이의 주된 차이점은 본 실시형태의 제 1 패드(112a)와 제 2 패드(115a)의 형태 및 배치 위치가 다르다는 것이다. 마찬가지로, 본 실시형태의 칩 패키지 회로 기판 모듈(100a)에 있어서, 회로 기판(110)의 제 1 패드(112a)는 오리지널 칩(120)의 폭(W1)의 2배보다 큰 폭(P1)을 채용하고, 제 2 패드(115a)는 오리지널 칩(120)의 폭(W1)의 2배보다 큰 폭(P2)을 채용하고, 오리지널 칩(120)이 작동할 수 없을 때, 오리지널 칩(120)을 분해할 필요는 없지만, 제 1 패드(112a) 및 제 2 패드(115a)가 충분한 폭(P1 및 P2)을 유지하는 한, 대체 칩(130)을 제 1 패드(112a) 및 제 2 패드(115a)에 직접 연결시켜 오리지널 칩(120)을 대체해서 작동시킬 수 있고, 제 1 패드(112a) 및 제 2 패드(115a)의 형태 및 배치 위치는 이것에 한정되지 않는다. 2 is a schematic view of a chip package circuit board module according to another embodiment of the present invention; 2, the main difference between the chip package circuit module 100a of FIG. 2 and the chip package circuit module 100 of FIG. 1 is that the first pad 112a and the second pad 115a ) Are different in shape and arrangement position. Similarly, in the chip package circuit board module 100a of the present embodiment, the first pad 112a of the circuit board 110 has a width P1 larger than twice the width W1 of the original chip 120 And the second pad 115a employs a width P2 larger than twice the width W1 of the original chip 120 and the original chip 120 can not operate. It is not necessary to disassemble the replacement chip 130 with the first pad 112a and the second pad 115a so long as the first pad 112a and the second pad 115a hold sufficient widths P1 and P2, 115a to replace and operate the original chip 120. The shapes and arrangement positions of the first pad 112a and the second pad 115a are not limited thereto.

도 3은 본 고안의 다른 실시형태에 따른 칩 패키지 회로 기판 모듈의 개략도이다. 도 3을 참조하면, 상부, 하부 및 중간부에 위치된 제 1 패드(212)와 제 2 패드(215)의 3개의 세트가 나타내어져 있고, 도 3의 칩 패키지 회로 기판 모듈(200)과 도 1의 칩 패키지 회로 기판 모듈(100) 사이의 주된 차이점은 본 실시형태에 있어서, 각각의 제 1 패드(212)는 서로 연결된 복수의 제 1 분기부(213)를 포함하고, 각각의 제 2 패드(215)는 서로 연결된 복수의 제 2 분기부(216)를 포함한다는 것이다. 제 1 패드(212)의 전체 폭은 제 1 분기부(213)의 폭(B1)의 총합이고, 제 2 패드(215)의 전체 폭은 제 2 분기부(216)의 폭(B2)의 총합이다. 각각의 제 1 분기부(213)의 폭(B1) 및 각각의 제 2 분기부(216)의 폭(B2)은 오리지널 칩(120)의 폭(W1)보다 크거나 같고, 대체 칩(130)의 폭(W2)보다 크거나 같다. 3 is a schematic view of a chip package circuit board module according to another embodiment of the present invention; 3, three sets of the first pad 212 and the second pad 215 located at the upper, lower and middle portions are shown, and the chip package circuit module 200 The first difference between chip package circuit board modules 100 is that in this embodiment each first pad 212 includes a plurality of first branch portions 213 connected to each other, (215) includes a plurality of second branch portions (216) connected to each other. The total width of the first pad 212 is the sum of the width B1 of the first branch 213 and the total width of the second pad 215 is the sum of the width B2 of the second branch 216 to be. The width B1 of each first branch 213 and the width B2 of each second branch 216 are greater than or equal to the width W1 of the original chip 120, Is equal to or greater than the width W2.

보다 구체적으로, 도 3의 제 1 패드(212)의 3개의 세트에 있어서, 각각의 제 1 패드(212)는 서로 연결된 2개의 제 1 분기부(213)를 포함하고, 각각의 제 2 패드(215)는 서로 연결된 2개의 제 2 분기부(216)를 포함한다. 오리지널 칩(120)이 제 1 패드(212)에 연결되는 위치는 제 1 분기부(213) 중 하나이고, 오리지널 칩(120)이 제 2 패드(215)에 연결되는 위치는 제 2 분기부(216) 중 하나이고, 오리지널 칩(120)이 작동할 수 없을 때, 오리지널 칩(120)을 분해할 필요는 없지만, 대체 칩(130)을 다른 제 1 분기부(213) 및 다른 제 2 분기부(216)에 직접 연결할 수 있다. 물론, 각각의 제 1 패드(212)의 제 1 분기부(213)의 수는 2개로 한정되지 않고, 각각의 제 2 패드(215)의 제 2 분기부(216)의 수도 2개로 한정되지 않으며, 다른 실시형태에 있어서 각각의 제 1 패드(212)의 제 1 분기부(213)의 수 및 각각의 제 2 패드(215)의 제 2 분기부(216)의 수는 3개 이상일 수 있고, 이는 회로 기판(110) 상의 공간 및 유지될 대체 칩(130)의 수에 따라 결정된다. More specifically, in the three sets of first pads 212 of FIG. 3, each first pad 212 includes two first branches 213 connected to each other, and each second pad 212 215 includes two second branches 216 connected to each other. The position where the original chip 120 is connected to the first pad 212 is one of the first branch portions 213 and the position where the original chip 120 is connected to the second pad 215 is the second branch portion It is not necessary to disassemble the original chip 120 when the original chip 120 can not operate, but the replacement chip 130 may be replaced with another first branch 213 and another second branch 213. In this case, (216). Of course, the number of the first branch portions 213 of each first pad 212 is not limited to two, and the number of the second branch portions 216 of each second pad 215 is not limited to two The number of first branch portions 213 of each first pad 212 and the number of second branch portions 216 of each second pad 215 may be three or more in another embodiment, This is determined by the space on the circuit board 110 and the number of replacement chips 130 to be maintained.

도 4는 본 고안의 다른 실시형태에 따른 칩 패키지 회로 기판 모듈의 개략도이다. 도 4를 참조하면, 도 4의 칩 패키지 회로 기판 모듈(200a)의 제 1 패드(212a) 및 제 2 패드(215a)의 구성은 도 2의 칩 패키지 회로 기판 모듈(100a)의 제 1 패드(112a) 및 제 2 패드(115a)의 구성과 유사하다. 도 4의 칩 패키지 회로 기판 모듈(200a)과 도 2의 칩 패키지 회로 기판 모듈(100a) 사이의 주된 차이점은 제 2 패드(215a)가 서로 연결된 복수의 제 2 분기부(216a)를 포함한다는 것이고, 오리지널 칩(120)은 제 1 패드(212a)에 연결되고, 오리지널 칩(120)이 제 2 패드(215a)에 연결되는 위치는 제 2 분기부(216a) 중 하나이고, 제 2 패드(215a)의 전체 폭은 제 2 분기부(216a)의 폭(B2)의 총합이다. 마찬가지로, 오리지널 칩(120)이 작동할 수 없을 때, 오리지널 칩(120)을 분해할 필요는 없지만, 대체 칩(130)을 제 1 패드(212a) 및 다른 제 2 분기부(216a)에 직접 연결할 수 있어 대체 칩(130)은 오리지널 칩(120)을 대체하여 작동할 수 있다. 4 is a schematic view of a chip package circuit board module according to another embodiment of the present invention. 4, the configuration of the first pad 212a and the second pad 215a of the chip package circuit board module 200a of FIG. 4 is the same as that of the first pad 212a of the chip package circuit module 100a of FIG. 112a and the second pad 115a. The main difference between the chip package circuit module 200a of FIG. 4 and the chip package circuit module 100a of FIG. 2 is that the second pad 215a includes a plurality of second branch portions 216a connected to each other The original chip 120 is connected to the first pad 212a and the position where the original chip 120 is connected to the second pad 215a is one of the second branch portions 216a and the second pad 215a Is the total of the width B2 of the second branch portion 216a. Likewise, when the original chip 120 can not operate, it is not necessary to disassemble the original chip 120, but the alternative chip 130 may be connected directly to the first pad 212a and the other second branch 216a And the replacement chip 130 can operate by replacing the original chip 120.

또한, 도 4의 칩 패키지 회로 기판 모듈(200a)을 도 3의 칩 패키지 회로 기판 모듈(200)과 비교했을 때, 제 1 패드(212a)는 임의의 분기부를 갖지 않고, 다른 실시형태에 있어서 제 1 패드(212)가 도 3의 실시형태와 유사한 제 1 분기부(213)를 갖고 제 2 패드(115a)가 도 2의 실시형태와 유사한 임의의 분기부를 갖지 않는 조합이 채용될 수도 있고, 제 1 패드(212a) 및 제 2 패드(215a)의 형태는 제 1 패드(212a)의 전체 폭이 오리지널 칩(120)의 폭(W1)의 2배보다 크고, 제 2 패드(215a)의 전체 폭이 오리지널 칩(120)의 폭(W1)의 2배보다 크고, 제 1 패드 및 제 2 패드(212a 및 215a)가 오리지널 칩(120) 및 대체 칩(130)을 연결시키기에 적합하기만 하면 상술한 설명에 한정되지 않는다. 3, the first pad 212a does not have any branch portion, and in the other embodiment, the first package substrate 200a is not provided with any branch portion, A combination in which one pad 212 has a first branch 213 similar to the embodiment of Fig. 3 and the second pad 115a does not have any branch similar to the embodiment of Fig. 2 may be employed, The first pad 212a and the second pad 215a may be formed so that the entire width of the first pad 212a is greater than twice the width W1 of the original chip 120, Is greater than twice the width W1 of the original chip 120 and the first and second pads 212a and 215a are suitable for connecting the original chip 120 and the replacement chip 130, It is not limited to one explanation.

요약하면, 본 고안의 칩 패키지 회로 기판 모듈에 있어서 회로 기판의 제 1 패드의 전체 폭(P1)을 오리지널 칩의 폭(W1)의 2배보다 크게 설계하고, 제 2 패드의 전체 폭(P2)을 오리지널 칩의 폭(W1)의 2배보다 크게 설계함으로써 오리지널 칩이 작동할 수 없을 때, 대체 칩을 오리지널 칩 바로 옆에 구성하여 제 1 패드와 제 2 패드를 연결할 수 있다. 즉, 제 1 패드 및 제 2 패드는 각각 대체 칩을 연결시키기 위한 폭을 유지한다. 이렇게 해서, 재작업 시에 오리지널 칩을 분해할 필요가 없어 재작업의 작업 절차를 효과적으로 간단화할 수 있다. In summary, in the chip package circuit board module according to the present invention, the entire width P1 of the first pad of the circuit board is designed to be larger than twice the width W1 of the original chip, Is designed to be larger than twice the width W1 of the original chip, the replacement chip can be arranged next to the original chip so that the first pad and the second pad can be connected. That is, the first pad and the second pad maintain a width for connecting the replacement chip, respectively. In this way, since it is not necessary to disassemble the original chip at the time of rework, the rework work procedure can be effectively simplified.

본 고안의 범위 또는 정신으로부터 벗어나는 일 없이 본 고안의 구조에 다양한 수정 및 변경이 이루어질 수 있음은 당업자에 의해 명백해질 것이다. 상술한 관점에서, 본 고안은 이하의 특허청구범위 및 그 등가물의 범위 내에서 본 고안의 수정 및 변경을 다루는 것으로 의도된다. It will be apparent to those skilled in the art that various modifications and variations can be made in the structure of the present invention without departing from the scope or spirit of the invention. In view of the foregoing, this invention is intended to cover modifications and variations of the present invention within the scope of the following claims and their equivalents.

Claims (8)

제 1 패드; 및
제 1 패드 옆에 배치되어 제 1 패드로부터 떨어져 있는 제 2 패드를 포함하는 회로 기판,
제 1 패드와 제 2 패드에 연결되는 오리지널 칩을 포함하는 칩 패키지 회로 기판 모듈로서:
상기 오리지널 칩의 폭은 W1이고, 상기 제 1 패드의 전체 폭은 P1이고, 상기 제 2 패드의 전체 폭은 P2이고, 상기 제 1 패드의 전체 폭(P1)은 상기 오리지널 칩의 폭(W1)의 2배보다 크고, 상기 제 2 패드의 전체 폭(P2)은 상기 오리지널 칩의 폭(W1)의 2배보다 큰 칩 패키지 회로 기판 모듈.
A first pad; And
A circuit board disposed next to the first pad and including a second pad spaced from the first pad,
A chip package circuit board module comprising an original chip connected to a first pad and a second pad, the module comprising:
Wherein the width of the original chip is W1, the overall width of the first pad is P1, the overall width of the second pad is P2, the overall width of the first pad is the width W1 of the original chip, And the overall width (P2) of the second pad is greater than twice the width (W1) of the original chip.
제 1 항에 있어서,
상기 제 1 패드의 전체 폭(P1) 및 상기 제 2 패드의 전체 폭(P2)은 각각 상기 오리지널 칩의 폭(W1)의 2.1~2.5배인 칩 패키지 회로 기판 모듈.
The method according to claim 1,
Wherein a total width (P1) of the first pad and a total width (P2) of the second pad are 2.1 to 2.5 times the width (W1) of the original chip, respectively.
제 1 항에 있어서,
상기 제 1 패드 및 상기 제 2 패드에 상기 오리지널 칩과 평행하게 연결된 N개의 대체 칩을 더 포함하고, 여기서 N≥1이고, 상기 각각의 대체 칩의 폭을 W2, 상기 오리지널 칩과 최근방 대체 칩 사이의 간격을 D라고 하면, P1≥W1+N(W2+D)이고, P2≥W1+N(W2+D)인 칩 패키지 회로 기판 모듈.
The method according to claim 1,
Further comprising N alternative chips connected to the first pad and the second pad in parallel with the original chip, wherein N > = 1, the width of each of the alternative chips being W2, (W2 + D) and P2 > = W1 + N (W2 + D).
제 3 항에 있어서,
상기 오리지널 칩과 최근방 대체 칩 사이의 간격(D)은 상기 오리지널 칩의 폭(W1)의 0.1~0.5배인 칩 패키지 회로 기판 모듈.
The method of claim 3,
Wherein an interval (D) between the original chip and the latest flash replacement chip is 0.1 to 0.5 times the width (W1) of the original chip.
제 1 항에 있어서,
상기 제 1 패드는 서로 연결된 복수의 제 1 분기부를 포함하고, 상기 제 2 패드는 서로 연결된 복수의 제 2 분기부를 포함하고, 상기 오리지널 칩이 상기 제 1 패드에 연결되는 위치는 상기 제 1 분기부 중 하나이고, 상기 오리지널 칩이 상기 제 2 패드에 연결되는 위치는 상기 제 2 분기부 중 하나이며, 상기 제 1 패드의 전체 폭(P1)은 상기 제 1 분기부의 폭의 총합이고, 상기 제 2 패드의 전체 폭(P2)은 상기 제 2 분기부의 폭의 총합인 칩 패키지 회로 기판 모듈.
The method according to claim 1,
The first pad includes a plurality of first branch portions connected to each other, and the second pad includes a plurality of second branch portions connected to each other, and a position where the original chip is connected to the first pad, Wherein a position at which the original chip is connected to the second pad is one of the second branch portions, the entire width (P1) of the first pad is a total of the widths of the first branch portions, Wherein a total width (P2) of the pad is a sum of the widths of the second branch portions.
제 5 항에 있어서,
상기 제 1 분기부 중 다른 하나 및 상기 제 2 분기부 중 다른 하나에 연결된 대체 칩을 더 포함하는 칩 패키지 회로 기판 모듈.
6. The method of claim 5,
Further comprising a replacement chip coupled to the other of the first branch and to the other of the second branch.
제 1 항에 있어서,
상기 제 2 패드는 서로 연결된 복수의 제 2 분기부를 포함하고, 상기 오리지널 칩이 상기 제 2 패드에 연결된 위치는 상기 제 2 분기부 중 하나이고, 상기 제 2 패드의 전체 폭(P2)은 상기 제 2 분기부의 폭의 총합인 칩 패키지 회로 기판 모듈.
The method according to claim 1,
Wherein the second pad comprises a plurality of second branches connected to each other, a position where the original chip is connected to the second pad is one of the second branches, and an overall width (P2) Chip package circuit board module that is the sum of the widths of the two branches.
제 7 항에 있어서,
상기 제 1 패드 및 상기 제 2 분기부 중 다른 하나에 연결된 대체 칩을 더 포함하는 칩 패키지 회로 기판 모듈.
8. The method of claim 7,
Further comprising a replacement chip coupled to the other of the first pad and the second branch.
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