KR20160007758A - Organic Light Emitting Display For Compensating Distortion Of Reference Voltage - Google Patents

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Abstract

According to the present invention, an organic light emitting display device comprises: a display panel which has a plurality of pixels individually including an organic light emitting diode (OLED) in which the amount of light emission is controlled by the voltage difference between data voltage applied to a gate electrode of a driving element and reference voltage applied to a source electrode of the driving element, a plurality of reference voltage supply lines for supplying reference voltage to the pixels, and a feedback line connected to at least any one of the reference voltage supply lines through a compensation switching unit; a reference voltage compensation circuit which generates a compensated reference voltage signal by compensating a feedback reference voltage signal inputted from the feedback line based on preset reference voltage; and a data driving circuit which supplies the compensated reference voltage signal to the reference voltage supply lines.

Description

기준전압 왜곡을 보상할 수 있는 유기발광 표시장치{Organic Light Emitting Display For Compensating Distortion Of Reference Voltage}BACKGROUND OF THE INVENTION 1. Field of the Invention [0001] The present invention relates to an organic light-

본 발명은 유기발광 표시장치에 관한 것으로, 특히 기준전압 왜곡을 보상할 수 있는 유기발광 표시장치에 관한 것이다.
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to an organic light emitting display, and more particularly, to an organic light emitting display capable of compensating for a reference voltage distortion.

액티브 매트릭스 타입의 유기발광 표시장치는 스스로 발광하는 유기발광다이오드(Organic Light Emitting Diode: 이하, "OLED"라 함)를 포함하며, 응답속도가 빠르고 발광효율, 휘도 및 시야각이 큰 장점이 있다. The active matrix type organic light emitting display device includes an organic light emitting diode (OLED) which emits light by itself, has a high response speed, and has a high luminous efficiency, luminance, and viewing angle.

자발광 소자인 OLED는 애노드전극 및 캐소드전극과, 이들 사이에 형성된 유기 화합물층(HIL, HTL, EML, ETL, EIL)을 포함한다. 유기 화합물층은 정공주입층(Hole Injection layer, HIL), 정공수송층(Hole transport layer, HTL), 발광층(Emission layer, EML), 전자수송층(Electron transport layer, ETL) 및 전자주입층(Electron Injection layer, EIL)으로 이루어진다. 애노드전극과 캐소드전극에 구동전압이 인가되면 정공수송층(HTL)을 통과한 정공과 전자수송층(ETL)을 통과한 전자가 발광층(EML)으로 이동되어 여기자를 형성하고, 그 결과 발광층(EML)이 가시광을 발생하게 된다. The organic light emitting diode (OLED) includes an anode electrode, a cathode electrode, and organic compound layers (HIL, HTL, EML, ETL, EIL) formed therebetween. The organic compound layer includes a hole injection layer (HIL), a hole transport layer (HTL), an emission layer (EML), an electron transport layer (ETL), and an electron injection layer EIL). When a driving voltage is applied to the anode electrode and the cathode electrode, holes passing through the HTL and electrons passing through the ETL are transferred to the EML to form excitons, Thereby generating visible light.

유기발광 표시장치는 OLED를 각각 포함한 픽셀들을 매트릭스 형태로 배열하고 비디오 데이터의 계조에 따라 픽셀들의 휘도를 조절한다. 픽셀들 각각은 OLED에 흐르는 구동전류를 제어하기 위해 구동 TFT(Thin Film Transistor)를 포함한다. 그런데, 유기발광 표시장치에서는 공정 편차, 경시적 변화 등의 이유로 픽셀들 간 구동 TFT의 전기적 특성(문턱전압, 전자 이동도)에 편차가 생겨 화상 품위가 저하되는 문제가 있다.The OLED display arranges pixels each including an OLED in a matrix form and adjusts the brightness of the pixels according to the gradation of the video data. Each of the pixels includes a driving TFT (Thin Film Transistor) for controlling the driving current flowing in the OLED. However, in the organic light emitting display device, there is a problem that the electrical characteristics (threshold voltage, electron mobility) of the driving TFTs between the pixels are varied due to process variations and changes over time, and the image quality is degraded.

이를 해결하기 위하여, 구동 TFT의 전기적 특성 편차를 픽셀 외부에서 보상하는 보상 방식이 알려져 있다. 이 보상 방식은 각 픽셀에 대해 구동 TFT의 전기적 특성 편차를 센싱하고 그 센싱값에 따라 입력 디지털 비디오 데이터를 보정한 후 픽셀에 공급한다. 각 픽셀의 OLED에는 구동 TFT의 게이트전극에 인가되는 보상 데이터전압과 구동 TFT의 소스전극에 인가되는 기준전압 간의 차에 의해 결정되는 구동 전류(Ioled)가 흐르며, 이러한 구동전류에 비례하여 OLED의 발광량이 결정된다.In order to solve this problem, a compensating method for compensating the electrical characteristic deviation of the driving TFT outside the pixel is known. This compensation method senses the electrical characteristic deviation of the driving TFT with respect to each pixel, corrects the input digital video data according to the sensed value, and supplies the corrected pixel to the pixel. A driving current Ioled determined by the difference between the compensated data voltage applied to the gate electrode of the driving TFT and the reference voltage applied to the source electrode of the driving TFT flows in the OLED of each pixel, Is determined.

보상 데이터전압은 데이터라인을 통해 구동 TFT의 게이트전극에 인가되며, 기준전압은 기준전압 공급라인을 통해 구동 TFT의 소스전극에 인가된다. 데이터라인과 기준전압 공급라인은 개별적으로 데이터 구동회로에 연결되며, 특히 기준전압 공급라인은 구동 TFT의 전기적 특성 편차를 센싱할 때 픽셀로부터 획득한 센싱전압을 데이터 구동회로에 전달하는 센싱 라인 역할을 겸한다.The compensation data voltage is applied to the gate electrode of the driving TFT through the data line and the reference voltage is applied to the source electrode of the driving TFT through the reference voltage supply line. The data line and the reference voltage supply line are individually connected to the data driving circuit. In particular, the reference voltage supply line serves as a sensing line for transmitting the sensing voltage obtained from the pixel to the data driving circuit when sensing the electrical characteristic deviation of the driving TFT As well.

기준전압은 구동 TFT의 게이트-소스 간 전압(Vgs)을 결정하는 데 있어 기준이 되는 전압이므로 항상 일정한 레벨로 유지되어야 한다. 하지만, 실제로 기준전압은 일정하게 유지되지 못하고 왜곡되며 그 결과 수평 크로스토크가 초래된다. 구체적으로 설명하면, 표시패널에는 다수의 데이터라인들과 다수의 기준전압 공급라인들이 형성되어 있으며, 특히 데이터라인과 기준전압 공급라인은 서로 인접하게 배치되어 서로 전기적 커플링 영향을 받는다. 즉, 도 1과 같이 원하는 계조 구현을 위해 데이터라인에 공급되는 데이터전압(Vdata)이 변할 때, 기준전압 공급라인 상의 기준전압(VR)도 커플링 영향에 의해 왜곡되게 된다. 이러한 기준전압 왜곡 문제는 오버랩 구동에서 더 커진다. 오버랩 구동시 이전 픽셀 행의 기준전압 변화가 다음 픽셀 행에 그대로 전달되므로, 기준전압 왜곡 문제가 심화되는 것이다.
Since the reference voltage is a reference voltage for determining the gate-source voltage (Vgs) of the driving TFT, it should always be maintained at a constant level. In practice, however, the reference voltage is not maintained constant and is distorted, resulting in horizontal crosstalk. More specifically, a plurality of data lines and a plurality of reference voltage supply lines are formed on the display panel. In particular, the data lines and the reference voltage supply lines are disposed adjacent to each other and are subjected to electrical coupling. That is, as shown in FIG. 1, when the data voltage Vdata supplied to the data line changes for a desired gradation implementation, the reference voltage VR on the reference voltage supply line is also distorted by the coupling effect. This reference voltage distortion problem is larger in the overlap driving. In the overlap driving, since the reference voltage change of the previous pixel row is transferred to the next pixel row as it is, the problem of the reference voltage distortion is intensified.

따라서, 본 발명의 목적은 기준전압 왜곡을 보상할 수 있는 유기발광 표시장치를 제공하는 데 있다.
Accordingly, an object of the present invention is to provide an organic light emitting display device capable of compensating for a reference voltage distortion.

상기 목적을 달성하기 위하여, 본 발명의 실시예에 따른 유기발광 표시장치는 구동소자의 게이트전극에 인가되는 데이터전압과 상기 구동소자의 소스전극에 인가되는 기준전압 간의 전압차에 의해 발광량이 제어되는 OLED를 각각 포함한 다수의 픽셀들과, 상기 픽셀들에 기준전압을 공급하기 위한 다수의 기준전압 공급라인들과, 보상 스위칭부를 통해 상기 기준전압 공급라인들 중 적어도 어느 하나에 연결되는 피드백 라인이 형성된 표시패널; 상기 피드백 라인으로부터 입력되는 피드백 기준전압 신호를 미리 셋팅된 기준전압을 기초로 보상하여 보상 기준전압 신호를 생성하는 기준전압 보상회로; 및 상기 보상 기준전압 신호를 상기 기준전압 공급라인들에 공급하는 데이터 구동회로를 구비한다.
In order to achieve the above object, an OLED display according to an exemplary embodiment of the present invention controls the amount of emitted light by a voltage difference between a data voltage applied to a gate electrode of a driving device and a reference voltage applied to a source electrode of the driving device A plurality of reference voltage supply lines for supplying a reference voltage to the pixels, and a feedback line connected to at least one of the reference voltage supply lines through the compensation switching unit are formed Display panel; A reference voltage compensation circuit for compensating a feedback reference voltage signal input from the feedback line based on a preset reference voltage to generate a compensated reference voltage signal; And a data driving circuit for supplying the compensated reference voltage signal to the reference voltage supply lines.

본 발명은 기준전압 보상회로를 채용하고, 외부 보상 방식에 맞게 보상 스위칭부와 피드백 라인을 포함한 패널 어레이를 적절히 설계하여 기준전압 왜곡을 효과적으로 보상함으로써, 표시 품위를 크게 높일 수 있다.
According to the present invention, a reference voltage compensation circuit is employed, and a panel array including a compensation switching unit and a feedback line is suitably designed in accordance with an external compensation scheme, thereby effectively compensating for a reference voltage distortion, thereby greatly increasing display quality.

도 1은 기준전압이 왜곡되는 일 예를 보여주는 도면.
도 2는 본 발명의 실시예에 따른 유기발광 표시장치를 보여주는 도면.
도 3은 도 2의 표시패널에 형성된 픽셀 어레이를 보여주는 도면.
도 4는 타이밍 콘트롤러, 데이터 드라이버 IC 및 픽셀 간 접속 구조를 보여주는 도면.
도 5 및 도 6은 노멀 구동 및 센싱 구동을 위한 구동 타이밍 신호들의 일 예를 보여주는 도면들.
도 7은 기준전압 보상회로의 상세 구성을 보여주는 도면.
도 8은 기준전압 보상에 필요한 스위칭부, 및 피드백라인 등과 같은 패널 어레이 구성을 보여주는 도면.
도 9 및 도 10은 기준전압 보상회로의 다양한 실장 위치를 보여주는 도면들.
도 11a 내지 도 11d는 보상 스위칭부의 다양한 구현 예들을 보여주는 도면들.
도 12는 보상 스위칭부의 또 다른 구현 예를 보여주는 도면.
도 13은 보상 스위칭부의 순차 구동을 보여주는 도면.1 is a view showing an example in which a reference voltage is distorted;
2 is a view illustrating an organic light emitting display according to an embodiment of the present invention.
3 is a view showing a pixel array formed on the display panel of Fig.
4 is a view showing a timing controller, a data driver IC, and an inter-pixel connection structure.
5 and 6 are diagrams showing an example of driving timing signals for normal driving and sensing driving.
7 is a diagram showing a detailed configuration of a reference voltage compensation circuit;
8 is a diagram showing a panel array configuration such as a switching section, a feedback line, and the like necessary for a reference voltage compensation.
9 and 10 are views showing various mounting positions of a reference voltage compensation circuit.
11A to 11D are diagrams showing various implementations of the compensation switching unit.
12 is a view showing another embodiment of the compensation switching unit;
13 is a view showing sequential driving of the compensation switching unit;

이하, 도 2 내지 도 13을 참조하여 본 발명의 바람직한 실시 예에 대하여 설명하기로 한다.Hereinafter, preferred embodiments of the present invention will be described with reference to FIGS. 2 to 13. FIG.

도 2는 본 발명의 실시예에 따른 유기발광 표시장치를 보여주고, 도 3은 도 2의 표시패널에 형성된 픽셀 어레이를 보여준다.FIG. 2 shows an organic light emitting display according to an embodiment of the present invention, and FIG. 3 shows a pixel array formed on the display panel of FIG.

도 2 및 도 3을 참조하면, 본 발명의 실시예에 따른 유기발광 표시장치는 표시패널(10), 타이밍 콘트롤러(11), 데이터 구동회로(12), 게이트 구동회로(13), 및 기준전압 보상회로(16)를 구비한다. 2 and 3, an OLED display according to an exemplary embodiment of the present invention includes a display panel 10, a timing controller 11, a data driving circuit 12, a gate driving circuit 13, And a compensation circuit (16).

표시패널(10)에는 다수의 데이터라인들(14)과, 다수의 게이트라인들(15)이 교차되고, 이 교차영역마다 픽셀들(PIX)이 매트릭스 형태로 배치된다. A plurality of data lines 14 and a plurality of gate lines 15 are intersected with each other in the display panel 10 and pixels PIX are arranged in a matrix form in each of the intersection regions.

데이터라인들(14)은 다수의 데이터전압 공급라인들(14A, A1~Am), 다수의 기준전압 공급라인들(14B, B1~Bm)을 포함한다. 그리고, 게이트라인들(15)은 다수의 제1 게이트라인들(15C, C1~Cn)과 다수의 제2 게이트라인들(15D, D1~Dn)을 포함한다.The data lines 14 include a plurality of data voltage supply lines 14A, A1 to Am and a plurality of reference voltage supply lines 14B, B1 to Bm. The gate lines 15 include a plurality of first gate lines 15C, C1 to Cn and a plurality of second gate lines 15D, D1 to Dn.

각 픽셀(PIX)은 데이터전압 공급라인들(14A) 중 어느 하나에, 기준전압 공급라인들(14B) 중 어느 하나에, 제1 게이트라인들(15C) 중 어느 하나에, 그리고 제2 게이트라인들(15D) 중 어느 하나에 접속된다. 각 픽셀(PIX)은 데이터전압 공급라인(14A)을 통해 데이터전압을 입력받고, 기준전압 공급라인(14B)을 통해 보상된 기준전압을 입력받고, 제1 게이트라인(15C)을 통해 제1 게이트펄스(도 4의 SCAN)를 입력받으며, 제2 게이트라인(15D)을 통해 제2 게이트펄스(도 4의 SEN)를 입력받는다. 제1 및 제2 게이트펄스는 행 순차 방식으로 공급되기 때문에, 픽셀들(PIX)은 제1 및 제2 게이트펄스에 응답하여 행 순차 방식으로 구동된다.Each pixel PIX is connected to any one of the data voltage supply lines 14A, any one of the reference voltage supply lines 14B, one of the first gate lines 15C, (15D). Each pixel PIX receives the data voltage through the data voltage supply line 14A, receives the compensated reference voltage through the reference voltage supply line 14B, and supplies the compensated reference voltage through the first gate line 15C. (SCAN in FIG. 4), and receives a second gate pulse (SEN in FIG. 4) through the second gate line 15D. Since the first and second gate pulses are supplied in a row-sequential manner, the pixels PIX are driven in a row-sequential manner in response to the first and second gate pulses.

픽셀(PIX) 각각은 도시하지 않은 전원생성부로부터 고전위 구동전압(EVDD)과 저전위 구동전압(EVSS)을 공급받는다. 본 발명의 픽셀(PIX)은 외부 보상을 위해 OLED, 구동 TFT, 제1 및 제2 스위치 TFT, 및 스토리지 커패시터를 포함할 수 있다. 픽셀(PIX)을 구성하는 TFT들은 p 타입으로 구현되거나 또는, n 타입으로 구현될 수 있다. 또한, 픽셀(PIX)을 구성하는 TFT들의 반도체층은, 아몰포스 실리콘 또는, 폴리 실리콘 또는, 산화물을 포함할 수 있다.Each of the pixels PIX is supplied with a high potential driving voltage EVDD and a low potential driving voltage EVSS from a power supply not shown. The pixel PIX of the present invention may include an OLED, a driver TFT, first and second switch TFTs, and a storage capacitor for external compensation. The TFTs constituting the pixel PIX may be implemented as a p-type or an n-type. In addition, the semiconductor layer of the TFTs constituting the pixel PIX may include amorphous silicon, polysilicon, or an oxide.

한편, 표시패널(10)에는 기준전압 공급라인들(14B) 중 적어도 어느 하나에 연결되는 피드백 라인이 형성된다. 그리고, 표시패널(10)에는 피드백 라인과 기준전압 공급라인(14B) 간의 접속을 스위칭하기 위한 스위칭부가 구비된다. 피드백 라인은 기준전압 공급라인(14B)으로부터 전달되는 피드백 기준전압 신호(VRN-FB)를 외부로 출력한다. 피드백 기준전압 신호(VRN-FB)에는 기준전압의 왜곡분이 모두 포함되어 있다.On the other hand, the display panel 10 is formed with a feedback line connected to at least one of the reference voltage supply lines 14B. The display panel 10 is provided with a switching unit for switching the connection between the feedback line and the reference voltage supply line 14B. The feedback line outputs the feedback reference voltage signal VRN-FB transmitted from the reference voltage supply line 14B to the outside. The feedback reference voltage signal VRN-FB includes all of the distortion of the reference voltage.

기준전압 보상회로(16)는 피드백 라인으로부터 입력되는 피드백 기준전압 신호(VRN-FB)를 미리 셋팅된 기준전압을 기초로 보상하여 보상 기준전압 신호(VRN-C)를 생성한다.The reference voltage compensation circuit 16 compensates the feedback reference voltage signal VRN-FB inputted from the feedback line on the basis of the preset reference voltage to generate the compensated reference voltage signal VRN-C.

데이터 구동회로(12)는 타이밍 콘트롤러(11)로부터 인가되는 데이터타이밍 제어신호(DDC)에 따라 픽셀 데이터(DATA)에 대응되는 데이터전압을 생성하여 데이터전압 공급라인들(14A)에 공급한다. 데이터 구동회로(12)는 보상 기준전압 신호(VRN-C)를 기준전압 공급라인들(14B)에 공급한다. 데이터 구동회로(12)는 PCB(Printed Circuit Board)에 연결된 다수의 데이터 드라이버 IC(Intergrated Circuit)들을 포함한다.The data driving circuit 12 generates a data voltage corresponding to the pixel data DATA according to the data timing control signal DDC applied from the timing controller 11 and supplies the data voltage to the data voltage supply lines 14A. The data driving circuit 12 supplies the compensated reference voltage signal VRN-C to the reference voltage supply lines 14B. The data driving circuit 12 includes a plurality of data driver ICs (Integrated Circuits) connected to a PCB (Printed Circuit Board).

게이트 구동회로(13)는 게이트 제어신호(GDC)를 기반으로 제1 및 제2 게이트펄스를 생성한다. 제1 게이트펄스는 데이터라인과 픽셀 간 접속을 스위칭하기 위한 스위치의 구동 타이밍을 제어하기 위한 것으로 스캔펄스에 해당된다. 제2 게이트펄스는 기준전압 공급라인과 픽셀 간 접속을 스위칭하기 위한 스위치의 구동 타이밍을 제어하기 위한 것이다. 게이트 구동회로(13)는 제1 게이트펄스를 행 순차 방식에 따라 제1 게이트라인들(15C)에 공급하고, 제2 게이트펄스를 행 순차 방식에 따라 제2 게이트라인들(15D)에 공급한다.The gate drive circuit 13 generates the first and second gate pulses based on the gate control signal GDC. The first gate pulse is for controlling the driving timing of the switch for switching the connection between the data line and the pixel, and corresponds to a scan pulse. The second gate pulse is for controlling the driving timing of the switch for switching the connection between the reference voltage supply line and the pixel. The gate drive circuit 13 supplies the first gate pulse to the first gate lines 15C in accordance with the row sequential method and supplies the second gate pulse to the second gate lines 15D according to the row sequential method .

타이밍 콘트롤러(11)는 수직 동기신호(Vsync), 수평 동기신호(Hsync), 도트클럭신호(DCLK) 및 데이터 인에이블신호(DE) 등의 타이밍 신호들에 기초하여 데이터 구동회로(12)의 동작 타이밍을 제어하기 위한 데이터 제어신호(DDC)와, 게이트 구동회로(13)의 동작 타이밍을 제어하기 위한 게이트 제어신호(GDC)를 생성한다.The timing controller 11 controls the operation of the data driving circuit 12 based on timing signals such as a vertical synchronizing signal Vsync, a horizontal synchronizing signal Hsync, a dot clock signal DCLK and a data enable signal DE A data control signal DDC for controlling the timing and a gate control signal GDC for controlling the operation timing of the gate drive circuit 13 are generated.

도 4는 타이밍 콘트롤러(11), 데이터 드라이버 IC(SDIC) 및 픽셀(PIX) 간 접속 구조를 보여주고, 도 5 및 도 6은 노멀 구동 및 센싱 구동을 위한 구동 타이밍 신호들의 일 예를 보여준다. 여기서, 노멀 구동이란 화상 표시를 위한 구동을 의미하고, 센싱 구동이란 외부 보상의 기초가 되는 구동 TFT의 전기적 특성 변화를 검출하기 위한 구동을 의미한다. 도 4 내지 도 6은 본 발명이 적용되는 픽셀 구조 및 그 구동에 대한 이해를 돕기 위한 일 예시에 불과하다. 본 발명이 적용되는 픽셀 구조 및 그 구동 타이밍은 다양한 변형이 가능하므로, 본 발명의 기술적 사상은 이 실시예에 한정되지 않는다. FIG. 4 shows a connection structure between the timing controller 11, the data driver IC (SDIC) and the pixel PIX, and FIGS. 5 and 6 show an example of the drive timing signals for the normal drive and the sensing drive. Here, normal driving means driving for image display, and sensing driving means driving for detecting a change in electrical characteristics of driving TFTs, which is the basis of external compensation. 4 to 6 are merely examples for helping understanding of the pixel structure and driving of the present invention. The pixel structure to which the present invention is applied and the driving timing thereof can be variously modified, so the technical idea of the present invention is not limited to this embodiment.

도 4를 참조하면, 본 발명의 픽셀(PIX)은 OLED, 구동 TFT(Thin Film Transistor)(DT), 스토리지 커패시터(Cst), 제1 스위치 TFT(ST), 및 제2 스위치 TFT(ST2)를 구비할 수 있다. 4, the pixel PIX of the present invention includes an OLED, a driving TFT (Thin Film Transistor) DT, a storage capacitor Cst, a first switch TFT ST, and a second switch TFT ST2 .

OLED는 제2 노드(N2)에 접속된 애노드전극과, 저전위 구동전압(EVSS)의 입력단에 접속된 캐소드전극과, 애노드전극과 캐소드전극 사이에 위치하는 유기화합물층을 포함한다.The OLED includes an anode electrode connected to the second node N2, a cathode electrode connected to the input terminal of the low potential driving voltage (EVSS), and an organic compound layer positioned between the anode electrode and the cathode electrode.

구동 TFT(DT)는 게이트-소스 간 전압(Vgs)에 따라 OLED에 흐르는 구동전류(Ioled)를 제어한다. 구동 TFT(DT)는 제1 노드(N1)에 접속된 게이트전극, 고전위 구동전압(EVDD)의 입력단에 접속된 드레인전극, 및 제2 노드(N2)에 접속된 소스전극을 구비한다.The driving TFT DT controls the driving current Ioled flowing in the OLED according to the gate-source voltage Vgs. The driving TFT DT has a gate electrode connected to the first node N1, a drain electrode connected to the input terminal of the high potential driving voltage EVDD, and a source electrode connected to the second node N2.

스토리지 커패시터(Cst)는 제1 노드(N1)와 제2 노드(N2) 사이에 접속된다.The storage capacitor Cst is connected between the first node N1 and the second node N2.

제1 스위치 TFT(ST)는 제1 게이트펄스(SCAN)에 응답하여 데이터전압 공급라인(14A) 상의 데이터전압(Vdata)을 제1 노드(N1)에 인가한다. 제1 스위치 TFT(ST)는 제1 게이트라인(15C)에 접속된 게이트전극, 데이터전압 공급라인(14A)에 접속된 드레인전극, 및 제1 노드(N1)에 접속된 소스전극을 구비한다.The first switch TFT ST applies the data voltage Vdata on the data voltage supply line 14A to the first node N1 in response to the first gate pulse SCAN. The first switch TFT ST has a gate electrode connected to the first gate line 15C, a drain electrode connected to the data voltage supply line 14A, and a source electrode connected to the first node N1.

제2 스위치 TFT(ST2)는 제2 게이트펄스(SEN)에 응답하여 제2 노드(N2)와 기준전압 공급라인(14B) 간의 전류 흐름을 스위칭함으로써 기준전압 공급라인(14B) 상의 보상 기준전압 신호(VPN-C)를 제2 노드(N2)에 인가한다. 제2 스위치 TFT(ST2)는 제2 게이트라인(15D)에 접속된 게이트전극, 기준전압 공급라인(14B)에 접속된 드레인전극, 및 제2 노드(N2)에 접속된 소스전극을 구비한다.The second switch TFT ST2 switches the current flow between the second node N2 and the reference voltage supply line 14B in response to the second gate pulse SEN so that the compensated reference voltage signal (VPN-C) to the second node N2. The second switch TFT ST2 has a gate electrode connected to the second gate line 15D, a drain electrode connected to the reference voltage supply line 14B, and a source electrode connected to the second node N2.

데이터 드라이버 IC(SDIC)는 데이터전압 공급라인(14A) 및 기준전압 공급라인(14B)을 통해 각 픽셀(PIX)에 연결된다. 데이터 드라이버 IC(SDIC)는 디지털-아날로그 컨버터(DAC), 아날로그-디지털 컨버터(ADC), 제1 및 제2 스위치(SW1,SW2)등을 포함한다.The data driver IC (SDIC) is connected to each pixel PIX via a data voltage supply line 14A and a reference voltage supply line 14B. The data driver IC (SDIC) includes a digital-to-analog converter (DAC), an analog-to-digital converter (ADC), first and second switches SW1 and SW2, and the like.

DAC는 타이밍 콘트롤러(11)로부터 입력되는 디지털 비디오 데이터(DATA)를 아날로그 데이터전압(Vdata)으로 변환하여 데이터전압 공급라인(14a)에 인가한다. 제1 스위치(SW1)는 기준전압 보상회로(16)로부터 보상 기준전압 신호(VRN-C)가 입력되는 제1 공급단자(T1)와 기준전압 공급라인(14B) 사이에 접속되어, PREN 신호에 따라 스위칭된다. PREN 신호는 노멀 구동시에는 계속해서 온 레벨로 입력될 수 있고 센싱 구동시에는 계속해서 오프 레벨로 입력될 수 있다. 제2 스위치(SW2)는 초기화 전압(미도시)이 입력되는 제2 공급단자(T2)와 기준전압 공급라인(14B) 사이에 접속되어, PRES 신호에 따라 스위칭된다. PRES 신호는 노멀 구동시에는 계속해서 오프 레벨로 입력될 수 있고 센싱 구동시에는 초기화 기간(도 6의 기간 ①) 동안 온 레벨로 입력될 수 있다. 제3 스위치(SW3)는 기준전압 공급라인(14B)과 ADC 사이에 접속되어, SAM 신호에 따라 스위칭된다. SAM 신호는 노멀 구동시 계속해서 오프 레벨로 입력될 수 있고 센싱 구동시에는 샘플링 기간(도 6의 기간 ③) 동안 온 레벨로 입력될 수 있다. ADC는 센싱 구동시 기준전압 공급라인(14B) 상의 센싱전압을 디지털 값으로 변환하여 타이밍 콘트롤러(11)에 인가한다. 한편, PREN 신호, PRES 신호 및 SAM 신호는 타이밍 콘트롤러(11)에서 생성될 수 있다.The DAC converts the digital video data (DATA) input from the timing controller 11 into an analog data voltage (Vdata) and applies it to the data voltage supply line 14a. The first switch SW1 is connected between the first supply terminal T1 to which the compensated reference voltage signal VRN-C is inputted from the reference voltage compensating circuit 16 and the reference voltage supply line 14B, Respectively. The PREN signal can be continuously input to the on level during normal driving and continuously input to the off level during the sensing period. The second switch SW2 is connected between the second supply terminal T2 to which the initializing voltage (not shown) is inputted and the reference voltage supply line 14B, and is switched in accordance with the PRES signal. The PRES signal can be continuously input at the OFF level at the time of the normal driving and can be input at the ON level during the initialization period (period 1 in Fig. 6). The third switch SW3 is connected between the reference voltage supply line 14B and the ADC, and is switched in accordance with the SAM signal. The SAM signal can be continuously input to the off level during normal driving and can be input to the on level during the sampling period (period 3 in Fig. 6). The ADC converts the sensing voltage on the reference voltage supply line 14B to a digital value and applies the sensing voltage to the timing controller 11 during sensing operation. On the other hand, the PREN signal, the PRES signal, and the SAM signal may be generated in the timing controller 11.

도 5를 결부하여 노멀 구동을 간단히 설명한다. 노멀 구동은 도 5와 같이 초기화 기간(Ti), 프로그래밍 기간(Tp), 발광기간(Te)로 나뉘어 진행되며, 이러한 3단계 진행을 매 프레임마다 반복한다. 노멀 구동시 데이터 드라이버 IC(SDIC)의 제1 스위치(SW1)는 계속해서 온 상태로 유지되는 데 반해, 제2 및 제3 스위치(SW2,SW3)는 계속해서 오프 상태로 유지된다.The normal driving will be briefly described with reference to FIG. The normal driving is divided into an initialization period (Ti), a programming period (Tp), and a light emission period (Te), as shown in FIG. The first switch SW1 of the data driver IC (SDIC) is kept in the ON state at the time of normal driving, while the second and third switches SW2 and SW3 are kept in the OFF state continuously.

초기화 기간(Ti)에서 제2 스위치 TFT(ST2)는 온 되어 제2 노드(N2)에 보상 기준전압 신호(VPN-C)를 공급한다. In the initialization period Ti, the second switch TFT ST2 is turned on to supply the compensated reference voltage signal VPN-C to the second node N2.

프로그래밍 기간(Tp)에서 제1 스위치 TFT(ST1)는 온 되어 보상 데이터전압(구동 TFT의 전기적 특성 편차가 반영된 데이터전압)을 제1 노드(N1)에 공급한다. 이 기간(Tp)에서 구동 TFT(DT)의 게이트-소스 간 전압(Vgs)은 원하는 레벨, 즉 보상 데이터전압과 보상 기준전압 신호 간 차이 값으로 프로그래밍된다.In the programming period Tp, the first switch TFT (ST1) is turned on to supply the compensation data voltage (the data voltage reflecting the electric characteristic deviation of the drive TFT) to the first node N1. In this period Tp, the gate-source voltage Vgs of the driving TFT DT is programmed to a desired level, that is, a difference value between the compensated data voltage and the compensated reference voltage signal.

발광 기간(Te)에서 제1 및 제2 스위치 TFT(ST1,ST2)가 오프 되고, 구동 TFT(DT)는 프로그래밍된 레벨로 구동전류(Ioled)를 생성하여 OLED에 인가한다. OLED는 구동전류(Ioled)에 대응되는 밝기로 발광하여 계조를 표시한다.The first and second switch TFTs ST1 and ST2 are turned off in the light emission period Te and the drive TFT DT generates the drive current Ioled at the programmed level and applies it to the OLED. The OLED emits light with a brightness corresponding to the driving current Ioled to display the gradation.

또한, 도 6을 결부하여 센싱 구동을 간단히 설명한다. 구동 TFT의 전기적 특성 변화를 센싱하기 위한 센싱 구동은 도 6과 같이 3 단계로 진행될 수 있다. 센싱 구동시 데이터 드라이버 IC(SDIC)의 제1 스위치(SW1)는 계속해서 오프 상태로 유지된다. ① 기간에서, 제1 스위치 TFT(ST1)는 온 되어 센싱용 데이터전압을 제1 노드(N1)에 공급하고, 제2 스위치(SW2)와 제2 스위치 TFT(ST2)는 온 되어 초기화전압을 제2 노드(N2)에 공급한다. The sensing drive will be briefly described with reference to Fig. The sensing drive for sensing a change in the electrical characteristics of the driving TFT may proceed to three stages as shown in FIG. During the sensing operation, the first switch SW1 of the data driver IC (SDIC) is kept in the OFF state continuously. In the (1) period, the first switch TFT (ST1) is turned on to supply the sensing data voltage to the first node (N1), and the second switch (SW2) and the second switch TFT 2 node N2.

② 기간에서, 제2 스위치 TFT(ST2)는 온 상태로 유지되고, 나머지들(ST1,SW2,SW3)은 오프 된다. 이 기간에서 구동 TFT(DT)를 통해 흐르는 구동전류(Ioled)에 의해 제2 노드(N2)의 전위는 증가되며, 제2 노드(N2)의 충전 전압이 제2 스위치 TFT(ST2)를 경유하여 기준전압 공급라인(14B)의 라인 커패시터(기생 커패시터)에 저장되게 된다.In the period (2), the second switch TFT (ST2) is kept in the on state and the remaining switches (ST1, SW2, SW3) are turned off. The potential of the second node N2 is increased by the driving current Ioled flowing through the driving TFT DT in this period and the charging voltage of the second node N2 is increased by the second switching TFT ST2 And stored in the line capacitor (parasitic capacitor) of the reference voltage supply line 14B.

③ 기간에서, 제3 스위치(SW3)는 온 되어 기준전압 공급라인(14B)에 저장된 센싱 전압을 샘플링하여 ADC에 인가한다. 이 센싱 전압은 ADC에서 디지털 센싱값으로 변환되어 타이밍 콘트롤러(11)로 전송된다. 타이밍 콘트롤러(11)는 디지털 센싱값을 내부 보상 알고리즘에 적용시켜 디지털 비디오 데이터를 보정함으로써 구동 TFT의 전기적 특성 편차를 보상하게 된다.In the third period, the third switch SW3 is turned on to sample the sensing voltage stored in the reference voltage supply line 14B and apply it to the ADC. This sensing voltage is converted into a digital sensing value by the ADC and transmitted to the timing controller 11. [ The timing controller 11 applies the digital sensing value to the internal compensation algorithm to correct the digital video data to compensate for the electrical characteristic deviation of the driving TFT.

도 7은 기준전압 보상회로(16)의 상세 구성을 보여준다. 도 8은 기준전압 보상에 필요한 스위칭부, 및 피드백라인 등과 같은 패널 어레이 구성을 보여준다. 그리고, 도 9 및 도 10은 기준전압 보상회로(16)의 실장 위치를 보여준다.7 shows the detailed configuration of the reference voltage compensation circuit 16. As shown in Fig. FIG. 8 shows a panel array configuration such as a switching section, a feedback line, and the like necessary for reference voltage compensation. 9 and 10 show mounting positions of the reference voltage compensating circuit 16. As shown in Fig.

도 7 및 도 8을 참조하면, 기준전압 보상회로(16)는 보상 기준전압 신호(VRN-C)를 피드백 기준전압 신호(VRN-FB)와 반대 위상으로 생성한다. 피드백 기준전압 신호(VRN-FB)에 포함된 기준전압 왜곡분은, 기준전압 공급라인(14B) 상에서 보상 기준전압 신호(VRN-C)에 의해 상쇄된다. 이를 위해, 기준전압 보상회로(16)는 반전 증폭기로 구현될 수 있다. 즉, 기준전압 보상회로(16)는 제1 저항(R1)을 경유하여 피드백 기준전압 신호(VRN-FB)를 입력받는 반전 입력단자(-)와, 미리 셋팅된 이상적인 기준전압(VRN)을 입력받는 비반전 입력단자(+)와, 제2 저항(R2)을 통해 반전 입력단자(-)에 접속된 출력단자를 구비하는 반전 증폭기(OP)로 구현될 수 있다.Referring to FIGS. 7 and 8, the reference voltage compensation circuit 16 generates the compensated reference voltage signal VRN-C in a phase opposite to the feedback reference voltage signal VRN-FB. The reference voltage distortion component contained in the feedback reference voltage signal VRN-FB is canceled by the compensation reference voltage signal VRN-C on the reference voltage supply line 14B. To this end, the reference voltage compensation circuit 16 may be implemented with an inverting amplifier. That is, the reference voltage compensating circuit 16 includes an inverting input terminal (-) receiving the feedback reference voltage signal VRN-FB via the first resistor Rl and an inverting input terminal (-) receiving the preset ideal reference voltage VRN (OP) having a non-inverting input terminal (+) to receive the input signal and an output terminal connected to the inverting input terminal (-) through the second resistor (R2).

기준전압 보상회로(16)는 도 9와 같이 데이터 드라이버 IC들(SDIC)이 연결된 PCB에 실장될 수 있다. 기준전압 보상회로(16)의 출력단은 데이터 드라이버 IC들(SDIC) 각각의 제1 공급단자(T1)에 공통으로 연결될 수 있다. 제1 공급단자(T1)는 노멀 구동시 기준전압 보상회로(16)로부터 보상 기준전압 신호(VPN-C)를 입력받는다.The reference voltage compensation circuit 16 may be mounted on a PCB to which the data driver ICs (SDIC) are connected as shown in FIG. The output terminal of the reference voltage compensation circuit 16 may be connected in common to the first supply terminal T1 of each of the data driver ICs (SDIC). The first supply terminal T1 receives the compensated reference voltage signal VPN-C from the reference voltage compensating circuit 16 during normal driving.

한편, 기준전압 보상회로(16)는 도 10과 같이 데이터 드라이버 IC들(SDIC) 각각에 직접 실장될 수 있다. 각 데이터 드라이버 IC(SDIC) 내에서 기준전압 보상회로(16)의 출력단은 제1 공급단자(T1)에 연결될 수 있다. 이 경우에도 마찬가지로 제1 공급단자(T1)는 노멀 구동시 기준전압 보상회로(16)로부터 보상 기준전압 신호(VPN-C)를 입력받는다.On the other hand, the reference voltage compensation circuit 16 can be directly mounted on each of the data driver ICs (SDIC) as shown in Fig. The output terminal of the reference voltage compensation circuit 16 in each data driver IC (SDIC) may be connected to the first supply terminal T1. In this case as well, the first supply terminal T1 receives the compensated reference voltage signal VPN-C from the reference voltage compensating circuit 16 during normal driving.

한편, 표시패널(10)에는 도 8과 같이 기준전압 보상회로(16)에 피드백 기준전압 신호(VRN-FB)를 공급하는 피드백 라인(FBL)과, 기준전압 공급라인들(14B) 중 적어도 어느 하나와 피드백 라인(FBL) 사이의 전기적 접속을 스위칭하는 보상 스위칭부(20)가 형성된다. 위에서 언급한 센싱 구동은 픽셀 단위로 개별적으로 이뤄지므로, 이러한 센싱 구동이 가능하도록 본 발명의 기준전압 공급라인들(14B)은 전기적으로 서로 분리되는 특징이 있다.On the other hand, the display panel 10 is provided with a feedback line FBL for supplying a feedback reference voltage signal VRN-FB to the reference voltage compensation circuit 16 and at least one of the reference voltage supply lines 14B And a compensation switching unit 20 for switching the electrical connection between the feedback line FBL and the feedback line FBL is formed. Since the above-described sensing driving is performed on a pixel-by-pixel basis, the reference voltage supply lines 14B of the present invention are electrically separated from each other to enable sensing driving.

보상 스위칭부(20)는 적어도 하나 이상의 보상 스위치(STR)로 구현된다. 보상 스위치(STR)의 게이트전극은 보상 제어신호가 인가되는 보상 제어라인(CTL)에 접속되고, 보상 스위치(STR)의 드레인전극은 기준전압 공급라인들(14B)에 접속되며, 보상 스위치(STR)의 소스전극은 피드백 라인(FBL)에 접속된다.The compensation switching unit 20 is implemented with at least one compensation switch STR. The gate electrode of the compensation switch STR is connected to the compensation control line CTL to which the compensation control signal is applied, the drain electrode of the compensation switch STR is connected to the reference voltage supply lines 14B, Is connected to the feedback line FBL.

도 11a 내지 도 11d는 보상 스위칭부(20)의 다양한 구현 예들을 보여준다.Figs. 11A to 11D show various implementations of the compensation switching unit 20. Fig.

도 11a를 참조하면, 보상 스위칭부(20)는 1개의 보상 스위치(STR)로 구현될 수 있다. 이 경우, 보상 스위치(STR)는 기준전압 공급라인들(14B) 중 어느 하나와 피드백 라인(FBL) 사이에 접속된다.Referring to FIG. 11A, the compensation switching unit 20 may be implemented with one compensation switch (STR). In this case, the compensation switch STR is connected between any one of the reference voltage supply lines 14B and the feedback line FBL.

도 11b를 참조하면, 보상 스위칭부(20)는 2개의 보상 스위치들(STR1,STR2)로 구현될 수 있다. 이 경우, 제1 보상 스위치(STR1)는 기준전압 공급라인들(14B) 중 어느 하나(L1)와 피드백 라인(FBL) 사이에 접속되고, 제2 보상 스위치(STR2)는 기준전압 공급라인들(14B) 중 다른 하나(L2)와 피드백 라인(FBL) 사이에 접속된다. 따라서, 피드백 라인(FBL)에 전달되는 피드백 기준전압 신호(VRN-FB)는 기준전압 공급라인들 L1 및 L2을 대상으로 한 평균 왜곡값을 포함하게 된다.Referring to FIG. 11B, the compensation switching unit 20 may be implemented with two compensation switches STR1 and STR2. In this case, the first compensation switch STR1 is connected between any one of the reference voltage supply lines 14B and the feedback line FBL, and the second compensation switch STR2 is connected between the reference voltage supply lines 14B and the feedback line FBL. Accordingly, the feedback reference voltage signal VRN-FB transmitted to the feedback line FBL includes the average distortion value for the reference voltage supply lines L1 and L2.

도 11c를 참조하면, 보상 스위칭부(20)는 다수의 보상 스위치들(STR1~STR7)로 구현될 수 있으며, 이 보상 스위치들(STR1~STR7)은 데이터 드라이버 IC(SDIC)마다 1개씩 할당될 수 있다. 이 경우, 제1 보상 스위치(STR1)는 제1 데이터 드라이버 IC(SDIC)에 의해 구동되는 기준전압 공급라인들(14B) 중 어느 하나(L1)와 피드백 라인(FBL) 사이에 접속되고, 제2 보상 스위치(STR2)는 제2 데이터 드라이버 IC(SDIC)에 의해 구동되는 기준전압 공급라인들(14B) 중 어느 하나(L2)와 피드백 라인(FBL) 사이에 접속되며, 마찬가지 원리로 제7 보상 스위치(STR7)는 제7 데이터 드라이버 IC(SDIC)에 의해 구동되는 기준전압 공급라인들(14B) 중 어느 하나(L7)와 피드백 라인(FBL) 사이에 접속되게 된다. 피드백 라인(FBL)에 전달되는 피드백 기준전압 신호(VRN-FB)는 기준전압 공급라인들 L1~L7을 대상으로 한 평균 왜곡값을 포함하게 된다. Referring to FIG. 11C, the compensation switching unit 20 may be implemented with a plurality of compensation switches STR1 to STR7, and one of the compensation switches STR1 to STR7 is allocated to each data driver IC (SDIC) . In this case, the first compensation switch STR1 is connected between the feedback line FBL and any one of the reference voltage supply lines 14B driven by the first data driver IC (SDIC) The compensation switch STR2 is connected between any one of the reference voltage supply lines 14B driven by the second data driver IC SDIC and the feedback line FBL and on the same principle, (STR7) is connected between any one of the reference voltage supply lines 14B driven by the seventh data driver IC (SDIC) and the feedback line FBL. The feedback reference voltage signal VRN-FB transmitted to the feedback line FBL includes the average distortion value for the reference voltage supply lines L1 to L7.

도 11d를 참조하면, 보상 스위칭부(20)는 다수의 보상 스위치들(STR1,STR2,STR3)로 구현될 수 있으며, 이 보상 스위치들(STR1,STR2,STR3)은 표시 블록(BL1,BL2,BL3)마다 1개씩 할당될 수 있다. 여기서, 각 표시 블록(BL1,BL2,BL3)은 적어도 2개 이상의 데이터 드라이버 IC(SDIC)를 포함할 수 있다. 이 경우, 제1 보상 스위치(STR1)는 제1 표시 블록(BL1)에 속하는 기준전압 공급라인들(14B) 중 어느 하나(L1)와 피드백 라인(FBL) 사이에 접속되고, 제2 보상 스위치(STR2)는 제2 표시 블록(BL2)에 속하는 기준전압 공급라인들(14B) 중 어느 하나(L2)와 피드백 라인(FBL) 사이에 접속되며, 마찬가지 원리로 제3 보상 스위치(STR3)는 제3 표시 블록(BL3)에 속하는 기준전압 공급라인들(14B) 중 어느 하나(L7)와 피드백 라인(FBL) 사이에 접속되게 된다. 피드백 라인(FBL)에 전달되는 피드백 기준전압 신호(VRN-FB)는 기준전압 공급라인들 L1~L3을 대상으로 한 평균 왜곡값을 포함하게 된다. Referring to FIG. 11D, the compensation switching unit 20 may be implemented with a plurality of compensation switches STR1, STR2 and STR3, and the compensation switches STR1, STR2 and STR3 are connected to the display blocks BL1, BL2, BL3, respectively. Here, each of the display blocks BL1, BL2, and BL3 may include at least two data driver ICs (SDICs). In this case, the first compensation switch STR1 is connected between any one of the reference voltage supply lines 14B belonging to the first display block BL1 and the feedback line FBL, and the second compensation switch STR2 is connected between any one of the reference voltage supply lines 14B belonging to the second display block BL2 and the feedback line FBL and on the same principle the third compensation switch STR3 is connected between the third And is connected between any one of the reference voltage supply lines 14B belonging to the display block BL3 and the feedback line FBL. The feedback reference voltage signal VRN-FB transmitted to the feedback line FBL includes the average distortion value for the reference voltage supply lines L1 to L3.

보상 스위치들(STR)과 그에 연결되는 기준전압 공급라인들(14B)의 개수를 늘려, 샘플링되는 피드백 기준전압 신호(VRN-FB)를 많게 하면 그만큼 기준전압 보상의 정확도는 높아지나 그만큼 패널 구성이 복잡해지므로, 적절한 설계가 필요하다.Increasing the number of compensating switches STR and reference voltage supply lines 14B connected thereto increases the accuracy of reference voltage compensation by increasing the number of feedback reference voltage signals VRN-FB to be sampled. As it becomes complicated, proper design is required.

도 12는 보상 스위칭부(20)의 또 다른 구현 예를 보여준다. 도 13은 보상 스위칭부(20)의 순차 구동을 보여준다.Fig. 12 shows another embodiment of the compensation switching unit 20. Fig. FIG. 13 shows sequential driving of the compensation switching unit 20. FIG.

도 12의 보상 스위칭부(20)는 선택군(예컨대, SG1,SG2) 별 개별 보상을 위해 각 선택군(SG1,SG2)마다 할당된 제1 및 제2 보상 스위치(STRa1,STRa2, 여기서, a는 양의 정수)를 구비할 수 있다. 여기서, 선택군(SG1,SG2)은 적어도 하나 이상의 데이터 드라이버 IC(SDIC)에 의해 구동되는 기준전압 공급라인들(14B)을 포함할 수 있다.The compensation switching unit 20 of FIG. 12 includes first and second compensation switches STRa1, STRa2, where a (k) is allocated for each selection group SG1 and SG2 for individual compensation for each selection group (for example, SG1 and SG2) May be a positive integer). Here, the selected group SG1 and SG2 may include reference voltage supply lines 14B driven by at least one data driver IC (SDIC).

M(M은 2 이상의 양의 정수)개의 선택군들에 있어, M 개의 제1 보상 스위치(예컨대, STR11, STR21)은 노멀 구동시 항상 온 레벨로 유지되고, 센싱 구동시 항상 오프 레벨로 유지될 수 있다. 그리고, M개의 선택군들(SG1,SG2)에 있어, M 개의 제2 보상 스위치들(예컨대, STR12, STR22)은 노멀 구동시 도 13과 같이 서로 다른 보상 제어신호에 따라 순차적으로 스위칭됨으로써 M 개의 기준전압 공급라인들(예컨대, L1,L2)을 피드백 라인(FBL)에 순차적으로 연결할 수 있다. 도 12에서, CTL11 및 CTL21은 구동 모드 신호를 제1 보상 스위치들(STR11, STR21)의 게이트전극에 공급하기 위한 제1 보상 제어라인들이고, CTL11 및 CTL21은 구동 모드 신호를 제2 보상 스위치들(STR12, STR22)의 게이트전극에 공급하기 위한 제1 보상 제어라인들을 지시한다.M first compensation switches (for example, STR11 and STR21) are always kept in an on level during normal driving and always maintained in an off level during sensing driving in M (M is a positive integer equal to or greater than 2) . In the M selection groups SG1 and SG2, M second compensation switches (e.g., STR12 and STR22) are sequentially switched according to different compensation control signals as shown in FIG. 13 during normal driving, The reference voltage supply lines (e.g., L1, L2) may be sequentially connected to the feedback line FBL. 12, CTL11 and CTL21 are first compensation control lines for supplying a drive mode signal to the gate electrodes of the first compensation switches STR11 and STR21, and CTL11 and CTL21 output drive mode signals to second compensation switches STR12, and STR22, respectively.

피드백 라인(FBL)은 일정 주기(P)마다 M 개의 기준전압 공급라인들(L1,L2)에 순차적으로 연결되어, 각 기준전압 공급라인(L1,L2) 상의 기준전압 신호를 피드백 기준전압 신호(VRN-FB)로서 기준전압 공급회로(16)에 순차 공급한다. 그러면, 기준전압 공급회로(16)는 순차 공급되는 피드백 기준전압 신호(VRN-FB)에 따라 보상 기준전압 신호(VRN-C)를 생성하여 해당 선택군(SG1,SG2)의 데이터 드라이버 IC(SDIC)에 공급한다. 이렇게 하면, 패널 구성은 다소 복잡하나 보상의 정확도는 높아진다.The feedback line FBL is sequentially connected to the M reference voltage supply lines L1 and L2 for every predetermined period P so that the reference voltage signal on each of the reference voltage supply lines L1 and L2 is divided into a feedback reference voltage signal VRN-FB to the reference voltage supply circuit 16 in sequence. Then, the reference voltage supply circuit 16 generates a compensated reference voltage signal VRN-C according to the feedback reference voltage signal VRN-FB sequentially supplied to the data driver IC (SDIC . In this way, the panel configuration is somewhat complicated, but the accuracy of the compensation increases.

상술한 바와 같이, 본 발명은 기준전압 보상회로를 채용하고, 외부 보상 방식에 맞게 보상 스위칭부와 피드백 라인을 포함한 패널 어레이를 적절히 설계하여 기준전압 왜곡을 효과적으로 보상함으로써, 표시 품위를 크게 높일 수 있다.As described above, according to the present invention, a reference voltage compensation circuit is employed, and a panel array including a compensation switching unit and a feedback line is suitably designed in accordance with an external compensation scheme to effectively compensate for the reference voltage distortion, .

이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여져야만 할 것이다.It will be apparent to those skilled in the art that various modifications and variations can be made in the present invention without departing from the spirit or scope of the invention. Therefore, the technical scope of the present invention should not be limited to the contents described in the detailed description of the specification, but should be defined by the claims.

10 : 표시패널 11 : 타이밍 콘트롤러
12 : 데이터 구동회로 13 : 게이트 구동회로
14 : 데이터라인들 15 : 게이트라인들
16 : 기준전압 보상회로10: Display panel 11: Timing controller
12: data driving circuit 13: gate driving circuit
14: Data lines 15: Gate lines
16: Reference voltage compensation circuit

Claims (8)

구동소자의 게이트전극에 인가되는 데이터전압과 상기 구동소자의 소스전극에 인가되는 기준전압 간의 전압차에 의해 발광량이 제어되는 OLED를 각각 포함한 다수의 픽셀들과, 상기 픽셀들에 기준전압을 공급하기 위한 다수의 기준전압 공급라인들과, 보상 스위칭부를 통해 상기 기준전압 공급라인들 중 적어도 어느 하나에 연결되는 피드백 라인이 형성된 표시패널;
상기 피드백 라인으로부터 입력되는 피드백 기준전압 신호를 미리 셋팅된 기준전압을 기초로 보상하여 보상 기준전압 신호를 생성하는 기준전압 보상회로; 및
상기 보상 기준전압 신호를 상기 기준전압 공급라인들에 공급하는 데이터 구동회로를 구비하는 것을 특징으로 하는 유기발광 표시장치.A plurality of pixels each including an OLED whose emission amount is controlled by a voltage difference between a data voltage applied to a gate electrode of a driving element and a reference voltage applied to a source electrode of the driving element; And a feedback line connected to at least one of the reference voltage supply lines through the compensation switching unit.
A reference voltage compensation circuit for compensating a feedback reference voltage signal input from the feedback line based on a preset reference voltage to generate a compensated reference voltage signal; And
And a data driving circuit for supplying the compensated reference voltage signal to the reference voltage supply lines. 제 1 항에 있어서,
상기 기준전압 보상회로는, 상기 보상 기준전압 신호를 상기 피드백 기준전압 신호와 반대 위상으로 생성하는 반전 증폭기로 구현되는 것을 특징으로 하는 유기발광 표시장치.The method according to claim 1,
Wherein the reference voltage compensation circuit is implemented as an inverting amplifier that generates the compensation reference voltage signal in a phase opposite to the feedback reference voltage signal. 제 2 항에 있어서,
상기 기준전압 보상회로는,
제1 저항을 경유하여 상기 피드백 기준전압 신호를 입력받는 반전 입력단자와, 상기 미리 셋팅된 기준전압을 입력받는 비반전 입력단자와, 제2 저항을 통해 상기 반전 입력단자에 접속된 출력단자를 구비하는 반전 증폭기로 구현되는 것을 특징으로 하는 유기발광 표시장치.3. The method of claim 2,
Wherein the reference voltage compensation circuit comprises:
An inverting input terminal receiving the feedback reference voltage signal via a first resistor, a non-inverting input terminal receiving the preset reference voltage, and an output terminal connected to the inverting input terminal through a second resistor And an organic light emitting diode (OLED). 제 1 항에 있어서,
상기 데이터 구동회로는 PCB에 연결된 다수의 데이터 드라이버 IC들을 포함하고;
상기 데이터 드라이버 IC들 각각은 상기 보상 기준전압 신호를 상기 기준전압 공급라인들에 공급하는 제1 공급단자를 포함하며;
상기 기준전압 보상회로는 상기 PCB에 실장되고, 상기 기준전압 보상회로의 출력단은 상기 데이터 드라이버 IC들 각각의 상기 제1 공급단자에 연결되는 것을 특징으로 하는 유기발광 표시장치.The method according to claim 1,
The data driving circuit comprising a plurality of data driver ICs connected to the PCB;
Each of the data driver ICs including a first supply terminal for supplying the compensated reference voltage signal to the reference voltage supply lines;
Wherein the reference voltage compensation circuit is mounted on the PCB, and an output terminal of the reference voltage compensation circuit is connected to the first supply terminal of each of the data driver ICs. 제 1 항에 있어서,
상기 데이터 구동회로는 PCB에 연결된 다수의 데이터 드라이버 IC들을 포함하고;
상기 데이터 드라이버 IC들 각각은 상기 보상 기준전압 신호를 상기 기준전압 공급라인들에 공급하는 제1 공급단자를 포함하며;
상기 기준전압 보상회로는 상기 데이터 드라이버 IC들 각각에 실장되고, 상기 기준전압 보상회로의 출력단은 상기 데이터 드라이버 IC들 각각의 상기 제1 공급단자에 연결되는 것을 특징으로 하는 유기발광 표시장치.The method according to claim 1,
The data driving circuit comprising a plurality of data driver ICs connected to the PCB;
Each of the data driver ICs including a first supply terminal for supplying the compensated reference voltage signal to the reference voltage supply lines;
Wherein the reference voltage compensation circuit is mounted on each of the data driver ICs, and the output terminal of the reference voltage compensation circuit is connected to the first supply terminal of each of the data driver ICs. 제 1 항에 있어서,
상기 기준전압 공급라인들은 전기적으로 서로 분리되고;
상기 보상 스위칭부는 N(N은 양의 정수) 개의 보상 스위치로 구현되어 보상 제어신호에 따라 스위칭됨으로써 N 개의 기준전압 공급라인들을 상기 피드백 라인에 연결하는 것을 특징으로 하는 유기발광 표시장치. The method according to claim 1,
The reference voltage supply lines are electrically separated from each other;
Wherein the compensation switching unit is implemented with N (N is a positive integer) compensation switches, and is switched according to a compensation control signal to connect N reference voltage supply lines to the feedback line. 제 6 항에 있어서,
상기 데이터 구동회로는 다수의 데이터 드라이버 IC들을 포함하고;
상기 보상 스위치는 적어도 하나의 데이터 드라이버 IC마다 1개씩 할당되고;
상기 할당된 보상 스위치는 해당 데이터 드라이버 IC에 연결된 다수의 기준전압 공급라인들 중 어느 하나에 접속되는 것을 특징으로 하는 유기발광 표시장치.The method according to claim 6,
The data driving circuit includes a plurality of data driver ICs;
The compensation switches being allocated one for each at least one data driver IC;
And the assigned compensation switch is connected to any one of a plurality of reference voltage supply lines connected to the data driver IC. 제 1 항에 있어서,
상기 기준전압 공급라인들은 전기적으로 서로 분리되고;
상기 보상 스위칭부는 미리 정해진 선택군마다 할당된 제1 및 제2 보상 스위치를 구비하고;
M(M은 2 이상의 양의 정수)개의 선택군들에 있어, M 개의 제1 보상 스위치들은 항상 온 레벨로 유지되고, M 개의 제2 보상 스위치들은 서로 다른 보상 제어신호에 따라 순차적으로 스위칭됨으로써 M 개의 기준전압 공급라인들을 상기 피드백 라인에 순차적으로 연결하고;
상기 선택군은 적어도 하나 이상의 데이터 드라이버 IC에 의해 구동되는 기준전압 공급라인들을 포함하는 것을 특징으로 하는 유기발광 표시장치.The method according to claim 1,
The reference voltage supply lines are electrically separated from each other;
Wherein the compensation switching unit has first and second compensation switches assigned to predetermined groups of the selection;
In M selection groups (M is a positive integer equal to or greater than 2), M first compensation switches are always kept on level, and M second compensation switches are sequentially switched according to different compensation control signals, Sequentially connecting the reference voltage supply lines to the feedback line;
Wherein the selection group includes reference voltage supply lines driven by at least one data driver IC.
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