KR20130048786A - 플랫폼 전력 절감을 위한 조정 장치 및 브레이크 이벤트 애플리케이션 - Google Patents

플랫폼 전력 절감을 위한 조정 장치 및 브레이크 이벤트 애플리케이션 Download PDF

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Abstract

브레이크 이벤트를 관리하는 시스템 및 방법은 제 1 이벤트 소스로부터 제 1 브레이크 이벤트를 검출하는 것과, 제 2 이벤트 소스로부터 제 2 브레이크 이벤트를 검출하는 것을 제공할 수 있다. 일례에서, 이벤트 소스는 플랫폼 및 플랫폼상의 액티브 애플리케이션에 연결되는 디바이스를 포함할 수 있다. 플랫폼에 대한 제 1 및 제 2 브레이크 이벤트의 발행은 플랫폼과 관련되는 런타임 정보에 적어도 부분적으로 기초하여 조정될 수 있다.

Description

플랫폼 전력 절감을 위한 조정 장치 및 브레이크 이벤트 애플리케이션{COORDINATING DEVICE AND APPLICATION BREAK EVENTS FOR PLATFORM POWER SAVING}
실시예는 전반적으로 플랫폼 브레이크 이벤트의 관리에 관련된다. 특히, 플랫폼 전력 절감을 향상시키기 위해 상이한 소스로부터의 브레이크 이벤트의 발행을 조정하는 것에 관한 것이다.
종래 모바일 연산 플랫폼에서는, 다수의 IO(입력/출력) 장치(가령, 통신 인터페이스) 및 소프트웨어 애플리케이션은 조정되지 않은 브레이크 이벤트를 발생시키는 경향이 있는데, 이는 플랫폼 및 그 구성요소가 신속하게 저전력 상태로 진입하고 확장된 시간 동안에 저전력 상태에 머무르는 것을 막을 수 있다. 실제로, 배터리 수명이 짧고 부족할수록 플랫폼이 필요 이상으로 자주 높은 전력 상태에 머무르게 할 수 있다.
실시예는 제 1 이벤트 소스로부터의 제 1 브레이크 이벤트가 검출되고 제 2 이벤트 소스로부터의 제 2 브레이크 이벤트가 검출되는 방법을 제공할 수 있다. 또한, 이 방법은 플랫폼과 관련되는 런타임 정보에 적어도 부분적으로 기초하여 제 1 및 제 2 브레이크 이벤트를 플랫폼으로 발행하는 것을 조정할 수 있다.
다른 실시예는 인스트럭션 세트를 갖는 컴퓨터 판독 가능한 저장 매체를 포함할 수 있는데, 이는 프로세서에 의해 실행되면 컴퓨터로 하여금 제 1 이벤트 소스로부터의 제 1 브레이크 이벤트 및 제 2 이벤트 소스로부터의 제 2 브레이크 이벤트를 검출하게 한다. 또한, 인스트럭션은 컴퓨터로 하여금 플랫폼과 관련되는 런타임 정보에 적어도 부분적으로 기초하여 제 1 및 제 2 브레이크 이벤트를 플랫폼으로 발행하는 것을 조정하게 할 수 있다.
또한, 실시예는 제 1 이벤트 소스로부터 제 1 브레이크 이벤트를 검출하고 제 2 이벤트 소스로부터 제 2 브레이크 이벤트를 검출하는 로직을 갖는 입력/출력(I/O) 모듈을 갖는 장치를 포함할 수 있다. 또한, 이 로직은 플랫폼과 관련되는 런타임 정보에 적어도 부분적으로 기초하여 제 1 및 제 2 브레이크 이벤트를 플랫폼으로 발행하는 것을 조정할 수 있다.
또한, 실시예는 제 1 이벤트 소스, 제 2 이벤트 소스, 프로세서 및 프로세서에 연결되는 입력/출력(IO) 모듈을 포함할 수 있다. IO 모듈은 제 1 이벤트 소스로부터 제 1 브레이크 이벤트를 검출하고 제 2 이벤트 소스로부터 제 2 브레이크 이벤트를 검출하는 로직을 가질 수 있다. 또한, 이 로직은 시스템과 관련되는 런타임 정보에 적어도 부분적으로 기초하여 제 1 및 제 2 브레이크 이벤트를 시스템으로 발행하는 것을 조정할 수 있다.
본 발명의 실시예의 다양한 이점은 첨부된 도면을 참조하여 이하의 상세한 설명 및 청구범위의 내용으로부터 당업자에게 명확할 것이다.
도 1은 실시예에 따른 복수의 조정된 브레이크 이벤트의 예의 블록도이다.
도 2는 실시예에 따른 브레이크 이벤트 관리 유닛의 예의 블록도이다.
도 3은 실시예에 따른 브레이크 이벤트의 발행 조정 방법의 예의 흐름도이다.
도 4는 실시예에 따른 브레이크 이벤트 관리 유닛 및 복수의 통합 유닛의 블록도이다.
도 5는 실시예에 따른 플랫폼의 예의 블록도이다.
이제 도 1을 참조하면, 상이한 소스(가령, 전력 관리 개체)로부터 플랫폼으로의 복수의 브레이크 이벤트 10(10a 내지 10f)의 발행이 조정되기 전과 조정된 후의 도면이 도시되어 있다. 도시된 예에서, 마우스와 같은 디바이스로부터의 입력/출력(IO) 이벤트(10a)(가령, 인터럽트)가 시각 t1에서 요청되고, 플랫폼상에서 실행되는 액티브 애플리케이션으로부터의 타이머 이벤트(10b)가 시각 t2에서 요청된다. 또한, NIC(network interface card)와 같은 다른 디바이스로부터의 일련의 IO 이벤트(10c)가 시각 t3에서 요청될 수 있다. 보다 상세히 설명할 바와 같이, IO 이벤트(10c)는 NIC 또는 소정 위치에 배치되는 통합 유닛에 의해 함께 그룹화될 수 있다. 또한, 오디오 디바이스로부터의 IO 이벤트(10d)가 시각(t4)에서 요청될 수 있다. 또한, 도시된 예는 각각 시각 t5 및 t6에 대해 액티브 애플리케이션으로부터 타이머 이벤트(10e 및 10f)의 검출을 보여주고 있다. 네이티브 상태에서, 브레이크 이벤트(10)는 확장된 시간 동안에 플랫폼이 소정 전력 절감 상태에 진입하는 것을 방지할 타이머 프로파일을 가질 수 있다.
따라서, 플랫폼으로의 브레이크 이벤트(10)의 발행은 플랫폼이 전력 소비를 감소시킬 수 있도록 조정될 수 있다. 예를 들어, 도시된 마우스로부터의 IO 이벤트(10a)는 지연된 시각 t1d까지 지연되어 애플리케이션 타이머 이벤트(10b)의 발행과 정렬될 수 있으며, 이는 지연된 시각(t2d)에서 발행될 수 있다. 다른 예에서, 타이머 이벤트(10b)는 지연 불가능한 이벤트일 수 있다. 이러한 경우, IO 이벤트(10a)는 지연될 수 있는 반면, 타이머 이벤트(10b)는 예정대로 발행될 수 있다. 어느 경우에도, 확장된 아이들 기간(12)이 생성될 수 있는데, 확장된 시간(12)으로 인해 플랫폼은 보다 긴 기간 동안 더 깊은 전력 절감 상태(가령, ACPI/ Advanced Configuration and Power Interface Specification, ACPI Specification, 개정 4.0, 2009년 6월 16일, low power states)로 보다 신속히 진입할 수 있다. 또한, NIC로부터의 IO 이벤트(10c)는 지연된 시각(t3d 및 t4d)에서 오디오 디바이스로부터의 IO 이벤트(10d)로 정렬되어, 다른 확장된 기간(14)을 생성할 수 있다. 유사하게, 애플리케이션 타이머 이벤트(10e 및 10f)는 각각 시각(t5d 및 t6d)로 지연될 수 있고, 확장된 기간(16)을 얻을 수 있다. 간단히 말해서, 확장된 기간(12, 14, 16)은 향상된 플랫폼 전력 절감 및 보다 긴 배터리 수명을 가능하게 할 수 있다.
도 2는, 플랫폼/OS(operating system)(26)과 연관되는 런타임 정보(24)에 적어도 부분적으로 기초하여 브레이크 이벤트(20)를 검출하여 조정된 브레이크 이벤트(22)로서 정렬할 수 있는 브레이크 이벤트 관리 유닛(BMU, 18)을 도시하고 있다. BMU(18)는 모바일 인터넷 디바이스(MID) 플랫폼의 시스템 제어 유닛(SCU) 또는 랩탑 플랫폼의 플랫폼 컨트롤러 허브(PCH)와 같은 플랫폼(26)의 모듈로 구현될 수 있다. 실제로, BMU(18)는 다소 상이한 인터페이스 및 구현 기술을 갖는 운영 시스템(OS)의 커널 공간 또는 사용자 공간에 존재할 수 있다. 도시된 예에서, 런타임 정보(24)는 브레이크 이벤트(20)의 소스(28) 및 플랫폼(26) 자체로부터 얻어질 수 있다. 예를 들어, 플랫폼에 연결되는 디바이스로부터 얻어지는 런타임 정보(24)는 하나 이상의 IO 이벤트에 대한 최대 지연 시간을 식별하는 QoS(quality of service) 사양을 포함할 수 있다. 또한, 애플리케이션으로부터 얻어지는 런타임 정보(24)는 하나 이상의 타이머 이벤트의 지연 가능성(deferability) 특징을 식별할 수 있다. 예를 들어, 타이머 이벤트가 지연 가능하지 않으면, BMU(18)는 지연 가능하지 않은 타이머 이벤트와 다른 브레이크 이벤트를 정렬하려고 시도할 수 있다. 타이머 이벤트가 지연 가능하면, BMU(18)는 최적 플랫폼 전력 절감 및 성능을 위해 타이머 이벤트를 관리할 수 있다.
예를 들어, 애플리케이션이 타이머 이벤트가 매 50ms마다 발생하고 매 100ms의 최대 주파수로 지연 가능한 경우, BMU(18)는 매 100ms마다 타이머 이벤트를 트리거하고 플랫폼(26)은 상대적으로 비활동적이다. 그러나, 플랫폼(26)이 보다 활동적인 경우, 다른 소스에 의해 생성된 브레이크 이벤트로 인해, BMU(18)는, 전력 소비에 부정적인 영향을 주지 않고, 보다 우수한 애플리케이션 성능을 위해 50ms를 향한 타이머 이벤트의 발행을 구성할 수 있다.
또한, 플랫폼(26)은 저전력 상태 브레이크 이븐 타임(even time), 프로그래밍 가능한 성능 요구조건 등의 형태로 런타임 정보(24)를 제공할 수 있다. 저전력 상태 브레이크 이븐 타임은, 저전력 상태로 들어가고 나오는 것과 연관되는 임의의 전력 비용 오버헤드를 오프셋/분할 보상(amortize)하기 위해 특정 저전력 상태에서 플랫폼(26)이 머물러야 하는 시간의 양을 표시할 수 있다. 보다 상세히 후술할 바와 같이, BMU(18)는 각 지연된 브레이크 이벤트에 대한 지연 시간을 결정하기 위해 저전력 상태 브레이크 이븐 타임을 사용할 수 있다. 이와 관련하여, 전력 절감 이득은 유지 시간이 브레이크 이븐 타임보다 길어질 때 신속하게 기울어질 수 있으며, 성능은 현저하게 저하될 수 있다. 따라서, BMU(18)는 브레이크 이븐 타임 및 원하는 성능에 기초하여 합리적인 유지 시간을 결정할 수 있다.
프로그래밍 가능한 성능 요구조건은 플랫폼(26)의 사용자에 의해 정의될 수 있다. 따라서, 사용자가 고성능을 선호하는 경우에는 유지 시간은 짧은 값으로 하향 튜닝되어 (어떤 전력 절감 기회를 잃을 수 있지만) 빠른 응답 및 향상된 성능을 제공할 수 있다. 한편, 사용자가 긴 배터리 수명을 요청하는 경우에는, 유지 시간이 상대적으로 긴 값으로 설정되어 플랫폼(26)에 저전력 상태로 머무를 더 많은 기회를 제공할 수 있다.
도 3을 참조하면, 브레이크 이벤트의 발행을 조정하는 예시적인 방법(30)이 도시되어 있다. 이 방법(30)은 RAM(random access memory), ROM(read only memory), PROM(programmable ROM) 및 플래시 메모리 등 또는 그 임의의 조합과 같은 메모리의 머신 또는 컴퓨터 판독 가능한 저장 매체에 저장되는 펌웨어 및/또는 로직 인스트럭션 세트로서 실행 가능한 소프트웨어에서, ASIC, CMOS(complementary metal oxide semiconductor) 또는 TTL(transistor-transistor logic)기술과 같은 회로 기술을 사용하여 고정 기능 하드웨어로 구현될 수 있다. 프로세싱 블록(32)은 디바이스, 애플리케이션 및 플랫폼으로부터 런타임 정보를 수집하고, 런타임 정보에 기초하여 유지 시간을 결정한다. 전술한 바와 같이, 유지 시간 결정은 저전력 브레이크 이븐 타임 및 프로그래밍 가능한 성능 요구조건뿐만 아니라 IO 이벤트에 대한 최대 지연 시간 및 타이머 이벤트의 지연 가능성 특징을 고려할 수 있다.
브레이크 이벤트가 블록(34)에서 검출되면, 블록(36)에서 유지 시간이 만료되는지 판단될 수 있다. 브레이크 이벤트가 검출되지 않으면, 브레이크 이벤트는 블록(38)에서 지연될 수 있다. 브레이크 이벤트의 지연은 환경에 의존하여 다수의 상이한 방식으로 달성될 수 있다. 예를 들어, 브레이크 이벤트는 큐(queue)에 배치될 수 있는데, 이 큐는 BMU(18)(도 2), 브레이크 이벤트를 발행하는 디바이스와 함께, 디바이스와 연관되는 통합 유닛 등에 위치될 수 있다. 실제로, 브레이크 이벤트가 버스 마스터링 트랜잭션과 연관되는 경우(가령, DMA/직접 메모리 액세스), 브레이크 이벤트는 PCIe(Peripheral Components Interconnect Express) OBFF(opportunistic buffer flush/fill)신호를 디어서팅(de-asserting)함으로써 지연되어 PCIe 버스가 이용 가능하지 않다고 소스 디바이스에 통보할 수 있다.
지연 불가능한 브레이크 이벤트가 블록(40)에서 검출되거나 유지 시간이 만료되었다고 블록(36)에서 판단되면, 블록(42)에서 모든 지연된 브레이크 이벤트가 플랫폼에 대해 해제/발행될 수 있다. 도시된 블록(44)은 수집된 런타임 정보에 기초하여 다음 유지 시간의 스케줄링을 제공한다. 전술한 바와 같이, 유지 시간은 동적으로 조절될 수 있다. 플랫폼 전력 관리 유닛은 블록(46)에서 다음 유지 시간에 대해 통보받을 수 있다.
도 4는 애플리케이션 타이머(54) 및 디바이스(56)(56a 내지 56c)로부터 다양한 브레이크 이벤트를 수신하는 프로세서/플랫폼(52)에 연결되며, 브레이크 이벤트는 프로세서/플랫폼(52)으로 하여금 하나 이상의 저전력 상태를 빠져나오도록(또는 들어가는 것을 막도록)할 수 있다. 도시된 예에서, 통합 유닛(58)은, 예를 들어, 다수의 브레이크 이벤트를 얻을 수 있는 다수의 패킷을 하나의 브레이크 이벤트로 결합함으로써 브레이크 이벤트의 수를 감소시키는 데에 사용될 수 있다. 그러므로, 통합 유닛(58)은 네트워크 컨트롤러와 같은 통신 디바이스를 위해 특히 유용할 수 있으며, 다른 디바이스 및 애플리케이션도 통합 프로세스로부터 이점을 취할 수 있다.
부트 시점의 초기화 단계로부터 시작하여, 통합 유닛(58)은 오버라이드 정책, 디바이스 버퍼 크기, 디바이스 레이턴시 허용 범위 요구조건 등과 같은 시스템 파라미터를 얻을 수 있거나 이미 알고 있을 수 있다. 이들 파라미터는 통합 유닛(58)에 의해 사용되어 초기 디바이스/애플리케이션 기반 유지 시간을 결정할 수 있는데, 이는 추후에 필요에 따라 런타임 동작에 기초하여 조절될 수 있다. 런타임 동안에, 통합 유닛(58)은 각 브레이크 이벤트 가능 디바이스를 추적하여 디바이스가 사전 결정된 기간 동안에 조용한지(가령, 마지막 α ms 동안에 인터럽트가 발생하지 않았는지)를 판단할 수 있다. 이러한 비활동이면, 논의되고 있는 통합 유닛(58)은 유지 간격(가령, β ms)에 진입할 수 있는데, 이 동안에는 이 특정 소스로부터 인터럽트가 BMU(50) 및/또는 프로세서/플랫폼(52)으로 중계되지 않을 것이다. 이 방안은 각 디바이스/애플리케이션에 대한 상이한 파라미터를 사용하여 디바이스/애플리케이션마다 구현될 수 있다. 또한, 고성능/벤치마킹 모드 등과 같은 통합 유닛(58)을 바이패스하기 위해 소정 방안이 사용될 수 있다.
통합 유닛(58)은 디바이스(56) 및 애플리케이션 타이머(54)에 구현될 수 있지만, 이를 BMU(50)에 위치시킴으로써 디바이스 제조자가 브레이크 이벤트 정렬을 지원할 필요가 없게 하여 스케일러블할 수 있다. 통합 유닛(58)을 BMU(50)에 구현함으로써 버퍼 오버런을 방지하기 위해 유지 타이머 β의 상한이 디바이스의 내부 버퍼 크기와 호환 가능하도록 보장하는 것을 포함할 수 있다. 또한, 비활동 타이머 α는 충분히 큰 값으로 설정되어 이른 만료를 방지하고 최대 시스템 성능에 어떤 부정적인 영향을 주는 것을 방지할 수 있다.
다수의 상이한 방안이 통합 타이머 구성을 위해 사용될 수 있다. 예를 들어, "정적 방안"은 사용자 설정( 또는 OS 프로파일 기반) 시스템 선호도에 대해 통합 동작을 링크하는 것을 포함할 수 있다. 따라서, 사용자가 고성능 프로파일을 선호하는 경우, 통합은 β=0으로 바이패스될 수 있다. 성능/전력 프로파일의 균형을 맞추기 위해, 전형적인 β=5ms의 값이 선택될 수 있다. 저전력 모드에 있어서, 최대 전력 절감과 관련하여, 전형적인 β=10ms의 값이 선택될 수 있다. 이와 달리, "동적 방안"이 사용될 수 있는데, β는 소정 카운팅 기간에 걸쳐 관측된 평균 브레이크 이벤트 카운트에 기초하여 폐쇄 루프 기반으로 제어된다. 그러므로, 이 방안은 통합을 가능한 비방해적으로 구성하여, (평균 센스로) 브레이크 이벤트 동작이 현저하게 변하지 않게 한다. 전형적으로 작은 β 값으로부터 시작하여, 개별적인 디바이스로부터의 브레이크 이벤트의 수는 상대적으로 긴 기간(즉, 대략 수 초)에 걸쳐 관측될 수 있으며, β는 평균 이벤트 횟수가 현저하게 변하지 않을 때까지 부가적으로 증가될 수 있다. 변화에 의존하여, b는 처음부터 구성되거나 배수적으로(multiplicatively) 감소되도록 리셋될 수 있다.
도 5를 참조하면, 시스템(60)이 도시되어 있다. 이 시스템(60)은 연산 기능(가령, PDA(personal digital assistant), 랩탑), 통신 기능(가령, 무선 스마트폰), 이미징 기능, 미디어 재생 기능 또는 그 임의의 조합(가령, 모바일 인터넷 디바이스(MID))을 갖는 모바일 플랫폼의 일부일 수 있다. 도시된 예에서, 이 시스템(60)은 프로세서(62), IMC(integrated memory controller,74), IO 모듈(64), 시스템 메모리(66), 네트워크 컨트롤러(가령, 네트워크 인터페이스 카드, 68), 오디오 IO 디바이스(72), 고체 상태 디스크(SSD, 70) 및 하나 이상의 다른 컨트롤러(80)를 포함한다. 하나 또는 여러 프로세서 코어(76)를 갖는 코어 영역을 포함할 수 있는 프로세서(62)는, 전술한 바와 같이, 성능 및/또는 전력 관리 고려사항에 기초하여 전력 관리 유닛(PMU, 78)을 사용하여 코어(76) 및 다른 시스템 구성요소를 하나 이상의 활동 및/또는 아이들 상태로 둘 수 있다.
종종 칩셋의 사우스브릿지(Southbridge) 또는 사우스 콤플렉스(South Complex)로서 지칭되는 도시된 IO 모듈(64)은 호스트 디바이스로서 기능하며, 네트워크 컨트롤러(68)와 통신하는데, 이는 다양한 목적을 위해 오프-플랫폼 통신 기능을 제공할 수 있는데, 가령, 셀룰러 전화(가령, W-CDMA (UMTS), CDMA2000 (IS-856/IS-2000) 등), WiFi (가령, IEEE 802.11, 1999 에디션, LAN/MAN Wireless LANS), 블루투스(가령, IEEE 802.15.1-2005, Wireless Personal Area Networks), WiMax(가령, IEEE 802.16-2004, LAN/MAN Broadband Wireless LANS), GPS(Global Positioning System), 스프레드 스펙트럼(가령, 900MHz) 및 기타 RF 전화 목적을 위한 것이다. 또한, IO 모듈(64)은 이러한 기능을 지원하기 위해 하나 이상의 무선 하드웨어 회로 블록을 포함할 수 있다.
SSD(70)는 하나 이상의 NAND 칩을 포함할 수 있으며, 대용량 데이터 저장 및/또는 현저한 양의 병렬성을 제공하기 위해 사용될 수 있다. 또한, Serial ATA (SATA, 가령, SATA 개정 3.0 사양, 2009년 5월 27일, SATA-IO(SATA International Organization)) 버스 또는 PCI Express Graphics (PEG, 가령, PCI(Peripheral Components Interconnect) Express x16 Graphics 150W-ATX 사양 1.0, PCI Special Interest Group) 버스와 같은 표준 버스상의 IO 모듈(64)에 접속되는 별도의 ASIC(application specific integrated circuit) 컨트롤러로서 구현되는 NAND 컨트롤러를 포함하는 해결책도 존재할 수 있다. 또한, SSD(70)는 USB(Universal Serial Bus, 가령, USB 사양 2.0, USB Implementers Forum) 플래시 저장 디바이스로서 사용될 수 있다.
도시된 IO 모듈(64)은 네트워크 컨트롤러(68), 오디오 IO 디바이스(72), SSD(70), 프로세서(62)상에서 실행되는 액티브 애플리케이션 등과 같은 복수의 상이한 소스로부터 브레이크 이벤트를 검출하고, 시스템(60)과 연관되는 런타임 정보에 기초하여 프로세서(62)로의 브레이크 이벤트 발행을 조정한다. 일례에서, 브레이크 이벤트의 발행을 조정하는 것은 런타임 정보에 기초하여 유지 시간을 결정하는 것과, 유지 시간에 기초하여 적어도 하나의 브레이크 이벤트를 지연시키는 것을 포함한다. 예를 들어, 시스템(60)은 VoIP(voice over Internet Protocol) 애플리케이션을 실행할 수 있는데, 여기서 네트워크 제어기(68) 및 오디오 IO 디바이스(72)는 다른 디바이스에 의해 생성되는 IO 이벤트를 거의 고려하지 않거나 고려하지 않고 각각 능동적으로 IO 이벤트를 생성한다. BMU(82)를 사용하여 네트워크 컨트롤러(68) 및 오디오 IO 디바이스(72)로부터 브레이크 이벤트를 조정함으로써, 도시된 IO 모듈(64)은 시스템(60)의 구성요소가 보다 긴 기간동안 보다 깊은 저전력 상태로 진입할 수 있게 하여, 시스템(60)에 의해 달성되는 전력 절감을 현저하게 향상시킨다.
따라서, 전술한 기술은 컴퓨터 시스템 아키텍쳐 및 인터페이스를 정의하는 전체론적 방안을 제공하여 다수의 IO 디바이스 및 애플리케이션의 동작을 조정하고 정렬한다. 결과적으로, 플랫폼 아이들(idleness)이 최적 플랫폼 전력 절감을 위해 최대화될 수 있다. 또한, 이러한 조정 및 정렬은 플랫폼이 이상적인 "작업 부하에 비례하는" 전력 소비에 보다 가까워지며 견고한 성능을 가질 수 있게 한다.
본 발명의 실시예는 모든 종류의 반도체 집적 회로("IC") 칩과 관련하여 사용하기에 적용 가능하다. 이들 IC 칩의 예는 프로세서, 컨트롤러, 칩셋 컴포넌트, PLA(programmable logic arrays), 메모리 칩, 네트워크 칩, 시스템 온 칩(SoC), SSD/NAND 컨트롤러 ASIC 등을 포함하지만 이에 한정되는 것은 아니다. 또한, 도면의 일부에서, 신호 도체 라인은 라인으로 표현된다. 일부는 보다 구성적(constituent) 신호 경로를 표시하기 위해 두꺼울 수 있고/있거나, 다수의 구성적 신호 경로를 표시하기 위해 번호를 지정될 수 있고/있거나, 주요한 정보 흐름 방향을 나타내기 위해 한쪽 이상의 단부에 화살표를 가질 수 있다. 그러나, 이는 제한적인 방식으로 고려되어서는 안 된다. 오히려, 이러한 추가적인 세부 사항은 회로를 쉽게 이해할 수 있도록 하나 이상의 실시예와 관련하여 사용될 수 있다. 임의의 표현된 신호 라인은, 추가적인 정보를 갖든 갖지 않든 간에, 다수의 방향으로 이동할 수 있으며 임의의 적합한 유형의 신호 방안, 가령, 차동 쌍으로 구현되는 디지털 또는 아날로그 라인, 광 섬유 라인 및/또는 싱글 엔디드(single-ended) 라인으로 구현될 수 있는 하나 이상의 신호를 실제로 포함할 수 있다.
예시적 크기/모델/값/범위가 주어지지만, 본 발명의 실시예는 이에 한정되지 않는다. 제조 기술(가령, 포토리소그래피)이 시간이 지날수록 발전함에 따라, 제조되는 장치의 크기가 작아질 것으로 예상된다. 또한, 설명을 간략히 하기 위하여 본 발명의 실시예의 특정 양태를 모호하게 하지 않기 위해 IC 칩 및 기타 부품으로의 잘 알려진 전원/접지 접속은 도면 내에 도시될 수도 있고 도시되지 않을 수도 있다. 또한, 본 발명의 실시예를 모호하게 하지 않기 위해 블록도 형태로 배치할 수 있으며, 이러한 블록도 배치의 구현에 관한 사양은 구현될 실시예 내의 플랫폼에 크게 의존하므로, 즉, 이러한 사양은 당업자가 이해할 것이다. 특정 세부사항(가령, 회로)가 본 발명의 실시예를 설명하기 위해 제시된 경우, 본 발명의 실시예는 이들 특정 세부사항 없이도 또는 변형하여 실시될 수 있음을 당업자에게 자명할 것이다. 따라서, 이들 설명은 제한적인 것이 아니라 예시적인 것으로 간주되어야 한다.
"연결되는"이라는 용어는 논의되는 구성요소들 사이의 직접 또는 간접적인 임의의 관계를 지칭하기 위해 사용될 수 있으며, 전기, 기계, 유체, 광학, 전자기, 전기기계 또는 다른 접속에 적용될 수 있다. 또한, "제 1 ", "제 2 "라는 용어는 단지 설명을 돕기 위해 본 명세서에서 사용되며, 특별한 언급이 없는 한 특정 시간적 또는 순서적 의미를 갖지 않는다.
당업자는 전술한 바로부터 본 발명의 실시예의 광범위한 기술이 다양한 형태로 구현될 수 있음을 인식할 것이다. 그러므로, 본 발명의 실시예는 특정 예와 관련하여 설명되었지만 본 발명의 실시예의 진정한 범위는 이에 한정되지 않으며 도면, 상세한 설명 및 이하의 청구범위에 기초하여 다른 수정이 당업자에게 자명할 것이다.

Claims (20)

  1. 하나 이상의 브레이크 이벤트(break event)를 발행(issue)하는 방법으로서,
    제 1 이벤트 소스로부터 제 1 브레이크 이벤트를 검출하는 단계와,
    제 2 이벤트 소스로부터 제 2 브레이크 이벤트를 검출하는 단계와,
    플랫폼과 연관되는 런타임 정보에 적어도 부분적으로 기초하여 상기 플랫폼에 대한 상기 제 1 브레이크 이벤트 및 상기 제 2 브레이크 이벤트의 발행을 조정하는(coordinating) 단계를 포함하는
    브레이크 이벤트 발행 방법.
  2. 제 1 항에 있어서,
    상기 제 1 브레이크 이벤트 및 상기 제 2 브레이크 이벤트의 발행을 조정하는 단계는, 상기 런타임 정보에 적어도 부분적으로 기초하여 유지 시간(holding time)을 결정하는 단계와, 상기 유지 시간에 적어도 부분적으로 기초하여 상기 제 1 브레이크 이벤트 및 상기 제 2 브레이크 이벤트 중 적어도 하나를 지연(defer)시키는 단계를 포함하는
    브레이크 이벤트 발행 방법.

  3. 제 1 항에 있어서,
    상기 제 1 이벤트 소스 및 상기 제 2 이벤트 소스 중 적어도 하나로부터 상기 런타임 정보를 획득하는 단계를 더 포함하는
    브레이크 이벤트 발행 방법.
  4. 제 3 항에 있어서,
    상기 런타임 정보는 상기 플랫폼에 연결되는 디바이스로부터 획득되며, 상기 제 1 브레이크 이벤트 및 상기 제 2 브레이크 이벤트 중 적어도 하나는 입력/출력 이벤트를 포함하고, 상기 런타임 정보는 상기 입력/출력 이벤트에 대한 지연 시간을 식별하는
    브레이크 이벤트 발행 방법.
  5. 제 3 항에 있어서,
    상기 런타임 정보는 상기 플랫폼의 액티브 애플리케이션으로부터 획득되며, 상기 제 1 브레이크 이벤트 및 상기 제 2 브레이크 이벤트 중 적어도 하나는 타이머 이벤트를 포함하고, 상기 런타임 정보는 상기 타이머 이벤트의 지연 가능성(deferability) 특성을 식별하는
    브레이크 이벤트 발행 방법.
  6. 제 1 항에 있어서,
    상기 플랫폼으로부터 상기 런타임 정보를 획득하는 단계를 더 포함하는
    브레이크 이벤트 발행 방법.
  7. 제 6 항에 있어서,
    상기 런타임 정보는 저전력 상태 브레이크 이븐 타임(low power state break even time)을 식별하는
    브레이크 이벤트 발행 방법.
  8. 제 6 항에 있어서,
    상기 런타임 정보는 프로그래밍 가능한 성능 요구조건을 식별하는
    브레이크 이벤트 발행 방법.
  9. 하나 이상의 브레이크 이벤트(break event)를 발행하는 장치로서,
    입력/출력 모듈을 포함하고,
    상기 입력/출력 모듈은
    제 1 이벤트 소스로부터 제 1 브레이크 이벤트를 검출하는 수단과,
    제 2 이벤트 소스로부터 제 2 브레이크 이벤트를 검출하는 수단과,
    플랫폼과 연관되는 런타임 정보에 적어도 부분적으로 기초하여 상기 플랫폼에 대한 상기 제 1 브레이크 이벤트 및 상기 제 2 브레이크 이벤트의 발행을 조정하는 수단을 포함하는
    브레이크 이벤트 발행 장치.
  10. 제 9 항에 있어서,
    상기 제 1 브레이크 이벤트 및 상기 제 2 브레이크 이벤트의 발행의 조정은, 상기 런타임 정보에 적어도 부분적으로 기초하는 유지 시간(holding time)의 결정과, 상기 유지 시간에 적어도 부분적으로 기초하는 상기 제 1 브레이크 이벤트 및 상기 제 2 브레이크 이벤트 중 적어도 하나의 지연(deference)을 포함하는
    브레이크 이벤트 발행 장치.
  11. 제 9 항에 있어서,
    상기 입력/출력 모듈은, 상기 제 1 이벤트 소스 및 상기 제 2 이벤트 소스 중 적어도 하나로부터 상기 런타임 정보를 획득하는 수단을 더 포함하는
    브레이크 이벤트 발행 장치.
  12. 제 11 항에 있어서,
    상기 런타임 정보는 상기 플랫폼에 연결되는 디바이스로부터 획득되며, 상기 제 1 브레이크 이벤트 및 상기 제 2 브레이크 이벤트 중 적어도 하나는 입력/출력 이벤트를 포함하고, 상기 런타임 정보는 상기 입력/출력 이벤트에 대한 지연 시간을 식별하는
    브레이크 이벤트 발행 장치.
  13. 제 11 항에 있어서,
    상기 런타임 정보는 상기 플랫폼의 액티브 애플리케이션으로부터 획득되며, 상기 제 1 브레이크 이벤트 및 상기 제 2 브레이크 이벤트 중 적어도 하나는 타이머 이벤트를 포함하고, 상기 런타임 정보는 상기 타이머 이벤트의 지연 가능성 특성을 식별하는
    브레이크 이벤트 발행 장치.

  14. 제 9 항에 있어서,
    상기 입력/출력 모듈은 상기 플랫폼으로부터 상기 런타임 정보를 획득하는 로직을 더 포함하고, 상기 런타임 정보는 저전력 상태 브레이크 이븐 타임 및 프로그래밍 가능한 성능 요구조건 중 적어도 하나를 식별하는
    브레이크 이벤트 발행 장치.
  15. 하나 이상의 브레이크 이벤트를 발행하는 시스템으로서,
    제 1 이벤트 소스와,
    제 2 이벤트 소스와,
    프로세서와,
    상기 프로세서에 연결되는 입력/출력 모듈을 포함하되,
    상기 입력/출력 모듈은,
    상기 제 1 이벤트 소스로부터 제 1 브레이크 이벤트를 검출하는 수단과,
    상기 제 2 이벤트 소스로부터 제 2 브레이크 이벤트를 검출하는 수단과,
    상기 시스템과 연관되는 런타임 정보에 적어도 부분적으로 기초하여 상기 시스템에 대한 상기 제 1 브레이크 이벤트 및 상기 제 2 브레이크 이벤트의 발행을 조정하는 수단을 구비하는
    브레이크 이벤트 발행 시스템.
  16. 제 15 항에 있어서,
    상기 제 1 브레이크 이벤트 및 상기 제 2 브레이크 이벤트의 발행의 조정은, 상기 런타임 정보에 적어도 부분적으로 기초하는 유지 시간(holding time)의 결정과,
    상기 유지 시간에 적어도 부분적으로 기초하는 상기 제 1 브레이크 이벤트 및 상기 제 2 브레이크 이벤트 중 적어도 하나의 지연을 포함하는
    브레이크 이벤트 발행 시스템.
  17. 제 15 항에 있어서,
    상기 입력/출력 모듈은, 상기 제 1 이벤트 소스 및 상기 제 2 이벤트 소스 중 적어도 하나로부터 상기 런타임 정보를 획득하는 수단을 더 포함하는
    브레이크 이벤트 발행 시스템.
  18. 제 17 항에 있어서,
    상기 제 1 이벤트 소스 및 상기 제 2 이벤트 소스 중 적어도 하나는 상기 시스템에 연결되는 디바이스를 포함하고, 상기 제 1 브레이크 이벤트 및 상기 제 2 브레이크 이벤트 중 적어도 하나는 입력/출력 이벤트를 포함하며, 상기 런타임 정보는 상기 입력/출력 이벤트에 대한 지연 시간을 식별하는
    브레이크 이벤트 발행 시스템.
  19. 제 17 항에 있어서,
    상기 제 1 이벤트 소스 및 상기 제 2 이벤트 소스 중 적어도 하나는 액티브 애플리케이션을 실행하는 상기 시스템의 구성요소를 포함하고, 상기 제 1 브레이크 이벤트 및 상기 제 2 브레이크 이벤트 중 적어도 하나는 타이머 이벤트를 포함하며, 상기 런타임 정보는 상기 타이머 이벤트에 대한 지연 가능성 특성을 식별하는
    브레이크 이벤트 발행 시스템.
  20. 제 15 항에 있어서,
    상기 입력/출력 모듈은 상기 시스템으로부터 상기 런타임 정보를 획득하는 수단을 더 포함하고, 상기 런타임 정보는 저전력 상태 브레이크 이븐 타임 및 프로그래밍 가능한 성능 요구조건 중 적어도 하나를 식별하는
    브레이크 이벤트 발행 시스템.
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