KR20130014977A - Signal transfer circuit - Google Patents

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Abstract

PURPOSE: A signal transmitting circuit is provided to guarantee a stable operation of the power supply and detect an accurate instantaneous low voltage without an influence of the noise. CONSTITUTION: A voltage divider(100) divides the input voltage into the predetermined voltage. A square wave generator(300) is connected to the voltage divider, and generates a square wave detection signal having a duty rate, which is resulted by comparing the inputted input voltage and the internal reference voltage. A voltage changer(400) is formed between the voltage divider and the square wave generator, and forms a hysteresis voltage.

Description

신호 전달 회로{SIGNAL TRANSFER CIRCUIT}[0001] SIGNAL TRANSFER CIRCUIT [0002]

본 발명은 전원장치등에 적용되는 신호 전달 회로에 관한 것으로, 전원장치의 안정된 동작을 보장할 수 있고, 노이즈의 영향없이 보다 정확한 순간 저전압을 검출할 수 있는 전압 검출 회로에 관한 것이다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a signal transfer circuit applied to a power supply device and the like, and to a voltage detection circuit that can ensure stable operation of a power supply device and can detect a more accurate instantaneous low voltage without the influence of noise.

일반적으로, 통상 신호전달회로에서 출력되는 검출 신호의 구현 방식은, 그 신호 형태에 따라 직류 파형(Wave Form) 방식과 구형 파형(Wave Form) 방식을 들 수 있다.In general, a method of implementing a detection signal output from a signal transmission circuit may be, for example, a direct current waveform and a rectangular waveform according to the signal type.

본 발명은 입력에 잡음이 포함되어도 출력에 영향을 미치지 않는 잡음 제거 기능을 갖는 신호전달회로에 관한 것이다.The present invention relates to a signal transmission circuit having a noise canceling function that does not affect the output even when noise is included in the input.

도 1은 종래 신호 전달회로를 도시한 도면이고, 도 2는 종래 신호 전달회로의 오동작 출력전압을 나타내는 도면이다.1 is a diagram illustrating a conventional signal transmission circuit, and FIG. 2 is a diagram illustrating a malfunction output voltage of the conventional signal transmission circuit.

종래 신호전달회로는 입력 전압을 기설정된 전압으로 분할하는 전압 분할부(100), 상기 전압 분할부(100)로부터의 분할된 전압을 안정화시키는 전압 안정화 회로부(200), 상기 전압 안정화 회로부(200)로부터 안정화된 입력전압과 내부 기준 전압을 비교하여, 결과에 따른 듀티비를 갖는 구형파 검출신호를 생성하는 구형파 생성부(300)를 포함할 수 있다.The conventional signal transmission circuit includes a voltage divider 100 for dividing an input voltage into a predetermined voltage, a voltage stabilizer 200 for stabilizing a divided voltage from the voltage divider 100, and the voltage stabilizer 200. The square wave generator 300 may include a square wave generator 300 configured to compare the stabilized input voltage with an internal reference voltage to generate a square wave detection signal having a duty ratio.

상기 전압 분할부(100)는, 상기 입력 전압을 기설정된 전압으로 분할한다. 예를 들면, 상기 전압 분할부(100)는, 상기 교류전압이 정상적인 상태에서 상기 구형파 생성부(300)의 내부 기준전압보다 높은 전압으로 분할하도록 설정된 값을 갖는 복수의 저항들을 포함할 수 있다.The voltage divider 100 divides the input voltage into a predetermined voltage. For example, the voltage divider 100 may include a plurality of resistors having a value set to divide the voltage into a voltage higher than an internal reference voltage of the square wave generator 300 when the AC voltage is in a normal state.

상기 전압 분할부(100)는, 상기 입력전압과 접지 사이에 직렬로 연결된 2개의 제1 및 제2 저항(R1~R2)을 포함할 수 있으며, 이 경우에, 상기 제1 저항(R1)과 제2 저항(R2)간의 분할노드에서 분할된 전압을 공급할 수 있다.The voltage divider 100 may include two first and second resistors R1 to R2 connected in series between the input voltage and the ground. In this case, the voltage divider 100 may include the first resistor R1 and the first resistor R1. The divided voltage may be supplied from the split node between the second resistors R2.

상기 전압 안정화 회로부(200)는, 정확한 전압 검출을 위해서, 상기 전압 분할부(100)로부터의 분할된 전압을 안정화시켜 상기 구형파 생성부(300)에 공급한다. 이에 따라, 상기 구형파 생성부(300)가 보다 정확한 동작을 할 수 있게 된다.The voltage stabilization circuit unit 200 stabilizes the divided voltage from the voltage dividing unit 100 and supplies the stabilized voltage to the square wave generator 300 to accurately detect the voltage. Accordingly, the square wave generator 300 may perform a more accurate operation.

일 예로, 상기 전압 안정화 회로부(200)는, 커패시터(C1)를 포함할 수 있다. 이때, 상기 커패시터(C1)는 상기 전압 분할부(100)의 기설정된 분할노드와 접지 사이의 전압을 평활시키고, 이러한 커패시터(C1)의 평활에 의해서, 상기 전압 안정화 회로부(200)에서 구형파 생성부(300)로 입력되는 입력전압(V,be)은 안정화된다.For example, the voltage stabilization circuit unit 200 may include a capacitor C1. In this case, the capacitor C1 smoothes the voltage between the predetermined division node of the voltage division unit 100 and the ground, and by the smoothing of the capacitor C1, the square wave generator in the voltage stabilization circuit unit 200. The input voltage V, be input to 300 is stabilized.

다음, 상기 구형파 생성부(300)는, 상기 전압 안정화 회로부(200)로부터 안정화된 입력전압(V,be)과 내부 기준전압을 비교하여, 상기 입력전압과 내부 기준전압의 비교결과에 따른 듀티비를 갖는 구형파 검출신호를 생성한다. 상기 구형파 생성부(300)는 트랜지스터를 포함할 수 있다.Next, the square wave generator 300 compares the input voltage (V, be) and the internal reference voltage stabilized from the voltage stabilization circuit unit 200, the duty ratio according to the comparison result of the input voltage and the internal reference voltage Generate a square wave detection signal having The square wave generator 300 may include a transistor.

도 2에 도시한 바와 같이 상기 입력전압(V,be)과 내부 기준전압(V,th)의 비교결과로서, 상기 입력전압(V,be)이 내부 기준전압(V,th)보다 높으면 로우레벨을 갖는 구형파 검출신호가 출력되고, 반대로 상기 입력전압(V,be)이 내부 기준전압(V,th)보다 높지 않으면 하이레벨을 갖는 구형파 검출신호가 출력된다.As shown in FIG. 2, as a result of comparing the input voltage (V, be) with the internal reference voltage (V, th), when the input voltage (V, be) is higher than the internal reference voltage (V, th), low level. A square wave detection signal having a voltage is output. On the contrary, a square wave detection signal having a high level is output when the input voltage (V, be) is not higher than the internal reference voltage (V, th).

구체적으로 상기 구형파 생성부(300)는 트랜지스터(TR)를 포함할 수 있는데, 상기 트랜지스터(TR)에 입력되는 상기 입력전압(V,be)이 상기 트랜지스터(TR)의 동작전압인 내부 기준전압(V,th)보다 높으면, 상기 트랜지스터(TR)가 턴온하여, 로우 레벨의 구형파 검출신호가 출력된다.In more detail, the square wave generator 300 may include a transistor TR, wherein the input voltages V and be input to the transistor TR are internal reference voltages that are operating voltages of the transistor TR. If it is higher than V, th, the transistor TR is turned on, and a low level square wave detection signal is output.

이와 반대로, 상기 트랜지스터(TR)에 입력되는 상기 입력전압(V,be)이 상기 트랜지스터(TR)의 동작전압인 내부 기준전압(V,th)보다 낮으면, 상기 트랜지스터(TR)가 턴오프하여, 하이 레벨의 구형파 검출신호가 출력된다.On the contrary, when the input voltage V, be input to the transistor TR is lower than the internal reference voltage V, th which is an operating voltage of the transistor TR, the transistor TR is turned off. The high level square wave detection signal is output.

즉, 상기 트랜지스터(TR)가 턴온되는 경우에는 출력전압(Vout)에 로우레벨의 구형파 검출신호가 출력되고, 반대로 상기 트랜지스터(TR)가 턴오프되는 경우에는 출력전압(Vout)에 하이레벨의 구형파 검출신호가 출력된다.That is, when the transistor TR is turned on, a low-level square wave detection signal is output to the output voltage Vout. On the contrary, when the transistor TR is turned off, a square wave of high level to the output voltage Vout. The detection signal is output.

그런데 상기 입력전압(Vin)에 t1의 시간만큼 노이즈가 포함되는 경우, 상기 노이즈로 인해 상기 구형파 생성부(300)에 입력되는 전압이 동작전압보다 충분히 크지 못하게 되어, 온-오프 동작이 반복되는 등, 회로가 오동작할 수 있다는 문제점이 있다.However, when noise is included in the input voltage Vin for a time of t1, the voltage input to the square wave generator 300 may not be sufficiently larger than the operating voltage due to the noise, and the on-off operation is repeated. There is a problem that the circuit may malfunction.

구체적으로, 노이즈로 인해 t1의 시간동안 상기 트랜지스터(TR)에 입력되는 상기 입력전압(V,be)이 상기 트랜지스터(TR)의 동작전압인 내부 기준전압(V,th)보다 낮아지는 경우, 출력전압(Vout)이 t1의 시간만큼 온오프되어 회로가 오동작할 수 있다.Specifically, when the input voltage (V, be) input to the transistor (TR) for a time t1 due to noise is lower than the internal reference voltage (V, th) that is the operating voltage of the transistor TR, output The voltage Vout is turned on and off by the time of t1 and the circuit may malfunction.

이와 같은 종래 전압 검출회로에서는, 입력전압이 일정 레벨 이상으로 인가되면 트랜지스터가 동작하여 출력전압이 반전되는 회로가 사용될 수 있는데, 입력 전압에 노이즈(noise)가 포함되는 경우, 트랜지스터가 온-오프(on-off) 오동작 되는 것을 방지하기 위해 전압 안정화 회로부에 노이즈 제거용 카패시터가 포함되어 있으나, 입력전압에 노이즈가 심화되는 경우, 또는 트랜지스터의 베이스 전압이 동작전압도다 충분히 크지 못한 경우에는 트랜지스터가 온-오프(on-off) 오동작 될 수 있다는 문제점이 있다.In such a conventional voltage detection circuit, a circuit in which the transistor is operated when the input voltage is applied above a predetermined level and the output voltage is inverted may be used. When the input voltage includes noise, the transistor is turned on or off ( on-off) The noise reduction capacitor is included in the voltage stabilization circuit to prevent malfunction, but the transistor is turned on when the noise is deepened in the input voltage or when the base voltage of the transistor is not large enough. There is a problem that on-off may be malfunctioned.

실시예에 따른 신호전달회로는 입력전압을 분할하는 전압 분할부; 상기 전압 분할부와 연결되고 입력된 입력전압과 내부 기준 전압을 비교하여, 결과에 따른 듀티비를 갖는 구형파 검출신호를 생성하며, 제1 트랜지스터를 포함하고 상기 제1 트랜지스터는 콜렉터 단에 바이어스 저항인 제5저항을 포함하고, 에미터단이 접지와 연결되는 구형파 생성부; 및, 상기 전압 분할부와 구형파 생성부의 사이에 형성되고, 히스테리시스 전압을 형성하는 전압변화부를 포함한다.The signal transmission circuit according to the embodiment includes a voltage divider for dividing an input voltage; A square wave detection signal having a duty ratio according to a result is generated by comparing an input voltage input to the voltage divider and an internal reference voltage, and including a first transistor, wherein the first transistor is a bias resistor at a collector stage. A square wave generator including a fifth resistor and having an emitter end connected to ground; And a voltage changer formed between the voltage divider and the square wave generator to form a hysteresis voltage.

본 발명에 따르면, 잡음이 중첩된 신호가 입력되어도 잡음을 제거해서 신호를 전달할 수 있고 또한 반도체 집적회로에 적합한 신호 전달회로를 제공할 수 있다.According to the present invention, even when a signal overlapping noise is input, the signal can be transmitted by removing the noise, and a signal transmission circuit suitable for a semiconductor integrated circuit can be provided.

도 1은 종래 신호 전달회로를 도시한 도면
도 2는 종래 신호 전달회로의 오동작 출력전압을 나타내는 도면
도 3은 발명의 실시예에 따른 신호 전달회로를 도시한 도면
도 4는 발명의 실시예에 따른 신호 전달회로에서 시간에 따른 입력전압을 도시한 도면
도 5는 발명의 실시예에 따른 신호 전달회로에서 시간에 따라 구형파 생성부에 입력되는 전압을 도시한 도면
도 6은 발명의 실시예에 따른 신호 전달회로에서 시간에 따라 구형파 생성부 및 전압변화부의 트랜지스터의 동작과 출력전압의 온/오프를 나타내는 도면.1 is a diagram illustrating a conventional signal transfer circuit.
2 is a view showing a malfunction output voltage of a conventional signal transmission circuit.
3 illustrates a signal transfer circuit according to an embodiment of the invention.
4 is a diagram illustrating an input voltage over time in a signal transfer circuit according to an exemplary embodiment of the present invention.
5 is a diagram illustrating a voltage input to a square wave generating unit with time in a signal transfer circuit according to an exemplary embodiment of the present invention.
FIG. 6 is a diagram illustrating operations of transistors of a square wave generator and a voltage changer and output voltages on and off according to time in a signal transfer circuit according to an exemplary embodiment of the present invention. FIG.

이하, 본 발명의 바람직한 실시예를 첨부된 도면들을 참조하여 상세히 설명한다. 우선 각 도면의 구성요소들에 참조부호를 부가함에 있어서, 동일한 구성요소들에 대해서는 비록 다른 도면상에 표시되더라도 가능한 한 동일한 부호를 가지도록 하고 있음에 유의해야 한다. 또한, 본 발명을 설명함에 있어, 관련된 공지 구성 또는 기능에 대한 구체적인 설명이 본 발명의 요지를 흐릴 수 있다고 판단되는 경우에는 그 상세한 설명은 생략한다.
Hereinafter, preferred embodiments of the present invention will be described in detail with reference to the accompanying drawings. In the drawings, the same reference numerals are used to designate the same or similar components throughout the drawings. In the following description of the present invention, a detailed description of known functions and configurations incorporated herein will be omitted when it may make the subject matter of the present invention rather unclear.

도 3은 발명의 실시예에 따른 신호 전달회로를 도시한 도면이다.3 is a diagram illustrating a signal transfer circuit according to an exemplary embodiment of the present invention.

도 4는 발명의 실시예에 따른 신호 전달회로에서 시간에 따른 입력전압을 도시한 도면이며, 도 5는 발명의 실시예에 따른 신호 전달회로에서 시간에 따라 구형파 생성부에 입력되는 전압을 도시한 도면이고, 도 6은 발명의 실시예에 따른 신호 전달회로에서 시간에 따라 구형파 생성부 및 전압변화부의 트랜지스터의 동작과 출력전압의 온/오프를 나타내는 도면이다.4 is a diagram illustrating an input voltage according to time in a signal transmission circuit according to an exemplary embodiment of the present invention, and FIG. 5 is a diagram illustrating a voltage input to a square wave generating unit according to time in a signal transmission circuit according to an exemplary embodiment of the present invention. FIG. 6 is a diagram illustrating operations of transistors of a square wave generator and a voltage changer and output voltages on and off in a signal transfer circuit according to an exemplary embodiment of the present invention.

발명의 실시예에 따른 신호 전달회로는 입력 전압을 기설정된 전압으로 분할하는 전압 분할부(100), 상기 전압 분할부(100)와 연결되고 입력된 입력전압과 내부 기준 전압을 비교하여, 결과에 따른 듀티비를 갖는 구형파 검출신호를 생성하는 구형파 생성부(300); 및, 상기 전압 분할부(100)와 구형파 생성부(300)의 사이에 형성되고, 히스테리시스 전압을 형성하는 전압변화부(400)를 포함할 수 있다.The signal transfer circuit according to the embodiment of the present invention is connected to the voltage divider 100 for dividing an input voltage into a predetermined voltage, and is connected to the voltage divider 100 and compares the input voltage with an internal reference voltage. Square wave generator 300 for generating a square wave detection signal having a duty ratio according to the; And a voltage changer 400 formed between the voltage divider 100 and the square wave generator 300 to form a hysteresis voltage.

상기 히스테리시스 전압의 범위는 상기 제1 트랜지스터(Q1) 및 저항(R1, R2, R3)을 조절하여 변화시킬 수 있다.The range of the hysteresis voltage may be changed by adjusting the first transistor Q1 and the resistors R1, R2, and R3.

상기 전압 분할부(100)는, 상기 정류된 전압을 기설정된 전압으로 분할한다. 예를 들면, 상기 전압 분할부(100)는, 상기 교류전압이 정상적인 상태에서 상기 구형파 생성부(300)의 내부 기준전압보다 높은 전압으로 분할하도록 설정된 값을 갖는 복수의 저항들(R1, R2)을 포함할 수 있다.The voltage dividing unit 100 divides the rectified voltage into a predetermined voltage. For example, the voltage divider 100 may include a plurality of resistors R1 and R2 having a value set to divide the voltage into a voltage higher than an internal reference voltage of the square wave generator 300 when the AC voltage is in a normal state. It may include.

상기 전압 분할부(100)는, 상기 입력전압과 접지 사이에 직렬로 연결된 2개의 제1 및 제2 저항(R1~R2)을 포함할 수 있으며, 이 경우에, 상기 제1 저항(R1)과 제2 저항(R2)간의 분할노드에서 분할된 전압을 공급할 수 있다.The voltage divider 100 may include two first and second resistors R1 to R2 connected in series between the input voltage and the ground. In this case, the voltage divider 100 may include the first resistor R1 and the first resistor R1. The divided voltage may be supplied from the split node between the second resistors R2.

바이어스 전압변화부(400)는 상기 전압 분할부(100)와 구형파 생성부(300)의 사이에 형성될 수 있다. 바이어스 전압변화부(400)는 제2 트랜지스터(Q2)를 포함할 수 있고, 상기 트랜지스터의 베이스단은 제4저항(R4)이 연결될 수 있다. 상기 제2 트랜지스터(Q2)의 컬렉터 단에는 바이어스 저항인 제3 저항(R3)이 연결될 수 있고, 에미터 단은 접지와 연결될 수 있다. 상기 컬렉터 단에 연결되는 제3 저항(R3)은 상기 제2 저항(R2)과 병렬로 연결될 수 있다.The bias voltage change unit 400 may be formed between the voltage divider 100 and the square wave generator 300. The bias voltage change unit 400 may include a second transistor Q2, and a fourth resistor R4 may be connected to a base terminal of the transistor. A third resistor R3, which is a bias resistor, may be connected to the collector terminal of the second transistor Q2, and an emitter terminal may be connected to the ground. The third resistor R3 connected to the collector terminal may be connected in parallel with the second resistor R2.

상기 구형파 생성부(300)의 제1 트랜지스터(Q1)는 컬렉터 단에 바이어스 저항인 제5 저항(R5)이 연결될 수 있으며, 에미터 단은 상기 제2 트랜지스터(Q2)와 마찬가지로 접지와 연결될 수 있다. 상기 바이어스 저항의 상단에는 제1 트랜지스터(Q1)의 컬렉터에 인가되는 바이어스 전압(Vcc)이 연결될 수 있다.In the first transistor Q1 of the square wave generator 300, a fifth resistor R5, which is a bias resistor, may be connected to a collector terminal, and an emitter terminal may be connected to ground similarly to the second transistor Q2. . A bias voltage Vcc applied to the collector of the first transistor Q1 may be connected to an upper end of the bias resistor.

상기 전압 분할부(100)에 의해 분할된 전압(Vbe)은 상기 구형파 생성부(300)로 입력될 수 있다. 이하 도 4를 참고하여 회로의 동작을 설명한다.The voltage Vbe divided by the voltage divider 100 may be input to the square wave generator 300. Hereinafter, the operation of the circuit will be described with reference to FIG. 4.

도 4에서와 같이, t0의 시간까지 입력전압이 증가하다가, t1 구간에서 노이즈가 인가되고, t2에서부터 감소하는 전원입력을 가정한다.As shown in FIG. 4, it is assumed that an input voltage increases until a time t0, noise is applied in a t1 section, and a power input decreases from t2.

도시된 바와 같이, 시간이 0에서 t0으로 경과함에 따라, 입력전압은 증가하게 된다. t0까지 출력전압(Vout)은 하이값이 검출되게 된다.As shown, as time elapses from 0 to t0, the input voltage increases. The output voltage Vout is detected to a high value until t0.

t0까지 제1 트랜지스터(Q1)의 컬렉터에 인가되는 바이어스 전압(Vcc)으로 인해 전압변화부(400)의 제2 트랜지스터(Q2)가 턴온되어 있는 상황에서, 상기 구형파 생성부(300)에 입력되는 전압(V,be Q1)은 상기 전압변화부(400)의 제2 트랜지스터(Q2)가 구동되고 있으므로, 전압 분할부(100)의 저항과 병렬 연결된 것으로 인식된다. When the second transistor Q2 of the voltage changer 400 is turned on due to the bias voltage Vcc applied to the collector of the first transistor Q1 until t0, the square wave generator 300 is input to the square wave generator 300. The voltage V and be Q1 are recognized as being connected in parallel with the resistance of the voltage divider 100 because the second transistor Q2 of the voltage change unit 400 is driven.

즉, 상기 구형파 생성부(300)에 베이스단에 입력되는 입력전압(V,be Q1)은 하기의 식을 만족하게 된다. That is, the input voltages V and be Q1 input to the base end of the square wave generator 300 satisfy the following equation.

Figure pat00001
.......식(1)
Figure pat00001
....... Equation (1)

식(1)에 나타난 바와 같이, 제1 트랜지스터(Q1)의 컬렉터에 인가되는 바이어스 전압(Vcc)으로 인해 전압변화부(400)의 제2 트랜지스터(Q2)가 턴온되어 있는 상황에서, 입력전압(Vin)이 증가하면 t0까지는 제1 트랜지스터(Q1)에 인가되는 입력전압(V,be Q1)이 상기 제1 트랜지스터(Q1)의 구동전압(Vth)보다 낮기 때문에, 상기 제1 트랜지스터(Q1)는 턴오프된 상태를 유지하게 된다.As shown in Equation (1), when the second transistor Q2 of the voltage change unit 400 is turned on due to the bias voltage Vcc applied to the collector of the first transistor Q1, the input voltage ( When Vin increases, the first transistor Q1 is lower than t0 because the input voltages V and be Q1 applied to the first transistor Q1 are lower than the driving voltage Vth of the first transistor Q1. It remains turned off.

t0을 기점으로 상기 식(1)에 의한 입력전압이 상기 제1 트랜지스터(Q1)의 내부 기준전압(V,th)보다 높아짐에 따라, 상기 제1 트랜지스터(Q1)가 동작되므로 출력전압(Vout)이 하이에서 로우로 동작하게 된다. 이때 상기 제1 트랜지스터(Q1)가 턴온되고, 상기 전압변화부(400)의 제2 트랜지스터(Q2)는 턴오프된다.As the input voltage according to Equation (1) becomes higher than the internal reference voltage (V, th) of the first transistor (Q1) starting at t0, the first transistor (Q1) is operated so that the output voltage (Vout) It goes from high to low. In this case, the first transistor Q1 is turned on and the second transistor Q2 of the voltage change unit 400 is turned off.

도 6에 도시된 바와 같이, 상기 구형파 생성부(300)의 제1 트랜지스터(Q1)와 상기 전압변화부(400)의 제2 트랜지스터(Q2)는 상호 번갈아 동작하는 것임을 알 수 있다. 즉, 상기 구형파 생성부(300)의 제1 트랜지스터(Q1)가 턴온되면, 상기 전압변화부(400)의 제2 트랜지스터(Q2)는 턴오프되고, 상기 구형파 생성부(300)의 제1 트랜지스터(Q1)가 턴오프되면, 상기 전압변화부(400)의 제2 트랜지스터(Q2)는 턴온된다.As shown in FIG. 6, it can be seen that the first transistor Q1 of the square wave generator 300 and the second transistor Q2 of the voltage change unit 400 alternately operate. That is, when the first transistor Q1 of the square wave generator 300 is turned on, the second transistor Q2 of the voltage changer 400 is turned off and the first transistor of the square wave generator 300 is turned off. When Q1 is turned off, the second transistor Q2 of the voltage change unit 400 is turned on.

상기 전압변화부(400)의 제2 트랜지스터(Q2)는 턴오프되므로, 상기 제2 트랜지스터(Q2)의 바이어스 저항인 제3 저항(R3)은 없는 것으로 인식된다. 이에 따라, t0 이후 상기 전압변화부(400)의 제2 트랜지스터(Q2)가 턴오프되면, 상기 제1 트랜지스터(Q1)에 입력되는 전압(V,be Q1)은 하기의 식을 만족하게 된다.Since the second transistor Q2 of the voltage change unit 400 is turned off, it is recognized that there is no third resistor R3 that is a bias resistor of the second transistor Q2. Accordingly, when the second transistor Q2 of the voltage change unit 400 is turned off after t0, the voltages V and be Q1 input to the first transistor Q1 satisfy the following equation.

Figure pat00002
.....식(2)
Figure pat00002
..... Equation (2)

식(2)에 나타난 바와 같이, 상기 구형파 생성부(300)의 제1 트랜지스터(Q1)가 턴온되고, 전압변화부(400)의 제2 트랜지스터(Q2)가 턴오프되면, 상기 구형파 생성부(300)의 제1 트랜지스터(Q1)에 입력되는 전압(V,be Q1)은 상기 전압변화부(400)의 제2 트랜지스터(Q2)가 턴온된 경우에 비해 입력전압(Vin)의 높은 비율을 차지하게 된다.As shown in Equation (2), when the first transistor Q1 of the square wave generator 300 is turned on and the second transistor Q2 of the voltage changer 400 is turned off, the square wave generator ( The voltages V and be Q1 input to the first transistor Q1 of 300 occupy a higher ratio of the input voltage Vin than when the second transistor Q2 of the voltage change unit 400 is turned on. Done.

상기 식(1)에서 식(2)로의 전환은 상기 구형파 생성부(300)의 제1 트랜지스터(Q1)가 턴온됨에 따라 이루어지므로, 상기 전압변화부(400)의 제2 트랜지스터(Q2)의 턴온/턴오프에 의한 합성 저항에 의한 분압차이만큼 히스테리시스 전압이 발생하게 된다.Since the switching from Equation (1) to Equation (2) is performed as the first transistor Q1 of the square wave generator 300 is turned on, the turn-on of the second transistor Q2 of the voltage change unit 400 is turned on. The hysteresis voltage is generated as much as the partial pressure difference due to the combined resistance by the / turn off.

이에 따라, 상기 입력전압에 t1의 시간만큼 노이즈가 인가되더라도, 상기 노이즈가 상기 히스테리시스 전압 이내의 값을 갖는 경우, 상기 구형파 생성부(300)의 제1 트랜지스터(Q1)는 턴온/턴오프 동작을 반복하지 않게 되므로 소자의 신뢰성이 향상될 수 있다.Accordingly, even when noise is applied to the input voltage for a time of t1, when the noise has a value within the hysteresis voltage, the first transistor Q1 of the square wave generator 300 performs turn on / turn off operation. Since it is not repeated, the reliability of the device can be improved.

입력전압이 t2를 기점으로 감소하더라도, 제1 트랜지스터(Q1)가 턴온되고, 제2 트랜지스터(Q2)가 턴오프되어 있으므로, 출력전압은 로우값을 유지하게 된다. Even if the input voltage decreases from t2, the first transistor Q1 is turned on and the second transistor Q2 is turned off, so the output voltage maintains a low value.

그러나 입력전압(Vth)이 감소함에 따라, t3를 기점으로 상기 식(2)를 통해 상기 제1 트랜지스터(Q1)에 입력되는 전압(V,be Q1)이 상기 제1 트랜지스터(Q1)의 구동전압(Vth)보다 낮아지는 경우, 상기 제1 트랜지스터(Q1)는 턴오프되고, 이에 따라 출력전압(Vout)은 하이값으로 검출된다.However, as the input voltage Vth decreases, the voltages V and be Q1 input to the first transistor Q1 through Equation (2) starting at t3 are driving voltages of the first transistor Q1. When lower than Vth, the first transistor Q1 is turned off, and thus the output voltage Vout is detected as a high value.

이상에서 실시예들에 설명된 특징, 구조, 효과 등은 본 발명의 적어도 하나의 실시예에 포함되며, 반드시 하나의 실시예에만 한정되는 것은 아니다. 나아가, 각 실시예에서 예시된 특징, 구조, 효과 등은 실시예들이 속하는 분야의 통상의 지식을 가지는 자에 의해 다른 실시예들에 대해서도 조합 또는 변형되어 실시 가능하다. 따라서 이러한 조합과 변형에 관계된 내용들은 본 발명의 범위에 포함되는 것으로 해석되어야 할 것이다.Features, structures, effects, and the like described in the above embodiments are included in at least one embodiment of the present invention, and are not necessarily limited to only one embodiment. Furthermore, the features, structures, effects, and the like illustrated in each embodiment may be combined or modified with respect to other embodiments by those skilled in the art to which the embodiments belong. Therefore, it should be understood that the present invention is not limited to these combinations and modifications.

이상에서 실시예를 중심으로 설명하였으나 이는 단지 예시일 뿐 본 발명을 한정하는 것이 아니며, 본 발명이 속하는 분야의 통상의 지식을 가진 자라면 본 실시예의 본질적인 특성을 벗어나지 않는 범위에서 이상에 예시되지 않은 여러 가지의 변형과 응용이 가능함을 알 수 있을 것이다. 예를 들어, 실시예에 구체적으로 나타난 각 구성 요소는 변형하여 실시할 수 있는 것이다. 그리고 이러한 변형과 응용에 관계된 차이점들은 첨부된 청구 범위에서 규정하는 본 발명의 범위에 포함되는 것으로 해석되어야 할 것이다.While the present invention has been particularly shown and described with reference to exemplary embodiments thereof, it is to be understood that the invention is not limited to the disclosed exemplary embodiments, but, on the contrary, It will be understood that various modifications and applications are possible. For example, each component specifically shown in the embodiments can be modified and implemented. It is to be understood that all changes and modifications that come within the meaning and range of equivalency of the claims are therefore intended to be embraced therein.

Claims (7)

입력전압을 분할하는 전압 분할부;
상기 전압 분할부와 연결되고 입력된 입력전압과 내부 기준 전압을 비교하여, 결과에 따른 듀티비를 갖는 구형파 검출신호를 생성하며, 제1 트랜지스터를 포함하고 상기 제1 트랜지스터는 콜렉터 단에 바이어스 저항인 제5저항을 포함하고, 에미터단이 접지와 연결되는 구형파 생성부; 및,
상기 전압 분할부와 구형파 생성부의 사이에 형성되고, 히스테리시스 전압을 형성하는 전압변화부를 포함하는 신호전달회로.A voltage divider dividing an input voltage;
A square wave detection signal having a duty ratio according to a result is generated by comparing an input voltage input to the voltage divider and an internal reference voltage, and including a first transistor. A square wave generator including a fifth resistor and having an emitter end connected to ground; And
And a voltage changer formed between the voltage divider and the square wave generator to form a hysteresis voltage. 제1항에 있어서,
상기 전압분할부는 직렬로 연결된 제1 저항 및 제2 저항을 포함하고 상기 제1 저항은 상기 입력전원과 연결되고, 상기 제2 저항은 접지와 연결되는 신호전달회로.The method of claim 1,
The voltage divider includes a first resistor and a second resistor connected in series, the first resistor is connected to the input power source, and the second resistor is connected to ground. 제2항에 있어서,
상기 전압변화부는 제2 트랜지스터를 포함하고, 상기 제2 트랜지스터는 콜렉터 단에 바이어스 저항인 제3저항을 포함하고, 에미터단이 접지와 연결되는 신호전달회로.The method of claim 2,
The voltage change unit includes a second transistor, and the second transistor includes a third resistor, which is a bias resistor, at a collector terminal, and an emitter terminal is connected to ground. 제3항에 있어서,
상기 제3 저항은 상기 구형파 생성부의 베이스단과 연결되는 신호전달회로.The method of claim 3,
The third resistor is connected to the base end of the square wave generator. 제3항에 있어서,
상기 제1 트랜지스터와 제2 트랜지스터는 상호 번갈아 턴온/턴오프되는 신호전달회로.The method of claim 3,
And the first transistor and the second transistor are alternately turned on / off. 제3항에 있어서,
상기 제1 트랜지스터가 턴오프된 경우, 상기 제1 트랜지스터의 베이스단에 입력되는 전압(Vbe)은 하기의 식(1)을 만족하는 신호전달회로.
Figure pat00003
......식(1)The method of claim 3,
When the first transistor is turned off, the voltage (Vbe) input to the base terminal of the first transistor satisfies the following equation (1).
Figure pat00003
Expression (1) 제3항에 있어서,
상기 제1 트랜지스터가 온프된 경우, 상기 제1 트랜지스터의 베이스단에 입력되는 전압(Vbe)은 하기의 식(2)을 만족하는 신호전달회로.
Figure pat00004
.....식(2)The method of claim 3,
And a voltage (Vbe) input to the base terminal of the first transistor when the first transistor is on, satisfies Equation (2) below.
Figure pat00004
..... Equation (2)
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