KR20100100621A - Display unit - Google Patents

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카츠히데 우치노
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Abstract

PURPOSE: A displaying unit is provided to reduce a diffraction-reflection phenomenon by forming either upper side of the source or the drain of a second transistor on an opposite region with respect to the anode or the cathode of an organic electroluminescent element. CONSTITUTION: A displaying unit includes an organic electroluminescent element and a pixel circuit. The pixel circuit includes a first transistor(Tws) for recording an image signal and a second transistor(TDr) for driving the image signal. The second transistor drives the organic electroluminescent element based on the image signal of the first transistor. The second transistor includes gates(31A, 32A), sources(31B, 32B), and drains(31C, 32C). The organic electroluminescent element includes an anode(35A), an organic layer, and a cathode.

Description

표시 유닛{DISPLAY UNIT}Display unit {DISPLAY UNIT}

본 발명은, 유기 EL (electro luminescence) 소자를 구비하는 표시 유닛에 관한 것이다.The present invention relates to a display unit including an organic EL (electro luminescence) element.

근래, 화상 표시를 행하는 표시 유닛의 분야에서는, 픽셀의 발광 소자로서, 흐르는 전류치에 따라 발광 휘도가 변하는 전류 구동형의 광학 소자, 예를 들면 유기 EL 소자를 이용한 표시 유닛이 개발되어, 상품화가 진행되고 있다(예를 들면, 일본 특개 2008-083272호 참조).In recent years, in the field of a display unit for performing image display, as a light emitting element of a pixel, a display unit using a current-driven optical element, for example, an organic EL element, in which the luminescence brightness is changed in accordance with a flowing current value, has been developed and commercialization proceeds. (For example, see Japanese Patent Laid-Open No. 2008-083272).

유기 EL 소자는, 액정 소자 등과 다르게 자발광 소자이다. 그 때문에, 유기 EL 소자를 포함하는 표시 유닛(유기 EL 표시 유닛)에서는, 광원(백라이트)이 필요 없기 때문에, 광원을 필요로 하는 액정 표시 유닛과 비교하여 화상의 시인성이 높고, 소비 전력이 낮고, 또한 소자의 응답 속도가 빠르다.An organic EL element is a self-luminous element unlike a liquid crystal element etc. Therefore, in the display unit (organic EL display unit) containing an organic EL element, since a light source (backlight) is not needed, compared with the liquid crystal display unit which requires a light source, image visibility is high, power consumption is low, In addition, the device responds quickly.

유기 EL 표시 유닛에서는, 액정 표시 유닛과 마찬가지로 그 구동 방식으로서 단순(패시브) 매트릭스 방식과 액티브 매트릭스 방식이 있다. 전자는, 구조가 단순한 것이지만, 대형이면서 고정밀의 표시 유닛의 실현이 어려운 등의 문제가 있다. 그 때문에, 현재는, 액티브 매트릭스 방식의 개발이 번창하게 행해지고 있다. 이 방식은, 픽셀마다 배치한 발광 소자에 흐르는 전류를, 발광 소자마다 설치한 구동 회로 내에 설치한 능동 소자(일반적으로는 TFT(Thin Film Transistor; 박막 트랜지스터))에 의해 제어하는 것이다.In the organic EL display unit, similarly to the liquid crystal display unit, there are a simple (passive) matrix method and an active matrix system as its driving methods. Although the former has a simple structure, there is a problem that it is difficult to realize a large and high-precision display unit. Therefore, development of the active matrix system is prosperous at present. In this system, the current flowing through the light emitting elements arranged for each pixel is controlled by an active element (typically a thin film transistor (TFT)) provided in a driving circuit provided for each light emitting element.

도 14는, 일반적인 유기 EL 표시 유닛의 대략 구성을 나타낸 것이다. 도 14에 기재된 표시 유닛(100)은, 복수의 픽셀(120)이 매트릭스 모양으로 배치된 표시부(110)와, 각 픽셀(120)을 구동하는 구동부(수평 구동 회로(130), 기록 주사 회로(140) 및 전원 주사 회로(150))를 구비하고 있다.14 shows a general configuration of a general organic EL display unit. The display unit 100 illustrated in FIG. 14 includes a display unit 110 in which a plurality of pixels 120 are arranged in a matrix, and a driver unit (horizontal drive circuit 130 and a write scan circuit) for driving each pixel 120. 140 and a power source scanning circuit 150 are provided.

각 픽셀(120)은, 적색용의 픽셀(120R), 녹색용의 픽셀(120G) 및 청색용의 픽셀(120B)로 구성된다. 픽셀(120R, 120G, 120B)은, 도 15, 도 16에 나타낸 바와 같이, 유기 EL 소자(121)(유기 EL 소자(121R, 121G, 121B)) 및 그것에 접속된 픽셀 회로(122)에 의해 구성되고 있다. 또한, 도 15는, 픽셀(120R, 120G, 120B)의 회로 구성을 나타낸 것이다. 도 16은, 픽셀(120R, 120G, 120B)의 레이아웃을 나타낸 것이다.Each pixel 120 is comprised of the pixel 120R for red, the pixel 120G for green, and the pixel 120B for blue. The pixels 120R, 120G, and 120B are constituted by the organic EL elements 121 (organic EL elements 121R, 121G, 121B) and the pixel circuit 122 connected thereto, as shown in Figs. 15 and 16. It is becoming. 15 illustrates a circuit configuration of the pixels 120R, 120G, and 120B. 16 shows the layout of the pixels 120R, 120G, and 120B.

픽셀 회로(122)는, 샘플링용의 트랜지스터(TWS), 유지 용량(Cs), 구동용의 트랜지스터(TDr)에 의해 구성된 것이고, 2Tr1C의 회로 구성으로 되어 있다. 기록 주사 회로(140)로부터 인출된 게이트선(WSL)은 행방향으로 연재되고, 콘택트(126A)를 통해, 트랜지스터(TWS)의 게이트(123A)에 접속되어 있다.The pixel circuit 122 is composed of a sampling transistor T WS , a holding capacitor C s , and a driving transistor T Dr , and has a circuit structure of 2Tr1C. The gate line WSL drawn out from the write scan circuit 140 extends in the row direction and is connected to the gate 123A of the transistor T WS through the contact 126A.

전원 주사 회로(150)로부터 인출된 드레인선(DSL)도 행방향으로 연재되고, 인출 배선(128A)을 통해, 트랜지스터(TDr)의 드레인(124C)에 접속되어 있다. 또, 수평 구동 회로(130)로부터 인출된 신호선(DTL)은 열방향으로 연재되고, 콘택트(126B) 및 인출 배선(128B)을 통해 트랜지스터(TWS)의 드레인(123C)에 접속되어 있다. 트랜지스터(TWS)의 소스(123B)는, 콘택트(126C)를 통해 구동용의 트랜지스터(TDr)의 게이트(124A)와, 유지 용량(Cs)의 일단(단자(125A))에 접속되어 있다. 트랜지스터(TDr)의 소스(124B)와 유지 용량(Cs)의 다른 일단(단자(125B))이, 콘택트(126D)를 통해 유기 EL 소자(121R, 121G, 121B)(이하, 유기 EL 소자(121R 등)이라고 생략한다.)의 아노드(127A)에 접속되어 있다. 유기 EL 소자(121R 등)의 캐소드(127B)는, 그라운드선(GND)에 접속되어 있다.The drain line DSL drawn out from the power source scanning circuit 150 is also extended in the row direction, and is connected to the drain 124C of the transistor T Dr via the lead wiring 128A. The signal line DTL drawn out from the horizontal drive circuit 130 extends in the column direction and is connected to the drain 123C of the transistor T WS through the contact 126B and the lead wiring 128B. The source 123B of the transistor T WS is connected to the gate 124A of the driving transistor T Dr and one end (terminal 125A) of the holding capacitor C s through the contact 126C. have. The source 124B of the transistor T Dr and the other end of the holding capacitor C s (terminal 125B) are connected to the organic EL elements 121R, 121G, 121B (hereinafter referred to as organic EL elements) via the contact 126D. (121R, etc.) is omitted. The cathode 127B of the organic EL element 121R or the like is connected to the ground line GND.

도 17은, 도 12의 A-A선을 따른 단면 구성을 나타낸 것이다. 각 픽셀(120)은, 도 16의 A-A선에 대응하는 부분에서, 기판(111) 위에, 게이트(124A)(단자(125A)), 게이트 절연막(112), 소스(124B)(단자(125B)), 절연 보호막(113), 절연 평탄화막(114), 개구 규정 절연막(115), 유기 EL 소자(121) 및 절연 보호막(116)을 갖고 있다. 유기 EL 소자(121R 등)의 아노드(127A)의 바로 아래에는, 예를 들면 막두께가 1㎛ 정도의 소스(124B)(단자(125B))가 존재하고 있고, 이것에 의해 아노드(127A)에 요철이 생기는 것을 방지할 목적으로, 절연 평탄화막(114)이 형성되어 있다.FIG. 17 illustrates a cross-sectional configuration along the line A-A in FIG. 12. Each pixel 120 has a gate 124A (terminal 125A), a gate insulating film 112, and a source 124B (terminal 125B) on the substrate 111 at a portion corresponding to the line AA in FIG. 16. ), An insulating protective film 113, an insulating planarizing film 114, an opening defining insulating film 115, an organic EL element 121, and an insulating protective film 116. Just below the anode 127A of the organic EL element 121R, for example, a source 124B (terminal 125B) having a film thickness of about 1 μm exists, whereby the anode 127A ), An insulating planarization film 114 is formed for the purpose of preventing unevenness.

그러나, 실제로는, 도 17에 나타낸 바와 같이, 소스(124B)(단자(125B))에 기인하여, 아노드(127A)에 예를 들면 0.3~0.4㎛ 정도의 요철(127D)이 생기고 있다. 이 요철(127D)은, 소스(124B)(단자(125B))의 형상을 반영하고 있고, 열방향으로 길게 연재되어 있다. 그 때문에, 외광(L)이 아노드(127A)에 입사한 때에, 이 요철(127D)에서 회절 반사하기 때문에, 그 반사광이 관찰자(도시하지 않고)에 보이게 되고, 화질이 저하되어 버린다는 문제가 있다.In reality, however, as shown in FIG. 17, due to the source 124B (terminal 125B), the unevenness 127D of about 0.3 to 0.4 μm, for example, is generated in the anode 127A. This uneven | corrugated 127D reflects the shape of the source 124B (terminal 125B), and is extended long in a column direction. Therefore, when the external light L enters the anode 127A, diffraction and reflection is caused by the unevenness 127D, so that the reflected light becomes visible to an observer (not shown), and the image quality is deteriorated. have.

본 발명은 상기 문제점을 감안하여 이루어진 것으로, 회절 반사를 절감하는 것이 가능한 표시 유닛을 제공하는 것에 있다.SUMMARY OF THE INVENTION The present invention has been made in view of the above problems, and an object of the present invention is to provide a display unit capable of reducing diffraction reflection.

본 발명의 일 실시의 형태에 따르면, 유기 EL 소자 및 픽셀 회로를 픽셀마다 갖는 표시부를 포함하는 제 1의 표시 유닛이 제공된다. 상기 픽셀 회로는, 영상 신호를 기록하는 기록용의 제 1의 트랜지스터와, 상기 제 1의 트랜지스터에 의해 기록된 영상 신호에 근거하여 상기 유기 EL 소자를 구동하는 구동용의 제 2의 트랜지스터를 구비한다. 상기 제 2의 트랜지스터는, 게이트, 소스 및 드레인을 구비한다. 상기 유기 EL 소자는, 아노드, 유기층 및 캐소드를 구비한다. 상기 소스 또는 상기 드레인의 상면이, 적어도 상기 아노드 또는 상기 캐소드의 대향 영역에 형성된다.According to one embodiment of the present invention, there is provided a first display unit including a display portion having an organic EL element and a pixel circuit for each pixel. The pixel circuit includes a first transistor for recording that records a video signal and a second transistor for driving that drives the organic EL element based on the video signal recorded by the first transistor. . The second transistor includes a gate, a source, and a drain. The organic EL device includes an anode, an organic layer, and a cathode. An upper surface of the source or the drain is formed at least in an opposite region of the anode or the cathode.

본 발명의 제 1의 표시 유닛에서는, 제 2의 트랜지스터의 소스 또는 드레인의 상면이, 적어도 유기 EL 소자의 아노드 또는 캐소드와의 대향 영역에 형성되어 있다. 이것에 의해, 소스 또는 드레인의 단부에 대응하는 단차가 아노드 또는 캐소드의 바로 아래에는 존재하지 않고, 아노드 또는 캐소드는 평탄면 상에 형성되어 있다.In the first display unit of the present invention, the upper surface of the source or the drain of the second transistor is formed at least in an area facing the anode or the cathode of the organic EL element. As a result, a step corresponding to the end of the source or the drain does not exist immediately below the anode or the cathode, and the anode or the cathode is formed on the flat surface.

본 발명의 일 실시의 형태에 따르면, 유기 EL 소자 및 픽셀 회로를 픽셀마다 갖는 표시부를 포함하는 표시 유닛이 제공된다. 상기 픽셀 회로는, 영상 신호를 기록하는 기록용의 제 1의 트랜지스터와, 상기 제 1의 트랜지스터에 의해 기록된 영상 신호에 근거하여 상기 유기 EL 소자를 구동하는 구동용의 제 2의 트랜지스터를 구비한다. 상기 제 2의 트랜지스터는, 게이트, 소스 및 드레인을 구비한다. 상기 유기 EL 소자는, 아노드, 유기층 및 캐소드를 구비한다. 상기 소스 또는 상기 드레인은, 연속한 만곡면을 포함하는 장변부를 갖는다.According to one embodiment of the present invention, a display unit is provided that includes a display portion having an organic EL element and a pixel circuit for each pixel. The pixel circuit includes a first transistor for recording that records a video signal and a second transistor for driving that drives the organic EL element based on the video signal recorded by the first transistor. . The second transistor includes a gate, a source, and a drain. The organic EL device includes an anode, an organic layer, and a cathode. The source or the drain has a long side portion including a continuous curved surface.

본 발명의 제 2의 표시 유닛에서는, 제 2의 트랜지스터의 소스 또는 드레인이, 연속한 만곡면을 포함한 장변부를 갖고 있다. 이것에 의해, 유기 EL 소자의 아노드 또는 캐소드에는, 소스 또는 드레인의 장변부에 형성된 연속한 만곡면에 대응하는 요철이 형성되어 있다.In the second display unit of the present invention, the source or the drain of the second transistor has a long side portion including a continuous curved surface. Thereby, the unevenness | corrugation corresponding to the continuous curved surface formed in the long side part of a source or a drain is formed in the anode or the cathode of an organic electroluminescent element.

본 발명의 실시의 형태의 제 1 및 제 2의 표시 유닛에서, 상기 표시부는, 상기 게이트와 상기 소스 또는 상기 드레인 사이에 접속된 유지 용량을 상기 픽셀마다 구비한다. 이 경우, 상기 유지 용량은, 상기 소스 또는 상기 드레인의 상면이 적어도 상기 아노드 또는 상기 캐소드와 상기 게이트에 대향하는 영역에 형성되는 상기 소스 또는 상기 드레인으로 구성될 수 있다.In the first and second display units of the embodiment of the present invention, the display section includes a storage capacitor connected between the gate and the source or the drain for each pixel. In this case, the holding capacitor may include the source or the drain having an upper surface of the source or the drain formed at least in the region facing the anode or the cathode and the gate.

본 발명의 제 1의 표시 유닛에 의하면, 제 2의 트랜지스터의 소스 또는 드레인의 상면을, 적어도 유기 EL 소자의 아노드 또는 캐소드와의 대향 영역에 형성하도록 했다. 이것에 의해, 외광이 아노드 또는 캐소드에 입사할 때에, 회절 반사를 절감할 수 있다. 그 결과, 회절 반사에 기인하는 화질의 저하를 억제할 수 있다.According to the first display unit of the present invention, the upper surface of the source or the drain of the second transistor is formed at least in an area facing the anode or the cathode of the organic EL element. This can reduce diffraction reflection when external light enters the anode or the cathode. As a result, the deterioration of the image quality resulting from diffraction reflection can be suppressed.

본 발명의 제 2의 표시 유닛에 의하면, 제 2의 트랜지스터의 소스 또는 드레인에, 연속한 만곡면을 포함한 장변부를 설치하도록 했다. 이것에 의해, 외광이 아노드 또는 캐소드에 입사할 때에, 일정 방향으로 회절 반사가 생기는 것을 절감할 수 있다. 그 결과, 회절 반사에 기인하는 화질의 저하를 억제한 것을 할 수 있다.According to the second display unit of the present invention, the long side portion including the continuous curved surface is provided in the source or drain of the second transistor. Thereby, when external light enters an anode or a cathode, it can reduce that diffraction reflection generate | occur | produces in a fixed direction. As a result, the fall of the image quality resulting from diffraction reflection can be suppressed.

본 발명의 다른 목적, 이점 및 특징은 첨부된 도면과 연계한 하기의 설명으로부터 더욱 명확해질 것이다.Other objects, advantages and features of the present invention will become more apparent from the following description taken in conjunction with the accompanying drawings.

도 1은 본 발명의 제 1의 실시의 형태에 관한 표시 유닛의 대략 구성도.
도 2는 도 1의 픽셀의 회로 구성도.
도 3은 도 1의 픽셀의 레이아웃도.
도 4는 도 3의 픽셀의 단면 구성도.
도 5는 도 1의 픽셀의 일 변형예의 레이아웃도.
도 6은 본 발명의 제 2의 실시의 형태에 관한 표시 유닛에 포함된 픽셀의 레이아웃도.
도 7은 도 6의 픽셀의 단면 구성도.
도 8은 상기 각 실시의 형태의 표시 유닛을 포함하는 모듈의 대략 구성을 나타내는 평면도.
도 9는 상기 실시의 형태의 표시 유닛의 제 1의 적용예의 외관을 나타내는 사시도.
도 10의 A는 제 2의 적용예의 바깥쪽에서 보었던 외관을 나타내는 사시도, B는 이면에서 본 외관을 나타내는 사시도.
도 11은 제 3의 적용예의 외관을 나타내는 사시도.
도 12는 제 4의 적용예의 외관을 나타내는 사시도.
도 13의 A는 제 5의 적용예가 열린 상태의 정면도, B는 그 측면도, C는 닫힌 상태의 정면도, D는 좌측면도, E는 우측면도, F는 상면도, G는 하면도.
도 14는 종래의 표시 유닛의 대략 구성도.
도 15는 도 10의 픽셀의 회로 구성도.
도 16은 도 10의 픽셀의 레이아웃도.
도 17은 도 16의 픽셀의 단면 구성도.
1 is a schematic configuration diagram of a display unit according to a first embodiment of the present invention.
2 is a circuit diagram illustrating a pixel of FIG. 1.
3 is a layout diagram of pixels of FIG. 1;
4 is a cross-sectional configuration diagram of the pixel of FIG. 3.
5 is a layout diagram of a variant of the pixel of FIG. 1;
6 is a layout diagram of pixels included in a display unit according to a second embodiment of the present invention.
7 is a cross-sectional configuration diagram of the pixel of FIG. 6.
FIG. 8 is a plan view illustrating a schematic configuration of a module including a display unit of each of the above embodiments. FIG.
9 is a perspective view showing an appearance of a first application example of the display unit according to the embodiment;
10: A is a perspective view which shows the external appearance seen from the outside of the 2nd application example, B is a perspective view which shows the external appearance seen from the back surface.
11 is a perspective view showing an appearance of a third application example.
12 is a perspective view showing an appearance of a fourth application example.
13A is a front view of a fifth application example in an open state, B is a side view thereof, C is a front view thereof in a closed state, D is a left side view, E is a right side view, F is a top view, and G is a bottom view.
14 is a schematic configuration diagram of a conventional display unit.
15 is a circuit diagram illustrating a pixel of FIG. 10.
16 is a layout diagram of pixels of FIG. 10;
17 is a cross-sectional configuration diagram of the pixel of FIG. 16;

이하, 발명을 실시하기 위한 형태에 관하여, 도면을 참조하여 상세히 설명하다. 또한, 설명은 이하의 순서로 행한다.EMBODIMENT OF THE INVENTION Hereinafter, the form for implementing this invention is demonstrated in detail with reference to drawings. The description will be made in the following order.

1. 제 1의 실시의 형태(소스의 면적이 크다)1. First embodiment (the area of the source is large)

2. 변형예2. Modification

3. 제 2의 실시의 형태(캐소드의 단부에, 연속한 만곡면을 포함한다)3. 2nd Embodiment (In the edge of a cathode, a continuous curved surface is included)

4. 변형예4. Modification

5. 모듈 및 적용예
5. Modules and Application Examples

1. 제 1의 실시의 형태1. First embodiment

도 1은, 본 발명의 제 1의 실시의 형태에 관계된 표시 유닛(1)의 전체 구성의 일 예를 나타낸 것이다. 이 표시 유닛(1)은, 예를 들면, 유리, 실리콘(Si)웨이퍼 또는 수지 등으로 된 기판(40)(후술) 위에, 표시부(10)와, 표시부(10)의 주변에 형성된 주변 회로부(20)(구동부)를 구비하고 있다.1 shows an example of the entire configuration of the display unit 1 according to the first embodiment of the present invention. The display unit 1 includes a display portion 10 and a peripheral circuit portion formed around the display portion 10 on a substrate 40 (to be described later) made of, for example, glass, silicon (Si) wafer or resin. 20) (drive part) is provided.

표시부(10)Display part (10)

표시부(10)는, 복수의 픽셀(11)을 표시부(10)의 전면에 걸쳐 매트릭스 모양으로 배치한 것이고, 외부에서 입력된 영상 신호(20a)에 근거한 화상을 액티브 매트릭스 구동에 의해 표시하는 것이다. 각 픽셀(11)은, 적색용의 픽셀(11R)과, 녹색용의 픽셀(11G)와, 청색용의 픽셀(11B)을 포함하고 있다.The display unit 10 arranges a plurality of pixels 11 in a matrix form over the entire surface of the display unit 10, and displays an image based on the externally input video signal 20a by active matrix driving. Each pixel 11 includes a pixel 11R for red, a pixel 11G for green, and a pixel 11B for blue.

도 2는, 픽셀(11R, 11G, 11B)의 회로 구성의 일 예를 나타낸 것이다. 도 3은, 픽셀(11R, 11G, 11B)의 레이아웃을 나타낸 것이다. 픽셀(11R, 11G, 11B) 안에는, 도 2에 나타낸 바와 같이, 유기 EL 소자(12R, 12G, 12B)(발광 소자)와, 픽셀 회로(13)가 마련되어 있다.2 shows an example of a circuit configuration of the pixels 11R, 11G, and 11B. 3 shows the layout of the pixels 11R, 11G, 11B. In the pixel 11R, 11G, 11B, as shown in FIG. 2, organic electroluminescent element 12R, 12G, 12B (light emitting element) and the pixel circuit 13 are provided.

픽셀 회로(13)는, 트랜지스터(TWS)(제 1의 트랜지스터)와, 트랜지스터(TDr)(제 2의 트랜지스터)와, 트랜지스터(TDr)의 게이트-소스 사이에 접속된 유지 용량(Cs)을 포함하여 구성된 것이고, 2Tr1C의 회로 구성으로 되어 있다. 트랜지스터(TWS)는, 영상 신호를 기록하는 기록용의 트랜지스터이다. 트랜지스터(TDr)는, 트랜지스터(TWS) 에 의해 기록된 영상 신호에 근거하여 유기 EL 소자(12R, 12G, 12B)(이하, 유기 EL 소자(12)라고 총칭한다)를 구동하는 구동용의 트랜지스터이다. 트랜지스터(TWS, TDr)는, 예를 들면, n 채널 MOS 형의 박막 트랜지스터(TFT(Thin Film Transistor))에 의해 형성되어 있다.The pixel circuit 13 includes a storage capacitor C connected between a transistor T WS (first transistor), a transistor T Dr (second transistor), and a gate-source of the transistor T Dr. s ) and the circuit structure of 2Tr1C. The transistor T WS is a recording transistor for recording a video signal. The transistor T Dr is used for driving the organic EL elements 12R, 12G, and 12B (hereinafter, collectively referred to as the organic EL element 12) based on the video signal recorded by the transistor T WS . Transistor. The transistors T WS and T Dr are formed of, for example, an n-channel MOS thin film transistor (TFT (Thin Film Transistor)).

주변 around 회로부Circuit (20)(20)

변 회로부(20)는, 타이밍 제어 회로(21)와, 수평 구동 회로(22)와, 기록 주사 회로(23)와, 전원 주사 회로(24)를 갖고 있다. 타이밍 제어 회로(21)는, 표시 신호 생성 회로(21A)와, 표시 신호 유지 제어 회로(21B)를 포함하고 있다. 또, 주변 회로부(20)에는, 게이트선(WSL)과, 드레인선(DSL)과, 신호선(DTL)과, 그라운드선(GND)이 마련되어 있다. 또한, 그라운드 선은, 그라운드에 접속된 것이고, 그라운드에 접속된 때에 그라운드 전압(참조 전압)으로 된다.The side circuit section 20 includes a timing control circuit 21, a horizontal drive circuit 22, a write scan circuit 23, and a power supply scan circuit 24. The timing control circuit 21 includes a display signal generating circuit 21A and a display signal holding control circuit 21B. In the peripheral circuit portion 20, a gate line WSL, a drain line DSL, a signal line DTL, and a ground line GND are provided. In addition, the ground line is connected to ground and becomes a ground voltage (reference voltage) when connected to ground.

표시 신호 생성 회로(21A)는, 외부에서 입력된 영상 신호(20a)에 근거하여, 예를 들면 1화면마다(1 필드의 표시마다) 표시부(10)에 표시하기 위한 표시 신호(21a)를 생성하는 것이다.The display signal generation circuit 21A generates a display signal 21a for displaying on the display unit 10 for each screen (for each display of one field), for example, based on the externally input video signal 20a. It is.

표시 신호 유지 제어 회로(21B)는, 표시 신호 생성 회로(21A)로부터 출력된 표시 신호(21a)를 1화면마다(1 필드의 표시마다), 예를 들면 SRAM 등(Static Random Access Memory)으로부터 구성된 필드 메모리에 격납하여 유지하는 것이다. 이 표시 신호 유지 제어 회로(21B)는 또, 각 픽셀(11)을 구동하는 수평 구동 회로(22), 기록 주사 회로(23) 및 전원 주사 회로(24)가 연동하여 동작하도록 제어하는 역할도 하고 있다. 구체적으로는, 표시 신호 유지 제어 회로(21B)는, 기록 주사 회로(23)에 대해서는 제어 신호(21b)를, 전원 주사 회로(24)에 대해서는 제어 신호(21c)를, 표시 신호 구동 회로(21C)에 대해서는 제어 신호(21d)를 각각 출력하게 되어 있다.The display signal holding control circuit 21B configures the display signal 21a output from the display signal generating circuit 21A for each screen (for each display of one field), for example, from an SRAM or the like (Static Random Access Memory). It is stored in the field memory. The display signal holding control circuit 21B also serves to control the horizontal driving circuit 22, the write scanning circuit 23, and the power supply scanning circuit 24 to operate in conjunction with each pixel 11. have. Specifically, the display signal holding control circuit 21B receives the control signal 21b for the write scanning circuit 23, the control signal 21c for the power supply scanning circuit 24, and the display signal driving circuit 21C. Are output to the control signal 21d, respectively.

수평 구동 회로(22)는, 표시 신호 유지 제어 회로(21B)로부터 출력된 제어 신호(21d)에 따른 전압을 출력할 수 있다. 구체적으로는, 수평 구동 회로(22)는, 표시부(10)의 각 픽셀(11)에 접속된 신호선(DTL)을 통해 기록 주사 회로(23)에 의해 선택된 픽셀(11)에 소정의 전압을 공급하게 되어 있다.The horizontal drive circuit 22 can output a voltage corresponding to the control signal 21d output from the display signal holding control circuit 21B. Specifically, the horizontal drive circuit 22 supplies a predetermined voltage to the pixel 11 selected by the write scan circuit 23 through the signal line DTL connected to each pixel 11 of the display unit 10. It is supposed to be done.

기록 주사 회로(23)는, 표시 신호 유지 제어 회로(21B)로부터 출력된 제어 신호(21b)에 따른 전압을 출력할 수 있다. 구체적으로는, 기록 주사 회로(23)는, 표시부(10)의 각 픽셀(11)에 접속된 게이트선(WSL)을 통해 구동 대상의 픽셀(11)에 소정의 전압을 공급하고, 샘플링용의 트랜지스터(TWS)를 제어하게 되어 있다.The write scanning circuit 23 can output the voltage corresponding to the control signal 21b output from the display signal holding control circuit 21B. Specifically, the write scanning circuit 23 supplies a predetermined voltage to the pixel 11 to be driven through the gate line WSL connected to each pixel 11 of the display unit 10, and thus for sampling. The transistor T WS is controlled.

전원 주사 회로(24)는, 표시 신호 유지 제어 회로(21B)로부터 출력된 제어 신호(21c)에 따른 전압을 출력할 수 있다. 구체적으로는, 전원 주사 회로(24)는, 표시부(10)의 각 픽셀(11)에 접속된 드레인선(DSL)을 통해 구동 대상의 픽셀(11)에 소정의 전압을 공급하고, 유기 EL 소자(12R 등)의 발광 및 소등을 제어하게 되어 있다.The power supply scanning circuit 24 can output a voltage corresponding to the control signal 21c output from the display signal holding control circuit 21B. Specifically, the power supply scanning circuit 24 supplies a predetermined voltage to the pixel 11 to be driven through the drain line DSL connected to each pixel 11 of the display unit 10, and the organic EL element. The light emission and the extinguishing of (12R etc.) are controlled.

레이아웃layout

다음에, 도 2, 도 3을 참조하여, 각 구성 요소의 접속 관계에 관하여 설명한다. 기록 주사 회로(23)로부터 인출된 게이트선(WSL)은, 행방향으로 연재되고, 콘택트(34A)를 통해 이용하고, 트랜지스터(TWS)의 게이트(31A)에 접속되어 있다. 전원 주사 회로(24)로부터 인출된 드레인선(DSL)도 행방향으로 연재되고, 인출 배선(36A)을 통해 트랜지스터(TDr)의 드레인(32C)에 접속되어 있다. 또, 수평 구동 회로(22)로부터 인출된 신호선(DTL)은 열방향으로 연재되고, 콘택트(34B) 및 인출 배선(36B)을 통해 트랜지스터(TWS)의 드레인(31C)에 접속되어 있다. 트랜지스터(TWS)의 소스(31B)는 구동용의 트랜지스터(TDr)의 게이트(32A)와, 유지 용량(Cs)의 일단(단자(33A))에 접속되어 있다. 트랜지스터(TDr)의 소스(32B)와 유지 용량(Cs)의 다른 일단(단자(33B))이, 콘택트(34D)를 통해 유기 EL 소자(12)의 아노드(35A)에 접속되어 있다. 유기 EL 소자(12)의 캐소드(35B)는, 그라운드선(GND)에 접속되어 있다.Next, with reference to FIG. 2, FIG. 3, the connection relationship of each component is demonstrated. The gate line WSL drawn out from the write scan circuit 23 is extended in the row direction, used through the contact 34A, and connected to the gate 31A of the transistor T WS . The drain line DSL drawn out from the power supply scanning circuit 24 is also extended in the row direction and is connected to the drain 32C of the transistor T Dr via the drawing wiring 36A. The signal line DTL drawn out from the horizontal drive circuit 22 extends in the column direction and is connected to the drain 31C of the transistor T WS through the contact 34B and the lead wiring 36B. The source 31B of the transistor T WS is connected to the gate 32A of the driving transistor T Dr and one end (terminal 33A) of the holding capacitor C s . The source 32B of the transistor T Dr and the other end (terminal 33B) of the storage capacitor C s are connected to the anode 35A of the organic EL element 12 via the contact 34D. . The cathode 35B of the organic EL element 12 is connected to the ground line GND.

단면 구성Sectional composition

도 4는, 도 3의 A-A선을 따른 단면 구성을 나타낸 것이다. 각 픽셀(11)은, 도 3의 A-A선에 대응하는 부분에서, 기판(40) 위에, 게이트(32A)(단자(33A)), 게이트 절연막(41), 소스(32B)(단자(33B)), 절연 보호막(42), 절연 평탄화막(43), 유기 EL 소자(12), 개구 규정 절연막(44) 및 절연 보호막(45)을 갖고 있다.FIG. 4 shows a cross-sectional configuration along the line A-A in FIG. 3. Each pixel 11 has a gate 32A (terminal 33A), a gate insulating film 41 and a source 32B (terminal 33B) on the substrate 40 at a portion corresponding to the AA line in FIG. 3. ), An insulating protective film 42, an insulating planarizing film 43, an organic EL element 12, an opening defining insulating film 44, and an insulating protective film 45.

게이트(32A)(단자(33A))는, 기판(40)의 표면에 형성되어 있고, 대체로, 후술의 EL 개구부(44A)와의 대향 영역을 포함하는 영역에 형성되어 있다. 또한, 도 3에는, 게이트(32A)(단자(33A))가, EL 개구부(44A) 중 상부를 제외한 영역과의 대향 영역을 포함하는 영역에 형성되어 있는 경우가 예시되어 있다. 게이트 절연막(41)은, 게이트(32A)(단자(33A))를 포함하는 기판(40) 표면 전체를 덮고 있다. 또한, 게이트(32A)는 극히 얇은 것으로, 게이트 절연막(41)에는, 게이트(32A)에 기인하는 요철은 실질적으로 존재하고 있지 않다. 즉, 게이트 절연막(41)의 상면은, 광학적으로는 평탄면과 동등하다.The gate 32A (terminal 33A) is formed in the surface of the board | substrate 40, and is formed in the area | region containing the opposing area | region with EL opening 44A mentioned later generally. 3, the case where the gate 32A (terminal 33A) is formed in the area | region including the area | region which opposes the area | region except the upper part among EL opening part 44A is illustrated. The gate insulating film 41 covers the entire surface of the substrate 40 including the gate 32A (terminal 33A). Further, the gate 32A is extremely thin, and substantially no irregularities due to the gate 32A are present in the gate insulating film 41. That is, the upper surface of the gate insulating film 41 is optically equivalent to the flat surface.

소스(32B)(단자(33B))는, 게이트 절연막(41)과 절연 보호막(42) 사이에 형성되어 있다. 소스(32B)의 상면(32B-1)(단자(33B)의 상면 33B-1)은 평탄면이고, 적어도 아노드(35A)와의 대향 영역에 형성되어 있다. 또한, 후술하는 바와 같이, 아노드(35A)의 상면의 일부가 EL 개구부(44A)에 상당하고 있기 때문에, 상면(32B-1)(33B-1)은, EL 개구부(44A)와의 대향 영역을 포함하는 영역에 형성되어 있다.The source 32B (terminal 33B) is formed between the gate insulating film 41 and the insulating protective film 42. The upper surface 32B-1 (the upper surface 33B-1 of the terminal 33B) of the source 32B is a flat surface and is formed at least in an area facing the anode 35A. In addition, as will be described later, since a part of the upper surface of the anode 35A corresponds to the EL opening 44A, the upper surfaces 32B-1 and 33B-1 form an opposing area with the EL opening 44A. It is formed in the area to include.

절연 보호막(42)은, 게이트 절연막(41) 및 소스(32B)(단자(33B))의 표면 전체를 덮고 있다. 절연 보호막(42)은, 게이트 절연막(41) 및 소스(32B)(단자(33B))의 표면을 따라 형성되어 있기 때문에, 소스(32B)(단자(33B))의 단부에 대응하는 단차(42A)를 갖고 있다. 이 단차(42A)는, 아노드(35A)와의 비대향 영역에 형성되어 있고, 절연 보호막(42)의 상면 중 적어도 아노드(35A)와의 대향 영역은, 평탄면으로 되어 있다.The insulating protective film 42 covers the entire surface of the gate insulating film 41 and the source 32B (terminal 33B). Since the insulating protective film 42 is formed along the surfaces of the gate insulating film 41 and the source 32B (terminal 33B), the step 42A corresponding to the end of the source 32B (terminal 33B) is provided. ) This step 42A is formed in the non-opposite region with the anode 35A, and at least the opposing region with the anode 35A of the upper surface of the insulating protective film 42 is a flat surface.

절연 평탄화막(43)은, 소스(32B)(단자(33B))의 바탕을 평탄화하는 것을 목적으로 설치된 것으로, 절연 보호막(42)의 표면 전체를 덮고 있다. 절연 평탄화막(43)은, 예를 들면, 단차(42A)에 대응하는 부위에, 단차(42A)의 높이의 반 이하 정도의 높이의 단차(43A)를 갖고 있다. 이 단차(43A)는, 아노드(35A)와의 비대향 영역에 형성되어 있고, 절연 평탄화막(43)의 상면 중 적어도 아노드(35A)와의 대향 영역은 평탄면으로 되어 있다.The insulating planarization film 43 is provided for the purpose of flattening the base of the source 32B (terminal 33B) and covers the entire surface of the insulating protective film 42. The insulating planarization film 43 has, for example, a step 43A having a height of about half or less of the height of the step 42A at a portion corresponding to the step 42A. This step 43A is formed in the non-opposite region with the anode 35A, and at least the opposing region with the anode 35A of the upper surface of the insulating planarization film 43 is a flat surface.

유기 EL 소자(12)는, 예를 들면, 아노드(35A)(아노드), 유기층(35C) 및 캐소드(35B)(음극)가 기판(40) 측에서 순서대로 적층된 구성을 갖고 있다. 유기층(35C)은, 예를 들면, 아노드(35A) 측에서 순서대로, 정공 주입 효율을 높인 정공 주입층과, 발광층으로의 정공 수송 효율을 높인 정공 수송층과, 전자와 정공과의 재결합에 의한 발광을 발생시키는 발광층과, 발광층에의 전자 수송 효율을 높인 전자 수송층을 적층하여 이루어진 적층 구조를 갖고 있다. 아노드(35A)는, 절연 평탄화막(43) 중 단차(43A)로 둘러싸인 부분의 표면(평탄 면) 위에 형성되어 있다. 그 때문에, 아노드(35A)에는, 단차(42A, 43A)에 대응하는 요철은 존재하지 않고, 아노드(35A)는, 절연 평탄화막(43)이 평탄면을 따른 평탄한 막으로 되어 있다. 캐소드(35B)는, 적어도 유기층(35C)의 상면에 접하여 형성되어 있고, 예를 들면, 유기층(35C) 및 개구 규정 절연막(44)의 표면 전체를 덮고 있다.The organic EL element 12 has a configuration in which an anode 35A (anode), an organic layer 35C, and a cathode 35B (cathode) are laminated in order on the substrate 40 side, for example. The organic layer 35C is formed by, for example, a hole injection layer having increased hole injection efficiency, a hole transport layer having increased hole transport efficiency to the light emitting layer, and recombination of electrons and holes, in order, on the anode 35A side, for example. It has the laminated structure which laminated | stacked the light emitting layer which generate | occur | produces light emission, and the electron carrying layer which improved the electron transport efficiency to the light emitting layer. The anode 35A is formed on the surface (flat surface) of the portion surrounded by the step 43A among the insulating planarization films 43. Therefore, unevenness corresponding to the steps 42A and 43A does not exist in the anode 35A, and the anode 35A is a flat film along which the insulating planarization film 43 is along the flat surface. The cathode 35B is formed in contact with at least the upper surface of the organic layer 35C, and covers, for example, the entire surface of the organic layer 35C and the opening defining insulating film 44.

개구 규정 절연막(44)은, 유기 EL 소자(12)의 아노드(35A)와 동일면 내에 형성되어 있고, 아노드(35A)에 대응하는 개구(EL 개구부(44A))를 갖고 있다. EL 개구부(44A)는, 아노드(35A)의 상면과의 대향 영역의 일부에 형성되어 있고, 개구 규정 절연막(44)이, 아노드(35A)의 외연(주연)을 덮고 있다. 즉, EL 개구부(44A)의 바닥면에는, 아노드(35A)의 상면의 일부만이 노출하고 있고, 유기층(35C)은, 아노드(35A)의 상면중 EL 개구부(44A)의 바닥면에 노출하고 있는 부분과 접하고 있다.The opening defining insulating film 44 is formed in the same plane as the anode 35A of the organic EL element 12 and has an opening (EL opening 44A) corresponding to the anode 35A. The EL opening 44A is formed in a part of the region facing the upper surface of the anode 35A, and the opening defining insulating film 44 covers the outer edge (periphery) of the anode 35A. That is, only a part of the top surface of the anode 35A is exposed on the bottom surface of the EL opening 44A, and the organic layer 35C is exposed on the bottom surface of the EL opening 44A of the top surface of the anode 35A. We are in contact with part that we do.

절연 보호막(45)은, 캐소드(35B)의 표면 전체를 덮고 있다. 절연 보호막(45)은, 유기 EL 소자(12)에서 발광한 빛에 대해 투명한 재료에 의해 형성되어 있다. 그 때문에, 절연 보호막(45)은, 유기 EL 소자(12)의 발광광뿐만 아니라, 유기 EL 소자(12)의 발광광과 공통된 파장대의 외광도 투과하는 것이 가능하다.The insulating protective film 45 covers the whole surface of the cathode 35B. The insulating protective film 45 is formed of a material transparent to the light emitted from the organic EL element 12. Therefore, the insulating protective film 45 can transmit not only the light emission of the organic EL element 12 but the external light of the wavelength band common to the light emission of the organic EL element 12.

동작 및 효과Motion and effects

본 실시의 형태의 표시 유닛(1)에서는, 각 픽셀(11)의 픽셀 회로(13)가 온 오프 제어되고, 각 픽셀(11)의 유기 EL 소자(12)에 구동 전류가 주입되는 것에 의해, 정공과 전자가 재결합하여 발광이 일어난다. 이 빛은, 아노드(35A)와 캐소드(35B) 사이에서 다중 반사하고, 캐소드(35B)를 투과하여 외부로 취출된다. 그 결과, 표시부(10)에 화상이 표시된다.In the display unit 1 of the present embodiment, the pixel circuit 13 of each pixel 11 is turned on and off, and a driving current is injected into the organic EL element 12 of each pixel 11. Holes and electrons recombine to emit light. This light multiplexes reflection between the anode 35A and the cathode 35B, passes through the cathode 35B, and is taken out to the outside. As a result, an image is displayed on the display unit 10.

그런데, 종래의 표시 유닛에서는, 예를 들면, 도 17에 나타낸 바와 같이, 유기 EL 소자(121R 등)의 아노드(127A)의 바로 아래에, 막두께가 1㎛ 정도의 소스(124B)(단자(125B))가 존재하고 있고, 그것에 기인하여, 아노드(127A)에 0.3~0.4㎛ 정도의 요철(127D)이 생기고 있다. 이 요철(127D)은, 소스(124B)(단자(125B))의 형상을 반영하고 있고, 열방향으로 길게 연재되어 있다. 그 때문에, 외광(L)이 아노드(127A)에 입사할 때에, 이 요철(127D)에서 회절 반사한다. 그 결과, 그 반사광이 관찰자(도시하지 않고)에게 보이게 되어, 화질이 저하되는 등의 문제가 발생하고 있다.By the way, in the conventional display unit, as shown in FIG. 17, for example, the source 124B (terminal) of about 1 micrometer in thickness just under the anode 127A of organic electroluminescent element 121R etc. (125B)) exists, and, as a result, the unevenness 127D of about 0.3-0.4 micrometers is produced in the anode 127A. This uneven | corrugated 127D reflects the shape of the source 124B (terminal 125B), and is extended long in a column direction. Therefore, when external light L enters the anode 127A, it diffracts and reflects at this unevenness 127D. As a result, the reflected light is visible to an observer (not shown), causing a problem such as deterioration in image quality.

한편, 본 실시의 형태에서는, 종래예와 마찬가지로 유기 EL 소자(12)의 아노드(35A)의 바로 아래에, 막두께가 1㎛ 정도의 소스(32B)(단자(33B))가 존재하고 있다. 그러나, 본 실시의 형태에서는, 소스(32B)의 상면(32B-1)(단자(33B)의 상면(33B-1))이, 적어도 아노드(35A)와의 대향 영역에 형성되어 있다. 그 때문에, 소스(32B)(단자(33B))의 단부에 대응하여 절연 보호막(42)이나 절연 평탄화막(43)에 형성된 단차(42A, 43A)가 아노드(35A)의 바로 아래에는 존재하지 않고, 아노드(35A)는 절연 평탄화막(43)의 평탄면 상에 형성되어 있다. 즉, 아노드(35A)에는, 단차(42A, 43A)에 대응하는 요철은 존재하지 않고, 아노드(35A)는, 절연 평탄화막(43)의 평탄면을 따라 평탄한 막으로 되어 있다. 따라서, 외광(L)이 아노드(35A)에 입사할 때에, 종래와 같은 회절 반사가 생기지 않기 때문에, 회절 반사에 기인하여 화질이 저하될 우려는 없다.On the other hand, in this embodiment, the source 32B (terminal 33B) whose film thickness is about 1 micrometer exists just under the anode 35A of the organic EL element 12 similarly to the conventional example. . However, in this embodiment, the upper surface 32B-1 (the upper surface 33B-1 of the terminal 33B) of the source 32B is formed at least in an area facing the anode 35A. Therefore, steps 42A and 43A formed in the insulating protective film 42 or the insulating planarization film 43 do not exist immediately below the anode 35A in correspondence with the end of the source 32B (terminal 33B). Instead, the anode 35A is formed on the flat surface of the insulating planarization film 43. That is, unevenness corresponding to the steps 42A and 43A does not exist in the anode 35A, and the anode 35A is a flat film along the flat surface of the insulating planarization film 43. Therefore, when the external light L enters the anode 35A, since diffraction reflection does not occur as in the prior art, there is no fear that the image quality is lowered due to the diffraction reflection.

변형예Variant

상기 실시의 형태에서는, 상면(32B-1)(33B-1)이, 적어도 아노드(35A)와의 대향 영역에 형성되어 있는 경우가 예시되고 있지만, 종래예와 비교하여 회절 반사를 절감하는 것이 가능한 범위내에서, 아노드(35A)와의 대향 영역에서 벗어나 있어도 좋다. 예를 들면, 도 5에 나타낸 바와 같이, 상면(32B-1)(33B-1)이, 아노드(35A)와의 관계에서 도면의 상방으로 벗어나 있고, 아노드(35A)의 단변부(35A-1)(단변 및 그 주변부)와만 비대향으로 되어 있어도 좋다. 도 5의 경우에는, 아노드(35A)의 길이 방향의 변 및 그 부근에 관해서는, 상면(32B-1)(33B-1)과 대향하고 있고, 적어도 회절 반사가 생기지 않는다. 따라서, 종래예보다도, 회절 반사를 절감할 수 있다. 그 결과, 회절 반사에 기인하는 화질의 저하를 억제할 수 있다. 또한, 도시하지 않지만, 아노드(35A)에 생기는 요철이 예를 들면 0.1㎛ 정도로 극히 작아지는 경우에 한하여, 상면(32B-1)(33B-1)의 단부가, 아노드(35A)의 단부보다도 약간 내측에 위치하고 있어도 좋다.In the above embodiment, the case where the upper surfaces 32B-1 and 33B-1 are formed at least in the region facing the anode 35A is illustrated, but the diffraction reflection can be reduced as compared with the conventional example. Within the range, it may be away from the region facing the anode 35A. For example, as shown in FIG. 5, the upper surfaces 32B-1 and 33B-1 deviate upward in the drawing in relation to the anode 35A, and the short sides 35A- of the anode 35A are located. 1) It may be opposed to only (short side and its periphery). In the case of FIG. 5, the sides and the vicinity of the longitudinal direction of the anode 35A face the upper surfaces 32B-1 and 33B-1, and at least diffraction reflection does not occur. Therefore, compared with the conventional example, diffraction reflection can be reduced. As a result, the deterioration of the image quality resulting from diffraction reflection can be suppressed. In addition, although not shown, only when the unevenness | corrugation which arises in the anode 35A becomes extremely small about 0.1 micrometer, for example, the edge part of the upper surface 32B-1 and 33B-1 is the edge part of the anode 35A. It may be located slightly inside.

제 2의 실시의 형태 Second embodiment

도 6은, 본 발명의 제 2의 실시의 형태에 관한 표시 유닛의 픽셀(11)(11R, 11G, 11B)의 레이아웃을 나타낸 것이다. 본 실시의 형태의 표시 유닛은, 트랜지스터(TDr)의 게이트(32A) 대용으로 게이트(52A)를, 트랜지스터(TDr)의 소스(32B) 대용으로 소스(52B)를 각각 구비하고 있는 점에서 상기 실시의 형태 및 그 변형예의 표시 유닛(1)의 구성과 서로 다르다. 또한, 본 실시의 형태의 표시 유닛은, 유지 용량(Cs)의 단자(33A) 대용으로 단자(53A)를, 유지 용량(Cs)의 단자(33B) 대용으로 단자(53B)를 각각 구비하고 있는 점에서 상기 실시의 형태 및 그 변형예의 표시 유닛(1)의 구성과 서로 다르다. 그러면, 이하에서는, 상기 실시의 형태 및 그 변형예와의 차이점에 관하여 주로 설명하고, 상기 실시의 형태 및 그 변형예와의 공통점에 관한 설명을 적절히 생략하는 것으로 한다.6 shows the layout of the pixels 11 (11R, 11G, 11B) of the display unit according to the second embodiment of the present invention. The display unit according to the present embodiment, the transistor gate (52A) to the gate (32A) substitute for the (T Dr), the transistors in that it comprises a source (52B) to the source (32B) substitute for the (T Dr), respectively It differs from the structure of the display unit 1 of the said embodiment and its modification. The display unit according to the present embodiment, the storage capacitor (C s) terminal (33A) substituted with terminals (53A) a storage capacitor having a terminal (33B) substituted in the terminal (53B) of the (C s) each It differs from the structure of the display unit 1 of the said embodiment and its modification in the point which it is doing. Then, below, the difference with the said embodiment and its modification is mainly demonstrated, and description about the common point with the said embodiment and the modification is abbreviate | omitted suitably.

레이아웃layout

본 실시의 형태에서는, 게이트(52A)(단자(53A))는, 상기 실시의 형태의 게이트(32A)(단자(33A))의 면적보다도 작은 면적을 갖는다. 트랜지스터(TDr)의 게이트(32A)로서 주로 기능하는 부분을 제외하면, 게이트(52A)(단자(53A))는 아노드(35A)에 대향하는 영역 내에 있다. 즉, 게이트(52A)(단자(53A))는, 도 16에 도시한 종래예의 게이트(124A)(단자 125A)와 동일한 구성으로 되어 있다.In the present embodiment, the gate 52A (terminal 53A) has an area smaller than the area of the gate 32A (terminal 33A) of the above embodiment. Except for the part mainly serving as the gate 32A of the transistor T Dr , the gate 52A (terminal 53A) is in a region facing the anode 35A. That is, the gate 52A (terminal 53A) has the same structure as the gate 124A (terminal 125A) of the conventional example shown in FIG.

한편, 소스(52B)(단자(53B))도, 상기 실시의 형태의 소스(32B)(단자(33B))의 면적보다도 작은 면적을 가지며, 트랜지스터(TDr)의 소스(52B)로서 주로 기능하는 부분을 제외하면, 아노드(35A)와의 대향 영역 내에 있다. 즉, 소스(52B)(단자(53B))는, 그 점에서는, 도 16에 도시한 종래예의 소스(124B)(단자(125B))와 동일한 구성으로 되어 있다.On the other hand, the source 52B (terminal 53B) also has an area smaller than that of the source 32B (terminal 33B) of the above embodiment, and mainly functions as the source 52B of the transistor T Dr. Except for the part described above, it is in the region facing the anode 35A. That is, the source 52B (terminal 53B) has the same structure as the source 124B (terminal 125B) of the prior art example shown in FIG. 16 in that point.

단, 소스(52B)(단자(53B))는, 종래예의 소스(124B)(단자(125B))와는 다르고, 적어도, 소스(52B)(단자(53B))의 장변부(54)(긴 변 및 그 부근)에서 면내 방향으로 물결 모양을 이루고 있고, 직선 형상으로 되어 있지 않다. 즉, 소스(52B)(단자(53B))는, 적어도 소스(52B)(단자(53B))의 장변부(54)에, 연속하는 만곡면을 포함하고 있다. 또한, 도 6에는, 소스(52B)(단자(53B))가, 장변부(54)뿐만 아니라, 단변부(55)(단수의 변 및 그 부근)에도 연속하는 만곡면을 포함하고 있는 경우가 예시되고 있다. 또한, 도 6에는, 소스(52B)(단자(53B))와 동일층 내에 형성된 트랜지스터(TWS)의 소스(31B)에 대해서도, 장변 및 그 부근에 연속하는 만곡면을 포함하고 있는 경우가 예시되어 있다.However, the source 52B (terminal 53B) is different from the source 124B (terminal 125B) of the conventional example, and at least, the long side part 54 (long side of the source 52B (terminal 53B)) is long. And its vicinity) are wavy in the in-plane direction and are not linear. That is, the source 52B (terminal 53B) includes the continuous curved surface at least in the long side part 54 of the source 52B (terminal 53B). 6, the source 52B (terminal 53B) includes the curved surface which continues not only in the long side part 54 but also in the short side part 55 (single side and its vicinity). It is illustrated. 6 illustrates a case where the source 31B of the transistor T WS formed in the same layer as the source 52B (terminal 53B) also includes a long side and a curved surface continuous to the vicinity thereof. It is.

단면 구성Sectional composition

도 7은, 도 6의 A-A선을 따른 단면 구성을 나타낸 것이다. 각 픽셀(11)은, 도 6의 A-A 선에 대응하는 부분에서, 기판(40) 위에, 게이트(52A)(단자(53A)), 게이트 절연막(41), 소스(52B)(단자(53B)), 절연 보호막(42), 절연 평탄화막(43), 유기 EL 소자(12), 개구 규정 절연막(44) 및 절연 보호막(45)을 갖고 있다.FIG. 7 shows a cross-sectional configuration along the line A-A in FIG. 6. Each pixel 11 has a gate 52A (terminal 53A), a gate insulating film 41 and a source 52B (terminal 53B) on the substrate 40 at a portion corresponding to the AA line in FIG. 6. ), An insulating protective film 42, an insulating planarizing film 43, an organic EL element 12, an opening defining insulating film 44, and an insulating protective film 45.

게이트(52A)(단자(53A))는, 기판(40)의 표면에 형성되어 있고, 상술한 바와 같이, 트랜지스터(TDr)의 게이트(32A)로서 주로 기능하는 부분을 제외하면, 아노드(35A)와의 대향 영역 내에 형성되어 있다. 게이트 절연막(41)은, 게이트(52A)(단자(53A))를 포함하는 기판(40) 표면 전체를 덮고 있다. 또한, 게이트(52A)(단자(53A))는 극히 얇은 것으로, 게이트 절연막(41)에는, 게이트(52A)(단자(53A))에 기인하는 요철은 실질적으로 존재하고 있지 않다. 즉, 게이트 절연막(41)의 상면은, 광학적으로는 평탄면과 동등하다.The gate 52A (terminal 53A) is formed on the surface of the substrate 40 and, as described above, except for a portion mainly serving as the gate 32A of the transistor T Dr , the anode ( It is formed in the area | region facing 35A). The gate insulating film 41 covers the entire surface of the substrate 40 including the gate 52A (terminal 53A). The gate 52A (terminal 53A) is extremely thin, and substantially no irregularities due to the gate 52A (terminal 53A) exist in the gate insulating film 41. That is, the upper surface of the gate insulating film 41 is optically equivalent to the flat surface.

소스(52B)(단자(53B))는, 게이트 절연막(41)과 절연 보호막(42) 사이에 형성되어 있다. 소스(52B)의 상면(52B-1)(단자(53B)의 상면(53B-1))은, 평탄면이 되고, 상술한 바와 같이, 트랜지스터(TDr)의 소스(52B)로서 주로 기능하는 부분을 제외하면, 아노드(35A)와의 대향 영역 내에 형성되어 있다. 또한, 상면(52B-1)(53B-1)은, 트랜지스터(TDr)의 소스(52B)로서 주로 기능하는 부분을 제외하면, EL 개구부(44A)와의 대향 영역 내에 형성되어 있다.The source 52B (terminal 53B) is formed between the gate insulating film 41 and the insulating protective film 42. The upper surface 52B-1 of the source 52B (the upper surface 53B-1 of the terminal 53B) becomes a flat surface and, as described above, mainly functions as the source 52B of the transistor T Dr. Except for the portion, it is formed in the region facing the anode 35A. The upper surfaces 52B-1 and 53B-1 are formed in the region facing the EL opening 44A except for the part mainly functioning as the source 52B of the transistor T Dr.

절연 보호막(42)은, 게이트 절연막(41) 및 소스(52B)(단자(53B))의 표면 전체를 덮고 있다. 절연 보호막(42)은, 게이트 절연막(41) 및 소스(52B)(단자(53B))의 표면을 따라 형성되어 있는 것으로, 소스(52B)(단자(53B))의 단부에 대응하는 부위에 단차(42A)를 갖고 있다. 단차(42A)는, 소스(52B)(단자(53B))의 단부와 마찬가지로 면내 방향에서 물결 모양으로 되어 있다(연속한 만곡면을 포함하고 있다). 단차(42A)는, 아노드(35A) 및 EL 개구부(44A)와의 대향 영역 내에 형성되어 있고, 절연 보호막(42)의 상면 중 아노드(35A) 및 EL 개구부(44A)와의 대향 영역은, 면내 방향에서 굴곡을 갖는 요철면으로 되어 있다.The insulating protective film 42 covers the entire surface of the gate insulating film 41 and the source 52B (terminal 53B). The insulating protective film 42 is formed along the surfaces of the gate insulating film 41 and the source 52B (terminal 53B), and is stepped at a portion corresponding to the end of the source 52B (terminal 53B). It has 42A. The step 42A is wavy in the in-plane direction similarly to the end of the source 52B (terminal 53B) (including a continuous curved surface). The step 42A is formed in an area facing the anode 35A and the EL opening 44A, and the area facing the anode 35A and the EL opening 44A is in-plane among the upper surfaces of the insulating protective film 42. It is an uneven surface having curvature in the direction.

절연 평탄화막(43)은, 소스(52B)(단자(53B))의 바탕을 평탄화하는 것을 목적으로 하여 설치된 것으로, 절연 보호막(42)의 표면 전체를 덮고 있다. 절연 평탄화막(43)은, 예를 들면, 단차(42A)에 대응하는 부위에, 단차(42A) 높이의 절반 이하 정도 높이의 단차(43A)를 갖고 있다. 단차(43A)는, 단차(42A)와 마찬가지로 면내 방향에서 물결 모양으로 되어 있다(연속한 만곡면을 포함하고 있다). 단차(43A)는, 아노드(35A) 및 EL 개구부(44A)와의 대향 영역 내에 형성되어 있고, 절연 평탄화막(43)의 상면 중 적어도 아노드(35A) 및 EL 개구부(44A)와의 대향 영역은, 면내 방향에서 굴곡을 갖는 요철면으로 되어 있다.The insulating planarization film 43 is provided for the purpose of flattening the base of the source 52B (terminal 53B) and covers the entire surface of the insulating protective film 42. The insulating planarization film 43 has, for example, a step 43A having a height of about half or less of the height of the step 42A at a portion corresponding to the step 42A. The step 43A is wavy in the in-plane direction similar to the step 42A (including a continuous curved surface). The step 43A is formed in an opposing area between the anode 35A and the EL opening 44A, and at least an opposing area between the anode 35A and the EL opening 44A of the upper surface of the insulating planarization film 43 is And an uneven surface having curvature in the in-plane direction.

유기 EL 소자(12)에서, 아노드(35A)는, 절연 평탄화막(43) 중 단차(43A)를 포함하는 표면(요철면) 위에 형성되어 있다. 그 때문에, 아노드(35A)에는, 단차(43A)에 대응하는 요철이 형성되어 있고, 절연 평탄화막(43)의 요철면을 따른 단차(35D)를 갖고 있다. 단차(35D)는, 단차(43A)와 마찬가지로 면내 방향에서 물결 모양으로 되어 있다(연속한 만곡면을 포함하고 있다). 단차(35D)는 EL 개구부(44A)의 바닥면에 노출하고 있고, 유기층(35C) 및 캐소드(35B)에도, 단차(35D)에 대응하는 요철이 형성되어 있다.In the organic EL element 12, the anode 35A is formed on the surface (uneven surface) including the step 43A among the insulating planarization films 43. Therefore, unevenness corresponding to the step 43A is formed in the anode 35A, and has a step 35D along the uneven surface of the insulating planarization film 43. The step 35D has a wavy shape in the in-plane direction similar to the step 43A (including a continuous curved surface). The step 35D is exposed on the bottom surface of the EL opening 44A, and the unevenness corresponding to the step 35D is formed in the organic layer 35C and the cathode 35B.

효과effect

본 실시의 형태의 표시 유닛에서는, 종래예와 마찬가지로 유기 EL 소자(12)의 아노드(35A)의 바로 아래에, 막두께가 1㎛ 정도의 소스(52B)(단자(53B))가 존재하고 있다. 또한, 소스(52B)(단자(53B))의 상면(52B-1)(53B-1)은, 종래예와 마찬가지로 트랜지스터(TDr)의 소스(52B)로서 주로 기능하는 부분을 제외하면, EL 개구부(44A)와의 대향 영역 내에 형성되어 있다. 그러나, 본 실시의 형태에서는, 소스(52B)(단자(53B))는, 소스(52B)(단자(53B))의 장변부(54)에 연속하는 만곡면을 포함하고 있다. 그 때문에, 아노드(35A)에는, 소스(52B)(단자(53B))의 장변부(54)에 형성된 연속한 만곡면에 대응하는 요철이 형성되어 있다. 또한, 본 실시의 형태에서는, 소스(52B)(단자(53B))는, 소스(52B)(단자(53B))의 단변부(55)에도 연속한 만곡면을 포함하고 있다. 그 때문에, 아노드(35A)에는, 소스(52B)(단자(53B))의 단변부(55)에 형성된 연속한 만곡면에 대응하는 요철이 형성되어 있다. 따라서, 외광(L)이 아노드(35A)에 입사할 때에, 일정 방향으로 회절 반사가 생기지 않기 때문에, 회절 반사에 기인하여 화질이 저하될 우려는 없다.In the display unit of the present embodiment, a source 52B (terminal 53B) having a film thickness of about 1 μm exists just below the anode 35A of the organic EL element 12 as in the conventional example. have. In addition, the upper surfaces 52B-1 and 53B-1 of the source 52B (terminal 53B) are EL except for the part mainly functioning as the source 52B of the transistor T Dr as in the conventional example. It is formed in the area | region opposing the opening part 44A. However, in the present embodiment, the source 52B (terminal 53B) includes a curved surface continuous to the long side portion 54 of the source 52B (terminal 53B). Therefore, the unevenness corresponding to the continuous curved surface formed in the long side part 54 of the source 52B (terminal 53B) is formed in the anode 35A. In addition, in this embodiment, the source 52B (terminal 53B) includes the curved surface continuous also to the short side part 55 of the source 52B (terminal 53B). Therefore, the unevenness corresponding to the continuous curved surface formed in the short side part 55 of the source 52B (terminal 53B) is formed in the anode 35A. Therefore, since the diffraction reflection does not occur in a predetermined direction when the external light L enters the anode 35A, the image quality is not deteriorated due to the diffraction reflection.

변형예Variant

상기 실시의 형태에서는, 소스(52B)(단자(53B))가, 장변부(54) 및 단변부(55)에 연속한 만곡면을 포함하고 있는 경우가 예시되고 있지만, 종래예와 비교하여 회절 반사를 절감하는 것이 가능한 범위 내에서, 연속한 만곡면의 형성 영역을 삭감해도 좋다. 예를 들면, 도시하지 않지만, 소스(52B)(단자(53B))의 장변부(54)에만 연속한 만곡면을 설치하고, 단변부(55)에는 그러한 만곡면을 설치하지 않고, 직선 형상의 단면을 설치해도 좋다. 이것에 의해, 일정 방향으로 회절 반사가 생기는 것을 절감할 수 있다. 그 결과, 회절 반사에 기인하는 화질의 저하를 억제할 수 있다.In the said embodiment, although the case where the source 52B (terminal 53B) contains the curved surface continuous to the long side part 54 and the short side part 55 is illustrated, diffraction is compared with the conventional example. As long as reflection can be reduced, the formation area | region of a continuous curved surface may be reduced. For example, although not shown, a continuous curved surface is provided only on the long side portion 54 of the source 52B (terminal 53B), and the short side portion 55 does not have such a curved surface, but has a straight line shape. You may provide a cross section. This can reduce the occurrence of diffraction reflection in a fixed direction. As a result, the deterioration of the image quality resulting from diffraction reflection can be suppressed.

모듈 및 적용예Module and Application Examples

이하, 상기 각 실시의 형태 및 그 변형예에서 설명한 표시 유닛의 적용예에 관하여 설명한다. 상기 실시의 형태 등의 표시 유닛은, 텔레비전 장치, 디지털 카메라, 노트형 퍼스널 컴퓨터, 휴대 전화 등의 휴대 단말 장치 또는 비디오 카메라등, 외부에서 입력된 영상 신호 또는 내부에서 생성한 영상 신호를, 화상 또는 영상으로서 표시하는 모든 분야의 전자 기기의 표시 유닛에 적용하는 것이 가능하다.Hereinafter, the application example of the display unit demonstrated by each said embodiment and its modification is demonstrated. The display unit according to the above-described embodiments includes an image signal input from the outside or a video signal generated internally, such as a video terminal or a portable terminal device such as a television device, a digital camera, a notebook computer, a mobile phone, or a video camera. It is possible to apply it to the display unit of the electronic equipment of all the fields displayed as an image.

모듈module

상기 실시의 형태 등의 표시 유닛은, 예를 들면, 도 8에 도시한 것과 같은 모듈로서, 후술하는 제 1 내지 제 5의 적용예 등의 여러 가지의 전자 기기에 편입된다. 이 모듈은, 예를 들면, 기판(2)의 한 변에, 표시부(10)를 밀봉하는 부재(도시하지 않고)로부터 노출된 영역(210)을 설치하고, 이 노출한 영역(210)에, 타이밍 제어 회로(21), 수평 구동 회로(22), 기록 주사 회로(23) 및 전원 주사 회로(24)의 배선을 연장하는 것에 의해 외부 접속단자(도시하지 않고)를 형성한다. 외부 접속단자에는, 신호의 입출력을 위한 플렉시블 프린트 배선 기판(FPC; Flexible Printed Circuit; 220)이 설치되어 있어도 좋다.The display unit of the above embodiment or the like is, for example, a module as shown in FIG. 8 and incorporated into various electronic devices such as the first to fifth application examples described later. This module is provided with, for example, an area 210 exposed from a member (not shown) that seals the display portion 10 on one side of the substrate 2, and in this exposed area 210, External connection terminals (not shown) are formed by extending the wirings of the timing control circuit 21, the horizontal drive circuit 22, the write scan circuit 23, and the power supply scan circuit 24. The external connection terminal may be provided with a flexible printed wiring board (FPC) 220 for inputting and outputting signals.

제 1의 적용예 First application example

도 9는, 상기 실시의 형태 등의 표시 유닛이 적용된 텔레비전 장치의 외관을 나타낸 것이다. 이 텔레비전 장치는, 예를 들면, 프런트 패널(310) 및 필터 유리(320)를 포함하는 영상 표시 화면부(300) 구비하고, 이 영상 표시 화면부(300)는, 상기 실시의 형태 등의 표시 유닛에 의해 구성되어 있다.9 shows the appearance of a television apparatus to which a display unit such as the above embodiment is applied. This television device is provided with the video display screen part 300 which contains the front panel 310 and the filter glass 320, for example, and this video display screen part 300 displays display of the said embodiment etc. It is comprised by a unit.

제 2의 Second 적용예Application example

도 10은, 상기 실시의 형태 등의 표시 유닛이 적용된 디지털 카메라의 외관을 나타낸 것이다. 이 디지털 카메라는, 예를 들면, 플래시용의 발광부(410), 표시부(420), 메뉴 스위치(430) 및 셔터 버튼(440)을 갖고 있고, 그 표시부(420)는, 상기 실시의 형태 등의 표시 유닛에 의해 구성되어 있다.Fig. 10 shows the appearance of a digital camera to which a display unit such as the above embodiment is applied. This digital camera has, for example, a light emitting portion 410, a display portion 420, a menu switch 430, and a shutter button 440 for flash, and the display portion 420 is the embodiment described above. It is comprised by the display unit of.

제 3의 Third 적용예Application example

도 11은, 상기 실시의 형태 등의 표시 유닛이 적용된 노트형 퍼스널 컴퓨터의 외관을 나타낸 것이다. 이 노트형 퍼스널 컴퓨터는, 예를 들면, 본체(510), 문자 등의 입력 조작을 위한 키보드(520) 및 화상을 표시하는 표시부(530)를 갖고 있고, 그 표시부(530)는, 상기 실시의 형태 등의 표시 유닛에 의해 구성되어 있다.Fig. 11 shows an appearance of a notebook personal computer to which the display unit of the above-described embodiment or the like is applied. This notebook personal computer has, for example, a main body 510, a keyboard 520 for input operation of characters and the like, and a display unit 530 for displaying an image. It is comprised by display units, such as a form.

제 4의 Fourth 적용예Application example

도 12는, 상기 실시의 형태 등의 표시 유닛이 적용된 비디오 카메라의 외관을 나타낸 것이다. 이 비디오 카메라는, 예를 들면, 본체부(610), 이 본체부(610)의 앞쪽 측면에 설치된 피사체 촬영용의 렌즈(620), 촬영시의 스타트/스톱 스위치(630) 및 표시부(640)를 갖고 있고, 그 표시부(640)는, 상기 실시의 형태 등의 표시 유닛에 의해 구성되어 있다.12 shows the appearance of a video camera to which a display unit such as the above embodiment is applied. For example, the video camera includes a main body 610, a lens 620 for photographing a subject provided on the front side of the main body 610, a start / stop switch 630 and a display 640 at the time of shooting. The display part 640 is comprised by display units, such as the said embodiment.

제 5의 5th 적용예Application example

도 13은, 상기 실시의 형태 등의 표시 유닛이 적용된 휴대 전화기의 외관을 나타낸 것이다. 이 휴대 전화기는, 예를 들면, 상측 박스(710)와 하측 박스(720)를 연결부(경첩부)(730)로 연결한 것이고, 디스플레이(740), 서브 디스플레이(750), 픽처 라이트(760) 및 카메라(770)을 갖고 있다. 그 디스플레이(740) 또는 서브 디스플레이(750)는, 상기 실시의 형태 등의 표시 유닛에 의해 구성되어 있다.Fig. 13 shows the appearance of a cellular phone to which the display unit of the above-described embodiment or the like is applied. The mobile phone is, for example, the upper box 710 and the lower box 720 connected by a connecting portion (hinges) 730, and the display 740, the sub display 750, and the picture light 760. And a camera 770. The display 740 or the sub display 750 is configured by display units such as the above embodiments.

이상, 상기 각 실시의 형태 및 그 변형예 및 적용예를 들어 본 발명을 설명했지만, 본 발명은 그것들로 한정되는 것이 아니고, 여러 가지 변형이 가능하다.As mentioned above, although this invention was demonstrated with each said embodiment, its modified example, and application example, this invention is not limited to them, A various deformation | transformation is possible.

예를 들면, 상기 실시의 형태 등에서는, 표시 유닛이 액티브 매트릭스형인 경우에 관하여 설명했지만, 액티브 매트릭스 구동을 위한 픽셀 회로(13)의 구성은 상기 실시의 형태 등으로 설명한 것에 한정되지 않고, 필요에 따라 용량 소자나 트랜지스터를 픽셀 회로(13)에 추가해도 좋다. 그 경우, 픽셀 회로(13)의 변경에 따라, 상술한 수평 구동 회로(22), 기록 주사 회로(23), 전원 주사 회로(24) 외에, 필요한 구동 회로를 추가해도 좋다.For example, in the above embodiment and the like, the case where the display unit is an active matrix type has been described. However, the configuration of the pixel circuit 13 for driving the active matrix is not limited to that described in the above embodiment and the like. Therefore, a capacitor or a transistor may be added to the pixel circuit 13. In that case, in accordance with the change of the pixel circuit 13, the necessary driving circuit may be added in addition to the above-described horizontal driving circuit 22, the write scanning circuit 23, and the power supply scanning circuit 24.

또한, 상기 실시의 형태 등에서는, 수평 구동 회로(22), 기록 주사 회로(23) 및 전원 주사 회로(24)의 구동을 신호 유지 제어 회로(21B)가 제어하고 있지만, 다른 회로가 이러한 구동을 제어하도록 하여도 좋다. 또한, 수평 구동 회로(22), 기록 주사 회로(23) 및 전원 주사 회로(24)의 제어는, 하드웨어(회로)로 제어되어도 좋고, 소프트웨어(프로그램)로 제어되어도 좋다.In the above embodiment, the signal holding control circuit 21B controls the driving of the horizontal driving circuit 22, the write scanning circuit 23, and the power supply scanning circuit 24, but other circuits perform such driving. You may make it control. In addition, the control of the horizontal drive circuit 22, the write scan circuit 23, and the power source scan circuit 24 may be controlled by hardware (circuit) or may be controlled by software (program).

또한, 상기 실시의 형태 등에서는, 트랜지스터(TWS)의 소스 및 드레인이나, 트랜지스터(TDr)의 소스 및 드레인이 고정된 것으로 하여 설명하고 있지만, 말할 것도 없이, 전류가 흐르는 방향에 따라, 소스와 드레인의 대향 관계가 상기의 설명과는 역으로 될 수도 있다.In the above embodiment and the like, the source and drain of the transistor T WS and the source and drain of the transistor T Dr are described as being fixed, but needless to say, depending on the direction in which the current flows The opposite relationship between and drain may be reversed from the above description.

또한, 상기 실시의 형태 등에서는, 트랜지스터(TWS, TDr)가 n채널 MOS형의 TFT에 의해 형성되어 있는 것으로 하여 설명하고 있지만, 트랜지스터(TWS, TDr)의 적어도 한편이 p채널 MOS형의 TFT에 의해 형성되어 있어도 좋다. 또한, 트랜지스터(TDr)가 p채널 MOS형의 TFT에 의해 형성되어 있는 경우에는, 상기 실시의 형태 등에서, 유기 EL 소자(12)의 아노드(35A)가 캐소드로 되고, 유기 EL 소자(12)의 캐소드(35B)가 아노드로 된다. 또한, 상기 실시의 형태 등에서, 트랜지스터(TWS, TDr)는, 무정형 실리콘형의 TFT라도 좋고, 저온 폴리실리콘형의 TFT라도 좋다.In the above embodiment and the like, the transistors T WS and T Dr are described as being formed by an n-channel MOS type TFT, but at least one of the transistors T WS and T Dr is a p-channel MOS. It may be formed by a TFT of a type | mold. In the case where the transistor T Dr is formed of a p-channel MOS type TFT, the anode 35A of the organic EL element 12 becomes a cathode in the above-described embodiment and the like, and the organic EL element 12 ) Cathode 35B becomes an anode. In the above embodiment, the transistors T WS and T Dr may be amorphous silicon TFTs or low temperature polysilicon TFTs.

1…표시 유닛
10…표시부
11, 11R, 11G, 11B…픽셀
12, 12R, 12G, 12B…유기 EL 소자
13…픽셀 회로
20…주변 회로부
21…타이밍 제어 회로
21A…표시 신호 생성 회로
21B…표시 신호 유지 제어 회로
22…수평 구동 회로
23…기록 주사 회로
24…전원 주사 회로
31A, 32A…게이트
31B, 32B…소스
32B-1, 33B-1, 52B-1, 53B-1…상면
31C, 32C…드레인
33A, 33B…단자
34A, 34B, 34C, 34D…콘택트
35A…아노드
35B…캐소드
35C…유기층
35D, 42A, 43A…단차
35A-1, 55…단변부
36A, 36B…인출선
40…기판
41…게이트 절연막
42, 45…절연 보호막
43…절연 평탄화막
44…개구 규정 절연막
44A…EL 개구부
54…장변부
Cs …유지 용량
DSL…드레인선
DTL…신호선
L…외광
TDr, TWS …트랜지스터
WSL…게이트선
One… Display unit
10... Display
11, 11R, 11G, 11B... pixel
12, 12R, 12G, 12B... Organic EL device
13... Pixel circuit
20... Peripheral circuit
21 ... Timing control circuit
21A... Display signal generation circuit
21B... Display signal holding control circuit
22... Horizontal drive circuit
23 ... Recording scanning circuit
24 ... Power scan circuit
31A, 32A... gate
31B, 32B... sauce
32B-1, 33B-1, 52B-1, 53B-1... Top
31C, 32C... drain
33A, 33B... Terminals
34A, 34B, 34C, 34D... Contact
35A... Anode
35B... Cathode
35C... Organic layer
35D, 42A, 43A... Step
35A-1, 55... Short edge
36A, 36B... Leader
40 ... Board
41... Gate insulating film
42, 45... Insulation shield
43 ... Insulation planarization film
44 ... Aperture regulation insulating film
44A... EL opening
54... Long side
C s … Holding capacity
DSL… Drain wire
DTL… Signal line
L… Outer light
T Dr , T WS . transistor
WSL… Gate line

Claims (4)

유기 EL 소자 및 픽셀 회로를 픽셀마다 갖는 표시부를 구비하고,
상기 픽셀 회로는, 영상 신호를 기록하는 기록용의 제 1의 트랜지스터와, 상기 제 1의 트랜지스터에 의해 기록된 영상 신호에 근거하여 상기 유기 EL 소자를 구동하는 구동용의 제 2의 트랜지스터를 구비하고,
상기 제 2의 트랜지스터는, 게이트, 소스 및 드레인을 구비하고,
상기 유기 EL 소자는, 아노드, 유기층 및 캐소드를 구비하고,
상기 소스 또는 상기 드레인의 상면이, 적어도 상기 아노드 또는 상기 캐소드의 대향 영역에 형성되는 것을 특징으로 하는 표시 유닛.
A display portion having an organic EL element and a pixel circuit for each pixel,
The pixel circuit includes a first transistor for recording for recording a video signal and a second transistor for driving for driving the organic EL element based on the video signal recorded by the first transistor. ,
The second transistor has a gate, a source, and a drain,
The organic EL device includes an anode, an organic layer, and a cathode,
An upper surface of the source or the drain is formed at least in an area opposite to the anode or the cathode.
제 1항에 있어서,
상기 표시부는, 상기 게이트와 상기 소스 또는 상기 드레인 사이에 접속된 유지 용량을 상기 픽셀마다 구비하며,
상기 유지 용량은, 상면이 상기 아노드 또는 상기 캐소드와 상기 게이트에 대향하는 영역에 형성되는 상기 소스 또는 상기 드레인으로 구성되는 것을 특징으로 하는 표시 유닛.
The method of claim 1,
The display unit includes a storage capacitor connected between the gate and the source or the drain for each pixel,
And the storage capacitor is configured by the source or the drain having an upper surface formed in a region facing the anode or the cathode and the gate.
유기 EL 소자 및 픽셀 회로를 픽셀마다 갖는 표시부를 구비하고,
상기 픽셀 회로는, 영상 신호를 기록하는 기록용의 제 1의 트랜지스터와, 상기 제 1의 트랜지스터에 의해 기록된 영상 신호에 근거하여 상기 유기 EL 소자를 구동하는 구동용의 제 2의 트랜지스터를 구비하고,
상기 제 2의 트랜지스터는, 게이트, 소스 및 드레인을 구비하고,
상기 유기 EL 소자는, 아노드, 유기층 및 캐소드를 구비하고,
상기 소스 또는 상기 드레인은, 연속한 만곡면을 포함하는 장변부를 갖는 것을 특징으로 하는 표시 유닛.
A display portion having an organic EL element and a pixel circuit for each pixel,
The pixel circuit includes a first transistor for recording for recording a video signal and a second transistor for driving for driving the organic EL element based on the video signal recorded by the first transistor. ,
The second transistor has a gate, a source, and a drain,
The organic EL device includes an anode, an organic layer, and a cathode,
The source or the drain has a long side portion including a continuous curved surface.
제 3항에 있어서,
상기 소스 또는 상기 드레인은, 연속한 만곡면을 포함하는 단변부를 더 갖는 것을 특징으로 하는 표시 유닛.
The method of claim 3, wherein
And the source or the drain further has a short side portion including a continuous curved surface.
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