KR20100091918A - 하나 이상의 할로겐 램프를 동작하기 위한 회로장치 - Google Patents

하나 이상의 할로겐 램프를 동작하기 위한 회로장치 Download PDF

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KR20100091918A
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오스람 게젤샤프트 미트 베쉬랭크터 하프퉁
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Abstract

본 발명은 하나 이상의 할로겐 램프(La)를 동작하기 위한 회로장치에 관한 것으로, 상기 회로장치는 교류 공급 전압(UN)을 인가하기 위한 제 1 입력단자(E1) 및 제 2 입력단자(E2)를 갖는 입력부를 포함하고;
상기 제 1 입력단자(E1)와 상기 제 2 입력단자(E2)에 연결된 입력부 및 중간회로전압(UZ)에 제공하기 위한 제 1 출력단자와 제 2 출력단자를 갖는 출력부를 구비한 정류기(D1, D2, D3, D4)를 포함하고;
각각 하나의 제어 전극, 기준 전극 및 동작 전극을 갖는 적어도 하나의 제 1 전자 스위치(T1)와 제 2 전자 스위치(T2) 갖는 브리지 회로를 포함하고―상기 제 1 전자 스위치(T1)와 상기 제 2 전자 스위치(T2)는 제 1 브리지 중점(HM1) 형성하에 상기 정류기(D1, D2, D3, D4)의 상기 제 1 출력단자와 상기 제 2 출력단자 사이에 직렬 연결되며, 그 외에도 상기 브리지 회로는 제 2 브리지 중점(HM2)을 포함함―;
1차 권선(W1) 및 2차 권선(W2)을 갖는 제 1 트랜스포머(TR1)를 포함하며―상기 1차 권선(W1)은 상기 제 1 브리지 중점(HM1)과 상기 제 2 브리지 중점(HM2) 사이에 연결됨―;
하나 이상의 할로겐 램프(La)에 동작 전압(UA)을 제공하기 위한 제 1 출력단자(A1)와 제 2 출력단자(A2)를 갖는 출력부를 포함하고―상기 제 1 출력단자(A1)는 상기 제 1 트랜스포머(TR1)의 상기 2차 권선(W2)의 제 1 접속단자에 연결되며, 상기 제 2 출력단자(A2)는 상기 제 1 트랜스포머(TR1)의 상기 2차 권선(W2)의 제 2 접속단자에 연결됨―;
제 1 권선(S1), 제 2 권선(S2), 제 3 권선(S3)을 갖는 제 2 트랜스포머(TR2)를 포함하고―상기 제 2 트랜스포머(TR2)의 제 1 권선(S1)은 상기 제 1 트랜스포머(TR1)의 상기 2차 권선(W1)에 직렬 연결되며, 상기 제 2 권선(S2)은 상기 제 1 전자 스위치의 상기 제어 전극에 연결되며, 상기 제 3 권선(S3)은 상기 제 2 전자 스위치의 상기 제어 전극에 연결됨―;
상기 정류기(D1, D2, D3, D4)의 상기 제 1 출력단자 및 상기 제 2 출력단자 사이에 연결된, 제 1 옴 저항(R1)과 제 1 콘덴서(C1)를 갖는 직렬 회로를 포함하고; 그리고
한편으로는 상기 제 1 옴 저항(R1) 및 상기 제 1 콘덴서(C1)의 접속점과 또 다른 한편으로는 상기 제 2 전자 스위치의 상기 제어 전극 사이에 연결된 트리거링 장치(Z1)를 포함하는, 하나 이상의 할로겐 램프(La)를 동작하기 위한 회로장치로서,
상기 회로장치는 이 외에도 적어도 하나의 입력부(E3, E4) 및 적어도 하나의 출력부(A3, A4) 갖는 마이크로프로세서(10)를 포함하는―적어도 하나의 디커플링 포인트를 갖는 상기 마이크로프로세서(10)의 상기 적어도 하나의 입력부(E3)는 상기 정류기(D1, D2, D3, D4)의 상기 출력부와 상기 회로장치의 상기 출력부(A1, A2) 사이에 연결되며, 상기 적어도 하나의 디커플링 포인트는 상기 중간회로전압(UZ)이 미리 주어진 제 1 임계값(US) 미만일 경우, 상기 디커플링 포인트의 전위값이 미리 주어진 제 2 임계값 미만인 것을 특징으로 한다.

Description

하나 이상의 할로겐 램프를 동작하기 위한 회로장치{CIRCUIT ARRANGEMENT FOR AT LEAST ONE HALOGEN LAMP}
본 발명은 하나 이상의 할로겐 램프를 동작하기 위한 회로장치에 관한 것으로, 상기 회로장치는 교류 공급 전압(supply AC voltage)을 인가하기 위한 제 1 입력단자 및 제 2 입력단자를 갖는 입력부를 포함하고, 상기 제 1 입력단자와 상기 제 2 입력단자에 연결된 입력부 및 중간회로전압을 제공하기 위한 제 1 출력단자와 제 2 출력단자를 갖는 출력부를 구비한 정류기를 포함하며, 각각 하나의 제어 전극, 기준 전극 및 동작 전극을 구비한 적어도 하나의 제 1 전자 스위치와 제 2 전자 스위치를 갖는 브리지 회로를 포함하고 ― 상기 제 1 전자 스위치와 상기 제 2 전자 스위치는 제 1 브리지 중점 형성하에 상기 정류기의 상기 제 1 출력단자와 상기 제 2 출력단자 사이에 직렬 연결되며, 그 외에도 상기 브리지 회로는 제 2 브리지 중점을 포함함 ―, 1차 권선과 2차 권선을 갖는 제 1 트랜스포머(TR1)를 포함하며 ― 상기 1차 권선은 상기 제 1 브리지 중점과 상기 제 2 브리지 중점 사이에 연결됨 ―, 하나 이상의 할로겐 램프에 동작전압을 제공하기 위한 제 1 출력단자와 제 2 출력단자를 갖는 출력부를 포함하고 ― 상기 제 1 출력단자는 상기 제 1 트랜스포머의 상기 2차 권선의 제 1 접속단자에 연결되며, 상기 제 2 출력단자는 상기 제 1 트랜스포머의 상기 2차 권선의 제 2 접속단자에 연결됨 ―, 제 1 권선, 제 2 권선, 제 3 권선을 갖는 제 2 트랜스포머를 포함하며 ― 상기 제 2 트랜스포머의 상기 제 1 권선은 상기 제 1 트랜스포머의 1차 권선에 직렬 연결되고, 상기 제 2 권선은 상기 제 1 전자 스위치의 상기 제어 전극에 연결되며, 상기 제 3 권선은 상기 제 2 전자 스위치의 상기 제어 전극에 연결됨 ―, 상기 정류기의 상기 제 1 출력단자와 상기 제 2 출력단자 사이에 연결된, 제 1 옴 저항과 제 1 콘덴서를 갖는 직렬회로를 포함하고, 그리고 한편에서는 상기 제 1 옴 저항 및 상기 제 1 콘덴서의 접속점과 또 다른 한편에서는 상기 제 2 전자 스위치의 상기 제어 전극 사이에 연결된 트리거링 장치를 포함한다.
본 발명은 할로겐 램프의 디밍(dimming)에 관련된 문제를 다룬다. 대개 이와 관련하여서는 위상 지연 디밍(phase lag dimming) 또는 위상 선도 디밍(phase lead dimming)이 특히 트리악(triac)과 공동으로 사용된다. 회로망을 동시에 위상 지연 또는 위상 선도하기 위해서는 공급전압의 제로 교차(zero crossing) 검출이 절대적으로 필요하다. 공지된 구현들, 예컨대 온 세미컨덕터(ON SEMICONDUCTOR)사(社)의 IC CA3059는 공급전압에서 바로, 즉 정류를 통해서 소위 제로 교차 신호를 생성한다. 공지된 해결책의 단점은 무엇보다 서지 펄스, 회로망 변형 및 또 다른 간섭들로 인해 안전한 디밍 동작을 방해하는 제로 교차가 야기된다는 것이다.
따라서, 본 발명의 목적은 비교적 간섭에 민감한 디밍 동작이 구현되도록 도입부에 언급한 회로장치를 개선하는 것이다.
상기 목적은 청구항 1의 특징들을 갖는 회로장치에 의해 달성된다.
본 발명은 제로 교차를 검출하기 위해 정류기의 출력부와 회로장치의 출력부 사이에 놓인 디커플링 포인트(decoupling point)가 선택될 경우, 상기 목적이 달성될 수 있다는 인식을 기본으로 하며, 이 경우 상기 디커플링 포인트는 중간회로전압이 미리 정해진 제 1 임계값 미만일 경우, 상기 디커플링 포인트의 전위값이 미리 정해진 제 2 임계값 미만인 것을 특징으로 한다. 달리 표현하자면, 대개 회로장치의 이러한 부분에 공급되는 중간회로전압이 정해진 임계값 이하로 내려갈 경우, 디커플링 포인트의 전위값이 대개 0 V에 맞춰짐으로써 상기 디커플링 포인트가 선택된다. 이러한 과정이 가능한 이유는 접속된 부하 회로가 중간전압회로의 정해진 임계값 미만일 경우, 부하회로가 자발적으로 스위치 오프되기 때문이다. 따라서, 이러한 스위치 오프는 회로망에서 동시에 실행되고 제로 교차 신호의 제너레이션을 위해 사용될 수 있다.
공급전압의 간섭은 예컨대, 서지 펄스 또는 회로망 변형에 의한 것과 같이 유동성 및 용량성 관련 컴포넌트들의 관성의 결과로서 대개 적은 전력 강하를 통해 본 발명에 따라 선택된 디커플링 포인트에 영향을 미치지 않으므로, 본 발명에 따른 회로장치는 공급전압의 제로 교차를 간단하고 견고하게 검출할 수 있다. 상기 본 발명에 따른 회로장치는 소수의 컴포넌트들을 필요로 하고, 공지된 실시예들보다 간단하게 설계될 수 있으며, 극히 섬세한 것으로 나타났다.
바람직한 실시예에서 마이크로프로세서는 자신의 적어도 하나의 입력부의 신호에 따라 상기 신호와 시간적으로 일치하는, 회로장치의 디밍을 구현하는 신호를 자신의 적어도 하나의 출력부에 제공하도록 설계된다. 이 경우, 고려해야 할 점은 하나의 마이크로프로세서가 통상적으로 예컨대 DALI 표준에 따라 디밍 신호를 수신하기 위해 상기와 같은 유형의 회로장치 내에 제공된다는 것이다. 마이크로프로세서는 미리 주어진 임계값 미만일 경우 자신의 입력부의 신호를 모니터링하고, 그 결과로 공급 전압의 제로 교차를 유도하여 자신의 출력부에 특히, 위상 지연 디밍 또는 위상 선도 디밍을 위한 디밍 정보를 전송하는 신호를 제공하도록 설계될 수 있다.
바람직하게 제 1 다이오드 및 평활장치(smoothing device)를 포함하는 직렬회로는 회로장치의 적어도 하나의 디커플링 포인트와 마이크로프로세서의 제 1 입력부 사이에 연결된다. 따라서, 마이크로프로세서에는 포지티브 직류 전압 신호(positive DC voltage signal)가 전송될 수 있으며, 상기 신호는 실질적으로 0 V로의 강하를 특징으로 하며, 이 경우 강하 시점은 공급전압의 제로 교차를 나타낸다. 이러한 평활장치는 자신의 매우 경제적인 구현시 제 2 옴 저항 및 제 2 콘덴서를 포함한다.
특히 바람직한 실시예에서 제 2 트랜스포머는 디커플링을 위해 제 4 권선을 포함한다. 디커플링 포인트뿐만 아니라 하프 브리지 중점이 브리지 회로의 전자 스위치들 및 결합 콘덴서들의 중점에서의 신호들을 고려하긴 하지만, 제 4 권선에 의한 디커플링이 제어 트랜스포머로 사용되는 제 2 트랜스포머에서 갖는 장점은 이러한 디커플링시 전위가 펄스상의 주기 동안 일정한 전압레벨을 취하고, 대기 시간 동안 0 V의 레벨을 취한다는 것이다. 이 외에도 기준 전위가 자유롭게 선택될 수 있다. 또한, 최대한 낮은 전압레벨로 인해 극히 적은 손실이 발생되는 반면, 종래 기술에서는 높은 손실하에 공급전압이 분할되어야 했다. 따라서, 마이크로프로세서에 안내되는 전압은 제 2 트랜스포머의 권선들의 코일 개수에 의해 간단한 방식으로 마이크로프로세서의 설정 입력전압 범위를 조절할 수 있다.
그 결과 할로겐 램프의 디밍은 손실이 매우 적고, 단순하게 설계된 셀프 발진기(self-oscillator)에 의해 구현될 수 있다. 무엇보다 공급전압의 간섭이 확실하게 무효화 되는데, 그 이유는 이러한 간섭이 더 이상 마이크로프로세서에 전송된 신호 내에 거의 존재하지 않기 때문이다.
또한, 회로장치는 위상 지연 디밍을 위해 제어 전극, 기준 전극 및 동작 전극을 갖는 제 3 전자 스위치를 포함하며, 이 경우 제 3 전자 스위치의 제어 전극은 마이크로프로세서의 제 1 출력부에 연결되고, 제 3 전자 스위치의 경로, 즉 동작 전극―기준 전극은 제 1 콘덴서에 병렬 접속된다. 이와 같이 제 3 전자 스위치가 도통 접속되는 한, 제 1 콘덴서 상에서는 트리거링 장치의 개시에 적합한 전압이 형성될 수 없다. 이러한 구동은 제 3 전자 스위치가 역 바이어스 접속될 경우에만 가능하다.
그 외에 회로장치는 위상 선도 디밍을 구현하기 위해 제어 전극, 기준 전극 및 동작 전극을 갖는 제 4 전자 스위치를 포함하며, 이 경우 제 4 전자 스위치의 제어 전극은 마이크로프로세서의 제 2 출력부에 연결되고, 제 4 전자 스위치의 경로, 즉 동작 전극―기준 전극은 제 4 권선에 병렬 접속된다. 제 4 전자 스위치가 도통 접속되는 한, 그로 인해 제 4 권선이 단락되고 제 2 권선 및 제 3 권선과의 결합을 통해서도 단락된다. 그 결과 제 1 전자 스위치 및 제 2 전자 스위치의 구동이 중지됨으로써, 위상 선도가 발생한다.
제 4 전자 스위치가 제 2 트랜스포머의 제 2 권선 또는 제 3 권선에 병렬 접속될 경우, 동일한 권선이 달성될 수 있다.
특히 바람직한 실시예에서 컴포넌트들의 크기 설계가 이루어짐으로써, 중간회로전압이 미리 주어진 제 1 임계값을 초과하는 제 1 시간 동안, 제 1 디커플링 포인트와 제 2 디커플링 포인트 사이 전위 포락 곡선(envelope curve)은 0 V와 같거나 상이하고, 상기 중간회로전압(UZ)이 미리 주어진 임계값 미만인 제 2 시간 동안, 제 1 디커플링 포인트와 제 2 디커플링 포인트 사이 전위 포락 곡선은 실질적으로 0 V, 특히 0 V이다. 이는 공급전압의 제로 교차를 특히 간단하게 검출할 수 있도록 한다.
바람직하게 마이크로프로세서는 디밍 신호, 특히 DALI 신호를 수신하기 위해 설계된 제 2 입력부를 포함한다. 따라서, 마이크로프로세서는 DALI 신호의 정보들에 따라 제 3 전자 스위치 및/또는 제 4 전자 스위치를 구동하도록 설계될 수 있다.
이와 관련하여 마이크로프로세서는 위상 지연 디밍을 야기하기 위한 신호를 자신의 제 1 출력부에 전송하고 그리고/또는 위상 리드 디밍을 야기하기 위한 신호를 자신의 제 2 출력부에 전송하기 위해, 자신의 제 1 입력부의 신호가 자신의 제 2 입력부의 신호와 결합하도록 설계된다.
또한, 회로장치는 방전장치를 포함할 수 있으며, 상기 방전장치는 회로장치가 발진하는 즉시, 제 1 콘덴서를 트리거링 장치의 항복전압보다 낮은 레벨로 방전하도록 설계된다. 그 결과로 트리거링 장치가 원하는 시점에만 개시되어 스타팅 펄스를 제 2 전자 스위치에 제공하는 것이 보장된다. 따라서, 원하지 않은 스타팅 펄스에 의한 제어가 차단된다.
추가의 바람직한 실시예들은 종속항들에 기술된다.
본 발명에 따른 회로장치의 실시예는 이하에서 첨부된 도면들을 참조하여 상세하게 설명된다.
도 1은 본 발명에 따른 회로장치의 실시예를 개략적으로 도시한 도면이고,
도 2는 도 1의 상이한 값의 시간적 파형을 도시한 도면이며,
도 3은 본 발명에 따른 회로장치의 실시예를 개략적으로 도시한 도면이다.
도 1은 본 발명에 따른 회로장치의 실시예를 개략적인 도면으로 도시한 것이다. 이 경우, 공급전압(UN)은 제 1 입력단자(E1)와 제 2 입력단자(E2) 사이에 연결된다. 상기 공급전압은 다이오드들(D1, D2, D3 및 D4)을 포함하는 정류기에 공급된다. 정류기의 출력부에는 정류된 공급전압(UN)에 상응하는 중간회로전압(UZ)이 제공된다. 상기 중간회로전압은 특히 하프 브리지 회로에 공급되고, 상기 하프 브리지 회로는 제 1 트랜지스터(T1) 및 제 2 트랜지스터(T2) 그리고 제 1 커플링 콘덴서(CK1) 및 제 2 커플링 콘덴서(CK2)를 포함한다. 제 1 하프 브리지 중점(HM1)은 트랜지스터들(T1, T2) 사이에 형성되는 반면, 제 2 하프 브리지 중점(HM2)은 2개의 커플링 콘덴서(CK1, CK2) 사이에 형성된다. 제 1 트랜스포머(TR1)는 1차 권선(W1) 및 그와 연결된 2차 권선(W2)을 갖는다. 1차 권선(W1)은 하프 브리지 중점들(HM1, HM2) 사이에 연결되어 있다. 2차 권선(W2)의 두 접속단자는 회로장치의 제 1 출력단자(A1)와 제 2 출력단자(A2)를 형성하고, 상기 두 출력단자에 할로겐 램프(La)가 접속된다.
제 2 트랜스포머(TR2)의 제 1 권선(S1)은 제 1 트랜스포머(TR1)의 1차 권선(W1)에 직렬 연결된다. 상기 제 1 권선은 제 2 권선(S2), 제 3 권선(S2) 및 제 4 권선(S4)에 연결된다. 제 2 권선(S2)은 트랜지스터(T1)의 베이스와 이미터(emitter) 사이에 연결되는 반면, 제 3 권선(S3)은 트랜지스터(T2)의 베이스와 이미터 사이에 연결된다. 또한, 옴 저항(R1) 및 콘덴서(C1)의 직렬회로는 정류기의 출력부들 사이에 연결된다. 콘덴서(C1)에서 강하하는 전압은 트리거링 장치(Z1)에 의해, 본 경우에는 다이악(Diac)으로 실행되고 트랜지스터(T2)의 베이스에 연결된다. 전압이 콘덴서(C1) 상에 다이악(Z1)의 항복전압(break down voltage)으로 축적되는 경우, 그 결과로 상기 전압은 회로장치를 발진하게 된다. 트리거링 후 스타팅 펄스의 간섭을 방지하기 위해, 콘덴서(C1)는 옴 저항(R2) 및 트랜지스터(T3)를 사용하여 다이악(Z1)의 항복전압 이하로 방전된다.
제 4 권선을 통해 결합 해제된 전압은 전류를 제한하기 위해 옴 저항(R5)에 연결되고, 그리고 나서 다이오드(D5)에 의해 정류되어 콘덴서(C2)와 옴 저항(R3)의 병렬 회로의 사용하에 평활해진다. 이어서, 상기 전압은 제어장치(10), 특히 마이크로프로세서의 제 1 입력부(E3)에 공급된다. 또한, 원하는 밝기에 대한 정보를 포함하는 DALI-신호는 입력부(E4)를 통해 마이크로프로세서(10)에 전송된다. 마이크로프로세서(10)는 트랜지스터(T4)의 베이스에 연결된 제 1 출력부(A3) 포함하고, 상기 트랜지스터(T4)는 콘텐서(C1)에 병렬 연결된다. 마이크로프로세서(10)의 제 2 출력부(A4)는 제 4 권선(S4)에 병렬 연결된 트랜지스터(T5)의 베이스에 연결된다.
도 2의 상부 도면은 중간회로전압(UZ)의 시간적 파형을 도시한 것이다. 상기 중간회로전압의 파형도는 0 V 내지 대개 약 325 V에 이르는 상기 중간회로전압의 최대값(UZmax) 사이에서 하프 사인파 형태로 진행한다. 임계값(US) 이하에서 전압은 권선(S3)을 통해 0.7 V 이상의 전압을 발생하고, 트랜지스터(T2)를 도통 접속하기에는 충분하지 않다. 따라서, 트랜지스터(T2)는 역 바이어스 상태로 전환되고, 그로 인해 하프 브리지(T1, T2)가 정지한다. 임계값(US)이 가장 먼저 대두되는 반주기(half wave)에서 다시 초과할 경우 비로소 회로장치의 스타팅이 다시 가능해진다. 따라서, 다이악(Z1)은 특히 중간회로전압(UZ)이 상기 다이악의 항복 후 회로장치의 상기 발진을 구현하기 위해 충분히 높은 크기로 설계된다.
도 2의 하부 도면은 제 3 권선(S3)의 전압(US3)의 시간적 파형을 도시한 것이다. 도면에서 명확히 알 수 있듯이, 상기 전압(US3)은 먼저 +0.7 V 내지 -0.7V 사이의 고주파 교류 신호로 진행한다. 그러나 중간회로전압(UZ)이 임계전압(US) 미만일 경우, 전압(US3)의 진폭은 O V로 되돌아간다. 제 4권선(S4)의 전압(US4)에 대해서도 상응하는 파형이 발생한다. 전압(US4)의 정류 및 평활에 의해 마이크로프로세서(10)의 입력부(E3)에서는 굵은 선으로 표현된 파형이 발생한다. 전압(US3)이 0 V로 되돌아 갈 경우에는 항상 공급전압(UN)의 제로 교차가 표시된다. 그로 인해, 회로망의 동시 위상 지연 디밍 또는 위상 선도 디밍이 가능해진다.
따라서, 공급전압(UN)의 제로 교차 인식시 마이크로프로세서(10)는 자신의 입력부(E4)에 전송된 DALI 신호의 고려하여 위상 지연 디밍하기 위한 신호를 자신의 출력부(A3) 및 출력부(A4)에 전송할 수 있다.
트랜지스터(T4)는 마이크로프로세서의 출력부(A3)에 전송된 신호에 의해 도통 접속될 수 있다. 그로 인해 콘덴서(C1) 상에서의 계속되는 전압 증가는 다이악(Z1)의 항복전압을 통해 방지될 수 있다. 트랜지스터(T4)가 역 바이어스 접속될 경우 비로소, 다이악(Z1)의 항복전압을 통해 콘덴서(C1) 상에서 충전이 계속되고, 그 결과 회로장치가 스타팅된다. 이러한 과정은 위상 지연 디밍에 상응한다.
위상 선도 디밍을 구현하기 위해서는 예컨대 마이크로프로세서의 출력부(A4)에 전송된 신호가 트랜지스터(T5)에 인가된다. 트랜지스터(T5)가 도통 접속되는 동안에는 제 4 권선(S4)이 단락되고 권선(S2) 및 권선(S3)과 커플링을 통해서도 단락된다. 그로 인해 사전에 스타팅된 회로장치가 스위치 오프될 수 있다.
주목되는 점은, 신호(US3)가 무전위 방식으로 제공될 수 있다는 것이다. 이는 모든 임의의 전위가 중요시될 수 있다는 장점을 갖는다. 특히 바람직하게는 권선(S4)의 코일들의 개수가 선택됨으로써, 전압(UE3)은 예컨대 최대 3.3 V의 마이크로프로세서(10)의 필수 입력전압에 매칭된다.
도 3은 본 발명에 따른 회로장치의 추가의 실시예를 도시한 것이다. 도면에서 동일한 또는 유사한 작용을 하는 컴포넌트들은 도 1에 첨부된 도면 부호와 동일하게 기재되었다. 상기 변이형은 갈바니 전기식 분리 없이도 결합 해제 가능한 것으로 분류된다. 결합 해제된 신호의 레벨을 마이크로프로세서(10)의 입력 레벨에 매칭하기 위해 증폭 장치, 예컨대 이미터 폴로어(emitter follower)가 중간접속될 수 있다. 위상 선도 디밍을 구현하기 위해 본 경우에는 트랜지스터(T5)가 권선(S3)에 병렬 접속되고, 이 경우 당업자에게 잘 알려져 있듯이, 권선(S2)의 병렬 접속도 동일한 효과를 갖는다.

Claims (12)

  1. 하나 이상의 할로겐램프(La)를 동작하기 위한 회로장치로서,
    교류 공급 전압(UN)을 인가하기 위한 제 1 입력단자(E1)와 제 2 입력단자(E2)를 갖는 입력부를 포함하고;
    상기 제 1 입력단자(E1)와 상기 제 2 입력단자(E2)에 연결된 입력부 및 중간회로전압(UZ)을 공급하기 위한 제 1 출력단자와 제 2 출력단자를 갖는 출력부를 구비한 정류기(D1, D2, D3, D4)를 포함하며;
    각각 하나의 제어 전극, 기준 전극 및 동작 전극을 구비한 적어도 하나의 제 1 전자 스위치(T1)와 적어도 하나의 제 2 전자 스위치(T2)를 갖는 브리지 회로를 포함하고 ― 상기 제 1 전자 스위치(T1)와 상기 제 2 전자 스위치(T2)는 제 1 브리지 중점(HM1)을 포함하며 상기 정류기(D1, D2, D3, D4)의 상기 제 1 출력단자와 상기 제 2 출력단자 사이에 직렬 연결되고, 그 외에도 상기 브리지 회로는 제 2 브리지 중점(HM2)을 포함함 ―;
    1차 권선(W1)과 2차 권선(W2)을 갖는 제 1 트랜스포머(TR1)를 포함하며 ― 상기 1차 권선(W1)은 상기 제 1 브리지 중점(HM1)과 상기 제 2 브리지 중점(HM2) 사이에 연결됨 ―;
    하나 이상의 할로겐램프(La)에 동작전압(UA)을 공급하기 위한 제 1 출력단자(A1)와 제 2 출력단자(A2)를 갖는 출력부를 포함하고 ― 상기 제 1 출력단자(A1)는 상기 제 1 트랜스포머(TR1)의 상기 2차 권선(W2)의 제 1 접속단자에 연결되며, 상기 제 2 출력단자는 상기 제 1 트랜스포머(TR1)의 상기 2차 권선(W2)의 제 2 접속단자에 연결됨 ―;
    제 1 권선(S1), 제 2 권선(S2), 제 3 권선(S3)을 갖는 제 2 트랜스포머(TR2)를 포함하고 ― 상기 제 2 트랜스포머(TR2)의 상기 제 1 권선(S1)은 상기 제 1 트랜스포머(TR1)의 상기 1차 권선(W1)에 직렬 연결되며, 상기 제 2 권선(S2)은 상기 제 1 전자 스위치의 상기 제어 전극에 연결되고, 상기 제 3 권선(S3)은 상기 제 2 전자 스위치의 상기 제어 전극에 연결됨 ―;
    상기 정류기(D1, D2, D3, D4)의 상기 제 1 출력 단자와 제 2 출력단자 사이에 연결된, 제 1 옴 저항(R1)과 제 1 콘덴서(C1)를 갖는 직렬 회로를 포함하고; 그리고
    한편으로는 상기 제 1 옴 저항(R1) 및 상기 제 1 콘덴서(C1)의 접속점과 또 다른 한편으로는 상기 제 2 전자 스위치의 상기 제어 전극 사이에 연결된 트리거링 장치(Z1)를 포함하며,
    상기 하나 이상의 할로겐램프를 동작하기 위한 회로장치가 그 외에도 적어도 하나의 입력부(E3, E4) 및 적어도 하나의 출력부(A3, A4)를 갖는 마이크로프로세서(10)를 포함하고,
    적어도 하나의 디커플링 포인트를 갖는 상기 마이크로프로세서(10)의 상기 적어도 하나의 입력부(E3)는 상기 정류기(D1, D2, D3, D4)의 상기 출력부와 상기 회로장치의 상기 출력부(A1, A2) 사이에 연결되며, 상기 적어도 하나의 디커플링 포인트는 상기 중간회로전압(UZ)이 미리 주어진 제 1 임계값(US) 미만일 경우, 상기 디커플링 포인트의 전위값이 미리 주어진 제 2 임계값 미만인,
    하나 이상의 할로겐램프를 동작하기 위한 회로장치.
  2. 제 1항에 있어서,
    상기 마이크로프로세서(10)가 자신의 하나 이상의 입력부(E3)의 신호에 따라 상기 신호와 시간적으로 일치하는, 회로장치의 디밍(dimming)을 구현하는 신호를 자신의 하나 이상의 출력부(A3, A4)에 제공하도록 설계되는,
    하나 이상의 할로겐램프를 동작하기 위한 회로장치.
  3. 제 2항에 있어서,
    상기 디밍이 위상 지연 디밍(phase lag dimming)이거나 또는 위상 선도 디밍(phase lead dimming)인,
    하나 이상의 할로겐램프를 동작하기 위한 회로장치.
  4. 제 3항에 있어서,
    제 1 다이오드(D5) 및 평활장치(C2, R3)를 포함하는 직렬 회로가 상기 하나 이상의 할로겐램프를 동작하기 위한 회로장치의 적어도 하나의 디커플링 포인트와 상기 마이크로프로세서(10)의 적어도 하나의 제 1 입력부(E3) 사이에 연결되는,
    하나 이상의 할로겐램프를 동작하기 위한 회로장치.
  5. 제 4항에 있어서,
    상기 평활장치가 제 2 옴 저항(R3) 및 제 2 콘덴서(C2)를 포함하는,
    하나 이상의 할로겐램프를 동작하기 위한 회로장치.
  6. 제 3항 내지 제 5항 중 어느 한 항에 있어서,
    결합 해제를 위해 상기 제 2 트랜스포머(TR2)가 제 4 권선(S4)을 포함하는,
    하나 이상의 할로겐램프를 동작하기 위한 회로장치.
  7. 제 3항 내지 제 5항 중 어느 한 항에 있어서,
    상기 하나 이상의 할로겐램프를 동작하기 위한 회로장치는 계속적으로 제어 전극, 기준 전극 및 동작 전극을 갖는 제 3 전자 스위치(T4)를 포함하고, 이 경우 상기 제 3 전자 스위치(T4)의 제어 전극은 상기 마이크로프로세서(10)의 제 1 출력부(A3; A4)에 연결되며, 이 경우 상기 제 3 전자 스위치(T4)의 경로, 즉 동작 전극-기준 전극은 상기 제 1 콘덴서(C1)에 병렬 접속되는,
    하나 이상의 할로겐램프를 동작하기 위한 회로장치.
  8. 제 6항 또는 제 7항에 있어서,
    상기 하나 이상의 할로겐램프를 동작하기 위한 회로장치는 계속적으로 제어 전극, 기준 전극 및 동작 전극을 갖는 제 4 전자 스위치(T5)를 포함하고, 상기 제 4 전자 스위치(T5)의 제어 전극은 상기 마이크로프로세서(10)의 제 2 출력부(A3; A4)에 연결되며, 상기 제 4 전자 스위치(T5)의 경로, 즉 동작 전극-기준 전극은 제 2 권선(S2) 또는 제 3 권선(S3) 또는 제 4 권선(S4)에 병렬 접속되는,
    하나 이상의 할로겐램프를 동작하기 위한 회로장치.
  9. 제 1항 내지 제 8항 중 어느 한 한에 있어서,
    상기 중간회로전압(UZ)이 미리 주어진 제 1 임계값(US)을 초과하는 제 1 시간 동안, 제 1 디커플링 포인트와 제 2 디커플링 포인트 사이 전위 포락 곡선은 0V와 같거나 상이하고, 상기 중간회로전압(UZ)이 미리 주어진 임계값(US) 미만인 제 2 시간 동안 전위 포락 곡선은 실질적으로 0 V인,
    하나 이상의 할로겐램프를 동작하기 위한 회로장치.
  10. 제 1항 내지 제 9항 중 어느 한 한에 있어서,
    상기 마이크로프로세서(10)가 디밍 신호, 특히 DALI 신호를 수신하도록 설계된 제 2 입력부(E4)를 포함하는,
    하나 이상의 할로겐램프를 동작하기 위한 회로장치.
  11. 제 10항에 있어서,
    상기 마이크로프로세서(10)는 위상 지연 디밍을 야기하기 위한 신호를 제 1 출력부(A3)에 전송하고 그리고/또는 위상 선도 디밍을 야기하기 위한 신호를 제 2 출력부(A4)에 전송하기 위해, 자신의 제 1 입력부(E3)의 신호가 자신의 제 2 입력부(E4)의 신호와 결합되도록 설계되는,
    하나 이상의 할로겐램프를 동작하기 위한 회로장치.
  12. 제 1항 내지 제 11항 중 어느 한 한에 있어서,
    상기 하나 이상의 할로겐램프를 동작하기 위한 회로장치가 계속적으로 방전장치(R2, T3)를 포함하고, 상기 방전장치는 상기 하나 이상의 할로겐램프를 동작하기 위한 회로장치가 발진되는 동안 상기 제 1 콘덴서(C1)가 상기 트리거링 장치(Z1)의 항복전압보다 낮게 방전되도록 설계되는,
    하나 이상의 할로겐램프를 동작하기 위한 회로장치.
KR1020100012404A 2009-02-10 2010-02-10 하나 이상의 할로겐 램프를 동작하기 위한 회로장치 KR20100091918A (ko)

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