KR20090043725A - 플라즈마 디스플레이 장치 - Google Patents

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Abstract

본 발명은 플라즈마 디스플레이 장치에 관한 것이다.
본 발명의 일실시 예에 따른 플라즈마 디스플레이 장치는 플라즈마 디스플레이 패널에 포함된 복수의 스캔 전극과 연결되는 복수의 스캔 구동 집적회로를 포함하고, 복수의 서브필드 중 어드레스 기간은 제1 어드레스 기간과 제1 어드레스 기간보다 복수의 스캔 전극에 공급되는 스캔 펄스의 스캔 순서가 시간상 늦게 공급되는 제2 어드레스 기간으로 나누고, 복수의 스캔 전극은 2n-1번째 스캔 전극 라인으로 형성하는 제1 스캔 전극 그룹과 2n번째 스캔 전극 라인으로 형성하는 제2 스캔 전극 그룹으로 나누고, 스캔 구동 집적회로는 제1 스캔 전극 그룹과 제2 스캔 전극 그룹으로 스캔 펄스를 선택적으로 출력하는 복수 개의 스위치부를 포함한다.

Description

플라즈마 디스플레이 장치{Plasma Display Apparatus}
본 발명은 플라즈마 디스플레이 장치에 관한 것이다.
일반적으로 플라즈마 디스플레이 패널은 전면 패널과 후면 패널 사이에 형성된 격벽이 하나의 단위 방전 셀을 이루는 것으로, 각 셀 내에는 네온(Ne), 헬륨(He) 또는 네온 및 헬륨의 혼합기체(Ne+He)와 같은 주 방전 기체와 소량의 크세논을 함유하는 불활성 가스가 충진되어 있다. 전술한 단위 방전 셀은 복수 개가 모여 하나의 화소(Pixel)를 이룬다. 예컨대, 적색(Red, R) 셀, 녹색(Green, G) 셀, 청색(Blue, B) 셀이 모여 하나의 픽셀을 이루는 것이다. 이러한 단위 방전 셀에 고주파 전압이 공급되어 방전이 될 때, 불활성 가스는 진공자외선(Vacuum Ultra Violet rays)을 발생하고 격벽 사이에 형성된 형광체를 발광시켜 화상이 구현된다. 이와 같은 플라즈마 디스플레이 패널은 얇고 가벼운 구성이 가능하므로 차세대 표시장치로서 각광받고 있다.
이러한 플라즈마 디스플레이 패널에는 복수의 전극들, 예컨대 스캔 전극(Y), 서스테인 전극(Z), 어드레스 전극(X)과 상기 전극들을 구동시키기 위한 구동부 등이 부착되어 플라즈마 디스플레이 장치를 이룬다.
이때, 스캔 전극을 복수 개로 분할해서 구동할 경우, 화면을 상하 두 개의 스캔 전극 그룹으로 나누어 구동하기 때문에 화면의 휘도 단차를 발생시킬 수 있다. 즉, 상측 스캔 전극 그룹과 하측 스캔 전극 그룹이 리셋 방전 양이 다르므로 두 전극 그룹의 어드레싱이 달라지며 결국 단위 서스테인 펄스 휘도가 달라져서 휘도 차이가 발생하는 문제가 발생한다.
한편, 이러한 휘도 단차를 극복하기 위한 홀수/짝수 스캔하는 방식을 나타낼 수 있다.
도 1은 종래의 홀수/짝수 스캔하는 방식을 나타낸 스캔 방식을 나타낸 것이다. 도 1을 살펴보면, 어드레스 기간 동안 스캐닝하는 순서를 홀수, 짝수 순서로 하면 홀수 라인의 휘도와 짝수 라인의 휘도 차이가 서로 교차되므로 휘도 차이를 중화시켜서 화면에서 휘도 단차를 줄일 수 있다.
한편, 이러한 방식을 사용하려면 도 1에서와 같이 스캔 구동 집적회로도 홀수, 짝수 라인에 따라 출력 라인이 교번되게 설계하여야 한다. 따라서, 스캔 구동 집적회로를 포함한 인쇄 회로 기판(Printed Circuit Board)상에서 패턴 배선(Lay-out) 및 부품 실장이 매우 복잡해지는 문제점이 발생한다.
이와 같은 문제점을 해결하기 위해, 본 발명은 스캔 구동 집적회로의 기능을 이용하여 인쇄 회로 기판의 패턴 배선을 쉽게 구성할 수 있는 플라즈마 디스플레이 장치를 제공하는데 그 목적이 있다.
본 발명의 기술적 과제는 이상에서 언급한 것에 제한되지 않으며, 본 발명이 이루고자 하는 또 다른 기술적 과제들은 이하 발명의 구성에서 나타나는 효과에 의해 당업자에게 명확하게 이해될 수 있을 것이다.
상술한 목적을 이루기 위한 본 발명의 일실시 예에 따른 플라즈마 디스플레이 장치는 플라즈마 디스플레이 패널에 포함된 복수의 스캔 전극과 연결되는 복수의 스캔 구동 집적회로를 포함하고, 복수의 서브필드 중 어드레스 기간은 제1 어드레스 기간과 제1 어드레스 기간보다 복수의 스캔 전극에 공급되는 스캔 펄스의 스캔 순서가 시간상 늦게 공급되는 제2 어드레스 기간으로 나누고, 복수의 스캔 전극은 2n-1번째 스캔 전극 라인으로 형성하는 제1 스캔 전극 그룹과 2n번째 스캔 전극 라인으로 형성하는 제2 스캔 전극 그룹으로 나누고, 스캔 구동 집적회로는 제1 스캔 전극 그룹과 제2 스캔 전극 그룹으로 스캔 펄스를 선택적으로 출력하는 복수 개의 스위치부를 포함한다.
또한, 복수 개의 스위치부는 제1 스캔 전극 그룹으로 스캔 펄스를 선택적으로 출력하는 제3 스위치부(Q3)와 제4 스위치부(Q4) 및 제2 스캔 전극 그룹으로 스캔 펄스를 선택적으로 출력하는 제5 스위치부(Q5)와 제6 스위치부(Q6)를 포함할 수 있다.
또한, 제3 스위치부(Q3)의 일단과 제5 스위치부(Q5)의 일단이 전기적으로 공통 연결되고, 제3 스위치부(Q3)의 타단과 제4 스위치부(Q4)의 일단이 전기적으로 연결되고, 제5 스위치부(Q5)의 타단과 제6 스위치부(Q6)의 일단이 전기적으로 연결 되고, 제4 스위치부(Q4)의 타단과 제6 스위치부(Q6)의 타단이 전기적으로 공통 연결되는 것을 포함할 수 있다.
또한, 제1 스캔 전극 그룹은 제3 스위치부(Q3)의 타단과 제4 스위치부(Q4)의 일단과 전기적으로 공통 연결되고, 제2 스캔 전극 그룹은 제5 스위치부(Q5)의 타단과 제6 스위치부(Q6)의 일단과 전기적으로 공통 연결되는 것을 포함할 수 있다.
또한, 제5 스위치부(Q5) 및 제6 스위치부(Q6)는 제1 어드레스 기간 동안 턴 오프되고, 제3 스위치부(Q3) 및 제4 스위치부(Q4)는 제2 어드레스 기간 동안 턴 오프되는 것을 포함할 수 있다.
또한, 제1 어드레스 기간 이전에 제1 스캔 전극 그룹에 공급되는 리셋 펄스와 제2 어드레스 기간 이전에 제2 스캔 전극 그룹에 공급되는 리셋 펄스가 서로 다른 파형인 것을 포함할 수 있다.
이상에서 상세히 설명한 바와 같이, 본 발명의 일실시 예에 따른 플라즈마 디스플레이 장치는 스캔 구동 집적회로 내부에서 2n-1번째 스캔 전극 라인으로 형성하는 제1 스캔 전극 그룹과 2n번째 스캔 전극 라인으로 형성되는 제2 스캔 전극그룹으로 공급되는 출력 상태를 조정함으로써, 인쇄 회로 기판의 패턴 배선을 쉽게 구성할 수 있는 효과가 있다.
또한, 본 발명의 일실시 예에 따른 플라즈마 디스플레이 장치는 복수의 스캔 전극 그룹에 따라 스캐닝하는 순서를 교번하여 휘도 단차를 최소화할 수 있을 뿐만 아니라 스캐닝하는 순서에 따라 구동 펄스를 가변하여 어드레싱 조건을 최적화할 수 있는 효과가 있다.
또한, 본 발명의 일실시 예에 따른 플라즈마 디스플레이 장치는 스캐닝하는 순서를 교번할 뿐만 아니라 구동 펄스를 가변하여 벽 전하가 소거되는 것을 방지할 수 있어 방전 안정화 및 화질 향상이 개선되는 효과가 있다.
도 2는 본 발명의 일실시 예에 따른 플라즈마 디스플레이 장치를 나타낸 것이다.
도 2를 살펴보면, 본 발명의 일실시 예에 따른 플라즈마 디스플레이 장치는 전극을 포함하는 플라즈마 디스플레이 패널(100)과 구동부를 포함한다. 또한, 구동부는 스캔 구동부(200), 서스테인 구동부(300) 및 데이터 구동부(400)를 포함한다.
먼저, 플라즈마 디스플레이 패널(100)은 전면 패널(미도시)과 후면 패널(미도시)이 일정한 간격을 두고 합착되고, 스캔 전극(Y1 내지 Yn), 서스테인 전극(Z1 내지 Zn) 및 어드레스 전극(X1 내지 Xm)을 포함한다.
스캔 구동부(200)는 방전 셀 내에 벽 전하(Wall Charge)가 균일하게 형성되도록 리셋 펄스를 스캔 전극(Y1 내지 Yn)에 공급한다. 스캔 구동부(200)는 어드레스 기간에 방전이 일어날 방전 셀을 선택하기 위한 스캔 펄스를 공급한다. 이때, 스캔 구동부(200)는 복수의 서브필드 중 어드레스 기간은 제1 어드레스 기간과 제2 어드레스 기간으로 나누고, 복수의 스캔 전극은 2n-1번째 스캔 전극 라인으로 형성하는 제1 스캔 전극 그룹과 2n번째 스캔 전극 라인으로 형성하는 제2 스캔 전극 그룹으로 나눌 수 있다. 이에 대한 자세한 설명은 후술하기로 한다.
이후, 서스테인 기간에 선택된 방전 셀에서 서스테인 방전을 발생시킬 서스테인 펄스를 스캔 전극(Y1 내지 Yn)에 공급한다.
서스테인 구동부(300)는 셋 다운 기간과 어드레스 기간 동안 서스테인 바이어스 펄스를 서스테인 전극(Z1 내지 Zn)들에 공급하고, 서스테인 기간 동안 서스테인 펄스를 서스테인 전극(Z1 내지 Zn)에 공급한다.
데이터 구동부(400)에서는 도시하지 않은 역감마 보정회로, 오차확산회로 등에 의해 역감마 보정 및 오차확산된 후, 서브필드 맵핑 회로에 의해 각 서브필드에 맵핑된 데이터(data)가 공급된다.
또한, 데이터 구동부(400)는 타이밍 컨트롤러(미도시)로부터의 데이터 타이밍 제어신호에 응답하여 스캔 전극(Y1 내지 Yn)과 대응되게 어드레스 기간 동안 데이터 펄스를 어드레스 전극(X1 내지 Xm)에 공급한다.
이러한 플라즈마 디스플레이 장치에 포함되는 플라즈마 디스플레이 패널의 구조를 살펴보면 다음과 같다.
도 3은 본 발명의 일실시 예에 따른 플라즈마 디스플레이 패널의 구조를 설명하기 위한 것이다.
도 3을 살펴보면, 본 발명의 일실시 예에 따른 플라즈마 디스플레이 패널은 스캔 전극(112)과 서스테인 전극(113)이 형성되는 전면 기판(111)을 포함하는 전면 패널(110)과, 전술한 스캔 전극(112) 및 서스테인 전극(113)과 교차하는 어드레스 전극(123)이 형성되는 후면 기판(121)을 포함하는 후면 패널(120)이 일정간격을 두고 합착하여 형성된다.
여기서, 전면 기판(111) 상에 형성되는 스캔 전극(112)과 서스테인 전극(113)은 서로 나란하게 형성되어 방전 셀(Cell)에서 방전을 발생시키고 아울러 방전 셀의 방전을 유지한다.
이러한 전면기판(111)상에 형성된 스캔 전극(112)과 서스테인 전극(113)은 방전 셀 내에서 발생한 광을 외부로 방출시키며 아울러 구동효율을 확보하기 위해 광 투과율 및 전기 전도도를 고려할 필요가 있다. 따라서, 스캔 전극(112)과 서스테인 전극(113) 각각은 은(Ag)과 같은 금속 재질의 버스 전극(112b, 113b)과 투명한 인듐 틴 옥사이드(Indium Tin Oxide : ITO) 재질의 투명 전극(112a, 113a)을 포함한다.
이러한 스캔 전극(112)과 서스테인 전극(113)이 형성된 전면 기판(111)의 상부에는 스캔 전극(112)과 서스테인 전극(113)을 덮도록 상부 유전체 층(114)이 형성될 수 있다.
상부 유전체 층(114)은 스캔 전극(112) 및 서스테인 전극(113)의 방전 전류를 제한하며 스캔 전극(112)과 서스테인 전극(113) 간을 절연시킨다.
상부 유전체 층(114) 상면에는 방전 조건을 용이하게 하기 위한 보호 층(115)이 형성될 수 있다. 이러한 보호 층(115)은 이차전자 방출 계수가 높은 재료, 예를 들어 산화마그네슘(MgO)으로 이루어질 수 있다.
한편, 후면 기판(121) 상에 형성되는 어드레스 전극(123)은 방전 셀에 데이터(Data) 펄스를 공급하는 전극이다.
어드레스 전극(123)이 형성된 후면 기판(121)의 상부에는 어드레스 전 극(123)을 덮도록 하부 유전체 층(125)이 형성될 수 있다.
하부 유전체 층(125)의 상부에는 방전 공간 즉, 방전 셀을 구획하기 위한 격벽(122)이 형성된다. 격벽(122)에 의해 구획된 방전 셀 내에는 어드레스 방전 시 화상표시를 위한 가시 광을 방출하는 형광체 층(124)이 형성된다. 예를 들면, 적색(Red : R), 녹색(Green : G), 청색(Blue : B) 형광체 층이 형성될 수 있다.
이상에서 설명한 본 발명의 일실시 예에 따른 플라즈마 디스플레이 패널은 스캔 전극(112), 서스테인 전극(113), 어드레스 전극(123)에 구동 펄스가 공급되면, 격벽(122)에 의해 구획된 방전 셀 내에서 방전이 발생하여 영상을 구현한다.
이상의 도 2에서는 본 발명의 일실시 예에 따른 플라즈마 디스플레이 패널만을 도시하고 설명한 것이며, 이에 한정되는 것은 아니다.
플라즈마 디스플레이 패널을 포함하는 본 발명의 일실시 예에 따른 플라즈마 디스플레이 장치의 동작에 대해 첨부된 도 4 내지 도 5를 결부하여 살펴보면 다음과 같다.
도 4는 본 발명의 일실시 예에 따른 플라즈마 디스플레이 패널의 구동방법에서 계조 레벨을 구현하기 위한 프레임을 설명하기 위한 것이다.
또한, 도 5는 본 발명의 일실시 예에 따른 플라즈마 디스플레이 패널의 구동 방법의 동작을 설명하기 위한 것이다.
먼저, 도 4를 살펴보면 본 발명의 일실시 예에 따른 플라즈마 디스플레이 구동장치에서 계조 레벨(Gray Level)을 구현하기 위한 프레임은 발광횟수가 다른 여러 서브필드로 나누어진다.
또한, 도시하지는 않았지만 각 서브필드는 다시 모든 방전 셀을 초기화시키기 위한 리셋 기간(Reset Period), 방전될 방전 셀을 선택하기 위한 어드레스 기간(Address Period) 및 방전횟수에 따라 계조를 구현하는 서스테인 기간(Sustain Period)으로 나누어질 수 있다.
예를 들어, 256 계조로 영상을 표시하고자 하는 경우에 1/60 초에 해당하는 프레임기간(16.67ms)은 예컨대, 도 3과 같이, 8개의 서브필드들(SF1 내지 SF8)로 나누어지고, 8개의 서브 필드들(SF1 내지 SF8) 각각은 리셋 기간, 어드레스 기간 및 서스테인 기간으로 다시 나누어진다. 이때, 어드레스 기간은 제1 어드레스 기간과 제2 어드레스 기간으로 나눌 수 있다. 이에 대한 설명은 후술하기로 한다.
한편, 서스테인 기간에 공급되는 서스테인 펄스의 개수를 조절하여 해당 서브필드의 계조 가중치를 설정할 수 있다. 다시 말해, 서스테인 기간을 이용하여 각각의 서브필드에 소정의 계조 가중치를 부여할 수 있다. 예를 들면, 제1 서브필드의 계조 가중치를 20으로 설정하고, 제2 서브필드의 계조 가중치를 21로 설정하는 방법으로 각 서브필드의 계조 가중치가 2n(단, n = 0, 1, 2, 3, 4, 5, 6, 7)의 비율로 증가하도록 각 서브필드의 계조 가중치를 결정할 수 있다. 이와 같이, 각 서브필드에서 계조 가중치에 따라 각 서브필드의 서스테인 기간에서 공급되는 서스테인 펄스의 개수를 조절함으로써, 다양한 계조 레벨을 구현하게 된다.
이러한 본 발명의 일실시 예에 따른 플라즈마 디스플레이 장치는 1초의 영상을 표시하기 위해 복수의 프레임을 사용한다. 예를 들면, 1초의 영상을 표시하기 위해 60개의 프레임을 사용하는 것이다.
도 3에서는 하나의 프레임이 8개의 서브필드로 이루어진 경우만으로 도시하고 설명하였지만, 이와는 다르게 하나의 프레임을 이루는 서브필드의 개수는 다양하게 변경될 수 있다. 예를 들면, 제1 서브필드부터 제12 서브필드까지의 12개의 서브필드로 하나의 프레임을 구성할 수도 있고, 10개의 서브필드로 하나의 프레임을 구성할 수도 있는 것이다.
이러한, 프레임으로 계조 레벨을 구현하는 플라즈마 디스플레이 장치가 구현하는 영상의 화질은 프레임에 포함되는 서브필드의 개수에 따라 결정될 수 있다.
즉, 프레임에 포함되는 서브필드가 12개인 경우는 212 가지의 계조 레벨을 표현할 수 있고, 프레임에 포함되는 서브필드가 10개인 경우는 210 가지의 계조 레벨을 구현할 수 있게 되는 것이다.
또한, 도 4에서는 하나의 프레임에서 계조 가중치의 크기가 증가하는 순서에 따라 서브필드들이 배열되었지만, 이와는 다르게 하나의 프레임에서 서브필드들이 계조 가중치가 감소하는 순서에 따라 배열될 수도 있고, 또는 영상을 디스플레이할 때 나타나는 컨투어 노이즈 발생을 방지하기 위해 계조 가중치에 관계없이 서브필드들이 배열될 수도 있는 것이다.
다음, 도 5를 살펴보면, 앞선 도 4와 같은 프레임에 포함된 복수의 서브필드 중 어느 하나의 서브필드(Sub-field)에 나타나는 본 발명의 일실시 예에 따른 플라즈마 디스플레이 장치의 동작이다. 도 2에서 전술한 각각의 스캔 구동부(200), 서 스테인 구동부(300) 및 데이터 구동부(400)는 리셋 기간, 어드레스 기간 및 서스테인 기간 중 적어도 하나 이상의 기간에서 스캔 전극(Y), 서스테인 전극(Z) 및 어드레스 전극(X)에 구동 펄스를 공급한다.
스캔 구동부(200)는 리셋 기간의 셋 업 기간에서 스캔 전극(Y)에 상승 램프 펄스(Ramp-up)를 공급할 수 있다.
이러한, 상승 램프 펄스에 의해 전 화면의 방전 셀 내에는 약한 암방전(Weak Discharge)이 일어난다. 셋 업 방전에 의해 어드레스 전극(X)과 서스테인 전극(Z) 상에는 정극성 벽 전하가 쌓이며, 스캔 전극(Y) 상에는 부극성의 벽 전하가 쌓인다.
또한, 스캔 구동부(200)는 셋 다운 기간에서 스캔 전극(Y)에 상승 램프 펄스를 공급한 후, 상승 램프 펄스의 최고 전압보다 낮은 정극성 전압에서 떨어지기 시작하여 그라운드 전압 레벨(GND) 이하의 특정 전압 레벨까지 떨어지는 하강 램프 펄스(Ramp-down)를 공급할 수 있다. 이에 따라, 방전 셀 내에 미약한 소거방전을 일으킴으로써 방전 셀 내에 과도하게 형성된 벽 전하를 충분히 소거시키게 된다. 이 셋 다운 방전에 의해 어드레스 방전이 안정되게 일어날 수 있을 정도의 벽 전하가 방전 셀 내에 균일하게 잔류한다.
서스테인 구동부(300)는 셋 다운 기간과 어드레스 기간 동안에 서스테인 전극(Z)에 서스테인 바이어스 전압(Vzb)을 공급한다. 서스테인 바이어스 전압(Vzb)은 스캔 전극(Y)과 서스테인 전극(Z) 간의 전압 차를 줄여 오 방전을 방지할 수 있다.
또한, 스캔 구동부(200)는 어드레스 기간에서 스캔 바이어스 전압으로부터 하강하는 부극성 스캔 펄스를 스캔 전극에 공급할 수 있다. 여기서 스캔 바이어스 전압은 그라운드 전압 레벨(GND) 이상이고 상승 램프 펄스의 최고 전압 이하이다.
이때 스캔 구동부(200)는 스캔 구동 집적회로를 포함하며, 스캔 구동 집적회로의 스위칭에 의해 복수의 서브필드 중 어드레스 기간은 제1 어드레스 기간과 제2 어드레스 기간으로 나누고, 복수의 스캔 전극은 2n-1번째 스캔 전극 라인으로 형성하는 제1 스캔 전극 그룹과 2n번째 스캔 전극 라인으로 형성하는 제2 스캔 전극 그룹으로 나눌 수 있다. 이에 대한 자세한 설명은 도 6에서 설명하기로 한다.
아울러 데이터 구동부(400)는 부극성 스캔 펄스에 대응되어 어드레스 전극(X)에 정극성의 데이터 펄스를 공급한다.
이러한 스캔 펄스와 데이터 펄스의 전압 차와 리셋 기간에 생성된 벽 전압이 더해지면서 데이터 펄스가 공급되는 방전 셀 내에는 어드레스 방전이 발생한다. 어드레스 방전에 의해 선택된 방전 셀 내에는 서스테인 전압(Vs)이 공급될 때 방전이 일어날 수 있게 하는 정도의 벽 전하가 형성된다.
어드레스 기간 이후의 서스테인 기간에서 스캔 구동부(200)와 서스테인 구동부(300)는 스캔 전극(Y)과 서스테인 전극(Z)에 서스테인 펄스(SUS)를 공급한다. 이에 따라, 어드레스 방전에 의해 선택된 방전 셀은 방전 셀 내의 벽 전압과 서스테인 펄스(SUS)가 더해지면서 매 서스테인 펄스(SUS)가 공급될 때마다 스캔 전극(Y)과 서스테인 전극(Z) 사이에 서스테인 방전이 일어난다.
이와 같은 구동 방법은 일실시 예에 따라 설명한 것으로 서스테인 기간 이후에 서스테인 방전 후 남아 있는 벽 전하를 제거하는 소거기간이 더 추가될 수도 있 고 리셋 기간 이전에 벽 전하들이 전극들에 안정적으로 형성될 수 있게 하는 프리 리셋 기간이 더 추가될 수 있다.
또한, 도 2 내지 도 5에서는 스캔 구동부(200)와 서스테인 구동부(300)가 독립적으로 동작하는 것으로 설명하였으나 스캔 구동부(200)와 서스테인 구동부(300)가 통합하여 동작할 수도 있다.
스캔 구동부(200)에 포함된 스캔 구동 집적회로에 대한 자세한 설명은 도 6 내지 도 8을 통해 하기로 한다.
도 6은 본 발명의 일실시 예에 따른 스캔 구동 집적회로와 플라즈마 디스플레이 패널의 연결을 설명하기 위한 것이다.
도 6을 살펴보면, 본 발명의 일실시 예에 따른 스캔 구동부는 복수의 서브필드 중 어드레스 기간은 제1 어드레스 기간과 상기 제1 어드레스 기간보다 복수의 스캔 전극에 공급되는 스캔 펄스의 스캔 순서가 시간상 늦게 공급되는 제2 어드레스 기간으로 나누고, 복수의 스캔 전극은 2n-1번째 스캔 전극 라인으로 형성하는 제1 스캔 전극 그룹과 2n번째 스캔 전극 라인으로 형성하는 제2 스캔 전극 그룹으로 나누어 스캔 펄스를 공급한다.
이때, 스캔 구동부에 포함된 스캔 구동 집적회로(410, 420)는 제1 스캔 전극 그룹과 제2 스캔 전극 그룹으로 스캔 펄스를 선택적으로 출력하는 복수 개의 스위치부를 포함하는 것이다.
즉, 본 발명의 일실시 예에 따른 스캔 구동 집적회로(410, 420)는 2n-1번째 스캔 전극 라인으로 형성하는 제1 스캔 전극 그룹과 2n번째 스캔 전극 라인으로 형 성하는 제2 스캔 전극 그룹으로 나누어 스캔 펄스를 선택적으로 출력하는 것이다.
이때, 스캔 구동 집적회로(410, 420)는 내부에 배치되는 복수 개의 스위치부를 컨트롤하여 스캔 펄스를 선택적으로 출력하는 것이다.
또한, 스캔 구동 집적회로(410, 420)는 제1 어드레스 기간과 제1 어드레스 기간보다 상기 복수의 스캔 전극에 공급되는 스캔 펄스의 스캔 순서가 시간상 늦게 공급되는 제2 어드레스 기간으로 나누고, 제1 어드레스 기간에 공급되는 구동펄스(구동 A)와 제2 어드레스 기간에 공급되는 구동 펄스(구동 B)를 공통으로 사용할 수 있다. 즉, 종래의 스캔 구동 집적회로에서는 스캔 구동 집적회로마다 독립된 구동 펄스를 공급하였지만 본원 발명의 일실시 예에 따른 스캔 구동 집적회로에서는 구동 펄스를 공통으로 사용할 수 있는 것이다.
또한, 구동 펄스를 공급받은 스캔 구동 집적회로(410, 420)에서 출력되는 출력 라인이 교번되지 아니하고 곧바로 플라즈마 디스플레이 패널(100)의 제1 스캔 전극 그룹(Y1a,Y3a,..,Y(n-1)a,Y1b,Y3b,..,Y(n-1)b)과 제2 스캔 전극 그룹(Y2a,Y4a,..,Yna, Y2b,Y4b,..,Ynb)에 순차적으로 매칭(Matching)되기 때문에 인쇄 회로 기판(Printed Circuit Board)상에서 패턴 배선(Lay-out)이 간결하게 될 수 있다.
예를 들어,스캔 구동 집적회로(Scan IC A, 410)와 스캔 구동 집적회로(Scan IC B, 420)가 순서대로 배치되더라도 각각의 스캔 구동 집적회로(410, 420)의 출력 라인이 플라즈마 디스플레이 패널(100)의 제1 스캔 전극 그룹(Y1a,Y3a,..,Y(n-1)a,Y1b,Y3b,..,Y(n-1)b)과 제2 스캔 전극 그룹(Y2a,Y4a,..,Yna, Y2b,Y4b,..,Ynb) 과 순차적으로 매칭(Matching)될 수 있는 것이다.
도 7은 본 발명의 다른 실시 예에 따른 스캔 구동 집적회로의 내부를 설명하기 위한 것이다.
도 7을 살펴보면, 본 발명의 일실시 예에 따른 스캔 구동 집적회로(410)는 제1 스캔 전극 그룹과 제2 스캔 전극 그룹으로 스캔 펄스를 선택적으로 출력하는 복수 개의 스위치부를 포함한다.
스캔 구동 집적회로(410)에 포함된 복수 개의 스위치부는 제1 스캔 전극 그룹으로 스캔 펄스를 선택적으로 출력하는 제3 스위치부(Q3)와 제4 스위치부(Q4) 및 제2 스캔 전극 그룹으로 스캔 펄스를 선택적으로 출력하는 제5 스위치부(Q5)와 제6 스위치부(Q6)를 포함한다.
또한, 스캔 구동 집적회로(410)의 내부에 배치되는 복수 개의 스위치부의 연결관계를 알아보면 다음과 같다.
우선, 스캔 구동 집적회로(410)의 외부에는 스캔 바이어스 전압을 공급하는 스캔 바이어스 전압원(Vst)과 부극성 스캔 펄스의 전압을 공급하는 부극성 스캔 펄스의 전압원(-Vy)이 배치될 수 있다.
스캔 바이어스 전압원(Vst)에서 공급되는 스캔 바이어스 전압은 제1 스위치부(Q1)를 통해 스캔 구동 집적회로(410)의 내부에 배치된 제3 스위치부(Q3)와 제5 스위치부(Q5)에 공급된다.
부극성 스캔 펄스의 전압원(-Vy)에서 공급되는 부극성 스캔 펄스의 전압은 제2 스위치부(Q2)를 통해 스캔 구동 집적회로(410)의 내부에 배치된 제4 스위치 부(Q4)와 제6 스위치부(Q6)에 공급된다.
따라서, 제1 스위치부(Q1)의 일단은 스캔 바이어스 전압원(Vst)과 전기적으로 연결되고, 제1 스위치부(Q1)의 타단은 스캔 구동 집적회로(410)의 내부에 배치되는 제3 스위치부(Q3)의 일단 및 제5 스위치부(Q5)의 일단과 전기적으로 공통 연결된다.
제3 스위치부(Q3)의 타다은 제4 스위치부(Q4)의 일단과 전기적으로 연결되고, 제5 스위치부(Q5)의 타단은 제6 스위치부(Q6)의 일단과 전기적으로 연결된다.
제4 스위치부(Q4)의 타단 및 제6 스위치부(Q6)의 타단은 스캔 구동 집적회로(410)의 외부에 배치되는 제2 스위치부(Q2)의 일단과 전기적으로 공통 연결되고, 제2 스위치부(Q2)의 타단은 부극성 스캔 펄스의 전압원(-Vy)과 전기적으로 연결된다.
이때, 제1 스캔 전극 그룹은 제3 스위치부(Q3)의 타단과 제4 스위치부(Q4)의 일단과 전기적으로 공통 연결되고, 제2 스캔 전극 그룹은 제5 스위치부(Q5)치의 타단과 제6 스위치부(Q6)의 일단과 전기적으로 공통 연결된다.
이와 같이 연결된 복수 개의 스위치부의 동작에 의해 플라즈마 디스플레이 패널에 공급되는 구동 펄스를 알아보면 다음과 같다.
도 8은 본 발명의 다른 실시 예에 따른 스캔 구동 집적회로에 의해 공급되는 구동 펄스를 설명하기 위한 것이다.
도 8을 살펴보면, 본 발명의 일실시 예에 따른 스캔 구동 집적회로의 스위칭 동작에 의해 구동펄스를 나타낸 것이다.
도 8에서는 지금까지 설명한 내용과 중복되는 내용은 생략하기로 한다. 도 7에서는 스캔 구동 집적회로 외부에 스캔 바이어스 전압원(Vst)과 부극성 스캔 펄스의 전압원(-Vy)이 배치되어 전기적으로 연결되는 것에 대해 설명하였으나 리셋 펄스의 셋 업 또는 셋 다운 전압을 공급하는 전압원이 배치되어 전기적으로 연결될 수 있다.
예를 들어, 스캔 구동 집적회로 외부에 셋 업 또는 셋 다운 전압을 공급하는 전압원이 배치되어 전기적으로 연결되면, 스캔 구동 집적회로의 스위칭을 통해 제1 어드레스 기간 이전에 제1 스캔 전극 그룹(Y1,Y3,...,Yn-1)에 공급되는 리셋 펄스와 제2 어드레스 기간 이전에 제2 스캔 전극 그룹(Y2,Y4,...,Yn)에 공급되는 리셋 펄스가 서로 다른 파형일 수 있다. 이에 따라 스캔 구동 집적회로에 의해 제1 스캔 전극 그룹(Y1,Y3,...,Yn-1)과 제2 스캔 전극 그룹(Y2,Y4,...,Yn)에 서로 다른 파형을 가진 리셋 펄스를 분리 또는 공급할 수 있는 것이다.
다시 말해, 셋 업 동작에서 제1 어드레스 기간 이전에 제1 스캔 전극 그룹(Y1,Y3,...,Yn-1)에 공급되는 리셋 펄스에서 제5 스위치부(Q5)를 제3 스위치부(Q3)보다 빨리 턴 오프 시켜서 리셋 펄스의 최고 전압(V1)을 제2 어드레스 기간 이전에 제2 스캔 전극 그룹(Y2,Y4,...,Yn)에 공급되는 리셋 펄스의 최고 전압(V2)보다 낮게 함으로써, 스캔 전극과 서스테인 전극 간의 면방전을 줄일 수 있으므로 컨트라스트(Contrast)를 향상시킬 수 있다.
이는 제1 어드레스 기간이 제2 어드레스 기간보다 스캐닝하는 시간이 빠르기 때문에 방전 셀에 형성된 벽 전하 손실이 적어 낮은 셋 업 전압으로 구동이 가능하 기 때문이다.
또한, 셋 다운 동작에서 제2 어드레스 기간 이전에 제2 스캔 전극 그룹(Y2,Y4,...,Yn)에 공급되는 리셋 펄스에서 제6 스위치부(Q6)를 제4 스위치부(Q4)보다 빨리 턴 오프 시켜서 리셋 펄스의 최저 전압(V3)을 제1 어드레스 기간 이전에 제1 스캔 전극 그룹(Y1,Y3,...,Yn-1)에 공급되는 리셋 펄스의 최저 전압(V4)보다 높게 함으로써 제1 어드레스 기간 동안의 벽 전하 차지 손실을 방지할 수 있는 것이다.
리셋 기간 이후 어드레스 기간에서는 제5 스위치부(Q5) 및 상기 제6 스위치부(Q6)는 제1 어드레스 기간 동안 턴 오프되고, 제3 스위치부(Q3) 및 제4 스위치부(Q4)는 제2 어드레스 기간 동안 턴 오프되는 것이다.
즉, 제1 어드레스 기간 동안 제1 스캔 전극 그룹(Y1,Y3,...,Yn-1)에 스캔 펄스를 선택적으로 공급하는 제3 스위치부(Q3)와 제4 스위치부(Q4)가 턴 온과 턴 오프를 교번적으로 스위칭하는 동안 제5 스위치부(Q5) 및 제6 스위치부(Q6)는 턴 오프되는 것이다. 이와 반대로, 제2 어드레스 기간 동안 제2 스캔 전극 그룹(Y2,Y4,...,Yn)에 스캔 펄스를 선택적으로 공급하는 제5 스위치부(Q5)와 제6 스위치부(Q6)가 턴 온과 턴 오프를 교번적으로 스위칭하는 동안 제3 스위치부(Q3) 및 제4 스위치부(Q4)는 턴 오프되는 것이다.
이와 같이, 스캔 구동 집적회로는 제1 어드레스 기간과 제2 어드레스 기간에 제1 스캔 전극 그룹(Y1,Y3,...,Yn-1)과 제2 스캔 전극 그룹(Y2,Y4,...,Yn)을 스캐닝하는 스캔 순서를 교번할 수 있으므로, 어드레싱 조건을 최적화할 수 있고, 휘도 단차(flicker)를 최소화할 수 있는 것이다. 따라서, 최적의 구동 효과를 얻을 수 있다.
이와 같이, 본 발명이 속하는 기술분야의 당업자는 본 발명이 그 기술적 사상이나 필수적 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다. 그러므로 이상에서 기술한 실시 예들은 모든 면에서 예시적인 것이며 한정적인 것이 아닌 것으로서 이해해야만 한다.
본 발명의 범위는 상기 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어지며, 특허청구범위의 의미 및 범위 그리고 그 등가 개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.
도 1은 종래의 홀수/짝수 스캔하는 방식을 나타낸 스캔 방식을 나타낸 것이다.
도 2는 본 발명의 일실시 예에 따른 플라즈마 디스플레이 장치를 나타낸 것이다.
도 3은 본 발명의 일실시 예에 따른 플라즈마 디스플레이 패널의 구조를 설명하기 위한 것이다.
도 4는 본 발명의 일실시 예에 따른 플라즈마 디스플레이 패널의 구동방법에서 계조 레벨을 구현하기 위한 프레임을 설명하기 위한 것이다.
도 5는 본 발명의 일실시 예에 따른 플라즈마 디스플레이 패널의 구동 방법의 동작을 설명하기 위한 것이다.
도 6은 본 발명의 일실시 예에 따른 스캔 구동 집적회로와 플라즈마 디스플레이 패널의 연결을 설명하기 위한 것이다.
도 7은 본 발명의 다른 실시 예에 따른 스캔 구동 집적회로의 내부를 설명하기 위한 것이다.
도 8은 본 발명의 다른 실시 예에 따른 스캔 구동 집적회로에 의해 공급되는 구동 펄스를 설명하기 위한 것이다.

Claims (6)

  1. 플라즈마 디스플레이 패널에 포함된 복수의 스캔 전극과 연결되는 복수의 스캔 구동 집적회로를 포함하는 플라즈마 디스플레이 장치에 있어서,
    복수의 서브필드 중 어드레스 기간은 제1 어드레스 기간과 상기 제1 어드레스 기간보다 상기 복수의 스캔 전극에 공급되는 스캔 펄스의 스캔 순서가 시간상 늦게 공급되는 제2 어드레스 기간으로 나누고,
    상기 복수의 스캔 전극은 2n-1번째 스캔 전극 라인으로 형성하는 제1 스캔 전극 그룹과 2n번째 스캔 전극 라인으로 형성하는 제2 스캔 전극 그룹으로 나누고,
    상기 스캔 구동 집적회로는 상기 제1 스캔 전극 그룹과 상기 제2 스캔 전극 그룹으로 상기 스캔 펄스를 선택적으로 출력하는 복수 개의 스위치부를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  2. 제1 항에 있어서,
    상기 복수 개의 스위치부는
    상기 제1 스캔 전극 그룹으로 상기 스캔 펄스를 선택적으로 출력하는 제3 스위치부와 제4 스위치부 및
    상기 제2 스캔 전극 그룹으로 상기 스캔 펄스를 선택적으로 출력하는 제5 스위치부와 제6 스위치부를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  3. 제2 항에 있어서,
    상기 제3 스위치부의 일단과 상기 제5 스위치부의 일단이 전기적으로 공통 연결되고, 상기 제3 스위치부의 타단과 상기 제4 스위치부의 일단이 전기적으로 연결되고, 상기 제5 스위치부의 타단과 상기 제6 스위치부의 일단이 전기적으로 연결되고, 상기 제4 스위치부의 타단과 상기 제6 스위치부의 타단이 전기적으로 공통 연결되는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  4. 제2 항에 있어서,
    상기 제1 스캔 전극 그룹은 상기 제3 스위치부의 타단과 상기 제4 스위치부의 일단과 전기적으로 공통 연결되고,
    상기 제2 스캔 전극 그룹은 상기 제5 스위치부의 타단과 상기 제6 스위치부의 일단과 전기적으로 공통 연결되는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  5. 제1 항에 있어서,
    상기 제5 스위치부 및 상기 제6 스위치부는 상기 제1 어드레스 기간 동안 턴 오프되고, 상기 제3 스위치부 및 상기 제4 스위치부는 상기 제2 어드레스 기간 동안 턴 오프되는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  6. 제1 항에 있어서,
    상기 제1 어드레스 기간 이전에 상기 제1 스캔 전극 그룹에 공급되는 리셋 펄스와 상기 제2 어드레스 기간 이전에 상기 제2 스캔 전극 그룹에 공급되는 리셋 펄스가 서로 다른 파형인 것을 특징으로 하는 플라즈마 디스플레이 장치.
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