KR20090041187A - 플라즈마 표시장치 및 그 구동방법 - Google Patents

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Abstract

본 발명은 하나의 프레임을 복수의 서브필드로 나누어 구동하고, 각각의 서브필드는 리셋 기간, 어드레스 기간 및 서스테인 기간을 포함하는 플라즈마 표시장치의 구동방법에 있어서, 상기 각 서브필드의 서스테인 기간 동안 공급되는 복수의 서스테인 펄스들 중, 마지막 서스테인 펄스를 포함한 적어도 하나의 서스테인 펄스의 상승시간이 나머지 서스테인 펄스들의 상승시간보다 감소되도록 설정하는 플라즈마 표시장치의 구동방법에 관한 것이다.

Description

플라즈마 표시장치 및 그 구동방법{Plasma Display Device and Driving Method Thereof}
본 발명은 플라즈마 표시장치 및 그 구동방법에 관한 것으로, 특히 어드레스 신호의 지연을 방지할 수 있도록 한 플라즈마 표시장치 및 그 구동방법에 관한 것이다.
플라즈마 표시장치는 기체 방전에 의해 생성된 플라즈마를 이용하여 문자 또는 영상을 표시하는 플라즈마 표시패널(Plasma Display Panel, PDP)을 이용한 표시장치로, 화상을 구현하는 플라즈마 표시패널과 이를 구동하기 위한 다수의 구동 회로부를 포함한다.
이와 같은 플라즈마 표시장치에 있어서, 플라즈마 표시패널의 주사 전극과 유지 전극 사이, 혹은, 어드레스 전극이 형성된 면과 주사 및 유지 전극이 형성된 면 사이의 방전공간 등이 용량성 부하로 작용하여, 플라즈마 표시패널에는 커패시턴스가 존재하게 된다.
이와 같은 플라즈마 표시패널의 커패시턴스는 표시되는 영상에 따른 부하 값의 변동에 의해 화면마다 달라지게 된다. 특히, 플라즈마 표시패널의 전체 표시영역 중 실제로 영상이 표시되는 유효 표시영역이 증가함에 따라 플라즈마 표시패널의 커패시턴스가 증가하여 신호지연이 발생하게 되고, 이에 따라 서스테인 펄스의 파형이 왜곡될 수 있다. 이와 같은 서스테인 펄스의 왜곡은 방전에 영향을 미치게 되고 이는 벽전하량의 변화로 이어질 수 있다.
예를 들어, 유효 표시영역의 증가에 따른 부하 값의 동반 상승으로 인해 플라즈마 표시패널의 커패시턴스가 증가하는 경우, 서스테인 펄스의 파형이 왜곡되어 서스테인 기간 동안 충분한 방전이 일어나지 않을 수 있다. 이 경우, 왜곡된 서스테인 펄스에 의해 방전이 일어나는 서스테인 기간 동안 원하는 만큼의 휘도를 표현하지 못함은 물론, 각 전극에 쌓이는 벽전하량에 영향을 미쳐 다음 서브필드의 어드레스 신호의 지연을 발생시킬 수 있다.
이와 같이 어드레스 신호의 지연이 발생되면, 어드레스 기간 동안 원하는 만큼의 방전이 발생하지 않아 어드레스를 위한 벽전하 형성이 제대로 이루어지지 않을 수 있다.
이로 인해, 후속되는 서스테인 기간 동안 또다시 충분한 방전이 일어나지 않아 상대적으로 휘도가 낮게 표시되는 등 화상마다 균일한 계조를 표현할 수 없는 문제점이 발생할 수 있다.
따라서, 본 발명의 목적은 어드레스 신호의 지연을 방지하여 균일한 계조를 표현할 수 있도록 한 플라즈마 표시장치 및 그 구동방법을 제공하는 것이다.
이와 같은 목적을 달성하기 위하여 본 발명의 제1 측면은 하나의 프레임을 복수의 서브필드로 나누어 구동하고, 각각의 서브필드는 리셋 기간, 어드레스 기간 및 서스테인 기간을 포함하는 플라즈마 표시장치의 구동방법에 있어서, 상기 각 서브필드의 서스테인 기간 동안 공급되는 복수의 서스테인 펄스들 중, 마지막 서스테인 펄스를 포함한 적어도 하나의 서스테인 펄스의 상승시간이 나머지 서스테인 펄스들의 상승시간보다 감소되도록 설정하는 플라즈마 표시장치의 구동방법을 제공한다.
바람직하게, 상기 복수의 서브필드 중 제1 서브필드의 리셋 기간에는 리셋 상승 기간과 리셋 하강 기간을 포함하는 메인 리셋 펄스가 공급되고, 상기 제1 서브필드에 후속되는 나머지 서브필드들 중 적어도 하나의 리셋 기간에는, 최대 전압레벨이 상기 메인 리셋 펄스의 최대 전압레벨보다 낮으며 리셋 하강 기간을 포함하는 보조 리셋 펄스가 공급될 수 있다. 상기 마지막 서스테인 펄스를 포함한 적어도 하나의 서스테인 펄스를 생성하기 위한 유지방전회로의 스위칭 타이밍을 조절하여 상기 상승시간을 조절할 수 있다. 상기 스위칭 타이밍은, 상기 마지막 서스테인 펄 스를 포함한 적어도 하나의 서스테인 펄스의 상승기간 동안 공급되는 스위칭 펄스의 지속시간이 나머지 서스테인 펄스들의 상승기간 동안 공급되는 스위칭 펄스의 지속시간보다 짧아지도록 설정될 수 있다. 상기 상승시간이 감소되는 서스테인 펄스는, 상기 마지막 서스테인 펄스를 포함하여 연속적으로 공급되는 한 개 내지 네 개의 서스테인 펄스로 설정될 수 있다.
본 발명의 제2 측면은 영상신호에 대응하여 어드레스 펄스를 결정하는 단계와, 상기 어드레스 펄스에 대응하는 유효 표시영역의 비중을 산출하는 단계와, 상기 유효 표시영역의 비중에 대응하여 서스테인 펄스를 생성하기 위한 유지방전회로의 구동 타이밍신호를 제어하는 단계와, 상기 구동 타이밍신호에 대응하여 상기 서스테인 펄스를 생성하는 단계를 포함하며, 상기 구동 타이밍신호는, 상기 유효 표시영역의 비중이 증가할수록 각 서브필드의 서스테인 기간 동안에 공급되는 마지막 서스테인 펄스를 포함한 적어도 하나의 서스테인 펄스의 상승시간이 감소하도록 제어되는 것을 특징으로 하는 플라즈마 표시장치의 구동방법을 제공한다.
바람직하게, 상기 유지방전회로의 구동 타이밍신호를 제어하는 단계는, 상기 산출된 유효 표시영역의 비중을 기준 유효 표시영역의 비중과 비교하여 미리 설정된 모드들 중 어느 하나의 모드를 선택하는 단계와, 상기 선택된 모드에 대응하여 상기 유지방전회로의 구동 타이밍신호를 생성하는 단계를 포함할 수 있다. 상기 유지방전회로의 구동 타이밍신호는 상기 유지방전회로에 포함되는 다수의 스위치들의 온/오프를 제어하기 위한 스위칭 펄스로 설정될 수 있다. 상기 모드들 중 상기 유효 표시영역의 비중이 상대적으로 큰 값에 대응하는 모드일수록 상기 마지막 서스 테인 펄스를 포함한 적어도 하나의 서스테인 펄스의 상승 구간 동안 공급되는 상기 유지방전회로의 스위칭 펄스의 지속시간을 짧게 설정할 수 있다. 상기 상승시간이 감소하는 서스테인 펄스는, 상기 마지막 서스테인 펄스를 포함하여 연속적으로 공급되는 한 개 내지 네 개의 서스테인 펄스로 설정될 수 있다. 상기 어드레스 펄스의 개수에 따라 상기 유효 표시영역의 비중을 산출할 수 있다.
본 발명의 제3 측면은 복수의 어드레스 전극, 스캔 전극 및 서스테인 전극의 교차부에 형성되는 방전셀들을 포함하는 플라즈마 표시패널과, 상기 어드레스 전극, 스캔 전극 및 서스테인 전극을 구동하기 위한 구동부와, 외부로부터 공급되는 영상신호에 대응하여 상기 구동부로 제어신호를 공급하기 위한 제어부를 포함하며, 상기 제어부는, 상기 영상신호에 대응하여 상기 플라즈마 표시패널의 전체 표시영역 중 유효 표시영역이 차지하는 비중을 산출하고, 상기 유효 표시영역의 비중에 대응하여 상기 구동부에서 생성되는 서스테인 펄스가 조절되도록 제어하는 제어신호를 생성하는 플라즈마 표시장치를 제공한다.
바람직하게, 상기 제어신호는 상기 유효 표시영역의 비중이 증가할수록 상기 구동부에서 생성되는 서스테인 펄스들 중 각 서브필드의 마지막 서스테인 펄스를 포함한 적어도 하나의 서스테인 펄스의 상승시간이 감소하도록 설정될 수 있다. 상기 상승시간이 감소하는 서스테인 펄스는, 상기 각 서브필드의 마지막 서스테인 펄스를 포함하여 연속적으로 공급되는 한 개 내지 네 개의 서스테인 펄스로 설정될 수 있다. 상기 구동부는, 상기 어드레스 전극을 구동하기 위한 어드레스 전극 구동부와, 상기 스캔 전극을 구동하기 위한 스캔 전극 구동부와, 상기 서스테인 전극을 구동하기 위한 서스테인 전극 구동부를 포함하며, 상기 스캔 전극 구동부 또는 상기 서스테인 전극 구동부는, 상기 제어신호에 의해 구동 타이밍이 조절되는 유지방전회로를 포함할 수 있다. 상기 유지방전회로의 구동 타이밍은, 상기 유효 표시영역의 비중이 증가할수록 각 서브필드의 서스테인 기간 동안 생성되는 서스테인 펄스들 중 마지막 서스테인 펄스를 포함한 적어도 하나의 서스테인 펄스의 상승 구간에 공급되는 펄스의 지속시간이 감소되도록 상기 제어신호에 의해 제어될 수 있다.
이와 같은 본 발명에 의하면, 유지방전회로의 구동 타이밍을 조절함으로써, 마지막 서스테인 펄스를 포함한 적어도 하나의 서스테인 펄스의 상승시간을 감소시킨다. 이에 의해, 표시패널에서 강방전이 발생하여, 서스테인 펄스의 왜곡으로 인해 부족해진 벽전하량을 보상할 수 있다.
이에 따라, 어드레스 신호의 지연이 방지되어, 표시패널에서 균일한 계조를 표현할 수 있고 화질을 향상시킬 수 있다.
이하, 첨부된 도면을 참조하여 본 발명의 실시 예를 보다 상세히 설명하기로 한다.
도 1은 본 발명의 실시 예를 적용하기 위한 플라즈마 표시패널의 일반적인 구조를 나타내는 도면이다.
도 1을 참조하면, 플라즈마 표시패널(100)은, 화상이 표시되는 표시면인 전면 기판(11)에 스캔 전극(12) 및 서스테인 전극(13)이 쌍을 이뤄 형성된 복수의 유지전극 쌍이 배열된 전면 패널(10)과, 배면을 이루는 후면 기판(21) 상에 복수의 유지전극 쌍과 교차하도록 복수의 어드레스 전극(23)이 배열된 후면 패널(20)이 일정거리를 사이에 두고 평행하게 결합된다.
전면 패널(10)은 하나의 방전셀에서 상호 방전시키고 셀의 발광을 유지하기 위하여 쌍을 이루어 구비된 다수의 스캔 전극(12) 및 서스테인 전극(13)을 포함한다. 여기서, 스캔 전극(12) 및 서스테인 전극(13)은 각각 투명한 인듐 틴 옥사이드(Induim-Tin Oxide, ITO) 물질로 형성된 투명 전극(12a, 13a)과 금속재질로 형성된 버스 전극(12b, 13b)을 포함한다. 이와 같은 스캔 전극(12) 및 서스테인 전극(13)은 방전 전류를 제한하며 전극 쌍 사이를 절연시키는 하나 이상의 상부 유전체층(14)에 의해 덮여지고, 상부 유전체층(14) 상면에는 방전 조건을 용이하게 하기 위하여 산화 마그네슘(MgO)을 증착한 보호층(15)이 형성된다.
후면 패널(20)은 복수 개의 방전공간, 즉, 방전셀이 형성되도록 스트라이프 타입(또는, 웰 타입)으로 평행하게 배열된 격벽(22)과, 격벽(22)에 대해 평행하게 배치되며 어드레스 방전을 수행하여 진공자외선을 발생시키는 다수의 어드레스 전극(23)을 포함한다. 이와 같은 후면 패널(20)의 상부 격벽들(22) 사이에는 어드레스 방전시 화상을 표시하기 위한 가시광선을 방출하는 적색(R), 녹색(G) 및 청색(B) 형광체(24)가 도포된다. 이때, 어드레스 전극(23)과 형광체(24) 사이에는 어 드레스 전극(23)을 보호하기 위한 하부 유전체층(25)이 형성된다.
편의상, 도 1에서는 하나의 화소를 구성하는 적색, 녹색 및 청색 방전셀을 도시하였지만, 실제 플라즈마 표시패널(100)에는 다수 개의 방전셀이 매트릭스(Matrix) 형태로 배열된다. 이와 같은 방전셀들은 스캔 및 서스테인 전극과 어드레스 전극이 교차되는 지점에 형성된다. 이에 대한 상세한 설명은 도 2를 참조하여 후술하기로 한다.
도 2는 본 발명의 실시 예에 의한 플라즈마 표시장치의 구성을 개략적으로 나타내는 블럭도이다.
도 2를 참조하면, 본 발명의 실시 예에 의한 플라즈마 표시장치는 플라즈마 표시패널(100), 제어부(200), 어드레스 전극 구동부(300), 스캔 전극 구동부(400) 및 서스테인 전극 구동부(500)를 포함한다.
플라즈마 표시패널(100)은 열 방향으로 배열되는 복수의 어드레스 전극(A1 내지 Am)과, 행 방향으로 서로 쌍을 이루면서 배열되는 복수의 스캔 전극(Y1 내지 Yn) 및 서스테인 전극(X1 내지 Xn)과, 이들의 교차부에 형성되어 단위 화소를 구성하는 방전셀들(Ce)을 포함한다.
제어부(200)는 외부로부터 수신되는 영상신호에 대응하여 어드레스 전극 구동 제어신호(SA), 스캔 전극 구동 제어신호(SY) 및 서스테인 전극 구동 제어신호(SX)를 생성하고, 이를 각각 어드레드 전극 구동부(300), 스캔 전극 구동부(400) 및 서스테인 전극 구동부(500)로 공급한다. 그리고, 제어부(200)는 한 프레임을 복 수의 서브필드로 분할하고, 각 서브필드를 리셋 기간, 어드레스 기간 및 서스테인 기간으로 나누어 구동한다.
어드레스 전극 구동부(300)는 제어부(200)로부터 공급되는 어드레스 전극 구동 제어신호(SA)에 대응하여 표시하고자 하는 방전셀(Ce)을 선택하기 위한 표시 데이터 신호를 생성하고, 이를 각 어드레스 전극(A1 내지 Am)으로 공급한다. 이를 위해, 어드레스 전극 구동부(300)는 어드레스 전극 구동 제어신호(SA)에 대응하여 표시 데이터 신호를 생성하는 다수의 구동회로들을 포함한다.
스캔 전극 구동부(400)는 제어부(200)로부터 공급되는 스캔 전극 구동 제어신호(SY)에 대응하여 스캔 전극(Y1 내지 Yn)에 구동 펄스를 공급하기 위한 다수의 구동회로들을 포함한다.
서스테인 전극 구동부(500)는 제어부(200)로부터 공급되는 서스테인 전극 구동 제어신호(SX)에 대응하여 서스테인 전극(X1 내지 Xn)에 구동 펄스를 공급하기 위한 다수의 구동회로들을 포함한다.
도 3은 본 발명의 일 실시 예에 의한 플라즈마 표시장치의 구동방법에 따라 플라즈마 표시패널의 각 전극에 공급되는 구동 펄스들을 나타내는 도면이다. 편의상, 도 3에서는 복수의 서브필드 중 두 개의 서브필드만을 도시하였으며, 이를 각각 제1 서브필드와 제2 서브필드라 하기로 한다.
도 3을 참조하면, 제1 및 제2 서브필드(SF1, SF2)는 각각 리셋 기간(PR), 어드레스 기간(PA) 및 서스테인 기간(PS)을 포함한다.
여기서, 제1 서브필드(SF1)의 리셋 기간(PR)에는 리셋 상승 기간(PR1)과 리셋 하강 기간(PR2)을 포함하는 메인 리셋 펄스가 공급되고, 제2 서브필드(SF2)를 포함하는 이후 서브필드(미도시)의 리셋 기간(PR)에는 보조 리셋 펄스가 공급되는 선택적 리셋 방법을 사용한다. 그러나, 본 발명이 이에 한정되는 것은 아니며, 리셋 기간(PR)에 본 발명에서 사용되는 리셋 펄스 이외에도 다양한 형태의 리셋 펄스가 공급될 수 있으며, 보조 리셋 펄스 없이 메인 리셋 펄스가 반복적으로 공급될 수도 있다.
또한, 제1 서브필드(SF1)는 복수의 서브필드 중 가장 낮은 계조 가중치를 갖는 서브필드로 저계조의 서브필드를 대표하며, 제2 서브필드(SF2)는 제1 서브필드(SF1)에 비해 높은 계조 가중치를 갖는 서브필드로 고계조의 서브필드를 대표하는 것으로 설명된다. 따라서, 제2 서브필드(SF2)의 서스테인 기간(PS) 동안 공급되는 서스테인 펄스의 수는 제1 서브필드(SF1)의 서스테인 기간(PS) 동안 공급되는 서스테인 펄스의 수보다 많게 설정된다.
또한, 도 3을 설명할 때, 스캔 전극, 서스테인 전극 및 어드레스 전극을 각각 Y 전극, X 전극 및 A 전극이라 하기로 한다.
제1 서브필드(SF1)의 리셋 상승 기간(PR1)에는 X 전극과 A 전극을 0V로 유지시킨 상태에서, Y 전극에 Vs 전압을 Vset에 해당하는 만큼 증가시키는 상승 펄스가 공급된다. 이에 의해, Y 전극과 X 전극, 및 Y 전극과 A 전극 사이에 미약한 리셋 방전이 일어나면서 Y 전극에는 부극성의 벽전하가 쌓이게 되고, X 전극 및 A 전극에는 정극성의 벽전하가 쌓이게 된다.
이후, 제1 서브필드(SF1)의 리셋 하강 기간(PR2)에는 X 전극과 A 전극을 각각 Vb 전압과 0V로 유지시킨 상태에서, Y 전극에 Vs 전압을 Vnf 전압까지 감소시키는 하강 펄스가 공급된다. 이에 의해, Y 전극과 X 전극, 및 Y 전극과 A 전극 사이에 미약한 리셋 방전이 일어나면서 Y 전극에 쌓여있던 부극성의 벽전하가 일부 소거됨과 아울러, X 전극 및 A 전극에 쌓여있던 정극성의 벽전하가 일부 소거된다. 이때, 벽전하에 의한 벽전압은 방전 개시전압 근처로 형성된다. 이러한 상승 펄스와 하강 펄스를 포함하는 메인 리셋 펄스는 모든 방전셀로 동시에 공급되어, 스캔 펄스 및 데이터 펄스가 공급될 때 어드레스 방전이 일어날 수 있는 상태로 벽전하를 재배치시키게 된다.
이후, 제1 서브필드(SF1)의 어드레스 기간(PA)에는 X 전극을 Vb 전압으로 유지시킨 상태에서 Y 전극과 A 전극에 각각 VscL 전압을 갖는 스캔 펄스와 Va 전압을 갖는 어드레스 펄스를 공급하여 서스테인 기간(PS)에 표시될 방전셀을 선택한다. 즉, Y 전극과 A 전극의 전압 차이(Va-VscL)와, 벽전하에 의한 벽전압에 의해 어드레스 방전이 일어나며, 그 결과 Y 전극에는 정극성의 벽전하가 쌓이고, A 전극 및 X 전극에는 부극성의 벽전하가 쌓이게 된다.
이후, 제1 서브필드(SF1)의 서스테인 기간(PS)에는 A 전극을 0V로 유지시킨 상태에서 Y 전극과 X 전극에 교번적으로 Vs 전압을 갖는 서스테인 펄스가 공급된다. 이에 따라, Y 전극과 X 전극의 전압 차이(Vs) 및 어드레스 기간(PA)에 생성된 벽전압으로 인하여 서스테인 방전이 일어난다. 이때, X 전극 및 Y 전극에 공급되는 서스테인 펄스는 서브필드가 갖는 계조 가중치에 따라 그 개수가 결정된다. 따라 서, 제1 서브필드(SF1)는 복수의 서브필드 중에서 가장 적은 개수의 서스테인 펄스가 공급된다.
이와 같은 제1 서브필드(SF1)의 서스테인 기간(PS)이 종료되면, 제2 서브필드(SF2)가 시작된다.
제2 서브필드(SF2)의 리셋 기간(PR)에는 X 전극과 A 전극을 각각 Vb 전압과 0V로 유지시킨 상태에서 Y 전극에 Vs 전압을 Vnf 전압까지 감소시키는 보조 리셋 펄스가 공급된다. 이에 따라, 방전셀 내에서 Y 전극과 X 전극, 및 Y 전극과 A 전극 각각에서 약방전이 발생되어 Y 전극과 X 전극 및 A 전극의 벽전하가 어드레스 방전이 일어날 수 있는 상태로 재배치된다.
단, 제1 서브필드(SF1)의 서스테인 기간(PS)에서 서스테인 방전이 일어나지 않은 경우에는 방전셀의 벽전하 상태가 제1 서스테인 기간(PS)의 리셋 기간(PR) 직후의 상태로 남아있게 된다. 따라서, 방전셀에 벽전하에 의한 벽전압이 방전 개시전압 근처로 형성되기 때문에 보조 리셋 펄스가 공급되는 제2 서브필드(SF2)의 리셋 기간(PR)에는 방전이 일어나지 않게 된다.
이후, 제2 서브필드(SF2)의 어드레스 기간(PA)에는 제1 서브필드(SF1)와 동일한 펄스가 공급되어 서스테인 기간(PS)에 선택될 방전셀을 선택하게 된다.
이후, 제2 서브필드(SF2)의 서스테인 기간(PS)에는 A 전극을 0V로 유지시킨 상태에서, Y 전극과 X 전극에 교번적으로 Vs 전압을 갖는 서스테인 펄스가 공급된다. 따라서, Y 전극과 X 전극의 전압 차이(Vs) 및 어드레스 기간(PA)에 생성된 벽전하에 의한 벽전압으로 인하여 서스테인 방전이 일어난다. 여기서, 제2 서브필 드(SF2)는 제1 서브필드(SF1)에 비하여 상대적으로 높은 계조 가중치를 갖기 때문에, 제2 서브필드(SF2)의 서스테인 기간(PS) 동안 공급되는 X 전극 및 Y 전극에 공급되는 서스테인 펄스의 개수는 제1 서브필드(SF1)의 서스테인 기간(PS) 동안 공급되는 서스테인 펄스의 개수보다 많게 설정된다.
전술한 본 발명의 일 실시예에 의한 플라즈마 표시장치의 구동방법에 의하면, 모든 서브필드의 리셋 기간 동안 메인 리셋 펄스를 공급하는 것이 아니라, 방전이 일어난 셀에는 보조 리셋 펄스를 공급하는 선택적 리셋 방법을 사용함으로써, 리셋 기간 동안 빛이 방출되는 것을 방지하여 콘트라스트 비(contrast ratio)를 향상시킴은 물론 시간을 단축할 수 있다.
단, 이와 같은 선택적 리셋 방법의 경우, 보조 리셋 펄스는 X 전극과 Y 전극에 쌓인 벽전하를 효과적으로 재배치시키지만, A 전극의 벽전하는 이전 상태와 거의 유사한 정도로 유지된다. 따라서, 이전 서브필드에서 유효 표시영역의 증가에 따른 부하 상승으로 인해 서스테인 펄스의 왜곡이 발생한 경우, 서스테인 기간 동안 충분한 방전이 발생하지 않아 A 전극의 벽전하가 다음 서브필드까지 부족한 상태로 유지된다. 이에 의해, 어드레스 신호의 지연이 발생할 수 있다. 이와 같이 어드레스 신호의 지연이 발생하면, 어드레스 기간 동안 원하는 만큼의 방전이 발생하지 않아 어드레스에 필요한 벽전하가 부족하게 쌓일 수 있다. 이로 인해, 후속되는 서스테인 기간에도 충분한 방전이 일어나지 않아 상대적으로 휘도가 낮게 표시되는 등 화상마다 균일한 계조를 표현할 수 없게 되는 문제점이 발생할 수 있다. 이에 대한 보다 상세한 설명은 도 4a 내지 도 5b를 참조하여 후술하기로 한다.
도 4a는 전체 표시영역 중 유효 표시영역의 비중이 증가하는 것을 나타내는 도면이고, 도 4b는 유효 표시영역의 증가에 따른 소비전력 및 전류의 변화를 나타내는 도면이다. 그리고, 도 4c는 유효 표시영역의 증가에 따른 시정수 및 표시패널의 커패시턴스의 변화를 나타내는 도면이다.
도 4a 내지 도 4c를 참조하면, 전체 표시영역 중 유효 표시영역이 차지하는 비중이 증가하면, 소비전력 및 전류가 증가하는 것을 확인할 수 있다. 이로 인해서, 시정수(time constant) 및 표시패널의 커패시턴스가 증가하게 된다.
이와 같이, 표시패널의 커패시턴스가 증가하게 되면, 표시패널에서 RC 딜레이가 발생하여 서스테인 펄스가 왜곡될 수 있다.
서스테인 펄스가 왜곡되면, 패널 내의 방전량이 변화되어 벽전하량이 달라질 수 있는데, 특히 RC 딜레이에 의해 서스테인 펄스가 왜곡되는 경우 각 전극에 쌓이는 벽전하량이 감소할 수 있다. 이에 따라, 서스테인 펄스의 왜곡이 발생하는 서브필드에서 영상의 실제휘도가 목표휘도보다 낮아질 수 있다.
또한, 서스테인 펄스가 공급되는 서스테인 기간이 종료되면, 그 다음 서브필드의 리셋 기간이 시작되는데, 선택적 리셋 방법을 이용하는 경우 X 전극 및 Y 전극의 벽전하는 정상적으로 재배치되지만, A 전극의 벽전하는 부족한 상태를 유지하게 된다.
따라서, 이어지는 어드레스 기간 동안 어드레스 신호의 지연이 발생하게 되고, 이로 인해 서스테인 펄스의 왜곡이 또다시 이어지게 된다. 이와 같은 과정으로 후속되는 서브필드 기간 동안 연이어 서스테인 펄스의 왜곡이 발생하면서 고계조를 표현하는 서브필드일수록 서스테인 펄스의 왜곡이 심화될 수 있다. 이에 의해, 균일한 계조를 표현할 수 없게 되고, 결국 화질이 저하될 수 있다.
도 5a는 유효 표시영역의 비중이 각각 10%, 50% 및 100%인 X 전극 및 Y 전극의 서스테인 펄스와 적외선 방출량을 나타내는 도면이다.
도 5a를 참조하면, 유효 표시영역의 비중이 증가할수록 서스테인 펄스의 왜곡이 심화되고, 이에 따라 적외선 방출량이 감소하는 것을 확인할 수 있다. 여기서, 적외선 방출량은 자외선 방출량과 동일하므로, 적외선 방출량을 측정함으로써 표시패널에서의 방전량을 추정할 수 있게 된다. 즉, 유효 표시영역의 비중이 증가할수록 표시패널에서 발생하는 방전량이 감소하는 것을 알 수 있다.
도 5b는 한 서브필드의 어드레스 기간 동안 측정한 적외선 방출량을 나타내는 도면이다.
도 5b를 참조하면, X 전극이 대략 100V로 유지되는 상태에서 Y 전극으로 대략 -180V의 전압값을 갖는 어드레스 신호가 공급되는 어드레스 기간 동안, 유효 표시영역의 비중이 각각 1%, 50% 및 100%로 증가함에 따라 적외선 방출량이 감소하는 것을 알 수 있다. 즉, 어드레스 기간 동안 유효 표시영역의 비중이 증가함에 따라 표시패널의 방전량이 감소하여 어드레스 신호의 지연이 발생하는 것을 확인할 수 있다.
도 4a 내지 도 5b에서 전술한 바와 같이, 유효 표시영역의 비중이 커짐에 따라 어드레스 신호의 지연이 발생하게 되는 문제점이 발생한다. 이와 같이 어드레스 신호의 지연이 발생하게 되면, 균일한 계조를 표현하지 못해 화질이 저하될 수 있다.
따라서, 본 발명에서는 후술할 다른 실시 예를 통해 어드레스 신호의 지연을 보상하면서 선택적 리셋 방법을 적용할 수 있는 방안을 제시하기로 한다.
도 6은 본 발명의 보다 바람직한 실시 예에 의한 플라즈마 표시장치의 구동방법에 따라 플라즈마 표시패널의 각 전극에 공급되는 구동 펄스들을 나타내는 도면이다. 편의상, 도 6에서는 도 3과 동일한 부분에 대한 설명은 생략하기로 한다.
도 6을 참조하면, 본 발명의 보다 바람직한 실시 예에 의한 플라즈마 표시장치의 구동방법에 의하면, 각 서브필드(SF)의 서스테인 기간 동안 공급되는 마지막 서스테인 펄스(LS)의 상승시간(tr2)은 다른 서스테인 펄스의 상승시간(tr1)보다 짧게 설정된다.
여기서, 서스테인 펄스의 상승시간(tr)은 서스테인 방전 및 벽전하의 양을 결정하는 중요한 요소이다. 보다 구체적으로, 서스테인 펄스의 상승시간(tr)이 상대적으로 짧으면, 방전 개시시점이 빨라지고 강방전이 발생하여 방전셀 내부에 쌓이는 벽전하가 많아지게 된다.
따라서, 마지막 서스테인 펄스(LS)의 상승시간(tr2)을 짧게 설정함에 의하여, 강방전을 일으켜 서스테인 펄스의 왜곡으로 인해 부족해진 벽전하를 보충할 수 있다.
이에 따라, 각 서브필드(SF)의 종료 후에도 벽전하량 감소로 인해 저방전되 는 현상을 방지할 수 있고, 선택적 리셋 방법을 채용할 때 발생할 수 있는 어드레스 신호의 지연을 방지할 수 있다.
전술한 바와 같이, 본 발명의 보다 바람직한 실시예에 의한 플라즈마 표시패널의 구동방법에 의하면, 마지막 서스테인 펄스(LS)를 포함한 적어도 하나의 서스테인 펄스의 상승시간(tr)을 감소시켜 강방전을 일으킴으로써 서스테인 펄스의 왜곡으로 인한 어드레스 신호의 지연을 방지할 수 있다. 이에 의해, 유효 표시영역이 증가할수록 영상의 휘도가 감소하는 것을 방지할 수 있다.
한편, 본 발명에서 서스테인 펄스의 상승시간을 감소시켜 강방전을 일으키는 것이 각 서스테인 기간 동안의 마지막 서스테인 펄스(LS)에 한정되는 것은 아니며, 상승시간이 감소되는 서스테인 펄스는 마지막 서스테인 펄스(LS)를 포함한 다수로 설정될 수도 있다.
여기서, 상승시간이 감소되어 상승 기울기가 증가한 서스테인 펄스의 수가 많을수록 벽전하량을 효과적으로 보충하여 어드레스 신호의 지연을 방지할 수 있는 반면, 강방전에 의해 소비전력이 증가할 수 있으므로, 상승시간(tr)이 감소될 서스테인 펄스의 수를 결정할 때에는 이 두 가지 요소를 모두 고려하는 것이 바람직하다.
예를 들어, 마지막 서스테인 펄스(LS)를 포함하여 연속적으로 공급되는 한 개 내지 네 개의 서스테인 펄스의 상승시간(tr)이 감소되도록 설정할 수도 있다. 단, 설명의 편의를 위하여, 이하에서는 마지막 서스테인 펄스(LS)의 상승시간(tr2)을 조절하는 것으로 설명하기로 한다.
한편, 전술한 바와 같이 조절되는 서스테인 펄스의 상승시간(tr)은 유효 표시영역의 비중을 고려하여 도 2에 도시된 제어부(200)에서 설정될 수 있다.
즉, 제어부(200)에서 영상신호에 대응하는 유효 표시영역의 비중을 산출하고, 이에 대응하여 마지막 서스테인 펄스(LS)의 상승시간(tr2) 조절 여부 및 그 정도를 제어하여 이를 제어신호(SX, SY)로써 스캔 전극 구동부(400) 및/또는 서스테인 전극 구동부(500)로 공급할 수 있다.
그러면, 스캔 전극 구동부(400) 및/또는 서스테인 전극 구동부(500)에 각각 포함된 유지방전회로(ERC)의 스위칭 타이밍이 조절되어 마지막 서스테인 펄스(LS)의 상승시간(tr2)이 조절된다. 이와 관련한 유지방전회로(ERC) 회로의 동작에 대해서는 도 7 내지 도 8을 참조하여 후술하기로 한다.
도 7은 유지방전회로의 일례를 나타내는 도면이다. 그리고, 도 8은 본 발명의 보다 바람직한 실시 예에 의해 도 7에 도시된 유지방전회로를 구동하기 위한 동작 파형을 나타내는 도면이다.
도 7 내지 도 8을 참조하면, 유지방전회로(또는, 전력회수회로(Energy Recovery Circuit))(700)는, 제1 및 제2 스위치(SW1, SW2)와 제1 및 제2 다이오드(D1, D2)와 전력회수용 커패시터(Cc)로 구성되는 전력 회수부(710)와, 직렬로 연결된 제3 및 제4 스위치(SW3, SW4)로 구성되는 유지 방전부(720)와, 전력 회수부(710)의 다이오드들(D1, D2)과 유지 방전부(720)의 스위치들(SW3, SW4) 사이에 연결된 인덕터(Lc)를 포함하며, 유지 방전부(720)에는 플라즈마 표시패널의 커패시 터(Cp)를 가지는 부하가 연결된다.
이와 같은 유지방전회로(700)는 도 8에 도시된 바와 같은 스위치들(SW1 내지 SW4)의 구동신호에 의해 구동된다.
이를 보다 구체적으로 설명하면, 초기상태에서는 제1 스위치(SW1)가 도통되기 직전에 제4 스위치(SW4)가 도통되어 있어서, 패널 양단의 전압(Vp)은 0V를 유지하게 된다. 이때, 전력회수용 커패시터(Cc)는 외부 인가전압(Vs)의 1/2 만큼의 전압(Vs/2)으로 미리 충전되어 유지방전 개시시 돌입전류가 발생하지 않도록 한다.
이와 같이 패널 양단의 전압(Vp)이 0V로 유지된 상태에서, 제1 스위치(SW1)가 턴-온되고, 이와 같은 제1 스위치(SW1)의 턴-온 상태는 t1 구간 동안 지속된다.
t1 구간 동안, 전력회수용 커패시터(Cc), 제1 스위치(SW1), 제1 다이오드(D1), 인덕터(Lc) 및 플라즈마 표시패널 커패시터(Cp)의 경로로 LC 공진회로가 형성된다. 이에 따라, 인덕터(Lc)에 전류(IL)가 흐르고 패널의 출력전압(Vp)이 증가한다.
이때, 인덕터(Lc)에 흐르는 전류(IL)는 도시되지 않은 기생 저항 등에 의해 서서히 감소하다가 0이 되고, 패널의 출력전압(Vp)은 외부 인가전압(Vs)이 된다.
이후, t2 구간 동안 제3 스위치(SW3)가 턴-온되면, 외부 인가전압(Vs)이 제3 스위치(SW3)를 통해 그대로 패널 커패시터(Cp)로 공급되므로, 패널의 출력전압(Vp)은 외부 인가전압(Vs)의 전압레벨로 유지된다.
이후, t3 구간 동안 제2 스위치(SW2)가 턴-온되면, t1 구간에서의 경로와 반 대의 경로, 즉, 패널 커패시터(Cp), 인덕터(Lc), 제2 다이오드(D2), 제2 스위치(SW2) 및 전력회수용 커패시터(Cc)의 경로로 LC 공진회로가 형성되어, 전류가 흐른다. 이에 따라, 패널의 출력전압(Vp)이 서서히 감소하다가 0이 되고, 이 시점에서 LC 공진회로를 따라 흐르는 전류도 0이 된다.
이후, t4 구간 동안 제4 스위치(SW4)가 턴-온되면, 패널 출력전압(Vp)은 0V를 그대로 유지한다.
이 상태에서, 제1 스위치(SW1)가 다시 도통되면, 전술한 동작으로 사이클이 반복되면서 복수의 서스테인 펄스가 생성된다.
단, 본 발명에서는, 유지방전회로(700)를 구동하는 스위칭 신호들 중 마지막 서스테인 펄스(LS)를 생성하기 위한 제1 스위치(SW1) 구동신호와 제3 스위치(SW3) 구동신호의 타이밍을 적절히 조절함으로써 방전량을 제어한다.
보다 구체적으로, 제1 스위치(SW1)가 턴-온되는 시간이 t1 에서 t1'으로 감소하도록 제1 스위치(SW1) 구동신호의 오프 시점을 앞당김과 아울러, 제1 스위치(SW1) 구동신호의 폭이 감소된 만큼 제3 스위치(SW3) 구동신호의 온 시점을 앞당겨 제3 스위치(SW3)가 턴-온되는 시간을 t2 에서 t2'으로 증가시킨다.
이에 따라, 마지막 서스테인 펄스(LS)의 상승시간(tr2)이 나머지 서스테인 펄스들의 상승시간(tr1)보다 짧아져 표시패널에서 강방전이 발생한다. 이로 인하여, 표시패널 내에 보다 많은 벽전하가 쌓여 서스테인 펄스의 왜곡으로 인해 부족해진 벽전하를 보상함으로써 어드레스 신호의 지연을 방지할 수 있다.
전술한 바와 같이, 본 발명에서는 마지막 서스테인 펄스(LS)의 상승기간 동 안 공급되는 스위칭 펄스(제1 스위치(SW1) 구동신호)의 지속시간이 나머지 서스테인 펄스들의 상승 기간에 공급되는 스위칭 펄스들의 지속시간보다 짧아지도록 유지방전회로(700)의 스위칭 타이밍을 조절한다. 이에 의해, 특정한 구동 보드 등을 제작하지 않고도 비교적 단순한 방법으로 부족한 벽전하를 보상하기 위한 강방전을 일으켜, 어드레스 신호의 지연을 방지할 수 있다.
도 9는 본 발명의 보다 바람직한 실시 예에 의한 플라즈마 표시장치의 구동 방법을 단계적으로 나타내는 순서도이다. 이하에서는, 도 9를 도 2와 결부하여 서스테인 펄스의 상승시간을 결정하는 방법에 대해 보다 상세하게 설명하기로 한다.
도 9를 참조하면, 본 발명의 보다 바람직한 실시 예에 의한 플라즈마 표시장치의 구동방법은 영상신호를 공급하는 단계와, 영상신호에 대응하는 어드레스 펄스를 결정하는 단계와, 어드레스 펄스 개수에 따른 유효 표시영역의 비중을 산출하는 단계와, 유효 표시영역의 비중에 대응하여 유지방전회로(이하, ERC라 함)의 구동 타이밍을 조절하는 단계를 포함한다. 여기서, ERC의 구동 타이밍은 제어부(200)에서 생성되는 구동 타이밍 신호에 의해 제어된다.
보다 구체적으로, 우선 외부로부터 제어부(200)로 영상신호가 공급된다.
그러면, 영상신호를 공급받은 제어부(200)는 영상신호에 대응하여 어드레스 펄스를 결정함과 아울러 어드레스 펄스의 개수에 따른 유효 표시영역의 비중을 산출한다.
이후, 제어부(200)는 산출된 유효 표시영역의 비중을 기준 유효 표시영역의 비중과 비교하면서, 미리 설정된 모드들 중 각 유효 표시영역의 비중에 부합되는 마지막 서스테인 구동파형을 발생시키기 위한 유지방전회로(이하, ERC라 함)(700)의 구동 타이밍을 위한 적절한 모드를 선택한다.
그리고, 제어부(200)는 선택된 모드를 스캔 전극 구동부(400) 및/또는 서스테인 전극 구동부(500)에 포함된 ERC(700)의 구동 타이밍으로 적용하기 위한 구동 타이밍 신호를 생성한다.
즉, 제어부(200)는 선택된 모드에 대응하는 구동 타이밍 신호가 포함된 스캔 전극 구동 제어신호(SY) 및/또는 서스테인 전극 구동 제어신호(SX)를 생성하고, 이를 각각 스캔 전극 구동부(400) 및/또는 서스테인 전극 구동부(500)로 공급할 수 있다.
여기서, 유효 표시영역의 비중이 커질수록 패널의 커패시턴스가 증가함과 더불어 어드레스 신호의 지연이 심화될 수 있으므로, 상대적으로 큰 유효 표시영역에 대응하는 모드일수록 마지막 서스테인 펄스(LS)의 상승시간(tr2)이 더욱 감소되도록 설정하는 것이 바람직하다. 이를 위해, 구동 타이밍 신호는 유효 표시영역의 비중이 증가할수록 마지막 서스테인 펄스(LS)의 상승시간(tr2)이 감소하도록 제1 스위치(SW1) 구동신호의 펄스 폭을 짧게 설정한다.
예를 들어, 유효 표시영역의 비중이 30% 이하인 경우, 마지막 서스테인 펄스(LS)의 상승시간(tr2)을 변화시키지 않는(즉, 마지막 서스테인 펄스(LS)의 상승시간(tr2)을 나머지 서스테인 펄스(LS)의 상승시간(tr1)과 동일하게 설정하는) 제1 모드에 따른 ERC 타이밍을 적용하여 스캔 전극 구동 제어신호(SY) 및/또는 서스테 인 전극 구동 제어신호(SX)를 생성할 수 있다.
또한, 유효 표시영역의 비중이 30% 초과하고 40% 이하인 경우, 마지막 서스테인 펄스(LS)의 상승시간(tr2)을 다른 서스테인 펄스의 상승시간(tr1)보다 짧게 설정하는 제2 모드에 따른 ERC 타이밍을 적용하여 스캔 전극 구동 제어신호(SY) 및/또는 서스테인 전극 구동 제어신호(SX)를 생성할 수 있다.
전술한 방식으로 유효 표시영역의 비중이 증가할수록 다른 서스테인 펄스의 상승시간(tr1)과의 차가 커지도록 마지막 서스테인 펄스(LS)의 상승시간(tr2)을 보다 감소시키도록 설정하는 ERC 타이밍을 적용하여 스캔 전극 구동 제어신호(SY) 및/또는 서스테인 전극 구동 제어신호(SX)를 생성할 수 있다.
그리고, 이와 같은 스캔 전극 구동 제어신호(SY) 및/또는 서스테인 전극 구동 제어신호(SX)에 대응하여 서스테인 펄스가 생성된다.
이와 같이 본 발명에 의하면 유효 표시영역의 비중에 대응하여 마지막 서스테인 펄스(LS)의 상승시간(tr2)이 적절히 조절된다. 따라서, 유효 표시영역의 증가에 따른 어드레스 신호의 지연을 방지함은 물론, 균일한 계조를 표현하여 화질을 향상시킬 수 있다.
도 10은 마지막 서스테인 펄스의 상승시간 조절 여부에 따른 적외선 방출량을 나타내는 도면이다.
도 10을 참조하면, X 전극의 마지막 펄스(Last X), 즉, 마지막 서스테인 펄스(LS)의 상승시간이 조절되지 않은 경우 적외선 방출량이 감소하는 것을 확인할 수 있다. 이를 통해, 마지막 서스테인 펄스(LS)의 상승시간이 조절되지 않으면 패널의 방전량이 감소하여 벽전하가 상대적으로 적게 생성된다는 것을 알 수 있다.
반면, 마지막 서스테인 펄스(LS)의 상승시간이 짧아진 경우, 적외선 방출량의 감소가 방지된 것을 확인할 수 있다. 이를 통해, 패널에서 강방전이 발생하여 벽전하가 보상된 것을 알 수 있다.
도 11은 마지막 서스테인 펄스의 상승시간 조절 여부 별로, 유효 표시영역의 비중에 따른 어드레스 신호의 지연을 나타내는 도면이다.
도 11을 참조하면, 유효 표시영역이 증가할수록 어드레스 신호의 지연은 전체적으로 증가하지만, 마지막 서스테인 펄스(LS)의 상승시간이 조절된(즉, 상승시간이 감소된) 경우, 조절되기 이전에 비해 어드레스 신호의 지연이 감소한 것을 확인할 수 있다.
본 발명의 기술 사상은 상기 바람직한 실시예에 따라 구체적으로 기술되었으나, 상기한 실시예는 그 설명을 위한 것이며 그 제한을 위한 것이 아님을 주의하여야 한다. 또한, 본 발명의 기술 분야의 통상의 지식을 가진 자라면 본 발명의 기술 사상의 범위 내에서 다양한 변형예가 가능함을 이해할 수 있을 것이다.
도 1은 본 발명의 실시 예를 적용하기 위한 플라즈마 표시패널의 일반적인 구조를 나타내는 도면이다.
도 2는 본 발명의 실시 예에 의한 플라즈마 표시장치의 구성을 개략적으로 나타내는 블럭도이다.
도 3은 본 발명의 일 실시 예에 의한 플라즈마 표시장치의 구동방법에 따라 플라즈마 표시패널의 각 전극에 공급되는 구동 펄스들을 나타내는 도면이다.
도 4a는 전체 표시영역 중 유효 표시영역의 비중이 증가하는 것을 나타내는 도면이다.
도 4b는 유효 표시영역의 증가에 따른 소비전력 및 전류의 변화를 나타내는 도면이다.
도 4c는 유효 표시영역의 증가에 따른 시정수 및 표시패널의 커패시턴스의 변화를 나타내는 도면이다.
도 5a는 유효 표시영역의 비중이 각각 10%, 50% 및 100%인 X 전극 및 Y 전극의 서스테인 펄스와 적외선 방출량을 나타내는 도면이다.
도 5b는 한 서브필드의 어드레스 기간 동안 측정한 적외선 방출량을 나타내는 도면이다.
도 6은 본 발명의 보다 바람직한 실시 예에 의한 플라즈마 표시장치의 구동방법에 따라 플라즈마 표시패널의 각 전극에 공급되는 구동 펄스들을 나타내는 도면이다.
도 7은 유지방전회로의 일례를 나타내는 도면이다.
도 8은 본 발명의 보다 바람직한 실시 예에 의해 도 7에 도시된 유지방전회로를 구동하기 위한 동작 파형을 나타내는 도면이다.
도 9는 본 발명의 보다 바람직한 실시 예에 의한 플라즈마 표시장치의 구동 방법을 단계적으로 나타내는 순서도이다.
도 10은 마지막 서스테인 펄스의 상승시간 조절 여부에 따른 적외선 방출량을 나타내는 도면이다.
도 11은 마지막 서스테인 펄스의 상승시간 조절 여부 별로, 유효 표시영역의 비중에 따른 어드레스 신호의 지연을 나타내는 도면이다.
<도면의 주요 부분에 대한 부호의 설명>
100: 플라즈마 표시패널 200: 제어부
300: 어드레스 전극 구동부 400: 스캔 전극 구동부
500: 서스테인 전극 구동부 700: 유지방전회로
Ce: 방전셀 SF1, SF2: 서브필드
LS : 마지막 서스테인 펄스 tr1, tr2: 상승시간

Claims (16)

  1. 하나의 프레임을 복수의 서브필드로 나누어 구동하고, 각각의 서브필드는 리셋 기간, 어드레스 기간 및 서스테인 기간을 포함하는 플라즈마 표시장치의 구동방법에 있어서,
    상기 각 서브필드의 서스테인 기간 동안 공급되는 복수의 서스테인 펄스들 중, 마지막 서스테인 펄스를 포함한 적어도 하나의 서스테인 펄스의 상승시간이 나머지 서스테인 펄스들의 상승시간보다 감소되도록 설정하는 플라즈마 표시장치의 구동방법.
  2. 제1항에 있어서,
    상기 복수의 서브필드 중 제1 서브필드의 리셋 기간에는 리셋 상승 기간과 리셋 하강 기간을 포함하는 메인 리셋 펄스가 공급되고,
    상기 제1 서브필드에 후속되는 나머지 서브필드들 중 적어도 하나의 리셋 기간에는, 최대 전압레벨이 상기 메인 리셋 펄스의 최대 전압레벨보다 낮으며 리셋 하강 기간을 포함하는 보조 리셋 펄스가 공급되는 플라즈마 표시장치의 구동방법.
  3. 제1항에 있어서,
    상기 마지막 서스테인 펄스를 포함한 적어도 하나의 서스테인 펄스를 생성하기 위한 유지방전회로의 스위칭 타이밍을 조절하여 상기 상승시간을 조절하는 플라 즈마 표시장치의 구동방법.
  4. 제3항에 있어서,
    상기 스위칭 타이밍은, 상기 마지막 서스테인 펄스를 포함한 적어도 하나의 서스테인 펄스의 상승기간 동안 공급되는 스위칭 펄스의 지속시간이 나머지 서스테인 펄스들의 상승기간 동안 공급되는 스위칭 펄스의 지속시간보다 짧아지도록 설정되는 플라즈마 표시장치의 구동방법.
  5. 제1항에 있어서,
    상기 상승시간이 감소되는 서스테인 펄스는, 상기 마지막 서스테인 펄스를 포함하여 연속적으로 공급되는 한 개 내지 네 개의 서스테인 펄스로 설정되는 플라즈마 표시장치의 구동방법.
  6. 영상신호에 대응하여 어드레스 펄스를 결정하는 단계와,
    상기 어드레스 펄스에 대응하는 유효 표시영역의 비중을 산출하는 단계와,
    상기 유효 표시영역의 비중에 대응하여 서스테인 펄스를 생성하기 위한 유지방전회로의 구동 타이밍신호를 제어하는 단계와,
    상기 구동 타이밍신호에 대응하여 상기 서스테인 펄스를 생성하는 단계를 포함하며,
    상기 구동 타이밍신호는, 상기 유효 표시영역의 비중이 증가할수록 각 서브 필드의 서스테인 기간 동안에 공급되는 마지막 서스테인 펄스를 포함한 적어도 하나의 서스테인 펄스의 상승시간이 감소하도록 제어되는 것을 특징으로 하는 플라즈마 표시장치의 구동방법.
  7. 제6항에 있어서,
    상기 유지방전회로의 구동 타이밍신호를 제어하는 단계는,
    상기 산출된 유효 표시영역의 비중을 기준 유효 표시영역의 비중과 비교하여 미리 설정된 모드들 중 어느 하나의 모드를 선택하는 단계와,
    상기 선택된 모드에 대응하여 상기 유지방전회로의 구동 타이밍신호를 생성하는 단계를 포함하는 플라즈마 표시장치의 구동방법.
  8. 제7항에 있어서,
    상기 유지방전회로의 구동 타이밍신호는 상기 유지방전회로에 포함되는 다수의 스위치들의 온/오프를 제어하기 위한 스위칭 펄스인 플라즈마 표시장치의 구동방법.
  9. 제8항에 있어서,
    상기 모드들 중 상기 유효 표시영역의 비중이 상대적으로 큰 값에 대응하는 모드일수록 상기 마지막 서스테인 펄스를 포함한 적어도 하나의 서스테인 펄스의 상승 구간 동안 공급되는 상기 유지방전회로의 스위칭 펄스의 지속시간을 짧게 설 정하는 플라즈마 표시장치의 구동방법.
  10. 제6항에 있어서,
    상기 상승시간이 감소하는 서스테인 펄스는, 상기 마지막 서스테인 펄스를 포함하여 연속적으로 공급되는 한 개 내지 네 개의 서스테인 펄스로 설정되는 플라즈마 표시장치의 구동방법.
  11. 제6항에 있어서,
    상기 어드레스 펄스의 개수에 따라 상기 유효 표시영역의 비중을 산출하는 플라즈마 표시장치의 구동방법.
  12. 복수의 어드레스 전극, 스캔 전극 및 서스테인 전극의 교차부에 형성되는 방전셀들을 포함하는 플라즈마 표시패널과,
    상기 어드레스 전극, 스캔 전극 및 서스테인 전극을 구동하기 위한 구동부와,
    외부로부터 공급되는 영상신호에 대응하여 상기 구동부로 제어신호를 공급하기 위한 제어부를 포함하며,
    상기 제어부는, 상기 영상신호에 대응하여 상기 플라즈마 표시패널의 전체 표시영역 중 유효 표시영역이 차지하는 비중을 산출하고, 상기 유효 표시영역의 비중에 대응하여 상기 구동부에서 생성되는 서스테인 펄스가 조절되도록 제어하는 제 어신호를 생성하는 플라즈마 표시장치.
  13. 제12항에 있어서,
    상기 제어신호는 상기 유효 표시영역의 비중이 증가할수록 상기 구동부에서 생성되는 서스테인 펄스들 중 각 서브필드의 마지막 서스테인 펄스를 포함한 적어도 하나의 서스테인 펄스의 상승시간이 감소하도록 설정되는 플라즈마 표시장치.
  14. 제13항에 있어서,
    상기 상승시간이 감소하는 서스테인 펄스는, 상기 각 서브필드의 마지막 서스테인 펄스를 포함하여 연속적으로 공급되는 한 개 내지 네 개의 서스테인 펄스로 설정되는 플라즈마 표시장치.
  15. 제12항에 있어서,
    상기 구동부는, 상기 어드레스 전극을 구동하기 위한 어드레스 전극 구동부와, 상기 스캔 전극을 구동하기 위한 스캔 전극 구동부와, 상기 서스테인 전극을 구동하기 위한 서스테인 전극 구동부를 포함하며,
    상기 스캔 전극 구동부 또는 상기 서스테인 전극 구동부는, 상기 제어신호에 의해 구동 타이밍이 조절되는 유지방전회로를 포함하는 플라즈마 표시장치.
  16. 제15항에 있어서,
    상기 유지방전회로의 구동 타이밍은, 상기 유효 표시영역의 비중이 증가할수록 각 서브필드의 서스테인 기간 동안 생성되는 서스테인 펄스들 중 마지막 서스테인 펄스를 포함한 적어도 하나의 서스테인 펄스의 상승 구간에 공급되는 펄스의 지속시간이 감소되도록 상기 제어신호에 의해 제어되는 플라즈마 표시장치.
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