KR20080000866A - Plasma display panel - Google Patents

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KR20080000866A
KR20080000866A KR1020060058702A KR20060058702A KR20080000866A KR 20080000866 A KR20080000866 A KR 20080000866A KR 1020060058702 A KR1020060058702 A KR 1020060058702A KR 20060058702 A KR20060058702 A KR 20060058702A KR 20080000866 A KR20080000866 A KR 20080000866A
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김철홍
최연주
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삼성에스디아이 주식회사
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    • H01J2211/444Means for improving contrast or colour purity, e.g. black matrix or light shielding means

Abstract

A plasma display panel is provided to improve a contrast and a brightness of the display panel by increasing a ratio of a size of a black layer to the size of a white layer on a bus electrode. First and second substrates(2,4) are arranged to face each other with a constant distance. A barrier rib(6) is arranged between the substrates to define discharge cells. A fluorescent layer(10) is formed in the discharge cell. An address electrode(12) is formed along a first direction on the first substrate. First and second electrodes(14,16) are formed in a second direction on the second substrate. The second direction is vertical to the first direction. A dielectric layer(20) covers the first and second electrodes and is formed on the second substrate. The first and second electrodes include bus electrodes(142,162) formed on edge portions of the discharge cells. The bus electrode includes black and white layers. The black layer is wider than the white layer.

Description

플라즈마 디스플레이 패널 {PLASMA DISPLAY PANEL}Plasma Display Panel {PLASMA DISPLAY PANEL}

도 1은 본 발명의 일 실시예에 따른 플라즈마 디스플레이 패널의 부분 분해 사시도이다.1 is a partially exploded perspective view of a plasma display panel according to an embodiment of the present invention.

도 2는 도 1의 Ⅱ-Ⅱ 선을 따라 자른 단면도이다.FIG. 2 is a cross-sectional view taken along the line II-II of FIG. 1.

도 3은 도 1에 도시한 플라즈마 디스플레이 패널 중 전면기판의 부분 확대 평면도이다.FIG. 3 is a partially enlarged plan view of a front substrate of the plasma display panel shown in FIG. 1.

<도면의 주요 부분에 대한 부호의 설명><Explanation of symbols for the main parts of the drawings>

2 : 제1 기판(배면기판) 4 : 제2 기판(전면기판)2: first substrate (back substrate) 4: second substrate (front substrate)

6 : 격벽 8 : 방전셀6: partition wall 8: discharge cell

10 : 형광체층 12 : 어드레스전극10 phosphor layer 12 address electrode

14 : 제1 전극(유지전극) 16 : 제2 전극(주사전극)14: first electrode (holding electrode) 16: second electrode (scanning electrode)

141,161 : 투명전극 142,162 : 버스전극141,161: transparent electrode 142,162: bus electrode

142a,162a : 블랙층 142b,162b : 화이트층142a, 162a: Black layer 142b, 162b: White layer

18 : 제1 유전층 20 : 제2 유전층18: first dielectric layer 20: second dielectric layer

22 : 보호막 24 : 홈22: shield 24: home

본 발명은 플라즈마 디스플레이 패널에 관한 것으로서, 보다 상세하게는 버스 전극의 형상을 개선하여 화면의 콘트라스트를 높일 수 있는 플라즈마 디스플레이 패널에 관한 것이다.The present invention relates to a plasma display panel, and more particularly, to a plasma display panel that can improve the contrast of a screen by improving the shape of a bus electrode.

일반적으로 플라즈마 디스플레이 패널은 기체방전을 통하여 얻어진 플라즈마로부터 방사되는 진공자외선(VUV: Vacuum Ultra-Violet)을 이용하여 형광체를 여기시킴으로서 발생되는 적색(R), 녹색(G) 및 청색(B)의 가시광으로 영상을 구현하는 디스플레이 소자이다.In general, a plasma display panel is a visible light of red (R), green (G) and blue (B) generated by exciting the phosphor using a vacuum ultra-violet (VUV) emitted from the plasma obtained through gas discharge It is a display device for implementing an image.

일례로서, 교류형 플라즈마 디스플레이 패널은 배면기판 상에 어드레스전극들을 형성하고, 어드레스전극들을 유전층으로 덮고 있다. 격벽들은 유전층 위의 각 어드레스전극들 사이에 배치되어 스트라이프(stripe)모양으로 형성되고, 적색(R)과 녹색(G) 및 청색(B)의 형광체층은 격벽들에 형성된다. 이 배면기판에 대향하는 전면 기판에는 어드레스전극들과 교차하는 방향을 따라 한 쌍의 유지전극과 주사전극으로 구성되는 표시전극들이 형성되고, 유전층과 MgO 보호막이 이 표시전극들을 덮고 있다. 배면기판 상의 어드레스전극들과 전면기판 상의 표시전극들 쌍이 교차하는 지점에 방전셀이 형성된다. 이 플라즈마 디스플레이 패널의 내부에는 수백만 개 이상의 단위 방전셀들이 매트릭스(Matrix) 형태로 배열된다.As an example, an AC plasma display panel forms address electrodes on a back substrate and covers the address electrodes with a dielectric layer. The barrier ribs are disposed between the address electrodes on the dielectric layer to form a stripe shape, and phosphor layers of red (R), green (G), and blue (B) are formed on the barrier ribs. On the front substrate facing the rear substrate, display electrodes composed of a pair of sustain electrodes and scanning electrodes are formed along the direction crossing the address electrodes, and a dielectric layer and an MgO protective film cover the display electrodes. The discharge cell is formed at the point where the pair of address electrodes on the rear substrate and the pair of display electrodes on the front substrate cross each other. In the plasma display panel, millions of unit discharge cells are arranged in a matrix form.

이와 같은 플라즈마 디스플레이 패널의 방전셀들을 구동시키는 데 기억특성이 이용된다. 보다 자세히 설명하면, 한 쌍의 표시전극을 구성하는 유지전극과 주사전극 사이에서 방전을 일으키기 위해서는 특정 전압 이상의 전위차가 필요하며, 이 경계가 되는 전압을 방전개시전압(Vf: Firing Voltage)이라고 한다. 스캔전압과 어드레스전압을 주사전극과 어드레스전극에 각각 인가하면 방전이 개시되어 방전셀 내에 플라즈마가 형성되고, 이 플라즈마의 전자와 이온은 반대 극성을 갖는 전극 쪽으로 이동하게 된다.The memory characteristic is used to drive the discharge cells of the plasma display panel. In more detail, in order to generate a discharge between the sustain electrode and the scan electrode constituting the pair of display electrodes, a potential difference of more than a specific voltage is required, and the voltage at this boundary is called a firing voltage (Vf). When the scan voltage and the address voltage are respectively applied to the scan electrode and the address electrode, the discharge is started to form a plasma in the discharge cell, and the electrons and ions of the plasma move toward the electrodes having opposite polarities.

한편, 이 플라즈마 디스플레이 패널의 각 전극에는 유전층이 도포되어 있어 이동된 공간전하들의 대부분은 반대 극성을 가지는 유전층 위에 쌓이며, 결국 주사전극과 어드레스전극 사이의 순(net) 공간 전위는 원래 인가된 어드레스전압(Va)보다 낮아져 방전은 약해지고 어드레스 방전은 소멸된다. 이때, 유지전극에는 상대적으로 적은 양의 전자가 쌓이며, 주사전극에는 상대적으로 많은 양의 이온이 쌓이게 되는데, 이들 유지전극 및 주사전극을 덮고 있는 유전층 위에 쌓인 전하들을 벽전하(Qw: Wall Charge)라 하고, 이들 벽전하에 의해 유지전극 및 주사전극 사이에 형성되는 공간전압을 벽전압(Vw: Wall Voltage)이라고 한다.On the other hand, a dielectric layer is applied to each electrode of the plasma display panel, so that most of the moved space charges are accumulated on the dielectric layer having opposite polarity, so that the net space potential between the scan electrode and the address electrode is originally applied to the address. The voltage becomes lower than the voltage Va, the discharge is weakened, and the address discharge is extinguished. At this time, a relatively small amount of electrons are accumulated in the sustain electrode, and a relatively large amount of ions are accumulated in the scan electrode. The charges accumulated on the dielectric layer covering the sustain electrode and the scan electrode are wall charged (Qw). The space voltage formed between the sustain electrode and the scan electrode by these wall charges is called a wall voltage (Vw).

계속해서, 유지전극과 주사전극에 방전유지전압(Vs)을 인가할 경우, 상기 방전유지전압(Vs)과 벽전압(Vw)의 크기를 합친 값(Vs+Vw)이 방전개시전압(Vf)보다 높게 되면 방전셀 내에서 유지 방전이 일어나게 된다. 이때 발생하는 진공 자외선(VUV)은 해당 형광체를 여기시켜 투명한 전면 기판을 통하여 가시광을 방출한다.Subsequently, when the discharge sustain voltage Vs is applied to the sustain electrode and the scan electrode, the sum of the magnitudes of the discharge sustain voltage Vs and the wall voltage Vw (Vs + Vw) is the discharge start voltage Vf. If higher, sustain discharge occurs in the discharge cell. The vacuum ultraviolet (VUV) generated at this time excites the corresponding phosphor and emits visible light through the transparent front substrate.

그러나 주사전극과 어드레스전극 사이의 어드레스 방전이 없을 경우(즉, 어드레스전압(Va)이 인가되지 않았을 경우)에는 유지전극과 주사전극 사이에는 벽전하가 쌓이지 않게 되며, 결과적으로 유지전극과 주사전극 사이의 벽전압도 존재하지 않게 된다. 이때에는 유지전극과 주사전극에 가해준 방전유지전압(Vs)만이 방전 셀 내에 형성되며, 이 방전유지전압은 방전개시전압(Vf)보다 낮기 때문에 유지전극과 주사전극 사이의 기체공간을 방전시키지 못한다.However, when there is no address discharge between the scan electrode and the address electrode (that is, when the address voltage Va is not applied), wall charges do not accumulate between the sustain electrode and the scan electrode, and as a result, between the sustain electrode and the scan electrode. The wall voltage does not exist. At this time, only the discharge sustain voltage Vs applied to the sustain electrode and the scan electrode is formed in the discharge cell. Since the discharge sustain voltage is lower than the discharge start voltage Vf, the gas space between the sustain electrode and the scan electrode cannot be discharged. .

전술한 구조의 플라즈마 디스플레이 패널에서, 유지전극과 주사전극 각각은 ITO와 같은 투명한 재질로 이루어지며 방전을 일으키기 위해 제공되는 투명전극과, 이 투명전극에 전압신호를 인가하기 위한 버스전극을 포함한다. 버스전극은 투명전극의 높은 전기 저항을 보상하도록 통전성이 우수한 금속 소재로 이루어지므로 휘도 저하 방지를 위해 방전셀의 가장자리에서 최소한의 폭으로 형성된다.In the plasma display panel having the above-described structure, each of the sustain electrode and the scan electrode is made of a transparent material such as ITO and includes a transparent electrode provided for generating a discharge, and a bus electrode for applying a voltage signal to the transparent electrode. Since the bus electrode is made of a metal material having excellent electrical conductivity to compensate for the high electrical resistance of the transparent electrode, the bus electrode is formed with a minimum width at the edge of the discharge cell in order to prevent a decrease in luminance.

이때 버스전극은 화면의 콘트라스트 향상을 위하여 흑색전극과 백색전극의 적층 구조로 이루어질 수 있다. 흑색전극은 전면기판 측에 위치하여 그 일면이 투명 전극 및 기판과 접촉하고, 백색전극은 배면기판을 향한 흑색전극의 일면에 형성되어 백색전극을 향해 방사된 가시광을 반사시킨다.In this case, the bus electrode may be formed of a stacked structure of a black electrode and a white electrode to improve the contrast of the screen. The black electrode is positioned on the front substrate side, one surface of which is in contact with the transparent electrode and the substrate, and the white electrode is formed on one surface of the black electrode facing the rear substrate to reflect visible light emitted toward the white electrode.

그런데 이와 같은 구조의 버스전극은 흑색전극이 차지하는 영역이 작아 우수한 콘트라스트를 기대하기 어려운 문제가 발생한다.However, the bus electrode having such a structure has a small area occupied by the black electrode, which causes a problem that it is difficult to expect excellent contrast.

또한, 통상의 백색전극은 전기전도성이 뛰어난 은(Ag)으로 형성되는데, 이러한 백색전극은 유전층과 이온 교환 반응(ion-exchange)을 일으켜 유전층을 황색으로 변화시키는 황변 현상을 유발한다. 즉, 이와 같은 백색전극을 구비한 플라즈마 디스플레이 패널은 색순도와 색재현율이 낮아져 표시 품질이 저하되는 문제가 발생한다.In addition, a conventional white electrode is formed of silver (Ag) having excellent electrical conductivity, which causes an ion-exchange reaction with the dielectric layer to cause a yellowing phenomenon of changing the dielectric layer to yellow. That is, a plasma display panel having such a white electrode has a problem in that color purity and color reproducibility are lowered, thereby degrading display quality.

따라서 본 발명은 상기한 문제점을 해소하기 위해 해소하기 위한 것으로서, 본 발명의 목적은 버스전극의 형상을 개선하여 표시품질을 향상시킬 수 있는 플라즈마 디스플레이 패널을 제공하는데 있다.Accordingly, an object of the present invention is to solve the above problems, and an object of the present invention is to provide a plasma display panel which can improve display quality by improving the shape of a bus electrode.

상기의 목적을 달성하기 위하여 본 발명은,In order to achieve the above object, the present invention,

서로 마주하여 이격 배치되는 제1 기판과 제2 기판과, 양 기판 사이에 배치되어 방전셀들을 구획하는 격벽과, 방전셀 내에 형성되는 형광체층과, 제1 기판에서 제1 방향을 따라 형성되는 어드레스전극과, 제2 기판에서 제1 방향과 교차하는 제2 방향을 따라 서로 나란하게 형성되는 제1 전극 및 제2 전극과, 제1 전극과 제2 전극을 덮으면서 제2 기판에 형성되는 유전층을 포함하며, 제1 전극과 제2 전극은 각각 방전셀의 가장자리에 형성되는 버스전극을 포함하며, 버스전극은 블랙층과 화이트층을 포함하고, 블랙층은 화이트층보다 넓은 면적으로 형성되는 플라즈마 디스플레이 패널을 제공한다.A first substrate and a second substrate disposed to face each other, a partition wall disposed between both substrates to partition the discharge cells, a phosphor layer formed in the discharge cell, and an address formed along the first direction in the first substrate An electrode, a first electrode and a second electrode formed in parallel with each other along a second direction crossing the first direction on the second substrate, and a dielectric layer formed on the second substrate while covering the first electrode and the second electrode; Wherein the first electrode and the second electrode each include a bus electrode formed at an edge of the discharge cell, wherein the bus electrode includes a black layer and a white layer, and the black layer has a larger area than the white layer. Provide a panel.

상기 블랙층은 유전층 위에 형성되며 제1 기판을 향한 일면에 길이 방향을 따라 홈을 형성할 수 있다.The black layer is formed on the dielectric layer and may form a groove along a length direction on one surface facing the first substrate.

그리고 화이트층은 상기 블랙층의 홈에 형성될 수 있다.The white layer may be formed in the groove of the black layer.

상기 유전층 위에는 보호막이 더욱 형성될 수 있고, 보호막은 MgO로 형성될 수 있다.A passivation layer may be further formed on the dielectric layer, and the passivation layer may be formed of MgO.

상기 격벽은 상기 제1 방향을 따라 길게 형성되고, 상기 제2 방향을 따라 기설정된 간격을 유지하면서 서로 나란하게 배치되는 제1 격벽부재들과, 제1 격벽부재들 사이에서 제2 방향을 따라 길게 형성되고, 제1 방향을 따라 기설정된 간격을 유지하면서 서로 나란하게 배치되는 제2 격벽부재들을 포함할 수 있다.The partition wall is formed to extend in the first direction, and the first partition members are disposed in parallel with each other while maintaining a predetermined interval along the second direction, and the length is extended along the second direction between the first partition members. The second barrier ribs may include second barrier rib members formed in parallel with each other while maintaining a predetermined distance along the first direction.

이하, 첨부한 도면을 참고하여 본 발명의 바람직한 실시예를 보다 상세하게 설명하면 다음과 같다.Hereinafter, exemplary embodiments of the present invention will be described in detail with reference to the accompanying drawings.

도 1은 본 발명의 일 실시예에 따른 플라즈마 디스플레이 패널의 부분 분해 사시도이고, 도 2는 도 1의 Ⅱ-Ⅱ 선을 따라 자른 단면도이며, 도 3은 도 1에 도시한 플라즈마 디스플레이 패널 중 전면기판의 부분 확대 평면도이다.1 is a partially exploded perspective view of a plasma display panel according to an embodiment of the present invention, FIG. 2 is a cross-sectional view taken along the line II-II of FIG. 1, and FIG. 3 is a front substrate of the plasma display panel shown in FIG. 1. A partial enlarged plan view of the.

도면을 참고하면, 플라즈마 디스플레이 패널은 기설정된 간격을 두고 서로 마주 배치되어 봉착(封着)되는 제1 기판(이하, "배면기판"이라 한다.)(2)과 제2 기판(이하, "전면기판"이라 한다)(4) 및 이 기판들 사이에 구비되는 격벽(6)을 포함한다. 격벽(6)은 배면기판(2)과 전면기판(4) 사이에서 소정의 높이로 형성되어 다수의 방전셀들(8)을 구획한다. 이 방전셀들(8)은 기체방전으로 진공자외선을 발생시킬 수 있도록 방전가스(일례로 네온(Ne)과 제논(Xe)을 포함하는 혼합가스)를 충전하고 있으며, 이 진공 자외선을 흡수하여 가시광을 방출하는 형광체층(10)을 구비하고 있다.Referring to the drawings, the plasma display panel is disposed to face each other at predetermined intervals (hereinafter, referred to as a "back substrate") 2 and a second substrate (hereinafter referred to as "front surface"). 4 "and a partition 6 provided between the substrates. The partition wall 6 is formed at a predetermined height between the rear substrate 2 and the front substrate 4 to partition the plurality of discharge cells 8. The discharge cells 8 are filled with a discharge gas (for example, a mixed gas containing neon (Ne) and xenon (Xe)) so as to generate vacuum ultraviolet rays by gas discharge. The phosphor layer 10 which emits light is provided.

이러한 플라즈마 디스플레이 패널은 기체방전으로 화상을 구현하기 위하여, 배면기판(2)과 전면기판(4) 사이에서 각 방전셀(8)에 대응하도록 어드레스전극(12)과 제1 전극(이하 "유지전극"이라 한다)(14) 및 제2 전극(이하, "주사전극"이라 한다)(16)을 구비하고 있다.The plasma display panel includes an address electrode 12 and a first electrode (hereinafter referred to as a “holding electrode”) corresponding to each discharge cell 8 between the rear substrate 2 and the front substrate 4 in order to realize an image by gas discharge. 14 and a second electrode (hereinafter referred to as "scan electrode") 16 are provided.

일례로서, 어드레스전극(12)은 배면기판(2)의 내부 표면에 제1 방향(도면의 y축 방향)을 따라 신장(伸長) 형성되어, y축 방향으로 인접하는 방전셀들(8)에 연 속적으로 대응한다. 또한, 다수의 어드레스전극들(12)은 y축 방향과 교차하는 제2 방향(도면의 x축 방향)을 따라 인접하는 방전셀들(8)에 대응하도록 나란하게 배치된다.As an example, the address electrode 12 is formed along the first direction (y-axis direction in the drawing) on the inner surface of the back substrate 2 to form discharge cells 8 adjacent to the y-axis direction. Respond continuously. In addition, the plurality of address electrodes 12 are arranged side by side to correspond to the discharge cells 8 adjacent to each other in a second direction (the x-axis direction of the drawing) crossing the y-axis direction.

어드레스전극들(12)은 상기한 바와 같이 배면기판(2)의 내부 표면을 덮어 이루어지는 제1 유전층(18)으로 덮여진다. 제1 유전층(18)은 방전시, 양이온 또는 전자가 어드레스전극(12)에 직접 충돌하는 것을 방지하여 어드레스전극(12)의 손상을 방지하고, 또한 벽전하를 형성 및 축적한다. 어드레스전극(12)은 배면기판(2)에 배치되어 가시광이 전방으로 조사되는 것을 방해하지 않도록 불투명한 전극으로 형성될 수 있다. 즉, 어드레스전극(12)은 우수한 통전성을 가지는 금속 전극으로 형성될 수 있다.The address electrodes 12 are covered with the first dielectric layer 18 covering the inner surface of the back substrate 2 as described above. The first dielectric layer 18 prevents cations or electrons from directly colliding with the address electrode 12 during discharge, thereby preventing damage to the address electrode 12, and also forms and accumulates wall charges. The address electrode 12 may be formed of an opaque electrode disposed on the rear substrate 2 so as not to prevent visible light from being irradiated forward. That is, the address electrode 12 may be formed of a metal electrode having excellent conductance.

그리고 격벽(6)은 제1 유전층(18) 상에 구비되어 방전셀들(8)을 구획한다. 격벽(6)은 y축 방향으로 신장 형성되는 제1 격벽부재들(6a)과, 이 제1 격벽부재들(6a) 사이에서 x축 방향으로 신장 형성되는 제2 격벽부재들(6b)을 포함하여 방전셀들(8)을 매트릭스(matrix) 구조로 형성하고 있다.The partition wall 6 is provided on the first dielectric layer 18 to partition the discharge cells 8. The partition wall 6 includes first partition wall members 6a extending in the y-axis direction and second partition wall members 6b extending in the x-axis direction between the first partition wall members 6a. Thus, the discharge cells 8 are formed in a matrix structure.

격벽(6)은 y축 방향으로 신장 형성되는 제1 격벽부재들(6a)로 형성되어 방전셀들(8)을 스트라이프(stripe) 구조로 형성할 수 있다.(미도시) 이 경우 방전셀들(8)은 y축 방향을 따라 개방되는 구조를 형성한다.The partition wall 6 may be formed of the first partition wall members 6a extending in the y-axis direction to form the discharge cells 8 in a stripe structure (not shown). (8) forms a structure which is opened along the y-axis direction.

도 1에서는 방전셀(8)을 매트릭스 구조로 형성하는 격벽(6)을 도시하였으며, 이 상태에서 제2 격벽부재들(6b)이 제거되면 제1 격벽부재들(6a)에 의해 스트라이프 구조의 방전셀이 형성된다.In FIG. 1, the partition wall 6 forming the discharge cells 8 in a matrix structure is illustrated. In this state, when the second partition wall members 6b are removed, the first partition wall members 6a discharge the stripe structure. The cell is formed.

방전셀들(8) 각각에 형성되는 형광체층(10)은 격벽(6)의 측면과, 격벽들(6) 사이에 위치하는 제1 유전층(18)의 표면에 형광체 페이스트를 도포하고, 이를 건조 및 소성함으로써 형성된다.The phosphor layer 10 formed in each of the discharge cells 8 is coated with a phosphor paste on the side of the partition 6 and the surface of the first dielectric layer 18 located between the partitions 6 and dried. And by firing.

형광체층(10)은 y축 방향을 따라 형성되는 방전셀들(8)에서 동일 색상의 형광체로 형성된다. 또한 형광체층(10)은 x축 방향을 따라 반복적으로 배치되는 방전셀들(8)에 적색(R), 녹색(G), 및 청색(B)의 형광체에 의하여 반복적으로 형성된다.The phosphor layer 10 is formed of phosphors of the same color in the discharge cells 8 formed along the y-axis direction. In addition, the phosphor layer 10 is repeatedly formed by the phosphors of red (R), green (G), and blue (B) in the discharge cells 8 repeatedly arranged along the x-axis direction.

한편 도 3을 참고하면, 유지전극(14)과 주사전극(16)은 전면기판(4)의 내부 표면에 구비되어, 방전셀들(8)에서 기체방전을 일으키도록 각 방전셀(8)에 대응하여 면방전 구조를 형성한다. 이 유지전극(14)과 주사전극(16)은 어드레스전극(12)과 교차하는 x축 방향을 따라 신장 형성된다.Meanwhile, referring to FIG. 3, the sustain electrode 14 and the scan electrode 16 are provided on the inner surface of the front substrate 4 so as to cause gas discharge in the discharge cells 8. Correspondingly, the surface discharge structure is formed. The sustain electrode 14 and the scan electrode 16 extend in the x-axis direction crossing the address electrode 12.

그리고 유지전극(14)과 주사전극(16) 각각은 방전을 일으키는 투명전극(141,161)과, 투명전극(141,161)에 각각 전압 신호를 인가하는 버스전극(142,162)을 포함한다. 투명전극들(141,161)은 방전셀(8) 내부에서 면방전을 일으키는 부분으로서, 방전셀(8)의 개구율 확보를 위하여 투명한 소재(일례로 ITO: Indium Tin Oxide)로 형성된다. 버스전극들(142,162)은 투명전극들(141,161)의 높은 전기 저항을 보상하도록 통전성이 우수한 금속 소재로 형성된다.Each of the sustain electrode 14 and the scan electrode 16 includes transparent electrodes 141 and 161 for generating a discharge and bus electrodes 142 and 162 for applying a voltage signal to the transparent electrodes 141 and 161, respectively. The transparent electrodes 141 and 161 are surface discharges in the discharge cell 8, and are formed of a transparent material (eg, indium tin oxide) to secure the aperture ratio of the discharge cell 8. The bus electrodes 142 and 162 are formed of a metal material having excellent electrical conductivity to compensate for the high electrical resistance of the transparent electrodes 141 and 161.

투명전극들(141,161)은 y축 방향을 따라 방전셀(8)의 외곽에서 중심으로 각각 일정한 폭(W14,W16)을 가지고 서로 면방전 구조를 형성하며, 각 방전셀(8)의 중심 부분에서 방전갭(G)을 형성한다. 버스전극들(142,162)은 투명전극들(141,161) 상에 각각 배치되고 방전셀(8)의 외곽에서 x축 방향으로 신장 형성된다. 따라서 버 스전극들(142,162)에 전압신호를 인가하게 되면 각 버스전극들(142,162)에 연결되는 투명전극들(141,161) 각각에 전압 신호가 인가된다.The transparent electrodes 141 and 161 form a surface discharge structure with each other having a constant width W14 and W16 from the outer edge of the discharge cell 8 along the y-axis direction, and at the center of each discharge cell 8. The discharge gap G is formed. The bus electrodes 142 and 162 are disposed on the transparent electrodes 141 and 161, respectively, and extend in the x-axis direction at the outside of the discharge cell 8. Therefore, when a voltage signal is applied to the bus electrodes 142 and 162, a voltage signal is applied to each of the transparent electrodes 141 and 161 connected to the bus electrodes 142 and 162.

또한, 투명전극(141,161)은 x축 방향을 따라 하나로 연결되어 각 방전셀들(8)에서 방전을 일으킬 수 있다.(미도시)In addition, the transparent electrodes 141 and 161 may be connected together in the x-axis direction to cause discharge in each of the discharge cells 8 (not shown).

다시 도 1과 도 2를 참조하면, 유지전극(14) 및 주사전극(16)은 어드레스전극들(12)과 교차하는 상태로 방전셀(8)에 대응하고, 서로 마주하면서 제2 유전층(20)으로 덮여진다. 제2 유전층(20)은 유지전극(14) 및 주사전극(16)을 기체방전으로부터 보호하면서 방전시 벽전하를 형성 및 축적한다.Referring back to FIGS. 1 and 2, the sustain electrode 14 and the scan electrode 16 correspond to the discharge cells 8 while crossing the address electrodes 12 and face each other, and the second dielectric layer 20 faces each other. Covered with) The second dielectric layer 20 forms and accumulates wall charges during discharge while protecting the sustain electrode 14 and the scan electrode 16 from gas discharge.

제2 유전층(20)은 보호막(22)으로 덮여진다. 예를 들면, 보호막(22)은 제2 유전층(20)을 보호하는 투명한 MgO로 형성되어, 방전시 이차전자방출계수를 증가시킨다.The second dielectric layer 20 is covered with the protective film 22. For example, the passivation layer 22 is formed of transparent MgO that protects the second dielectric layer 20 to increase the secondary electron emission coefficient upon discharge.

전술한 구조의 플라즈마 디스플레이 패널 구동시, 리셋 기간에서는 주사전극(16)에 인가되는 리셋 펄스에 의하여 리셋 방전이 일어나고, 이 리셋 기간에 이어지는 어드레싱 기간에서는 주사전극(16)에 인가되는 스캔 펄스와 어드레스전극(12)에 인가되는 어드레스 펄스에 의하여 어드레스 방전이 일어나며, 그 후, 유지기간에서는 유지전극(14)과 주사전극(16)에 인가되는 유지 펄스에 의하여 유지 방전이 일어난다.In driving the plasma display panel having the above-described structure, reset discharge is caused by a reset pulse applied to the scan electrode 16 in the reset period, and scan pulses and addresses applied to the scan electrode 16 in the addressing period following the reset period. The address discharge is caused by the address pulse applied to the electrode 12, and then the sustain discharge is caused by the sustain pulse applied to the sustain electrode 14 and the scan electrode 16 in the sustain period.

유지전극(14)과 주사전극(16)은 유지 방전에 필요한 유지 펄스를 인가하는 전극의 역할을 하고, 주사전극(16)은 리셋 펄스 및 스캔 펄스를 인가하는 전극의 역할을 하며, 어드레스전극(12)은 어드레스 펄스를 인가하는 전극의 역할을 한다. 유지전극(14)과 주사전극(16) 및 어드레스전극(12)은 각각에 인가되는 전압 파형에 따라 그 역할을 달리할 수 있으므로 반드시 이 역할들에 한정되는 것을 아니다.The sustain electrode 14 and the scan electrode 16 serve as electrodes for applying sustain pulses required for sustain discharge, and the scan electrodes 16 serve as electrodes for applying reset pulses and scan pulses, and the address electrodes ( 12 serves as an electrode for applying an address pulse. The sustain electrode 14, the scan electrode 16, and the address electrode 12 may have different roles depending on voltage waveforms applied to the sustain electrode 14, the scan electrode 16, and the address electrode 12, respectively, and are not necessarily limited to these roles.

플라즈마 디스플레이 패널은 어드레스전극(12)과 주사전극(16)의 상호 작용으로 인한 어드레스 방전에 의하여 켜질 방전셀(8)을 선택하고, 유지전극(14)과 주사전극(16)의 상호 작용으로 인한 유지 방전에 의하여 상기 선택된 방전셀(8)을 구동시켜 화상을 구현한다.The plasma display panel selects the discharge cells 8 to be turned on by the address discharge due to the interaction between the address electrode 12 and the scan electrode 16, and the interaction between the sustain electrode 14 and the scan electrode 16. The selected discharge cell 8 is driven by sustain discharge to realize an image.

전술한 구성에서 본 실시예의 버스전극(142,162)은 배면기판(2)을 향한 일면에 길이 방향을 따라 홈(24)을 형성하는 블랙층(142a,162a)과, 상기 홈(24)에 삽입되는 화이트층(142b,162b)을 포함한다.In the above-described configuration, the bus electrodes 142 and 162 of the present embodiment are inserted into the grooves 24 and the black layers 142a and 162a forming the grooves 24 in the longitudinal direction on one surface facing the rear substrate 2. White layers 142b and 162b are included.

블랙층(142a,162a)은 외광을 흡수하여 화면의 콘트라스트를 향상시킬 수 있도록 흑색 계통의 색으로 배면기판(2)을 향한 전면기판(4)과 투명전극(141,161)의 일면에 형성되고, 홈(24)은 일정한 폭을 가지고 블랙층(142a,162a)의 길이 방향을 따라 블랙층의 일면 전체에 형성된다. 그리고 홈(24)에 대응하는 화이트층(142b,162b)은 우수한 도전성을 가지는 백색 계통의 색으로 형성된다.The black layers 142a and 162a are formed on one surface of the front substrate 4 and the transparent electrodes 141 and 161 facing the rear substrate 2 in a black color so as to absorb external light and improve the contrast of the screen. 24 has a constant width and is formed on one surface of the black layer along the longitudinal direction of the black layers 142a and 162a. In addition, the white layers 142b and 162b corresponding to the grooves 24 are formed in a white color having excellent conductivity.

이와 같은 구조의 버스전극(142,162)은 흑색의 도전막을 인쇄하고 건조하여 전술한 홈(24)을 가지는 블랙층(142b,162b)을 형성하고, 상기 홈(24)에 백색의 도전막을 인쇄, 건조하여 화이트층(142b,162b)을 형성한 다음, 이들을 노광과 현상 및 소성하여 완성할 수 있다.The bus electrodes 142 and 162 having such a structure print and dry a black conductive film to form the black layers 142b and 162b having the grooves 24 described above, and print and dry the white conductive film in the grooves 24. White layers 142b and 162b may be formed, and then exposed, developed, and baked.

본 실시예의 버스전극(142,162)은 흑색 계통의 색으로 형성되는 블랙층(142a,162a)의 면적을 확대하여 흑부비율을 개선하고, 그에 따라 화면의 콘트라 스트를 향상시킬 수 있다. 이때 백색 계통의 색으로 형성되는 화이트층(142b,162b)은 화이트층(142b,162b)을 향해 방사된 가시광을 반사시켜 화면의 휘도를 높인다.The bus electrodes 142 and 162 according to the present exemplary embodiment may enlarge the area of the black layers 142a and 162a formed in the black color to improve the black ratio, thereby improving the contrast of the screen. In this case, the white layers 142b and 162b formed with the color of the white system reflect the visible light emitted toward the white layers 142b and 162b to increase the brightness of the screen.

또한, 본 실시예의 버스전극(142,162)은 제2 유전층(20)을 향한 화이트층(142b,162b)의 면적을 축소함으로써 화이트층(142b,162b)과 제1 유전층(18)과의 반응에 의한 황변 형상을 억제하고, 그에 따라 화면의 색순도와 색재현율을 높이는 등 표시 품질을 개선하는 효과를 구현한다.In addition, the bus electrodes 142 and 162 according to the present embodiment reduce the area of the white layers 142b and 162b facing the second dielectric layer 20, thereby reacting with the white layers 142b and 162b and the first dielectric layer 18. The effect of improving the display quality by suppressing the yellowing shape and increasing the color purity and color reproducibility of the screen is realized accordingly.

상기에서는 본 발명의 바람직한 실시예에 대하여 설명하였지만, 본 발명은 이에 한정되는 것이 아니고 특허청구범위와 발명의 상세한 설명 및 첨부한 도면의 범위 안에서 여러 가지로 변형하여 실시하는 것이 가능하고 이 또한 본 발명의 범위에 속하는 것은 당연하다.Although the preferred embodiments of the present invention have been described above, the present invention is not limited thereto, and various modifications and changes can be made within the scope of the claims and the detailed description of the invention and the accompanying drawings. Naturally, it belongs to the range of.

이와 같이 본 발명에 따른 플라즈마 디스플레이 패널은 버스전극에서 화이트층에 대한 블랙층의 면적을 증대시켜 화면의 콘트라스트와 휘도를 높이고, 또한 블랙층의 홈에 화이트층을 형성하여 황변 현상을 억제하므로 표시 품질을 향상시키는 효과가 있다.As described above, the plasma display panel according to the present invention increases the contrast and brightness of the screen by increasing the area of the black layer with respect to the white layer in the bus electrode, and also suppresses yellowing by forming a white layer in the groove of the black layer. Has the effect of improving.

Claims (6)

서로 마주하여 이격 배치되는 제1 기판과 제2 기판과;A first substrate and a second substrate spaced apart from each other; 상기 양 기판 사이에 배치되어 방전셀들을 구획하는 격벽과;Barrier ribs disposed between the substrates to partition discharge cells; 상기 방전셀 내에 형성되는 형광체층과;A phosphor layer formed in the discharge cell; 상기 제1 기판에서 제1 방향을 따라 형성되는 어드레스전극과;An address electrode formed along the first direction in the first substrate; 상기 제2 기판에서 상기 제1 방향과 교차하는 제2 방향을 따라 서로 나란하게 형성되는 제1 전극 및 제2 전극과;First and second electrodes formed parallel to each other along a second direction crossing the first direction on the second substrate; 상기 제1 전극과 상기 제2 전극을 덮으면서 상기 제2 기판에 형성되는 유전층을 포함하며,A dielectric layer formed on the second substrate while covering the first electrode and the second electrode, 상기 제1 전극과 상기 제2 전극은 각각 상기 방전셀의 가장자리에 형성되는 버스전극을 포함하며,The first electrode and the second electrode each includes a bus electrode formed on the edge of the discharge cell, 상기 버스전극은 블랙층과 화이트층을 포함하고,The bus electrode includes a black layer and a white layer, 상기 블랙층은 화이트층보다 넓은 면적으로 형성되는 플라즈마 디스플레이 패널.And the black layer has a larger area than the white layer. 제1항에 있어서,The method of claim 1, 상기 블랙층은 상기 유전층 위에 형성되며 상기 제1 기판을 향한 일면에 길이 방향을 따라 홈을 형성하는 플라즈마 디스플레이 패널.And the black layer is formed on the dielectric layer and forms grooves along a length direction on one surface facing the first substrate. 제1항에 있어서,The method of claim 1, 상기 화이트층은 상기 블랙층의 홈에 형성되는 플라즈마 디스플레이 패널.And the white layer is formed in the groove of the black layer. 제1항에 있어서,The method of claim 1, 상기 유전층 위에 보호막이 더욱 형성되는 플라즈마 디스플레이 패널.And a protective film formed on the dielectric layer. 제3항에 있어서,The method of claim 3, 상기 보호막이 MgO로 형성되는 플라즈마 디스플레이 패널.And a protective film formed of MgO. 제1항에 있어서,The method of claim 1, 상기 격벽이,The bulkhead, 상기 제1 방향을 따라 길게 형성되고, 상기 제2 방향을 따라 기설정된 간격을 유지하면서 서로 나란하게 배치되는 제1 격벽부재들; 및First barrier members formed to extend in the first direction and disposed in parallel with each other while maintaining a predetermined interval in the second direction; And 상기 제1 격벽부재들 사이에서 상기 제2 방향을 따라 길게 형성되고, 상기 제1 방향을 따라 기설정된 간격을 유지하면서 서로 나란하게 배치되는 제2 격벽부재들을 포함하는 플라즈마 디스플레이 패널.And second partition walls formed between the first partition members in the second direction, the second partition members being disposed parallel to each other while maintaining a predetermined distance along the first direction.
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* Cited by examiner, † Cited by third party
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CN105033765A (en) * 2015-08-07 2015-11-11 孟令启 Micro-vibration monitoring device for numerical control machine tool

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