KR20070070543A - 액정 패널 및 그 구동 회로 - Google Patents

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Abstract

화상의 질을 유지하면서도 시야각을 넓히기에 적합한 액정 패널이 개시된다.
액정 패널에는 다수의 메인 게이트 라인과 다수의 서브 게이트 라인이 수평 및 수직 방향 중 어느 한 방향으로 교번되게 배열된다. 이들 메인 및 서브 게이트 라인들과 교차하게 배열된 다수의 데이터 라인들에 의해 구분되는 영역들 각각에 상기 메인 및 서브 게이트 라인 어느 하나와 상기 데이터 라인과 전기적으로 접속되게 형성되는 화소 셀들이 배치된다. 메인 게이트 라인에 접속된 화소 셀과 서브 게이트 라인에 접속된 화소 셀이 하나의 화소를 이루게 된다.
이에 따라, 메인 게이트 라인에 접속된 화소 셀에 포함된 액정 셀과 서브 게이트 라인에 접속된 화소 셀에 포함된 액정 셀이 전계의 세기의 차이에 의하여 서로 다른 각도로 비틀릴 수 있어, 상하좌우 모든 방향으로 투과되는 광량이 균일하게 된다. 이 결과, 액정 패널의 시야각이 넓어지게 된다.
액정, 시야각, 전계, 펄스 폭, 전압 레벨, 메인, 서브.

Description

액정 패널 및 그 구동 회로{Liquid Crystal Panel and Driving Circuit thereof}
본 발명의 상세한 설명에서 사용되는 도면에 대한 보다 충분한 이해를 돕기 위하여, 각 도면의 간단한 설명이 제공된다.
도 1 은 본 발명의 실시 예에 따른 액정 패널을 설명하는 도면이다.
도 2 는 본 발명의 실시 예에 따른 액정 패널 구동회로를 설명하는 블럭도 이다.
도 3 은 도 2에 도시된 제1 및 제2 게이트 드라이버에 출력되는 스캔 신호의 파형을 도시하는 파형도 이다.
도 4 는 도 2의 액정 패널의 메인 화소 셀 및 서브 화소 셀에 충전되는 전압 특성을 설명하는 특성도 이다.
도 5 는 본 발명의 다른 실시 예에 따른 액정 패널 구동 회로를 설명하는 블럭도 이다.
《도면의 주요부분에 대한 부호의 설명》
10 : 액정 패널 20,22 : 게이트 드라이버
24 : 폭 조정기 30 : 데이터 드라이버
40 : 타이밍 제어부 TFT : 박막 트랜지스터
CLC : 액정 셀
본 발명은 평판 표시 장치에 사용되는 액정 패널에 관한 것으로, 분할된 화소를 포함하는 액정 패널 및 그 구동 회로에 관한 것이다.
액정 표시 장치는 음극선관과 같은 기존의 표시 장치에 비하여 부피 및 중량을 감소시킬 수 있다는 점에서 각광받고 있다. 액정 표시 장치는 액정의 광 투과율을 조절하여 화상이 표시되게 한다. 이러한 액정 표시 장치에서는 액정을 투과하는 광량이 균일하지 않고 부분적으로 편중되게 분포함에 의하여 시야각이 좁을 수밖에 없다.
액정 표시 장치의 시야각을 넓히기 위한 방안으로, 하나의 화소를 분할하여 구동하는 방안이 제안되고 있다. 하나의 화소 영역에 두 개의 화소 전극을 형성하여 각각의 화소 전극에 인가되는 전계의 세기가 달라지게 함으로서, 화소 영역의 일부는 센 전계에 의하여 나머지 영역은 약한 전계에 의해 구동되게 한다. 이러한 투과된 광의 진행 방향이 분사되게 하여 시야각이 넓어지게 한다.
이러한 화소의 분할 구동 방안으로는 공통 전압 방식과 플로팅 방식(Floating System)이 시도되고 있다. 플로팅 방식에서는, 분할된 한쪽 일부 화소(이하, "제1 서브 화소"라 함)는 공통 전극에 연결되는 반면 나머지 일부 화소(이하, "제2 서브 화소"라 함)의 한쪽 단자가 개방되게 한다. 이 경우, 한쪽 단자가 개방된 제2 서브 화소가 캐패시터로 작용하여 제1 서브 화소와는 다르게 전하의 충전을 수행한다. 이로 인하여, 플로팅 방식에서는 원하지 않은 화상이 표시될 수도 있다.
이와는 달리, 공통 전압 방식에서는 제1 서브 화소는 제2 서브 화소와는 다른 레벨의 공통 전압으로 구동된다. 다시 말하여, 제1 및 제2 서브 화소에 따라 공통 전압이 스윙한다. 이러한 공통 전압 방식은 공통 전압에 대한 부하량이 커지게 하여 플리커 잡음 및 녹색 띠 등이 화상에 나타나게 된다.
따라서, 본 발명의 목적은 화상의 질을 유지하면서도 시야각을 넓히기에 적합한 액정 패널 및 그 구동회로를 제공함에 있다.
상술한 목적을 달성하기 위한 본 발명의 일면의 실시 예에 따른 액정 패널은 수평 및 수직 방향 중 어느 한 방향으로 교번되게 배열되는 다수의 메인 게이트 및 다수의 서브 게이트 라인; 메인 및 서브 게이트 라인들과 교차하게 배열된 다수의 데이터 라인들; 및 게이트 라인들 및 데이터 라인들에 의해 구분되는 영역들 각각 에 상기 메인 및 서브 게이트 라인 어느 하나와 상기 데이터 라인과 전기적으로 접속되게 형성되는 화소 셀들을 구비한다. 상기의 메인 게이트 라인에 접속된 화소 셀과 상기의 서브 게이트 라인에 접속된 화소 셀이 하나의 화소를 구성한다.
상기의 화소 셀들이 데이터 라인에 따라 위쪽 및 아래쪽의 게이트 라인에 번갈아 접속되는 형태로 형성되는 것이 바람직하다.
상기의 메인 게이트 라인에 접속된 화소 셀과 상기 서브 게이트 라인에 접속된 화소 셀이 수평 방향에서 교번되게 배열되는 것이 바람직하다.
상기의 화소 셀들은 지그재그 형태로 진행하는 공통 전극에 공통적으로 접속될 수 있다.
본 발명의 다른 일면의 실시 예에 따른 액정 패널 구동 회로는, 상기의 액정 패널; 액정 패널의 데이터 라인들에 화소 구동 신호를 공급하는 데이터 드라이버; 액정 패널 상의 상기 메인 게이트 라인들에 접속된 화소 셀들이 상기 데이터 라인 상의 상기 화소 구동 신호를 충전하게 구동하는 제1 게이트 구동 드라이버; 액정 패널 상의 서브 게이트 라인에 접속된 화소 셀들이 상기 데이터 라인 상의 화소 구동 신호의 일부를 충전하게 구동하는 제2 게이트 구동 드라이버를 구비한다.
상기의 제2 게이트 구동 드라이버가 메인 게이트 라인에 인가되는 인에이블 전압보다 낮은 레벨의 인에이블 전압을 상기 서브 게이트 라인에 공급할 수 있다.
상기의 제2 게이트 구동 드라이버가 메인 게이트 라인에 인가되는 인에이블 펄스보다 짧은 폭의 인에이블 펄스를 서브 게이트 라인에 공급할 수도 있다. 이 경우, 서브 게이트 라인에 공급되는 인에이블 펄스와 메인 게이트 라인에 인가되는 인에이블 펄스가 동일한 위상을 가지는 것이 바람직하다.
이상과 같은 구성에 의하여, 본 발명에 따른 액정패널은 메인 화소 셀에 포함된 액정 셀과 서브 화소 셀에 포함된 액정 셀이 전계의 세기의 차이에 의하여 서로 다른 각도로 비틀리게 하여, 상하좌우 모든 방향으로 투과되는 광량을 균일하게 한다. 이에 따라, 본 발명에 따른 액정 패널은 시야각을 넓힐 수 있다. 또한, 본 발명에 따른 액정 패널 구동 회로는 서브 화소 셀의 액정 셀에 충전되는 전압이 메인 화소 셀의 액정 셀에 충전되는 액정 셀에 충전되는 전압보다 낮아지게 하여, 서브 화소 셀의 액정 셀이 메인 화소 셀의 액정 셀과는 다른 각도로 비틀려지게 한다. 이에 따라, 액정 패널이 투과시키는 광량이 중앙을 포함하여 상하좌우 모든 방향에서 균일하게 된다. 이 결과, 액정 패널 상에 표시되는 화상의 시야각이 넓어지게 한다.
상기한 바와 같은 본 발명의 목적들 외에, 본 발명의 다른 목적들, 다른 이점들 및 다른 특징들은 첨부한 도면을 참조한 바람직한 실시 예의 상세한 설명을 통하여 명백하게 드러나게 될 것이다.
이하, 첨부한 도면과 결부되어 본 발명에 바람직한 실시 예들이 상세히 설명될 것이다.
도 1 은 본 발명의 실시 예에 따른 액정 패널을 도시하는 도면이다. 도 1에 있어서, 인용 부호 "10"은 액정 패널을 지시한다. 이 액정 패널(10)에는 단지 5개의 데이터 라인(DL1 내지 DL5), 4개의 메인 게이트 라인(FGL1 내지 FGL4) 및 4개의 서브 게이트 라인(SGL1 내지 SGL4) 만이 포함되어 있으나, 통상의 지식을 가진 자 라면 데이터 라인은 임의의 정수인 m개가 마련될 수 있음과 아울러 메인 게이트 라인(FSL) 및 서브 게이트 라인(SGL)도 "m"과는 다른 정수인 n개씩 형성될 수 있음을 알 수 있을 것이다.
설명 상의 편의를 위하여, 메인 게이트 라인(FGL)에 접속된 박막 트랜지스터(TFT)를 포함하는 화소 셀(FPX)들은 "메인 화소 셀"로 그리고 서브 게이트 라인(SGL)에 접속된 박막 트랜지스터(TFT)를 포함하는 화소 셀들(SPX)은 "서브 화소 셀"로 구분되는 것으로 한다.
도 1의 액정 패널(10)에는, 수직 방향에서 교번되게 배열되는 메인 게이트 라인(FGL1,FGL2) 및 서브 게이트 라인(SGL1,SGL2)과 이들 메인 및 서브 게이트 라인들(FGL,SGL)과 교차하게 수평 방향으로 배열된 데이터 라인들(DL1 내지 DL5)이 포함된다. 이들 게이트 라인(FGL,SGL) 및 데이터 라인(DL)에 의하여 구분되는 단위 영역들 각각에는 화소 셀(FPX 또는 SPX)이 마련된다. 이들 화소 셀(FPX,SPX) 각각은 일측 단자가 공통 전극(Vcom)에 접속된 액정 셀(CLC)과, 이 액정 셀(CLC)의 타측 단자, 게이트 라인(FGL 또는 SGL) 및 데이터 라인(DL)과 접속된 박막 트랜지스터(TFT)로 구성된다.
해당하는 메인 게이트 라인(FGL)에 접속된 박막 트랜지스터(TFT)를 포함하는 메인 화소 셀(FPX)은 동일한 데이터 라인(DL)에 공통-접속됨과 아울러 해당하는 서브 게이트 라인(SGL)에 접속된 박막 트랜지스터(TFT)를 포함하는 서브 화소 셀(SPX)와 하나의 화소 셀(PX)을 구성한다. 예를 들면, 제2 데이터 라인(DL2)에 공통 접속됨과 아울러 제1 메인 게이트 라인(FGL1) 및 제1 서브 게이트 라인(SGL1)에 각각 접속된 메인 화소 셀(FPX12) 및 서브 화소 셀(SPX12)가 첫 번째 수평 라인의 두 번째 화소 셀(PX12)를 형성한다. 마찬가지로, 제1 데이터 라인(DL1)에 공통 접속됨과 아울러 제2 메인 게이트 라인(FGL2) 및 제2 서브 게이트 라인(SGL2)에 각각 접속된 메인 화소 셀(FPX21) 및 서브 화소 셀(SPX21)가 두 번째 수평 라인의 두 번째 화소 셀(PX21)를 형성한다.
또한, 기수 번째 데이터 라인(DL1,DL3)에 접속되는 메인 및 서브 화소 셀들(FPX,SPX)는 해당하는 게이트 라인(FGL,SGL)의 위쪽 편에 형성되는 반면 우수 번째 데이터 라인(DL2,DL4)에 접속된 메인 및 서브 화소 셀들(FPX,SPX)은 해당하는 게이트 라인(FGL,SGL)의 아래 편에 형성된다. 이에 따라, 화소 셀들(PX) 각각은 수평 방향에서 인접 화소 셀들과 지그재그 형태로 배열되게 된다. 다시 말하면, 수평 및 수직 방향 모두에서 메인 화소 셀(FPX)와 서브 화소 셀(SPX)가 교번되게 배열된다. 이렇게 메인 화소 셀(FPX) 및 서브 화소 셀(SPX)가 교번-배열되게끔 공통 전극은 수평 방향에서 화소(PX)가 진행됨에 따라 지그재그의 형태로 진행하게 된다.
이와 같이, 본 발명의 실시 예에 따른 액정 패널에서는, 하나의 화소 셀(PX)이 메인 및 서브 화소 셀(FPX,SPX)로 분할됨과 아울러 메인 및 서브 화소 셀이 수평 및 수직 방향 모두에서 교번-배열된다. 이에 따라, 메인 화소 셀(FPX)에 포함된 액정 셀(CLC)과 서브 화소 셀(SPX)에 포함된 액정 셀이 전계의 세기의 차이에 의하여 서로 다른 각도로 비틀리게 되어, 상하좌우 모든 방향으로 투과되는 광량이 균일하게 된다. 이 결과, 액정 패널(10) 상에 표시되는 화상의 시야각이 넓어지게 된다.
도 2는 본 발명의 실시 예에 따른 액정 패널 구동 회로를 개략적으로 설명하는 블록도 이다.
도 2를 참조하면, 액정 패널 구동 회로는 액정 패널(10) 상의 메인 게이트 라인들(FGL)이 순차적이고 번갈아 인이에블 되게 하는 제1 게이트 드라이버(20) 및 액정 패널(10) 상의 서브 게이트 라인들(SGL)이 순차적이고 번갈아 인에이블 되게 하는 제2 게이트 드라이버(22)를 구비한다. 제1 게이트 드라이버(20)는 타이밍 제어기(40)의 제어하에 메인 게이트 라인들이(FGL1 내지 FGLn) 순차적이고 번갈아 인에이블되게 하는 메인 게이트 라인(FGL)의 수에 해당하는 메인 게이트 구동 신호들(FGL1 내지 FGLn)을 발생한다. 게이트 구동 신호들은 수평 동기 신호의 주기에 해당하는 폭과 고 전위의 게이트 하이 전압을 가지는 펄스가 순차적으로 그 폭 만큼 쉬프트되는 파형을 가진다. 다시 말하여, 제1 게이트 드라이버(20)은 도시하지 않은 전압 발생기로부터의 게이트 하이 전압(Vgh)이 인에이블 될 메인 게이터 라인(FGL)에 인가되게 하는 한편 나머지 메인 게이트 라인(FGL)에는 저 전위의 게이트 로우 전압(Vgl)이 공급되게 한다. 이러한 메인 게이트 구동 신호(FGL1 내지 FGLn)에 응답하는 메인 화소 셀(FPX)은 1라인 분씩 데이터 라인들(DL1 내지 DLm) 상의 화소 구동 신호를 충전하게 된다.
제1 게이트 드라이버(20)과 마찬가지로, 제2 게이트 드라이버(22)도 타이밍 제어기(40)의 제어하에 서브 게이트 라인들이(SGL1 내지 SGLn) 순차적이고 번갈아 인에이블되게 하는 서브 게이트 라인(SGL)의 수에 해당하는 서브 게이트 구동 신호들(SGL1 내지 SGLn)을 발생한다. 또한, 제2 게이트 드라이버(20)는 서브 게이트 라인들(SGL1 내지 SGLn)이 해당하는 메인 게이트 라인들(FGL1 내지 FGLn)과 동시에 인에이블되게끔, 도 3에 도시된 바와 같이, 상기의 메인 게이트 구동 신호(FGL1 내지 FGLn)와 폭과 위상이 같은 서브 게이트 구동 신호(SGL1 내지 SGLn)을 발생한다. 서브 게이트 구동 신호들(SGL1 내지 SGLn)은 중간 전위의 게이트 중간 전압(Vgh/α)을 가지는 펄스가 순차적으로 그 폭 만큼 쉬프트되는 파형을 가진다. 다시 말하여, 제2 게이트 드라이버(22)는 도시하지 않은 전압 발생기로부터의 게이트 중간 전압(Vgh/α)이 인에이블 될 서브 게이트 라인(SGL)에 인가되게 하는 한편 나머지 서브 게이트 라인(SGL)에는 저 전위의 게이트 로우 전압(Vgl)이 공급되게 한다. 이러한 서브 게이트 구동 신호(SGL1 내지 SGLn)에 응답하는 서브 화소 셀들(SPX)은 1라인 분씩 데이터 라인(DL1 내지 DLm) 상의 화소 구동 신호를 충전하게 된다. 이 때, 서브 화소 셀(SPX)에 충전되는 전압은 메인 화소 셀(FPX)에 충전되는 전압의 중간 정도의 레벨을 가지게 된다. 이는 서브 게이트 구동 신호(SGL)의 인에이블 전압 레벨이 메인 게이트 구동 신호(FGL)의 인에이블 전압 레벨에 비하여 낮아 서브 화소 셀(SPX)의 박막 트랜지스터(TFT)에 흐르는 전류량이 메인 서브 셀(FPX)의 박막 트랜지스터(TFT)에 흐르는 전류량 보다 적은 것에 기인한다. 이렇게 중간 전위의 펄스를 가지는 서브 게이트 구동 신호(SGL1 내지 SGLn)는 서브 게이트 라인(SGL1 내지 SGLn)에 접속된 서브 화소 셀(SPX)의 액정 셀(CLC)에 충전되는 전압이 도4에서와 같이 메인 화소 셀(FPX)의 액정 셀(CLC)에 충전되는 액정 셀(CLC)에 충전되는 전압 보다 낮아지게 한다. 이에 따라, 서브 화소 셀(SPX)의 액정 셀(CLC)이 메인 화소 셀(FPX)의 액정 셀(CLC)과는 다른 각도로 비틀려지어 광 투과량이 중 앙을 포함하여 상하좌우 모든 방향에서 균일하게 유지되게 한다. 이 결과, 액정 패널(10) 상에 표시되는 화상의 시야각이 넓어지게 한다.
또한, 도 2의 액정 패널 구동 회로에는 비디오 데이터에 응답하여 액정 패널(10) 상의 데이터 라인들(DL1 내지 DLm)에 화소 구동 신호를 공급하는 데이터 드라이버(30)가 포함된다. 비디오 데이터에는 각 화소 대응되는 화소 데이터가 포함되어 있다. 이에 따라, 데이터 드라이버(14)는 비디오 데이터에 포함된 화소 데이터를 1 라인 분씩 화소 구동 신호로 변환하고 그 변환된 1라인 분의 화소 구동 신호들이 대응하는 데이터 라인들(DL1 내지 DLm)에 각각 공급되게 한다.
타이밍 제어부(40)는 수직 동기 신호, 수평 동기 신호 및 클럭 신호를 포함하는 동기 신호들을 입력한다. 이들 동기 신호들에 응답하여 타이밍 제어부(40)는 제1 및 제2 게이트 드라이버(20,22)에서 출력되는 메인 및 서브 게이트 구동 신호(FGL,SGL)의 주기 및 출력 시점은 물론 데이터 드라이버(30)의 비디오 데이터 입력 시점 및 화소 구동 신호의 출력 시점 등을 제어한다.
도 5는 본 발명의 다른 실시 예에 따른 액정 패널 구동 회로를 개략적으로 설명하는 블록도 이다. 도 5에 따르면, 본 발명의 다른 실시 예의 액정 패널 구동 회로는 도 2에 도시된 제2 게이트 드라이버(22)가 폭 조정기(24)로 대치된 것을 제외하고는 도 2의 구동 회로와 동일한 구성을 가진다. 따라서, 도 2에서의 것과 동일한 명칭, 기능 및 역할을 가지는 도 5의 구성 요소들은 도 2에서와 동일한 참조 번호로 인용될 것이다. 이에 더하여, 도 2에서와 중복되는 구성요소에 대한 작용효과에 대한 설명도 생략될 것이다.
폭 조정기(24)는 액정 패널(10) 상의 서브 게이트 라인들(SGL1 내지 SGLn)과는 물론 메인 게이트 라인들(FGL1 내지 FGLn)과도 접속된다. 이렇게 액정 패널(10)과 접속되는 폭 조정기(24)는 메인 게이트 라인들(FGL1 내지 FGLn)을 경유하는 게이트 드라이버(20)로부터의 메인 게이트 구동 신호들(FGL1 내지 FGLn)에 고 전위의 게이트 하이 전압의 펄스 폭을 좁게 하여 서브 게이트 구동 신호들(SGL1 내지 SGLn)을 발생한다. 서브 게이트 구동 신호(SGL)에 포함된 펄스는 메인 게이트 구동 신호(FGL)의 펄스와 동일한 위상을 가지거나 또는 자신의 폭 만큼 뒤진 위상을 가질 수 있다. 이 서브 게이트 구동 신호들(SGL1 내지 SGLn)은 서브 게이트 라인(SGL1 내지 SGLn)에 각각 공급되어 서브 화소 셀들(SPX)이 1라인 분씩 데이터 라인(DL1 내지 DLm) 상의 화소 구동 신호를 충전하게 한다.
이 때, 서브 화소 셀(SPX)에 충전되는 전압은 메인 화소 셀(FPX)에 충전되는 전압의 중간 정도의 레벨을 가지게 된다. 이는 서브 게이트 구동 신호(SGL)의 인에이블 기간이 메인 게이트 구동 신호(FGL)의 인에이블 기간에 비하여 짧아 서브 화소 셀(SPX)의 박막 트랜지스터(TFT)을 통과하는 총 전하량이 메인 서브 셀(FPX)의 박막 트랜지스터(TFT)을 통과하는 총 전하량 보다 적은 것에 기인한다. 이렇게 좁은 폭의 펄스를 가지는 서브 게이트 구동 신호(SGL1 내지 SGLn)는 서브 게이트 라인(SGL1 내지 SGLn)에 접속된 서브 화소 셀(SPX)의 액정 셀(CLC)에 충전되는 전압이 도4에서와 같이 메인 화소 셀(FPX)의 액정 셀(CLC)에 충전되는 액정 셀(CLC)에 충전되는 전압보다 낮아지게 한다. 이에 따라, 서브 화소 셀(SPX)의 액정 셀(CLC)이 메인 화소 셀(FPX)의 액정 셀(CLC)과는 다른 각도로 비틀려지어 광 투과량 이 중앙을 포함하여 상하좌우 모든 방향에서 균일하게 유지되게 한다. 이 결과, 액정 패널(10) 상에 표시되는 화상의 시야각이 넓어지게 한다.
상술한 바와 같이, 본 발명에 따른 액정 패널에서는, 하나의 화소 셀이 메인 및 서브 화소 셀로 분할됨과 아울러 메인 및 서브 화소 셀이 수평 및 수직 방향 모두에서 교번-배열된다. 이에 따라, 메인 화소 셀에 포함된 액정 셀과 서브 화소 셀에 포함된 액정 셀이 전계의 세기의 차이에 의하여 서로 다른 각도로 비틀리게 되어, 상하좌우 모든 방향으로 투과되는 광량이 균일하게 된다. 이 결과, 액정 패널의 시야각이 넓어지게 된다.
또한, 본 발명에 따른 액정 패널 구동 회로는 서브 화소 셀의 액정 셀에 충전되는 전압이 메인 화소 셀의 액정 셀에 충전되는 액정 셀에 충전되는 전압보다 낮아지게 하여, 서브 화소 셀의 액정 셀이 메인 화소 셀의 액정 셀과는 다른 각도로 비틀려지게 한다. 이에 따라, 액정 패널이 투과시키는 광량이 중앙을 포함하여 상하좌우 모든 방향에서 균일하게 된다. 이 결과, 액정 패널 상에 표시되는 화상의 시야각이 넓어지게 한다.
이상과 같이, 본 발명이 도면에 도시된 실시 예를 참고하여 설명되었으나, 이는 예시적인 것들에 불과하며, 본 발명이 속하는 기술 분야의 통상의 지식을 가진 자라면 본 발명의 요지 및 범위를 벗어나지 않으면서도 다양한 변형, 변경 및 균등한 타 실시 예들이 가능하다는 것을 명백하게 알 수 있을 것이다.

Claims (8)

  1. 수평 및 수직 방향 중 어느 한 방향으로 교번되게 배열되는 다수의 메인 게이트 및 다수의 서브 게이트 라인;
    상기 메인 및 서브 게이트 라인들과 교차하게 배열된 다수의 데이터 라인들; 및
    상기 게이트 라인들 및 데이터 라인들에 의해 구분되는 영역들 각각에 상기 메인 및 서브 게이트 라인 어느 하나와 상기 데이터 라인과 전기적으로 접속되게 형성되는 화소 셀들을 구비하고,
    상기 메인 게이트 라인에 접속된 화소 셀과 상기 서브 게이트 라인에 접속된 화소 셀이 하나의 화소를 구성하는 것을 특징으로 하는 액정 패널.
  2. 제 1 항에 있어서,
    상기 화소 셀들이 데이터 라인에 따라 위쪽 및 아래쪽의 게이트 라인에 번갈아 접속되는 형태로 형성되는 것을 특징으로 하는 액정 패널.
  3. 제 1 항에 있어서,
    상기 메인 게이트 라인에 접속된 화소 셀과 상기 서브 게이트 라인에 접속된 화소 셀이 수평 방향에서 교번되게 배열되는 것을 특징으로 하는 액정 패널.
  4. 제 1 항에 있어서, 상기 제어 모듈은
    상기 화소 셀들은 지그재그 형태로 진행하는 공통 전극에 공통적으로 접속되는 것을 특징으로 하는 액정 패널.
  5. 제 1 항에 기재된 액정 패널;
    상기 액정 패널의 데이터 라인들에 화소 구동 신호를 공급하는 데이터 드라이버;
    상기 액정 패널 상의 상기 메인 게이트 라인들에 접속된 화소 셀들이 상기 데이터 라인 상의 상기 화소 구동 신호를 충전하게 구동하는 제1 게이트 구동 드라이버;
    상기 액정 패널 상의 상기 서브 게이트 라인에 접속된 화소 셀들이 상기 데이터 라인 상의 상기 화소 구동 신호의 일부를 충전하게 구동하는 제2 게이트 구동 드라이버를 구비하는 것을 특징으로 하는 액정 패널 구동 회로.
  6. 제 5 항에 있어서,
    상기 제2 게이트 구동 드라이버가 상기 메인 게이트 라인에 인가되는 인에이블 전압보다 낮은 레벨의 인에이블 전압을 상기 서브 게이트 라인에 공급하는 것을 특징으로 하는 액정 패널 구동 회로.
  7. 제 5 항에 있어서,
    상기 제2 게이트 구동 드라이버가 상기 메인 게이트 라인에 인가되는 인에이블 펄스보다 짧은 폭의 인에이블 펄스를 상기 서브 게이트 라인에 공급하는 것을 특징으로 하는 액정 패널 구동 회로.
  8. 제 7 항에 있어서,
    상기 서브 게이트 라인에 공급되는 인에이블 펄스와 상기 메인 게이트 라인에 인가되는 인에이블 펄스가 동일한 위상을 가지는 것을 특징으로 하는 액정 패널 구동 회로.
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