KR20050097090A - Field emission display apparatus wherein positive ions are efficiently eliminated - Google Patents
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Abstract
본 발명에 따른 전계 방출 디스플레이 장치는 캐소드 전극 라인들, 게이트 전극 라인들, 형광 셀들, 및 양극판을 포함한다. 캐소드 전극 라인들은 전자 방출원들과 전기적으로 연결된다. 게이트 전극 라인들에서, 캐소드 전극 라인들과 교차되는 영역에 상기 전자 방출원들에 대응하는 관통구들이 형성된다. 형광 셀들은 게이트 전극 라인들의 관통구들에 대응하여 형성된다. 양극판에는 전자 방출원들로부터의 전자들이 형광 셀들로 이동하도록 정극성 전위가 인가된다. 여기에서, 수직 구동 주기가 수직 디스플레이 주기 및 수직 동기 주기를 포함하고, 상기 수직 동기 주기에서 게이트 전극 라인들에 부극성 전위가 인가된다.The field emission display device according to the present invention includes cathode electrode lines, gate electrode lines, fluorescent cells, and a bipolar plate. The cathode electrode lines are electrically connected with the electron emitters. In the gate electrode lines, through holes corresponding to the electron emission sources are formed in an area crossing the cathode electrode lines. The fluorescent cells are formed corresponding to the through holes of the gate electrode lines. A positive potential is applied to the positive electrode plate so that electrons from the electron emission sources move to the fluorescent cells. Here, the vertical driving period includes a vertical display period and a vertical synchronization period, in which a negative potential is applied to the gate electrode lines.
Description
본 발명은, 전계 방출 디스플레이 장치에 관한 것으로서, 보다 상세하게는, 캐소드 전극 라인들, 게이트 전극 라인들, 형광 셀들, 및 양극판을 포함한 전계 방출 디스플레이 장치에 관한 것이다.The present invention relates to a field emission display device, and more particularly, to a field emission display device including cathode electrode lines, gate electrode lines, fluorescent cells, and a bipolar plate.
전계 방출 디스플레이 장치와 관련된 선행 기술로는 2003년 미국 특허출원 공개 번호 제122,118호(명칭 : FED driving method)를 들 수 있다.Prior art related to field emission display devices is US Patent Application Publication No. 122,118 (FED driving method) in 2003.
상기와 같은 통상적인 전계 방출 디스플레이 장치는 기본적으로 캐소드 전극 라인들, 게이트 전극 라인들, 형광 셀들, 및 양극판을 포함한다. 캐소드 전극 라인들은 전자 방출원들과 전기적으로 연결된다. 게이트 전극 라인들에서, 캐소드 전극 라인들과 교차되는 영역에는 전자 방출원들에 대응하는 관통구들이 형성된다. 형광 셀들은 게이트 전극 라인들의 관통구들에 대응하여 형성된다. 양극판에는 전자 방출원들로부터의 전자들이 형광 셀들로 이동하도록 정극성 전위가 인가된다.Such a conventional field emission display device basically includes cathode electrode lines, gate electrode lines, fluorescent cells, and a bipolar plate. The cathode electrode lines are electrically connected with the electron emitters. In the gate electrode lines, through holes corresponding to the electron emission sources are formed in the region crossing the cathode electrode lines. The fluorescent cells are formed corresponding to the through holes of the gate electrode lines. A positive potential is applied to the positive electrode plate so that electrons from the electron emission sources move to the fluorescent cells.
한편, 전자 방출원들로부터의 전자들이 형광 셀들에 충돌하여 형광 셀들이 빛을 발생시킴에 있어서, 정극성 이온들이 발생되어 전계 방출 디스플레이 패널의 내부에 축적된다. 이러한 정극성 이온들은 전계 방출 디스플레이 패널의 동작을 비정상적으로 유도하는 원인이 된다.On the other hand, when electrons from the electron emission sources collide with the fluorescent cells to generate light, the positive ions are generated and accumulated inside the field emission display panel. These positive ions cause abnormal operation of the field emission display panel.
이와 같은 문제점을 해결하기 위한 종래의 전계 방출 디스플레이 장치에서는, 수직 구동 주기가 수직 디스플레이 주기 및 수직 동기 주기로 구분되고, 수직 동기 주기에서 양극판의 정극성 전위가 낮아짐으로써 상기 정극성 이온들이 소거된다.In the conventional field emission display device for solving such a problem, a vertical driving period is divided into a vertical display period and a vertical synchronizing period, and the positive polarity of the positive electrode plate is lowered in the vertical synchronizing period so that the positive ions are erased.
하지만, 상기와 같은 종래의 전계 방출 디스플레이 장치에 의하면, 양극판의 약 1 내지 4 킬로볼트(KV)의 높은 전위가 스위칭되어야 하므로, 상대적으로 큰 스위칭 노이즈가 작용하고, 소자들이 열화되는 문제점들이 있다.However, according to the conventional field emission display device as described above, since a high potential of about 1 to 4 kilovolts (KV) of the positive electrode plate needs to be switched, relatively large switching noise works and there are problems of deteriorating elements.
본 발명의 목적은, 스위칭 노이즈 및 소자 열화를 방지하면서 정극성 이온들이 소거될 수 있는 전계 방출 디스플레이 장치를 제공하는 것이다.It is an object of the present invention to provide a field emission display device in which positive ions can be erased while preventing switching noise and device degradation.
상기 목적을 이루기 위한 본 발명의 전계 방출 디스플레이 장치는 캐소드 전극 라인들, 게이트 전극 라인들, 형광 셀들, 및 양극판을 포함한다. 상기 캐소드 전극 라인들은 전자 방출원들과 전기적으로 연결된다. 상기 게이트 전극 라인들에서, 상기 캐소드 전극 라인들과 교차되는 영역에 상기 전자 방출원들에 대응하는 관통구들이 형성된다. 상기 형광 셀들은 상기 게이트 전극 라인들의 관통구들에 대응하여 형성된다. 상기 양극판에는 상기 전자 방출원들로부터의 전자들이 상기 형광 셀들로 이동하도록 정극성 전위가 인가된다. 여기에서, 수직 구동 주기가 수직 디스플레이 주기 및 수직 동기 주기를 포함하고, 상기 수직 동기 주기에서 상기 게이트 전극 라인들에 부극성 전위가 인가된다.The field emission display device of the present invention for achieving the above object includes cathode electrode lines, gate electrode lines, fluorescent cells, and a bipolar plate. The cathode electrode lines are electrically connected to the electron emission sources. In the gate electrode lines, through holes corresponding to the electron emission sources are formed in an area crossing the cathode electrode lines. The fluorescent cells are formed corresponding to the through holes of the gate electrode lines. A positive potential is applied to the positive electrode plate so that electrons from the electron emission sources move to the fluorescent cells. Here, a vertical driving period includes a vertical display period and a vertical synchronization period, and a negative potential is applied to the gate electrode lines in the vertical synchronization period.
본 발명의 상기 전계 방출 디스플레이 장치에 의하면, 상기 수직 동기 주기에서 상기 게이트 전극 라인들에 부극성 전위가 인가된다. 이에 따라, 상기 게이트 전극 라인들의 상대적으로 낮은 전위가 스위칭되므로, 스위칭 노이즈 및 소자 열화를 방지하면서 정극성 이온들이 소거될 수 있다.According to the field emission display device of the present invention, a negative potential is applied to the gate electrode lines in the vertical synchronization period. Accordingly, since the relatively low potential of the gate electrode lines is switched, the positive ions can be erased while preventing switching noise and device degradation.
이하, 본 발명에 따른 바람직한 실시예가 상세히 설명된다. Hereinafter, preferred embodiments according to the present invention will be described in detail.
도 1을 참조하면, 본 발명의 일 실시예에 의한 전계 방출 디스플레이 장치는 전계 방출 디스플레이 패널(1) 및 그 구동 장치를 포함한다. 전계 방출 디스플레이 패널(1)의 구동 장치는 영상 제어부(4), 셋탑 박스(5), 패널 제어부(6), 주사 구동부(7), 데이터 구동부(8), 및 전원 공급부(9)를 포함한다.Referring to FIG. 1, a field emission display device according to an embodiment of the present invention includes a field emission display panel 1 and a driving device thereof. The driving device of the field emission display panel 1 includes an image controller 4, a set-top box 5, a panel controller 6, a scan driver 7, a data driver 8, and a power supply 9. .
영상 제어부(4)는 컴퓨터로부터의 영상 신호(SPC), DVD(digital versatile disk) 플레이어로부터의 영상 신호(SDVD), 및 셋탑 박스(5)로부터의 영상 신호를 처리하여 패널 제어부(6)에 입력시킨다. 셋탑 박스(5)는 텔레비젼으로부터의 영상 신호(STV)를 변환하여 영상 제어부(4)에 입력시킨다.Image control section 4 includes an image signal from a computer (S PC), DVD (digital versatile disk) video signal (S DVD), and processes the video signal from the set-top box 5, the panel control unit 6 from the player To enter. The set top box 5 converts the video signal STV from the television and inputs it to the video control unit 4.
패널 제어부(6)는 영상 제어부(4)로부터의 영상 신호를 처리하여 주사-구동 제어 신호들 및 데이터-구동 제어 신호들을 발생시킨다. 주사 구동부(7)는 패널 제어부(6)로부터의 주사-구동 제어 신호들에 따라 전계 방출 디스플레이 패널(1)의 제1 게이트 전극 라인들(G1,...,Gn)을 구동한다. 데이터 구동부(8)는 패널 제어부(6)로부터의 데이터-구동 제어 신호들에 따라 전계 방출 디스플레이 패널(1)의 캐소드 전극 라인들(CR1,...,CBm)을 구동한다.The panel controller 6 processes the image signal from the image controller 4 to generate scan-drive control signals and data-drive control signals. The scan driver 7 drives the first gate electrode lines G 1 ,..., G n of the field emission display panel 1 in accordance with scan-drive control signals from the panel controller 6. The data driver 8 drives the cathode electrode lines C R1 ,..., C Bm of the field emission display panel 1 in accordance with data-driven control signals from the panel controller 6.
전원 공급부(9)는 영상 제어부(4), 셋탑 박스(5), 패널 제어부(6), 주사 구동부(7), 데이터 구동부(8), 및 전계 방출 디스플레이 패널(1)의 양극(도 2의 22)과 제2 게이트 전극판(도 2의 36)에 필요한 전위들을 인가한다. 여기에서, 양극판(도 2의 22)에는 1 내지 4 킬로볼트(KV)의 높은 전위가 인가된다. The power supply unit 9 is an anode of the image controller 4, the set-top box 5, the panel controller 6, the scan driver 7, the data driver 8, and the field emission display panel 1 (see FIG. 2). 22 and the potentials required for the second gate electrode plate (36 in FIG. 2) are applied. Here, a high potential of 1 to 4 kilovolts (KV) is applied to the positive electrode plate (22 in Fig. 2).
도 2를 참조하면, 도 1의 전계 방출 디스플레이 패널(1)은 앞쪽 패널(2)과 뒤쪽 패널(3)이 스페이스 바아(space bar)들(41,...,43)에 의하여 지지된다. 여기에서, 도 2에 도시된 스페이스 바아들(41,...,43) 외에도 다수의 스페이스 바아들이 제2 게이트 전극판(36) 위에 존재한다. Referring to FIG. 2, in the field emission display panel 1 of FIG. 1, the front panel 2 and the rear panel 3 are supported by space bars 41,..., 43. Here, in addition to the space bars 41,..., 43 shown in FIG. 2, a plurality of space bars exist on the second gate electrode plate 36.
뒤쪽 패널(3)은 뒤쪽 기판(31), 캐소드 전극 라인들(CR1,...,CBm), 전자 방출원들(ER11,...,EBnm), 제1 절연층(33), 제1 게이트 전극 라인들(G1,...,G n), 제2 절연층(35), 및 제2 게이트 전극판(36)을 포함한다.The rear panel 3 includes the rear substrate 31, the cathode electrode lines C R1 , ..., C Bm , the electron emission sources E R11 , ..., E Bnm , and the first insulating layer 33. ), First gate electrode lines G 1 ,..., G n , a second insulating layer 35, and a second gate electrode plate 36.
데이터 신호들이 인가되는 캐소드 전극 라인들(CR1,...,CBm)은 전자 방출원들(ER11,...,EBnm)과 전기적으로 연결된다. 제1 절연층(33), 제1 게이트 전극 라인들(G1,...,Gn), 제2 절연층(35), 및 제2 게이트 전극판(36)에는 전자 방출원들(ER11,...,EBnm)에 대응하는 관통구들(HR11,...,HBnm )이 형성된다. 따라서, 주사 신호들이 인가되는 제1 게이트 전극 라인들(G1,...,Gn)에서, 캐소드 전극 라인들(CR1,...,CBm)과 교차되는 영역에 관통구들(HR11,...,HBnm )이 형성된다. 제2 게이트 전극판(36)에는 포커싱 신호가 인가된다.The cathode electrode lines C R1 , ..., C Bm to which data signals are applied are electrically connected to the electron emission sources E R11 , ..., E Bnm . Electron emission sources E are formed in the first insulating layer 33, the first gate electrode lines G 1 ,..., G n , the second insulating layer 35, and the second gate electrode plate 36. R11, ..., E Bnm) through phrases (R11 H, corresponding to ..., is formed with H Bnm). Thus, the scanning signals are applied to the first gate electrode lines (G 1, ..., G n) in, the line through the cathode electrode in a region intersecting with (C R1, ..., Bm C) spheres (H R 11 ,..., H Bnm ) is formed. The focusing signal is applied to the second gate electrode plate 36.
앞쪽 패널(2)은 앞쪽 투명 기판(21), 양극판(22), 및 형광 셀들(FR11,...,FBnm)을 포함한다. 형광 셀들(FR11,...,FBnm )은 제2 게이트 전극판(36)의 관통구들(HR11,...,HBnm)에 대응하여 형성된다. 양극판(22)에는 전자 방출원들(ER11,...,EBnm)로부터의 전자들이 형광 셀들로 이동하도록 1 내지 4 킬로볼트(KV)의 높은 정극성 전위가 인가된다.The front panel 2 includes a front transparent substrate 21, a positive electrode plate 22, and fluorescent cells F R11 ,..., F Bnm . The fluorescent cells F R11 ,..., F Bnm are formed corresponding to the through holes H R11 ,..., H Bnm of the second gate electrode plate 36. A high positive potential of 1 to 4 kilovolts (KV) is applied to the positive electrode plate 22 so that electrons from the electron emission sources E R11 ,..., E Bnm move to the fluorescent cells.
도 3은 도 2의 제1 게이트 전극 라인들(G1,...,Gn) 및 제2 게이트 전극판(36)에 인가되는 구동 신호들의 제1 예를 보여준다. 도 3에서 참조 부호 SG1은 제1 게이트 전극 라인들(G1,...,Gn)중에서 제1 게이트 전극 라인(도 2의 G 1)에 인가되는 구동 신호를, SG2는 제1 게이트 전극 라인들(G1,...,Gn)중에서 제2 게이트 전극 라인에 인가되는 구동 신호를, SGn은 제1 게이트 전극 라인들(G1,...,G n)중에서 제n 게이트 전극 라인(도 2의 Gn)에 인가되는 구동 신호를, 그리고 S36은 제2 게이트 전극판(도 2의 36)에 인가되는 구동 신호를 각각 가리킨다.3 illustrates a first example of driving signals applied to the first gate electrode lines G 1 ,..., G n of FIG. 2 and the second gate electrode plate 36. Reference numeral S in Fig. 3 G1 is the first gate electrode lines (G 1, ..., G n ) a drive signal applied to the first gate electrode lines (G 1 in FIG. 2) in, S G2 is first among the gate electrode lines (G 1, ..., G n ) of the driving signal applied to the second gate electrode in a line, s is the Gn of the first gate electrode lines (G 1, ..., G n ) the The driving signal applied to the n gate electrode line (G n of FIG. 2), and S 36 indicates the driving signal applied to the second gate electrode plate (36 of FIG. 2), respectively.
도 2 및 3을 참조하면, 수직 구동 주기(TVDR)는 수직 디스플레이 주기(TDISP) 및 수직 동기 주기(TVSYN)를 포함한다.2 and 3, the vertical driving period T VDR includes a vertical display period T DISP and a vertical synchronization period T VSYN .
수직 디스플레이 주기(TDISP)에 있어서, 각각의 수평 구동 주기(THDR)에 상응하는 시간에서 제1 게이트 전극 라인들(G1,...,Gn) 각각에 정극성 전위(+Vg1)의 주사 펄스가 순차적으로 인가된다. 이와 동시에 각각의 주사 펄스에 상응하는 데이터 신호들이 캐소드 전극 라인들(CR1,...,CBm)에 인가된다. 펄스폭 변조(Pulse Width Modulation) 방식인 경우, 캐소드 전극 라인들(CR1,...,CBm)에 인가되는 데이터 신호의 펄스폭이 계조에 따라 변한다. 전압 변조(Amplitude Modulation) 방식인 경우, 캐소드 전극 라인들(CR1,...,CBm)에 인가되는 데이터 신호의 펄스 전위가 계조에 따라 변한다. 제2 게이트 전극판(36)에는 관통구들(HR11,...,HBnm)로부터의 전자들의 포커싱을 위한 정극성 전위(+Vg2)가 인가된다.In the vertical display period T DISP , the positive potential (+ Vg1) is applied to each of the first gate electrode lines G 1 ,..., G n at a time corresponding to each horizontal driving period T HDR . Scan pulses are sequentially applied. At the same time, data signals corresponding to the respective scan pulses are applied to the cathode electrode lines C R1 ,..., C Bm . In the case of the pulse width modulation method, the pulse width of the data signal applied to the cathode electrode lines C R1 ,..., C Bm varies according to the gray level. In the case of the voltage modulation method, the pulse potential of the data signal applied to the cathode electrode lines C R1 ,..., C Bm varies according to the gray level. A positive potential (+ Vg 2) for focusing electrons from the through holes H R11 ,..., H Bnm is applied to the second gate electrode plate 36.
다음에, 수직 구동 주기(TVDR)에서 제1 게이트 전극 라인들(G1,...,Gn)에 부극성 전위(-Vg1)가 인가된다. 이에 따라, 수직 디스플레이 주기(TDISP)에서 발생되어 축적된 정극성 이온들이 제1 게이트 전극 라인들(G1,...,Gn)을 통하여 효율적으로 소거될 수 있다. 즉, 제1 게이트 전극 라인들(G1,...,Gn)의 상대적으로 낮은 전위가 스위칭되므로, 스위칭 노이즈 및 소자 열화를 방지하면서 정극성 이온들이 소거될 수 있다.Next, the negative potential -Vg1 is applied to the first gate electrode lines G 1 ,..., G n in the vertical driving period T VDR . Accordingly, the positive ions generated and accumulated in the vertical display period T DISP may be efficiently erased through the first gate electrode lines G 1 ,..., G n . That is, since relatively low potentials of the first gate electrode lines G 1 ,..., G n are switched, the positive ions can be erased while preventing switching noise and device degradation.
도 4는 도 2의 제1 게이트 전극 라인들(G1,...,Gn) 및 제2 게이트 전극판(36)에 인가되는 구동 신호들의 제2 예를 보여준다. 도 4에서 도 3과 동일한 참조 부호는 동일한 기능의 대상을 가리킨다.4 illustrates a second example of driving signals applied to the first gate electrode lines G 1 ,..., G n of FIG. 2 and the second gate electrode plate 36. In FIG. 4, the same reference numerals as used in FIG. 3 indicate objects of the same function.
수직 디스플레이 주기(TDISP)에서의 구동 파형들은 도 3을 참조하여 설명된 바와 같다.The drive waveforms in the vertical display period T DISP are as described with reference to FIG. 3.
다음에, 수직 구동 주기(TVDR)에서 제2 게이트 전극판(36)에 부극성 전위(-Vg2)가 인가된다. 이에 따라, 수직 디스플레이 주기(TDISP)에서 발생되어 축적된 정극성 이온들이 제2 게이트 전극판(36)을 통하여 효율적으로 소거될 수 있다. 즉, 제2 게이트 전극판(36)의 상대적으로 낮은 전위가 스위칭되므로, 스위칭 노이즈 및 소자 열화를 방지하면서 정극성 이온들이 소거될 수 있다.Next, in the vertical driving period T VDR , the negative potential -Vg2 is applied to the second gate electrode plate 36. Accordingly, the positive ions generated and accumulated in the vertical display period T DISP may be efficiently erased through the second gate electrode plate 36. That is, since the relatively low potential of the second gate electrode plate 36 is switched, the positive ions can be erased while preventing switching noise and device deterioration.
도 5는 도 2의 제1 게이트 전극 라인들(G1,...,Gn) 및 제2 게이트 전극판(36)에 인가되는 구동 신호들의 제3 예를 보여준다. 도 5에서 도 3과 동일한 참조 부호는 동일한 기능의 대상을 가리킨다.5 illustrates a third example of driving signals applied to the first gate electrode lines G 1 ,..., G n of FIG. 2 and the second gate electrode plate 36. In FIG. 5, the same reference numerals as used in FIG. 3 indicate objects of the same function.
수직 디스플레이 주기(TDISP)에서의 구동 파형들은 도 3을 참조하여 설명된 바와 같다.The drive waveforms in the vertical display period T DISP are as described with reference to FIG. 3.
다음에, 수직 구동 주기(TVDR)에서 제1 게이트 전극 라인들(G1,...,Gn)에 부극성 전위(-Vg1)가 인가됨과 동시에 제2 게이트 전극판(36)에도 부극성 전위(-Vg2)가 인가된다. 이에 따라, 수직 디스플레이 주기(TDISP)에서 발생되어 축적된 정극성 이온들이 제1 게이트 전극 라인들(G1,...,Gn) 및 제2 게이트 전극판(36)을 통하여 효율적으로 소거될 수 있다. 즉, 제1 게이트 전극 라인들(G1,...,Gn) 및 제2 게이트 전극판(36)의 상대적으로 낮은 전위들이 스위칭되므로, 스위칭 노이즈 및 소자 열화를 방지하면서 정극성 이온들이 소거될 수 있다.Next, the negative potential (-Vg1) is applied to the first gate electrode lines G 1 ,..., G n in the vertical driving period T VDR , and is also applied to the second gate electrode plate 36. Polarity potential (-Vg2) is applied. Accordingly, the positive ions generated and accumulated in the vertical display period T DISP are efficiently erased through the first gate electrode lines G 1 ,..., G n and the second gate electrode plate 36. Can be. That is, since relatively low potentials of the first gate electrode lines G 1 ,..., G n and the second gate electrode plate 36 are switched, the positive ions are erased while preventing switching noise and device degradation. Can be.
이상 설명된 바와 같이, 본 발명에 따른 전계 방출 디스플레이 장치에 의하면, 수직 동기 주기에서 제1 게이트 전극 라인들 및/또는 제2 게이트 전극판에 부극성 전위가 인가된다. 이에 따라, 제1 게이트 전극 라인들 및/또는 제2 게이트 전극판의 상대적으로 낮은 전위들이 스위칭되므로, 스위칭 노이즈 및 소자 열화를 방지하면서 정극성 이온들이 소거될 수 있다.As described above, according to the field emission display device according to the present invention, a negative potential is applied to the first gate electrode lines and / or the second gate electrode plate in the vertical synchronization period. Accordingly, since relatively low potentials of the first gate electrode lines and / or the second gate electrode plate are switched, the positive ions can be erased while preventing switching noise and device degradation.
본 발명은, 상기 실시예에 한정되지 않고, 청구범위에서 정의된 발명의 사상 및 범위 내에서 당업자에 의하여 변형 및 개량될 수 있다.The present invention is not limited to the above embodiments, but may be modified and improved by those skilled in the art within the spirit and scope of the invention as defined in the claims.
도 1은 본 발명의 일 실시예에 의한 전계 방출 디스플레이 장치의 구성을 보여주는 블록도이다.1 is a block diagram showing the configuration of a field emission display device according to an embodiment of the present invention.
도 2는 도 1의 전계 방출 디스플레이 패널을 보여주는 분리 사시도이다.FIG. 2 is an exploded perspective view illustrating the field emission display panel of FIG. 1.
도 3은 도 2의 제1 게이트 전극 라인들 및 제2 게이트 전극판에 인가되는 구동 신호들의 제1 예를 보여주는 타이밍도이다.3 is a timing diagram illustrating a first example of driving signals applied to the first gate electrode lines and the second gate electrode plate of FIG. 2.
도 4는 도 2의 제1 게이트 전극 라인들 및 제2 게이트 전극판에 인가되는 구동 신호들의 제2 예를 보여주는 타이밍도이다.4 is a timing diagram illustrating a second example of driving signals applied to the first gate electrode lines and the second gate electrode plate of FIG. 2.
도 5는 도 2의 제1 게이트 전극 라인들 및 제2 게이트 전극판에 인가되는 구동 신호들의 제3 예를 보여주는 타이밍도이다.5 is a timing diagram illustrating a third example of driving signals applied to the first gate electrode lines and the second gate electrode plate of FIG. 2.
<도면의 주요 부분에 대한 부호의 설명><Description of the symbols for the main parts of the drawings>
1...전계 방출 디스플레이 패널, 2...앞쪽 패널,1 ... field emission display panel, 2 ... front panel,
21...앞쪽 기판, 22...양극판,21 the front substrate, 22 the positive plate,
FR11,...,FBnm...형광 셀들, 3...뒤쪽 패널,F R11 , ..., F Bnm ... fluorescent cells, 3 ... rear panel,
31...뒤쪽 기판, CR1,...,CBm...캐소드 전극 라인들,31 ... rear substrate, C R1 , ..., C Bm ... cathode electrode lines,
ER11,...,EBnm...전자 방출원들, 33...제1 절연층,E R11 , ..., E Bnm ... electron emitters, 33 ... first insulating layer,
G1,...,Gn...제1 게이트 전극 라인들, 35...제2 절연층,G 1 , ..., G n ... first gate electrode lines, 35 ... second insulating layer,
36...제2 게이트 전극판, HR11,...,HBnm...관통구들,36 ... second gate electrode plate, H R11 , ..., H Bnm ... through holes,
41,...,43...스페이스 바아들.41, ..., 43 ... space bars.
Claims (5)
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1020040021817A KR20050097090A (en) | 2004-03-30 | 2004-03-30 | Field emission display apparatus wherein positive ions are efficiently eliminated |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1020040021817A KR20050097090A (en) | 2004-03-30 | 2004-03-30 | Field emission display apparatus wherein positive ions are efficiently eliminated |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| KR20050097090A true KR20050097090A (en) | 2005-10-07 |
Family
ID=37276955
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| KR1020040021817A KR20050097090A (en) | 2004-03-30 | 2004-03-30 | Field emission display apparatus wherein positive ions are efficiently eliminated |
Country Status (1)
| Country | Link |
|---|---|
| KR (1) | KR20050097090A (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100846598B1 (en) * | 2007-01-26 | 2008-07-16 | 삼성에스디아이 주식회사 | Gas excitation display apparatus performing double scan |
-
2004
- 2004-03-30 KR KR1020040021817A patent/KR20050097090A/en not_active Application Discontinuation
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
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