KR20050041141A - 플라즈마 디스플레이 패널 구동방법 - Google Patents

플라즈마 디스플레이 패널 구동방법 Download PDF

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Abstract

본 발명은 리셋 주기에서의 방전을 선택적으로 억제하여 콘트라스트비를 향상시키고, 리셋 주기에 X 전극에 인가되는 전압의 레벨을 상승시켜 어드레스 동작마진을 확보할 수 있는 플라즈마 디스플레이 패널 구동방법에 관한 것이다. 본 발명에 의한 플라즈마 디스플레이 패널의 구동 방법은, X 전극 라인들과 Y 전극 라인들이 교대로 나란히 배열되는 유지전극 라인 쌍들에 대하여 어드레스 전극 라인들이 교차되는 영역에 방전셀들이 형성되는 플라즈마 디스플레이 패널에 대하여, 디스플레이 주기로서의 프레임마다 시분할 계조 디스플레이를 위하여 각각의 계조 가중치를 갖는 복수의 서브-필드들이 존재하고, 각각의 서브-필드마다 리셋 주기, 어드레스 주기, 및 유지방전 주기들이 존재한다. 리셋 주기가, Y 전극 라인들에 제1 레벨로부터 제2 레벨까지 지속적으로 상승하는 상승 램프 펄스 파형의 전압이 인가되는 제1 리셋 주기와, X 전극 라인들이 제4 레벨의 전압으로 바이어싱되고 Y 전극 라인들에 제1 레벨로부터 제3 레벨까지 지속적으로 하강하는 하강 램프 펄스 파형의 전압이 순차적으로 인가되는 제2 리셋 주기를 포함하여 이루어진다. 선택된 서브-필드의 리셋 주기에서는, 제1 리셋 주기가 생략되고, 선택된 서브-필드의 제2 리셋 주기에 X 전극 라인들이 제4 레벨보다 높은 제5 레벨의 전압으로 바이어싱된다.

Description

플라즈마 디스플레이 패널 구동방법{Driving method of plasma display panel}
본 발명은 플라즈마 디스플레이 패널 구동방법에 관한 것으로서, 보다 상세하게는 리셋 주기에서의 방전을 선택적으로 억제하여 콘트라스트비를 향상시키고, 리셋 주기에 X 전극에 인가되는 전압의 레벨을 상승시켜 어드레스 동작마진을 확보할 수 있는 플라즈마 디스플레이 패널 구동방법에 관한 것이다.
도 1은 통상적인 3-전극 면방전 방식의 플라즈마 디스플레이 패널의 구조를 보여주는 내부 사시도이다. 도 2는 도 1의 패널의 단위 디스플레이 셀의 구성을 보여주는 단면도이다.
도면을 참조하면, 통상적인 면방전 플라즈마 디스플레이 패널(1)의 앞쪽 및 뒤쪽 글라스 기판들(10, 13) 사이에는, 어드레스 전극 라인들(AR1, AG1, ..., A Gm, ABm), 유전층(11, 15), Y 전극 라인들(Y1, ..., Yn), X 전극 라인들(X 1, ..., Xn), 형광층(16), 격벽(17) 및 보호층으로서의 일산화마그네슘(MgO)층(12)이 마련되어 있다.
어드레스 전극 라인들(AR1, AG1, ..., AGm, ABm)은 뒤쪽 글라스 기판(13)의 앞쪽에 일정한 패턴으로 형성된다. 아래쪽 유전층(15)은 어드레스 전극 라인들(AR1, AG1, ..., AGm, ABm)의 앞쪽에서 전면(全面) 도포된다. 아래쪽 유전층(15)의 앞쪽에는 격벽(17)들이 어드레스 전극 라인들(AR1, AG1, ..., AGm, ABm )과 평행한 방향으로 형성된다. 이 격벽(17)들은 각 방전셀의 방전 영역을 구획하고 각 방전셀 사이의 광학적 간섭(cross talk)을 방지하는 기능을 한다. 형광층(16)은, 격벽(17)들 사이에서 형성된다.
X 전극 라인들(X1, ..., Xn)과 Y 전극 라인들(Y1, ..., Yn)은 어드레스 전극 라인들(AR1, AG1, ..., AGm, ABm)과 직교되도록 앞쪽 글라스 기판(10)의 뒤쪽에 일정한 패턴으로 형성된다. 각 교차점은 상응하는 방전셀을 설정한다. 각 X 전극 라인(X1, ..., Xn)과 각 Y 전극 라인(Y1, ..., Yn)은 ITO(Indium Tin Oxide) 등과 같은 투명한 도전성 재질의 투명 전극 라인과 전도도를 높이기 위한 금속 전극 라인이 결합되어 형성된다. 앞쪽 유전층(11)은 X 전극 라인들(X1, ..., Xn)과 Y 전극 라인들(Y1, ..., Yn)의 뒤쪽에 전면(全面) 도포되어 형성된다. 강한 전계로부터 패널(1)을 보호하기 위한 보호층(12) 예를 들어, 일산화마그네슘(MgO)층은 앞쪽 유전층(11)의 뒤쪽에 전면 도포되어 형성된다. 방전 공간(14)에는 플라즈마 형성용 가스가 밀봉된다.
상기한 바와 같은 구조의 플라즈마 디스플레이 패널(1)의 구동방법으로, 주로 사용되는 어드레스-디스플레이 분리 구동방법이 미국특허 제5541618호에 개시되어 있다.
도 3은 도 1의 플라즈마 디스플레이 패널의 통상적인 구동 장치를 보여주는 블록도이다.
플라즈마 표시 패널(1)의 통상적인 구동 장치(2)는 영상 처리부(26), 논리 제어부(22), 어드레스 구동부(23), X 구동부(24) 및 Y 구동부(25)를 포함한다. 영상 처리부(26)는 외부 아날로그 영상 신호를 디지털 신호로 변환하여 내부 영상 신호 예를 들어, 각각 8 비트의 적색(R), 녹색(G) 및 청색(B) 영상 데이터, 클럭 신호, 수직 및 수평 동기 신호들을 발생시킨다. 논리 제어부(22)는 영상 처리부(26)로부터의 내부 영상 신호에 따라 구동 제어 신호들(SA, SY, SX)을 발생시킨다.
이때, 어드레스 구동부(23), X 구동부(24) 및 Y 구동부(25) 등의 구동부에서 상기 구동 제어 신호들(SA, SY, SX)로부터 입력받아 각각의 구동 신호들을 발생시키고, 발생된 구동 신호를 각각의 전극 라인들에 인가한다.
즉, 어드레스 구동부(23)는, 논리 제어부(22)로부터의 구동 제어 신호들(SA, SY, SX)중에서 어드레스 신호(SA)를 처리하여 표시 데이터 신호를 발생시키고, 발생된 표시 데이터 신호를 어드레스 전극 라인들에 인가한다. X 구동부(24)는 논리 제어부(22)로부터의 구동 제어 신호들(SA, SY, SX)중에서 X 구동 제어 신호(S X)를 처리하여 X 전극 라인들에 인가한다. Y 구동부(25)는 논리 제어부(22)로부터의 구동 제어 신호들(SA, SY, SX)중에서 Y 구동 제어 신호(SY)를 처리하여 Y 전극 라인들에 인가한다.
도 4는 도 1의 플라즈마 디스플레이 패널의 통상적인 구동 방법을 보여주는 타이밍도이다.
도면을 참조하면, 단위 프레임은 시분할 계조 표시를 실현하기 위하여 8 개의 서브필드들(SF1, ..., SF8)로 분할된다. 또한, 각 서브필드(SF1, ..., SF8)는 리셋 주기(R1,..., R8)와, 어드레스 주기(A1, ..., A8)및, 유지방전 주기(S1, ..., S8)로 분할된다.
플라즈마 디스플레이 패널의 휘도는 단위 프레임에서 차지하는 유지방전 주기(S1, ..., S8)의 길이에 비례한다. 단위 프레임에서 차지하는 유지방전 주기(S1, ..., S8)의 길이는 255T(T는 단위 시간)이다. 이때, 제 n 서브필드(SFn)의 유지방전 주기(Sn)에는 2n에 상응하는 시간이 각각 설정된다. 이에 따라, 8 개의 서브필드들중에서 표시될 서브필드를 적절히 선택하면, 어느 서브필드에서도 표시되지 않는 0(영) 계조를 포함하여 모두 256 계조의 표시가 수행될 수 있음을 알 수 있다.
도 5는 도 4의 단위 서브-필드에서 도 1의 플라즈마 디스플레이 패널의 전극 라인들에 인가되는 구동 신호들을 보여주는 타이밍도이다.
도 5에서 참조부호 SAR1..ABm은 각 어드레스 전극 라인(도 1의 AR1, AG1 , ..., AGm, ABm)에 인가되는 구동 신호를, SX1..Xn은 X 전극 라인들(도 1의 X 1, ..., Xn)에 인가되는 구동 신호를, 그리고 SY1..Yn은 각 Y 전극 라인(도 1의 Y1, ..., Yn )에 인가되는 구동 신호를 가리킨다.
도면을 참조하면, 단위 서브-필드(SF)의 리셋 주기(PR)에서는, 먼저 X 전극 라인들(X1, ..., Xn)에 인가되는 전압을 접지 전압(VG)으로부터 제2 전압(V S) 예를 들어, 155 볼트(V)까지 지속적으로 상승시킨다. 여기서, Y 전극 라인들(Y1, ..., Yn)과 어드레스 전극 라인들(AR1, AG1, ..., AGm, ABm )에는 접지 전압(VG)이 인가된다.
다음에, Y 전극 라인들(Y1, ..., Yn)에 인가되는 전압이 제2 전압(VS) 예를 들어, 155 볼트(V)부터 제2 전압(VS)보다 제3 전압(VSET)만큼 더 높은 최고 전압(VSET+VS) 예를 들어, 355 볼트(V)까지 지속적으로 상승된다. 여기서, X 전극 라인들(X1, ..., Xn)과 어드레스 전극 라인들(AR1, AG1, ..., AGm, ABm)에는 접지 전압(VG)이 인가된다.
다음에, X 전극 라인들(X1, ..., Xn)에 인가되는 전압이 제2 전압(VS)으로 유지된 상태에서, Y 전극 라인들(Y1, ..., Yn)에 인가되는 전압이 제2 전압(VS )으로부터 접지 전압(VG)까지 지속적으로 하강된다. 여기서, 어드레스 전극 라인들(AR1, AG1, ..., AGm, ABm)에는 접지 전압(VG)이 인가된다.
이에 따라, 이어지는 어드레스 주기(PA)에서, 어드레스 전극 라인들에 표시 데이터 신호가 인가되고, 제2 전압(VS)보다 낮은 제4 전압(VSCAN)으로 바이어싱된 Y 전극 라인들(Y1, ..., Yn)에 접지 전압(VG)의 주사 신호가 순차적으로 인가됨에 따라, 원활한 어드레싱이 수행될 수 있다. 각 어드레스 전극 라인(AR1, AG1, ..., A Gm, ABm)에 인가되는 표시 데이터 신호는 방전셀을 선택할 경우에 정극성 어드레스 전압(VA)이, 그렇지 않을 경우에 접지 전압(VG)이 인가된다. 이에 따라 접지 전압(VG)의 주사 펄스가 인가되는 동안에 정극성 어드레스 전압(VA)의 표시 데이터 신호가 인가되면 상응하는 방전셀에서 어드레스 방전에 의하여 벽전하들이 형성되며, 그렇지 않은 방전셀에서는 벽전하들이 형성되지 않는다. 여기서, 보다 정확하고 효율적인 어드레스 방전을 위하여, X 전극 라인들(X1, ..., Xn)에 제2 전압(V S)이 인가된다.
이어지는 유지방전 주기(PS)에서는, 모든 Y 전극 라인들(Y1, ..., Yn)과 X 전극 라인들(X1, ..., Xn)에 제2 전압(VS)의 디스플레이 유지 펄스가 교호하게 인가되어, 상응하는 어드레스 주기(PA)에서 벽전하들이 형성된 방전셀들에서 디스플레이 유지를 위한 방전을 일으킨다.
도 6은 선택적 리셋 방법에 의한 플라즈마 디스플레이 패널의 구동 방법을 보여주는 타이밍도이다. 도 7은 도 6의 플라즈마 디스플레이 패널의 구동방법에 의한 경우, 제2 리셋 구동 방법에서의 제2 리셋 주기의 종료 후의 벽전하 분포를 도시한 도면이다.
도면을 참조하면, 선택적 리셋 방법에 의한 플라즈마 디스플레이 패널의 구동 방법은 서로 다른 리셋 구동 방법을 서브-필드마다 다르게 적용하는 것이다. 도시한 예의 경우에는 두 가지의 리셋 구동 방법이 있고, 첫 번째 서브-필드에서는 제1 리셋 구동 방법(PRA)을 적용하였고, 둘째 및 셋째 서브-필드에서는 제2 리셋 구동 방법(PRB)을 적용하였다.
플라즈마 디스플레이 패널의 구동 방법은, X 전극 라인들(도 1의 X1, ..., Xn)과 Y 전극 라인들(도 1의 Y1, ..., Yn)이 교대로 나란히 배열되는 유지전극 라인 쌍들에 대하여 어드레스 전극 라인들(도 1의 AR1, AG1, ..., AGm, A Bm)이 교차되는 영역에 방전셀들이 형성되는 플라즈마 디스플레이 패널에 대하여, 디스플레이 주기로서의 프레임마다 시분할 계조 디스플레이를 위한 복수의 서브-필드(SF)들이 존재하고, 상기 각각의 서브-필드(SF)마다 리셋 주기(PR), 어드레스 주기(PA), 및 유지방전 주기(PS)들이 존재한다.
상기 리셋 주기가, 상기 Y 전극 라인들에 제1 레벨(Vs)로부터 제2 레벨(Vs+Vset)까지 지속적으로 상승하는 상승 램프 펄스 파형의 전압이 인가되는 제1 리셋 주기(PR0)와, 상기 X 전극 라인들이 제4 레벨의 전압(V4)으로 바이어싱되고, 상기 Y 전극 라인들에 상기 제1 레벨(Vs)로부터 제3 레벨(V3)까지 지속적으로 하강하는 하강 램프 펄스 파형의 전압이 순차적으로 인가되는 제2 리셋 주기(PR1)를 포함하여 이루어진다.
이때, 제1 리셋 구동 방법(PRA)에서는 제1 리셋 주기(PR0)와 제2 리셋 주기(PR1)가 모두 존재하고, 제2 리셋 구동 방법(PRB)에서는 제2 리셋 주기(PR2)만 존재한다. 따라서, 제2 리셋 구동 방법(PRB)에서는 제1 리셋 주기(PR0)가 생략되어 리셋 주기(PR)에 발생할 수 있는 방전이 약화되어, 패널에 표시되는 화상의 콘트라스트를 향상시킬 수 있다.
이때, 콘트라스트는 패널에서 표시되는 화상에서 가장 밝은 피크 화이트(peak white)의 휘도와 가장 어두운 방전이 없을 때의 휘도의 비로써 표현되는데, 피크 화이트는 주로 유지 방전에 의하여 발생된 빛으로 구성되고, 가장 어두운 부분은 리셋 방전에 의하여 발생된 빛으로 구성된다. 따라서, 콘트라스트를 향상시키기 위해서는 밝은 부분을 더욱 밝게 하거나 어두운 부분을 더욱 어둡게 함으로써 구현하는데, 후자의 방법에 의하면 방전이 없을 때의 백그라운드 휘도가 낮을수록 콘트라스트는 향상된다.
하지만, 도 7에서 도시한 제2 리셋 구동 방법에서의 제2 리셋 주기의 종료 후의 벽전하 분포에서와 같이, 이 경우에 리셋 주기(PR)에서 충분한 방전을 일으키지 못하여, 어드레스 동작마진을 충분히 확보할 수 없어 안정적인 어드레스 방전을 일으키지 못할 수 있는 문제점이 있다.
본 발명은 상기와 같은 문제점을 해결하기 위한 것으로, 리셋 주기에서의 방전을 선택적으로 억제하여 콘트라스트비를 향상시키고, 리셋 주기에 X 전극에 인가되는 전압의 레벨을 상승시켜 어드레스 동작마진을 확보할 수 있는 플라즈마 디스플레이 패널 구동방법을 제공하는 것을 목적으로 한다.
상기와 같은 목적을 달성하기 위한 본 발명에 의한 플라즈마 디스플레이 패널의 구동 방법은, X 전극 라인들과 Y 전극 라인들이 교대로 나란히 배열되는 유지전극 라인 쌍들에 대하여 어드레스 전극 라인들이 교차되는 영역에 방전셀들이 형성되는 플라즈마 디스플레이 패널에 대하여, 디스플레이 주기로서의 프레임마다 시분할 계조 디스플레이를 위하여 각각의 계조 가중치를 갖는 복수의 서브-필드들이 존재하고, 각각의 서브-필드마다 리셋 주기, 어드레스 주기, 및 유지방전 주기들이 존재한다. 리셋 주기가, Y 전극 라인들에 제1 레벨로부터 제2 레벨까지 지속적으로 상승하는 상승 램프 펄스 파형의 전압이 인가되는 제1 리셋 주기와, X 전극 라인들이 제4 레벨의 전압으로 바이어싱되고 Y 전극 라인들에 제1 레벨로부터 제3 레벨까지 지속적으로 하강하는 하강 램프 펄스 파형의 전압이 순차적으로 인가되는 제2 리셋 주기를 포함하여 이루어진다. 선택된 서브-필드의 리셋 주기에서는, 제1 리셋 주기가 생략되고, 선택된 서브-필드의 제2 리셋 주기에 X 전극 라인들이 제4 레벨보다 높은 제5 레벨의 전압으로 바이어싱된다.
이때, 제3 레벨이 접지 레벨보다 높은 것이 바람직하다.
또한, 제5 레벨과 제3 레벨의 차가 제4 레벨과 같은 것이 바람직하다.
어드레스 주기에는, X 전극 라인들이 제4 레벨로 바이어싱되고, Y 전극 라인들이 제6 레벨로 바이어싱된 상태에서, Y 전극 라인들에 기준 레벨의 주사 신호가 순차적으로 인가됨에 따라 어드레싱이 수행된다.
제5 레벨이 제1 레벨과 같은 것이 바람직하다.
제4 레벨이 제1 레벨과 같은 것이 바람직하다.
선택된 서브-필드가, 계조 가중치가 가장 작은 적어도 하나 이상의 서브-필드인 것이 바람직하다.
선택된 서브-필드가, 프레임 내의 각각의 방전셀에서 한 번도 선택되지 아니한 계조 가중치의 서브-필드인 것이 바람직하다.
이때, 선택된 서브-필드가, 하나의 프레임 내의 각각의 방전셀에서 동일한 개수인 것이 바람직하다.
본 발명의 다른 측면에 따른 플라즈마 디스플레이 패널의 구동 방법은, X 전극 라인들과 Y 전극 라인들이 교대로 나란히 배열되는 유지전극 라인 쌍들에 대하여 어드레스 전극 라인들이 교차되는 영역에 방전셀들이 형성되는 플라즈마 디스플레이 패널에 대하여, 디스플레이 주기로서의 프레임마다 시분할 계조 디스플레이를 위하여 각각의 계조 가중치를 갖는 복수의 서브-필드들이 존재하고, 각각의 서브-필드마다 리셋 주기, 어드레스 주기, 및 유지방전 주기들이 존재한다.
리셋 주기는, Y 전극 라인들에 제1 레벨로부터 제2 레벨까지 지속적으로 상승하는 상승 램프 펄스 파형의 전압이 인가되는 제1 리셋 주기와, X 전극 라인들이 제4 레벨의 전압으로 바이어싱되고 Y 전극 라인들에 제1 레벨로부터 기준 레벨보다 높은 제3 레벨까지 지속적으로 하강하는 하강 램프 펄스 파형의 전압이 순차적으로 인가되는 제2 리셋 주기를 포함하여 이루어진다. 선택된 서브-필드의 리셋 주기에서는, 제1 리셋 주기가 생략되고, 선택된 서브-필드의 제2 리셋 주기에 X 전극 라인들이 제4 레벨보다 높은 제5 레벨의 전압으로 바이어싱된다. 선택된 서브-필드의 어드레스 주기에서는, X 전극 라인들이 제4 레벨로 바이어싱된다.
본 발명에 따르면, 리셋 주기에서의 방전을 선택적으로 억제하여 콘트라스트비를 향상시키고, 리셋 주기에 X 전극에 인가되는 전압의 레벨을 상승시켜 어드레스 동작마진을 확보할 수 있다.
이하, 첨부된 도면을 참조하여 바람직한 실시예에 따른 본 발명을 상세히 설명하기로 한다.
도 8은 본 발명의 바람직한 실시예로서, 플라즈마 디스플레이 패널의 구동방법을 개략적으로 도시한 타이밍도이다. 도 11은 도 8의 플라즈마 디스플레이 패널의 구동방법에 의한 경우, 제2 리셋 구동 방법에서의 제2 리셋 주기의 종료 후의 벽전하 분포를 도시한 도면이다.
도면을 참조하면, 플라즈마 디스플레이 패널의 구동 방법은, X 전극 라인들(도 1의 X1, ..., Xn)과 Y 전극 라인들(도 1의 Y1, ..., Yn)이 교대로 나란히 배열되는 유지전극 라인 쌍들에 대하여 어드레스 전극 라인들(도 1의 AR1, AG1, ..., A Gm, ABm)이 교차되는 영역에 방전셀들이 형성되는 플라즈마 디스플레이 패널에 대하여, 디스플레이 주기로서의 프레임마다 시분할 계조 디스플레이를 위하여 각각의 계조 가중치를 갖는 복수의 서브-필드(SF)들이 존재하고, 각각의 서브-필드(SF)마다 리셋 주기(PR), 어드레스 주기(PA), 및 유지방전 주기(PS)들이 존재한다. 상기 리셋 주기(PR)가, Y 전극 라인들(도 1의 Y1, ..., Yn)에 제1 레벨(Vs)로부터 제2 레벨(Vs+Vset)까지 지속적으로 상승하는 상승 램프 펄스 파형의 전압이 인가되는 제1 리셋 주기(PR0)와, X 전극 라인들(도 1의 X1, ..., Xn)이 제4 레벨의 전압(V 4)으로 바이어싱되고 Y 전극 라인들(도 1의 Y1, ..., Yn)에 제1 레벨(Vs)로부터 제3 레벨(V3)까지 지속적으로 하강하는 하강 램프 펄스 파형의 전압이 순차적으로 인가되는 제2 리셋 주기(PR1)를 포함하여 이루어진다. 선택된 서브-필드의 리셋 주기에서(PRB)는, 제1 리셋 주기(PR0)가 생략되고, 선택된 서브-필드의 제2 리셋 주기(PR2)에 X 전극 라인들(도 1의 X1, ..., Xn)이 제4 레벨(V4)보다 높은 제5 레벨(V5)의 전압으로 바이어싱된다.
이때, 제3 레벨(V3)이 접지 레벨(GND)보다 높은 것이 바람직하며, 제5 레벨(V5)과 제3 레벨(V3)의 차가 제4 레벨(V4)과 같은 것이 바람직하다.
어드레스 주기(PA)에는, X 전극 라인들(도 1의 X1, ..., Xn)이 제4 레벨(V4 )로 바이어싱되고, Y 전극 라인들(도 1의 Y1, ..., Yn)이 제6 레벨(Vscan)로 바이어싱된 상태에서, Y 전극 라인들(도 1의 Y1, ..., Yn)에 기준 레벨(GND)의 주사 신호가 순차적으로 인가됨에 따라 어드레싱이 수행된다. 이때, 표시될 방전셀에 위치되는 어드레스 전극 라인들에는 Y 전극 라인들에 인가되는 주사 신호에 동기되어 어드레스 전압(VA)이 인가된다.
본 실시예에 의한 플라즈마 디스플레이 패널의 구동 방법은 선택적 리셋 방법에 의한다. 즉, 적어도 2이상의 리셋 구동방법이 있고, 각각의 서브-필드에서 각각의 리셋 구동방법이 선택된다. 도시한 예의 경우에는 제1 리셋 구동방법과 제2 리셋 구동방법의 두 가지 리셋 구동방법(PRA, PRB)이 있으며, 첫 번째 서브-필드에는 제1 리셋 구동방법(PRA)이 적용되고, 둘째 및 셋째 서브-필드에는 제2 리셋 구동방법(PRB)이 적용된다.
플라즈마 디스플레이 패널의 구동 방법은, 디스플레이 주기로서의 프레임마다 시분할 계조 디스플레이를 위하여 각각의 계조 가중치를 갖는 복수의 서브-필드(SF)들이 존재하고, 상기 각각의 서브-필드(SF)마다 리셋 주기(PR), 어드레스 주기(PA), 및 유지방전 주기(PS)들이 존재한다.
제1 리셋 구동방법(PRA)은 상기 Y 전극 라인들에 제1 레벨(Vs)로부터 제2 레벨(Vs+Vset)까지 지속적으로 상승하는 상승 램프 펄스 파형의 전압이 인가되는 제1 리셋 주기(PR0)와, 상기 X 전극 라인들이 제4 레벨의 전압(V4)으로 바이어싱되고, 상기 Y 전극 라인들에 상기 제1 레벨(Vs)로부터 제3 레벨(V3)까지 지속적으로 하강하는 하강 램프 펄스 파형의 전압이 순차적으로 인가되는 제2 리셋 주기(PR1)를 포함하여 이루어진다.
이때, 제1 리셋 구동 방법(PRA)에서는 제1 리셋 주기(PR0)와 제2 리셋 주기(PR1)가 모두 존재하지만, 제2 리셋 구동 방법(PRB)에서는 제2 리셋 주기(PR2)만 존재한다. 따라서, 제2 리셋 구동 방법(PRB)에서는 제1 리셋 주기(PR0)가 생략되어 리셋 주기(PR)에 발생할 수 있는 방전이 약화되어, 패널에 표시되는 화상의 콘트라스트를 향상시킬 수 있다.
이때, 콘트라스트는 패널에서 표시되는 화상에서 가장 밝은 피크 화이트(peak white)의 휘도와 가장 어두운 방전이 없을 때의 휘도의 비로써 표현되는데, 피크 화이트는 주로 유지 방전에 의하여 발생된 빛으로 구성되고, 가장 어두운 부분은 리셋 방전에 의하여 발생된 빛으로 구성된다. 따라서, 콘트라스트를 향상시키기 위해서는 밝은 부분을 더욱 밝게 하거나 어두운 부분을 더욱 어둡게 함으로써 구현하는데, 후자의 방법에 의하면 방전이 없을 때의 백그라운드 휘도가 낮을수록 콘트라스트는 향상된다.
또한, 선택된 서브-필드의 리셋 주기에서(PRB)는, 제1 리셋 주기(PR0)가 생략되고, 선택된 서브-필드의 제2 리셋 주기(PR2)에 X 전극 라인들(도 1의 X1, ..., Xn)이 제4 레벨(V4)보다 높은 제5 레벨(V5)의 전압으로 바이어싱된다.
이때, 제2 리셋 주기(PR2)에서 X 전극 라인들(도 1의 X1, ..., Xn)에 인가되는 전압이 도 6에 도시된 리셋 주기(PR2)에서 X 전극 라인들(도 1의 X1, ..., Xn)에 인가되는 전압보다 높다. 따라서, 도 11에 도시한 바와 같이 어드레스 전극에 양극의 벽전하가 좀 더 쌓여, 다음에 이어지는 어드레스 주기(PA)에서의 어드레스 방전을 더욱 용이하게 할 수 있다. 또한, 그만큼 방전마진이 커지고 방전이 안정되게 된다.
이때, 제3 레벨(V3)이 접지 레벨(GND)보다 높아져, 제5 레벨(V5)과 제3 레벨(V3)의 차가 제4 레벨(V4)과 같은 것이 바람직하다. Y 전극에서 벽전하를 지우는 레벨, 즉 하강 램프 펄스의 레벨(V3)도 함께 연동시켜 제1 리셋 구동 방법(PRA)을 수행하는 서브-필드에서의 벽전하 지우는 레벨보다 제2 리셋 구동 방법(PRB)을 수행하는 서브-필드에서의 벽전하 지우는 레벨을 보다 높게 설정하여 X 전극의 전위가 높아지면서 X 전극과 Y 전극 사이의 벽전하 상쇄가 과다하게 되는 경을 방지해 주는 것이 바람직하다.
도 9는 본 발명의 바람직한 다른 실시예로서, 플라즈마 디스플레이 패널의 구동방법을 개략적으로 도시한 타이밍도이다. 도 11은 도 9의 플라즈마 디스플레이 패널의 구동방법에 의한 경우, 제2 리셋 구동 방법에서의 제2 리셋 주기의 종료 후의 벽전하 분포를 도시한 도면이다.
도면을 참조하면, 플라즈마 디스플레이 패널의 구동 방법은, X 전극 라인들(도 1의 X1, ..., Xn)과 Y 전극 라인들(도 1의 Y1, ..., Yn)이 교대로 나란히 배열되는 유지전극 라인 쌍들에 대하여 어드레스 전극 라인들(도 1의 AR1, AG1, ..., A Gm, ABm)이 교차되는 영역에 방전셀들이 형성되는 플라즈마 디스플레이 패널에 대하여, 디스플레이 주기로서의 프레임마다 시분할 계조 디스플레이를 위하여 각각의 계조 가중치를 갖는 복수의 서브-필드(SF)들이 존재하고, 각각의 서브-필드(SF)마다 리셋 주기(PR), 어드레스 주기(PA), 및 유지방전 주기(PS)들이 존재한다. 상기 리셋 주기(PR)가, Y 전극 라인들(도 1의 Y1, ..., Yn)에 제1 레벨(Vs)로부터 제2 레벨(Vs+Vset)까지 지속적으로 상승하는 상승 램프 펄스 파형의 전압이 인가되는 제1 리셋 주기(PR0)와, X 전극 라인들(도 1의 X1, ..., Xn)이 제4 레벨의 전압(V 4)으로 바이어싱되고 Y 전극 라인들(도 1의 Y1, ..., Yn)에 제1 레벨(Vs)로부터 제3 레벨(V3)까지 지속적으로 하강하는 하강 램프 펄스 파형의 전압이 순차적으로 인가되는 제2 리셋 주기(PR1)를 포함하여 이루어진다.
선택된 서브-필드의 리셋 주기에서(PRB)는, 제1 리셋 주기(PR0)가 생략되고, 선택된 서브-필드의 제2 리셋 주기(PR2)에 X 전극 라인들(도 1의 X1, ..., Xn)이 제4 레벨(V4)보다 높은 제5 레벨(V5)의 전압으로 바이어싱된다. 이때, 제5 레벨(V 5)이 제1 레벨(Vs)과 같은 것이 바람직하다.
도 10은 본 발명의 바람직한 다른 실시예로서, 플라즈마 디스플레이 패널의 구동방법을 개략적으로 도시한 타이밍도이다. 도 11은 도 10의 플라즈마 디스플레이 패널의 구동방법에 의한 경우, 제2 리셋 구동 방법에서의 제2 리셋 주기의 종료 후의 벽전하 분포를 도시한 도면이다.
도면을 참조하면, 플라즈마 디스플레이 패널의 구동 방법은, X 전극 라인들(도 1의 X1, ..., Xn)과 Y 전극 라인들(도 1의 Y1, ..., Yn)이 교대로 나란히 배열되는 유지전극 라인 쌍들에 대하여 어드레스 전극 라인들(도 1의 AR1, AG1, ..., A Gm, ABm)이 교차되는 영역에 방전셀들이 형성되는 플라즈마 디스플레이 패널에 대하여, 디스플레이 주기로서의 프레임마다 시분할 계조 디스플레이를 위하여 각각의 계조 가중치를 갖는 복수의 서브-필드(SF)들이 존재하고, 각각의 서브-필드(SF)마다 리셋 주기(PR), 어드레스 주기(PA), 및 유지방전 주기(PS)들이 존재한다. 상기 리셋 주기(PR)가, Y 전극 라인들(도 1의 Y1, ..., Yn)에 제1 레벨(Vs)로부터 제2 레벨(Vs+Vset)까지 지속적으로 상승하는 상승 램프 펄스 파형의 전압이 인가되는 제1 리셋 주기(PR0)와, X 전극 라인들(도 1의 X1, ..., Xn)이 제4 레벨의 전압(V 4)으로 바이어싱되고 Y 전극 라인들(도 1의 Y1, ..., Yn)에 제1 레벨(Vs)로부터 제3 레벨(V3)까지 지속적으로 하강하는 하강 램프 펄스 파형의 전압이 순차적으로 인가되는 제2 리셋 주기(PR1)를 포함하여 이루어진다.
선택된 서브-필드의 리셋 주기에서(PRB)는, 제1 리셋 주기(PR0)가 생략되고, 선택된 서브-필드의 제2 리셋 주기(PR2)에 X 전극 라인들(도 1의 X1, ..., Xn)이 제4 레벨(V4)보다 높은 제5 레벨(V5)의 전압으로 바이어싱된다. 이때, 제4 레벨(V 4)은 제1 레벨(Vs)과 같은 것이 바람직하다.
도 12는 도 8 내지 도 10의 플라즈마 디스플레이 패널의 구동방법에서 선택적 리셋을 서브-필드별로 도시한 타이밍도이다.
도면을 참조하면, 플라즈마 디스플레이 패널의 구동 방법은, 디스플레이 주기로서의 프레임마다 시분할 계조 디스플레이를 위하여 각각의 계조 가중치를 갖는 복수의 서브-필드(SF)들이 존재하고, 각각의 서브-필드(SF)마다 리셋 주기(PR), 어드레스 주기(PA), 및 유지방전 주기(PS)들이 존재한다.
상기 리셋 주기(PR)가, Y 전극 라인들(도 1의 Y1, ..., Yn)에 제1 레벨(Vs)로부터 제2 레벨(Vs+Vset)까지 지속적으로 상승하는 상승 램프 펄스 파형의 전압이 인가되는 제1 리셋 주기(PR0)와, X 전극 라인들(도 1의 X1, ..., Xn)이 제4 레벨의 전압(V4)으로 바이어싱되고 Y 전극 라인들(도 1의 Y1, ..., Yn)에 제1 레벨(Vs)로부터 기준 레벨(GND)보다 높은 제3 레벨(V3)까지 지속적으로 하강하는 하강 램프 펄스 파형의 전압이 순차적으로 인가되는 제2 리셋 주기(PR1)를 포함하여 이루어진다.
하지만, 선택된 서브-필드의 리셋 주기(PRB)에서는, 제1 리셋 주기(PR0)가 생략되고, 선택된 서브-필드의 제2 리셋 주기(PR2)에 X 전극 라인들(도 1의 X1, ..., Xn)이 제4 레벨(V4)보다 높은 제5 레벨(V5)의 전압으로 바이어싱되는 제2 리셋 구동방법이 적용된다. 이때, 선택된 서브-필드의 어드레스 주기에서는, X 전극 라인들이 제4 레벨로 바이어싱된다.
선택된 서브-필드에서 제2 리셋 구동방법을 적용하는 것은 콘트라스트를 향상시키기 위한 것으로, 표시하는 영상의 휘도를 가능한 저하시키지 아니하도록 제2 리셋 구동방법을 적용할 서브-필드를 선택하는 것이 바람직하다.
따라서, 선택된 서브-필드로 계조 가중치가 가장 작은 서브-필드를 선택하는 것이 바람직하다. 또는, 동일한 프레임의 각각의 방전셀들을 전체적으로 조사하여 한 번도 선택되지 아니하는 계조 가중치의 서브-필드를 선택된 서브-필드로 할 수도 있을 것이다.
이 경우, 동일한 프레임의 각각의 방전셀들을 전체적으로 조사하여 한 번도 선택되지 아니하는 계조 가중치의 서브-필드를 선택된 서브-필드로 하고, 한 번도 선택되지 아니하는 서브-필드가 없는 경우에는 가장 작은 계조 가중치의 서브-필드를 선택할 수 있을 것이다.
이는 선택된 서브-필드에서 어드레스 방전마진이 줄어들게 되는 경우에도, 휘도를 저하시키지 아니하면서 콘트라스트를 향상시키기 위하여 바람직하다. 다만, 화면의 플리커(flicker) 현상을 방지하기 위하여 선택된 서브-필드가, 하나의 프레임 내의 각각의 방전셀에서 동일한 개수인 것이 바람직하다.
본 발명에 따른 플라즈마 디스플레이 패널 구동방법에 의하면, 리셋 주기에서의 방전을 선택적으로 억제하여 콘트라스트비를 향상시키고, 리셋 주기에 X 전극에 인가되는 전압의 레벨을 상승시켜 어드레스 동작마진을 확보할 수 있다.
또한, 충분한 어드레스 동작마진을 확보하므로, 패널의 방전 균일도를 향상시킬 수 있다.
또한, 어드레스 동작마진을 확보하여 안정적인 어드레스 동작을 위하여 필요한 어드레스 전압의 상승을 방지할 수 있다.
공통전극에 인가되는 전압의 레벨 수를 감수시켜 회로를 간소화할 수 있다.
본 발명은 첨부된 도면에 도시된 일 실시예를 참고로 설명되었으나, 이는 예시적인 것에 불과하며, 당해 기술분야에서 통상의 지식을 가진 자라면 이로부터 다양한 변형 및 균등한 타 실시예가 가능하다는 점을 이해할 수 있을 것이다. 따라서, 본 발명의 진정한 보호 범위는 첨부된 청구 범위에 의해서만 정해져야 할 것이다.
도 1은 통상적인 3-전극 면방전 방식의 플라즈마 디스플레이 패널의 구조를 보여주는 내부 사시도이다.
도 2는 도 1의 패널의 단위 디스플레이 셀의 구성을 보여주는 단면도이다.
도 3은 도 1의 플라즈마 디스플레이 패널의 통상적인 구동 장치를 보여주는 블록도이다.
도 4는 도 1의 플라즈마 디스플레이 패널의 통상적인 구동 방법을 보여주는 타이밍도이다.
도 5는 도 4의 단위 서브-필드에서 도 1의 플라즈마 디스플레이 패널의 전극 라인들에 인가되는 구동 신호들을 보여주는 타이밍도이다.
도 6은 선택적 리셋 방법에 의한 플라즈마 디스플레이 패널의 구동방법을 보여주는 타이밍도이다.
도 7은 도 6의 플라즈마 디스플레이 패널의 구동방법에 의한 경우, 제2 리셋 구동 방법에서의 제2 리셋 주기의 종료 후의 벽전하 분포를 도시한 도면이다.
도 8은 본 발명의 바람직한 실시예로서, 플라즈마 디스플레이 패널의 구동방법을 개략적으로 도시한 타이밍도이다.
도 9는 본 발명의 바람직한 다른 실시예로서, 플라즈마 디스플레이 패널의 구동방법을 개략적으로 도시한 타이밍도이다.
도 10은 본 발명의 바람직한 다른 실시예로서, 플라즈마 디스플레이 패널의 구동방법을 개략적으로 도시한 타이밍도이다.
도 11은 도 8 내지 도 10의 플라즈마 디스플레이 패널의 구동방법에 의한 경우, 제2 리셋 구동 방법에서의 제2 리셋 주기의 종료 후의 벽전하 분포를 도시한 도면이다.
도 12는 도 8 내지 도 10의 플라즈마 디스플레이 패널의 구동방법에서 선택적 리셋을 서브-필드별로 도시한 타이밍도이다.

Claims (11)

  1. X 전극 라인들과 Y 전극 라인들이 교대로 나란히 배열되는 유지전극 라인 쌍들에 대하여 어드레스 전극 라인들이 교차되는 영역에 방전셀들이 형성되는 플라즈마 디스플레이 패널에 대하여, 디스플레이 주기로서의 프레임마다 시분할 계조 디스플레이를 위하여 각각의 계조 가중치를 갖는 복수의 서브-필드들이 존재하고, 상기 각각의 서브-필드마다 리셋 주기, 어드레스 주기, 및 유지방전 주기들이 존재하는 플라즈마 디스플레이 패널의 구동 방법에 있어서,
    상기 리셋 주기가, 상기 Y 전극 라인들에 제1 레벨로부터 제2 레벨까지 지속적으로 상승하는 상승 램프 펄스 파형의 전압이 인가되는 제1 리셋 주기와, 상기 X 전극 라인들이 제4 레벨의 전압으로 바이어싱되고 상기 Y 전극 라인들에 상기 제1 레벨로부터 제3 레벨까지 지속적으로 하강하는 하강 램프 펄스 파형의 전압이 순차적으로 인가되는 제2 리셋 주기를 포함하여 이루어지고,
    선택된 서브-필드의 리셋 주기에서는, 상기 제1 리셋 주기가 생략되고, 상기 선택된 서브-필드의 제2 리셋 주기에 상기 X 전극 라인들이 제4 레벨보다 높은 제5 레벨의 전압으로 바이어싱되는 플라즈마 디스플레이 패널의 구동 방법.
  2. 제1항에 있어서,
    상기 제3 레벨이 접지 레벨보다 높은 플라즈마 디스플레이 패널의 구동 방법.
  3. 제2항에 있어서,
    상기 제5 레벨과 상기 제3 레벨의 차가 상기 제4 레벨과 같은 플라즈마 디스플레이 패널의 구동 방법.
  4. 제1항에 있어서,
    상기 어드레스 주기에는,
    상기 X 전극 라인들이 상기 제4 레벨로 바이어싱되고, 상기 Y 전극 라인들이 제6 레벨로 바이어싱된 상태에서, 상기 Y 전극 라인들에 기준 레벨의 주사 신호가 순차적으로 인가됨에 따라 어드레싱이 수행되는 플라즈마 디스플레이 패널의 구동 방법.
  5. 제1항에 있어서,
    상기 제5 레벨이 상기 제1 레벨과 같은 플라즈마 디스플레이 패널의 구동 방법.
  6. 제1항에 있어서,
    상기 제4 레벨이 상기 제1 레벨과 같은 플라즈마 디스플레이 패널의 구동 방법.
  7. 제1항에 있어서,
    상기 선택된 서브-필드가, 계조 가중치가 가장 작은 적어도 하나 이상의 서브-필드인 플라즈마 디스플레이 패널의 구동 방법.
  8. 제1항에 있어서,
    상기 선택된 서브-필드가,
    상기 프레임 내의 각각의 방전셀에서 한 번도 선택되지 아니한 계조 가중치의 서브-필드인 플라즈마 디스플레이 패널의 구동 방법.
  9. 제1항에 있어서,
    상기 프레임 내의 각각의 방전셀에서 한 번도 선택되지 아니한 계조 가중치의 서브-필드가 존재하는 경우에는 해당 서브-필드가 상기 선택된 서브-필드로 되고,
    상기 프레임 내의 각각의 방전셀에서 한 번도 선택되지 아니한 계조 가중치의 서브-필드가 존재하지 않는 경우에는 계조 가중치가 가장 작은 적어도 하나 이상의 서브-필드가 기 선택된 서브-필드로 되는 플라즈마 디스플레이 패널의 구동 방법.
  10. 제7항 내지 제9항 중 어느 한 항에 있어서,
    상기 선택된 서브-필드가, 하나의 프레임 내의 각각의 방전셀에서 동일한 개수인 플라즈마 디스플레이 패널의 구동 방법.
  11. X 전극 라인들과 Y 전극 라인들이 교대로 나란히 배열되는 유지전극 라인 쌍들에 대하여 어드레스 전극 라인들이 교차되는 영역에 방전셀들이 형성되는 플라즈마 디스플레이 패널에 대하여, 디스플레이 주기로서의 프레임마다 시분할 계조 디스플레이를 위하여 각각의 계조 가중치를 갖는 복수의 서브-필드들이 존재하고, 상기 각각의 서브-필드마다 리셋 주기, 어드레스 주기, 및 유지방전 주기들이 존재하는 플라즈마 디스플레이 패널의 구동 방법에 있어서,
    상기 리셋 주기가, 상기 Y 전극 라인들에 제1 레벨로부터 제2 레벨까지 지속적으로 상승하는 상승 램프 펄스 파형의 전압이 인가되는 제1 리셋 주기와, 상기 X 전극 라인들이 제4 레벨의 전압으로 바이어싱되고 상기 Y 전극 라인들에 상기 제1 레벨로부터 기준 레벨보다 높은 제3 레벨까지 지속적으로 하강하는 하강 램프 펄스 파형의 전압이 순차적으로 인가되는 제2 리셋 주기를 포함하여 이루어지고;
    선택된 서브-필드의 리셋 주기에서는, 상기 제1 리셋 주기가 생략되고, 상기 선택된 서브-필드의 제2 리셋 주기에 상기 X 전극 라인들이 제4 레벨보다 높은 제5 레벨의 전압으로 바이어싱되고;
    상기 선택된 서브-필드의 어드레스 주기에서는, 상기 X 전극 라인들이 제4 레벨로 바이어싱되는 플라즈마 디스플레이 패널의 구동 방법.
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