KR20050025803A - 플라즈마 표시패널 및 그의 구동방법 - Google Patents

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Abstract

본 발명은, 리셋구간 동안에 벽전하의 소실을 방지하여 어드레스구간에서 어드레스방전이 충분히 발생할 수 있는 플라즈마 표시패널 및 그의 구동방법에 관한 것이다.
본 발명은, 리셋구간 중에, 제1전극에 제1전압부터 제3전압까지 하강하는 하강램프파형을 인가하고, 어드레스전극에 음의 전압인 제4전압을 인가한다. 또한 본 발명은, 리셋구간 중에, 제1전극에 제1전압에 특정전압만큼 상승된 전압부터 제3전압에 특정전압만큼 상승된 전압까지 하강하는 하강램프파형을 인가하고, 제2전극에는 제5전압에 상기 특정전압만큼 상승된 전압을 인가한다.
본 발명에 따르면, 리셋구간에 생성된 벽전하의 소실을 방지하여 어드레스방전의 발생을 보다 용이하게 함으로써, 어드레스구간에 어드레스전극에 인가되는 펄스폭을 줄이거나 낮은 전압의 펄스를 인가하여도 어드레스방전을 일으킬 수 있다.

Description

플라즈마 표시패널 및 그의 구동방법{Plasma display panel and Method for deriving the same}
본 발명은 플라즈마 표시패널(plasma display panel, 이하 PDP라고 명명함) 및 그 구동방법에 관한 것으로, 특히 리셋구간에 벽전하의 소실을 방지할 수 있는 플라즈마 표시패널의 구동방법 및 이를 이용한 플라즈마 표시패널에 관한 것이다.
최근 액정표시장치(liquid crystal display; LCD), 전계 방출 표시장치(field emission display; FED), PDP 등의 평면 표시 장치가 활발히 개발되고 있다. 이들 평면 표시 장치 중에서 PDP는 다른 평면 표시 장치에 비해 휘도 및 발광효율이 높으며 시야각이 넓다는 장점이 있다. 따라서, PDP가 40인치 이상의 대형 표시 장치에서 종래의 CRT(cathode ray tube)를 대체할 표시 장치로서 각광받고 있다.
먼저, 도 1을 참조하여 일반적인 PDP의 구조에 대하여 설명한다.
도 1은 일반적인 PDP의 구조를 보여주는 부분분해 사시도이다.
도 1에 도시한 바와 같이, 제1유리기판(1) 위에는 유전체층(2) 및 보호막(3)으로 덮인 주사전극(4)과 유지전극(5)이 쌍을 이루어 평행하게 설치된다. 제2유리기판(6) 위에는 절연체층(7)으로 덮인 복수의 어드레스전극(8)이 설치된다. 어드레스전극(8)들 사이에 있는 절연체층(7) 위에는 어드레스전극(8)과 평행하게 격벽(9)이 형성되어 있다. 또한, 절연체층(7)의 표면 및 격벽(9)의 양측면에 형광체(10)가 형성되어 있다. 제1유리기판(1)과 제2유리기판(6)은 주사전극(4)과 어드레스전극(8) 및 유지전극(5)과 어드레스전극(8)이 직교하도록 방전공간(11)을 사이에 두고 대향하여 배치되어 있다. 어드레스전극(8)과, 쌍을 이루는 주사전극(4)과 유지전극(5)과의 교차부에 있는 방전공간이 방전셀(12)을 형성한다.
도 2는 도 1의 플라즈마 디스플레이 패널의 전극들의 배열을 개략적으로 보여주는 도면이다.
도 2에 도시한 바와 같이, PDP의 전극들은 m×n 의 매트릭스 구성을 가지고 있으며, 구체적으로 열 방향으로는 어드레스전극(A1~Am)이 배열되어 있고 행방 향으로는 n행의 주사전극(Y1~Yn)(이하, Y전극 이라 명명함) 및 유지전극(X1~Xn)(이하, X전극이라고 명명함)이 교대로 배열되어 있다. 즉, X전극(X1~Xn)과 Y전극(Y1~Yn)은 어드레스전극(A1~Am)과 직교되도록 제1유리기판(1)의 뒤쪽에 일정한 패턴으로 형성된다. 각 교차점마다 방전셀(12)이 형성된다. 방전셀(12)의 방전공간에는 플라즈마 형성용 가스가 밀봉되고, 3전극에 인가되는 펄스에 의해 방전되어 화상을 표시한다.
상기한 바와 같은 구조의 플라즈마 표시 패널(1)의 구동방법으로서 주로 사용되는 어드레스-표시 분리(ADS: Address Display Separation) 구동방법이 미국특허 제5541618호에 개시되어 있다.
어드레스-표시 분리 구동방법에서는, 단위 프레임이 시분할 계조 표시를 실현하기 위하여 특정 개의 서브필드들로 분할된다. 또한, 각 서브필드는 리셋 기간, 어드레스 기간 및 유지기간으로 분할된다.
도 3은 앞서 설명한 3전극을 갖는 PDP의 서브필드의 구동파형을 보여주는 도면이다.
도 3에서와 같이, 각 서브필드는 리셋구간, 어드레스구간 및 유지구간으로 구성된다. 리셋구간은 이전의 유지 방전의 벽전하 상태를 소거하고, 다음의 어드레스 방전을 안정적으로 수행하기 위해 벽전하를 셋업(setup)하는 역할을 한다. 어드레스구간은 패널에서 켜지는 셀과 켜지지 않는 셀을 선택하여 켜지는 셀(어드레싱된 셀)에 벽전하를 쌓는 동작을 수행하는 구간이다. 유지구간은 어드레싱된 셀에 실제로 화상을 표시하기 위한 방전을 수행하는 구간이다.
여기서, 리셋구간은, 콘트라스트비의 향상시키기 위하여 Vs부터 Vset까지 상승하는 램프파형의 전압이 Y전극에 인가되는 Y램프상승구간(ta)과, Vs부터 -Vsc까지 하강하는 램프전압을 Y전극에 인가하는 Y램프하강구간(tb)을 포함한다. X전극의 전압은 Y램프상승구간(ta) 동안 0V이고, Y램프하강구간(tb) 동안 Ve이다. 어드레스전극의 전압은 리셋구간 동안 0V를 유지한다.
Y램프상승구간(ta)은 3전극에 벽전하를 쌓는 구간이다. 구체적으로, Y램프상승구간(ta)동안 모든 방전 셀에서는 Y전극으로부터 어드레스전극 및 X전극으로 각각 미약한 제1리셋방전이 일어난다. 그 결과, Y전극에 (-)벽전하가 축적되고, 동시에 어드레스전극 및 X전극에는 (+)벽전하가 축적된다.
Y램프하강구간(tb)은 X전극과 Y전극 간의 오방전을 막기 위해 벽전하를 재분포시키는 역할을 수행하는 구간이다. 구체적으로, Y램프하강구간(tb) 구간동안, X전극은 정전압 Ve로 유지되고, Y전극에는 VS로부터 -Vsc를 향해 완만하게 하강하는 램프전압이 인가된다. 이 램프전압이 하강하는 동안 다시 모든 방전셀에서는 미약한 제2리셋방전이 일어난다. 그 결과, Y전극의 (-)벽전하가 감소하고 X전극은 극성이 반전되어 미약한 (-)전하가 축적된다. 또한, 어드레스전극의 (+)벽전하는 어드레스 동작에 적당한 값으로 조정된다.
이때, Y전극과 어드레스전극 사이의 전압차(Vsc)에 의해 불필요한 Y전극과 어드레스전극 사이에 약한 방전이 발생하여 어드레스전극에 형성된 어드레스 방전을 위한 벽전하가 소실된다.
이 때문에, 어드레스구간에서 어드레스펄스를 인가하여도 어드레스방전이 충분히 발생하지 않게 된다는 문제점이 발생한다.
상기 문제점을 해결하기 위한 본 발명의 기술적 과제는, 리셋구간 동안에 벽전하의 소실을 방지하여 어드레스구간에서 어드레스방전이 충분히 발생할 수 있는 플라즈마 표시패널 및 그의 구동방법에 관한 것이다.
상기 기술적 과제를 해결하기 위한 본 발명의 하나의 특징에 따른 플라즈마 표시패널의 구동방법은, 제1 및 제2전극 라인들이 교대로 나란히 배열되고 어드레스전극들이 상기 라인들과 교차되는 배열되는 플라즈마 표시패널을, 리셋구간, 어드레스구간 및 유지구간을 포함하는 구동파형에 의해 구동하는 플라즈마 표시패널의 구동방법으로서, 상기 리셋구간은, a) 상기 제1전극에, 제1전압부터 제2전압까지 상승하는 상승램프파형을 인가하는 단계; 및 b) 상기 제1전극에, 제3전압부터 제4전압까지 하강하는 하강램프파형을 인가하는 단계를 포함하고, 상기 b) 단계에서 상기 하강램프파형을 인가하는 동안, 상기 어드레스전극에 음의 전압인 제5전압을 인가한다.
여기서, 상기 제5전압은 상기 하강램프파형의 끝부분에 상기 어드레스전극에 인가되거나, 상기 하강램프파형을 인가하는 동안 계속하여 상기 어드레스전극에 인가될 수 있다. 또, 상기 제5전압까지 점차 감소하는 램프파형의 전압이 상기 어드레스전극에 인가될 수 있다.
상기 제1전압은 상기 제3전압과 동일한 전압이고, 상기 제5전압은 상기 리셋구간에 상기 전극들 간에 오방전을 일으키지 않는 전압이며, 상기 제5전압은 상기 제4전압보다 큰 것이 바람직하다.
본 발명의 다른 특징에 따른 플라즈마 표시패널의 구동방법은, 제1 및 제2전극 라인들이 교대로 나란히 배열되고 어드레스전극들이 상기 라인들과 교차되는 배열되는 플라즈마 표시패널을, 리셋구간, 어드레스구간 및 유지구간을 포함하는 구동파형에 의해 구동하는 플라즈마 표시패널의 구동방법으로서, 상기 리셋구간은,a) 상기 제1전극에, 제1전압부터 제2전압까지 상승하는 상승램프파형을 인가하는 단계; 및 b) 상기 제1전극에, 상기 제1전압보다 큰 제3전압부터 제4전압까지 하강하는 하강램프파형을 인가하는 단계를 포함하고, 상기 b) 단계에서 상기 하강램프파형을 인가하는 동안, 어드레스구간 동안 어드레싱을 위하여 상기 제2전극에 인가되는 어드레스전압보다 큰 제5전압을 상기 제2전극에 인가한다.
여기서, 상기 제1전압과 상기 제3전압의 전압차는 상기 어드레싱전압과 상기 제5전압의 전압차와 동일할 수 있으며, 상기 어드레스구간 동안 주사를 위하여 제1전극에 인가되는 주사전압과 상기 제4전압의 전압차는 상기 제1전압과 상기 제3전압의 전압차와 동일한 것이 바람직하다.
상기 전압차는 상기 리셋구간에 상기 전극들 간에 오방전을 일으키지 않는 전압차일 수 있으며, 또한 상기 전압차는 상기 주사전압보다 작은 것이 바람직하다.
본 발명의 또 다른 특징에 따른 플라즈마 표시패널은, 교대로 나란히 배열된 제1 및 제2전극; 상기 전극들과 교차되는 배열된 어드레스전극; 및 리셋구간에 상기 전극들에 구동신호를 보내는 구동회로부를 포함하고, 상기 구동회로부는 상기 제1전극에는 제1전압부터 제2전압까지 하강하는 하강램프파형을 인가하고, 동시에 상기 어드레스전극에는 음의 전압인 제3전압을 인가하는 구동신호를 생성한다.
여기서, 상기 제3전압은 상기 리셋구간에 상기 전극들 간에 오방전을 일으키지 않는 전압인 것이 바람직하다.
본 발명의 또 다른 특징에 따른 플라즈마 표시패널은, 교대로 나란히 배열된 제1 및 제2전극; 상기 전극들과 교차되는 배열된 어드레스전극; 및 리셋구간에 상기 전극들에 구동신호를 보내는 구동회로부를 포함하고, 상기 구동회로부는 상기 제1전극에는 상기 제1전압부터 제2전압까지 하강하는 하강램프파형을 인가하고, 동시에 어드레스구간 동안 어드레싱을 위하여 상기 제2전극에 인가되는 어드레스전압보다 큰 제3전압을 상기 제2전극에 인가하는 구동신호를 생성한다.
여기서, 상기 제3전압과 상기 어드레스전압이 전압차는 상기 리셋구간에 상기 전극들 간에 오방전을 일으키지 않는 전압인 것이 바람직하다.
이하에서는 첨부한 도면을 참조하여 본 발명의 실시예들에 대하여 상세하게 설명한다.
도 4는 본 발명의 제1실시예에 따른 PDP 구동방법의 구동파형을 보여주는 도면이다. 도 5a 및 도 5b는 도 4의 A, B 시점에서의 벽전하의 상태를 각각 보여주는 도면이다.
도 4에서와 같이, 본 실시예는 Y램프하강구간(tb) 중에서 Y전극의 전압이 어드레스펄스전압(-Vsc)까지 하강하는 램프전압의 끝부분에, 음의 전압(-Vn)을 어드레스전극에 인가하는 것이 특징이다.
구체적으로, Y램프상승구간(ta)동안 유지전압(Vs)부터 Vset까지 상승하는 램프전압이 Y전극에 인가된다. 그리고 X전극 및 어드레스전극의 전압은 0V이다. 이때, 모든 방전 셀에서 Y전극과 어드레스전극 및 X전극 각각 사이에서 미약한 제1리셋방전이 일어난다. 그 결과, 도 5a에서와 같이, Y전극에 (-)벽전하가 축적되고, 동시에 어드레스전극 및 X전극에는 (+)벽전하가 축적된다.
다음으로, X전극과 Y전극 사이에 면방전이 이루어지기 위해서 외부에서 인가하는 전압으로서 대략 130~150V인 정전압(Ve)이 X전극에 인가되고, Y전극에는 유지전압(Vs)으로부터 어드레스펄스전압(-Vsc)을 향하여 하강하는 램프전압이 인가되어 Y전극과 X전의 사이에 방전이 발생한다. 이때, 어드레스펄스전압(-Vsc)을 향하여 하강함에 따라, Y전극과 어드레스전극 사이의 전압차가 발생한다. 이 전압차에 의해 약한 방전이 발생하여 어드레스전극에 있던 벽전하가 소실된다.
구체적으로, 어드레스전극에 형성된 벽전하의 소실은, Y전극과 X전의 사이에 방전이 시작되는 초기단계에는 거의 발생하지 않고, Y전극과 어드레스전극 사이의 전압차가 발생하는 램프전극의 끝부분에서 주로 발생한다. 따라서 어드레스전극에 형성된 벽전하의 소실을 방지하기 위하여 램프전극의 끝부분에서 어드레스전극에 음의 전압(-Vn)을 인가한다.
다르게는, 음의 전압은 벽전하의 소실이 발생하기 전에 인가하면 충분하므로, Y램프하강구간(tb) 전체에 음의 전압(-Vn)을 인가할 수도 있으며, 0V부터 특정 음의 전압(-Vn)까지 감소하는 램프전압을 인가할 수도 있다.
Y램프하강구간(tb) 전체에 음의 전압(-Vn)을 인가하는 경우 및 Y램프하강구간(tb) 동안 0V부터 특정 음의 전압(-Vn)까지 감소하는 램프전압을 인가하는 경우는 보다 확실하게 어드레스전극에 형성된 벽전하의 소실을 방지할 수 있다.
또한 음의 전압(-Vn)은 낮을수록 벽전하의 소실을 막을 수 있지만, 오방전의 위험이 있으므로 오방전의 위험이 적은 특정 값, 예를 들면 -40V이상으로 제한되어야 한다.
이렇게 함으로써, Y전극의 램프전압이 하강하는 동안 모든 방전셀에서 Y전극과 X전극 사이에서는 미약한 제2리셋방전이 일어나, 도 5b에서와 같이, Y전극의 (-)벽전하는 감소하고 X전극의 극성은 반전되어 (-)전하가 약간 축적된다. 또한, 어드레스전극에 음의 전압(-Vn)의 인가로 인하여 Y전극과 어드레스전극 사이에 벽전하의 소실이 거의 발생하지 않는다.
또한, 어드레스전극에 음의 전압(-Vn)을 인가하지 않은 경우에는, 어드레스전극에 형성된 벽전하의 소실을 고려하여, 비교적 높은 전압의 어드레스펄스가 어드레스전극에 인가되어야 한다. 그러나 본 실시예에 따르면 어드레스전극에 음의 전압(-Vn)이 인가되어 어드레스전극에 형성된 벽전하가 거의 소실되지 않기 때문에 상기 어드레스펄스보다 낮은 전압의 어드레스펄스를 인가하여도 충분한 어드레스방전이 발생한다.
예컨대, 음의 전압(-Vn)을 인가하지 않는 경우 크기가 60V이고 폭이 1㎲ 인 어드레서펄스를 인가한다면, -40V인 음의 전압(-Vn)을 전압을 어드레스전극에 인가한 경우에는, 폭이 1㎲이고 크기가 20V인 어드레스펄스를 인가하여도 어드레스방전이 발생한다. 또한, 크기가 60V인 어드레스펄스를 어드레스전극에 인가하는 경우에는 펄스폭을 줄일 수 있어 어드레스구간을 단축시킬 수도 있다.
도 6은 본 발명의 제2실시예에 따른 PDP 구동방법의 구동파형을 보여주는 도면이다. 도 6에서와 같이, Y램프하강구간(tb) 동안 X전극에는 인가전압(Ve)보다 특정전압(Va)만큼 증가된 전압이 인가되고, Y전극에는 유지전압(Vs)보다 특정전압(Va)만큼 높은 전압부터 하강하는 하강램프파형의 전압이 인가된다는 점이 제1실시예와 다르다. 이하에서는 제1실시예와 다른 부분에 대하여 구체적으로 설명한다.
Y램프하강구간(tb)동안 X전극에는 정전압(Ve)에 특정 전압(Va)이 더해진 전압(Ve+Va)이 인가되고, Y전극의 전압은 유지전압(Vs)에 특정전압(Va)이 더해진 전압(Vs+Va)부터 음의 어드레스펄스전압(-Vsc)에 특정전압(Va)을 더한 전압(-Vsc+Va)까지 하강한다. 즉, Y램프하강구간(tb)에서 X전압은 정전압(Ve)보다 특정전압(Va) 보다 상승한다. 또, Y전압은 하강 램프전압을 전체적으로 X전압과 같은 크기로 상승시켜, 상승 램프의 시작부분과 하강 램프의 시작부분의 전압레벨이 달라진다.
이와 같이, Y램프하강구간(tb)에서 X와 Y의 전압을 동시에 상승시킴으로써, Y램프 상승구간(ta)에서 쌓여진 벽전하를 소실되지 않게 함과 동시에 X, Y전극간의 오방전도 방지할 수 있다.
또한, 특정전압(Va)을 인가하지 않은 경우에는, 어드레스전극에 형성된 벽전하의 소실을 고려하여, 비교적 높은 전압의 어드레스펄스가 어드레스전극에 인가되어야 한다. 그러나 본 실시예에 따르면 X전극에 특정전압(Va)을 더 인가함으로써 어드레스전극에 형성된 벽전하가 거의 소실되지 않기 때문에 상기 어드레스펄스보다 낮은 전압의 어드레스펄스를 인가하여도 충분한 어드레스방전이 발생한다.
예컨대, 특정전압(Va)을 인가하지 않은 경우 크기가 60V이고 폭이 1㎲ 인 어드레서펄스를 인가한다면, -40V의 특정전압(Va)을 X전극에 더 인가한 경우에는, 폭이 1㎲이고 크기가 20V인 어드레스펄스를 인가하여도 어드레스방전이 발생한다. 또한, 크기가 60V인 어드레스펄스를 어드레스전극에 인가하는 경우에는 펄스폭을 줄일 수 있어 어드레스구간을 단축시킬 수도 있다.
도 7은 본 발명에 따른 PDP의 구성을 개략적으로 보여주는 도면이다.
도7에 도시한 바와 같이, 본 발명에 따른 플라즈마 표시패널은 플라즈마 패널(100), 구동회로부(200), 어드레스 구동부(300), X전극 구동부(400) 및 Y전극 구동부(500)를 포함한다. 플라즈마 패널(100)은 열 방향으로 배열되어 있는 다수의 어드레스전극(A1~Am), 행 방향으로 지그재그로 배열되어 있는 다수의 주사전극(X1~Xn) 및 유지전극(Y1~Yn)을 포함한다.
구동회로부(200)는 외부로부터 영상신호를 수신하여 X전극구동 구동회로신호, Y전극구동 구동신호 및 어드레스구동 구동신호를 출력한다. X전극 구동부(400)는 구동회로부(200)로부터 X전극구동 구동신호를 수신하여 X전극에 구동 전압을 인가하고, Y전극 구동부(500)는 구동회로부(200)로부터 Y전극구동 구동신호를 수신하여 Y전극에 구동 전압을 인가한다.
구체적으로, 구동회로부(200)는, 도 4와 같이, Y전극 구동부(500)가 Y전극에 Y램프하강구간(tb) 동안 Vset부터 어드레스펄스전압(-Vsc)까지 하강하는 램프전압을 Y전극에 인가하도록 하는 구동신호를 Y전극 구동부(500)에 출력한다.
또한, 구동회로부(200)는, 어드레스전극 구동부(300)가 표시하고자 하는 방전 셀을 선택하기 위한 표시 데이터 신호를 각 어드레스전극에 인가하도록 하는 구동신호를 어드레스전극 구동부(300)에 출력한다. 특히, 구동회로부(200)로부터 수신된 어드레스전극 구동신호에 따라, 도 4와 같이, 어드레스전극 구동부(300)는 Y램프하강구간(tb)의 끝부분에 음의 전압(-Vn)을 어드레스전극에 인가한다. 여기서, 어드레스전극에 음의 전압(-Vn)의 인가가 Y램프하강구간(tb) 전체에 수행될 수도 있으며, 0V부터 음의 전압(-Vn)까지 감소하는 램프전압을 어드레스전극에 인가할 수도 있다.
이와 같은 구동회로부(200)에 의해, 제1실시예에 따른 PDP 구동방법을 실현할 수 있으며, 제1실시예에 의해 얻을 수 있는 효과와 동일한 효과를 얻을 수 있다.다르게는, 구동회로부(200)는, X전극 구동부(400)가 도 6에서와 같이, Y램프하강구간(tb)동안 X전극에는 정전압(Ve)에 특정 전압(Va)이 더해진 전압(Ve+Va)이 인가되도록 하는 X전극 구동신호를 출력하고, Y전극 구동부(500)가 유지전압(Vs)에 특정전압(Va)이 더해진 전압(Vs+Va)부터 음의 어드레스펄스전압(-Vsc)에 특정전압(Va)을 더한 전압(-Vsc+Va)까지 하강하는 램프전압을 Y전극에 인가하도록 하는 구동신호를 Y전극 구동부(500)에 출력할 수도 있다
따라서 Y램프하강구간(tb)에서 X전압은 정전압(Ve)보다 특정전압(Va) 보다 상승한다. 또, Y전압은 하강 램프전압을 전체적으로 X전압과 같은 크기로 상승시켜, 상승 램프의 시작부분과 하강 램프의 시작부분의 전압레벨이 달라진다. 이와 같은 구동회로부(200)에 의해, 제2실시예에 따른 PDP 구동방법을 실현할 수 있으며, 제2실시예에 의해 얻을 수 있는 효과와 동일한 효과를 얻을 수 있다.
앞에서 바람직한 실시예들에 근거하여 본 발명을 설명하였지만, 이 실시예는 본 발명을 제한하려는 것이 아니라 예시하려는 것이다. 본 발명이 속하는 기술분야의 통상의 기술자에게는 본 발명의 기술사상의 벗어남 없이 실시예에 대한 다양한 변화, 변경 등이 가능함은 명백할 것이다. 그러므로 본 발명의 보호범위는 첨부된 청구범위에 의해서만 한정될 것이며, 변화예 또는 변경예 등을 모두 포함하는 것으로 해석되어야 할 것이다.
본 발명에 따르면, 리셋구간에 생성된 벽전하의 소실을 방지하여 어드레스방전의 발생을 보다 용이하게 함으로써, 어드레스구간에 어드레스전극에 인가되는 펄스폭을 줄이거나 낮은 전압의 펄스를 인가하여도 어드레스방전을 일으킬 수 있다. 이로 인하여 어드레스구간을 줄일 수 있어 PDP의 고속 구동을 실현할 수 있다. 특히 대형 PDP에서 단일주사(Single Scan)의 원활한 구동이 가능하다.
도 1은 일반적인 PDP의 구조를 보여주는 부분분해 사시도이다.
도 2는 도 1의 플라즈마 디스플레이 패널의 전극들의 배열을 개략적으로 보여주는 도면이다.
도 3은 앞서 설명한 3전극을 갖는 PDP의 서브필드의 구동파형을 보여주는 도면이다.
도 4는 본 발명의 제1실시예에 따른 PDP 구동방법의 구동파형을 보여주는 도면이다.
도 5a 및 도 5b는 도 4의 구동파형에 의해 리셋구간에 형성된 벽전하의 상태를 보여주는 단면도들이다.
도 6은 본 발명의 제2실시예에 따른 PDP 구동방법의 구동파형을 보여주는 도면이다.
도 7은 본 발명에 따른 PDP의 구성을 개략적으로 보여주는 도면이다.

Claims (16)

  1. 제1 및 제2전극 라인들이 교대로 나란히 배열되고 어드레스전극들이 상기 라인들과 교차되는 배열되는 플라즈마 표시패널을, 리셋구간, 어드레스구간 및 유지구간을 포함하는 구동파형에 의해 구동하는 플라즈마 표시패널의 구동방법에 있어서,
    상기 리셋구간은,
    a) 상기 제1전극에, 제1전압부터 제2전압까지 상승하는 상승램프파형을 인가하는 단계; 및
    b) 상기 제1전극에, 제3전압부터 제4전압까지 하강하는 하강램프파형을 인가하는 단계
    를 포함하고,
    상기 b) 단계에서 상기 하강램프파형을 인가하는 동안, 상기 어드레스전극에 음의 전압인 제5전압을 인가하는 플라즈마 표시패널의 구동방법.
  2. 제1항에 있어서,
    상기 제5전압은 상기 하강램프파형의 끝부분에 상기 어드레스전극에 인가되는 플라즈마 표시패널의 구동방법.
  3. 제1항에 있어서,
    상기 제5전압은 상기 하강램프파형을 인가하는 동안 계속하여 상기 어드레스전극에 인가되는 플라즈마 표시패널의 구동방법.
  4. 제1항에 있어서,
    상기 제5전압까지 점차 감소하는 램프파형의 전압이 상기 어드레스전극에 인가되는 플라즈마 표시패널의 구동방법.
  5. 제1항 내지 제4항 중 어느 한 항에 있어서,
    상기 제1전압은 상기 제3전압과 동일한 전압인 플라즈마 표시패널의 구동방법.
  6. 제1항 내지 제4항 중 어느 한 항에 있어서,
    상기 제5전압은 상기 리셋구간에 상기 전극들 간에 오방전을 일으키지 않는 전압인 플라즈마 표시패널의 구동방법.
  7. 제6항에 있어서,
    상기 제5전압은 상기 제4전압보다 큰 플라즈마 표시패널의 구동방법.
  8. 제1 및 제2전극 라인들이 교대로 나란히 배열되고 어드레스전극들이 상기 라인들과 교차되는 배열되는 플라즈마 표시패널을, 리셋구간, 어드레스구간 및 유지구간을 포함하는 구동파형에 의해 구동하는 플라즈마 표시패널의 구동방법에 있어서,
    상기 리셋구간은,
    a) 상기 제1전극에, 제1전압부터 제2전압까지 상승하는 상승램프파형을 인가하는 단계; 및
    b) 상기 제1전극에, 상기 제1전압보다 큰 제3전압부터 제4전압까지 하강하는 하강램프파형을 인가하는 단계
    를 포함하고,
    상기 b) 단계에서 상기 하강램프파형을 인가하는 동안, 어드레스구간 동안 어드레싱을 위하여 상기 제2전극에 인가되는 어드레스전압보다 큰 제5전압을 상기 제2전극에 인가하는 플라즈마 표시패널의 구동방법.
  9. 제8항에 있어서,
    상기 제1전압과 상기 제3전압의 전압차는 상기 어드레싱전압과 상기 제5전압의 전압차와 동일한 플라즈마 표시패널의 구동방법.
  10. 제8항에 있어서,
    상기 어드레스구간 동안 주사를 위하여 제1전극에 인가되는 주사전압과 상기 제4전압의 전압차는 상기 제1전압과 상기 제3전압의 전압차와 동일한 플라즈마 표시패널의 구동방법.
  11. 제9항 또는 제10항에 있어서,
    상기 전압차는 상기 리셋구간에 상기 전극들 간에 오방전을 일으키지 않는 전압차인 플라즈마 표시패널의 구동방법.
  12. 제9항 또는 제10항에 있어서,
    상기 전압차는 상기 주사전압보다 작은 플라즈마 표시패널의 구동방법.
  13. 교대로 나란히 배열된 제1 및 제2전극;
    상기 전극들과 교차되는 배열된 어드레스전극; 및
    리셋구간에 상기 전극들에 구동신호를 보내는 구동회로부
    를 포함하고,
    상기 구동회로부는
    상기 제1전극에는 제1전압부터 제2전압까지 하강하는 하강램프파형을 인가하고, 동시에 상기 어드레스전극에는 음의 전압인 제3전압을 인가하는 구동신호를 생성하는 플라즈마 표시패널.
  14. 제13항에 있어서,
    상기 제3전압은 상기 리셋구간에 상기 전극들 간에 오방전을 일으키지 않는 전압인 플라즈마 표시패널.
  15. 교대로 나란히 배열된 제1 및 제2전극;
    상기 전극들과 교차되는 배열된 어드레스전극; 및
    리셋구간에 상기 전극들에 구동신호를 보내는 구동회로부
    를 포함하고,
    상기 구동회로부는
    상기 제1전극에는 상기 제1전압부터 제2전압까지 하강하는 하강램프파형을 인가하고, 동시에 어드레스구간 동안 어드레싱을 위하여 상기 제2전극에 인가되는 어드레스전압보다 큰 제3전압을 상기 제2전극에 인가하는 구동신호를 생성하는 플라즈마 표시패널.
  16. 제15항에 있어서,
    상기 제3전압과 상기 어드레스전압이 전압차는 상기 리셋구간에 상기 전극들 간에 오방전을 일으키지 않는 전압인 플라즈마 표시패널.
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KR100724362B1 (ko) * 2005-07-30 2007-06-04 엘지전자 주식회사 플라즈마 디스플레이 패널 구동 장치 및 방법

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