KR20030068756A - 인버터와 이를 사용한 램프 점화 시스템 - Google Patents

인버터와 이를 사용한 램프 점화 시스템 Download PDF

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KR20030068756A KR1020020008363A KR20020008363A KR20030068756A KR 20030068756 A KR20030068756 A KR 20030068756A KR 1020020008363 A KR1020020008363 A KR 1020020008363A KR 20020008363 A KR20020008363 A KR 20020008363A KR 20030068756 A KR20030068756 A KR 20030068756A
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쳉-치아 수
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앰비트 마이크로시스템즈 코포레이션
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Abstract

방전램프 점화용 인버터는 변압기, 제1 스위치 트랜지스터, 제2 스위치 트랜지스터, 제1 스너버 커패시터, 제2 스너버 커패시터, 리셋 커패시터, 및 제어 회로를 포함한다. 제1 스위치 트랜지스터의 소스/드레인 중 하나는 변압기의 주 측부에 전기적으로 연결된다. 제2 스위치 트랜지스터의 소스/드레인 중 하나는 변압기의 주 측부에 전기적으로 연결된다. 제1 스너버 커패시터는 제1 스위치 트랜지스터의 소스와 드레인 사이에 전기적으로 연결된다. 제2 스너버 커패시터는 제2 스위치 트랜지스터의 소스와 드레인 사이에 전기적으로 연결된다. 리셋 커패시터는 제1 스위치 트랜지스터의 소스/드레인 중 나머지 하나와 제2 스위치 트랜지스터의 소스/드레인 중 나머지 하나 사이에 전기적으로 연결된다. 제어회로는 제1 스위치 트랜지스터와 제2 스위치 트랜지스터를 제어하여서 두 트랜지스터가 동시에 전도하지 않도록 한다.

Description

인버터와 이를 사용한 램프 점화 시스템{INVERTER AND LAMP IGNITION SYSTEM USING THE SAME}
본 발명은 램프 점화장치의 인버터, 특히 액정 디스플레이(LCD)의 백라이트 모듈용 모노-스테이지 고효율 인버터에 관계한다.
콜드 캐소드 형광램프(CCFL)와 같은 방전램프는 보통 LCD패널의 백라이트 소스로서 사용된다. 이러한 램프는 램프에 적용된 자극(AC신호)의 진동수와 순간 상태에 따라 변하는 터미널 전압 특성을 갖는다. CCFL은 작동 또는 점화될 때까지 전류를 전도하지 않는다. 램프가 전류를 전도할때 적용된 터미널 전압은 스트라이크전압 미만이다. 예컨대 램프를 작동시키기 위해서 터미널 전압은 1500V이상이어야 한다. CCFL에서 전기 아크가 발생되면 터미널 전압은 스트라이크 전압의 1/3정도인 하부 런(run) 전압으로 강하한다. 예컨대 500-6mA 전류범위에서 스트라이크 전압은 1500V이지만 CCFL의 런 전압은 500V이다. CCFL은 보통 30-100Hz 진동수를 갖는 AC신호에 의해서 작동된다.
방전램프는 네가티브 저항 특성을 보이므로 소모 전력이 증가하면 작동전압은 감소한다. 램프에 전력을 공급하는 인버터와 같은 회로는 회로의 안정성 유지와 부하 조절 능력을 위해서 램프 전류를 정확하게 모니터링 할 수 있는 피드백 루프와 제어 가능한 교류 전원을 필요로 한다.
노트북이나 데스크탑 컴퓨터의 LCD백라이트 시스템용 인버터를 설계할 때 효율, 단가 및 크기가 가장 중요한 인자이다. TDK Corporation(Tokyo, Japan)에 의해서 판매되는 CXA-K05L-FS와 같은 전통적인 LCD백라이트 시스템용 인버터는 벅(buck)컨버터와 전류-공급 자체 진동 푸시-풀 인버터(Royer인버터라 불리는)를 포함한다. 이러한 벅 컨버터와 Royer인버터 조합의 효율은 두개의 전력 전환 단계에 의해서 제한된다. 특히, 공명 인덕턴스로서 작용하는 Royer DC/AC 컨버터 변압기 자기 인덕턴스는 추가 전력 손실을 야기한다.
현재 두 전력 전환 스테이지인 벅 스테이지와 Royer스테이지 구조를 갖는 인버터의 효율은 70-80%이다. 특히 저 입력 전압의 경우에 더 큰 코일 비율의 변압기가 필요하므로 손실이 증가하고 효율이 저하한다. 이러한 변압기 구조는 중앙 탭을 사용하므로 소형화가 어렵고 제조단가가 증가한다. 게다가 변압기의 각 하프-사이클에서 단지 한 세트의 코일이 작동하므로 활용율이 낮다. 또한 이러한 인버터의 출력 전압 파동이 고차 조화 조성을 가지므로 조명효율을 저하시키고 램프 수명을 단축시키고 전자기 간섭을 증대시킨다. 요약하면 이러한 인버터는 제조비용을 증가시키고 효율을 저하시키며 조화파가 과다하다는 단점을 갖는다.
이에 비추어서 단일한 전력 전환 스테이지로 구성된 램프 점화장치용 인버터를 제공하는 것이 본 발명의 목적이다.
변압기가 중앙 탭이 없이 단순한 구조를 갖는 램프 점화장치용 인버터를 제공하는 것이 본 발명의 또 다른 목적이다.
D=0.5의 듀티 사이클에서 작동하며 버스트 모드 컨트롤에 의해서 감쇠 가능한 램프 점화장치용 인버터를 제공하는 것이 본 발명의 또 다른 목적이다. 따라서 전류 비대칭이 방지된다.
더 적은 조화 조성을 갖는 램프 전압 파동으로 출력하는 램프 점화 시스템을 제공하는 것도 본 발명의 목적이다. 그러므로 더 높은 조명효율, 더 오랜 램프 수명, 더 작은 전자기 간섭이 달성된다.
도1은 본 발명에 따른 인버터와 방전 램프의 조합을 보여준다.
도2는 인버터 작동의 타이밍 다이아그램이다.
* 부호설명
10...에러 증폭기20...비교기
30...드라이브 회로50...제어회로
100...인버터
따라서 본 발명은 방전램프 점화용 인버터를 발표한다. 본 발명에 따른 인버터는 변압기, 제1 스위치 트랜지스터, 제2 스위치 트랜지스터, 리셋 커패시터, 및 제어 회로를 포함한다. 제1 스위치 트랜지스터의 소스/드레인 중 하나는 변압기의 주 측부에 전기적으로 연결된다. 제2 스위치 트랜지스터의 소스/드레인 중 하나는변압기의 주 측부에 전기적으로 연결된다. 리셋 커패시터는 제1 스위치 트랜지스터의 소스/드레인 중 나머지 하나와 제2 스위치 트랜지스터의 소스/드레인 중 나머지 하나 사이에 전기적으로 연결된다. 제어회로는 제1 스위치 트랜지스터와 제2 스위치 트랜지스터를 제어하여서 두 트랜지스터가 동시에 전도하지 않도록 한다.
제어회로는 제1 스위치 트랜지스터의 전도와 제2 스위치 트랜지스터의 전도 사이의 기간동안 제1 및 제2 스위치 트랜지스터가 비-전도하게 한다. 제어회로는 버스트 모드 제어신호에 따라 변압기의 제2 측부에서 전류값을 제어한다.
제어회로는 전도 저항을 감소시키기 위해서 제1 스위치 트랜지스터와 제2 스위치 트랜지스터에 출력된 두개의 스위치 제어신호를 발생시키기 위한 구동력으로서 리셋 커패시터를 가로지르는 전압을 활용하는 드라이브 회로를 포함한다.
게다가 본 발명은 방전램프와 인버터를 포함한 램프 점화 시스템을 발표한다. 인버터는 변압기, 제1 스위치 트랜지스터, 제2 스위치 트랜지스터, 리셋 커패시터, 및 제어 회로를 포함한다. 변압기의 제2 측부는 방전램프에 전기적으로 연결된다. 제1 스위치 트랜지스터의 소스/드레인 중 하나는 변압기의 주 측부에 전기적으로 연결된다. 제2 스위치 트랜지스터의 소스/드레인 중 하나는 변압기의 주 측부에 전기적으로 연결된다. 리셋 커패시터는 제1 스위치 트랜지스터의 소스/드레인 중 나머지 하나와 제2 스위치 트랜지스터의 소스/드레인 중 나머지 하나 사이에 전기적으로 연결된다. 제1 스너버 커패시터는 제1 스위치 트랜지스터의 소스와 드레인 사이에 전기적으로 연결된다. 제2 스너버 커패시터는 제2 스위치 트랜지스터의 소스와 드레인 사이에 전기적으로 연결된다. 제어회로는 변압기의 제2 측부에서전류값을 나타내는 전압 피드백 신호에 응답하여 두개의 스위치 제어신호를 발생하고 이들을 제1 스위치 트랜지스터의 게이트와 제2 스위치 트랜지스터의 게이트에 출력하여서 제1 스위치 트랜지스터와 제2 스위치 트랜지스터가 동시에 전도하지 않도록 한다.
제어회로는 에러 증폭기와 한 쌍의 비교기를 포함한다. 에러 증폭기는 방전 램프의 전류값을 나타내는 전압 피드백 신호와 기준전압을 감지하여서 에러 증폭을 수행한다. 비교기는 에러 증폭기의 출력과 기준 삼각파의 비교 결과에 따라서 두개의 스위치 제어신호를 발생한다.
도1은 본 발명에 따른 인버터와 방전램프의 조합을 보여준다. 인버터(100)와 램프(Lp)는 램프 점화 시스템을 구성한다. 본 발명의 인버터(100)는 변압기(T1),스위치 트랜지스터(Q1,Q2), 및 리셋 커패시터(C1)를 포함한다. 스위치 트랜지스터(Q1)의 소스/드레인 중 하나는 노드(A)에서 변압기(T1)의 주 측부에 전기적으로 연결되고 다른 하나는 노드(B)에서 리셋 커패시터(C1)에 전기적으로 연결된다. 스위치 트랜지스터(Q2)의 소스/드레인 중 하나는 노드(A)에서 변압기(T1)의 주 측부에 전기적으로 연결되고 다른 하나는 노드(E)에서 리셋 커패시터(C1)에 전기적으로 연결된다. 방전 램프(Lp)는 변압기(T1)의 제2 측부에 전기적으로 연결된다. DC전원은 DC전압(Vin)을 인버터(100)에 출력한다. 한 구체예에서 스위치 트랜지스터(Q1)는NMOS트랜지스터이고 스위치 트랜지스터(Q2)는PMOS트랜지스터이다.
Vin=5V, D=0.5 하에서 다음 분석이 수행된다. D는 스위치 트랜지스터(Q1,Q2)의 듀티 사이클이다. DC전압(Vin)을 인버터(100)에 제공하면 전압(Vin)은변압기(T1)의 주 측부에 위치된 스위치 트랜지스터(Q1)의 바디 다이오드(Dp)를 통해서 커패시터(C1)를 충전한다. 커패시터(C1)를 가로지르는 전압이 특정값에 도달하면 스위치 트랜지스터(Q1,Q2)는 스위치 되고 전체 회로가 작동한다. 도2는 인버터 작동의 타이밍 다이아그램을 보여준다.
시간간격(t1-t2)동안 스위치 트랜지스터(Q1)는 ON이고 스위치 트랜지스터(Q2)는 OFF이다. DC전압(Vin)은 변압기(T1)의 자화 인덕터를 충전하여서 자화전류(IM)를 선형으로 증가 시킨다. 이 순간에 전력의 일부는 자화 인덕터에 저장되고 일부는 변압기(T1)의 제2권선에 전달된다.
시간간격(t2-t3)동안 스위치 트랜지스터(Q1,Q2)는 OFF이다. 변압기(T1)의 주 측부에서 전류는 연속적이어야 하므로 스위치 트랜지스터(Q2)의 바디 다이오드(Dp)는 전도한다.
시간간격(t3-t4)동안 스위치 트랜지스터(Q1)는 OFF이고 스위치 트랜지스터(Q2)는 ON이다. 커패시터(C1)를 가로지르는 전압(Vcl)(커패시터(C1)는 안정적인 DC전압(Vcl)을 제공하기 위해서 충분히 커야한다)은 변압기(T1)의 자기 플럭스를 리셋 시켜서 자화전류(IM)를 선형으로 감소시킨다. 이 순간에 변압기(T1)의 주 측부를 가로지르는 전압은 (Vcl-Vin)=-5V이다.
시간간격(t4-t5)동안 스위치 트랜지스터(Q1,Q2)는 OFF이다. 변압기(T1)의 주 측부에서 전류는 연속적이어야 하므로 스위치 트랜지스터(Q1)의 바디 다이오드(Dn)는 전도한다.
위 분석에 따르면 바디 다이오드(Dp,Dn)는 스위치 트랜지스터(Q1,Q2)가 켜지기 이전에 전류 전도를 개시시켜 스위치 트랜지스터는 켜질 경우 제로 전압 스위칭(ZVS)특성을 가진다.
스위치 트랜지스터의 턴-오프는 하드-스위칭이다. 그러므로 소스-드레인 전압(Vds)의 상승 시간을 지연 시켜서 드레인 전류(Id)와 소스-드레인 전압(Vds)의 교차 영역을 감소시키고 스위치의 턴-오프로 나타나는 전력 손실을 저하 시키도록 스너버 커패시터(C3,C4)는 스위치 트랜지스터(Q1,Q2)의 드레인과 소스 사이에 병렬 연결된다. 따라서 스위치가 ON상태에 있는 동안 변압기(T1) 자화 인덕터의 평균 전압은 0이므로 Vcl=Vin/(1-D)가 유도된다. 예컨대 Vin=5V, D=0.5일 경우에 Vcl=2Vin=10V이다. 커패시터(C1)를 가로지르는 전압(Vcl)은 스위치 구동력으로서 사용되어 더 작은 전도 저항(Rdson)과 더 낮은 전도 손실을 가져온다. 더 작은 전도 저항(Rdson)이 수득되므로 단지 PMOS를 스위치 트랜지스터(Q2)로서 사용함으로써 양호한 결과가 달성될 수 있다. 스위치 트랜지스터(Q2)로서 NMOS를 사용하지 않으므로 복잡한 분리 드라이브 회로가 불필요하다.
한 구체예에 따르면 인버터(100)의 제어회로(50)는 에러 증폭기(20)와 한 쌍의 비교기(30)으로 구성될 수 있으며 스위치 트랜지스터(Q1,Q2)가 동시에 전도하는 것을 막기 위해서 저항(R1,R2)의 비율을 조절함으로써 데드 타임이 변화될 수 있다.
에러 증폭기(10)는 증폭기(10a)와 임피던스 네트워크(Z1,Z2)를 포함한다. 임피던스 네트워크(Z1)는 변압기(T1)의 제2 측부에서 방전램프(Lp)를 통해 전류(ILP)를 이에 비례하는 전압 피드백 신호(Vf)로 변환시킨다. 증폭기(10a)는 변압기(T1)의 제2 측부에서 램프 전류를 나타내는 전압 피드백 신호(Vf)와 기준전압(Vref)을 감지하여서 에러 증폭을 수행한다. 임피던스 네트워크(Z2)는 증폭기(10a)의 입력 단자와 출력 단자에서 저항의 균형을 위해서 제공된다.
에러 증폭기(10)의 출력과 삼각파(ST)의 비교 결과에 따라서 비교기(20)는 스위치 트랜지스터(Q1,Q2)를 제어하는 제어신호를 발생한다. 비교기 쌍(20)은 전압-분할 저항(R1+R2)과 비교기(20a,20b)를 포함한다. 전압-분할 저항(R1+R2)은 에러 증폭기(10)의 출력단자에 전기적으로 연결되어서 비교기(20a,20b)로의 출력을 위한 두개의 상이한 전압을 제공한다. 비교기(20a,20b)는 전압 분할 저항에서 나오는 두개의 상이한 전압을 삼각파(ST)와 비교하여 스위치 트랜지스터(Q1,Q2)를 제어하는 두개의 제어신호를 발생한다.
게다가 본 발명은 스위치 제어 신호의 구동력을 증가시키는 드라이브 회로(30)를 더욱 활용한다. 커패시터(C1)를 가로지르는 전압(Vcl)은 드라이브 회로(30)에 전력을 주는데 사용될 수 있다. 그러므로 스위치 트랜지스터(Q1,Q2)는 켜질 경우에 더 작은 전도 저항(Rdson)을 가자므로 전도 손실이 감소된다.
변압기(T1)의 제2 측부에서 누출 인덕턴스, 필터로서 램프의 누출 전류, 디커플링 커패시터로서 커패시터(C2)를 사용함으로써 변압기(T1)의 주 측부에서 AC사각파가 사인파로 여과되어서 램프(Lp)에 공급된다. 출력 전압은 더 적은 수의 조화조성을 갖는 사인파에 근사하므로 전자기 간섭이 감소되어 조명효율이 증가하고 램프 수명이 증가된다.
본 발명의 회로는 D=0.5근처에서 작동할 수 있으며 조광 제어를 위해서 버스트 모드 신호 SBMC(200-300Hz)를 활용한다. 그러므로 램프 전류의 비대칭이 일어나지 않는다.
본 발명의 회로는 모노-스테이지 전환 구성이므로 85%이상의 효율이 달성된다. 추가로 제어회로는 단순성과 저렴한 단가로 이한 장점이 있다

Claims (22)

  1. 변압기;
    소스/드레인 중 하나가 변압기의 주 측부에 전기적으로 연결된 제1 스위치 트랜지스터;
    소스/드레인 중 하나가 변압기의 주 측부에 전기적으로 연결된 제2 스위치 트랜지스터;
    제1 스위치 트랜지스터의 소스/드레인 중 나머지 하나와 제2 스위치 트랜지스터의 소스/드레인 중 나머지 하나 사이에 전기적으로 연결된 리셋 커패시터;
    변압기의 제2 측부에서 전류값을 나타내는 전압 피드백 신호에 응답하여 두개의 스위치 제어신호를 발생하고 이들을 제1 스위치 트랜지스터의 게이트와 제2 스위치 트랜지스터의 게이트에 출력하여서 제1 스위치 트랜지스터와 제2 스위치 트랜지스터가 동시에 전도하지 않도록 하는 제어 회로를 포함하는 인버터.
  2. 제 1항에 있어서, 제1 스위치 트랜지스터의 소스와 드레인 사이에 전기적으로 연결된 제1 스너버 커패시터;
    제2 스위치 트랜지스터의 소스와 드레인 사이에 전기적으로 연결된 제2 스너버 커패시터를 더욱 포함하는 인버터.
  3. 제 1항에 있어서, 변압기의 제2 측부에 전기적으로 연결된 디커플링 커패시터를 더욱 포함하는 인버터.
  4. 제 1항에 있어서, 상기 제어회로가 두개의 스위치 제어신호를 발생하기 위한 구동력으로서 리셋 커패시터를 가로지르는 전압을 활용하는 드라이브 회로를 포함함을 특징으로 하는 인버터.
  5. 제 1항에 있어서, 제어회로가 변압기의 제2 측부에서 전류값을 나타내는 전압 피드백 신호와 기준전압을 감지하여서 에러 증폭을 수행하는 에러 증폭기; 및
    에러 증폭기의 출력과 기준 삼각파의 비교 결과에 따라서 두개의 스위치 제어신호를 발생하는 한 쌍의 비교기를 더욱 포함함을 특징으로 하는 인버터.
  6. 제 5항에 있어서, 제어회로가 두개의 스위치 제어신호의 구동력을 증진시키는 드라이브 회로를 더욱 포함함을 특징으로 하는 인버터.
  7. 제 5항에 있어서, 제어회로가 에러 증폭기에 의해서 수신된 버스트 모드 제어 신호에 따라서 변압기의 제2 측부에서 전류값을 더욱 제어함을 특징으로 하는 인버터.
  8. 제 5항에 있어서, 상기 비교기 쌍이 에러 증폭기(10)의 출력단자에 전기적으로 연결되어 두개의 상이한 전압을 제공하는 전압-분할 저항;
    전압 분할 저항의 두 출력 중 하나에 전기적으로 연결되어서 두개의 제어신호 중 하나를 발생하는 제1비교기; 및
    전압 분할 저항의 두 출력 중 나머지 하나에 전기적으로 연결되어서 두개의 제어신호 중 다른 하나를 발생하는 제2비교기를 포함함을 특징으로 하는 인버터.
  9. 제 1항에 있어서, 제어회로가 버스트 모드 제어 신호에 따라서 변압기의 제2 측부에서 전류값을 더욱 제어함을 특징으로 하는 인버터.
  10. 제 1항에 있어서, 제어회로가 제1 스위치 트랜지스터의 전도 제2 스위치 트랜지스터의 전도 사이의 기간동안 제1 스위치 트랜지스터와 제2 스위치 트랜지스터를 둘 다 비-전도성이 되게 함을 특징으로 하는 인버터.
  11. 방전램프에 전기적으로 연결된 제2 측부를 갖는 변압기;
    소스/드레인 중 하나가 변압기의 주 측부에 전기적으로 연결된 제1 스위치 트랜지스터;
    소스/드레인 중 하나가 변압기의 주 측부에 전기적으로 연결된 제2 스위치 트랜지스터;
    제1 스위치 트랜지스터의 소스/드레인 중 나머지 하나와 제2 스위치 트랜지스터의 소스/드레인 중 나머지 하나 사이에 전기적으로 연결된 리셋 커패시터;
    변압기의 제2 측부에서 전류값을 나타내는 전압 피드백 신호에 응답하여 두개의 스위치 제어신호를 발생하고 이들을 제1 스위치 트랜지스터의 게이트와 제2 스위치 트랜지스터의 게이트에 출력하여서 제1 스위치 트랜지스터와 제2 스위치 트랜지스터가 동시에 전도하지 않도록 하는 제어 회로를 포함하는 인버터와, 방전램프를 포함하는 램프 점화 시스템.
  12. 제 11항에 있어서, 상기 인버터가 제1 스위치 트랜지스터의 소스와 드레인 사이에 전기적으로 연결된 제1 스너버 커패시터; 및
    제2 스위치 트랜지스터의 소스와 드레인 사이에 전기적으로 연결된 제2 스너버 커패시터를 더욱 포함함을 특징으로 하는 램프 점화 시스템.
  13. 제 11항에 있어서, 상기 인버터가 변압기의 제2 측부와 방전램프 사이에 전기적으로 연결된 디커플링 커패시터를 더욱 포함함을 특징으로 하는 램프 점화 시스템.
  14. 제 11항에 있어서, 상기 제어회로가 두개의 스위치 제어신호를 발생하기 위한 구동력으로서 리셋 커패시터를 가로지르는 전압을 활용하는 드라이브 회로를 포함함을 특징으로 하는 램프 점화 시스템.
  15. 제 11항에 있어서, 제어회로가 변압기의 제2 측부에서 전류값을 나타내는 전압 피드백 신호와 기준전압을 감지하여서 에러 증폭을 수행하는 에러 증폭기; 및
    에러 증폭기의 출력과 기준 삼각파의 비교 결과에 따라서 두개의 스위치 제어신호를 발생하는 한 쌍의 비교기를 더욱 포함함을 특징으로 하는 램프 점화 시스템.
  16. 제 15항에 있어서, 제어회로가 두개의 스위치 제어신호의 구동력을 증진시키는 드라이브 회로를 더욱 포함함을 특징으로 하는 램프 점화 시스템.
  17. 제 15항에 있어서, 제어회로가 에러 증폭기에 의해서 수신된 버스트 모드 제어 신호에 따라서 방전램프를 통한 전류값을 더욱 제어함을 특징으로 하는 램프 점화 시스템.
  18. 제 11항에 있어서, 제어회로가 버스트 모드 제어 신호에 따라서 방전램프를 통한 전류값을 더욱 제어함을 특징으로 하는 램프 점화 시스템.
  19. 변압기;
    소스/드레인 중 하나가 변압기의 주 측부에 전기적으로 연결된 제1 스위치 트랜지스터;
    소스/드레인 중 하나가 변압기의 주 측부에 전기적으로 연결된 제2 스위치 트랜지스터;
    제1 스위치 트랜지스터의 소스/드레인 중 나머지 하나와 제2 스위치 트랜지스터의 소스/드레인 중 나머지 하나 사이에 전기적으로 연결된 리셋 커패시터;
    제1 스위치 트랜지스터와 제2 스위치 트랜지스터가 동시에 전류를 전도하지 않도록 하는 제어 회로를 포함하는 인버터.
  20. 제 19항에 있어서, 상기 제어회로가 제1 스위치 트랜지스터와 제2 스위치 트랜지스터에 출력되는 두개의 스위치 제어신호를 발생하여 이의 전도 저항을 감소시키도록 구동력으로서 리셋 커패시터를 가로지르는 전압을 활용하는 드라이브 회로를 포함함을 특징으로 하는 인버터.
  21. 제 19항에 있어서, 제어회로가 제1 스위치 트랜지스터의 전도 제2 스위치 트랜지스터의 전도 사이의 기간동안 제1 스위치 트랜지스터와 제2 스위치 트랜지스터를 둘 다 비-전도성이 되게 함을 특징으로 하는 인버터.
  22. 제 19항에 있어서, 제1 스위치 트랜지스터의 소스와 드레인 사이에 전기적으로 연결된 제1 스너버 커패시터;
    제2 스위치 트랜지스터의 소스와 드레인 사이에 전기적으로 연결된 제2 스너버 커패시터를 더욱 포함하는 인버터.
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