KR20020039405A - 데이터 전송에서의 다중패킷 전송장치 - Google Patents

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KR20020039405A
KR20020039405A KR1020000069184A KR20000069184A KR20020039405A KR 20020039405 A KR20020039405 A KR 20020039405A KR 1020000069184 A KR1020000069184 A KR 1020000069184A KR 20000069184 A KR20000069184 A KR 20000069184A KR 20020039405 A KR20020039405 A KR 20020039405A
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김보경
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구자홍
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Abstract

본 발명은 고속 데이터 통신에서 정해진 크기까지는 여러 패킷을 동시에 전송하여 패킷전송에 필요한 시간을 줄임으로써 데이터의 전송속도를 높일 수 있도록 한 다중패킷 전송장치에 관한 것으로, 실시예는, 단말기가 컴퓨터로부터 데이터를 수신하기 위해 인터페이싱하는 인터페이스부와, 상기 인터페이스를 통해 수신된 데이터를 패킷 형태로 처리하는 데이터 처리부와, 상기 데이터 처리부를 통해 처리된 패킷을 저장하는 패킷버퍼와, 상기 패킷버퍼에 저장된 일정크기 이하의 여러 패킷을 한번의 파워 온(power on) 시간동안 패킷을 전송하거나 또는 재전송하는 다중전송버퍼를 가지고 있는 단말기와; 기지국이 상기 단말기의 다중전송버퍼를 통해 전송된 패킷을 수신하는 데이터 수신부와, 상기 데이터 수신부를 통해 전송된 패킷의 수신여부에 대한 응답신호를 상기 단말기에 전송하는 데이터 처리부를 가지고 있는 기지국;으로 구성됨으로써, 다중버퍼 개념을 이용한 패킷의 전송은 기전송된 하나의 패킷에 대한 응답의 수신여부에 상관없이 전송할 패킷이 존재하면 정해진 크기까지 여러개의 패킷을 한번에 전송할 수 있도록 함으로써 파워 온을 할 수 있는 한정된 기회를 거의 모두 사용할 수 있게되어 고속 데이터 전송이 가능하게 된다.

Description

데이터 전송에서의 다중패킷 전송장치{multi packet transmission apparatus in data transmission}
본 발명은 데이터 통신에서의 데이터 전송에 관한 것으로, 특히 고속 데이터 통신에서 정해진 크기까지는 여러 패킷을 동시에 전송하여 패킷전송에 필요한 시간을 줄임으로써 데이터의 전송속도를 높일 수 있도록 한 다중패킷 전송장치에 관한 것이다.
종래의 데이터 전송방식은 도 1 에 도시된 바와같이 하나의 패킷(packet)을 전송한 후 이에 대한 응답을 기다리고, 이와같이 수신된 응답값에 따라 현재의 패킷의 재전송이나 다음 패킷으로의 이동을 결정하게 되는데, 상기 응답(ACK)이 돌아오는 시간에 따라 최대로 송수신할 수 있는 패킷의 수가 정해진다.
저속통신에서는 이러한 지연시간(delay time)이 데이터 처리율(throuput)에 별다른 영향을 미치지 않지만 고속통신에서는 최대 크기의 패킷이 몇개가 전송되는가에 따라서 속도에 차이가 생길 수 있다.
또한, 종래의 컴퓨터(PC)(10)에서 사용하는 윈도우 방식은 정해진 크기만큼의 패킷을 전송한 후 그에 대한 응답이 제시간내에 수신되지 않으면 윈도우를 점점 줄여나가면서 패킷을 전송한다.
상기 데이터를 전송하는 방식은 PC(10)로부터 수신된 데이터를 하나의 PPP(Point to Point Protocol)로 만들어 전송하고, 이에 대한 응답을 기다리며, 수신된 응답에 따라 다음 패킷의 전송이나 현재 전송된 패킷을 재전송한다.
그러므로, 단말기(20)가 파워를 사용할 수 있는 상황에 패킷의 크기에 상관없이 하나의 패킷만을 전송할 수 있다.
그리나, 한번에 전송할 수 있는 패킷의 크기가 최대 1500 바이트 정도이므로 384kbps 이상의 속도를 요구하는 고속 데이터 통신에서는 이러한 응답지연시간이 데이터 처리율에 병목(bottleneck)이 될 수 있다.
또한, 무선으로 데이터를 사용할 수 있는 상태일지라도 응답을 받지 못하면 어떠한 데이터를 보내야할 지를 판단할 수 없기 때문에 응답지연시간이 길어질수록송수신할 수 있는 패킷의 수가 줄어드므로 이러한 상태에서는 고속의 데이터 통신이 이루어지기 어렵다.
따라서, 본 발명은 상기와 같은 종래의 문제점을 해소하기 위해 창안된 것으로서, 정해진 크기까지는 여러개의 패킷을 한번에 전송하여 응답시간을 줄이므로써 데이터 통신속도를 향상시키도록 하는데 그 목적이 있다.
도 1 은 종래의 패킷 전송장치의 구성도.
도 2 는 본 발명에 적용되는 다중 패킷 전송장치의 구성도.
<도면의 주요 부분에 대한 부호의 설명>
10, 100 : PC 20, 200 : 단말기
21, 210 : 인터페이스부 22, 32, 220, 320 : 데이터 처리부
23, 230 : 패킷버퍼 24 : 단일전송버퍼
30, 300 : 기지국 31, 310 : 데이터 수신부
240 : 다중전송버퍼
이하, 첨부도면을 참조하여 본 고안에 따른 바람직한 실시예에 대하여 상세히 설명한다.
본 발명 다중패킷 전송장치의 실시예는,
단말기(200)가 컴퓨터(100)로부터 데이터를 수신하기 위해 인터페이싱하는 인터페이스부(210)와,
상기 인터페이스(210)를 통해 수신된 데이터를 패킷 형태로 처리하는 데이터 처리부(220)와,
상기 데이터 처리부(220)를 통해 처리된 패킷을 저장하는 패킷버퍼(230)와,
상기 패킷버퍼(230)에 저장된 일정크기 이하의 여러 패킷을 한번의 파워 온(power on) 시간동안 패킷을 전송하거나 또는 재전송하는 다중전송버퍼(240)를 가지고 있는 단말기(200)와;
기지국(300)이 상기 단말기(200)의 다중전송버퍼(240)를 통해 전송된 패킷을 수신하는 데이터 수신부(310)와,
상기 데이터 수신부(310)를 통해 전송된 패킷의 수신여부에 대한 응답신호를 상기 단말기(200)에 전송하는 데이터 처리부(320)를 가지고 있는 기지국으로 구성됨이 바람직하다.
상기 다중전송버퍼(240)는 여러개의 패킷을 모아서 한번에 전송할 수 있도록 구성됨이 바람직하다.
기지국(300)으로부터 단말기(200)로 응답신호가 수신되지 않을때 패킷을 전송 또는 재전송함이 바람직하다.
상기 응답신호의 송수신시,
로크(lock)을 잡기위한 프리엠블 타임(preamble time)과 데이터 손실을 방지하기 위한 포스트앰블 타임(postamble time)을 사용함이 바람직하다.
도 2 는 본 발명에 적용되는 다중 패킷 전송장치의 구성도로서, 이를 참조하여 설명하면 다음과 같다.
일정한 크기 이하의 여러 패킷을 한번에 전송할 수 있도록 하는데, 이를 위해 다중버퍼내에서 전송할 여러개의 패킷을 합친후 한번의 파워온 동안에 다중버퍼내의 패킷을 모두 전송한다.
고속 데이터 통신을 위해서는 최대한 빨리 응답이 송수신되어야 하므로 최소한의 프리앰블 타임(preamble time)과 포스트앰블 타임(postamble time)이 사용될 필요가 있다.
패킷모드에서는 파워 온후 패킷을 전송할 수 있는 횟수가 한정되어 있으므로 다중전송버퍼를 사용하여 고속의 데이터 통신을 구현한다.
또한, 패킷모드에서 단말(200)은 전송할 데이터가 있을때만 파워를 쏘게 되는데, 이때 필요한 오버헤드 타임(overhead time)(프리앰블+포스트앰블)이 크므로 데이터의 재전송을 물리계층에서 수행함으로써 재전송 횟수를 줄여 데이터 전송속도를 향상시키게 된다.
이상에서 설명한 바와 같이 본 발명에 의하면, 다중버퍼 개념을 이용한 패킷의 전송은 기전송된 하나의 패킷에 대한 응답의 수신여부에 상관없이 전송할 패킷이 존재하면 정해진 크기까지 여러개의 패킷을 한번에 전송할 수 있도록 함으로써 파워 온을 할 수 있는 한정된 기회를 거의 모두 사용할 수 있게되어 고속 데이터 전송이 가능하게 된다.

Claims (4)

  1. 단말기가 컴퓨터로부터 데이터를 수신하기 위해 인터페이싱하는 인터페이스부와,
    상기 인터페이스를 통해 수신된 데이터를 패킷 형태로 처리하는 데이터 처리부와,
    상기 데이터 처리부를 통해 처리된 패킷을 저장하는 패킷버퍼와,
    상기 패킷버퍼에 저장된 일정크기 이하의 여러 패킷을 한번의 파워 온(power on) 시간동안 패킷을 전송하거나 또는 재전송하는 다중전송버퍼를 가지고 있는 단말기와;
    기지국이 상기 단말기의 다중전송버퍼를 통해 전송된 패킷을 수신하는 데이터 수신부와,
    상기 데이터 수신부를 통해 전송된 패킷의 수신여부에 대한 응답신호를 상기 단말기에 전송하는 데이터 처리부를 가지고 있는 기지국;을 포함하여 구성된 것을 특징으로 하는 다중패킷 전송장치.
  2. 제 1 항에 있어서, 상기 다중전송버퍼는 여러개의 패킷을 모아서 한번에 전송할 수 있도록 구성된 것을 특징으로 하는 다중패킷 전송장치.
  3. 제 1 항에 있어서, 기지국으로부터 단말기로 응답신호가 수신되지 않을때패킷을 전송 또는 재전송할 수 있음을 특징으로 하는 다중패킷 전송장치.
  4. 제 1 항에 있어서, 상기 응답신호의 송수신시,
    로크(lock)을 잡기위한 프리앰블 타임(preamble time)과 데이터 손실을 방지하기 위한 포스트앰블 타임(postamble time)을 사용함을 특징으로 하는 다중패킷 전송장치.
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* Cited by examiner, † Cited by third party
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JPH0369231A (ja) * 1989-08-08 1991-03-25 Toshiba Corp パケット通信装置のバッファ制御方式
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Patent Citations (5)

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