KR20010057299A - Serve channel control apparatus and method between base station and base station controller for ATM system - Google Patents
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Abstract
Description
본 발명은 WLL시스템에 관한 것으로, 특히 WLL시스템에서 RP와 RPC간의 E1링크 전송 효율을 높이기 위한 비동기 전송 모드시스템의 기지국과 기지국 제어국간 서브채널 제어장치 및 방법에 관한 것이다.The present invention relates to a WLL system, and more particularly, to an apparatus and method for controlling a subchannel between a base station and a base station control station in an asynchronous transmission mode system for improving E1 link transmission efficiency between an RP and an RPC in a WLL system.
일반적으로 WLL시스템의 RP와 RPC간은 E1/LAPD로 정합되어 있으며 이들의 물리적 연결방법은 E1전용선이나 HDSL과 같은 장비를 사용하여 구현하고 있다.In general, the WRP system's RP and RPC are matched with E1 / LAPD, and their physical connection method is implemented using equipment such as E1 dedicated line or HDSL.
이 전용선은 WLL서비스 공급자들이 설치하여 제공하고 있으며 WLL RP의 스위치용량에 따라 E1 전용선의 수가 결정된다.These leased lines are installed and provided by WLL service providers. The number of E1 leased lines is determined by the switch capacity of the WLL RP.
이러한 E1 전용선은 기본적으로 32개의 PCM채널을 제공하며 0번 채널은 동기 채널로 16번 채널은 LAPD프로토콜 전용채널로 사용하고 있어 제공 가능한 음성 채널수는 30채널 뿐이다.The E1 dedicated line basically provides 32 PCM channels, and channel 0 is used as a synchronization channel and channel 16 is used as a dedicated channel for the LAPD protocol, so only 30 channels can be provided.
WLL시스템의 OMNI기지국은 기본적으로 30-40채널을 제공하나 1FA 3섹터의 경우는 90-120채널을 수용해야 하므로 3개의 E1 전용선이 필요하다.The OMNI base station of the WLL system provides 30-40 channels by default, but three E1 dedicated lines are needed because 1FA 3 sectors must accommodate 90-120 channels.
이 E1 전용선은 초기 설치비가 많이 드는 단점이 있어 추후 기지국 용량 증가를 잘 설계하여야 하나 지역에 따른 서비스 증가율을 정확히 예측하기가 힘들며 E1 링크의 용량 초과시에는 E1 링크 하나를 가설하기가 무척 어려워 재증설시 많은 시간과 비용이 요구된다.This E1 leased line has a disadvantage of high initial installation cost, so it is necessary to design the base station capacity increase well later, but it is difficult to accurately estimate the service growth rate according to the region, and it is very difficult to establish one E1 link when the capacity of the E1 link is exceeded. It takes a lot of time and money.
종래 이를 해결하기 위한 수단으로 RP와 RPC간의 한정된 E1링크를 최대한 이용하는 방법이 있다.Conventionally, there is a method of maximizing the limited E1 link between RP and RPC as a means to solve this problem.
즉, RP와 RPC간의 64Kbps의 PCM음성정보는 32Kbps의 ADPCM으로 변조되어 송수신되고 있으며 하나의 음성채널에 4비트만 채워 송수신하고 있다.That is, 64 Kbps PCM voice information between RP and RPC is modulated and transmitted by 32 Kbps ADPCM, and only 4 bits are filled in one voice channel.
도 1은 WLL시스템의 RP와 RPC간의 서브채널 스위칭의 기본 개념도로, (A)는 기존의 시스템에서 음성변조된 ADPCM데이터를 8비트의 채널 하나에 실어 송수신하는 상태를 나타낸 개념도이다.FIG. 1 is a basic conceptual diagram of subchannel switching between RP and RPC of a WLL system, and (A) is a conceptual diagram illustrating a state in which voice-modulated ADPCM data is transmitted and received on one 8-bit channel in a conventional system.
(B)는 RP와 RPC간의 서브채널 스위칭을 수행하는 개념도로, 8비트의 채널 하나에 4비트 ADPCM데이터 2개씩을 실어 송수신하는 상태를 나타낸 개념도이다.(B) is a conceptual diagram for performing subchannel switching between RP and RPC, and is a conceptual diagram illustrating a state of transmitting and receiving two 4-bit ADPCM data on one 8-bit channel.
도 2는 RP와 RPC사이의 서브채널 스위칭을 수행하는 다양한 방법들중에서 E1정합부에서 구현하였을 경우 E1 RP/RPC정합 보드 유니트의 블록도이고, 도 3은 서브채널 스위칭을 수행하여 주는 CCU/ECRU유니트의 블록도이다.FIG. 2 is a block diagram of an E1 RP / RPC matching board unit when implemented in an E1 matching unit among various methods for performing subchannel switching between RP and RPC, and FIG. 3 is a CCU / ECRU for performing subchannel switching. A block diagram of the unit.
이와같은 서브 채널 스위칭방법으로는 메인 스위치가 위치한 RMCU(RPC Main Control Unit)와 RCP(RP Control Processor)내에서 수행하는 방법과 각각의 4비트의 ADPCM데이터를 직접 다루는 CCU(Cannel Control Unit)와 ETU(Echo Canceller & Trancoding Unit)에서 처리하는 방법이 있다.Such subchannel switching methods are performed in the RMCU (RPC Main Control Unit) and RCP (RP Control Processor) where the main switch is located, and the CCU (Cannel Control Unit) and ETU that directly handle each 4-bit ADPCM data. There is a way to do it in (Echo Canceller & Trancoding Unit).
그러나 종래 RMCU/RCP에서 구현하는 방법은 메인 스위치에서 구현하므로 시스템 구성은 간단한 장점이 있으나, 대용량 스위치를 가져야 하므로 소프트웨어적인 로드가 많이 걸리는 단점이 있다.However, since the conventional RMCU / RCP is implemented in the main switch, the system configuration has a simple advantage, but it requires a large capacity switch, which requires a lot of software load.
또한, CCU/ETU에서 구현하는 방법은 현재 각 부분에서 서브 채널을 다루기 때문에 별도의 하드웨어적인 구현이 불필요하나 해당 기지국에 대한 풀 용량의 서브 채널 스위칭을 할 수 없는 단점이 있다.In addition, since the method implemented in the CCU / ETU currently handles subchannels in each part, a separate hardware implementation is unnecessary, but there is a disadvantage in that full capacity subchannel switching for a corresponding base station cannot be performed.
본 발명은 이와같은 종래의 문제점을 해결하기 위하여 안출한 것으로, 본 발명의 목적은, WLL 시스템에 있어서 RP와 RPC간의 E1링크 전송효율을 높이는 서브채널을 스위칭 장치를 제공하여 시스템 유지 보수 및 확장성이 용이하도록 하는 비동기 전송 모드시스템의 기지국과 기지국 제어국간 서브채널 제어장치 및 방법을 제공하는데 있다.SUMMARY OF THE INVENTION The present invention has been made to solve such a conventional problem, and an object of the present invention is to provide a switching device for a subchannel that increases the transmission efficiency of an E1 link between an RP and an RPC in a WLL system, thereby providing system maintenance and scalability. The present invention provides a subchannel control apparatus and method between a base station and a base station control station in an asynchronous transmission mode system to facilitate this.
도 1은 서브 채널 스위칭의 개념도1 is a conceptual diagram of subchannel switching
도 2는 서브 채널을 수행하는 E1RP/RPC유니트의 블록도2 is a block diagram of an E1RP / RPC unit performing subchannels
도 3은 서브 채널 스위칭을 수행하는 CCU/ECTU유니트의 블록도3 is a block diagram of a CCU / ECTU unit performing subchannel switching
도 4는 본 발명의 서브 채널 스위칭을 수행하는 E1RP/RPC유니트의 블록도4 is a block diagram of an E1RP / RPC unit performing subchannel switching of the present invention.
도 5는 본 발명에 따른 서브 채널 스위칭을 수행하는 E1RP/RPC유니트의 동 작 흐름도5 is an operation flowchart of an E1RP / RPC unit performing subchannel switching according to the present invention.
〈도면의 주요 부분에 대한 부호의 설명〉<Explanation of symbols for main parts of drawing>
10:E1라인 인터페이스 트랜스포머 11:E1프레이머 및 트랜스포머10: E1 line interface transformer 11: E1 framer and transformer
12:클락동기부 13:HDAL어레이12: Clock synchronous 13: HDAL array
14:타임스위치 15:병렬버스 콘트롤러14: Time switch 15: Parallel bus controller
16:CPU 17:EPLD인터럽트 핸들러16: CPU 17: EPLD Interrupt Handler
18:롬 19:램18: Romans 19: Ram
20:프레쉬 롬 21:SIO20: Fresh rom 21: SIO
이하, 본 발명의 실시예를 첨부된 도면을 참고로 하여 상세히 설명하면 다음과 같다.Hereinafter, embodiments of the present invention will be described in detail with reference to the accompanying drawings.
도 4는 서브채널 스위칭을 수행하여 주는 E1 RP/RPC유니트의 상세 블록도로,기지국과 제어국 사이의 물리적인 연결방법인 E1의 특성을 맞추어 주는 E1라인 인터페이스 트랜스포머(10)와, E1프레임을 송수신하며, 입력되는 E1프레임의 에러를 체크 복구하고 동기를 맞추어 주는 E1프레이머 및 트랜스시버(11)와, 상기 E1프레이머 및 트랜스시버(11)에 클락동기신호를 공급하는 클락동기부(12)와, E1프레임간의 LAPD처리를 위한 콘트롤러로, 입력되는 E1프레임에서 각 채널별로 할당되어 채널에서 HDLC(High-level Data Link Control Precedure)프레임을 추출하는 HDLC어레이(13)와, 정합장치 내부에서 병렬 버스 콘트롤러(15)를 통하여 상위 제어부로 보낸 후 입력된 데이터들의 정보를 분석하여 이에 대한 서브 스위칭 정보를 수신하는 타임스위치(14)와, 병렬 버스 콘트롤러(15)와, 각부를 제어하는 CPU(16)와, 내부에서 사용되는 각종 클럭이나 디코더/인터럽트를 다루는 EPLD(17)와, 보드 파우어 온시 보드를 기동시키는 소프트웨어가 실장되어 있는 롬(18)과, 응용 소프트웨어가 내장되어 있는 메모리이며 롬(18)의 프로그램이 구동되면 여기에 기록된 소프트웨어가 램(19)으로 로드되어 구동되는 프레쉬 롬(20)과, 응용 소프트웨어가 로드되어 사용되며 각종 연산시의 변수들의 저장장소로 사용되는 램(19)과, RS-232를 통하여 내부와 통신을 수행하도록 도와주는 역할을 하는 시리얼 포트인 SIO(Serial Input-Output)(21)로 구성된다.4 is a detailed block diagram of an E1 RP / RPC unit performing subchannel switching, and transmits and receives an E1 frame interface 10 and an E1 line interface transformer 10 that matches the characteristics of E1, a physical connection method between a base station and a control station. And an E1 framer and transceiver 11 for checking and recovering an error of the input E1 frame and synchronizing the clock; and a clock synchronizing unit 12 for supplying a clock synchronization signal to the E1 framer and transceiver 11, and an E1 frame. As a controller for LAPD processing, an HDLC array 13 for extracting a high-level Data Link Control Precedure (HDLC) frame from a channel assigned to each channel in an input E1 frame, and a parallel bus controller (15) inside a matching device. The time switch 14, the parallel bus controller 15, and each unit for analyzing the information of the input data and sending the sub-switching information to the upper control unit through CPU 16 for controlling the CPU, an EPLD 17 for dealing with various clocks and decoders / interrupts used therein, a ROM 18 having software for starting a board on-board, and application software. When the program of the ROM 18 is driven and the software recorded therein is loaded into the RAM 19, the fresh ROM 20 is driven and the application software is loaded and used to store variables for various calculations. RAM 19 is used, and a serial input SIO (Serial Input-Output) 21 which serves to help communicate with the internal through RS-232.
이와같이 구성된 본 발명의 작용을 설명하면 다음과 같다.Referring to the operation of the present invention configured as described above is as follows.
E1라인 인터페이스 트랜스포머(10)는 기지국과 제어국 사이의 물리적인 연결방법인 E1의 특성을 맞추어 E1라인 프레이머 및 트랜스시버(11)로 보내면 E1라인 프레이머 및 트랜스시버(11)는 입력되는 E1프레임의 에러를 체크 복구하고, 클락 동기부(12)로부터 입력되는 동기를 맞추어 주며, E1프레임을 송/수신한다.The E1 line interface transformer 10 sends the E1 line framer and the transceiver 11 to the E1 line framer and the transceiver 11 according to the characteristics of the physical connection method between the base station and the control station. It checks and restores, synchronizes the synchronization input from the clock synchronization unit 12, and transmits / receives an E1 frame.
또한, HDLC어레이(13)는 E1프레임간의 LAPD처리를 위한 제어를 수행하며, 타임 스위치(14)는 정합장치 내부에서 직접적으로 서브 채널을 수행한다.In addition, the HDLC array 13 performs control for LAPD processing between E1 frames, and the time switch 14 performs a subchannel directly in the matching device.
그리고 CPU(16)는 HDLC어레이(13)로부터 추출된 호처리 및 제어정보를 분석하여 정보를 병렬 버스 콘트롤러(15)를 통하여 상위 제어부로 보내면, 입력된 데이터들의 정보를 분석하여 이에 대한 서브 스위칭 정보를 수신하고 타임 스위치부(14)를 제어한다.The CPU 16 analyzes the call processing and control information extracted from the HDLC array 13 and sends the information to the upper controller through the parallel bus controller 15. The CPU 16 analyzes the information of the input data and sub-switching information therefor. Receives and controls the time switch unit 14.
EPLD 디코더 인터럽트 핸들러(17)는 내부에서 사용되는 각종 클럭이나 디코더/인터럽트를 다루며, 롬(18)은 보드 파우어 온시 보드를 기동시키는 소프트웨어가 실장되어 있다.The EPLD decoder interrupt handler 17 handles various clocks and decoders / interrupts used therein, and the ROM 18 has software for starting a board when the board is powered on.
또한, 프레시 롬(20)은 응용 소프트웨어가 내장되어 있는 메모리로 롬(18)의 프로그램이 구동되면 여기에 기록된 소프트웨어가 램(19)으로 로드(Load)되어 구동된다.In addition, the fresh ROM 20 is a memory in which application software is embedded, and when a program of the ROM 18 is driven, the software recorded therein is loaded into the RAM 19 and driven.
이때, 상기 롬(18)은 프레시 롬(20)의 응용 소프트웨어가 로드되어 사용되면 각종 연산시의 변수들의 저장장소로 사용되며, SIO(21)는 시리얼 포트로 사용된다.In this case, when the application software of the fresh ROM 20 is loaded and used, the ROM 18 is used as a storage location of variables in various operations, and the SIO 21 is used as a serial port.
도 5는 본 발명에서 서브채널 스위칭을 구현하기 위한 동작흐름도로, 파우어 온시 PBA를 초기화시키고 E1 라인 인터페이스 트랜스포머를 통하여 E1프레임을 입력한다(S1-S3단계).FIG. 5 is an operation flow diagram for implementing subchannel switching in the present invention. In the power-on, the PBA is initialized and an E1 frame is input through an E1 line interface transformer (S1-S3).
그리고 HDLC어레이(13)에서 D채널을 검출하고(S4단계), E1RP/RPC CPU에서 페이로드 추출후 RMCU로 전달한다(S4,S5단계).The HDLC array 13 detects the D channel (step S4), extracts the payload from the E1RP / RPC CPU, and transfers it to the RMCU (steps S4 and S5).
그러면 RMCU에서 호처리 정보 분석후 서브 채널 스위칭 명령을 하달한다(S6단계).Then, the RMCU analyzes the call processing information and issues a subchannel switching command (step S6).
따라서, 입력된 서브채널이 기설정된 채널과 같은가를 판단하여 다를때에는 E1RP/RPC CPU에서 타임 스위치(14)에 8비트 채널 스위칭 명령을 하달한다(S8단계).Accordingly, when it is determined whether the input subchannel is the same as the preset channel, the 8-bit channel switching command is issued to the time switch 14 by the E1RP / RPC CPU (step S8).
또한, RMCU에서 데이터 통신 정합장치(IWF)로 스위칭하면 이 데이터 통신 정합 장치에서 인터넷으로 접속한다(S9,S10단계).In addition, when switching from the RMCU to the data communication matching device IWF, the data communication matching device accesses the Internet (steps S9 and S10).
한편, 상기 S7단계에서 입력된 서브채널이 기설정된 채널과 같으면, E1RP/RPC CPU에서 타임 스위치(14)에 서브 채널 스위칭 명령을 하달한다(S11단계).On the other hand, if the sub-channel input in step S7 is the same as the preset channel, the sub-channel switching command to the time switch 14 in the E1RP / RPC CPU (step S11).
그러면 E1RP/RPC 타임 스위치(14)에서는 ADPCM데이터 하나당 8비트 채널 하나씩 할당하여 메인 스위치로 전달한다(S12단계).Then, the E1RP / RPC time switch 14 allocates one 8-bit channel per ADPCM data to the main switch (step S12).
또한, RMCU에서는 입력된 데이터를 ECTU로 전달 후 트랜스코더 처리하고(S13단계) 보코더에서 처리된 데이터를 교환기로 전송한다(S14단계).In addition, the RMCU transfers the input data to the ECTU and then processes the transcoder (step S13) and transmits the data processed by the vocoder to the exchange (step S14).
이상에서 설명한 바와같은 본 발명은 WLL시스템에서 RP와 RPC간의 E1링크 전송 효율을 높일 수 있으며 실장보드를 모듈화하여 시스템 유지보수 및 확장성을 용이하게 할 수 있는 효과가 있다.As described above, the present invention can increase the E1 link transmission efficiency between the RP and the RPC in the WLL system, and has an effect of facilitating system maintenance and scalability by modularizing the mounting board.
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