KR20000023526A - 부호분할다중접속 통신시스템의 확산코드 생성 및 이를이용한대역확산 장치 및 방법 - Google Patents

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Abstract

부호분할다중접속 통신시스템의 대역확산장치에서 대역확산을 위한 확산시퀀스 발생방법이, 먼저 임의의 초기위상에서 위상이변화하게 하는-DSPK를 수행하는 과정과, 다음에는 이전의 출력에서 동일한 값이 출력되거나 아니면 부호가 둘다 변화하게 되거나 위상이

Description

부호분할다중접속 통신시스템의 확산코드 생성 및 이를 이용한 대역확산 장치 및 방법 {DEVICE AND METHOD FOR GENERATING SPREADING CODE AND SPREADING CHANNEL SIGNALS USING SPREADING CODE IN CDMA COMMUNICATION SYSTEM}
본 발명은 부호분할다중접속 방식을 이용하는 통신시스템의 대역확산 장치 및 방법에 관한 것으로, 특히 확산시퀀스를 발생하는 장치 및 방법에 관한 것이다.
일반적으로 부호분할다중접속(Code Division Multiple Access: 이하 CDMA 라 칭한다) 방식의 이동통신 시스템은 음성을 위주로 하는 이동 통신 규격에서 발전하여, 음성뿐만 아니라 고속 데이터의 전송이 가능한 IMT-2000 규격으로 발전하기에 이르렀다. 상기 IMT-2000 규격에서는 고품질의 음성, 동화상, 인터넷 검색 등의 서비스가 가능하다. 상기 CDMA 이동 통신 시스템에서 단말기와 기지국 사이에 존재하는 통신 선로는 크게 기지국에서 단말기로 향하는 순방향 링크(Forward Link)와 반대로 단말기에서 기지국으로 향하는 역방향 링크(Reverse Link)로 구별된다.
상기 CDMA 통신시스템의 역방향링크에서 대역확산(spread spectrum)을 위한 방법으로는 PN(Psuedo Noise) 복소 확산방법(PN Complex Spreading Scheme)이 널리 알려져 있다. 그러나 상기 PN 복소 확산방법은 사용자 데이터에 따라 전력증폭기(Power Amplifier)의 출력에서 최대전력 대 평균전력비(Peak-to-Average Power Ratio: 이하 PAR 라 칭한다.)가 증가하는 문제점이 있다. 즉, 역방향링크에서 송신전력의 최대전력 대 평균전력비가 커지면 리그로스(Re-growth)가 발생하고, 단말기의 전력증폭기(Power Amplifier)의 설계와 성능에 커다란 영향을 미친다. 단말기 전력증폭기의 특성곡선에는 선형구간과 비선형구간이 존재하며, 단말기의 전력을 크게 하면 단말기의 송신신호가 비선형 구간에 걸치게 되어 타사용자의 주파수 영역을 방해하게되는데 이와 같은 현상을 "리그로스(Re-growth)"라 한다. 따라서 다른 사용자의 주파수 영역을 방해하지 않게하기 위해서는 셀영역을 작게하고, 그 셀 영역내의 단말기는 해당 기지국에 낮은 송신전력으로 신호를 전송해야 한다. 따라서 전체 시스템 성능의 하나인 비트오율(Bit Error Rate: 이하 BER 라 칭한다.) 성능의 저하를 최소화하면서도 PAR 를 감소시키는 확산방법을 사용하는 것이 필요하다.
상기 PN 복소확산방법을 살펴보기 위하여 종래의 CDMA방식 통신시스템의 송신기 구성을 살펴본다.
도 1은 부호분할다중접속 통신시스템의 대역확산장치를 포함하는 채널송신기의 구조를 도시하고 있다. 상기 채널송신기는 상기 도 1에 도시된 바와 같이 직교 확산기(orthogonal spreader)101, 복소 곱셈기(complex multiplier)102, 확산코드 발생기(spread sequence generator)103 및 저역여파 및 변조기104의 4개 부분으로 구성될 수 있다.
상기 도 1을 참조하면, 각 채널의 송신 데이타는 대응되는 채널부호화기들을 통해 채널 부호화(channel coding), 반복(repeatition) 및 인터리빙(interleaving)되어 직교 확산기101에 인가된다. 그러면 직교 확산기101은 대응되는 채널에 할당된 직교부호(orthogonal code)와 입력되는 채널 데이타를 곱하여 직교 확산한 후 출력한다. 상기 직교부호는 월시부호(Walsh code)를 사용할 수 있다. 상기 PN시퀀스 발생기103은 상기 각 채널들의 송신신호를 대역확산하기 위한 확산시퀀스를 발생한다. 상기 확산시퀀스는 PN시퀀스를 사용할 수 있다. 복소곱셈기102는 상기 직교확산기101에서 출력되는 신호들과 상기 PN시퀀스 발생기103에서 출력되는 확산시퀀스를 복소 곱셈하여 대역확산신호(complex spreading signal)를 발생한다. 저역여파 및 변조기104는 상기 복소곱셈기102에서 출력되는 복소 확산된 송신신호를 기저대역으로 여파한 후 RF 대역의 신호로 변조하여 출력한다.
도 2는 도 1과 같은 구성을 갖는 CDMA 방식 통신시스템의 채널 송신기의 상세한 구성도로써, 특히 역방향링크 채널송신기 구조를 도시하는 도면이다.
상기 도 2를 참조하면, 전송될 각 채널 데이터들은 채널 부호 과정(channel coding, repeating, channel interleaving)을 거친 후, 0는 +1로 1은 -1로 이진 매핑(Binary Mapping)이 되어서 각 채널 데이터로 입력된다. 상기와 같은 각 채널의 데이터들은 각 채널의 분리를 위하여 곱셈기111, 121, 131 및 141에서 직교부호와 곱해진다. 상기 도 2에서 각 채널 송신기들은 파일럿 채널(pilot channel), 제어채널(control channel), 부가채널(supplemental channel), 기본채널(fundamental channel) 등의 채널 송신기로 구성된 예를 도시하고 있다. 따라서 상기 직교부호들은 상기 각 채널들을 구분하기 위한 부호로써, 상기한 바와 같이 월시부호(Walsh code)를 사용할 수 있다. 상기와 같이 직교 확산된 각 채널 데이터 중에서 제어채널, 부가채널 및 기본채널 데이터들은 각각 제1이득조정기122 ~ 제3 이득조정기142에서 각 채널에 알맞은 이득(gain)이 곱해져 이득이 조정된다. 이렇게 만들어진 각 채널의 데이터들은 이진가산기112 및 133에서 합해진 다음, 복소곱셈기(Complex Multiplier) 102에 입력된다. 이하 본 발명에서 각 채널데이터를 모두 포함한 이진가산기 112 및 133의 출력을 "채널화 데이터"라 칭한다.
상기 복소곱셈기102는 상기 가산기112 및 133의 출력을 확산코드와 곱하여 대역 확산하는 기능을 수행한다. 여기서 확산코드는 상기한 바와 같이 PN시퀀스 발생기103에서 발생되는 PN코드를 사용할 수 있다. 상기 복소곱셈기102의 입력으로 사용되는 PN코드의 레이트(Rate)가 칩 율(Chip Rate)이고 +1 혹은 -1의 값을 가질 수도 있다. 이하의 설명에서는 상기 PN코드가 별도의 언급이 없는 한 +1 혹은 -1의 값을 가지는 것으로 가정한다.
상기 복소곱셈기102의 구성을 살펴보면, 상기 가산기112에 출력되는 채널화 데이타는 각각 곱셈기113 및 143에 인가되고, 상기 가산기133에서 출력되는 채널화 데이타는 곱셈기123 및 134에 인가된다. 또한 상기 곱셈기144에서 출력되는 확산코드 PNI는 곱셈기113 및 123의 다른 입력으로 인가되고, 상기 곱셈기145에서 출력되는 확산코드 PNQ는 곱셈기134 및 143의 다른 입력으로 인가된다. 그리고 상기 곱셈기113 및 134의 출력은 가산기114에서 감산되어 제1저역여파기115에 인가되며, 상기 곱셈기123 및 143의 출력은 가산기135에서 가산되어 제2저역여파기136에 인가된다.
상기 이진가산기114 및 135의 출력데이터 신호의 실수(Real)부분은 제1저역여파기115로 입력되고 허수(Imaginary)부분은 제2저역여파기136으로 입력된다. 저역여파기115 및 136을 거친 신호는 제4 및 제5 이득조정기116 및 137에 의하여 이득조정이 이루어진 후 변조되어 채널로 전송된다. 상기 이진가산기 114 및 135의 출력 데이터를 저역 여파하고 변조하여 이진가산기 118을 통하여 출력하는 장치는 저역여파 및 변조기 104에 대응된다.
지금까지 제1저역여파기115 및 제2저역 여파기136을 통과한 신호의 PAR을 줄이는 방법에 대하여 여러 가지 방법이 제안되어 왔으며, 그 방법들은 상기 PN시퀀스 발생기103에서 확산코드인 PNI및PNQ를 생성하는 방법에 중점을 둔 것이다. 일반적으로 최대전력 대 평균전력비 PAR은 상기 PNI및PNQ의 부호가 동시에 바뀌면서 생기는 제로-크로싱(Zero-Crossing)현상과, 상기 PNI및PNQ의 부호가 둘다 바뀌지 않는 홀드(Hold) 현상에 의해서 성능저하가 일어난다. 상기 ZC란, 예를들면 초기상태가 1사분면일 때 3사분면으로 천이하는 것과 같이 위상변화는가 되는 것을 의미한다. 그리고 상기 홀드란, 예를들면 초기상태가 1사분면일때 1사분면에 그대로 머무르는 천이와 같이 위상 변화가 없는 것을 의미한다.
상기한 바와 종래의 QPSK 확산방법은 PN 코드의 값에 따라 생성된 확산코드의 상태천이가 1사분면에서 2사분면, 3사분면 및 4사분면으로 모두 가능한 천이경로를 가진다. 이로인해 종래의 확산 코드를 생성 방법을 사용하게 되면, 상기 PNI및PNQ가 동시에 부호가 바뀌면서 생기는 제로-크로싱(Zero-Crossing: 이하 ZC 라 칭한다.)현상과, PNI및PNQ의 부호가 둘다 바뀌지 않는 홀드(Hold) 현상에 의해서 상기 PAR의 성능저하가 일어난다. 따라서 CDMA 통신시스템에서 대역확산시 PNI및PNQ에 따라 PAR이 커지는 문제점이 있다.
따라서 본 발명의 목적은 부호분할다중접속 통신시스템에서 비트오율의 성능저하 없이 최대전력 대 평균전력비를 감소시킬 수 있는 확산시퀀스를 생성할 수 있는 장치 및 방법을 제공함에 있다.
본 발명의 다른 목적은 부호분할다중접속 통신시스템에서 PN시퀀스를 QPSK 및 π/2-DPSK 위상천이시킨 확산시퀀스를 반복적으로 생성할 수 있는 장치 및 방법을 제공함에 있다.
본 발명의 또 다른 목적은 부호분할다중접속 통신시스템에서 PN시퀀스와 특정의 직교부호를 혼합시켜 DPSK 위상천이 및 QPSK 위상천이를 반복적으로 수행하는 확산시퀀스를 생성할 수 있는 장치 및 방법을 제공함에 있다.
본 발명의 또 다른 목적은 부호분할다중접속 통신시스템에서 생성되는 PN시퀀스를 이전의 확산시퀀스와 혼합시켜 DPSK 위상천이 및 QPSK 위상천이된 확산시퀀스를 생성하며, 상기 생성된 확산시퀀스를 선택하여 DPSK 위상천이 및 QPSK 위상천이를 반복적으로 수행하는 확산시퀀스를 생성할 수 있는 장치 및 방법을 제공함에 있다.
본 발명의 또 다른 목적은 부호분할다중접속 통신시스템에서 PN시퀀스를 QPSK 및 π/2-DPSK 위상천이시킨 확산시퀀스를 반복적으로 생성하고, 생성된 확산시퀀스를 이용하여 채널신호를 확산(역확산)할 수 있는 장치 및 방법을 제공함에 있다.
도 1은 부호분할다중접속 통신시스템의 채널송신기 구조를 도시하는 도면
도 2는 부호분할다중접속 통신시스템의 역방향링크 채널송신기 구조를 상세하게 도시하는 도면
도 3 - 도 6은 각각 제로크로싱, 홀드, +-DPSK, --DPSK의 기본(Primitive) 상태천이를 도시하는 도면
도 7은 부호분할다중접속 통신시스템의 대역확산장치에서-DPSK 확산시퀀스를 발생하는 구성을 도시하는 도면
도 8은 부호분할다중접속 통신시스템의 대역확산장치에서 QPSK,-DPSK 확산시퀀스를 발생하는 구성을 도시하는 도면
도 9는 도 8과 같은 구조로 QPSK,-DPSK 확산시퀀스를 발생하는 타이밍도를 도시하는 도면
도 10은 QPSK,-DPSK 확산시퀀스를 발생하는 구조에서 QPSK,-DPSK의 상태천이에 대한 타이밍도를 도시하는 도면
도 11은-DPSK , QPSK 확산시퀀스를 발생하는 구조에서-DPSK , QPSK의 상태천이에 대한 타이밍도를 도시하는 도면
도 12는 부호분할다중접속 통신시스템에서 본 발명의 실시예에 따라 확산시퀀스를 발생할 때 1-칩 선행에 의한-DPSK , QPSK 상태천이에 대한 타이밍도를 도시하는 도면
도 13은 부호분할다중접속 통신시스템에서 본 발명의 실시예에 따라 확산시퀀스를 발생할 때 1-칩 지연에 의한-DPSK , QPSK 상태천이에 대한 타이밍도를 도시하는 도면
도 14는 부호분할다중접속 통신시스템에서 본 발명의 실시예에 따른 1-칩 지연을 이용한 D-Q 상태천이 구현한 확산코드 발생기의 구성을 도시하는 도면
도 15는 부호분할다중접속 통신시스템에서 본 발명의 실시예에 따른 1-칩 지연을 이용한 D-Q 상태천이 구현한 또 다른 확산코드 발생기의 구성을 도시하는 도면
도 16은 부호분할다중접속 통신시스템에서 본 발명의 실시예에 따른 D-Q 확산코드 발생기 구성을 도시하는 도면
도 17은 부호분할다중접속 통신시스템에서 본 발명의 실시예에 따른 D-Q 확산코드 발생기의 타이밍도를 도시하는 도면
도 18은 부호분할다중접속 통신시스템에서 본 발명의 다른 실시예에 따른 D-Q확산코드 발생기의 구성을 도시하는 도면
이하 본 발명의 바람직한 실시예를 첨부된 도면의 참조와 함께 상세히 설명한다.
상기 확산코드의 상태천이(State Transition)의 특성은 하기의 설명에 의하여 보다 명확히 이해될 수 있다. 설명의 편의를 위하여, 상기 확산코드의 초기 상태가 1사분면에 위치하는 것으로 설정하기로 한다. 도 3 - 도 6는 기본(Primitive) 상태천이를 도시하는 도면으로써, 상기 도 3은 제로크로싱을 나타내며, 상기 도 4는 홀드를 나타내고, 상기 도 5는-DPSK를 나타내며, 상기 도 6은-DPSK를 나타낸다. 상기와 같은 상태천이는 여러 가지 방법으로 구현이 가능하다.
한편 이전상태를 1사분면의 값(1,1)이라고 가정할 때, 현재 상태가 1사분면의 값(1,1), 2사분면의 값(-1,1), 3사분면의 값(-1,-1) 혹은 4사분면의 값(1,-1)이 되는 경우, 이것은 이전 상태의 값에 관계없이 현재 상태로의 천이가 모든 사분면에 나타날 수 있는 무기억적(Memoryless) 성격을 가진다. 이는 종래의 QPSK 확산방식이다(이하 Q라 칭한다).
상기한 바와 상기 확산코드 발생기의 확산시퀀스 Ci및 Cq가 동시에 부호가 바뀌면서 생기는 제로-크로싱 현상과, 확산코드의 부호가 둘다 바뀌지 않는 홀드 현상은 시스템의 PAR의 성능저하를 야기한다. 따라서 CDMA 통신시스템에서 대역확산시 확산코드 Ci및 Cq의 제로크로싱 및 홀드 현상을 억제하는 것이 PAR의 성능을 향성시킬 수 있다. 본 발명의 실시예에서는 확산시퀀스의 제로크로싱 및 홀드 현상을 줄이는 방식으로서, 확산시퀀스의 QPSK 및 DPSK 위상 천이를 반복적으로 수행한다. 그러면 상기 QPSK에서는 상기 도 3에서 도 6과 같은 모든 상태의 위상천이가 이루어질수 있지만, 다음에 DPSK 위상천이를 수행하므로써, 제로크로싱 및 홀드 현상을 방지할 수 있다. 상기와 같은 방법은 확산시퀀스의 제로크로싱 및 홀드 현상을 줄일 수 있으며, 또한 연속적인 제로크로싱 또는 홀드를 억제할 수 있다.
먼저 본 발명의 실시예에 따른 확산시퀀스 발생 동작을 살펴본다.
도 7은 부호분할다중접속 통신시스템에서 직교부호를 이용하여 상기-DPSK(이하 D 라 칭한다) 확산시퀀스를 발생하는 구성 예을 도시하는 도면이다.
상기 도 7을 참조하면, 곱셈기211은 직교부호1과 PN코드를 곱하여 확산코드 Ci를 생성하며, 곱셈기212는 직교부호2와 PN코드를 곱하여 확산코드 Cq를 생성한다. 여기서 상기 PN코드가 +1, -1, -1, +1, -1 이고, 초기 직교부호1이 +1이며, 상기 직교부호2가 +1 이라고 가정하면, 곱셈기211의 출력은 +1, -1, -1, +1, -1 이고, 곱셈기212의 출력은 +1, +1, -1, -1,-1이 된다. 따라서 곱셈기211 및 212의 출력(Ci,Cq)을 종합하면, (+1,+1),(-1,+1), (-1,-1),(+1,-1),(-1,-1) 이 되어, 확산코드의 상태천이가 1사분면, 2사분면, 3사분면, 4사분면, 3사분면으로 천이되어위상변화가 나타난다.
도 8은 QPSK,-DPSK 확산시퀀스를 발생하는 구성 예를 도시하는 도면이다.
상기 도 8을 참조하면, 2-데시메이터222는 PNI를 데시메이션하여 출력하며, 곱셈기223은 직교부호2와 상기 데시메이터222의 출력을 곱하여 출력한다. 곱셈기221은 직교부호1과 PNQ코드를 곱하여 확산코드 Ci를 생성하며, 곱셈기224는 상기 곱셈기223의 출력과 상기 PNQ코드를 곱하여 확산코드 Cq를 생성한다. 상기 곱셈기 221은 직교부호1과 PNQ를 곱하여 직교부호 Ci를 출력한다. 2-데시메이터 222는 PNI를 데시메이션하고, 곱셈기 223은 직교부호2와 2-데시메이터 222의 출력을 곱하며, 곱셈기 224에서 상기 곱셈기 223의 출력과 PNQ의 출력을 곱하여 직교부호 Cq를 출력한다.
도 9는 QPSK,-DPSK 확산시퀀스를 발생하는 상기 도 8의 구성 예에 대한 상세 타이밍도이다. 상기 도 8에서 직교부호1의 초기값은 +1이고, 직교부호2의 초기값은 +1이라고 가정한다. 상기 도 9에서 311은 PNI이고, 312는 2-데시메이터222에서 출력되는 PNI이며, 313은 곱셈기223의 출력이고, 314는 PNQ이며, 315는 곱셈기221에서 출력되는 확산코드 Ci이고, 316은 곱셈기224에서 출력되는 확산코드 Cq이며, 317은 확산코드의 상태 천이를 나타내고 있다.
상기 도 8 및 도 9를 참조하면, 곱셈기 221의 출력과 곱셈기 224의 출력은 각각 315 및 316과 같이 확산코드Ci, Cq를 구성한다. 상기 확산코드Ci, Cq출력을 정리하면, 도 9의 315, 316 및 317에 나타낸 바와 같이 (+1,+1), (-1,+1), (-1,-1), (+1,-1), (+1,+1), (-1,+1), (+1,-1), (+1,+1), (-1,-1), (-1,+1), (+1,-1), (+1,+1), (+1,+1), (-1,+1), (+1,+1), (+1,-1) 이 되어, 확산코드의 상태천이가 초기 임의상태에서 1사분면(Q천이), 2사분면(D천이), 3사분면(Q천이), 4사분면(D천이), 1사분면(Q천이), 2사분면(D천이), 4사분면(Q천이), 1사분면(D천이), 3사분면(Q천이), 2사분면(D천이), 4사분면(Q천이), 1사분면(D천이), 1사분면(Q천이), 2사분면(D천이), 1사분면(Q천이), 4사분면(D천이)이 된다. 즉, 상기 도 8과 같은 확산코드 발생기에서 발생되는 확산코드의 상태천이는 도 9의 317에 도시된 바와 같이 QPSK과-DPSK 의 상태천이가 반복적으로 발생한다.
도 10은 상기 직교확산기에서 출력되는 채널화 데이터와 Q-D 상태천이를 수행하는 확산코드 발생기의 출력을 도시한 타이밍도이다. 상기 도 10에서 411은 직교확산기에서 출력되는 채널화 데이타로써 복소곱셈기에 입력되며, 412는 확산코드 발생기103에서 출력되는 확산코드가 된다. 상기 도 10을 참조하면, 시간기준(time reference ; 이하 "타임레퍼런스"라 칭한다)에서 보았을 때, 상기 채널화 데이터가 복소곱셈기에 입력되는 시점에서 확산코드 발생기로부터 QPSK 상태천이를 하는 확산코드가 입력된다.
도 11은 상기 직교확산기에서 출력되는 채널화 데이터와 D-Q 상태천이를 수행하는 확산코드 발생기의 출력을 도시한 타이밍도이다. 상기 도 11에서 421은 직교확산기에서 출력되는 채널화 데이타로써 복소곱셈기에 입력되며, 422는 확산코드 발생기에서 출력되는 확산코드가 된다. 상기 도 11을 참조하면, 타임레퍼런스에서 보았을 때 상기 채널화데이터가 복소곱셈기에 입력되는 시점에서 확산코드 발생기로부터-DPSK 상태천이를 하는 확산코드가 입력된다.
따라서 상기 도 10의 Q-D 확산시퀀스를 발생하는 확산코드 발생기를 이용하여 상기 도 11의 D-Q 확산시퀀스를 발생하는 확산코드 발생기의 구현이 가능하다. 첫 번째 구현방법은 채널화데이터를 타임레퍼런스를 기준으로 해서 1-칩 지연(delay) 또는 1-칩 선행(advance)시키는 방법이다.
도 12는 도 10에서 채널화데이터를 타임레퍼런스를 기준으로 1-칩 선행시킨 타이밍도이다. 상기 도 12에서 431은 직교확산기에서 출력되는 1칩 선행된 채널화 데이타로써 복소곱셈기에 입력되며, 432는 확산코드 발생기에서 출력되는 확산코드이다. 상기 도 12를 참조하면, 타임레퍼런스에서 보았을 때 채널화데이터가 상기 복소곱셈기에 입력되는 시점에서 확산코드 발생기로부터-DPSK 상태천이를 하는 확산코드가 입력된다. 따라서 D-Q 상태천이를 구현하게 된다.
도 13은 도 10에서 채널화데이터를 타임레퍼런스를 기준으로 1-칩 지연시킨 타이밍도이다. 상기 도 13에서 441은 직교확산기에서 출력되는 1칩 지연된 채널화 데이타로써 복소곱셈기에 입력되며, 442는 확산코드 발생기에서 출력되는 확산코드이다. 성가 도 13을 참조하면, 타임레퍼런스에서 보았을 때 채널화데이터가 복소곱셈기에 입력되는 시점에서 확산코드 발생기로부터-DPSK 상태천이를 하는 확산코드가 입력된다. 따라서 D-Q 상태천이를 구현하게 된다.
상기 설명에서 알 수 있듯이 채널화데이터를 1-칩 선행 혹은 1-칩 지연하는 방법을 이용하여 Q-D 상태천이를 발생하는 확산코드 발생기를 이용하여 D-Q 상태천이를 구현할 수 있다.
두 번째 구현방법은 Q-D 확산코드 발생기의 출력을 1-칩 선행 혹은 1-칩 지연하는 방법을 이용하여 D-Q 상태천이를 구현할 수도 있다. 이하 본 발명에서는 비교적 구현이 간단한 1-칩 지연하는 방법을 이용한 경우에 대하여 설명하기로 한다.
도 14는 본 발명의 실시예에 따라 1-칩 지연을 이용한 D-Q 상태천이를 구현하는 구조를 도시하는 도면이다.
상기 도 14를 참조하면, 직교확산기511은 채널 부호화된 데이타를 입력하며, 상기 부호화 데이타를 할당된 직교부호와 곱하여 직교확산된 채널화 데이타를 발생한다. 여기서 상기 직교부호는 월시코드가 될 수 있다. 1-칩 지연기515는 상기 채널화 데이타를 1-칩 지연 출력한다. 확산코드 발생기513은 상기 채널화 데이타를 대역확산하기 위한 확산코드를 발생한다. 여기서 상기 확산코드 발생기513은 D-Q 위상천이를 반복하는 확산시퀀스를 발생할 수 있으며, 복소곱셈기512는 상기 1칩 지연된 채널화 데이타와 상기 확산코드를 복소 곱셈하여 대역확산된 송신신호를 발생한다. 여기서 상기 확산코드는 PN코드가 될 수 있다. 상기 PN코드는 레이트가 칩율이고, +1 또는 -1의 값을 가질 수도 있다. 본 발명의 실시예에서는 상기 PN코드가 +1 또는 -1의 값을 갖는 것으로 가정한다. 저역여파 및 변조기514는 상기 복소곱셈기512에서 출력되는 대역 확산신호를 기저대역으로 저역여파하며, 상기 저역 여파된 신호를 변조하여 RF신호로 변환한다. 상기 변조기는 QPSK 변조기를 사용할 수 있다.
상기 도 14와 같은 구조에서 상기 1-칩 지연기515는 상기 채널화데이터를 1-칩 지연하여 복소곱셈기512에 입력하며, 따라서 확산코드 발생기513은 D-Q 상태천이를 구현할 수 있다.
도 15는 본 발명의 또 다른 실시예에 따라 1-칩 지연을 이용한 D-Q 상태천이를 구현하는 구조를 도시하는 도면이다.
상기 도 15를 참조하면, 직교확산기511은 채널 부호화된 데이타를 입력하며, 상기 부호화 데이타를 할당된 직교부호와 곱하여 직교확산된 채널화 데이타를 발생한다. 여기서 상기 직교부호는 월시코드가 될 수 있다. 확산코드 발생기513은 상기 채널화 데이타를 대역확산하기 위한 확산코드를 발생한다. 1-칩 지연기516은 상기 확산코드 발생기513에서 출력되는 확산코드를 1-칩 지연 출력한다. 복소곱셈기512는 상기 채널화 데이타와 1-칩 지연된 상기 확산코드를 복소 곱셈하여 대역확산된 송신신호를 발생한다. 여기서 상기 확산코드는 PN코드가 될 수 있다. 상기 PN코드는 레이트가 칩율이고, +1 또는 -1의 값을 가질 수도 있다. 본 발명의 실시예에서는 상기 PN코드가 +1 또는 -1의 값을 값을 갖는 것으로 가정한다. 저역여파 및 변조기514는 상기 복소곱셈기512에서 출력되는 대역 확산신호를 기저대역으로 저역여파하며, 상기 저역 여파된 신호를 변조하여 RF신호로 변환한다. 상기 변조기는 QPSK 변조기를 사용할 수 있다.
상기 도 15와 같은 구조에서 상기 1-칩 지연기516은 확산코드 발생기513의 출력을 1-칩 지연하여 복소곱셈기512에 입력하며, 따라서 Q-D 확산코드 발생기를 이용하여 D-Q 상태천이를 구현할 수 있다.
한편, 상기 도 14 및 도 15에 도시된 바와 같은 1-칩 지연기를 사용하지 않고 확산코드 발생기513이 D-Q 상태천이를 수행하도록 구현할 수 있다. 이는 상기 도 8과 같은 구조를 갖는 종래 Q-D 확산코드 발생기에서 2-데시메이터812의 출력을 1-칩 지연하는 방법을 이용하여 D-Q 상태천이를 구현할 수 있다.
도 16은 본 발명의 또 다른 실시예에 따른 D-Q 확산코드 발생기 구조를 도시하는 도면이다.
상기 도 16을 참조하면, 데시메이터612는 PNI를 데시메이션하여 출력하며, 지연기615는 상기 데시메이터612의 출력을 지연한다. 곱셈기613은 직교부호2와 상기 지연기615의 출력을 곱하여 출력한다. 곱셈기611은 직교부호1과 PNQ코드를 곱하여 확산코드 Ci를 생성하며, 곱셈기614는 상기 곱셈기613의 출력과 상기 PNQ코드를 곱하여 확산코드 Cq를 생성한다. 상기 곱셈기 611은 직교부호1과 PNQ를 곱하여 직교부호 Ci를 출력한다. 2-데시메이터 612는 PNI를 데시메이션하고, 곱셈기 613은 직교부호2와 2-데시메이터 612의 출력을 곱하며, 곱셈기 614에서 상기 곱셈기 613의 출력과 PNQ의 출력을 곱하여 직교부호 Cq를 출력한다.
따라서 상기 곱셈기 611은 직교부호1과 PNQ를 곱하여 직교부호 Ci를 출력한다. 또한 상기 2-데시메이터 612는 PNI를 데시메이션하고, 지연기615는 2-데시메이터612의 출력을 1-칩 지연한다. 상기 지연기615의 지연시간은 1-칩이 아닌 임의의 칩 시간이 될 수도 있다. 곱셈기 613은 직교부호2와 지연기615의 출력을 곱하며 곱셈기 614에서 상기 곱셈기 613의 출력과 PNQ의 출력을 곱하여 직교부호 Cq를 출력한다.
도 17은 QPSK,-DPSK 확산시퀀스를 발생하는 상기 도 16의 구성 예에 대한 상세 타이밍도이다. 상기 도 16에서 직교부호1의 초기값은 +1 이고, 직교부호2의 초기값은 +1이라고 가정한다. 상기 도 17을 참조하면, 711은 PNI이고, 712는 2-데시메이터612에서 출력되는 PNI이며, 713은 지연기615에서 출력되는 지연된 PNI이고, 714는 상기 직교부호2와 상기 지연기615의 출력을 곱하는 곱셈기613의 출력이고, 715는 PNQ이며, 716은 상기 PNQ와 상기 직교부호1을 곱하는 곱셈기611에서 출력되는 확산코드 Ci이고, 717은 상기 PNQ와 상기 곱셈기613의 출력을 곱하는 곱셈기614에서 출력되는 확산코드 Cq이며, 718은 확산코드의 상태 천이를 나타내고 있다.
상기 도 16 및 도 17의 예에서 직교부호1의 초기값은 +1 이고, 직교부호2의 초기값은 +1이라고 가정한다. 도 16 및 도17을 참조하면, 상기 곱셈기 611의 출력과 곱셈기 614의 출력은 각각 (Ci, Cq)를 구성한다. 상기 곱셈기611 및 614에서 출력되는 확산코드(Ci, Cq)의 출력을 정리하면, 도 17의 718에 도시된 바와 같이 (임의상태), (+1,-1), (-1,-1), (-1,+1), (+1,+1), (+1,-1), (-1,-1), (+1,+1), (+1,-1), (-1,+1), (-1,-1), (+1,+1), (+1,-1), (+1,-1), (-1,-1), (+1,-1) 이 된다. 따라서 상기 도 16과 같은 구조를 갖는 경우, 확산코드(Ci, Cq)의 상태천이가 초기 임의상태에서 4사분면(Q천이), 3사분면(D천이), 2사분면(Q천이), 1사분면(D천이), 4사분면(Q천이), 3사분면(D천이), 1사분면(Q천이), 4사분면(D천이), 2사분면(Q천이), 3사분면(D천이), 1사분면(Q천이), 1사분면(D천이), 4사분면(Q천이), 4사분면(D천이), 3사분면(Q천이), 4사분면(D천이)이 된다. 상기 상태천이 과정이 타임레퍼런스를 기준으로-DPSK 와 QPSK의 상태천이가 반복적으로 발생한다.
도 18은 직교부호를 사용하지 않고 PN시퀀스를 조합하여 QPSK(Quadrature Phase Shift Keying) 및-DPSK 상태 천이를 반복적으로 수행하는 또 다른 구현예를 도시하고 있다. 상기 도 18에서 신호A는 PNI및 PNQ의 신호가 그대로 출력되는 QPSK의 신호를 나타내고, 신호B는-DPSK를 나타낸다. 상기
도 18을 참조하면, 지연기811은 출력되는 이전 확산코드 Ci를 지연한다. 지연기521은 출력되는 이전 확산코드 Cq를 지연한다. 곱셈기815는 PNQ코드와 -1을 곱하여 PNQ코드를 반전시키는 기능을 수행한다. 곱셈기814는 지연기821에서 출력되는 이전 확산코드 Cq와 곱셈기815의 출력을 곱하여 출력한다. 제1선택기812는 상기 PNI코드를 제1신호A로 입력하며, 곱셈기814의 출력을 제2신호B로 입력하며, 제어장치831의 제어하에 입력되는 신호 A, B 중 해당하는 신호를 선택 출력한다. 곱셈기824는 PNQ코드와 상기 지연기811에서 출력되는 이전 확산코드 Ci를 곱하여 출력한다. 제2선택기822는 상기 PNQ코드를 제1신호A로 입력하며, 곱셈기824의 출력을 제2신호B로 입력하며, 제어장치831의 제어하에 입력되는 신호 A, B 중 해당하는 신호를 선택 출력한다. 여기서 상기 제1신호 A는 PNI및 PNQ의 신호가 그대로 출력되는 QPSK 신호이며, 제2신호 B는 π/2-DPSK 신호이다.
상기 도 18과 같은 구성으로 확산코드를 발생하는 동작을 살펴보면, 제어장치831은 제1 및 제2 선택기 812 및 822가 미리 정해진 순서에 따라 신호 A, B를 순차적으로 선택하도록 제어한다. 상기 QPSK,-DPSK의 방법을 조합하여 BER 성능 저하가 최소이면서도 PAR이 낮은 다양한 확산방법을 만들 수도 있다. 상기 도 18의 방법은 처음에는 입력되는 PNI및 PNQ의 값을 그대로 출력하므로 사분면에서(1,1), (1,-1), (-1,1), (-1,-1) 중의 한 값이 되는 QPSK를 수행하고, 다음에는 이전의 출력에서 위상이변화하게 하는-DSPK를 수행한다. 이것은 제1선택기812 및 제2선택기822의 선택에 있어서 신호A, 신호B를 순차적으로 반복 선택함으로써 동작할 수 있다. 상기 도 18의 PNI및 PNQ코드는 종래의 PN 확산코드에서 사용하는 것과 동일할 수도 있다.
상술한 바와 같이 본 발명은 CDMA 방식의 통신시스템의 대역 확산장치에서 사용되는 확산시퀀스를 생성할 시,-DPSK와 QPSK의 상태 천이가 반복적으로 이루어지는 확산시퀀스를 생성하므로써 PAR 를 감소시킬 수 있는 이점이 있다.

Claims (27)

  1. PNi 및 PNq 시퀀스를 발생하는 PN발생기와,
    제1직교부호 및 제2직교부호를 발생하며, 상기 제1직교부호 및 제2직교부호가 적어도 두 칩 간격으로 DPSK 상태 천이를 하는 직교부호 발생기와,
    확산부호 Ci, Cq의 위상이 이전 확산부호Ci, Cq 위상에 대하여 교번적으로 QPSK와 DPSK 상태 천이를 반복하도록, 상기 PNi 및 PNq 시퀀스와 상기 제1직교부호 및 제2직교부호를 각각 혼합하여 확산부호Ci 및 Cq를 생성하는 확산부호 발생기로 구성되는 부호분할다중접속 통신시스템의 확산부호 발생장치.
  2. 제1항에 있어서, 상기 확산부호 발생기가,
    상기 PNq시퀀스와 특정의 제1직교부호를 칩단위로 혼합하여 제2확산부호Ci를 발생하며, 상기 제1직교부호가 +1,+1로 이루어지는 2칩 시퀀스인 제1곱셈기와,
    상기 PNi시퀀스를 2-데시메이션하는 데시메이터와,
    상기 2-데시메이션된 PNi와 특정의 제2직교부호를 칩 단위로 혼합하며, 상기 제2직교부호가 +1,-1로 이루어지는 2칩 시퀀스인 제2곱셈기와,
    상기 제2곱셈기와 상기 PNq를 칩 단위로 혼합하여 제2확산부호Cq를 발생하는 제3곱셈기로 구성되는 부호분할다중접속 통신시스템의 확산부호 발생장치.
  3. 제2항에 있어서, 상기 데시메이터와 제2곱셈기 사이에 1칩 지연기를 더 부가하는 부호분할다중접속 통신시스템의 확산부호 발생장치.
  4. 제3항에 있어서, 이전 확산부호 Ci 및 Cq가 QPSK 상태 천이이면 상기 확산부호 Ci 및 Cq는 DPSK 상태 천이하며, 이전 확산부호 Ci 및 Cq가 DPSK 상태 천이이면 상기 확산부호 Ci 및 Cq는 QPSK 상태 천이하는 부호분할다중접속 통신시스템의 확산부호 발생장치.
  5. 제4항에 있어서, 상기 QPSK 상태 천이는, 제로크로싱 또는 홀드 상태 중의 한 상태이며, 상기 DPSK 상태 천이는천이한 상태인 부호분할다중접속 통신시스템의 확산부호 발생장치.
  6. PNi 및 PNq 시퀀스를 발생하는 PN발생기와,
    확산부호 Ci, Cq의 위상이 이전 확산부호Ci, Cq 위상에 대하여 교번적으로 QPSK와 DPSK 상태 천이를 반복하도록, 상기 PNi 및 PNq 시퀀스와 상기 이전 확산부호Ci 및 Cq를 각각 혼합하여 확산부호Ci 및 Cq를 생성하는 확산부호 발생기로 구성되는 부호분할다중접속 통신시스템의 확산부호 발생장치.
  7. 제6항에 있어서, 상기 확산부호 발생기가,
    상기 확산부호Ci를 1칩 지연하는 제1지연기와,
    상기 확산부호Cq를 1칩 지연하는 제2지연기와,
    상기 지연된 제2확산부호Cq와 반전된 상기 PNq 시퀀스를 혼합하는 제1곱셈기와,
    상기 지연된 제2확산부호Ci와 상기 PNq 시퀀스를 혼합하는 제2곱셈기와,
    상기 PNi와 상기 제1곱셈기의 출력을 번갈아가면서 선택하여 제2확산부호 Ci로 출력하는 제1선택기와,
    상기 PNq와 상기 제2곱셈기의 출력을 번갈아면서 선택하여 제2확산부호Cq로 출력하는 제2선택기로 구성되는 부호분할다중접속 통신시스템의 확산부호 발생장치.
  8. 제7항에 있어서, 이전 확산부호 Ci 및 Cq가 QPSK 상태 천이이면 상기 확산부호 Ci 및 Cq는 DPSK 상태 천이하며, 이전 확산부호 Ci 및 Cq가 DPSK 상태 천이이면 상기 확산부호 Ci 및 Cq는 QPSK 상태 천이하는 부호분할다중접속 통신시스템의 확산부호 발생장치.
  9. 제8항에 있어서, 상기 QPSK 상태 천이는, 제로크로싱 또는 홀드 상태 중의 한 상태이며, 상기 DPSK 상태 천이는천이한 상태인 부호분할다중접속 통신시스템의 확산부호 발생장치.
  10. 채널신호를 직교확산하는 직교확산기와,
    제1확산부호를 발생하는 제1확산부호 발생기와,
    상기 확산부호를 입력하며, 상기 입력된 제1확산부호의 위상을 이전에 생성된 제2확산부호에서 dpsk 상태 천이시키는 제2확산부호를 생성하는 제2확산부호 발생기와,
    상기 직교 확산된 신호를 상기 제2확산부호로 확산하는 복소곱셈기로 구성되는 부호분할다중접속 통신시스템의 대역확산장치.
  11. 제10항에 있어서,
    상기 제1확산부호발생기가 PNi 및 PNq를 발생하며,
    상기 제2확산부호발생기가 상기 PNi 및 PNq를 입력하고, 상기 PNi 및 PNq를 각각 특정의 제1직교부호 및 제2직교부호에 혼합시켜 상기 제2확산부호 Ci 및 Cq를 생성하며, 상기 제2확산부호 Ci 및 Cq가 이전에 생성된 제2확산부호 Ci 및 Cq 간의 위상 천이가 QPSK, DPSK 상태 천이를 반복하는 부호분할다중접속 통신시스템의 대역확산장치.
  12. 제11항에 있어서, 상기 제2확산부호 발생기가,
    상기 PNq와 특정의 제1직교부호를 칩단위로 혼합하여 제2확산부호Ci를 발생하며, 상기 제1직교부호가 +1,+1로 이루어지는 2칩시퀀스인 제1곱셈기와,
    상기 PNi를 2-데시메이션하는 데시메이터와,
    상기 2-데시메이션된 PNi와 특정의 제2직교부호를 칩 단위로 혼합하며, 상기 제2직교부호가 +1,-1로 이루어지는 2칩 시퀀스인 제2곱셈기와,
    상기 제2곱셈기와 상기 PNq를 칩 단위로 혼합하여 제2확산부호Cq를 발생하는 제3곱셈기로 구성되는 부호분할다중접속 통신시스템의 대역확산장치.
  13. 제12항에 있어서, 상기 데시메이터와 제2곱셈기 사이에 1칩 지연기를 더 부가하는 부호분할다중접속 통신시스템의 확산부호 발생장치.
  14. 제10항에 있어서,
    상기 제1확산부호발생기가 PNi 및 PNq를 발생하며,
    상기 제2확산부호발생기가 상기 PNi 및 PNq를 입력하고, 상기 PNi 및 PNq와, 상기 PNi 및 PNq를 이전에 생성된 제2확산부호 Ci 및 Cq를 혼합하여 상기 PNi 및 PNq와 DPSK 상태천이를 하는 확산부호를 생성하며, 상기 PNi 및 PNq와 상기 생성되는 제2확산부호 Ci 및 Cq를 칩단위로 순차적으로 선택하여 제2확산부호Ci 및 Cq로 생성하는 부호분할다중접속 통신시스템의 대역확산장치.
  15. 제14항에 있어서, 상기 제2확산부호 발생기가,
    상기 제2확산부호Ci를 1칩 지연하는 제1지연기와,
    상기 제2확산부호Cq를 1칩 지연하는 제2지연기와,
    상기 지연된 제2확산부호Cq와 반전된 상기 PNq를 혼합하는 제1곱셈기와,
    상기 지연된 제2확산부호Ci와 상기 PNq를 혼합하는 제2곱셈기와,
    상기 PNi와 상기 제1곱셈기의 출력을 번갈아가면서 선택하여 제2확산부호 Ci로 출력하는 제1선택기와,
    상기 PNq와 상기 제2곱셈기의 출력을 번갈아면서 선택하여 제2확산부호Cq로 출력하는 제2선택기로 구성되는 구성되는 부호분할다중접속 통신시스템의 대역확산장치.
  16. 채널신호를 직교확산하는 직교확산기와,
    제1확산부호를 발생하는 제1확산부호 발생기와,
    상기 확산부호를 입력하며, 상기 입력된 제1확산부호의 위상을 이전에 생성된 제2확산부호에서 dpsk 상태 천이시키는 제2확산부호를 생성하는 제2확산부호 발생기와,
    상기 제2확산부호를 1칩 지연하는 지연기와,
    상기 직교 확산된 신호를 상기 지연된 제2확산부호로 확산하는 복소곱셈기로 구성되는 부호분할다중접속 통신시스템의 대역확산장치.
  17. 채널신호를 직교확산하는 직교확산기와,
    상기 직교확산된 신호를 1칩 지연하는 지연기와,
    제1확산부호를 발생하는 제1확산부호 발생기와,
    상기 확산부호를 입력하며, 상기 입력된 제1확산부호의 위상을 이전에 생성된 제2확산부호에서 DPSK 상태 천이시키는 제2확산부호를 생성하는 제2확산부호 발생기와,
    상기 지연된 직교 확산된 신호를 상기 제2확산부호로 확산하는 복소곱셈기로 구성되는 부호분할다중접속 통신시스템의 대역확산장치.
  18. PNi 및 PNq 시퀀스와 적어도 두 칩 간격으로 DPSK 상태 천이시키기 위한 제1직교부호 및 제2직교부호들을 각각 발생하는 과정과,
    확산부호 Ci, Cq의 위상이 이전 확산부호Ci, Cq 위상에 대하여 교번적으로 QPSK와 DPSK 상태 천이를 반복하도록, 상기 PNi 및 PNq 시퀀스와 상기 제1직교부호 및 제2직교부호를 각각 혼합하여 확산부호Ci 및 Cq를 생성하는 과정으로 이루어지는 부호분할다중접속 통신시스템의 확산부호 발생방법.
  19. 제18항에 있어서, 상기 확산부호를 발생하는 과정이,
    상기 PNq시퀀스와 +1,+1로 이루어지는 2칩 시퀀스인 제1직교부호를 칩단위로 혼합하여 제2확산부호Ci를 발생하는 과정과,
    상기 PNi시퀀스를 2-데시메이션하고, 상기 2-데시메이션된 PNi와 +1,-1로 이루어지는 2칩 시퀀스인 제2직교부호를 칩 단위로 혼합하며, 상기 혼합된 시퀀스를 상기 PNq를 칩 단위로 혼합하여 제2확산부호Cq를 발생하는 과정으로 이루어지는 부호분할다중접속 통신시스템의 확산부호 발생방법.
  20. PNi 및 PNq 시퀀스를 발생하는 과정과,
    확산부호 Ci, Cq의 위상이 이전 확산부호Ci, Cq 위상에 대하여 교번적으로 QPSK와 DPSK 상태 천이를 반복하도록, 상기 PNi 및 PNq 시퀀스와 상기 이전 확산부호Ci 및 Cq를 각각 혼합하여 확산부호Ci 및 Cq를 생성하는 과정으로 이루어지는 부호분할다중접속 통신시스템의 확산부호 발생방법.
  21. 제20항에 있어서, 상기 확산부호를 발생하는 과정이,
    상기 확산부호Ci 및 확산부호Cq들을 각각 1칩 지연하는 과정과,
    상기 지연된 제2확산부호Cq와 반전된 상기 PNq 시퀀스를 혼합하여 제1혼합신호를 발생하고, 상기 지연된 제2확산부호Ci와 상기 PNq 시퀀스를 혼합하여 제2혼합신호를 발생하는 과정과,
    상기 PNi와 상기 제1혼합된 신호를 번갈아가면서 선택하여 제2확산부호 Ci로 출력하고, 상기 PNq와 상기 제2혼합신호를 번갈아면서 선택하여 제2확산부호Cq로 출력하는 과정으로 이루어지는 부호분할다중접속 통신시스템의 확산부호 발생방법.
  22. PNi 및 PNq 시퀀스와 적어도 두 칩 간격으로 DPSK 상태 천이시키기 위한 제1직교부호 및 제2직교부호들을 각각 발생하는 과정과,
    확산부호 Ci, Cq의 위상이 이전 확산부호Ci, Cq 위상에 대하여 교번적으로 QPSK와 DPSK 상태 천이를 반복하도록, 상기 PNi 및 PNq 시퀀스와 상기 제1직교부호 및 제2직교부호를 각각 혼합하여 확산부호Ci 및 Cq를 생성하는 과정과,
    직교확산된 채널신호를 상기 확산부호Ci 및 Cq로 확산하여 송신하는 과정으로 이루어지는 부호분할다중접속 통신시스템의 대역확산방법.
  23. 제22항에 있어서, 상기 확산부호Ci 및 Cq를 발생하는 과정이,
    PNq시퀀스와 +1,+1로 이루어지는 2칩 시퀀스인 제1직교부호를 칩단위로 혼합하여 제2확산부호Ci를 발생하는 과정과,
    상기 PNi시퀀스를 2-데시메이션하고, 상기 2-데시메이션된 PNi와 +1,-1로 이루어지는 2칩 시퀀스인 제2직교부호를 칩 단위로 혼합하며, 상기 혼합된 시퀀스를 상기 PNq를 칩 단위로 혼합하여 제2확산부호Cq를 발생하는 과정으로 이루어지는 부호분할다중접속 통신시스템의 대역확산방법.
  24. PNi 및 PNq 시퀀스를 발생하는 과정과,
    확산부호 Ci, Cq의 위상이 이전 확산부호Ci, Cq 위상에 대하여 교번적으로 QPSK와 DPSK 상태 천이를 반복하도록, 상기 PNi 및 PNq 시퀀스와 상기 이전 확산부호Ci 및 Cq를 각각 혼합하여 확산부호Ci 및 Cq를 생성하는 과정과,
    직교확산된 채널신호를 상기 확산부호Ci 및 Cq로 확산하여 송신하는 과정으로 이루어지는 부호분할다중접속 통신시스템의 대역확산방법.
  25. 제24항에 있어서, 상기 확산부호를 발생하는 과정이,
    상기 확산부호Ci 및 확산부호Cq들을 각각 1칩 지연하는 과정과,
    상기 지연된 제2확산부호Cq와 반전된 상기 PNq 시퀀스를 혼합하여 제1혼합신호를 발생하고, 상기 지연된 제2확산부호Ci와 상기 PNq 시퀀스를 혼합하여 제2혼합신호를 발생하는 과정과,
    상기 PNi와 상기 제1혼합된 신호를 번갈아가면서 선택하여 제2확산부호 Ci로 출력하고, 상기 PNq와 상기 제2혼합신호를 번갈아면서 선택하여 제2확산부호Cq로 출력하는 과정으로 이루어지는 부호분할다중접속 통신시스템의 대역확산방법.
  26. 제1확산부호를 발생하는 과정과,
    상기 제1확산부호의 위상을 이전에 생성된 제2확산부호에서 DPSK 상태 천이시키는 제2확산부호를 생성하는 과정과,
    상기 제2확산부호를 1칩 지연하는 과정과,
    직교 확산된 신호를 상기 지연된 제2확산부호로 복소 확산하는 과정으로 이루어지는 부호분할다중접속 통신시스템의 대역확산방법.
  27. 채널신호를 직교확산하는 직교확산기와,
    상기 직교확산된 신호를 1칩 지연하는 과정과,
    제1확산부호를 발생하는 과정과,
    상기 제1확산부호의 위상을 이전에 생성된 제2확산부호에서 DPSK 상태 천이시키는 제2확산부호를 생성하는 과정과,
    상기 지연된 직교 확산된 신호를 상기 제2확산부호로 복소확산하는 과정으로 이루어지는 부호분할다중접속 통신시스템의 대역확산방법.
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