KR19990086332A - Pad open method of semiconductor device - Google Patents
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Abstract
패드오픈공정을 할 때 패드가 차아지-업되는 것을 억제하여 신뢰성 있는 패드를 제조하기 위한 반도체소자의 패드오픈방법을 제공하기 위한 것이다. 이와 같은 목적을 달성하기 위한 반도체소자의 패드오픈방법은 기판의 소정영역에 제 1 베리어막과 금속막과 제 2 베리어막이 적층되도록 차례로 형성하는 공정, 상기 제 1 베리어막과 상기 금속막과 상기 제 2 베리어막을 포함한 상기 전면에 페시베이션막으로 제 1 절연막과 제 2 절연막을 증착하는 공정, 상기 제 2 절연막 상부의 일영역이 드러나도록 감광물질을 형성하는 공정, 상기 감광물질을 마스크로 제 1 식각 기준가스와 헬륨가스를 혼합하여 제 2 절연막을 식각하는 공정과, 상기 감광물질과 상기 식각된 제 2 절연막을 마스크로 제 2 식각 기준가스와 헬륨가스를 혼합하여 제 1 절연막을 식각하는 공정, 상기 감광물질을 마스크로 상기 제 2 베리어막을 상기 금속막이 드러나도록 플라즈마식각하는 공정, 상기 감광물질을 헬륨가스를 첨가한 산소가스상태에서 에싱(Ashing)처리한 후 현상하는 것을 특징으로 한다.It is to provide a pad opening method of a semiconductor device for manufacturing a reliable pad by suppressing the pad is charged up during the pad opening process. In order to achieve the above object, a method of opening a pad of a semiconductor device may include sequentially forming a first barrier film, a metal film, and a second barrier film on a predetermined region of a substrate, wherein the first barrier film, the metal film, and the first Depositing a first insulating film and a second insulating film with a passivation film on the entire surface including the barrier film, forming a photosensitive material to expose a region of an upper portion of the second insulating film, and first etching the photosensitive material with a mask Etching a second insulating film by mixing a reference gas and helium gas; etching a first insulating film by mixing a second etching reference gas and helium gas using the photosensitive material and the etched second insulating film as a mask; Plasma etching the second barrier layer using the photosensitive material as a mask so that the metal layer is exposed, and oxygen containing helium gas as the photosensitive material. It characterized by ashing (Ashing) after processing in developer's state.
Description
본 발명은 반도체소자에 대한 것으로, 특히 반도체소자의 패드오픈공정을 할 때 특정 패드가 차아지-업(charge-up) 되는 것을 방지하기에 알맞은 반도체소자의 패드오픈방법에 관한 것이다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a semiconductor device, and more particularly, to a pad opening method of a semiconductor device suitable for preventing a specific pad from being charged up during a pad opening process of the semiconductor device.
첨부 도면을 참조하여 종래 반도체소자의 패드오픈방법에 대하여 설명하면 다음과 같다.A pad opening method of a conventional semiconductor device will be described below with reference to the accompanying drawings.
도 1a 내지 1d는 종래 반도체소자의 패드오픈방법을 나타낸 공정단면도이고, 도 2는 종래에 따라 패드오픈하여 변색된 패드를 나타낸 사진이다.1A to 1D are process cross-sectional views illustrating a pad opening method of a conventional semiconductor device, and FIG.
먼저 종래 반도체 패드오픈방법은 도 1a에 도시한 바와 같이 반도체기판(1)의 소정영역상에 배선층으로써 제 1 텅스텐티타늄막(2)과 알루미늄막(3)과 제 2 텅스텐티타늄막(4)이 차례로 적층되도록 형성한다. 그리고 상기 제 1 텅스텐티타늄막(2)과 알루미늄막(3)과 제 2 텅스텐티타늄막(4)을 포함한 반도체기판(1) 전면에 페시베이션막으로 PSG(Phospho Silicate Glass)로 구성된 산화막(5)과, 실리콘질화막(SiN)(6)을 차례로 증착한다. 여기서 실리콘질화막(6)은 P형으로 도핑된 것이다. 이후에 실리콘질화막(6)상에 감광막(7)을 30000Å 정도의 두께를 갖도록 도포하고, 노광 및 현상공정으로 소정부분이 제거되도록 감광막(7)을 선택적으로 패터닝한다.First, in the conventional semiconductor pad opening method, as shown in FIG. 1A, the first tungsten titanium film 2, the aluminum film 3, and the second tungsten titanium film 4 are formed as a wiring layer on a predetermined region of the semiconductor substrate 1. It is formed so as to be sequentially stacked. And an oxide film 5 composed of PSG (Phospho Silicate Glass) as a passivation film on the entire surface of the semiconductor substrate 1 including the first tungsten titanium film 2, the aluminum film 3, and the second tungsten titanium film 4; And the silicon nitride film (SiN) 6 are sequentially deposited. Here, the silicon nitride film 6 is doped with a P-type. Thereafter, the photoresist film 7 is coated on the silicon nitride film 6 to have a thickness of about 30000 mm 3, and the photoresist film 7 is selectively patterned so that a predetermined portion is removed by an exposure and development process.
다음에 도 1b에 도시한 바와 같이 상기 패터닝된 감광막(7)을 마스크로 이용하여 플라즈마 장비내에서 CF4+O2가스를 이용하여 실리콘질화막(6)을 식각한다.Next, as shown in FIG. 1B, the silicon nitride film 6 is etched using CF 4 + O 2 gas in a plasma apparatus using the patterned photoresist 7 as a mask.
이후에 도 1c에 도시한 바와 같이 상기 패터닝된 감광막(7)을 마스크로 CF4+Ar 가스로 다른 플라즈마 장비내에서 앤드포인트 디코더(EndPoint Decoder:EPD)로 PSG의 산화막(5)를 식각한다. 그리고 오버에치로 제 2 텅스텐티타늄막(4)을 식각하는데 이때 패드오픈된 알루미늄막(3)의 표면에 1차 차아지-업영역(8)이 발생한다. 이때 다른 플라즈마 장비를 사용하여 식각하므로 실리콘질화막(6)과 산화막(5)과 제 2 텅스텐티타늄막(4)의 식각된 측면이 계단형 슬롭을 이루게 된다.Subsequently, as illustrated in FIG. 1C, the oxide film 5 of the PSG is etched using an end point decoder (EPD) in another plasma apparatus using CF 4 + Ar gas using the patterned photoresist 7 as a mask. In addition, the second tungsten titanium film 4 is etched by overetching. At this time, the primary charge-up region 8 is generated on the surface of the pad-opened aluminum film 3. At this time, since etching is performed using other plasma equipment, the etched side surfaces of the silicon nitride film 6, the oxide film 5, and the second tungsten titanium film 4 form a stepped slope.
그리고 도 1d에 도시한 바와 같이 감광막(7)을 제거하기 위해서 1000SCCM 정도의 O2가스로 에싱(Ashing)처리를 할 때 플라즈마 상태의 전리된 전자가 1차 차아지-업영역(8)에 대전되어 2차 차아지-업영역(9)이 발생된다. 이와 같이 대전된 부분은 폴리머를 제거하기 위한 현상처리시 현상액과 반응하여 변색된다.As shown in FIG. 1D, when ashing is performed with O 2 gas of about 1000 SCCM to remove the photoresist film, ionized electrons in a plasma state are charged to the primary charge-up region 8. The secondary charge-up area 9 is then generated. The charged portion is discolored in reaction with the developer during the development treatment for removing the polymer.
상기와 같은 방법을 통하여 패드오픈한 종래 패드는 도 2에 도시한 사진에서와 같이 패드가 변색되어있음을 알수 있다.Through the above method, it can be seen that the pad has been discolored as shown in the photograph shown in FIG.
상기와 같은 종래 반도체소자의 패드오픈방법은 다음과 같은 문제가 있다.The pad opening method of the conventional semiconductor device as described above has the following problems.
페시베이션막인 실리콘질화막과 PSG의 산화막을 식각하여 패드오픈공정을 할 때 사용되는 가스들이 플라즈마 상태에서 특정 패드내에 1차 차아지-업되고, 또한 감광막을 에싱처리할 때에 O2가스에 의해 2차 차아지-업된다. 이후에 폴리머 제거를 위한 현상처리시에 2차 차아지-업된 영역의 패드가 변색된다. 이와 같이 불량한 패드가 형성되므로 패드의 신뢰성이 저하된다.Gases used during the pad-opening process by etching the silicon nitride film and the PSG oxide film, which are passivation films, are primarily charged up in a specific pad in a plasma state, and the O 2 gas is used when ashing the photoresist film. The car is charged up. The pads of the secondary charged-up area then discolor in development for polymer removal. As such a bad pad is formed, the reliability of the pad is lowered.
본 발명은 상기와 같은 문제를 해결하기 위하여 안출한 것으로 특히, 패드오픈공정을 할 때 패드가 차아지-업되는 것을 억제하여 신뢰성 있는 패드를 제조하기 위한 반도체소자의 패드오픈방법을 제공하는 데 그 목적이 있다.The present invention has been made to solve the above problems, and in particular, to provide a pad opening method of a semiconductor device for manufacturing a reliable pad by suppressing the pad is charged up during the pad opening process. There is a purpose.
도 1a 내지 1d는 종래 반도체소자의 패드오픈방법을 나타낸 공정단면도1A to 1D are process cross-sectional views illustrating a pad opening method of a conventional semiconductor device.
도 2는 종래에 따라 패드오픈하여 변색된 패드를 나타낸 사진Figure 2 is a photograph showing a pad discolored by the conventional pad opening
도 3a 내지 3d는 본 발명 반도체소자의 패드오픈방법을 나타낸 공정단면도3A to 3D are cross-sectional views illustrating a pad opening method of a semiconductor device according to the present invention.
도 4는 본 발명에 따라 패드오픈하여 정상상태인 패드를 나타낸 사진Figure 4 is a photo showing a pad in a steady state by opening the pad in accordance with the present invention
도면의 주요 부분에 대한 부호의 설명Explanation of symbols for the main parts of the drawings
21: 반도체기판 22: 제 1 텅스텐티타늄막21: semiconductor substrate 22: first tungsten titanium film
23: 알루미늄막 24: 제 2 텅스텐티타늄막23: aluminum film 24: second tungsten titanium film
25: 산화막 26: 실리콘질화막25: oxide film 26: silicon nitride film
27: 감광막27: photosensitive film
상기와 같은 목적을 달성하기 위한 본 발명 반도체소자의 패드오픈방법은 기판의 소정영역에 제 1 베리어막과 금속막과 제 2 베리어막이 적층되도록 차례로 형성하는 공정, 상기 제 1 베리어막과 상기 금속막과 상기 제 2 베리어막을 포함한 상기 전면에 페시베이션막으로 제 1 절연막과 제 2 절연막을 증착하는 공정, 상기 제 2 절연막 상부의 일영역이 드러나도록 감광물질을 형성하는 공정, 상기 감광물질을 마스크로 제 1 식각 기준가스와 헬륨가스를 혼합하여 제 2 절연막을 식각하는 공정과, 상기 감광물질과 상기 식각된 제 2 절연막을 마스크로 제 2 식각 기준가스와 헬륨가스를 혼합하여 제 1 절연막을 식각하는 공정, 상기 감광물질을 마스크로 상기 제 2 베리어막을 상기 금속막이 드러나도록 플라즈마식각하는 공정, 상기 감광물질을 헬륨가스를 첨가한 산소가스상태에서 에싱(Ashing)처리한 후 현상하는 것을 특징으로 한다.The pad opening method of the semiconductor device of the present invention for achieving the above object is a step of sequentially forming a first barrier film, a metal film and a second barrier film in a predetermined region of the substrate, the first barrier film and the metal film And depositing a first insulating film and a second insulating film with a passivation film on the entire surface including the second barrier film, forming a photosensitive material to expose a region of the second insulating film, and using the photosensitive material as a mask. Etching the second insulating film by mixing the first etching reference gas and helium gas; and etching the first insulating film by mixing the second etching reference gas and helium gas with the photosensitive material and the etched second insulating film as a mask. Process, plasma etching the second barrier layer using the photosensitive material as a mask to expose the metal film, and adding helium gas to the photosensitive material. It is characterized by developing after ashing treatment in the state of added oxygen gas.
첨부 도면을 참조하여 본 발명 반도체소자의 패드오픈방법에 대하여 설명하면 다음과 같다.The pad opening method of the semiconductor device according to the present invention will be described with reference to the accompanying drawings.
도 3a 내지 3d는 본 발명 반도체소자의 패드오픈방법을 나타낸 공정단면도이고, 도 4는 본 발명에 따라 패드오픈하여 정상상태인 패드를 나타낸 사진이다.3A to 3D are cross-sectional views illustrating a method of opening a pad of a semiconductor device according to the present invention, and FIG. 4 is a photograph showing a pad in a normal state by opening a pad according to the present invention.
본발명 반도체 패드오픈방법은 도 3a에 도시한 바와 같이 반도체기판(21)의 소정영역상에 배선층으로써 제 1 텅스텐티타늄막(22)과 알루미늄막(23)과 제 2 텅스텐티타늄막(24)이 차례로 적층되도록 형성한다. 그리고 상기 제 1 텅스텐티타늄막(22)과 알루미늄막(23)과 제 2 텅스텐티타늄막(24)을 포함한 반도체기판(21) 전면에 페시베이션막으로 PSG(Phospho Silicate Glass)로 구성된 산화막(25)과, 실리콘질화막(SiN)(26)을 차례로 증착한다. 여기서 실리콘질화막(26)은 P형으로 도핑된 것이다. 이후에 실리콘질화막(26)상에 감광막(27)을 30000Å 정도의 두께를 갖도록 도포하고, 노광 및 현상공정으로 소정부분이 제거되도록 감광막(27)을 선택적으로 패터닝한다.In the semiconductor pad opening method of the present invention, as shown in FIG. 3A, a first tungsten titanium film 22, an aluminum film 23, and a second tungsten titanium film 24 are formed as a wiring layer on a predetermined region of the semiconductor substrate 21. It is formed so as to be sequentially stacked. An oxide film 25 made of PSG (Phospho Silicate Glass) as a passivation film on the entire surface of the semiconductor substrate 21 including the first tungsten titanium film 22, the aluminum film 23, and the second tungsten titanium film 24. And a silicon nitride film (SiN) 26 are sequentially deposited. The silicon nitride film 26 is doped with a P-type. Thereafter, the photosensitive film 27 is applied on the silicon nitride film 26 to have a thickness of about 30000 mm 3, and the photosensitive film 27 is selectively patterned so that a predetermined portion is removed by an exposure and development process.
다음에 도 3b에 도시한 바와 같이 상기 패터닝된 감광막(27)을 마스크로 이용하여 플라즈마 장비내에서 60SCCM 정도의 CF4에 10SCCM 정도의 O2가스와 100SCCM 정도의 He가스를 사용하여 실리콘질화막(26)을 식각한다. 이때 CF4와 O2는 1차 식각 기준가스이고, 헬륨(He)가스와 1차 식각 기준가스의 유량비는 1:1이상이 되도록 하거나, 공정에 따라 헬륨가스량을 변화시킬 수 있다.Next, as shown in FIG. 3B, using the patterned photosensitive film 27 as a mask, the silicon nitride film 26 using CF 4 of about 60 SCCM, O 2 gas of about 10 SCCM and He gas of about 100 SCCM is used in a plasma apparatus. Etch). At this time, CF 4 and O 2 is the primary etching reference gas, the flow rate ratio of helium (He) gas and the primary etching reference gas may be 1: 1 or more, or the amount of helium gas can be changed according to the process.
이후에 도 3c에 도시한 바와 같이 상기 패터닝된 감광막(27)을 마스크로 60 SCCM 정도의 CF4에 300SCCM 정도의 Ar 가스와 400SCCM 정도의 He가스를 사용하여 다른 플라즈마 장비내에서 PSG의 산화막(25)를 식각한다. 이때 CF4와 Ar 가스는 2차 식각 기준가스이고, 헬륨가스와 2차 식각 기준가스의 비는 1:1이상이 되도록 하거나, 공정에 따라 헬륨가스량을 줄일 수 있다.In the above-mentioned 60 SCCM around the patterned photoresist 27 as a mask, CF 4, as later shown in Figure 3c in use the Ar gas and He gas of 400SCCM degree of about 300SCCM in other plasma equipment oxide film (25 of PSG Etch). At this time, CF 4 and Ar gas is the secondary etching reference gas, the ratio of helium gas and the secondary etching reference gas is 1: 1 or more, or the amount of helium gas can be reduced according to the process.
그리고 오버에치로 제 2 텅스텐티타늄막(24)을 식각한다. 이때 다른 플라즈마 장비를 사용하여 식각하므로 실리콘질화막(26)과 산화막(25)과 제 2 텅스텐티타늄막(24)의 식각된 측면이 계단형 슬롭을 이루게 된다.The second tungsten titanium film 24 is etched by over etching. At this time, since etching is performed using other plasma equipment, the etched side surfaces of the silicon nitride film 26, the oxide film 25, and the second tungsten titanium film 24 form a stepped slope.
그리고 도 3d에 도시한 바와 같이 감광막(27)을 제거하기 위해서 1000SCCM 정도의 O2가스와 500SCCM 정도의 He 가스를 사용하여 에싱(Ashing)처리를 한다. 여기서 에싱처리시에 헬륨가스와 O2가스의 비는 1:2 정도가 되도록 하고, 에싱비율(Ashing Rate)에 따라 헬륨가스량을 줄일 수 있다. 이후에 폴리머 제거를 위한 현상처리를 한다.As shown in FIG. 3D, an ashing process is performed using O 2 gas of about 1000 SCCM and He gas of about 500 SCCM to remove the photosensitive film 27. Here, the ratio of helium gas and O 2 gas during the ashing process is about 1: 2, and the amount of helium gas can be reduced according to the ashing rate. Thereafter, development is carried out to remove the polymer.
상기와 같은 방법을 통하여 패드오픈한 패드는 도 4에 도시한 사진에서와 같이 정상상태로써 변색되지 않았다.The pad-opened pad was not discolored to a normal state as shown in the photograph shown in FIG.
이와 같이 헬륨(He)가스를 혼합한 플라즈마 안정화 공정은 로코스(Local Oxidation of Silicon:LOCOS)공정에서 필드영역을 정의하기 위해서 패드오픈 공정을 진행할 때에도 SF6에 He가스를 혼합하는 것으로써 응용할 수 있다.The plasma stabilization process in which helium (He) gas is mixed can be applied by mixing He gas in SF 6 even when the pad opening process is performed to define the field region in the LOCOS process. have.
상기와 같은 본 발명 반도체소자의 패드오픈방법은 다음과 같은 효과가 있다.The pad opening method of the semiconductor device of the present invention as described above has the following effects.
패드오픈을 위해 페시베이션막인 실리콘질화막과 산화막을 식각하는 공정과, 에싱처리를 할 때 헬륨(He)가스를 혼합하여 사용하므로 가스의 대전을 안정화시켜서 패드내에 차아지-업이 발생되는 것을 방지할 수 있다. 따라서 이후공정에서 패드가 변색되는 것을 줄여서 패드의 신뢰성을 향상시킬 수 있다.The process of etching the passivation film silicon nitride film and the oxide film for pad opening, and helium (He) gas is mixed during the ashing process to stabilize the charging of the gas to prevent charge-up in the pad can do. Therefore, it is possible to improve pad reliability by reducing discoloration of the pad in a subsequent process.
Claims (8)
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019980019273A KR100287880B1 (en) | 1998-05-27 | 1998-05-27 | Method for opening pad of semiconductor device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019980019273A KR100287880B1 (en) | 1998-05-27 | 1998-05-27 | Method for opening pad of semiconductor device |
Publications (2)
Publication Number | Publication Date |
---|---|
KR19990086332A true KR19990086332A (en) | 1999-12-15 |
KR100287880B1 KR100287880B1 (en) | 2001-08-07 |
Family
ID=37517334
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019980019273A KR100287880B1 (en) | 1998-05-27 | 1998-05-27 | Method for opening pad of semiconductor device |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR100287880B1 (en) |
-
1998
- 1998-05-27 KR KR1019980019273A patent/KR100287880B1/en not_active IP Right Cessation
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Publication number | Publication date |
---|---|
KR100287880B1 (en) | 2001-08-07 |
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