KR19980056051A - Current source circuit - Google Patents
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Abstract
파워-업시 출력 단자의 초기 조건을 설정하기 위한 스타트-업 전류의 영향에 무관하게 안정된 기준 전압을 생성하도록 한 전류원 회로가 개시되어 있다. 기준 전압 발생부는 2개의 커런트 미러로 구성되어지며 파워-업시 출력 단자로 일정한 기준 전압을 발생시킨다. 스타트-업 장치는 파워-업시 상기 출력 단자의 초기 조건을 설정하기 위해 파워-업 초기동작시 상기 기준 전압 발생 수단으로 일정 전류를 공급하고, 그 이후 정상 동작에서는 동작이 정지된다. 윌슨 전류 미러 회로를 이용하여 스타트-업 회로를 구성하여 파워-업시 출력 단자의 초기 조건을 설정하기 위한 스타트-업 전류의 영향에 무관하게 안정된 기준 전압을 생성한다.A current source circuit is disclosed which produces a stable reference voltage regardless of the influence of the start-up current for setting the initial condition of the output terminal at power-up. The reference voltage generator is composed of two current mirrors and generates a constant reference voltage to the output terminal during power-up. The start-up device supplies a constant current to the reference voltage generating means during power-up initial operation to set the initial condition of the output terminal at power-up, and then stops operation in normal operation. The start-up circuit is constructed using a Wilson current mirror circuit to produce a stable reference voltage independent of the effect of the start-up current to set the initial condition of the output terminal at power-up.
Description
본 발명은 전류원 회로에 관한 것으로, 특히 파워-업(power-up)시 출력 단자의 초기 조건을 잡아 주기 위한 스타트-업(start-up) 전류의 영향에 무관하게 안정된 기준 전압을 생성하도록 한 전류원 회로에 관한 것이다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a current source circuit, and more particularly to a current source designed to produce a stable reference voltage regardless of the effect of start-up current to set the initial condition of the output terminal during power-up. It is about a circuit.
일반적으로, 전류원 회로는 회로 양 단자간의 전압 차와 무관하게 항상 일정한 전류를 흐르게 할 수 있는 회로를 의미한다. 이러한 전류원 회로는 아날로그 집적회로의 바이어스 회로에 사용되거나, 증폭기단의 부하 저항으로 널리 사용된다. 즉, 공지된 바와 같이, 연산 증폭기의 일부분을 구성하는 차동 증폭단에 전류원 회로가 사용되거나 회로의 바이어스 상태를 일정하게 유지하기 위하여 전류원 회로의 일종인 커런트 미러 회로가 사용되고 있다.In general, a current source circuit refers to a circuit capable of flowing a constant current at all times regardless of the voltage difference between both terminals of the circuit. Such a current source circuit is used in a bias circuit of an analog integrated circuit or widely used as a load resistance of an amplifier stage. That is, as is known, a current source circuit is used for the differential amplifier stage constituting a part of the operational amplifier, or a current mirror circuit, which is a kind of current source circuit, is used to maintain a constant bias state of the circuit.
그러나, 일반적인 전류원 회로 구성에 있어서, 주위 환경의 변화와 무관하게 항상 일정한 전류를 흐르게 할 수 있는 이상적인 전류원 회로는 구현하기는 용이하지 않다. 즉, 주위의 온도 변화, 회로를 구성하는 각 소자 자체의 온도 특성 변화 및 바이어스 상태에 따른 소자 자체의 비선형적 특성으로 인하여 항상 일정한 전류를 흐르게 할 수 있는 전류원 회로를 구현하기는 사실상 불가능하다.However, in a general current source circuit configuration, it is not easy to implement an ideal current source circuit capable of always allowing a constant current to flow regardless of changes in the surrounding environment. That is, it is virtually impossible to implement a current source circuit capable of allowing a constant current to flow at all times due to a change in ambient temperature, a change in temperature characteristic of each element constituting the circuit, and a nonlinear characteristic of the element itself according to a bias state.
그러나, 전술한 바와 같은 어려운 상황하에서도 보다 안정된 전류원 회로를 구현하기 위한 노력이 계속되고 있다.However, efforts have been made to implement more stable current source circuits even under difficult circumstances as described above.
종래의 일반적인 전류원 회로가 도 1에 도시되어 있다. 도시한 바와 같이, 종래의 전류원 회로는 전원 전압(Vcc) 노드와 제1 노드(N1) 사이에 접속된 제1 저항(R1), 상기 전원 전압(Vcc) 노드와 제1 노드(N1) 사이에 접속되며 베이스가 제2 노드(N2)에 연결된 PNP형 제4 바이폴라 트랜지스터(Q4), 상기 전원 전압(Vcc) 노드와 제2 노드(N2) 사이에 접속되며 베이스가 상기 제2 노드(N2)에 연결된 제5 PNP형 바이폴라 트랜지스터(Q5), 상기 제2 노드(N2)와 제3 노드(N3) 사이에 접속되며 베이스가 상기 제1 노드(N1)에 연결된 제2 NPN형 바이폴라 트랜지스터(Q2), 상기 제1 노드(N1)와 접지 전압(Vss) 사이에 접속되며 베이스가 상기 제3 노드(N3)에 연결된 제1 NPN형 바이폴라 트랜지스터(Q1), 상기 제 3 노드(N3)와 접지 전압(Vss) 사이에 접속된 제2 저항(R2), 상기 전원 전압(Vcc) 노드와 출력 단자 사이에 접속되며 베이스가 상기 제2 노드(N2)에 연결된 제6 PNP형 바이폴라 트랜지스터(Q6), 상기 출력 단자와 접지 전압(Vss) 사이에 접속되며 베이스가 상기 제3 노드(N3)에 연결된 제3 NPN형 바이폴라 트랜지스터(Q3)로 구성되어 있다.A conventional general current source circuit is shown in FIG. As shown, a conventional current source circuit includes a first resistor R1 connected between a power supply voltage Vcc node and a first node N1, and a connection between the power supply voltage Vcc node and a first node N1. A PNP type fourth bipolar transistor Q4 connected between the base and the second node N2, the power supply voltage Vcc and the second node N2, and a base connected to the second node N2. A connected fifth PNP bipolar transistor Q5, a second NPN bipolar transistor Q2 connected between the second node N2 and a third node N3 and having a base connected to the first node N1, A first NPN type bipolar transistor Q1 connected between the first node N1 and a ground voltage Vss and a base connected to the third node N3, and the ground voltage Vss with the third node N3. Is connected between the second resistor (R2), the power supply voltage (Vcc) node and the output terminal, and a base is connected to the second node (N2). The sixth PNP type bipolar transistor Q6 is connected between the output terminal and the ground voltage Vss, and the third NPN type bipolar transistor Q3 is connected to the third node N3.
상기와 같이 구성된 종래의 일반적인 전류원 회로 동작은 다음과 같다.The conventional general current source circuit operation configured as described above is as follows.
상기 제1 저항(R1)은 파워-온시 이 회로를 스타트시키기 위한 스타트-업 회로로 동작한다. 파워가 온되면 제1 저항(R1)을 통해 제2 NPN 트랜지스터(Q2)의 베이스에 전류가 공급되면서 제2 NPN 트랜지스터(Q2)가 동작되고, 제5 NPN 트랜지스터(Q5), 제2 NPN 트랜지스터(Q2) 및 제2 저항(R2)을 통해 전류가 흐르고, 이 전류가 제2 저항(R2)을 통해 전압으로 잡혀 제1 NPN 트랜지스터(Q1) 및 제3 NPN 트랜지스터(Q3)를 동작시킨다. 이어 제4 NPN 트랜지스터(Q4)도 동작되어 지면서 기준 전류가 제4 NPN 트랜지스터(Q4) 및 제1 NPN 트랜지스터(Q1)을 통해 흐른다. 제6 PNP 트랜지스터(Q6) 역시 온된다.The first resistor R1 acts as a start-up circuit for starting this circuit at power-on. When the power is turned on, the second NPN transistor Q2 is operated while a current is supplied to the base of the second NPN transistor Q2 through the first resistor R1, and the fifth NPN transistor Q5 and the second NPN transistor ( A current flows through Q2) and the second resistor R2, and the current is applied to the voltage through the second resistor R2 to operate the first NPN transistor Q1 and the third NPN transistor Q3. Subsequently, the fourth NPN transistor Q4 is also operated, and a reference current flows through the fourth NPN transistor Q4 and the first NPN transistor Q1. The sixth PNP transistor Q6 is also turned on.
그런데, 상기 제1 저항(R1)을 통해 제1 노드(N1)로 흐르는 전류(이하 'IR1'라 함)는 그 영향을 최소한 줄이기 위해 IRXIref가 되도록 제1 저항(R1)의 저항값을 되도록 크게 설계하게 된다. 하지만, 상기 제1 노드(N1)에 의해 동작되는 제2 NPN 트랜지스터(Q2)를 동작시킬 수 있는 최소한의 한계가 있으므로, IR1을 무한정 작게 할 수는 없다. 따라서 일정한 저항값을 갖는 상기 제1 저항(R1)을 통해 흐르는 전류 IR1은 전류원 회로가 동작한 후에도 계속해서 흘러 제1 노드(N1)로 흐르는 기준 전류인 Iref에 영향을 주게 된다.However, the current flowing through the first resistor R1 to the first node N1 (hereinafter referred to as “I R1 ”) is the resistance of the first resistor R1 such that I RX I ref to minimize the effect thereof. You will design the value as large as possible. However, since there is a minimum limit to operate the second NPN transistor Q2 operated by the first node N1, I R1 cannot be made infinitely small. Therefore, the current I R1 flowing through the first resistor R1 having a constant resistance value continues to flow after the current source circuit operates to affect I ref , which is a reference current flowing to the first node N1.
상기 제1 노드(N1)를 통해 흐르는 전류(Iref)와 출력 전류(Iout)를 수식으로 표현하면 다음[식 1]과 같다.When the current I ref and the output current I out flowing through the first node N1 are expressed by a formula, Equation 1 is as follows.
[식 1][Equation 1]
Iref= IC4+ IR I ref = I C4 + I R
IOUT= VBE1/R2= (VT/R2) ln (Iref/IS1) =(VT/R2)ln(IC4+ IRX)/IS1 I OUT = V BE1 / R 2 = (V T / R 2 ) ln (I ref / I S1 ) = (V T / R 2 ) ln (I C4 + I RX ) / I S1
실제로, 상기 제1 저항 R1은 굉장히 큰 값을 가지게 된다.In fact, the first resistor R 1 has a very large value.
상기와 같은 종래의 전류원 회로에서는 파워-업시 초기 동작을 설정하기 위한 스타트-업 회로인 제1 저항(R1)을 통해 흐르는 전류가 전류원 회로가 동작한 후에도 계속해서 흘러 제1 노드(N1)로 흐르는 기준 전류 Iref에 영향을 주게 되고, 또한 출력 신호인 Iout의 안정성에 영향을 주는 문제점이 있었다.In the conventional current source circuit as described above, a current flowing through the first resistor R1, which is a start-up circuit for setting an initial operation at power-up, continues to flow even after the current source circuit is operated to flow to the first node N1. There is a problem that affects the reference current I ref and also affects the stability of the output signal Iout.
따라서 본 발명에서는 파워-업시 출력 단자의 초기 조건을 설정하기 위한 스타트-업 전류의 영향에 무관하게 안정된 기준 전압을 생성하도록 한 전류원 회로를 제공하는 데에 그 목적이 있다.Accordingly, an object of the present invention is to provide a current source circuit which generates a stable reference voltage regardless of the influence of a start-up current for setting an initial condition of an output terminal during power-up.
도 1 은 종래의 전류원 회로도이다.1 is a conventional current source circuit diagram.
도 2 는 본 발명의 실시예에 의한 전류원 회로도이다.2 is a circuit diagram of a current source according to an embodiment of the present invention.
*도면의주요부분에대한부호의설명** Explanation of symbols on the main parts of the drawings *
Q1∼Q17 : 트랜지스터Q1 to Q17: transistor
R1∼R6 : 저항R1 to R6: resistance
상기한 목적을 달성하기 위하여 본 발명은 2개의 커런트 미러로 구성되어지며 파워-업시 출력 단자로 일정한 기준 전압을 발생시키기 위한 기준 전압 발생 수단; 및 파워-업시 상기 출력 단자의 초기 조건을 설정하기 위해 파워-업 초기동작시 상기 기준 전압 발생 수단으로 일정 전류를 공급하고, 그 이후 정상 동작에서는 동작이 정지되는 스타트-업 수단을 포함하는 전류원 회로를 제공한다.In order to achieve the above object, the present invention comprises a reference voltage generating means composed of two current mirrors for generating a constant reference voltage to the output terminal at power-up; And a start-up means for supplying a constant current to the reference voltage generating means during initial power-up operation to set an initial condition of the output terminal during power-up, and then stopping operation in normal operation. To provide.
본 발명에 의하면, 윌슨 전류 미러 회로를 이용하여 스타트-업 회로를 구성하여 파워-업시 출력 단자의 초기 조건을 설정하기 위한 스타트-업 전류의 영향에 무관하게 안정된 기준 전압을 생성한다.According to the present invention, a start-up circuit is constructed using a Wilson current mirror circuit to generate a stable reference voltage regardless of the influence of the start-up current for setting the initial condition of the output terminal at power-up.
이하, 첨부된 도면을 참조하여 본 발명의 실시예를 상세히 설명한다.Hereinafter, with reference to the accompanying drawings will be described an embodiment of the present invention;
도2 는 본 발명의 실시예에 의한 전류원 회로도를 도시한다. 본 발명의 실시예에 의한 전류원 회로는 2개의 커런트 미러로 구성되어지며 파워-업시 출력 단자로 일정한 기준 전압을 발생시키기 위한 기준 전압 발생부(21); 및 파워-업시 상기 출력 단자의 초기 조건을 설정하기 위해 파워-업 초기동작시 상기 기준 전압 발생부(21)로 일정 전류를 공급하고, 그 이후 정상 동작에서는 동작이 정지되는 스타트-업 장치(22)를 포함한다.2 shows a current source circuit diagram according to an embodiment of the present invention. The current source circuit according to the embodiment of the present invention is composed of two current mirrors and includes a reference voltage generator 21 for generating a constant reference voltage to an output terminal during power-up; And a start-up device 22 in which a constant current is supplied to the reference voltage generator 21 during power-up initial operation to set an initial condition of the output terminal at power-up, and then stops in normal operation. ).
스타트-업 장치(22)는 전원 전압(Vcc) 노드와 제4 노드(N4) 사이에 접속되며 베이스가 제7 노드(N7)에 연결된 제7 PNP형 바이폴라 트랜지스터(Q7), 상기 전원 전압(Vcc) 노드와 제5 노드(N5) 사이에 접속되며 베이스가 상기 제4 노드(N4)에 연결된 제9 NPN형 바이폴라 트랜지스터 (Q9), 상기 제4 노드(N4)와 접지 전압(Vss) 노드 사이에 접속되며 베이스가 상기 제 5 노드(N5)에 연결된 제8 PNP형 바이폴라 트랜지스터(Q8), 상기 제8 PNP형 바이폴라 트랜지스터(Q8)의 에미터 단자와 접지 전압(Vss) 노드 사이에 접속된 제3 저항(R3), 상기 전원 전압(Vcc) 노드와 제6 노드(N6) 사이에 접속된 제4 저항(R4)과, 상기 제6 노드(N6)와 접지 전압(Vss) 노드 사이에 접속되며 베이스가 상기 제6 노드(N6)에 연결된 제10 NPN형 바이폴라 트랜지스터(Q10), 상기 제7 노드(N7)와 제5 노드(N5) 사이에 접속되며 베이스가 상기 제6 노드(N6)에 연결된 제11 NPN형 바이폴라 트랜지스터(Q11), 상기 제11 NPN형 바이폴라 트랜지스터(Q11)의 에미터 단자와 접지 전압(Vss) 노드 사이에 접속된 제5 저항(R5)을 구비한다. 기준 전압 발생부(21)는 상기 전원 전압(Vcc) 노드와 제7 노드(N7) 사이에 접속되며 베이스가 상기 제7 노드(N7)에 연결된 제12 PNP형 바이폴라 트랜지스터(Q12), 상기 전원 전압(Vcc) 노드와 제8 노드(N8) 사이에 접속되며 베이스가 상기 제7 노드(N7)에 연결된 제13 PNP형 바이폴라 트랜지스터(Q13), 상기 제7 노드(N7)와 접지 전압(Vss) 노드 사이에 접속되며 베이스가 상기 제8 노드(N8)에 연결된 제15 NPN형 바이폴라 트랜지스터(Q15), 상기 제8 노드(N8)와 접지 전압(Vss) 노드 사이에 접속되며 베이스가 상기 제8 노드(N8)에 연결된 제16 NPN형 바이폴라 트랜지스터(Q16), 상기 제16 NPN형 바이폴라 트랜지스터(Q16)의 에미터 단자와 접지 전압(Vss) 노드 사이에 접속된 제6 저항(R6), 상기 전원 전압(Vcc) 노드와 출력 단자 사이에 접속되며 베이스가 상기 제7 노드(N7)에 연결된 제14 PNP형 바이폴라 트랜지스터(Q14), 상기 출력 단자와 접지 전압(Vss) 노드 사이에 접속되며 베이스가 상기 제8 노드(N8)에 연결된 제17 NPN형 바이폴라 트랜지스터(Q17)를 포함한다.The start-up device 22 is connected between a power supply voltage Vcc node and a fourth node N4, and a seventh PNP type bipolar transistor Q7 having a base connected to a seventh node N7, and the power supply voltage Vcc. ) A ninth NPN type bipolar transistor Q9 connected between a node and a fifth node N5 and a base connected to the fourth node N4, between the fourth node N4 and a ground voltage Vss node. A third connected to an eighth PNP type bipolar transistor Q8 having a base connected to the fifth node N5, and an emitter terminal of the eighth PNP type bipolar transistor Q8 and a ground voltage Vss node; A resistor R3, a fourth resistor R4 connected between the power supply voltage Vcc node and the sixth node N6, and a base connected between the sixth node N6 and the ground voltage Vss node. Is connected between the tenth NPN type bipolar transistor Q10 and the seventh node N7 and the fifth node N5 connected to the sixth node N6, and A fifth resistor R5 connected between an emitter terminal of the eleventh NPN type bipolar transistor Q11 connected to the sixth node N6 and an emitter terminal of the eleventh NPN type bipolar transistor Q11, and a node of a ground voltage Vss. ). The reference voltage generator 21 is connected between the power supply voltage Vcc node and the seventh node N7, and a twelfth PNP type bipolar transistor Q12 having a base connected to the seventh node N7, and the power supply voltage. A thirteenth PNP type bipolar transistor Q13 connected between a (Vcc) node and an eighth node N8 and a base connected to the seventh node N7, the seventh node N7, and a ground voltage Vss node. A 15th NPN type bipolar transistor Q15 connected between the base and the eighth node N8, the eighth node N8, and a ground voltage Vss node, and a base connected to the eighth node N8. A sixteenth NPN type bipolar transistor Q16 connected to N8), a sixth resistor R6 connected between an emitter terminal of the sixteenth NPN type bipolar transistor Q16 and a ground voltage Vss node, and the power supply voltage ( Vcc) a fourteenth PNP type bar connected between the node and the output terminal and whose base is connected to the seventh node N7 A bipolar transistor Q14 includes a seventeenth NPN type bipolar transistor Q17 connected between the output terminal and a ground voltage Vss node and having a base connected to the eighth node N8.
상기 구성과 같이 구성된 본 발명의 실시예에 의한 전류원 회로의 동작을 설명하면 다음과 같다.The operation of the current source circuit according to the embodiment of the present invention configured as described above is as follows.
상기 제10 및 제11 NPN형 바이폴라 트랜지스터(Q10 및 Q11), 제4 및 제5 저항(R4 및 R5)으로 구성된 윌슨 전류 소오스에 의해 스타트-업 회로가 흘러 제12 PNP 트랜지스터(Q12)를 턴-온시키고, 이어 제13 PNP형 바이폴라 트랜지스터(Q13) - 제16 NPN형 바이폴라 트랜지스터(Q16) - 제15 NPN형 바이폴라 트랜지스터 (Q15)가 순서적으로 턴-온되어 전류원 회로가 정상적으로 동작하게 된다. 이때, 상기 제11 NPN형 바이폴라 트랜지스터(Q11)의 베이스 전압은 VBE10이 되며 스타트-업 회로는 하기 [식 2]와 같다.A start-up circuit flows through a Wilson current source including the tenth and eleventh NPN bipolar transistors Q10 and Q11 and the fourth and fifth resistors R4 and R5 to turn on the twelfth PNP transistor Q12. Then, the thirteenth PNP type bipolar transistor Q13-a sixteenth NPN type bipolar transistor Q16-a fifteenth NPN type bipolar transistor Q15 are sequentially turned on so that the current source circuit operates normally. At this time, the base voltage of the eleventh NPN bipolar transistor Q11 is V BE10 , and the start-up circuit is as shown in Equation 2 below.
[식 2][Equation 2]
Istart = (Vcc - VBE10)/R4Istart = (Vcc-V BE10 ) / R4
가 되는데, 이때 제11 NPN형 바이폴라 트랜지스터(Q11)의 에미터 전압은 R5 × Istart로 제11 NPN형 바이폴라 트랜지스터(Q11)의 VBE11보다 굉장히 적어 제11 NPN형 바이폴라 트랜지스터(Q11)를 턴-온시키게 된다.In this case, the emitter voltage of the eleventh NPN bipolar transistor Q11 is R5 × Istart, which is much less than V BE11 of the eleventh NPN bipolar transistor Q11, thereby turning on the eleventh NPN bipolar transistor Q11. Let's go.
일단, 전류원 회로가 동작하면 출력 전류인 Iout이 제7 PNP형 바이폴라 트랜지스터(Q7)를 통해 제8 NPN형 바이폴라 트랜지스터(Q8)에도 흐르게 되는데, 이때 제11 NPN형 바이폴라 트랜지스터(Q11)의 에미터 전압인 제8 NPN형 바이폴라 트랜지스터(Q8)의 베이스 전압이 출력 전류에 의해 다음식으로 새로이 잡히게 된다.Once the current source circuit operates, the output current Iout flows through the seventh PNP type bipolar transistor Q7 to the eighth NPN type bipolar transistor Q8, where the emitter voltage of the eleventh NPN type bipolar transistor Q11 is applied. The base voltage of the eighth NPN type bipolar transistor Q8 is newly caught by the output current in the following manner.
VE11= (Iout R3) + VBE9 V E11 = (Iout R3) + V BE9
1) 스타트시 제11 NPN형 바이폴라 트랜지스터(Q11)의 베이스-에미터 전압(VBE11)1) Base-emitter voltage V BE11 of the 11th NPN type bipolar transistor Q11 at start-up
VBE11= VBE10- (Istart×R5) V BE11 = V BE10 - (Istart × R5)
2) 정상 동작후 제11 NPN형 바이폴라 트랜지스터(Q11)의 베이스-에미터 전압(VBE11)2) Base-Emitter Voltage V BE11 of Eleventh NPN Bipolar Transistor Q11 After Normal Operation
VBE11= VBE10- (Iout×R5) V BE11 = V BE10 - (Iout × R5)
1)의 경우 Istart가 굉장히 적으므로, VBE11이 트랜지스터 턴-온 전압보다 커 동작하게 되고, 2)의 경우 Iout이 Istart보다는 훨씬 크므로 VBE11이 트랜지스터 턴-온 전압 이하로 떨어져 턴-오프되어 버린다. 따라서 제11 NPN형 바이폴라 트랜지스터(Q11)를 통한 스타트 전류는 전류원 회로의 기준 전압에 영향을 주지 못한다.In the case of 1), Istart is very small, so V BE11 is operated larger than the transistor turn-on voltage, and in case of 2) V BE11 is turned off and turned off below the transistor turn-on voltage because Throw it away. Therefore, the start current through the eleventh NPN type bipolar transistor Q11 does not affect the reference voltage of the current source circuit.
이상에서 설명한 바와 같이, 본 발명에 의한 전류원 회로는 윌슨 전류 미러 회로를 이용하여 스타트-업 회로를 구성하여 파워-업시 출력 단자의 초기 조건을 잡아 주기 위한 스타트-업 전류의 영향에 무관하게 안정된 기준 전압을 생성하는 효과가 있다.As described above, the current source circuit according to the present invention uses a Wilson current mirror circuit to configure a start-up circuit so as to be stable regardless of the influence of the start-up current for grasping the initial condition of the output terminal during power-up. It has the effect of generating a voltage.
이상, 본 발명은 상기 바람직한 실시예를 들어 설명하였지만, 본 발명의 범위는 이에 의해 제한되는 것은 아니고, 당업자의 통상적인 지식의 범위내에서, 그 변형이나 개량이 가능하다.As mentioned above, although this invention was mentioned and demonstrated the said preferable Example, the scope of the present invention is not limited by this, A deformation | transformation and improvement are possible within the range of the common knowledge of a person skilled in the art.
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Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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