KR102611883B1 - 다중 대역 레이다 표적 모의 장치 및 그 방법 - Google Patents
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Abstract
본 발명은 레이더 표적 모의장치에서 다중 대역에 대해 송/수신 대응이 가능하도록 하여 각종 레이다의 시험에 활용할 수 있도록 한 다중 대역 레이다 표적 모의장치 및 그 방법에 관한 것으로서, 상기 장치는, 수신 안테나를 통해 수신된 레이다 신호를 운용자의 주파수 대역 선택에 따라 서로 다른 주파수 대역의 신호를 각각 수신 처리하는 수신부; 상기 선택된 주파수 대역에 따라 상기 수신부에서 처리된 신호를 일정 시간 메모리에 저장하고, 도플러 주파수 합성하여 표적 신호를 생성하는 디지털 신호 처리부; 및 상기 생성된 표적신호를 운용자의 주파수 대역 선택에 따라 서로 다른 주파수 대역의 신호를 각각 송신 처리하여 표적 신호를 송신 처리하는 송신부를 포함한다.
Description
본 발명은 다중 대역 표적 모의장치 및 그 방법에 관한 것으로서, 특히 레이더 표적 모의장치에서 다중 대역에 대해 송/수신 대응이 가능하도록 하여 각종 레이다의 시험에 활용할 수 있도록 한 다중 대역 레이다 표적 모의장치 및 그 방법에 관한 것이다.
일반적으로, 레이다는 전파를 방사한 뒤 표적에 반사된 전파를 수신하여 대상물의 위치와 속도를 탐지/추적하는 기능을 수행한다. 레이다 개발 시 표적의 탐지 및 추적 성능 검증을 수행하나, 상시 실제 표적을 이용하여 시험을 하는데 현실적으로 어려움이 있으므로 이를 극복하기 위해 별도의 표적 모의장치를 개발하여 시험을 수행한다.
이러한 표적 모의장치는 레이다가 방사한 RF신호를 수신 받아서 실제 표적에 가까운 모의 신호를 생성하여 레이다로 재 방사하는 역할을 수행하며, 모의 표적의 거리에 해당하는 시간 지연, 속도에 해당하는 도플러 주파수 합성 그리고 표적 크기에 비례하는 레벨 조절을 수행할 수 있어야 한다.
일반적으로 레이다 표적 모의 장치는 도 1에 도시된 바와 같이 수신 안테나(100)를 통해 수신된 레이다 신호의 주파수를 하향하는 수신부(200), 수신부(200)를 통해 하향 변환된 레이다 신호에 대하여 표적 거리와 속도에 해당하는 시간 지연 및 도플러 주파수 합성을 수행하여 표적 신호를 생성하는 디지털 신호 처리부(300), 상기 디지털 신호 처리부(300)를 통해 생성된 표적 신호의 주파수 상향과 신호 증폭 및 감쇄를 수행한 후, 송신 안테나(500)를 통해 표적신호를 레이다 장치로 출력하는 송신부(400)를 포함한다.
이와 같은 구성을 갖는 종래 기술에 따른 표적 모의 장치에 대한 상세 구성 및 동작에 대하여 첨부한 도 2 내지 도 4를 참조하여 설명해 보기로 한다.
도 2는 도 1에 도시된 레이다 표적 모의 장치의 수신부에 대한 상세 블록 구성을 나타낸 도면이고, 도 3은 도 1에 도시된 레이다 표적 모의 장치의 디지털 신호 처리부에 대한 상세 블록 구성을 나타낸 도면이며, 도 4는 도 1에 도시된 레이다 표적 모의 장치의 송신부에 대한 상세 블록 구성을 나타낸 도면이다.
먼저, 도 2에 도시된 레이다 표적 모의 장치에서, 종래 기술에 따른 수신부(200)는, 감쇄기(201), 대역필터(202) 및 믹서(203)를 포함할 수 있다.
상기 감쇄기(201)는 회로 보호를 위해 수신 안테나(100)를 통해 수신된 레이다 신호를 일정 레벨로 감쇄시킨 후, 감쇄된 레이다 신호를 대역 필터(202)로 제공한다.
대역 필터(202)는 감쇄기(201)로부터 제공되는 감쇄된 레이다 신호의 특정 대역만을 통과시킨 후, 해당 대역의 신호를 믹서(203)로 제공한다.
믹서(203)는 대역 필터(202)를 통과한 신호의 주파수 하향을 수행한 후, 주파수 하향된 레이더 신호를 디지털 신호 처리부(300)로 제공한다.
상기 디지털 신호 처리부(300)는 도 3에 도시된 바와 같이, ADC(301), FPGA(302) 및 DAC(303)를 포함할 수 있다.
상기 ADC(301)는 수신부(200)의 믹서(203)를 통해 주파수 하향된 레이다 신호 즉, 아날로그 신호를 디지털 신호로 변환하여 FPGA(302)로 제공한다.
FPGA(302)는 ADC(301)를 통해 변환된 디지털 신호를 표적 거리와 속도에 해당하는 시간 지연 즉, 일정 시간 동안 메모리에 저장 및, 도플러 주파수 합성한 뒤 DAC(303)로 제공한다.
DAC(303)는 FPGA(302)에서 도플러 주파수 합성된 신호를 아날로그 신호로 변환하여 송신부(400)로 제공한다. 여기서, 송신부(400)로 전달되는 아날로그 신호는 표적 모의 신호이다.
상기 송신부(400)는 도 4에 도시된 바와 같이, 믹서(401), 대역필터(402), 가변 감쇄기(403), 증폭기(404) 및 아이솔레이터(405)를 포함할 수 있다.
송신부(400)의 믹서(401)는 디지털 신호 처리부(300)의 DAC(303)에서 변환된 아날로그 신호의 주파수 상향을 수행한 후, 주파수 상향된 신호를 대역필터(402)로 제공한다.
대역필터(402)는 믹서(401)을 통해 주파수 상향된 신호에서 특정 대역의 신호만을 통과시킨 후, 가변 감쇄기(403)로 제공한다.
가변 감쇄기(403)는 대역필터(402)를 통과한 신호의 감쇄량을 조절하고, 증폭기(404)를 통해 신호의 증폭을 수행하여 출력신호의 레벨을 조절한다.
또한, 최종단의 아이솔레이터(405)는 증폭기(404)에서 출력되는 높은 출력신호가 송신부(400) 뒤로 역류하지 않도록 방지해 주며, 이와 같이 최종적으로 생성된 표적 모의신호를 송신 안테나(500)를 통해 레이다로 방사하는 것이다.
이와 같은 종래 기술에서 제시한 표적 모의장치는 특정 주파수 대역 신호만 송/수신할 수 있는 구조로, 시험하고자 하는 레이다가 변경되어 운용 주파수 대역이 바뀌거나 하나의 레이다가 이중 대역을 사용한다면 표적 신호를 생성할 수 없게 되어 새로운 표적 모의장치를 개발해야 하는 번거로움이 있다.
따라서, 레이다는 운용 환경과 요구 성능 등을 고려하여 운용 주파수 대역을 선정하며, 각 주파수 대역의 장점을 모두 이용하고자 이중 대역의 주파수를 운용하는 레이다가 개발되고 있는 실정에서, 다중 대역의 신호에 대응이 가능한 표적모의장치의 개발이 필요한 실정이다.
따라서, 본 발명은 상기한 종래 기술에 따른 문제점을 해결하기 위한 것으로, 본 발명의 목적은, 레이더 표적 모의장치에서 다중 대역에 대해 송/수신 대응이 가능하도록 하여 각종 레이다의 시험에 활용할 수 있도록 한 다중 대역 레이다 표적 모의장치 및 그 방법을 제공함에 있다.
다만, 본 발명이 해결하고자 하는 과제는 상기된 바와 같은 과제로 한정되지 않으며, 또 다른 과제들이 존재할 수 있다.
상기한 목적을 달성하기 위한 본 발명의 일 실시예에 따른 다중대역 레이다 표적 모의 장치는, 수신 안테나를 통해 수신된 레이다 신호를 운용자의 주파수 대역 선택에 따라 서로 다른 주파수 대역의 신호를 각각 수신 처리하는 수신부; 상기 선택된 주파수 대역에 따라 상기 수신부에서 처리된 신호를 일정 시간 메모리에 저장하고, 도플러 주파수 합성하여 표적 신호를 생성하는 디지털 신호 처리부; 및 상기 생성된 표적신호를 운용자의 주파수 대역 선택에 따라 서로 다른 주파수 대역의 신호를 각각 송신 처리하여 표적 신호를 송신 처리하는 송신부를 포함할 수 있다.
상기 수신부는, 수신 안테나를 통해 수신되는 레이다 신호의 감쇄량을 조절하는 감쇄부; 상기 감쇄부를 통해 감쇄량이 조절된 신호의 경로를 제1 대역 경로 또는 제2 대역 경로로 운용자의 선택에 따라 스위칭하는 스위칭부; 상기 스위칭부를 통해 스위칭되는 감쇄량 조절된 신호를 제1 주파수 대역으로 신호 처리한 후, 상기 디지털 신호 처리부로 제공하는 제1 대역 수신신호 처리부; 및 상기 스위칭부를 통해 스위칭되는 감쇄량 조절된 신호를 제2 주파수 대역으로 신호 처리한 후, 상기 디지털 신호 처리부로 제공하는 제2 대역 수신신호 처리부를 포함할 수 있다.
상기 제1 대역 수신신호 처리부는, 상기 스위칭부를 통해 스위칭된 감쇄량 조절 신호를 제1 대역으로 필터링하는 제1 대역 필터; 및 상기 제1 대역 필터를 통해 필터링된 신호를 주파수 합성을 통해 주파수 하향 조정한 후, 하향 조정된 신호를 상기 디지털 신호 처리부로 제공하는 제1 믹서를 포함할 수 있다.
상기 제2 대역 수신신호 처리부는, 상기 스위칭부를 통해 스위칭된 감쇄량 조절 신호를 제2 대역으로 필터링하는 제2 대역 필터; 및 상기 제2 대역 필터를 통해 필터링된 신호를 주파수 합성을 통해 주파수 하향 조정한 후, 하향 조정된 신호를 상기 디지털 신호 처리부로 제공하는 제2 믹서를 포함할 수 있다.
상기 디지털 신호 처리부는, 상기 제1 대역 수신신호 처리부의 제1 믹서를 통해 주파수 하향 조정된 신호를 디지털 신호로 변환하는 제1 ADC; 상기 제2 대역 수신신호 처리부의 제2 믹서를 통해 주파수 하향 조정된 신호를 디지털 신호로 변환하는 제2 ADC; 상기 제1 ADC 또는 제2 ADC를 통해 변환된 디지털 신호를 메모리에 저장하고 도플러 주파수 합성하여 출력하는 FPGA; 상기 FPGA를 통해 출력되는 제1 대역에 대한 도플러 주파수 합성된 신호를 아날로그 신호로 변환하는 제1 DAC; 및 상기 FPGA를 통해 출력되는 제2 대역에 대한 도플러 주파수 합성된 신호를 아날로그 신호로 변환하는 제2 DAC를 포함할 수 있다.
상기 송신부는, 상기 디지털 신호 처리부의 제1 DAC로부터 출력되는 신호를 제1 대역의 송신신호로 처리하는 제1 대역 송신신호 처리부; 상기 디지털 신호 처리부의 제2 DAC로부터 출력되는 신호를 제2 대역의 송신신호로 처리하는 제2 대역 송신신호 처리부; 상기 제1 대역 송신신호 처리부에서 처리된 송신신호 및 상기 제2 대역 송신신호 처리부에서 처리된 신호를 운용자의 주파수 대역 선택에 따라 스위칭 출력하는 스위칭부; 및 상기 스위칭부를 통해 스위칭 출력되는 신호를 증폭하여 표적신호로 송신 안테나로 제공하는 증폭기를 포함할 수 있다.
상기 송신부는, 상기 증폭기에서 증폭된 신호의 역류를 방지하기 위한 아이솔레이터를 더 포함할 수 있다.
상기 제1 대역 송신신호 처리부는, 상기 제1 DAC를 통해 출력되는 신호를 주파수 상향 조정하는 제1 믹서; 상기 제1 믹서를 통해 주파수 상향 조정된 신호를 선택된 제1 대역으로 필터링하는 제1 대역필터; 및 상기 제1 대역필터를 통해 필터링된 신호의 감쇄량을 조절한 후, 감쇄량 조절된 신호를 상기 스위칭부를 통해 증폭기로 제공하는 제1 가변 감쇄기를 포함할 수 있다.
상기 제2 대역 송신신호 처리부는, 상기 제2 DAC를 통해 출력되는 신호를 주파수 상향 조정하는 제2 믹서; 상기 제2 믹서를 통해 주파수 상향 조정된 신호를 선택된 제2 대역으로 필터링하는 제2 대역필터; 및 상기 제2 대역필터를 통해 필터링된 신호의 감쇄량을 조절한 후, 감쇄량 조절된 신호를 상기 스위칭부를 통해 증폭기로 제공하는 제2 가변 감쇄기를 포함할 수 있다.
한편, 본 발명의 다른 실시예에 따른 다중대역 레이다 표적 모의 방법은, 수신 안테나를 통해 수신된 레이다 신호를 운용자의 주파수 대역 선택에 따라 서로 다른 주파수 대역의 신호를 각각 수신 처리하는 수신 처리 단계; 상기 선택된 주파수 대역에 따라 상기 수신 처리된 신호를 일정 시간 메모리에 저장하고, 도플러 주파수 합성하여 표적 신호를 생성하는 디지털 신호 처리 단계; 및 상기 생성된 표적신호를 운용자의 주파수 대역 선택에 따라 서로 다른 주파수 대역의 신호를 각각 송신 처리하여 표적 신호를 송신 처리하는 송신 처리 단계를 포함할 수 있다.
상기 수신 처리 단계는, 수신 안테나를 통해 수신되는 레이다 신호의 감쇄량을 조절하는 단계; 상기 감쇄량이 조절된 신호의 경로를 제1 대역 경로 또는 제2 대역 경로로 운용자의 선택에 따라 스위칭하는 단계; 상기 스위칭되는 감쇄량 조절된 신호를 제1 주파수 대역으로 신호 처리하는 제1 대역 수신신호 처리 단계; 및 상기 스위칭되는 감쇄량 조절된 신호를 제2 주파수 대역으로 신호 처리하는 제2 대역 수신신호 처리 단계를 포함할 수 있다.
상기 제1 대역 수신신호 처리 단계는, 상기 스위칭된 감쇄량 조절된 신호를 제1 대역으로 제1 대역필터를 통해 필터링하는 단계; 및 상기 제1 대역으로 필터링된 신호를 제1 믹서를 통해 주파수 하향 조정한 후, 하향 조정된 신호를 출력하는 단계를 포함할 수 있다.
상기 제2 대역 수신신호 처리 단계는, 상기 스위칭된 감쇄량 조절된 신호를 제2 대역으로 제2 대역필터를 통해 필터링하는 단계; 및 상기 제2 대역으로 필터링된 신호를 제2 믹서를 통해 주파수 하향 조정한 후, 하향 조정된 신호를 출력하는 단계를 포함할 수 있다.
상기 디지털 신호 처리단계는, 상기 제1 믹서를 통해 주파수 하향 조정된 신호를 디지털 신호로 변환하거나, 상기 제2 믹서를 통해 주파수 하향 조정된 신호를 디지털 신호로 변환하는 단계; 상기 제1 대역 또는 제2 대역에 대한 AD변환된 디지털 신호를 FPGA를 이용하여 메모리에 저장하고 도플러 주파수 합성하여 출력하는 단계; 및 상기 FPGA를 통해 출력되는 제1 대역에 대한 도플러 주파수 합성된 신호를 아날로그 신호로 변환하거나, 상기 FPGA를 통해 출력되는 제2 대역에 대한 도플러 주파수 합성된 신호를 아날로그 신호로 변환하는 단계를 포함할 수 있다.
상기 송신 처리단계는, 상기 아날로그 신호로 변환된 제1 대역의 송신신호 또는 제2 대역의 송신신호로 처리하는 단계; 상기 처리된 제1 대역 또는 제 2대역의 송신 신호를 운용자의 주파수 대역 선택에 따라 스위칭 출력하는 단계; 및 상기 스위칭 출력되는 신호를 증폭하여 표적신호로 송신 안테나로 출력하는 단계를 포함할 수 있다.
상기 송신 처리 단계는; 상기 증폭된 신호의 역류를 방지하기 위해 아이솔레이션하는 단계를 더 포함할 수 있다.
상기 제1 대역의 송신신호 또는 제2 대역의 송신신호로 처리하는 단계는, 상기 디지털 신호로 변환된 제1 대역의 신호 또는 제2 대역의 신호를 각 대역에 상응하는 믹서를 통해 주파수 상향 조정하는 단계; 상기 각 대역의 믹서를 통해 주파수 상향 조정된 신호를 선택된 제1 대역 또는 제2 대역으로 대역 필터를 통해 필터링하는 단계; 및 상기 필터링된 신호의 감쇄량을 조절한 후, 감쇄량 조절된 신호를 증폭기를 통해 증폭한 후, 송신 안테나에 표적 신호로 제공하는 단계를 포함할 수 있다.
상술한 과제를 해결하기 위한 본 발명의 다른 면에 따른 컴퓨터 프로그램은, 하드웨어인 컴퓨터와 결합되어 상기 항공기 레이다 시스템에서의 PRF 선택 방법을 실행하며, 컴퓨터 판독가능 기록매체에 저장된다.
본 발명의 기타 구체적인 사항들은 상세한 설명 및 도면들에 포함되어 있다.
본 발명에 따르면, 다중 대역의 신호 송/수신이 가능한 표적 모의장치로 레이다가 변경되어 운용 주파수 대역이 변경되거나, 하나의 레이다가 이중 대역의 주파수를 운용하더라도 해당 레이다의 표적 신호를 생성할 수 있다.
또한, 현재 레이다 개발 사업마다 표적모의장치 개발을 수행하나, 설계의 간단한 구조 변경으로 표적모의장치의 개발하는 번거로움과 사업 수행의 비용을 절감하는데 기여할 수 있다.
본 발명의 효과들은 이상에서 언급된 효과로 제한되지 않으며, 언급되지 않은 또 다른 효과들은 아래의 기재로부터 통상의 기술자에게 명확하게 이해될 수 있을 것이다.
이하에 첨부되는 도면들은 본 실시 예에 관한 이해를 돕기 위한 것으로, 상세한 설명과 함께 실시 예들을 제공한다. 다만, 본 실시 예의 기술적 특징이 특정 도면에 한정되는 것은 아니며, 각 도면에서 개시하는 특징들은 서로 조합되어 새로운 실시 예로 구성될 수 있다.
도 1은 일반적인 레이더 표적 모의장치에 대한 개략적인 블록 구성을 나타낸 도면.
도 2는 도 1에 도시된 레이다 표적 모의 장치에서 종래 기술에 따른 수신부의 블록 구성을 나타낸 도면.
도 3은 도 1에 도시된 레이다 표적 모의 장치에서 종래 기술에 따른 디지털 신호 처리부의 블록 구성을 나타낸 도면.
도 4는 도 1에 도시된 레이다 표적 모의 장치에서 종래 기술에 따른 송신부의 블록 구성을 나타낸 도면.
도 5는 도 1에 도시된 레이다 표적 모의 장치에서, 본 발명에 따른 수신부의 상세 블록 구성을 나타낸 도면.
도 6은 도 1에 도시된 레이다 표적 모의 장치에서, 본 발명에 따른 디지털 신호 처리부의 상세 블록 구성을 나타낸 도면.
도 7은 도 1에 도시된 레이다 표적 모의 장치에서, 본 발명에 따른 송신부의 상세 블록 구성을 나타낸 도면.
도 8은 본 발명에 따른 레이다 표적 모의 방법에 대한 동작 플로우챠트를 나타낸 도면.
도 1은 일반적인 레이더 표적 모의장치에 대한 개략적인 블록 구성을 나타낸 도면.
도 2는 도 1에 도시된 레이다 표적 모의 장치에서 종래 기술에 따른 수신부의 블록 구성을 나타낸 도면.
도 3은 도 1에 도시된 레이다 표적 모의 장치에서 종래 기술에 따른 디지털 신호 처리부의 블록 구성을 나타낸 도면.
도 4는 도 1에 도시된 레이다 표적 모의 장치에서 종래 기술에 따른 송신부의 블록 구성을 나타낸 도면.
도 5는 도 1에 도시된 레이다 표적 모의 장치에서, 본 발명에 따른 수신부의 상세 블록 구성을 나타낸 도면.
도 6은 도 1에 도시된 레이다 표적 모의 장치에서, 본 발명에 따른 디지털 신호 처리부의 상세 블록 구성을 나타낸 도면.
도 7은 도 1에 도시된 레이다 표적 모의 장치에서, 본 발명에 따른 송신부의 상세 블록 구성을 나타낸 도면.
도 8은 본 발명에 따른 레이다 표적 모의 방법에 대한 동작 플로우챠트를 나타낸 도면.
본 발명의 이점 및 특징, 그리고 그것들을 달성하는 방법은 첨부되는 도면과 함께 상세하게 후술되어 있는 실시예들을 참조하면 명확해질 것이다. 그러나, 본 발명은 이하에서 개시되는 실시예들에 제한되는 것이 아니라 서로 다른 다양한 형태로 구현될 수 있으며, 단지 본 실시예들은 본 발명의 개시가 완전하도록 하고, 본 발명이 속하는 기술 분야의 통상의 기술자에게 본 발명의 범주를 완전하게 알려주기 위해 제공되는 것이며, 본 발명은 청구항의 범주에 의해 정의될 뿐이다.
본 명세서에서 사용된 용어는 실시예들을 설명하기 위한 것이며 본 발명을 제한하고자 하는 것은 아니다. 본 명세서에서, 단수형은 문구에서 특별히 언급하지 않는 한 복수형도 포함한다. 명세서에서 사용되는 "포함한다(comprises)" 및/또는 "포함하는(comprising)"은 언급된 구성요소 외에 하나 이상의 다른 구성요소의 존재 또는 추가를 배제하지 않는다. 명세서 전체에 걸쳐 동일한 도면 부호는 동일한 구성 요소를 지칭하며, "및/또는"은 언급된 구성요소들의 각각 및 하나 이상의 모든 조합을 포함한다. 비록 "제1", "제2" 등이 다양한 구성요소들을 서술하기 위해서 사용되나, 이들 구성요소들은 이들 용어에 의해 제한되지 않음은 물론이다. 이들 용어들은 단지 하나의 구성요소를 다른 구성요소와 구별하기 위하여 사용하는 것이다. 따라서, 이하에서 언급되는 제1 구성요소는 본 발명의 기술적 사상 내에서 제2 구성요소일 수도 있음은 물론이다.
다른 정의가 없다면, 본 명세서에서 사용되는 모든 용어(기술 및 과학적 용어를 포함)는 본 발명이 속하는 기술분야의 통상의 기술자에게 공통적으로 이해될 수 있는 의미로 사용될 수 있을 것이다. 또한, 일반적으로 사용되는 사전에 정의되어 있는 용어들은 명백하게 특별히 정의되어 있지 않는 한 이상적으로 또는 과도하게 해석되지 않는다.
이하, 본 발명의 바람직한 실시예에 따른 다중 대역 레이더 표적 모의장치 및 그 방법에 대하여 첨부한 도면을 참조하여 상세하게 설명하기로 한다.
먼저, 본 발명은 상기한 종래 기술과는 달리, 다중 대역의 신호의 송/수신을 수행하는 것으로, 송신부(400)와 수신부(200)에서는 송/수신 RF Path를 이중화하여 다중 대역의 신호를 송/수신할 수 있도록 하며, 디지털 신호 처리부(300) 역시 ADC와 DAC를 2채널 구성하여 다중 대역의 신호를 동시에 처리할 수 있도록 설계하였다. 여기서, 본 발명에서는 채널을 2채널에 대해서만 도시하고 설명하겠지만, 이에 한정하지 않고 2채 널 이상의 채널에 대해서도 구성 및 동작할 수 있음을 이 분야의 통상의 지식을 가진자라면 이해해야 할 것이다.
도 5는 도 1에 도시된 레이다 표적 모의 장치에서, 본 발명에 따른 수신부의 상세 블록 구성을 나타낸 도면이다,
도 5에 도시된 바와 같이, 본 발명에 따른 다중 대역 레이다 표적 모의 장치의 수신부(200)는 감쇄기(210), 스위칭부(220), 제1 대역 수신신호 처리부(230), 및 제2 대역 수신신호 처리부(240)를 포함할 수 있다.
상기 감쇄기(210)는 레이다가 변경되어 입력 레벨이 달라지더라도 수신 안테나(100)를 통해 수신된 레이다 신호의 감쇄값 조절을 통해 수신부 보호를 수행한다.
스위칭부(220)는 운용자의 스위칭 제어신호 즉, 표적 모의 시험을 위한 레이더 신호의 원하는 대역을 선택하기 위한 스위칭 제어신호에 따라 감쇄기(210)에서 감쇄된 레이더 신호를 선택된 대역에 대응하는 RF Path로 스위칭한다.
예를 들어, 운용자가 제1 대역을 선택한 경우, 스위칭부(220)는 감쇄기(210)를 통해 감쇄 조절된 레이다 신호를 제1 대역 수신신호 처리부(230)로 스위칭하고, 제2 대역을 선택한 경우, 스위칭부(220)는 감쇄기(210)를 통해 감쇄 조절된 레이다 신호를 제2 대역 수신신호 처리부(240)로 스위칭한다.
상기 제1 대역 수신신호 처리부(230)는 제1 대역 필터(231) 및 제1 믹서(232)를 포함할 수 있다.
제1 대역 필터(231)는 스위칭부(220)를 통해 스위칭된 해당 레이더 신호에 대하여 해당 대역(제 1대역) 신호만을 통과시킨 후, 제1 믹서(232)로 제공한다.
제1 믹서(232)는 제1 대역 필터(231)를 통해 통과된 제1 대역 신호에 대하여 주파수 하향된 후, 주파수 하향된 제1 대역에 대한 레이더 신호를 디지털 신호 처리부(300)의 제1 ADC(310)로 제공한다.
한편, 제2 대역 수신신호 처리부(240)는 제2 대역 필터(241) 및 제2 믹서(242)를 포함할 수 있다.
제2 대역 필터(241)는 스위칭부(220)를 통해 스위칭된 해당 레이더 신호에 대하여 해당 대역(제 2대역) 신호만을 통과시킨 후, 제2 믹서(242)로 제공한다.
제2 믹서(242)는 제2대역 필터(241)를 통해 통과된 제2 대역 신호에 대하여 주파수 하향된 후, 주파수 하향된 제2 대역에 대한 레이더 신호를 디지털 신호 처리부(300)의 제2 ADC(311)로 제공한다.
상기 디지털 신호 처리부(300)는 도 6에 도시된 바와 같이, 제1,2 ADC(310, 311), FPGA(320) 및 제1,2 DAC(330, 331)을 포함할 수 있다.
상기 디지털 신호 처리부(300)의 제1 ADC(310)는 수신부(200)내 상기 제1 대역 수신신호 처리부(230)의 제1 믹서(232)로부터 제공되는 주파수 하향된 제1 대역의 레이더 신호(아날로그 신호)를 디지털 신호로 변환한 후, 변환된 신호를 FPGA(320)로 제공한다.
한편, 상기 디지털 신호 처리부(300)의 제2 ADC(311)는 수신부(200)내 상기 제2 대역 수신신호 처리부(240)의 제2 믹서(242)로부터 제공되는 주파수 하향된 제2 대역의 레이더 신호(아날로그 신호)를 디지털 신호로 변환한 후, 변환된 신호를 FPGA(320)로 제공한다.
상기 FPGA(320)는 상기 제1 ADC(310)로부터 제공되는 디지털 신호(레이더 신호)를 일정 시간 동안 메모리에 저장 및 도플러 주파수 합성한 뒤 제1 DAC(330)로 제공한다.
상기 제1 DAC(330)는 도플러 주파수 합성된 신호를 아날로그 신호로 변환한 후, 변환된 신호를 송신부(400)의 제1 대역 송신신호 처리부(410)의 제1 믹서(411)로 제공한다.
한편, 상기 FPGA(320)는 상기 제2 ADC(311)로부터 제공되는 디지털 신호(레이더 신호)를 일정 시간 동안 메모리에 저장 및 도플러 주파수 합성한 뒤 제2 DAC(331)로 제공한다.
상기 제2 DAC(331)는 도플러 주파수 합성된 신호를 아날로그 신호로 변환한 후, 변환된 신호를 송신부(400)의 제2 대역 송신신호 처리부(420)의 제2 믹서(421)로 제공한다.
상기 송신부(400)는 도 7에 도시된 바와 같이 제1 대역 송신신호 처리부(410), 제2 대역 송신신호 처리부(420), 스위칭부(430), 증폭기(440) 및 아이솔레이터(450)을 포함할 수 있다.
상기 스위칭부(430)는 초기 표적 모의 시험 시, 운용자가 선택한 주파수 대역에 따라 제1 대역 송신신호 처리부(410) 또는 제2 대역 송신신호 처리부(420)로 선택적 스위칭이 이루어진다. 즉, 운용자가 제1 대역을 선택한 경우, 제1 대역 송신신호 처리부(410)를 통해 처리된 송신신호(표적신호)를 증폭기(440)로 전달하고, 운용자가 제2 대역을 선택한 경우, 제2 대역 송신신호 처리부(420)를 통해 처리된 송신신호(표적신호)를 증폭기(440)로 전달하는 것이다.
상기 송신부(400) 내 제1 대역 송신신호 처리부(410)의 제1 믹서(411)는 디지털 신호 처리부(300)의 제1 DAC(330)로부터 출력되는 신호를 주파수 상향 변환한 후, 제1 대역 필터(412)로 제공한다.
제1 대역 필터(412)는 주파수 상향 변환된 신호에서 제 1대역의 주파수 신호만을 통과시킨 후, 제1 대역의 주파수 신호를 제1 가변 감쇄부(413)으로 제공한다.
제1 가변 감쇄부(413)는 상기 제1 대역필터(412)를 통과한 신호 레벨 감쇄를 수행한 후, 스위칭부(430)를 통해 증폭기(440)로 제공한다.
한편, 상기 송신부(400) 내 제2 대역 송신신호 처리부(430)의 제2 믹서(421)는 디지털 신호 처리부(300)의 제2 DAC(331)로부터 출력되는 신호를 주파수 상향 변환한 후, 제2 대역 필터(422)로 제공한다.
제2 대역 필터(422)는 주파수 상향 변환된 신호에서 제2 대역의 주파수 신호만을 통과시킨 후, 제2 대역의 주파수 신호를 제2 가변 감쇄부(423)으로 제공한다.
제2 가변 감쇄부(423)는 상기 제2 대역필터(422)를 통과한 신호 레벨 감쇄를 수행한 후, 스위칭부(430)를 통해 증폭기(440)로 제공한다.
증폭기(400)는 스위칭부(430)의 스위칭에 따른 제1 대역 송신신호 출력부(410) 또는 제2 대역 송신신호 처리부(420)로부터 출력되는 신호를 증폭한 후, 아이솔레이터(450)를 통해 송신 안테나(500)로 제공한다.
따라서, 송신 안테나(500)는 수신된 제1 대역 또는 제2 대역 신호를 최종 표적신호로 레이다로 전송하는 것이다.
상기한 본 발명에 따른 다중 대역 레이다 표적 모의 장치의 RF Path를 정리하면, 먼저 운용자가 제 1 대역의 표적 모의 시험을 선택한 경우, 수신부(200)의 스위칭부(220)를 제1 대역 수신신호 처리부(230)로 스위칭하고, 송신부(400)의 스위칭부(430)를 제1 대역 송신신호 처리부(410)로 각각 스위칭한다.
한편, 운용자가 제2 대역의 표적 모의 시험을 선택한 경우, 수신부(200)의 스위칭부(220)를 제2 대역 수신신호 처리부(240)로 스위칭하고, 송신부(400)의 스위칭부(430)를 제2 대역 송신신호 처리부(420)로 각각 스위칭한다.
상기의 스위칭 동작에서, 제1 대역의 표적 모의 시험이 선택된 경우의 RF Path는, 수신 안테나(100) → 감쇄기(210) → 스위칭부(220) → 제1 대역 수신신호 처리부(230)(제1 대역필터(231) → 제1 믹서(232)) → 디지털 신호 처리부(300)(제1 ADC(310) → FPGA(320) → 제1 DAC(330)) →송신부(400)의 제1 대역 송신신호 처리부(410)(제1 믹서(411)→제1 대역필터(412) → 제1 가변 감쇄기(413)) → 스위칭부(430) → 증폭기(440) → 아이솔레이터(450) → 송신 안테나(500)의 순으로 처리되며, 이러한 순서를 통해 레이더신호를 수신하고 표적신호를 생성하여 전송하는 것이다.
한편, 상기의 스위칭 동작에서, 제2 대역의 표적 모의 시험이 선택된 경우의 RF Path는, 수신 안테나(100) →감쇄기(210) →스위칭부(220) →제2 대역 수신신호 처리부(240)(제2 대역필터(241) → 제2 믹서(242)) →디지털 신호 처리부(300)(제2 ADC(311) →FPGA(320) →제2 DAC(331)) →송신부(400)의 제2 대역 송신신호 처리부(420)(제2 믹서(421) → 제2 대역필터(422) → 제2 가변 감쇄기(423)) → 스위칭부(430) → 증폭기(440) → 아이솔레이터(450) → 송신 안테나(500)의 순으로 처리되며, 이러한 순서를 통해 레이더신호를 수신하고 표적신호를 생성하여 전송하는 것이다.
상기한 본 발명에 따른 다중 대역 레이다 표적 모의 장치의 동작과 상응하는 본 발명에 따른 다중 대역 레이다 표적 모의 방법에 대하여 도 8을 참조하여 단계적으로 설명하기로 한다.
도 8은 본 발명에 따른 다중 대역 레이다 표적 모의 방법에 대한 동작 플로우챠트를 나타낸 도면이다.
도 8에 도시된 바와 같이, 먼저 운용자가 표적 모의 시험을 위해 원하는 주파수 대역을 선택했는지 판단한다(S801).
판단 결과, 운용자가 제1 주파수 대역을 선택한 경우, 수신 RF Path를 제1 주파수 대역의 처리 경로로 스위칭한 후, 수신 안테나를 통해 수신되는 레이더 신호의 감쇄량을 조절한다(S802). 여기서 감쇄량 조절은 도 5에 도시된 감쇄기(210)를 이용하여 조절할 수 있다.
이어, 감쇄량 조절된 신호를 제1 대역으로 필터링하고, 필터링된 신호의 주파수 하향 조정한다(S803). 여기서, 필터링 및 주파수 햐향은 도 5에 도시된 제1 대역 필터(231)와 제1 믹서(232)를 통해 이루어질 수 있다.
이어, 주파수 하향된 신호를 디지털 신호로 변환하고(S804), 변환된 디지털 신호를 일정 시간동안 메모리에 저장 및 도플러 주파수 합성을 수행한다(S805). 그리고, 도플러 주파수 합성된 디지털 신호를 아날로그 신호로 변환한다(S806). 여기서, S804 단계는 도 6에 도시된 제1 ADC(310)를 통해 수행하고, S805단계는 도 6에 도시된 FPGA(320), S806 단계는 도 6에 도시된 제1 DAC(330)를 통해 각각 수행될 수 있다.
이어, 상기 S806 단계를 통해 변환된 아날로그 신호는 다시 주파수 상향하고, 제1 대역 필터링을 수행한 후, 신호 감쇄량을 조절한다(S807). 여기서, S807 단계는 도 7의 제1 믹서(411), 제1 대역필터(412) 및 제1 가변 감쇄기(413)를 통해 순차적으로 수행할 수 있다.
이어, 신호 감쇄량이 조절된 신호는 도 7에 도시된 증폭기(440)를 통해 출력 레벨로 증폭한 후, 최종적인 표적 신호로 송신 안테나(450)를 통해 레이다로 전송하는 것이다(S808).
한편, 상기 S801 단계에서, 판단 결과, 운용자가 제2 주파수 대역을 선택한 경우, 송신 RF Path를 제2 주파수 대역의 처리 경로로 스위칭한 후, 수신 안테나를 통해 수신되는 레이더 신호의 감쇄량을 조절한다(S809). 여기서 감쇄량 조절은 도 5에 도시된 감쇄기(210)를 이용하여 조절할 수 있다.
이어, 감쇄량 조절된 신호를 제2 대역으로 필터링하고, 필터링된 신호의 주파수 하향 조정한다(S810). 여기서, 필터링 및 주파수 하향은 도 5에 도시된 제2 대역 필터(241)와 제2 믹서(242)를 통해 이루어질 수 있다.
이어, 주파수 하향된 신호를 디지털 신호로 변환하고(S811), 변환된 디지털 신호를 일정 시간동안 메모리에 저장 및 도플러 주파수 합성을 수행한다(S812). 그리고, 도플러 주파수 합성된 디지털 신호를 아날로그 신호로 변환한다(S813). 여기서, S811 단계는 도 6에 도시된 제2 ADC(311)를 통해 수행하고, S812단계는 도 6에 도시된 FPGA(320), S813 단계는 도 6에 도시된 제2 DAC(331)를 통해 각각 수행될 수 있다.
이어, 상기 S813 단계를 통해 변환된 아날로그 신호는 다시 주파수 상향하고, 제2 대역 필터링을 수행한 후, 신호 감쇄량을 조절한다(S814). 여기서, S814 단계는 도 7의 제2 믹서(421), 제2 대역필터(422) 및 제2 가변 감쇄기(423)를 통해 순차적으로 수행할 수 있다.
이어, 신호 감쇄량이 조절된 신호는 도 7에 도시된 증폭기(440)를 통해 출력 레벨로 증폭한 후, 최종적인 표적 신호로 송신 안테나(450)를 통해 레이다로 전송하는 것이다(S815).
따라서, 본 발명은 상기한 바와 같이, 다중 대역의 신호 송/수신이 가능한 표적모의장치로 레이다가 변경되어 운용 주파수 대역이 변경되거나, 하나의 레이다가 이중 대역의 주파수를 운용하더라도 해당 레이다의 표적 신호를 생성할 수 있는 것이다.
이상에서 전술한 본 발명의 일 실시예에 따른 다중 대역 레이다 표적 모의방법은, 하드웨어인 컴퓨터와 결합되어 실행되기 위해 프로그램(또는 어플리케이션)으로 구현되어 매체에 저장될 수 있다.
상기 전술한 프로그램은, 상기 컴퓨터가 프로그램을 읽어 들여 프로그램으로 구현된 상기 방법들을 실행시키기 위하여, 상기 컴퓨터의 프로세서(CPU)가 상기 컴퓨터의 장치 인터페이스를 통해 읽힐 수 있는 C, C++, JAVA, Ruby, 기계어 등의 컴퓨터 언어로 코드화된 코드(Code)를 포함할 수 있다. 이러한 코드는 상기 방법들을 실행하는 필요한 기능들을 정의한 함수 등과 관련된 기능적인 코드(Functional Code)를 포함할 수 있고, 상기 기능들을 상기 컴퓨터의 프로세서가 소정의 절차대로 실행시키는데 필요한 실행 절차 관련 제어 코드를 포함할 수 있다. 또한, 이러한 코드는 상기 기능들을 상기 컴퓨터의 프로세서가 실행시키는데 필요한 추가 정보나 미디어가 상기 컴퓨터의 내부 또는 외부 메모리의 어느 위치(주소 번지)에서 참조되어야 하는지에 대한 메모리 참조관련 코드를 더 포함할 수 있다. 또한, 상기 컴퓨터의 프로세서가 상기 기능들을 실행시키기 위하여 원격(Remote)에 있는 어떠한 다른 컴퓨터나 서버 등과 통신이 필요한 경우, 코드는 상기 컴퓨터의 통신 모듈을 이용하여 원격에 있는 어떠한 다른 컴퓨터나 서버 등과 어떻게 통신해야 하는지, 통신 시 어떠한 정보나 미디어를 송수신해야 하는지 등에 대한 통신 관련 코드를 더 포함할 수 있다.
상기 저장되는 매체는, 레지스터, 캐쉬, 메모리 등과 같이 짧은 순간 동안 데이터를 저장하는 매체가 아니라 반영구적으로 데이터를 저장하며, 기기에 의해 판독(reading)이 가능한 매체를 의미한다. 구체적으로는, 상기 저장되는 매체의 예로는 ROM, RAM, CD-ROM, 자기 테이프, 플로피디스크, 광 데이터 저장장치 등이 있지만, 이에 제한되지 않는다. 즉, 상기 프로그램은 상기 컴퓨터가 접속할 수 있는 다양한 서버 상의 다양한 기록매체 또는 사용자 컴퓨터상의 다양한 기록매체에 저장될 수 있다. 또한, 상기 매체는 네트워크로 연결된 컴퓨터 시스템에 분산되어, 분산방식으로 컴퓨터가 읽을 수 있는 코드가 저장될 수 있다.
전술한 본 발명의 설명은 예시를 위한 것이며, 본 발명이 속하는 기술분야의 통상의 지식을 가진 자는 본 발명의 기술적 사상이나 필수적인 특징을 변경하지 않고서 다른 구체적인 형태로 쉽게 변형이 가능하다는 것을 이해할 수 있을 것이다. 그러므로 이상에서 기술한 실시예들은 모든 면에서 예시적인 것이며 한정적이 아닌 것으로 이해해야만 한다. 예를 들어, 단일형으로 설명되어 있는 각 구성 요소는 분산되어 실시될 수도 있으며, 마찬가지로 분산된 것으로 설명되어 있는 구성 요소들도 결합된 형태로 실시될 수 있다.
본 발명의 범위는 상기 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어지며, 특허청구범위의 의미 및 범위 그리고 그 균등 개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.
100 : 수신 안테나
200 : 수신부
210 : 감쇄기
220 : 스위칭부
230 : 제1 대역 수신신호 처리부
231 : 제1 대역필터
232 : 제1 믹서
240 : 제2 대역 수신신호 처리부
241 : 제2 대역필터
242 : 제2 믹서
300 : 디지털 신호 처리부
310 : 제1 ADC
311 : 제2 ADC
320 : FPGA
330 : 제1 DAC
331 : 제2 DAC
400 : 송신부
410 : 제1 대역 송신신호 처리부
411 : 제1 믹서
412 : 제1 대역필터
413 : 제1 가변 감쇄기
420 : 제2 대역 송신신호 처리부
421 : 제2 믹서
422 : 제2 대역필터
423 : 제2 가변 감쇄기
430 : 스위칭부
440 : 증폭기
450 : 아이솔레이터
500 : 송신 안테나
200 : 수신부
210 : 감쇄기
220 : 스위칭부
230 : 제1 대역 수신신호 처리부
231 : 제1 대역필터
232 : 제1 믹서
240 : 제2 대역 수신신호 처리부
241 : 제2 대역필터
242 : 제2 믹서
300 : 디지털 신호 처리부
310 : 제1 ADC
311 : 제2 ADC
320 : FPGA
330 : 제1 DAC
331 : 제2 DAC
400 : 송신부
410 : 제1 대역 송신신호 처리부
411 : 제1 믹서
412 : 제1 대역필터
413 : 제1 가변 감쇄기
420 : 제2 대역 송신신호 처리부
421 : 제2 믹서
422 : 제2 대역필터
423 : 제2 가변 감쇄기
430 : 스위칭부
440 : 증폭기
450 : 아이솔레이터
500 : 송신 안테나
Claims (17)
- 다중대역 레이다 표적 모의 장치에 있어서,
수신 안테나를 통해 수신된 레이다 신호를 운용자의 주파수 대역 선택에 따라 서로 다른 주파수 대역의 신호를 각각 수신 처리하는 수신부;
상기 선택된 주파수 대역에 따라 상기 수신부에서 처리된 신호를 일정 시간 메모리에 저장하고, 도플러 주파수 합성하여 표적 신호를 생성하는 디지털 신호 처리부; 및
상기 생성된 표적신호를 운용자의 주파수 대역 선택에 따라 서로 다른 주파수 대역의 신호를 각각 송신 처리하여 표적 신호를 송신 처리하는 송신부를 포함하고,
상기 수신부는,
수신 안테나를 통해 수신되는 레이다 신호의 감쇄량을 조절하는 감쇄부;
상기 감쇄부를 통해 감쇄량이 조절된 신호의 경로를 제1 대역 경로 또는 제2 대역 경로로 운용자의 선택에 따라 스위칭하는 스위칭부;
상기 스위칭부를 통해 스위칭되는 감쇄량 조절된 신호를 제1 주파수 대역으로 신호 처리한 후, 상기 디지털 신호 처리부로 제공하는 제1 대역 수신신호 처리부; 및
상기 스위칭부를 통해 스위칭되는 감쇄량 조절된 신호를 제2 주파수 대역으로 신호 처리한 후, 상기 디지털 신호 처리부로 제공하는 제2 대역 수신신호 처리부를 포함하며,
상기 제1 대역 수신신호 처리부는,
상기 스위칭부를 통해 스위칭된 감쇄량 조절 신호를 제1 대역으로 필터링하는 제1 대역 필터; 및
상기 제1 대역 필터를 통해 필터링된 신호를 주파수 합성을 통해 주파수 하향 조정한 후, 하향 조정된 신호를 상기 디지털 신호 처리부로 제공하는 제1 믹서를 포함하고,
상기 제2 대역 수신신호 처리부는,
상기 스위칭부를 통해 스위칭된 감쇄량 조절 신호를 제2 대역으로 필터링하는 제2 대역 필터; 및
상기 제2 대역 필터를 통해 필터링된 신호를 주파수 합성을 통해 주파수 하향 조정한 후, 하향 조정된 신호를 상기 디지털 신호 처리부로 제공하는 제2 믹서를 포함하며,
상기 디지털 신호 처리부는,
상기 제1 대역 수신신호 처리부의 제1 믹서를 통해 주파수 하향 조정된 신호를 디지털 신호로 변환하는 제1 ADC;
상기 제2 대역 수신신호 처리부의 제2 믹서를 통해 주파수 하향 조정된 신호를 디지털 신호로 변환하는 제2 ADC;
상기 제1 ADC 또는 제2 ADC를 통해 변환된 디지털 신호를 메모리에 저장하고 도플러 주파수 합성하여 출력하는 FPGA;
상기 FPGA를 통해 출력되는 제1 대역에 대한 도플러 주파수 합성된 신호를 아날로그 신호로 변환하는 제1 DAC; 및
상기 FPGA를 통해 출력되는 제2 대역에 대한 도플러 주파수 합성된 신호를 아날로그 신호로 변환하는 제2 DAC를 포함하고,
상기 송신부는,
상기 디지털 신호 처리부의 제1 DAC로부터 출력되는 신호를 제1 대역의 송신신호로 처리하는 제1 대역 송신신호 처리부;
상기 디지털 신호 처리부의 제2 DAC로부터 출력되는 신호를 제2 대역의 송신신호로 처리하는 제2 대역 송신신호 처리부;
상기 제1 대역 송신신호 처리부에서 처리된 송신신호 및 상기 제2 대역 송신신호 처리부에서 처리된 신호를 운용자의 주파수 대역 선택에 따라 스위칭 출력하는 스위칭부; 및
상기 스위칭부를 통해 스위칭 출력되는 신호를 증폭하여 표적신호로 송신 안테나로 제공하는 증폭기를 포함하며,
상기 송신부는, 상기 증폭기에서 증폭된 신호의 역류를 방지하기 위한 아이솔레이터를 더 포함하고,
상기 제1 대역 송신신호 처리부는,
상기 제1 DAC를 통해 출력되는 신호를 주파수 상향 조정하는 제1 믹서;
상기 제1 믹서를 통해 주파수 상향 조정된 신호를 선택된 제1 대역으로 필터링하는 제1 대역필터; 및
상기 제1 대역필터를 통해 필터링된 신호의 감쇄량을 조절한 후, 감쇄량 조절된 신호를 상기 스위칭부를 통해 증폭기로 제공하는 제1 가변 감쇄기를 포함하며,
상기 제2 대역 송신신호 처리부는,
상기 제2 DAC를 통해 출력되는 신호를 주파수 상향 조정하는 제2 믹서;
상기 제2 믹서를 통해 주파수 상향 조정된 신호를 선택된 제2 대역으로 필터링하는 제2 대역필터; 및
상기 제2 대역필터를 통해 필터링된 신호의 감쇄량을 조절한 후, 감쇄량 조절된 신호를 상기 스위칭부를 통해 증폭기로 제공하는 제2 가변 감쇄기를 포함하는 것인 다중대역 레이다 표적 모의 장치.
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- 다중대역 레이다 표적 모의 방법에 있어서,
수신 안테나를 통해 수신된 레이다 신호를 운용자의 주파수 대역 선택에 따라 서로 다른 주파수 대역의 신호를 각각 수신 처리하는 수신 처리 단계;
상기 선택된 주파수 대역에 따라 상기 수신 처리된 신호를 일정 시간 메모리에 저장하고, 도플러 주파수 합성하여 표적 신호를 생성하는 디지털 신호 처리 단계; 및
상기 생성된 표적신호를 운용자의 주파수 대역 선택에 따라 서로 다른 주파수 대역의 신호를 각각 송신 처리하여 표적 신호를 송신 처리하는 송신 처리 단계를 포함하고,
상기 수신 처리 단계는,
수신 안테나를 통해 수신되는 레이다 신호의 감쇄량을 조절하는 단계;
상기 감쇄량이 조절된 신호의 경로를 제1 대역 경로 또는 제2 대역 경로로 운용자의 선택에 따라 스위칭하는 단계;
상기 스위칭되는 감쇄량 조절된 신호를 제1 주파수 대역으로 신호 처리하는 제1 대역 수신신호 처리 단계; 및
상기 스위칭되는 감쇄량 조절된 신호를 제2 주파수 대역으로 신호 처리하는 제2 대역 수신신호 처리 단계를 포함하며,
상기 제1 대역 수신신호 처리 단계는,
상기 스위칭된 감쇄량 조절된 신호를 제1 대역으로 제1 대역필터를 통해 필터링하는 단계; 및
상기 제1 대역으로 필터링된 신호를 제1 믹서를 통해 주파수 하향 조정한 후, 하향 조정된 신호를 출력하는 단계를 포함하고,
상기 제2 대역 수신신호 처리 단계는,
상기 스위칭된 감쇄량 조절된 신호를 제2 대역으로 제2 대역필터를 통해 필터링하는 단계; 및
상기 제2 대역으로 필터링된 신호를 제2 믹서를 통해 주파수 하향 조정한 후, 하향 조정된 신호를 출력하는 단계를 포함하며,
상기 디지털 신호 처리단계는,
상기 제1 믹서를 통해 주파수 하향 조정된 신호를 디지털 신호로 변환하거나, 상기 제2 믹서를 통해 주파수 하향 조정된 신호를 디지털 신호로 변환하는 단계;
상기 제1 대역 또는 제2 대역에 대한 AD변환된 디지털 신호를 FPGA를 이용하여 메모리에 저장하고 도플러 주파수 합성하여 출력하는 단계; 및
상기 FPGA를 통해 출력되는 제1 대역에 대한 도플러 주파수 합성된 신호를 아날로그 신호로 변환하거나, 상기 FPGA를 통해 출력되는 제2 대역에 대한 도플러 주파수 합성된 신호를 아날로그 신호로 변환하는 단계를 포함하고,
상기 송신 처리단계는,
상기 아날로그 신호로 변환된 제1 대역의 송신신호 또는 제2 대역의 송신신호로 처리하는 단계;
상기 처리된 제1 대역 또는 제 2대역의 송신 신호를 운용자의 주파수 대역 선택에 따라 스위칭 출력하는 단계; 및
상기 스위칭 출력되는 신호를 증폭하여 표적신호로 송신 안테나로 출력하는 단계를 포함하며,
상기 송신 처리 단계는, 상기 증폭된 신호의 역류를 방지하기 위해 아이솔레이션하는 단계를 더 포함하고,
상기 제1 대역의 송신신호 또는 제2 대역의 송신신호로 처리하는 단계는,
상기 디지털 신호로 변환된 제1 대역의 신호 또는 제2 대역의 신호를 각 대역에 상응하는 믹서를 통해 주파수 상향 조정하는 단계;
상기 각 대역의 믹서를 통해 주파수 상향 조정된 신호를 선택된 제1 대역 또는 제2 대역으로 대역 필터를 통해 필터링하는 단계; 및
상기 필터링된 신호의 감쇄량을 조절한 후, 감쇄량 조절된 신호를 증폭기를 통해 증폭한 후, 송신 안테나에 표적 신호로 제공하는 단계를 포함하는 것인 다중대역 레이다 표적 모의 방법. - 삭제
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Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN117805752A (zh) * | 2024-01-31 | 2024-04-02 | 南京雷电信息技术股份有限公司 | 一种集成一体化雷达信号模拟器 |
Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2003014838A (ja) * | 2001-06-29 | 2003-01-15 | Koden Electronics Co Ltd | レーダ送受信性能監視装置 |
CN114720952A (zh) * | 2022-06-09 | 2022-07-08 | 成都远望探测技术有限公司 | 一种多频段的天气雷达全链路远程标定系统 |
KR20220139715A (ko) * | 2021-04-08 | 2022-10-17 | 엘아이지넥스원 주식회사 | 모의 표적 신호 발생 장치 및 이를 포함하는 레이더 시험 시스템 |
-
2023
- 2023-08-16 KR KR1020230106887A patent/KR102611883B1/ko active IP Right Grant
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