KR102459379B1 - High efficiency long wavelength light emitting device - Google Patents
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Abstract
일 실시예에 따른 발광 소자는, 제1 도전형 반도체층, 상기 제1 도전형 반도체층 상에 위치하며, 양자우물구조를 갖는 활성층, 상기 활성층 상에 위치하는 제2 도전형 반도체층, 상기 활성층과 상기 제2 도전형 반도체층 사이에 위치하는 전자차단층, 및 상기 전자차단층을 관통하는 관통영역을 포함하며, 상기 활성층은 복수의 우물층 및 복수의 장벽층을 포함하고, 상기 우물층은 In을 포함하는 질화물계 반도체를 포함하며, 상기 장벽층은 상기 우물층의 상부 및 하부에 배치되고, 상기 관통영역은 제2 도전형 반도체층의 상면에 입구를 형성하여, 상기 입구로부터 200nm 이상의 깊이를 가진다.The light emitting device according to an embodiment includes a first conductivity-type semiconductor layer, an active layer positioned on the first conductivity-type semiconductor layer, and having a quantum well structure, a second conductivity-type semiconductor layer positioned on the active layer, and the active layer and an electron blocking layer positioned between the second conductivity type semiconductor layer, and a through region penetrating the electron blocking layer, wherein the active layer includes a plurality of well layers and a plurality of barrier layers, the well layer comprising: a nitride-based semiconductor containing In, wherein the barrier layer is disposed above and below the well layer, and the through region forms an entrance on the upper surface of the second conductivity type semiconductor layer, and has a depth of 200 nm or more from the entrance. have
Description
본 발명은 발광 소자에 관한 것으로, 특히, 녹색광을 포함하는 장파장의 광을 방출하는 고효율 발광 소자에 관한 것이다.The present invention relates to a light-emitting device, and more particularly, to a high-efficiency light-emitting device emitting light of a long wavelength including green light.
최근 발광 다이오드와 같은 발광 소자의 베이스 물질로 질화물계 반도체가 폭넓게 사용된다. 질화물계 반도체는 Ⅲ족 원소의 조성비에 따라 다양한 밴드갭 에너지를 가질 수 있어서, Al, Ga, In 등의 원소들의 조성비를 제어함으로써 다양한 파장대의 광을 구현할 수 있다.Recently, nitride-based semiconductors are widely used as base materials for light emitting devices such as light emitting diodes. Since the nitride-based semiconductor may have various bandgap energies according to the composition ratio of the group III element, light in various wavelength bands may be realized by controlling the composition ratio of elements such as Al, Ga, and In.
활성층의 구조로서 다중양자우물구조(MQW)가 일반적으로 사용되고 있으며, 상기 다중양자우물구조의 우물층(Well layer)의 질화물계 반도체의 조성비에 따라 발광 소자의 발광 파장이 결정된다. 예를 들어, 활성층에서 청색광을 방출하는 발광 소자의 경우 우물층으로 In을 소량으로 포함하는 InGaN층을 이용하고, 자외선 발광 소자의 경우 우물층으로 AlGaN층을 이용한다.A multi-quantum well structure (MQW) is generally used as the structure of the active layer, and the emission wavelength of the light emitting device is determined according to the composition ratio of the nitride-based semiconductor of the well layer of the multi-quantum well structure. For example, in the case of a light emitting device emitting blue light from an active layer, an InGaN layer containing a small amount of In is used as a well layer, and in the case of an ultraviolet light emitting device, an AlGaN layer is used as a well layer.
한편, 상대적으로 장파장의 광을 방출하는 발광 소자, 즉, 청색광보다 긴 파장의 광을 방출하는 발광 소자를 구현하려면 In을 다량으로 포함하는 질화물계 반도체를 이용하여 우물층을 형성한다. 그런데 InGaN과 같은 In을 과량으로 포함하는 질화물계 반도체는 성장 조건 등이 GaN와 달라, 일반적인 청색 발광 소자 제조 방법 등을 장파장 발광 소자의 제조에 그대로 적용하기 곤란하다.Meanwhile, to implement a light emitting device emitting light of a relatively long wavelength, that is, a light emitting device emitting light having a longer wavelength than blue light, a well layer is formed using a nitride-based semiconductor containing a large amount of In. However, a nitride-based semiconductor containing an excessive amount of In such as InGaN has different growth conditions from GaN, so it is difficult to apply a general method of manufacturing a blue light emitting device to the manufacturing of a long wavelength light emitting device as it is.
나아가, In을 과량으로 포함하는 우물층을 가지는 발광 다이오드는 청색 발광 다이오드에 비해 일반적으로 정전 방전 등에 취약한 것으로 알려져 있다.Furthermore, it is known that a light emitting diode having a well layer containing excessively In is generally more vulnerable to electrostatic discharge and the like than a blue light emitting diode.
본 발명이 해결하고자 하는 과제는, 우물층에서의 In 원자의 사이트(site) 이탈로 인한 석출, 편석의 발생 등을 방지하여 파장의 전이(shift)가 최소화되고 발광 효율이 높은 장파장 발광 소자를 제공하는 것이다.The problem to be solved by the present invention is to prevent the occurrence of precipitation and segregation due to site departure of In atoms in a well layer, thereby minimizing wavelength shift and providing a long-wavelength light emitting device with high luminous efficiency will do
본 발명이 해결하고자 하는 또 다른 과제는, 정전 방전에 의한 소자 불량 발생을 방지하면서 발광 효율이 높은 장파장 발광 소자를 제공하는 것이다.Another problem to be solved by the present invention is to provide a long-wavelength light emitting device having high luminous efficiency while preventing device defects from occurring due to electrostatic discharge.
본 발명의 일 실시예에 따른 장파장 발광 소자는, 제1 도전형 반도체층; 상기 제1 도전형 반도체층 상에 위치하며, 양자우물구조를 갖는 활성층; 및 상기 활성층 상에 위치하는 제2 도전형 반도체층을 포함하고, 상기 활성층은, 21% 이상의 In을 포함하는 질화물계 반도체를 포함하는 적어도 하나의 우물층; 상기 우물층의 상부 및 하부에 위치하는 적어도 두 개의 장벽층; 및 상기 우물층 상에 위치하며, 상기 우물층과 상기 장벽층의 사이에 위치하는 적어도 하나의 상부 캡핑층을 포함하며, 상기 상부 캡핑층은 상기 장벽층보다 큰 밴드갭 에너지를 가지며, 상기 상부 캡핑층과 상기 우물층은 접한다.A long wavelength light emitting device according to an embodiment of the present invention, a first conductivity type semiconductor layer; an active layer disposed on the first conductivity-type semiconductor layer and having a quantum well structure; and a second conductivity-type semiconductor layer disposed on the active layer, wherein the active layer includes: at least one well layer including a nitride-based semiconductor containing 21% or more In; at least two barrier layers positioned above and below the well layer; and at least one upper capping layer disposed on the well layer and disposed between the well layer and the barrier layer, wherein the upper capping layer has a higher bandgap energy than the barrier layer, and wherein the upper capping layer has a bandgap energy greater than that of the barrier layer. The ping layer and the well layer are in contact.
한편, 상기 우물층은 InGaN을 포함하고, 상기 장벽층은 GaN를 포함하며, 상기 상부 캡핑층은 AlGaN을 포함할 수 있다.Meanwhile, the well layer may include InGaN, the barrier layer may include GaN, and the upper capping layer may include AlGaN.
또한, 상기 상부 캡핑층의 AlGaN은 0.1% 내지 2.5%의 Al을 포함할 수 있다. 더 구체적으로, 상기 상부 캡핑층의 AlGaN은 1.4% 내지 1.8%의 Al을 포함할 수 있으며, 이 범위에서 양호한 광 출력 및 낮은 순방향 전압을 달성할 수 있다.In addition, AlGaN of the upper capping layer may include 0.1% to 2.5% Al. More specifically, AlGaN of the upper capping layer may contain 1.4% to 1.8% Al, and in this range, good light output and low forward voltage can be achieved.
한편, 상기 상부 캡핑층의 두께는 상기 장벽층의 두께보다 얇을 수 있다. 일 실시예에서, 상기 상부 캡핑층은 5Å 내지 20Å의 두께를 가질 수 있다.Meanwhile, a thickness of the upper capping layer may be thinner than a thickness of the barrier layer. In an embodiment, the upper capping layer may have a thickness of 5 Å to 20 Å.
한편, 상기 장파장 발광 소자는 복수의 우물층 및 복수의 장벽층을 포함하고, 상기 복수의 장벽층들 중 최상부에 위치하는 최상부 장벽층의 두께는 나머지 장벽층들보다 두꺼울 수 있다.Meanwhile, the long wavelength light emitting device may include a plurality of well layers and a plurality of barrier layers, and a thickness of the uppermost barrier layer positioned at the top of the plurality of barrier layers may be thicker than the other barrier layers.
또한, 상기 최상부 장벽층은 상기 최상부 장벽층의 평균 밴드갭 에너지보다 작은 밴드갭 에너지를 갖는 서브 장벽층을 포함할 수 있다. 특히, 상기 서브 장벽층은 In을 함유할 수 있으며, 서브 장벽층의 In 조성비는 우물층의 In 조성비보다 작을 수 있다. 서브 장벽층은 우물층보다 작은 격자 상수를 가지며, 따라서 우물층과 전자 차단층 사이의 격자 불일치를 완화한다. 이에 따라, 제2 도전형 반도체층의 결정 품질이 개선될 수 있다.In addition, the uppermost barrier layer may include a sub-barrier layer having a bandgap energy smaller than an average bandgap energy of the uppermost barrier layer. In particular, the sub-barrier layer may contain In, and the In composition ratio of the sub-barrier layer may be smaller than the In composition ratio of the well layer. The sub-barrier layer has a smaller lattice constant than the well layer, thus mitigating the lattice mismatch between the well layer and the electron blocking layer. Accordingly, the crystal quality of the second conductivity type semiconductor layer may be improved.
상기 장파장 발광 소자는, 상기 우물층 아래에 위치하며, 상기 우물층과 상기 장벽층의 사이에 위치하는 적어도 하나의 하부 캡핑층을 더 포함할 수 있으며, 상기 하부 캡핑층은 상기 장벽층보다 큰 밴드갭 에너지를 가질 수 있다.The long wavelength light emitting device may further include at least one lower capping layer positioned under the well layer and positioned between the well layer and the barrier layer, wherein the lower capping layer has a larger band than the barrier layer. It may have a gap energy.
상기 장파장 발광 소자는 상기 활성층 상에 위치하는 전자 차단층을 더 포함할 수 있다.The long wavelength light emitting device may further include an electron blocking layer disposed on the active layer.
몇몇 실시예들에 있어서, 상기 전자 차단층은 Al 조성비가 상기 제2 도전형 반도체층을 향해 감소하는 그레이딩 층을 포함할 수 있다. Al 그레이딩 층을 사용함으로써 전자를 차단하면서도 홀을 활성층 내로 쉽게 주입할 수 있다. 또한, 상기 전자 차단층은 In을 함유할 수 있으며, 상기 전자 차단층의 In 조성비는 상기 서브 장벽층의 In 조성비보다 작을 수 있다. 이에 따라, 우물층, 서브 장벽층 및 전자 차단층 순서로 In 조성비가 점차 줄어들며 격자 상수가 감소한다. In 조성비가 매우 큰 장파장 발광 소자에서 In 조성비를 위와 같이 점차 감소시킴으로써 전자 차단층 및 제2 도전형 반도체층의 결정 품질을 개선할 수 있다. 제2 도전형 반도체층 및 전자 차단층의 결정 품질을 개선함으로써 정전 방전에도 강한 발광 소자를 제공할 수 있다.In some embodiments, the electron blocking layer may include a grading layer in which the Al composition ratio decreases toward the second conductivity type semiconductor layer. By using the Al grading layer, holes can be easily injected into the active layer while blocking electrons. In addition, the electron blocking layer may contain In, and the In composition ratio of the electron blocking layer may be smaller than the In composition ratio of the sub-barrier layer. Accordingly, the In composition ratio gradually decreases in the order of the well layer, the sub-barrier layer, and the electron blocking layer, and the lattice constant decreases. The crystal quality of the electron blocking layer and the second conductivity type semiconductor layer may be improved by gradually decreasing the In composition ratio as described above in a long wavelength light emitting device having a very large In composition ratio. By improving the crystal quality of the second conductivity type semiconductor layer and the electron blocking layer, it is possible to provide a light emitting device resistant to electrostatic discharge.
다른 실시예들에 있어서, 상기 전자 차단층은 상기 활성층에 접하는 제1 전자 차단층, 상기 제1 전자 차단층 상에 배치된 제2 전자 차단층 및 상기 2 도전형 반도체층에 접하는 제3 전자 차단층을 포함하고, 상기 제2 전자 차단층은 상기 제1 및 제3 전자 차단층에 비해 Mg이 고농도로 도핑되고, 상기 제3 전자 차단층은 초격자 구조를 가질 수 있다. 이에 따라, 제2 전자 차단층을 이용하여 전자를 효율적으로 차단하면서 홀을 활성층 내로 잘 주입시킬 수 있다.In other embodiments, the electron blocking layer includes a first electron blocking layer in contact with the active layer, a second electron blocking layer disposed on the first electron blocking layer, and a third electron blocking layer in contact with the second conductivity type semiconductor layer. layer, wherein the second electron blocking layer is doped with Mg at a higher concentration than the first and third electron blocking layers, and the third electron blocking layer may have a superlattice structure. Accordingly, holes can be well injected into the active layer while efficiently blocking electrons using the second electron blocking layer.
나아가, 상기 제3 전자 차단층은 AlInGaN/GaN의 초격자 구조를 가질 수 있다. AlInGaN/GaN의 초격자 구조를 채택함으로써 그 위에 형성되는 제2 도전형 반도체층, 예컨대 GaN층의 결정 품질을 향상시킬 수 있다.Furthermore, the third electron blocking layer may have a superlattice structure of AlInGaN/GaN. By adopting the AlInGaN/GaN superlattice structure, the crystal quality of the second conductivity type semiconductor layer formed thereon, for example, the GaN layer can be improved.
한편, 상기 장벽층은 120Å 내지 150Å의 두께를 가질 수 있으나, 이에 한정되는 것은 아니다. 상기 장벽층은 150Å보다 더 두꺼운 두께를 가질 수도 있다. 다만, 상기 장벽층은 220Å 이하의 두께를 갖는다. 장벽층이 220Å보다 더 두꺼울 경우, 광 출력이 감소하고, 순방향 전압이 증가한다. 특히, 상기 장벽층은 170Å 내지 200Å의 두께를 가질 수 있는데, 이 두께 범위에서 높은 광 출력 및 낮은 순방향 전압이 가능하다.Meanwhile, the barrier layer may have a thickness of 120 Å to 150 Å, but is not limited thereto. The barrier layer may have a thickness greater than 150 angstroms. However, the barrier layer has a thickness of 220 angstroms or less. When the barrier layer is thicker than 220 angstroms, the light output decreases and the forward voltage increases. In particular, the barrier layer may have a thickness of 170 angstroms to 200 angstroms, in which high light output and low forward voltage are possible.
한편, 상기 활성층은 복수의 장벽층 및 복수의 우물층을 포함하고, 상기 복수의 장벽층들은 상기 장벽층들 중 n형 불순물이 상대적으로 고농도로 도핑된 장벽층들 및 n형 불순물이 상대적으로 저농도로 도핑되거나 언도프트 장벽층들을 포함할 수 있다. 상기 n형 불순물이 상대적으로 고농도로 도핑된 장벽층들은 상기 제2 도전형 반도체층보다 상기 제1 도전형 반도체층에 더 가깝게 배치된다. 전자와 홀은 대체로 제2 도전현 반도체층에 가까운 우물층에서 재결합하기 쉽다. 따라서, 전자와 홀이 재결합하는 우물층들 주위의 장벽층들에 비해 제1 도전형 반도체층에 상대적으로 가까운 장벽층들에 n형 불순물을 도핑함으로써 비발광 재결합을 방지하면서 전자의 주입 효율을 향상시킬 수 있다.Meanwhile, the active layer includes a plurality of barrier layers and a plurality of well layers, and the plurality of barrier layers include barrier layers doped with a relatively high concentration of n-type impurities and a relatively low concentration of n-type impurities among the barrier layers. It may include undoped or undoped barrier layers. The barrier layers doped with the n-type impurity at a relatively high concentration are disposed closer to the first conductivity type semiconductor layer than the second conductivity type semiconductor layer. Electrons and holes are generally likely to recombine in the well layer close to the second conductive current semiconductor layer. Therefore, the electron injection efficiency is improved while preventing non-luminescent recombination by doping the n-type impurity into the barrier layers relatively close to the first conductivity type semiconductor layer compared to the barrier layers around the well layers where electrons and holes recombine. can do it
또한, 상기 장벽층들은 Mg이 도핑된 장벽층들을 포함할 수 있으며, 상기 Mg이 도핑된 장벽층들은 상기 제2 도전형 반도체층에 가까울수록 더 높은 Mg 도핑 농도를 가질 수 있다. 제2 도전형 반도체층에 가까운 장벽층들에 상대적으로 높은 농도로 Mg을 도핑함으로써 홀의 주입효율을 개선할 수 있다.In addition, the barrier layers may include Mg-doped barrier layers, and the Mg-doped barrier layers may have a higher Mg doping concentration as they are closer to the second conductivity-type semiconductor layer. By doping the barrier layers close to the second conductivity type semiconductor layer with Mg at a relatively high concentration, hole injection efficiency may be improved.
한편, 상기 제1 도전형 반도체층은 V-피트 생성층을 포함할 수 있다. 상기 V-피트 생성층은 n형 불순물 도핑된 단일 조성의 제1층 및 초격자 구조의 제2층을 포함할 수 있다. V-피트 생성층을 이용하여 활성층을 통과하는 V-피트를 형성함으로써 정전 방전에 강한 발광 소자를 제공할 수 있다.Meanwhile, the first conductivity type semiconductor layer may include a V-pit generation layer. The V-pit generation layer may include a first layer of a single composition doped with an n-type impurity and a second layer of a superlattice structure. By using the V-pit generation layer to form V-pits passing through the active layer, it is possible to provide a light emitting device resistant to electrostatic discharge.
나아가, 상기 제1층은 n형 불순물 도핑된 GaN층이고, 상기 제2층은 InGaN/GaN 초격자 구조일 수 있다. 제2층을 초격자 구조로 함으로써 활성층의 결정 품질을 향상시킬 수 있다. 상기 초격자 구조 내 InGaN의 In 함량은 1% 내지 5%일 수 있다.Furthermore, the first layer may be a GaN layer doped with n-type impurities, and the second layer may have an InGaN/GaN superlattice structure. When the second layer has a superlattice structure, the crystal quality of the active layer can be improved. The In content of InGaN in the superlattice structure may be 1% to 5%.
또한, 상기 V-피트 생성층은 1500Å 내지 3000Å의 두께를 가지며, 상기 초격자 구조의 제2층의 두께는 상기 단일 조성의 제1층보다 더 크거나 같을 수 있다. 제2층의 두께를 제1층의 두께보다 더 크거나 같게 함으로써 활성층의 결정 품질을 확보하면서 정전 방전에 강한 발광 소자를 제공할 수 있다.In addition, the V-pit generation layer may have a thickness of 1500 Å to 3000 Å, and the thickness of the second layer of the superlattice structure may be greater than or equal to that of the first layer of the single composition. By making the thickness of the second layer greater than or equal to the thickness of the first layer, it is possible to provide a light emitting device resistant to electrostatic discharge while securing the crystal quality of the active layer.
한편, 상기 제1 도전형 반도체층은 상기 V-피트 생성층 하부에 위치하는 n형 불순물 변조 도핑층을 더 포함할 수 있으며, 상기 n형 불순물 변조 도핑층의 도핑 농도는 상기 제1층의 n형 불순물 도핑 농도보다 높다. 상기 n형 불순물 변조 도핑층이 전극이 접촉하는 콘택층이 될 수 있다.Meanwhile, the first conductivity-type semiconductor layer may further include an n-type impurity modulation doping layer positioned below the V-pit generation layer, and the doping concentration of the n-type impurity modulation doping layer is n of the first layer. type impurity is higher than the doping concentration. The n-type impurity modulation doping layer may be a contact layer to which an electrode contacts.
몇몇 실시예들에 있어서, 상기 제2층은 상기 제1층보다 더 높은 농도로 n형 불순물이 도핑될 수 있다. 그러나 다른 실시예에 있어서, 상기 제2층은 상기 제1층보다 더 낮은 농도로 n형 불순물이 도핑될 수 있으며, 도핑되지 않을 수도 있다.In some embodiments, the second layer may be doped with an n-type impurity at a higher concentration than that of the first layer. However, in another embodiment, the second layer may be doped with an n-type impurity at a lower concentration than that of the first layer, or may not be doped.
한편, 상기 활성층은 복수의 장벽층 및 복수의 우물층을 포함하고, 상기 복수의 장벽층들은 상기 장벽층들 중 n형 불순물이 상대적으로 고농도로 도핑된 장벽층들 및 n형 불순물이 상대적으로 저농도로 도핑되거나 언도프트 장벽층들을 포함하고, 상기 n형 불순물이 상대적으로 고농도로 도핑된 장벽층들은 상기 제2 도전형 반도체층보다 상기 제1 도전형 반도체층에 더 가깝게 배치되며, 상기 제1층보다 더 높은 n형 불순물 도핑 농도를 가지며, 상기 제1층은 상기 n형 불순물 상대적으로 저농도로 도핑되거나 언도프트 장벽층들보다 더 높은 n형 불순물 도핑 농도를 가질 수 있다. Meanwhile, the active layer includes a plurality of barrier layers and a plurality of well layers, and the plurality of barrier layers include barrier layers doped with a relatively high concentration of n-type impurities and a relatively low concentration of n-type impurities among the barrier layers. The barrier layers doped with or including undoped barrier layers and doped with the n-type impurity at a relatively high concentration are disposed closer to the first conductivity type semiconductor layer than the second conductivity type semiconductor layer, and the first layer It has a higher n-type impurity doping concentration, and the first layer may be doped with a relatively low concentration of the n-type impurity or may have a higher n-type impurity doping concentration than the undoped barrier layers.
일 실시예에서, 상기 발광 소자는 입구가 250nm를 초과하는 V-피트들을 포함할 수 있다. In one embodiment, the light emitting device may include V-pits having an entrance greater than 250 nm.
다른 실시예에서, 상기 제2 도전형 반도체층은 p-GaN층들 사이에 위치하는 p-AlGaN층을 포함할 수 있다. 상기 p-AlGaN층은 상기 제2 도전형 반도체층의 상면보다 하면에 더 가깝게 배치될 수 있으며, 여기서, 상기 하면은 상기 상면보다 상기 활성층측에 더 가깝게 위치하는 면이다.In another embodiment, the second conductivity type semiconductor layer may include a p-AlGaN layer positioned between the p-GaN layers. The p-AlGaN layer may be disposed closer to a lower surface than the upper surface of the second conductivity type semiconductor layer, wherein the lower surface is a surface located closer to the active layer side than the upper surface.
본 발명에 따르면, 우물층과 장벽층의 사이에 위치하며, 우물층을 덮는 상부 캡핑층을 포함하는 장파장 발광 소자가 제공된다. 상부 캡핑층은 우물층의 열적 손상을 방지하여, In의 이탈을 방지하고 우물층의 결정성이 악화되는 것을 방지한다. 또한 상부 캡핑층은 우물층 및 장벽층보다 작은 격자상수를 가짐으로써, 우물층에 발생하는 스트레인을 감소시켜 양자가둠스타크효과를 저하시켜, 발광 효율을 향상시킬 수 있다.According to the present invention, there is provided a long-wavelength light emitting device including an upper capping layer disposed between a well layer and a barrier layer and covering the well layer. The upper capping layer prevents thermal damage of the well layer, thereby preventing the escape of In and preventing the crystallinity of the well layer from being deteriorated. In addition, since the upper capping layer has a smaller lattice constant than the well layer and the barrier layer, the strain generated in the well layer can be reduced, thereby reducing the quantum confinement Stark effect, thereby improving luminous efficiency.
또한, 활성층 아래에 V-피트 생성층을 배침함으로써 정전 방전에 의한 소자 불량을 방지할 수 있다.In addition, by disposing the V-pit generation layer under the active layer, it is possible to prevent device failure due to electrostatic discharge.
본 발명의 다른 특징 및 장점들은 이하의 상세한 설명을 통해 더욱 명확해질 것이다.Other features and advantages of the present invention will become more apparent from the following detailed description.
도 1 내지 도 4는 본 발명의 실시예들에 따른 장파장 발광 소자 및 장파장 발광 소자 제조 방법을 설명하기 위한 단면도들이다.
도 5a 및 도 5b는 일 실시예에 따른 장파장 발광 소자의 활성층을 설명하기 위한 확대 단면도 및 밴드 다이어그램이다.
도 6a 및 도 6b는 또 다른 실시예에 따른 장파장 발광 소자의 활성층을 설명하기 위한 확대 단면도 및 밴드 다이어그램이다.
도 7은 본 발명의 일 실시예에 따른 장파장 발광 소자의 제1 도전형 반도체층을 설명하기 위한 확대 단면도이다.
도 8은 본 발명의 일 실시예에 따른 장파장 발광 소자의 전자 차단층을 설명하기 위한 확대 단면도이다.
도 9는 본 발명의 또 다른 실시예에 따른 장파장 발광 소자의 전자 차단층을 설명하기 위한 확대 단면도이다.
도 10은 본 발명의 일 실시예에 따른 장파장 발광 소자의 제2 도전형 반도체층을 설명하기 위한 확대 단면도이다.
도 11은 본 발명의 다양한 실시예들에 따른 발광 소자의 표면을 보여주는 광학사진들이다.
도 12는 V-피트의 단면을 보여주는 전자현미경 사진이다.1 to 4 are cross-sectional views illustrating a long wavelength light emitting device and a method of manufacturing a long wavelength light emitting device according to embodiments of the present invention.
5A and 5B are enlarged cross-sectional views and band diagrams for explaining an active layer of a long wavelength light emitting device according to an embodiment.
6A and 6B are enlarged cross-sectional views and band diagrams for explaining an active layer of a long wavelength light emitting device according to another embodiment.
7 is an enlarged cross-sectional view illustrating a first conductivity type semiconductor layer of a long wavelength light emitting device according to an embodiment of the present invention.
8 is an enlarged cross-sectional view illustrating an electron blocking layer of a long wavelength light emitting device according to an embodiment of the present invention.
9 is an enlarged cross-sectional view for explaining an electron blocking layer of a long wavelength light emitting device according to another embodiment of the present invention.
10 is an enlarged cross-sectional view illustrating a second conductivity type semiconductor layer of a long wavelength light emitting device according to an embodiment of the present invention.
11 is an optical photograph showing a surface of a light emitting device according to various embodiments of the present invention.
12 is an electron micrograph showing a cross-section of the V-pit.
이하, 첨부한 도면들을 참조하여 본 발명의 실시예들을 상세히 설명한다. 다음에 소개되는 실시예들은 본 발명이 속하는 기술분야의 통상의 기술자에게 본 발명의 사상이 충분히 전달될 수 있도록 하기 위해 예로서 제공되는 것이다. 따라서, 본 발명은 이하 설명되는 실시예들에 한정되지 않고 다른 형태로 구체화될 수도 있다. 그리고, 도면들에 있어서, 구성요소의 폭, 길이, 두께 등은 편의를 위하여 과장되어 표현될 수도 있다. 또한, 하나의 구성요소가 다른 구성요소의 "상부에" 또는 "상에" 있다고 기재된 경우 각 부분이 다른 부분의 "바로 상부" 또는 "바로 상에" 있는 경우뿐만 아니라 각 구성요소와 다른 구성요소 사이에 또 다른 구성요소가 개재된 경우도 포함한다. 명세서 전체에 걸쳐서 동일한 참조번호들은 동일한 구성요소들을 나타낸다.Hereinafter, embodiments of the present invention will be described in detail with reference to the accompanying drawings. The embodiments introduced below are provided as examples so that the spirit of the present invention can be sufficiently conveyed to those skilled in the art to which the present invention pertains. Accordingly, the present invention is not limited to the embodiments described below and may be embodied in other forms. And, in the drawings, the width, length, thickness, etc. of the components may be exaggerated for convenience. In addition, when one component is described as being “on” or “on” another component, each component is different from each component as well as when each component is “immediately above” or “directly on” the other component. It includes the case where another component is interposed between them. Like reference numerals refer to like elements throughout.
또한, 이하 설명되는 질화물계 반도체층들에 대한 각 조성비, 성장 방법, 성장 조건, 두께 등은 예시에 해당하며, 하기 기재된 바에 따라 본 발명이 제한되는 것은 아니다. 예를 들어, InGaN로 표기되는 경우, In과 Ga의 조성비는 이 기술 분야의 통상의 지식을 가진 자(이하, "통상의 기술자")의 필요에 따라 다양하게 적용될 수 있다. 또한, 이하 설명되는 질화물계 반도체층들은 통상의 기술자에게 일반적으로 알려진 다양한 방법을 이용하여 성장될 수 있으며, 예를 들어, MOCVD(Metal Organic Chemical Vapor Deposition), MBE(Molecular Beam Epitaxy) 또는 HVPE(Hydride Vapor Phase Epitaxy) 등의 기술을 이용하여 성장될 수 있다. 다만, 이하 설명되는 실시예들에서는, 반도체층들이 MOCVD를 이용하여 성장 챔버 내에서 성장된 것으로 설명된다. 질화물계 반도체층들의 성장 과정에서, 성장 챔버 내에 유입되는 소스들은, 특별히 언급하지 않는 한, 통상의 기술자에게 알려진 소스를 이용할 수 있으며, 예를 들어, Ga 소스로 TMGa, TEGa 등을 이용할 수 있고, Al 소스로 TMAl, TEAl 등을 이용할 수 있으며, In 소스로 TMIn, TEIn 등을 이용할 수 있으며, N 소스로 NH3를 이용할 수 있다. 그러나 본 발명이 이에 한정되는 것은 아니다. 또한, 후술하는 실시예들에 따른 장파장 발광 소자 제조 방법에 있어서, 각 단계의 순서는 일례에 해당하며, 각 단계의 순서들은 변경될 수 있다.In addition, each composition ratio, growth method, growth condition, thickness, etc. for the nitride-based semiconductor layers described below are examples, and the present invention is not limited as described below. For example, when expressed as InGaN, the composition ratio of In and Ga may be variously applied according to the needs of a person skilled in the art (hereinafter, "a person skilled in the art"). In addition, the nitride-based semiconductor layers described below may be grown using various methods generally known to those skilled in the art, for example, MOCVD (Metal Organic Chemical Vapor Deposition), MBE (Molecular Beam Epitaxy), or HVPE (Hydride). Vapor Phase Epitaxy) can be grown using techniques such as. However, in the embodiments described below, it is described that the semiconductor layers are grown in a growth chamber using MOCVD. In the process of growing nitride-based semiconductor layers, sources introduced into the growth chamber may use sources known to those skilled in the art, unless otherwise specified, for example, TMGa, TEGa, etc. may be used as Ga sources, TMAl, TEAl, etc. may be used as the Al source, TMIn, TEIn, etc. may be used as the In source, and NH 3 may be used as the N source. However, the present invention is not limited thereto. In addition, in the method of manufacturing a long wavelength light emitting device according to embodiments to be described later, the order of each step corresponds to an example, and the order of each step may be changed.
도 1 내지 도 4는 본 발명의 실시예들에 따른 장파장 발광 소자 및 장파장 발광 소자 제조 방법을 설명하기 위한 단면도들이다.1 to 4 are cross-sectional views illustrating a long wavelength light emitting device and a method of manufacturing a long wavelength light emitting device according to embodiments of the present invention.
먼저, 도 1을 참조하면, 기판(110) 상에 제1 도전형 반도체층(130)을 형성한다. 일 실시예에서, 제1 도전형 반도체층(130)의 성장 전에, 기판(110) 상에 버퍼층이 더 형성될 수 있다.First, referring to FIG. 1 , a first conductivity-
기판(110)은 질화물계 반도체를 성장시킬 수 있는 기판이면 한정되지 않으며, 예를 들어, 사파이어 기판, 실리콘 기판, 실리콘 카바이드 기판, 또는 스피넬 기판과 같은 이종 기판을 포함할 수 있고, 또한, 질화갈륨 기판, 질화알루미늄 기판 등과 같은 동종 기판을 포함할 수 있다. 또한, 기판(110)은 비극성, 반극성 또는 극성의 성장면을 가질 수 있다.The
제1 도전형 반도체층(130)은 성장 기판(110) 상에 위치한다. 제1 도전형 반도체층(130)은 (Al, Ga, In)N과 같은 질화물계 반도체를 포함하고, MOCVD, MBE, HVPE 등과 같은 방법을 이용하여 성장 기판(110) 상에 성장되어 형성될 수 있다. 예컨대, MOCVD를 이용하여 제1 도전형 반도체층(130)을 성장시키는 경우, 약 950℃ 내지 1200℃의 성장 온도에서 소정의 성장 속도로 GaN을 포함하는 질화물계 반도체층을 성장시킴으로써, 제1 도전형 반도체층(130)이 형성될 수 있다. 또한, 제1 도전형 반도체층(120)은 Si, C, Ge, Sn, Te, Pb 등과 같은 불순물을 1종 이상 포함하여 n형으로 도핑될 수 있다. 다만, 이에 한정되지 않고, 제1 도전형 반도체층(130)은 p형 도펀트를 포함하여 반대의 도전형으로 도핑될 수도 있다. 나아가, 제1 도전형 반도체층(130)은 단일층 또는 다중층으로 이루어질 수 있다. 제1 도전형 반도체층(130)이 다중층으로 이루어진 경우, 제1 도전형 반도체층(130)은 초격자층, 컨택층, 변조도핑층, 전자주입층 등을 포함할 수 있다. 제1 도전형 반도체층(130)이 다중층인 경우에 대해서 도 7을 참조하여 뒤에서 더 상세하게 설명된다.The first conductivity
한편, 제1 도전형 반도체층(130)을 성장시키기 전에, 기판(110) 상에 버퍼층(120)을 더 형성할 수 있다. 버퍼층(120)은 GaN과 같은 질화물 반도체를 포함할 수 있고, MOCVD를 이용하여 성장시킬 수 있으며, 약 450 내지 600℃ 범위 내의 성장 온도에서 성장될 수 있다. 버퍼층(120)은 후속 공정에서 기판(110) 상에 성장되는 반도체층들의 결정성을 우수하게 할 수 있으며, 또한, 이종 기판 상에 질화물계 반도체층들이 성장될 수 있는 시드층 역할을 할 수도 있다.Meanwhile, before growing the first conductivity-
도 2를 참조하면, 제1 도전형 반도체층(130) 상에 활성층(140)을 형성한다. 나아가, 활성층(140) 상에 전자차단층(150)을 더 형성할 수 있다.Referring to FIG. 2 , the
활성층(140)은 (Al, Ga, In)N과 같은 질화물 반도체를 포함할 수 있으며, MOCVD, MBE, 또는 HVPE 등의 기술을 이용하여 제1 도전형 반도체층(130) 상에 성장될 수 있다. 또한, 활성층(140)은 적어도 두 개의 장벽층(barrier layer; 141) 및 적어도 하나의 우물층(well layer, 143)을 포함하는 양자우물구조(QW)를 포함할 수 있으며, 나아가, 복수의 장벽층(141) 및 복수의 우물층(143)을 포함하는 다중양자우물구조(MQW)를 포함할 수 있다. 또한, 활성층(140)은 적어도 하나의 우물층(143)의 상부에 위치하여, 상기 적어도 하나의 우물층(143)과 장벽층(141)의 사이에 개재된 상부 캡핑층(145 또는 145a)을 더 포함할 수 있다. 더 나아가, 활성층(140)은 적어도 하나의 우물층(143)의 하부에 위치하여, 상기 적어도 하나의 우물층(143)과 장벽층(141)의 사이에 개재된 하부 캡핑층(145b)을 더 포함할 수 있다. The
활성층(140)에서 방출되는 광은 상대적으로 장파장의 광일 수 있고, 예컨대, 청색광보다 긴 파장대의 녹색광을 방출할 수 있다. 활성층(140)에서 방출되는 광의 파장은 우물층(143)의 질화물계 반도체층의 조성비를 제어하여 조절할 수 있다. 이 경우, 우물층(143)은 In을 포함하는 질화물계 반도체를 포함할 수 있으며, 상기 In의 조성비는 21% 이상일 수 있다. 활성층(140)과 관련하여서는 후술하여 더욱 상세하게 설명한다.Light emitted from the
전자차단층(150)은 활성층(140) 상에 위치하며, 활성층(140)으로부터 그 상부로 전자(electron)가 오버플로우하는 것을 방지한다. 전자차단층(150)은 활성층(140)의 최상부 장벽층(147) 상에 형성될 수 있다. 또한, 전자차단층(150)의 평균 밴드갭에너지는 최상부 장벽층(147)의 평균 밴드갭 에너지보다 클 수 있으며, 이에 따라 전자들이 제2 도전형 반도체층(160) 측으로 이동하는 것이 전자차단층(150)의 에너지 베리어에 의해 차단될 수 있다.The
도 3을 참조하면, 활성층(140) 또는 전자차단층(150) 상에 제2 도전형 반도체층(160)을 형성한다.Referring to FIG. 3 , the second conductivity
제2 도전형 반도체층(160)은 (Al, Ga, In)N과 같은 질화물계 반도체를 포함할 수 있으며, MOCVD, MBE, 또는 HVPE 등의 기술을 이용하여 성장될 수 있다. 제2 도전형 반도체층(160)은 제1 도전형 반도체층(130)의 도전형과 반대의 도전형으로 도핑될 수 있다. 예를 들어, 제2 도전형 반도체층(160)은 Mg과 같은 불순물을 포함하여 p형으로 도핑될 수 있다. 제2 도전형 반도체층(160)은 p-GaN 단일층으로 형성될 수 있으나, 이에 한정되는 것은 아니며, 내부에 AlGaN층을 포함할 수도 있다. 제2 도전형 반도체층(160) 내의 Mg 도핑 농도는 제2 도전형 반도체층(160)의 표면에서 가장 높고 전자 차단층(150) 측에서 상대적으로 높으며, 내부 층에서 상대적으로 낮은 프로파일을 가질 수 있다. 나아가, 상기 Mg 도핑 농도는 내부 층에서 상대적으로 낮은 프로파일을 가지는 영역과 전자 차단층(150) 사이에 도핑 농도가 상대적으로 높아졌다가 감소하는 프로파일을 가지는 영역을 포함할 수 있다. 제2 도전형 반도체층(160) 내부에 배치되는 AlGaN층은 Mg 도핑 농도가 상대적으로 낮은 프로파일을 가지는 영역과 전자 차단층(150) 사이에서 도핑 농도가 감소하는 영역 내에 배치될 수 있다. The second conductivity
도 3의 구조는 다양하게 가공될 수 있고, 이에 따라 다양한 구조의 장파장 발광 소자가 구현될 수 있다. 예컨대, 도 4를 참조하면, 상기 장파장 발광 소자는 제1 전극(171) 및 제2 전극(173)을 더 포함하여 수평형 발광 소자가 제공될 수 있다. 제1 전극(171) 및 제2 전극(173)은 각각 제1 도전형 반도체층(130) 및 제2 도전형 반도체층(160)과 전기적으로 연결된다. 다만, 본 발명이 이에 한정되는 것은 아니며, 도 3의 구조는 플립칩형 발광 소자, 수직형 발광 소자 등 다양한 구조로 변형될 수 있다. 또한, 발광 소자의 형태에 따라, 기판(110)은 생략될 수도 있다.The structure of FIG. 3 may be variously processed, and thus, a long-wavelength light emitting device of various structures may be implemented. For example, referring to FIG. 4 , the long wavelength light emitting device may further include a
이하, 도 5a 내지 도 6b를 참조하여 다양한 실시예들에 따른 장파장 발광 소자의 활성층(140)에 대해 더욱 상세하게 설명한다.Hereinafter, the
먼저, 도 5a 및 도 5b는 일 실시예에 따른 장파장 발광 소자의 활성층(140)을 설명하기 위한 확대 단면도 및 밴드 다이어그램이다.First, FIGS. 5A and 5B are enlarged cross-sectional views and band diagrams for explaining the
도 5a 및 도 5b를 참조하면, 활성층(140)은 적어도 하나의 우물층(143), 적어도 두 개의 장벽층(141) 및 적어도 하나의 상부 캡핑층(145)을 포함할 수 있다. 또한, 활성층(140)은 복수의 우물층(143), 복수의 우물층(143)들 각각의 상부 및 하부에 위치하는 복수의 장벽층(141), 복수의 우물층(143)들 각각의 상부에 위치하는 복수의 상부 캡핑층(145)을 포함할 수 있다. 나아가, 활성층(140)은 활성층(140)의 마지막 장벽층을 형성하는 최상부 장벽층(147)을 포함할 수 있다.5A and 5B , the
우물층(143)은 장벽층(141)들의 사이에 위치하며, 도 5b에 도시된 바와 같이 우물층(143)의 밴드갭 에너지는 장벽층(141)의 밴드갭 에너지보다 작다. 우물층(143)은 InxGa(1-x)N (0<x<1)을 포함하거나 이것으로 형성될 수 있으며, 상기 장파장 발광 소자에서 방출하는 파장에 따라 In의 조성비(x)가 제어될 수 있다. 일 실시예에서, In의 조성비(x)는 0.21 이상일 수 있으며, 나아가, 0.23 이상일 수 있다. 이에 따라, 장파장 발광 소자는 녹색광을 방출할 수 있다. 장벽층(141)은 GaN 및/또는 InGaN을 포함할 수 있다. 장벽층(141)의 밴드갭 에너지는 우물층(143)의 밴드갭 에너지보다 크므로, 장벽층(141)이 InGaN을 포함하는 경우 장벽층(141)의 InGaN의 In 조성비는 우물층(143)의 InxGa(1-x)N의 In 조성비(x)보다 작다.The
상부 캡핑층(145)은 우물층(143)의 상부에 위치하며, 우물층(143)과 장벽층(141)의 사이에 위치한다. 특히, 상부 캡핑층(145)은 그 하부에 위치하는 우물층(143)에 접할 수 있다. 상부 캡핑층(145)의 평균 격자 상수는 우물층(143) 및 장벽층(141)의 평균 격자 상수보다 작을 수 있다. 또한, 상부 캡핑층(145)의 밴드갭 에너지는 장벽층(141)의 밴드갭 에너지보다 클 수 있다. 일 실시예에서, 상부 캡핑층(145)은 AlyGa(1-y)N (0<y<1)을 포함하거나 이것으로 형성될 수 있으며, Al의 조성비(y)는 0.001 내지 0.025일 수 있다. 추가적으로, 상기 Al의 조성비(y)가 0.014 내지 0.017 범위 내일 때, 양호한 광출력 및 낮은 순방향 전압을 달성할 수 있다.The
이하, 활성층(140)의 제조 과정에 대해 설명한다. Hereinafter, a manufacturing process of the
먼저, 제1 도전형 반도체층(130) 상에 장벽층(141)을 형성할 수 있다. 장벽층(141)은 GaN으로 형성될 수 있으며, 약 900℃ 내지 1200℃의 온도에서 약 120Å 내지 220Å의 두께, 나아가, 170Å 내지 200Å의 두께로 성장될 수 있다. 장벽층(141)의 두께가 이 범위에서 높은 광 출력 및 낮은 순방향 전압을 달성할 수 있다. 이어서, 장벽층(141) 상에 우물층(143)을 형성한다. 우물층(143)은 InxGa(1-x)N으로 형성될 수 있으며, 약 20Å 내지 약 30Å의 두께로 형성될 수 있다. 우물층(143)의 성장 온도는 장벽층(141)의 성장 온도보다 약 150℃ 내지 200℃ 더 낮은 온도로 설정될 수 있다. 우물층(143)이 너무 높은 온도에서 성장되는 경우, 우물층(143) 내의 In 함량이 의도한 것보다 낮게 형성될 수 있으므로, 상대적으로 높은 In 조성비가 요구되는 장파장 발광 소자의 우물층(143)은 상술한 바와 같은 온도 범위에서 성장된다. 이어서, 우물층(143) 상에 상부 캡핑층(145)을 형성한다. 상부 캡핑층(145)은 우물층(143)의 성장 온도와 대체로 동일한 온도에서 성장될 수 있다. 예를 들어, 상부 캡핑층(145)은 장벽층(141)의 성장 온도보다 약 150℃ 내지 200℃ 더 낮은 온도에서 성장되는 AlyGa(1-y)N으로 형성될 수 있다. 상부 캡핑층(145)은 약 5Å 내지 20Å의 두께를 가질 수 있다. 이후 다시 성장 온도를 높이고, 상술한 장벽층(141), 우물층(143) 및 상부 캡핑층(145)의 성장 과정을 반복하여 도 5a에 도시된 바와 같은 활성층(140) 구조가 제공될 수 있다.First, the
일반적으로, 우물층(143)의 성장 후에 우물층(143)의 표면이 노출된 상태에서 성장 온도를 상승시키면, 우물층(143) 내의 In 원자들이 반도체층의 사이트(site)로부터 이탈할 확률이 높아진다. 이렇게 되면, 성장 온도 상승에 따라 우물층(143)의 표면에 In이 석출되거나 In 편석이 발생할 수 있다. 이 경우, 우물층(143)의 결정질이 조악해지거나, 표면 모폴로지가 악화된다. 또한, 반도체층의 사이트로부터 In 원자들이 이탈하면, 우물층(143)의 In 조성비가 의도한 것보다 더 작아져, 의도한 파장보다 짧은 파장의 광이 발광 소자로부터 방출되게 된다. 그러나, 상술한 실시예들에 따르면, 우물층(143)의 성장 완료 후 바로 온도를 승온하여 장벽층(141)을 형성하지 않고, 우물층(143)의 성장 온도와 대체로 동일한 온도에서 성장되는 상부 캡핑층(145) 형성 후에 장벽층(141)을 형성한다. 이에 따라, 상부 캡핑층(145)은 우물층(143)의 상부를 덮어 우물층(143)을 열로부터 보호할 수 있다. 따라서 In 원자가 우물층(143)으로부터 이탈하는 것을 방지할 수 있어, 우물층(143)의 표면 모폴로지 악화 및 파장의 단파장으로의 쉬프트 현상을 방지할 수 있다. 또한, 상부 캡핑층(145)의 형성으로 인하여 장벽층(141)의 성장 온도를 장벽층(141)의 결정질이 우수해질 수 있는 온도까지 높일 수 있어, 활성층(140) 전체의 결정질을 향상시켜 발광 소자의 발광 효율을 향상시킬 수 있다. In general, if the growth temperature is increased while the surface of the
한편, 상부 캡핑층(145)은 상대적으로 낮은 온도에서 성장되는 AlyGa(1-y)N으로 형성되므로, 상부 캡핑층(145) 자체의 결정질은 비교적 우수하지 않을 수 있다. 그러나, 상부 캡핑층(145)의 두께는 약 5Å 내지 20Å로 제어되므로, 장벽층(141)에 비해 매우 얇은 두께를 가져 상부 캡핑층(145)으로 인한 활성층(140) 전체의 결정질 저하는 거의 발생하지 않는다. 따라서 상부 캡핑층(145)의 결정질로 인한 발광 효율 저하 역시 거의 발생하지 않는다.Meanwhile, since the
또한, 일반적으로, 녹색광 발광 소자와 같은 장파장 발광 소자는 우물층의 높은 In 함량으로 인하여 우물층과 장벽층 사이의 격자 상수 차이로 인한 스트레스 및 스트레인이 비교적 강하게 작용한다. 이로 인해, 강한 양자가둠스타크효과 (Quantum Confined Stark Effect; QCSE)가 나타나게 되고, 발광 효율 저하 및 발광 파장의 변화가 초래된다. 반면 실시예들에 따르면, 장벽층(141)과 우물층(143)의 차이에 장벽층(141) 및 우물층(143)보다 작은 평균 격자 상수를 갖는 상부 캡핑층(145)을 형성함으로써, 우물층(143)에 작용하는 스트레인을 감소시킨다. 스트레인의 감소로 인하여 우물층(143) 내의 양자가둠스타크효과가 약화됨으로써, 발광 효율이 향상될 수 있고 밴드 벤딩(bending)으로 인한 발광 파장의 변화를 감소시킬 수 있다.Also, in general, a long-wavelength light emitting device such as a green light emitting device is subjected to relatively strong stress and strain due to a difference in lattice constant between the well layer and the barrier layer due to the high In content of the well layer. Due to this, a strong quantum confined stark effect (QCSE) appears, resulting in a decrease in luminous efficiency and a change in luminous wavelength. On the other hand, according to embodiments, by forming the
나아가, 실시예들에 따르면, 상부 캡핑층(145)의 두께를 약 5Å 내지 20Å로 하고, 장벽층(141)의 두께를 약 120Å 내지 220Å, 특히 170Å 내지 200Å으로 형성함으로써, 발광 효율을 최적화할 수 있다. 상술한 범위로 상부 캡핑층(145)을 형성하여, 격자 상수 차이로 인한 스트레인을 최소화함과 아울러, 상부 캡핑층(145)으로 인한 결정질 저하를 최소화할 수 있다. 또한, 장벽층(141)의 두께를 상부 캡핑층(145)의 두께를 고려하여 상술한 범위로 형성함으로써, 활성층(140) 전체의 평균적인 결정성을 향상시켜 발광 효율을 향상시킬 수 있다.Furthermore, according to embodiments, the thickness of the
다시 도 5a 및 도 5b를 참조하면, 장벽층들 중 전자차단층(150)의 바로 아래에 위치하는 최상부 장벽층(147)을 나머지 장벽층(141)들의 평균 두께보다 두꺼운 두께를 가질 수 있다. 또한, 최상부 장벽층(147)은 최상부 장벽층(147)의 평균 밴드갭 에너지보다 작은 밴드갭 에너지를 갖는 서브 장벽층(147a)을 포함할 수 있다.Referring back to FIGS. 5A and 5B , the
한편, 몇몇 실시예들에 있어서, 발광 소자는 복수의 장벽층들(141) 및 복수의 우물층(143)이 교대로 적층된 다중 양자우물 구조를 가질 수 있다. 이 경우, 전자의 이동도가 홀의 이동도보다 크기 때문에, 전자와 홀은 대체로 제2 도전형 반도체층(160)(또는 전자 차단층(150))에 가까운 우물층(143)에서 주로 재결합한다. 따라서, 전자와 홀의 재결합이 잘 발생되지 않는 활성층(140) 부분의 장벽층들(141), 즉, 제1 도전형 반도체층(130)에 가까운 장벽층들(141)에에 Si와 같은 n형 불순물을 도핑함으로써 전자의 주입 효율을 향상시킬 수 있으며, 이에 따라, 발광 소자의 순방향 전압을 낮출 수 있다. 이 경우, 상기 복수의 장벽층들(141)은 n형 불순물이 상대적으로 고농도로 도핑된 장벽층들 및 n형 불순물이 상대적으로 저농도로 도핑되거나 언도프트 장벽층들을 포함하게 된다. 특히, n형 불순물이 상대적으로 고농도로 도핑된 장벽층들(141)은 상기 제2 도전형 반도체층(160)보다 상기 제1 도전형 반도체층(130)에 더 가깝게 배치된다.Meanwhile, in some embodiments, the light emitting device may have a multi-quantum well structure in which a plurality of barrier layers 141 and a plurality of
대체로 제2 도전형 반도체층(160)에 가까운 적어도 2개의 우물층들(143) 주위에는 Si과 같은 n형 불순물이 도핑되지 않는 것이 바람직하다. 예를 들어, 장벽층들(141)이 10개인 경우, 제1 도전형 반도체층(130)에 가까운 5개의 장벽층들(141)에 상대적으로 고농도, 예컨대 약 5×1018/㎤로 Si를 도핑하고, 제2 도전형 반도체층(160)에 가까운 5개의 장벽층들에는 저농도, 예컨대 약 5×1017/㎤로 Si를 도핑할 수 있다. 또한, Si가 도핑된 장벽층들(141)이 모두 동일한 Si 도핑 농도를 가질 필요는 없으며, 제1 도전형 반도체층(130)으로부터 멀어질수록 도핑 농도가 점차적으로 감소할 수도 있다.In general, it is preferable that an n-type impurity such as Si is not doped around at least two
한편, 상기 n형 불순물이 상대적으로 고농도로 도핑된 장벽층들(141)의 n형 불순물 도핑 농도는 제1 도전형 반도체층(130)의 변조 도핑층(도 7의 133)에 도핑된 n형 불순물의 도핑 농도보다 낮지만, V-피트 생성층(도 7의 137) 내의 n형 불순물의 도핑 농도보다는 높다. 이에 대해서는 뒤에서 다시 설명된다.Meanwhile, the n-type impurity doping concentration of the barrier layers 141 doped with the n-type impurity at a relatively high concentration is the n-type doped n-type doped layer (133 in FIG. 7 ) of the first conductivity-
한편, 장벽층들(141)에 Mg과 같은 p형 불순물이 도핑될 수 있다. p형 불순물은 홀의 주입 효율을 개선하기 위해 도핑될 수 있으며, 따라서, 제2 도전형 반도체층(160)에 가까운 장벽층들에 주로 도핑된다. 나아가, 제2 도전형 반도체층(160)에 가까울수록 더 많은 Mg이 도핑되도록 할 수 있다. 다만, 장벽층들에 도핑되는 Mg 도핑 농도는 전자 차단층(150)이나 제2 도전형 반도체층(160)에 도핑되는 Mg 도핑 농도보다는 상대적으로 낮다. Meanwhile, the barrier layers 141 may be doped with a p-type impurity such as Mg. The p-type impurity may be doped to improve hole injection efficiency, and thus, barrier layers close to the second conductivity-
또한, 다양한 실시예들에서, 도 6a 및 도 6b에 도시된 바와 같이, 활성층(140)은 상부 캡핑층(145a)을 포함함과 아울러, 하부 캡핑층(145b)을 더 포함할 수 있다.Further, in various embodiments, as shown in FIGS. 6A and 6B , the
도 6a 및 도 6b를 참조하면, 하부 캡핑층(145b)은 우물층(143)의 하부에 위치하며, 우물층(143)과 장벽층(141)의 사이에 위치한다. 특히, 하부 캡핑층(145b)은 그 상부에 위치하는 우물층(143)에 접할 수 있다. 하부 캡핑층(145b)의 평균 격자 상수는 우물층(143) 및 장벽층(141)의 평균 격자 상수보다 작을 수 있다. 또한, 하부 캡핑층(145b)의 밴드갭 에너지는 장벽층(141)의 밴드갭 에너지보다 클 수 있다. 일 실시예에서, 하부 캡핑층(145b)은 AlzGa(1-z)N (0<z<1)을 포함하거나 이것으로 형성될 수 있으며, Al의 조성비(z)는 0.001 내지 0.025일 수 있다. 상부 캡핑층(145a)과 하부 캡핑층(145b)은 대체로 동일한 Al 조성비를 갖는 AlGaN을 포함하거나, 그것으로 형성될 수 있다. 다만, 본 발명이 이에 한정되는 것은 아니며, 상부 캡핑층(145a)의 Al 조성비는 하부 캡핑층(145b)의 Al 조성비와 다를 수 있다. 하부 캡핑층(145b)을 더 포함함으로써, 우물층(143)의 스트레인이 더욱 감소될 수 있다.6A and 6B , the
도 7은 본 발명의 일 실시예에 따른 장파장 발광 소자의 제1 도전형 반도체층(130)을 설명하기 위한 확대 단면도이다.7 is an enlarged cross-sectional view illustrating the first conductivity
도 7을 참조하면, 제1 도전형 반도체층(130)은 기판(110) 상에 배치된다. 기판(110)이 사파이어 기판(패터닝된 사파이어 기판 포함)과 같은 이종 기판인 경우, 버퍼층(120)이 기판(110) 상에 먼저 형성될 수 있다.Referring to FIG. 7 , the first conductivity
제1 도전형 반도체층(130)은 예를 들어 언도프트 반도체층(131), 변조 도핑층(133), 스트레인 완화층(135) 및 V-피트 생성층(137)을 포함할 수 있다. V-피트 생성층(137)은 단일 조성의 제1층(137a) 및 초격자 구조의 제2층(137b)을 포함할 수 있다.The first conductivity
언도프트 반도체층(131)은 GaN으로 형성될 수 있으며, 결정 품질을 향상시키기 위해 Si이 도핑되지 않는 것이 바람직하다. 그러나 다른 실시예에서 Si이 저농도로 도핑된 반도체층이 사용될 수도 있다.The
변조 도핑층(133)은 GaN으로 형성될 수 있으며, Si와 같은 n형 불순물이 변조 도핑된다. 따라서, n형 불순물이 도핑된 영역과 언도프트 영역, 또는 n형 불순물이 상대적으로 고농도로 도핑된 영역과 상대적으로 저농도로 도핑된 영역이 교대로 반복된다. 상기 n형 불순물이 도핑된 영역 또는 n형 불순물이 상대적으로 고농도로 도핑된 영역의 불순물, 예를 들어 Si 도핑 농도는 n형 불순물이 고농도로 도핑된 장벽층들(141) 내의 n형 불순물 도핑 농도보다 높다. 변조 도핑층(133)은 n전극(171)이 콘택되는 층으로 콘택 저항을 낮추고 전류를 분산시키기 위해 상기 n형 불순물이 도핑된 영역 또는 n형 불순물이 상대적으로 고농도로 도핑된 영역은 상대적으로 높은 농도, 예컨대 5×1018/㎤ 이상, 나아가, 1×1019/㎤ 이상의 농도로 Si가 도핑될 수 있다. 또한, 안정한 오믹 콘택을 위해, 상기 n형 불순물이 도핑된 영역 또는 n형 불순물이 상대적으로 고농도로 도핑된 영역이 상기 언도프트 영역 또는 n형 불순물이 상대적으로 저농도로 도핑된 영역의 두께보다 더 두껍다. The modulation doped
스트레인 완화층(135)은 활성층(140)에 인가되는 스트레인을 완화하고 전류 분산을 돕기 위해 형성될 수 있다. 스트레인 완화층(135)은 예를 들어, n형 불순물이 도핑된 AlGaN층과 언도프트 GaN층을 교대로 적층한 예컨대 5쌍의 n-AlGaU/u-GaN 초격자층으로 형성될 수 있다. n-AlGaN에 도핑되는 n형 불순물, 예컨대 Si의 도핑농도는 변조 도핑층(133)에 도핑되는 Si의 도핑농도와 대체로 유사하며, 예컨대 5×1018/㎤ 이상, 나아가, 1×1019/㎤ 이상의 농도일 수 있다. 다만, 스트레인 완화층(135)은 생략될 수도 있다.The strain
V-피트 생성층(137)은 실 전위(threading dislocation)들이 형성된 부분에 V-피트를 생성한다. V-피트 생성층(137)은 750℃ 내지 950℃, 구체적으로는 800℃ 내지 900℃, 더 구체적으로는 800℃ 내지 850℃의 온도범위에서 Ga 소스로 TEGa(Triethylgallium)을 사용하고 N2 캐리어 가스를 사용하여 형성될 수 있다. 이 조건에서 크기가 대체로 균일한 V-피트들이 생성된다.The V-
V-피트들은 활성층(140)을 관통하여 형성된다. V-피트 내의 브레이크 다운 전압은 V-피트 주위 활성 영역의 브레이크 다운 전압과 차이를 나타내며, 이에 따라, 정전 방전시 V-피트들을 통해 전류를 분산시킬 수 있어 활성 영역의 파괴를 방지할 수 있다.V-pits are formed through the
본 실시예에 있어서, V-피트 생성층(137)은 단일 조성의 제1층(137a)과 초격자 구조의 제2층(137b)을 포함한다. 제1층(137)은 n형 불순물, 예컨대 Si이 도핑된 GaN층으로 형성될 수 있다. 제1층(137) 내 n형 불순물의 도핑 농도는 변조 도핑층(133)의 Si 도핑 농도보다 낮고 나아가 n형 불순물이 고농도로 도핑된 장벽층들(141) 내의 n형 불순물의 도핑 농도보다 낮을 수 있다.In the present embodiment, the V-
한편, 제2층은 예컨대 InGaN/GaN 초격자 구조로 형성될 수 있다. 제2층에는 n형 불순물이 도핑되지 않을 수도 있으며, 도핑될 수도 있다. 다만, 제2층 내의 n형 불순물의 도핑 농도는 변조 도핑층(133)의 Si 도핑 농도보다 낮고 나아가 n형 불순물이 고농도로 도핑된 장벽층들(141) 내의 n형 불순물의 도핑 농도보다 낮다. 활성층(140)은 상기 제2층 상에 직접 형성될 수 있으며, 따라서, 제2층(137b)을 InGaN을 포함하는 초격자 구조로 형성함으로써 활성층(140)의 결정 품질을 개선할 수 있다. 제2층 내 InGaN층의 In의 조성비는 1% 내지 5%일 수 있다.Meanwhile, the second layer may be formed of, for example, an InGaN/GaN superlattice structure. The second layer may be undoped or doped with an n-type impurity. However, the doping concentration of the n-type impurity in the second layer is lower than the Si doping concentration of the modulation doped
한편, 상기 V-피트 생성층(137)의 두께는 발광 다이오드의 광 출력 및 순방향 전압에 영향을 미친다. V-피트 생성층(137)의 두께는 예를 들어 1500Å 내지 3000Å 범위 내일 수 있다. 이 범위에서 최대 광 출력의 90% 이상의 광 출력을 달성할 수 있다. 더 구체적으로, V-피트 생성층(137)의 두께는 예를 들어 2000Å 내지 3000Å 범위 내일 수 있으며, 이 범위에서 최대 광 출력의 95% 이상의 광 출력 및 상대적으로 낮은 순방향 전압을 달성할 수 있다.Meanwhile, the thickness of the V-
이 경우, 제2층(137b)은 제1층(137a)과 동일하거나 그보다 큰 두께를 가진다. 제2층(137b)을 적어도 제1층(137a) 두께만큼 확보함으로써 제한된 두께 범위에서 V-피트를 생성하면서도 활성층(140)의 결정 품질을 개선할 수 있다. 특히, 제2층(137b)은 1000Å 이상의 두께를 가질 수 있다. In this case, the
도 8은 본 발명의 일 실시예에 따른 장파장 발광 소자의 전자 차단층(150)을 설명하기 위한 확대 단면도이다.8 is an enlarged cross-sectional view for explaining the
도 8을 참조하면, 상기 전자 차단층(150)은 Al 조성비가 상기 제2 도전형 반도체층(160)을 향해 감소하는 그레이딩 층(153)을 포함할 수 있다. 나아가, 상기 전자 차단층(150)은 그레이딩 층(153)과 활성층(140) 사이에 일정 조성의 계면층(151)을 더 포함할 수 있다.Referring to FIG. 8 , the
전자 차단층(150)은 AlGaN 또는 AlInGaN으로 형성될 수 있으며, 상대적으로 높은 밴드갭을 가지어 활성층(140)으로부터 전자가 제2 도전형 반도체층(160)으로 이동하는 것을 차단하여 발광 효율을 개선한다. 전자 차단층(150)은 전자의 흐름을 차단하면서 홀이 활성층(140) 영역 내로 주입되는 것을 허용해야 한다. 서브 장벽층(147a) 내의 In 조성비는 우물층(143) 내의 In 조성비보다 작고, 전자 차단층(150) 내의 In 조성비는 서브 장벽층(147a) 내의 In 조성비보다 작다. 이에 따라, 우물층(143), 서브 장벽층(147a) 및 전자 차단층(150) 순서로 In 함량을 감소시킴으로써 우물층(143)과 전자 차단층(150) 사이의 격자 불일치를 감소시킬 수 있으며, 양호한 전자 차단층(150) 및 제2 도전형 반도체층(160)을 성장시킬 수 있다.The
그레이딩 층(153)의 Al 조성비는 계면층(151)의 Al 조성비로부터 점차 감소할 수 있으며, 최종적으로 Al 조성비가 0이 될 수 있다. 그레이딩 층(153)은 제2 도전형 반도체층(160)을 향해 Al 조성이 감소하기 때문에, 에너지 장벽이 제2 도전형 반도체층(160)을 향해 감소한다. 이에 따라, 홀이 그레이딩 층(153)을 넘어 활성층(140) 내로 더 잘 주입될 수 있다.The Al composition ratio of the
또한, Mg과 같은 p형 불순물이 전자 차단층(150)에 도핑될 수 있으며, 전자 차단층(150) 내에서 활성층(140)을 향해 도핑 농도가 낮아지는 도핑 농도 그레이딩 특성을 보일 수 있다. 도핑 농도 그레이딩은 그레이딩 층(153) 내에서 또는 계면층(151) 내에서 형성될 수 있다.In addition, a p-type impurity such as Mg may be doped into the
본 실시예에서, 일정 두께의 계면층(151)이 그레이딩 층(153)을 형성하기 전에 먼저 형성된 것에 대해 설명하나, 계면층(151)은 생략될 수도 있다.In the present embodiment, the description will be given that the
도 9는 본 발명의 또 다른 실시예에 따른 장파장 발광 소자의 전자 차단층(150)을 설명하기 위한 확대 단면도이다.9 is an enlarged cross-sectional view for explaining the
도 9를 참조하면, 상기 전자 차단층(150)은 제1 전자 차단층(151), 제2 전자 차단층(155) 및 제3 전자 차단층(157)을 포함할 수 있다.Referring to FIG. 9 , the
제1 전자 차단층(151)은 앞서 도 8을 참조하여 설명한 바와 같은 계면층(151)과 동일하게 단일 조성으로 형성될 수 있으며, 활성층(140)에 접한다. 제1 전자 차단층(151)은 AlGaN 또는 AlInGaN으로 형성될 수 있다. 제1 전자 차단층(151)에 Mg과 같은 p형 불순물이 도핑될 수 있다. 제1 전자 차단층(151) 내의 p형 불순물의 도핑 농도는 제2 도전형 반도체층(160) 내의 p형 불순물의 도핑 농도보다 낮을 수 있다. 덧붙여, 제1 전자 차단층(151) 내의 p형 불순물의 도핑 농도는 활성층(140)을 향해 감소하는 그레이딩 특성을 가질 수 있다. The first
제2 전자 차단층(155)은 제1 전자 차단층(151)에 비해 Al 조성비가 낮은 AlGaN 또는 AlInGaN으로 형성될 수 있다. 더욱이, 제2 전자 차단층(155)은 단일 조성일 수도 있으나, 초격자 구조일 수도 있다. 제2 전자 차단층(155)에는 상기 제1 및 제3 전자 차단층(151, 157)에 비해 p형 불순물이 고농도로 도핑된다. 제2 전자 차단층(155)에 도핑되는 p형 불순물, 예컨대 Mg의 도핑 농도는 제2 도전형 반도체층(160) 내의 p형 불순물 농도와 대체로 유사할 수 있다.The second
제3 전자 차단층(157)은 제2 도전형 반도체층(160)에 접한다. 제3 전자 차단층(157)은 제2 도전형 반도체층(160)의 결정 품질을 개선하기 위해 초격자 구조를 가질 수 있다. 예를 들어, 상기 제3 전자 차단층(157)은 AlInGaN/GaN의 초격자 구조를 가질 수 있다. 제3 전자 차단층(157)에도 p형 불순물, 예컨대 Mg이 도핑될 수 있으며, 도핑 농도는 제2 도전형 반도체층(160) 내의 p형 불순물의 도핑 농도보다 낮으며, 나아가, 제1 전자 차단층(151)의 도핑 농도보다 낮을 수 있다.The third
본 실시예에서, 제2 전자 차단층(155)은 제1 전자 차단층(151) 및 제3 전자 차단층(157) 사이에 배치되며, 제1 및 제3 전자 차단층(151, 157)에 비해 상대적으로 낮은 밴드갭을 가진다. 또한, 상기 제2 전자 차단층(155)은 p형 불순물이 고농도로 도핑된다. 이에 따라, 제2 도전형 반도체층(160)에서 홀이 전자 차단층(150)을 통해 활성층(140)으로 쉽게 주입될 수 있다.In the present embodiment, the second
도 10은 본 발명의 일 실시예에 따른 장파장 발광 소자의 제2 도전형 반도체층을 설명하기 위한 확대 단면도이다.10 is an enlarged cross-sectional view illustrating a second conductivity type semiconductor layer of a long wavelength light emitting device according to an embodiment of the present invention.
도 10을 참조하면, 제2 도전형 반도체층(160)은 제1층(161), 제2층(163) 및 제3층(165)을 포함할 수 있다. 제2 도전형 반도체층(160)은 단일 조성의 p-GaN 단일층으로 형성될 수 있으나, 본 실시예에 있어서는 복수층으로 형성된 것에 대해 설명한다.Referring to FIG. 10 , the second conductivity
제1층(161)은 전자 차단층(150)에 접한다. 제1층(161)은 N2 분위기에서 성장되며, V-피트를 따라 형성된다. 제1층(161)은 p-GaN으로 형성된다. 제1층(161)의 Mg 도핑 농도는 전자 차단층(160)의 도핑 농도보다 낮지만 제2층(163)의 도핑 농도보다 상대적으로 높다.The first layer 161 is in contact with the
제2층(163)은 제1층(161) 상에 위치하며, p-AlGaN으로 형성된다. 제2층(163)의 Mg 도핑 농도는 제1층(161)의 그것보다 상대적으로 낮다. AlGaN층은 일반적으로 GaN층에 비해 상대적으로 매우 높은 온도에서 성장되지만, 제2 도전형 반도체층(160)은 활성층(140) 상부에 성장되기 때문에 성장 온도를 높이는데 한계가 있다. 따라서, 제2층(163)은 제1층보다 Mg 도핑 농도를 낮춰 결정 품질이 악화되는 것을 방지한다.The
제2층(163)은 제2 도전형 반도체층(160) 내에 p-AlGaN 단일층으로 배치될 수 있으나, 이에 한정되는 것은 아니며, 복수의 p-AlGaN층들이 GaN층을 개재하여 배치될 수도 있다. 여기서, AlGaN의 Al 조성비는 10% 이하일 수 있으며, 더 구체적으로는 5% 이하일 수 있다. Al 함령이 5%까지 증가하여도 구동 전압 증가는 거의 나타나지 않으나, 5%를 초과할 경우, 구동전압이 증가한다. 특히, Al 함량이 10%를 초과하면, 정공의 주입을 과도하게 방해하여 발광 소자의 구동 전압을 크게 증가시킨다.The
제2층(163)은 H2 분위기에서 성장되어, V-피트를 메운다. V-피트는 V-피트 생성층(137)에서 시작하여 In을 과량으로 포함하는 활성층(140)을 성장하는 동안 그 크기가 상당히 커진다. 아울러, 전자 차단층(150) 및 제1층(161)은 N2 분위기에서 성장되기 때문에 V-피트를 메우지 못한다. 제2층(163)을 성장하기 전 V-피트는 대략 200nm 이상의 깊이로 형성될 수도 있다. H2 분위기에서 성장되는 AlGaN층(163)은 성장 속도가 상대적으로 느리기 때문에, 상대적으로 큰 V-피트를 잘 메울 수 있다.The
제3층(165)은 제2 도전형 반도체층(160)의 상면 측에 위치하는 층이다. 제3층(165)은 p-GaN으로 형성될 수 있다. 제3층(163)은 표면측에 전자 차단층(150)보다 더 높은 Mg 도핑 농도 영역을 가지며, 제2층(163) 측에 제2층(163)의 도핑 농도보다 상대적으로 높지만 제1층(161)의 도핑 농도보다 낮은 Mg 도핑 농도 영역을 가지고, 또한, 내부에 제2층(163)의 도핑 농도보다 더 낮은 Mg 도핑 농도 영역을 가질 수 있다. 제3층(165) 표면의 고농도 도핑 영역은 오믹 콘택을 위한 것이다. 제2층(163)의 도핑 농도보다 더 낮은 농도 영역은 제2 도전형 반도체층(160)의 면 내에 정공을 고르게 분산시키기 위한 것으로, 생략될 수도 있다.The
본 실시예에 있어서, 제2층(163)은 제2 도전형 반도체층(160)의 상면보다 전자 차단층(150)에 더 가깝게 배치된다. 이에 따라, 제2 도전형 반도체층(160)의 성장 동안 V-피트를 빨리 메울 수 있으며, 평평한 영역의 제3층(165)을 상대적으로 두껍게 형성할 수 있다.In this embodiment, the
본 실시예에 있어서, AlGaN층(163)을 이용하여 V-피트를 메우는 것에 대해 설명하였으나, AlGaN층(163)을 N2 분위기에서 성장하거나 생략함으로써 발광소자의 표면에 V-피트들을 남겨 놓을 수도 있다.In the present embodiment, it has been described that the V-pits are filled by using the
도 11(a)는 도 10의 실시예에 따라 V-피트를 메워 표면을 평탄화한 발광 소자의 표면을 보여주는 광학 사진이고, 도 11(b)는 V-피트를 남겨 놓은 발광 소자의 표면을 보여주는 광학 사진이다. 도 12는 도 11(b)의 V-피트의 단면을 보여주는 전자 현미경 사진이다.11 (a) is an optical photograph showing the surface of the light emitting device having the surface planarized by filling in the V-pits according to the embodiment of FIG. 10 , and FIG. It's an optical picture. FIG. 12 is an electron micrograph showing a cross-section of the V-pit of FIG. 11( b ).
도 11(a)와 같이, 앞서 설명한 AlGaN층(163)을 사용하여 V-피트를 채워 표면을 평탄하게 할 수도 있으며, 도 11(b)와 같이, V-피트를 유지할 수도 있다.As shown in FIG. 11( a ), the V-pits may be filled using the
V-피트를 메우는 층을 사용하지 않음으로써, 장파장 발광 소자에서 입구의 폭이 대략 250nm를 넘는 V-피트들을 다량으로 형성할 수 있다. 더욱이, V-피트들의 깊이는 제2 도전형 반도체층(160) 및 전자 차단층(150)의 전체 두께보다 클 수 있다. V-피트의 밀도는 예를 들어, 1×104~1×107/㎠ 범위 내일 수 있다. 발광 소자의 표면에 남아 있는 V-피트는 내부 전반사를 감소시켜 광 추출 효율을 증가시킨다. 나아가, 제2 도전형 반도체층(160)의 표면적을 증가시킴으로써 전극 형성 면적이 증가되며, 이에 따라, 구동 전압을 낮출 수 있다.By not using a layer filling the V-pits, it is possible to form a large amount of V-pits having an entrance width exceeding about 250 nm in the long-wavelength light emitting device. Moreover, the depth of the V-pits may be greater than the total thickness of the second conductivity
종래에는 의도적인 식각을 통해 표면에 거칠어진 면(roughened surface)을 형성하나, 상대적으로 얇은 두께의 p-GaN 층에 거칠어진 면을 형성하는 것이 곤란하며, 그 크기를 제어하는 것 또한 어렵다. 더욱이, p-GaN층에 형성된 거칠어진 면은 활성층 위에 한정되어야 하므로, 그 깊이가 제2 도전형 반도체층(160)과 전자차단층(150)의 전체 두께보다 클 수 없다. 또한, 제2 도전형 반도체층(160) 표면을 식각하여 거칠어진 면을 형성할 경우, 그 위에 형성되는 전극과 활성층 사이의 거리가 짧아져 전류 분산이 어려우며, 이에 따라 정전 방전 등에 특히 취약해진다. 이에 반해, V-피트를 이용할 경우, V-피트 내의 상대적으로 높은 저항 특성을 이용하여 전류 분산에 유리하며 정전 방전에도 내성이 강한 제2 도전형 반도체층(160)을 제공할 수 있다. 더욱이, 거칠어진 면을 형성하는 공정을 별도로 수행할 필요가 없으므로, 광 추출 효율을 높이기 위한 공정이 더욱 단순화된다.Conventionally, a roughened surface is formed on a surface through intentional etching, but it is difficult to form a roughened surface on a relatively thin p-GaN layer, and it is also difficult to control the size. Furthermore, since the roughened surface formed on the p-GaN layer must be limited on the active layer, the depth cannot be greater than the total thickness of the second conductivity
이상, 상기 실시예들은 본 발명의 특허청구범위에 의한 기술적 사상을 벗어나지 않는 범위 내에서 다양한 변형과 변경이 가능하고, 본 발명은 특허청구범위에 의한 기술적 사상을 모두 포함한다.As mentioned above, various modifications and changes are possible in the above embodiments without departing from the technical spirit of the present invention, and the present invention includes all of the technical spirit of the present invention.
Claims (10)
상기 제1 도전형 반도체층 상에 위치하며, 양자우물구조를 갖는 활성층;
상기 활성층 상에 위치하는 제2 도전형 반도체층;
상기 활성층과 상기 제2 도전형 반도체층 사이에 위치하는 전자차단층; 및
상기 전자차단층을 관통하는 관통영역을 포함하며,
상기 활성층은 복수의 우물층 및 복수의 장벽층을 포함하고,
상기 우물층은 In을 포함하는 질화물계 반도체를 포함하며, 상기 장벽층은 상기 우물층의 상부 및 하부에 배치되고,
상기 관통영역은 제2 도전형 반도체층의 상면에 입구를 형성하여, 상기 입구로부터 200nm 이상의 깊이를 가지는 발광 소자.a first conductivity type semiconductor layer;
an active layer disposed on the first conductivity-type semiconductor layer and having a quantum well structure;
a second conductivity-type semiconductor layer positioned on the active layer;
an electron blocking layer positioned between the active layer and the second conductivity-type semiconductor layer; and
a penetrating region penetrating the electron blocking layer;
the active layer comprises a plurality of well layers and a plurality of barrier layers;
the well layer includes a nitride-based semiconductor including In, and the barrier layer is disposed above and below the well layer;
The through region forms an entrance on the upper surface of the second conductivity type semiconductor layer, and the light emitting device has a depth of 200 nm or more from the entrance.
상기 제2 도전형 반도체층에 형성된 상기 입구의 폭은 250nm 이상인 발광소자.The method according to claim 1,
The width of the entrance formed in the second conductivity-type semiconductor layer is 250nm or more light emitting device.
상기 발광소자는 상기 제2 도전형 반도체층과 전기적으로 연결되는 전극을 포함하며,
상기 전극은 관통영역의 표면을 따라 형성되는 발광소자.The method according to claim 1,
The light emitting device includes an electrode electrically connected to the second conductivity type semiconductor layer,
The electrode is a light emitting device formed along the surface of the through region.
상기 입구는 복수 개 형성되어 상기 제2 도전형 반도체층의 표면에 거칠어진 면을 형성하는 발광소자.The method according to claim 1,
The plurality of inlets are formed in the light emitting device to form a roughened surface on the surface of the second conductivity type semiconductor layer.
상기 관통영역은 상기 전자차단층에서 상기 활성층까지 연장하여 형성되는 발광소자.The method according to claim 1,
The through region is a light emitting device formed to extend from the electron blocking layer to the active layer.
상기 전자차단층은 Al조성이 감소하는 그레이딩층을 포함하며, 상기 제2 도전형 반도체층과 접하는 영역에서 Al조성비가 0인 발광소자.6. The method of claim 5,
The electron blocking layer includes a grading layer having a reduced Al composition, and an Al composition ratio of 0 in a region in contact with the second conductivity-type semiconductor layer.
상기 복수의 장벽층은 n형 불순물을 포함하며, 상기 n형 불순물이 상대적으로 고농도로 도핑된 영역 및 저농도로 도핑된 영역을 포함하는 발광소자.The method according to claim 1,
The plurality of barrier layers includes an n-type impurity, and the light emitting device includes a region doped with a relatively high concentration of the n-type impurity and a region doped with a low concentration.
상기 복수의 장벽층의 고농도로 도핑된 영역은 상기 제2 도전형 반도체층보다 상기 제1 도전형 반도체층에 더 가깝게 배치되는 발광소자.8. The method of claim 7,
The heavily doped region of the plurality of barrier layers is disposed closer to the first conductivity type semiconductor layer than the second conductivity type semiconductor layer.
상기 우물층의 In함량은 21% 이상이며, 상기 우물층은 녹색 파장의 광을 방출하는 발광소자.The method according to claim 1,
An In content of the well layer is 21% or more, and the well layer emits light of a green wavelength.
상기 입구의 밀도는 1×104~1×107/㎠ 범위를 가지는 발광소자.3. The method according to claim 2,
The density of the inlet is a light emitting device having a range of 1×10 4 to 1×10 7 /cm 2 .
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