KR102353801B1 - 표시 패널 어셈블리 - Google Patents

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Abstract

표시 패널 어셈블리는 평판 형상을 갖는 표시 패널, 상기 표시 패널의 일 변과 연결되는 제1 및 제2 회로 기판들 및 상기 제1 및 제2 회로 기판들 사이에 배치되고, 상기 제1 및 제2 회로 기판들을 전기적으로 연결하는 연결 부재를 포함하고, 외력에 의하여 상기 표시 패널의 형상이 곡면으로 변경될 시, 상기 연결 부재는 끊어지거나 상기 제1 및 제2 회로 기판들로부터 분리된다.

Description

표시 패널 어셈블리 {DISPLAY PANEL ASSEMBLY}
본 발명은 표시 패널 어셈블리에 관한 것으로, 보다 표시 패널의 오용을 방지 하기 위한 표시 패널 어셈블리에 관한 것이다.
최근 기존의 평판 표시 장치와 다르게 곡면을 갖는 곡면 표시 장치가 개발되고 있다. 곡면 표시 장치는 사용자에게 좀 더 높은 몰입도와 사용의 편의성을 제공한다.
곡면을 갖는 표시 장치에 적용되는 곡면형 표시 패널은 평판을 갖는 표시 장치에 적용되는 평판형 표시 패널과 상이한 특징을 갖는다. 곡면형 표시 패널의 제조 비용이 평판형 표시 패널의 제조 비용보다 높을 수 있다.
낮은 제조 비용으로 곡면형 표시 패널을 제조하기 위하여, 일부 제조사들은 낮은 값으로 구입한 평판형 표시 패널을 곡면 표시 장치에 적용하여 재 판매할 수 있다. 이 경우, 곡면 표시 장치의 표시 품질이 저하될 수 있다.
또한, 일부 제조사들이 평판형 표시 패널을 오용함으로써, 평판형 표시 패널 및 곡면형 표시 패널을 각각 독립적으로 제조하는 다른 제조사들에게 비용적 손실을 발생시킬 수 있다.
본 발명의 목적은 평판형 표시 패널의 오용을 방지하는 표시 패널 어셈블리를 제공하는 데 있다.
본 발명의 실시 예에 따른 표시 패널 어셈블리는 평판 형상을 갖는 표시 패널, 상기 표시 패널의 일 변과 연결되는 제1 및 제2 회로 기판들 및 상기 제1 및 제2 회로 기판들 사이에 배치되고, 상기 제1 및 제2 회로 기판들을 전기적으로 연결하는 연결 부재를 포함하고, 상기 연결 부재는 상기 표시패널보다 약한 탄성력 및 약한 강성을 갖고, 외력에 의하여 상기 표시 패널의 형상이 곡면으로 변경될 시, 상기 연결 부재는 끊어지거나 상기 제1 및 제2 회로 기판들로부터 분리된다.
상기 표시 패널은 제1 방향으로 장변을 갖고, 상기 제1 방향과 교차되는 제2 방향으로 단변을 갖는다.
상기 표시 패널의 평면상의 영역은 영상을 표시하는 표시 영역 및 상기 표시 영역을 둘러싸도록 배치되어 영상을 표시하지 않는 비표시 영역을 포함하고, 상기 제1 및 제2 회로 기판들은 상기 제2 방향에서 상기 표시 패널의 일측에 배치된 상기 비표시 영역에 연결된다.
상기 표시 영역은 상기 제1 방향으로 배열된 제1 표시 영역 및 제2 표시 영역을 포함한다.
상기 제1 회로 기판과 상기 제2 방향에서 상기 제1 표시 영역의 일측에 인접한 상기 비표시 영역에 연결되는 제1 데이터 구동부 및 상기 제2 회로 기판과 상기 제2 방향에서 상기 제2 표시 영역의 일측에 인접한 상기 비표시 영역에 연결되는 제2 데이터 구동부를 더 포함한다.
상기 표시 패널은 게이트 라인들 및 제1 및 제2 데이터 라인들에 연결된 복수의 화소들을 포함하고, 상기 화소들 중 상기 제1 표시 영역에 배치된 상기 화소들은 상기 제1 데이터 라인들을 통해 상기 제1 데이터 구동부에 연결되고, 상기 화소들 중 상기 제2 표시 영역에 배치된 상기 화소들은 상기 제2 데이터 라인들을 통해 상기 제2 데이터 구동부에 연결된다.
상기 제1 및 제2 데이터 구동부들은 각각 복수의 연성 회로 기판들에 실장된 복수의 데이터 구동칩들을 포함하고, 상기 데이터 구동칩들은 상기 연성 회로 기판들에 의해 상기 제1 및 제2 회로 기판들과 상기 제2 방향에서 상기 표시 영역의 일측에 인접한 상기 비표시 영역에 연결된다.
상기 제1 회로 기판은 상기 표시 패널을 구동하기 위한 영상 신호들 및 제어 신호들을 출력하는 타이밍 컨트롤러를 포함한다.
상기 영상 신호들 및 제어 신호는 상기 제1 회로 기판을 통해 상기 표시 패널에 제공되고, 상기 연결 부재와 상기 제2 회로 기판을 경유하여 상기 표시 패널에 제공된다.
상기 제1 회로 기판에 실장되는 전압 생성부를 더 포함한다.
삭제
본 발명의 다른 실시 예에 따른 표시 패널 어셈블리는 상기 제1 회로 기판 상에 실장되고, 상기 제1 데이터 구동부들에 영상 신호들 및 데이터 제어 신호를 출력하는 제1 타이밍 컨트롤러, 상기 제2 회로 기판 상에 실장되고, 상기 제2 데이터 구동부들에 영상 신호들 및 데이터 제어 신호를 출력하는 제2 타이밍 컨트롤러 및 상기 제1 및 제2 회로 기판들 중 어느 하나에 실장되는 전압 생성부를 포함한다.
본 발명의 실시 예에 따른 표시 패널 어셈블리는 평판형 표시 패널의 오용을 방지할 수 있다.
도 1은 본 발명의 실시 예에 따른 표시 패널 어셈블리의 평면도이다.
도 2a 내지 도 2c는 도 1에 도시된 I-I'선의 단면도이다.
도 3a 내지 도 3c는 도 2a 내지 도 2c에 도시된 제1 및 제2 회로 기판에 외력이 작용하는 경우, I-I'선의 단면도이다.
본 발명의 이점 및 특징, 그리고 그것들을 달성하는 방법은 첨부되는 도면과 함께 상세하게 후술되어 있는 실시 예들을 참조하면 명확해질 것이다. 그러나 본 발명은 이하에서 개시되는 실시 예들에 한정되는 것이 아니라 서로 다른 다양한 형태로 구현될 것이며, 단지 본 실시 예들은 본 발명의 개시가 완전하도록 하며, 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자에게 발명의 범주를 완전하게 알려주기 위해 제공되는 것이며, 본 발명은 청구항의 범주에 의해 정의될 뿐이다. 명세서 전체에 걸쳐 동일 참조 부호는 동일 구성 요소를 지칭한다.
소자(elements) 또는 층이 다른 소자 또는 층의 "위(on)" 또는 "상(on)"으로 지칭되는 것은 다른 소자 또는 층의 바로 위뿐만 아니라 중간에 다른 층 또는 다른 소자를 개재한 경우를 모두 포함한다. 반면, 소자가 "직접 위(directly on)" 또는 "바로 위"로 지칭되는 것은 중간에 다른 소자 또는 층을 개재하지 않은 것을 나타낸다. "및/또는"은 언급된 아이템들의 각각 및 하나 이상의 모든 조합을 포함한다.
공간적으로 상대적인 용어인 "아래(below)", "아래(beneath)", "하부(lower)", "위(above)", "상부(upper)" 등은 도면에 도시되어 있는 바와 같이 하나의 소자 또는 구성 요소들과 다른 소자 또는 구성 요소들과의 상관관계를 용이하게 기술하기 위해 사용될 수 있다. 공간적으로 상대적인 용어는 도면에 도시되어 있는 방향에 더하여 사용시 또는 동작 시 소자의 서로 다른 방향을 포함하는 용어로 이해되어야 한다. 명세서 전체에 걸쳐 동일 참조 부호는 동일 구성 요소를 지칭한다.
비록 제 1, 제 2 등이 다양한 소자, 구성요소 및/또는 섹션들을 서술하기 위해서 사용되나, 이들 소자, 구성요소 및/또는 섹션들은 이들 용어에 의해 제한되지 않음은 물론이다. 이들 용어들은 단지 하나의 소자, 구성요소 또는 섹션들을 다른 소자, 구성요소 또는 섹션들과 구별하기 위하여 사용하는 것이다. 따라서, 이하에서 언급되는 제 1 소자, 제 1 구성요소 또는 제 1 섹션은 본 발명의 기술적 사상 내에서 제 2 소자, 제 2 구성요소 또는 제 2 섹션일 수도 있음은 물론이다.
본 명세서에서 기술하는 실시 예들은 본 발명의 이상적인 개략도인 평면도 및 단면도를 참고하여 설명될 것이다. 따라서, 제조 기술 및/또는 허용 오차 등에 의해 예시도의 형태가 변형될 수 있다. 따라서, 본 발명의 실시 예들은 도시된 특정 형태로 제한되는 것이 아니라 제조 공정에 따라 생성되는 형태의 변화도 포함하는 것이다. 따라서, 도면에서 예시된 영역들은 개략적인 속성을 가지며, 도면에서 예시된 영역들의 모양은 소자의 영역의 특정 형태를 예시하기 위한 것이고, 발명의 범주를 제한하기 위한 것은 아니다.
이하, 첨부된 도면들을 참조하여 본 발명의 바람직한 실시 예를 보다 상세하게 설명한다.
도 1은 본 발명의 실시 예에 따른 표시 패널 어셈블리의 평면도이다.
도 1을 참조하면, 본 발명의 실시 예에 따른 표시 패널 어셈블리(100)는 표시 패널(110), 제1 및 제2 회로 기판들(120a, 120b), 연결 부재(CNT), 제1 및 제2 데이터 구동부들(130a, 130b) 및 게이트 구동부(140) 를 포함한다.
표시 패널(110)은 평판 형상을 갖는 평판형 표시 패널일 수 있다. 표시 패널(110)은 제1 방향(D1)으로 장변을 갖고, 제2 방향(D2)으로 단변을 갖는다. 제2 방향(D2)은 제1 방향(D1)과 교차되는 방향이다.
표시 패널(110)의 평면상의 영역은 영상을 표시하는 복수의 화소들(PX1, PX2)이 배치된 표시 영역(DA1, DA2) 및 표시 영역을 둘러싸도록 배치되어 영상을 표시하지 않는 비표시 영역(NDA)을 포함할 수 있다.
표시 영역(DA1, DA2)은 제1 방향(D1)으로 배열된 제1 표시 영역(DA1) 및 제2 표시 영역(DA2)을 포함한다. 제2 표시 영역(DA2)은 제1 표시 영역(DA1)과 제1 방향(D1)에서 인접하게 배치된다.
표시 패널(110)은 복수의 게이트 라인들(GL1~GLn), 게이트 라인들(GL1~GLn)과 절연되어 교차하는 복수의 제1 및 제2 데이터 라인들(DL1~DLm, DL1'~DLm') 및 복수의 제1 및 제2 화소들(PX1, PX2)을 포함한다. 이 때, n, m 및 m'은 0보다 큰 정수이다.
게이트 라인들(GL1~GLn) 및 제1 및 제2 데이터 라인들(DL1~DLm, DL1'~DLm')은 표시 패널(110)의 제1 및 제2 표시 영역들(DA1, DA2)에 배치된다. 구체적으로, 게이트 라인들(GL1~GLn)은 제1 방향(D1)으로 연장되고, 제2 방향(D2)으로 나열된다. 제1 및 제2 데이터 라인들(DL1~DLm, DL1'~DLm')은 제2 방향(D2)으로 연장되고, 제1 방향(D1)으로 나열된다. 제1 데이터 라인들(DL1~DLm)은 제1 표시 영역(DA1)에 배치되고, 제2 데이터 라인들(DL1'~DLm')은 제2 표시 영역(DA2)에 배치된다.
제1 및 제2 데이터 라인들(DL1~DLm, DL1'~DLm')은 제1 및 제2 데이터 구동부들(130a, 130b)에 연결되어 아날로그 형태의 데이터 전압들을 수신할 수 있다. 게이트 라인들(GL1~GLn)은 게이트 구동부(140)에 연결되어 순차적인 게이트 신호들을 수신할 수 있다.
제1 및 제2 화소들(PX1, PX2)은 매트릭스 형태로 배열되어 제1 및 제2 표시 영역들(DA1, DA2)에 배치된다.
구체적으로, 제1 화소들(PX1)은 제1 표시 영역(DA1) 상에서 서로 교차하는 게이트 라인들(GL1~GLn) 및 제1 데이터 라인들(DL1~DLm)에 의해 구획된 영역들에 배치된다. 따라서, 제1 화소들(PX1)은 n개의 행들 및 m개의 열들로 배열될 수 있다.
제2 화소들(PX2)은 제2 표시 영역(DA2) 상에서 서로 교차하는 게이트 라인들(GL1~GLn)이 제2 데이터 라인들(DL1'~DLm')에 의해 구획된 영역들에 배치된다. 따라서, 제2 화소들(PX2)은 n개의 행들 및 m'개의 열들로 배열될 수 있다.
제1 및 제2 회로 기판들(120a, 120b)은 제1 방향(D1)으로 장변으로 갖고, 제2 방향(D2)으로 단변을 갖는다. 제1 및 제2 회로 기판들(120a, 120b)은 제1 방향(D1)으로 연장된다. 제1 및 제2 회로 기판들(120a, 120b)은 서로 인접하게 배치된다. 구체적으로, 제1 및 제2 회로 기판들(120a, 120b)은 제1 및 제2 회로 기판들(120a, 120b)의 일 단변들이 서로 마주보도록 인접하게 배치될 수 있다.
제1 및 제2 회로 기판들(120a, 120b)은 표시 패널(110)의 어느 일 장변과 인접하게 배치된다. 제1 및 제2 회로 기판들(120a, 120b)의 장변들은 각각 표시 패널(110)의 장변보다 짧을 수 있다.
제1 회로 기판(120a)은 제1 표시 영역(DA1)과 대응되도록 배치되고, 제2 회로 기판(120b)은 제2 표시 영역(DA2)과 대응되도록 배치된다. 즉, 제1 회로 기판(120a)은 제1 방향(D1)에서 표시 패널(110)의 장변의 일측과 인접하게 배치되고, 제2 회로 기판(120b)은 제1 방향(D1)에서 표시 패널(110)의 장변의 타측과 인접하게 배치될 수 있다.
제1 및 제2 회로 기판들(120a, 120b) 중 어느 하나는 타이밍 컨트롤러(121a) 및 전압 생성부(미도시)를 포함할 수 있다. 타이밍 컨트롤러(121a)는 집적 회로 칩의 형태로 제1 및 제2 회로 기판들(120a, 120b) 중 어느 하나에 실장될 수 있다. 도 1에서는 제1 회로 기판(120a) 상에 실장된 타이밍 컨트롤러(121a)가 도시되었다.
제1 및 제2 데이터 구동부들(130a, 130b)은 각각 복수의 제1 데이터 구동칩들(131a) 및 복수의 제2 데이터 구동칩들(131b)을 포함한다. 구체적으로, 제1 데이터 구동부(130a)는 제1 데이터 구동칩들(131a)을 포함하고, 제2 데이터 구동부(130b)는 제2 데이터 구동칩들(131b)을 포함한다.
표시 패널 어셈블리(100)는 복수의 제1 연성회로 기판들(FPCB1) 및 복수의 제2 연성회로 기판들(FPCB2)을 더 포함한다. 제1 및 제2 연성회로 기판들(FPCB1, FPCB2)은 가요성을 갖는다.
제1 및 제2 데이터 구동칩들(131a, 131b)은 각각 제1 및 제2 연성회로 기판들(FPCB1, FPCB2) 상에 실장되어 제1 및 제2 회로 기판들(120a, 120b) 및 표시 패널(110)과 연결된다.
구체적으로, 제1 데이터 구동칩들(131a)은 제1 연성회로 기판들(FPCB1) 상에 실장되어 제1 회로 기판(120a)과 제1 표시 영역(DA1)의 상측에 인접한 비표시 영역(NDA)의 표시 패널(110)에 연결된다.
제2 데이터 구동칩들(131b)은 제2 연성회로 기판들(FPCB2) 상에 실장되어 제2 회로 기판(120b)과 제2 표시 영역(DA2)의 상측에 인접한 비표시 영역(NDA)의 표시 패널(110)에 연결된다.
제1 및 제2 데이터 구동부들(130a, 130b)은 타이밍 컨트롤러(121a)로부터 영상 신호들 및 데이터 제어 신호를 제공받는다. 제1 및 제2 데이터 구동부들(130a, 130b)은 데이터 제어 신호에 응답하여 영상 신호들에 대응하는 아날로그 데이터 전압들을 생성한다.
제1 및 제2 데이터 구동부들(130a, 130b)은 제1 및 제2 데이터 라인들(DL1~DLm, DL1'~DLm')을 통해 데이터 전압들을 제1 및 제2 화소들(PX1, PX2)에 제공한다. 구체적으로, 제1 데이터 구동부(130a)는 제1 데이터 라인들(DL1~DLm)을 통해 데이터 전압들을 제1 화소들(PX1)에 제공한다. 제2 데이터 구동부(130b)는 제2 데이터 라인들(DL1'~DLm')을 통해 데이터 전압들을 제2 화소들(PX2)에 제공한다.
게이트 구동부(140)는 타이밍 컨트롤러(121a)로부터 제공된 게이트 제어 신호에 응답하여 게이트 신호들을 생성할 수 있다.
게이트 구동부(140)는 제1 방향(D1)에서 표시 패널(110)의 일측에 배치된 비표시 영역(NDA)에 배치된다. 게이트 구동부(140)는 ASG(Amorphous Silicon TFT Gate driver circuit) 형태 또는 OSG(Oxide Silicon TFT Gate driver circuit) 형태로 표시 패널(110)에 실장될 수 있다.
그러나, 이에 한정되지 않고, 게이트 구동부(140)는 복수의 구동 칩들로 형성되고 가요성 인쇄 회로 기판상에 실장되어 테이프 캐리어 패키지(TCP: Tape Carrier Package) 방식으로 표시 패널(110)에 연결될 수 있다.
연결 부재(CNT)는 제1 회로 기판(120a)과 제2 회로 기판(120b)을 연결한다. 구체적으로, 연결 부재(CNT)는 제1 방향(D1)에서 서로 인접하게 배치된 제1 회로 기판(120a)의 일측과 제2 회로 기판(120b)의 일측을 연결한다. 연결 부재(CNT)는 도전성 부재 및 금속 배선들을 포함할 수 있다. 연결 부재(CNT)에 의하여 제1 및 제2 회로 기판들(120a, 120b)이 전기적으로 도통될 수 있다.
즉, 타이밍 컨트롤러(121a)에서 생성된 영상 신호들 및 데이터 제어 신호들 및 전압 생성부(미도시)에서 생성된 각종 전압들은 연결 부재(CNT)의 도전성 부재 또는 금속 배선들을 통하여 제2 회로 기판(120b)에 전달된다. 전달된 제어 신호, 영상 신호 및 각종 전압들은 제2 회로 기판(120b)를 경유하여 제2 데이터 구동부(130b)에 제공될 수 있다.
연결 부재(CNT)는 표시 패널(110)보다 약한 탄성력 및 약한 강성을 갖는다. 따라서, 평판 표시 패널(110)이 제1 방향(D1)에서 소정의 곡률을 갖도록 평판 표시 패널(110)에 소정의 외력이 가해질 경우, 연결 부재(CNT)는 표시 패널(110)과 같이 휘어지지 않고 끊어지거나 제1 및 제2 회로 기판들(120a, 120b)로부터 분리될 수 있다. 이하 도 3a 내지 도 3c에서 연결 부재(CNT)의 파손에 관하여 보다 상세히 설명된다.
도 2a 내지 도 2c는 도 1에 도시된 I-I'선의 단면도이다.
도 2a 내지 도 2c를 참조하면, 연결 부재(CNT)는 서로 이격되도록 배치된 제1 및 제2 회로 기판들(120a, 120b)을 연결한다. 구체적으로, 연결 부재(CNT)는 제1 방향(D1)에서 서로 인접하게 배치된 제1 회로 기판(120a)의 일측과 제2 회로 기판(120b)의 일측을 연결한다.
연결 부재(CNT)는 여러 가지 형태로 제1 회로 기판(120a) 및 제2 회로 기판(120b)를 연결할 수 있다.
예시적으로 도 2a에 도시된 바와 같이, 연결 부재(CNT)는 제1 방향(D1)에서 제1 회로 기판(120a)의 일측의 상면과 접촉되고, 제1 회로 기판(120a)의 일측과 마주보는 제2 회로 기판(120b)의 일측의 상면과 접촉될 수 있다.
도 2b에 도시된 바와 같이, 연결 부재(CNT)는 제1 방향(D1)에서 제1 회로 기판(120a)의 일측의 하면과 접촉되고, 제1 회로 기판(120a)의 일측과 마주보는 제2 회로 기판(120b)의 일측의 상면과 접촉될 수 있다. 그러나, 이에 한정되지 않고, 연결 부재(CNT)는 제1 회로 기판(120a)의 일측의 상면과 접촉되고, 제1 회로 기판(120a)의 일측과 마주보는 제2 회로 기판(120b)의 일측의 하면과 접촉될 수 있다.
도 2c에 도시된 바와 같이, 연결 부재(CNT)는 제1 방향(D1)에서 제1 회로 기판(120a)의 일측의 하면과 접촉되고, 제1 회로 기판(120a)의 일측과 마주보는 제2 회로 기판(120b)의 일측 하면과 접촉될 수 있다.
도 3a 내지 도 3c는 도 2a 내지 도 2c에 도시된 제1 및 제2 회로 기판에 외력이 작용하는 경우, I-I'선의 단면도이다.
도 3a 내지 도 3c를 참조하면, 평판 표시 패널(110)이 제1 방향(D1)으로 소정의 곡률을 갖도록 연결 부재(CNT)에 벤딩되는 외력이 가해질 경우, 제1 회로 기판(120a) 및 제2 회로 기판(120b)의 연결이 끊어질 수 있다. 즉, 연결 부재(CNT)가 휘어지지 않고 파손되어 끊어지거나 제1 및 제2 회로 기판(120a, 120b)로부터 분리될 수 있다.
예시적으로 도 3a에 도시된 바와 같이, 연결 부재(CNT)에 벤딩되는 외력이 가해질 경우, 연결 부재(CNT)의 가운데 부분이 끊어질 수 있다. 그러나 이에 한정되지 않고, 연결 부재(CNT)의 다양한 부분들이 끊어질 수 있다. 연결 부재(CNT)가 끊어지는 경우, 제1 회로 기판(120a) 및 제2 회로 기판(120b)이 서로 전기적으로 단선될 수 있다.
또한, 연결 부재(CNT)에 벤딩되는 외력이 가해질 경우, 연결 부재(CNT)가 제1 회로 기판(120a) 또는 제2 회로 기판(120b)으로부터 분리될 수 있다. 연결 부재(CNT)가 제1 회로 기판(120a) 또는 제2 회로 기판(120b)으로부터 분리되는 경우, 제1 회로 기판(120a) 및 제2 회로 기판(120b)이 서로 단선될 수 있다.
예시적으로, 도 3b에 도시된 바와 같이, 제1 회로 기판(120a)의 하면의 일측 및 제2 회로 기판(120b) 상면의 일측에 접촉되어있던 연결 부재(CNT)가 제1 회로 기판(120a)으로부터 분리될 수 있다.
도 3c에 도시된 바와 같이, 제1 회로 기판(120a)의 하면의 일측 및 제2 회로 기판(120b) 하면의 일측에 접촉되어있던 연결 부재(CNT)가 제2 회로 기판(120b)으로부터 분리될 수 있다.
제1 회로 기판(120a) 및 제2 회로 기판(120b)이 서로 단선되는 경우, 제1 회로 기판(120a)에 배치된 타이밍 컨트롤러(121a)로부터 제2 회로 기판(120b)에 영상 신호들, 데이터 제어 신호들 및 각종 전압들이 제공되지 않는다. 따라서, 제2 표시 영역(DA2)에 영상이 표시되지 않을 수 있다.
본 발명의 실시 예에서, 제1 및 제2 회로 기판들(120a, 120b)은 표시 패널(110)보다 약한 탄성력 및 강성을 갖는 연결 부재(CNT)로 연결된다. 따라서, 표시 패널(110)을 휘기 위하여 표시 패널(110)에 외력이 인가될 경우, 연결 부재(CNT)가 파손되어 끊어지거나, 제1 및 제2 회로 기판들(120a, 120b)로부터 분리될 수 있다.
이러한 경우, 제1 회로 기판(120a)과 제2 회로 기판(120b)이 전기적으로 단선되어 표시 패널이 정상적으로 구동되지 않는다. 즉, 평판 표시 패널(110)이 곡면 표시 패널로 사용될 경우, 표시 패널 어셈블리(100)가 동작하지 않는다. 그 결과, 평판형 표시 패널 어셈블리(100)가 곡면형 표시 장치에 사용되는 것을 방지할 수 있다.
결과적으로, 본 발명의 실시 예에 따른 표시 패널 어셈블리(100)는 평판형 표시 패널(110)의 오용을 방지할 수 있다.
이상 실시 예를 참조하여 설명하였지만, 해당 기술 분야의 숙련된 당업자는 하기의 특허 청구의 범위에 기재된 본 발명의 사상 및 영역으로부터 벗어나지 않는 범위 내에서 본 발명을 다양하게 수정 및 변경시킬 수 있음을 이해할 수 있을 것이다. 또한 본 발명에 개시된 실시 예는 본 발명의 기술 사상을 한정하기 위한 것이 아니고, 하기의 특허 청구의 범위 및 그와 동등한 범위 내에 있는 모든 기술 사상은 본 발명의 권리범위에 포함되는 것으로 해석되어야 할 것이다.
100: 표시 패널 어셈블리 110: 표시 패널
120a: 제1 회로 기판 120b: 제2 회로 기판
121: 제1 타이밍 컨트롤러 130a: 제1 데이터 구동부
130b: 제2 데이터 구동부 131a: 제1 데이터 구동칩
131b: 제2 데이터 구동칩 FPCB1: 제1 연성회로 기판
FPCB2: 제2 연성회로 기판 D1: 제1 방향
D2: 제2 방향 CNT: 연결 부재

Claims (12)

  1. 평판 형상을 갖는 표시 패널;
    상기 표시 패널의 일 변과 연결되는 제1 및 제2 회로 기판들; 및
    상기 제1 및 제2 회로 기판들 사이에 배치되고, 상기 제1 및 제2 회로 기판들을 전기적으로 연결하는 연결 부재를 포함하고,
    상기 연결 부재는 상기 표시 패널보다 약한 탄성력 및 약한 강성을 갖고,
    외력에 의하여 상기 표시 패널의 형상이 곡면으로 변경될 시, 상기 연결 부재는 끊어지거나 상기 제1 및 제2 회로 기판들로부터 분리되는 표시 패널 어셈블리.
  2. 제 1 항에 있어서,
    상기 표시 패널은 제1 방향으로 장변을 갖고, 상기 제1 방향과 교차되는 제2 방향으로 단변을 갖는 표시 패널 어셈블리.
  3. 제 2 항에 있어서,
    상기 표시 패널의 평면상의 영역은,
    영상을 표시하는 표시 영역; 및
    상기 표시 영역을 둘러싸도록 배치되어 영상을 표시하지 않는 비표시 영역을 포함하고,
    상기 제1 및 제2 회로 기판들은 상기 제2 방향에서 상기 표시 패널의 일측에 배치된 상기 비표시 영역에 연결되는 표시 패널 어셈블리.
  4. 제 3 항에 있어서,
    상기 표시 영역은
    상기 제1 방향으로 배열된 제1 표시 영역 및 제2 표시 영역을 포함하는 표시 패널 어셈블리.
  5. 제 4 항에 있어서,
    상기 제1 회로 기판과 상기 제2 방향에서 상기 제1 표시 영역의 일측에 인접한 상기 비표시 영역에 연결되는 제1 데이터 구동부; 및
    상기 제2 회로 기판과 상기 제2 방향에서 상기 제2 표시 영역의 일측에 인접한 상기 비표시 영역에 연결되는 제2 데이터 구동부를 더 포함하는 표시 패널 어셈블리.
  6. 제 5 항에 있어서,
    상기 표시 패널은 게이트 라인들 및 제1 및 제2 데이터 라인들에 연결된 복수의 화소들을 포함하고,
    상기 화소들 중 상기 제1 표시 영역에 배치된 상기 화소들은 상기 제1 데이터 라인들을 통해 상기 제1 데이터 구동부에 연결되고, 상기 화소들 중 상기 제2 표시 영역에 배치된 상기 화소들은 상기 제2 데이터 라인들을 통해 상기 제2 데이터 구동부에 연결되는 표시 패널 어셈블리.
  7. 제 6 항에 있어서,
    상기 제1 및 제2 데이터 구동부들은 각각 복수의 연성 회로 기판들에 실장된 복수의 데이터 구동칩들을 포함하고,
    상기 데이터 구동칩들은 상기 연성 회로 기판들에 의해 상기 제1 및 제2 회로 기판들과 상기 제2 방향에서 상기 표시 영역의 일측에 인접한 상기 비표시 영역에 연결되는 표시 패널 어셈블리.
  8. 제 1 항에 있어서,
    상기 제1 회로 기판은 상기 표시 패널을 구동하기 위한 영상 신호들 및 제어 신호들을 출력하는 타이밍 컨트롤러를 포함하는 표시 패널 어셈블리.
  9. 제 8 항에 있어서,
    상기 영상 신호들 및 제어 신호는 상기 제1 회로 기판을 통해 상기 표시 패널에 제공되고, 상기 연결 부재와 상기 제2 회로 기판을 경유하여 상기 표시 패널에 제공되는 표시 패널 어셈블리.
  10. 제 8 항에 있어서,
    상기 제1 회로 기판에 실장되는 전압 생성부를 더 포함하는 표시 패널 어셈블리.
  11. 삭제
  12. 제 5 항에 있어서,
    상기 제1 회로 기판 상에 실장되고, 상기 제1 데이터 구동부들에 영상 신호들 및 데이터 제어 신호를 출력하는 제1 타이밍 컨트롤러;
    상기 제2 회로 기판 상에 실장되고, 상기 제2 데이터 구동부들에 영상 신호들 및 데이터 제어 신호를 출력하는 제2 타이밍 컨트롤러; 및
    상기 제1 및 제2 회로 기판들 중 어느 하나에 실장되는 전압 생성부를 포함하는 표시 패널 어셈블리.
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