KR102109109B1 - Light emitting device and lighting system - Google Patents
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Abstract
실시예는 발광소자, 발광소자의 제조방법, 발광소자 패키지 및 조명시스템에 관한 것이다.
실시예에 따른 발광소자는 제1 도전형 반도체층; 상기 제1 도전형 반도체층(11) 상에 InxAlyGa1 -x- yN/GaN층(단, 0<x<1, 0<y<1)(17); 상기 InxAlyGa1 -x- yN/GaN층(17) 상에 활성층(12); 및 상기 활성층(12) 상에 제2 도전형 반도체층(13);을 포함하고, 상기 활성층(12)은 InpGa1 - pN 웰층(단, 0<p<1)(12a) 및 GaN 배리어층(12b)을 포함할 수 있다.Embodiments relate to a light emitting device, a method of manufacturing the light emitting device, a light emitting device package, and a lighting system.
The light emitting device according to the embodiment may include a first conductive semiconductor layer; An In x Al y Ga 1 -x- y N / GaN layer on the first conductivity type semiconductor layer 11 (however, 0 <x <1, 0 <y <1) 17; An active layer 12 on the In x Al y Ga 1 -x- y N / GaN layer 17; And the active layer 12 onto the second conductive type semiconductor layer 13; including, and the active layer 12 is In p Ga 1 - p N well layer (where, 0 <p <1) ( 12a) and GaN A barrier layer 12b may be included.
Description
실시예는 발광소자, 발광소자의 제조방법, 발광소자 패키지 및 조명시스템에 관한 것이다.Embodiments relate to a light emitting device, a method of manufacturing the light emitting device, a light emitting device package, and a lighting system.
발광소자(Light Emitting Device)는 전기에너지가 빛 에너지로 변환되는 특성의 p-n 접합 다이오드로서, 주기율표상에서 Ⅲ족과 Ⅴ족 등의 화합물 반도체로 생성될 수 있고 화합물 반도체의 조성비를 조절함으로써 다양한 색상구현이 가능하다.Light Emitting Device is a pn junction diode that converts electrical energy into light energy. It can be made of compound semiconductors such as group III and group V on the periodic table and realizes various colors by controlling the composition ratio of compound semiconductors. It is possible.
발광소자는 순방향전압 인가 시 n층의 전자와 p층의 정공(hole)이 결합하여 전도대(Conduction band)와 가전대(Valance band)의 밴드갭 에너지에 해당하는 만큼의 에너지를 발산하는데, 이 에너지는 주로 열이나 빛의 형태로 방출되며, 빛의 형태로 발산되면 발광소자가 되는 것이다.When the forward voltage is applied, the n-layer electrons and p-layer holes are combined to emit energy corresponding to the band gap energy of the conduction band and the valance band. Is mainly emitted in the form of heat or light, and when emitted in the form of light, becomes a light emitting device.
예를 들어, 질화물 반도체는 높은 열적 안정성과 폭넓은 밴드갭 에너지에 의해 광소자 및 고출력 전자소자 개발 분야에서 큰 관심을 받고 있다. 특히, 질화물 반도체를 이용한 청색(Blue) 발광소자, 녹색(Green) 발광소자, 자외선(UV) 발광소자 등은 상용화되어 널리 사용되고 있다.For example, nitride semiconductors have attracted great attention in the field of optical devices and high power electronic devices due to their high thermal stability and wide band gap energy. In particular, blue light emitting devices, green light emitting devices, and ultraviolet light (UV) light emitting devices using nitride semiconductors have been commercialized and widely used.
종래 발광소자의 일반적인 InGaN/GaN 구조의 에피층(Epitxial Layer)은 InGaN과 GaN의 격자상수(Lattice Constant) 차이에 의해 두 박막(Thin Film) 경계면에서 격자 부정합이 발생하고, 이로 인해 그 계면이 분극화현상(Polarization)이 발생하고, 에피구조를 가로질러 피에조 필드(Piezoelectric Field)가 발생한다.In the conventional InGaN / GaN structure epitaxial layer of a conventional light emitting device, lattice mismatch occurs at the interface of two thin films due to the difference in the lattice constant of InGaN and GaN, thereby polarizing the interface. Polarization occurs, and a piezoelectric field across the epistructure.
이러한 피에조 필드가 존재하는 상태 하에서 에피구조에 고전류 인가는 밴드갭(Band-Gap)을 심각하게 구부리며(Bending), 이로 인해 두 박막 경계면에서 낮은 전위 장벽 발생하고, 이로 인해 주입된 전자의 캐리어 구속(Carrier Confinement) 기능이 저하되고 전자오버플로우(Electron Overflow) 현상을 촉진시켜 비발광 캐리어(Non-Radiative Carrier)의 수가 증가하고 발광 효율이 급격히 저하된다.In the presence of such a piezo field, high current application to the epi structure severely bends the band-gap, resulting in a low potential barrier at the interface of the two thin films, thereby constraining the carrier of the injected electrons. The (Carrier Confinement) function is deteriorated and the electron overflow phenomenon is promoted, so that the number of non-radiative carriers increases and the luminous efficiency decreases rapidly.
또한 전자의 오버플로우가 존재한 상태 하에서 에피구조에 전류밀도(Current Density)를 점진적으로 올리면, 밴드갭이 구부러지면서, 이로 인해 동일 In 함량을 포함한 InGaN Well을 갖더라도 점차 전자오버플로우 현상이 심화 된다.In addition, if the current density (Current Density) is gradually increased in the epi structure under the condition that the electron overflow exists, the band gap is bent, thereby causing the electron overflow phenomenon to gradually increase even if the InGaN well with the same In content is included. .
상기 낮은 전위 장벽층을 갖는 웰에서 발생하는 전자의 오버플로우는 다수에 MQW에 의해 발생하는 광(Photon, hv) 수를 감소시킬 수 있다.The overflow of electrons generated in the well having the low potential barrier layer can reduce the number of light (Photon, hv) generated by MQW in a large number.
실시예는 에피구조에서 전자오버플로우(Electron Overflow) 현상을 방지하여 광효율을 높일 수 있는 발광소자, 발광소자의 제조방법, 발광소자 패키지 및 조명시스템을 제공하고자 한다.An embodiment is to provide a light emitting device, a method of manufacturing a light emitting device, a light emitting device package, and a lighting system capable of increasing light efficiency by preventing an electron overflow phenomenon in an epi structure.
실시예에 따른 발광소자는 제1 도전형 반도체층(11); 상기 제1 도전형 반도체층(11) 상에 InxAlyGa1 -x- yN/GaN층(단, 0<x<1, 0<y<1)(17); 상기 InxAlyGa1 -x- yN/GaN층(17) 상에 활성층(12); 및 상기 활성층(12) 상에 제2 도전형 반도체층(13);을 포함하고, 상기 활성층(12)은 InpGa1 - pN 웰층(단, 0<p<1)(12a) 및 GaN 배리어층(12b)을 포함할 수 있다.The light emitting device according to the embodiment includes a first
상기 InxAlyGa1 -x- yN/GaN층(17)에서 In의 조성(x)과 상기 웰층(12a)의 In의 조성(p) 비율 관계는 0.75≤x/p≤1.0 범위일 수 있다.In the In x Al y Ga 1 -x- y N /
상기 InxAlyGa1 -x- yN/GaN층(단, 0<x<1, 0<y<1)(17)에서 Al의 조성범위(y)는 0<y≤0.02일 수 있다.In the In x Al y Ga 1 -x- y N / GaN layer (however, the composition range (y) of Al in 0 <x <1, 0 <y <1) (17) may be 0 <y≤0.02. .
또한, 실시예에 따른 조명장치는 상기 발광소자를 구비하는 발광 모듈을 포함할 수 있다.In addition, the lighting device according to the embodiment may include a light emitting module having the light emitting element.
실시예에 따른 발광소자, 발광소자의 제조방법, 발광소자 패키지 및 조명시스템에 의하면, 에피구조에서 전자오버플로우(Electron Overflow) 현상을 방지하여 광효율을 높일 수 있다.According to the light emitting device, the manufacturing method of the light emitting device, the light emitting device package and the lighting system according to the embodiment, it is possible to prevent an electron overflow phenomenon in an epi structure, thereby increasing light efficiency.
도 1은 실시예에 따른 발광소자의 단면도.
도 2는 실시예에 따른 발광소자의 에너지 밴드갭 다이어 그램.
도 3은 실시예에 따른 발광소자의 내부 양자효율 제1 예시도.
도 4는 실시예에 따른 발광소자의 내부 양자효율 제2 예시도.
도 5는 실시예에 따른 발광소자의 내부 양자효율 제3 예시도.
도 6 내지 도 8은 실시예에 따른 발광소자의 제조방법 공정 단면도.
도 9는 다른 실시예에 따른 발광소자의 단면도.
도 10은 실시예에 따른 발광소자 패키지의 단면도.
도 11은 실시예에 따른 조명장치의 도면.1 is a cross-sectional view of a light emitting device according to an embodiment.
Figure 2 is an energy band gap diagram of the light emitting device according to the embodiment.
Figure 3 is a first illustration of the internal quantum efficiency of the light emitting device according to the embodiment.
4 is a second illustration of the internal quantum efficiency of the light emitting device according to the embodiment.
5 is a third illustration of the internal quantum efficiency of the light emitting device according to the embodiment.
6 to 8 are sectional views showing the manufacturing method of the light emitting device according to the embodiment.
9 is a cross-sectional view of a light emitting device according to another embodiment.
10 is a sectional view of a light emitting device package according to an embodiment.
11 is a view of a lighting device according to an embodiment.
실시 예의 설명에 있어서, 각 층(막), 영역, 패턴 또는 구조물들이 기판, 각 층(막), 영역, 패드 또는 패턴들의 "상/위(on/over)"에 또는 "아래(under)"에 형성되는 것으로 기재되는 경우에 있어, "상/위(on/over)"와 "아래(under)"는 "직접(directly)" 또는 "다른 층을 개재하여 (indirectly)" 형성되는 것을 모두 포함한다. 또한 각 층의 상/위 또는 아래에 대한 기준은 도면을 기준으로 설명한다.In the description of the embodiments, each layer (film), region, pattern or structure is "on / over" or "under" the substrate, each layer (film), region, pad or pattern. In the case described as being formed in, "on / over" and "under" include both "directly" or "indirectly" formed through another layer. do. In addition, the criteria for the top / top or bottom of each layer will be described based on the drawings.
도면에서 각층의 두께나 크기는 설명의 편의 및 명확성을 위하여 과장되거나 생략되거나 또는 개략적으로 도시되었다. 또한 각 구성요소의 크기는 실제크기를 전적으로 반영하는 것은 아니다.In the drawings, the thickness or size of each layer is exaggerated, omitted, or schematically illustrated for convenience and clarity. Also, the size of each component does not entirely reflect the actual size.
(실시예)(Example)
도 1은 실시예에 따른 발광소자(100)의 단면도이다.1 is a cross-sectional view of a
실시예에 따른 발광소자(100)는 제1 도전형 반도체층(11)과, 상기 제1 도전형 반도체층(11) 상에 InxAlyGa1 -x- yN/GaN층(단, 0<x<1, 0<y<1)(17)과, 상기 InxAlyGa1-x-yN/GaN층(17) 상에 활성층(12) 및 상기 활성층(12) 상에 제2 도전형 반도체층(13)을 포함할 수 있다.The
도 2는 실시예에 따른 발광소자의 에너지 밴드갭 다이어 그램이다.2 is an energy band gap diagram of a light emitting device according to an embodiment.
실시예에서 상기 InxAlyGa1 -x- yN/GaN층(17)은 InxAlyGa1 -x- yN(17a)/GaN(17b) 초격자 구조를 포함할 수 있으나 이에 한정되지 않는다.In an embodiment, the In x Al y Ga 1 -x- y N / GaN
실시예에서, 상기 활성층(12)은 InpGa1 - pN 웰층(단, 0<p<1)(12a) 및 GaN 배리어층(12b)을 포함할 수 있고, 상기 InxAlyGa1 -x- yN/GaN층(17)에서 In의 조성(x)과 상기 웰층(12a)의 In의 조성(p) 비율 관계는 0.75≤x/p≤1.0 범위일 수 있다.In an embodiment, the
도 3은 실시예에 따른 발광소자의 내부 양자효율과 비교예의 내부 양자효율(Ref)의 제1 예시도이다. 3 is a first example of the internal quantum efficiency of the light emitting device and the internal quantum efficiency (Ref) of the comparative example.
도 3에서, 실시예의 InxAlyGa1 -x- yN/GaN층(17)은 In0 .13Al0 .02Ga0 .85N/GaN인 경우의 예를 들고 있으나, 실시예가 이에 한정되는 것은 아니다.In Figure 3, the embodiment of In x Al y Ga 1 -x- y N /
일반적으로, 에피 구조(Epi Structure) 전반에 걸려 있는 피에조 필드(Piezoelectric Fields)는 고전류 주입(High Current Driving)이 밴드갭을 심각하게 구부리며(Bending), 전자 오버플로우(Electron Overflow) 현상을 심화시켜 활성층에서 발생하는 Photon (hv) 수를 감소시킬 수 있다. In general, Piezoelectric Fields hanging across the Epi Structure cause high current driving to severely bend the bandgap and deepen the electron overflow phenomenon. The number of Photon (hv) generated in the active layer can be reduced.
실시예는 피에조 필드 현상을 개선시키기 위해 PFRS(Piezoelectric Fields Reduction Structure) 구현을 위해서 활성층(12) 하부에 InxAlyGa1 -x- yN/GaN층(17)을 배치할 수 있다.In an embodiment, an In x Al y Ga 1 -x- y N /
실시예에서 PFRS(Piezoelectric Fields Reduction Structure) 구현 위해서 활성층(12) 하부에 배치된 InxAlyGa1 -x- yN/GaN층(17) 초격자 구조의 역할이 중요하다.In an embodiment, the role of the In x Al y Ga 1 -x- y N /
활성층에 주입된 전자는 InxAlyGa1 -x- yN/GaN 구조에서 In/Al 조성(Composition)에 따라 캐리어 구속 기능(Carrier Confinement Function)을 강화시킬 수 있고, 또한 캐리어 전달기능(Carrier Transfer Function)을 강화 시켜 여기되는 Photon (hv) 수를 증대시켜 파장/에너지 스펙트럼(Wave/Energy Sepectrum) 상에 발광강도(Emission Intensity) 및 IQE(Internal Quantum Efficiency를 증가시킬 수 있다.The electron injected into the active layer can enhance the carrier confinement function according to the In / Al composition in the In x Al y Ga 1 -x- y N / GaN structure, and also the carrier transfer function (Carrier) By strengthening the transfer function, the number of excited photons (hv) can be increased to increase emission intensity and internal quantum efficiency on the wavelength / energy spectrum.
예를 들어 실시예에 의하면, 상기 InxAlyGa1 -x- yN/GaN층(17)에서 In을 약 13%, Al을 2%로 구성하여 밴드갭 에너지(Bandgap Energy)을 형성시켜 주면, 실제 에피층(Epitxial Layer) 내에서 InAlGaN과 GaN의 밴드갭 에너지 차이에 의해 두 박막(Thin Film) 경계면에서 전위 장벽이 발생하고, n/p-Type을 가로질러 존재하는 피에조 필드(Piezoelectric Field)를 감소시켜, 주입(Injection)된 전자(Electron)의 캐리어 구속(Carrier Confinement)을 도와 특정 우물(Well)에서 캐리어의 존재 확률을 높이고 발광재결합(Radiative Recombination)을 촉진하여, 발광 효율을 개선할 수 있다.For example, according to an embodiment, in the In x Al y Ga 1 -x- y N / GaN
도 4는 실시예에 따른 발광소자의 내부 양자효율 제2 예시도로서, 비교예(Ref)와 제1 실시예(E1), 제2 실시예(E2)에서 Al 레벨(Level) 최적화 실험 결과이다.4 is a second exemplary diagram of internal quantum efficiency of a light emitting device according to an embodiment, and is an Al level (Level) optimization experiment result in the comparative example (Ref), the first embodiment (E1), and the second embodiment (E2). .
실시예에서 상기 InxAlyGa1 -x- yN/GaN층(단, 0<x<1, 0<y<1)(17)에서 Al의 조성범위(y)는 0<y≤0.02일 수 있다.In an embodiment, the composition range (y) of Al in the In x Al y Ga 1 -x- y N / GaN layer (where 0 <x <1, 0 <y <1) 17 is 0 <y≤0.02 Can be
실시예는 전자 오버플로우(Electron Overflow) 현상이나 비발광재결합(Non-Radiative Recombination)을 개선하기 위해, InAlGaN/GaN 극성(Polarity)이 줄어들도록 2% 이하의 저농도의 Al 조성(Composition)을 구비하는 InxAlyGa1 -x- yN/GaN층(17)을 디자인하여 고전류 주입(High Current Driving)에서 밴드 벤딩(Band Bending) 현상을 완화시켜 주입된 전자(Injected Electron)의 캐리어 구속기능(Carrier Confinement Function)을 강화시킬 수 있다.In an embodiment, in order to improve an electron overflow phenomenon or non-radiative recombination, an AlAl composition having a low concentration of 2% or less is reduced to reduce InAlGaN / GaN polarity. By designing the In x Al y Ga 1 -x- y N /
도 5는 실시예에 따른 발광소자의 내부 양자효율 제3 예시도로서, 비교예(Ref)와 제1 실시예(E1), 제3 실시예(E3)에서 In 레벨(Level) 최적화 실험 결과이다.5 is a third example of internal quantum efficiency of a light emitting device according to an embodiment, and is a result of an In level (Level) optimization experiment in the comparative example (Ref), the first embodiment (E1), and the third embodiment (E3). .
실시예에서, 상기 InxAlyGa1 -x- yN/GaN층(17)에서 In의 조성(x)과 상기 웰층(12a)의 In의 조성(p) 비율 관계는 0.75≤x/p≤1.0 범위일 수 있다.In an embodiment, the relationship between the composition (x) of In in the In x Al y Ga 1 -x- y N /
예를 들어, 상기 InxAlyGa1 -x- yN/GaN층(단, 0<x<1, 0<y<1)(17)에서 In의 조성범위(x)는 0<x≤0.13일 수 있다.For example, the composition range (x) of In in the In x Al y Ga 1 -x- y N / GaN layer (where 0 <x <1, 0 <y <1) 17 is 0 <x ≤ 0.13.
실시예는 InAlGaN/GaN 극성이 줄어들고, 활성층과의 격자상수 차이를 줄일 수 있도록 종래 스트레인 완화층의 In 농도보다 높게 설계하여, In의 조성(x)을 웰층(12a)의 In의 조성(p)의 75% 내지 100%로 설계하여 밴드 벤딩 현상을 완화시키고, 캐리어 전달기능을 증대시킬 수 있다.In the embodiment, the InAlGaN / GaN polarity is reduced, and the concentration of the In (x) of the
실시예에서, 상기 InxAlyGa1 -x- yN/GaN층(17)은 언도프트층(un-doped layer)일 수 있다.In an embodiment, the In x Al y Ga 1 -x- y N / GaN
또는 실시예에서, 상기 InxAlyGa1 -x- yN/GaN층(17)은 제1 도전형으로 도핑된 층일 수 있고, 벌크 저항을 구비하여 활성층과는 다른 물리적 물성을 구비할 수 있다.Or in an embodiment, the In x Al y Ga 1 -x- y N / GaN
실시예에 따른 발광소자, 발광소자의 제조방법, 발광소자 패키지 및 조명시스템에 의하면, 에피구조에서 전자오버플로우(Electron Overflow) 현상을 방지하여 광효율을 높일 수 있다.According to the light emitting device, the manufacturing method of the light emitting device, the light emitting device package and the lighting system according to the embodiment, it is possible to increase the light efficiency by preventing an electron overflow phenomenon in the epi structure.
이하, 도 6 내지 도 8을 참조하여 실시예에 따른 발광소자 제조방법을 설명하기로 한다. Hereinafter, a method of manufacturing a light emitting device according to an embodiment will be described with reference to FIGS. 6 to 8.
실시 예에 따른 발광소자 제조방법에 의하면, 도 6과 같이, 기판(5) 위에 제1 도전형 반도체층(11), 활성층(12), 제2 도전형 반도체층(13)을 형성할 수 있다. 상기 제1 도전형 반도체층(11), 상기 활성층(12), 상기 제2 도전형 반도체층(13)은 발광구조물(10)로 정의될 수 있다.According to the method of manufacturing the light emitting device according to the embodiment, as shown in FIG. 6, the first
상기 기판(5)은 예를 들어, 사파이어 기판(Al2O3), SiC, GaAs, GaN, ZnO, Si, GaP, InP, Ge 중 적어도 하나로 형성될 수 있으며, 이에 대해 한정하지는 않는다. 상기 제1 도전형 반도체층(11)과 상기 기판(5) 사이에는 버퍼층(14)이 더 형성될 수 있다.The
예로써, 상기 제1 도전형 반도체층(11)이 제1 도전형 도펀트로서 n형 도펀트가 첨가된 n형 반도체층으로 형성되고, 상기 제2 도전형 반도체층(13)이 제2 도전형 도펀트로서 p형 도펀트가 첨가된 p형 반도체층으로 형성될 수 있다. 또한 상기 제1 도전형 반도체층(11)이 p형 반도체층으로 형성되고, 상기 제2 도전형 반도체층(13)이 n형 반도체층으로 형성될 수도 있다.For example, the first conductivity
상기 제1 도전형 반도체층(11)은 예를 들어, n형 반도체층을 포함할 수 있다. 상기 제1 도전형 반도체층(11)은 InxAlyGa1 -x- yN (0≤x≤1, 0≤y≤1, 0≤x+y≤1)의 조성식을 갖는 반도체 재료로 형성될 수 있다. 상기 제1 도전형 반도체층(11)은, 예를 들어 InAlGaN, GaN, AlGaN, AlInN, InGaN, AlN, InN 등에서 선택될 수 있으며, Si, Ge, Sn, Se, Te 등의 n형 도펀트가 도핑될 수 있다.The first
상기 활성층(12)은 상기 제1 도전형 반도체층(11)을 통해서 주입되는 전자(또는 정공)와 상기 제2 도전형 반도체층(13)을 통해서 주입되는 정공(또는 전자)이 서로 만나서, 상기 활성층(12)의 형성 물질에 따른 에너지 밴드(Energy Band)의 밴드갭(Band Gap) 차이에 의해서 빛을 방출하는 층이다. In the
상기 제2 도전형 반도체층(13)은 예를 들어, p형 반도체층으로 구현될 수 있다. 상기 제2 도전형 반도체층(13)은 InxAlyGa1 -x- yN (0≤x≤1, 0≤y≤1, 0≤x+y≤1)의 조성식을 갖는 반도체 재료로 형성될 수 있다. 상기 제2 도전형 반도체층(13)은, 예를 들어 InAlGaN, GaN, AlGaN, InGaN, AlInN, AlN, InN 등에서 선택될 수 있으며, Mg, Zn, Ca, Sr, Ba 등의 p형 도펀트가 도핑될 수 있다.The second conductivity
한편, 상기 제1 도전형 반도체층(11)이 p형 반도체층을 포함하고 상기 제2 도전형 반도체층(13)이 n형 반도체층을 포함할 수도 있다. 또한, 상기 제2 도전형 반도체층(13) 위에는 n형 또는 p형 반도체층을 포함하는 반도체층이 더 형성될 수도 있으며, 이에 따라, 상기 발광구조물(10)은 np, pn, npn, pnp 접합 구조 중 적어도 어느 하나를 가질 수 있다. 또한, 상기 제1 도전형 반도체층(11) 및 상기 제2 도전형 반도체층(13) 내의 불순물의 도핑 농도는 균일 또는 불균일하게 형성될 수 있다. 즉, 상기 발광구조물(10)의 구조는 다양하게 형성될 수 있으며, 이에 대해 한정하지는 않는다.Meanwhile, the first conductivity
또한, 상기 제1 도전형 반도체층(11)과 상기 활성층(12) 사이에는 제1 도전형 InGaN/GaN 슈퍼래티스 구조 또는 InGaN/InGaN 슈퍼래티스 구조가 형성될 수도 있다. 또한, 상기 제2 도전형 반도체층(13)과 상기 활성층(12) 사이에는 제2 도전형의 AlGaN층이 형성될 수도 있다.In addition, a first conductivity type InGaN / GaN superlattice structure or an InGaN / InGaN superlattice structure may be formed between the first conductivity
도 2는 실시예에 따른 발광소자의 밴드갭 다이어 그램을 참조하여 실시예에 따른 발광소자를 좀 더 구체적으로 설명한다.2 illustrates the light emitting device according to the embodiment in more detail with reference to a band gap diagram of the light emitting device according to the embodiment.
도 2는 실시예에 따른 발광소자의 에너지 밴드갭 다이어 그램이다.2 is an energy band gap diagram of a light emitting device according to an embodiment.
실시예에서 상기 InxAlyGa1 -x- yN/GaN층(17)은 초격자 구조를 포함할 수 있으나 이에 한정되지 않는다.In an embodiment, the In x Al y Ga 1 -x- y N /
실시예에서, 상기 활성층(12)은 InpGa1 - pN 웰층(단, 0<p<1)(12a) 및 GaN 배리어층(12b)을 포함할 수 있고, 상기 InxAlyGa1 -x- yN/GaN층(17)에서 In의 조성(x)과 상기 웰층(12a)의 In의 조성(p) 비율 관계는 0.75≤x/p≤1.0 범위일 수 있다.In an embodiment, the
실시예는 피에조 필드 현상을 개선시키기 위해 활성층(12) 하부에 InxAlyGa1 -x-yN/GaN층(17)을 배치할 수 있다.In an embodiment, the In x Al y Ga 1 -xy N /
실시예에 의하면, 상기 InxAlyGa1 -x- yN/GaN층(17)에서 In을 약 13%, Al을 2%로 구성하여 밴드갭 에너지를 형성시켜 주면, 실제 에피층 내에서 InAlGaN과 GaN의 밴드갭 에너지 차이에 의해 두 박막 경계면에서 전위 장벽이 발생하고, 피에조 필드를 감소시켜, 주입된 전자의 캐리어 구속을 도와 특정 우물에서 캐리어의 존재 확률을 높이고 발광재결합을 촉진하여, 발광 효율을 개선할 수 있다.According to an embodiment, in the In x Al y Ga 1 -x- y N /
다음으로, 도 7과 같이, 상기 발광구조물(10)에 대한 에칭을 행하여 상기 제1 도전형 반도체층(11)의 일부 영역을 노출시킬 수 있다. 이때, 상기 에칭은 습식에칭 또는 건식에칭으로 수행될 수 있다.Next, as shown in FIG. 7, a portion of the first
이후, 상기 발광구조물(10)에 채널층(30), 오믹접촉패턴(15), 반사층(17)을 형성할 수 있다.Thereafter, a
예를 들어, 상기 채널층(30)은 Si02, SixOy, Si3N4, SixNy, SiOxNy, Al2O3, TiO2, AlN 등으로 이루어진 군에서 적어도 하나가 선택되어 형성될 수 있다. For example, the
상기 반사층(17)과 상기 제2 도전형 반도체층(13) 사이에 상기 오믹접촉패턴(15)이 배치될 수 있다. 상기 오믹접촉패턴(15)은 상기 제2 도전형 반도체층(13)에 접촉되어 배치될 수 있다. The
상기 오믹접촉패턴(15)은 상기 발광구조물(10)과 오믹 접촉이 되도록 형성될 수 있다. 상기 반사층(17)은 상기 제2 도전형 반도체층(13)에 전기적으로 연결될 수 있다. 상기 오믹접촉패턴(15)은 상기 발광구조물(10)과 오믹 접촉되는 영역을 포함할 수 있다.The
상기 오믹접촉패턴(15)은 예컨대 투명 전도성 산화막으로 형성될 수 있다. 상기 오믹접촉패턴(15)은 예로서 ITO(Indium Tin Oxide), IZO(Indium Zinc Oxide), AZO(Aluminum Zinc Oxide), AGZO(Aluminum Gallium Zinc Oxide), IZTO(Indium Zinc Tin Oxide), IAZO(Indium Aluminum Zinc Oxide), IGZO(Indium Gallium Zinc Oxide), IGTO(Indium Gallium Tin Oxide), ATO(Antimony Tin Oxide), GZO(Gallium Zinc Oxide), IZON(IZO Nitride), ZnO, IrOx, RuOx, NiO, Pt, Ag, Ti 중에서 선택된 적어도 하나의 물질로 형성될 수 있다.The
상기 반사층(17)은 고 반사율을 갖는 물질로 형성될 수 있다. 예컨대 상기 반사층(17)은 Ag, Ni, Al, Rh, Pd, Ir, Ru, Mg, Zn, Pt, Cu, Au, Hf 중 적어도 하나를 포함하는 금속 또는 합금으로 형성될 수 있다. 또한, 상기 반사층(17)은 상기 금속 또는 합금과 ITO(Indium-Tin-Oxide), IZO(Indium-Zinc-Oxide), IZTO(Indium-Zinc-Tin-Oxide), IAZO(Indium-Aluminum-Zinc-Oxide), IGZO(Indium-Gallium-Zinc-Oxide), IGTO(Indium-Gallium-Tin-Oxide), AZO(Aluminum-Zinc-Oxide), ATO(Antimony-Tin-Oxide) 등의 투광성 전도성 물질을 이용하여 다층으로 형성될 수 있다. 예를 들어, 실시 예에서 상기 반사층(17)은 Ag, Al, Ag-Pd-Cu 합금, 또는 Ag-Cu 합금 중 적어도 어느 하나를 포함할 수 있다.The
예를 들면, 상기 반사층(17)은 Ag 층과 Ni 층이 교대로 형성될 수도 있고, Ni/Ag/Ni, 혹은 Ti 층, Pt 층을 포함할 수 있다. 또한, 상기 오믹접촉패턴(15)은 상기 반사층(17) 아래에 형성되고, 적어도 일부가 상기 반사층(17)을 통과하여 상기 발광구조물(10)과 오믹 접촉될 수도 있다.For example, the
이어서, 상기 반사층(17) 위에 금속층(50), 본딩층(60), 지지부재(70), 임시기판(90)이 형성될 수 있다.Subsequently, a
상기 금속층(50)은 Au, Cu, Ni, Ti, Ti-W, Cr, W, Pt, V, Fe, Mo 물질 중에서 적어도 하나를 포함할 수 있다. 상기 금속층(50)은 확산장벽층의 기능을 수행할 수도 있다.The
실시 예에 의하면, 상기 제2 도전형 반도체층(13)에 전기적으로 연결된 제1 전극층은 반사층, 오믹접촉층, 금속층 중에서 적어도 하나를 포함할 수 있다. 실시 예에 의하면 제1 전극층은 반사층, 오믹접촉층, 금속층을 모두 포함할 수도 있으며, 그 중에서 1 개의 층 또는 2 개의 층을 포함할 수도 있다.According to an embodiment, the first electrode layer electrically connected to the second conductivity
상기 금속층(50)은 상기 본딩층(60)이 제공되는 공정에서 상기 본딩층(60)에 포함된 물질이 상기 반사층(17) 방향으로 확산되는 것을 방지하는 기능을 수행할 수 있다. 상기 제2 금속층(50)은 상기 본딩층(60)에 포함된 주석(Sn) 등의 물질이 상기 반사층(17)에 영향을 미치는 것을 방지할 수 있다. The
상기 본딩층(60)은 베리어 금속 또는 본딩 금속 등을 포함하며, 예를 들어, Ti, Au, Sn, Ni, Cr, Ga, In, Bi, Cu, Ag, Nb, Pd 또는 Ta 중 적어도 하나를 포함할 수 있다. 상기 지지부재(70)는 실시 예에 따른 발광구조물(10)을 지지하며 방열 기능을 수행할 수 있다. 상기 본딩층(60)은 시드층으로 구현될 수도 있다.The
상기 지지부재(70)는 예를 들어, Ti, Cr, Ni, Al, Pt, Au, W, Cu, Mo, Cu-W 또는 불순물이 주입된 반도체 기판(예: Si, Ge, GaN, GaAs, ZnO, SiC, SiGe 등) 중에서 적어도 어느 하나로 형성될 수 있다. 또한 상기 지지부재(70)는 절연물질로 형성될 수도 있다.The
상기 임시기판(90)은 상기 지지부재(70) 위에 형성될 수 있다. 상기 임시기판(90)은 금속물질, 반도체 물질, 또는 절연물질 중에서 적어도 하나로 형성될 수 있다.The
다음으로 도 8과 같이, 상기 발광구조물(10)으로부터 상기 기판(5)을 제거한다. 하나의 예로서, 상기 기판(5)은 레이저 리프트 오프(LLO: Laser Lift Off) 공정에 의해 제거될 수 있다. 레이저 리프트 오프 공정(LLO)은 상기 기판(5)의 하면에 레이저를 조사하여, 상기 기판(5)과 상기 발광구조물(10)을 서로 박리시키는 공정이다.Next, as illustrated in FIG. 8, the
그리고, 아이솔레이션 에칭 공정, 패드 전극(81) 형성 공정, 스크라이빙 공정, 반사부(40) 형성 공정, 상기 임시기판(90) 제거 공정이 진행될 수 있다. 이러한 공정은 하나의 예시이며, 필요에 따라 공정 순서는 다양하게 변형될 수 있다. In addition, an isolation etching process, a
실시 예에 의하면, 아이솔레이션 에칭을 수행하여 상기 발광구조물(10)의 측면을 식각하고 상기 채널층(30)의 일부 영역이 노출될 수 있게 된다. 상기 아이솔레이션 에칭은 예를 들어, ICP(Inductively Coupled Plasma)와 같은 건식 식각에 의해 실시될 수 있으나, 이에 대해 한정하지는 않는다. According to an exemplary embodiment, isolation etching is performed to etch a side surface of the
상기 발광구조물(10)의 상부 면에 러프니스(roughness)(미도시)가 형성될 수 있다. 상기 발광구조물(10)의 상부 면에 광 추출 패턴이 제공될 수 있다. 상기 발광구조물(10)의 상부 면에 요철 패턴이 제공될 수 있다. 상기 발광구조물(10)에 제공되는 광 추출 패턴은 하나의 예로서 PEC (Photo Electro Chemical) 식각 공정에 의하여 형성될 수 있다. 이에 따라 실시 예에 의하면 외부 광 추출 효과를 상승시킬 수 있게 된다.Roughness (not shown) may be formed on an upper surface of the
다음으로, 상기 발광구조물(10) 위에 패드 전극(81)이 형성될 수 있다.Next, a
상기 패드 전극(81)은 상기 제1 도전형 반도체층(11)에 전기적으로 연결될 수 있다. 상기 패드 전극(81)의 일부 영역은 상기 제1 도전형 반도체층(11)에 접촉될 수 있다. 실시 예에 의하면, 상기 패드 전극(81) 및 상기 제1 전극층(87)을 통하여 상기 발광구조물(10)에 전원이 인가될 수 있게 된다.The
상기 패드 전극(81)은 오믹층, 중간층, 상부층으로 구현될 수 있다. 상기 오믹층은 Cr, V, W, Ti, Zn 등에서 선택된 물질을 포함하여 오믹 접촉을 구현할 수 있다. 상기 중간층은 Ni, Cu, Al 등에서 선택된 물질로 구현될 수 있다. 상기 상부층은 예컨대 Au를 포함할 수 있다. 상기 패드 전극(81)은 Cr, V, W, Ti, Zn,Ni, Cu, Al, Au 중에서 적어도 하나를 포함할 수 있다. The
그리고, 스크라이빙 공정이 수행되어 상기 채널층(30), 상기 지지부재(70)의 측면이 노출될 수 있게 된다. 이어서 상기 채널층(30)의 측면과 상기 지지부재(70)의 측면에 상기 반사부(40)가 형성될 수 있다. 이후 상기 임시기판(90)이 제거됨으로써 개별 발광소자가 형성될 수 있게 된다.Then, the scribing process is performed so that the side surfaces of the
실시예에 의하면, 상기 반사부(40)는 상기 채널층(30)의 상부에 배치될 수 있다. 상기 반사부(40)는 상기 채널층(30) 위에 접촉되어 배치될 수 있다. 상기 반사부(40)는 상기 지지부재(70)의 측면에 배치될 수 있다. 상기 반사부(40)는 상기 지지부재(70)의 측면에 접촉되어 배치될 수 있다. 실시 예에 의하면, 상기 반사부(40)는 상기 채널층(30)의 상부에 배치된 제1 영역과 상기 지지부재(70)의 측면에 배치된 제2 영역이 서로 연결되어 배치될 수 있다.According to an embodiment, the
또한, 상기 반사부(40)는 상기 금속층(50)의 측면에 배치될 수도 있다. 상기 반사부(40)는 상기 금속층(50)의 측면에 접촉되어 배치될 수 있다. 상기 반사부(40)는 상기 본딩층(60)의 측면에 배치될 수 있다. 상기 반사부(40)는 상기 본딩층(60)의 측면에 접촉되어 배치될 수 있다. 상기 반사부(40)는 상기 발광구조물(10)과 이격되어 배치될 수 있다. 상기 반사부(40)는 상기 발광구조물(10)과 전기적으로 절연되어 배치될 수 있다.In addition, the
상기 반사부(40)는 반사율이 좋은 물질로 구현될 수 있다. 예로서 상기 반사부(40)는 Ag, Al, Pt 중에서 적어도 하나의 물질을 포함할 수 있다. 상기 반사부(40)는 예로서 50 나노미터 내지 5000 나노미터의 두께로 형성될 수 있다.The
상기 반사부(40)는 상기 발광구조물(10)에서 발광된 빛이 상기 채널층(30), 상기 금속층(50), 상기 본딩층(60), 상기 지지부재(70)로 입사되어 흡수되는 것을 방지할 수 있다. 즉, 상기 반사부(40)는 외부로부터 입사되는 빛을 반사시킴으로써 상기 채널층(30), 상기 금속층(50), 상기 본딩층(60), 상기 지지부재(70)에서 빛이 흡수되어 소실되는 것을 방지할 수 있게 된다. The
상기 반사부(40)가 배치됨에 따라, 상기 채널층(30)의 측면, 상기 금속층(50)의 측면, 상기 본딩층(60)의 측면, 상기 지지부재(70)의 측면 중의 어느 하나에 거칠기가 형성된 경우에도, 실시 예에 따른 발광소자의 측면은 모두 매끄럽게 구현될 수 있게 된다. 즉, 상기 반사부(40)의 표면이 매끄럽게 형성될 수 있으므로 스크라이빙 공정 등에서 상기 채널층(30)의 측면, 상기 금속층(50)의 측면, 상기 본딩층(60)의 측면, 상기 지지부재(70)의 측면 중의 어느 하나에 거칠기 또는 버(burr)가 형성된 경우에도, 실시 예에 따른 발광소자의 측면은 모두 매끄럽게 구현될 수 있게 된다.As the
도 9는 다른 실시예에 따른 발광소자(102)의 단면도이다.9 is a cross-sectional view of a
다른 실시예는 상기 실시예의 기술적인 특징을 채용할 수 있다.Other embodiments may employ technical features of the above embodiments.
다른 실시예에 따른 발광소자(102)는 수평형 발광소자에 대한 예로서, 이는 기판(5)과, 상기 기판(5) 상에 제1 도전형 반도체층(11)과, 상기 제1 도전형 반도체층(11) 상에 활성층(12)과, 상기 활성층(12) 상에 제2 도전형 반도체층(13)을 포함할 수 있다.The
다른 실시예에 따른 발광소자(102)는 수평형 칩에 대한 구조로서, 제2 도전형 반도체층(13) 상에 제1 전극층(87)이 배치될 수 있고, 제1 전극층(87)은 투명 오믹층을 포함할 수 있다.The
제1 패드 전극(81)과 제2 패드 전극(82)이 제2 전극층(87)과 노출된 제1 도전형 반도체층(11) 상에 배치될 수 있고, 버퍼층(14)이 기판(5) 상에 배치될 수 있다.The
도 10은 실시 예에 따른 발광소자가 적용된 발광소자 패키지를 나타낸 도면이다.10 is a view showing a light emitting device package to which a light emitting device according to an embodiment is applied.
도 10을 참조하면, 실시 예에 따른 발광소자 패키지는 몸체(120)와, 상기 몸체(120)에 배치된 제1 리드전극(131) 및 제2 리드전극(132)과, 상기 몸체(120)에 제공되어 상기 제1 리드전극(131) 및 제2 리드전극(132)과 전기적으로 연결되는 실시 예에 따른 발광소자(100)와, 상기 발광소자(100)를 포위하는 몰딩부재(140)를 포함할 수 있다.Referring to FIG. 10, a light emitting device package according to an embodiment includes a
상기 몸체(120)는 실리콘 재질, 합성수지 재질, 또는 금속 재질을 포함하여 형성될 수 있으며, 상기 발광소자(100)의 주위에 경사면이 형성될 수 있다.The
상기 제1 리드전극(131) 및 제2 리드전극(132)은 서로 전기적으로 분리되며, 상기 발광소자(100)에 전원을 제공한다. 또한, 상기 제1 리드전극(131) 및 제2 리드전극(132)은 상기 발광소자(100)에서 발생된 빛을 반사시켜 광 효율을 증가시킬 수 있으며, 상기 발광소자(100)에서 발생된 열을 외부로 배출시키는 역할을 할 수도 있다.The first
상기 발광소자(100)는 상기 몸체(120) 위에 배치되거나 상기 제1 리드전극(131) 또는 제2 리드전극(132) 위에 배치될 수 있다.The
상기 발광소자(100)는 상기 제1 리드전극(131) 및 제2 리드전극(132)과 와이어 방식, 플립칩 방식 또는 다이 본딩 방식 중 어느 하나에 의해 전기적으로 연결될 수도 있다. The
상기 몰딩부재(140)는 상기 발광소자(100)를 포위하여 상기 발광소자(100)를 보호할 수 있다. 또한, 상기 몰딩부재(140)에는 형광체가 포함되어 상기 발광소자(100)에서 방출된 광의 파장을 변화시킬 수 있다.The
실시 예에 따른 발광소자 또는 발광소자 패키지는 복수 개가 기판 위에 어레이될 수 있으며, 상기 발광소자 패키지의 광 경로 상에 광학 부재인 렌즈, 도광판, 프리즘 시트, 확산 시트 등이 배치될 수 있다. 이러한 발광소자 패키지, 기판, 광학 부재는 라이트 유닛으로 기능할 수 있다. 상기 라이트 유닛은 탑뷰 또는 사이드 뷰 타입으로 구현되어, 휴대 단말기 및 노트북 컴퓨터 등의 표시 장치에 제공되거나, 조명장치 및 지시 장치 등에 다양하게 적용될 수 있다. 또 다른 실시 예는 상술한 실시 예들에 기재된 발광소자 또는 발광소자 패키지를 포함하는 조명 장치로 구현될 수 있다. 예를 들어, 조명 장치는 램프, 가로등, 전광판, 전조등을 포함할 수 있다.A plurality of light emitting devices or light emitting device packages according to an embodiment may be arranged on a substrate, and an optical member such as a lens, a light guide plate, a prism sheet, and a diffusion sheet may be disposed on an optical path of the light emitting device package. The light emitting device package, the substrate, and the optical member may function as a light unit. The light unit may be implemented in a top view or side view type, and may be provided to display devices such as portable terminals and notebook computers, or may be variously applied to lighting devices and pointing devices. Another embodiment may be implemented as a lighting device including the light emitting device or the light emitting device package described in the above-described embodiments. For example, the lighting device may include a lamp, a street light, a signboard, and a headlight.
도 11은 실시예에 따른 조명장치의 분해 사시도이다.11 is an exploded perspective view of a lighting device according to an embodiment.
도 11을 참조하면, 실시 예에 따른 조명 장치는 커버(2100), 광원 모듈(2200), 방열체(2400), 전원 제공부(2600), 내부 케이스(2700), 소켓(2800)을 포함할 수 있다. 또한, 실시 예에 따른 조명 장치는 부재(2300)와 홀더(2500) 중 어느 하나 이상을 더 포함할 수 있다. 상기 광원 모듈(2200)은 실시 예에 따른 발광소자 패키지를 포함할 수 있다.Referring to FIG. 11, the lighting device according to the embodiment may include a
예컨대, 상기 커버(2100)는 벌브(bulb) 또는 반구의 형상을 가지며, 속이 비어 있고, 일 부분이 개구된 형상으로 제공될 수 있다. 상기 커버(2100)는 상기 광원 모듈(2200)과 광학적으로 결합될 수 있다. 예를 들어, 상기 커버(2100)는 상기 광원 모듈(2200)로부터 제공되는 빛을 확산, 산란 또는 여기 시킬 수 있다. 상기 커버(2100)는 일종의 광학 부재일 수 있다. 상기 커버(2100)는 상기 방열체(2400)와 결합될 수 있다. 상기 커버(2100)는 상기 방열체(2400)와 결합하는 결합부를 가질 수 있다.For example, the
상기 커버(2100)의 내면에는 유백색 도료가 코팅될 수 있다. 유백색의 도료는 빛을 확산시키는 확산재를 포함할 수 있다. 상기 커버(2100)의 내면의 표면 거칠기는 상기 커버(2100)의 외면의 표면 거칠기보다 크게 형성될 수 있다. 이는 상기 광원 모듈(2200)로부터의 빛이 충분히 산란 및 확산되어 외부로 방출시키기 위함이다.A milky white coating may be coated on the inner surface of the
상기 커버(2100)의 재질은 유리(glass), 플라스틱, 폴리프로필렌(PP), 폴리에틸렌(PE), 폴리카보네이트(PC) 등일 수 있다. 여기서, 폴리카보네이트는 내광성, 내열성, 강도가 뛰어나다. 상기 커버(2100)는 외부에서 상기 광원 모듈(2200)이 보이도록 투명할 수 있고, 불투명할 수 있다. 상기 커버(2100)는 블로우(blow) 성형을 통해 형성될 수 있다.The material of the
상기 광원 모듈(2200)은 상기 방열체(2400)의 일 면에 배치될 수 있다. 따라서, 상기 광원 모듈(2200)로부터의 열은 상기 방열체(2400)로 전도된다. 상기 광원 모듈(2200)은 광원부(2210), 연결 플레이트(2230), 커넥터(2250)를 포함할 수 있다.The
상기 부재(2300)는 상기 방열체(2400)의 상면 위에 배치되고, 복수의 광원부(2210)들과 커넥터(2250)이 삽입되는 가이드홈(2310)들을 갖는다. 상기 가이드홈(2310)은 상기 광원부(2210)의 기판 및 커넥터(2250)와 대응된다.The
상기 부재(2300)의 표면은 빛 반사 물질로 도포 또는 코팅된 것일 수 있다. 예를 들면, 상기 부재(2300)의 표면은 백색의 도료로 도포 또는 코팅된 것일 수 있다. 이러한 상기 부재(2300)는 상기 커버(2100)의 내면에 반사되어 상기 광원 모듈(2200)측 방향으로 되돌아오는 빛을 다시 상기 커버(2100) 방향으로 반사한다. 따라서, 실시 예에 따른 조명 장치의 광 효율을 향상시킬 수 있다.The surface of the
상기 부재(2300)는 예로서 절연 물질로 이루어질 수 있다. 상기 광원 모듈(2200)의 연결 플레이트(2230)는 전기 전도성의 물질을 포함할 수 있다. 따라서, 상기 방열체(2400)와 상기 연결 플레이트(2230) 사이에 전기적인 접촉이 이루어질 수 있다. 상기 부재(2300)는 절연 물질로 구성되어 상기 연결 플레이트(2230)와 상기 방열체(2400)의 전기적 단락을 차단할 수 있다. 상기 방열체(2400)는 상기 광원 모듈(2200)로부터의 열과 상기 전원 제공부(2600)로부터의 열을 전달받아 방열한다.The
상기 홀더(2500)는 내부 케이스(2700)의 절연부(2710)의 수납홈(2719)을 막는다. 따라서, 상기 내부 케이스(2700)의 상기 절연부(2710)에 수납되는 상기 전원 제공부(2600)는 밀폐된다. 상기 홀더(2500)는 가이드 돌출부(2510)를 갖는다. 상기 가이드 돌출부(2510)는 상기 전원 제공부(2600)의 돌출부(2610)가 관통하는 홀을 갖는다.The
상기 전원 제공부(2600)는 외부로부터 제공받은 전기적 신호를 처리 또는 변환하여 상기 광원 모듈(2200)로 제공한다. 상기 전원 제공부(2600)는 상기 내부 케이스(2700)의 수납홈(2719)에 수납되고, 상기 홀더(2500)에 의해 상기 내부 케이스(2700)의 내부에 밀폐된다.The
상기 전원 제공부(2600)는 돌출부(2610), 가이드부(2630), 베이스(2650), 연장부(2670)를 포함할 수 있다.The
상기 가이드부(2630)는 상기 베이스(2650)의 일 측에서 외부로 돌출된 형상을 갖는다. 상기 가이드부(2630)는 상기 홀더(2500)에 삽입될 수 있다. 상기 베이스(2650)의 일 면 위에 다수의 부품이 배치될 수 있다. 다수의 부품은 예를 들어, 외부 전원으로부터 제공되는 교류 전원을 직류 전원으로 변환하는 직류변환장치, 상기 광원 모듈(2200)의 구동을 제어하는 구동칩, 상기 광원 모듈(2200)을 보호하기 위한 ESD(ElectroStatic discharge) 보호 소자 등을 포함할 수 있으나 이에 대해 한정하지는 않는다.The
상기 연장부(2670)는 상기 베이스(2650)의 다른 일 측에서 외부로 돌출된 형상을 갖는다. 상기 연장부(2670)는 상기 내부 케이스(2700)의 연결부(2750) 내부에 삽입되고, 외부로부터의 전기적 신호를 제공받는다. 예컨대, 상기 연장부(2670)는 상기 내부 케이스(2700)의 연결부(2750)의 폭과 같거나 작게 제공될 수 있다. 상기 연장부(2670)에는 "+ 전선"과 "- 전선"의 각 일 단이 전기적으로 연결되고, "+ 전선"과 "- 전선"의 다른 일 단은 소켓(2800)에 전기적으로 연결될 수 있다.The
상기 내부 케이스(2700)는 내부에 상기 전원 제공부(2600)와 함께 몰딩부를 포함할 수 있다. 몰딩부는 몰딩 액체가 굳어진 부분으로서, 상기 전원 제공부(2600)가 상기 내부 케이스(2700) 내부에 고정될 수 있도록 한다.The
이상에서 실시예들에 설명된 특징, 구조, 효과 등은 적어도 하나의 실시예에 포함되며, 반드시 하나의 실시예에만 한정되는 것은 아니다. 나아가, 각 실시예에서 예시된 특징, 구조, 효과 등은 실시예들이 속하는 분야의 통상의 지식을 가지는 자에 의해 다른 실시예들에 대해서도 조합 또는 변형되어 실시 가능하다. 따라서 이러한 조합과 변형에 관계된 내용들은 실시예의 범위에 포함되는 것으로 해석되어야 할 것이다.Features, structures, and effects described in the above embodiments are included in at least one embodiment, and are not necessarily limited to only one embodiment. Furthermore, features, structures, effects, and the like exemplified in each embodiment may be combined or modified for other embodiments by a person having ordinary knowledge in the field to which the embodiments belong. Therefore, contents related to such combinations and modifications should be interpreted as being included in the scope of the embodiments.
이상에서 실시예를 중심으로 설명하였으나 이는 단지 예시일 뿐 실시예를 한정하는 것이 아니며, 실시예가 속하는 분야의 통상의 지식을 가진 자라면 본 실시예의 본질적인 특성을 벗어나지 않는 범위에서 이상에 예시되지 않은 여러 가지의 변형과 응용이 가능함을 알 수 있을 것이다. 예를 들어, 실시예에 구체적으로 나타난 각 구성 요소는 변형하여 실시할 수 있는 것이다. 그리고 이러한 변형과 응용에 관계된 차이점들은 첨부된 청구 범위에서 설정하는 실시예의 범위에 포함되는 것으로 해석되어야 할 것이다.Although the embodiments have been mainly described in the above, these are merely examples and do not limit the embodiments, and those who have ordinary knowledge in the field to which the embodiments belong may not be exemplified in the above without departing from the essential characteristics of this embodiment. You will see that it is possible to modify and apply branches. For example, each component specifically shown in the embodiments can be implemented by modification. And differences related to these modifications and applications should be construed as being included in the scope of the embodiments set forth in the appended claims.
제1 도전형 반도체층(11), 활성층(12), 제2 도전형 반도체층(13),
InxAlyGa1 -x- yN/GaN층(17), InpGa1 - pN 웰층(12a), GaN 배리어층(12b),The first conductivity
In x Al y Ga 1 -x- y N /
Claims (13)
상기 본딩층 상에 배치되는 금속층;
상기 금속층 상에 배치되는 반사층;
상기 반사층 및 상기 금속층 상에 배치되는 채널층;
상기 채널층 및 상기 반사층 사이에 배치되는 오믹접촉 패턴;
상기 오믹접촉 패턴 상에 배치되는 제2 도전형 반도체층;
상기 제2 도전형 반도체층 상에 배치되는 활성층;
상기 활성층 상에 배치되는 InxAlyGa1-x-yN/GaN층(단, 0<x<1, 0<y<1);
상기 InxAlyGa1-x-yN/GaN층 상에 배치되는 제1 도전형 반도체층; 및
상기 제1 도전형 반도체층 상에 배치되는 패드 전극을 포함하고,
상기 활성층은 InpGa1-pN 웰층(단, 0<p<1) 및 GaN 배리어층을 포함하고,
상기 InxAlyGa1-x-yN/GaN층(단, 0<x<1, 0<y<1)에서 In의 조성범위(x)는 0<x≤0.13이고, Al의 조성범위(y)는 0<y≤0.02이고,
상기 InxAlyGa1-x-yN/GaN층에서 In의 조성(x)과 상기 웰층의 In의 조성(p) 비율 관계는 0.75≤x/p≤1.0 범위이고,
상기 InxAlyGa1-x-yN/GaN층의 InxAlyGa1-x-yN의 두께는 상기 InxAlyGa1-x-yN/GaN층의 GaN층의 두께보다 얇고,
상기 활성층의 InpGa1-pN 웰층의 두께는 상기 활성층의 GaN 배리어층의 두께보다 얇고,
상기 제2 도전형 반도체층은 상기 InxAlyGa1-x-yN/GaN층 및 상기 활성층과 동일한 수평 방향 너비를 가지고,
상기 InxAlyGa1-x-yN/GaN층의 최상면은 상기 금속층의 최상면보다 상부에 배치되고 상기 채널층의 최상면보다 하부에 배치되는 발광소자.A bonding layer disposed on the support member;
A metal layer disposed on the bonding layer;
A reflective layer disposed on the metal layer;
A channel layer disposed on the reflective layer and the metal layer;
An ohmic contact pattern disposed between the channel layer and the reflective layer;
A second conductivity type semiconductor layer disposed on the ohmic contact pattern;
An active layer disposed on the second conductivity type semiconductor layer;
An In x Al y Ga 1-xy N / GaN layer disposed on the active layer (however, 0 <x <1, 0 <y <1);
A first conductivity type semiconductor layer disposed on the In x Al y Ga 1-xy N / GaN layer; And
It includes a pad electrode disposed on the first conductive semiconductor layer,
The active layer includes an In p Ga 1-p N well layer (however, 0 <p <1) and a GaN barrier layer,
In the In x Al y Ga 1-xy N / GaN layer (however, the composition range (x) of In in 0 <x <1, 0 <y <1) is 0 <x≤0.13, and the composition range of Al (y ) Is 0 <y≤0.02,
In the In x Al y Ga 1-xy N / GaN layer, the relationship between the composition (x) of In and the composition (p) of In of the well layer is in the range of 0.75 ≤ x / p ≤ 1.0,
It said In x Al y Ga 1-xy N / In x Al y Ga 1-xy N wherein the thickness of the GaN layer is In x Al y Ga 1-xy N / GaN layer of a thickness thinner than that of the GaN layer,
The thickness of the In p Ga 1-p N well layer of the active layer is thinner than the thickness of the GaN barrier layer of the active layer,
The second conductivity type semiconductor layer has the same horizontal width as the In x Al y Ga 1-xy N / GaN layer and the active layer,
The top surface of the In x Al y Ga 1-xy N / GaN layer is disposed above the top surface of the metal layer and below the top surface of the channel layer.
상기 InxAlyGa1 -x- yN/GaN층은
언도프트층(un-doped layer)인 발광소자.According to claim 1,
The In x Al y Ga 1 -x- y N / GaN layer
A light emitting device that is an undoped layer.
상기 InxAlyGa1 -x- yN/GaN층은
제1 도전형으로 도핑된 층인 발광소자.According to claim 1,
The In x Al y Ga 1 -x- y N / GaN layer
A light emitting device that is a layer doped with a first conductivity type.
상기 InxAlyGa1 -x- yN/GaN층은
초격자 구조를 포함하는 발광소자.According to claim 1,
The In x Al y Ga 1 -x- y N / GaN layer
A light emitting device comprising a superlattice structure.
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Legal Events
Date | Code | Title | Description |
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A201 | Request for examination | ||
E902 | Notification of reason for refusal | ||
E701 | Decision to grant or registration of patent right | ||
GRNT | Written decision to grant |