KR101892690B1 - IFF and method for detecting peak power of transmitting/receiving signal - Google Patents

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Abstract

An identification friend or foe (IFF) for transmitting/receiving peak power and a method for measuring the transmitting/receiving peak power are provided. An identification friend or foe (IFF) for the transmitting/receiving peak power of at least one of an active phased array radar and a passive phased array radar provides question signals for each of N channels, receives the provided question signals and the reception signals reflected from a target through a feedback path and performs down conversion on them, and detects peak power for the down-converted question signals and the reception signals using the delay time of the down-converted question signals and of the reception signals. The IFF includes a plurality of question providing and peak power detectors; a plurality of band convertors; and a plurality of transceivers.

Description

송수신 첨두전력 측정을 위한 피아식별 질문기 및 그의 첨두전력 측정 방법{IFF and method for detecting peak power of transmitting/receiving signal} FIELD OF THE INVENTION [0001] The present invention relates to a peer identification interrogator for measuring transmission power and peak power,

본 발명은 송수신 첨두전력 측정을 위한 피아식별 질문기 및 그의 첨두전력 측정 방법에 관한 것으로서, 보다 상세하게는, 단일 송수신모듈에서 N개의 채널에 대해 제공되는 질문신호와 그의 수신신호에 대해 첨두전력을 측정할 수 있는 송수신 첨두전력 측정을 위한 피아식별 질문기 및 그의 첨두전력 측정 방법에 관한 것이다.The present invention relates to a peer identification interrogator for measuring transmission power and peak power and a peak power measurement method thereof. More particularly, the present invention relates to a query signal provided for N channels in a single transmission / The present invention relates to a peer identification interrogator for measuring transmit / receive peak power and a method of measuring peak power thereof.

국방 지상방어체계에서 레이더 시스템의 피아식별 기능은 이동하는 항공기에 아군인지 판별하는 질문 신호를 방사하여 해당 질문 신호에 알맞은 코드 정보를 포함한 RF 신호를 수신하고, 이로부터 아군 여부를 식별하는 기능이다.In the Defense Defense System, the identification function of the radar system identifies whether the aircraft is allied to the moving aircraft, receives the RF signal including the code information suitable for the question signal, and identifies the alliance.

최근 전력화를 계획하고 있는 레이더는 다수의 송수신 모듈을 포함한 능동위상배열(AESA: Active Electronically Scanned Array Radar) 구조를 기반으로 설계한다. 능동위상배열 레이더는 수동위상배열(PESA: Passive Electronically Scanned Array) 구조와는 달리 단일 안테나 복사소자를 통해 방사하는 RF신호에 대한 위상과 크기를 각각 조절 가능하다. The radar, which plans to power up recently, is based on an Active Electronically Scanned Array Radar (AESA) structure including a number of transmit and receive modules. The active phased array radar can adjust the phase and size of the RF signal radiated through a single antenna radiation element, unlike a passive electronically scanned array (PESA) structure.

또한, 송/수신 경로를 각 채널 별로 교체 및 점검하는 것이 용이하여, 전 세계적으로 지상용, 해상용, 공중용 레이더의 안테나시스템은 능동위상배열 구조를 바탕으로 설계하는 추세이다. In addition, it is easy to replace and check the transmission / reception path for each channel, and the antenna system of the ground, maritime, and aerial radars is designed around an active phased array structure all over the world.

피아식별 기능 역시 능동위상배열 구조로 설계할 때의 이점은 언급한 바와 같다.The advantages of designing the peer identification function in the active phased array structure are also mentioned.

일반적으로 피아식별 기능을 위한 시스템은, 송신 펄스 정보를 제어하고 반사된 신호 정보를 처리하는 피아식별 질문기(Interrogator, 또는 IFF: Identification Friend or Foe), 질문기로부터 받은 신호를 증폭하여 표적을 향해 수하하고 반사된 신호를 받는 피아식별안테나로 구성된다. In general, the system for the peer identification function comprises: an interrogator (or IFF: Identification Friend or Foe) that controls the transmitted pulse information and processes the reflected signal information; And a peer identification antenna receiving the reflected and reflected signals.

질문기에는 신호처리를 위한 DSP(Digital Signal Processor)와 송신/수신 모듈이 포함되어 있으며, 다수의 복사소자 각각의 위상과 크기를 제어하기 위해 다수의 송신/수신모듈을 사용할 수 있다. The interrogator includes a DSP (Digital Signal Processor) for signal processing and a transmission / reception module, and a plurality of transmission / reception modules can be used to control the phase and size of each of the plurality of radiation elements.

기존에는 질문 신호 정보를 포함한 RF 신호의 전력을 증폭하여 안테나로 출력하여 송출하고, 송출된 질문 신호는 다시 수신되어 첨두전력 검출에 사용된다. 즉, 피아식별 질문기는 디지털화된 질문 신호를 아날로그 신호로 변환하여 주파수를 상향조절한 후 전력증폭기로 전달한다. 전력 증폭기를 통해 증폭된 신호는 커플링되어 하향 변환부가 수신하여 낮은 주파수 대역으로 옮겨진 후 첨두 전력 측정에 사용된다. 그리고, 하향변환된 아날로그 송신신호를 디지털화하여 전력범위를 계산하여 첨두전력값이 필요한 모듈에서 해당 데이터를 수신한다.In the past, the power of the RF signal including the question signal information is amplified and outputted to the antenna, and the transmitted question signal is received again and used for peak power detection. That is, the PI interrogator transforms the digitized interrogation signal into an analog signal, up-regulates the frequency, and delivers it to the power amplifier. The signal amplified by the power amplifier is coupled, the down-converted signal is received, and the signal is transferred to the low frequency band. The down-converted analog transmission signal is digitized to calculate the power range, and the corresponding data is received from a module requiring a peak power value.

그러나, 기존의 질문기를 이용하여 첨두전력을 측정하는 방식 및/또는 구조는 능동위상배열 구조가 아닌 수동위상배열(PESA) 구조에 적합하다. 특히, 기존의 기술은 단일 송신모듈의 전력 증폭기와 송신 경로에 해당하는 첨두전력 측정만을 다루고 있다. 현재 대부분의 레이더 시스템은 능동위상배열 구조를 채택하고 있기 때문에, 각 채널 별 송신출력의 첨두전력에 대한 검출을 고려해야 한다.However, the method and / or structure for measuring the peak power using a conventional interrogator is suitable for a passive phased array (PESA) structure, not an active phased array structure. In particular, existing techniques only deal with peak power measurements corresponding to the power amplifier and transmission path of a single transmit module. Since most current radar systems employ active phased array architecture, the detection of the peak power of the transmit power for each channel must be considered.

또한, 기존의 첨두전력을 측정하는 방식 및/또는 구조는 송신 경로(즉, 송출된 신호)의 첨두전력만 고려할 뿐 수신 경로(즉, 수신된 신호)의 첨두전력에 대해서는 고려하고 있지 않다. 수동위상배열 레이더 또는 능동위상배열 레이더에서는 송신/수신경로를 하나의 모듈로 제어하고 있다. 따라서, 송신 경로의 출력뿐만 아니라 수신 경로의 출력을 측정하여, 표적으로부터 반사된 신호에 대한 수신 경로의 검증 역시 필요하다. In addition, the conventional method and / or structure for measuring the peak power considers only the peak power of the transmission path (i.e., the transmitted signal) but does not consider the peak power of the received path (i.e., the received signal). In a passive phased array radar or active phased array radar, the transmit / receive path is controlled by a single module. Therefore, it is also necessary to measure the output of the receive path as well as the output of the transmit path, and verify the receive path for the reflected signal from the target.

국내 등록특허 제10-1838210호(2018.03.07. 등록)Domestic registered patent No. 10-1838210 (registered on July, 2018)

전술한 문제점을 해결하기 위하여 본 발명이 이루고자 하는 기술적 과제는, 현재 대부분의 레이더 시스템은 능동 위상 배열 구조를 채택하고 있고, 다수의 송수신 모듈, 즉, 다수의 채널들 별로 신호를 송출하므로, 각 채널 별 송신 출력에 대한 첨두전력을 검출할 수 있는 송수신 첨두전력 측정을 위한 피아식별 질문기 및 그의 첨두전력 측정 방법을 제시하는 데 있다.SUMMARY OF THE INVENTION In order to solve the above-described problems, the present invention has been made in view of the above problems, and it is an object of the present invention to provide a radar system, This paper proposes a peer identification interrogator and its peak power measurement method for the transmission power peak power measurement that can detect the peak power for each transmission power.

또한, 본 발명이 이루고자 하는 다른 기술적 과제는, 수동위상배열 레이더 또는 능동위상배열 레이더에서 송신 경로 뿐만 아니라 수신 경로에 대해서도 출력 측정 및 첨두전력 검출을 적용함으로써, 표적으로부터 반사된 신호에 대한 수신 경로에 대해서도 검증할 수 있는 송수신 첨두전력 측정을 위한 피아식별 질문기 및 그의 첨두전력 측정 방법을 제시하는 데 있다.Another aspect of the present invention is to provide a method and apparatus for measuring the power of a signal received from a target by applying power measurement and peak power detection to a receive path as well as a transmit path in a passive phased array radar or active phased array radar This paper proposes a peer identification interrogator and its peak power measurement method for the transmission power peak power measurement.

또한, 본 발명이 이루고자 하는 다른 기술적 과제는, 왜란으로 인해 RF 신호가 흔들릴 때 송출 신호 또는 수신 신호의 예상 지연시간을 보다 정확히 측정하기 위해, 레지스터에 저장된 고정 지연시간에 대한 다수의 데이터를 제공할 수 있는 송수신 첨두전력 측정을 위한 피아식별 질문기 및 그의 첨두전력 측정 방법을 제시하는 데 있다. Another object of the present invention is to provide a method and apparatus for providing a plurality of data on a fixed delay time stored in a register in order to more accurately measure an expected delay time of a transmission signal or a reception signal when an RF signal is shaken due to a disturbance This paper proposes a peer identification interrogator and its peak power measurement method for the measurement of transmit power and peak power.

본 발명의 해결과제는 이상에서 언급된 것들에 한정되지 않으며, 언급되지 아니한 다른 해결과제들은 아래의 기재로부터 당업자에게 명확하게 이해될 수 있을 것이다.The solution of the present invention is not limited to those mentioned above, and other solutions not mentioned can be clearly understood by those skilled in the art from the following description.

전술한 기술적 과제를 해결하기 위한 수단으로서, 본 발명의 실시 예에 따르면, 능동위상배열 레이다 및 수동위상배열 레이다 중 적어도 하나의 송수신 첨두전력 측정을 위한 피아식별 질문기는, N개의 채널 별로 질문신호들을 제공하는 다수의 질문 제공 및 첨두전력 검출부들; 상기 다수의 질문 제공 및 첨두전력 검출부들에서 제공되는 질문신호들의 주파수 대역을 상향변환하는 다수의 대역 변환부들; 및 상기 상향변환된 질문신호들의 전력을 증폭하여 안테나로 송출하고, 상기 송출된 질문신호들과 표적으로부터 반사되어 수신된 수신신호들을 궤환 경로를 통해 상기 다수의 대역 변환부들로 제공하는 다수의 송수신기들;을 포함하고, 상기 다수의 대역 변환부들은 상기 수신된 질문신호들과 수신신호들의 주파수대역을 하향변환하고, 상기 다수의 질문 제공 및 첨두전력 검출부들은, 상기 하향변환된 질문신호들과 수신신호들의 딜레이 시간을 각각 검출하고, 상기 각각 검출된 딜레이 시간을 이용하여 상기 하향변환된 질문신호들 및 상기 하향변환된 수신신호들에 대한 첨두전력을 검출할 수 있다.According to an aspect of the present invention, there is provided a peer identification interrogator for measuring transmit and receive peak power of at least one of an active phased array radar and a passive phased array radar, Providing a plurality of questions and peak power detectors; A plurality of band converters for up-converting a frequency band of the question signals provided from the plurality of question providing and peak power detecting units; And a plurality of transceivers for amplifying the power of the up-converted interrogated signals and transmitting the amplified interrogated signals to an antenna, and for providing the received signals reflected from the target to the plurality of band transformers through a feedback path, Wherein the plurality of band converters downconvert the frequency bands of the received interrogating signals and the received signals and the plurality of interrogating and peak power detectors are operable to receive the down- And detects the peak power of the down-converted question signals and the down-converted received signals using the detected delay times, respectively.

상기 다수의 송수신기들 각각은, 상기 상향변환된 질문신호의 전력을 증폭하는 전력 증폭기; 및 상기 증폭된 질문신호가 상기 안테나로 송출된 후 상기 표적으로부터 반사된 수신신호에 대해 저잡음의 전력을 증폭하는 저잡음 증폭기;를 포함할 수 있다.Each of the plurality of transceivers comprising: a power amplifier for amplifying power of the up-converted Q signal; And a low noise amplifier amplifying the low noise power of the received signal reflected from the target after the amplified interrogation signal is sent to the antenna.

상기 다수의 대역 변환부들은 각각, 상기 질문 제공 및 첨두전력 검출부에서 제공되는 질문신호의 주파수 대역을 상향변환하는 상향변환부; 상기 전력 증폭기에서 증폭되어 안테나로 송출된 질문신호를 상기 궤환 경로를 통해 제공받아 주파수 대역을 하향변환하는 송신 하향변환부; 및 상기 저잡음 증폭기에서 증폭된 수신신호의 주파수 대역을 하향변환하는 수신 하향변환부;를 포함할 수 있다.Wherein the plurality of band converters comprises: an up-converting unit for up-converting a frequency band of a question signal provided by the question providing and peak power detecting unit; A down converter for downconverting a frequency band by receiving a question signal amplified by the power amplifier and sent to an antenna through the feedback path; And a receiving downconverting unit for downconverting the frequency band of the received signal amplified by the low noise amplifier.

상기 다수의 질문 제공 및 첨두전력 검출부들은 각각, 상기 질문신호를 아날로그 신호로 변환하여 상기 상향변환부로 출력하는 DAC(Digital Analog Converter); 상기 송신 하향변환부에서 하향변환된 질문신호의 펄스와 기설정된 기준 송출 펄스를 비교하여 상기 질문신호의 딜레이 시간(이하, '질문 딜레이 시간'이라 한다)을 검출하고, 상기 검출된 질문 딜레이 시간을 이용하여 상기 하향변환된 질문신호의 첨두전력을 검출하는 송신 첨두전력 검출부; 및 상기 수신 하향변환부에서 하향변환된 수신신호의 펄스와 기설정된 기준 수신 펄스를 비교하여 상기 수신신호의 딜레이 시간(이하, '수신 딜레이 시간'이라 한다)을 검출하고, 상기 검출된 수신 딜레이 시간을 이용하여 상기 하향변환된 수신신호의 첨두전력을 검출하는 수신 첨두전력 검출부;를 포함할 수 있다.Wherein each of the plurality of question providing and peak power detecting units includes a DAC (Digital Analog Converter) for converting the question signal into an analog signal and outputting the analog signal to the up conversion unit; The transmission down-converter detects a delay time of the question signal (hereinafter, referred to as 'question delay time') by comparing a pulse of the down-converted question signal with a predetermined reference dispatch pulse, A transmitted peak power detector for detecting a peak power of the down-converted question signal; And a receiving unit configured to detect a delay time of the received signal by comparing a pulse of the down-converted received signal in the receiving down-conversion unit with a preset reference receiving pulse (hereinafter, referred to as a receiving delay time) And a receiving peak power detector for detecting the peak power of the down-converted received signal using the received peak power detector.

상기 송신 첨두전력 검출부는, 상기 하향변환된 질문신호의 전력을 전압으로 전환시켜 출력하는 디텍터; 상기 디텍터로부터 출력되는 전압에 기초하여 실제 질문 펄스를 생성하는 실제 펄스 생성기; 상기 기설정된 기준 송출 펄스를 생성하는 기준 펄스 생성기; 상기 실제 질문 펄스와 상기 기준 송출 펄스를 비교하여 딜레이 구간이 발생하면, 상기 딜레이 구간에 해당하는 송출 딜레이 시간을 카운팅하는 딜레이 검출기; 상기 디텍터로부터 출력되는 질문신호에 대한 전압을 디지털 신호로 변환하는 ADC(Analog Digital Converter); 및 상기 ADC에서 변환되어 순차적으로 입력되는 디지털 신호들 중 상기 기준 송출 펄스가 하이(high)가 되는 구간의 중간 시간값에 해당하는 시점에서 상기 카운팅된 송출 딜레이 시간만큼 경과한 신호에 대한 첨두 전력값을 출력하는 피크 검출기;를 포함할 수 있다.Wherein the transmission peak power detection unit comprises: a detector for converting the power of the down-converted Q signal into a voltage and outputting the converted voltage; An actual pulse generator for generating an actual question pulse based on a voltage output from the detector; A reference pulse generator for generating the predetermined reference transmission pulse; A delay detector for comparing the actual question pulse with the reference dispatch pulse to count a dispatch delay time corresponding to the delay interval when a delay interval occurs; An ADC (Analog Digital Converter) for converting the voltage of the question signal output from the detector into a digital signal; And a peak power value for a signal that has elapsed by the counted transmission delay time at a time point corresponding to an intermediate time value of an interval during which the reference transmission pulse is high, among the digital signals sequentially converted by the ADC, And a peak detector outputting the output signal.

상기 수신 첨두전력 검출부는, 상기 하향변환된 수신신호의 전력을 전압으로 전환시켜 출력하는 디텍터; 상기 디텍터로부터 출력되는 전압에 기초하여 실제 수신 펄스를 생성하는 실제 펄스 생성기; 상기 기설정된 기준 수신 펄스를 생성하는 기준 펄스 생성기; 상기 실제 수신 펄스와 상기 기준 수신 펄스를 비교하여 딜레이 구간이 발생하면, 상기 딜레이 구간에 해당하는 수신 딜레이 시간을 카운팅하는 딜레이 검출기; 상기 디텍터로부터 출력되는 수신신호에 대한 전압을 디지털 신호로 변환하는 ADC(Analog Digital Converter); 및 상기 ADC에서 변환되어 순차적으로 입력되는 디지털 신호 중 상기 기준 수신 펄스가 하이(high)가 되는 구간의 중간 시간값에 해당하는 시점에서 상기 카운팅된 수신 딜레이 시간만큼 경과한 신호에 대한 첨두 전력값을 출력하는 피크 검출기;를 포함할 수 있다.Wherein the receiving peak power detecting unit comprises: a detector for converting the power of the down-converted received signal into a voltage and outputting the voltage; An actual pulse generator for generating an actual reception pulse based on a voltage output from the detector; A reference pulse generator for generating the predetermined reference reception pulse; A delay detector for comparing the actual reception pulse with the reference reception pulse to count a reception delay time corresponding to the delay interval when a delay interval occurs; An ADC (Analog Digital Converter) for converting the voltage of the received signal output from the detector into a digital signal; And a peak power value for a signal that has passed the counted reception delay time at a time point corresponding to an intermediate time value of a period during which the reference reception pulse is high, And a peak detector outputting the output signal.

한편, 본 발명의 다른 실시 예에 따르면, 피아식별 질문기의 송수신 첨두전력 측정을 위한 방법은, (A) 상기 피아식별 질문기가, N개의 채널 별로 질문신호들을 제공하는 단계; (B) 상기 피아식별 질문기가, 상기 (A) 단계에서 제공된 질문신호들의 주파수 대역을 상향변환하는 단계; (C) 상기 피아식별 질문기가, 상기 상향변환된 질문신호들의 전력을 증폭하여 안테나로 송출하는 단계; (D) 상기 피아식별 질문기가, 상기 송출된 질문신호들을 궤한 경로를 통해 제공받아 N개의 채널 별로 송신출력에 대한 첨두전력을 검출하는 단계; 및 (E) 상기 피아식별 질문기가, 표적으로부터 반사되어 수신된 수신신호들을 궤환 경로를 통해 제공받아 N개의 채널 별로 수신출력에 대한 첨두전력을 검출하는 단계;를 포함한다.According to another embodiment of the present invention, there is provided a method for transmitting / receiving peak power measurement of a peer identification interrogator, comprising the steps of: (A) providing the question signals for each of N channels; (B) up-converting the frequency band of the question signals provided in the step (A) by the peer identification interrogator; (C) amplifying the power of the up-converted interrogation signals and transmitting the amplified power to the antenna; (D) receiving, by the peer identification interrogator, the sent question signals through a return path and detecting a peak power for a transmission output for each of the N channels; And (E) the peer identification interrogator receiving the received signals reflected from the target through the feedback path and detecting the peak power for the received output for each of the N channels.

상기 (D) 단계는, (D1) 상기 피아식별 질문기가, 상기 안테나로 송출된 질문신호를 상기 궤환 경로를 통해 제공받아 주파수 대역을 하향변환하는 단계; 및 (D2) 상기 피아식별 질문기가, 상기 하향변환된 질문신호의 펄스와 기설정된 기준 송출 펄스를 비교하여 상기 질문신호의 딜레이 시간(이하, '질문 딜레이 시간'이라 한다)을 검출하고, 상기 검출된 질문 딜레이 시간을 이용하여 상기 하향변환된 질문신호의 첨두전력을 검출하는 단계;를 포함한다.Wherein the step (D) includes the steps of: (D1) receiving the interrogation signal sent by the antenna through the feedback path and downconverting the frequency band; And (D2) the peer identification interrogator detects a delay time of the interrogation signal (hereinafter referred to as 'question delay time') by comparing a pulse of the down-converted interrogation signal with a predetermined reference transmission pulse, And a step of detecting the peak power of the down-converted Q signal using the Q delay time.

상기 (D2) 단계는, (D21) 상기 피아식별 질문기가, 상기 하향변환된 질문신호의 전력을 전압으로 전환시켜 출력하는 단계; (D22) 상기 피아식별 질문기가, 상기 (D21) 단계로부터 출력되는 전압에 기초하여 실제 질문 펄스를 생성하는 단계; (D23) 상기 피아식별 질문기가, 상기 기설정된 기준 송출 펄스를 생성하는 단계; (D24) 상기 피아식별 질문기가, 상기 실제 질문 펄스와 상기 기준 송출 펄스를 비교하여 딜레이 구간이 발생하면, 상기 딜레이 구간에 해당하는 질문 딜레이 시간을 카운팅하는 단계; (D25) 상기 피아식별 질문기가, 상기 디텍터로부터 출력되는 질문신호에 대한 전압을 디지털 신호로 변환하는 단계; 및 (D26) 상기 피아식별 질문기가, 상기 (D25)단계에서 변환되어 순차적으로 입력되는 디지털 신호들 중 상기 기준 송출 펄스가 하이(high)가 되는 구간의 중간 시간값에 해당하는 시점에서 상기 카운팅된 질문 딜레이 시간만큼 경과한 신호에 대한 첨두 전력값을 출력하는 단계;를 포함한다.Wherein the step (D2) comprises the steps of: (D21) converting the power of the down-converted question signal into a voltage and outputting the converted voltage; (D22) the PI questioner generates an actual question pulse based on the voltage output from the step (D21); (D23) the peer identification interrogator generating the predetermined reference emission pulse; (D24) comparing the actual question pulse with the reference dispatch pulse, and counting a question delay time corresponding to the delay interval when the delay interval occurs; (D25) converting the voltage of the question signal output from the detector into a digital signal; And (D26) the peer identification interrogator calculates the counted number at a time point corresponding to an intermediate time value of a period during which the reference transmission pulse is high, among the digital signals sequentially converted and input in the step (D25) And outputting a peak power value for a signal that has elapsed by the Q delay time.

상기 (E) 단계는, (E1) 상기 피아식별 질문기가, 상기 표적으로부터 반사되어 수신된 수신신호들의 전력을 증폭하는 단계; (E2) 상기 피아식별 질문기가, 상기 증폭된 수신신호들을 궤환 경로를 통해 제공받아 주파수 대역을 하향변환하는 단계; 및 (E3) 상기 피아식별 질문기가, 상기 하향변환된 수신신호의 펄스와 기설정된 기준 수신 펄스를 비교하여 상기 수신신호의 딜레이 시간(이하, '수신 딜레이 시간'이라 한다)을 검출하고, 상기 검출된 수신 딜레이 시간을 이용하여 상기 하향변환된 수신신호의 첨두전력을 검출하는 단계;를 포함한다.Wherein the step (E) comprises: (E1) amplifying the power of the received signals reflected from the target by the peer identification interrogator; (E2) receiving the amplified reception signals through the feedback path, and downconverting the frequency band; And (E3) the peer identification interrogator detects a delay time of the received signal by comparing a pulse of the down-converted received signal with a preset reference reception pulse, And detecting the peak power of the down-converted received signal using the received delay time.

상기 (E3) 단계는, (E31) 상기 피아식별 질문기가, 상기 하향변환된 수신신호의 전력을 전압으로 전환시켜 출력하는 단계; (E32) 상기 피아식별 질문기가, 상기 (D21) 단계로부터 출력되는 전압에 기초하여 실제 수신 펄스를 생성하는 단계; (E33) 상기 피아식별 질문기가, 상기 기설정된 기준 수신 펄스를 생성하는 단계; (E34) 상기 피아식별 질문기가, 상기 실제 수신 펄스와 상기 기준 수신 펄스를 비교하여 딜레이 구간이 발생하면, 상기 딜레이 구간에 해당하는 수신 딜레이 시간을 카운팅하는 단계; (E35) 상기 피아식별 질문기가, 상기 디텍터로부터 출력되는 수신신호에 대한 전압을 디지털 신호로 변환하는 단계; 및 (E36) 상기 피아식별 질문기가, 상기 (E35) 단계에서 변환되어 순차적으로 입력되는 디지털 신호들 중 상기 기준 수신 펄스가 하이(high)가 되는 구간의 중간 시간값에 해당하는 시점에서 상기 카운팅된 수신 딜레이 시간만큼 경과한 신호에 대한 첨두 전력값을 출력하는 단계;를 포함한다.The step (E3) comprises the steps of: (E31) converting the power of the down-converted received signal into a voltage and outputting the converted signal; (E32) the step of generating the actual reception pulse based on the voltage output from the step (D21); (E33) the peer identification interrogator generating the predetermined reference reception pulse; (E34) comparing the actual reception pulse with the reference reception pulse, and counting a reception delay time corresponding to the delay interval when a delay interval occurs; (E35) the step of converting the voltage of the received signal output from the detector into a digital signal; And (E36) the peer identification interrogator determines the number of times the reference reception pulse is counted at a time point corresponding to an intermediate time value of a period during which the reference reception pulse is high, among the digital signals sequentially converted and input in the step (E35) And outputting a peak power value for a signal that has elapsed by a reception delay time.

본 발명에 따르면, 능동위상배열 구조 또는 수동위상배열 구조를 채택하는 레이더 시스템에 있어서, 다수의 송수신 모듈, 즉, 다수의 채널들 별로 송출된 신호의 송신 출력에 대한 첨두전력을 검출할 수 있다.According to the present invention, in a radar system adopting an active phased array structure or a passive phased array structure, peak power for transmission outputs of signals transmitted by a plurality of transmission / reception modules, that is, a plurality of channels, can be detected.

또한, 본 발명에 따르면, 수동위상배열 레이더 또는 능동위상배열 레이더에서 송신 경로뿐만 아니라 수신 경로에 대해서도 출력 측정 및 첨두전력을 검출할 수 있어, 표적으로부터 반사된 신호에 대한 수신 경로에 대해서도 검증할 수 있으며, 해당 값이 저장된 피아식별 질문기의 운용분석 컴퓨터를 통해 확인하여 송신 혹은 수신에 문제가 생길 경우 출력 이상유무를 손쉽게 검증할 수 있다.Further, according to the present invention, it is possible to detect the output measurement and the peak power for the receive path as well as the transmit path in the passive phased array radar or the active phased array radar, and to verify the receive path for the reflected signal from the target And the operation analysis computer of the pier identification interrogator storing the corresponding value can confirm the output abnormality easily when there is a problem in transmission or reception.

또한, 본 발명에 따르면, 레지스터에 다수의 고정 지연시간을 저장하고 이를 이용함으로써 왜란으로 인해 RF 신호(즉, 송출 신호 또는 수신 신호)가 흔들리는 경우가 발생하여도 송출 신호 또는 수신 신호의 예상 지연시간을 보다 정확히 측정할 수 있다. In addition, according to the present invention, even if an RF signal (i.e., a transmission signal or a reception signal) is shaken due to a disturbance by storing and using a plurality of fixed delay times in a register, Can be measured more accurately.

또한, 본 발명에 따르면, 간단한 로직을 추가하는 것만으로도 송출 신호와 수신 신호에 대한 딜레이 타이밍을 감지할 수 있다. FPGA(Field Programmable Gate Array)를 사용하는 경우, 메모리의 용량을 아낄 수 있어 저용량의 메모리를 가진 저렴한 FPGA를 선택하더라도 운용모드 별 고정 지연시간을 저장하고 첨두전력 측정에 대해 동일한 효과를 얻을 수 있으므로 결과적으로 대량 양산이 필요한 송수신모듈의 단가를 줄일 수 있다. 또한, 불필요한 추가 메모리 칩을 사용하지 않음으로써 모듈 당 가격을 절감하고 PCB(Printed Circuit Board)의 공간활용도를 높일 수 있다. Also, according to the present invention, it is possible to detect a delay timing of a transmission signal and a reception signal by adding simple logic. If FPGA (Field Programmable Gate Array) is used, the memory capacity can be saved, so even if an inexpensive FPGA with low capacity memory is selected, the fixed delay time for each operation mode can be stored and the same effect can be obtained for peak power measurement. , It is possible to reduce the unit cost of the transmission / reception module which requires mass production. In addition, by not using unnecessary additional memory chips, it is possible to reduce the cost per module and increase the space utilization of the printed circuit board (PCB).

본 발명의 효과는 이상에서 언급된 것들에 한정되지 않으며, 언급되지 아니한 다른 효과들은 아래의 기재로부터 당업자에게 명확하게 이해될 수 있을 것이다.The effects of the present invention are not limited to those mentioned above, and other effects not mentioned can be clearly understood by those skilled in the art from the following description.

도 1은 본 발명의 일 실시 예에 따른 송수신 첨두전력 측정을 위한 피아식별 질문기를 도시한 도면,
도 2는 본 발명의 실시 예에서 사용되는 기준 송출 펄스와 기준 수신 펄스를 설명하기 위한 도면,
도 3은 피아식별 레이다의 운용모드 별 기준 송출 펄스와 기준 수신 펄스를 도시한 도면,
도 4는 피아식별 질문기 중 제1질문제공 및 첨두전력 검출부, 제1대역 변환부 및 제1송수신기를 도시한 블록도,
도 5는 본 발명의 실시 예에 따른 제1송신 첨두전력 검출부를 도시한 블록도,
도 6은 기준 송출 펄스(A), 실제 질문 펄스(A_Delay) 및 실제 딜레이 펄스(Delay)의 일 예를 도시한 도면,
도 7은 도 5에 도시된 딜레이 검출기의 회로도를 간단히 도시한 도면,
도 8은 본 발명의 다른 실시 예에 따른 송수신 첨두전력 측정을 위한 피아식별 질문기를 도시한 도면, 그리고,
도 9 내지 도 11은 본 발명의 실시 예에 따른 피아식별 질문기의 송수신 첨두전력 측정을 위한 방법을 도시한 흐름도이다.
FIG. 1 illustrates a peer identification interrogator for transmitting / receiving peak power measurement according to an embodiment of the present invention.
FIG. 2 is a view for explaining a reference transmission pulse and a reference reception pulse used in an embodiment of the present invention; FIG.
3 is a diagram showing a reference transmission pulse and a reference reception pulse for each operating mode of the peer identification radar,
FIG. 4 is a block diagram showing a first question providing unit and a peak power detecting unit, a first band converting unit, and a first transceiver,
5 is a block diagram illustrating a first transmission peak power detector according to an embodiment of the present invention.
6 is a diagram showing an example of the reference dispatch pulse A, the actual question pulse A_Delay and the actual delay pulse Delay,
FIG. 7 is a simplified circuit diagram of the delay detector shown in FIG. 5,
FIG. 8 is a diagram illustrating a peer identification interrogator for transmitting / receiving peak power measurement according to another embodiment of the present invention, and FIG.
9 to 11 are flowcharts illustrating a method for transmitting / receiving peak power measurement of a peer identification interrogator according to an embodiment of the present invention.

이상의 본 발명의 목적들, 다른 목적들, 특징들 및 이점들은 첨부된 도면과 관련된 이하의 바람직한 실시 예들을 통해서 쉽게 이해될 것이다. 그러나 본 발명은 여기서 설명되는 실시 예들에 한정되지 않고 다른 형태로 구체화될 수도 있다. 오히려, 여기서 소개되는 실시 예들은 개시된 내용이 철저하고 완전해질 수 있도록 그리고 당업자에게 본 발명의 사상이 충분히 전달될 수 있도록 하기 위해 제공되는 것이다.BRIEF DESCRIPTION OF THE DRAWINGS The above and other objects, features, and advantages of the present invention will become more readily apparent from the following description of preferred embodiments with reference to the accompanying drawings. However, the present invention is not limited to the embodiments described herein but may be embodied in other forms. Rather, the embodiments disclosed herein are provided so that the disclosure can be thorough and complete, and will fully convey the scope of the invention to those skilled in the art.

본 명세서에서, 어떤 구성요소가 다른 구성요소 상에 있다고 언급되는 경우에 그것은 다른 구성요소 상에 직접 형성될 수 있거나 또는 그들 사이에 제 3의 구성요소가 개재될 수도 있다는 것을 의미한다. In this specification, when an element is referred to as being on another element, it may be directly formed on another element, or a third element may be interposed therebetween.

본 명세서에서 제1, 제2 등의 용어가 구성요소들을 기술하기 위해서 사용된 경우, 이들 구성요소들이 이 같은 용어들에 의해서 한정되어서는 안 된다. 이들 용어들은 단지 어느 구성요소를 다른 구성요소와 구별시키기 위해서 사용되었을 뿐이다. 여기에 설명되고 예시되는 실시 예들은 그것의 상보적인 실시 예들도 포함한다.Where the terms first, second, etc. are used herein to describe components, these components should not be limited by such terms. These terms have only been used to distinguish one component from another. The embodiments described and exemplified herein also include their complementary embodiments.

또한, 제1 엘리먼트 (또는 구성요소)가 제2 엘리먼트(또는 구성요소) 상(ON)에서 동작 또는 실행된다고 언급될 때, 제1 엘리먼트(또는 구성요소)는 제2 엘리먼트(또는 구성요소)가 동작 또는 실행되는 환경에서 동작 또는 실행되거나 또는 제2 엘리먼트(또는 구성요소)와 직접 또는 간접적으로 상호 작용을 통해서 동작 또는 실행되는 것으로 이해되어야 할 것이다.Also, when it is mentioned that the first element (or component) is operated or executed on the second element (or component) ON, the first element (or component) It should be understood that it is operated or executed in an operating or running environment or is operated or executed through direct or indirect interaction with a second element (or component).

어떤 엘리먼트, 구성요소, 장치, 또는 시스템이 프로그램 또는 소프트웨어로 이루어진 구성요소를 포함한다고 언급되는 경우, 명시적인 언급이 없더라도, 그 엘리먼트, 구성요소, 장치, 또는 시스템은 그 프로그램 또는 소프트웨어가 실행 또는 동작하는데 필요한 하드웨어(예를 들면, 메모리, CPU 등)나 다른 프로그램 또는 소프트웨어(예를 들면 운영체제나 하드웨어를 구동하는데 필요한 드라이버 등)를 포함하는 것으로 이해되어야 할 것이다.It is to be understood that when an element, component, apparatus, or system is referred to as comprising a program or a component made up of software, it is not explicitly stated that the element, component, (E.g., memory, CPU, etc.) or other programs or software (e.g., drivers necessary to run an operating system or hardware, etc.)

또한, 어떤 엘리먼트(또는 구성요소)가 구현됨에 있어서 특별한 언급이 없다면, 그 엘리먼트(또는 구성요소)는 소프트웨어, 하드웨어, 또는 소프트웨어 및 하드웨어 어떤 형태로도 구현될 수 있는 것으로 이해되어야 할 것이다.It is also to be understood that the elements (or elements) may be implemented in software, hardware, or any form of software and hardware, unless the context requires otherwise.

또한, 본 명세서에서 사용된 용어는 실시 예들을 설명하기 위한 것이며 본 발명을 제한하고자 하는 것은 아니다. 본 명세서에서, 단수형은 문구에서 특별히 언급하지 않는 한 복수형도 포함한다. 명세서에서 사용되는 '포함한다(comprises)' 및/또는 '포함하는(comprising)'은 언급된 구성요소는 하나 이상의 다른 구성요소의 존재 또는 추가를 배제하지 않는다.Also, terms used herein are for the purpose of illustrating embodiments and are not intended to limit the invention. In the present specification, the singular form includes plural forms unless otherwise specified in the specification. The terms "comprises" and / or "comprising" used in the specification do not exclude the presence or addition of one or more other elements.

이하, 도면을 참조하여 본 발명을 상세히 설명하도록 한다. 아래의 특정 실시 예들을 기술하는데 있어서, 여러 가지의 특정적인 내용들은 발명을 더 구체적으로 설명하고 이해를 돕기 위해 작성되었다. 하지만 본 발명을 이해할 수 있을 정도로 이 분야의 지식을 갖고 있는 독자는 이러한 여러 가지의 특정적인 내용들이 없어도 사용될 수 있다는 것을 인지할 수 있다. Hereinafter, the present invention will be described in detail with reference to the drawings. In describing the specific embodiments below, various specific details have been set forth in order to explain the invention in greater detail and to assist in understanding it. However, it will be appreciated by those skilled in the art that the present invention may be understood by those skilled in the art without departing from such specific details.

어떤 경우에는, 발명을 기술하는 데 있어서 흔히 알려졌으면서 발명과 크게 관련 없는 부분들은 본 발명을 설명하는 데 있어 별 이유 없이 혼돈이 오는 것을 막기 위해 기술하지 않음을 미리 언급해 둔다. In some instances, it should be noted that portions of the invention that are not commonly known in the description of the invention and are not significantly related to the invention do not describe confusing reasons for explaining the present invention.

이하, 본 발명에서 실시하고자 하는 구체적인 기술내용에 대해 첨부도면을 참조하여 상세하게 설명하기로 한다.DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENTS Hereinafter, the present invention will be described in detail with reference to the accompanying drawings.

도 1, 도 4, 도 5 및 도 8에 도시된 송수신 첨두전력 측정을 위한 피아식별 질문기(100, 800)의 각각의 구성은 기능 및/또는 논리적으로 분리될 수 있음을 나타내는 것이며, 반드시 각각의 구성이 별도의 물리적 장치로 구분되거나 별도의 코드로 작성됨을 의미하는 것은 아님을 본 발명의 기술분야의 평균적 전문가는 용이하게 추론할 수 있을 것이다. The configuration of each of the peer identification interrogators 100, 800 for the transmission and reception peak power measurement shown in Figs. 1, 4, 5 and 8 is shown to be functionally and / or logically separable, May be easily deduced by an average expert in the field of the present invention that does not mean that the configuration of the device is divided into separate physical devices or written in a separate code.

상기 송수신 첨두전력 측정을 위한 피아식별 질문기(100)는 소정의 데이터 프로세싱 장치에 설치되어 본 발명의 기술적 사상을 구현할 수도 있다.The peer identification interrogator 100 for measuring the transmission / reception peak power may be installed in a predetermined data processing apparatus to implement the technical idea of the present invention.

또한, 본 발명의 실시 예에 따른 상기 송수신 첨두전력 측정을 위한 피아식별 질문기(100, 800)는 예를 들면, 데스크탑 PC(Personal Computer), 서버, 랩탑 PC(Laptop PC), 넷북 컴퓨터(Netbook Computer) 등 프로그램의 설치 및 실행이 가능한 모든 전자기기들 중 하나에 의해 동작할 수 있다.The peer identification interrogators 100 and 800 for measuring the transmission power and the peak power according to the embodiment of the present invention may be implemented as a personal computer (PC), a server, a laptop PC, a netbook Computer) and the like can be operated by one of all the electronic devices capable of installing and executing the program.

도 1은 본 발명의 일 실시 예에 따른 송수신 첨두전력 측정을 위한 피아식별 질문기(100)를 도시한 도면이다.FIG. 1 is a diagram illustrating a peer identification interrogator 100 for transmitting / receiving peak power measurement according to an embodiment of the present invention.

도 1에 도시된 본 발명의 일 실시 예에 따른 송수신 첨두전력 측정을 위한 피아식별 질문기(100)는 단일 송수신 모듈에서 N(N은 1 이상의 정수)개의 채널에 대한 질문신호 제공, 대역 변환 및 증폭을 처리할 수 있다. 또한, 피아식별 질문기(100)는 질문신호의 송출 경로뿐만 아니라 저잡음 증폭된 수신신호를 커플링(coupling)하여 하향변환한 뒤 첨두전력을 측정하는 수신 경로를 제공할 수 있다. The peer identification interrogator 100 for measuring transmission power and peak power according to an embodiment of the present invention shown in FIG. 1 provides a question signal for N (N is an integer of 1 or more) channels in a single transmission / Amplification can be processed. In addition, the peer identification interrogator 100 may provide a reception path for coupling the low-noise amplified reception signal as well as the transmission path of the interrogation signal to down-convert the received signal to measure the peak power.

이러한 피아식별 질문기15(100)는 1개 이상의 송수신 모듈을 포함한 능동위상배열(AESA: Active Electronically Scanned Array Radar) 구조 또는 수동위상배열(PESA: Passive Electronically Scanned Array) 구조의 레이다에 적용가능하다. The peer identification interrogator 15 (100) is applicable to an active electronically scanned array (AESA) structure including at least one transmission / reception module or a passive electronically scanned array (PESA) structure.

도 1을 참조하면, 본 발명의 일 실시 예에 따른 송수신 첨두전력 측정을 위한 피아식별 질문기(100)는 제1 내지 제3질문제공 및 첨두전력 검출부들(110, 120, 130), 제1 내지 제3대역 변환부들(140, 150, 160) 및 제1 내지 제3송수신기들(170, 180, 190)을 포함할 수 있다. 도 1에는 설명의 편의를 위해 3개의 송수신신호들을 처리하는 경우를 예로 들었으며, 실제로는 3개 미만 또는 3개 이상의 송수신신호들도 처리가능하다.Referring to FIG. 1, a peer identification interrogator 100 for measuring transmission and reception peak power according to an embodiment of the present invention includes first to third question provision and peak power detectors 110, 120 and 130, And third to fourth transceivers 170, 180, and 190. The first to third transceivers 140, In FIG. 1, three transmission / reception signals are processed for convenience of explanation. In practice, less than three or three or more transmission / reception signals can be processed.

제1 내지 제3질문제공 및 첨두전력 검출부들(110, 120, 130)은 단일 송수신 모듈 또는 다수 송수신 모듈에서, N개(도 1의 경우, 3개)의 채널 별로 질문신호들을 동시에 또는 선별적으로 다른 시간에 제공할 수 있다.The first to third query provisioning and peak power detectors 110, 120, and 130 may be configured to simultaneously or interrogate query signals for N (three in FIG. 1) channels in a single transmit / receive module or multiple transmit / At a different time.

제1 내지 제3대역 변환부들(140, 150, 160)은 제1 내지 제3질문 제공 및 첨두전력 검출부들(110, 120, 130)에서 제공되는 질문신호들의 주파수 대역을 상향변환할 수 있다. 예를 들어, 질문신호는 중간주파수(IF) 대역의 신호이므로, 제1 내지 제3대역 변환부들(140, 150, 160)은 RF 대역의 신호로 상향변환할 수 있다.The first to third band converters 140, 150 and 160 may up-convert the frequency bands of the question signals provided by the first to third question providing and peak power detectors 110, 120 and 130. For example, since the interrogation signal is an intermediate frequency (IF) band signal, the first through third band-shifting units 140, 150, and 160 can up-convert the signals into RF band signals.

제1 내지 제3송수신기들(170, 180, 190)은 상향변환된 질문신호들의 전력을 증폭하여 제1 내지 제3안테나들(11, 12, 13)로 송출하고, 송출된 질문신호들을 궤환 경로를 통해 제1 내지 제3대역 변환부들(140, 150, 160)로 제공할 수 있다.The first to third transceivers 170, 180 and 190 amplify the power of the up-converted interrogation signals and transmit them to the first to third antennas 11, 12 and 13, To the first to third band converters 140, 150, and 160 through the first and second frequency bands.

또한, 제1 내지 제3안테나들(11, 12, 13)에 의해 표적으로 송출된 질문신호들은 표적에서 반사되어 제1 내지 제3안테나들(11, 12, 13)로 수신되며, 제1 내지 제3송수신기들(170, 180, 190)은 표적으로부터 반사되어 수신된 수신신호들을 궤환 경로를 통해 제1 내지 제3대역 변환부들(140, 150, 160)로 제공할 수 있다.The question signals sent out by the first to third antennas 11, 12 and 13 are reflected on the target and are received by the first to third antennas 11, 12 and 13, The third transceivers 170, 180, and 190 may provide the received signals reflected from the target to the first through third band transformers 140, 150, and 160 through a feedback path.

제1 내지 제3대역 변환부들(140, 150, 160)은 수신된 질문신호들과 수신신호들의 주파수대역을 중간주파수 대역으로 하향변환할 수 있다.The first to third band converters 140, 150, and 160 may downconvert the frequency bands of the received interrogation signals and the received signals to an intermediate frequency band.

제1 내지 제3질문 제공 및 첨두전력 검출부들(110, 120, 130)은 제1 내지 제3안테나들(11, 12, 13)로 송출된 질문신호들 및 수신된 수신신호들 중 해당하는 신호를 이용하여 N개의 채널 별로 송신출력 및 수신출력에 대한 첨두전력을 검출할 수 있다. The first to third query provisioning and peak power detectors 110, 120 and 130 detect the question signals sent to the first to third antennas 11, 12 and 13 and the corresponding one of the received signals The peak power for the transmission output and the reception power for each of the N channels can be detected.

제1 내지 제3질문 제공 및 첨두전력 검출부들(110, 120, 130)은 하향변환된 질문신호들과 수신신호들의 딜레이 시간을 각각 검출하고, 각각 검출된 딜레이 시간을 이용하여 하향변환된 질문신호들 및 하향변환된 수신신호들에 대한 첨두전력을 각각 검출할 수 있다. 이로써, 본 발명의 실시 예에서는 각 채널 별 송신출력의 첨두전력 검출이 가능하다. 또한, 표적으로부터 반사된 수신신호에 대한 수신출력의 첨두전력 검출도 가능하다.The first to third query provisioning and peak power detectors 110, 120, and 130 detect the delay times of the down-converted question signals and the received signals, respectively, and output the down- And the peak power for the down-converted received signals, respectively. Thus, in the embodiment of the present invention, it is possible to detect the peak power of the transmission output for each channel. It is also possible to detect the peak power of the received output with respect to the received signal reflected from the target.

도 2는 본 발명의 실시 예에서 사용되는 기준 송출 펄스와 기준 수신 펄스를 설명하기 위한 도면이다. FIG. 2 is a diagram for explaining a reference transmission pulse and a reference reception pulse used in the embodiment of the present invention. FIG.

도 2를 참조하면, 기준 트리거 신호(Trigger Signal)에서 첫번째 디지털 펄스가 로우(low)인 구간은 RF 질문신호를 송출하기로 설계한 예상 송출 구간이고, 하이(high)인 구간은 RF 질문신호를 수신하기로 설계한 예상 수신 구간이다. Referring to FIG. 2, a period in which a first digital pulse is low in a reference trigger signal is an expected transmission period designed to transmit an RF interrogation signal, and a period in which a high digital pulse is low is an RF interrogation signal It is the expected reception interval designed to receive.

따라서, RF 질문신호(Transmitter Signal)는 디지털 펄스가 로우일 때 송출되고, 수신신호(Receiver Signal)는 디지털 펄스가 하이일 때 수신된다. 송출은 안테나에서 RF 질문신호를 방사하는 것이고, 수신은 표적에 맞아 반사된 RF 질문신호를 안테나에서 받는 것이다.Therefore, the RF question signal (Transmitter Signal) is sent when the digital pulse is low and the Receiver Signal is received when the digital pulse is high. The emission is to radiate an RF interrogation signal at the antenna, and the reception is to receive a reflected RF interrogation signal at the antenna that is matched to the target.

피아식별 질문기(100) 또는 피아식별 질문기(100)를 제어하는 장치는 로우인 구간동안 RF 질문신호를 송출하도록 내부 회로를 동작시키고, 하이인 구간동안 수신하도록 내부 회로를 동작시킨다. The device controlling the peer identification interrogator 100 or the peer identification interrogator 100 operates the internal circuitry to send the RF interrogation signal during the low period and the internal circuitry to receive during the high period.

이를 바탕으로, 본 발명의 실시 예에 따른 제N송신 첨두전력 검출부(N=1, 2, 3, ?)는 RF 질문신호를 송출하는 예상 송출 구간 동안 하이 상태인 디지털 펄스, 즉, 기준 송출 펄스를 생성한다. 또한, 제N수신 첨두전력 검출부는 반사된 수신신호를 수신하는 예상 수신 구간 동안 하이 상태인 기준 수신 펄스를 생성한다. (N = 1, 2, 3,?) According to an exemplary embodiment of the present invention includes a digital pulse having a high state during a predicted transmission interval for transmitting an RF interrogation signal, that is, a reference transmission pulse . Further, the Nth receiving peak power detecting section generates a reference receiving pulse that is in the high state during the expected receiving period in which the reflected receiving signal is received.

이러한 기준 송출 펄스와 기준 수신 펄스는 각각 후술할 제1송신 첨두전력 검출부(114)와 제1수신 첨두전력 검출부(116)에서 기준 펄스로서 사용될 수 있다.The reference transmission pulse and the reference reception pulse may be used as reference pulses in the first transmission peak power detection unit 114 and the first reception peak power detection unit 116, respectively, which will be described later.

또한, 상술한 트리거 신호는 피아식별 레이다의 운용모드 별로 상이할 수 있으며, 따라서, 기준 송출 펄스와 기준 수신 펄스 역시 피아식별 레이다의 운용모드 별로 상이할 수 있다. In addition, the trigger signal may be different depending on the operation mode of the peer identification radar, so that the reference transmission pulse and the reference reception pulse may also be different depending on the operation mode of the peer identification radar.

피아식별 레이다의 운용모드는 피아식별 질문기(100)가 적용된 능동위상배열 피아식별 레이다 또는 수동위상배열 피아식별 레이다의 운용모드로서, 예를 들어, MODE 1, MODE 2, MODE 3/A, MODE C 및 MODE 4를 포함할 수 있다. 피아식별 레이다의 운용모드는 http://www.f-15e.info/joomla/technology/avionics/66-iff-system의 설명을 참조할 수 있으며, 각 피아식별 레이다의 운용모드 별 기준 송출 펄스와 기준 수신 펄스는 일 예로 도 3과 같은 형태를 가질 수 있다. The operation mode of the peer identification radar is an operation mode of an active phased array peer identification radar or a passive phased array peer identification radar to which the peer identification interrogator 100 is applied. For example, MODE 1, MODE 2, MODE 3 / A, MODE C, and MODE 4. The operation mode of the peer identification radar can be refer to the description of http://www.f-15e.info/joomla/technology/avionics/66-iff-system, and the reference emission pulse for each operation mode of each peer identification radar The reference reception pulse may have a form as shown in FIG. 3, for example.

이하에서는 제1질문제공 및 첨두전력 검출부(110), 제1대역 변환부(140) 및 제1송수신기(170)를 예로 들어 첨두전력을 검출하는 동작에 대해 설명한다.Hereinafter, the operation of detecting the peak power using the first quiz providing and the peak power detecting unit 110, the first band converting unit 140, and the first transceiver 170 will be described.

도 4는 본 발명의 실시 예에 따른 피아식별 질문기(100) 중 제1질문제공 및 첨두전력 검출부(110), 제1대역 변환부(140) 및 제1송수신기(170)를 도시한 블록도이다.4 is a block diagram showing a first question providing unit and a peak power detecting unit 110, a first band converting unit 140, and a first transceiver 170 of a peer identification interrogator 100 according to an embodiment of the present invention. to be.

도 4를 참조하면, 제1질문제공 및 첨두전력 검출부(110)는 제1DAC(Digital Analog Converter, 112), 제1송신 첨두전력 검출부(114) 및 제1수신 첨두전력 검출부(116)를 포함한다. 또한, 제1대역 변환부(140)는 제1상향변환부(142), 제1송신 하향변환부(144) 및 제1수신 하향변환부(146)를 포함한다. 또한, 제1송수신기(170)는 제1전력증폭기(172) 및 제1저잡음증폭기(174)를 포함한다. 4, the first query providing and peak power detecting unit 110 includes a first digital analog converter (DAC) 112, a first transmitting peak power detecting unit 114, and a first receiving peak power detecting unit 116 . In addition, the first band converter 140 includes a first up-converter 142, a first down-conversion unit 144, and a first down-conversion unit 146. In addition, the first transceiver 170 includes a first power amplifier 172 and a first low noise amplifier 174.

제1DAC(112)는 송출할 질문신호를 아날로그 신호로 변환하여 제1상향변환부(142)로 출력한다.The first DAC 112 converts the question signal to be transmitted into an analog signal and outputs the analog signal to the first up-converter 142.

제1상향변환부(142)는 제1DAC(112)에서 제공되는 질문신호의 주파수 대역을 RF 대역으로 상향변환한다.The first up-converter 142 up-converts the frequency band of the interrogation signal provided by the first DAC 112 to the RF band.

제1전력증폭기(172)는 상향변환된 질문신호의 전력을 설정된 값으로 증폭하고, 증폭된 질문신호를 제1전력증폭기(172)로 출력한다.The first power amplifier 172 amplifies the power of the up-converted interrogation signal to a predetermined value and outputs the amplified interrogation signal to the first power amplifier 172.

제1안테나(11)는 증폭된 질문신호를 표적을 향해 송출한다.The first antenna 11 transmits the amplified question signal toward the target.

또한, 제1전력증폭기(172)에서 제1안테나(11)로 송출된 질문신호는 커플링되어 궤환 경로를 통해 제1송신 하향변환부(144)로 제공된다.The interrogation signal sent from the first power amplifier 172 to the first antenna 11 is coupled to the first transmission down-converter 144 through a feedback path.

제1송신 하향변환부(144)는 제1전력증폭기(172)에서 증폭되어 송출된 질문신호를 궤환 경로를 통해 제공받아 주파수 대역을 IF 대역으로 하향변환한다. The first transmission down-converter 144 receives the inquiry signal amplified and transmitted from the first power amplifier 172 through a feedback path, and downconverts the frequency band to the IF band.

제1송신 첨두전력 검출부(114)는 제1송신 하향변환부(144)에서 하향변환된 질문신호의 펄스와 기설정된 기준 송출 펄스를 비교하여 질문신호 송출 시 딜레이된 시간, 즉, 송출된 질문신호의 딜레이 시간(이하, '질문 딜레이 시간'이라 한다)을 검출하고, 검출된 질문 딜레이 시간을 이용하여 하향변환된 질문신호에 대한 첨두전력을 검출할 수 있다.The first transmission peak power detection unit 114 compares the pulse of the down-converted question signal with the predetermined reference transmission pulse in the first transmission down-converter unit 144, and outputs the delayed time when the question signal is transmitted, (Hereinafter, referred to as 'question delay time') and detect the peak power of the down-converted question signal using the detected question delay time.

도 5는 본 발명의 실시 예에 따른 제1송신 첨두전력 검출부(114)를 도시한 블록도이다. 5 is a block diagram illustrating a first transmission peak power detector 114 according to an embodiment of the present invention.

도 5를 참조하면, 본 발명의 실시 예에 따른 제1송신 첨두전력 검출부(114)는 디텍터(510), 실제 펄스 생성기(520), 기준펄스 생성기(530), 딜레이 검출기(540), ADC(Analog Digital Converter, 550) 및 피크 검출기(560)를 포함할 수 있다.5, a first transmission peak power detector 114 according to an embodiment of the present invention includes a detector 510, an actual pulse generator 520, a reference pulse generator 530, a delay detector 540, an ADC Analog Digital Converter, 550) and a peak detector 560.

디텍터(510)는 제1송신 하향변환부(144)에서 하향변환된 질문신호의 전력(단위: dBm)을 전압(단위: Volt)으로 전환시켜 실제 펄스 생성기(520) 및 ADC(550)로 출력할 수 있다.The detector 510 converts the power (unit: dBm) of the down-converted question signal in the first transmission down-conversion unit 144 into a voltage (unit: Volt) and outputs it to the actual pulse generator 520 and the ADC 550 can do.

실제 펄스 생성기(520)는 디텍터(510)로부터 출력되는 질문신호의 전압에 기초하여 실제 질문 펄스를 생성할 수 있다. 즉, 실제 펄스 생성기(520)는 디텍터(510)에서 변환된 출력을 트리거로 받아 실제 질문 펄스를 생성할 수 있다. The actual pulse generator 520 may generate the actual question pulse based on the voltage of the question signal output from the detector 510. [ That is, the actual pulse generator 520 may receive the converted output from the detector 510 as a trigger to generate the actual question pulse.

자세히 설명하면, 디텍터(510)의 출력값이 사전에 정해진 기준 출력값을 넘어가면 실제 펄스 생성기(520)의 카운터(미도시)가 동작할 수 있다. 예를 들어, 디텍터(510)의 출력이 1v(기준 출력값, 설계자에 따라 변경 가능함)을 초과하면, 실제 펄스 생성기(520)는 질문신호의 송신이 시작되는 것으로 판단하여 카운터(미도시)를 동작시킬 수 있다. More specifically, the counter (not shown) of the actual pulse generator 520 can operate when the output value of the detector 510 exceeds a predetermined reference output value. For example, if the output of the detector 510 exceeds 1v (the reference output value, which may vary depending on the designer), the actual pulse generator 520 determines that the transmission of the interrogation signal is to begin, .

실제 펄스 생성기(520)의 카운터(미도시)의 카운팅이 로우(Low, 0) 전압에서 하이(High, 1) 전압으로 전환하는 시간에 도달하면, 즉, 기준 송출 펄스의 처음 로우 구간에 해당하는 시간이 경과하면, 실제 펄스 생성기(520)는 실제 질문 펄스를 생성할 수 있다. 따라서, 생성된 실제 질문 펄스는 기준 송출 펄스와 동일한 형태를 가지나, 시작 시점만이 다를 수 있다. 만약, 질문신호 송출 시 딜레이가 발생하지 않았다면, 실제 질문 펄스와 기준 송출 펄스의 시작점은 동일할 것이다.When the counting of the counter (not shown) of the actual pulse generator 520 reaches the time to switch from the Low (0) voltage to the High (1) voltage, that is, As time elapses, the actual pulse generator 520 may generate the actual question pulse. Thus, the generated actual question pulse has the same form as the reference dispatch pulse, but only the start point may be different. If there is no delay in sending the interrogation signal, the starting point of the actual interrogation pulse and the reference dispatching pulse will be the same.

생성된 실제 질문 펄스는 딜레이 검출기(540)로 입력된다. 이로써, 딜레이 검출기(540)는 실제 송출된 RF 질문신호가 발생했을 때부터 만들어진 실제 질문 펄스를 실제 펄스 생성기(520)로부터 입력받을 수 있다.The generated actual interrogation pulse is input to the delay detector 540. Thus, the delay detector 540 can receive the actual question pulse generated from the actual transmitted RF question signal from the actual pulse generator 520.

또한, 기준펄스 생성기(530)는 기설정된 기준 송출 펄스를 생성할 수 있다. 예를 들어, 기준펄스 생성기(530)는 초기에는 로우 전압을 유지하다가, 기준펄스 생성기(530)의 카운터(미도시)에 의해 기준 트리거 신호로부터 사전에 정해진 송출 시간(즉, 고정 지연시간)에 도달하면 송출 펄스 구간을 열어주는, 즉, 하이 전압이 정해진 시간동안 유지되는 구간을 포함하는 기준 송출 펄스를 도 2와 같이 생성할 수 있다. 도 2를 참조하여 설명한 것처럼, 질문신호를 송출하기 위한 기준 펄스인 기준 송출 펄스는 송출 구간에만 열려 하이 전압을 유지할 수 있다. Also, the reference pulse generator 530 may generate a predetermined reference transmission pulse. For example, the reference pulse generator 530 initially maintains the low voltage, and the reference pulse generator 530 outputs a predetermined trigger signal (i.e., a fixed delay time) from the reference trigger signal by a counter (not shown) of the reference pulse generator 530 A reference emission pulse including an interval in which the emission pulse interval is opened, that is, a period in which the high voltage is maintained for a predetermined time, can be generated as shown in FIG. As described with reference to FIG. 2, the reference transmission pulse, which is the reference pulse for sending the interrogation signal, is opened only during the transmission period, and can maintain the high voltage.

이 때, 기준펄스 생성기(530)는 도 3을 참조하여 설명한 피아식별 레이다의 운용 모드 별로 상이한 기준 송출 펄스를 생성할 수 있다. 즉, 고정 지연시간은 운용모드 별로 상이할 수 있으며, 피아식별 레이다를 제어하는 CPU의 레지스터나, FPGA의 레지스터에 저장될 수 있다.At this time, the reference pulse generator 530 can generate different reference transmission pulses according to the operation modes of the peer identification radar described with reference to FIG. That is, the fixed delay time may be different for each operation mode, and may be stored in a register of the CPU that controls the peer identification radar, or a register of the FPGA.

딜레이 검출기(540)는 실제 질문 펄스와 기준 송출 펄스를 비교하여 기준 송출 펄스 구간에 딜레이 구간(D)이 발생하면, 딜레이 검출기(540)의 카운터(미도시)를 이용하여 딜레이 구간(D)에 해당하는 질문 딜레이 시간(t2-t1)을 카운팅할 수 있다. 즉, 딜레이 검출기(540)는 실제 질문 펄스와 기준 송출 펄스의 차이를 감지하고 그 차이값을 카운팅하여 질문 딜레이 시간으로서 검출할 수 있다. The delay detector 540 compares the actual question pulse with the reference dispatch pulse and generates a delay interval D using a counter (not shown) of the delay detector 540 when a delay interval D occurs in the reference dispatch pulse interval The corresponding question delay time (t2-t1) can be counted. That is, the delay detector 540 detects the difference between the actual question pulse and the reference dispatch pulse, and counts the difference value to detect it as the question delay time.

도 6은 기준 송출 펄스(A), 실제 질문 펄스(A_Delay) 및 실제 딜레이 펄스(Delay)의 일 예를 도시한 도면이다.Fig. 6 is a diagram showing an example of the reference dispatch pulse A, the actual question pulse A_Delay, and the actual delay pulse Delay.

도 6을 참조하면, 딜레이 검출기(540)는 기준 송출 펄스(A)와 실제 질문 펄스(A_Delay)의 차이에 의해 딜레이 구간(D)이 발생 시, 해당 딜레이 펄스(Delay) 중 딜레이 구간(D)의 상승 엣지부터 딜레이 검출기(540)의 카운터(미도시)가 카운팅을 시작하여 딜레이 구간(D)이 끝날 때까지의 시간(t2-t1)을 계산할 수 있다. 딜레이 검출기(540)는 계산된 시간을 질문 딜레이 시간으로서 검출하여 피크 검출기(560)로 전달할 수 있다.6, when a delay section D occurs due to a difference between a reference dispatch pulse A and an actual question pulse A_Delay, the delay detector 540 outputs a delay section D of the delay pulse Del, (T2-t1) from the rising edge of the delay detector 540 until the counter (not shown) of the delay detector 540 starts counting and the delay section D ends. The delay detector 540 may detect the calculated time as the question delay time and deliver it to the peak detector 560. [

도 7은 도 5에 도시된 딜레이 검출기(540)의 회로도를 간단히 도시한 도면이다.FIG. 7 is a simplified circuit diagram of the delay detector 540 shown in FIG.

도 7을 참조하면, 딜레이 검출기(540)는 딜레이를 검출하기 위해 PLL(Phase Locked Loop) 설계에 사용되는 PFD(Phase Frequency Detector) 회로를 로직으로 설계하여 사용할 수 있다. PFD 회로인 딜레이 검출기(540)는 2개의 D 플립플롭과 1개의 NAND 게이트를 포함할 수 있다. Referring to FIG. 7, the delay detector 540 may use a PFD (Phase Frequency Detector) circuit, which is used in a PLL (Phase Locked Loop) design, as logic for detecting a delay. The delay detector 540, which is a PFD circuit, may include two D flip-flops and one NAND gate.

이미 딜레이가 생겼다는 가정하에, 딜레이 검출기(540)의 동작에 대해 간단히 설명한다. 먼저, 딜레이 구간(도 6의 D)에서 A는 하이 상태의 전압(1이라 한다), B는 로우 상태의 전압(0이라 한다)이다. The operation of the delay detector 540 will be briefly described on the assumption that a delay has already occurred. First, in the delay period (D in Fig. 6), A is a high voltage (1) and B is a low voltage (0).

상단 D 플립플롭은 상승 엣지(Rising Edge)의 클럭에서 1을 출력한다. 하단 D 플립플롭은 상승 엣지의 클럭에서 0을 출력한다. 두 신호를 입력으로 받는 NAND 게이트는 (1,0) 입력을 받아 1을 출력한다. 1을 리셋신호로 받는 동안 상단의 D 플립플롭은 A_delay 출력을 이전 상태로 유지한다. 작은 동그라미는 Negative reset, 즉 0일 때 reset을 한다는 의미이다.The top D flip-flop outputs 1 at the rising edge of the clock. The bottom D flip-flop outputs 0 at the rising edge of the clock. The NAND gate receiving the two signals receives the (1,0) input and outputs 1. While receiving 1 as a reset signal, the D flip-flop at the top keeps the A_delay output in the previous state. A small circle means a negative reset, that is, reset when it is zero.

딜레이 구간이 끝났을 때(즉, 도 6의 D 다음 구간) A는 1, B는 1이다. 상단 D 플립플롭은 상승 엣지의 클럭에서 1을 출력하고, 하단 D 플립플롭은 상승 엣지의 클럭에서 1을 출력한다. 두 신호를 입력으로 받는 NAND 게이트는 (1,1) 입력을 받아 0을 출력한다. 0을 리셋신호로 받아 상단의 D 플립플롭은 A_delay 출력이 0이 된다. 딜레이가 된 시간만큼 A_delay 신호는 1이 유지된다. At the end of the delay interval (i.e., the interval after D in FIG. 6), A is 1 and B is 1. The upper D flip-flop outputs 1 at the rising edge clock, and the lower D flip-flop outputs 1 at the rising edge clock. The NAND gate receiving the two signals receives the input (1,1) and outputs 0. 0 is received as a reset signal, and the A_delay output of the upper D flip-flop becomes 0. The A_delay signal is held at 1 as long as it is delayed.

다시 도 5를 참조하면, ADC(550)는 디텍터(510)로부터 출력되는 전압을 디지털 신호로 변환하여 출력할 수 있다.Referring again to FIG. 5, the ADC 550 may convert a voltage output from the detector 510 into a digital signal and output the digital signal.

피크 검출기(560)는 ADC(550)에서 변환되어 순차적으로 입력되는 디지털 신호들 중 기준 송출 펄스가 하이(high)가 되는 구간의 중간 시간값에 해당하는 시점에서 카운팅된 딜레이 시간(t2-t1)만큼 경과한 디지털 신호에 대한 첨두 전력값을 출력할 수 있다.The peak detector 560 detects a delay time t2-t1 counted at a time point corresponding to an intermediate time value of a period during which the reference transmission pulse is high among the digital signals sequentially converted and input by the ADC 550, Can output the peak power value for the digital signal that has passed the predetermined time.

질문신호 송출 시 딜레이가 발생하지 않은 경우, 딜레이 시간=0이므로, 피크 검출기(560)는 기준 송출 펄스의 중간 시간값에 해당하는 시점에서의 디지털 신호에 대한 첨두 전력값을 출력할 수 있다. If delay is not generated when the question signal is transmitted, the peak detector 560 can output the peak power value for the digital signal at the time point corresponding to the intermediate time value of the reference transmission pulse since the delay time is zero.

한편, 제1전력증폭기(172)에서 증폭된 후 제1안테나(11)에 의해 표적으로 송출된 질문신호는 표적에서 반사되어 제1안테나(11)에 의해 수신된다. 이하에서는 제1안테나(11)가 표적으로 수신한 신호를 '수신신호'라 한다.On the other hand, the question signal amplified by the first power amplifier 172 and transmitted to the target by the first antenna 11 is reflected by the target and is received by the first antenna 11. Hereinafter, a signal received by the first antenna 11 as a target will be referred to as a " received signal ".

제1저잡음증폭기(174)는 표적으로부터 수신된 수신신호를 저잡음 증폭시킨다.The first low-noise amplifier 174 low-noise amplifies the received signal received from the target.

제1수신 하향변환부(146)는 증폭된 수신신호의 주파수 대역을 IF 대역으로 하향변환한다. The first reception down-converter 146 downconverts the frequency band of the amplified reception signal to the IF band.

제1수신 첨두전력 검출부(116)는 제1수신 하향변환부(146)에서 하향변환된 수신신호의 펄스와 기설정된 기준 수신 펄스를 비교하여 수신신호의 딜레이 시간(이하, '수신 딜레이 시간'이라 한다)을 검출하고, 검출된 수신 딜레이 시간을 이용하여 하향변환된 수신신호의 첨두전력을 검출할 수 있다.The first reception peak power detection unit 116 compares the pulse of the down-converted reception signal from the first reception down-conversion unit 146 with a predetermined reference reception pulse and outputs a delay time of the reception signal (hereinafter referred to as a reception delay time And detects the peak power of the down-converted received signal using the detected received delay time.

제1수신 첨두전력 검출부(116)는 도 5에 도시된 것처럼 제1송신 첨두전력 검출부(114)와 동일한 구조를 가질 수 있다. 따라서, 제1수신 첨두전력 검출부(116)도 도 5를 참조하여 간략히 설명한다. The first reception peak power detection unit 116 may have the same structure as the first transmission peak power detection unit 114 as shown in FIG. Therefore, the first reception peak power detection unit 116 is also briefly described with reference to Fig.

도 5를 참조하면, 제1수신 첨두전력 검출부(116)는 디텍터(510), 실제 펄스 생성기(520), 기준펄스 생성기(530), 딜레이 검출기(540), ADC(550) 및 피크 검출기(560)를 포함할 수 있다.5, the first reception peak power detector 116 includes a detector 510, an actual pulse generator 520, a reference pulse generator 530, a delay detector 540, an ADC 550 and a peak detector 560 ).

디텍터(510)는 제1수신 하향변환부(146)에서 하향변환된 질문신호의 전력을 전압으로 전환시킬 수 있다.The detector 510 may convert the power of the down-converted question signal in the first receiving down-conversion unit 146 to a voltage.

실제 펄스 생성기(520)는 디텍터(510)로부터 출력되는 수신신호의 전압에 기초하여 실제 수신 펄스를 생성할 수 있다. 예를 들어, 실제 펄스 생성기(520)는 디텍터(510)에서 변환된 출력값이 사전에 정해진 기준 출력값(예를 들어, 1v)을 초과하면, 수신신호의 수신이 시작된 것으로 판단하고, 카운터(미도시)를 동작시켜 실제 수신 펄스를 생성할 수 있다. The actual pulse generator 520 can generate an actual reception pulse based on the voltage of the reception signal output from the detector 510. [ For example, when the output value converted by the detector 510 exceeds a predetermined reference output value (for example, 1v), the actual pulse generator 520 determines that the reception of the reception signal is started, Can be operated to generate an actual reception pulse.

기준펄스 생성기(530)는 기설정된 기준 수신 펄스를 생성할 수 있다. 예를 들어, 기준펄스 생성기(530)는 초기에는 로우 전압을 유지하다가, 기준펄스 생성기(530)의 카운터(미도시)에 의해 기준 트리거 신호로부터 수신 구간에 해당하는 시간에 도달하면 수신 펄스 구간을 열어주는, 즉, 하이 전압이 정해진 시간동안 유지되는 기준 수신 펄스를 도 2와 같이 생성할 수 있다. 이 때, 기준펄스 생성기(530)는 도 3을 참조하여 설명한 피아식별 레이다의 운용모드 별로 상이한 기준 수신 펄스를 생성할 수 있다.The reference pulse generator 530 may generate a predetermined reference reception pulse. For example, the reference pulse generator 530 maintains a low voltage initially, and when the reference pulse generator 530 reaches a time corresponding to the reception interval from the reference trigger signal by a counter (not shown), the reception pulse interval A reference reception pulse which is opened, that is, a high voltage is maintained for a predetermined time, can be generated as shown in FIG. At this time, the reference pulse generator 530 may generate different reference reception pulses according to the operation modes of the peer identification radar described with reference to FIG.

딜레이 검출기(540)는 실제 수신 펄스와 기준 수신 펄스를 비교하여 기준 수신 펄스 구간에 딜레이 구간(D', D'=D 또는 D'≠D)이 발생하면, 딜레이 구간(D')에 해당하는 수신 딜레이 시간을 카운팅할 수 있다. The delay detector 540 compares the actual reception pulse with the reference reception pulse, and when the delay interval (D ', D' = D or D '≠ D) occurs in the reference reception pulse interval, The receive delay time can be counted.

ADC(550)는 디텍터(510)로부터 출력되는 수신신호에 대한 전압을 디지털 신호로 변환하여 출력할 수 있다.The ADC 550 may convert the voltage of the received signal output from the detector 510 into a digital signal and output the digital signal.

피크 검출기(560)는 ADC(550)에서 변환되어 순차적으로 입력되는 디지털 신호 중 기준 수신 펄스가 하이(high)가 되는 구간의 중간 시간값에 해당하는 시점에서 카운팅된 수신 딜레이 시간만큼 경과한 신호에 대한 첨두 전력값을 출력할 수 있다.The peak detector 560 detects a peak value of a digital signal that is converted and input sequentially by the ADC 550 and which is delayed by a reception delay time counted at a time point corresponding to an intermediate time value of a period in which the reference reception pulse becomes high The peak power value can be output.

도 8은 본 발명의 다른 실시 예에 따른 송수신 첨두전력 측정을 위한 피아식별 질문기(800)를 도시한 도면이다.FIG. 8 is a diagram illustrating a peer identification interrogator 800 for transmitting / receiving peak power measurement according to another embodiment of the present invention.

도 8에 도시된 본 발명의 다른 실시 예에 따른 송수신 첨두전력 측정을 위한 피아식별 질문기(800)는 질문제공 및 첨두전력 검출부(810), 대역 변환부(820) 및 제1 내지 제N송수신기들(830, 840, 850)을 포함할 수 있다.The peer identification interrogator 800 for measuring transmission power and peak power according to another embodiment of the present invention shown in FIG. 8 includes a query providing and peak power detecting unit 810, a band transforming unit 820, (830, 840, 850).

또한, 질문제공 및 첨두전력 검출부(810)는 DAC(812), 송신 첨두전력 검출부(814) 및 수신 첨두전력 검출부(816)을 포함한다. The query providing and peak power detecting unit 810 includes a DAC 812, a transmitting peak power detecting unit 814, and a receiving peak power detecting unit 816.

대역 변환부(820)는 상향 변환부(822), 송신 하향변환부(824) 및 수신 하향변환부(826)를 포함한다. The band transforming unit 820 includes an up-converting unit 822, a down-converting unit 824, and a down-converting unit 826.

제1 내지 제N송수신기들(830, 840, 850)은 전력 증폭기와 저잡음 증폭기를 포함한다. The first to Nth transceivers 830, 840 and 850 include a power amplifier and a low noise amplifier.

도 8에 도시된 피아식별 질문기(800)는 도 1을 참조하여 설명한 피아식별 질문기(100)의 동작과 거의 동일하므로 상세한 설명은 생략한다.8 is substantially the same as the operation of the peer-identification interrogator 100 described with reference to FIG. 1, and thus a detailed description thereof will be omitted.

다만, 도 1에 도시된 피아식별 질문기(100)는 능동위상배열 구조에 맞게 송신경로의 전력증폭기와 수신경로의 저잡음증폭기에 따른 대역변환부와 질문제공 및 첨두전력 검출부를 각 복사소자 채널 별로 구비하고 있는 반면, 도 8에 도시된 피아식별 질문기(800)는 대역변환부와 질문제공 및 첨두전력 검출부를 복사소자들이 공용으로 사용하도록 구비하고 있다.The PI inquiry interrogator 100 shown in FIG. 1 includes a power amplifier of a transmission path and a low-noise amplifier of a reception path according to an active phased array structure, a band conversion unit, a question provision unit, and a peak power detection unit, While the peer identification interrogator 800 shown in FIG. 8 is provided with a band conversion unit, a question provision unit, and a peak power detection unit for common use by the radiation elements.

도 9는 본 발명의 실시 예에 따른 피아식별 질문기(100)의 송수신 첨두전력 측정을 위한 방법을 도시한 흐름도이다.9 is a flowchart illustrating a method for transmitting / receiving peak power measurement of the peer identification interrogator 100 according to an embodiment of the present invention.

도 9에 도시된 송수신 첨두전력 측정을 위한 방법은 도 1 내지 도 7을 참조하여 설명한 피아식별 질문기(100)에 의해 동작할 수 있다. 따라서, 도 9를 참조하는 송수신 첨두전력 측정을 위한 방법의 구체적인 설명은 생략한다.The method for transmitting / receiving peak power measurement shown in FIG. 9 can be operated by the peer identification interrogator 100 described with reference to FIG. 1 to FIG. Therefore, a detailed description of the method for transmitting / receiving peak power measurement with reference to FIG. 9 is omitted.

도 9를 참조하면, 피아식별 질문기(100)는 단일 송수신 모듈 또는 다수의 송수신 모듈에서 N개의 채널 별로 질문신호들을 제공할 수 있다(S910).Referring to FIG. 9, the peer identification interrogator 100 may provide question signals for each of N channels in a single transmission / reception module or a plurality of transmission / reception modules (S910).

피아식별 질문기(100)는 S910단계에서 제공된 질문신호들의 주파수 대역을 상향변환하고(S920), 상향변환된 질문신호들의 전력을 증폭하여 안테나로 송출한다(S930).The peer identification interrogator 100 upconverts the frequency band of the interrogation signals provided in operation S910 (S920), amplifies the power of the upconverted interrogation signals, and transmits the amplified power to the antenna (S930).

그리고, 피아식별 질문기(100)는 송출된 질문신호들을 궤한 경로를 통해 제공받아 N개의 채널 별로 송신출력에 대한 첨두전력을 검출할 수 있다(S940).In step S940, the peer identification interrogator 100 receives the transmitted question signals through the feedback path and detects the peak power of the transmission output for each of the N channels.

또한, 피아식별 질문기(100)는 표적으로부터 반사되어 수신된 수신신호들을 궤환 경로를 통해 제공받아 N개의 채널 별로 수신출력에 대한 첨두전력을 검출할 수 있다(S950).In addition, the peer identification interrogator 100 may receive the received signals reflected from the target through the feedback path to detect the peak power of the received output for each of the N channels (S950).

도 10은 도 9의 S940단계를 자세히 설명하기 위한 흐름도이다.FIG. 10 is a flowchart for explaining step S940 of FIG. 9 in detail.

도 10을 참조하면, 피아식별 질문기(100)는 안테나로 송출된 질문신호를 궤환 경로를 통해 제공받아 주파수 대역을 하향변환할 수 있다(S941).Referring to FIG. 10, in step S941, the peer identification interrogator 100 receives a question signal transmitted through an antenna through a feedback path, and downconverts the frequency band.

피아식별 질문기(100)는 하향변환된 질문신호의 펄스와 기설정된 기준 송출 펄스를 비교하여 딜레이 시간을 검출하고, 검출된 딜레이 시간을 이용하여 하향변환된 질문신호의 첨두전력을 검출한다(S942~S947).The peer identification interrogator 100 detects a delay time by comparing a pulse of the down-converted query signal with a preset reference transmission pulse, and detects the peak power of the down-converted query signal using the detected delay time (S942 ~ S947).

자세히 설명하면, 피아식별 질문기(100)는 S941단계에서 하향변환된 질문신호의 전력을 전압으로 전환시켜 출력할 수 있다(S942).In more detail, in step S941, the peer identification interrogator 100 may convert the power of the down-converted question signal into a voltage and output the voltage.

피아식별 질문기(100)는 S942단계로부터 출력되는 전압에 기초하여 실제 질문 펄스(A_delay)를 생성하고(S943), 기준 트리거 신호에 기초하여 송출 구간을 하이 상태로 유지하는 기준 송출 펄스(A)를 생성할 수 있다(S944).The peer identification interrogator 100 generates an actual question pulse A_delay based on the voltage output from the step S942 (S943), and outputs the reference dispatch pulse A, which keeps the dispatch interval high, based on the reference trigger signal, (S944).

피아식별 질문기(100)는 생성된 실제 질문 펄스와 기준 송출 펄스를 비교하여 기준 송출 펄스 구간에 딜레이 구간(D)이 발생하면, 딜레이 구간(D)에 해당하는 질문 딜레이 시간을 카운팅할 수 있다(S945).The peer identification interrogator 100 compares the generated actual interrogation pulse with the reference transmission pulse and counts the question delay time corresponding to the delay interval D when the delay interval D occurs in the reference transmission pulse interval (S945).

S943단계~S945단계가 수행되는 동안 피아식별 질문기(100)는 S942단계로부터 출력되는 전압을 디지털 신호로 변환할 수 있다(S946).While the steps S943 through S945 are being performed, the interrogator 100 may convert the voltage output from the step S942 into a digital signal (S946).

그리고, 피아식별 질문기(100)는 디지털 신호로 변환되어 순차적으로 입력되는 디지털 신호들 중 기준 송출 펄스가 하이(high)가 되는 구간의 중간 시간값에 해당하는 시점에서 질문 딜레이 시간만큼 경과한 디지털 신호에 대한 첨두 전력값을 검출하여 출력할 수 있다(S947).Then, the interrogator 100 interrogates the digital signal, which has been passed through the interrogation delay time at a time point corresponding to the intermediate time value of the period in which the reference transmission pulse is high, The peak power value for the signal can be detected and output (S947).

도 11은 도 9의 S950단계를 자세히 설명하기 위한 흐름도이다.11 is a flowchart for explaining step S950 of FIG. 9 in detail.

도 11을 참조하면, 피아식별 질문기(100)는 표적으로부터 반사되어 수신된 수신신호를 커플링에 의해 제공받아 저잡음전력을 증폭시킨 후, 주파수 대역을 하향변환할 수 있다(S951, S952).Referring to FIG. 11, the peer identification interrogator 100 may receive the received signal reflected from the target by coupling, amplify low-noise power, and downconvert the frequency band (S951, S952).

피아식별 질문기(100)는 하향변환된 수신신호의 펄스와 기설정된 기준 수신 펄스를 비교하여 딜레이 시간을 검출하고, 검출된 딜레이 시간을 이용하여 하향변환된 수신신호의 첨두전력을 검출한다(S953~S958).The peer identification interrogator 100 detects a delay time by comparing a pulse of the down-converted received signal with a predetermined reference reception pulse, and detects the peak power of the down-converted received signal using the detected delay time (S953 ~ S958).

자세히 설명하면, 피아식별 질문기(100)는 S952단계에서 하향변환된 수신신호의 전력을 전압으로 전환시켜 출력할 수 있다(S953).More specifically, the interrogator 100 interrogates the power of the down-converted received signal in step S952 and outputs the converted signal as a voltage (step S953).

피아식별 질문기(100)는 S953단계로부터 출력되는 전압에 기초하여 실제 수신 펄스를 생성하고(S954), 기준 트리거 신호에 기초하여 수신 구간을 하이 상태로 유지하는 기준 수신 펄스를 생성할 수 있다(S955).The peer identification interrogator 100 generates an actual reception pulse based on the voltage output from the step S953 (S954), and generates a reference reception pulse for keeping the reception interval high in accordance with the reference trigger signal S955).

피아식별 질문기(100)는 생성된 실제 수신 펄스와 기준 수신 펄스를 비교하여 기준 수신 펄스 구간에 딜레이 구간(D')이 발생하면, 딜레이 구간(D')에 해당하는 수신 딜레이 시간을 카운팅할 수 있다(S956).The peer identification interrogator 100 compares the generated actual reception pulse with the reference reception pulse and counts the reception delay time corresponding to the delay interval D 'when the delay interval D' occurs in the reference reception pulse interval (S956).

S954단계~S956단계가 수행되는 동안 피아식별 질문기(100)는 S953단계로부터 출력되는 수신신호에 대한 전압을 디지털 신호로 변환할 수 있다(S957).While the steps S954 to S956 are being performed, the interrogator 100 may convert the voltage of the received signal output from the step S953 into a digital signal (S957).

그리고, 피아식별 질문기(100)는 디지털 신호로 변환되어 순차적으로 입력되는 디지털 신호들 중 기준 수신 펄스가 하이(high)가 되는 구간의 중간 시간값에 해당하는 시점에서 수신 딜레이 시간만큼 경과한 디지털 신호에 대한 첨두 전력값을 검출하여 출력할 수 있다(S958).Then, the interrogation ID interrogator (100) receives intermittent digital signals from the digital signals sequentially converted by the digital interrogator (100) The peak power value for the signal can be detected and output (S958).

한편, 본 발명에 따른 피아식별 질문기의 송수신 첨두전력 측정을 위한 방법은 이를 구현하기 위한 명령어들의 프로그램이 유형적으로 구현됨으로써, 컴퓨터를 통해 판독될 수 있는 기록매체에 포함되어 제공될 수도 있음은 통상의 기술자가 쉽게 이해할 수 있다.Meanwhile, the method for transmitting / receiving peak power measurement of the peer identification interrogator according to the present invention may be provided in a recording medium readable by a computer by tangibly embodying a program of instructions for implementing the method, Can be easily understood by a person skilled in the art.

즉, 본 발명에 따른 피아식별 질문기의 송수신 첨두전력 측정을 위한 방법은 다양한 컴퓨터 수단을 통하여 수행될 수 있는 프로그램 형태로 구현되어, 컴퓨터 판독 가능한 기록매체에 기록될 수 있으며, 상기 컴퓨터 판독 가능한 기록매체는 프로그램 명령, 데이터 파일, 데이터 구조 등을 단독으로 또는 조합하여 포함할 수 있다. 상기 컴퓨터 판독 가능한 기록매체에는 하드 디스크와 같은 자기 매체(magnetic media), CD-ROM, DVD와 같은 광기록 매체(optical media) 및 롬(ROM), 램(RAM), 플래시 메모리, USB 메모리 등과 같은 프로그램 명령을 저장하고 수행하도록 특별히 구성된 하드웨어 장치가 포함된다.That is, the method for transmitting / receiving peak power measurement of the peer identification interrogator according to the present invention can be implemented in a form of a program that can be performed through various computer means, and can be recorded on a computer-readable recording medium, The medium may include program instructions, data files, data structures, etc., alone or in combination. The computer-readable recording medium may be any of various types of media such as magnetic media such as hard disks, optical media such as CD-ROMs and DVDs, and optical disks such as ROMs, RAMs, flash memories, And hardware devices specifically configured to store and execute program instructions.

따라서, 본 발명은 피아식별 질문기의 송수신 첨두전력 측정을 위한 방법을 구현하기 위하여 상기 피아식별 질문기를 제어하는 컴퓨터 상에서 수행되는 컴퓨터 판독 가능한 기록매체에 저장된 프로그램을 함께 제공할 수 있다.Thus, the present invention can also provide a program stored on a computer readable recording medium carried on a computer for controlling said peer identification interrogator to implement a method for transmitting and receiving peak power measurements of a peer identification interrogator.

한편, 이상으로 본 발명의 기술적 사상을 예시하기 위한 바람직한 실시 예와 관련하여 설명하고 도시하였지만, 본 발명은 이와 같이 도시되고 설명된 그대로의 구성 및 작용에만 국한되는 것이 아니며, 기술적 사상의 범주를 일탈함이 없이 본 발명에 대해 다수의 변경 및 수정 가능함을 당업자들은 잘 이해할 수 있을 것이다. 따라서, 그러한 모든 적절한 변경 및 수정과 균등물들도 본 발명의 범위에 속하는 것으로 간주하여야 할 것이다. 따라서, 본 발명의 진정한 기술적 보호 범위는 첨부된 등록청구범위의 기술적 사상에 의해 정해져야 할 것이다.While the present invention has been particularly shown and described with reference to exemplary embodiments thereof, it is to be understood that the present invention is not limited to the disclosed exemplary embodiments, but, on the contrary, It will be apparent to those skilled in the art that numerous modifications and variations can be made to the present invention without departing from the scope of the present invention. Accordingly, all such modifications and variations are intended to be included within the scope of the present invention. Accordingly, the true scope of the present invention should be determined by the technical idea of the appended claims.

100: 피아식별 질문기
110, 120, 130: 제1 내지 제3질문제공 및 첨두전력 검출부들
140, 150, 160: 제1 내지 제3대역 변환부들
170, 180, 190: 제1 내지 제3송수신기들
112: 제1DAC 114: 제1송신 첨두전력 검출부
116: 제1수신 첨두전력 검출부 142: 제1대역 변환부
144: 제1송신 하향변환부 146: 제1수신 하향변환부
172: 제1전력증폭기 174: 제1저잡음증폭기
100: Peer Identification Questioner
110, 120, and 130: providing first to third questions, and peak power detectors
140, 150, 160: First to third band converters
170, 180, 190: first to third transceivers
112: first DAC 114: first transmission peak power detector
116: first receiving peak power detecting unit 142: first band converting unit
144: first transmission down-converter 146: first reception down-
172: first power amplifier 174: first low noise amplifier

Claims (11)

능동위상배열 레이다 및 수동위상배열 레이다 중 적어도 하나의 송수신 첨두전력 측정을 위한 피아식별 질문기에 있어서,
N개의 채널 별로 질문신호들을 제공하는 다수의 질문 제공 및 첨두전력 검출부들;
상기 다수의 질문 제공 및 첨두전력 검출부들에서 제공되는 질문신호들의 주파수 대역을 상향변환하는 다수의 대역 변환부들; 및
상기 상향변환된 질문신호들의 전력을 증폭하여 안테나로 송출하고, 상기 송출된 질문신호들과 표적으로부터 반사되어 수신된 수신신호들을 궤환 경로를 통해 상기 다수의 대역 변환부들로 제공하는 다수의 송수신기들;을 포함하고,
상기 다수의 대역 변환부들은 상기 수신된 질문신호들과 수신신호들의 주파수대역을 하향변환하고,
상기 다수의 질문 제공 및 첨두전력 검출부들은, 상기 하향변환된 질문신호들과 수신신호들의 딜레이 시간을 각각 검출하고, 상기 각각 검출된 딜레이 시간을 이용하여 상기 하향변환된 질문신호들 및 상기 하향변환된 수신신호들에 대한 첨두전력을 검출하며,
상기 다수의 송수신기들 각각은,
상기 상향변환된 질문신호의 전력을 증폭하는 전력 증폭기; 및
상기 증폭된 질문신호가 상기 안테나로 송출된 후 상기 표적으로부터 반사된 수신신호에 대해 저잡음전력을 증폭하는 저잡음 증폭기;를 포함하고,
상기 다수의 대역 변환부들은 각각,
상기 질문 제공 및 첨두전력 검출부에서 제공되는 질문신호의 주파수 대역을 상향변환하는 상향변환부;
상기 전력 증폭기에서 증폭되어 안테나로 송출된 질문신호를 상기 궤환 경로를 통해 제공받아 주파수 대역을 하향변환하는 송신 하향변환부; 및
상기 저잡음 증폭기에서 저잡음 증폭된 수신신호의 주파수 대역을 하향변환하는 수신 하향변환부;를 포함하고,
상기 다수의 질문 제공 및 첨두전력 검출부들은 각각,
상기 질문신호를 아날로그 신호로 변환하여 상기 상향변환부로 출력하는 DAC(Digital Analog Converter);
상기 송신 하향변환부에서 하향변환된 질문신호의 펄스와 기설정된 기준 송출 펄스를 비교하여 상기 질문신호의 딜레이 시간(이하, '질문 딜레이 시간'이라 한다)을 검출하고, 상기 검출된 질문 딜레이 시간을 이용하여 상기 하향변환된 질문신호의 첨두전력을 검출하는 송신 첨두전력 검출부; 및
상기 수신 하향변환부에서 하향변환된 수신신호의 펄스와 기설정된 기준 수신 펄스를 비교하여 상기 수신신호의 딜레이 시간(이하, '수신 딜레이 시간'이라 한다)을 검출하고, 상기 검출된 수신 딜레이 시간을 이용하여 상기 하향변환된 수신신호의 첨두전력을 검출하는 수신 첨두전력 검출부;를 포함하는 것을 특징으로 하는 송수신 첨두전력 측정을 위한 피아식별 질문기.
A peer identification interrogator for measuring transmit and receive peak power of at least one of an active phased array radar and a passive phased array radar,
A plurality of question providing and peak power detectors for providing question signals for each of N channels;
A plurality of band converters for up-converting a frequency band of the question signals provided from the plurality of question providing and peak power detecting units; And
A plurality of transceivers for amplifying the power of the up-converted Q signals and transmitting the amplified signals to an antenna, and for providing the received signals reflected from the target to the plurality of band converters via a feedback path; / RTI >
Wherein the plurality of band converters downconvert the frequency bands of the received interrogation signals and the received signals,
The plurality of question providing and peak power detecting units detect a delay time of the down-converted question signals and received signals, respectively, and output the down-converted question signals and the down- Detecting peak power for received signals,
Each of the plurality of transceivers comprising:
A power amplifier for amplifying the power of the upconverted question signal; And
And a low noise amplifier for amplifying the low noise power of the received signal reflected from the target after the amplified interrogation signal is sent to the antenna,
The plurality of band transformers are respectively connected to a plurality of band-
An up-converting unit for up-converting a frequency band of the question signal provided by the question providing and peak power detecting unit;
A down converter for downconverting a frequency band by receiving a question signal amplified by the power amplifier and sent to an antenna through the feedback path; And
And a receiving downconverting unit for downconverting the frequency band of the low noise amplified receiving signal in the low noise amplifier,
Wherein the plurality of question provisioning and peak power detecting units are respectively provided with:
A DAC (Digital Analog Converter) for converting the question signal into an analog signal and outputting the analog signal to the up-converter;
The transmission down-converter detects a delay time of the question signal (hereinafter, referred to as 'question delay time') by comparing a pulse of the down-converted question signal with a predetermined reference dispatch pulse, A transmitted peak power detector for detecting a peak power of the down-converted question signal; And
The reception down-converter converts the down-converted reception signal to a predetermined reference reception pulse to detect a delay time of the reception signal (hereinafter, referred to as reception delay time) And a peak power detector for detecting the peak power of the down-converted received signal using the peak power detector.
삭제delete 삭제delete 삭제delete 제1항에 있어서,
상기 송신 첨두전력 검출부는,
상기 하향변환된 질문신호의 전력을 전압으로 전환시켜 출력하는 디텍터;
상기 디텍터로부터 출력되는 전압에 기초하여 실제 질문 펄스를 생성하는 실제 펄스 생성기;
상기 기설정된 기준 송출 펄스를 생성하는 기준 펄스 생성기;
상기 실제 질문 펄스와 상기 기준 송출 펄스를 비교하여 딜레이 구간이 발생하면, 상기 딜레이 구간에 해당하는 송출 딜레이 시간을 카운팅하는 딜레이 검출기;
상기 디텍터로부터 출력되는 질문신호에 대한 전압을 디지털 신호로 변환하는 ADC(Analog Digital Converter); 및
상기 ADC에서 변환되어 순차적으로 입력되는 디지털 신호들 중 상기 기준 송출 펄스가 하이(high)가 되는 구간의 중간 시간값에 해당하는 시점에서 상기 카운팅된 송출 딜레이 시간만큼 경과한 신호에 대한 첨두 전력값을 출력하는 피크 검출기;를 포함하는 것을 특징으로 하는 송수신 첨두전력 측정을 위한 피아식별 질문기.
The method according to claim 1,
Wherein the transmission peak power detection unit comprises:
A detector for converting the power of the down-converted Q signal into a voltage and outputting the converted voltage;
An actual pulse generator for generating an actual question pulse based on a voltage output from the detector;
A reference pulse generator for generating the predetermined reference transmission pulse;
A delay detector for comparing the actual question pulse with the reference dispatch pulse to count a dispatch delay time corresponding to the delay interval when a delay interval occurs;
An ADC (Analog Digital Converter) for converting the voltage of the question signal output from the detector into a digital signal; And
A peak power value for a signal that has elapsed by the counted transmission delay time at a time point corresponding to an intermediate time value of an interval during which the reference transmission pulse is high among the digital signals sequentially converted and input by the ADC A peer identification interrogator for measuring transmission and reception peak power.
제1항에 있어서,
상기 수신 첨두전력 검출부는,
상기 하향변환된 수신신호의 전력을 전압으로 전환시켜 출력하는 디텍터;
상기 디텍터로부터 출력되는 전압에 기초하여 실제 수신 펄스를 생성하는 실제 펄스 생성기;
상기 기설정된 기준 수신 펄스를 생성하는 기준 펄스 생성기;
상기 실제 수신 펄스와 상기 기준 수신 펄스를 비교하여 딜레이 구간이 발생하면, 상기 딜레이 구간에 해당하는 수신 딜레이 시간을 카운팅하는 딜레이 검출기;
상기 디텍터로부터 출력되는 수신신호에 대한 전압을 디지털 신호로 변환하는 ADC(Analog Digital Converter); 및
상기 ADC에서 변환되어 순차적으로 입력되는 디지털 신호 중 상기 기준 수신 펄스가 하이(high)가 되는 구간의 중간 시간값에 해당하는 시점에서 상기 카운팅된 수신 딜레이 시간만큼 경과한 신호에 대한 첨두 전력값을 출력하는 피크 검출기;를 포함하는 것을 특징으로 하는 송수신 첨두전력 측정을 위한 피아식별 질문기.
The method according to claim 1,
Wherein the reception peak power detection unit comprises:
A detector for converting the power of the down-converted received signal into a voltage and outputting the converted voltage;
An actual pulse generator for generating an actual reception pulse based on a voltage output from the detector;
A reference pulse generator for generating the predetermined reference reception pulse;
A delay detector for comparing the actual reception pulse with the reference reception pulse to count a reception delay time corresponding to the delay interval when a delay interval occurs;
An ADC (Analog Digital Converter) for converting the voltage of the received signal output from the detector into a digital signal; And
A peak power value for a signal that has elapsed by the counted reception delay time at a time point corresponding to an intermediate time value of an interval during which the reference reception pulse is high among the digital signals sequentially converted and input by the ADC A peer identification interrogator for measuring transmit / receive peak power.
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