KR101668671B1 - 표시 장치 - Google Patents

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Abstract

본 발명의 실시예들에 따른 표시 장치는 제 1 방향의 데이터 라인들과 상기 데이터 라인들에 수직한 제 2 방향의 게이트 라인들의 교차에 의해 형성되는 서브 화소들이 배열된 활성 영역 및 상기 활성 영역 외곽의 비활성 영역을 포함하는 표시 패널과, 상기 표시 패널의 상기 게이트 라인 및 상기 데이터 라인에 구동 신호를 공급하는 구동부와, 상기 구동부에서 상기 제 1 방향으로 인출되어 상기 데이터 라인에 데이터 신호를 인가하는 데이터 링크들 및 상기 구동부에서 인출되어 상기 구동부와 상기 활성 영역 사이의 비활성 영역 및 상기 제 1 방향으로 상기 활성 영역까지 연장 형성되어 상기 제 2 방향의 상기 게이트 라인에 게이트 신호를 인가하는 게이트 링크들을 포함하여 비활성 영역의 면적을 최소화하고 개구율을 향상시킬 수 있다.

Description

표시 장치 {Display Device}
본 발명의 실시예들은 표시 장치에 관한 것으로, 보다 상세하게는 비활성 영역의 면적을 최소화하고 개구율을 향상시킬 수 있는 표시 장치에 관한 것이다.
근래 정보화 사회의 발전과 더불어, 표시 장치에 대한 다양한 형태의 요구가 증대되면서, 액정 표시 장치(Liquid Crystal Display Device; LCD), 플라즈마 디스플레이 패널(Plasma Display Panel; PDP), 전계 방출 장치(Field Emission Display Device; FED), 전기 영동 표시 장치(Electrophoretic Display Device: EPD), 유기 발광 표시 장치(Organic light emitting device: OLED) 등 표시 장치에 대한 연구가 활발히 진행되고 있다.
표시 장치는 수동 매트릭스(passive matrix) 방식과 능동 매트릭스(active matrix) 방식으로 구분된다. 능동 매트릭스 방식의 표시 장치는 서브 화소들이 매트릭스 형태로 배열되는 것으로 수동 매트릭스 방식에 비해 해상도 및 동영상 구현 능력이 우수하여 주로 사용되고 있다.
도 1을 참조하면, 능동형 표시 장치는 화상을 구현하는 최소 단위인 서브 화소(20)들이 액티브 매트릭스 형태로 배열되는 표시 패널(10)과, 표시 패널(10)을 구동하기 위한 구동부(30)를 구비한다.
표시 패널(10)은 게이트 라인들(G1~Gn) 및 데이터 라인들(D1~Dm)에 의해 구획되는 각각의 서브 화소(20)들이 배열된 활성 영역(Active Area; 12) 및 활성 영역(12) 외곽에 위치하여 게이트 라인들(G1~Gn) 및 데이터 라인들(D1~Dm)에 각각 연결되는 게이트 링크들(GL1∼GLn) 및 데이터 링크들(DL1~DLm)이 형성되고 게이트 링크들(GL1∼GLn) 및 데이터 링크들(DL1~DLm)에 구동 신호를 공급하는 구동부(30)가 실장된 비활성 영역(14)으로 구성된다.
이 때, 구동부(30)는 게이트 구동부와 데이터 구동부로 나뉘어 구현될 수도 있으나, 소형 표시 장치인 경우 도시된 바와 같이 주사 신호를 출력하는 게이트 구동부와 화상 신호를 출력하는 데이터 구동부가 원-칩으로 구성된 단일 구동부로 적용됨이 일반적이다.
게이트 링크들(GL1~GLn) 및 데이터 링크들(DL1~DLm)은 구동부(30)에서 비활성 영역(14)으로 인출되어 활성 영역(12)에 배열된 게이트 라인들(G1~Gn) 및 데이터 라인들(D1~Dm)에 각각 연결된다. 이 때, 게이트 링크들(GL1~GLn)의 경우 활성 영역(12)의 좌우 양 측면에서 수직인 제 1 방향으로 인출되어 수평인 제 2 방향으로 배열된 게이트 라인들(G1~Gn)과 각각 연결되는바, 이를 구현하기 위해서 활성 영역(12)의 좌우 양 측면에 위치한 비활성 영역(14)의 폭이 확보되어야 한다.
그러나, 비활성 영역(14)의 폭이 넓어지게 되면 상대적으로 활성 영역(12)의 면적이 작아지며, 비활성 영역(14)의 폭에 연동하여 블랙 매트릭스의 면적이 넓어짐에 따라 개구율이 저하된다. 즉, 종래의 표시 장치 구조에 의할 경우 활성 영역 면적을 최대화하는 최근의 추세를 반영하기 어렵다.
본 발명의 실시예들은 비활성 영역의 면적을 최소화하고 개구율을 향상시킬 수 있는 표시 장치를 제공한다.
본 발명의 실시예에 따르면, 표시 장치는 제 1 방향의 데이터 라인들과 상기 데이터 라인들에 수직한 제 2 방향의 게이트 라인들의 교차에 의해 형성되는 서브 화소들이 배열된 활성 영역 및 상기 활성 영역 외곽의 비활성 영역을 포함하는 표시 패널과, 상기 표시 패널의 상기 게이트 라인 및 상기 데이터 라인에 구동 신호를 공급하는 구동부와, 상기 구동부에서 상기 제 1 방향으로 인출되어 상기 데이터 라인에 데이터 신호를 인가하는 데이터 링크들 및 상기 구동부에서 인출되어 상기 구동부와 상기 활성 영역 사이의 비활성 영역 및 상기 제 1 방향으로 상기 활성 영역까지 연장 형성되어 상기 제 2 방향의 상기 게이트 라인에 게이트 신호를 인가하는 게이트 링크들을 포함한다.
상기 비활성 영역에 형성되는 게이트 링크들은 상기 구동부와 상기 활성 영역 사이의 비활성 영역에만 형성된다. 상기 게이트 링크들은 2개씩 한 쌍을 이루어 상기 활성 영역 내의 동일 선 상에 형성된다. 상기 한 쌍의 게이트 링크는 절연막을 사이에 두고 중첩되어 형성된다.
상기 한 쌍의 게이트 링크는 최외곽의 일측 상기 서브 화소 이후부터 2 개의 상기 서브 화소를 사이에 두고 형성되고, 최외곽의 타측 상기 서브 화소의 측부에는 하나의 게이트 링크만 형성된다.
상기 데이터 라인들은 2개씩 한 쌍을 이루어 상기 활성 영역 내의 동일 선 상에 형성된다. 상기 한 쌍의 데이터 라인은 절연막을 사이에 두고 중첩되어 형성된다.
최외곽 일측의 상기 서브 화소의 측부에는 하나의 데이터 라인만 형성되고, 상기 한 쌍의 데이터 라인은 상기 최외곽 일측의 상기 서브 화소 이후부터 2 개의 상기 서브 화소마다 형성된다.
본 발명의 다른 실시예에 따른 표시 장치는 제 1 방향의 데이터 라인들과 상기 데이터 라인들에 수직한 제 2 방향의 게이트 라인들의 교차에 의해 형성되는 서브 화소들이 배열된 활성 영역 및 상기 활성 영역 외곽의 비활성 영역을 포함하는 표시 패널과, 상기 표시 패널의 상기 게이트 라인 및 상기 데이터 라인에 구동 신호를 공급하는 구동부 및 상기 구동부에서 인출되어 상기 구동부와 상기 활성 영역 사이의 비활성 영역에서 상기 활성 영역까지 연장 형성되어 상기 게이트 라인에 게이트 신호를 인가하는 게이트 링크들을 포함한다.
여기서, 상기 비활성 영역에 형성되는 상기 게이트 링크들은 상기 구동부와 상기 활성 영역 사이의 비활성 영역에만 형성된다.
상기 게이트 링크들은 상기 활성 영역에서 상기 데이터 라인과 동일한 방향으로 연장 형성된다. 상기 게이트 링크와 상기 데이터 라인은 절연막을 사이에 두고 동일 선 상에 중첩되어 형성된다. 상기 게이트 링크는 전기적으로 연결되는 해당 게이트 라인까지만 상기 활성 영역 내에 연장 형성된다.
본 발명의 또 다른 실시예에 따른 표시 장치는 제 1 방향의 데이터 라인들과 상기 데이터 라인들에 수직한 제 2 방향의 게이트 라인들의 교차에 의해 형성되는 서브 화소들이 배열된 활성 영역 및 상기 활성 영역 외곽의 비활성 영역을 포함하는 표시 패널과, 상기 표시 패널의 상기 게이트 라인 및 상기 데이터 라인에 구동 신호를 공급하는 구동부와, 상기 구동부에서 상기 제 1 방향으로 인출되어 상기 데이터 라인에 데이터 신호를 인가하는 데이터 링크들 및 상기 구동부에서 인출되어 상기 구동부와 상기 활성 영역 사이의 비활성 영역에서 상기 활성 영역까지 연장 형성되어 상기 게이트 라인에 게이트 신호를 인가하는 게이트 링크들을 포함한다.
여기서, 상기 비활성 영역에 형성되는 상기 게이트 링크들은 상기 구동부와 상기 활성 영역 사이의 비활성 영역에만 형성되고, 상기 활성 영역 내에서 최외곽 타측의 상기 서브 화소 이전에 2 개의 게이트 링크가 한 쌍을 이루어 동일 선 상에 형성되고, 최외곽 일측의 상기 서브 화소 이후로 2 개의 데이터 라인이 한 쌍을 이루어 동일 선 상에 형성된다.
상기 한 쌍의 게이트 링크는 제 1 절연막을 사이에 두고 중첩되어 형성되고, 상기 한 쌍의 데이터 라인은 제 2 절연막을 사이에 두고 중첩되어 형성된다.
상기 최외곽 일측에 형성되는 상기 서브 화소 측부의 상기 데이터 라인은 하나만 형성되고, 상기 최외곽 타측에 형성되는 상기 서브 화소 측부의 상기 게이트 라인은 하나만 형성된다.
상기 한 쌍의 게이트 링크는 상기 최외곽 일측에 형성되는 상기 서브 화소 이후부터 2 개의 상기 서브 화소를 사이에 두고 형성된다. 상기 한 쌍의 데이터 라인은 상기 최외곽 일측에 형성되는 상기 서브 화소 이후부터 2 개의 상기 서브 화소마다 형성된다.
본 발명의 실시예들은 비활성 영역에 배열되던 게이트 링크들을 데이터 링크들과 동일한 방향으로 인출하여 절연막을 사이에 두고 데이터 링크들 및 데이터 라인들과 중첩되게 활성 영역에 형성함으로써, 활성 영역의 양 측부에 위치한 비활성 영역을 제거하거나 그 면적을 최소화할 수 있다.
또는, 본 발명의 실시예들은 게이트 링크들을 데이터 링크들과 동일한 방향으로 인출하여 절연막을 사이에 두고 서로 중첩되게 활성 영역에 형성하고, 데이터 라인들을 절연막을 사이에 두고 서로 중첩되게 형성함으로써, 활성 영역의 양측부에 위치한 비활성 영역을 제거하거나 그 면적을 최소화할 수 있다.
아울러, 본 발명의 실시예들은 비활성 영역 및 활성 영역 내의 비표시 영역의 폭이나 면적에 연동하여 형성되는 블랙 매트릭스의 면적을 최소로 줄일 수 있으므로 개구율을 향상시킬 수 있다.
도 1은 종래의 표시 장치의 구성을 나타내는 도면이다.
도 2a는 본 발명의 일 실시예에 의한 표시 장치의 구성을 나타내는 도면이다.
도 2b는 도 2a에 도시된 본 발명의 일 실시예에 의한 표시 장치의 등가 회로도이다.
도 3은 도 2a에 도시된 본 발명의 일 실시예에 의한 표시 패널의 레이아웃 배치도이다.
도 4a는 도 3에 도시된 본 발명의 일 실시예에 의한 표시 패널의 A 영역을 나타내는 단면도이다.
도 4b 및 도 4c는 도 3에 도시된 본 발명의 일 실시예에 의한 표시 패널의 B 영역을 나타내는 단면도이다.
도 5a는 본 발명의 다른 실시예에 의한 표시 장치의 구성을 나타내는 도면이다.
도 5b는 도 5a에 도시된 본 발명의 다른 실시예에 의한 표시 장치의 등가 회로도이다.
도 6a는 도 5a에 도시된 본 발명의 다른 실시예에 의한 표시 패널의 C 영역을 나타내는 단면도이다.
도 6b는 도 5a에 도시된 본 발명의 다른 실시예에 의한 표시 패널의 D 영역을 나타내는 단면도이다.
이하, 첨부된 도면을 통해 본 발명의 실시예들에 따른 표시 장치를 상세히 설명하도록 한다.
여기서 i) 첨부된 도면들에 도시된 형상, 크기, 비율, 각도, 개수 등은 개략적인 것으로 다소 변경될 수 있다. ii) 도면은 관찰자의 시선으로 도시되기 때문에 도면을 설명하는 방향이나 위치는 관찰자의 위치에 따라 다양하게 변경될 수 있다. iii) 도면 번호가 다르더라도 동일한 부분에 대해서는 동일한 도면 부호가 사용될 수 있다.
iv) '포함한다', '갖는다', '이루어진다' 등이 사용되는 경우 '~만'이 사용되지 않는 이상 다른 부분이 추가될 수 있다. v) 단수로 설명되는 경우 다수로도 해석될 수 있다. vi) 형상, 크기의 비교, 위치 관계 등이 '약', '실질적' 등으로 설명되지 않아도 통상의 오차 범위가 포함되도록 해석된다. vii) '~후', '~전', '이어서', '그리고', '여기서', '후속하여', '이 때' 등의 용어가 사용되더라도 시간적 위치를 한정하는 의미로 사용되지는 않는다.
viii) '제 1', '제 2', '제 3' 등의 용어는 단순히 구분의 편의를 위해 선택적, 교환적 또는 반복적으로 사용되며 한정적 의미로 해석되지 않는다. ix) '~상에', '~상부에', '~하부에', '~옆에' 등으로 두 부분의 위치 관계가 설명되는 경우 '바로'가 사용되지 않는 이상 두 부분 사이에 하나 이상의 다른 부분이 위치할 수도 있다. x)부분들이 '~또는'으로 연결되는 경우 부분들 단독뿐만 아니라 조합도 포함되게 해석되나 '~또는 ~중 하나'로 연결되는 경우 부분들 단독으로만 해석된다.
도 2a는 본 발명의 일 실시예에 의한 표시 장치의 구성을 나타내는 도면이고, 도 2b는 도 2a에 도시된 본 발명의 일 실시예에 의한 표시 장치의 등가 회로도이다. 도 3은 도 2a에 도시된 본 발명의 일 실시예에 의한 표시 패널의 레이아웃 배치도이다.
도 2a 및 도 2b를 참조하면, 본 발명의 일 실시예에 의한 표시 장치(100)는 표시 패널(110)과, 표시 패널(110)을 구동하기 위한 구동 신호를 공급하는 구동부(130)를 포함한다. 구동 신호는 구동부(130)에서 인출된 게이트 링크들(GL1∼GLn) 및 데이터 링크들(DL1~DLm)을 통해 표시패널(110)의 게이트 라인들(G1~Gn) 및 데이터 라인들(D1~Dm)에 공급된다.
표시 패널(110)은 게이트 라인들(G1~Gn) 및 데이터 라인들(D1~Dm)의 교차에 의해 액티브 매트릭스 형태로 구획된 서브 화소(120)들이 배열된 활성 영역(112)과, 활성 영역(112)의 외곽에 위치하는 비활성 영역(114)으로 정의될 수 있다. 비활성 영역(114)은 활성 영역(112) 외곽의 4면으로 정의될 수 있다.
비활성 영역(114)의 일면에는 게이트 링크들(GL1∼GLn) 및 데이터 링크들(DL1~DLm)에 구동 신호를 공급하는 구동부(130)가 실장된다. 데이터 라인들(D1~Dm)은 제 1 방향으로 배열되고, 게이트 라인들(G1~Gn)은 제 1 방향에 수직인 제 2 방향으로 배열된다.
데이터 링크들(DL1~DLm)은 구동부(130)로부터의 데이터 신호(data signal)를 데이터 라인들(D1~Dn)에 공급한다. 이를 위해, 데이터 링크들(DL1~DLm)은 구동부(130)에서 비활성 영역(114)의 제 1 방향으로 인출되어 활성 영역(112)의 제 1 방향으로 위치하는 데이터 라인들(D1~Dm)과 각각 전기적으로 연결된다.
게이트 링크들(GL1~GLn)은 구동부(130)로부터의 게이트 신호(gate signal)를 게이트 라인들(G1~Gn)에 공급한다. 이를 위해, 게이트 링크들(GL1~GLn)은 구동부(130)에서 인출되어 구동부(130)와 활성 영역(112) 사이의 비활성 영역(114)에서 수직인 제 1 방향으로 활성 영역(112)까지 연장되어 위치한다.
이 때, 비활성 영역(114)에 형성되는 게이트 링크들(GL1~GLn)은 구동부(130)와 표시 패널(110)의 활성 영역(112) 사이의 비활성 영역(114)에만 위치한다. 본 발명의 일 실시예에 의한 게이트 링크들(GL1~GLn)은 구동부(130)와 표시 패널(110)의 활성 영역(112) 사이의 비활성 영역(114)에만 위치하므로, 활성 영역(112)의 양 측부에 위치한 비활성 영역(114)을 제거하거나 그 면적을 최소화할 수 있다.
수직인 제 1 방향으로 인출된 게이트 링크들(GL1~GLn)은 활성 영역(112)에서 제 1 방향에 직교하는 제 2 방향의 게이트 라인들(G1~Gn)과 각각 전기적으로 연결된다. 이 때, 게이트 링크들(GL1~GLn) 각각은 도 2b의 굵은 선으로 도시된 바와 같이 연결되는 해당 게이트 라인들(G1~Gn)까지만 연장 형성되어 게이트 신호(gate signal)를 각각의 게이트 라인들(G1~Gn)에 공급한다.
즉, 도 3에 도시된 바와 같이 활성 영역(112) 내에서 제 1 방향의 제 1 게이트 링크(GL1)는 제 2 방향의 제 1 게이트 라인(G1)까지 연장 형성되고, 제 1 방향의 제 2 게이트 링크(GL2)는 제 2 방향의 제 2 게이트 라인(G2)까지만 연장 형성된다. 제 1 방향의 제 3 게이트 링크(GL3)는 제 2 방향의 제 3 게이트 라인(G3)까지만 연장 형성되는 식으로, 제 1 방향의 제 N번째 게이트 링크(GLn)는 제 2 방향의 제 N번째 게이트 라인(Gn)까지만 연장 형성된다.
한편, 게이트 링크에 이용되는 도전 물질로 R, G, B 서브 화소(120)의 화소 전극과 드레인 전극 또는 소스 전극을 전기적으로 연결하여 R, G, B 서브 화소(120)에 전원을 공급할 수 있다.
본 발명의 일 실시예에서는 활성 영역(112) 내에서 게이트 링크들(GL1~GLn)과 동일한 제 1 방향으로 중첩되어 위치하는 데이터 라인들(D1~Dm)간의 전기적 쇼트를 방지하기 위하여 게이트 링크들(GL1~GLn)과 데이터 라인들(D1~Dm) 사이에 절연막을 형성한다.
이 때, 동일한 제 1 방향의 게이트 링크들(GL1~GLn)과 데이터 라인들(D1~Dm)은 절연막을 사이에 두고 중첩되게 위치하므로 서브 화소(120)들 사이의 간격이 변하는 것은 아니다. 즉, 활성 영역(112) 내에서 신호 라인들이 형성되는 비표시 영역이 증가하는 것은 아니다.
본 발명의 일 실시예에서는 게이트 링크들(GL1~GLn)을 데이터 라인(D1~Dm)들과 중첩되게 형성함으로써, 활성 영역(112) 내의 비표시 영역 상에 형성되던 블랙 매트릭스의 면적을 최소화할 수 있으므로 개구율을 향상시킬 수 있다.
구체적으로, 게이트 링크들(GL1~GLn), 데이터 라인들(D1~Dm) 및 게이트 라인들(GL1~GLn)이 중첩되는 영역(A)은 도 4a에 도시된 바와 같이 하부 기판(122) 상에 전면 증착된 제 1 절연막(125) 상에 게이트 라인(G)이 위치한다. 게이트 라인(G) 상에 제 1 층간 절연막(126)이 위치하고, 제 1 층간 절연막(126) 상에 데이터 라인(D)이 위치한다. 데이터 라인(D) 상에 제 2 층간 절연막(127)이 위치하고, 제 2 층간 절연막(127) 상에 게이트 링크(GL)가 위치한다.
게이트 링크들(GL1~GLn)과 데이터 라인들(D1~Dm)이 중첩되는 영역(B)은 도 4b에 도시된 바와 같이 하부 기판(122) 상에 전면 증착된 제 1 절연막(125) 상에 데이터 라인(D)이 위치하고, 데이터 라인(D) 상에 제 2 층간 절연막(127)이 위치하고, 제 2 층간 절연막(127) 상에 게이트 링크(GL)가 위치한다.
게이트 라인(G)과 데이터 라인(D)은 제 1 층간 절연막(126)에 의해 절연되고, 데이터 라인(D)과 게이트 링크(GL)는 제 2 층간 절연막(127)에 의해 절연된다. 즉, 게이트 라인(G)과 데이터 라인(D)은 제 1 층간 절연막(126)을 사이에 두고 중첩되도록 형성되고, 데이터 라인(D)과 게이트 링크(GL)는 제 2 층간 절연막(127)을 사이에 두고 중첩되도록 형성된다.
게이트 링크(GL) 상에 제 2 절연막(128) 및 제 3 절연막(129)이 순차로 더 적층될 수 있고, 하부 기판(122)과 제 1 절연막(125) 사이에 반도체층(124)이 더 형성될 수 있다.
또한, 게이트 링크들(GL1~GLn)과 데이터 라인들(D1~Dm)이 중첩되는 영역(B)은 도 4c에 도시된 바와 같이 하부 기판(122') 상에 게이트 링크(GL')가 위치하고, 게이트 링크(GL') 상에 제 2 절연막(128') 및 제 1 절연막(125')이 위치하고, 제 1 절연막(125') 상에 데이터 라인(D')이 위치할 수 있다.
데이터 라인(D')과 게이트 링크(GL')는 제 2 절연막(128') 및 제 1 절연막(125')에 의해 절연될 수 있다. 데이터 라인(D') 상에 제 2 층간 절연막(127') 및 제 3 절연막(129')이 순차로 더 적층될 수 있고, 제 2 절연막(128')과 제 1 절연막(125') 사이에 반도체층(124')이 더 형성될 수 있다.
여기서, 제 1 절연막(125, 125')은 게이트 산화막 또는 게이트 절연막일 수 있고, 제 2 절연막(128, 128')은 패시베이션막일 수 있고, 제 3 절연막(129, 129')은 유기 절연막일 수 있다.
상술한 바와 같이 본 발명의 일 실시예는 게이트 링크들(GL1~GLn)을 데이터 링크들(DL1~DLm)과 동일한 방향으로 인출하여 절연막을 사이에 두고 데이터 링크들(DL1~DLm) 및 데이터 라인(D1~Dm)들과 중첩되게 활성 영역(112)의 양 측부에 위치한 비활성 영역(114)이 아닌 활성 영역(112)에 형성한다. 따라서, 발명의 일 실시예는 종래에 게이트 링크들(GL1~GLn)이 형성되었던 활성 영역(112)의 양 측부에 위치한 비활성 영역(114)을 제거하거나 그 면적을 최소화할 수 있다.
아울러, 본 발명의 실시예는 비활성 영역(114)의 폭이나 면적에 연동하여 형성되는 블랙 매트릭스의 면적을 최소로 줄일 수 있으므로 개구율을 향상시킬 수 있다.
이하, 본 발명의 다른 실시예에 의한 표시 장치를 설명하기로 한다.
도 5a는 본 발명의 다른 실시예에 의한 표시 장치의 구성을 나타내는 도면이고, 도 5b는 도 5a에 도시된 본 발명의 다른 실시예에 의한 표시 장치의 등가 회로도이다. 도 6a는 도 5a에 도시된 본 발명의 다른 실시예에 의한 표시 패널의 C 영역을 나타내는 단면도이고, 도 6b는 도 5a에 도시된 본 발명의 다른 실시예에 의한 표시 패널의 D 영역을 나타내는 단면도이다.
도 5a 및 도 5b를 참조하면, 본 발명의 다른 실시예에 의한 표시 장치(200)는 표시 패널(210)과, 표시 패널(210)을 구동하기 위한 구동 신호를 공급하는 구동부(230)를 포함한다. 구동 신호는 구동부(230)에서 인출된 게이트 링크들(GL1∼GLn) 및 데이터 링크들(DL1~DLm)을 통해 표시패널(210)의 게이트 라인들(G1~Gn) 및 데이터 라인들(D1~Dm)에 공급된다.
표시 패널(210)은 게이트 라인들(G1~Gn) 및 데이터 라인들(D1~Dm)의 교차에 의해 액티브 매트릭스 형태로 구획된 서브 화소(220)들이 배열된 활성 영역(212)과, 활성 영역(212)의 외곽에 위치하는 비활성 영역(214)으로 정의될 수 있다. 비활성 영역(214)은 활성 영역(212) 외곽의 4면으로 정의될 수 있다.
비활성 영역(214)의 일면에는 게이트 링크들(GL1∼GLn) 및 데이터 링크들(DL1~DLm)에 구동 신호를 공급하는 구동부(230)가 실장된다. 데이터 라인들(D1~Dm)은 제 1 방향으로 배열되고, 게이트 라인들(G1~Gn)은 제 1 방향에 수직인 제 2 방향으로 배열된다.
데이터 링크들(DL1~DLm)은 구동부(230)로부터의 데이터 신호(data signal)를 데이터 라인들(D1~Dm)에 공급한다. 이를 위해, 데이터 링크들(DL1~DLm)은 구동부(230)에서 비활성 영역(214)의 제 1 방향으로 인출되어 활성 영역(212)의 제 1 방향으로 위치하는 데이터 라인들(D1~Dm)과 각각 전기적으로 연결된다.
이 때, 데이터 링크들(DL1~DLm) 및 데이터 라인들(D1~Dm)은 각각 2 개의 선이 한 쌍을 이루어 절연막을 사이에 두고 동일 선 상에 중첩되도록 위치한다. 다만, 예외적으로 활성 영역(212)의 최외곽 일측에는 제 1 데이터 링크(DL1)와 연결되는 제 1 데이터 라인(D1)만 위치한다.
구체적으로, 활성 영역(212)의 최외곽 일측에는 제 1 데이터 라인(D1)만 위치하고, 2개의 서브 화소(220)를 사이에 두고 제 2 데이터 라인(D2) 및 제 3 데이터 라인(D3)이 다음으로 위치한다. 즉, 최외곽 일측의 제 1 데이터 라인(D1)을 제외하고 데이터 라인들(D1~Dm)은 각각의 서브 화소(220)에 데이터 신호(data signal)를 전송하도록 2 개의 서브 화소(220)마다 2 개의 데이터 라인들이 형성된다.
예를 들어, 제 2 데이터 라인(D2) 및 제 3 데이터 라인(D3)은 절연막을 사이에 두고 동일 선 상에 중첩되어 형성되므로 제 2 데이터 라인(D)은 2번째 서브 화소(220)에 데이터 신호를 공급하고, 제 3 데이터 라인(D)은 3번째 서브 화소(220)에 데이터 신호를 공급할 수 있다. 본 발명의 다른 실시예는 서브 화소(220)들이 데이터 라인을 공유하지 않고 서브 화소(220)마다 개별적으로 데이터 라인으로부터 데이터 신호를 공급받으므로 데이터 신호가 딜레이되는 현상을 방지할 수 있다.
게이트 링크들(GL1~GLn)은 구동부(230)로부터의 게이트 신호(gate signal)를 게이트 라인들(G1~Gn)에 공급한다. 이를 위해, 게이트 링크들(GL1~GLn)은 구동부(230)에서 인출되어 구동부(230)와 활성 영역(212) 사이의 비활성 영역(214)에서 수직인 제 1 방향으로 활성 영역(212)까지 연장되어 위치한다.
이 때, 비활성 영역(214)에 형성되는 게이트 링크들(GL1~GLn)은 구동부(230)와 표시 패널(210)의 활성 영역(212) 사이의 비활성 영역(214)에만 위치한다. 본 발명의 다른 실시예에 의한 게이트 링크들(GL1~GLn)은 구동부(230)와 표시 패널(210)의 활성 영역(212) 사이의 비활성 영역(214)에만 위치하므로, 활성 영역(212)의 양 측부에 위치한 비활성 영역(214)을 제거하거나 그 면적을 최소화할 수 있다.
수직인 제 1 방향으로 인출된 게이트 링크들(GL1~GLn)은 활성 영역(212)에서 제 1 방향에 직교하는 제 2 방향으로 연장 형성되는 각각의 게이트 라인들(G1~Gn)과 전기적으로 연결된다. 게이트 링크들(GL1~GLn) 각각은 연결되는 게이트 라인들(G1~Gn)까지만 연장 형성되어 게이트 신호(gate signal)를 각각의 게이트 라인들(G1~Gn)에 공급한다.
이 때, 게이트 링크들(GL1~GLn)은 데이터 라인들(D1~Dm) 사이에서 2 개의 게이트 링크가 한 쌍을 이루어 절연막을 사이에 두고 동일 선 상에 중첩되도록 위치한다. 한 쌍을 이루는 게이트 링크는 활성 영역(212) 내에서 한 쌍을 이루어 형성되는 2 개의 데이터 라인들 사이마다 형성되거나, 최외곽 일측의 상기 서브 화소 이후부터 2 개의 상기 서브 화소를 사이에 두고 형성될 수 있다.
또는, 한 쌍을 이루는 게이트 링크는 최외곽 일측의 서브 화소(220)와 최외곽 일측의 서브 화소(220)에 인접한 서브 화소(220)의 사이부터 2개의 서브 화소(220)들을 사이에 두고 위치할 수 있다. 다만, 예외적으로 활성 영역(212)의 최외곽 타측에는 제 N 번째 게이트 링크(GLn)만 위치한다.
예를 들어, 제 1 게이트 링크(GL1) 및 제 2 게이트 링크(GL2)는 절연막을 사이에 두고 최외곽 일측의 서브 화소(220)와 최외곽 일측의 서브 화소(220)에 인접한 서브 화소(220)의 사이에 동일 선 상으로 중첩되어 형성되어 제 1 게이트 링크(GL1)는 제 1 게이트 라인(G1)에 게이트 신호를 공급하고, 제 2 게이트 링크(GL2)는 제 2 게이트 라인(G2)에 게이트 신호를 공급한다.
게이트 링크들(GL1~GLn) 각각은 연결되는 게이트 라인들(G1~Gn)까지만 연장 형성되어 게이트 신호(gate signal)를 각각의 게이트 라인들(G1~Gn)에 공급한다.
즉, 활성 영역(212) 내에서 제 1 방향의 제 1 게이트 링크(GL1)는 제 2 방향의 제 1 게이트 라인(G1)까지 연장 형성되고, 제 1 방향의 제 2 게이트 링크(GL2)는 제 1 방향의 제 1 게이트 링크(GL1)와 중첩됨과 동시에 제 2 방향의 제 2 게이트 라인(G2)까지만 연장 형성된다. 이와 같이, 제 1 방향의 제 N번째 게이트 링크(GLn)는 제 2 방향의 제 N번째 게이트 라인(Gn)까지만 연장 형성된다.
본 발명의 일 실시예에서는 활성 영역(212) 내에서 동일 선 상에 중첩되어 형성되는 한 쌍의 게이트 링크와 동일 선 상에 중첩되어 형성되는 한 쌍의 데이터 라인간의 전기적 쇼트를 방지하기 위하여 한 쌍의 게이트 링크 사이 및 한 쌍의 데이터 라인 사이에 절연막을 형성한다.
이 때, 동일한 제 1 방향의 한 쌍의 게이트 링크 및 한 쌍의 게이트 링크로부터 서브 화소(220)의 크기만큼 이격되어 위치하는 한 쌍의 데이터 라인은 각각 절연막을 사이에 두고 중첩되게 위치하므로 서브 화소(220)들 사이의 간격이 변하는 것은 아니다. 즉, 활성 영역(212) 내에서 신호 라인들이 형성되는 비표시 영역이 증가하는 것은 아니다.
본 발명의 다른 실시예에서는 게이트 링크들(GL1~GLn) 및 데이터 링크들(DL1~DLm)이 쌍을 이루어 중첩되게 형성됨으로써, 활성 영역(212) 내의 비표시 영역 상에 형성되던 블랙 매트릭스의 면적을 최소화할 수 있으므로 개구율을 향상시킬 수 있다.
구체적으로, 한 쌍의 게이트 링크와 게이트 라인이 중첩되는 영역(C)은 도 6a에 도시된 바와 같이 하부 기판(222) 상에 전면 증착된 제 1 절연막(225) 상에 게이트 라인(G)이 위치한다. 게이트 라인(G) 상에 제 1 층간 절연막(226)이 위치하고, 제 1 층간 절연막(226) 상에 일 게이트 링크(GL, 예를 들어 제 1 게이트 링크; GL1)가 위치한다. 제 1 게이트 링크(GL1) 상에 제 2 층간 절연막(227)이 위치하고, 제 2 층간 절연막(127) 상에 차수 번째 타 게이트 링크(GL', 예를 들어 제 2 게이트 링크; GL2)가 위치한다.
게이트 라인(G)과 일 게이트 링크(GL)는 제 1 층간 절연막(226)에 의해 절연되고, 일 게이트 링크(GL)와 타 게이트 링크(GL')는 제 2 층간 절연막(227)에 의해 절연된다. 즉, 게이트 라인(G)과 일 게이트 링크(GL)는 제 1 층간 절연막(226)을 사이에 두고 중첩되도록 형성되고, 일 게이트 링크(GL)와 타 게이트 링크(GL')는 제 2 층간 절연막(227)을 사이에 두고 중첩되도록 형성된다.
한 쌍의 데이터 라인과 게이트 라인이 중첩되는 영역(D)은 도 6b에 도시된 바와 같이 하부 기판(222) 상에 전면 증착된 제 1 절연막(225) 상에 일 데이터 라인(D, 예를 들어 제 2 데이터 라인;D2)이 위치한다. 일 데이터 라인(D) 상에 제 1 층간 절연막(226)이 위치하고, 제 1 층간 절연막(226) 상에 게이트 라인(G, 예를 들어 제 N-1 번째 게이트 라인; GLn-1)이 위치한다. 게이트 라인(G) 상에 제 2 층간 절연막(227)이 위치하고, 제 2 층간 절연막(227) 상에 차수 번째 타 데이터 라인(D', 예를 들어 제 3 데이터 라인; D3)이 위치한다.
일 데이터 라인(D)과 게이트 라인(G)은 제 1 층간 절연막(226)에 의해 절연되고, 게이트 라인(G)과 타 데이터 라인(D')은 제 2 층간 절연막(227)에 의해 절연된다. 즉, 일 데이터 라인(D)과 게이트 라인(G)은 제 1 층간 절연막(226)을 사이에 두고 중첩되도록 형성되고, 게이트 라인(G)과 타 데이터 라인(D')은 제 2 층간 절연막(227)을 사이에 두고 중첩되도록 형성된다.
최상부 도전층인 타 게이트 링크(GL') 또는 타 데이터 라인(D') 상에 제 2 절연막(228) 및 제 3 절연막(229)이 순차로 더 적층될 수 있고, 하부 기판(222)과 제 1 절연막(225) 사이에 반도체층(224)이 더 형성될 수 있다.
여기서, 제 1 절연막(225)은 게이트 산화막 또는 게이트 절연막일 수 있고, 제 2 절연막(228)은 패시베이션막일 수 있고, 제 3 절연막(229)은 유기 절연막일 수 있다.
상술한 바와 같이 본 발명의 다른 실시예는 게이트 링크들(GL1~GLn)이 2개씩 쌍을 이루어 절연막을 사이에 두고 동일한 방향으로 중첩되어 활성 영역(212)의 양 측부에 위치한 비활성 영역(214)이 아닌 활성 영역(212)에 형성된다. 또한, 데이터 라인들(D1~Dn) 역시 2개씩 쌍을 이루어 절연막을 사이에 두고 동일한 방향으로 중첩되어 활성 영역(212)에 형성된다.
따라서, 발명의 일 실시예는 종래에 게이트 링크들(GL1~GLn)이 형성되었던 활성 영역(212)의 양 측부에 위치한 비활성 영역(214)을 제거하거나 그 면적을 최소화할 수 있다. 아울러, 본 발명의 실시예는 비활성 영역(214)의 폭이나 면적에 연동하여 형성되는 블랙 매트릭스의 면적을 최소로 줄일 수 있으므로 개구율을 향상시킬 수 있다.
이상에서와 같이 상세한 설명과 도면을 통해 본 발명의 실시예들을 개시하였다. 용어들은 단지 본 발명을 설명하기 위한 목적에서 사용된 것이지 의미 한정이나 특허 청구범위에 기재된 본 발명의 범위를 제한하기 위하여 사용된 것은 아니다. 그러므로 본 기술 분야의 통상의 지식을 가진 자라면 이로부터 다양한 변형 및 균등한 타 실시예가 가능하다는 점을 이해할 것이다. 따라서 본 발명의 진정한 기술적 보호 범위는 첨부된 특허 청구범위의 기술적 사상에 의해 정해져야 할 것이다.
110, 210: 표시 패널 112, 212: 활성 영역
114, 214: 비활성 영역 120, 220: 서브 화소
122, 222: 하부 기판 125, 225: 제 1 절연막
126, 226: 제 1 층간 절연막 127, 227: 제 2 층간 절연막
128, 228: 제 2 절연막 129, 229: 제 3 절연막
D1~Dm: 데이터 라인들 DL1~DLm: 데이터 링크들
G1~Gn: 게이트 라인들 GL1~GLn: 게이트 링크들

Claims (20)

  1. 제 1 방향의 데이터 라인들과 상기 데이터 라인들에 수직한 제 2 방향의 게이트 라인들의 교차에 의해 형성되는 서브 화소들이 배열된 활성 영역 및 상기 활성 영역 외곽의 비활성 영역을 포함하는 표시 패널;
    상기 표시 패널의 상기 게이트 라인 및 상기 데이터 라인에 구동 신호를 공급하는 구동부;
    상기 구동부에서 상기 제 1 방향으로 인출되어 상기 데이터 라인에 데이터 신호를 인가하는 데이터 링크들; 및
    상기 구동부에서 인출되어 상기 구동부와 상기 활성 영역 사이의 비활성 영역 및 상기 제 1 방향으로 상기 활성 영역까지 연장 형성되어 상기 제 2 방향의 상기 게이트 라인에 게이트 신호를 인가하는 게이트 링크들을 포함하고,
    상기 비활성 영역에 형성되는 게이트 링크들은 상기 구동부와 상기 활성 영역 사이의 비활성 영역에만 형성되는 표시 장치.
  2. 제 1 항에 있어서, 상기 게이트 링크들은 상기 활성 영역 내의 상기 데이터 라인들과 동일 선 상에 형성되는 표시 장치.
  3. 제 2 항에 있어서, 상기 게이트 링크와 상기 데이터 라인은 절연막을 사이에 두고 중첩되어 형성되는 표시 장치.
  4. 제 2 항에 있어서, 상기 게이트 링크는 전기적으로 연결되는 해당 게이트 라인까지만 연장 형성되는 표시 장치.
  5. 제 1 항에 있어서, 상기 게이트 링크들은 2개씩 한 쌍을 이루어 상기 활성 영역 내의 동일 선 상에 형성되는 표시 장치.
  6. 제 5 항에 있어서, 상기 한 쌍의 게이트 링크는 절연막을 사이에 두고 중첩되어 형성되는 표시 장치.
  7. 제 5 항에 있어서, 상기 게이트 링크는 전기적으로 연결되는 해당 게이트 라인까지만 형성되는 표시 장치.
  8. 제 5 항에 있어서, 상기 한 쌍의 게이트 링크는 최외곽 일측의 상기 서브 화소 이후부터 2 개의 상기 서브 화소를 사이에 두고 형성되고,
    최외곽 타측의 상기 서브 화소의 측부에는 하나의 게이트 링크만 형성되는 표시 장치.
  9. 제 5 항에 있어서, 상기 데이터 라인들은 2개씩 한 쌍을 이루어 상기 활성 영역 내의 동일 선 상에 형성되는 표시 장치.
  10. 제 9 항에 있어서, 상기 한 쌍의 데이터 라인은 절연막을 사이에 두고 중첩되어 형성되는 표시 장치.
  11. 제 9 항에 있어서, 최외곽 일측의 상기 서브 화소의 측부에는 하나의 데이터 라인만 형성되고, 상기 한 쌍의 데이터 라인은 상기 최외곽 일측의 상기 서브 화소 이후부터 2 개의 상기 서브 화소마다 형성되는 표시 장치.
  12. 제 1 방향의 데이터 라인들과 상기 데이터 라인들에 수직한 제 2 방향의 게이트 라인들의 교차에 의해 형성되는 서브 화소들이 배열된 활성 영역 및 상기 활성 영역 외곽의 비활성 영역을 포함하는 표시 패널;
    상기 표시 패널의 상기 게이트 라인 및 상기 데이터 라인에 구동 신호를 공급하는 구동부; 및
    상기 구동부에서 인출되어 상기 구동부와 상기 활성 영역 사이의 비활성 영역에서 상기 활성 영역까지 연장 형성되어 상기 게이트 라인에 게이트 신호를 인가하는 게이트 링크들을 포함하고,
    상기 비활성 영역에 형성되는 상기 게이트 링크들은 상기 구동부와 상기 활성 영역 사이의 비활성 영역에만 형성되는 표시 장치.
  13. 제 12 항에 있어서, 상기 게이트 링크들은 상기 활성 영역에서 상기 데이터 라인과 동일한 방향으로 연장 형성되는 표시 장치.
  14. 제 12 항에 있어서, 상기 게이트 링크와 상기 데이터 라인은 절연막을 사이에 두고 동일 선 상에 중첩되어 형성되는 표시 장치.
  15. 제 12 항에 있어서, 상기 게이트 링크는 전기적으로 연결되는 해당 게이트 라인까지만 상기 활성 영역 내에 연장 형성되는 표시 장치.
  16. 제 1 방향의 데이터 라인들과 상기 데이터 라인들에 수직한 제 2 방향의 게이트 라인들의 교차에 의해 형성되는 서브 화소들이 배열된 활성 영역 및 상기 활성 영역 외곽의 비활성 영역을 포함하는 표시 패널;
    상기 표시 패널의 상기 게이트 라인 및 상기 데이터 라인에 구동 신호를 공급하는 구동부;
    상기 구동부에서 상기 제 1 방향으로 인출되어 상기 데이터 라인에 데이터 신호를 인가하는 데이터 링크들; 및
    상기 구동부에서 인출되어 상기 구동부와 상기 활성 영역 사이의 비활성 영역에서 상기 활성 영역까지 연장 형성되어 상기 게이트 라인에 게이트 신호를 인가하는 게이트 링크들을 포함하고,
    상기 비활성 영역에 형성되는 상기 게이트 링크들은 상기 구동부와 상기 활성 영역 사이의 비활성 영역에만 형성되고,
    상기 활성 영역 내에서 최외곽 타측의 상기 서브 화소 이전에 2 개의 게이트 링크가 한 쌍을 이루어 동일 선 상에 형성되고,
    최외곽 일측의 상기 서브 화소 이후로 2 개의 데이터 라인이 한 쌍을 이루어 동일 선 상에 형성되는 표시 장치.
  17. 제 16 항에 있어서, 상기 한 쌍의 게이트 링크는 제 1 절연막을 사이에 두고 중첩되어 형성되고,
    상기 한 쌍의 데이터 라인은 제 2 절연막을 사이에 두고 중첩되어 형성되는 표시 장치.
  18. 제 16 항에 있어서, 상기 최외곽 일측에 형성되는 상기 서브 화소 측부의 상기 데이터 라인은 하나만 형성되고,
    상기 최외곽 타측에 형성되는 상기 서브 화소 측부의 상기 게이트 라인은 하나만 형성되는 표시 장치.
  19. 제 16 항에 있어서, 상기 한 쌍의 게이트 링크는 상기 최외곽 일측에 형성되는 상기 서브 화소 이후부터 2 개의 상기 서브 화소를 사이에 두고 형성되는 표시 장치.
  20. 제 16 항에 있어서, 상기 한 쌍의 데이터 라인은 상기 최외곽 일측에 형성되는 상기 서브 화소 이후부터 2 개의 상기 서브 화소마다 형성되는 표시 장치.
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