KR101588144B1 - 루마 기반 크로마 인트라 예측 - Google Patents

루마 기반 크로마 인트라 예측 Download PDF

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Abstract

루마 기반 크로마 인트라 예측을 위한 시스템들, 장치들 및 방법들이 설명된다. 다운샘플 필터들을 루마 픽셀 위치들의 루마 값들에 적용하여 인트라 프레임의 예측 유닛 내의 크로마 픽셀 위치들에 대한 재구성된 루마 값들을 생성할 수 있다. 이어서, 다운샘플링된 재구성된 루마 값들을 이용하여, 크로마 픽셀 위치들에 대한 크로마 값들을 예측할 수 있다. 일부 구현들에서, 크로마 위치의 재구성된 루마 값을 이용하여 그 위치의 크로마 값을 예측할 수 있다. 다른 구현들에서, 이웃 크로마 픽셀 위치들의 재구성된 루마 값들을 분석하여 크로마 픽셀 위치에 대한 크로마 값을 적응적으로 예측할 수 있다.

Description

루마 기반 크로마 인트라 예측{LUMA-BASED CHROMA INTRA PREDICTION}
비디오 코딩에서, 인트라 코딩된 프레임들은 다른 프레임들에 대한 종속성 없이 인코딩되어, 이러한 프레임들이 독립적으로 디코딩되고, 예를 들어 고속 진행 및 고속 되감기 비디오 플레이를 위한 랜덤 액세스 포인트들로서 사용되는 것을 가능하게 한다. 인트라 코딩된 프레임과 같은 이미지 프레임 또는 픽처는 최대 코딩 유닛(LCU:Largest Coding Unit)의 유닛들로 코딩될 수 있다. LCU는 픽셀들의 128x128 블록, 64x64 블록, 32x32 블록 또는 16x16 블록일 수 있다. LCU는 직접 인코딩될 수 있거나, 4개의 더 작은 코딩 유닛(CU:Coding Unit)으로 분할될 수 있다. 게다가, CU는 직접 인코딩될 수 있거나, 더 세분될 수 있다. 통상적으로, 가장 작은 CU는 픽셀들 또는 픽셀 위치들의 8x8 블록에 대응한다.
픽셀 값들의 예측을 용이하게 하기 위하여, 크기 2Nx2N의 각각의 CU는 상이한 크기의 예측 유닛들(PU들)로 분할될 수 있으며, 이들 PU에서 픽셀 값들은 동일 프레임 또는 픽처 내의 이웃 PU들 내의 다른 픽셀 값들에 기초하여 인트라 예측될 수 있다. 인트라 코딩의 경우, 2Nx2N CU는 하나의 2Nx2N PU 또는 4개의 NxN PU로 인코딩될 수 있다. 예를 들어, 32x32 LCU는 4개의 16x16 CU로 분할될 수 있으며, 이들 각각은 또한 인트라 예측의 목적을 위해 4개의 8x8 PU로 분할될 수 있다. 게다가, YUV 4:2:0 포맷으로 코딩된 픽처들과 같은 컬러 픽처들의 경우, 8x8 PU는 하나의 8x8 루마(luma) 블록 Y 및 2개의 더 작은 4x4 크로마 블록 U 및 V에 대응할 수 있다.
통상적으로, 루마 및 크로마 블록들은 서로 독립적으로 인트라 예측된다. 따라서, 전통적으로, 루마 픽셀 값들은 이웃 PU들의 재구성된 루마 픽셀 값들로부터 예측되며, 크로마 픽셀 값들은 이웃 PU들의 재구성된 크로마 픽셀 값들로부터 예측된다. 그러나, PU의 루마 및 크로마 블록들에 포함된 정보는 객체 텍스처 등과 같은 유사한 구조적 특징들을 나타낼 수 있으므로 완전히 독립적은 아닐 수 있다. 인코딩 및/또는 디코딩 프로세스들 동안 루마 및 크로마 블록들 간의 유사성을 이용하여 픽셀 예측을 돕기 위한 기술들이 필요하다.
본 명세서에서 설명되는 내용은 첨부 도면들에 한정이 아니라 예시적으로 도시된다. 도시의 간명화를 위해, 도면들에 도시되는 요소들은 반드시 축척으로 도시되지는 않는다. 예를 들어, 일부 요소들의 치수들은 명료화를 위해 다른 요소들에 비해 과장될 수 있다. 게다가, 적절한 것으로 간주되는 경우, 도면들 사이에서 대응하거나 유사한 요소들을 지시하기 위해 참조 부호들이 반복되었다. 도면들에서:
도 1은 예시적인 비디오 인코더 시스템의 예시적인 도면이다.
도 2는 예시적인 비디오 디코더 시스템의 예시적인 도면이다.
도 3은 예시적인 프로세스를 나타내는 도면이다.
도 4는 예시적인 인트라 예측 스킴을 나타내는 도면이다.
도 5는 예시적인 프로세스를 나타내는 도면이다.
도 6은 예시적인 인트라 예측 스킴을 나타내는 도면이다.
도 7은 예시적인 인트라 예측 스킴을 나타내는 도면이다.
도 8은 예시적인 시스템의 도면이다.
도 9는 본 발명의 적어도 일부 구현들에 따라 모두 배열된 예시적인 시스템의 도면이다.
이하, 첨부 도면들을 참조하여 하나 이상의 실시예가 설명된다. 특정 구성들 및 배열들이 설명되지만, 이것은 예시의 목적을 위한 것일 뿐이라는 것을 이해해야 한다. 관련 분야의 기술자들은 본 발명의 사상 및 범위로부터 벗어나지 않고서 다른 구성들 및 배열들이 이용될 수 있다는 것을 인식할 것이다. 관련 분야의 기술자들에게는 본 명세서에서 설명되는 기술들 및/또는 배열들이 본 명세서에서 설명되는 것과 다른 다양한 시스템들 및 응용들에서도 이용될 수 있다는 것이 명백할 것이다.
아래의 설명은 예를 들어 시스템-온-칩(SoC) 아키텍처와 같은 아키텍처들에서 나타날 수 있는 다양한 구현들을 설명하지만, 본 명세서에서 설명되는 기술들 및/또는 배열들의 구현은 특정 아키텍처들 및/또는 컴퓨팅 시스템들로 한정되지 않으며, 유사한 목적들을 위해 임의의 실행 환경에 의해 구현될 수 있다. 예를 들어, 다양한 아키텍처들, 예를 들어 다수의 집적 회로(IC) 칩들 및/또는 패키지들, 및/또는 셋톱 박스, 스마트폰 등과 같은 다양한 컴퓨팅 장치들 및/또는 소비자 전자(CE) 장치들을 이용하는 아키텍처들은 본 명세서에서 설명되는 기술들 및/또는 배열들을 구현할 수 있다. 게다가, 아래의 설명은 시스템 컴포넌트들, 논리 분할/통합 선택들 등의 논리적 구현들, 타입들 및 상호관계들과 같은 다양한 특정 상세들을 설명할 수 있지만, 청구 발명은 그러한 특정 상세들 없이 실시될 수 있다. 다른 예들에서는 본 명세서에서 개시되는 내용을 불명료하게 하지 않기 위해, 예를 들어 제어 구조들 및 풀 소프트웨어 명령어 시퀀스들과 같은 일부 내용은 상세히 설명되지 않을 수 있다.
본 명세서에서 개시되는 내용은 하드웨어, 펌웨어, 소프트웨어 또는 이들의 임의 조합에서 구현될 수 있다. 본 명세서에서 개시되는 내용은 하나 이상의 프로세서에 의해 판독 및 실행될 수 있는 머신 판독 가능 매체 상에 저장되는 명령어들로서 구현될 수도 있다. 머신 판독 가능 매체는 머신(예를 들어, 컴퓨팅 장치)에 의해 판독 가능한 형태로 정보를 저장하거나 전송하기 위한 임의의 매체 및/또는 메커니즘을 포함할 수 있다. 예를 들어, 머신 판독 가능 매체는 판독 전용 메모리(ROM); 랜덤 액세스 메모리(RAM); 자기 디스크 저장 매체; 광학 저장 매체; 플래시 메모리 장치; 전기, 광학, 음향 또는 다른 형태의 전파 신호(예로서, 반송파, 적외선 신호, 디지털 신호 등) 등을 포함할 수 있다.
본 명세서에서 "하나의 구현", "일 구현", "예시적인 구현" 등에 대한 참조들은, 설명되는 구현 또는 실시예가 특정 특징, 구조 또는 특성을 포함할 수 있지만, 모든 구현이 그러한 특정 특징, 구조 또는 특성을 반드시 포함하지는 않을 수 있다는 것을 지시한다. 더욱이, 그러한 문구들은 반드시 동일 구현을 참조하지는 않는다. 게다가, 특정 특징, 구조 또는 특성이 일 구현과 관련하여 설명될 때, 명시적 설명의 여부에 관계없이 그러한 특징, 구조 또는 특성을 다른 구현과 관련하여 실행하는 것은 이 분야의 기술자의 지식 내에 있다는 것을 진술한다.
본 명세서에서 설명되는 내용은 비디오 압축 및/또는 압축 해제를 행하는 비디오 인코더/디코더 시스템과 관련하여 구현될 수 있다. 도 1은 본 발명에 따른 인트라 예측 모듈(106)을 포함하는 예시적인 비디오 인코더(100)를 나타낸다. 인코더(100)는 예를 들어 2003년 3월에 발표된 ITU-T H.264 표준과 같은 하나 이상의 진보된 비디오 코덱 표준을 적어도 부분적으로 구현할 수 있다. 현재 비디오 정보가 현재 비디오 블록(102)으로부터 비디오 데이터의 복수의 프레임의 형태로 제공될 수 있다. 현재 비디오는 구별 유닛(differencing unit)(103)에 전달될 수 있다. 구별 유닛(103)은 모션 보상(MC) 모듈(108) 및 모션 추정(ME) 모듈(104)을 포함할 수 있는 (코어 비디오 인코딩이라고도 하는) 차분 펄스 코드 변조(DPCM:Differential Pulse Code Modulation) 루프의 일부일 수 있다. 이 루프는 인트라 예측 모듈(106), 인트라 보간 모듈(110) 및 프레임 버퍼(111)도 포함할 수 있다. 일부 예들에서는, 인-루프 디블록킹 필터(112)도 DPCM 루프에서 사용될 수 있다.
현재 비디오는 구별 유닛(103)에 그리고 ME 모듈(104)에 제공될 수 있다. MC 모듈(108) 또는 인트라 보간 모듈(110)은 스위치(113)를 통해 출력을 생성할 수 있으며, 이어서 현재 비디오(102)로부터 이 출력을 빼서 나머지(residual)를 생성할 수 있다. 나머지는 변환/양자화 스테이지(114)에서 변환 및 양자화되며, 인코딩된 비트스트림과 같은 채널 출력(122)을 제공하기 위해 모듈(120)에서 엔트로피 인코딩될 수 있다.
모션 보상 스테이지(108) 또는 인트라 보간 스테이지(110)의 출력은 가산기(summer)(115)에 제공될 수 있으며, 이 가산기는 또한 역양자화 유닛(116) 및 역변환 유닛(118)으로부터 입력을 수신할 수 있다. 역양자화 유닛(116) 및 역변환 유닛(118)은 역양자화 및 역변환된 정보를 DPCM 루프로 반환할 수 있다.
인트라 예측 모듈(106)은 본 명세서에서 설명되는 다양한 루마 기반 크로마 인트라 예측 스킴들을 적어도 부분적으로 구현할 수 있다. 예를 들어, 아래에 더 상세히 설명되는 바와 같이, 인트라 예측 모듈(106)은 어떤 PU들 또는 이들의 부분들이 루마 기반 크로마 인트라 예측 스킴들에 따라야 하는지, 어떤 루마 기반 크로마 인트라 예측 스킴이 적용되어야 하는지, 어떤 루마 다운샘플링 필터(들)가 이용되어야 하는지, 어떤 대응하는 필터 계수들이 이용되어야 하는지 등과 같은 인트라 예측 데이터 및/또는 파라미터들을 포함하는 정보를 적어도 부분적으로 결정 및/또는 지정할 수 있다. 인트라 예측 모듈(106)은 그러한 정보를 채널 출력(122)의 일부로서 제공되는 하나 이상의 비트스트림 헤더 내에서 그리고 본 발명에 따른 루마 기반 크로마 인트라 예측 스킴들을 구현하기 위해 호환 디코더에 의해 사용되도록 운반할 수 있다.
도 2는 본 발명에 따른 인트라 예측 모듈(202)을 포함하는 비디오 디코더(200)를 나타낸다. 디코더(200)는 예를 들어 H.264 표준과 같은 하나 이상의 진보된 비디오 코덱 표준을 구현할 수 있다. 디코더(200)는 엔트로피 디코딩 모듈(206)에 결합된 채널 입력(204)을 포함할 수 있다. 채널 입력(204)은 도 1의 인코더(100)와 같은 인코더의 채널 출력으로부터 입력을 수신할 수 있다. 다양한 구현들에서, 입력(204)에서 수신되는 채널 출력은 본 발명에 따른 루마 기반 크로마 인트라 예측 스킴들을 구현하도록 디코더(200)를 구성하는 데 적합한 인트라 예측 데이터 및/또는 파라미터들을 운반하는 하나 이상의 비트스트림 헤더를 갖는 인코딩된 비트스트림을 포함할 수 있다.
디코딩 모듈(206)로부터의 출력은 역양자화 모듈(208)에 제공될 수 있으며, 모듈(208)의 출력은 역변환 모듈(210)에 제공될 수 있다. 디코딩 모듈(206)로부터의 출력은 또한 인트라 예측 모듈(202)에 그리고 모션 보상(MC) 모듈(212)에 제공될 수 있다. 인트라 예측 모듈(202)의 출력은 인트라 보간 모듈(214)에 제공될 수 있으며, 이 인트라 보간 모듈은 선택기 스위치(216)에 피딩할 수 있다. 이어서, 역변환 모듈(210), 및 스위치(216)에 의해 선택되는 바와 같은 MC 모듈(212) 또는 인트라 보간 모듈(214)로부터의 정보가 합산(218)되어, 인-루프 디블록킹 모듈(220)에 제공되고, 인트라 보간 모듈(214)로 피드백될 수 있다. 이어서, 인-루프 디블록킹 모듈(220)의 출력은 프레임 버퍼(222)로 그리고 이 프레임 버퍼로부터 인트라 예측 모듈(202) 및 MC 모듈(212)로 제공될 수 있다.
인트라 예측 모듈(202)은 본 명세서에서 설명되는 다양한 루마 기반 크로마 인트라 예측 스킴들을 적어도 부분적으로 구현할 수 있다. 다양한 구현들에서, 인트라 예측 모듈(202)은 아래에 더 상세히 설명되는 바와 같이 도 1의 인코더(100)의 인트라 예측 모듈(106)과 동기화 및/또는 조화될 수 있다. 본 발명에 따르면, 인코더(100)의 인트라 예측 모듈(106)은 아래에 더 상세히 설명되는 루마 기반 크로마 인트라 예측 스킴들을 행하는 데 있어서 디코더(200)의 인트라 예측 모듈(202)에 의해 사용하기에 적합한 다양한 인트라 예측 데이터 및/또는 파라미터들을 결정하는 데 사용될 수 있다. 예를 들어, 인코더(100)는 채널 출력(112)에 포함되고 채널 입력(204)에 의해 수신되는 하나 이상의 비트스트림 헤더의 형태로 그러한 인트라 예측 데이터 및/또는 파라미터들을 제공할 수 있다. 게다가, 다양한 구성들에서, 인코더(100) 및 디코더(200), 및 대응하는 인트라 예측 모듈들(106, 202)은 범용 비디오 코덱 아키텍처에서 구현될 수 있으며, H.264 코딩 아키텍처와 같은 임의의 특정 코딩 아키텍처로 한정되지 않는다.
본 명세서에서 설명되는 바와 같은 인코더(100) 및 디코더(200), 및 이들에 의해 수행되는 처리는 하드웨어, 펌웨어 또는 소프트웨어, 또는 이들의 임의 조합에서 구현될 수 있다. 게다가, 본 명세서에서 설명되는 어느 하나 이상의 특징은 개별 및 집적 회로 논리, 주문형 집적 회로(ASIC) 논리 및 마이크로컨트롤러들을 포함하는 하드웨어, 소프트웨어, 펌웨어 및 이들의 조합들에서 구현될 수 있으며, 도메인-고유 집적 회로 패키지의 일부 또는 집적 회로 패키지들의 조합으로서 구현될 수 있다. 본 명세서에서 사용되는 바와 같은 소프트웨어라는 용어는 컴퓨터 시스템으로 하여금 본 명세서에서 설명되는 하나 이상의 특징 및/또는 특징들의 조합들을 수행하게 하기 위한 컴퓨터 프로그램 논리를 저장한 컴퓨터 판독 가능 매체를 포함하는 컴퓨터 프로그램 제품을 지칭한다.
도 3은 본 발명의 다양한 구현들에 따른 예시적인 프로세스(300)의 흐름도를 나타낸다. 프로세스(300)는 블록 302, 304 및/또는 306 중 하나 이상에 의해 설명되는 바와 같은 하나 이상의 동작, 기능 또는 액션을 포함할 수 있다. 다양한 구현들에서, 프로세스(300)는 예를 들어 도 1의 인코더(100)와 같은 비디오 인코더에서 행해질 수 있다.
프로세스(300)는 블록 302에서 시작될 수 있으며, 여기서 이미지 프레임의 현재 예측 유닛(PU) 내의 크로마 픽셀 위치에 대해, 이미지 프레임 내의 크로마 픽셀 위치에 물리적으로 인접하는 복수의 루마 픽셀 위치에 대해 텍스처 특성이 결정될 수 있다. 예를 들어, 다양한 구현들에서, 블록 302는 인코더(100)가 인트라 예측 모듈(106)을 이용하여, 인트라 코딩된 프레임의 크로마 픽셀 위치에 이웃하는 루마 픽셀 위치들의 텍스처 특성을 분석하는 단계를 포함할 수 있으며, 도 2의 디코더(200)와 같은 디코더가 아래에 더 상세히 설명되는 바와 같이 그러한 크로마 픽셀 위치에 대한 크로마 값을 나중에 예측할 수 있다. 다양한 비제한적인 예들에서, 블록 302에서 결정된 텍스처 특성은 크로마 픽셀 위치에 인접하는 루마 픽셀 위치들의 그룹을 평탄한 텍스처 특성을 나타내는 것으로서(예를 들어, 중대한 에지들을 갖지 않는 것으로서) 또는 크로마 픽셀 위치에 대해 다양한 방향으로 배향된 하나 이상의 에지를 갖는 것으로서 특성화하는 것을 포함할 수 있다.
도 4는 YUV 4:2:0 포맷을 갖는 8x8 PU(401)에 대한 예시적인 인트라 예측 스킴(400)을 나타내며, 여기서 PU(401)의 루마 픽셀 위치들 및 크로마 픽셀 위치들은 각각 원들(402) 및 삼각형들(404)로서 도시된다. 본 명세서에서 설명되는 바와 같은 처리가 행해질 때, PU(401)와 같은 PU는 현재 PU로서 설명될 수 있다. 예시적인 PU(401)는 이미지 에지(406)를 가질 수 있으며, 에지(406)의 양측의 루마 위치들(402)은 실질적으로 상이한 루마 값들을 가질 수 있다. 이 예에서, 인트라 예측 모듈(106)이 에지(406)에 인접 배치된 루마 위치(408)에 대해 블록 302를 수행할 때, 모듈(106)은 루마 위치(408)에 이웃하거나 인접하는 루마 픽셀 위치들의 그룹(410)의 루마 값들의 텍스처 구조를 분석할 수 있으며, 에지(406)를 루마 위치(408)와 관련된 텍스처 특성으로서 식별할 수 있다. 다양한 구현들에서, 모듈(106)은 그룹(410)의 루마 값들에 대해 잘 알려진 에지 검출 처리 기술들을 적용함으로써, 예를 들어 Sobel 필터를 그룹(410)에 적용함으로써 그렇게 할 수 있다. PU(401) 내의 다른 예시적인 크로마 픽셀 위치들(412, 416)에 대해, 모듈(106)은 또한 그룹들(414, 418)의 루마 값들을 각각 분석하여, 그러한 크로마 픽셀 위치들에 대한 대응하는 텍스처 특성들을 결정할 수 있다. 이 예에서, 그룹(418)을 분석할 때, 모듈(106)은 크로마 위치(416)가 에지(406)에 인접하지 않고, 따라서 평탄한 텍스처 특성을 갖는 것으로 결정할 수 있다.
도 4는 다양한 구현들에 따른 예시적인 인트라 예측 스킴(400)을 도시하지만, 본 발명에 따른 인트라 예측 스킴은 스킴(400) 또는 본 명세서에서 설명되는 다른 스킴들 내에 도시된 아이템들 및/또는 구조들의 다양한 크기들, 양들 및 특정 배열들로 한정되지 않는다. 따라서, 예를 들어, 본 발명은 루마 위치들, 다운샘플 필터들의 크기, 형상 및 배향 등과 관련하여 PU들의 특정 크기들, 특정 이미지 포맷들(예로서, YUV4:2:0, YUV4:2:2 등), 크로마 위치들의 배향에 한정되지 않는다. 예를 들어, 도 4는 그룹들(410, 414, 418)을 가장 가까운 이웃 루마 위치들만을 포함하는 것으로 도시하지만, 다양한 구현들에서 그룹들(410, 414, 418)은 임의의 형상들을 가질 수 있고/있거나, 다음으로 가장 가까운 이웃 루마 위치들 등을 포함하는 임의 수의 인접하는 루마 위치들을 포함할 수 있다. 게다가, 그룹들(410, 414, 418)은 관련 루마 위치에 대해 임의의 배향을 가질 수 있다.
도 3의 설명으로 돌아가면, 프로세스(300)는 블록 304에서 계속될 수 있으며, 여기서 블록 302에서 결정된 텍스처 특성에 응답하여 적어도 하나의 다운샘플 필터가 지정된다. 예를 들어, 다양한 구현들에서, 블록 304는 인코더(100)가 인트라 예측 모듈(106)을 이용하여, 크로마 픽셀 위치의 근처에서 검출된 임의의 에지들에 기초하여 다운샘플 필터를 지정하는 단계를 포함할 수 있으며, 도 2의 디코더(200)와 같은 디코더는 그러한 다운샘플 필터를 이용하여, 아래에 더 상세히 설명되는 바와 같이 크로마 픽셀 위치에 대한 재구성된 루마 값을 생성할 수 있다. 다양한 구현들에서, 블록 304에서 지정된 다운샘플 필터는 다양한 크기 NxM을 갖는 사전 결정된 다운샘플 필터들의 세트로부터 선택될 수 있으며, N 및 M은 다운샘플 필터에 의해 각각 스패닝(spanning)되는 픽셀들의 열들 및 행들의 수를 지정한다. 예를 들어, 사전 결정된 다운샘플 필터들의 세트는 크기 1x2, 2x1, 2x2, 3x1, 1x3, 3x2, 2x3 및 3x3의 필터들을 포함할 수 있다.
도 4를 다시 참조하면, 블록 302에서 에지(406)를 검출한 후, 인트라 예측 모듈(106)은 1x2 필터(420)를 지정함으로써 크로마 픽셀 위치(408)에 대해 블록 304를 수행할 수 있다. 아래에 더 상세히 설명되는 바와 같이, 디코더는 필터(420)를 이용하여, 필터(420)에 의해 스패닝되는 (도 4에 어두운 원들에 의해 도시된) 2개의 루마 픽셀 위치(422)의 루마 값들에 기초하여 크로마 위치(408)에 대한 루마 값을 재구성할 수 있다. 유사하게, 크로마 픽셀 위치(412)에 대해, 블록 304는 모듈(106)이 도시된 바와 같이 크로마 위치(412)의 우하 측으로 배향된 지향성 2x1 필터(424)를 지정하는 단계를 포함할 수 있다. 이어서, 디코더는 크로마 위치(412)의 인트라 예측 처리를 수행할 때 다운샘플 필터(424)를 적용할 수 있다. 다른 비제한적인 예에서, 블록 304는 모듈(106)이 그룹(418)의 루마 값들에 대한 평탄한 특성을 결정한 블록 302에서 행해진 분석에 기초하여 크로마 픽셀 위치(416)에 대한 3x2 다운샘플 필터(426)를 지정하는 단계를 포함할 수 있다.
다양한 구현들에서, 다운샘플 필터들은 다운샘플링된 루마 픽셀 값을 주변 루마 픽셀들의 가중된 평균으로서 생성할 수 있다. 게다가, 다운샘플 필터들에 대한 상이한 가중 팩터들 또는 계수 값들이 상이한 루마 픽셀 위치들에 대해 사용될 수 있다. 다양한 구현들에서, 블록 304는 또한 다운샘플 필터에 대한 가중 팩터들 또는 계수 값들을 지정하는 단계를 포함할 수 있다.
프로세스(300)는 블록 304에서 지정된 다운샘플 필터를 지정하는 정보를 제공하는 블록 306에서 마무리될 수 있다. 다양한 구현들에서, 블록 306은 인코더가 블록 304에서 지정된 다운샘플 필터의 크기를 지정하는 비디오 비트스트림의 하나 이상의 헤더 내의 데이터를 제공하는 단계를 포함할 수 있다. 예를 들어, 인코더(100)는 채널 출력(122)을 통해 비트스트림을 제공할 수 있으며, 비트스트림은 모듈(106)에 의해 PU의 다양한 크로마 픽셀 위치들에 대해 지정된 다운샘플 필터들에 대한 헤더 정보를 포함한다. 전술한 바와 같이, 인코더(100)에 의해 제공되는 비트스트림은 또한 다양한 다운샘플 필터들과 관련된 계수 값들을 지정할 수 있다. 도 3은 블록 302, 304, 306의 특정 배열을 도시하지만, 본 발명은 이와 관련하여 한정되지 않으며, 본 발명의 다양한 구현들에 따른 루마 기반 크로마 인트라 예측을 위한 프로세스들은 다른 배열들을 포함할 수 있다.
도 5는 본 발명의 다양한 구현들에 따른 예시적인 프로세스(500)의 흐름도를 나타낸다. 프로세스(500)는 블록 502 및/또는 504 중 하나 이상에 의해 도시되는 바와 같은 하나 이상의 동작, 기능 또는 액션을 포함할 수 있다. 다양한 구현들에서, 프로세스(500)는 예를 들어 도 2의 디코더(200)와 같은 비디오 디코더에서 수행될 수 있다. 도 5는 블록 502 및 504의 특정 배열을 도시하지만, 본 발명은 이와 관련하여 한정되지 않으며, 본 발명의 다양한 구현들에 따른 루마 기반 크로마 인트라 예측을 위한 프로세스들은 다른 배열들을 포함할 수 있다.
프로세스(500)는 블록 502에서 시작될 수 있으며, 여기서 루마 픽셀 위치들의 그룹의 루마 값들에 응답하여 크로마 픽셀 위치들의 그룹의 루마 값들이 재구성될 수 있다. 예를 들어, 다양한 구현들에서, 블록 502는 디코더(200)의 인트라 예측 모듈(202)이 크로마 픽셀 위치에 이웃하는 루마 픽셀 위치들의 루마 값들에 다운샘플 필터를 적용하여 그 크로마 픽셀 위치에 대한 재구성된 루마 값을 생성 또는 예측하는 단계를 포함할 수 있다. 전술한 바와 같이, 인코더는 다운샘플 필터들 및/또는 다운샘플 필터 계수 또는 가중 값들을 지정하는 하나 이상의 비트스트림 헤더 내의 정보를 제공할 수 있다. 디코더(200)는 채널 입력(204)에서 인코더(100)와 같은 인코더로부터 비트스트림을 수신할 수 있으며, 블록 502를 수행할 때 헤더 정보를 이용할 수 있다.
예를 들어, 도 4를 다시 참조하면, 블록 502는 인트라 예측 모듈(202)이 3x2 필터(426)를 이용하여, 크로마 픽셀 위치(416)에 대한 재구성된 루마 값을 생성하는 단계를 포함할 수 있다. 유사하게, 블록 302를 수행할 때, 디코더(200)는 1x2 필터(420) 및 2x1 필터(424)를 적용하여, 크로마 픽셀 위치들(408, 412)에 대한 재구성된 루마 값들을 각각 생성할 수 있다. 따라서, 도 4의 예에서, 블록 302는 그룹(418)의 6개의 루마 픽셀 위치(428)의 루마 값들에 기초하여 크로마 픽셀 위치(416)에 대한 재구성된 루마 값을 그리고 루마 픽셀 위치들(422, 430)의 쌍들의 루마 값들에 기초하여 크로마 픽셀 위치들(408, 412)에 대한 재구성된 루마 값들을 각각 생성하는 단계를 포함할 수 있다.
도 6은 PU(401)의 모든 크로마 픽셀 위치들(604)에 대한 블록 502에서의 처리 후의 도 6의 예시적인 PU(401)에 대한 예시적인 인트라 예측 스킴(600)을 나타낸다. 스킴(600)에 도시된 바와 같이, 블록 502에서의 처리에 이어서, PU(401) 내의 (열린 삼각형들에 의해 도시된) 각각의 크로마 픽셀 위치(604)는 명료화를 위해 도 6에 도시되지 않은 인접 루마 픽셀 위치들의 루마 값들로부터 (블록 502에서) 생성된 재구성된 루마 값을 가질 것이다. 게다가, 스킴(600)에 도시된 바와 같이, 이웃 PU들 내의 (어두운 삼각형들에 의해 도시된) 크로마 픽셀 위치들(606)은 인접 PU들(608, 610, 612)에 대해 이전에 수행된 프로세스(500)의 결과로서 재구성된 크로마 값들을 이미 가질 수 있다.
도 5를 다시 참조하면, 프로세스(500)는 크로마 픽셀 위치의 재구성된 루마 값 또는 인접 크로마 픽셀 위치들의 루마 값들 중 적어도 하나에 응답하여 크로마 픽셀 위치의 크로마 값을 예측할 수 있는 블록 504에서 마무리될 수 있다. 다양한 구현들에서, 블록 504는 디코더(200)의 인트라 예측 모듈(202)이 크로마 픽셀 위치의 재구성된 루마 값에 응답하여 또는 인접 크로마 픽셀 위치들의 국지적 분석을 수행함으로써 크로마 픽셀 위치에 대한 크로마 값을 예측하는 단계를 포함할 수 있다. 디코더(200)는 크로마 픽셀 위치의 (블록 502에서 생성된) 재구성된 루마 값과 디코더(200)에 의해 재구성된 인접 크로마 픽셀 위치들의 재구성된 루마 값들을 비교함으로써 인접 크로마 픽셀 위치들의 국지적 분석을 수행할 수 있으며, 디코더(200)는 래스터 스캔 처리 순서(raster scan processing order)를 구현할 수 있다.
본 발명에 따르면, 블록 504에서 크로마 픽셀 위치의 재구성된 루마 값에 응답하여 크로마 픽셀 위치에 대한 크로마 값을 예측하는 단계는 다양한 방식으로 구현될 수 있다. 일부 구현들에서, 크로마 픽셀 위치의 재구성된 루마 값에 대해 선형 또는 비선형 변환이 수행될 수 있다. 예를 들어, 크로마 픽셀 위치 k에 대해, 아래의 식을 이용하여 위치 k의 루마 값 L(k)로부터 크로마 값 C'(k)가 예측될 수 있다.
Figure 112014007024675-pct00001
여기서, f(ㆍ)는 선형 또는 비선형 함수 또는 변환일 수 있다. 다양한 구현들에서, f(ㆍ)의 파라미터들은 적어도 일부 이웃 크로마 픽셀 위치들의 재구성된 루마 및/또는 크로마 값들을 이용하여 결정될 수 있다. 다양한 구현들에서, 이웃 위치들에 대한 루마 및/또는 크로마 값들을 이용하여, f(ㆍ)에 대한 선형 또는 비선형 방정식 그룹을 생성할 수 있다. 이어서, f(ㆍ)의 파라미터들은 예를 들어 선형 최소 제곱(linear least squares), 비선형 최소 제곱, 가중된 최소 제곱 또는 다른 공지된 최적화 방법들과 같은 공지 기술들을 이용하여 획득될 수 있다.
일반적으로, f(ㆍ)의 선형 형태는 다음과 같이 표현될 수 있다.
Figure 112014007024675-pct00002
여기서, L(k)는 크로마 픽셀 위치 k에서의 루마 값을 나타내고, C'(k)는 위치 k에서의 예측 크로마 값을 나타내고, a 및 b는 선형 방정식 파라미터들이다.
일반적으로, f(ㆍ)의 비선형 형태는 다음과 같이 표현될 수 있다.
Figure 112014007024675-pct00003
여기서, a(k) 및 b(k)는 비선형 방정식 파라미터들이다. 다양한 구현들에서, 파라미터들 a(k) 및 b(k)는 적어도 부분적으로 L(k)의 값에 의해 결정될 수 있다. 예를 들어, L(k)의 값들의 범위(예를 들어, 8비트 비디오 깊이에 대해 [0, 255])는 루마 값들의 M개의 더 작은 서브세트 또는 범위 S(k)로 분할될 수 있다. 이어서, 각각의 서브세트 S(k)는 식 (3)에서 사용될 a(k) 및 b(k)에 대한 상이한 값들을 할당받을 수 있으며, 따라서 특정 크로마 위치에 대한 L(k)의 값이 주어진 서브세트 S(k) 내에 있을 때, a(k) 및 b(k)에 대한 대응하는 값들은 그 위치에 대한 크로마 값 C'(k)를 예측하기 위해 적용된다.
도 7은 블록 504에서 크로마 값들을 적응적으로 예측하기 위한 처리를 수행할 때의 PU(401)에 대한 예시적인 인트라 예측 스킴(700)을 나타낸다. 스킴(700)은 3개의 예시적인 크로마 픽셀 위치(702, 704, 705)에 대한 적응성 크로마 예측을 나타낸다. 예시적인 상하, 좌우 래스터 스캔 순서(706)가 구현되는 스킴(700)의 예에서, 블록 504에서, 이용 가능한 이웃하는 재구성된 루마 값들의 국지적 분석에 적어도 부분적으로 기초하여 위치(702)에 대한 크로마 값이 예측될 수 있다. 래스터 스캔 순서(706)는 PU(401)의 좌상 코너에 있는 위치(710)로부터 시작하여 상하, 좌우 방식으로 PU(401)의 크로마 픽셀 위치들을 스캔 처리하는 것을 포함하므로, 이웃하는 재구성된 크로마 값들의 가용성은 PU(401) 내의 위치에 의존할 수 있다. 예를 들어, 위치(702)에 대해, (이웃하는 PU(608) 내의 3개의 위치(708)를 포함하는) 5개의 이웃하는 크로마 픽셀 위치는 이용 가능한 재구성된 루마 값들을 가지며, 따라서 (도 7에 점선 화살표들에 의해 지시되는) 국지적 분석은 이러한 이웃하는 위치들로 제한될 수 있다. 이와 달리, 위치(705)에 대해서는 (이웃 PU(612) 내의 2개의 위치(712)를 포함하는) 3개의 이웃 크로마 픽셀 위치만이 이용 가능한 재구성된 루마 값들을 가지며, 따라서 국지적 분석은 이러한 이웃하는 위치들로 제한될 수 있다.
다양한 구현들에서, 이웃 위치들의 재구성된 루마 값들의 국지적 분석은 어느 이웃하는 재구성된 루마 값이 블록 504에서 예측된 그의 크로마 값을 갖는 크로마 픽셀 위치의 재구성된 루마 값에 값이 가장 가까운지를 결정하는 것을 포함할 수 있다. 예를 들어, 크로마 픽셀 위치 P에 대해, 이웃하는 또는 인접하는 크로마 픽셀 위치들의 세트 S = {Ni|i = 1, 2,..., K}가 정의될 수 있으며, 여기서 Ni는 인접 크로마 위치들을 나타낸다. 다양한 구현들에서, 이웃하는 크로마 위치들(Ni)은 이웃 PU들 내에 있을 수 있고/있거나, 현재 PU 내에 있을 수 있다. L(K)가 크로마 위치 k의 다운샘플링된 재구성된 루마 값을 나타내고,
Figure 112014007024675-pct00004
가 위치 k의 재구성된 크로마 값을 나타내는 경우, 크로마 위치 P에 대해 예측된 크로마 값은 다음 식에 의해 결정될 수 있다.
Figure 112014007024675-pct00005
값 L(Ni)가 주어진 이웃 위치 Ni에 대해 이용 가능하지 않은 경우, 그 위치는 식 (3)을 적용할 때 고려되지 않을 수 있다. 예를 들어, 크로마 픽셀 위치(704)에 대해, 블록 504에서 식 (4)는 N1, N2, N3 및 N4로 라벨링된 이웃 위치들의 재구성된 루마 값들에 적용될 수 있으며, N5로 라벨링된 위치는 국지적 분석에 포함되지 않는데, 그 이유는 재구성된 크로마 값이 그 위치에 대해 아직 생성되지 않았을 것이기 때문이다. 이 예에서, 에지(406)가 이웃 크로마 위치들 사이를 지나는 크로마 위치(704)에 대해 국지적 분석을 적용한 결과로서, 위치 N2 및 N3은 위치(704)와 동일한 에지(406)의 측에 위치하는 반면에 위치 N1 및 N4는 에지(406)의 타측에 위치하므로 위치 N2 및 N3의 재구성된 루마 값들 중 하나는 위치(704)의 재구성된 루마 값에 값이 가장 가까운 것으로 결정될 수 있다.
도 8은 본 발명에 따른 예시적인 시스템(800)을 나타낸다. 시스템(800)은 본 명세서에서 설명되는 다양한 기능들 중 일부 또는 전부를 수행하는 데 사용될 수 있으며, 본 발명에 따른 루마 기반 크로마 인트라 예측 처리를 행할 수 있는 임의의 장치 또는 장치들의 집합을 포함할 수 있다. 예를 들어, 시스템(800)은 데스크탑, 이동 또는 태블릿 컴퓨터, 스마트폰, 셋톱 박스 등과 같은 컴퓨팅 플랫폼 또는 장치의 선택된 컴포넌트들을 포함할 수 있지만, 본 발명은 이와 관련하여 한정되지 않는다.
시스템(800)은 프로세서(804) 및 메모리(806)에 동작 가능하게 결합된 비디오 코덱 모듈(802)을 포함할 수 있다. 디코더 모듈(802)은 인트라 예측 모듈(808)을 포함할 수 있다. 인트라 예측 모듈(808)은 적응성 예측 모듈(810) 및 필터 모듈(812)을 포함할 수 있으며, 프로세서(804) 및/또는 메모리(806)와 연계하여 본 명세서에서 설명되는 임의의 프로세스들 및/또는 임의의 등가 프로세스들을 수행하도록 구성될 수 있다. 다양한 구현들에서, 도 2의 예시적인 디코더(200)를 참조하면, 인트라 예측 모듈(808)은 인트라 예측 모듈(202)에 의해 제공될 수 있다. 코덱 모듈(802)은 명료화를 위해 도 8에 도시되지 않은 역양자화 모듈, 역변환 모듈 등과 같은 추가적인 컴포넌트들을 포함할 수 있다. 프로세서(804)는 SoC 또는 마이크로프로세서 또는 중앙 처리 유닛(CPU)일 수 있다. 다른 구현들에서, 프로세서(1004)는 주문형 집적 회로(ASIC:application specific integrated circuit), 필드 프로그래머블 게이트 어레이(FPGA:Field Programmable Gate Array), 디지털 신호 프로세서(DSP:digital signal processor) 또는 다른 집적된 포맷들일 수 있다.
프로세서(804) 및 모듈(802)은 임의의 적절한 수단에 의해, 예를 들어 유선 접속 또는 무선 접속에 의해 서로 그리고 메모리(806)와 통신하도록 구성될 수 있다. 더욱이, 시스템(800)은 도 1의 인코더(100)를 구현할 수 있다. 게다가, 시스템(800)은 명료화를 위해 도 8에 도시되지 않은 통신 회로 등과 같은 추가적인 컴포넌트들 및/또는 장치들을 포함할 수 있다.
도 8은 코덱 모듈(802)을 프로세서(804)와 별개로 도시하지만, 이 분야의 기술자들은 코덱 모듈(802)이 하드웨어, 소프트웨어 및/또는 펌웨어의 임의 조합에서 구현될 수 있으며, 따라서 코덱 모듈(802)이 메모리(806)에 저장된 소프트웨어 논리에 의해 그리고/또는 프로세서(804)에 의해 실행되는 명령어들로서 적어도 부분적으로 구현될 수 있다는 것을 인식할 것이다. 예를 들어, 코덱 모듈(802)은 머신 판독 가능 매체에 저장된 명령어들로서 시스템(800)에 제공될 수 있다. 일부 구현들에서, 코덱 모듈(802)은 프로세서의 내부 메모리(도시되지 않음)에 저장된 명령어들을 포함할 수 있다.
메모리(806)는 본 명세서에서 설명된 바와 같은 재구성된 크로마 또는 루마 픽셀 값들, 다운샘플 필터 계수들 등을 저장할 수 있다. 예를 들어, 메모리(806)에 저장된 다운샘플 필터 계수들은 필터 모듈(812)이 본 명세서에서 설명되는 바와 같은 필터 계수들을 지정하는 것에 응답하여 메모리(806)에 로딩될 수 있다. 따라서, 다양한 구현들에서, 시스템(800)의 특정 컴포넌트들은 본 명세서에서 설명되는 바와 같은 도 3 및 5의 예시적인 프로세스들(300, 500)의 블록들 중 하나 이상을 각각 수행할 수 있다. 예를 들어, 필터 모듈(812)은 프로세스(500)의 블록 502를 수행할 수 있는 반면, 적응성 예측 모듈(810)은 블록 504를 수행할 수 있으며, 기타 등등이다.
도 9는 본 발명에 따른 예시적인 시스템(900)을 나타낸다. 시스템(900)은 본 명세서에서 설명되는 다양한 기능들 중 일부 또는 전부를 수행하는 데 사용될 수 있으며, 본 발명의 다양한 구현들에 따른 루마 기반 크로마 인트라 예측을 수행할 수 있는 임의의 장치 또는 장치들의 집합을 포함할 수 있다. 예를 들어, 시스템(900)은 데스크탑, 이동 또는 태블릿 컴퓨터, 스마트폰 등과 같은 컴퓨팅 플랫폼 또는 장치의 선택된 컴포넌트들을 포함할 수 있지만, 본 발명은 이와 관련하여 한정되지 않는다. 일부 구현들에서, 시스템(900)은 인텔® 아키텍처(IA)에 기초하는 컴퓨팅 플랫폼 또는 SoC일 수 있다. 이 분야의 기술자는 본 발명의 범위로부터 벗어나지 않고서 본 명세서에서 설명되는 구현들이 대안적인 처리 시스템들과 함께 사용될 수 있다는 것을 쉽게 알 것이다.
시스템(900)은 하나 이상의 프로세서 코어(904)를 갖는 프로세서(902)를 포함한다. 프로세서 코어들(904)은 적어도 부분적으로 소프트웨어를 실행하고/하거나 데이터 신호들을 처리할 수 있는 임의 타입의 프로세서 논리일 수 있다. 다양한 예들에서, 프로세서 코어들(904)은 복합 명령어 세트 컴퓨터(CISC:complex instruction set computer) 마이크로프로세서, 축소 명령어 세트 컴퓨팅(RISC:reduced instruction set computing) 마이크로프로세서, 매우 긴 명령어 워드(VLIW:very long instruction word) 마이크로프로세서, 명령어 세트들의 조합을 구현하는 프로세서, 또는 디지털 신호 프로세서 또는 마이크로컨트롤러와 같은 임의의 다른 프로세서 장치를 포함할 수 있다. 명료화를 위해 도 9에 도시되지 않았지만, 프로세서(902)는 하나 이상의 코프로세서(온칩 등)에 결합될 수 있다. 따라서, 다양한 구현들에서는, 다른 프로세서 코어들(도시되지 않음)이 본 발명에 따라 프로세서(902)와 연계하여 루마 기반 크로마 인트라 예측을 수행하도록 구성될 수 있다.
프로세서(902)는 또한 예를 들어 디스플레이 프로세서(908) 및/또는 그래픽 프로세서(910)에 의해 수신되는 명령어들을 제어 신호들 및/또는 마이크로코드 엔트리 포인트들로 디코딩하는 데 사용될 수 있는 디코더(906)를 포함한다. 시스템(900)에서는 코어(들)(904)와 다른 컴포넌트들로서 도시되지만, 이 분야의 기술자들은 코어(들)(904) 중 하나 이상이 디코더(906), 디스플레이 프로세서(908) 및/또는 그래픽 프로세서(910)를 구현할 수 있다는 것을 인식할 수 있다. 일부 구현들에서, 코어(들)(904)는 도 3 및 5와 관련하여 설명된 예시적인 프로세스들을 포함하는 본 명세서에서 설명되는 임의의 프로세스를 수행하도록 구성될 수 있다. 게다가, 제어 신호들 및/또는 마이크로코드 엔트리 포인트들에 응답하여, 코어(들)(904), 디코더(906), 디스플레이 프로세서(908) 및/또는 그래픽 프로세서(910)는 대응하는 동작들을 수행할 수 있다.
처리 코어(들)(904), 디코더(906), 디스플레이 프로세서(908) 및/또는 그래픽 프로세서(910)는 시스템 상호접속(916)을 통해 서로 그리고/또는 예를 들어 메모리 제어기(914), 오디오 제어기(918) 및/또는 주변 장치들(920)을 포함할 수 있지만 이에 한정되지 않는 다양한 다른 시스템 장치들과 통신 가능하게 그리고/또는 동작 가능하게 결합될 수 있다. 주변 장치들(920)은 예를 들어 통합 직렬 버스(USB:unified serial bus) 호스트 포트, 주변 컴포넌트 상호접속(PCI:Peripheral Component Interconnect) 익스프레스 포트, 직렬 주변 장치 인터페이스(SPI:Serial Peripheral Interface) 인터페이스, 확장 버스 및/또는 다른 주변 장치들을 포함할 수 있다. 도 9는 메모리 제어기(914)를 상호접속(916)에 의해 디코더(906) 및 프로세서들(908, 910)에 결합된 것으로 도시하지만, 다양한 구현들에서 메모리 제어기(914)는 디코더(906), 디스플레이 프로세서(908) 및/또는 그래픽 프로세서(910)에 직접 결합될 수 있다.
일부 구현들에서, 시스템(900)은 도 9에 도시되지 않은 다양한 I/O 장치들과 I/O 버스(또한 도시되지 않음)를 통해 통신할 수 있다. 그러한 I/O 장치들은 예를 들어 유니버설 비동기 수신기/송신기(UART:universal asynchronous receiver/transmitter) 장치, USB 장치, I/O 확장 인터페이스 또는 다른 I/O 장치들을 포함할 수 있지만, 이에 한정되지 않는다. 다양한 구현들에서, 시스템(900)은 이동, 네트워크 및/또는 무선 통신들을 수행하기 위한 시스템의 부분들을 적어도 나타낼 수 있다.
시스템(900)은 메모리(912)를 더 포함할 수 있다. 메모리(912)는 동적 랜덤 액세스 메모리(DRAM) 장치, 정적 랜덤 액세스 메모리(SRAM) 장치, 플래시 메모리 장치 또는 다른 메모리 장치들과 같은 하나 이상의 개별 메모리 컴포넌트일 수 있다. 도 9는 메모리(912)를 프로세서(902) 외부에 있는 것으로 도시하지만, 다양한 구현들에서 메모리(912)는 프로세서(902) 내부에 있을 수 있다. 메모리(912)는 프로세서(902)에 의해 실행될 수 있는 데이터 신호들에 의해 표현되는 명령어들 및/또는 데이터를 저장할 수 있다. 일부 구현들에서, 메모리(912)는 다운샘플 필터 계수들 등을 저장할 수 있다.
전술한 시스템들 및 본 명세서에서 설명되는 바와 같이 그들에 의해 수행되는 처리는 하드웨어, 펌웨어 또는 소프트웨어 또는 이들의 임의 조합에서 구현될 수 있다. 게다가, 본 명세서에서 설명되는 임의의 하나 이상의 특징은 개별 및 집적 회로 논리, 주문형 집적 회로(ASIC) 논리 및 마이크로컨트롤러를 포함하는 하드웨어, 소프트웨어, 펌웨어 및 이들의 조합들에서 구현될 수 있으며, 도메인-고유 집적 회로 패키지의 일부 또는 집적 회로 패키지들의 조합으로서 구현될 수 있다. 본 명세서에서 사용되는 바와 같은 소프트웨어라는 용어는 컴퓨터 시스템으로 하여금 본 명세서에서 설명되는 하나 이상의 특징 및/또는 특징들의 조합들을 수행하게 하기 위한 컴퓨터 프로그램 논리를 저장한 컴퓨터 판독 가능 매체를 포함하는 컴퓨터 프로그램 제품을 지칭한다.
본 명세서에서 설명된 소정 특징들이 다양한 구현들을 참조하여 설명되었지만, 이러한 설명은 한정적인 것으로 해석되는 것을 의도하지 않는다. 따라서, 본 명세서에서 설명되는 구현들의 다양한 변경들은 물론, 본 발명이 속하는 분야의 기술자들에게 명백한 다른 구현들도 본 발명의 사상 및 범위 내에 있는 것으로 간주된다.

Claims (36)

  1. 컴퓨터 구현 방법으로서,
    비디오 인코더에서,
    이미지 프레임의 현재 예측 유닛(PU) 내의 크로마 픽셀 위치에 대해, 상기 이미지 프레임 내의 상기 크로마 픽셀 위치에 물리적으로 인접하는 복수의 루마 픽셀 위치의 텍스처 특성을 결정하는 단계;
    상기 텍스처 특성에 응답하여 적어도 하나의 다운샘플 필터를 지정하는 단계; 및
    상기 다운샘플 필터를 지정하는 정보를 제공하는 단계,
    비디오 디코더에서,
    현재 예측 유닛(PU)의 제1 복수의 크로마 픽셀 위치에 대한 재구성된 루마 값들을 상기 현재 PU의 복수의 루마 픽셀 위치의 루마 값들에 응답하여 결정하는 단계; 및
    상기 제1 복수의 크로마 픽셀 위치 중 제1 크로마 픽셀 위치의 크로마 값을 상기 제1 크로마 픽셀 위치의 재구성된 루마 값 또는 상기 제1 크로마 픽셀 위치에 인접 배치된 제2 복수의 크로마 픽셀 위치의 루마 값들 중 적어도 하나에 응답하여 예측하는 단계
    를 포함하고,
    상기 제2 복수의 크로마 픽셀 위치는 상기 제1 복수의 크로마 픽셀 위치 중 적어도 일부를 포함하는 컴퓨터 구현 방법.
  2. 제1항에 있어서,
    상기 제1 크로마 픽셀 위치의 상기 크로마 값을 상기 제2 복수의 크로마 픽셀 위치의 루마 값들에 응답하여 예측하는 단계는
    상기 제1 크로마 픽셀 위치의 상기 재구성된 루마 값과 상기 제2 복수의 크로마 픽셀 위치의 상기 재구성된 루마 값들을 비교함으로써 상기 제1 크로마 픽셀 위치의 상기 재구성된 루마 값에 값이 가장 가까운 재구성된 루마 값을 갖는 제2 크로마 픽셀 위치를 식별하는 단계를 포함하고,
    상기 제2 복수의 크로마 픽셀 위치는 상기 제2 크로마 픽셀 위치를 포함하는 컴퓨터 구현 방법.
  3. 제2항에 있어서,
    상기 제1 크로마 픽셀 위치의 상기 크로마 값은 상기 제2 크로마 픽셀 위치의 크로마 값을 포함하는 컴퓨터 구현 방법.
  4. 제1항에 있어서,
    상기 제1 크로마 픽셀 위치의 상기 크로마 값을 상기 제1 크로마 픽셀 위치의 상기 재구성된 루마 값에 응답하여 예측하는 단계는 상기 제1 크로마 픽셀 위치의 상기 재구성된 루마 값에 선형 변환 또는 비선형 변환 중 적어도 하나를 적용하는 단계를 포함하는 컴퓨터 구현 방법.
  5. 제4항에 있어서,
    상기 제2 복수의 크로마 픽셀 위치의 재구성된 크로마 값들 또는 상기 제2 복수의 크로마 픽셀 위치의 재구성된 루마 값들 중 적어도 하나에 응답하여 상기 선형 변환 또는 상기 비선형 변환의 하나 이상의 파라미터를 결정하는 단계를 더 포함하는 컴퓨터 구현 방법.
  6. 제5항에 있어서,
    상기 선형 변환 또는 상기 비선형 변환의 상기 하나 이상의 파라미터를 결정하는 단계는 상기 제2 복수의 크로마 픽셀 위치의 상기 재구성된 크로마 값들 및/또는 재구성된 루마 값들의 선형 최소 제곱 값, 비선형 최소 제곱 값 또는 가중된 최소 제곱 값 중 적어도 하나를 결정하는 단계를 포함하는 컴퓨터 구현 방법.
  7. 제1항에 있어서,
    상기 현재 PU의 상기 복수의 크로마 픽셀 위치에 대한 재구성된 루마 값들을 상기 현재 PU의 상기 복수의 루마 픽셀 위치의 루마 값들에 응답하여 결정하는 단계는 상기 복수의 루마 픽셀 위치의 상기 루마 값들에 다운샘플 필터를 적용하는 단계를 포함하는 컴퓨터 구현 방법.
  8. 시스템으로서,
    비디오 인코더; 및
    비디오 디코더
    를 포함하고,
    상기 비디오 인코더는,
    이미지 프레임의 현재 예측 유닛(PU) 내의 크로마 픽셀 위치에 대해, 상기 이미지 프레임 내의 상기 크로마 픽셀 위치에 물리적으로 인접하는 복수의 루마 픽셀 위치의 텍스처 특성을 결정하고;
    상기 텍스처 특성에 응답하여 적어도 하나의 다운샘플 필터를 지정하고;
    상기 다운샘플 필터를 지정하는 정보를 제공하도록 구성되는 인트라 예측 모듈을 포함하고,
    상기 비디오 디코더는,
    현재 예측 유닛(PU)의 제1 복수의 크로마 픽셀 위치에 대한 재구성된 루마 값들을 상기 현재 PU의 복수의 루마 픽셀 위치의 루마 값들에 응답하여 결정하고;
    상기 제1 복수의 크로마 픽셀 위치 중 제1 크로마 픽셀 위치의 크로마 값을 상기 제1 크로마 픽셀 위치의 재구성된 루마 값 또는 상기 제1 크로마 픽셀 위치에 인접 배치된 제2 복수의 크로마 픽셀 위치의 루마 값들 중 적어도 하나에 응답하여 예측하도록 구성되는 인트라 예측 모듈을 포함하고,
    상기 제2 복수의 크로마 픽셀 위치는 상기 제1 복수의 크로마 픽셀 위치 중 적어도 일부를 포함하는 시스템.
  9. 제8항에 있어서,
    상기 인트라 예측 모듈은 상기 제1 크로마 픽셀 위치의 상기 재구성된 루마 값과 상기 제2 복수의 크로마 픽셀 위치의 상기 재구성된 루마 값들을 비교함으로써 상기 제1 크로마 픽셀 위치의 상기 재구성된 루마 값에 값이 가장 가까운 재구성된 루마 값을 갖는 제2 크로마 픽셀 위치를 식별함으로써 상기 제2 복수의 크로마 픽셀 위치의 루마 값들에 응답하여 상기 제1 크로마 픽셀 위치의 상기 크로마 값을 예측하도록 구성되고, 상기 제2 복수의 크로마 픽셀 위치는 상기 제2 크로마 픽셀 위치를 포함하는 시스템.
  10. 제9항에 있어서,
    상기 제1 크로마 픽셀 위치의 상기 크로마 값은 상기 제2 크로마 픽셀 위치의 크로마 값을 포함하는 시스템.
  11. 제8항에 있어서,
    상기 인트라 예측 모듈은 상기 제1 크로마 픽셀 위치의 상기 재구성된 루마 값에 선형 변환 또는 비선형 변환 중 적어도 하나를 적용함으로써 상기 제1 크로마 픽셀 위치의 상기 재구성된 루마 값에 응답하여 상기 제1 크로마 픽셀 위치의 상기 크로마 값을 예측하도록 구성되는 시스템.
  12. 제8항에 있어서,
    상기 인트라 예측 모듈은 상기 복수의 루마 픽셀 위치의 상기 루마 값들에 다운샘플 필터를 적용함으로써 상기 현재 PU의 상기 복수의 크로마 픽셀 위치에 대한 재구성된 루마 값들을 상기 현재 PU의 상기 복수의 루마 픽셀 위치의 루마 값들에 응답하여 결정하도록 구성되는 시스템.
  13. 시스템으로서,
    이미지 프레임의 내용들을 저장하기 위한 메모리; 및
    이미지 프레임의 현재 예측 유닛(PU) 내의 크로마 픽셀 위치에 대해, 상기 이미지 프레임 내의 상기 크로마 픽셀 위치에 물리적으로 인접하는 복수의 루마 픽셀 위치의 텍스처 특성을 결정하고;
    상기 텍스처 특성에 응답하여 적어도 하나의 다운샘플 필터를 지정하고;
    상기 다운샘플 필터를 지정하는 정보를 제공하도록 구성되는 인트라 예측 모듈
    을 포함하는 시스템.
  14. 제13항에 있어서,
    상기 인트라 예측 모듈은
    상기 다운샘플 필터와 관련된 필터 계수들을 결정하고;
    상기 다운샘플 필터를 지정하는 상기 정보와 함께 상기 필터 계수들을 제공하도록 더 구성되는 시스템.
  15. 제13항에 있어서,
    상기 메모리 내에 제1 이미지 프레임의 내용들을 저장하기 위한 프로세서를 더 포함하는 시스템.
  16. 삭제
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