KR101354359B1 - 표시장치 - Google Patents

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Abstract

본 발명은, 표시패널; 표시패널에 데이터신호를 공급하는 데이터구동부; 표시패널에 게이트신호를 공급하는 게이트구동부; 및 데이터구동부 및 게이트구동부를 제어하며 내부에서 생성된 제어신호에 따라 주파수가 가변되는 전압제어발진부를 포함하는 타이밍구동부를 포함하는 표시장치를 제공한다.
표시장치, 타이밍구동부, 주파수

Description

표시장치{Display Device}
본 발명은 표시장치에 관한 것이다.
정보화 기술이 발달함에 따라 사용자와 정보간의 연결 매체인 표시장치의 시장이 커지고 있다. 이에 따라, 액정표시장치(Liquid Crystal Display: LCD), 유기전계발광소자(Organic Light Emitting Diodes: OLED) 및 플라즈마 디스플레이 패널(Plasma Display Panel: PDP) 등과 같은 평판 표시장치(Flat Panel Display: FPD)의 사용이 증가하고 있다. 그 중 고해상도를 구현할 수 있고 소형화뿐만 아니라 대형화가 가능한 액정 표시장치가 널리 사용되고 있다.
앞서 설명한 표시장치 중 일부 예컨대, 액정표시장치나 유기전계발광표시장치는 매트릭스 형태로 배치된 복수의 서브 픽셀을 구동하는 타이밍구동부, 게이트구동부 및 데이터구동부 등에 의해 구동된다.
그런데, 앞서 설명한 표시장치를 구동하는 타이밍구동부는 전압제어발진부(Voltage Controlled Oscillator)의 주파수를 조절하기 어렵거나 설계값과 실제 출력되는 값이 다르게 나올 경우 이를 변경하기 어려운 문제가 있어 이의 개선이 요구된다.
상술한 배경기술의 문제점을 해결하기 위한 본 발명은, 다양한 주파수 생성과 더불어 설계된 주파수보다 높거나 낮은 주파수가 출력될 때 이를 보정할 수 있도록 구성된 전압제어발진부를 포함하는 타이밍구동부를 제공하여 주파수 조정을 위한 재설계 및 재공정이 미요구되는 표시장치를 제공하는 것이다. 또한, 본 발명은 설계 시간 단축 및 공정 단가를 낮출 수 있는 타이밍구동부를 포함하는 표시장치를 제공하는 것이다.
상술한 과제 해결 수단으로 본 발명은, 표시패널; 표시패널에 데이터신호를 공급하는 데이터구동부; 표시패널에 게이트신호를 공급하는 게이트구동부; 및 데이터구동부 및 게이트구동부를 제어하며 내부에서 생성된 제어신호에 따라 주파수가 가변되는 전압제어발진부를 포함하는 타이밍구동부를 포함하는 표시장치를 제공한다.
전압제어발진부는, 타이밍구동부의 내부에 포함된 메모리부로부터 출력된 제어신호의 조합에 따라 주파수가 가변될 수 있다.
타이밍구동부는, 내부에 포함된 메모리부로부터 출력된 제어신호를 이용하여 전압제어발진부를 제어하는 주파수변환부를 포함할 수 있다.
주파수변환부는, 제어신호의 조합에 따라 저항값이 가변되고 저항값에 따라 전압제어발진부의 출력 주파수를 가변할 수 있다.
주파수변환부는, 메모리부로부터 출력되는 N개의 제어신호를 2N개의 제어신호로 변환하는 디코더부와, 디코더부로부터 출력되는 2N개의 제어신호를 조합하여 전압제어발진부에 공급하는 조합부를 포함할 수 있다.
조합부는, 디코더부로부터 출력되는 2N개의 제어신호에 응답하여 스위칭 동작하는 2N개의 스위치부와, 2N개의 스위치부의 스위칭 동작에 따라 저항값이 가변되는 저항기부를 포함할 수 있다.
저항기부는 직렬로 구성된 제1저항기 내지 제2N저항기를 포함하고, 2N개의 스위치부는 제1저항기 내지 제2N저항기에 병렬로 연결되며 디코더부로부터 출력되는 2N개의 제어신호에 응답하여 스위칭 동작을 수행할 수 있다.
저항기부는, 제1저항기의 일단과 제2N저항기의 일단이 전압제어발진부에 연결될 수 있다.
저항기부는, 제1저항기의 일단이 제1전원배선에 연결되고 제2N저항기의 일단이 제2전원배선에 연결되며 제1저항기 내지 제2N저항기를 연결하는 노드들 중 적어도 하나의 노드가 전압제어발진부에 연결될 수 있다.
주파수변환부는, 전압제어발진부 내에 포함될 수 있다.
본 발명은, 다양한 주파수 생성과 더불어 설계된 주파수보다 높거나 낮은 주파수가 출력될 때 이를 보정할 수 있도록 구성된 전압제어발진부를 포함하는 타이밍구동부를 제공하여 주파수 조정을 위한 재설계 및 재공정이 미요구되는 표시장치를 제공하는 효과가 있다. 또한, 본 발명은 원하는 주파수를 출력하기 위해 타이밍구동부를 재설계 및 재공정이 미요구되므로 설계 시간 단축 및 공정 단가를 낮출 수 있는 효과가 있다. 또한, 본 발명은 내부 메모리부를 이용하여 주파수를 다양하게 생성할 수 있어 타이밍구동부에 주파수 보정을 위한 입력단을 생략할 수 있고 타이밍구동부의 크기를 줄일 수 있는 효과가 있다.
이하, 본 발명의 실시를 위한 구체적인 내용을 첨부된 도면을 참조하여 설명한다.
도 1은 본 발명의 일 실시예에 따른 표시장치의 블록도 이고, 도 3은 게이트구동부의 블록도 이며, 도 4는 데이터구동부의 블록도 이고, 도 5는 액정표시패널의 서브 픽셀 회로 구성 예시도 이며, 도 6은 유기전계발광표시패널의 서브 픽셀 회로 구성 예시도 이다.
도 1에 도시된 바와 같이, 본 발명의 일 실시예에 따른 표시장치는, 타이밍구동부(TCN), 표시패널(PNL), 게이트구동부(SDRV) 및 데이터구동부(DDRV)를 포함한 다.
타이밍구동부(TCN)는 외부로부터 수직 동기신호(Vsync), 수평 동기신호(Hsync), 데이터 인에이블 신호(Data Enable, DE), 클럭신호(CLK), 데이터신호(DATA)를 공급받는다. 타이밍구동부(TCN)는 수직 동기신호(Vsync), 수평 동기신호(Hsync), 데이터 인에이블 신호(Data Enable, DE), 클럭신호(CLK) 등의 타이밍신호를 이용하여 데이터구동부(DDRV)와 게이트구동부(SDRV)의 동작 타이밍을 제어한다. 타이밍구동부(TCN)는 1 수평기간의 데이터 인에이블 신호(DE)를 카운트하여 프레임기간을 판단할 수 있으므로 외부로부터 공급되는 수직 동기신호(Vsync)와 수평 동기신호(Hsync)는 생략될 수 있다. 타이밍구동부(TCN)에서 생성되는 제어신호들에는 게이트구동부(SDRV)의 동작 타이밍을 제어하기 위한 게이트 타이밍 제어신호(GDC)와 데이터구동부(DDRV)의 동작 타이밍을 제어하기 위한 데이터 타이밍 제어신호(DDC)가 포함될 수 있다. 게이트 타이밍 제어신호(GDC)에는 게이트 스타트 펄스(Gate Start Pulse, GSP), 게이트 시프트 클럭(Gate Shift Clock, GSC), 게이트 출력 인에이블신호(Gate Output Enable, GOE) 등이 포함된다. 게이트 스타트 펄스(GSP)는 첫 번째 게이트신호가 발생하는 게이트 드라이브 IC(Integrated Circuit)에 공급된다. 게이트 시프트 클럭(GSC)은 게이트 드라이브 IC들에 공통으로 입력되는 클럭신호로써 게이트 스타트 펄스(GSP)를 시프트시키기 위한 클럭신호이다. 게이트 출력 인에이블신호(GOE)는 게이트 드라이브 IC들의 출력을 제어한다. 데이터 타이밍 제어신호(DDC)에는 소스 스타트 펄스(Source, Start Pulse, SSP), 소스 샘플링 클럭(Source Sampling Clock, SSC), 소스 출력 인에이블신호(Source Output Enable, SOE) 등이 포함된다. 소스 스타트 펄스(SSP)는 데이터구동부(DDRV)의 데이터 샘플링 시작 시점을 제어한다. 소스 샘플링 클럭(SSC)은 라이징 또는 폴링 에지에 기준하여 데이터구동부(DDRV) 내에서 데이터의 샘플링 동작을 제어하는 클럭신호이다. 소스 출력 인에이블신호(SOE)는 데이터구동부(DDRV)의 출력을 제어한다. 한편, 데이터구동부(DDRV)에 공급되는 소스 스타트 펄스(SSP)는 데이터전송 방식에 따라 생략될 수도 있다.
게이트구동부(SDRV)는 타이밍구동부(TCN)로부터 공급된 게이트 타이밍 제어신호(GDC)에 응답하여 표시패널(PNL)에 포함된 서브 픽셀들(SP)의 트랜지스터들이 동작 가능한 게이트 구동전압의 스윙폭으로 신호의 레벨을 시프트시키면서 게이트신호를 순차적으로 생성한다. 게이트구동부(SDRV)에는 게이트라인들(SL1~SLm)을 통해 생성된 게이트신호를 표시패널(PNL)에 포함된 서브 픽셀들(SP)에 공급한다. 도 2에 도시된 바와 같이, 게이트구동부(SDRV)는 쉬프트레지스터(61), 레벨쉬프터(63), 쉬프트레지스터(61)와 레벨쉬프터(63) 사이에 접속된 다수의 논리곱 게이트(이하, "AND 게이트"라 함)(62) 및 게이트 출력 인에이블신호(GOE)를 반전시키기 위한 인버터(64) 등을 포함한다. 쉬프트레지스터(61)는 종속적으로 접속된 다수의 D-플립플롭을 이용하여 게이트 스타트 펄스(GSP)를 게이트 쉬프트 클럭(GSC)에 따라 순차적으로 쉬프트시킨다. AND 게이트들(62)은 각각 쉬프트레지스터(61)의 출력신호와 게이트 출력 인에이블신호(GOE)의 반전신호를 논리곱하여 출력을 발생한다. 인버터(64)는 게이트 출력 인에이블신호(GOE)를 반전시켜 AND 게이트들(62)에 공급한다. 레벨쉬프터(63)는 AND 게이트(62)의 출력전압 스윙폭을 표시패널(PNL)에 포 함된 트랜지스터들이 동작 가능한 게이트전압의 스윙폭으로 쉬프트시킨다. 레벨쉬프터(63)로부터 출력되는 게이트신호는 게이트라인들(SL1~SLm)에 순차적으로 공급된다.
데이터구동부(DDRV)는 타이밍구동부(TCN)로부터 공급된 데이터 타이밍 제어신호(DDC)에 응답하여 타이밍구동부(TCN)로부터 공급되는 데이터신호(DATA)를 샘플링하고 래치하여 병렬 데이터 체계의 데이터로 변환한다. 데이터구동부(DDRV)는 병렬 데이터 체계의 데이터로 변환할 때, 데이터신호(DATA)를 감마 기준전압으로 변환한다. 데이터구동부(DDRV)는 데이터라인들(DL1~DLn)을 통해 변환된 데이터신호(DATA)를 표시패널(PNL)에 포함된 서브 픽셀들(SP)에 공급한다. 도 3에 도시된 바와 같이, 쉬프트 레지스터(51), 데이터 레지스터(52), 제1래치(53), 제2래치(54), 변환부(55), 출력회로(56) 등을 포함한다. 쉬프트레지스터(51)는 타이밍구동부(TCN)로부터 공급된 소스 샘플링 클럭(SSC)을 쉬프트시킨다. 쉬프트레지스터(51)는 이웃하는 다음 단의 소스 드라이브 IC의 쉬프트레지스터에 캐리신호(CAR)를 전달한다. 데이터레지스터(52)는 타이밍구동부(TCN)로부터 공급된 데이터신호(DATA)를 일시 저장하고 이를 제1래치(53)에 공급한다. 제1래치(53)는 쉬프트레지스터(51)로부터 순차적으로 공급되는 클럭에 따라 직렬로 입력되는 데이터신호(DATA)를 샘플링하여 래치한 다음 래치한 데이터들을 동시에 출력한다. 제2래치(54)는 제1래치(53)로부터 공급되는 데이터들을 래치한 다음 소스 출력 인에이블신호(SOE)에 응답하여 다른 소스 드라이브 IC들의 제2래치(54)와 동기 하여 래치한 데이터들을 동시에 출력한다. 변환부(55)는 제2래치(54)로부터 입력되는 데이터신 호(DATA)를 감마 기준전압(GMA1~GMAn)으로 변환한다. 출력회로(56)로부터 출력되는 데이터신호(DATA)는 소스 출력 인에이블신호(SOE)에 응답하여 데이터라인들(DL1~DLn)에 공급된다.
표시패널(PNL)은 매트릭스형태로 배치된 서브 픽셀(SP)을 포함한다. 표시패널(PNL)은 액정표시패널 또는 유기전계발광표시패널로 구성될 수 있다. 표시패널(PNL)이 액정표시패널로 구성된 경우 서브 픽셀(SP)은 다음의 도 4와 같은 회로 구성을 가질 수 있다. 스위칭 트랜지스터(TFT)는 게이트신호가 공급되는 게이트라인(SL1)에 게이트가 연결되고 데이터신호가 공급되는 데이터라인(DL1)에 일단이 연결되며 제1노드(n1)에 타단이 연결된다. 액정셀(Clc)의 일측에 위치하는 화소전극(1)은 스위칭 트랜지스터(TFT)의 타단에 연결된 제1노드(n1)에 일단이 연결되며 액정셀(Clc)의 타측에 위치하는 공통전극(2)은 공통전압배선(Vcom)에 연결된다. 스토리지커패시터(Cst)는 제1노드(n1)에 일단이 연결되며 공통전압배선(Vcom)에 타단이 연결된다. 이와 같은 서브 픽셀(SP) 구조를 갖는 액정표시패널은 게이트라인(SL1)을 통해 공급되는 게이트신호와 데이터라인(DL1)을 통해 공급되는 데이터신호에 따라 각 서브 픽셀에 포함된 액정층의 변화에 따른 광의 투과로 화상을 표시할 수 있다.
이와 달리, 표시패널(PNL)이 유기전계발광표시패널로 구성된 경우 서브 픽셀은 다음의 도 5와 같은 회로 구성을 가질 수 있다. 스위칭 트랜지스터(T1)는 게이트신호가 공급되는 게이트라인(SL1)에 게이트가 연결되고 데이터신호가 공급되는 데이터라인(DL1)에 일단이 연결되며 제1노드(n1)에 타단이 연결된다. 구동 트랜지 스터(T2)는 제1노드(n1)에 게이트가 연결되고 고 전위의 구동 전원(Vdd)이 공급되는 제1전원 배선(VDD)에 연결된 제2노드(n2)에 일단이 연결되며 제3노드(n3)에 타단이 연결된다. 스토리지커패시터(Cst)는 제1노드(n1)에 일단이 연결되고 제2노드(n2)에 타단이 연결된다. 유기 발광다이오드(D)는 구동 트랜지스터(T2)의 타단에 연결된 제3노드(n3)에 애노드가 연결되고 저 전위의 구동 전원(Vss)이 공급되는 제2전원 배선(VSS)에 캐소드가 연결된다. 이와 같은 서브 픽셀(SP) 구조를 갖는 유기전계발광표시패널은 게이트라인(SL1)을 통해 공급되는 게이트신호와, 데이터라인(DL1)을 통해 공급되는 데이터신호에 따라 각 서브 픽셀에 포함된 발광층이 발광을 함으로써 화상을 표시할 수 있다.
이하, 본 발명의 실시예에 따른 표시장치에 대해 더욱 자세히 설명한다.
<제1실시예>
도 6은 본 발명의 제1실시예에 따른 타이밍구동부의 개략적인 블록도이다.
도 6에 도시된 바와 같이, 타이밍구동부(TCN)는 자체적으로 주파수를 생성하는 전압제어발진부(150)와 전압제어발진부(150)로부터 공급된 주파수를 이용하여 구동신호를 생성하는 제어부(160)를 포함한다. 전압제어발진부(150)는 내부에서 생성된 N개의 제어신호(CS1~CSn)에 따라 출력 주파수(Fout)가 가변된다. 따라서, 전압제어발진부(150)는 입력되는 전원전압(VDD, VSS)과 N개의 제어신호(CS1~CSn)에 의해 출력 주파수(Fout)가 가변된다. 실시예의 전압제어발진부(150)는 타이밍구동부(TCN)의 내부에 포함된 메모리부(130)(예컨대, EEPROM 등의 내부 메모리)로부터 출력된 N개의 제어신호(CS1~CSn)의 조합에 따라 출력 주파수(Fout)가 가변된다. N개의 제어신호(CS1~CSn)는 메모리부(130)에 0과 1의 비트(bit) 형태로 저장될 수 있다.
<제2실시예>
도 7은 본 발명의 제2실시예에 따른 전압제어발진부의 개략적인 블록도이다.
도 7에 도시된 바와 같이, 타이밍구동부(TCN)는 메모리부(130), 전압제어발진부(150) 및 제어부(160)를 포함한다.
전압제어발진부(150)는 메모리부(130)로부터 공급된 N개의 제어신호(CS1~CSn)를 이용하여 전압제어발진소자(150c)를 제어하는 주파수변환부(150a, 150b)를 포함한다. 주파수변환부(150a, 150b)는 N개의 제어신호(CS1~CSn)의 조합에 따라 저항값이 가변되고 가변된 저항값에 따라 전압제어발진소자(150c)의 출력 주파수(Fout)를 가변할 수 있다.
주파수변환부(150a, 150b)는 디코더부(150a)와 조합부(150b)를 포함한다. 디코더부(150a)는 메모리부(130)로부터 출력되는 N개의 제어신호(CS1~CSn)를 2N개의 제어신호(CS1'~CSnN')로 변환한다. 예컨대, 2개의 신호가 입력되면 4개의 신호를, 3개의 신호가 입력되면 8개의 신호를 출력하게 된다. 조합부(150b)는 디코더부(150a)로부터 출력되는 2N개의 제어신호(CS1'~CSnN')를 조합하여 전압제어발진소자(150c)에 공급한다.
조합부(150b)는 디코더부(150a)로부터 출력되는 2N개의 제어신호(CS1'~CSnN')에 응답하여 스위칭 동작하는 2N개의 스위치부(Switch<1>~Switch<nN>)와, 2N개의 스위치부(Switch<1>~Switch<nN>)의 스위칭 동작에 따라 저항값이 가변되는 저항기부(R1~RnN)를 포함한다.
저항기부(R1~RnN)는 직렬로 구성된 제1저항기(R1) 내지 제2N저항기(RnN)를 포함하고, 2N개의 스위치부(Switch<1>~Switch<nN>)는 제1저항기(R1) 내지 제2N저항기(RnN)에 병렬로 연결된다. 저항기부(R1~RnN)는 제1저항기(R1)의 일단과 제2N저항기(RnN)의 일단이 전압제어발진소자(150c)에 연결된다. 이에 따라, 2N개의 제어신호(CS1'~CSnN')에 응답하여 스위칭 동작을 수행하는 2N개의 스위치부(Switch<1>~Switch<nN>)에 의해 저항기부(R1~RnN)의 저항값이 가변되고 전압제어발진소자(150c)는 가변된 저항값에 따라 출력 주파수(Fout)가 가변된다.
<제3실시예>
도 8은 본 발명의 제3실시예에 따른 전압제어발진부의 개략적인 블록도이다.
도 8에 도시된 바와 같이, 타이밍구동부(TCN)는 메모리부(130), 전압제어발진부(150) 및 제어부(160)를 포함한다.
전압제어발진부(150)는 메모리부(130)로부터 공급된 N개의 제어신 호(CS1~CSn)를 이용하여 전압제어발진소자(150c)를 제어하는 주파수변환부(150a, 150b)를 포함한다. 주파수변환부(150a, 150b)는 N개의 제어신호(CS1~CSn)의 조합에 따라 저항값이 가변되고 가변된 저항값에 따라 전압제어발진소자(150c)의 출력 주파수(Fout)를 가변할 수 있다.
주파수변환부(150a, 150b)는 디코더부(150a)와 조합부(150b)를 포함한다. 디코더부(150a)는 메모리부(130)로부터 출력되는 N개의 제어신호(CS1~CSn)를 2N개의 제어신호(CS1'~CSnN')로 변환한다. 그리고 조합부(150b)는 디코더부(150a)로부터 출력되는 2N개의 제어신호(CS1'~CSnN')를 조합하여 전압제어발진소자(150c)에 공급한다.
조합부(150b)는 디코더부(150a)로부터 출력되는 2N개의 제어신호(CS1'~CSnN')에 응답하여 스위칭 동작하는 2N개의 스위치부(Switch<1>~Switch<nN>)와, 2N개의 스위치부(Switch<1>~Switch<nN>)의 스위칭 동작에 따라 저항값이 가변되는 저항기부(R1~RnN)를 포함한다.
저항기부(R1~RnN)는 직렬로 구성된 제1저항기(R1) 내지 제2N저항기(RnN)를 포함하고, 2N개의 스위치부(Switch<1>~Switch<nN>)는 제1저항기(R1) 내지 제2N저항기(RnN)에 병렬로 연결된다. 저항기부(R1~RnN)는 제1저항기(R1)의 일단이 제1전원배 선(VDD)에 연결되고 제2N저항기(RnN)의 일단이 제2전원배선(VSS)에 연결되며 제1저항기(R1) 내지 제2N저항기(RnN)를 연결하는 노드들 중 적어도 하나의 노드(Node)가 전압제어발진소자(150c)에 연결된다. 이에 따라, 2N개의 제어신호(CS1'~CSnN')에 응답하여 스위칭 동작을 수행하는 2N개의 스위치부(Switch<1>~Switch<nN>)에 의해 저항기부(R1~RnN)의 저항값이 가변되고 전압제어발진소자(150c)는 가변된 저항값에 따른 전압값의 가감으로 출력 주파수(Fout)가 가변된다.
제2 및 제3실시예와 같이 타이밍구동부(TCN)에 포함된 장치들이 구성된 경우, 제K번째 제어신호(CSk')로 "0"이 입력되면 제K번째 스위치부(Switch<k>)는 전압제어발진소자(150c)로부터 나오는 신호(또는 전류, 전압)를 제K번째 저항기(Rk)로 전달할 수 있다. 이와 달리, 제K번째 제어신호(CSk')로 "1"이 입력되면 제K번째 스위치부(Switch<k>)는 전압제어발진소자(150c)로부터 나오는 신호(또는 전류, 전압)를 제K+1번째 저항기(Rk+1)와 연결된 노드로 전달할 수 있다. 이는 실시예의 일례일 뿐 2N개의 스위치부(Switch<1>~Switch<nN>)는 특성에 따라 "0"과 "1"에 대한 응답 설정을 달리할 수도 있다.
한편, 제2 및 제3실시예에서는 전압제어발진소자(150c)로부터 출력되는 주파수를 다양하게 가변하기 위해 디코더부(150a)를 이용하였으나 이는 생략될 수도 있 다. 이 경우, 전압제어발진소자(150c)는 메모리부(130)로부터 공급되는 N개의 제어신호(CS1~CSn)와 맞게 조합부(150b)를 설계하더라도 저항값을 가변할 수 있게 되므로 전압제어발진소자(150c)의 출력 주파수(Fout)를 가변할 수 있게 된다. 그리고 제2 및 제3실시예에서는 전압제어발진부(150) 내부에 주파수변환부(150a, 150b)가 포함된 것을 일례로 하였지만 이는 전압제어발진부(150)의 외부에 구성될 수도 있다. 그리고 제2 및 제3실시예에서는 조합부(150b) 내에 포함된 저항기부(R1~RnN)의 저항값을 변경하는 것을 일례로 하였으나 주파수 가변시 요구되는 커패시터의 정전 용량값 또한 변경하는 형태로 구성될 수도 있다.
이하, 본 발명의 실시예들에 따른 전압제어발진부의 주파수 가변 동작에 대해 설명한다.
도 9는 전압제어발진부의 주파수 가변 동작을 설명하기 위한 도면이고, 도 10은 전압제어발진부의 출력 주파수의 예시도이다.
도 9에 도시된 바와 같이, 실시예들에 따른 전압제어발진부(VCO)는 입력된 전원전압(Voltage)과 저항값(Rs)의 변화로 출력 주파수(Fout)를 제1주파수(F[1]) 내지 제N주파수(F[n])로 가변하게 된다. 예컨대, 저항값(Rs)가 증가하게 되면 출력 주파수(Fout)는 감소하게 되고 저항값(Rs)가 감소하게 되면 출력 주파수(Fout)는 증가하게 된다. 이와 같은 방법에 의해, 전압제어발진부(VCO)는 도 6 내지 도 8에 도시된 메모리부(130)로부터 공급된 N개의 제어신호(CS1~CSn)에 따라 주파수를 가 변할 수 있게 된다. 이에 따르면, 전압제어발진부(VCO)로부터 출력되는 주파수는 메모리부(130)에 저장된 N개의 제어신호(CS1~CSn)를 조합함으로써 도 10과 같이 제1주파수(F[1])부터 제N주파수(F[n])까지 다양하게 가변된다. 또한, 전압제어발진부(VCO)로부터 출력되어야 할 주파수가 제3주파수인데 실질적으로 출력되는 주파수가 제2주파수인 경우 메모리부(130)에 저장된 N개의 제어신호(CS1~CSn)를 조합함으로써 원하는 주파수가 출력되도록 주파수 보정을 할 수 있게 된다.
이상 본 발명은 다양한 주파수 생성과 더불어 설계된 주파수보다 높거나 낮은 주파수가 출력될 때 이를 보정할 수 있도록 구성된 전압제어발진부를 포함하는 타이밍구동부를 제공하여 주파수 조정을 위한 재설계 및 재공정이 미요구되는 표시장치를 제공하는 효과가 있다. 또한, 본 발명은 원하는 주파수를 출력하기 위해 타이밍구동부를 재설계 및 재공정이 미요구되므로 설계 시간 단축 및 공정 단가를 낮출 수 있는 효과가 있다. 또한, 본 발명은 내부 메모리부를 이용하여 주파수를 다양하게 생성할 수 있어 타이밍구동부에 주파수 보정을 위한 입력단을 생략할 수 있고 타이밍구동부의 크기를 줄일 수 있는 효과가 있다.
이상 첨부된 도면을 참조하여 본 발명의 실시예를 설명하였지만, 상술한 본 발명의 기술적 구성은 본 발명이 속하는 기술 분야의 당업자가 본 발명의 그 기술적 사상이나 필수적 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다. 그러므로 이상에서 기술한 실시 예들은 모든 면에서 예시적인 것이며 한정적인 것이 아닌 것으로서 이해되어야 한다. 아울러, 본 발 명의 범위는 상기 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어진다. 또한, 특허청구범위의 의미 및 범위 그리고 그 등가 개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.
도 1은 본 발명의 일 실시예에 따른 표시장치의 블록도.
도 2는 액정표시패널의 서브 픽셀 회로 구성 예시도.
도 3은 유기전계발광표시패널의 서브 픽셀 회로 구성 예시도.
도 4는 게이트구동부의 블록도.
도 5는 데이터구동부의 블록도.
도 6은 본 발명의 제1실시예에 따른 타이밍구동부의 개략적인 블록도.
도 7은 본 발명의 제2실시예에 따른 전압제어발진부의 개략적인 블록도.
도 8은 본 발명의 제3실시예에 따른 전압제어발진부의 개략적인 블록도.
도 9는 전압제어발진부의 주파수 가변 동작을 설명하기 위한 도면.
도 10은 전압제어발진부의 출력 주파수의 예시도.
<도면의 주요 부분에 관한 부호의 설명>
TCN: 타이밍구동부 PNL: 표시패널
SDRV: 게이트구동부 DDRV: 데이터구동부
130: 메모리부 150: 전압제어발진부
160: 제어부

Claims (10)

  1. 표시패널;
    상기 표시패널에 데이터신호를 공급하는 데이터구동부;
    상기 표시패널에 게이트신호를 공급하는 게이트구동부; 및
    상기 데이터구동부 및 상기 게이트구동부를 제어하며 내부에서 생성된 제어신호에 따라 주파수가 가변되는 전압제어발진부를 포함하는 타이밍구동부를 포함하고,
    상기 타이밍구동부는 내부에 포함된 메모리부로부터 출력된 제어신호를 이용하여 상기 전압제어발진부를 제어하는 주파수변환부를 포함하고,
    상기 주파수변환부는 상기 메모리부로부터 출력되는 N개의 제어신호를 2N개의 제어신호로 변환하는 디코더부와, 상기 디코더부로부터 출력되는 상기 2N개의 제어신호를 조합하여 상기 전압제어발진부에 공급하는 조합부를 포함하며,
    상기 전압제어발진부는 상기 제어신호를 조합하는 상기 조합부의 조합 결과에 따라 주파수가 가변되는 것을 특징으로 하는 표시장치.
  2. 삭제
  3. 삭제
  4. 제1항에 있어서,
    상기 주파수변환부는,
    상기 제어신호의 조합 결과에 따라 저항값이 가변되고 상기 저항값에 따라 상기 전압제어발진부의 출력 주파수를 가변하는 것을 특징으로 하는 표시장치.
  5. 삭제
  6. 제1항에 있어서,
    상기 조합부는,
    상기 디코더부로부터 출력되는 상기 2N개의 제어신호에 응답하여 스위칭 동작하는 2N개의 스위치부와,
    상기 2N개의 스위치부의 스위칭 동작에 따라 저항값이 가변되는 저항기부를 포함하는 표시장치.
  7. 제6항에 있어서,
    상기 저항기부는 직렬로 구성된 제1저항기 내지 제2N저항기를 포함하고,
    상기 2N개의 스위치부는 상기 제1저항기 내지 상기 제2N저항기에 병렬로 연결되며 상기 디코더부로부터 출력되는 상기 2N개의 제어신호에 응답하여 스위칭 동작을 수행하는 것을 특징으로 하는 표시장치.
  8. 제7항에 있어서,
    상기 저항기부는,
    상기 제1저항기의 일단과 상기 제2N저항기의 일단이 상기 전압제어발진부에 연결된 것을 특징으로 하는 표시장치.
  9. 제7항에 있어서,
    상기 저항기부는,
    상기 제1저항기의 일단이 제1전원배선에 연결되고 상기 제2N저항기의 일단이 제2전원배선에 연결되며 상기 제1저항기 내지 상기 제2N저항기를 연결하는 노드들 중 적어도 하나의 노드가 상기 전압제어발진부에 연결된 것을 특징으로 하는 표시장치.
  10. 제1항에 있어서,
    상기 주파수변환부는,
    상기 전압제어발진부 내에 포함된 것을 특징으로 하는 표시장치.
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