KR101183145B1 - 플라즈마 디스플레이 패널의 전면전극 구동회로 - Google Patents

플라즈마 디스플레이 패널의 전면전극 구동회로 Download PDF

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Abstract

본 발명은 램프 파형 출력 전압 및 구형파 출력 전압을 제어함에 있어 회로 구성을 간소화시킬 수 있는 PDP 전면전극 구동회로에 관한 것으로서, 본 발명에 따른 PDP 전면전극 구동회로는 제어신호 입력단, 램프파형 ON 신호입력부, 램프파형 출력 제어회로부, 구형파 ON 신호입력부 및 램프파형-구형파 스위칭소자를 포함하여 이루어지며, 상기 제어신호 입력단은 상기 램프파형-구형파 스위칭소자를 온/오프시키는 제어신호를 상기 램프파형 ON 신호입력부 또는 구형파 ON 신호입력부에 인가하는 역할을 하며, 상기 램프파형 ON 신호입력부는 상기 제어신호 입력단으로부터 제어신호를 인가받아 상기 램프파형-구형파 스위칭소자를 제어하기 위한 게이트 전압 파형을 생성하는 역할을 하며, 상기 램프파형 출력 제어회로부는 캐패시터를 포함하여 구성되어 상기 캐패시터 내에 충전된 전하를 방전하여 상기 램프파형 ON 신호입력부에 의해 상기 램프파형-구형파 스위칭소자에 인가되는 게이트 전압 파형을 제어하는 역할을 하며, 상기 구형파 ON 신호입력부는 상기 제어신호 입력단으로부터 제어신호를 인가받아 상기 램프파형-구형파 스위칭소자를 제어하기 위한 게이트 전압 파형을 생성하는 역할을 하며, 상기 램프파형-구형파 스위칭소자의 드레인 단자는 램프파형 전압 및 구형파 전압의 입력단과 연결되고, 상기 램프파형-구형파 스위칭소자의 소스 단자는 램프파형 전압 및 구형파 전압의 출력단과 연결되는 것을 특징으로 한다.
램프파형, 구형파, PDP, 구동회로

Description

플라즈마 디스플레이 패널의 전면전극 구동회로{Driving circuit for front electrode of plasma display panel}
본 발명은 PDP 전면전극 구동회로에 관한 것으로서, 보다 상세하게는 램프 파형 출력 전압 및 구형파 출력 전압을 제어함에 있어 회로 구성을 간소화시킬 수 있는 PDP의 전면전극 구동회로에 관한 것이다.
교류형 플라즈마 디스플레이 패널(AC-PDP)은 스캔 전극(Y), 서스테인 전극(X) 및 어드레스 전극(A)의 3개의 전극을 구비하는 구조로 되어 있으며, 각 전극에 인가되는 전압을 이용하여 셀의 안정적 방전을 유도함으로써 밝기를 제어한다. 이와 같은 AC-PDP는 화상의 계조(gray scale)를 구현하기 위해 하나의 프레임을 발광횟수가 다른 여러 개의 서브필드(subfield)로 나누어 시분할 구동하는 방식을 택하고 있다.
한편, 하나의 프레임에 인가되는 PDP 구동파형은 복수의 서브필드로 구분되며, 각각의 서브필드는 시계열적으로 리셋 구간, 어드레스 구간 및 서스테인 구간 으로 구분된다. 이 때, 리셋 구간에 인가되는 PDP 구동파형은 도 1에 도시한 바와 같이 램프-업 및 램프-다운의 램프 파형을 사용하며, 어드레스 구간 및 서스테인 구간에 인가되는 파형은 통상, 구형파이다.
종래 기술에 있어서, 램프-업을 위한 스위칭 소자, 램프-다운을 위한 스위칭 소자, 스캔 펄스를 인가하는 스위칭 소자, 유지방전 전압을 인가하는 스위칭 소자를 각각 독립적으로 회로 구성하여 램프 파형 및 구형파를 제어하고 있다. 이와 같이 리셋 구간, 어드레스 구간 및 서스테인 구간 등의 각 구간에 인가되는 구동파형을 독립적인 스위칭 소자를 이용하여 제어함에 따라 회로가 복잡해지는 문제점이 있다.
종래의 PDP 회로 구성을 보다 상세히 살펴보면 다음과 같다. 도 2a는 도 1의 PDP 구동파형을 생성하는 종래 기술에 따른 PDP 전면전극 구동회로의 회로 구성도이고, 도 2b는 도 2a의 A 부분의 상세 회로도이며, 도 2c는 도 2a의 B 부분의 상세 회로도이다.
먼저, 램프-업 및 유지방전 전압을 인가하는 스위칭 소자를 살펴보면 도 2a 및 도 2b에 도시한 바와 같이 유지방전 전압을 인가하는 스위칭 소자(SW3)와 램프-업을 위한 스위칭 소자(SW5)가 별도의 회로로 각각 구성되어 유지방전 전압 파형 및 램프-업 전압 파형이 주사 전극(Y)에 인가됨을 알 수 있다.
도 2b를 이용하여 구체적으로 설명하면, 리셋 구간에서는 SW3은 오프되고 SW5를 이용하여 출력 전압 파형을 제어하는데, 램프-업 제어신호(S_SW5)가 로우(LOW) 상태를 유지하는 동안에 유지방전 전압 Vsus와 Y1에 인가되어 있는 전압 차이에 의해 캐패시터 C1에 전하가 충전된다. 이후, 리셋 구간의 램프-업 구동 파형을 주사 전극에 인가하기 위하여 제어신호 S_SW5를 하이(HIGH) 상태로 변화시키면 RC 회로의 적절한 충방전 시간에 따라 SW5의 게이트 입력전압이 제어되면서 SW5는 서서히 온(on) 상태로 변한다. 이 때, 전압 변화가 기울기를 갖는 것은 SW5의 게이트 입력전압이 RC 회로에 의해 시간을 갖고 서서히 변하기 때문이며, 가변저항 R4는 램프-업 전압 파형의 기울기를 조정하기 위해 사용된다. 또한, 유지방전 구간에서는 SW5는 항상 오프(off)된 상태에서 SW3을 온과 오프를 교대로 인가하면서 유지방전 파형을 구현한다.
다음으로, 램프-다운 및 스캔 펄스 인가의 경우도 도 2c에 도시한 바와 같이 램프-다운을 수행하는 스위칭 소자(SW7)와 어드레스 구간에서 스캔 펄스를 인가할 때 기저 전압을 인가하기 위한 스위칭 소자(SW8)를 별개로 구비시켜 램프-다운 전압 파형 및 스캔 펄스 파형을 구현한다.
한편, 도 2a의 회로도를 블록도로 나타내면 도 2d에 도시한 바와 같다. 도 2d에 있어서 제 1 제어스위치는 램프 파형 출력 전압을 제어하기 위한 스위치로서 도 2b의 SW5와 도 2c의 SW7이 포함되며, 도 2d의 제 2 제어스위치는 도 2b의 SW3과 도 2c의 SW8을 포함한다. 도 2d에 있어서, 제어신호 A와 B는 제 1 및 제 2 제어스위치를 제어하기 위한 제어신호로서 제어신호 A는 S_SW5와 S_SW7에 해당하고 제어신호 B는 S_SW3과 S_SW8에 해당한다. OFF 제어 회로부는 도 2b 및 도 2c에 도시된 트랜지스터 Q1, Q2, Q3, Q4이며, 풀다운 회로부는 저항이나 다이오드 등으로 구성되며 선택적으로 사용 가능하다.
이상 살펴본 바와 같이, 종래의 PDP 전면전극 구동회로는 리셋 구간, 어드레스 구간 및 서스테인 구간 등의 각 구간에 인가되는 구동파형을 독립적인 스위칭 소자를 이용하여 제어함에 따라, 요구되는 스위칭 소자의 개수가 많아 회로 구성이 복잡해지는 단점이 있다.
본 발명은 상기와 같은 문제점을 해결하기 위해 안출한 것으로서, 램프 파형 출력 전압 및 구형파 출력 전압을 제어함에 있어 회로 구성을 간소화시킬 수 있는 PDP의 전면전극 구동회로를 제공하는데 그 목적이 있다.
상기의 목적을 달성하기 위한 본 발명에 따른 PDP의 전면전극 구동회로는 플라즈마 디스플레이 패널의 전면전극을 구동하는 구동회로에 있어서, 하나의 스위칭 소자로 구형파와 램프파형을 출력할 수 있는 스위칭제어회로를 포함하는 것을 특징으로 한다.
상기 플라즈마 디스플레이 패널의 전면전극은 주사전극과 유지방전전극 중 어느 하나일 수 있으며, 상기 램프파형은 상승하는 램프파형과 하강하는 램프파형 중 어느 하나일 수 있다.
한편, 상기 스위칭 소자의 전압원은 유지방전전압, 스캔전압, 레벨전압 중 어느 하나이며, 상기 전면전극 구동회로는 램프파형을 출력시키는 역할을 수행하는 제 1 제어신호와 구형파를 출력시키는 역할을 수행하는 제 2 제어신호를 입력받아 상기 스위칭 소자를 제어함으로써 파형을 생성한다.
상기 전면전극 구동회로는 상기 제 1 제어신호가 입력될 때 상기 스위칭 소자의 게이트 전압이 서서히 변화하도록 하여 램프파형을 생성하고 상기 제 2 제어 신호가 입력될 때 상기 스위칭 소자의 게이트 전압이 급격히 변화하도록 하여 구형파를 생성한다. 또한, 상기 전면전극 구동회로는 상기 제 1 제어신호가 입력될 때 상기 스위칭 소자의 게이트 전압이 서서히 변화하도록 하는 역할을 수행하는 램프파형 출력 제어 회로부가 더 포함될 수 있다.
상기 램프파형 출력 제어 회로부는 커패시터와 저항을 포함하여 이루어지며, 상기 전면전극 구동회로는 상기 제 1 제어신호와 제 2 제어신호가 입력되지 않을 때 상기 스위칭 소자를 급격히 OFF시키기 위한 OFF 제어회로부가 더 구비될 수 있다.
상기 전면전극 구동회로는 제 1 램프파형을 출력시키는 역할을 수행하는 제 1 제어신호와 제 2 램프파형을 출력시키는 역할을 수행하는 제 2 제어신호와 구형파를 출력시키는 역할을 수행하는 제 3 제어신호를 입력받아 상기 스위칭 소자를 제어함으로써 파형을 생성할 수 있다. 또한, 상기 전면전극 구동회로는 상기 제 1 제어신호가 입력될 때 상기 스위칭 소자의 게이트 전압이 서서히 변화하도록 하여 제 1 램프파형을 생성하고 상기 제 2 제어신호가 입력될 때 상기 스위칭 소자의 게이트 전압이 서서히 변화하도록 하여 제 2 램프파형을 생성하고 제 3 제어신호가 입력될 때 상기 스위칭 소자의 게이트 전압이 급격히 변화하도록 하여 구형파를 생성할 수 있다.
여기서, 상기 제 1 램프파형과 상기 제 2 램프파형은 그 기울기가 다를 수 있으며, 상기 전면전극 구동회로는 상기 제 1 제어신호와 상기 제 2 제어신호가 동시에 입력될 때 상기 제 1 제어신호와 상기 제 2 제어신호 중 어느 하나가 입력될 때와 램프파형의 기울기가 달라질 수 있다.
또한, 상기 전면전극 구동회로는 상기 제 1 제어신호와 상기 제 2 제어신호 중 적어도 어느 하나가 입력될 때 상기 스위칭 소자의 게이트 전압이 서서히 변화하도록 하는 역할을 수행하는 램프파형 출력 제어 회로부가 포함될 수 있다.
상기 램프파형 출력 제어 회로부는 커패시터와 저항을 포함하여 이루어지며, 상기 전면전극 구동회로는 상기 제 1 제어신호가 입력될 때 상기 스위칭 소자의 게이트 전압이 서서히 변화하도록 하는 역할을 수행하는 제 1 램프파형 출력 제어 회로부와 상기 제 2 제어신호가 입력될 때 상기 스위칭 소자의 게이트 전압이 서서히 변화하도록 하는 역할을 수행하는 제 2 램프파형 출력 제어 회로부가 포함될 수 있다.
상기 제 1 램프파형 출력 제어 회로부와 상기 제 2 램프파형 출력 제어 회로부는 각각 커패시터와 저항을 포함하여 이루어지며, 상기 전면전극 구동회로는 상기 제 1 제어신호와 제 2 제어신호 및 제 3 제어신호가 입력되지 않을 때 상기 스위칭 소자를 급격히 OFF시키기 위한 OFF 제어회로부가 더 구비될 수 있다.
한편, 본 발명에 따른 PDP 전면전극 구동회로는, 플라즈마 디스플레이 패널의 전면전극을 구동하는 구동회로에 있어서, 하나의 스위칭 소자로 구형파와 램프파형을 출력할 수 있는 스위칭제어회로를 포함하고, 전면전극에 인가되는 출력을 증대시키기 위하여 상기 스위칭제어회로에 구형파를 출력하는 스위칭 소자가 복수개 병렬로 연결되는 것을 특징으로 할 수도 있다.
본 발명에 따른 PDP 전면전극 구동회로는 다음과 같은 효과가 있다.
하나의 스위칭 소자를 통해 램프-업 및 램프-다운 파형 전압 등의 램프파형뿐만 아니라 스캔 펄스 전압 및 유지방전 전압 등의 구형파 전압을 스위칭할 수 있게 되어 회로 구성을 간략화할 수 있다. 또한, 하나의 스위칭 소자를 통해 램프파형 및 구형파 전압을 모두 스위칭함에 따라 구동 방법을 간소화할 수 있게 된다.
이하, 도면을 참조하여 본 발명에 따른 PDP 전면전극 구동회로 및 그 구동방법을 상세히 설명하기로 한다. 도 3은 본 발명의 제 1 실시예에 따른 PDP 전면전극 구동회로의 블록도이다.
도 3에 도시한 바와 같이 본 발명의 제 1 실시예에 따른 PDP 전면전극 구동회로는 제어신호 입력단, 램프파형 ON 신호입력부, 램프파형 출력 제어회로부, 구형파 ON 신호입력부, OFF 신호입력부 A, OFF 신호입력부 B, OFF 제어회로부 및 램프파형-구형파 스위칭소자를 포함하여 이루어진다.
상기 제어신호 입력단은 상기 램프파형-구형파 스위칭소자를 제어하기 위한 제어신호 A, B가 외부의 회로로부터 입력되는 수단으로서, 상기 제어신호 A는 상기 램프파형 ON 신호입력부에 입력되며, 상기 제어신호 B는 구형파 ON 신호입력부에 입력된다.
상기 램프파형 ON 신호입력부는 상기 제어신호 A를 인가받아 상기 램프파형- 구형파 스위칭소자를 제어하기 위한 게이트 전압 파형을 생성하는 역할을 하며, 상기 램프파형 출력 제어회로부는 캐패시터를 포함하여 구성되어 상기 캐패시터 내에 축적된 전하를 방전함으로써 상기 램프파형-구형파 스위칭소자에 인가되는 게이트 전압 파형을 제어하는 역할을 한다. 상기 램프파형 출력 제어회로부에 의한 게이트 전압 파형의 제어에 의해 램프파형의 기울기가 형성될 수 있다.
상기 구형파 ON 신호입력부는 상기 제어신호 입력단으로부터 제어신호 B를 인가받아 상기 램프파형-구형파 스위칭소자를 제어하기 위한 게이트 전압 파형을 생성하는 역할을 하며, 상기 OFF 제어회로부는 제어신호 A 및 B가 로우(low) 상태인 경우 상기 램프파형-구형파 스위칭소자에 인가된 전압을 오프시키는 역할을 한다. 또한, 상기 OFF 신호입력부 A 및 OFF 신호입력부 B는 각각 로우 상태의 제어신호 A 및 B를 입력받아 상기 OFF 제어회로부를 온(ON)시킴으로써 램프파형-구형파 스위칭 소자의 게이트 입력단에 인가한 제어 전압을 빠르게 제거하는 역할을 한다.
상기 구성요소 이외에 상기 램프파형-구형파 스위칭소자에 인가하는 제어 전압을 안정적으로 구현하기 위해서 풀다운 회로부가 더 구비될 수 있으며, 상기 램프파형-구형파 스위칭소자의 드레인, 소스 단자는 각각 램프파형 전압, 구형파 전압의 입력단, 출력단이 연결된다.
이상과 같은 구성을 갖는 본 발명의 제 1 실시예에 따른 PDP 전면전극 구동회로의 블록 구성은 도 4 및 도 7에 도시한 바와 같은 회로로 구현될 수 있다. 도 4는 도 3의 블록 구성에 대한 일 실시예로 램프-업과 유지방전 전압을 인가하는 회로를 나타낸 것이며, 도 7은 도 3의 블록 구성에 대한 일 실시예로 램프-다운과 스 캔 펄스 전압을 인가하는 회로를 나타낸 것이다.
먼저, 도 4의 회로 구성 및 동작을 살펴보면 다음과 같다. 도 4에 도시한 바와 같이 상기 램프파형 ON 신호입력부 및 구형파 ON 신호입력부는 각각 저항(R1, R2)과 다이오드(D1, D2)로 구성되며, 상기 램프파형 출력 제어회로부는 캐패시터(C1)와 저항(R8)으로 구성된다. 또한, 상기 OFF 신호입력부 A는 병렬 연결되는 저항(R3, R4)과 다이오드(D3)로 구성되고, 상기 OFF 신호입력부 B는 병렬 연결되는 저항(R5, R6)과 다이오드(D4)로 구성되며, 상기 OFF 제어회로부는 트랜지스터(Q1)로 구성된다.
도 4의 회로에 있어서, R2, R9는 1～5Ω의 작은 값을 사용하고 R1은 5～20kΩ의 높은 값을 사용하는 것이 바람직하다. R2, R9를 낮게 설정하는 이유는 유지방전 전압 파형의 경우 매우 빠른 스위칭이 요구되기 때문이며, R1을 높게 설정하는 이유는 램프-업 파형의 기울기가 R1, C1에 의해 결정되기 때문이다. 또한, R3, R5는 R4와 R6에 대비하여 상당히 작은 값을 갖도록 하여야 한다. 그렇지 않으면 제어신호 A와 B 중 어느 하나가 하이(high)인 상태에서 트랜지스터(Q1)가 동작할 수 있기 때문이다. 제어신호 A와 B 중 어느 하나가 하이(high)인 상태에서 트랜지스터(Q1)가 동작하면 램프파형-구형파 스위칭소자(SW1)는 오프 상태가 되어 램프파형 및 구형파의 제어가 불가능하게 된다.
이이상의 회로 구성을 갖는 도 4의 회로 동작을 도 5와 도 6의 제어 신호를 예로 들어 살펴보면 다음과 같다. 도 5는 도 4의 회로 동작을 설명하기 위한 제어신호 A, B의 타이밍도이고, 도 6은 도 4의 회로 동작을 설명하기 위한 타이밍도로 써 도 5의 변형 실시예이다.
먼저, 도 5에서 램프-업 구간에서의 동작을 살펴보면, 제어신호 A가 하이 상태로 인가되면 제어신호 A에 의한 전류는 충전 및 방전용 커패시터인 C1은 R1-C1-R8로 이어지는 방전경로를 통하여 서서히 방전되면서 SW1에 필요한 제어 전압을 조정하며, 램프파형-구형파 스위칭 소자 SW1의 게이트에 인가할 제어 전압/전류는 R1, D1, R9를 거쳐 SW1의 게이트 단자에 인가된다. 이 때, 램프-업 파형의 기울기를 생성하며, 이와 동시에 하이 상태의 제어신호 A는 R5-D4-R7의 경로를 통해 트랜지스터(Q1)의 게이트 단자에 인가되어 트랜지스터(Q1)를 오프시킨다.
램프-업 구간이 완료되면 충방전 캐패시터(C1)에 저장되어 있던 모든 전하는 방전된 상태가 되고 SW1은 완전히 온(on) 상태가 된다. 이후, 제어신호 A를 로우(low) 상태로 인가하고 제어신호 B를 하이 상태로 인가하면 R2-D2-R9로 이어지는 회로를 통한 스위치 제어로 유지방전 전압 Vsus를 주사 전극에 인가할 수 있게 된다. 여기서, 제어신호 B에 의해 R3-D3-R7로 연결되는 회로를 통해 트랜지스터(Q1)는 오프 상태가 된다.
유지방전 구간의 경우, 제어신호 A를 사용하지 않고 제어신호 B를 사용하며 하이 및 로우 신호를 교대로 인가하여 SW1을 교대로 온/오프시켜 유지방전 파형을 구현한다.
한편, 램프-업 전압이 어드레스 구간에서 스캔 소자의 Vcc 전압단에 인가되는 Vyl 전압보다 낮은 경우에는 Vs 전압을 Vyl 전압으로 대신할 수 있다. 즉, 램프-업 전압 파형과 Vyl 전압 파형을 각각 출력하는 2개의 스위치 제어회로를 구성하 고 제어신호 A, B를 도 6과 같이 인가할 수 있다. 도 6에 있어서, 램프-업 구간에서는 제어신호 A가 인가되어 기울기를 갖는 램프-업 파형이 주사 전극에 인가되며, 어드레스 구간에서는 Vyl 전압을 주사 전극에 공급하기 위해 제어신호 B를 사용한다. 제어신호 B를 하이 상태로 변환하면 제어신호 A와 무관하게 SW1을 통해 구형파 전압 파형이 스캔 소자의 Vcc로 인가되어 원하는 형태의 구동파형을 주사 전극에 공급할 수 있게 된다.
이상의 방법을 통해, 하나의 스위칭소자(SW1)를 통해 램프-업 파형 및 유지방전 전압 파형(구형파)을 생성시킬 수 있게 된다.
다음으로, 램프-다운과 스캔 펄스 전압을 인가하는 회로에 대한 실시예인 도 7의 회로 구성을 살펴보면 다음과 같다. 램프-다운 및 스캔 펄스 전압을 인가하는 회로는 램프-업 및 유지방전 전압을 인가하는 회로에 비해 간략하게 구성할 수 있다. 램프-업의 경우에는 유지방전 파형이 매우 빠른 스위칭 속도를 요구하기 때문에 트랜지스터(Q1)를 이용한 빠른 오프 동작이 유리하지만, 램프-다운의 경우에는 빠른 스위칭이 요구되지 않기 때문에 저항을 이용하여 회로를 간략하게 구성할 수 있다. 이에 따라, OFF 신호입력부 및 OFF 제어회로부를 선택적으로 구성할 수 있다.
도 7에 도시한 바와 같이 상기 램프파형 ON 신호입력부는 병렬 연결되는 저항(R11, R12, R13)과 다이오드(D11)로 구성되고, 구형파 ON 신호입력부는 저항(R14)과 다이오드(D13)로 구성된다.
도 7의 회로 동작을 살펴보면 다음과 같다. 도 8은 도 4의 회로 동작을 설명하기 위한 제어신호 C, D의 타이밍도이다. 먼저, 램프 다운의 경우를 살펴보면 제어신호 C가 하이 상태로 인가되면 R11-R12-D11-R17로 이어지는 스위치 SW2의 제어 전압 경로와, R11-R12-C11-R15로 이어지는 캐패시터 방전 전류 경로를 통하여 램프-다운 전압이 기울기를 갖도록 SW2가 제어된다. 이 때, 제어신호 D는 로우 상태를 유지한다. 램프-다운이 완료되는 시점에 출력 전압은 Vyd에 도달하며, 이후 어드레스 구간이 시작된다. 즉, 제어신호 D가 하이 상태로 인가되며 SW2의 제어 전압은 R14-D13-R17로 이어지는 경로를 통하여 빠른 스위칭이 발생하여 SW2를 완전한 온 상태로 전환시킨다. 이렇게 되면, 스캔 소자의 GND 단자의 전압이 Vsc 전압과 연결된다. 한편, Vyl 전압은 다른 회로 경로를 통하여 스캔 소자의 Vcc 단자에 전원을 공급한다. 어드레스 구간이 종료된 후에는 제어신호 C와 D를 모두 로우 상태로 변경함으로써 SW2는 오프 상태를 유지하게 된다. 참고로, 어드레스 구간에서 제어신호 C를 로우 상태로 유지할 수도 있으며, 저항 R13과 R14는 작은 값의 저항을 사용하여야 한다.
이상, 본 발명의 제 1 실시예에 따른 PDP 전면전극 구동회로를 설명하였다. 이하에서는 본 발명의 제 2 실시예 내지 제 3 실시예에 따른 PDP 전면전극 구동회로를 설명하기로 한다. 먼저, 본 발명의 제 2 실시예에 따른 PDP 전면전극 구동회로를 설명하면 다음과 같다. 도 9는 본 발명의 제 2 실시예에 따른 PDP 전면전극 구동회로의 블록 구성도이고, 도 10은 도 9의 블록 구성의 일 실시예에 따른 회로 구성도이다.
본 발명의 제 2 실시예에 따른 PDP 전면전극 구동회로는 도 9에 도시한 바와 같이 2개의 램프 파형을 위한 제어신호 A와 B, 1개의 구형파 파형을 위한 제어신호 C를 사용하며, 램프파형 기울기를 제어하는 램프파형 출력 제어회로부를 A와 B로 별개로 구성함을 특징으로 한다.
이에 따라, 램프파형의 기울기를 다르게 설정할 수 있게 되며 궁극적으로 각 서브필드마다 서로 다른 형태의 리셋 파형을 형성할 수 있게 된다. 도 9에 있어서, 램프파형 ON 신호입력부, 램프파형 출력 제어회로부, 구형파 ON 신호입력부, OFF 신호입력부, OFF 제어회로부, 풀다운 회로부, 램프파형-구형파 스위칭소자의 세부 회로 구성은 각각 도 10에 도시한 바와 같이 도 3에 도시한 그것에 상응하다.
본 발명의 제 3 실시예에 따른 PDP 전면전극 구동회로를 살펴보면 다음과 같다. 도 11은 본 발명의 제 3 실시예에 따른 PDP 전면전극 구동회로의 블록 구성도이고, 도 12는 도 11의 블록 구성의 일 실시예에 따른 회로 구성도이며, 도 13은 도 11의 회로 동작을 설명하기 위한 타이밍도이다.
본 발명의 제 3 실시예에 따른 PDP 전면전극 구동회로는 도 11에 도시한 바와 같이, 2개의 램프 파형을 위한 제어신호 A와 B, 1개의 구형파 파형을 위한 제어신호 C를 사용하며, 램프파형 기울기를 제어하는 램프파형 출력 제어부를 1개만 사용한다. 본 발명의 제 3 실시예는 램프파형을 위한 제어신호 A와 B를 동일한 시간에 제어하게 되면 다른 기울기의 램프 파형을 생성시킬 수 있음을 특징으로 한다. 이에 따라, 다양한 기울기를 갖는 램프파형을 생성시킬 수 있게 되어 패널의 방전 특성에 효과적으로 대응할 수 있다.
도 11의 블록 구성은 도 12에 도시한 바와 같이 구체적인 회로로 구성할 수 있으며, 도 12에 있어서 램프파형 ON 신호입력부, 램프파형 출력 제어회로부, 구형파 ON 신호입력부, OFF 신호입력부, OFF 제어회로부, 풀다운 회로부, 램프파형-구형파 스위칭소자의 세부 회로 구성은 각각 도 3에 도시한 그것에 상응하다.
도 12에 도시한 회로 동작에 의한 구동파형을 살펴보면 도 13에 도시한 바와 같이 램프-업 전압 파형이 2개의 기울기를 갖음을 알 수 있다. 이와 같은 구동파형을 생성하기 위해 제어신호 A는 도 13에 도시한 바와 같이 A1 또는 A2의 상태로 인가하고 제어신호 B와 C는 도 13에 도시한 바와 같이 인가한다.
도 13의 구동파형을 세부적으로 살펴보면, 제어신호 A1을 사용하여 도 12의 회로를 동작시키는 경우에, T1 구간에 제어신호 A1을 하이 상태로 인가하여 동작시키고, T2 구간에 A1을 로우 상태로 인가하고 제어신호 B를 하이 상태로 인가한다. 이 경우에 제어신호 A1에 의하여 기울기가 큰 램프-업 파형을 상기의 T1 구간동안에 출력한 후에, T2의 구간동안에 제어신호 B에 의하여 기울기가 상대적으로 작은 램프-업 파형을 형성한다. 이렇게 함으로써 PDP 셀의 방전에서 매우 중요한 램프-업의 상단부분에서 보다 안정적인 방전을 유도할 수 있다.
도 13의 램프-업 파형은 기울기가 큰 파형이 먼저 출력되는 경우를 나타낸 것인데, 도 13의 램프-업 파형과 반대로 기울기가 작은 파형을 먼저 출력할 수도 있다. 이 경우, 제어신호 A로 도 13의 신호 B를 이용하고 제어신호 B로는 도 13의 신호 A를 인가함으로써 구현할 수 있다. 참고로, 본 실시예에서는 R41의 저항값이 R42의 저항값보다 작은 것으로 설명하고 있다. 기울기의 정도를 조정하는 것은 도 12의 저항 R41, R42의 저항값에 의한 것으로 R41의 저항값이 R42의 저항값보다 크게 설정한다면 제어신호 A에 의한 램프-업 파형이 기울기가 더 작은 형태를 만들 것이며, 그 반대로 R42의 저항값이 크게 설정된다면 제어신호 B에 의한 램프-업 파형의 기울기가 더 작은 형태를 만드는 것도 가능하다. 램프-업 파형의 2개의 기울기 중에서 작은 기울기를 갖는 램프-업을 먼저 출력하기 위한 또 다른 방법으로는 제어신호 A로써 도 13의 A2를 사용하고 제어신호 B로써 도 13의 신호 B를 이용하는 방법도 가능하다.
램프-업 및 램프-다운 전압 파형의 출력이 완료된 후에 구형파를 출력하는 경우 즉, T3과 T4 구간에서는 제어신호 A와 B를 모두 로우 상태로 인가하고, 제어신호 C를 하이 상태로 인가함으로써 구형파를 출력할 수 있게 된다.
본 실시예에서는 램프-업의 경우에 2개의 서로 다른 기울기를 갖는 방법에 관하여 서술하고 있으나, 램프-다운의 경우에도 상기의 방법에 의하여 2개의 서로 다른 기울기를 갖는 방법을 적용할 수 있다.
본 발명의 제 4 실시예에 따른 PDP 전면전극 구동회로를 살펴보면 다음과 같다. 도 14는 본 발명의 제 4 실시예에 따른 PDP 전면전극 구동회로의 블록 구성도이고, 도 15는 도 14의 블록 구성의 일 실시예에 따른 회로 구성도이다.
본 발명의 제 4 실시예는 도 3에 도시된 본 발명의 제 3 실시예의 변형 실시예로서, 구형파 전압 파형의 출력을 위한 전용 스위칭소자를 별도로 구비시킴에 특징이 있다. 도 14에 도시한 바와 같이 제 1 스위칭소자(SW5)는 램프파형 및 구형파 전압 파형을 모두 출력하는 역할을 하며, 제 2 스위칭소자(SW6)는 구형파 전압 파형만을 출력하는 역할을 한다.
도 14에 있어서 램프파형 ON 신호입력부, 램프파형 출력 제어회로부, 구형파 ON 신호입력부, OFF 신호입력부, OFF 제어회로부, 풀다운 회로부, 램프파형-구형파 스위칭소자의 세부 회로 구성은 각각 도 3에 도시한 그것에 상응하다.
도 14의 회로에 있어서, 램프파형 제어신호인 제어신호 A가 하이 상태로 입력되면 도 3에서와 마찬가지로 SW5만 제어신호 A에 의해 기울기를 갖는 출력 전압을 주사 전극에 공급하고 SW6은 오프 상태를 유지한다. 한편, 유지방전 전압 제어신호인 제어신호 B가 하이 상태로 인가되면 SW5 및 SW6은 동시에 온되며 2개의 스위치(SW5, SW6)를 통하여 Vd로부터 보다 큰 방전 전류를 전극으로 공급할 수 있게 된다. 또한, SW5와 SW6이 병렬로 구성되어 2개의 스위치 모두 램프파형과 구형파 파형을 인가할 수 있도록 설계하는 것도 가능하다.
도 1은 종래 기술에 따른 PDP 구동파형을 나타낸 도면.
도 2a는 도 1의 PDP 구동파형을 생성하는 종래 기술에 따른 PDP 전면전극 구동회로의 회로 구성도.
도 2b는 도 2a의 A 부분의 상세 회로도.
도 2c는 도 2a의 B 부분의 상세 회로도.
도 2d는 도 2a의 A 및 B 부분의 블록 구성도.
도 3은 본 발명의 제 1 실시예에 따른 PDP 전면전극 구동회로의 블록도.
도 4는 도 3의 블록 구성에 대한 일 실시예로 램프-업과 유지방전 전압을 인가하는 회로를 나타낸 도면.
도 5는 도 4의 회로 동작을 설명하기 위한 제어신호 A, B의 타이밍도.
도 6은 도 4의 회로 동작을 설명하기 위한 타이밍도로써 도 5의 변형 실시예를 나타낸 도면.
도 7은 도 3의 블록 구성에 대한 일 실시예로 램프-다운과 스캔 펄스 전압을 인가하는 회로를 나타낸 도면.
도 8은 도 4의 회로 동작을 설명하기 위한 제어신호 C, D의 타이밍도.
도 9는 본 발명의 제 2 실시예에 따른 PDP 전면전극 구동회로의 블록 구성도.
도 10은 도 9의 블록 구성의 일 실시예에 따른 회로 구성도.
도 11은 본 발명의 제 3 실시예에 따른 PDP 전면전극 구동회로의 블록 구성 도.
도 12는 도 11의 회로 동작을 설명하기 위한 타이밍도.
도 13은 도 11의 블록 구성의 일 실시예에 따른 회로 구성도.
도 14는 본 발명의 제 4 실시예에 따른 PDP 전면전극 구동회로의 블록 구성도.
도 15는 도 14의 블록 구성의 일 실시예에 따른 회로 구성도.

Claims (19)

  1. 플라즈마 디스플레이 패널의 전면전극을 구동하는 구동회로에 있어서,
    하나의 스위칭 소자로 구형파와 램프파형을 출력할 수 있는 스위칭제어회로를 포함하며,
    상기 전면전극 구동회로는 제 1 램프파형을 출력시키는 역할을 수행하는 제 1 제어신호와 제 2 램프파형을 출력시키는 역할을 수행하는 제 2 제어신호와 구형파를 출력시키는 역할을 수행하는 제 3 제어신호를 입력받아 상기 스위칭 소자를 제어함으로써 파형을 생성하며,
    상기 전면전극 구동회로는 상기 제 1 제어신호가 입력될 때 상기 스위칭 소자의 게이트 전압이 서서히 변화하도록 하여 제 1 램프파형을 생성하고 상기 제 2 제어신호가 입력될 때 상기 스위칭 소자의 게이트 전압이 서서히 변화하도록 하여 제 2 램프파형을 생성하고 제 3 제어신호가 입력될 때 상기 스위칭 소자의 게이트 전압이 급격히 변화하도록 하여 구형파를 생성하며,
    상기 제 1 램프파형과 상기 제 2 램프파형은 그 기울기가 다르며,
    상기 전면전극 구동회로는 상기 제 1 제어신호와 상기 제 2 제어신호가 동시에 입력될 때 상기 제 1 제어신호와 상기 제 2 제어신호 중 어느 하나가 입력될 때와 램프파형의 기울기가 달라지는 것을 특징으로 하는 플라즈마 디스플레이 패널의 전면전극 구동회로.
  2. 제 1 항에 있어서, 상기 플라즈마 디스플레이 패널의 전면전극은 주사전극과 유지방전전극 중 어느 하나인 것을 특징으로 하는 플라즈마 디스플레이 패널의 전면전극 구동회로.
  3. 제 1 항에 있어서, 상기 램프파형은 상승하는 램프파형과 하강하는 램프파형 중 어느 하나인 것을 특징으로 하는 플라즈마 디스플레이 패널의 전면전극 구동회로.
  4. 제 1 항에 있어서, 상기 스위칭 소자의 전압원은 유지방전전압, 스캔전압, 레벨전압 중 어느 하나인 것을 특징으로 하는 플라즈마 디스플레이 패널의 전면전극 구동회로.
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  14. 제 1 항에 있어서, 상기 전면전극 구동회로는 상기 제 1 제어신호와 상기 제 2 제어신호 중 적어도 어느 하나가 입력될 때 상기 스위칭 소자의 게이트 전압이 서서히 변화하도록 하는 역할을 수행하는 램프파형 출력 제어 회로부가 포함되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 전면전극 구동회로.
  15. 제 1 항에 있어서, 상기 램프파형 출력 제어 회로부는 커패시터와 저항을 포함하여 이루어지는 것을 특징으로 하는 플라즈마 디스플레이 패널의 전면전극 구동회로.
  16. 제 1 항에 있어서, 상기 전면전극 구동회로는 상기 제 1 제어신호가 입력될 때 상기 스위칭 소자의 게이트 전압이 서서히 변화하도록 하는 역할을 수행하는 제 1 램프파형 출력 제어 회로부와 상기 제 2 제어신호가 입력될 때 상기 스위칭 소자의 게이트 전압이 서서히 변화하도록 하는 역할을 수행하는 제 2 램프파형 출력 제어 회로부가 포함되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 전면전극 구동회로.
  17. 제 1 항에 있어서, 상기 제 1 램프파형 출력 제어 회로부와 상기 제 2 램프파형 출력 제어 회로부는 각각 커패시터와 저항을 포함하여 이루어지는 것을 특징으로 하는 플라즈마 디스플레이 패널의 전면전극 구동회로.
  18. 제 1 항에 있어서, 상기 전면전극 구동회로는 상기 제 1 제어신호와 제 2 제어신호 및 제 3 제어신호가 입력되지 않을 때 상기 스위칭 소자를 급격히 OFF시키기 위한 OFF 제어회로부가 더 구비되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 전면전극 구동회로.
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