KR101133707B1 - Resistive memory device and method for manufacturing the same - Google Patents
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Abstract
본 발명은 셋/리셋동작 특성을 향상시킬 수 있는 저항성 메모리 장치 및 그 제조방법을 제공하기 위한 것으로, 이를 위한 본 발명의 저항성 메모리 장치는, 하부전극 상의 제1저항층; 상기 제1저항층 상의 상기 제1저항층보다 낮은 산소환원력을 갖는 제2저항층; 및 상기 제2저항층 상의 상부전극을 포함하고 있으며, 상술한 본 발명에 따르면, 제1 및 제2저항층을 서로 다른 산소환원력을 갖는 물질로 형성하여 제1 및 제2저항층 내 단위체적당 산소공공 밀도를 서로 다르게 형성함으로써, 저항성 메모리 장치의 셋/리셋동작 특성을 향상시킬 수 있는 효과가 있다. The present invention provides a resistive memory device capable of improving the set / reset operation characteristics and a method of manufacturing the same. The resistive memory device of the present invention includes: a first resistive layer on a lower electrode; A second resistance layer having an oxygen reduction force lower than that of the first resistance layer on the first resistance layer; And an upper electrode on the second resistive layer, and according to the present invention, the first and second resistive layers are formed of a material having different oxygen reducing powers to form oxygen per unit volume in the first and second resistive layers. By forming the void density differently, there is an effect that can improve the set / reset operation characteristics of the resistive memory device.
셋, 리셋, 공공, 열처리, 환원, 결합력 Three, reset, vacancy, heat treatment, reduction, bonding force
Description
본 발명은 반도체 장치의 제조 기술에 관한 것으로, 저항 변화를 이용하는 저항성 메모리 장치 및 그 제조 방법에 관한 것이다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a manufacturing technique of a semiconductor device, and relates to a resistive memory device using a resistance change and a method of manufacturing the same.
최근 디램과 플래쉬 메모리를 대체할 수 있는 차세대 메모리 장치에 대한 연구가 활발히 수행되고 있다. 이러한 차세대 메모리 장치 중 하나는, 인가되는 전압에 따라 저항이 급격히 변화하여 적어도 서로 다른 두 저항 상태 사이에서 스위칭(switching)할 수 있는 가변 저항 물질을 이용하는 저항성 메모리 장치이다. 이러한 특성을 갖는 가변 저항 물질로는 전이금속산화물을 포함하는 이원계 산화물이나 페로브스카이트(perovskite) 계열의 물질이 이용되고 있다. Recently, research on next generation memory devices that can replace DRAM and flash memory has been actively conducted. One of such next-generation memory devices is a resistive memory device using a variable resistance material capable of rapidly changing resistance in accordance with an applied voltage to switch between at least two different resistance states. As the variable resistance material having such characteristics, a binary oxide containing a transition metal oxide or a perovskite-based material is used.
도 1은 종래기술에 따른 저항성 메모리 장치를 도시한 단면도이다. 1 is a cross-sectional view illustrating a resistive memory device according to the related art.
도 1에 도시된 바와 같이, 종래기술에 따른 저항성 메모리 장치는 상하부전극(11, 13) 사이에 저항층(12)이 개재된 구조를 가지며, 저항층(12)은 내부에 산소 공공(oxygen vacancy)을 포함하고 있다. As shown in FIG. 1, the resistive memory device according to the related art has a structure in which a
상술한 구조를 갖는 저항성 메모리 장치의 스위칭 매커니즘(mechanism)을 간략히 설명하면 다음과 같다. The switching mechanism of the resistive memory device having the above-described structure will be briefly described as follows.
하부 및 상부전극(11, 13)에 바이어스가 인가되면, 인가되는 바이어스에 따라서 저항층(12) 내에 산소공공에 의한 필라멘트 전류 경로(filamentary current path)가 생성되거나, 산소공공이 제거되어 기 생성된 필라멘트 전류 경로가 소멸된다. 이와 같이 필라멘트 전류 경로의 생성 또는 소멸에 의하여 저항층(12)은 서로 구별될 수 있는 두 저항 상태를 나타낸다. 즉, 필라멘트 전류 경로가 생성된 경우 저항이 낮은 상태를 나타내고 필라멘트 전류 경로가 소멸된 경우 저항이 높은 상태를 나타내는 것이다. 여기서, 저항층(12) 내에 필라멘트 전류 경로가 생성되어 저항이 낮은 상태가 되는 것을 셋(set) 동작이라 하고, 반대로 기 생성된 필라멘트 전류 경로가 소멸되어 저항이 높은 상태가 되는 것을 리셋(reset) 동작이라 한다.When a bias is applied to the lower and
여기서, 셋/리셋동작 특성(예컨대, 셋/리셋전류 및 셋/리셋시간 등)을 향상시키기 위해서는 저항층(12) 상부영역 즉, 상부전극(13)과 인접한 영역에서의 단위체적당 산소공공 밀도를 저항층(12) 하부영역 즉, 하부전극(11)과 인접합 영역에서의 단위체적당 산소공공 밀도보다 작게 형성하는 것이 바람직하다. Here, in order to improve the set / reset operation characteristics (eg, set / reset current and set / reset time), the oxygen pore density per unit volume in the upper region of the
하지만, 종래기술은 저항층(12)을 형성한 후에 열처리를 실시하여 저항층(12) 내 산소를 환원시키는 방법으로 저항층(12) 내부에 산소공공을 형성하기 때문에 저항층(12) 내부의 산소공공 분포를 제어할 수가 없어 셋/리셋동작 특성이 열화되는 문제점이 있다. 즉, 종래기술로는 저항층(12) 내부에서 상부영역과 하부영 역의 단위체적당 산소공공 밀도를 서로 다르게 형성할 수가 없어 셋/리셋동작 특성이 열화되는 문제점이 있다. However, in the related art, since oxygen vacancies are formed in the
이를 해결하기 위하여 저항층(12) 증착 및 열처리를 복수회 실시하여 상부영역과 하부영역의 단위체적당 산소공공 밀도를 서로 다르게 형성하는 기술이 제안되었으나, 이 경우에는 공정스탭이 급격히 증가하여 저항성 메모리 장치의 생산성을 저하시키는 문제점이 있으며, 기형성된 구조물에 가해지는 열적부담이 지속적으로 증가하여 저항성 메모리 장치의 특성이 열화되는 문제점을 유발한다. To solve this problem, a technique of forming oxygen pore density per unit volume of the upper region and the lower region by performing the deposition and heat treatment of the resistive layer 12 a plurality of times has been proposed. There is a problem of decreasing the productivity of the, and the thermal burden on the pre-formed structure continuously increases, causing a problem that the characteristics of the resistive memory device is deteriorated.
본 발명은 상기한 종래기술의 문제점을 해결하기 위하여 제안된 것으로, 셋/리셋동작 특성을 향상시킬 수 있는 저항성 메모리 장치 및 그 제조방법을 제공하는데 그 목적이 있다. The present invention has been proposed to solve the above-mentioned problems of the prior art, and an object thereof is to provide a resistive memory device and a method of manufacturing the same that can improve the set / reset operation characteristics.
상기 목적을 달성하기 위한 일 측면에 따른 본 발명의 저항성 메모리 장치는, 하부전극 상의 제1저항층; 상기 제1저항층 상의 상기 제1저항층보다 낮은 산소환원력을 갖는 제2저항층; 및 상기 제2저항층 상의 상부전극을 포함한다. In accordance with an aspect of the present invention, a resistive memory device includes: a first resistive layer on a lower electrode; A second resistance layer having an oxygen reduction force lower than that of the first resistance layer on the first resistance layer; And an upper electrode on the second resistance layer.
상기 제1 및 제2저항층은 산화물을 포함할 수 있다. The first and second resistance layers may include oxides.
상기 제1 및 제2저항층은 산소공공을 포함하고, 상기 제1저항층의 단위체적당 산소공공 밀도가 상기 제2저항층의 단위체적당 산소공공 밀도보다 클 수 있다. The first and second resistive layers may include oxygen pores, and the oxygen pore density per unit volume of the first resistive layer may be greater than the oxygen pore density per unit volume of the second resistive layer.
상기 제2저항층은 수소가스(H2), 질소가스(N2) 및 암모니아가스(NH3)로 이루어진 그룹으로부터 선택된 어느 하나 또는 이들의 혼합가스에 의한 산소환원력이 상기 제1저항층 보다 낮을 수 있다. The second resistive layer may have a lower oxygen reduction force than any one selected from the group consisting of hydrogen gas (H 2 ), nitrogen gas (N 2 ), and ammonia gas (NH 3 ) or a mixture thereof. Can be.
상기 제1저항층은 티타늄(Ti)산화물, 니오브(Nb)산화물, 탄탈륨(Ta)산화물, 니켈(Ni)산화물, 텅스텐(W)산화물, 바나듐(V)산화물, 스트론튬티타늄(SrTi)산화물 및 바륨티타늄(BaTi)산화물로 이루어진 그룹으로부터 선택된 어느 하나로 이루어진 단일막 또는 이들이 적층된 적층막을 포함할 수 있다. The first resistive layer includes titanium (Ti) oxide, niobium (Nb) oxide, tantalum (Ta) oxide, nickel (Ni) oxide, tungsten (W) oxide, vanadium (V) oxide, strontium titanium (SrTi) oxide, and barium. It may include a single film made of any one selected from the group consisting of titanium (BaTi) oxide or a laminated film in which they are laminated.
상기 제2저항층은 실리콘(Si)산화물, 알루미늄(Al)산화물, 하프늄(Hf)산화물, 지르코늄(Zr)산화물, 란탄(La)산화물, 가톨리늄(Gd)산화물, 하프늄실리콘(HfSi)산화물, 지르코늄실리콘(ZrSi)산화물, 하프늄알루미늄(HfAl)산화물 및 란탄알루미늄(LaAl)산화물로 이루어진 그룹으로부터 선택된 어느 하나로 이루어진 단일막 또는 이들이 적층된 적층막을 포함할 수 있다. The second resistive layer may be a silicon (Si) oxide, an aluminum (Al) oxide, a hafnium (Hf) oxide, a zirconium (Zr) oxide, a lanthanum (La) oxide, a tollium (Gd) oxide, a hafnium silicon (HfSi) oxide, A zirconium silicon (ZrSi) oxide, a hafnium aluminum (HfAl) oxide and a lanthanum aluminum (LaAl) oxide may include a single film made of any one selected from the group consisting of or a laminated film stacked thereon.
상기 상부전극 및 상기 하부전극은 백금(Pt), 이리듐(Ir), 금(Au), 루테늄(Ru), 이리듐산화물(IrO2), 루테늄산화물(RuO2), 티타늄질화물(TiN) 및 탄탈륨질화물(TaN)로 이루어진 그룹으로부터 선택된 어느 하나로 이루어진 단일막 또는 이들이 적층된 적층막을 포함할 수 있다. The upper electrode and the lower electrode are platinum (Pt), iridium (Ir), gold (Au), ruthenium (Ru), iridium oxide (IrO 2 ), ruthenium oxide (RuO 2 ), titanium nitride (TiN) and tantalum nitride It may include a single film made of any one selected from the group consisting of (TaN) or a laminated film in which they are laminated.
상기 목적을 달성하기 위한 다른 일 측면에 따른 본 발명의 저항성 메모리 장치 제조방법은, 하부전극 상에 제1저항층을 형성하는 단계; 상기 제1저항층 상에 상기 제1저항층보다 낮은 산소환원력을 갖는 제2저항층을 형성하는 단계; 상기 제1 및 제2저항층을 열처리하는 단계; 및 상기 제2저항층 상에 상부전극을 형성하는 단계를 포함한다. According to another aspect of the present invention, there is provided a method of manufacturing a resistive memory device, including: forming a first resistive layer on a lower electrode; Forming a second resistance layer on the first resistance layer, the second resistance layer having a lower oxygen reduction force than the first resistance layer; Heat-treating the first and second resistance layers; And forming an upper electrode on the second resistance layer.
상기 열처리는 진공상태 또는 아르곤가스(Ar) 분위기에서 실시할 수 있다.The heat treatment may be performed in a vacuum state or argon gas (Ar) atmosphere.
또한, 상기 열처리는 수소가스(H2), 질소가스(N2) 및 암모니아가스(NH3)로 이루어진 그룹으로부터 선택된 어느 하나 또는 이들의 혼합가스를 사용하여 실시할 수 있다. In addition, the heat treatment may be performed using any one or a mixture of these selected from the group consisting of hydrogen gas (H 2 ), nitrogen gas (N 2 ) and ammonia gas (NH 3 ).
또한, 상기 열처리는 퍼니스열처리법 또는 급속열처리법을 사용하여 실시하는 저항성 메모리 장치 제조방법. In addition, the heat treatment is a method of manufacturing a resistive memory device using a furnace heat treatment method or a rapid heat treatment method.
또한, 상기 열처리는 300℃ ~ 600℃ 범위의 온도에서 실시할 수 있다. In addition, the heat treatment may be carried out at a temperature in the range of 300 ℃ ~ 600 ℃.
상기 제1 및 제2저항층은 산화물로 형성할 수 있다. 구체적으로, 상기 제1저항층은 티타늄(Ti)산화물, 니오브(Nb)산화물, 탄탈륨(Ta)산화물, 니켈(Ni)산화물, 텅스텐(W)산화물, 바나듐(V)산화물, 스트론튬티타늄(SrTi)산화물 및 바륨티타늄(BaTi)산화물로 이루어진 그룹으로부터 선택된 어느 하나로 이루어진 단일막 또는 이들이 적층된 적층막으로 형성할 수 있다. 그리고, 상기 제2저항층은 실리콘(Si)산화물, 알루미늄(Al)산화물, 하프늄(Hf)산화물, 지르코늄(Zr)산화물, 란탄(La)산화물, 가톨리늄(Gd)산화물, 하프늄실리콘(HfSi)산화물, 지르코늄실리콘(ZrSi)산화물, 하프늄알루미늄(HfAl)산화물 및 란탄알루미늄(LaAl)산화물로 이루어진 그룹으로부터 선택된 어느 하나로 이루어진 단일막 또는 이들이 적층된 적층막으로 형성할 수 있다. The first and second resistance layers may be formed of an oxide. Specifically, the first resistance layer is titanium (Ti) oxide, niobium (Nb) oxide, tantalum (Ta) oxide, nickel (Ni) oxide, tungsten (W) oxide, vanadium (V) oxide, strontium titanium (SrTi) It can be formed as a single film composed of any one selected from the group consisting of an oxide and a barium titanium (BaTi) oxide or a laminated film in which they are laminated. In addition, the second resistive layer may be formed of silicon (Si) oxide, aluminum (Al) oxide, hafnium (Hf) oxide, zirconium (Zr) oxide, lanthanum (La) oxide, gasoline (Gd) oxide, and hafnium silicon (HfSi). It can be formed as a single film or a laminated film in which they are made of one selected from the group consisting of oxides, zirconium silicon (ZrSi) oxides, hafnium aluminum (HfAl) oxides and lanthanum aluminum (LaAl) oxides.
상기 하부전극 및 상기 상부전극은 백금(Pt), 이리듐(Ir), 금(Au), 루테늄(Ru), 이리듐산화물(IrO2), 루테늄산화물(RuO2), 티타늄질화물(TiN) 및 탄탈륨질화물(TaN)로 이루어진 그룹으로부터 선택된 어느 하나로 이루어진 단일막 또는 이들이 적층된 적층막으로 형성할 수 있다. The lower electrode and the upper electrode are platinum (Pt), iridium (Ir), gold (Au), ruthenium (Ru), iridium oxide (IrO 2 ), ruthenium oxide (RuO 2 ), titanium nitride (TiN) and tantalum nitride It can be formed from a single film composed of any one selected from the group consisting of (TaN) or a laminated film in which these are laminated.
상술한 과제 해결 수단을 바탕으로 하는 본 발명은 저항층이 서로 다른 산소환원력을 갖는 제1 및 제2저항층으로 이루어짐에 따라 제1 및 제2저항층에서의 단위체적당 산소공공 밀도를 서로 다르게 형성할 수 있으며, 이를 통해 저항성 메모리 장치의 셋/리셋동작 특성을 향상시킬 수 있는 효과가 있다. According to the present invention based on the above-mentioned problem solving means, the resistance layer is formed of the first and second resistance layer having different oxygen reduction force, so that different oxygen pore density per unit volume in the first and second resistance layer In this way, the set / reset operation characteristics of the resistive memory device may be improved.
또한, 서로 다른 산소환원력을 갖는 제1 및 제2저항층을 형성한 이후, 한번의 열처리를 통해 제1 및 제2저항층에서의 단위체적당 산소공공 밀도를 서로 다르게 형성할 수 있으며, 이를 통해 저항성 메모리 장치의 생산성 및 열처리 공정에 대한 부담을 경감시킬 수 있는 효과가 있다. In addition, after forming the first and second resistance layer having different oxygen reducing power, it is possible to form different oxygen pore density per unit volume in the first and second resistance layer through one heat treatment, thereby resisting There is an effect that can reduce the burden on the productivity and heat treatment process of the memory device.
이하 본 발명이 속하는 기술분야에서 통상의 지식을 가진자가 본 발명의 기술적 사상을 용이하게 실시할 수 있을 정도로 상세히 설명하기 위하여, 본 발명의 가장 바람직한 실시예를 첨부도면을 참조하여 설명하기로 한다.DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENT Hereinafter, preferred embodiments of the present invention will be described in detail with reference to the accompanying drawings, in order to facilitate a person skilled in the art to easily carry out the technical idea of the present invention.
후술할 본 발명은 저항성 메모리 장치의 셋/리셋동작 특성을 향상시킬 수 있는 저항층 즉, 저항층의 상부영역과 하부영역에서의 단위체적당 공공밀도가 서로 다른 저항층을 구비하는 저항성 메모리 장치 및 그 제조방법을 제공한다.The present invention to be described below includes a resistive memory device capable of improving the set / reset operation characteristics of a resistive memory device, that is, a resistive memory device having a resistive layer having a different pore density per unit volume in an upper region and a lower region of the resistive layer. It provides a manufacturing method.
도 2는 본 발명의 일실시예에 따른 저항성 메모리 장치를 도시한 단면도이다. 2 is a cross-sectional view illustrating a resistive memory device according to an exemplary embodiment of the present invention.
도 2에 도시된 바와 같이, 본 발명의 일실시예에 따른 저항성 메모리 장치는 하부전극(21)과 상부전극(25) 사이에 개재된 저항층(24)을 포함하고 있으며, 저항층(24)이 하부전극(21) 상에 형성된 제1저항층(22) 및 제1저항층(22)과 상부전극(25) 사이에 개재되어 제1저항층(22)보다 낮은 산소환원력을 갖는 제2저항층(23)으로 이루어짐을 특징으로 한다. 구체적으로, 제2저항층(23)은 수소가스(H2), 질소가스(N2) 및 암모니아가스(NH3)로 이루어진 그룹으로부터 선택된 어느 하나 또는 이들의 혼합가스에 의한 산소환원력이 제1저항층(22) 보다 낮은 물질로 이루어짐을 특징으로 한다. As shown in FIG. 2, a resistive memory device according to an exemplary embodiment of the present invention includes a
저항층(24) 즉, 제1 및 제2저항층(22, 23)은 산화물일 수 있다. 구체적으로, 저항층(24)은 전이금속산화물을 포함하는 이원계 산화물, 페로브스카이트 계열을 산화물 일 수 있다. 이때, 제1저항층(22)은 제2저항층(23)에 비하여 산소와의 결합력이 낮은 산화물일 수 있다. 즉, 낮은 산소환원력은 산소와의 결합력(또는 산소결합력)이 큰 것을 의미한다. The
또한, 저항층(24)은 막내 산소공공(oxygen vacancy, 26) 또는 금속공공(metal vacancy)과 같은 공공을 포함할 수 있다. 이때, 저항층(24)이 산화물로 이루어짐에 따라 저항층(24) 내 공공의 대부분은 산소공공(26)이다. 따라서, 저항층(24) 내 필라멘트 전류 경로의 생성 및 소멸은 산소공공(26)에 의해 결정된다고 할 수 있다. 참고로, 산소공공(26)은 산소가 결합되어 있어야할 위치의 산소가 빠져나감으로써 발생된 격자결합(lattice defect)으로 양의 전하를 갖는 입자 예컨대, 정공(Hole)과 같은 거동을 보인다. In addition, the
또한, 저항층(24)을 구성하는 제2저항층(23)은 제1저항층(22)보다 낮은 산소환원력을 갖기 때문에 제1저항층(22)의 단위체적당 산소공공(26) 밀도가 제2저항층(23)의 단위체적당 산소공공(26) 밀도보다 클 수가 있다.In addition, since the second
상술한 조건을 만족하는 제1저항층(22)은 티타늄(Ti)산화물, 니오브(Nb)산화물, 탄탈륨(Ta)산화물, 니켈(Ni)산화물, 텅스텐(W)산화물, 바나듐(V)산화물, 스트론튬티타늄(SrTi)산화물 및 바륨티타늄(BaTi)산화물로 이루어진 그룹으로부터 선택된 어느 하나 또는 이들이 적층된 적층막을 포함할 수 있다. 그리고, 제2저항층(23)은 실리콘(Si)산화물, 알루미늄(Al)산화물, 하프늄(Hf)산화물, 지르코늄(Zr)산화물, 란탄(La)산화물, 가톨리늄(Gd)산화물, 하프늄실리콘(HfSi)산화물, 지르코늄실리콘(ZrSi)산화물, 하프늄알루미늄(HfAl)산화물 및 란탄알루미늄(LaAl)산화물로 이루어진 그룹으로부터 선택된 어느 하나 또는 이들이 적층된 적층막을 포함할 수 있다. The first
저항층(24)의 두께(T3) 즉, 제1 및 제2저항층(22, 23)의 두께 합(T1 + T2 = T3)은 50Å ~ 500Å 범위일 수 있다. 이때, 제2저항층(23)보다 단위체적당 산소공공(26) 밀도가 큰 제1저항층(22)의 두께(T1)를 조절하면 저항층(24) 내 단위체적당 산소공공(26) 밀도를 조절할 수 있기 때문에 셋/리셋전류를 용이하게 조절할 수 있다. 그리고, 제1저항층(22)보다 단위체적당 산소공공(26) 밀도가 작은 제2저항층(23)의 두께(T2)를 조절하면 저항층(24)의 저항값 및 저항변화속도(즉, 셋/리셋시간)를 용이하게 조절할 수 있다. 예컨대, 저항층(24)의 두께(T3)는 고정된 상태에서 제2저항층(23)에 비하여 단위체적당 산소공공(26) 밀도가 큰 제1저항층(22)의 두께(T1)를 증가시키면(T1 > T2) 저항층(24)의 셋/리셋전류, 저항값 및 셋/리셋시간이 감소하고, 제1저항층(22)보다 제2저항층(23)의 두께를 증가시키면(T2 > T1) 저항층(24)의 셋/리셋전류, 저항값 및 셋/리셋시간을 증가시킬 수 있다. The thickness T3 of the
상부전극 및 하부전극은 백금(Pt), 이리듐(Ir), 금(Au), 루테늄(Ru), 이리듐산화물(IrO2), 루테늄산화물(RuO2), 티타늄질화물(TiN) 및 탄탈륨질화물(TaN)로 이루어진 그룹으로부터 선택된 어느 하나를 포함할 수 있다. The upper and lower electrodes are platinum (Pt), iridium (Ir), gold (Au), ruthenium (Ru), iridium oxide (IrO 2 ), ruthenium oxide (RuO 2 ), titanium nitride (TiN), and tantalum nitride (TaN). It may include any one selected from the group consisting of
상술한 구조를 갖는 본 발명의 저항층(24)은 제1 및 제2저항층(22, 23)을 서로 다른 산소환원력을 갖는 물질로 이루어짐에 따라 제1 및 제2저항층(22, 23)에서의 단위체적당 산소공공(26) 밀도를 서로 다르게 가져갈 수 있다. 즉, 저항층(24)의 상부영역 즉, 제2저항층(23)보다 하부영역 즉, 제1저항층(22)에서의 단위체적당 산소공공(26) 밀도를 더 크게 가져감으로써, 저항성 메모리 장치의 셋/리셋동작 특성(즉, 셋/리셋전류, 셋/리셋시간 등)을 향상시킬 수 있다.In the
이하, 도 3a 및 도 3b를 참조하여 본 발명의 일실시예에 따른 저항성 메모리 장치의 동작원리를 살펴봄으로써, 셋/리셋동작 특성을 향상시킬 수 있는 원리에 대하여 구체적으로 설명한다. 3A and 3B, the operation principle of the resistive memory device according to an exemplary embodiment of the present invention will be described in detail with reference to the principle of improving set / reset operation characteristics.
도 3a 및 도 3b는 본 발명의 일실시예에 따른 저항성 메모리 장치의 동작원리를 설명하기 위한 개략도이다. 3A and 3B are schematic diagrams for describing an operating principle of a resistive memory device according to an embodiment of the present invention.
도 3a 및 도 3b를 참조하여 본 발명의 일실시예에 따른 구조를 갖는 저항성 메모리 장치의 동작 매커니즘을 간략히 설명하면, 하부 및 상부전극(21, 25)에 바이어스가 인가되면, 인가되는 바이어스에 따라서 저항층(24) 내에 산소공공(26)에 의한 필라멘트 전류 경로(filamentary current path)가 생성되거나, 산소공공(26)이 제거되어 기 생성된 필라멘트 전류 경로가 소멸된다. 이와 같이 필라멘트 전류 경로의 생성 또는 소멸에 의하여 저항층(24)은 서로 구별될 수 있는 두 저항 상태를 나타낸다. 즉, 필라멘트 전류 경로가 생성된 경우 저항이 낮은 상태를 나타내고 필라멘트 전류 경로가 소멸된 경우 저항이 높은 상태를 나타내는 것이다. 여기서, 저항층(24) 내에 필라멘트 전류 경로가 생성되어 저항이 낮은 상태가 되는 것을 셋(set) 동작이라 하고, 반대로 기 생성된 필라멘트 전류 경로가 소멸되어 저항이 높은 상태가 되는 것을 리셋(reset) 동작이라 한다.3A and 3B, the operation mechanism of the resistive memory device having the structure according to the exemplary embodiment of the present invention will be briefly described. When a bias is applied to the lower and
도 3a에 도시된 바와 같이, 하부전극(21)에 접지전압(VSS)를 인가하고, 상부전극(25)에 접지전압보다 낮은 음의 전압(예컨대, VBB)를 인가하면, 상하부전극(21, 25)에 인가된 전압에 의해 저항층(24)내 산소공공(26)이 재배열되면서 필라멘트 전류 경로(미도시)가 생성된다. 이때, 필라멘트 전류 경로의 생성은 하부전극(21)으로부터 생성되며, 하부전극(21)과 접하는 제1저항층(22) 내 단위체적당 산소공공(26) 밀도가 저항층(24) 내에서 상대적으로 크기 때문에 필라멘트 전류 경로의 생성을 용이하게 하여 셋동작 특성을 향상시킬 수 있다. As shown in FIG. 3A, when the ground voltage VSS is applied to the
또한, 통상적으로 오프상태(off) 상태에서의 저항성 메모리 장치의 누설전류 발생을 억제하기 위해 상하부전극(21, 25)과 저항층(24) 사이의 어느 한 계면은 높은 전위장벽 예컨대, 샤키베리어(schottky barrier)를 갖도록 형성한다. 본 발명의 일실시예의 경우에는 저항층(24)에서 상대적으로 단위체적당 산소공공(26) 밀도가 작은 제2저항층(23)과 상부전극(25) 사이에 높은 전위장벽이 형성되는데, 상하부전극(21, 25)에 인가된 전압에 의해 제1저항층(22)의 산소공공(26) 일부가 제2저항층(23)으로 확산됨에 따라 제2저항층(23) 내 단위체적당 산소공공(26) 밀도가 증가하여 제2저항층(23)과 상부전극(25) 사이의 전위장벽을 감소시킬 수 있다. 이를 통해, 하부전극(21), 저항층(24) 내 필라멘트 전류 경로 및 상부전극(25) 사이의 캐리어 이동(즉, 전류의 흐름)을 용이하게 할 수 있으며, 결과적으로 셋동작 특성을 보다 효과적으로 향상시킬 수 있다.Also, in order to suppress leakage current of the resistive memory device in the off state, any one interface between the upper and
한편, 상하부전극(21, 25)을 서로 동일한 물질로 형성하더라도, 제1저항층(22)은 제2저항층(23)보다 단위체적당 산소공공(26) 밀도가 크기 때문에 하부전극(21)과 제1저항층(22) 사이에는 샤키배리어가 형성되지 않는다. On the other hand, even if the upper and
도 3b에 도시된 바와 같이, 하부전극(21)에 접지전압(VSS)를 인가하고, 상부전극(25)에 접지전압보다 높은 양의 전압(예컨대, VDD)를 인가하면, 상하부전극(21, 25)에 인가된 전압에 의해 저항층(24)내 산소공공(26)이 재배열되면서 필라멘트 전류 경로(미도시)가 소멸된다. 이때, 필라멘트 전류 경로의 소멸은 저항층(24)과 상부전극(25) 계면의 산소가 저항층(24) 내 산소공공(26)을 채우거나, 또는 상하부전극(21, 25)에 인가된 전압에 의하여 산소공공(26)이 하부전극(21) 방향으로 이동함에 따라 상하부전극(21, 25) 사이를 연결하는 필라멘트 전류 경로가 끊어짐으로써 발생한다. 따라서, 저항층(24)의 상부에 위치하는 제2저항층(23) 내 단위체적당 산소공공(26) 밀도가 제1저항층(22)보다 작게 형성하면 제2저항층(23) 내 형성된 필라멘트 전류 경로의 갯수가 제1저항층(22)에 비하여 상대적으로 적기 때문에 필라멘트 전류 경로의 소멸이 보다 용이하다. 이를 통해, 리셋동작 특성을 향상시킬 수 있다. As shown in FIG. 3B, when the ground voltage VSS is applied to the
또한, 셋동작시 상하부전극(21, 25)에 인가된 전압에 의해 제1저항층(22)에서 제2저항층(23)으로 이동한 산소공공(26)이 리셋동작시 인가된 전압에 의해 다시 제2저항층(23)에서 제1저항층(22)으로 이동함에 따라 제2저항층(23)과 상부전극(25) 사이의 전위장벽이 다시 높아지게 된다. 이를 통해, 리셋동작 특성을 보다 효과적으로 향상시킬 수 있다. In addition, the
이처럼, 본 발명의 저항층(24)은 제1 및 제2저항층(22, 23)이 서로 다른 산소환원력을 갖는 물질(또는 서로 다른 산소결합력을 갖는 물질)로 이루어짐에 따라 제1 및 제2저항층(22, 23)에서의 단위체적당 산소공공(26) 밀도를 서로 다르게 가져갈 수 있으며, 이를 통해 저항성 메모리 장치의 셋/리셋동작 특성(즉, 셋/리셋전류, 셋/리셋시간 등)을 향상시킬 수 있다. As described above, the
도 4a 내지 도 4d는 본 발명의 일실시예에 따른 저항성 메모리 장치의 제조방법을 도시한 공정단면도이다. 4A through 4D are cross-sectional views illustrating a method of manufacturing a resistive memory device in accordance with an embodiment of the present invention.
도 4a에 도시된 바와 같이, 하부전극(21)을 형성한다. 하부전극(21)은 백금(Pt), 이리듐(Ir), 금(Au), 루테늄(Ru), 이리듐산화물(IrO2), 루테늄산화물(RuO2), 티타늄질화물(TiN) 및 탄탈륨질화물(TaN)로 이루어진 그룹으로부터 선택 된 어느 하나로 이루어진 단일막 또는 이들이 적층된 적층막으로 형성할 수 있다. As shown in FIG. 4A, the
다음으로, 하부전극(21) 상에 제1저항층(22)을 형성한다. 이때, 제1저항층(22)은 산화물로 형성할 수 있다. 구체적으로, 제1저항층(22)은 티타늄(Ti)산화물, 니오브(Nb)산화물, 탄탈륨(Ta)산화물, 니켈(Ni)산화물, 텅스텐(W)산화물, 바나듐(V)산화물, 스트론튬티타늄(SrTi)산화물 및 바륨티타늄(BaTi)산화물로 이루어진 그룹으로부터 선택된 어느 하나로 이루어진 단일막 또는 이들이 적층된 적층막으로 형성할 수 있다.Next, the
도 4b에 도시된 바와 같이, 제1저항층(22) 상에 제1저항층(22)보다 낮은 산소환원력을 갖는 제2저항층(23)을 형성한다. 이때, 제2저항층(23)은 산화물로 형성할 수이 있으며, 제1저항층(22)보다 낮은 산소환원력을 갖는 제2저항층(23)은 제1저항층(22)보다 산소와의 결합력이 큰 산화물로 형성함을 의미한다. As shown in FIG. 4B, a
구체적으로, 제1저항층(22)보다 낮은 산소환원력(즉, 산소와의 결합력이 큰)을 갖는 제2저항층(23)으로는 실리콘(Si)산화물, 알루미늄(Al)산화물, 하프늄(Hf)산화물, 지르코늄(Zr)산화물, 란탄(La)산화물, 가톨리늄(Gd)산화물, 하프늄실리콘(HfSi)산화물, 지르코늄실리콘(ZrSi)산화물, 하프늄알루미늄(HfAl)산화물 및 란탄알루미늄(LaAl)산화물로 이루어진 그룹으로부터 선택된 어느 하나로 이루어진 단일막 또는 이들이 적층된 적층막으로 형성할 수 있다. Specifically, the second
이하, 제1 및 제2저항층(22, 23)이 적층된 적층구조물을 '저항층(24)'으로 표기한다. Hereinafter, the stacked structure in which the first and second resistance layers 22 and 23 are stacked is referred to as a 'resistance layer 24'.
도 4c에 도시된 바와 같이, 열처리를 실시하여 저항층(24) 내 공공을 생성한 다. 이때, 저항층(24) 즉, 제1 및 제2저항층(22, 23)이 산화물로 이루어짐에 따라 저항층(24) 내부에는 산소환원에 의해 산소공공(26)이 형성되며, 제1 및 제2저항층(22, 23)의 산소환원력이 서로 다름으로 인해 제1 및 제2저항층(22, 23) 내 단위체적당 산소공공(26) 밀도를 서로 다르게 형성할 수 있다. 즉, 본 발명의 일실시예에서는 제1저항층(22)의 산소환원력보다 제2저항층(23)의 산소환원력이 낮기 때문에 열처리를 통해 생성된 단위체적당 산소공공(26) 밀도는 제2저항층(23)보다 제1저항층(22)이 크다. As shown in FIG. 4C, heat treatment is performed to generate pores in the
열처리는 진공상태 또는 아르곤가스(Ar) 분위기에서 실시할 수 있다. 이때, 진공상태 또는 아르곤가스 분위기에서 실시하는 열처리는 저항층(24)에 가해지는 열에너지만을 사용하여 저항층(24) 내 산소성분을 환원시키는 방법으로, 열처리공정간 원치않는 불순물이 저항층(24) 내부로 침투하는 것을 효과적으로 방지할 수 있는 장점이 있다. The heat treatment can be carried out in a vacuum or in an argon gas (Ar) atmosphere. At this time, the heat treatment performed in a vacuum state or in an argon gas atmosphere is a method of reducing oxygen components in the
또한, 열처리는 산소환원효율을 증가시키기 위하여 수소가스(H2), 질소가스(N2) 및 암모니아가스(NH3)로 이루어진 그룹으로부터 선택된 어느 하나 또는 이들이 혼합된 혼합가스를 사용하여 실시할 수도 있다. 상술한 가스를 이용하여 열처리를 실시할 경우에는 열에너지에 의해 결합이 분리된 산소성분이 상술한 가스와 결합하여 휘발되기 때문에 보다 효율적으로 저항층(24) 내 산소공공(26)을 생성할 수 있는 장점이 있다. In addition, the heat treatment may be carried out using any one selected from the group consisting of hydrogen gas (H 2 ), nitrogen gas (N 2 ) and ammonia gas (NH 3 ) or mixed gas in order to increase the oxygen reduction efficiency. have. In the case of performing heat treatment using the above-described gas, since the oxygen component in which the bond is separated by thermal energy is combined with the above-described gas, the
열처리는 퍼니스열처리 또는 급속열처리를 사용하여 실시할 수 있으며, 300 ℃ ~ 600℃ 범위의 온도에서 실시할 수 있다. 여기서, 300℃ 미만의 온도에서 열처리를 실시할 경우에는 산소환원력이 큰 제1저항층(22) 즉, 산소와의 결합력이 낮은 제1저항층(22)에서도 산소공공(26)이 생성되지 않을 수 있으며, 600℃를 초과하는 온도에서 열처리를 실시할 경우에는 산소환원력이 작은 제2저항층(23) 즉, 산소와의 결합력이 큰 제2저항층(23)에서도 산소공공(26)이 용이하게 생성되어 제1 및 제2저항층(22, 23) 사이의 단위체적당 산소공공(26) 밀도차를 발생시키지 못할 우려가 있다.The heat treatment may be carried out using furnace heat treatment or rapid heat treatment, and may be carried out at a temperature in the range of 300 ° C to 600 ° C. In this case, when the heat treatment is performed at a temperature of less than 300 ° C., the
일례로, 제1저항층(22)을 티타늄산화물(TiO2)로 형성하고, 제2저항층(23)을 지르코늄산화물(ZrO2)로 형성한 경우에 암모니아가스(NH3)를 이용하여 400℃온도로 열처리를 실시하면, 티타늄산화물에 비하여 상대적으로 암모니아가스에 의한 산소환원력이 낮은 지르코늄산화물(즉, 티타늄산화물에 비하여 상대적으로 산소와의 결합력이 큰 지르코늄산화물) 내부에는 산소공공(26)이 거의 생성되지 않으나, 티타늄산화물 내부에는 다수의 산소공공(26)을 생성할 수 있다. 참고로, 티타늄산화물은 300℃ 이상의 온도에서부터 암모니아가스에 의한 산소환원이 발생하며(즉, 산소공공이 생성되며), 지르코늄산화물은 600℃ 이상의 온도에서부터 암모니아 가스에 의한 산소환원이 발생한다.For example, when the
도 4d에 도시된 바와 같이, 제2저항층(23) 상에 상부전극(25)을 형성한다. 이때, 상부전극(25)은 백금(Pt), 이리듐(Ir), 금(Au), 루테늄(Ru), 이리듐산화물(IrO2), 루테늄산화물(RuO2), 티타늄질화물(TiN) 및 탄탈륨질화물(TaN)로 이루어 진 그룹으로부터 선택된 어느 하나로 이루어진 단일막 또는 이들이 적층된 적층막으로 형성할 수 있으며, 하부전극(21)과 동일한 물질로 형성할 수 있다. As shown in FIG. 4D, the
상술한 공정과정에서 하부전극(21), 제1저항층(22), 제2저항층(23) 및 상부전극(25) 형성공정은 물리기상증착법(Physical Vapor Deposition, PVD), 화학기상증착법(Chemical Vapor Deposition, CVD) 및 원자층증착법(Atomic Layer Deposition, ALD)으로 이루어진 그룹으로부터 선택된 어느 한 방법을 사용하여 실시할 수 있다. The process of forming the
이와 같이, 본 발명은 저항층(24)을 서로 다른 산소환원력을 갖는(또는 서로 다른 산소와의 결합력을 갖는) 제1 및 제2저항층(22, 23)으로 형성함으로써, 한번의 열처리공정을 통해 서로 다른 단위체적당 산소공공(26) 밀도를 갖는 제1 및 제2저항층(22, 23)을 형성할 수 있다. 이를 통해, 저항성 메모리 장치의 생산성을 향상시킬 수 있으며, 열처리 공정시 기형성된 구조물에 가해지는 열적 부담을 경감시킬 수 있다. As described above, the present invention forms the
본 발명의 기술 사상은 상기 바람직한 실시예에 따라 구체적으로 기술되었으나, 상기 실시예는 그 설명을 위한 것이며, 그 제한을 위한 것이 아님을 주의하여야 한다. 또한, 본 발명의 기술분야의 통상의 전문가라면 본 발명의 기술사상의 범위내의 다양한 실시예가 가능함을 이해할 수 있을 것이다.Although the technical spirit of the present invention has been described in detail according to the above preferred embodiment, it should be noted that the above embodiment is for the purpose of description and not of limitation. In addition, those skilled in the art will appreciate that various embodiments within the scope of the technical idea of the present invention are possible.
도 1은 종래기술에 따른 저항성 메모리 장치를 도시한 단면도. 1 is a cross-sectional view showing a resistive memory device according to the prior art.
도 2는 본 발명의 일실시예에 따른 저항성 메모리 장치를 도시한 단면도. 2 is a cross-sectional view illustrating a resistive memory device in accordance with an embodiment of the present invention.
도 3a 및 도 3b는 본 발명의 일실시예에 따른 저항성 메모리 장치의 동작원리를 설명하기 위한 개략도. 3A and 3B are schematic diagrams for describing an operating principle of a resistive memory device according to an embodiment of the present invention.
도 4a 내지 도 4d는 본 발명의 일실시예에 따른 저항성 메모리 장치의 제조방법을 도시한 공정단면도. 4A through 4D are cross-sectional views illustrating a method of manufacturing a resistive memory device in accordance with an embodiment of the present invention.
*도면 주요 부분에 대한 부호 설명** Description of symbols on the main parts of the drawings *
21 : 기판 22 : 제1저항층21
23 : 제2저항층 24 : 저항층23: second resistive layer 24: resistive layer
25 : 상부전극 26 : 산소공공25: upper electrode 26: oxygen vacancies
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